JP4097250B2 - 誘電体材料およびこれを用いた半導体素子形成方法 - Google Patents
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- 238000000034 method Methods 0.000 title claims description 34
- 239000003989 dielectric material Substances 0.000 title claims description 33
- 239000004065 semiconductor Substances 0.000 title claims description 28
- CURLTUGMZLYLDI-UHFFFAOYSA-N Carbon dioxide Chemical compound O=C=O CURLTUGMZLYLDI-UHFFFAOYSA-N 0.000 claims description 104
- 239000003361 porogen Substances 0.000 claims description 76
- -1 polyphenylene Polymers 0.000 claims description 72
- 229920000265 Polyparaphenylene Polymers 0.000 claims description 62
- 229910002092 carbon dioxide Inorganic materials 0.000 claims description 52
- 239000001569 carbon dioxide Substances 0.000 claims description 52
- 239000007788 liquid Substances 0.000 claims description 46
- CSCPPACGZOOCGX-UHFFFAOYSA-N Acetone Chemical compound CC(C)=O CSCPPACGZOOCGX-UHFFFAOYSA-N 0.000 claims description 42
- OKKJLVBELUTLKV-UHFFFAOYSA-N Methanol Chemical compound OC OKKJLVBELUTLKV-UHFFFAOYSA-N 0.000 claims description 42
- YXFVVABEGXRONW-UHFFFAOYSA-N Toluene Chemical compound CC1=CC=CC=C1 YXFVVABEGXRONW-UHFFFAOYSA-N 0.000 claims description 42
- LFQSCWFLJHTTHZ-UHFFFAOYSA-N Ethanol Chemical compound CCO LFQSCWFLJHTTHZ-UHFFFAOYSA-N 0.000 claims description 40
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 claims description 19
- BDERNNFJNOPAEC-UHFFFAOYSA-N propan-1-ol Chemical compound CCCO BDERNNFJNOPAEC-UHFFFAOYSA-N 0.000 claims description 14
- 239000000758 substrate Substances 0.000 claims description 13
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 9
- 229910052710 silicon Inorganic materials 0.000 claims description 9
- 239000010703 silicon Substances 0.000 claims description 9
- 238000005266 casting Methods 0.000 claims description 2
- 238000004519 manufacturing process Methods 0.000 claims 7
- 229920000642 polymer Polymers 0.000 description 28
- 238000012545 processing Methods 0.000 description 28
- 239000000463 material Substances 0.000 description 22
- 239000002861 polymer material Substances 0.000 description 16
- 239000004642 Polyimide Substances 0.000 description 10
- 239000010408 film Substances 0.000 description 10
- 229920001721 polyimide Polymers 0.000 description 10
- 239000000615 nonconductor Substances 0.000 description 6
- 238000010292 electrical insulation Methods 0.000 description 5
- 239000011810 insulating material Substances 0.000 description 5
- 239000000203 mixture Substances 0.000 description 5
- 230000000712 assembly Effects 0.000 description 4
- 238000000429 assembly Methods 0.000 description 4
- 238000009413 insulation Methods 0.000 description 4
- 229920000090 poly(aryl ether) Polymers 0.000 description 4
- 229920006254 polymer film Polymers 0.000 description 4
- 239000011148 porous material Substances 0.000 description 4
- 229920001577 copolymer Polymers 0.000 description 3
- 229920001296 polysiloxane Polymers 0.000 description 3
- 239000004810 polytetrafluoroethylene Substances 0.000 description 3
- 229920001343 polytetrafluoroethylene Polymers 0.000 description 3
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 2
- 230000000052 comparative effect Effects 0.000 description 2
- 238000011161 development Methods 0.000 description 2
- 238000010438 heat treatment Methods 0.000 description 2
- 229910010272 inorganic material Inorganic materials 0.000 description 2
- 239000011147 inorganic material Substances 0.000 description 2
- 239000010409 thin film Substances 0.000 description 2
- 238000004630 atomic force microscopy Methods 0.000 description 1
- 239000011248 coating agent Substances 0.000 description 1
- 238000000576 coating method Methods 0.000 description 1
- 238000004891 communication Methods 0.000 description 1
- 230000000295 complement effect Effects 0.000 description 1
- 238000007334 copolymerization reaction Methods 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 239000002360 explosive Substances 0.000 description 1
- 239000012212 insulator Substances 0.000 description 1
- 239000012528 membrane Substances 0.000 description 1
- 229910044991 metal oxide Inorganic materials 0.000 description 1
- 150000004706 metal oxides Chemical class 0.000 description 1
- 238000012544 monitoring process Methods 0.000 description 1
- 239000011368 organic material Substances 0.000 description 1
- 229920000620 organic polymer Polymers 0.000 description 1
- 230000000704 physical effect Effects 0.000 description 1
- 229920005597 polymer membrane Polymers 0.000 description 1
- 238000004626 scanning electron microscopy Methods 0.000 description 1
- 239000000377 silicon dioxide Substances 0.000 description 1
- 239000002904 solvent Substances 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
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- H01L21/02282—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process liquid deposition, e.g. spin-coating, sol-gel techniques, spray coating
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Description
【発明の属する技術分野】
本発明は、誘電体材料およびこれを用いた半導体素子の絶縁方法を対象とする。特に、本発明は、液体または超臨界二酸化炭素を高分子誘電体膜に導入することによって調製される誘電体材料、およびこの誘電体材料を用いて半導体素子を絶縁することを対象とする。
【0002】
【従来の技術】
相補型金属酸化物半導体(CMOS)の爆発的成長は、こうした半導体素子のサイズが次々と縮小したことに対応して起こった。このCMOSサイズの縮小は、電気アセンブリの複数のCMOS間に配置される絶縁層を次々と薄くすることになった。絶縁層が極端に薄い膜でなければならないという要件は、電気的短絡による電気アセンブリの故障数を増やす誘引となった。もちろん、これらの故障は、こうした薄い絶縁材料の絶縁性能が不適当なためである。
【0003】
この問題は、当技術分野で見過ごされてきたわけではない。したがって、多くの製品およびプロセスが開発されて、誘電率がより低いより効果的な絶縁材料が提供された。半導体用途用に設計された誘電率が低いポリマーを記載している米国特許第5,548,159号、第5,965,679号、第5,965,934号、および第6,218,497号が注目される。この用途で使用するために開発されたポリマーには、ポリイミド、フッ素化ポリイミド、ポリオルガノヒドリドシラン、ポリシロキサン、ポリフェニレン、ジビニルシロキサン−ビスベンゾシクロブテン共重合体、ポリベンジル、およびポリアリールエーテルがある。
【0004】
これらの高分子材料を使用することによって、絶縁特性が改良され半導体を含む電気アセンブリの短絡故障は減少した。しかし、これらの新しく開発されたポリマーの使用によって、上記の「短絡」問題が完全に克服されたわけではない。すなわち、これらの新しいポリマーの誘電特性は従来用いられたものより低いが、これらの新しく開発されたポリマーによってもたらされる電気絶縁の程度は、これらポリマー膜によって分離された半導体素子間の短絡を防止するにはしばしば依然として不適当である。
【0005】
半導体素子間を絶縁する誘電体材料の高分子膜の不十分さを強調した上記の議論は、適当な絶縁能力をもたらすには新しいポリマーの開発以上の何かが必要であることを示唆するものである。確かに、半導体を含む電気アセンブリに用いられる絶縁材料に課された厳しい要件を満たすためには、従来開発されたものより誘電率がさらに低い高分子材料を開発するための技術の必要性を最近の開発は示唆している。
【0006】
【発明が解決しようとする課題】
本発明の目的は、絶縁能力に優れた高分子誘電体材料を提供することである。本発明の他の目的は、絶縁能力に優れた高分子誘電体材料を用いた半導体装置を提供することである。
【0007】
【課題を解決するための手段】
最近開発された小型の半導体素子を使用した電気アセンブリへの使用に適当な、誘電率が低下した新しい種類の高分子材料が開発された。
【0008】
本発明によれば、新しい誘電体材料が提供される。この誘電体材料は、高分子材料を基板上に配置することによって形成される。それに引き続いて、前記基板上に置かれたポリマーを、二酸化炭素が液体または超臨界状態に維持される熱力学的条件下で、液体または超臨界二酸化炭素と接触させる。次いで、この熱力学的条件を使用環境温度および圧力の条件に変える。
【0009】
さらに本発明によれば、半導体素子を含む電気アセンブリの絶縁方法が提供される。この方法では、高分子材料を電気アセンブリの表面に配置する。それに引き続いて、電気アセンブリを、二酸化炭素を液体または超臨界状態に維持することができる熱力学的条件下で、液体または超臨界二酸化炭素と接触させる。それに引き続いて、この熱力学的条件を使用環境温度および圧力の条件に調整する。
【0010】
【発明の実施の形態】
低い誘電率が、電気絶縁に用いられる材料の特徴である。材料が有機であるか無機であるかとは無関係に、材料の誘電率が5以下であれば、その材料は電気絶縁体用の候補とみなされる。したがって、誘電率が5のシリカなどの無機材料および誘電率が約4のポリイミドなどの有機材料は、優れた電気絶縁体とみなされる。
【0011】
当分野の技術者なら知っているように、半導体素子間の電気絶縁体として有機高分子材料を用いることが好ましい。これは、半導体素子を含む電気アセンブリ上に高分子膜をキャストすることは、その上に無機材料を配置するよりもはるかに容易であるからである。半導体素子を用いた電気アセンブリに電気絶縁体として用いられる好ましいポリマーの種類には、上記のポリイミド、およびフッ素化ポリイミド、ポリオルガノヒドリドシラン、ポリフェニレン、ポリシロキサン、ジビニルシロキサンとビスベンゾシクロブテンの共重合体、ポリベンジル、ポリアリールエーテル、およびポリテトラフルオロエチレンがある。以前最も一般に用いられていたポリマーであるポリイミドよりポリフェニレンの誘電率が低いので、最近はポリフェニレンがこの用途における好ましいポリマーとなった。
【0012】
特に好ましい種類のポリフェニレンは、Dow Chemical製造の高分子製品であり、その商標SiLK(登録商標)で呼ばれるポリマーである。SiLK(登録商標)の商標で市販されているポリマーは、米国特許第5,965,679号に記載されており、参照により本明細書に組み込む。SiLK(登録商標)などのポリフェニレンは、誘電率が約3.5のオーダーである。
【0013】
誘電率が3.5と低い材料は、優れた電気絶縁性を実現する。しかし、要求される電気絶縁性についての上記の議論から、この低い誘電率でも、非常に薄い膜に要求される電気絶縁としては不安であることがはっきりしている。当技術分野では、誘電率が3.5より低い絶縁材料が熱望されていることが明確である。
【0014】
誘電率が3.5より低い電気絶縁体は、以下に記述する方法によって提供される。本発明は、その作用を説明するどんな理論によっても限定されるものではないが、高分子誘電体材料内に空気を導入することによって誘電率が3.5未満にも低下するので、本発明の絶縁体は当技術分野の著しい進歩を表すものであると思われる。これは、当分野の技術者なら分かるように、空気の誘電率が1であるためである。したがって、用いられる高分子材料とは無関係に、本発明が予期する範囲の高分子材料は、誘電率が従来技術で得られる値より低いものである。空気の導入に伴う誘電率の低下は、絶対値としては大きいものではないかもしれないが、この低下は絶縁能力の著しい改良を伴うものである。
【0015】
高分子絶縁材料への空気の導入は、本発明の方法によって得られる。この方法では、シリコン・ウエーハなどの半導体素子の少なくとも片面を、上記の任意のポリマーなどの有機電気絶縁体で覆う。これらのポリマーの中では、ポリフェニレンが特に好ましい。
【0016】
本発明の好ましい実施形態では、ポロゲン(porogen:細孔形成物質)を供給する。すなわち、液体または超臨界二酸化炭素との接触前に、高分子材料をポロゲンと接触させる。本発明のポロゲンは、水、アセトン、トルエン、メタノール、エタノール、プロパノール、およびこれらの混合物からなる群から選択されることが好ましい。この好ましいポロゲンのリストは、排他的とみなすべきではない。他のポロゲンを、上記と代替することができる。
【0017】
いくつかの高分子材料とポロゲンの接触方法を用いることができる。第1の方法では、ポロゲンをポリマーの表面上に配置する。この方法は、特に好ましいポロゲンである水を用いる場合に特に好ましい。
【0018】
ポロゲンを導入する第2の方法は、液体または超臨界二酸化炭素にポロゲンを溶解してから、これを高分子材料と接触させるものである。この変形方法では、二酸化炭素以外にポロゲンを第2成分とする液体または超臨界二酸化炭素組成物とポリマーを接触させる。この実施形態では、アセトン、トルエン、メタノール、エタノール、およびプロパノールからなる群からポロゲンを選択することが好ましい。ポロゲンは、溶液の総重量を基準として10重量%までの濃度で存在することができる。
【0019】
ポロゲンを導入する第3の方法は、ポロゲンをその中に溶解した高分子誘電体材料組成物を供給する方策を用いる。この方法では、ポロゲンは、ポリマーの重量を基準として約1重量%までの濃度、またはポリマーへのポロゲンの溶解度のどちらか低い濃度で存在する。例えば、水はSiLK(登録商標)ポリフェニレンに0.25重量%程度しか溶解せず、したがってポリマーSiLK(登録商標)と水の組成物を用いる場合は、水の最大濃度は0.25重量%である。
【0020】
ポロゲンは、ポリマーの重量を基準として約1重量%までの濃度で存在するのが好ましい。ポロゲンは、ポリマーの総重量を基準として約0.01重量%から約1重量%の濃度で存在するのがさらに好ましい。
【0021】
特に好ましい実施形態では、誘電ポリマーはポリフェニレン、すなわちSiLK(登録商標)であり、かつポロゲンを用いる。この好ましい実施形態では、ポリフェニレン膜層の表面に、SiLK(登録商標)膜の重量を基準として約0.01重量%から1重量%の濃度で水を配置することが好ましい。
【0022】
二酸化炭素が浸透する気孔が形成されたら、処理装置に存在する熱力学的条件を使用環境に変える。使用環境温度および圧力で、二酸化炭素は気体になり高分子材料の気孔から逃げる。次いで、これらの気孔は空気で満たされ、高分子材料の誘電率を低下させる。
【0023】
次に図に移ると、本発明の方法の実施に好適な装置が提供される。ここで、その表面に低誘電率の高分子材料を配置するシリコン・ウエーハなどの半導体素子を参照番号16で示す。ポリマーおよび任意選択でポロゲン導入ステップを、図示した装置内で行うことができるが、これらのステップはこの装置の外で行うことが好ましい。これら初期加工ステップの場所とは無関係に、素子16を液体または超臨界二酸化炭素と接触させるステップは、図示した装置で行われる。
【0024】
半導体素子16を、この装置の加工室12の液体または超臨界二酸化炭素接触帯域14に配置する。ここで、半導体素子16は、液体または超臨界二酸化炭素に暴露される。加工室12、特に接触帯域14は、液体または超臨界二酸化炭素が加工中に液体または超臨界状態に確実に保たれているように設計する。したがって、加工室12は、約1,000psi(70kg/cm2)から約8,000psi(562kg/cm2)の圧力に維持する。より好ましくは、加工室12の圧力は、約2,000psi(140g/cm2)から約5,000psi(351kg/cm2)である。さらに好ましくは、加工室12の圧力は、約3,000psi(210kg/cm2)である。加工室12の温度は、約32℃から約100℃に維持する。好ましくは、加工室12の温度は、約40℃から約80℃に維持する。さらに好ましくは、加工室12の温度は約70℃である。
【0025】
上記の熱力学的条件を本発明の加工中維持することがきわめて重要であるので、加工室12は、熱伝対(図示せず)によって加工室12の温度を監視することができる熱制御装置32によって制御される。測定温度は、当技術分野で周知の温度制御手段に従って、制御装置32によって制御される加熱ジャケット18によって調節される。
【0026】
液体または超臨界二酸化炭素は、液体または超臨界二酸化炭素供給源30から加工室12へ供給される。図に示すように、供給源30から供給される液体または超臨界二酸化炭素は、液体または超臨界二酸化炭素供給源30の下流に配置された高圧ポンプ28で加圧される。高圧の液体または超臨界二酸化炭素は、導管22によって加工室12へ運ばれる。ちなみに、導管22に通ずる導管37へ貯蔵領域36から供給して追加成分を導入するための手段が設けられていることがに留意されたい。二酸化炭素組成物が供給される実施形態では、溶媒は貯蔵領域36に貯めておき、導管22と流通している導管37を経由して加工室12へ導入することができる。
【0027】
液体または超臨界二酸化炭素は、再循環してクローズド・システムを形成することができることを強調しておく。この好ましい実施形態では、タンク34を備えている。タンク34は、加工室12にある液体または超臨界二酸化炭素を外管24を経由して回収または精製し、あるいはその両方を行う。液体または超臨界二酸化炭素は、導管35を経由して加工室12へ再循環されて戻る。
【0028】
下記の実施例は、本発明の範囲を例証するために示すものである。これらの実施例は例証の目的のみで示すものであり、本発明がこれらに限定されるとみなすべきではない。
【0029】
比較例1
参照により本明細書に組み込んだ米国特許第5,965,679号に記載のポリフェニレン誘電体材料SiLK(登録商標)を、シリコン・ウエーハ上にキャストして厚み500ナノメートル(nm)の層をそこに形成した。得られた高分子膜を試験して誘電率を求めた。D. Van Krevelinが、Physical Properties of Polymers, Elsevier Press, New York, 1976年、237頁に記載した方法を用いて、J.K. Wollan製造のn、kエリプソメータで測定するなど248nmにおける屈折率手段を用いて、ポリフェニレン膜の誘電率を測定した。
【0030】
この比較例の概要を表に示す。
【0031】
実施例1
厚み500nmのSiLK(登録商標)の層を配置したシリコン・ウエーハを、図示した装置で処理した。この装置で、圧力2,000psi(140kg/cm2)および温度32℃で5分間、半導体素子を超臨界二酸化炭素に暴露した。それに引き続いて、加工室12を使用環境の熱力学的条件に戻した。このように処理したシリコン・ウエーハを加工室12から取り出し、この絶縁ポリフェニレン膜の誘電率を上記の方法に従って再度測定した。
【0032】
この実施例の概要を表に示す。
【0033】
実験例2
第3のサンプルも加工室12で加工した。しかし、このサンプルは超臨界二酸化炭素に5分間暴露したが、加工室12の熱力学的条件を実施例1と異なるものとした。熱力学的条件は、圧力5,027psi(353kg/cm2)および温度70℃に維持した。再度、誘電率を248nmにおける屈折率手段によって測定した。
【0034】
この実施例の概要を表に示す。
【表1】
【0035】
実験例3
厚み450nmのSiLK(登録商標)の膜をシリコン・ウエーハ上に配置した。高分子膜の重量を基準として1重量%未満を構成する水のコーティングをこの膜層の上に配置し、加工室12の接触帯域14に置いた。それに引き続いて、超臨界二酸化炭素を、圧力6,500psi(457kg/cm2)および温度70℃で、加工室12の帯域14に導入した。この接触は15分間続けた。次いで、加工室12の条件を、加工室を大気開放することによって使用環境に戻した。
【0036】
この接触によって多孔質の誘電膜層が生成した。原子間力顕微鏡法および走査電子顕微鏡法によって、この膜の中に10nmを超える細孔および凹みがあることが分かった。
【0037】
上記実施形態および実施例は、本発明の範囲および精神を例証するために提供される。当分野の技術者であれば、これらの実施形態および実施例によって、その他の実施形態および実施例も明らかとなろう。これらの他の実施形態および実施例は、本発明の所期の範囲内にある。したがって、本発明は、頭記の特許請求の範囲によってのみ限定されるものである。
【0038】
まとめとして、本発明の構成に関して以下の事項を開示する。
【0039】
(1)誘電体材料であって、
高分子材料を基板上に配置するステップと、
前記高分子材料と液体または超臨界二酸化炭素を、二酸化炭素を前記液体または超臨界状態に保持することができる熱力学的条件で接触させるステップと、
前記熱力学的条件を使用環境温度および圧力に調整するステップとによって形成される生成物を含む誘電体材料。
(2)前記高分子材料が、ポリイミド、フッ素化ポリイミド、ポリオルガノヒドリドシラン、ポリシロキサン、ポリフェニレン、ジビニルシロキサンとビスベンゾシクロブテンとの共重合体、ポリベンジル、ポリアリールエーテル、およびポリテトラフルオロエチレンからなる群から選択される、上記(1)に記載の誘電体材料。
(3)前記高分子材料がポリフェニレンである、上記(2)に記載の誘電体材料。
(4)前記高分子材料を、ポロゲンの存在下に液体または超臨界二酸化炭素と接触させる、上記(1)に記載の誘電体材料。
(5)前記ポロゲンが、前記高分子材料上に前記ポロゲンを配置すること、前記ポロゲンを前記高分子材料と混合すること、または前記ポロゲンを前記液体または超臨界二酸化炭素と混合することによって存在する、上記(4)に記載の誘電体材料。
(6)前記ポロゲンが、ポリフェニレン膜上に水を配置することによって存在し、前記水が、前記ポリフェニレンの重量を基準として約0.01重量%から約1重量%である、上記(5)に記載の誘電体材料。
(7)前記ポロゲンが、前記液体または超臨界二酸化炭素の総重量を基準として約10重量%までの濃度で、前記液体または超臨界二酸化炭素にポロゲンを溶解することによって存在し、前記ポロゲンが、アセトン、トルエン、メタノール、エタノールおよびプロパノールからなる群から選択される、上記(5)に記載の誘電体材料。
(8)前記ポロゲンが、前記高分子材料の重量を基準として約1重量%までのポロゲンを前記高分子材料と混合することによって存在し、前記ポロゲンが、アセトン、トルエン、メタノール、エタノールおよびプロパノールからなる群から選択される、上記(5)に記載の誘電体材料。
(9)前記ポロゲンが、約0.25重量%までの濃度で存在する水であり、前記高分子材料がポリフェニレンである、上記(8)に記載の誘電体材料。
(10)前記基板がシリコン・ウエーハである、上記(1)に記載の誘電体材料。
(11)誘電体材料であって、
(a)シリコン・ウエーハ上にポリフェニレンをキャストするステップと、
(b)前記キャスト・ポリフェニレンの表面に水を配置するステップであって、前記水が、前記キャスト・ポリフェニレンの総重量を基準として約0.01重量%から約1重量%の濃度で存在するステップと、
(c)前記ポリフェニレンと液体または超臨界二酸化炭素を、約1,000psi(70kg/cm2)から約8,000psi(562kg/cm2)の圧力、および約32℃から約100℃の温度で接触させるステップと、
(d)前記熱力学的条件を使用環境温度および圧力に変えるステップとによって形成される生成物を含む誘電体材料。
(12)半導体素子を含む電気アセンブリの形成方法であって、
(a)高分子材料を半導体素子の表面上に配置するステップと、
(b)前記高分子材料と液体または超臨界二酸化炭素を、二酸化炭素を前記液体または超臨界状態に維持することができる熱力学的条件で接触させるステップと、
(c)前記半導体素子が維持される前記熱力学的条件を使用環境温度および圧力条件に調整するステップとを含む方法。
(13)前記高分子材料が、ポリイミド、フッ素化ポリイミド、ポリオルガノヒドリドシラン、ポリシロキサン、ポリフェニレン、ジビニルシロキサンとビスベンゾシクロブテンとの共重合体、ポリベンジル、ポリアリールエーテル、およびポリテトラフルオロエチレンからなる群から選択される上記(12)に記載の方法。
(14)前記高分子材料がポリフェニレンである、上記(13)に記載の方法。
(15)前記高分子材料を液体または超臨界二酸化炭素と接触させる前に、前記高分子材料をポロゲンと接触させるステップを含む、上記(12)に記載の方法。
(16)前記ポロゲン接触ステップが、前記ポロゲンをポリフェニレン膜に、前記ポリフェニレンの重量を基準として約0.01重量%から約1重量%の濃度で配置することを含む、上記(15)に記載の方法。
(17)前記ポロゲン接触ステップが、前記液体または超臨界二酸化炭素に、溶液の総重量を基準として約10重量%までの前記ポロゲンを溶解することを含み、前記ポロゲンが、アセトン、トルエン、メタノール、エタノールおよびプロパノールからなる群から選択される、上記(15)に記載の方法。
(18)前記ポロゲン接触ステップが、前記高分子材料の重量を基準として、約1重量%までの前記ポロゲンを合体することを含み、前記ポロゲンが、前記高分子材料中のアセトン、トルエン、メタノール、エタノールおよびプロパノールからなる群から選択される、上記(15)に記載の方法。
(19)前記ポロゲン接触ステップが、ポリフェニレンの重量を基準として約0.25%までの水をポリフェニレンに合体することを含む、上記(15)に記載の方法。
(20)前記ステップ(b)が、約32℃から約100℃の温度、および約1,000psi(70kg/cm2)から約8,000psi(562kg/cm2)の圧力で行われる、上記(12)に記載の方法。
【図面の簡単な説明】
【図1】高分子材料を液体または超臨界二酸化炭素と接触させるプロセスに用いられる装置の模式図である。
【符号の説明】
12 加工室
14 液体または超臨界二酸化炭素接触帯域
16 半導体素子
18 加熱ジャケット
22 導管
24 外管
28 高圧ポンプ
30 液体または超臨界二酸化炭素供給源
32 熱制御装置
34 タンク
35 導管
36 貯蔵領域
37 導管
Claims (13)
- ポリフェニレンを基板上に配置するステップと、
前記ポリフェニレンと液体または超臨界二酸化炭素を、二酸化炭素を前記液体または超臨界状態に保持することができる熱力学的条件で接触させるステップと、
前記熱力学的条件を使用環境温度および圧力に調整するステップとを含む
誘電体材料の製造方法。 - 前記ポリフェニレンを液体または超臨界二酸化炭素と接触させる前に、前記ポリフェニレンをポロゲンと接触させるポロゲン接触ステップを含み、
以下に示す(A)〜(C)のいずれか1つを少なくとも含む請求項1に記載の誘電体材料の製造方法。
(A)前記ポリフェニレンを基板上に配置するステップが、ポリフェニレン膜を基板上に配置するステップであり、かつ、前記ポロゲン接触ステップが、ポリフェニレン膜上に、前記ポリフェニレンの重量を基準として0.01重量%から1重量%の濃度で水を配置することを含むステップ。
(B)前記ポロゲン接触ステップが、前記液体または超臨界二酸化炭素に、溶液の総重量を基準として10重量%までの前記ポロゲンを溶解することを含み、前記ポロゲンが、アセトン、トルエン、メタノール、エタノールおよびプロパノールからなる群から選択されるステップ。
(C)前記ポロゲン接触ステップが、前記ポリフェニレンの重量を基準として、1重量%までの前記ポロゲンを合体することを含み、前記ポロゲンが、前記ポリフェニレン中のアセトン、トルエン、メタノール、エタノールおよびプロパノールからなる群から選択されるステップ。 - 前記ポリフェニレンを基板上に配置するステップが、ポリフェニレン膜を基板上に配置するステップであり、かつ、前記ポロゲン接触ステップが、ポリフェニレン膜上に、前記ポリフェニレンの重量を基準として0.01重量%から1重量%の濃度で水を配置することを含む、請求項2に記載の誘電体材料の製造方法。
- 前記ポロゲン接触ステップが、前記液体または超臨界二酸化炭素に、溶液の総重量を基準として10重量%までの前記ポロゲンを溶解することを含み、前記ポロゲンが、アセトン、トルエン、メタノール、エタノールおよびプロパノールからなる群から選択される、請求項2に記載の誘電体材料の製造方法。
- 前記ポロゲン接触ステップが、前記ポリフェニレンの重量を基準として、1重量%までの前記ポロゲンを合体することを含み、前記ポロゲンが、前記ポリフェニレン中のアセトン、トルエン、メタノール、エタノールおよびプロパノールからなる群から選択される、請求項2に記載の誘電体材料の製造方法。
- 前記液体または超臨界状態に保持することができる熱力学的条件で接触させるステップが、32℃から100℃の温度、および1,000psi(70kg/cm 2 )から8,000psi(562kg/cm 2 )の圧力で行われる、請求項1に記載の誘電体材料の製造方法。
- (a)シリコン・ウエーハ上にポリフェニレンをキャストするステップと、
(b)前記キャスト・ポリフェニレンの表面に水を配置するステップであって、前記水が、前記キャスト・ポリフェニレンの総重量を基準として0.01重量%から1重量%の濃度で存在するステップと、
(c)前記ポリフェニレンと液体または超臨界二酸化炭素を、1,000psi(70kg/cm2)から8,000psi(562kg/cm2)の圧力、および32℃から100℃の温度で接触させるステップと、
(d)前記熱力学的条件を使用環境温度および圧力に変えるステップとを含む
誘電体材料の製造方法。 - 半導体素子を含む電気アセンブリの形成方法であって、
(a)ポリフェニレンを半導体素子の表面上に配置するステップと、
(b)前記ポリフェニレンと液体または超臨界二酸化炭素を、二酸化炭素を前記液体または超臨界状態に維持することができる熱力学的条件で接触させるステップと、
(c)前記半導体素子が維持される前記熱力学的条件を使用環境温度および圧力条件に調整するステップとを含む、方法。 - 前記ポリフェニレンを液体または超臨界二酸化炭素と接触させる前に、前記ポリフェニレンをポロゲンと接触させるポロゲン接触ステップを含み、以下に示す(A)〜(C)のいずれか1つを少なくとも含む請求項8に記載の方法。
(A)前記ポリフェニレンを基板上に配置するステップが、ポリフェニレン膜を基板上に配置するステップであり、かつ、前記ポロゲン接触ステップが、ポリフェニレン膜上に、前記ポリフェニレンの重量を基準として0.01重量%から1重量%の濃度で水を配置することを含むステップ。
(B)前記ポロゲン接触ステップが、前記液体または超臨界二酸化炭素に、溶液の総重量を基準として10重量%までの前記ポロゲンを溶解することを含み、前記ポロゲンが、アセトン、トルエン、メタノール、エタノールおよびプロパノールからなる群から選択されるステップ。
(C)前記ポロゲン接触ステップが、前記ポリフェニレンの重量を基準として、1重量%までの前記ポロゲンを合体することを含み、前記ポロゲンが、前記ポリフェニレン中のアセトン、トルエン、メタノール、エタノールおよびプロパノールからなる群から選択されるステップ。 - 前記ポリフェニレンを基板上に配置するステップが、ポリフェニレン膜を基板上に配置するステップであり、かつ、前記ポロゲン接触ステップが、ポリフェニレン膜上に、前記ポリフェニレンの重量を基準として0.01重量%から1重量%の濃度で水を配置することを含む、請求項9に記載の方法。
- 前記ポロゲン接触ステップが、前記液体または超臨界二酸化炭素に、溶液の総重量を基準として10重量%までの前記ポロゲンを溶解することを含み、前記ポロゲンが、アセトン、トルエン、メタノール、エタノールおよびプロパノールからなる群から選択される、請求項9に記載の方法。
- 前記ポロゲン接触ステップが、前記ポリフェニレンの重量を基準として、1重量%までの前記ポロゲンを合体することを含み、前記ポロゲンが、前記ポリフェニレン中のアセトン、トルエン、メタノール、エタノールおよびプロパノールからなる群から選択される、請求項9に記載の方法。
- 前記ステップ(b)が、32℃から100℃の温度、および1,000psi(70kg/cm2)から8,000psi(562kg/cm2)の圧力で行われる、請求項8に記載の方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US09/893104 | 2001-06-27 | ||
US09/893,104 US20030008129A1 (en) | 2001-06-27 | 2001-06-27 | Dielectric material and process of insulating a semiconductor device using same |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2003109431A JP2003109431A (ja) | 2003-04-11 |
JP4097250B2 true JP4097250B2 (ja) | 2008-06-11 |
Family
ID=25401043
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2002184636A Expired - Fee Related JP4097250B2 (ja) | 2001-06-27 | 2002-06-25 | 誘電体材料およびこれを用いた半導体素子形成方法 |
Country Status (2)
Country | Link |
---|---|
US (3) | US20030008129A1 (ja) |
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- 2001-06-27 US US09/893,104 patent/US20030008129A1/en not_active Abandoned
-
2002
- 2002-06-25 JP JP2002184636A patent/JP4097250B2/ja not_active Expired - Fee Related
-
2003
- 2003-06-06 US US10/456,299 patent/US7056837B2/en not_active Expired - Fee Related
-
2006
- 2006-04-06 US US11/399,579 patent/US7485964B2/en not_active Expired - Fee Related
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Publication number | Priority date | Publication date | Assignee | Title |
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CN107507683A (zh) * | 2017-08-16 | 2017-12-22 | 广东海翔教育科技有限公司 | 一种增强型环保绝缘材料加工装置及制备方法 |
Also Published As
Publication number | Publication date |
---|---|
US20030211312A1 (en) | 2003-11-13 |
JP2003109431A (ja) | 2003-04-11 |
US7485964B2 (en) | 2009-02-03 |
US20030008129A1 (en) | 2003-01-09 |
US20060180922A1 (en) | 2006-08-17 |
US7056837B2 (en) | 2006-06-06 |
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RD12 | Notification of acceptance of power of sub attorney |
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|
A521 | Request for written amendment filed |
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|
A521 | Request for written amendment filed |
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TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
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|
RD14 | Notification of resignation of power of sub attorney |
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|
A61 | First payment of annual fees (during grant procedure) |
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|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
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|
S531 | Written request for registration of change of domicile |
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|
FPAY | Renewal fee payment (event date is renewal date of database) |
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|
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|
FPAY | Renewal fee payment (event date is renewal date of database) |
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|
FPAY | Renewal fee payment (event date is renewal date of database) |
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|
FPAY | Renewal fee payment (event date is renewal date of database) |
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