JP3894220B2 - 記憶制御装置 - Google Patents
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Description
本実施例では、マスタ制御装置700が、副制御装置109から基準となる時刻を計算するのに必要な情報を受け取ったが、図7に示すように、正制御装置104から受け取るようにしてもよい。この場合、マスタ副制御装置700の制御用メモリ108には、マスタ正制御装置ライト時刻800がある。マスタ正制御装置ライト時刻800は、正制御装置104対応の情報である。マスタ正制御装置ライト時刻800は、各正制御装置104から、マスタ副制御装置700が、適当な周期で、その正制御装置109内で、オン状態の副制御装置転送必要ビット124を含むすべてのライトデ−タ管理情報113の中で、最も以前のライト時刻111を受け取リ、設定を行う情報である。マスタライト時刻702には、マスタ副制御装置700が、適当な周期で、すべての正制御装置ライト時刻701を参照して、もっとも以前の時刻を選択して、この時刻を設定する。デステ−ジ、デ−タ破棄の際、基準となる時刻として用いる時刻が、マスタライト時刻702である点は、同様である。
107…制御用メモリ
108…キャッシュメモリ
109…副制御装置
111…ライト時刻
112…ライトデ−タ
113…ライトデ−タ管理情報
124…副制御装置転送必要ビット
130…正ライトデ−タ受領部
140…正ライトデ−タ送信部
150…副ライトデ−タ受領部
160…副ライトデ−タデステ−ジ部
170…正基準時刻送信部
180…副基準時刻受信部
185…デステ−ジ許可時刻
190…正障害時デ−タ破棄部
300…正ライトデ−タ送信部a
310…副ライトデ−タデステ−ジ部a
500…正制御装置ライト許可時刻
510…副ライトデ−タデステ−ジ部b
520…副基準時刻受信部b
530…正障害時デ−タ破棄部b
700…マスタ副制御装置
701…副制御装置ライト時刻
702…マスタライト基準時刻
710…副ライト時刻送信部
711…マスタ副ライト時刻受信部
712…マスタ副ライト時刻ケ計算部
713…マスタ副ライト時刻送信部
710…副ライトデ−タデステ−ジ部c
720…正障害時デ−タ破棄部c
800…正制御装置ライト時刻
Claims (4)
- 処理装置と、前記処理装置に接続される第一の記憶システムと、および、前記第一の記憶システムに接続される第二の記憶システムとから構成されるシステムのデータ処理方法であって、
前記第一の記憶システムが、前記処理装置から受信した第一のライトデータを前記第一の記憶システムの第一のキャッシュメモリに格納し、前記第一のライトデータを前記第一のキャッシュメモリに格納したことを報告する第一の完了報告を前記処理装置に行うステップと、
前記第一の記憶システムが、前記第一のライトデータを受信後に、前記処理装置から受信した第二のライトデータを前記第一のキャッシュメモリに格納し、前記第二のライトデータを前記第一のキャッシュメモリに格納したことを報告する第二の完了報告を前記処理装置に行うステップと、
前記第一の記憶システムが、前記第一の完了報告を前記処理装置に行った後に、前記第一のライトデータと前記第一のライトデータの時刻に関する第一の参照情報とを前記第二の記憶システムに送信するステップと、
前記第一の記憶システムが、前記第二の完了報告を前記処理装置に行った後に、前記第二のライトデータと前記第二のライトデータの時刻に関する第二の参照情報とを前記第二の記憶システムに送信するステップと、
前記第二の記憶システムが、受信した前記第一のライトデータを、前記第二の記憶システムの第二のキャッシュメモリに格納し、前記第一のライトデータを受信したことを示す応答を前記第一の記憶システムに送信するステップと、
前記第一の記憶システムが、前記応答を受信した後に、前記第二の記憶システムへ、前記第一のライトデータを前記第二の記憶システムが有する前記第二のキャッシュメモリから前記第二の記憶システムが有する第二の記憶装置へデステージすることに関するメッセージを送信するステップと、
前記第二の記憶システムが、前記メッセージの受信に応じて、前記第一のライトデータを、前記第二のキャッシュメモリから前記第二の記憶システムが有する記憶装置にデステージするステップとを有することを特徴とするデータ処理方法。 - 請求項1記載のデータ処理方法であって、
前記第一の記憶システムが、前記第一の完了報告を行った後、前記第一のライトデータを前記第一の記憶システムが有する第一の記憶装置に格納するステップと、
前記第二の完了報告を行った後、前記第二のライトデータを前記第一の記憶装置に格納するステップを有することを特徴とするデータ処理方法。 - 第一の記憶システムと第二の記憶システムとから構成されるデータ記憶システムであって、
前記第一の記憶システムは、データを記憶する第一の記憶装置と、外部処理装置と前記第一の記憶装置との間でデータの転送を制御する第一の記憶制御装置を有し、
前記第二の記憶システムは、データを記憶する第二の記憶装置と、前記第一の記憶制御装置と前記第二の記憶装置との間でデータの転送を制御する第二の記憶制御装置を有し、
ここで、
前記第一の記憶制御装置が、
前記外部処理装置から受信した第一のライトデータを前記第一の記憶制御装置のキャッシュメモリに格納し、前記第一のライトデータを前記キャッシュメモリに格納したことを報告する第一の完了報告を前記外部処理装置に行い、前記第一のライトデータを受信後に、前記外部処理装置から受信した第二のライトデータを前記キャッシュメモリに格納し、前記第二のライトデータを前記キャッシュメモリに格納したことを報告する第二の完了報告を前記外部処理装置に行い、前記第一の完了報告を行った後に前記第一のライトデータと前記第一のライトデータの時刻に関する第一の参照情報とを前記第二の記憶制御装置に送信し、前記第二の完了報告を行った後に前記第二のライトデータと前記第二のライトデータの時刻に関する第二の参照情報とを前記第二の記憶制御装置に送信し、
前記第二の記憶制御装置が、受信した前記第一のライトデータを記憶し、前記第一のライトデータを受信したことを示す応答を前記第一の記憶システムに送信し、
前記第一の記憶制御装置が、前記応答を受信した後に、前記第二の記憶制御装置へ、前記第一のライトデータを前記第二の記憶制御装置から前記第二の記憶装置へデステージすることに関するメッセージを送信し、
前記第二の記憶制御装置が、前記メッセージの受信に応じて、前記第一のライトデータを、前記第二の記憶制御装置から前記第二の記憶装置にデステージすることを特徴とするデータ記憶システム。 - 請求項3記載のデータ記憶システムであって、
前記第一の記憶制御装置が、前記第一の完了報告を行った後、前記第一のライトデータを前記第一の記憶装置に格納し、前記第二の完了報告を行った後、前記第二のライトデータを前記第一の記憶装置に格納することを特徴とするデータ記憶システム。
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