JP3784334B2 - Semiconductor device inspection equipment - Google Patents
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Description
【0001】
【発明の属する技術分野】
本発明は、半導体素子を検査する検査装置に係り、プロービング検査およびバーンイン検査など半導体素子製造工程における半導体素子の電気的特性を効率的に検査する半導体素子検査装置に関する。
【0002】
【従来の技術】
ICやLSIなどにおける半導体素子の製造工程は、シリコンウエハ表面に集積回路を形成するまでのいわゆる前工程と、このシリコンウエハを個別のチップに分離して樹脂やセラミック等で封止するまでのいわゆる後工程とに大別される。
【0003】
これらの半導体素子では前工程中の所定の段階において、各回路の電気的特性検査が行われ、チップ単位で良品、不良品の判定が行われる。
【0004】
電気的特性検査は各回路間の導通の良否を判別するプロービング検査と、150℃程度の高温中で熱的、電気的ストレスを回路に付与して不良を加速選別するバーンイン検査と、最終的に高周波を用いて検査を行う選別検査とに大きく分別することができる。
【0005】
特に、高周波を用いて行われる選別検査では高速デバイスの検査を超高周波を用いて行う高速動作の検査方式が望まれている。
【0006】
上述した各種の検査方法においては、検査装置と被検ウエハもしくは被検チップおよび外部の検査システムの基本的な接続手段は同様である。
【0007】
つまり、検査装置には個々に導電性を有する微細なプローブが形成されており、被検ウェハもしくは被検チップ上に数十ないし百数十μmピッチでパターニングされた、数十ないし百数十μm角、厚さ1μm程度の個々のアルミニウム合金もしくはその他合金電極パッドに対して、上記プローブが機械的に押圧される。
【0008】
また、検査装置には外部の検査システムに接続する外部接続電極が形成されており、上記プローブと外部電極とを接続するための配線がプローブから外部電極に到るまで形成されている。検査装置と外部検査システムとの接続は、外部検査システムの電極ピンを検査装置の外部接続電極に機械的に押圧して接触させる手段を用いる。
【0009】
上述した半導体素子検査装置の一例としては、本発明者等が先に提案している特開平11−274251号公報に記載された技術がある。この公報記載の技術は、シリコンをエッチングすることにより、シリコン基板上にプローブ、梁、貫通孔を一体型で形成し、プローブと外部電極とを接続する配線は、プローブから貫通孔を介して外部接続電極に到る配線により接続される。
【0010】
【発明が解決しようとする課題】
ところで、被検ウエハのパッド数増加に伴い、プローブ数および貫通孔数が増加する傾向にあるが、機械的な手法で貫通孔を形成したのでは、形成可能な数に限界がある。
このため、異方性エッチングを用いて貫通孔が形成されている。
【0011】
しかしながら、異方性エッチングを用いて単に貫通孔を形成すると、貫通孔の形状は四角錐状となってしまい、この四角錐の頂点付近がシリコン基板一方の面側の開口部となり、開口面積は極小とならざるをえない。
【0012】
このため、異方性エッチングを用いて形成された貫通孔を介して基板の表裏面に渡る導電配線を形成すると、上記極小開口部分に形成される配線の抵抗値が大となるばかりか、断線の可能性も大となる。
【0013】
配線の抵抗値の増大及び断線を防止するため、形成した貫通孔に導電体を充満させることも考えられる。
【0014】
しかしながら、貫通孔に導電体を充満させるためには、製造工程が複雑となり、製造時間が長くなってしまうため、望ましいものではない。
【0015】
したがって、導電性配線の抵抗値の増大及び断線を抑制する他の手段が望まれている。
【0016】
本発明の目的は、基板の両面を電気的に導通させるための貫通孔を介して形成される配線の抵抗が小さく、かつ断線を抑制可能な半導体素子検査装置を実現することである。
【0017】
【課題を解決するための手段】
上記目的を達成するために、本発明は次のように構成される。
(1)基板の一方の面に設けられ、検査すべき半導体素子の電極パッドに接触されるプローブと、上記基板の他方の面に設けられ、上記プローブからの電気信号を外部に伝達する外部接続電極と、上記プローブと上記外部接続電極とを上記基板に形成された貫通孔を介して電気的に接続する配線とを有する半導体素子検査装置において、上記基板に形成された貫通孔における、上記基板の一方面側の開口部又は上記基板の他方面側の開口部のうち、開口面積が小さい開口部は、矩形を組みあわせて、3つ以上の突状部を有する形状であり、上記基板の一方面側及び他方面側の少なくとも一方に、上記突状部のそれぞれを包囲して形成される3つ以上の両面接続用配線部であって、これら両面接続用配線部のそれぞれは、互いに電気的に分離されて、上記配線に接続される。
【0021】
(2)好ましくは、上記(1)において、上記開口面積が小さい開口部は、凸型形状、十字型形状又はH型形状である。
【0023】
(3)半導体素子を検査する半導体素子検査装置の半導体素子検査基板において、矩形を組みあわせて、3つ以上の突状部を有する形状の開口部を有する貫通孔が形成された基板と、上記基板の一方の面に設けられ、検査すべき半導体素子の電極パッドに接触されるプローブと、上記基板の他方の面に設けられ、上記プローブからの電気信号を外部に伝達する外部接続電極と、上記基板の一方の面と他方の面とを貫通する貫通孔を介して電気的に接続する配線と、上記基板の一方面側及び他方面側の少なくとも一方に、上記貫通孔開口部の突状部のそれぞれを包囲して形成され、互いに電気的に分離されて、上記配線に接続される3つ以上の両面接続用配線部とを備える。
【0024】
(4)好ましくは、上記(3)において、上記貫通孔の開口部は、凸型形状、十字型形状又はH型形状である。
【0025】
両面接続用配線部の形成により、貫通孔開口部(底部)近辺においての配線の断線を抑制することができ、かつ貫通孔開口部周囲からの配線の接続(引き出し)が容易となり、配線の抵抗値を低減することが可能となる。
【0026】
したがって、本発明によれば、基板の両面を電気的に導通させるための貫通孔を介して形成される配線の抵抗が小さく、かつ断線を抑制可能な半導体素子検査装置及び半導体検査基板を実現することができる。
【0027】
また、貫通孔の形状を凸型、十字型、H型とすれば、貫通孔サイズを小さくでき、かつ半導体素子検査基板のサイズを小さくすることができる。
【0028】
【発明実施の形態】
以下、本発明の実施形態について図面を参照して説明する。
図1は、本発明が適用される半導体素子検査装置の全体概略断面図である。この検査装置は、プロービング検査工程、バーンイン検査工程及び選別検査工程で用いられる。
【0029】
図1において、半導体素子検査装置1の、単一のシリコン基板(半導体素子検査基板)11は、エッチングされ、被検体3に対向する面にプローブ111群が形成されている。
【0030】
プローブ111群の各先端には被検体3と外部装置との導通を得るための配線221が、ウエハプロセス技術を用いて形成されている。そして、配線221は半導体素子検査基板11に設けられた貫通孔13を介してプローブ111群が形成された面とは反対側の面まで延長して形成され、上記反対側の面に形成された外部接続電極222に電気的に接続されている。
【0031】
半導体素子検査基板11の外部接続電極222が形成された面には第1基板4が接合されている。この第1基板4は、半導体素子検査基板11の平坦性確保、補強の目的で用いられている。
【0032】
第1基板4の半導体素子検査基板11に接合される面の他方面には、エラストマ5が設けられており、このエラストマ5を介して第2基板6が設けられている。この第2基板6は、一般的には、多層の導通配線が展開されたガラスエポキシ多層プリント基板が用いられる。
【0033】
エラストマ5は、半導体素子検査基板11のプローブ111群を形成した面が被検体3の面に対して、傾斜している場合、その向きを被検体3に倣わせること、および被検体3と半導体素子検査基板11との押し付け量のばらつきに伴う荷重バラツキを低減させる目的で用いられる。
【0034】
また、エラストマ5にはヤング率が小さく、ゴム弾性挙動を示すエラストマが用いられる。または、エラストマ5にはコイル状ばねを用いても良い。
【0035】
第2基板6には導通構造体7が形成され、この導通構造体7は、被検体3と第2基板6とを、半導体素子検査基板11のプローブ111、配線221、外部接続電極222を介して導通させるために用いられる。
【0036】
導通構造体7は、例えば、スプリング付きコンタクトプローブ、又は、はんだボールが用いられる。
【0037】
次に、本発明の第1の実施形態による半導体素子検査装置1の検査基板11の構成について説明する。
【0038】
図2は、本発明の第1の実施形態による半導体検査装置1の検査基板11におけるプローブ111を形成した面の平面図である。図3は、図2の底面図である。図4は、図2及び図3のX−X線に沿った断面図である。
【0039】
図2に示すように、半導体素子検査基板11は、シリコン基板を加工して、両端支持梁用溝開口部1121を形成する。また、図3および図4に示すように、シリコン基板を加工して、両端支持梁用溝1122を形成することにより、両端支持梁112を形成する。そして、図2及び図4に示すように、両端支持梁112の上に凸状のプローブ111を形成する。
【0040】
また、図2〜図4に示すように、シリコン基板を加工して、貫通孔113を形成する。さらに、図3及び図4に示すように、配線プロセスにより、シリコン基板のプローブ111が形成された面とは反対側の面に外部接続電極222を形成する。この外部接続電極222の形成と共に、図2〜図4に示すように、外部接続電極222と貫通孔113とプローブ111とを配線221により接続する。
【0041】
また、図2〜図4に示すように、貫通孔底部1131(四角錐状の貫通孔の頂点側の開口部)の周囲長より長い周囲長を有する両面接続用配線パターン223を、貫通孔113の内面側であって、貫通孔底部1131との境界部分を含む領域に形成するとともに、シリコン基板のプローブ111が形成される面側であって、貫通孔底部1131の周囲にも形成する(貫通孔底部1131を包囲して形成する)。これにより、シリコン基板の両面の電気的導通が行われる。
【0042】
つまり、例えば、(100)シリコン基板の厚みが500μmで、四角形状の貫通孔底部の一辺が50μmであり、同じく四角形状の貫通孔上部(四角錐状の貫通孔の底辺側の開口部)の一辺が760μmとすると、四角形状の開口部のうち、一辺の長さが200μm以下の領域を形成するシリコン基板の内面の全ての領域に両面接続用配線パターン223を形成する。
【0043】
この内面接続用配線パターン223が本発明の第1の実施形態における最も特徴とするところである。
【0044】
この両面接続用配線パターン223と外部接続電極222とが配線221により接続される。そして、両面接続用配線パターン223とプローブ111とが配線221により接続される。
【0045】
この両面接続用配線パターン223により、貫通孔底部1131を介してより広い部分でシリコン基板の両面側の配線221と接続することが可能となる。したがって、配線221の全体の抵抗値増加を減少することができるとともに、貫通孔底部1131近辺における配線221の断線を抑制することができる。
【0046】
次に、図5及び図6を用いて、本発明の第1の実施形態における半導体素子検査装置の検査基板の製造方法について説明する。
【0047】
図5は本発明の第1の実施形態による半導体素子検査装置における検査基板の製造方法の工程図である。
なお、図5に示したXXは、図2及び図3におけるX−X線に沿った断面を示し、図5のYYは、図2及び図3におけるY−Y線に沿った断面を示す。
【0048】
図5において、シリコン基板11をエッチングにより、両端支持梁用開口部1121、両端支持梁用溝1122、貫通孔113のようにエッチング量の異なるパターンを形成する場合には、シリコン基板11上にマスクを重ねて形成する。そして、それぞれのエッチング量に適合するように、エッチング後、所定のマスクを除去し、さらにエッチングを進行し、各エッチング量に差分を持たせる方法がある。本発明においても、このような方法により、各部のエッチング量に差を持たせることができる。
【0049】
図5の(イ)に示すように、プローブ111を形成したシリコン基板11上に、第1層マスク81を形成し、両端支持梁用開口部1121を形成し、その上に第2層マスク82を配置して、両端支持梁用溝1122のパターンを形成する。そして、さらに、第2層マスク82の上に形成された第3層マスク83によって、貫通孔13のパターンを形成する。
なお、第1層マスク81、第2層マスク82、第3層マスク83の材料としては、酸化シリコン、窒化シリコン、もしくはポリシリコン等が用いられる。
【0050】
次に、図5の(ロ)に示すように、貫通孔113と両端支持梁用溝1122との深さ差分をエッチングして形成する。
【0051】
続いて、図5の(ハ)に示すように、第3層マスク83を除去する。
次に、図5の(ニ)に示すように、両端支持梁112の厚さ分を残してエッチングし、貫通孔113を形成するためのエッチングも行う。
【0052】
続いて、図5の(ホ)に示すように、第2層マスク82を除去する。
次に、図5の(ヘ)に示すように、両端支持梁112をエッチングにより形成する。
そして、図5の(ト)に示すように、第1層マスク81を除去する。その後、シリコン基板11上に絶縁層を作成する。
【0053】
図5に示した工程によりシリコン基板11の形状が形成され、これに配線処理等が行われる。
【0054】
次に、図6を用いて、配線形成プロセスについて説明する。なお、図5と同様に、XXは、図2及び図3におけるX−X線に沿った断面を示し、YYは、図2及び図3におけるY−Y線に沿った断面を示す。
【0055】
まず、図6の(イ)に示すように、スパッタリング、蒸着、CVD法等により、金属膜2をシリコン基板11の両面に形成する。
【0056】
次に、図6の(ロ)に示すように、フォトリソエッチングにより、配線221、外部接続電極222および両面接続用配線パターン223を形成する。
【0057】
次に、図6の(ハ)に示すように、配線抵抗の低減、プローブ111の寿命強度のため、電解めっき、無電解めっき等でめっき金属膜22を、配線221、外部接続電極222及び両面接続用配線パターン223に積層する。
【0058】
次に、図6の(ニ)に示すように、保護膜23を形成し、被検体等と接触するプローブ111及び外部接続電極222以外の配線を外部からの不純物、水分の付着から保護する。
以上のようにして本発明における半導体素子検査装置の検査基板が製造される。
【0059】
本発明の第1の実施形態における特徴は、上述したように、貫通孔底部1131に到る貫通孔内面側に両面接続用配線パターン223を形成した点である。この両面接続用配線パターン223の形成により、貫通孔底部1131近辺においての断線を抑制することができ、かつ貫通孔底部131周囲からの配線221の引き出しが容易となり、配線の抵抗値を低減することが可能となる。
【0060】
したがって、本発明の第1の実施形態によれば、基板の両面を電気的に導通させるための貫通孔を介して形成される配線の抵抗が小さく、かつ断線を抑制可能な半導体素子検査装置を実現することができる。
【0061】
さらに、この半導体素子検査装置の半導体素子検査基板を実現することができる。
【0062】
次に、図7、図8を用いて、本発明の第2の実施形態による半導体素子検査装置1の検査基板11について説明する。なお、この第2の実施形態は、貫通孔の底部の形状を3つの凸部を有する凸型形状とするものである。この凸型貫通孔は異方性エッチングにより形成される四角錐形状の孔を組みあわせて形成することができる。
【0063】
図7は、本発明の第2の実施形態による凸型貫通孔を形成した半導体素子検査装置における検査基板11のプローブを形成した面の平面図である。また、図8は、図7に示した検査基板11の底面図である。なお、図7及び図8において、図2及び図3と同一符号は、同一部分を示している。
【0064】
図7に示すように、半導体素子検査基板11は、シリコン基板に両端支持梁用開口部1121を形成し、また、図8に示すように、シリコン基板を加工して、両端支持梁用溝1122を形成することにより、両端支持梁112を形成する。
【0065】
そして、図7に示すように、両端支持梁112の上に凸状のプローブ111を形成する。
【0066】
さらに、図7及び図8に示すように、シリコン基板を加工して、凸型貫通孔114を形成する。そして、配線プロセスにより、外部接続電極222を形成すると共に、外部接続電極222と凸型貫通孔114とプローブ111とを配線221により接続する。
【0067】
また、凸型貫通孔114における貫通孔底部(シリコン基板のプローブ111が形成される面側における凸型貫通孔114の開口部)1141近辺に両面接続用配線パターン223を形成する。この両面接続用配線パターン223は、貫通孔底部1141の一つの突部に対してこの突部を囲む凹型形状が、凸型貫通孔114の内面側と、シリコン基板のプローブ111が形成される面側の凸型貫通孔114の周囲に形成され、シリコン基板の両面の電気的導通が行われる。
【0068】
この第2の実施形態による凸型貫通孔114が形成された半導体素子検査基板11の形成プロセスは、貫通孔が凸型形状であることを除外して上記に示した図5および図6と同様である。したがって、その詳細な説明は省略する。
【0069】
本発明の第2の実施形態における半導体素子検査装置の特徴は、貫通孔の形状を凸型として、両面接続用配線パターン223を各矩形部(3つの各突部)に形成した点である。
【0070】
貫通孔を凸型とすることで、貫通孔114の凸状底部の各凸部の周辺に形成された両面接続用配線パターン223に、3本の配線221を接続して、この配線221により、プローブ111から外部接続電極222までを接続することが可能である。
【0071】
したがって、この第2の実施形態における半導体素子検査装置によれば、第1の実施形態と同様な効果を得ることができる他、一つの貫通孔から3本の配線221を接続することが可能となり、3本の配線についてそれぞれ、貫通孔を形成する場合と比較して、貫通孔サイズを小さくすることができる。
【0072】
例えば、厚さ500μmの(100)シリコン基板を用いて、異方性エッチングにより、凸型貫通孔114を形成する場合、凸型貫通孔底部1141を100μm×150μmとしたとき、凸型貫通孔開口部142は880μm×910μmとなる。
【0073】
四角型貫通孔では配線一本当たり5.76×105μm2/本であるのに対し、凸型貫通孔では配線一本当たり2.67×105μm2/本となり、貫通孔サイズを小さく形成することが可能である。
【0074】
これにより、被検ウエハのパッド数増加に対応することが可能となる。
【0075】
次に、図9、図10を用いて、本発明の第3の実施形態による十字型貫通孔について説明する。この十字型貫通孔は、上述した凸型貫通孔と同様に、異方性エッチングを用いて形成される四角錐形状の孔を組みあわせて形成することができる。
【0076】
図9は、本発明の第3の実施形態による十字型貫通孔を形成した半導体素子検査装置の検査基板のプローブを形成した面の平面図である。また、図10は、図9の底面図である。なお、図9及び図10において、図2、図3と同一符号は、同一部分を示している。
【0077】
図9に示すように、半導体素子検査基板11は、シリコン基板に両端支持梁用溝開口部1121を形成し、両端支持梁用溝1122を形成することにより、両端支持梁112を形成する。
【0078】
また、両端支持梁112の上に凸状のプローブ111を形成する。そして、図9及び図10に示すように、シリコン基板を加工して、十字型貫通孔115を形成する。
【0079】
さらに、図9及び図10に示すように、配線プロセスにより、外部接続電極222を形成すると共に、外部接続電極222と十字型貫通孔115とプローブ111とを配線221により接続する。
【0080】
また、十字型貫通孔115の貫通孔底部1151に両面接続用配線パターン223を形成する。両面接続用配線パターン223は、貫通孔底部1151の一つの突部に対してこの突部を囲む凹型形状が、十字型貫通孔115の内面側と、シリコン基板のプローブ111が形成される面側の十字型貫通孔115の周囲に形成され、シリコン基板の両面の電気的導通が行われる。
【0081】
この第3の実施形態による十字型貫通孔115を用いた半導体素子検査基板11の形成プロセスは、貫通孔が十字型形状であることを除外して上記に示した図5および図6と同様である。したがって、その詳細な説明は省略する。
【0082】
本発明の第3の実施形態における半導体素子検査装置の特徴は、貫通孔の形状を4つの突部を有する十字型として、両面接続用配線パターン223を各矩形部(4つの各突部)に形成した点である。十字型貫通孔115とすることで、4本の配線221をプローブ111から外部接続電極222まで接続することが可能である。
【0083】
したがって、この第3の実施形態における半導体素子検査装置によれば、第1の実施形態と同様な効果を得ることができる他、一つの貫通孔から4本の配線221を接続することが可能となり、4本の配線についてそれぞれ、貫通孔を形成する場合と比較して、貫通孔サイズを小さくすることができる。
【0084】
例えば、厚さ500μmの(100)シリコン基板を用いて、異方性エッチングにより、十字型貫通孔115を形成する場合、貫通孔底部1151を150マμm×150μmとした場合、貫通孔開口部1152は910μm×910μmとなる。
【0085】
四角型貫通孔では配線一本当たり5.76×105μm2/本であるのに対し、十字型貫通孔では配線一本当たり2.07×105μm2/本となり、4本の配線についてそれぞれ、貫通孔を形成する場合と比較して、貫通孔サイズを小さく形成することが可能である。
【0086】
これにより、被検ウエハのパッド数増加に対応することが可能となる。
【0087】
次に、図11、図12を用いて、本発明の第4の実施形態によるH型貫通孔について説明する。このH型貫通孔は、上述した凸型貫通孔と同様に、異方性エッチングを用いて形成される四角錐形状の孔を組みあわせて形成することができる。
【0088】
図11は、本発明の第4の実施形態によるH型貫通孔を形成した半導体素子検査装置の検査基板のプローブを形成した面の平面図である。また、図12は、図11の底面図である。なお、図10及び図11において、図2、図3と同一符号は、同一部分を示している。
【0089】
図11に示すように、半導体素子検査基板11は、シリコン基板に両端支持梁用溝開口部1121を形成し、両端支持梁用溝1122を形成することにより、両端支持梁112を形成する。
【0090】
また、両端支持梁112の上に凸状のプローブ111を形成する。そして、図11及び図12に示すように、シリコン基板を加工して、H型貫通孔116を形成する。
【0091】
さらに、図11及び図12に示すように、配線プロセスにより、外部接続電極222を形成すると共に、外部接続電極222とH型貫通孔116とプローブ111とを配線221により接続する。
【0092】
また、H型貫通孔116のH型貫通孔底部1161に両面接続用配線パターン223を形成する。両面接続用配線パターン223は、貫通孔底部1161の一つの突部に対してこの突部を囲む凹型形状が、H型貫通孔116の内面側と、シリコン基板のプローブ111が形成される面側のH型貫通孔116の周囲に形成され、シリコン基板の両面の電気的導通が行われる。
【0093】
この第4の実施形態によるH型貫通孔116を用いた半導体素子検査基板11の形成プロセスは、貫通孔がH型形状であることを除外して上記に示した図5および図6と同様である。
【0094】
本発明の第4の実施形態における半導体素子検査装置の特徴は、貫通孔の形状を4つの突部を有するH型として、両面接続用配線パターン223を各矩形部に形成した点である。H型貫通孔116とすることで、4本の配線221をプローブ111から外部接続電極222まで接続することが可能である。
【0095】
したがって、この第3の実施形態における半導体素子検査装置によれば、第1の実施形態と同様な効果を得ることができる他、一つの貫通孔から4本の配線221を接続することが可能となり、4本の配線についてそれぞれ、貫通孔を形成する場合と比較して、貫通孔サイズを小さくすることができる。
【0096】
例えば、厚さ500μmの(100)シリコン基板を用いて、異方性エッチングにより、H型貫通孔116を形成する場合、貫通孔底部1161を150μm×150μmとした場合、貫通孔開口部1161は910μm×910μmとなる。
【0097】
四角型貫通孔では配線一本当たり5.76×105μm2/本であるのに対し、H型貫通孔では配線一本当たり2.07×105μm2/本となり、4本の配線についてそれぞれ、貫通孔を形成する場合と比較して、貫通孔サイズを小さく形成することが可能である。
【0098】
これにより、被検ウエハのパッド数増加に対応することが可能となる。
【0099】
なお、上述した本発明の実施形態である半導体素子検査装置を用いた半導体素子の製造方法は次の工程を備えている。
【0100】
すなわち、ウエハ上に多数の素子を形成する素子形成工程と、複数の素子が形成されたウエハをプロービング検査(導通検査)するプロービング検査工程と、複数の素子が形成されたウエハをバーンイン検査(熱負荷検査)するバーンイン検査工程とを備えている。以下、各工程毎にその詳細を説明する。
【0101】
素子形成工程は、単結晶Siインゴットを薄くスライスして表面を鏡面研磨したウエハに対して、製造する素子の仕様毎に多数の単位工程を経て行われる。その詳細については省略するが、一般的な素子形成工程は、ウエハ基板のP型、N型形成工程、素子分離工程、ゲート形成工程、ソース/ドレイン形成工程、配線工程、保護膜形成工程などである。
【0102】
ウエハ基板のP型、N型形成工程はウエハ表面にB、Pを打ち込み、後に拡散により、表面上で引き延ばすものである。素子分離工程は上記の表面にSi酸化膜を形成し、領域選択のための窒化膜パターニングを施し、パターニングされない部分の酸化膜を選択的に成長させることにより、個々を微細素子により分離するものである。
【0103】
ゲート形成工程は、上記の各素子間に厚さ数nmのゲート酸化膜を形成し、その上部にポリSiをCVD(Chemical Vapor Deposition)法により堆積した後、所定寸法に加工し電極を形成するものである。
【0104】
ソース/ドレイン工程は、ゲート電極形成後にPやBなどの不純物をイオン打ち込みし、活性化アニールによってソース/ドレイン拡散層を形成するものである。
【0105】
配線工程はAl配線や層間絶縁膜を積み重ねることにより、上記で分離した各素子を電気的につなぎ合わせる工程である。保護膜形成工程は上記のようにして形成された微細素子への外部からの不純物や水分の進入を阻止したり、後に回路をパッケージする際の機械的ストレスを緩和させるために行う工程であり、回路表面に保護膜を形成する工程である。
【0106】
プロービング検査工程は、素子形成工程で形成した各素子の電気信号の導通を検査する工程であり、通常、プローブ装置を用いて各プローブを回路中の電極パッドに一つずつ接触することにより行う。
【0107】
バーンイン検査工程は、回路に熱的、電気的ストレスを付与して不良を加速選別する検査工程である。この工程もプロービング検査と同様の方法によって電極パッドに各プローブを接触させる。
【0108】
選別検査工程は、回路に高周波信号を印加して、素子形成工程で形成した各素子の性能について検査する工程である。この工程もプロービング検査およびバーンイン検査と同様の方法によって電極パッドに各プローブを接触させる。
【0109】
なお、上述した実施形態においては、貫通孔113における、基板11の一方面側の開口部及び他方面側の開口部のうち、開口面積が小さい開口部に接する領域の上記基板の一方面側及び他方面側の両方に、開口面積が小さい開口部を包囲して両面接続用配線部(パターン)223を形成するように構成したが、開口面積が小さい開口部に接する領域の基板11の一方面側及び他方面側の少なくとも一方に、開口面積が小さい開口部を包囲して両面接続用配線部223を形成しても本発明の効果を得ることができる。
【0110】
【発明の効果】
本発明によれば、基板の両面を電気的に導通させるための貫通孔を介して形成される配線の抵抗が小さく、かつ断線を抑制可能な半導体素子検査装置及びこれに用いられる検査基板を実現することができる。
【0111】
つまり、半導体素子検査装置において、両面接続用配線パターンの形成により、貫通孔底部における配線の抵抗値の増加を防止できるとともに、断線を抑制することができる。さらに、貫通孔底部周囲からの配線の引き出しが容易となる。
【0112】
また、貫通孔の形状を凸型、十字型、H型とすることで貫通孔開口部の大きさを小さくでき、被検ウエハのパッド数増加に対応することが可能となる。
【図面の簡単な説明】
【図1】本発明が適用される半導体素子検査装置の全体概略断面図である。
【図2】本発明の第1の実施形態による半導体検査装置の検査基板におけるプローブを形成した面の平面図である。
【図3】図2に示した検査基板の底面図である。
【図4】図2及び図3のX−X線に沿った断面図である。
【図5】本発明の第1の実施形態による半導体素子検査装置における検査基板の製造方法の工程図である。
【図6】本発明の第1の実施形態による半導体素子検査装置における検査基板の配線プロセスを示す図である。
【図7】本発明の第2の実施形態による半導体素子検査装置における検査基板のプローブを形成した面の平面図である。
【図8】図7に示した検査基板の底面図である。
【図9】本発明の第3の実施形態による半導体素子検査装置の検査基板の平面図である。
【図10】図9に示した検査基板の底面図である。
【図11】本発明の第4の実施形態による半導体素子検査装置の検査基板の平面図である。
【図12】図11に示した検査基板の底面図である。
【符号の説明】
1 半導体素子検査装置
2 金属膜
4 第1基板
5 エラストマ
6 第2基板
7 導通構造体
11 検査基板
22 めっき金属膜
23 保護膜
81 第1層マスク
82 第2層マスク
83 第3層マスク
111 プローブ
112 両端支持梁
113 貫通孔
114 凸型貫通孔
115 十字型貫通孔
116 H型貫通孔
221 配線
222 外部接続電極
223 両面接続用配線パターン
1121 両端支持梁用開口部
1122 両端支持梁溝
1131 貫通孔底部
1132 貫通孔開口部
1141 凸型貫通孔底部
1142 凸型貫通孔開口部
1151 十字型貫通孔底部
1152 十字型貫通孔開口部
1161 H型貫通孔底部
1162 H型貫通孔開口部[0001]
BACKGROUND OF THE INVENTION
The present invention relates to an inspection apparatus for inspecting a semiconductor element, and relates to a semiconductor element inspection apparatus for efficiently inspecting electrical characteristics of a semiconductor element in a semiconductor element manufacturing process such as probing inspection and burn-in inspection.
[0002]
[Prior art]
The manufacturing process of a semiconductor element in an IC or LSI includes a so-called pre-process until an integrated circuit is formed on the surface of a silicon wafer and a so-called process in which the silicon wafer is separated into individual chips and sealed with resin, ceramic, or the like. It is roughly divided into the post-process.
[0003]
In these semiconductor elements, electrical characteristics inspection of each circuit is performed at a predetermined stage in the previous process, and a non-defective product or a defective product is determined on a chip basis.
[0004]
Electrical characteristic inspection includes probing inspection to determine the quality of continuity between circuits, burn-in inspection to apply thermal and electrical stress to the circuit at a high temperature of about 150 ° C and accelerate selection of defects, and finally It can be largely classified into a sorting inspection in which an inspection is performed using a high frequency.
[0005]
In particular, in a sorting inspection performed using a high frequency, a high-speed operation inspection method for performing an inspection of a high-speed device using an ultra-high frequency is desired.
[0006]
In the various inspection methods described above, the basic connection means of the inspection apparatus, the wafer to be tested or the chip to be tested, and the external inspection system are the same.
[0007]
That is, the inspection apparatus is formed with fine conductive probes, and is patterned on the wafer or chip to be tested at a pitch of several tens to hundreds of tens of μm. The probe is mechanically pressed against an individual aluminum alloy or other alloy electrode pad having a corner and a thickness of about 1 μm.
[0008]
In addition, an external connection electrode connected to an external inspection system is formed in the inspection apparatus, and wiring for connecting the probe and the external electrode is formed from the probe to the external electrode. The connection between the inspection apparatus and the external inspection system uses means for mechanically pressing and contacting the electrode pins of the external inspection system with the external connection electrodes of the inspection apparatus.
[0009]
As an example of the semiconductor element inspection apparatus described above, there is a technique described in Japanese Patent Laid-Open No. 11-274251 previously proposed by the present inventors. The technique described in this publication forms a probe, a beam, and a through hole integrally on a silicon substrate by etching silicon, and wiring for connecting the probe and the external electrode is externally connected from the probe through the through hole. They are connected by wiring reaching the connection electrode.
[0010]
[Problems to be solved by the invention]
By the way, although the number of probes and the number of through holes tend to increase as the number of pads on the wafer to be tested increases, there is a limit to the number that can be formed if the through holes are formed by a mechanical method.
For this reason, the through-hole is formed using anisotropic etching.
[0011]
However, if a through hole is simply formed using anisotropic etching, the shape of the through hole becomes a quadrangular pyramid, and the vicinity of the apex of the quadrangular pyramid becomes an opening on one surface side of the silicon substrate, and the opening area is It must be minimal.
[0012]
For this reason, when a conductive wiring is formed across the front and back surfaces of the substrate through a through hole formed using anisotropic etching, the resistance value of the wiring formed in the above-mentioned minimum opening portion is not only increased, but is also broken. The possibility of is also great.
[0013]
In order to prevent an increase in the resistance value of the wiring and disconnection, it is conceivable to fill the formed through hole with a conductor.
[0014]
However, filling the through hole with the conductor is not desirable because the manufacturing process becomes complicated and the manufacturing time becomes long.
[0015]
Therefore, another means for suppressing an increase in resistance value and disconnection of the conductive wiring is desired.
[0016]
An object of the present invention is to realize a semiconductor element inspection apparatus in which resistance of wiring formed through a through hole for electrically connecting both surfaces of a substrate is small and disconnection can be suppressed.
[0017]
[Means for Solving the Problems]
In order to achieve the above object, the present invention is configured as follows.
(1)A probe provided on one surface of the substrate and in contact with an electrode pad of a semiconductor element to be inspected; an external connection electrode provided on the other surface of the substrate and transmitting an electrical signal from the probe to the outside; In a semiconductor element inspection apparatus having a wiring for electrically connecting the probe and the external connection electrode through a through hole formed in the substrate, one surface of the substrate in the through hole formed in the substrate Side opening or the opening on the other side of the substrate, the opening having a small opening area is a shape having three or more projecting portions by combining rectangles, and one side of the substrate And three or more double-sided connection wiring portions formed on at least one of the other surface side so as to surround each of the protruding portions, each of the double-sided connection wiring portions being electrically separated from each other Being It is connected to the serial wiring.
[0021]
(2Preferably the above (1), The opening having a small opening area has a convex shape, a cross shape, or an H shape.
[0023]
(3) In a semiconductor element inspection substrate of a semiconductor element inspection apparatus for inspecting a semiconductor element, a substrate formed with a through-hole having an opening having a shape having three or more protrusions by combining rectangles; A probe provided on one surface and in contact with an electrode pad of a semiconductor element to be inspected, an external connection electrode provided on the other surface of the substrate and transmitting an electric signal from the probe to the outside, and the substrate Wiring that is electrically connected through a through hole penetrating one surface of the substrate and the other surface, and at least one of the one surface side and the other surface side of the substrate is provided with a protruding portion of the through hole opening. Three or more double-sided connection wiring portions are formed so as to surround each other and are electrically separated from each other and connected to the wiring.
[0024]
(4Preferably the above (3), The opening of the through hole has a convex shape, a cross shape, or an H shape.
[0025]
By forming the double-sided connection wiring part, it is possible to suppress the disconnection of the wiring in the vicinity of the through-hole opening (bottom), and it is easy to connect (draw out) the wiring from the periphery of the through-hole opening. The value can be reduced.
[0026]
Therefore, according to the present invention, it is possible to realize a semiconductor element inspection apparatus and a semiconductor inspection substrate in which resistance of a wiring formed through a through hole for electrically connecting both surfaces of the substrate is small and disconnection can be suppressed. be able to.
[0027]
Further, if the through hole is formed in a convex shape, a cross shape, or an H shape, the size of the through hole can be reduced, and the size of the semiconductor element inspection substrate can be reduced.
[0028]
DETAILED DESCRIPTION OF THE INVENTION
Embodiments of the present invention will be described below with reference to the drawings.
FIG. 1 is an overall schematic cross-sectional view of a semiconductor element inspection apparatus to which the present invention is applied. This inspection apparatus is used in a probing inspection process, a burn-in inspection process, and a sorting inspection process.
[0029]
In FIG. 1, a single silicon substrate (semiconductor element inspection substrate) 11 of the semiconductor
[0030]
A
[0031]
The first substrate 4 is bonded to the surface of the semiconductor
[0032]
An elastomer 5 is provided on the other surface of the first substrate 4 to be bonded to the semiconductor
[0033]
When the surface of the semiconductor
[0034]
The elastomer 5 is made of an elastomer having a small Young's modulus and exhibiting rubber elastic behavior. Alternatively, a coil spring may be used for the elastomer 5.
[0035]
A
[0036]
For example, a contact probe with a spring or a solder ball is used for the
[0037]
Next, the configuration of the
[0038]
FIG. 2 is a plan view of the surface on which the
[0039]
As shown in FIG. 2, the semiconductor
[0040]
Further, as shown in FIGS. 2 to 4, the through
[0041]
2 to 4, the double-sided
[0042]
That is, for example, the thickness of the (100) silicon substrate is 500 μm, one side of the bottom of the quadrangular through hole is 50 μm, and the top of the same quadrangular through hole (opening on the bottom side of the quadrangular pyramid through hole) When one side is 760 μm, the double-sided
[0043]
This inner surface
[0044]
The double-sided
[0045]
With this double-sided
[0046]
Next, a method for manufacturing an inspection substrate of the semiconductor element inspection apparatus according to the first embodiment of the present invention will be described with reference to FIGS.
[0047]
FIG. 5 is a process diagram of a method for manufacturing an inspection substrate in the semiconductor element inspection apparatus according to the first embodiment of the present invention.
5 indicates a cross section taken along line XX in FIGS. 2 and 3, and YY in FIG. 5 indicates a cross section taken along line YY in FIGS. 2 and 3.
[0048]
In FIG. 5, when the
[0049]
As shown in FIG. 5A, a
In addition, as a material of the
[0050]
Next, as shown in FIG. 5B, the depth difference between the through
[0051]
Subsequently, as shown in FIG. 5C, the
Next, as shown in FIG. 5D, etching is performed so as to form the through
[0052]
Subsequently, as shown in FIG. 5E, the
Next, as shown in FIG. 5F, both-end support beams 112 are formed by etching.
Then, as shown in FIG. 5G, the
[0053]
The shape of the
[0054]
Next, the wiring formation process will be described with reference to FIG. As in FIG. 5, XX indicates a cross section along the line XX in FIGS. 2 and 3, and YY indicates a cross section along the line YY in FIGS. 2 and 3.
[0055]
First, as shown in FIG. 6A, the metal film 2 is formed on both surfaces of the
[0056]
Next, as shown in FIG. 6B, the
[0057]
Next, as shown in FIG. 6C, in order to reduce the wiring resistance and the life strength of the
[0058]
Next, as shown in FIG. 6D, a
As described above, the inspection substrate of the semiconductor element inspection apparatus according to the present invention is manufactured.
[0059]
As described above, the first embodiment of the present invention is characterized in that the double-sided
[0060]
Therefore, according to the first embodiment of the present invention, there is provided a semiconductor element inspection apparatus in which resistance of wiring formed through a through hole for electrically connecting both surfaces of a substrate is small and disconnection can be suppressed. Can be realized.
[0061]
Furthermore, a semiconductor element inspection substrate of this semiconductor element inspection apparatus can be realized.
[0062]
Next, the
[0063]
FIG. 7 is a plan view of the surface on which the probe of the
[0064]
As shown in FIG. 7, the semiconductor
[0065]
Then, as shown in FIG. 7, a
[0066]
Further, as shown in FIGS. 7 and 8, the silicon substrate is processed to form the convex through-
[0067]
Also, a double-sided
[0068]
The formation process of the semiconductor
[0069]
A feature of the semiconductor element inspection apparatus according to the second embodiment of the present invention is that the through hole has a convex shape and the double-sided
[0070]
By making the through hole convex, three
[0071]
Therefore, according to the semiconductor element inspection apparatus of the second embodiment, the same effect as that of the first embodiment can be obtained, and three
[0072]
For example, when the convex through
[0073]
For square-shaped through holes, 5.76 x 10 per wiring5μm2/ In contrast to the convex through-hole, 2.67 × 10 per wiring5μm2It is possible to form a small through-hole size.
[0074]
Thereby, it becomes possible to cope with an increase in the number of pads of the test wafer.
[0075]
Next, a cross-shaped through hole according to a third embodiment of the present invention will be described with reference to FIGS. 9 and 10. This cross-shaped through hole can be formed by combining square pyramid-shaped holes formed by using anisotropic etching, like the above-described convex through-hole.
[0076]
FIG. 9 is a plan view of the surface on which the probe of the inspection substrate of the semiconductor element inspection apparatus in which the cross-shaped through hole is formed according to the third embodiment of the present invention is formed. FIG. 10 is a bottom view of FIG. 9 and 10, the same reference numerals as those in FIGS. 2 and 3 indicate the same parts.
[0077]
As shown in FIG. 9, the semiconductor
[0078]
Further, the
[0079]
Further, as shown in FIGS. 9 and 10, the
[0080]
Also, a double-sided
[0081]
The formation process of the semiconductor
[0082]
A feature of the semiconductor element inspection apparatus according to the third embodiment of the present invention is that the shape of the through hole is a cross shape having four protrusions, and the double-sided
[0083]
Therefore, according to the semiconductor element inspection apparatus of the third embodiment, the same effect as that of the first embodiment can be obtained, and four
[0084]
For example, when the cross-shaped through-
[0085]
For square-shaped through holes, 5.76 x 10 per wiring5μm2/ In contrast to the cross-type through-hole, 2.07 × 10 per wiring5μm2Therefore, it is possible to reduce the size of the through hole for each of the four wirings as compared to the case of forming the through hole.
[0086]
Thereby, it becomes possible to cope with an increase in the number of pads of the test wafer.
[0087]
Next, the H-type through hole according to the fourth embodiment of the present invention will be described with reference to FIGS. 11 and 12. This H-type through hole can be formed by combining quadrangular pyramid-shaped holes formed by anisotropic etching in the same manner as the convex through-hole described above.
[0088]
FIG. 11 is a plan view of the surface on which the probe of the inspection substrate of the semiconductor element inspection apparatus in which the H-type through hole is formed according to the fourth embodiment of the present invention is formed. FIG. 12 is a bottom view of FIG. 10 and 11, the same reference numerals as those in FIGS. 2 and 3 denote the same parts.
[0089]
As shown in FIG. 11, the semiconductor
[0090]
Further, the
[0091]
Further, as shown in FIGS. 11 and 12, the
[0092]
Further, a double-sided
[0093]
The formation process of the semiconductor
[0094]
A feature of the semiconductor element inspection apparatus according to the fourth embodiment of the present invention is that the through hole has an H shape having four protrusions, and the double-sided
[0095]
Therefore, according to the semiconductor element inspection apparatus of the third embodiment, the same effect as that of the first embodiment can be obtained, and four
[0096]
For example, when the H-type through
[0097]
For square-shaped through holes, 5.76 x 10 per wiring5μm2/ In contrast to the H-type through hole, 2.07 × 10 per wiring5μm2Therefore, it is possible to reduce the size of the through hole for each of the four wirings as compared to the case of forming the through hole.
[0098]
Thereby, it becomes possible to cope with an increase in the number of pads of the test wafer.
[0099]
In addition, the manufacturing method of the semiconductor element using the semiconductor element inspection apparatus which is embodiment of this invention mentioned above is equipped with the following process.
[0100]
That is, an element formation process for forming a large number of elements on a wafer, a probing inspection process for performing a probing inspection (conductivity inspection) on a wafer on which a plurality of elements are formed, and a burn-in inspection (heat on a wafer on which a plurality of elements are formed) And a burn-in inspection process (load inspection). Hereinafter, the details will be described for each step.
[0101]
The element forming process is performed on a wafer whose surface is mirror-polished by thinly slicing a single crystal Si ingot through a number of unit processes for each specification of an element to be manufactured. Although details are omitted, general element forming processes include a wafer substrate P-type, N-type forming process, element isolation process, gate forming process, source / drain forming process, wiring process, protective film forming process, and the like. is there.
[0102]
In the P-type and N-type formation process of the wafer substrate, B and P are implanted into the wafer surface, and are then extended on the surface by diffusion. In the element isolation process, an Si oxide film is formed on the above surface, nitride film patterning for region selection is performed, and an oxide film in a portion not to be patterned is selectively grown to separate individual elements by fine elements. is there.
[0103]
In the gate formation step, a gate oxide film having a thickness of several nanometers is formed between the above elements, and poly Si is deposited thereon by a CVD (Chemical Vapor Deposition) method, and then processed to a predetermined size to form an electrode. Is.
[0104]
In the source / drain process, impurities such as P and B are ion-implanted after forming the gate electrode, and a source / drain diffusion layer is formed by activation annealing.
[0105]
The wiring process is a process of electrically connecting the elements separated as described above by stacking Al wirings and interlayer insulating films. The protective film forming step is a step performed to prevent the entry of impurities and moisture from the outside to the fine element formed as described above, or to reduce mechanical stress when packaging the circuit later, This is a step of forming a protective film on the circuit surface.
[0106]
The probing inspection step is a step of inspecting the electrical signal conduction of each element formed in the element formation step, and is usually performed by bringing each probe into contact with an electrode pad in the circuit one by one using a probe device.
[0107]
The burn-in inspection process is an inspection process in which defects are accelerated by applying thermal and electrical stress to the circuit. In this step, each probe is brought into contact with the electrode pad by the same method as the probing inspection.
[0108]
The screening inspection process is a process for inspecting the performance of each element formed in the element formation process by applying a high frequency signal to the circuit. In this process, each probe is brought into contact with the electrode pad by the same method as the probing inspection and burn-in inspection.
[0109]
In the above-described embodiment, the one surface side of the substrate in the region in contact with the opening having a small opening area among the opening on the one surface side of the
[0110]
【The invention's effect】
ADVANTAGE OF THE INVENTION According to this invention, the resistance of the wiring formed through the through-hole for electrically conducting both surfaces of a board | substrate is small, and the semiconductor element test | inspection apparatus which can suppress a disconnection, and the test | inspection board used for this are implement | achieved can do.
[0111]
That is, in the semiconductor element inspection apparatus, by forming the double-sided connection wiring pattern, it is possible to prevent an increase in the resistance value of the wiring at the bottom of the through hole and to suppress disconnection. Furthermore, it becomes easy to pull out the wiring from the periphery of the bottom of the through hole.
[0112]
Further, by making the shape of the through hole convex, cross-shaped, or H-shaped, the size of the through-hole opening can be reduced, and it becomes possible to cope with an increase in the number of pads on the wafer to be tested.
[Brief description of the drawings]
FIG. 1 is an overall schematic cross-sectional view of a semiconductor element inspection apparatus to which the present invention is applied.
FIG. 2 is a plan view of a surface on which a probe is formed on the inspection substrate of the semiconductor inspection apparatus according to the first embodiment of the present invention.
FIG. 3 is a bottom view of the inspection substrate shown in FIG. 2;
4 is a cross-sectional view taken along line XX in FIGS. 2 and 3. FIG.
FIG. 5 is a process diagram of a method for manufacturing an inspection substrate in the semiconductor element inspection apparatus according to the first embodiment of the present invention.
FIG. 6 is a diagram showing a wiring process of an inspection substrate in the semiconductor element inspection apparatus according to the first embodiment of the present invention.
FIG. 7 is a plan view of a surface on which a probe of an inspection substrate is formed in a semiconductor element inspection apparatus according to a second embodiment of the present invention.
FIG. 8 is a bottom view of the inspection substrate shown in FIG.
FIG. 9 is a plan view of an inspection substrate of a semiconductor element inspection apparatus according to a third embodiment of the present invention.
10 is a bottom view of the inspection board shown in FIG. 9. FIG.
FIG. 11 is a plan view of an inspection substrate of a semiconductor element inspection apparatus according to a fourth embodiment of the present invention.
12 is a bottom view of the inspection board shown in FIG. 11. FIG.
[Explanation of symbols]
1 Semiconductor device inspection equipment
2 Metal film
4 First board
5 Elastomer
6 Second board
7 Conducting structure
11 Inspection board
22 Plating metal film
23 Protective film
81 First layer mask
82 Second layer mask
83 Third layer mask
111 probe
112 Both ends support beam
113 Through hole
114 Convex through hole
115 Cross-shaped through-hole
116 H-type through-hole
221 wiring
222 External connection electrode
223 Double-sided connection wiring pattern
1121 Opening for both ends supporting beam
1122 Support beam groove on both ends
1131 Through hole bottom
1132 Through-hole opening
1141 Convex through hole bottom
1142 Convex-type through-hole opening
1151 Bottom of cross-shaped through hole
1152 Cross-shaped through-hole opening
1161 Bottom of H-type through hole
1162 H-type through-hole opening
Claims (4)
上記基板に形成された貫通孔における、上記基板の一方面側の開口部又は上記基板の他方面側の開口部のうち、開口面積が小さい開口部は、矩形を組みあわせて、3つ以上の突状部を有する形状であり、上記基板の一方面側及び他方面側の少なくとも一方に、上記突状部のそれぞれを包囲して形成される3つ以上の両面接続用配線部であって、これら両面接続用配線部のそれぞれは、互いに電気的に分離されて、上記配線に接続されることを特徴とする半導体素子検査装置。A probe provided on one surface of the substrate and in contact with an electrode pad of a semiconductor element to be inspected; an external connection electrode provided on the other surface of the substrate and transmitting an electrical signal from the probe to the outside; In a semiconductor element inspection apparatus having a wiring for electrically connecting the probe and the external connection electrode through a through hole formed in the substrate,
Of the openings on the one surface side of the substrate or the openings on the other surface side of the substrate in the through hole formed in the substrate, the opening portion with a small opening area is a combination of three or more rectangles. Three or more double-sided connecting wiring parts formed so as to surround each of the protruding parts on at least one of the one side and the other side of the board, each having a protruding part, Each of these double-sided connection wiring parts is electrically isolated from each other and connected to the wiring.
矩形を組みあわせて、3つ以上の突状部を有する形状の開口部を有する貫通孔が形成された基板と、
上記基板の一方の面に設けられ、検査すべき半導体素子の電極パッドに接触されるプローブと、
上記基板の他方の面に設けられ、上記プローブからの電気信号を外部に伝達する外部接続電極と、
上記基板の一方の面と他方の面とを貫通する貫通孔を介して電気的に接続する配線と、
上記基板の一方面側及び他方面側の少なくとも一方に、上記貫通孔開口部の突状部のそれぞれを包囲して形成され、互いに電気的に分離されて、上記配線に接続される3つ以上の両面接続用配線部と、
を備えることを特徴とする半導体素子検査基板。In a semiconductor element inspection substrate of a semiconductor element inspection apparatus for inspecting a semiconductor element,
A substrate in which a through hole having an opening having a shape having three or more protrusions is formed by combining rectangles;
A probe provided on one surface of the substrate and in contact with an electrode pad of a semiconductor element to be inspected;
An external connection electrode provided on the other surface of the substrate and transmitting an electrical signal from the probe to the outside;
A wiring electrically connected through a through-hole penetrating one surface and the other surface of the substrate;
Three or more formed on at least one of the one surface side and the other surface side of the substrate so as to surround each of the protruding portions of the through-hole opening, electrically separated from each other, and connected to the wiring A double-sided connection wiring section,
A semiconductor element inspection substrate comprising:
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