JP3505369B2 - Liquid crystal display - Google Patents

Liquid crystal display

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JP3505369B2
JP3505369B2 JP26718397A JP26718397A JP3505369B2 JP 3505369 B2 JP3505369 B2 JP 3505369B2 JP 26718397 A JP26718397 A JP 26718397A JP 26718397 A JP26718397 A JP 26718397A JP 3505369 B2 JP3505369 B2 JP 3505369B2
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Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【発明の属する技術分野】本発明は、液晶表示装置に関
するものであり、特に駆動回路も含めTFTで作り込ま
れた液晶表示装置に於いて、端子に侵入するサージの保
護を行う素子に関するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a liquid crystal display device, and more particularly to a device for protecting a surge invading a terminal in a liquid crystal display device including a driving circuit and made of TFTs. is there.

【0002】[0002]

【従来の技術】最近、液晶表示装置は、低消費電力、薄
型軽量、高精細な画像等が着目され、TFTを採用した
液晶表示装置が盛んに研究されている。特に、a−S
i、ポリSiが中心であるが、移動度、開口率、プロセ
ス工程数等の観点からポリSiが着目され、実用化され
ている。
2. Description of the Related Art Recently, as liquid crystal display devices, attention has been paid to low power consumption, thinness and light weight, high-definition images, etc., and liquid crystal display devices employing TFTs have been actively researched. In particular, aS
Although i and poly-Si are the main components, poly-Si has been focused and put to practical use from the viewpoint of mobility, aperture ratio, number of process steps, and the like.

【0003】例えば図4は、液晶表示装置の概略平面図
であり、左右に複数本延在されている配線がゲートライ
ン10であり、上下に複数本延在されている配線がドレ
インライン11である。そして前記ゲートラインと前記
ドレインラインによりマトリックス状に交点が構成さ
れ、ここにそれぞれ表示電極12、この表示電極12と
電気的に接続されたTFT13が対と成って表示領域を
構成している。
For example, FIG. 4 is a schematic plan view of a liquid crystal display device, in which a plurality of wiring lines extending left and right are gate lines 10 and a plurality of wiring lines extending vertically are drain lines 11. is there. The gate lines and the drain lines form matrix-shaped intersections, and the display electrodes 12 and the TFTs 13 electrically connected to the display electrodes 12 form a pair to form a display area.

【0004】一方、これらが形成されるガラス基板14
の一側辺には、端子15が群となって配置され、この端
子群15・・・と表示領域との間には、液晶表示装置を
駆動する駆動回路、ここではプリチャージドライバー1
6が形成され、対向する側辺にはドレインドライバー1
7が形成されている。更に、左右の側辺には、ゲートド
ライバー18が形成されている。
On the other hand, the glass substrate 14 on which these are formed
Terminals 15 are arranged as a group on one side of the liquid crystal display device, and a driving circuit for driving the liquid crystal display device, here, the precharge driver 1 is provided between the terminal group 15 ... And the display area.
6 is formed, and the drain driver 1 is provided on the opposite side.
7 are formed. Further, gate drivers 18 are formed on the left and right sides.

【0005】そしてゲートドライバ18には、垂直クロ
ック信号と垂直スタート信号が入力される配線19、2
0が、ドレインドライバー17には、水平クロック信
号、水平スタート信号およびビデオ信号が入力される配
線21、22、23が、プリチャージドライバー16に
は、プリチャージ信号およびゲートコントロール信号が
入力される配線24、25が、基板14の周囲を延在し
て端子15と接続されている。
The gate driver 18 has wirings 19 and 2 to which a vertical clock signal and a vertical start signal are input.
0, wirings 21, 22 and 23 to which a horizontal clock signal, a horizontal start signal and a video signal are input to the drain driver 17, and wirings to which a precharge signal and a gate control signal are input to the precharge driver 16. 24 and 25 extend around the substrate 14 and are connected to the terminals 15.

【0006】これらの構成でなる基板14の端子15近
傍を拡大すると、図5のような構成となり、端子にはサ
ージ吸収用の保護トランジスタが形成され、これを等価
的に示したものが図6である。ここで実線は、表示領域
を構成するTFTのドレイン電極、つまりAlである。
また一点鎖線は、表示領域を構成するTFTの半導体層
となるポリSiでAlの下層に形成されている。また、
二点鎖線はTFTのゲートを構成するCrでポリSiの
下層に配置されている。また×印で示した部分は、コン
タクトである。
When the vicinity of the terminal 15 of the substrate 14 having these structures is enlarged, the structure as shown in FIG. 5 is formed, and a protection transistor for surge absorption is formed at the terminal, which is equivalently shown in FIG. Is. Here, the solid line is the drain electrode of the TFT forming the display area, that is, Al.
Further, the alternate long and short dash line is formed in the lower layer of Al of poly-Si which becomes the semiconductor layer of the TFT which constitutes the display area. Also,
The alternate long and two short dashes line is Cr that constitutes the gate of the TFT and is arranged in the lower layer of poly-Si. Further, the portion indicated by X is a contact.

【0007】まず配線30は、図4の端子15が延在さ
れているもので、Alよりなり、下層のポリSi抵抗3
1を介してから、グランドラインVssとの交差を避け
るために、下層に延在されるCr配線32を使ってクロ
スオーバーしている。またVssラインの一領域からポ
リSi抵抗33を介し、一旦上層のAl配線34に戻っ
てから、下層に延在されるCrゲート35が形成されて
いる。またCrゲート35の上層には、サージ吸収用の
トランジスタ36の半導体層37、つまりポリSiが形
成されている。またトランジスタ36のドレイン電極3
8からポリSi抵抗39を介してトランジスタ40が形
成され、このトランジスタ40のゲート44は、端子か
らの延在配線30′と接続し、この延在配線30′はポ
リSiより成る半導体層45とコンタクトしている。ま
たこの延在配線30′は、ポリSi抵抗42を有し、電
源ラインVDDとの交差を避けるためにCr配線43で下
層に延在され、クロスオバーし、延在配線30′′で、
例えばプリチャージドライバーへ延在されている。
First, the wiring 30 is formed by extending the terminal 15 of FIG. 4 and is made of Al.
In order to avoid the intersection with the ground line Vss after passing through 1, the Cr wiring 32 extended to the lower layer is used for crossover. Further, a Cr gate 35 is formed so as to extend from one region of the Vss line to the upper Al wiring 34 through the poly Si resistor 33 and then extend to the lower layer. Further, on the upper layer of the Cr gate 35, the semiconductor layer 37 of the transistor 36 for absorbing surge, that is, poly-Si is formed. Also, the drain electrode 3 of the transistor 36
A transistor 40 is formed from 8 through a poly-Si resistor 39, and a gate 44 of the transistor 40 is connected to an extended wiring 30 'from the terminal. The extended wiring 30' is connected to a semiconductor layer 45 made of poly-Si. I have a contact. Further, this extended wiring 30 'has a poly-Si resistor 42, is extended to a lower layer by a Cr wiring 43 in order to avoid crossing with the power supply line VDD, is cross-overed, and is extended wiring 30''.
For example, it has been extended to precharge drivers.

【0008】[0008]

【発明が解決しようとする課題】この構成に於いて、ポ
リSi抵抗31、42は、異常パルス(サージ)が印加
された場合、この波形をなまらせるために設けている
が、この異常パルスが大きすぎると、このポリSi抵抗
が溶断してしまい、延在配線30と30′、または延在
配線30と30′′が断線してしまい、ここの延在配線
30の手前に設けられた端子に入力される信号が、配線
30′′へ伝わらなくなり、液晶表示装置として機能し
なくなる問題があった。
In this structure, the poly-Si resistors 31 and 42 are provided for blunting the waveform when an abnormal pulse (surge) is applied. If it is too large, the poly-Si resistance is melted and the extended wirings 30 and 30 ′ or the extended wirings 30 and 30 ″ are disconnected, and the terminals provided in front of the extended wiring 30 are broken. There is a problem in that the signal input to is not transmitted to the wiring 30 ″ and thus does not function as a liquid crystal display device.

【0009】[0009]

【課題を解決するための手段】本発明は、前述の課題に
鑑みてなされ、第1に、電源ラインおよびグランドライ
ンと交差する前記第1のラインを、この第1のラインよ
りも下層に形成されるゲート材料でクロスオーバー構造
とし、前記2つの交差部間に延在される第1の配線を、
Al電極で成し、前記第1の配線から突出して一体で設
けられた電極を、前記第1のボトムゲート型TFTと前
記第2のボトムゲート型TFTの共通電極とすることで
解決するものである。
The present invention has been made in view of the above-mentioned problems, and firstly, the first line intersecting the power supply line and the ground line is formed in a layer lower than the first line. A gate material to be formed into a crossover structure, and a first wiring extending between the two intersections,
The problem is solved by using an electrode made of an Al electrode and integrally formed so as to project from the first wiring as the common electrode of the first bottom gate type TFT and the second bottom gate type TFT. is there.

【0010】表示電極と接続される能動素子、ここでは
ボトムゲートであるので、ポリSiよりも抵抗値の低い
ゲート材料を使用することで、端子から延在される配線
の抵抗値を下げることができ、またコンタクトC1、C
2の為のスペースだけを取ってすぐに共通電極とできる
ので、トランジスタの半導体層を構成するポリSi10
9、112側で溶断させることができる。
Since the active element connected to the display electrode, which is the bottom gate in this case, is used, it is possible to reduce the resistance value of the wiring extending from the terminal by using a gate material having a resistance value lower than that of poly-Si. Yes, and contacts C1 and C
Since the common electrode can be formed immediately after taking only the space for 2, the poly-Si10 forming the semiconductor layer of the transistor can be formed.
It can be melt-fused on the side of 9, 112.

【0011】第2に、電源ラインおよびグランドライン
と交差する前記配線を、この配線よりも下層に形成され
るゲート材料でクロスオーバー構造とし、ビデオ信号が
入力される配線に於いては、電源ラインおよびグランド
ラインを、下層に形成されるゲート材料でクロスオーバ
ー構造とすることで解決するものである。ゲート材料と
しては、一般にCr、タンタル等が使用され、ポリSi
から比べるとその抵抗値は小さいが、Alよりも抵抗値
が高いため、表示の一番重要な映像信号がなまってしま
う問題がある。しかし、配線はAlのままで、電源ライ
ンVDDおよびグランドラインVssを、ゲート材料を使
ってクロスオバー構造とすれば、延在配線は更にその抵
抗値を小さくすることができると同時に、映像信号のな
まりも抑制できる。
Secondly, the wiring intersecting the power supply line and the ground line has a crossover structure with a gate material formed in a layer lower than the wiring, and in the wiring to which the video signal is input, the power supply line is used. This is solved by forming a crossover structure with the gate material formed in the lower layer for the ground line and the ground line. Generally, Cr, tantalum, etc. are used as the gate material, and poly-Si
Although the resistance value is smaller than that of Al, the resistance value is higher than that of Al, so that there is a problem that the most important video signal for display is dulled. However, if the wiring is made of Al and the power supply line VDD and the ground line Vss have a crossover structure using a gate material, the extended wiring can further reduce its resistance value and, at the same time, the video signal You can also suppress blunting.

【0012】第3として、Crは、耐食性等の点で優
れ、比較的抵抗値も少ないことからゲート材料として優
れ、これをクロスオーバー材料として採用すれば、工程
数を増やすことなく実現できる。第4に、延在配線とV
DDライン、延在配線とVssラインの交差部に、ノンド
ープの半導体層を形成することでサージがトランジスタ
を介さず駆動回路へ侵入することを防止することができ
る。
Thirdly, Cr is excellent as a gate material because it is excellent in corrosion resistance and the like and has a relatively small resistance value. If this is used as a crossover material, it can be realized without increasing the number of steps. Fourth, extended wiring and V
By forming a non-doped semiconductor layer at the intersection of the DD line, the extended wiring and the Vss line, it is possible to prevent the surge from entering the drive circuit without passing through the transistor.

【0013】[0013]

【発明の実施の形態】以下に、本発明の実施の形態につ
いて説明する。まず従来例でも説明したが、図4を参照
して平面的な配置について説明する。左右に複数本延在
されている配線がCrより成るゲートライン10であ
り、上下に複数本延在されている配線がAlより成るド
レインライン11である。そして2種のライン10、1
1によりマトリックス状に交点が構成され、ここにそれ
ぞれITOより成る表示電極12、この表示電極12と
電気的に接続されたTFT13が対と成って表示領域を
構成している。
BEST MODE FOR CARRYING OUT THE INVENTION Embodiments of the present invention will be described below. First, the conventional example has been described, but the planar arrangement will be described with reference to FIG. A plurality of wirings extending to the left and right are the gate lines 10 made of Cr, and a plurality of wirings extending vertically are the drain lines 11 made of Al. And two kinds of lines 10, 1
1, the intersections are formed in a matrix, and the display electrodes 12 each made of ITO and the TFTs 13 electrically connected to the display electrodes 12 form a pair to form a display area.

【0014】一方、これらが形成されるガラス基板14
の一側辺には、端子15が群となって配置され、この端
子群15・・・と表示領域との間には、液晶表示装置を
駆動する駆動回路、ここではプリチャージドライバー1
6が形成され、対向する側辺にはドレインドライバー1
7が形成されている。更に、左右の側辺には、ゲートド
ライバー18が形成されている。ただしドレインドライ
バーとプリチャージドライバーの位置を交換しても良い
し、ゲートドライバーを一方の側辺にまとめて形成して
も良い。
On the other hand, the glass substrate 14 on which these are formed
Terminals 15 are arranged as a group on one side of the liquid crystal display device, and a driving circuit for driving the liquid crystal display device, here, the precharge driver 1 is provided between the terminal group 15 ... And the display area.
6 is formed, and the drain driver 1 is provided on the opposite side.
7 are formed. Further, gate drivers 18 are formed on the left and right sides. However, the positions of the drain driver and the precharge driver may be exchanged, or the gate driver may be formed integrally on one side.

【0015】そしてゲートドライバ18には、垂直クロ
ック信号と垂直スタート信号が入力されるAl配線1
9、20が、ドレインドライバー17には、水平クロッ
ク信号、水平スタート信号およびビデオ信号が入力され
るAl配線21、22、23が、プリチャージドライバ
ー16には、プリチャージ信号およびゲートコントロー
ル信号が入力されるAl配線24、25が、基板14の
周囲を回りながら端子15と接続されている。
Then, the Al wiring 1 to which the vertical clock signal and the vertical start signal are inputted to the gate driver 18.
Reference numerals 9 and 20 denote drain drivers 17 and Al wirings 21, 22, and 23 to which a horizontal clock signal, a horizontal start signal, and a video signal are input. Precharge drivers 16 receive precharge signals and gate control signals. The Al wirings 24 and 25 are connected to the terminal 15 while rotating around the substrate 14.

【0016】また図1のパターンの説明の前に、液晶表
示装置の断面構造を説明する。第1の透明基板として無
アルカリガラス50が採用され、この上には、トランジ
スタのゲート51およびこれと一体のゲートラインが形
成され、また同一材料の補助容量電極52が形成されて
いる。ここでは耐食性と抵抗値が考慮され、Crが採用
され、この上の膜切れが考慮されてテーパー構造が採用
されている。
Before explaining the pattern of FIG. 1, the sectional structure of the liquid crystal display device will be described. An alkali-free glass 50 is used as the first transparent substrate, on which a gate 51 of a transistor and a gate line integral therewith are formed, and an auxiliary capacitance electrode 52 of the same material is formed. Here, the corrosion resistance and the resistance value are taken into consideration, Cr is adopted, and the taper structure is adopted considering the film breakage on this.

【0017】また全面には、プラズマCVDによりSi
酸化膜53とSi窒化膜54が形成され、トランジスタ
領域と補助容量領域に延在されるようにパターニングさ
れたポリSi55が設けられている。ここでポリSiに
は不純物Pが導入され、低濃度N−型ののソース・ドレ
イン領域57、58、高濃度N+型のコンタクト領域5
9、60が形成されている。またトランジスタのチャン
ネル領域56は、この不純物を阻止するために、Si酸
化膜のマスク61が設けられている。
Further, Si is formed on the entire surface by plasma CVD.
An oxide film 53 and a Si nitride film 54 are formed, and a poly-Si 55 patterned so as to extend to the transistor region and the auxiliary capacitance region is provided. Here, the impurity P is introduced into the poly-Si, and the low concentration N− type source / drain regions 57 and 58 and the high concentration N + type contact region 5 are formed.
9 and 60 are formed. Further, the channel region 56 of the transistor is provided with a mask 61 of Si oxide film in order to prevent this impurity.

【0018】ここで補助容量は、補助容量電極52まで
延在されているポリSiのN+型のコンタクト領域6
0、Crからなる補助容量電極52および絶縁層53、
54で構成されている。更には、全面にプラズマCVD
法によりSi酸化膜62、Si窒化膜63が被覆され、
コンタクト領域59の一部が開口されてコンタクト孔が
形成され、Alのドレイン電極64が設けられている。
また全面には、今までの構成で成る凹凸を埋める平坦化
膜65が設けられ、コンタクト領域60の一部が露出さ
れたコンタクト孔を介してITOから成る表示電極66
が設けられている。
Here, the auxiliary capacitance is a poly-Si N + type contact region 6 extending to the auxiliary capacitance electrode 52.
0, a storage capacitor electrode 52 and an insulating layer 53 made of Cr,
It is composed of 54. Furthermore, plasma CVD on the entire surface
The Si oxide film 62 and the Si nitride film 63 by the method
A part of the contact region 59 is opened to form a contact hole, and an Al drain electrode 64 is provided.
In addition, a flattening film 65 that fills the irregularities having the structure described above is provided on the entire surface, and a display electrode 66 made of ITO is provided through a contact hole where a part of the contact region 60 is exposed.
Is provided.

【0019】一方、第2の透明基板70の上には、IT
Oからなる対向電極67が設けられている。またここで
はカラー表示のため、R・G・Bのカラーフィルター6
8が表示電極66に対応した領域に設けられると共にそ
の周囲には遮光膜69が設けられている。また必要によ
っては、凹凸を平坦化するために対向電極67が設けら
れる前に設けられても良い。
On the other hand, on the second transparent substrate 70, IT
A counter electrode 67 made of O is provided. Also, here, for color display, R, G, B color filters 6
8 is provided in a region corresponding to the display electrode 66, and a light shielding film 69 is provided around the region. Further, if necessary, it may be provided before the counter electrode 67 is provided in order to flatten the unevenness.

【0020】以上の構成を有した透明基板50、70に
は、配向膜71、72が設けられ、この透明基板が対向
配置され、この間にシール材が設けられ、このシール材
の一部で成る注入孔を介して液晶が注入され液晶表示装
置として完了される。本発明は、図3の構成に使用した
材料を活用し、如何にサージ吸収用のトランジスタを構
成させるかがポイントであり、以下にその具体例を図1
を参照して述べる。
Alignment films 71 and 72 are provided on the transparent substrates 50 and 70 having the above-mentioned structure, the transparent substrates are arranged to face each other, and a sealing material is provided between them, which is a part of the sealing material. Liquid crystal is injected through the injection hole to complete the liquid crystal display device. The point of the present invention is how to construct a transistor for surge absorption by utilizing the material used for the configuration of FIG. 3, and a specific example thereof will be described below.
Will be described with reference to.

【0021】まず端子100と接続されるトランジスタ
101および延在配線104′′までの関係について説
明する。従来例と同様に、図3の構成要件を使って製造
され、実線はAl、一点鎖線はポリSi、二点鎖線はC
rで成る。端子100は、Al電極より成り、下層には
Crまたは上層にはITOが積層されて構成しても良
い。端子100から電気的に接続されたAlの延在配線
104は、Crより成る下層延在配線105を介して、
Alの延在配線104′と接続され、この延在配線10
4′は、再度Crの下層延在配線106を介してAlの
延在配線104′′と接続されている。
First, the relationship between the transistor 101 connected to the terminal 100 and the extended wiring 104 '' will be described. Similar to the conventional example, it is manufactured using the constituent elements of FIG. 3, the solid line is Al, the one-dot chain line is poly-Si, and the two-dot chain line is C.
It consists of r. The terminal 100 may be composed of an Al electrode, and Cr may be laminated on the lower layer or ITO may be laminated on the upper layer. The Al extended wiring 104 electrically connected to the terminal 100 is connected via a lower layer extended wiring 105 made of Cr,
This extended wiring 10 is connected to the extended wiring 104 ′ of Al.
4'is again connected to the Al extended wiring 104 '' via the Cr lower layer extended wiring 106.

【0022】前記下層延在配線105、106の上層に
は、図3の絶縁層53、54が設けられ、図1の紙面に
対して上から下に伸びているAlのVssラインとAl
のVDDラインが設けられている。Vssラインは、下層
延在配線105を交差すると、トランジスタ107のゲ
ート、ここではCrゲート108が接続されており、こ
のCrゲート108の上には、ポリSiより成る半導体
層109が被覆されている。ここではトランジスタがN
チャンネルであるため、ゲート108に対応する領域を
除き、N型の不純物が導入されている。そしてポリSi
109の上には図3で示す絶縁層62、63が被覆され
ている。AlのVssラインがソース電極として、延在
配線104′の一部がVDDラインと平行に突出した形で
設けられ、Al電極110がドレイン電極としてコンタ
クト孔を介して半導体層とコンタクトしている。またV
DDラインは、下層延在配線106を交差すると、トラン
ジスタ101のゲート、ここではCrゲート111が接
続されている。このCrゲート111の上には、ポリS
iより成る半導体層112が被覆されている。ここでは
トランジスタがPチャンネル型であるため、ゲート11
1に対応する領域を除き、P型の不純物が導入されてい
る。そしてポリSi112の上には図3で示す絶縁層6
2、63が被覆され、AlのVDDラインがソース電極と
して成り、延在配線104′の一部が延在されたAl電
極110がドレイン電極として成り、コンタクト孔を介
して半導体層とコンタクトしている。
Insulating layers 53 and 54 of FIG. 3 are provided on the upper layers of the lower layer extended wirings 105 and 106, and the Vss line of Al and Al extending from the top to the bottom with respect to the paper surface of FIG.
VDD line is provided. When the Vss line crosses the lower layer extended wiring 105, the gate of the transistor 107, here the Cr gate 108, is connected, and the Cr gate 108 is covered with the semiconductor layer 109 made of poly-Si. . Here, the transistor is N
Since it is a channel, N-type impurities are introduced except for the region corresponding to the gate 108. And poly-Si
The insulating layer 62, 63 shown in FIG. The Vss line of Al is provided as a source electrode, and a part of the extended wiring 104 'is provided so as to project in parallel with the VDD line, and the Al electrode 110 serves as a drain electrode and is in contact with the semiconductor layer through the contact hole. Also V
When the DD line crosses the lower layer extended wiring 106, the gate of the transistor 101, here the Cr gate 111, is connected. On top of this Cr gate 111, poly S
A semiconductor layer 112 of i is covered. Since the transistor is a P-channel type here, the gate 11
P-type impurities are introduced except for the region corresponding to 1. The insulating layer 6 shown in FIG. 3 is formed on the poly-Si 112.
2, 63 are covered, the Al VDD line serves as a source electrode, and the Al electrode 110 in which a part of the extended wiring 104 ′ extends serves as a drain electrode, and contacts the semiconductor layer through a contact hole. There is.

【0023】本発明の特徴は、延在配線104〜10
4′′の所で、ポリSi抵抗を使わず、トランジスタ1
01、107によりノイズを吸収することにある。抵抗
体としてポリSiを使わず、クロスオーバーが必要なと
ころには、ゲート材料を使用している。またAl電極1
10は、VDDラインと平行に延在し、コンタクト孔C
1、C2の縦幅の分だけ過ぎた後、とらんじすたの10
1、107の共通電極として成っているので、延在配線
104〜104′′の所で溶断せず、トランジスタでサ
ージを吸収できる。また従来のようなポリSi抵抗を溶
断するようなサージが侵入しても、トランジスタの半導
体層(ポリSi)で溶断するように成っているため、延
在配線には、端子に印加された信号が駆動回路へと伝わ
ってゆく。そのため表示可能な正常動作期間を延ばすこ
とが可能となる。
The feature of the present invention is that the extended wirings 104 to 10 are provided.
At 4 ″, without using poly-Si resistor, transistor 1
The noise is absorbed by 01 and 107. Instead of using poly-Si as a resistor, a gate material is used where crossover is required. In addition, Al electrode 1
10 extends in parallel with the VDD line and has a contact hole C
After passing the height of 1 and C2
Since it is formed as a common electrode of Nos. 1 and 107, the surge can be absorbed by the transistor without being blown out at the extended wirings 104 to 104 ″. In addition, even if a surge that melts the poly-Si resistance as in the conventional case enters, the semiconductor layer (poly-Si) of the transistor melts and the signal applied to the terminal is connected to the extended wiring. Is transmitted to the drive circuit. Therefore, the displayable normal operation period can be extended.

【0024】一方、端子102に接続されているトラン
ジスタとその構成について説明する。駆動回路へと延在
されるAlの延在配線120は、下層配線を設けず共通
電極121と一体で駆動回路まで延在されている。そし
て逆にAlのVssラインとAlのVDDラインがCrの
下層配線122、123を介して接続されている。また
Crの下層配線122が、上層のVssラインとコンタ
クトしてからトランジスタ124のCrゲートが形成さ
れている。このCrゲートの上には、絶縁層53、54
が被覆され、この上にトランジスタの半導体層となるポ
リSi層125が形成される。そして、再度絶縁層6
2、63を介してその上層に設けられたVssラインが
ソース電極として、共通電極121がドレイン電極とし
て、コンタクト孔を介して半導体層とコンタクトしてい
る。またVDDラインも、下層配線123を介してクロス
オーバーしており、再度上層に上がったVDDラインがC
rゲート126とコンタクトしている。やはりトランジ
スタ124のゲート上には、絶縁層53、54が、半導
体層127の上には絶縁層62、63が形成されてい
る。
On the other hand, the transistor connected to the terminal 102 and its configuration will be described. The Al extension wiring 120 extending to the drive circuit is extended to the drive circuit integrally with the common electrode 121 without providing a lower layer wiring. On the contrary, the Vss line of Al and the VDD line of Al are connected via the lower wirings 122 and 123 of Cr. Further, the Cr gate of the transistor 124 is formed after the Cr lower layer wiring 122 contacts the upper layer Vss line. Insulating layers 53 and 54 are formed on the Cr gate.
And a poly-Si layer 125 to be a semiconductor layer of the transistor is formed thereon. Then, again the insulating layer 6
The Vss line provided on the upper layer via the electrodes 2, 63 serves as the source electrode, and the common electrode 121 serves as the drain electrode, and is in contact with the semiconductor layer through the contact hole. Further, the VDD line also crosses over via the lower layer wiring 123, and the VDD line rising to the upper layer again is C.
It is in contact with the r gate 126. The insulating layers 53 and 54 are formed on the gate of the transistor 124, and the insulating layers 62 and 63 are formed on the semiconductor layer 127.

【0025】ここの構成は、端子102から駆動回路へ
延在される延在配線120を、下層にクロスオーバーさ
せず、その代わりVssラインとVDDラインを下層にク
ロスオバーさせている。従って上の延在配線104〜1
04′′と比べて抵抗値を更に下げることができる。従
って従来構造のようにポリSi抵抗を採用していないた
めに、延在配線が容易に溶断することが無く、従来のよ
うなポリSi抵抗を溶断するようなサージが侵入して
も、トランジスタの半導体層が破壊するだけであり、延
在配線には、端子に印加された信号が駆動回路へと伝わ
ってゆく。そのため表示可能な正常動作期間を延ばすこ
とが可能となる。
In this structure, the extended wiring 120 extending from the terminal 102 to the drive circuit is not crossed over to the lower layer, but instead the Vss line and the VDD line are crossed over to the lower layer. Therefore, the extended wirings 104 to 1 above
The resistance value can be further reduced as compared with 04 ″. Therefore, unlike the conventional structure, since the poly-Si resistance is not adopted, the extended wiring is not easily blown out, and even if a surge that blows out the poly-Si resistance as in the conventional case enters, the transistor Only the semiconductor layer is destroyed, and the signal applied to the terminal is transmitted to the drive circuit in the extended wiring. Therefore, the displayable normal operation period can be extended.

【0026】本発明では、Vss、VDDの変動、および
映像信号の変動が一番重要であることから、映像信号が
入る端子は、下の端子102で説明された構造を採用
し、実質それ以外は、上の端子100で説明された構造
を採用している。実際、異常パルスが保護トランジスタ
に侵入すると、ポリSiの半導体層が溶けるように設計
されている。しかし端子と駆動回路との間の配線は、図
4のようにパネルの周辺に延在されているため、駆動回
路に達するまでには波形がなまり、殆ど駆動回路を破壊
することもない。
In the present invention, since the fluctuations of Vss and VDD and the fluctuations of the video signal are the most important, the terminal for receiving the video signal adopts the structure described in the terminal 102 below, and otherwise Employs the structure described for terminal 100 above. In fact, it is designed so that the poly-Si semiconductor layer melts when an abnormal pulse enters the protective transistor. However, since the wiring between the terminal and the drive circuit extends around the panel as shown in FIG. 4, the waveform is blunted by the time it reaches the drive circuit, and the drive circuit is hardly destroyed.

【0027】また図1のCrとAlの配線の交差部は、
ポリSiが形成されている。このポリSiの設置によ
り、この交差部でのスパークが防止できる。
Further, the intersection of the Cr and Al wirings in FIG.
Poly-Si is formed. By installing this poly-Si, sparks at this intersection can be prevented.

【0028】[0028]

【発明の効果】以上の説明からも明らかなように、第1
に、電源ラインおよびグランドラインと交差する前記延
在配線を、この延在配線よりも下層に形成されるゲート
材料でクロスオーバー構造とすることで、抵抗値を下げ
ることができ、また共通電極が直近に在るため、端子と
駆動回路との間にある延在配線の溶断を防止することが
できる。
As is apparent from the above description, the first
In addition, a resistance value can be lowered by forming the extended wiring that intersects the power supply line and the ground line into a crossover structure with a gate material formed in a layer lower than the extended wiring, and the common electrode Since it is in the immediate vicinity, it is possible to prevent the extended wiring between the terminal and the drive circuit from being blown.

【0029】特に、表示電極と接続される能動素子は、
ボトムゲートであるので、ポリSiよりも抵抗値の低い
ゲート材料を使用することで、端子から延在される延在
配線の溶断を防止することができる。第2に、電源ライ
ンおよびグランドラインと交差する前記延在配線を、こ
の延在配線よりも下層に形成されるゲート材料でクロス
オーバー構造とし、ビデオ信号が入力される端子と接続
される延在配線では、電源ラインおよびグランドライン
を、下層に形成されるゲート材料でクロスオーバー構造
とすることで、映像信号のなまりも無く保護することが
できる。
In particular, the active element connected to the display electrode is
Since it is a bottom gate, by using a gate material having a resistance value lower than that of poly-Si, it is possible to prevent melting of the extended wiring extended from the terminal. Secondly, the extended wiring that intersects the power supply line and the ground line has a crossover structure with a gate material formed in a layer lower than the extended wiring, and the extended wiring connected to a terminal to which a video signal is input. In the wiring, the power supply line and the ground line have a crossover structure with the gate material formed in the lower layer, so that the video signal can be protected without blunting.

【0030】ゲート材料としては、一般にCr、タンタ
ル等が使用され、ポリSiから比べるとその抵抗値は小
さいが、Alよりも抵抗値が高いため、表示の一番重要
な映像信号がなまってしまう問題があるが、延在配線は
Alのままで、電源ラインVDDおよびグランドラインV
ssを、ゲート材料を使ってクロスオバー構造とすれ
ば、延在配線は溶断せず且つ映像信号もなまらなくて済
む。
As the gate material, Cr, tantalum or the like is generally used, and its resistance value is smaller than that of poly-Si, but its resistance value is higher than that of Al, so that the most important video signal for display is lost. Although there is a problem, the extended wiring remains Al and the power supply line VDD and ground line V
If ss is made to have a crossover structure using a gate material, the extended wiring is not melted and the video signal is not dulled.

【0031】第3として、Crは、耐食性等の点で優
れ、比較的抵抗値も少ないことからゲート材料として優
れ、これをクロスオーバー材料として採用すれば、工程
数を増やすことなく実現できる。第4に、延在配線とV
DDライン、延在配線とVssラインの交差部に、ノンド
ープの半導体層を形成することでサージがトランジスタ
を介さず駆動回路へ侵入することを防止することができ
る。
Thirdly, Cr is excellent as a gate material because it is excellent in corrosion resistance and the like and has a relatively small resistance value. If it is used as a crossover material, it can be realized without increasing the number of steps. Fourth, extended wiring and V
By forming a non-doped semiconductor layer at the intersection of the DD line, the extended wiring and the Vss line, it is possible to prevent the surge from entering the drive circuit without passing through the transistor.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の液晶表示装置に使用される保護素子を
説明する図である。
FIG. 1 is a diagram illustrating a protective element used in a liquid crystal display device of the present invention.

【図2】図1の等価回路を説明する図である。FIG. 2 is a diagram illustrating an equivalent circuit of FIG.

【図3】液晶表示装置を説明する断面図である。FIG. 3 is a cross-sectional view illustrating a liquid crystal display device.

【図4】液晶表示装置のトランジスタが形成される側の
基板を説明した図である。
FIG. 4 is a diagram illustrating a substrate on a side where a transistor of a liquid crystal display device is formed.

【図5】従来の保護素子を説明する図である。FIG. 5 is a diagram illustrating a conventional protection element.

【図6】図5の等価回路を説明する図である。FIG. 6 is a diagram illustrating an equivalent circuit of FIG.

Claims (3)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】 第1の透明基板と、前記第1の透明基板
に設けられ、ボトムゲート型TFTおよびこれと接続す
る表示電極を複数集めて成る表示領域と、前記第1の透
明基板の一側辺に形成された複数の端子と、前記複数の
端子と前記表示領域との間に設けられた駆動回路と、前
記端子と前記駆動回路とを電気的に接続する配線と、前
記配線と交差する同層の電源ラインおよび同層のグラン
ドラインと、前記配線と前記電源ラインとの間に接続さ
れたサージ吸収用の第1のボトムゲート型TFTと、前
記配線と前記グランドラインとの間に接続されたサージ
吸収用の第2のボトムゲート型TFTと、第2の透明基
板と、前記第2の透明基板に設けられた対向電極と、前
記第1の透明基板および第2の透明基板に設けられた配
向膜と、前記第1の透明基板と前記第2の透明基板との
間にシール材を介して封入された液晶とを有する液晶表
示装置に於いて、ビデオ信号が入力される前記端子と接続される前記配線
との交差部に対応する電源ラインおよびグランドライン
は、この配線よりも下層に形成されるゲート材料で接続
されており、 前記電源ラインおよび前記グランドラインとの交差部に
対応するビデオ信号以外が入力される前記端子と接続さ
れる前記配線は、この配線よりも下層のゲート材料で接
続されており、 前記電源ラインとの第1の交差部と前記グランドライン
との第2の交差部間に延在される第1の配線は、Al電
極で成り、前記第1の配線から突出して一体で設けられ
た電極は、前記第1のボトムゲート型TFTと前記第2
のボトムゲート型TFTの共通電極となることを特徴と
した液晶表示装置。
1. A first transparent substrate, a display region which is provided on the first transparent substrate, and which includes a plurality of bottom gate type TFTs and a plurality of display electrodes connected thereto, and one of the first transparent substrate. A plurality of terminals formed on a side edge, a driving circuit provided between the plurality of terminals and the display region, a wiring electrically connecting the terminals and the driving circuit, and a crossing of the wiring. Between a power line of the same layer and a ground line of the same layer, a first bottom gate type TFT for surge absorption connected between the wiring and the power line, and between the wiring and the ground line The connected second bottom-gate TFT for absorbing surge, the second transparent substrate, the counter electrode provided on the second transparent substrate, the first transparent substrate and the second transparent substrate. The alignment film provided and the first In a liquid crystal display device having a liquid crystal sealed between a transparent substrate and the second transparent substrate via a sealing material, the wiring connected to the terminal for inputting a video signal.
Power line and ground line corresponding to the intersection with
Is connected by the gate material formed below this wiring
It is, in the intersections of the power supply line and the ground line
Connected to the above-mentioned terminal to input other than the corresponding video signal.
The wiring is connected with the gate material in the layer below this wiring.
Are continued, a first wiring extending between the second intersection of the first intersections of the power supply lines the ground line is made of Al electrode protrudes from said first wiring The electrodes integrally provided are the first bottom gate type TFT and the second bottom gate type TFT.
The liquid crystal display device, which is used as a common electrode of the bottom gate type TFT.
【請求項2】 前記ゲートはCrより成る請求項1の液2. The liquid according to claim 1, wherein the gate is made of Cr.
晶表示装置。Crystal display device.
【請求項3】 前記交差部には、ノンドープの半導体層3. A non-doped semiconductor layer at the intersection.
が形成される請求項1または2記載の液晶表示装置。The liquid crystal display device according to claim 1, wherein the liquid crystal display device is formed.
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