JP3143223U - Ipアドレスを有するロードセル - Google Patents
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Abstract
【解決手段】IPアドレスを有するロードセルは電源1及び荷重センサを含む。前記電源はブリッジ電源及び電源を含む。前記荷重センサは、荷重センサから出力されたアナログ信号をデジタル信号に変換するIP変換基板/ボックス3を含む。電源は荷重センサ及びIP変換基板/ボックスに直列に接続されている。IPアドレスを有するロードセルは遠隔操作で検査しパラメータを修正することができる。ロードセルは検査中及び使用中に試験し、修正し、区別することができる。
【選択図】図1
Description
Claims (10)
- 電源(1) 及びアナログセンサ要素(2) を備えており、IPアドレスを有するロードセルにおいて、
前記電源(1) はブリッジ電源及び電気電源であり、
前記アナログセンサ要素(2) が出力したアナログ信号をデジタル信号に変換可能なIP変換基板又は変換ボックス(3) を更に備え、
前記電源(1) 、アナログセンサ要素(2) 並びにIP変換基板又は変換ボックス(3) は直列に連続して接続されている
ことを特徴とするIPアドレスを有するロードセル。 - 前記IP変換基板又は変換ボックス(3) は、演算増幅器(4) と、A/Dコンバータ(5) と、論理コントローラ(6) と、Mcuマイクロコントローラ又はDSPデジタル信号プロセサ(7) と、プログラムメモリ(8) と、コンピュータ又はイーサネット専用荷重メータに接続されており、IPアドレスを有するイーサネットコントローラ(9) とを備え、
前記アナログセンサ要素(2) の信号出力端は前記演算増幅器(4) の信号入力端に接続され、
前記演算増幅器(4) は、前記Mcuマイクロコントローラ又はDSPデジタル信号プロセサ(7) 、イーサネットコントローラ(9) 、論理コントローラ(6) 、及びプログラムメモリ(8) に、前記A/Dコンバータ(5) を介して接続され、
前記演算増幅器(4) の演算増幅回路は12V電源、チップINA128及び抵抗R19を備える
ことを特徴とする請求項1に記載のIPアドレスを有するロードセル。 - 前記アナログセンサ要素(2) は2つの歪み抵抗及び2つの等値抵抗を含むブリッジ回路で構成された抵抗歪み式センサであり、
前記ブリッジ回路の1番リード線は前記電源(1) の陽極に接続され、
前記ブリッジ回路の2番リード線は前記演算増幅器(4) のチップINA128の2番ピンに接続され、
前記ブリッジ回路の3番リード線は接地され、
前記ブリッジ回路の4番リード線は前記演算増幅器(4) のチップINA128の3番ピンに接続されている
ことを特徴とする請求項2に記載のIPアドレスを有するロードセル。 - 前記演算増幅器(4) のチップINA128の7番ピンは前記12V電源の陽極に接続され、
前記チップINA128の4番ピンは前記12V電源の陰極に接続され、
前記チップINA128の1番及び8番ピンは前記抵抗R19に接続され、
前記チップINA128の2番ピンは前記アナログセンサ要素(2) の2番リード線に接続され、
前記チップINA128の3番ピンは前記アナログセンサ要素(2) の4番リード線に接続され、
前記チップINA128の5番ピンは接地され、
前記チップINA128の6番ピンは、前記抵抗R1に直列に接続された後、前記A/Dコンバータ(5) の9番ピンに接続されている
ことを特徴とする請求項1又は2又は3に記載のIPアドレスを有するロードセル。 - 前記A/Dコンバータ(5) の変換回路はA/Dコンバータ(5) 、抵抗R1及びキャパシタC1を備え、
前記A/Dコンバータ(5) の9番ピンは、前記抵抗R1に直列に接続された後、前記演算増幅器(4) のチップINA128の6番ピンに接続され、
前記A/Dコンバータ(5) の9番ピンはキャパシタC1に直列に接続され、この信号は接地され、
前記A/Dコンバータ(5) の19番ピンは前記論理コントローラ(6) の35番ピンに接続され、
前記A/Dコンバータ(5) の20番ピンは前記論理コントローラ(6) の36番ピンに接続されている
ことを特徴とする請求項1又は2又は3に記載のIPアドレスを有するロードセル。 - 前記論理コントローラ(6) はPLDの要素であり、
該PLDの35番ピンは前記A/Dコンバータ(5) の19番ピンに接続され、
前記PLDの36番ピンは前記A/Dコンバータ(5) の20番ピンに接続され、
前記PLDの50番ピンは前記電源(1) の陽極に接続され、
前記PLDの25番ピンは接地され、
前記PLDの78番ピンは前記デジタル信号プロセサ(7) の108番ピンに接続されている
ことを特徴とする請求項1又は2又は3に記載のIPアドレスを有するロードセル。 - 前記デジタル信号プロセサ(7) はMcuマイクロコントローラ又はDSPデジタル信号プロセサであり、
デジタル信号プロセサの回路はMcuマイクロコントローラ又はDSPデジタル信号プロセサ(7) と電源(1) とを備え、
前記Mcuマイクロコントローラ又はDSPデジタル信号プロセサ(7) の11番ピンは前記プログラムメモリ(8) の5番ピンに接続され、
前記Mcuマイクロコントローラ又はDSPデジタル信号プロセサ(7) の13番ピンは前記電源(1) の陽極に接続され、
前記Mcuマイクロコントローラ又はDSPデジタル信号プロセサ(7) の14番ピンは前記プログラムメモリ(8) の8番ピンに接続され、
前記Mcuマイクロコントローラ又はDSPデジタル信号プロセサ(7) の12番ピンは接地され、
前記Mcuマイクロコントローラ又はDSPデジタル信号プロセサ(7) の4番、5番、6番及び7番ピンは、IPアドレスを有する、コンピュータ又はイーサネット専用荷重メータに接続されているイーサネットコントローラ(9) の1番、2番、3番及び6番ピンに夫々接続されている
ことを特徴とする請求項1又は2又は3に記載のIPアドレスを有するロードセル。 - 前記プログラムメモリ(8) のプログラムメモリ回路はプログラムメモリ(8) 及び電源(1) を備え、
前記プログラムメモリ(8) の6番ピンは電源(1) の陽極に接続され、
前記プログラムメモリ(8) の7番ピンは接地され、
前記プログラムメモリ(8) の5番ピンは前記Mcuマイクロコントローラ又はDSPデジタル信号プロセサ(7) の11番ピンに接続され、
前記プログラムメモリ(8) の8番ピンは前記Mcuマイクロコントローラ又はDSPデジタル信号プロセサ(7) の14番ピンに接続されている
ことを特徴とする請求項1又は2又は3に記載のIPアドレスを有するロードセル。 - IPアドレスを有するイーサネットコントローラ(9) の1番、2番、3番及び6番ピンは前記デジタル信号プロセサ(7) の4番、5番、6番及び7番ピンに夫々接続されていることを特徴とする請求項1又は2又は3に記載のIPアドレスを有するロードセル。
- 前記IP変換基板又は変換ボックス(3) は、アナログセンサ要素(2) に組み込み可能であるか、又はケーブル(14)を介してアナログセンサ要素(2) に接続可能であることを特徴とする請求項1又は2又は3に記載のIPアドレスを有するロードセル。
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