JP3062858B2 - 多点プログラマブル端末装置 - Google Patents
多点プログラマブル端末装置Info
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- JP3062858B2 JP3062858B2 JP5077155A JP7715593A JP3062858B2 JP 3062858 B2 JP3062858 B2 JP 3062858B2 JP 5077155 A JP5077155 A JP 5077155A JP 7715593 A JP7715593 A JP 7715593A JP 3062858 B2 JP3062858 B2 JP 3062858B2
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Description
【０００１】
【産業上の利用分野】本発明は、制御システム等に使用
される時分割多重伝送システムの端末装置の改良に関す
る。
される時分割多重伝送システムの端末装置の改良に関す
る。
【０００２】
【従来技術】図４は従来の時分割多重伝送システムを使
用した制御システムの一例の構成例を示した図である。
中央監視装置５０と複数の端末器５１が時分割多重信号
線５２で接続され、端末器５１は制御対象機器（不図
示）に接続されている。中央監視装置５０と複数の端末
器５１とは、図５に示すような伝送信号のフレームで通
信している。即ち、中央監視装置５０からは通信モード
（データポーリング／制御データの別）を示す通信モー
ドパルスＤｍ、当該端末器５１のアドレスパルスＤａ及
び制御データ（ＯＮ／ＯＦＦ指令、設定値等）の制御デ
ータパルスＤｃを送信する。そうして、アドレスパルス
Ｄａの端末器５１が、制御対象機器（不図示）から受け
た返信用データ（ＯＮ／ＯＦＦ状態信号、警報信号、温
度情報等）である返信データパルスＤｒを返信する（通
信モード＝データポーリングの時）か、制御データパル
スＤｃを受け入れて（通信モード＝制御データの時）、
制御対象機器（不図示）へ転送するようになっている。
そうして、一連の処理が終了すると次のフレームの通信
に移る。
用した制御システムの一例の構成例を示した図である。
中央監視装置５０と複数の端末器５１が時分割多重信号
線５２で接続され、端末器５１は制御対象機器（不図
示）に接続されている。中央監視装置５０と複数の端末
器５１とは、図５に示すような伝送信号のフレームで通
信している。即ち、中央監視装置５０からは通信モード
（データポーリング／制御データの別）を示す通信モー
ドパルスＤｍ、当該端末器５１のアドレスパルスＤａ及
び制御データ（ＯＮ／ＯＦＦ指令、設定値等）の制御デ
ータパルスＤｃを送信する。そうして、アドレスパルス
Ｄａの端末器５１が、制御対象機器（不図示）から受け
た返信用データ（ＯＮ／ＯＦＦ状態信号、警報信号、温
度情報等）である返信データパルスＤｒを返信する（通
信モード＝データポーリングの時）か、制御データパル
スＤｃを受け入れて（通信モード＝制御データの時）、
制御対象機器（不図示）へ転送するようになっている。
そうして、一連の処理が終了すると次のフレームの通信
に移る。
【０００３】
【発明が解決しようとする課題】ところが、図５に示す
ような伝送信号のフォーマットでは１フレームで扱える
データ量が限られているので、端末器５１は制御対象機
器（不図示）の１Ｉ／Ｏ信号（入出力信号）毎に接続さ
れる。その為、Ｉ／Ｏ信号が一箇所に集中すると、多数
の端末器５１が集中することになり、アドレスの設定間
違いやＩ／Ｏ信号の種類のミスマッチ等が起き易くなる
問題があった。
ような伝送信号のフォーマットでは１フレームで扱える
データ量が限られているので、端末器５１は制御対象機
器（不図示）の１Ｉ／Ｏ信号（入出力信号）毎に接続さ
れる。その為、Ｉ／Ｏ信号が一箇所に集中すると、多数
の端末器５１が集中することになり、アドレスの設定間
違いやＩ／Ｏ信号の種類のミスマッチ等が起き易くなる
問題があった。
【０００４】本発明は上記事情に鑑みてなされたもので
あり、１台で多点のＩ／Ｏ信号を結合することが出来、
かつ従来の時分割多重伝送の信号フォーマットで運用出
来る端末装置（端末器）を提供することを目的とする。
あり、１台で多点のＩ／Ｏ信号を結合することが出来、
かつ従来の時分割多重伝送の信号フォーマットで運用出
来る端末装置（端末器）を提供することを目的とする。
【０００５】
【課題を解決するための手段】上記目的を達成する為に
提案される本発明による多点プログラマブル端末装置
は、中央監視装置が複数の制御対象機器を制御する制御
システムに使用されるプログラマブル端末装置であっ
て、端末インターフェースブロックと、シーケンサとを
備えて、上記端末インターフェースブロックには、上記
中央監視装置と時分割多重信号線で接続された信号結合
部と、指定されたアドレス番号から複数チャンネル分の
返信用データを蓄積しチャンネル毎に上記信号結合部を
介して多重伝送すると共に、上記中央監視装置からの制
御データを処理する通信処理用マイクロプロセッサと、
上記シーケンサからのデータを時分割多重伝送のデータ
フォーマットに変換して上記通信処理用マイクロプロセ
ッサへ転送すると共に、上記通信処理用マイクロプロセ
ッサからの制御データを上記シーケンサへ転送するデー
タ変換用マイクロプロセッサとを備え、上記シーケンサ
には、上記制御対象機器と信号の授受を行なう複数のＩ
／Ｏユニットと、上記複数のＩ／Ｏユニットからのデー
タを受けて上記データ変換用マイクロプロセッサへ転送
すると共に、上記データ変換用マイクロプロセッサから
の制御データを受けて上記複数のＩ／Ｏユニットのうち
の当該Ｉ／Ｏユニットへ転送するシーケンサマイクロプ
ロセッサを備えた構成となっている。
提案される本発明による多点プログラマブル端末装置
は、中央監視装置が複数の制御対象機器を制御する制御
システムに使用されるプログラマブル端末装置であっ
て、端末インターフェースブロックと、シーケンサとを
備えて、上記端末インターフェースブロックには、上記
中央監視装置と時分割多重信号線で接続された信号結合
部と、指定されたアドレス番号から複数チャンネル分の
返信用データを蓄積しチャンネル毎に上記信号結合部を
介して多重伝送すると共に、上記中央監視装置からの制
御データを処理する通信処理用マイクロプロセッサと、
上記シーケンサからのデータを時分割多重伝送のデータ
フォーマットに変換して上記通信処理用マイクロプロセ
ッサへ転送すると共に、上記通信処理用マイクロプロセ
ッサからの制御データを上記シーケンサへ転送するデー
タ変換用マイクロプロセッサとを備え、上記シーケンサ
には、上記制御対象機器と信号の授受を行なう複数のＩ
／Ｏユニットと、上記複数のＩ／Ｏユニットからのデー
タを受けて上記データ変換用マイクロプロセッサへ転送
すると共に、上記データ変換用マイクロプロセッサから
の制御データを受けて上記複数のＩ／Ｏユニットのうち
の当該Ｉ／Ｏユニットへ転送するシーケンサマイクロプ
ロセッサを備えた構成となっている。
【０００６】
【作用】本発明による多点プログラマブル端末装置で
は、端末インターフェースブロックと、シーケンサとを
備えて、上記端末インターフェースブロックでは、デー
タ変換用マイクロプロセッサが、上記シーケンサからの
データを時分割多重伝送のデータフォーマットに変換し
て上記通信処理用マイクロプロセッサへ転送すると共
に、上記通信処理用マイクロプロセッサからの制御デー
タを上記シーケンサへ転送する。また、通信処理用マイ
クロプロセッサが、指定されたアドレス番号から複数チ
ャンネル分の返信用データを蓄積し、チャンネル毎に信
号結合部を介して多重伝送すると共に、中央監視装置か
らの制御データを処理して上記データ変換用マイクロプ
ロセッサへ転送する。従って、１台で多点のＩ／Ｏ信号
を結合することが出来、かつ従来の時分割多重伝送の信
号フォーマットで運用することが出来る多点プログラマ
ブル端末装置を実現することが出来る。
は、端末インターフェースブロックと、シーケンサとを
備えて、上記端末インターフェースブロックでは、デー
タ変換用マイクロプロセッサが、上記シーケンサからの
データを時分割多重伝送のデータフォーマットに変換し
て上記通信処理用マイクロプロセッサへ転送すると共
に、上記通信処理用マイクロプロセッサからの制御デー
タを上記シーケンサへ転送する。また、通信処理用マイ
クロプロセッサが、指定されたアドレス番号から複数チ
ャンネル分の返信用データを蓄積し、チャンネル毎に信
号結合部を介して多重伝送すると共に、中央監視装置か
らの制御データを処理して上記データ変換用マイクロプ
ロセッサへ転送する。従って、１台で多点のＩ／Ｏ信号
を結合することが出来、かつ従来の時分割多重伝送の信
号フォーマットで運用することが出来る多点プログラマ
ブル端末装置を実現することが出来る。
【０００７】
【実施例】以下に、添付図を参照して本発明の実施例を
説明する。図１は、本発明による多点プログラマブル端
末装置の一実施例の要部構成例を示したものである。図
において、１０は端末インターフェースブロックであ
り、中央監視装置１１と時分割多重信号線５２で接続さ
れた信号結合部１２、指定されたアドレス番号から複数
チャンネル分の返信用データを蓄積し、チャンネル毎に
信号結合部１２を介して多重伝送すると共に、中央監視
装置１１からの制御データを処理する通信処理用マイク
ロプロセッサＭＰＵ１、通信処理用マイクロプロセッサ
ＭＰＵ１の内部メモリ１３、シーケンサ１４からのデー
タを時分割多重伝送のデータフォーマットに変換して通
信処理用マイクロプロセッサＭＰＵ１へ転送すると共
に、通信処理用マイクロプロセッサＭＰＵ１からの制御
データをシーケンサ１４へ転送するデータ変換用マイク
ロプロセッサＭＰＵ２、データ変換用マイクロプロセッ
サＭＰＵ２の内部メモリ１５、シーケンサ１４との共有
メモリ１６及び通信処理用マイクロプロセッサＭＰＵ１
の最小アドレスを設定するアドレススイッチ１７から構
成されている。
説明する。図１は、本発明による多点プログラマブル端
末装置の一実施例の要部構成例を示したものである。図
において、１０は端末インターフェースブロックであ
り、中央監視装置１１と時分割多重信号線５２で接続さ
れた信号結合部１２、指定されたアドレス番号から複数
チャンネル分の返信用データを蓄積し、チャンネル毎に
信号結合部１２を介して多重伝送すると共に、中央監視
装置１１からの制御データを処理する通信処理用マイク
ロプロセッサＭＰＵ１、通信処理用マイクロプロセッサ
ＭＰＵ１の内部メモリ１３、シーケンサ１４からのデー
タを時分割多重伝送のデータフォーマットに変換して通
信処理用マイクロプロセッサＭＰＵ１へ転送すると共
に、通信処理用マイクロプロセッサＭＰＵ１からの制御
データをシーケンサ１４へ転送するデータ変換用マイク
ロプロセッサＭＰＵ２、データ変換用マイクロプロセッ
サＭＰＵ２の内部メモリ１５、シーケンサ１４との共有
メモリ１６及び通信処理用マイクロプロセッサＭＰＵ１
の最小アドレスを設定するアドレススイッチ１７から構
成されている。
【０００８】また、１８は制御対象機器と信号の授受を
行なうＩ／Ｏユニット、ＭＰＵは複数のＩ／Ｏユニット
１８からのデータを受けてデータ変換用マイクロプロセ
ッサＭＰＵ２へ転送すると共に、データ変換用マイクロ
プロセッサＭＰＵ２からの制御データを受けて当該Ｉ／
Ｏユニット１８へ転送するシーケンサマイクロプロセッ
サ、１９はシーケンサマイクロプロセッサＭＰＵの内部
メモリであり、これら各部によりシーケンサ１４を構成
している。
行なうＩ／Ｏユニット、ＭＰＵは複数のＩ／Ｏユニット
１８からのデータを受けてデータ変換用マイクロプロセ
ッサＭＰＵ２へ転送すると共に、データ変換用マイクロ
プロセッサＭＰＵ２からの制御データを受けて当該Ｉ／
Ｏユニット１８へ転送するシーケンサマイクロプロセッ
サ、１９はシーケンサマイクロプロセッサＭＰＵの内部
メモリであり、これら各部によりシーケンサ１４を構成
している。
【０００９】図２はこのような多点プログラマブル端末
装置２０を使用した時分割多重伝送システムの概要構成
例を示した図である。上記のような多点プログラマブル
端末装置２０の各部の動作を以下に説明する。シーケン
サマイクロプロセッサＭＰＵは、シーケンサ１４のユニ
ット−スロット番号（＝ＣＰＵユニットから数えてＩ／
Ｏユニットが実装されている位置番号）に接続されるＩ
／Ｏユニットの種類（ディジタル／アナログ、入力／出
力、点数等）を認識し、この接続情報を端末インターフ
ェースブロック１０のデータ変換用マイクロプロセッサ
ＭＰＵ２へ通知しておく。
装置２０を使用した時分割多重伝送システムの概要構成
例を示した図である。上記のような多点プログラマブル
端末装置２０の各部の動作を以下に説明する。シーケン
サマイクロプロセッサＭＰＵは、シーケンサ１４のユニ
ット−スロット番号（＝ＣＰＵユニットから数えてＩ／
Ｏユニットが実装されている位置番号）に接続されるＩ
／Ｏユニットの種類（ディジタル／アナログ、入力／出
力、点数等）を認識し、この接続情報を端末インターフ
ェースブロック１０のデータ変換用マイクロプロセッサ
ＭＰＵ２へ通知しておく。
【００１０】制御対象機器（不図示）のＩ／Ｏ信号（入
出力信号）は各々のＩ／Ｏユニット１８に入出力するよ
うになっている。また、シーケンサマイクロプロセッサ
ＭＰＵの内部メモリ１９は、Ｉ／Ｏユニット１８毎の格
納位置（スロット）が予め定められている。従って、制
御対象機器（不図示）の各Ｉ／Ｏ信号は、シーケンサマ
イクロプロセッサＭＰＵによって内部メモリ１９の予め
定められた格納位置（スロット）に格納されるか（入力
信号の時）、内部メモリ１９の予め定められた格納位置
（スロット）から取り出されて（出力信号の時）、所定
のＩ／Ｏユニット１８にセットされる。
出力信号）は各々のＩ／Ｏユニット１８に入出力するよ
うになっている。また、シーケンサマイクロプロセッサ
ＭＰＵの内部メモリ１９は、Ｉ／Ｏユニット１８毎の格
納位置（スロット）が予め定められている。従って、制
御対象機器（不図示）の各Ｉ／Ｏ信号は、シーケンサマ
イクロプロセッサＭＰＵによって内部メモリ１９の予め
定められた格納位置（スロット）に格納されるか（入力
信号の時）、内部メモリ１９の予め定められた格納位置
（スロット）から取り出されて（出力信号の時）、所定
のＩ／Ｏユニット１８にセットされる。
【００１１】端末インターフェースブロック１０のデー
タ変換用マイクロプロセッサＭＰＵ２は、上記のように
シーケンサ１４のユニット−スロット番号に接続される
Ｉ／Ｏユニット１８の接続情報を、シーケンサマイクロ
プロセッサＭＰＵから通知されるので、シーケンサマイ
クロプロセッサＭＰＵの内部メモリ１９にどのようなＩ
／Ｏ信号が配列されているか判断することが出来る。こ
の為、データ変換用マイクロプロセッサＭＰＵ２は、共
有メモリ１６を介して、内部メモリ１９内のＩ信号（入
力信号）をシーケンサマイクロプロセッサＭＰＵとのデ
ータ処理で取り出し、自己の内部メモリ１５に一定サイ
クルで常時書き込みを行なっている。
タ変換用マイクロプロセッサＭＰＵ２は、上記のように
シーケンサ１４のユニット−スロット番号に接続される
Ｉ／Ｏユニット１８の接続情報を、シーケンサマイクロ
プロセッサＭＰＵから通知されるので、シーケンサマイ
クロプロセッサＭＰＵの内部メモリ１９にどのようなＩ
／Ｏ信号が配列されているか判断することが出来る。こ
の為、データ変換用マイクロプロセッサＭＰＵ２は、共
有メモリ１６を介して、内部メモリ１９内のＩ信号（入
力信号）をシーケンサマイクロプロセッサＭＰＵとのデ
ータ処理で取り出し、自己の内部メモリ１５に一定サイ
クルで常時書き込みを行なっている。
【００１２】データ変換用マイクロプロセッサＭＰＵ２
は、上記の内部メモリ１５に書き込まれ蓄積されたＩ信
号を、時分割多重伝送のデータフォーマット（図５）の
データ形式（データ単位）（図５のＤｒ）に変換して、
通信処理用マイクロプロセッサＭＰＵ１の内部メモリ１
３の所定チャンネルへ転送する。例えば、図５に示した
データフォーマットの１フレームのデータ量（Ｄｒのビ
ット数）を４ビットとするなら、１台の１６点入力のＤ
Ｉ（ディジタルインプット）ユニットから取り込んだ１
６ビットのＯＮ／ＯＦＦ状態信号を、４チャンネル分に
分解して通信処理用マイクロプロセッサＭＰＵ１にセッ
トする。こうすることにより、１６点入力のＤＩユニッ
トからの信号でも従来のデータフォーマット（図５）で
扱うことが可能になる。
は、上記の内部メモリ１５に書き込まれ蓄積されたＩ信
号を、時分割多重伝送のデータフォーマット（図５）の
データ形式（データ単位）（図５のＤｒ）に変換して、
通信処理用マイクロプロセッサＭＰＵ１の内部メモリ１
３の所定チャンネルへ転送する。例えば、図５に示した
データフォーマットの１フレームのデータ量（Ｄｒのビ
ット数）を４ビットとするなら、１台の１６点入力のＤ
Ｉ（ディジタルインプット）ユニットから取り込んだ１
６ビットのＯＮ／ＯＦＦ状態信号を、４チャンネル分に
分解して通信処理用マイクロプロセッサＭＰＵ１にセッ
トする。こうすることにより、１６点入力のＤＩユニッ
トからの信号でも従来のデータフォーマット（図５）で
扱うことが可能になる。
【００１３】また、ＡＩ（アナログインプット）信号の
場合、計測範囲が例えば０〜４０００であれば、１回の
伝送フレームでは返信出来ないので、従来同様、同一チ
ャンネルの制御データ（通常ポーリングの時には意味を
持たない）を数値の桁指定として（例：制御データ＝１
の時１桁目、制御データ＝２の時２桁目・・・）使用
し、４フレームを費やして１点のアナログ情報を返信す
る。この為、通信処理用マイクロプロセッサＭＰＵ１で
は、通信１チャンネルについて桁数分のバイト容量を確
保している。
場合、計測範囲が例えば０〜４０００であれば、１回の
伝送フレームでは返信出来ないので、従来同様、同一チ
ャンネルの制御データ（通常ポーリングの時には意味を
持たない）を数値の桁指定として（例：制御データ＝１
の時１桁目、制御データ＝２の時２桁目・・・）使用
し、４フレームを費やして１点のアナログ情報を返信す
る。この為、通信処理用マイクロプロセッサＭＰＵ１で
は、通信１チャンネルについて桁数分のバイト容量を確
保している。
【００１４】データ変換用マイクロプロセッサＭＰＵ２
は、通信処理用マイクロプロセッサＭＰＵ１からアドレ
スの何チャンネルにどのような制御データが送信されて
来たかを知って、その制御データを通信処理用マイクロ
プロセッサＭＰＵ１から読み出して、シーケンサマイク
ロプロセッサＭＰＵの内部メモリ１９の予め定められた
格納位置（スロット）に書き込む。シーケンサマイクロ
プロセッサＭＰＵは、内部メモリ１９に書き込まれた制
御データを取り出して、所定のＩ／Ｏユニット１８にセ
ットする。
は、通信処理用マイクロプロセッサＭＰＵ１からアドレ
スの何チャンネルにどのような制御データが送信されて
来たかを知って、その制御データを通信処理用マイクロ
プロセッサＭＰＵ１から読み出して、シーケンサマイク
ロプロセッサＭＰＵの内部メモリ１９の予め定められた
格納位置（スロット）に書き込む。シーケンサマイクロ
プロセッサＭＰＵは、内部メモリ１９に書き込まれた制
御データを取り出して、所定のＩ／Ｏユニット１８にセ
ットする。
【００１５】通信処理用マイクロプロセッサＭＰＵ１
は、時分割多重信号線５２上の伝送フレームを監視して
おり、アドレスパルスＤａ（図５）が、アドレススイッ
チ１７により設定されたｋチャンネルからｎ番地の自己
の受け持つアドレスの何れかと一致するかを判断する。
そうして、一致すると、通信モードパルスＤｍ（図５）
がポーリングモードの時は、当該チャンネルに格納して
ある返信データを返信データパルスＤｒに乗せて、中央
監視装置１１へ返信する。通信モードパルスＤｍが制御
データの時は、これをデータ変換用マイクロプロセッサ
ＭＰＵ２へ通知する。
は、時分割多重信号線５２上の伝送フレームを監視して
おり、アドレスパルスＤａ（図５）が、アドレススイッ
チ１７により設定されたｋチャンネルからｎ番地の自己
の受け持つアドレスの何れかと一致するかを判断する。
そうして、一致すると、通信モードパルスＤｍ（図５）
がポーリングモードの時は、当該チャンネルに格納して
ある返信データを返信データパルスＤｒに乗せて、中央
監視装置１１へ返信する。通信モードパルスＤｍが制御
データの時は、これをデータ変換用マイクロプロセッサ
ＭＰＵ２へ通知する。
【００１６】図３は図１のシーケンサ１４のユニット−
スロット番号（＝ＣＰＵユニットから数えてＩ／Ｏユニ
ット１８が実装されている位置番号）の１，２，３に接
続されるＩ／Ｏユニット１８の種類をＤｉ−１６点（デ
ィジタルインプット１６点）、Ｄｏ−１６点（ディジタ
ルアウトプット１６点）、Ａｉ−４点（アナログインプ
ット４点）とした例を示したものである。
スロット番号（＝ＣＰＵユニットから数えてＩ／Ｏユニ
ット１８が実装されている位置番号）の１，２，３に接
続されるＩ／Ｏユニット１８の種類をＤｉ−１６点（デ
ィジタルインプット１６点）、Ｄｏ−１６点（ディジタ
ルアウトプット１６点）、Ａｉ−４点（アナログインプ
ット４点）とした例を示したものである。
【００１７】図３において、シーケンサマイクロプロセ
ッサＭＰＵは、内部メモリ１９内のどのスロットにどの
種類のＩ／Ｏユニット１８が接続されているかを認識
し、内部メモリ１９内の各データを定期的（プログラム
サイクル等）に更新する。データはワード（この場合は
１６ビット）単位で処理する。データ変換用マイクロプ
ロセッサＭＰＵ２は、シーケンサマイクロプロセッサＭ
ＰＵから内部メモリ１９内のどのスロットにどの種類の
Ｉ／Ｏユニット１８が接続されているかの情報を受け取
る。そうして、１スロットにはＤｉ−１６点ユニットが
接続されているので、内部メモリ１９の０ワード番地の
データを読み出し、これを４チャンネル分に分割して、
通信処理用マイクロプロセッサＭＰＵ１の内部メモリ１
３のポーリング領域１３´（ｘ０−３，ｘ４−７，ｘ８
−Ｂ，ｘＣ−Ｆ）にセットする。（０〜Ｆは１６進数）
また、３スロットにはＡｉ−４点のアナログユニットが
接続されているので、まず、データ変換用マイクロプロ
セッサＭＰＵ２は、３ワード番地のデータを読み出し、
これを桁データ（１回の伝送フレームで伝送出来る量）
に分割して、通信処理用マイクロプロセッサＭＰＵ１の
内部メモリ１３のポーリング領域１３´（Ａｉ−１）に
セットする。次いで、順次、４，５，６ワード番地のデ
ータを読み出し、同様に桁データに分割して、内部メモ
リ１３のポーリング領域１３´（Ａｉ−２，Ａｉ−３，
Ａｉ−４）にセットする。
ッサＭＰＵは、内部メモリ１９内のどのスロットにどの
種類のＩ／Ｏユニット１８が接続されているかを認識
し、内部メモリ１９内の各データを定期的（プログラム
サイクル等）に更新する。データはワード（この場合は
１６ビット）単位で処理する。データ変換用マイクロプ
ロセッサＭＰＵ２は、シーケンサマイクロプロセッサＭ
ＰＵから内部メモリ１９内のどのスロットにどの種類の
Ｉ／Ｏユニット１８が接続されているかの情報を受け取
る。そうして、１スロットにはＤｉ−１６点ユニットが
接続されているので、内部メモリ１９の０ワード番地の
データを読み出し、これを４チャンネル分に分割して、
通信処理用マイクロプロセッサＭＰＵ１の内部メモリ１
３のポーリング領域１３´（ｘ０−３，ｘ４−７，ｘ８
−Ｂ，ｘＣ−Ｆ）にセットする。（０〜Ｆは１６進数）
また、３スロットにはＡｉ−４点のアナログユニットが
接続されているので、まず、データ変換用マイクロプロ
セッサＭＰＵ２は、３ワード番地のデータを読み出し、
これを桁データ（１回の伝送フレームで伝送出来る量）
に分割して、通信処理用マイクロプロセッサＭＰＵ１の
内部メモリ１３のポーリング領域１３´（Ａｉ−１）に
セットする。次いで、順次、４，５，６ワード番地のデ
ータを読み出し、同様に桁データに分割して、内部メモ
リ１３のポーリング領域１３´（Ａｉ−２，Ａｉ−３，
Ａｉ−４）にセットする。
【００１８】一方、中央監視装置１１からｋ＋６チャン
ネルの制御データを設定して来た時には、データ変換用
マイクロプロセッサＭＰＵ２は、この制御データはシー
ケンサデータとしてはｙ４−７ビット（出力の４−７ポ
ート）と判別して、この制御データによりシーケンサマ
イクロプロセッサＭＰＵの内部メモリ１９の１ワード番
地のデータを書き換える。
ネルの制御データを設定して来た時には、データ変換用
マイクロプロセッサＭＰＵ２は、この制御データはシー
ケンサデータとしてはｙ４−７ビット（出力の４−７ポ
ート）と判別して、この制御データによりシーケンサマ
イクロプロセッサＭＰＵの内部メモリ１９の１ワード番
地のデータを書き換える。
【００１９】通信処理用マイクロプロセッサＭＰＵ１
は、時分割多重信号線５２上の伝送フレームを監視し
て、アドレスパルスＤａ（図５）が自己の受け持つアド
レスの何れかと一致するかを判断しており、一致する
と、通信モードパルスＤｍ（図５）がポーリングモード
の時は、当該チャンネルに格納してある返信データを返
信データパルスＤｒに乗せて、中央監視装置へ返信す
る。通信モードパルスＤｍが制御データの時は、これを
データ変換用マイクロプロセッサＭＰＵ２へ通知する。
は、時分割多重信号線５２上の伝送フレームを監視し
て、アドレスパルスＤａ（図５）が自己の受け持つアド
レスの何れかと一致するかを判断しており、一致する
と、通信モードパルスＤｍ（図５）がポーリングモード
の時は、当該チャンネルに格納してある返信データを返
信データパルスＤｒに乗せて、中央監視装置へ返信す
る。通信モードパルスＤｍが制御データの時は、これを
データ変換用マイクロプロセッサＭＰＵ２へ通知する。
【００２０】上記のような接続は、中央監視装置１１か
ら見ると、チャンネルｋ〜ｋ＋３にはＤｉ（ディジタル
インプット）端末器が、チャンネルｋ＋４〜ｋ＋７には
Ｄｏ（ディジタルアウトプット）端末器が、チャンネル
ｋ＋８〜ｋ＋１１にはＡｉ（アナログインプット）端末
器が、各々接続されているのと同じになる。
ら見ると、チャンネルｋ〜ｋ＋３にはＤｉ（ディジタル
インプット）端末器が、チャンネルｋ＋４〜ｋ＋７には
Ｄｏ（ディジタルアウトプット）端末器が、チャンネル
ｋ＋８〜ｋ＋１１にはＡｉ（アナログインプット）端末
器が、各々接続されているのと同じになる。
【００２１】
【発明の効果】本発明による多点プログラマブル端末装
置によれば、１台で多点のＩ／Ｏ信号を結合することが
出来、かつ従来の時分割多重伝送の信号フォーマットで
運用することが出来るので、従来の中央監視装置が使用
出来る。また、既存のシーケンサと組み合わせるので、
ＡＮＤ／ＯＲの論理データを簡単に作り出すことが出
来、Ｉ／Ｏ信号の追加変更もＩ／Ｏユニットの追加交換
で簡単に行える。
置によれば、１台で多点のＩ／Ｏ信号を結合することが
出来、かつ従来の時分割多重伝送の信号フォーマットで
運用することが出来るので、従来の中央監視装置が使用
出来る。また、既存のシーケンサと組み合わせるので、
ＡＮＤ／ＯＲの論理データを簡単に作り出すことが出
来、Ｉ／Ｏ信号の追加変更もＩ／Ｏユニットの追加交換
で簡単に行える。
【図１】本発明による多点プログラマブル端末装置の構
成例図である。
成例図である。
【図２】図１の多点プログラマブル端末装置を使用した
制御システムの構成例図である。
制御システムの構成例図である。
【図３】図１の多点プログラマブル端末装置の動作を説
明する為の図である。
明する為の図である。
【図４】従来の制御システムの構成例図である。
【図５】時分割多重伝送のデータフォーマットを示した
図である。
図である。
１０・・・端末インターフェースブロック １１・・・中央監視装置 １２・・・信号結合部 １３・・・通信処理用マイクロプロセッサの内部メモリ １４・・・シーケンサ １５・・・データ変換用マイクロプロセッサの内部メモ
リ １７・・・アドレススイッチ １８・・・Ｉ／Ｏユニット １９・・・シーケンサマイクロプロセッサの内部メモリ ２０・・・多点プログラマブル端末装置 ５２・・・時分割多重信号線 ＭＰＵ・・・シーケンサマイクロプロセッサ ＭＰＵ１・・・通信処理用マイクロプロセッサ ＭＰＵ２・・・データ変換用マイクロプロセッサ
リ １７・・・アドレススイッチ １８・・・Ｉ／Ｏユニット １９・・・シーケンサマイクロプロセッサの内部メモリ ２０・・・多点プログラマブル端末装置 ５２・・・時分割多重信号線 ＭＰＵ・・・シーケンサマイクロプロセッサ ＭＰＵ１・・・通信処理用マイクロプロセッサ ＭＰＵ２・・・データ変換用マイクロプロセッサ
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) H04L 5/22 H04J 3/00 H04Q 9/00
Claims (1)
- 【請求項１】中央監視装置が複数の制御対象機器を制御
する制御システムに使用されるプログラマブル端末装置
であって、 端末インターフェースブロックと、シーケンサとを備え
て、 上記端末インターフェースブロックには、上記中央監視
装置と時分割多重信号線で接続された信号結合部と、指
定されたアドレス番号から複数チャンネル分の返信用デ
ータを蓄積しチャンネル毎に上記信号結合部を介して多
重伝送すると共に、上記中央監視装置からの制御データ
を処理する通信処理用マイクロプロセッサと、上記シー
ケンサからのデータを時分割多重伝送のデータフォーマ
ットに変換して上記通信処理用マイクロプロセッサへ転
送すると共に、上記通信処理用マイクロプロセッサから
の制御データを上記シーケンサへ転送するデータ変換用
マイクロプロセッサとを備え、 上記シーケンサには、上記制御対象機器と信号の授受を
行なう複数のＩ／Ｏユニットと、上記複数のＩ／Ｏユニ
ットからのデータを受けて上記データ変換用マイクロプ
ロセッサへ転送すると共に、上記データ変換用マイクロ
プロセッサからの制御データを受けて上記複数のＩ／Ｏ
ユニットのうちの当該Ｉ／Ｏユニットへ転送するシーケ
ンサマイクロプロセッサを備えたことを特徴とする多点
プログラマブル端末装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5077155A JP3062858B2 (ja) | 1993-04-02 | 1993-04-02 | 多点プログラマブル端末装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5077155A JP3062858B2 (ja) | 1993-04-02 | 1993-04-02 | 多点プログラマブル端末装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06291750A JPH06291750A (ja) | 1994-10-18 |
| JP3062858B2 true JP3062858B2 (ja) | 2000-07-12 |
Family
ID=13625910
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5077155A Expired - Fee Related JP3062858B2 (ja) | 1993-04-02 | 1993-04-02 | 多点プログラマブル端末装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3062858B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7375937B2 (en) | 2001-02-01 | 2008-05-20 | Hydro-Aire, Inc. | Current fault detector and circuit interrupter and packaging thereof |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005311523A (ja) * | 2004-04-19 | 2005-11-04 | Fuji Electric Systems Co Ltd | 光通信制御装置 |
-
1993
- 1993-04-02 JP JP5077155A patent/JP3062858B2/ja not_active Expired - Fee Related
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7375937B2 (en) | 2001-02-01 | 2008-05-20 | Hydro-Aire, Inc. | Current fault detector and circuit interrupter and packaging thereof |
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| Publication number | Publication date |
|---|---|
| JPH06291750A (ja) | 1994-10-18 |
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