JP3041318B2 - Semiconductor device bonding equipment - Google Patents
Semiconductor device bonding equipmentInfo
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Description
【0001】[0001]
【産業上の利用分野】この発明は、半導体チップの突起
電極とリードとを加熱下で圧着させるボンディング装置
に関するものである。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a bonding apparatus for pressing a protruding electrode and a lead of a semiconductor chip under heating.
【0002】[0002]
【従来の技術】半導体チップの上面に形成される突起電
極と、実装用テープのリードとをボンディングするTA
B(Tape Automated Bonding) 法を適用した実装例を図
を用いて説明する。図7はTAB法によって実装された
従来の半導体チップを示す斜視図である。図において、
1は半導体チップ、2はこの半導体チップ1の上面に形
成された突起電極、3は実装テープ(図示せず)のリー
ドで、突起電極2と電気的、機械的に接続されている。
このように、突起電極2とリード3とのボンディングを
行なうと、半導体チップ1の持つ能動機能をリード3に
取り出すことが可能となる。したがって、たとえば外部
端子と電気的に配線されているパッドを有する基板上
に、リード3を半田付け等に接続することによって、半
導体チップ1はその能動機能を外部端子から送り出すこ
とができ、半導体装置としての機能を発輝する。2. Description of the Related Art A TA for bonding a projecting electrode formed on an upper surface of a semiconductor chip to a lead of a mounting tape.
An example of implementation using the B (Tape Automated Bonding) method will be described with reference to the drawings. FIG. 7 is a perspective view showing a conventional semiconductor chip mounted by the TAB method. In the figure,
1 is a semiconductor chip, 2 is a protruding electrode formed on the upper surface of the semiconductor chip 1, and 3 is a lead of a mounting tape (not shown), which is electrically and mechanically connected to the protruding electrode 2.
By bonding the protruding electrodes 2 and the leads 3 in this manner, the active functions of the semiconductor chip 1 can be taken out to the leads 3. Therefore, for example, by connecting the leads 3 to the substrate having pads electrically connected to the external terminals by soldering or the like, the semiconductor chip 1 can send out its active function from the external terminals. As a function to shine.
【0003】TAB技術におけるボンディング方法を図
を用いて説明する、図8は、TAB技術におけるボンデ
ィング方法の一例の全突起電極と全リードを一括で熱圧
着するギャング・ボンディング法を説明する概略図であ
る。図において、4は約15mm×15mmの半導体チップ
1を載せるボンディング・ステージ、5はボンディング
・ツール、6はステージ4の固定具である。図8(a)
において、ステージ4上に半導体チップ1を載置し、突
起電極2とリード3を位置合わせする。次に、図(b)
において、約500℃に昇温させたツール5を、全突起
電極2(材質は例えばAu)および全リード3(材質は
例えばSn,Au等)に押しつける。この熱および押し
つけ力により、突起電極2とリード3は熱圧着される。[0003] A bonding method in the TAB technique will be described with reference to the drawings. FIG. 8 is a schematic diagram illustrating an example of a bonding method in the TAB technique, which is a gang bonding method in which all protruding electrodes and all leads are thermocompressed together. is there. In the figure, reference numeral 4 denotes a bonding stage on which the semiconductor chip 1 of about 15 mm × 15 mm is mounted, 5 denotes a bonding tool, and 6 denotes a fixture for the stage 4. FIG. 8 (a)
, The semiconductor chip 1 is placed on the stage 4 and the projecting electrodes 2 and the leads 3 are aligned. Next, FIG.
, The tool 5 heated to about 500 ° C. is pressed against all the protruding electrodes 2 (made of, for example, Au) and all the leads 3 (made of, for example, Sn, Au, etc.). The projecting electrode 2 and the lead 3 are thermocompression bonded by this heat and pressing force.
【0004】[0004]
【発明が解決しようとする課題】ところが、従来のボン
ディング方法では、図8(c)に示すように、ツール5
の熱がチップを介してステージ1に達し、ステージ1内
で温度分布が生じ、ステージが上へ凸形状に反るという
現象がみられた。この現象により、図8(d)に示すよ
うにボンディング後のチップの各辺中央付近のバンプチ
ップコーナのそれとにはリードに高さの差Hcが生じて
いた。つまり中央付近のチップの電極リードはコーナ付
近のものに比較しつぶれすぎる結果となった。このつぶ
れすぎは、隣接バンプとの接触や、バンプ下地破壊の原
因となり、半導体装置の不良となるという問題点があっ
た。However, in the conventional bonding method, as shown in FIG.
The heat reaches the stage 1 via the chip, a temperature distribution occurs in the stage 1, and the stage is warped in a convex shape. As a result of this phenomenon, as shown in FIG. 8D, a difference Hc in height between the lead and the bump chip corner near the center of each side of the chip after bonding occurred. That is, the electrode lead of the chip near the center was too much crushed as compared with that near the corner. The over-crushing causes a contact with an adjacent bump and a breakdown of a bump underlayer, which causes a problem that a semiconductor device becomes defective.
【0005】この発明は、上記のような問題点を解消す
るためになされたもので、チップ内のHcのバラツキを
減少させることを目的とし、ひいては、隣接バンプの接
触やバンプ下地破壊という不良が発生しにくいボンディ
ング方法および装置を提供することを目的とするもので
ある。SUMMARY OF THE INVENTION The present invention has been made to solve the above problems, and has as its object to reduce the variation of Hc in a chip. It is an object of the present invention to provide a bonding method and a device that are less likely to occur.
【0006】[0006]
【課題を解決するための手段】本発明のボンディング装
置は、突起電極を有する半導体チップをボンディングス
テージ上に載置し、リードを前記突起電極上に重なるよ
うに配置した状態で、所定の温度に加熱されたボンディ
ングツールによって重ね合わされたリードと突起電極と
を加圧することによってリードと突起電極とを圧着する
装置である。上記のボンディングステージは、直径30
mm以上で、厚さが10mm以上の円柱形状を有し、F
αρC/λ[単位:cal/(℃・mm 4 )]がSKS−3のそれ
よりも小さい材料で形成されていることを特徴とする。
ここで、αは線膨張係数1/℃、ρは密度gr/mm 3 、C
は比熱cal/(gr・℃)、λは熱伝導率cal/(mm・s・℃)
である。また、Fは次の場合の熱流束[cal/(mm 2 ・
s)]である。25℃のボンディングステージの上に半導
体チップを載せて、実装用のテープのリードをその半導
体チップに圧着するために500℃のボンディングツー
ルでボンディングステージ側に押し付けたとき、半導体
チップを介してボンディングステージに流入する、単位
面積[mm 2 ]当り、単位時間[s]当りの熱流束[cal/
(mm 2 ・s)]である。 SUMMARY OF THE INVENTION A bonding apparatus according to the present invention is provided.
The semiconductor chip having the protruding electrodes is mounted on a bonding stage, and the leads and the protruding electrodes superimposed by a bonding tool heated to a predetermined temperature in a state where the leads are arranged so as to overlap the protruding electrodes. To press the lead and the protruding electrode by applying pressure
Device. The above bonding stage has a diameter of 30
mm and a column shape with a thickness of 10 mm or more , F
αρC / λ [unit: cal / (° C.mm 4 )] is that of SKS-3
It is characterized by being formed of a smaller material.
Where α is the linear expansion coefficient 1 / ° C., ρ is the density gr / mm 3 , C
Is the specific heat cal / (gr · ° C), λ is the thermal conductivity cal / (mm · s · ° C)
It is. F is the heat flux [cal / (mm 2 ·
s)]. Semi-conductive on 25 ° C bonding stage
Body chip and place the leads on the mounting tape
500 ° C bonding tool
When pressed against the bonding stage with a
Unit that flows into the bonding stage via the chip
Heat flux [cal / cal / per unit area [ s] per area [mm 2 ]
(mm 2 · s)].
【0007】[0007]
【作用】このボンディングステージの形状は、直径30
mm以上で、厚さが10mm以上の円柱形状とする。こ
の形状のため、従来のボンディングステージに比べて大
型となり、剛性が向上してステージ反りを拘束する。ま
た、このように、ボンディングステージを大型にすれ
ば、熱が外側にも伝わることになり、ステージ表面が盛
り上がる膨張が減少する。さらに、このボンディングス
テージの材料として、FαρC/λがSKS−3のそれ
より小さい材料をを用いることにより、図6に示すよう
に、圧着後の突起電極とリードとを合わせた高さに関し
て、ステージ中央で圧着されたものと、ステージの端で
圧着されたものとの差Hcを1.83未満とすることが
できる。 The bonding stage has a diameter of 30 mm.
mm and a column shape with a thickness of 10 mm or more. This
Shape compared to conventional bonding stages
It becomes a mold and improves rigidity to restrain the stage warpage. Ma
Also, when the bonding stage is large,
If heat is transferred to the outside, the stage surface
Rising swelling is reduced. In addition, this bondings
As the material of the cottage, FαρC / λ is that of SKS-3
By using smaller materials, as shown in FIG.
The height of the combined protruding electrode and lead after crimping
And the one pressed at the center of the stage
The difference Hc from the crimped one should be less than 1.83
it can.
【0008】[0008]
【実施例】実施例1.以下、この発明の一実施例を図に
よって説明する。図1(a)はボンディング前の状態を
示す概略図でステージ全体温度を285℃に設定した場
合を示す。なおこの時のステージ温度の285℃はこの
実施例におけるボンディング装置の構成上の制約からな
されたものである。また図示しないが従来例と同様にス
テージ4は固定具で図示しないボンディング装置架台に
精度良く固定されている。そしてボンディング時間は3
秒間でなされている。次に数値解析を行った結果図1
(b)に示したボンディングが完了した直後には、ステ
ージ上面温度が360.4℃になる。この時ステージ下
面温度は285℃に保持されている。この解析結果ステ
ージ上面と下面との温度差ΔTは75.4℃となる。こ
のような温度差(温度分布)を有するステージを下面固
定として数値解析した結果1.61μmの反り量である
ことがわかった。この反り量を有するステージでチップ
のボンディングが為されているため上記した電極リード
の高さの差Hcが、反り量零の場合に比較してその反り
量の分だけ、つまり1.61μmのばらつきを有するも
のと考えられる。なお、この一実施例のステージ形状は
図4に示すものであり、材質はSKS−3(合金工具
鋼)としている。またステージの加熱法は特に記載して
ないが、通常のヒータ加熱等によるものである。[Embodiment 1] Hereinafter, an embodiment of the present invention will be described with reference to the drawings. FIG. 1A is a schematic diagram showing a state before bonding and shows a case where the entire stage temperature is set to 285 ° C. Note that the stage temperature of 285 ° C. at this time was determined due to restrictions on the configuration of the bonding apparatus in this embodiment. Although not shown, the stage 4 is precisely fixed to a bonding apparatus base (not shown) by a fixture similarly to the conventional example. And the bonding time is 3
Have been done in seconds. Next, as a result of numerical analysis, FIG.
Immediately after the bonding shown in (b) is completed, the stage upper surface temperature becomes 360.4 ° C. At this time, the temperature of the lower surface of the stage is maintained at 285 ° C. As a result of this analysis, the temperature difference ΔT between the upper surface and the lower surface of the stage is 75.4 ° C. Numerical analysis was performed with the stage having such a temperature difference (temperature distribution) fixed to the lower surface, and it was found that the warpage was 1.61 μm. Since the bonding of the chip is performed on the stage having the amount of warpage, the difference Hc in the height of the electrode leads is equal to the amount of warpage compared to the case where the amount of warpage is zero, that is, the variation of 1.61 μm. It is considered that it has. The stage shape of this embodiment is shown in FIG. 4, and the material is SKS-3 (alloy tool steel). Although the stage heating method is not particularly described, it is based on ordinary heater heating or the like.
【0009】なお、上記実施例では、装置の制約上から
ステージ温度が285℃となっているが、その制約が無
くなればツール温度(この場合500℃)と等しくする
とステージ内の温度分布が無くなり、反り発生のない、
Hcのばらつきの無いボンディングを行うことは言うま
でもない。In the above embodiment, the stage temperature is 285.degree. C. due to the restriction of the apparatus. No warpage,
It goes without saying that bonding without variation in Hc is performed.
【0010】このような本願発明の一実施例に対し図2
に示す従来の方法では、ステージ温度が25℃である。
この場合は、ボンディングの完了する時にはステージ表
面温度が131.4℃になることが数値解析により求ま
った。その結果、温度差ΔTは106.4℃となり、こ
のときの反り量は2.27μmである。(数値解析値)
したがって、Hcのばらつきが2.27μmであると考
えられる。この場合の材質もSKS−3、形状は図3に
示すものである。FIG. 2 shows an embodiment of the present invention.
In the conventional method shown in (1), the stage temperature is 25 ° C.
In this case, it was found by numerical analysis that the stage surface temperature would be 131.4 ° C. when the bonding was completed. As a result, the temperature difference ΔT becomes 106.4 ° C., and the amount of warpage at this time is 2.27 μm. (Numerical analysis value)
Therefore, it is considered that the variation of Hc is 2.27 μm. The material in this case is also SKS-3, and the shape is as shown in FIG.
【0011】このように、本発明によれば、従来のボン
ディング装置によるリード電極の高さの差Hcのばらつ
きが2.27μmであったものが、本願発明のそれでは
1.61μmに減少させることができる。As described above, according to the present invention, the variation in the height difference Hc of the lead electrodes caused by the conventional bonding apparatus was 2.27 μm, but the variation of the present invention can be reduced to 1.61 μm. it can.
【0012】実施例2.また、この発明の第2の実施例
を図3を用いて説明する。図3は、30mmφ、10mmt
のステージ(大ステージ)を示す。この場合でのステー
ジ反り量は、1.83μmであることが数値解析より求
まった、材質はSKS−3、温度は25℃である。これ
に対し、従来のステージ形状(小ステージ)である図4
の場合は、ステージ反り量が前述のように2.27μm
である。これは、従来のステージに比べて本発明のステ
ージ(図3)は大型であるため、剛性が向上しステージ
反りを拘束するためと考えられる。また、ステージを大
型にすれば熱が外側へも伝わることになり、ステージ表
層部の面方向への膨張が減少したのも理由の一つと考え
られる。図5(a)(b)に大、小ステージのボンディ
ング作業完了時点(3秒後)の温度分布と変形を示す。
このように、第2の実施例によれば、Hcのばらつきを
2.27μmから1.83μmへ減少させることが可能
となる。尚、ステージ形状を30mmφ以上、10mmt以
上とすれば更にHcは減少すると考えられる。Embodiment 2 FIG. A second embodiment of the present invention will be described with reference to FIG. Fig. 3 shows 30mmφ, 10mmt
(Large stage) is shown. The amount of stage warpage in this case was determined to be 1.83 μm by numerical analysis. The material was SKS-3 and the temperature was 25 ° C. On the other hand, FIG. 4 shows a conventional stage shape (small stage).
In the case of, the stage warpage amount is 2.27 μm as described above.
It is. This is considered to be because the stage of the present invention (FIG. 3) is larger than the conventional stage, so that the rigidity is improved and the stage warpage is restrained. Further, it is considered that one of the reasons is that when the stage is made large, heat is transmitted to the outside, and expansion of the surface layer of the stage in the surface direction is reduced. FIGS. 5A and 5B show the temperature distribution and deformation at the time of completion of the bonding operation of the large and small stages (after 3 seconds).
Thus, according to the second embodiment, it is possible to reduce the variation in Hc from 2.27 μm to 1.83 μm. If the stage shape is 30 mmφ or more and 10 mmt or more, it is considered that Hc is further reduced.
【0013】実施例3. また、この発明の第3の実施例を図6を用いて説明す
る。図6は、ステージ材に関するFαρC/λとHcの
関係を示す。ここで、Fは熱流束、αは線膨張係数、ρ
は密度、Cは比熱、λは熱伝導率である。このFαρC
/λの小さな材料を選べば、Hcが小さいことが数値解
析により判明した。図中では、窒化ケイ素が最もHcが
小さく、0.59μmであることがわかる。この場合の
形状は、図3に示すものであり、温度は25℃である。
尚、その他の材質の例が図6に示されており、従来材質
であるSKS−3は1.83μm、フォルステライトは
3.59μmである。このように、本発明によれば、F
αρC/λの小さな材質を選択すれば、Hcが小さくな
り、たとえば、窒化ケイ素を用いればHcが0.59μ
mに向上する。Embodiment 3 A third embodiment of the present invention will be described with reference to FIG . FIG. 6 shows the relationship between FαρC / λ and Hc for the stage material. Here, F is the heat flux, α is the linear expansion coefficient, ρ
Is density, C is specific heat, and λ is thermal conductivity. This FαρC
It was found by numerical analysis that Hc was small when a material having a small / λ was selected. In the figure, it can be seen that silicon nitride has the smallest Hc of 0.59 μm. The shape in this case is as shown in FIG. 3, and the temperature is 25 ° C.
An example of another material is shown in FIG. 6 , and the conventional material SKS-3 is 1.83 μm, and forsterite is 3.59 μm. Thus, according to the present invention, F
If a material having a small αρC / λ is selected , Hc becomes small. For example, when silicon nitride is used, Hc becomes 0.59 μm.
m.
【0014】実施例4.上記実施例1〜3ではステージ
材を同一材質で図3の形状のものについて示したが、ス
テージにヒートシンク部を設け反り量を少くする構造を
採用しても同様の効果が得られる。Embodiment 4 FIG. In the first to third embodiments, the stage material is made of the same material and has the shape shown in FIG. 3, but the same effect can be obtained by adopting a structure in which the stage is provided with a heat sink to reduce the amount of warpage.
【0015】[0015]
【発明の効果】以上のように、本発明によればHcのば
らつきを小さくすることが可能となり、隣接バンプの接
触やバンプ下地破壊という不良が発生しにくくなる。As described above, according to the present invention, variation in Hc can be reduced, and defects such as contact between adjacent bumps and breakage of the under bump are less likely to occur.
【図1】本発明の実施例の1つである、ステージ温度を
昇温する場合のボンディング前後の温度分布概略図FIG. 1 is a schematic diagram of a temperature distribution before and after bonding when a stage temperature is raised, which is one of embodiments of the present invention.
【図2】従来の、ステージ温度を昇温しない場合の、ボ
ンディング前後の温度分布概略図FIG. 2 is a schematic diagram of a conventional temperature distribution before and after bonding when the stage temperature is not raised.
【図3】本発明の実施例の1つである、ステージ形状を
30mmφ、10mmtにした場合のステージ外観概略図FIG. 3 is a schematic external view of a stage when one of the embodiments of the present invention has a stage shape of 30 mmφ and 10 mmt.
【図4】従来の、ステージ形状外観概略図FIG. 4 is a schematic view of a conventional stage appearance.
【図5】図3(a)(b)のボンディング直後の温度分
布と変形を示す図FIG. 5 is a diagram showing a temperature distribution and deformation immediately after bonding in FIGS. 3 (a) and 3 (b).
【図6】FαρC/λとHcの関係を示す図FIG. 6 is a diagram showing a relationship between FαρC / λ and Hc.
【図7】TAB法によって実装された半導体チップを示
す斜視図FIG. 7 is a perspective view showing a semiconductor chip mounted by a TAB method.
【図8】Hcのばらつきが生じる理由を示す概略図FIG. 8 is a schematic diagram showing the reason why variation in Hc occurs.
1 半導体チップ 2 突起電極 3 リード 4 ボンディング・ステージ 5 ボンディング・ツール DESCRIPTION OF SYMBOLS 1 Semiconductor chip 2 Protruding electrode 3 Lead 4 Bonding stage 5 Bonding tool
───────────────────────────────────────────────────── フロントページの続き (72)発明者 安永 雅敏 伊丹市瑞原4丁目1番地 三菱電機株式 会社 エル・エス・アイ研究所内 (56)参考文献 特開 平4−171739(JP,A) 特開 平3−206635(JP,A) 実開 昭63−112339(JP,U) (58)調査した分野(Int.Cl.7,DB名) H01L 21/60 ──────────────────────────────────────────────────続 き Continuing from the front page (72) Inventor Masatoshi Yasunaga 4-1-1 Mizuhara, Itami City Mitsubishi Electric Corporation In-LSE Research Institute (56) References JP-A-4-171739 (JP, A) Hei 3-206635 (JP, A) Japanese Utility Model 63-112339 (JP, U) (58) Field surveyed (Int. Cl. 7 , DB name) H01L 21/60
Claims (1)
ィングステージ上に載置し、リードを前記突起電極上に
重なるように配置した状態で、所定の温度に加熱された
ボンディングツールによって重ね合わされた前記リード
と前記突起電極とを加圧することによってリードと突起
電極とを圧着するボンディング装置において、 前記ボンディングステージは、直径30mm以上で、厚
さが10mm以上の円柱形状を有し、FαρC/λ[単
位:cal/(℃・mm 4 )]がSKS−3のそれよりも小さい
材料で形成されていることを特徴とする、半導体装置の
ボンディング装置。ここで、αは線膨張係数[1/
℃]、ρは密度[gr/mm 3 ],Cは比熱[cal/(gr・
℃)]、λは熱伝導率[cal/(mm・s・℃)]である。ま
た、Fは次の場合の熱流束[cal/(mm 2 ・s)]である。
25℃のボンディングステージの上に半導体チップを載
せて、実装用のテープのリードをその半導体チップに圧
着するために500℃のボンディングツールでボンディ
ングステージ側に押し付けたとき、半導体チップを介し
てボンディングステージに流入する、単位面積[mm 2 ]
当り、単位時間[s]当りの熱流束[cal/(mm 2 ・s)]
である。 1. A placing a semiconductor chip having a protruding electrode on the bonding stage, while arranged so as to overlap the lead on the projecting electrodes, the lead superimposed by a bonding tool which is heated to a predetermined temperature The bonding stage has a columnar shape with a diameter of 30 mm or more and a thickness of 10 mm or more, and a FαρC / λ [unit].
Order: cal / (° C.mm 4 )] is smaller than that of SKS-3
A bonding device for a semiconductor device , wherein the bonding device is formed of a material . Here, α is a coefficient of linear expansion [1 /
° C], ρ is density [gr / mm 3 ], C is specific heat [cal / (gr ·
° C)] and λ is the thermal conductivity [cal / (mm · s · ° C)]. Ma
F is the heat flux [cal / (mm 2 · s)] in the following case.
Place semiconductor chip on bonding stage at 25 ℃
Press the leads of the mounting tape onto the semiconductor chip.
Bonding with 500 ° C bonding tool
When pressed against the moving stage side,
Unit area [mm 2 ] flowing into the bonding stage
Heat flux per unit time [s] [cal / (mm 2 · s)]
It is.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4118739A JP3041318B2 (en) | 1992-05-12 | 1992-05-12 | Semiconductor device bonding equipment |
Applications Claiming Priority (1)
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JP4118739A JP3041318B2 (en) | 1992-05-12 | 1992-05-12 | Semiconductor device bonding equipment |
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JPH06177215A JPH06177215A (en) | 1994-06-24 |
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JP2001127102A (en) * | 1999-10-25 | 2001-05-11 | Sony Corp | Semiconductor device and manufacturing method thereof |
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- 1992-05-12 JP JP4118739A patent/JP3041318B2/en not_active Expired - Fee Related
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