JP2902169B2 - Electric circuit of CCD information bus - Google Patents
Electric circuit of CCD information busInfo
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Description
【０００１】[0001]
【産業上の利用分野】本発明はＣＣＤ（電荷結合素子）
情報バスの電気回路に関し、特に一個の出力ポートで多
数の伝送線に対して情報を伝送し得るＣＣＤ情報バスの
電気回路に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a CCD (charge coupled device).
The present invention relates to an electric circuit of an information bus, and more particularly to an electric circuit of a CCD information bus capable of transmitting information to a large number of transmission lines with one output port.
【０００２】[0002]
【従来の技術】一般の線形カラー映像センサーは、普通
同一ＣＣＤセンサーに多数のＣＣＤセンサーを形成し
て、それぞれ赤、ブルー、グリーンなどの光信号を検出
して伝送する。このような製品の典型として、例えば日
本の東芝が提供するＴＣＤ１４０ＣのＣＣＤ線形映像セ
ンサー等が挙げられる。この種線形カラーＣＣＤは高分
解能の要求に応じて、異なる光信号に対応してそれぞれ
を異なる伝送線で出力ポートに送るのであり、その応用
と効果は図３，図４の図示から了解できる。2. Description of the Related Art In general, a linear color image sensor generally forms a plurality of CCD sensors on the same CCD sensor, and detects and transmits red, blue, green, and other light signals, respectively. A typical example of such a product is a CCD linear image sensor of TCD140C provided by Toshiba of Japan. This kind of linear color CCD sends different output signals to the output ports in response to different optical signals in response to a demand for high resolution, and its application and effects can be understood from the illustrations of FIGS.
【０００３】図３は、従来の線形カラーＣＣＤを示す図
で、そのうち、それぞれ異なる光信号を検出するセンサ
ー・ユニットＳ１，Ｓ２及びＳ３は、通常一次元マトリ
クスのものであって、それぞれセンサー・ユニットに二
本の伝送線を設けて合計六本の伝送線Ｃ１，Ｃ２，Ｃ
３，Ｃ４，Ｃ５及びＣ６を備えており、順に光信号を出
力ポートに伝送するため、その出力ポートは六つ（０１
〜０６）もある。FIG. 3 is a view showing a conventional linear color CCD. Among them, sensor units S1, S2 and S3 for detecting different light signals are usually one-dimensional matrices, and are each a sensor unit. Are provided with two transmission lines, and a total of six transmission lines C1, C2, C
3, C4, C5, and C6, and sequentially transmits the optical signals to the output ports.
To 06).
【０００４】更に、図４を参照して図３のカラー線形Ｃ
ＣＤにおけるそれぞれ出力線のクロックと動作について
説明する。現在の線形カラーＣＣＤは２個のクロック信
号を採用してＣＣＤ伝送線とし、そのうちφ１Ａ，φ１
Ｂは伝送線Ｃ１，Ｃ２に使用され、同様な理屈からφ２
Ａ，φ２Ｂ，φ３Ａ，φ３ＢはそれぞれＣ３，Ｃ４，Ｃ
５及びＣ６のＣＣＤ伝送線に使われ、φ１Ａ，φ２Ａ，
φ３Ａは同期に、かつφ１Ｂ，φ２Ｂ，φ３Ｂも同期で
はあるが、該φ１Ａなどとは逆に作動する。例えば、図
４の（ａ）（ｂ）に示す光信号０１，０３，０５は同
期、０２，０４，０６も同期に出力されるのであるが、
ｔ２時間内に回ＣＣＤシステムは必ず３つのカラーの出
力信号を処理しなけはならず、一方，ｔ１時間内にはシ
ステムに必要な出力信号が無く、従って、ｔ２時間中で
はシステムは極めて忙しく、ｔ１時間内ではシステムは
信号を待つような現象が生じて、システムの信号処理に
不規則を形成するばかりでなく、同時に３つの出力信号
を処理しなければならない困難や不便があって、システ
ムの電気回路を複雑化し、或いは後続のコンピュータ処
理において、時分割を使用して処理するのが比較的難し
くなり、情報処理に困難をもたらす。Further, referring to FIG. 4, the color linear C of FIG.
The clock and operation of each output line in the CD will be described. The current linear color CCD adopts two clock signals to form a CCD transmission line, of which φ1A, φ1
B is used for the transmission lines C1 and C2.
A, φ2B, φ3A, φ3B are C3, C4, C
5 and C6 CCD transmission lines, φ1A, φ2A,
φ3A operates synchronously and φ1B, φ2B, and φ3B operate synchronously, but operates in reverse to φ1A and the like. For example, the optical signals 01, 03, and 05 shown in FIGS. 4A and 4B are output synchronously, and 02, 04, and 06 are output synchronously.
At time t2, the CCD system must always process the output signals of the three colors, while at time t1 there is no output signal required by the system, so at time t2 the system is very busy, During the time t1, the system waits for a signal, causing not only irregularities in the signal processing of the system but also difficulties and inconveniences in processing three output signals at the same time. The complexity of the electrical circuit or the subsequent computer processing becomes relatively difficult to process using time division, which leads to difficulties in information processing.
【０００５】尚、図４におけるＲ1 …Ｒ6 はそれぞれリ
セットクロックである。[0005] Incidentally, R 1 ... R 6 in FIG. 4 is a reset clock, respectively.
【０００６】[0006]
【発明が解決しようとする課題】上記従来の線形カラー
ＣＣＤにおける問題点に鑑み、この発明は、現有のＣＣ
Ｄ集積回路（ＩＣ）製造過程を利用し、単一の出力ポー
トを備えて多数のＣＣＤ伝送線を作り得るＣＣＤ情報バ
スの伝送方法及びその電気回路を提供することを目的と
する。SUMMARY OF THE INVENTION In view of the above-mentioned problems in the conventional linear color CCD, the present invention relates to an existing CC.
It is an object of the present invention to provide a method of transmitting a CCD information bus and a circuit thereof using a D integrated circuit (IC) manufacturing process and having a single output port to form a large number of CCD transmission lines.
【０００７】[0007]
【課題を解決するための手段】それ故、上記目的は、予
め異なるセンサー・ユニットの伝送線のクロックに、 単
一の出力伝送線にシリアルに規則正しく整列された出力
を得るために、それぞれ６０°の位相差を付けるよう構
成され、上記クロックの周波数の６倍以上の頻度をもつ
クロックを備えた単一の出力伝送線に伝送するようにし
てなり、該異なるセンサー・ユニットの数は３であり、
これらのセンサー・ユニットのそれぞれの両側に２つづ
つ前記伝送線を設けてなるＣＣＤ情報バスの電気回路に
より達成される。 SUMMARY OF THE INVENTION Therefore, the above-mentioned object is
The clock of the transmission line of the eye different sensor unit, single
Outputs serially and regularly aligned on one output transmission line
To obtain a phase difference of 60 °.
And has a frequency of at least 6 times the frequency of the clock
Transmit on a single output transmission line with a clock
And the number of said different sensor units is three,
Two on each side of each of these sensor units
In the electric circuit of the CCD information bus provided with the transmission line
More achieved.
【０００８】[0008]
【作用】上記のように構成された、本発明は、バス伝送
線のクロックパルスを、伝送前の各クロックの６倍以上
に設計されているので、該出力ポートから順に出力され
る信号は、即ち該単一の伝送線のクロック出力に対応す
るのであり、従って、システムのハードウェアを簡単化
し、その出力時間は規則的周期性を有することができ
る。According to the present invention configured as described above, the clock pulse of the bus transmission line is designed to be six times or more of each clock before transmission, so that the signals sequentially output from the output port are: That is, it corresponds to the clock output of the single transmission line, thus simplifying the hardware of the system, and its output time can have a regular periodicity.
【０００９】本発明の上記またはその他の目的、特徴お
よび利点は、図面を参照しての以下の実施例の詳細な説
明から一層明らかとなろう。The above and other objects, features and advantages of the present invention will become more apparent from the following detailed description of embodiments with reference to the drawings.
【００１０】[0010]
【実施例】図１は、本発明を応用した線形カラーＣＣＤ
を示す図で、図２における（ａ）−（ｆ）はその伝送線
のクロックを示す図である。図１において、上記図３に
示した従来の線形カラーＣＣＤと同様な機能を備えた部
分は、対照比較して容易に了解できるよう、みな同じ符
号で示す。本発明のＣＣＤは単一の出力伝送線Ｃ７を備
え、その際のクロックはφＴＡ，φＴＢで、システム中
において単一の出力ポート０Ｔに対応する。そして、図
２を参照すれば、そのうちの（ａ）（ｂ）（ｃ）に示す
φ１Ａ，φ２Ａ，φ３Ａはそれぞれクロック信号波形を
表わし、この実施例では、その位相差は１８０度／３＝
６０度であり、バス伝送線Ｃ７のクロックパルスは、図
２の（ｄ）に示すように、伝送前の各クロックの６倍に
設計され、それ故、該出力ポート０Ｔから順に出力され
る信号は、該単一の出力伝送線Ｃ７のクロック出力に対
応するのであり、その信号の出力順序は、図２の（ｅ）
に示すように、０１，０３，０５，０２，０４，０６の
順である。従って、このように単一の出力ポートを応用
して出力することは、システムのハードウェアを簡単化
し、その０１から０６に至る出力時間は規則的周期性を
有して、システムが比較的高い頻度で作動し効率を向上
することができる。尚、図２におけるＲはリセットクロ
ックである。1 shows a linear color CCD to which the present invention is applied.
FIG. 2A to FIG. 2F are diagrams showing clocks of the transmission line. In FIG. 1, portions having functions similar to those of the conventional linear color CCD shown in FIG. 3 are denoted by the same reference numerals so that they can be easily understood by comparison. The CCD of the present invention includes a single output transmission line C7, and the clocks at that time are φTA and φTB, which correspond to a single output port 0T in the system. Referring to FIG. 2, φ1A, φ2A, and φ3A shown in (a), (b), and (c) represent clock signal waveforms, respectively. In this embodiment, the phase difference is 180 degrees / 3 =
The clock pulse of the bus transmission line C7 is designed to be six times as large as each clock before transmission, as shown in FIG. Corresponds to the clock output of the single output transmission line C7, and the output order of the signals is shown in FIG.
, The order is 01, 03, 05, 02, 04, 06. Thus, applying a single output port for output simplifies the hardware of the system, and the output time from 01 to 06 has a regular periodicity, so that the system is relatively high. It can operate frequently and improve efficiency. Note that R in FIG. 2 is a reset clock.
【００１１】[0011]
【発明の効果】本発明は、上記のように、バス伝送線の
クロックパルスを、伝送前の各クロックの６倍以上に設
計しているので、該出力ポートから順に出力される信号
は、即ち該単一の伝送線のクロック出力に対応するとな
り、従って、システムのハードウェアを簡単化し、その
出力時間は秩序ある周期性規律で出力すると共に、シス
テムが比較的高い頻度で作動し効率を向上することがで
きる。According to the present invention, as described above, the clock pulse of the bus transmission line is designed to be six times or more of each clock before transmission, so that the signals sequentially output from the output port are: It will correspond to the clock output of the single transmission line, thus simplifying the hardware of the system, the output time is output in an orderly periodic discipline, and the system operates relatively frequently to improve the efficiency can do.
【図１】本発明のバス伝送線を備えたＣＣＤの構造表示
図である。FIG. 1 is a diagram showing the structure of a CCD having a bus transmission line according to the present invention.
【図２】本発明のバス伝送線を備えたＣＣＤの伝送線ク
ロック及び出力信号の波形説明図である。FIG. 2 is an explanatory diagram of waveforms of a transmission line clock and an output signal of a CCD having a bus transmission line according to the present invention.
【図３】従来の線形カラーＣＣＤの構造表示図である。FIG. 3 is a diagram showing the structure of a conventional linear color CCD.
【図４】従来の線形カラーＣＣＤの伝送線のクロック波
形説明図である。FIG. 4 is an explanatory diagram of a clock waveform of a transmission line of a conventional linear color CCD.
Ｓ１，Ｓ２，Ｓ３ センサー・ユニット φ１Ａ，φ１Ｂ，φ２Ａ，φ２Ｂ，φ３Ａ，φ３Ｂ ク
ロック Ｃ１，Ｃ２，Ｃ３，Ｃ４，Ｃ５，Ｃ６ 伝送線S1, S2, S3 Sensor unit φ1A, φ1B, φ2A, φ2B, φ3A, φ3B Clock C1, C2, C3, C4, C5, C6 Transmission line
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平１−258568（ＪＰ，Ａ) 特開 昭61−294962（ＪＰ，Ａ) 特開 昭55−162174（ＪＰ，Ａ) (58)調査した分野(Int.Cl.6，ＤＢ名) H04N 1/028 H04N 5/338 ────────────────────────────────────────────────── ─── Continuation of front page (56) References JP-A-1-258568 (JP, A) JP-A-61-294962 (JP, A) JP-A-55-162174 (JP, A) (58) Field (Int.Cl. 6 , DB name) H04N 1/028 H04N 5/338
Claims (1)
Ｓ２，Ｓ３）の伝送線（Ｃ１，Ｃ２，Ｃ３，Ｃ４，Ｃ
５，Ｃ６）のクロック（φ１Ａ，φ１Ｂ，φ２Ａ，φ２
Ｂ，φ３Ａ，φ３Ｂ）に、単一の出力伝送線にシリアル
に規則正しく整列された出力を得るために、それぞれ６
０°の位相差を付けるよう構成され、上記クロック（φ
１Ａ）の周波数の６倍以上の頻度をもつクロック（φＴ
Ａ，φＴＢ）を備えた単一の出力伝送線に伝送するよう
にしてなり、該異なるセンサー・ユニット（Ｓ１，Ｓ
２，Ｓ３）の数は３であり、これらのセンサー・ユニッ
トのそれぞれの両側に２つづつ前記伝送線を設けてなる
ＣＣＤ情報バスの電気回路。1. A different sensor unit (S1,
S2, S3) transmission line (C1, C2, C3, C4, C
5, C6) clocks (φ1A, φ1B, φ2A, φ2
B, φ3A, φ3B) , serial to a single output transmission line
To obtain a regularly ordered output
A phase difference of 0 ° is provided , and the clock (φ
1A) having a frequency six times or more the frequency (φT
A, φTB) to a single output transmission line with the different sensor units (S1, STB).
2, S3) is 3, the CCD information bus electric circuit comprising two transmission lines on each side of each of these sensor units.
Priority Applications (1)
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|---|---|---|---|
| JP3234349A JP2902169B2 (en) | 1991-09-13 | 1991-09-13 | Electric circuit of CCD information bus |
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|---|---|---|---|
| JP3234349A JP2902169B2 (en) | 1991-09-13 | 1991-09-13 | Electric circuit of CCD information bus |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0646197A JPH0646197A (en) | 1994-02-18 |
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1991
- 1991-09-13 JP JP3234349A patent/JP2902169B2/en not_active Expired - Fee Related
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