JP2883884B2 - Switching circuit - Google Patents

Switching circuit

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JP2883884B2 JP8272520A JP27252096A JP2883884B2 JP 2883884 B2 JP2883884 B2 JP 2883884B2 JP 8272520 A JP8272520 A JP 8272520A JP 27252096 A JP27252096 A JP 27252096A JP 2883884 B2 JP2883884 B2 JP 2883884B2
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Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は、複数のシンセサイ
ザ回路からの信号を切り換えて出力するスイッチング回
路に関するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a switching circuit for switching and outputting signals from a plurality of synthesizer circuits.

【0002】[0002]

【従来の技術】シンセサイザによって発生した異なる2
種の周波数の信号を切り換え、いずれか一方の周波数の
信号を出力し、高速に周波数を切り換えるためのスイッ
チング回路がある。
2. Description of the Related Art There are two different
There is a switching circuit for switching a signal of a certain frequency, outputting a signal of one of the frequencies, and rapidly switching the frequency.

【0003】従来、この2種の異なる周波数の信号を切
り換えるスイッチング回路として、PINダイオードを
用いて切り換える方法と、図5に示すベース接地の3段
の回路の電源をON/OFFして切り換える回路があ
る。
Conventionally, as a switching circuit for switching between these two kinds of signals having different frequencies, a switching method using a PIN diode and a circuit for switching ON / OFF the power supply of a three-stage circuit with a grounded base shown in FIG. is there.

【0004】[0004]

【発明が解決しようとする課題】前者のトランジスタに
よりアンプ部を構成し、PINダイオードでスイッチ部
を構成した場合には、部品点数および回路が複雑になっ
てしまうと共に、スイッチング時間が長く(例えば実験
によれば12μs位と長く)なってしまうという問題が
あった。
In the case where the amplifier section is constituted by the former transistor and the switch section is constituted by the PIN diode, the number of components and the circuit become complicated, and the switching time becomes long (for example, in an experiment). According to this, there is a problem that the length is as long as about 12 μs).

【0005】また、後者の図5に示すベース接地の3段
の回路の電源をON/OFFして切り換える回路の場合
には、図6に示すようにスイッチング時間が例えば13
1.1μsと極めて遅いという問題があった。
[0005] In the case of the latter circuit in which the power supply of the three-stage circuit with the grounded base shown in FIG.
There was a problem that it was extremely slow at 1.1 μs.

【0006】図5は、従来回路例(ベース接地)を示
す。これは、シンセサイザからの信号を第1段のベース
接地の回路で受け、第2段および第3段のベース接地の
回路で増幅し、第1段の回路、第2段の回路および第3
段の回路の各トランジスタの電源をON/OFFしてス
イッチングする回路である。
FIG. 5 shows an example of a conventional circuit (grounded base). This is because a signal from the synthesizer is received by a first-stage grounded base circuit, amplified by second-stage and third-stage grounded base circuits, and is amplified by a first-stage circuit, a second-stage circuit, and a third-stage circuit.
This is a circuit for switching by turning on / off the power supply of each transistor in the circuit of the stage.

【0007】本発明は、これらの問題を解決するため、
アンブ部およびスイッチング回路をトランジスタのベー
ス接地およびエミッタ接地により構成し、回路の簡素化
および電気的特性の向上を図ることを目的としている。
[0007] The present invention solves these problems,
It is an object of the present invention to simplify the circuit and improve the electrical characteristics by forming the umbrella section and the switching circuit with the base ground and the emitter ground of the transistor.

【0008】[0008]

【課題を解決するための手段】図1を参照して課題を解
決するための手段を説明する。図1において、第1の回
路1は、エミッタ接地のトランジスタのベースで受信す
ると共に当該トランジスタのコレクタに電源を供給ある
いは遮断する回路からなるものである。
Means for solving the problem will be described with reference to FIG. In FIG. 1, a first circuit 1 is a circuit that receives a signal at the base of a transistor whose emitter is grounded and supplies or cuts off power to the collector of the transistor.

【0009】第2の回路2は、ベース接地のトランジス
タのエミッタで受信すると共に当該トランジスタのコレ
クタに電源を供給あるいは遮断する回路からなるもので
ある。
The second circuit 2 comprises a circuit that receives the signal at the emitter of the transistor whose base is grounded and supplies or cuts off the power to the collector of the transistor.

【0010】第3の回路3は、ベース接地のトランジス
タのエミッタで受信すると共に当該トランジスタのコレ
クタに電源を供給あるいは遮断する回路からなるもので
ある。
The third circuit 3 comprises a circuit that receives the signal at the emitter of the transistor whose base is grounded and supplies or cuts off the power to the collector of the transistor.

【0011】シンセサイザ回路4は、所定の高周波信号
を発生する回路である。次に、回路構成を説明する。第
1の回路1がシンセサイザ回路4からの信号をエミッタ
接地のトランジスタのベースで受信すると共に当該トラ
ンジスタのコレクタに電源を供給あるいは遮断する回路
からなり、第2の回路2が第1の回路のエミッタ接地の
トランジスタのコレクタからの出力信号をベース接地の
トランジスタのエミッタで受信すると共に当該トランジ
スタのコレクタに電源を供給あるいは遮断する回路から
なり、第3の回路3が第2の回路のコレクタからの出力
信号をベース接地のトランジスタのエミッタで受信する
と共に当該トランジスタのコレクタに電源を供給あるい
は遮断する回路からなり、第3の回路3がシンセサイザ
回路4からの信号を出力するようにしている。
The synthesizer circuit 4 is a circuit for generating a predetermined high-frequency signal. Next, the circuit configuration will be described. The first circuit 1 comprises a circuit for receiving a signal from the synthesizer circuit 4 at the base of a transistor having a common emitter and supplying or cutting off power to the collector of the transistor. The second circuit 2 comprises an emitter of the first circuit. A third circuit 3 receives a signal output from the collector of the grounded transistor at the emitter of the transistor grounded at the base and supplies or cuts off power to the collector of the transistor. The third circuit 3 outputs the signal from the collector of the second circuit. A signal is received by the emitter of the transistor whose base is grounded, and a circuit for supplying or interrupting power to the collector of the transistor is provided. The third circuit 3 outputs a signal from the synthesizer circuit 4.

【0012】この際、シンセサイザ回路4と第1の回路
1のエミッタ接地のトランジスタのベースとの間に電流
制限用の抵抗Rを直列に入れ、当該シンセサイザ回路4
への負荷の影響を少なくするようにしている。
At this time, a resistor R for limiting current is inserted in series between the synthesizer circuit 4 and the base of the transistor whose emitter is grounded in the first circuit 1.
To reduce the impact of the load.

【0013】また、第1の回路1、第2の回路2、第3
の回路3を2組み設けて当該第3の回路の出力端を接続
し、2つのシンセサイザ回路4からの信号を高速に切り
換えて出力するようにしている。
The first circuit 1, the second circuit 2, the third circuit
Are connected to the output terminals of the third circuit, and the signals from the two synthesizer circuits 4 are switched and output at high speed.

【0014】また、第1の回路、第2の回路、第3の回
路を全てトランジスタで構成するようにしている。従っ
て、アンブ部およびスイッチング回路をトランジスタの
ベース接地およびエミッタ接地により構成し、回路の簡
素化および電気的特性の向上を図ることができ、実験例
では2.22μsの従来回路では得られない高速切り換
えを実現すると共にスイッチングON/OFF比が−8
2.33dBと極めて良好な値を得ることができた。
Further, the first circuit, the second circuit, and the third circuit are all constituted by transistors. Therefore, the umbrella section and the switching circuit are configured by the common base and the common emitter of the transistor, so that the circuit can be simplified and the electrical characteristics can be improved. And the switching ON / OFF ratio is -8.
An extremely good value of 2.33 dB was obtained.

【0015】[0015]

【発明の実施の形態】次に、図1から図4を用いて本発
明の実施の形態および動作を順次詳細に説明する。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS Next, embodiments and operations of the present invention will be sequentially described in detail with reference to FIGS.

【0016】図1は、本発明の1実施例回路図を示す。
図1において、第1の回路1は、シンセサイザ回路4か
らの信号を受信し、次の第2の回路2に伝送したり、遮
断したりする回路であって、図示のように、エミッタ接
地のトランジスタのベースで受信すると共に当該トラン
ジスタのコレクタに電源を供給あるいは遮断する回路か
らなるものである。図示のSW端子にスイッチング信号
のON/OFFを印加してエミッタ接地のトランジスタ
のコレクタに電源を供給したり、遮断したりするように
している。エミッタ接地でシンセサイザ回路4からの信
号を受信するために入力インピーダンスが大きくなり、
しかも直列に抵抗Rを挿入しても十分に動作し、これら
が相まってエミッタ接地のトランジスタの負荷が変動し
ても入力側のシンセサイザ回路4への影響を極めて小さ
くできる。
FIG. 1 is a circuit diagram showing one embodiment of the present invention.
In FIG. 1, a first circuit 1 is a circuit for receiving a signal from a synthesizer circuit 4, transmitting the signal to a next second circuit 2, or cutting off the signal, and as shown in FIG. It comprises a circuit that receives at the base of a transistor and supplies or cuts off power to the collector of the transistor. The ON / OFF of the switching signal is applied to the illustrated SW terminal to supply or cut off power to the collector of the transistor whose emitter is grounded. In order to receive the signal from the synthesizer circuit 4 with the emitter grounded, the input impedance increases,
In addition, even if the resistor R is inserted in series, the circuit operates sufficiently, and even if the load of the transistor having the common emitter fluctuates, the influence on the synthesizer circuit 4 on the input side can be extremely reduced.

【0017】第2の回路2は、第1の回路1のトランジ
スタのコレクタからの出力信号を受信し、増幅して出力
する回路であって、第1の回路のエミッタ接地のトラン
ジスタのコレクタからの出力信号をベース接地のトラン
ジスタのエミッタで受信すると共に当該トランジスタの
コレクタに電源を供給あるいは遮断する回路からなるも
のである。
The second circuit 2 receives, amplifies and outputs an output signal from the collector of the transistor of the first circuit 1, and outputs the amplified signal. The second circuit 2 receives the output signal from the collector of the common-emitter transistor of the first circuit. An output signal is received by an emitter of a transistor whose base is grounded, and a circuit for supplying or interrupting power to the collector of the transistor is provided.

【0018】第3の回路3は、第2の回路2のトランジ
スタのコクレタからの出力信号を受信し、増幅して出力
する回路であって、第2の回路のコレクタからの出力信
号をベース接地のトランジスタのエミッタで受信すると
共に当該トランジスタのコレクタに電源を供給あるいは
遮断する回路からなるものである。
The third circuit 3 receives, amplifies, and outputs an output signal from the collector of the transistor of the second circuit 2, and outputs the output signal from the collector of the second circuit 2 to the grounded base. And a circuit for supplying or cutting off power to the collector of the transistor while receiving at the emitter of the transistor.

【0019】シンセサイザ回路4は、所定の高周波信号
を発振する回路であって、例えば1.669500GH
zの高周波信号を発振する回路であって、所定周波数間
隔で順次発振する回路(シンセサイザ回路)である。こ
こでは、2つのシンセサイザ回路4を用い、両者を交互
に切り換えて高速に所定周波数間隔の高周波信号を出力
するようにしている。
The synthesizer circuit 4 is a circuit for oscillating a predetermined high-frequency signal, and is, for example, 1.669500 GHz
A circuit that oscillates a high-frequency signal of z and that oscillates sequentially at predetermined frequency intervals (synthesizer circuit). Here, two synthesizer circuits 4 are used, and the two are alternately switched to output a high-frequency signal at a predetermined frequency interval at high speed.

【0020】以上のように、シンセサイザ回路4からの
入力段を第1の回路1のエミッタ接地とし、入力インピ
ーダンスを高くしシンセサイザ回路4への負荷変動など
の影響を最小限にし切り替え時に安定な高周波信号を得
ることができ、しかも、第2の回路2および第3の回路
3をベース接地とし、スイッチングON/OFF比を大
きく、かつシンセサイザ回路4間のアイソレーション特
性を向上させることができる(図2ないし図4を用いて
後述する)。
As described above, the input stage from the synthesizer circuit 4 is connected to the grounded emitter of the first circuit 1, the input impedance is increased, the influence of load fluctuation on the synthesizer circuit 4 is minimized, and the stable high frequency is used when switching. A signal can be obtained, and the second circuit 2 and the third circuit 3 are grounded at the base, so that the switching ON / OFF ratio is large and the isolation characteristics between the synthesizer circuits 4 can be improved (FIG. 2 to 4 will be described later).

【0021】図2は、本発明のスイッチングON/OF
F比測定例を示す。このスイッチングON/OFF比測
定例は、図1のシンセサイザ回路4のうちの1つ(PL
L1)のみのSWにONあるいはOFF信号を供給した
とき、即ち第1の回路1のエミッタ接地のトランジスタ
のコレクタに供給する電源をONあるいはOFFにした
ときのOUTから出力される信号の出力比を測定したも
のである。図示のようにスイッチングON/OFF比測
定の値は、ここでは、−82.33dBの値が得られ
た。そのときの条件は図示の下記である。
FIG. 2 shows the switching ON / OF of the present invention.
The example of F ratio measurement is shown. This switching ON / OFF ratio measurement example is based on one of the synthesizer circuits 4 (PL
L1) when the ON or OFF signal is supplied to the SW, that is, when the power supply to the collector of the transistor with the common emitter of the first circuit 1 is turned ON or OFF, the output ratio of the signal output from OUT is determined. Measured. As shown in the figure, the value of the switching ON / OFF ratio measurement obtained here is a value of -82.33 dB. The conditions at that time are as shown below.

【0022】 ・CENTER周波数:1.669500GHz ・SPAN :2.000MHz ・RBW :10KHz ・VBW :100Hz ・SWP :5.0sec 以上のように、図1の回路構成で第1の回路の電源をO
N/OFFしたときのスイッチングON/OFF比は、
−82.33dBと極めて良い値が得られた。
· CENTER frequency: 1.669500 GHz · SPAN: 2.000 MHz · RBW: 10 kHz · VBW: 100 Hz · SWP: 5.0 sec As described above, the power supply of the first circuit in the circuit configuration of FIG.
Switching ON / OFF ratio when N / OFF is
An extremely good value of -82.33 dB was obtained.

【0023】図3は、本発明の実測例(エミッタ接地、
その1)を示す。これは、図1の回路において、図示の
f=1.66950GHzの周波数で、チャネル切り換
え時間(f Span 80KHz)2.44μsと測
定されたときの測定画面のコピーである。このように図
1の回路のチャネル切り換え時間は2.44μsと、従
来のピンダイオードのチャネル切り換え時間12μsに
比し、チャネルを切り換えたときに極めて高速に安定な
信号を得ることができると判明した。
FIG. 3 shows an actual measurement example (grounded emitter,
The 1) is shown. This is a copy of the measurement screen when the channel switching time (f Span 80 KHz) is measured at 2.44 μs at the illustrated frequency of f = 1.66950 GHz in the circuit of FIG. Thus, it has been found that the channel switching time of the circuit of FIG. 1 is 2.44 μs, and a stable signal can be obtained at a very high speed when the channel is switched, compared to the channel switching time of the conventional pin diode of 12 μs. .

【0024】図4は、本発明の実測例(エミッタ接地、
その2)を示す。これは、図1の回路において、図示の
f=1.66950GHzの周波数で、チャネル切り換
え時間(f Span 20KHz)2.22μsと測
定されたときの測定画面のコピーである。このように図
1の回路のチャネル切り換え時間は2.22μsと、従
来のピンダイオードのチャネル切り換え時間12μsに
比し、チャネルを切り換えたときに極めて高速に安定な
信号を得ることができると判明した。
FIG. 4 shows a measurement example of the present invention (common emitter,
The 2) is shown. This is a copy of the measurement screen when the channel switching time (f Span 20 KHz) is measured to be 2.22 μs at the illustrated frequency of f = 1.66950 GHz in the circuit of FIG. 1. As described above, it has been found that the channel switching time of the circuit of FIG. 1 is 2.22 μs, and a stable signal can be obtained at a very high speed when the channel is switched, as compared with the channel switching time of the conventional pin diode of 12 μs. .

【0025】[0025]

【発明の効果】以上説明したように、本発明によれば、
アンブ部およびスイッチング回路をトランジスタのベー
ス接地およびエミッタ接地により回路を構成しているた
め、高周波信号を極めて高速に切り換えることができ、
しかもスイッチングON/OFF比を大きくしたスイッ
チング回路を実現できた。実験例によれば、図1の回路
構成で1.66950GHzの周波数信号のチャネルを
2.22μs(f Span 20KHz)で安定に切
り換えることができ、しかもスイッチングON/OFF
比として−82.33dBという優れた値が得られた。
As described above, according to the present invention,
Since the circuit of the amp section and the switching circuit is configured by the common ground of the transistor and the common ground of the transistor, the high-frequency signal can be switched at a very high speed,
Moreover, a switching circuit having a large switching ON / OFF ratio can be realized. According to the experimental example, the channel of the frequency signal of 1.66950 GHz can be stably switched in 2.22 μs (f Span 20 KHz) with the circuit configuration of FIG.
An excellent value of -82.33 dB was obtained.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明の1実施例回路図である。FIG. 1 is a circuit diagram of one embodiment of the present invention.

【図2】本発明のスイッチングON/OFF比測定例で
ある。
FIG. 2 is a measurement example of a switching ON / OFF ratio according to the present invention.

【図3】本発明の実測例(エミッタ接地、その1)であ
る。
FIG. 3 is a measurement example (common emitter, part 1) of the present invention.

【図4】本発明の実測例(エミッタ接地、その2)であ
る。
FIG. 4 is an actual measurement example (common emitter, part 2) of the present invention.

【図5】従来回路例(ベース接地)である。FIG. 5 is an example of a conventional circuit (grounded base).

【図6】従来回路の実測例(ベース接地、その1)であ
る。
FIG. 6 is an actual measurement example (grounded base, part 1) of a conventional circuit.

【符号の説明】[Explanation of symbols]

1:第1の回路 2:第2の回路 3:第3の回路 4:シンセサイザ回路 R:抵抗 1: first circuit 2: second circuit 3: third circuit 4: synthesizer circuit R: resistor

───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 平8−256078(JP,A) 特開 平6−164385(JP,A) 特開 平6−237169(JP,A) (58)調査した分野(Int.Cl.6,DB名) H03L 7/16 - 7/23 H03K 17/00 H03K 17/62 H01P 1/15 ────────────────────────────────────────────────── ─── Continuation of the front page (56) References JP-A-8-256078 (JP, A) JP-A-6-164385 (JP, A) JP-A-6-237169 (JP, A) (58) Survey Field (Int.Cl. 6 , DB name) H03L 7/16-7/23 H03K 17/00 H03K 17/62 H01P 1/15

Claims (4)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】複数のシンセサイザ回路からの信号を切り
換えて出力するスイッチング回路において、 シンセサイザ回路からの信号をエミッタ接地のトランジ
スタのベースで受信する第1の回路と、 この第1の回路のエミッタ接地のトランジスタのコレク
タからの出力信号をベース接地のトランジスタのエミッ
タで受信する第2の回路と、 この第2の回路のコレクタからの出力信号をベース接地
のトランジスタのエミッタで受信する第3の回路とをシ
ンセサイザ毎に設け、 上記第1の回路、上記第2の回路、上記第3の回路の各
トランジスタのコレクタに電源を供給あるいは遮断して
任意のシンセサイザ回路からの信号に切り換えて出力す
ることを特徴とするスイッチング回路。
1. A switching circuit for switching and outputting signals from a plurality of synthesizer circuits, a first circuit receiving a signal from the synthesizer circuit at a base of a transistor having a common emitter, and a common emitter of the first circuit. A second circuit for receiving the output signal from the collector of the transistor at the emitter of the common-base transistor; and a third circuit for receiving the output signal from the collector of the second circuit at the emitter of the common-base transistor. Is provided for each synthesizer, and power is supplied to or cut off from the collectors of the transistors of the first circuit, the second circuit, and the third circuit to switch to and output a signal from an arbitrary synthesizer circuit. Switching circuit characterized.
【請求項2】上記シンセサイザ回路と上記第1の回路の
エミッタ接地のトランジスタのベースとの間に電流制限
用の抵抗を直列に入れ、当該シンセサイザ回路への負荷
の影響を少なくしたことを特徴とする請求項1記載のス
イッチング回路。
2. A current limiting resistor is connected in series between the synthesizer circuit and the base of a transistor whose emitter is grounded in the first circuit to reduce the influence of a load on the synthesizer circuit. The switching circuit according to claim 1, wherein
【請求項3】上記第1の回路、上記第2の回路、上記第
3の回路を2組み設けて当該第3の回路の出力端を接続
し、2つのシンセサイザ回路からの信号を高速に切り換
えて出力することを特徴とする請求項1あるいは請求項
2記載のスイッチング回路。
3. The first circuit, the second circuit, and the third circuit are provided in two sets, the output terminals of the third circuit are connected, and the signals from the two synthesizer circuits are switched at high speed. 3. The switching circuit according to claim 1, wherein the switching circuit outputs the output.
【請求項4】上記第1の回路、上記第2の回路、上記第
3の回路を全てトランジスタで構成したことを特徴とす
る請求項1ないし請求項3記載のいずれかのスイッチン
グ回路。
4. The switching circuit according to claim 1, wherein said first circuit, said second circuit, and said third circuit are all constituted by transistors.
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