JP2729117B2 - Power saving output circuit - Google Patents
Power saving output circuitInfo
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Description
【０００１】[0001]
【産業上の利用分野】本発明は省電力出力回路に関し、
特に、ビデオ信号等を扱う信号処理回路装置の出力端に
おいて使用される省電力出力回路に関する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a power saving output circuit,
In particular, the present invention relates to a power saving output circuit used at an output terminal of a signal processing circuit device that handles video signals and the like.
【０００２】[0002]
【従来の技術】従来のビデオ信号等の信号処理装置にお
ける出力回路に含まれる出力端子および対応する前段回
路を図２に示す。図２において、前段回路は、信号処理
回路１および同軸プラグ１０に対応して、通常低インピ
ーダンスにてビデオ信号を出力するためのインピーダン
ス変換用のエミッタフォロワトランジスタ２、抵抗３、
インピーダンス整合抵抗４および結合容量５を含むエミ
ッタフォロワバッファ回路６と、簡易な断面図にて示さ
れる配線端子７、中心電極１２、絶縁体１３および接地
側電極１４を含むピンジャックとを備えて構成されてお
り、エミッタフォロワバッファ回路６の出力信号は、前
記ピンジャックの配線端子７に接続され、このピンジャ
ックは、信号取出し用の同軸プラグ１０が嵌合される。
この場合、通常は、ビデオ信号処理のインピーダンス整
合用としては７５Ωが使用されており、出力端子側より
前段回路を見たインピーダンスは７５Ωに設定される。
このため、インピーダンス整合抵抗４は７５Ωとし、エ
ミッタフォロワトランジスタ２の出力インピーダンス
は、７５Ωよりも十分小さいインピーダンスに設定され
る。2. Description of the Related Art FIG. 2 shows an output terminal included in an output circuit of a conventional signal processing apparatus for a video signal or the like and a corresponding preceding circuit. In FIG. 2, the pre-stage circuit corresponds to the signal processing circuit 1 and the coaxial plug 10, and usually has an emitter follower transistor 2 for impedance conversion for outputting a video signal with low impedance, a resistor 3,
An emitter follower buffer circuit 6 including an impedance matching resistor 4 and a coupling capacitor 5, and a pin jack including a wiring terminal 7, a center electrode 12, an insulator 13, and a ground electrode 14 shown in a simplified cross-sectional view. The output signal of the emitter follower buffer circuit 6 is connected to the wiring terminal 7 of the pin jack, and a coaxial plug 10 for extracting a signal is fitted to the pin jack.
In this case, normally, 75Ω is used for impedance matching for video signal processing, and the impedance when the preceding circuit is viewed from the output terminal side is set to 75Ω.
For this reason, the impedance matching resistor 4 is set to 75Ω, and the output impedance of the emitter follower transistor 2 is set to an impedance sufficiently smaller than 75Ω.
【０００３】ここで、エミッタフォロワトランジスタ２
の出力インピーダンスは、一般に、ｋＴ／ｑＩにて与え
られる。ｋはボルツマン定数、ｑは単位電荷、Ｔは絶対
温度、Ｉはエミッタフォロワトランジスタ２を流れる電
流である。従って、エミッタフォロワトランジスタ２の
出力インピーダンスを７５Ωの１％以下に設定するもの
とすると、電流Ｉとしては３４ｍＡ以上流す必要があ
る。また、出力端子に接続される負荷は交流的には十分
低い値となるので、出力の信号振幅が大きい場合には、
この交流負荷を駆動することができる直流バイアス電流
をエミッタフォロワトランジスタ２に流しておく必要が
ある。例えば、出力２Ｖppとすると、２７ｍＡの電流が
必要であり、また出力４Ｖppの場合には５３ｍＡ以上の
電流を流すことになる。Here, the emitter follower transistor 2
Is generally given in kT / qI. k is the Boltzmann constant, q is the unit charge, T is the absolute temperature, and I is the current flowing through the emitter follower transistor 2. Therefore, assuming that the output impedance of the emitter follower transistor 2 is set to 1% or less of 75Ω, the current I needs to flow at 34 mA or more. Also, since the load connected to the output terminal has a sufficiently low value in terms of AC, when the output signal amplitude is large,
It is necessary to supply a DC bias current capable of driving the AC load to the emitter follower transistor 2. For example, if the output is 2 V pp , a current of 27 mA is required, and if the output is 4 V pp , a current of 53 mA or more flows.
【０００４】[0004]
【発明が解決しようとする課題】上述した従来の信号出
力回路は、テレビジョンおよびＶＴＲ等において、図２
に示されるように、ピンジャックと呼ばれる２端子の同
軸コネクタに対応して使用されることが多い。その場合
に、当該出力回路においては、出力端子である前記ピン
ジャックに同軸プラグ１０が接続されているか否かに関
せず、出力バッファ用のエミッタフォロワトランジスタ
２には電流が流れている。このため、出力端子数が多い
信号処理装置においては、信号処理装置の数に対応する
数の出力段エミッタフォロワトランジスタに無為の電流
を流すことが必要となり、無為の消費電力を多大に要す
るという欠点がある。The above-described conventional signal output circuit is used in televisions, VTRs and the like.
As shown in (1), it is often used corresponding to a two-terminal coaxial connector called a pin jack. In this case, in the output circuit, a current flows through the emitter follower transistor 2 for the output buffer regardless of whether or not the coaxial plug 10 is connected to the pin jack as the output terminal. For this reason, in a signal processing device having a large number of output terminals, it is necessary to supply an unnecessary current to the number of output-stage emitter follower transistors corresponding to the number of the signal processing devices, resulting in a large amount of unnecessary power consumption. There is.
【０００５】[0005]
【課題を解決するための手段】本発明の省電力出力回路
は、所定の信号出力を受けて、同軸プラグを介して前記
信号出力を同軸線路に出力するエミッタフォロワ型の信
号出力回路において、前記信号出力を入力して、前記同
軸線路に対応する２線式の信号出力を低インピーダンス
にて出力するエミッタフォロワバッファ回路と、前記同
軸プラグの外部導体に接続される、相互に絶縁された接
地側第１電極ならびに接地側第２電極と、前記同軸プラ
グの内部導体に接続される中心電極とを備え、前記エミ
ッタフォロワバッファ回路との接続側において、前記接
地側第１電極が直接に接地電位に接続され、前記接地側
第２電極が前記エミッタフォロワバッファ回路の接地側
端子に接続されるとともに、前記中心電極が前記エミッ
タフォロワバッファ回路の信号出力端子に接続されるピ
ンジャックと、を備えて構成される。A power saving output circuit according to the present invention is an emitter follower type signal output circuit for receiving a predetermined signal output and outputting the signal output to a coaxial line via a coaxial plug. An emitter follower buffer circuit that receives a signal output and outputs a two-wire signal output corresponding to the coaxial line at low impedance, and a mutually insulated ground side connected to an outer conductor of the coaxial plug. A first electrode, a ground-side second electrode, and a center electrode connected to the inner conductor of the coaxial plug, wherein the ground-side first electrode is directly connected to a ground potential on a connection side with the emitter follower buffer circuit. And the ground-side second electrode is connected to a ground-side terminal of the emitter-follower buffer circuit, and the center electrode is connected to the emitter-follower buffer. Configured with a pin jack to be connected to the signal output terminal of the circuit.
【０００６】[0006]
【実施例】次に、本発明について図面を参照して説明す
る。Next, the present invention will be described with reference to the drawings.
【０００７】図１（ａ）は、本発明の一実施例を示すブ
ロック図である。図１に示されるように、本実施例は、
信号処理回路１および同軸プラグ１０に対応して、低イ
ンピーダンスにてビデオ信号を出力するためのインピー
ダンス変換用のエミッタフォロワトランジスタ２、抵抗
３、インピーダンス整合抵抗４および結合容量５を含む
エミッタフォロワバッファ回路６と、簡易な断面図にて
示される配線端子７、中心電極１２、絶縁体１３および
接地側第１電極８および接地側第２電極９を含むピンジ
ャックとを備えて構成されており、エミッタフォロワバ
ッファ回路６の出力信号は、前記ピンジャックの配線端
子７に接続され、このピンジャックには、信号取出し用
の同軸プラグ１０が嵌合接続される。また、図１（ｂ）
には、前記ピンジャックの２面図が示されている。FIG. 1A is a block diagram showing one embodiment of the present invention. As shown in FIG.
An emitter follower buffer circuit including an emitter follower transistor 2, a resistor 3, an impedance matching resistor 4, and a coupling capacitor 5 for impedance conversion for outputting a video signal with low impedance corresponding to the signal processing circuit 1 and the coaxial plug 10. 6 and a pin jack including a wiring terminal 7, a center electrode 12, an insulator 13, a ground-side first electrode 8, and a ground-side second electrode 9 shown in a simplified cross-sectional view. The output signal of the follower buffer circuit 6 is connected to the wiring terminal 7 of the pin jack, and a coaxial plug 10 for extracting a signal is fitted and connected to the pin jack. FIG. 1 (b)
2 shows a two-sided view of the pin jack.
【０００８】本発明の特徴は、このピンジャックの構成
にあり、図１（ｂ）に示されるように、同軸プラグ１０
に嵌合し接続される接地側第１電極８、接地側第２電極
９および中心電極１２と、これらの電極間を電気的に絶
縁するための絶縁体１３と、接地側第１電極８と接地側
第２電極９との間を絶縁する絶縁体１１と、エミッタフ
ォロワバッファ回路６の結合容量５に接続される配線端
子７とを備えて形成され、且つ、当該ピンジャックの接
地側第１電極８が直接接地電位に接続されており、ま
た、接地側第２電極９がエミッタフォロワバッファ回路
６の抵抗３の接地側端子に接続されて、直接に接地電位
に接続されていないことである。The feature of the present invention lies in the configuration of this pin jack, and as shown in FIG.
The ground-side first electrode 8, the ground-side second electrode 9, and the center electrode 12, which are fitted and connected to the ground electrode; an insulator 13 for electrically insulating these electrodes; An insulator 11 that insulates between the ground side second electrode 9 and a wiring terminal 7 connected to the coupling capacitor 5 of the emitter follower buffer circuit 6 is formed. That is, the electrode 8 is directly connected to the ground potential, and the ground second electrode 9 is connected to the ground terminal of the resistor 3 of the emitter follower buffer circuit 6 and is not directly connected to the ground potential. .
【０００９】このようにピンジャックの使用により、同
軸プラグ１０がピンジャックに接続されていない時、即
ち、信号処理回路１の出力信号が外部に取出されていな
い非使用状態においては、接地側第１電極８および接地
側第２電極９の間に挿入されている絶縁体１１により、
出力段を形成するエミッタフォロワトランジスタ２には
バイアス電流が流れないが、一旦ピンジャックに同軸プ
ラグ１０を接続させると、同軸プラグ１０の外部導体を
介して、接地側第１電極８および接地側第２電極９の間
が短絡されることにより導通状態となり、出力段のエミ
ッタフォロワトランジスタ２に電流が流れ、エミッタフ
ォロワバッファ回路６は信号処理回路１に対応するバッ
ファ回路として機能する。即ち、非使用時における無為
の電流を排除する省電力出力回路として機能する。As described above, by using the pin jack, when the coaxial plug 10 is not connected to the pin jack, that is, when the output signal of the signal processing circuit 1 is not taken out to the outside, the ground side second jack is not used. Due to the insulator 11 inserted between the first electrode 8 and the ground-side second electrode 9,
Although no bias current flows through the emitter follower transistor 2 forming the output stage, once the coaxial plug 10 is connected to the pin jack, the ground-side first electrode 8 and the ground-side first electrode 8 are connected via the outer conductor of the coaxial plug 10. When the two electrodes 9 are short-circuited, a conduction state is established, a current flows through the emitter follower transistor 2 in the output stage, and the emitter follower buffer circuit 6 functions as a buffer circuit corresponding to the signal processing circuit 1. That is, it functions as a power saving output circuit that eliminates unnecessary current when not in use.
【００１０】[0010]
【発明の効果】以上説明したように、本発明は、信号処
理装置の出力端子に対応するエミッタフォロワバッファ
回路に接続されるピンジャックの構成を修正することに
より、出力端子の多い信号処理装置に対する出力回路の
消費電力を低減することができるという効果がある。As described above, the present invention is directed to a signal processing device having a large number of output terminals by modifying the configuration of a pin jack connected to an emitter follower buffer circuit corresponding to an output terminal of a signal processing device. There is an effect that power consumption of the output circuit can be reduced.
【図１】本発明の一実施例を示す回路図および部分断面
図である。FIG. 1 is a circuit diagram and a partial cross-sectional view showing one embodiment of the present invention.
【図２】従来例を示す回路図および部分断面図である。FIG. 2 is a circuit diagram and a partial cross-sectional view showing a conventional example.
１ 信号処装置 ２ エミッタフォロワトランジスタ ３ 抵抗 ４ インピーダンス整合抵抗 ５ 結合容量 ６ エミッタフォロワバッファ回路 ７ 配線端子 ８ 接地側第１電極 ９ 接地側第２電極 １０ 同軸プラグ １１、１３ 絶縁体 １２ 中心電極 REFERENCE SIGNS LIST 1 signal processing device 2 emitter follower transistor 3 resistor 4 impedance matching resistor 5 coupling capacitance 6 emitter follower buffer circuit 7 wiring terminal 8 ground-side first electrode 9 ground-side second electrode 10 coaxial plug 11, 13 insulator 12 center electrode
Claims (1)
介して前記信号出力を同軸線路に出力するエミッタフォ
ロワ型の信号出力回路において、前記信号出力を入力し
て、前記同軸線路に対応する２線式の信号出力を低イン
ピーダンスにて出力するエミッタフォロワバッファ回路
と、前記同軸プラグの外部導体に接続される、相互に絶
縁された接地側第１電極ならびに接地側第２電極と、前
記同軸プラグの内部導体に接続される中心電極とを備
え、前記エミッタフォロワバッファ回路との接続側にお
いて、前記接地側第１電極が直接に接地電位に接続さ
れ、前記接地側第２電極が前記エミッタフォロワバッフ
ァ回路の接地側端子に接続されるとともに、前記中心電
極が前記エミッタフォロワバッファ回路の信号出力端子
に接続されるピンジャックと、を備えることを特徴とす
る省電力出力回路。1. An emitter follower type signal output circuit for receiving a predetermined signal output and outputting the signal output to a coaxial line via a coaxial plug, wherein the signal output is input to correspond to the coaxial line. An emitter-follower buffer circuit for outputting a two-wire signal output at low impedance, a mutually insulated ground-side first electrode and a ground-side second electrode connected to an outer conductor of the coaxial plug, A center electrode connected to the internal conductor of the plug, the ground-side first electrode being directly connected to ground potential on the connection side with the emitter-follower buffer circuit, and the ground-side second electrode being connected to the emitter follower. A pin jack connected to a ground terminal of the buffer circuit and having the center electrode connected to a signal output terminal of the emitter follower buffer circuit. And a power-saving output circuit comprising:
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14051591A JP2729117B2 (en) | 1991-06-13 | 1991-06-13 | Power saving output circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14051591A JP2729117B2 (en) | 1991-06-13 | 1991-06-13 | Power saving output circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04365277A JPH04365277A (en) | 1992-12-17 |
| JP2729117B2 true JP2729117B2 (en) | 1998-03-18 |
Family
ID=15270452
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14051591A Expired - Lifetime JP2729117B2 (en) | 1991-06-13 | 1991-06-13 | Power saving output circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2729117B2 (en) |
-
1991
- 1991-06-13 JP JP14051591A patent/JP2729117B2/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH04365277A (en) | 1992-12-17 |
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Legal Events
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|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
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