JP2624776B2 - 光ディスク装置の基準クロック信号生成回路 - Google Patents
光ディスク装置の基準クロック信号生成回路Info
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- JP2624776B2 JP2624776B2 JP63136772A JP13677288A JP2624776B2 JP 2624776 B2 JP2624776 B2 JP 2624776B2 JP 63136772 A JP63136772 A JP 63136772A JP 13677288 A JP13677288 A JP 13677288A JP 2624776 B2 JP2624776 B2 JP 2624776B2
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Description
【発明の詳細な説明】 〔概要〕 光ディスク表面に予め記録されているクロックピット
を検出し、この検出を基準に情報のリード，ライトのた
めの基準クロック信号を生成するPLLを設けられたサン
プルサーボ方式の光ディスク装置に関し、 クロックピットの検出ができなくなった場合でもPLL
を安定に動作させて正しい基準クロック信号を生成する
ことを目的とし、 VCOの出力発振周波数を下げるためのパルスが所定時
間発生していることを検出してこのパルスを強制的に終
了させると共に、VCOの出力発振周波数を上げるための
パルスを上記所定時間発生させる信号を出力する制御回
路を設けた構成とする。
を検出し、この検出を基準に情報のリード，ライトのた
めの基準クロック信号を生成するPLLを設けられたサン
プルサーボ方式の光ディスク装置に関し、 クロックピットの検出ができなくなった場合でもPLL
を安定に動作させて正しい基準クロック信号を生成する
ことを目的とし、 VCOの出力発振周波数を下げるためのパルスが所定時
間発生していることを検出してこのパルスを強制的に終
了させると共に、VCOの出力発振周波数を上げるための
パルスを上記所定時間発生させる信号を出力する制御回
路を設けた構成とする。
本発明は、光ディスク装置に係わり、特に光ディスク
表面に予め記録されているクロックピットを検出し、こ
の検出を基準に情報のリード，ライトのための基準クロ
ック信号を生成するPLL回路を設けられたサンプルサー
ボ方式の光ディスク装置に関する。
表面に予め記録されているクロックピットを検出し、こ
の検出を基準に情報のリード，ライトのための基準クロ
ック信号を生成するPLL回路を設けられたサンプルサー
ボ方式の光ディスク装置に関する。
光ディスク装置において光ディスクから情報をリード
する場合及び光ディスクに情報をライトする場合、リー
ド，ライトのための基準クロック信号を生成する必要が
あるが、このための方式として大別として連続サーボ方
式及びサンプルサーボ方式の２種がある。サンプルサー
ボ方式は、光ディスク表面に予め記録されているクロッ
クピットを検出し、この検出を基準に情報のリード，ラ
イトのための基準クロック信号を生成するPLL回路が必
要である。
する場合及び光ディスクに情報をライトする場合、リー
ド，ライトのための基準クロック信号を生成する必要が
あるが、このための方式として大別として連続サーボ方
式及びサンプルサーボ方式の２種がある。サンプルサー
ボ方式は、光ディスク表面に予め記録されているクロッ
クピットを検出し、この検出を基準に情報のリード，ラ
イトのための基準クロック信号を生成するPLL回路が必
要である。
第４図は従来装置の基準クロック信号生成回路の一例
のブロック図を示す。同図において、光ディスク１は第
５図に示す如く、１トラック宛1300余のサーボバイト
（２バイト）2,データゾーン（16バイト）３を形成され
ており、これらが１周宛繰返し形成されてなる。なお、
一点鎖線は１つのトラック中心線を示す。サーボバイト
２は基本的に、トラック中心から偏位して設けられたト
ラックエラー検出のための１対のウォブルドピット2a,
データゾーン３のビットピッチの最大より長いユニーク
ディスタンス部2b,ウォブルドピット2a通過タイミング
を検出するためのクロックピット2cの３つの部分から構
成されている。
のブロック図を示す。同図において、光ディスク１は第
５図に示す如く、１トラック宛1300余のサーボバイト
（２バイト）2,データゾーン（16バイト）３を形成され
ており、これらが１周宛繰返し形成されてなる。なお、
一点鎖線は１つのトラック中心線を示す。サーボバイト
２は基本的に、トラック中心から偏位して設けられたト
ラックエラー検出のための１対のウォブルドピット2a,
データゾーン３のビットピッチの最大より長いユニーク
ディスタンス部2b,ウォブルドピット2a通過タイミング
を検出するためのクロックピット2cの３つの部分から構
成されている。
ここで、１対のウォブルドビット2aはトラックの両側
に設けられているので、夫々のピットを照射した際の反
射光量の差からトラックエラー信号が検出され、これに
よってビームスポットがトラックを正確に照射するよう
に光学ヘッドを変位させる。又、データのリード，ライ
トのタイミングやウォブルドピット2aを通過するタイミ
ングを知る必要があり、このためにクロックピット2cの
検出を基準にして、PLLを動作させて基準クロック信号
を生成し、これを分割してリード，ライトのタイミング
を得る。
に設けられているので、夫々のピットを照射した際の反
射光量の差からトラックエラー信号が検出され、これに
よってビームスポットがトラックを正確に照射するよう
に光学ヘッドを変位させる。又、データのリード，ライ
トのタイミングやウォブルドピット2aを通過するタイミ
ングを知る必要があり、このためにクロックピット2cの
検出を基準にして、PLLを動作させて基準クロック信号
を生成し、これを分割してリード，ライトのタイミング
を得る。
第４図において、光ディスク１からクロックピット検
出回路４にてクロックピット2cが検出され、クロックピ
ット信号R1（第６図（Ａ））として出力される。なお、
第５図中ユニークディスタンス部2bは鏡面とされてお
り、ユニークディスタンス部2bの次のピットをクロック
ピット2cとして認識させるためのものである。クロック
ピット信号R1は後述のVCO（電圧制御発振器）７の発振
出力nfを分周回路８でｎ分周した信号D1（第６図
（Ｂ））と位相比較回路５で位相比較され、信号D1の位
相がクロックピット信号R1の位相より遅れている場合は
INCパルス（第６図（Ｄ））が出力され、一方、信号D1
の位相がクロックピット信号R1の位相より進んでいる場
合はDECパルス（第６図（Ｃ））が出力される。
出回路４にてクロックピット2cが検出され、クロックピ
ット信号R1（第６図（Ａ））として出力される。なお、
第５図中ユニークディスタンス部2bは鏡面とされてお
り、ユニークディスタンス部2bの次のピットをクロック
ピット2cとして認識させるためのものである。クロック
ピット信号R1は後述のVCO（電圧制御発振器）７の発振
出力nfを分周回路８でｎ分周した信号D1（第６図
（Ｂ））と位相比較回路５で位相比較され、信号D1の位
相がクロックピット信号R1の位相より遅れている場合は
INCパルス（第６図（Ｄ））が出力され、一方、信号D1
の位相がクロックピット信号R1の位相より進んでいる場
合はDECパルス（第６図（Ｃ））が出力される。
INCパルス及びDECパルスはループフィルタ６に供給さ
れ、ここで、INCパルスが入来した時はVCO7の出力発振
周波数を上げるための制御信号が取出され、一方、DEC
パルスが入来した時はVCO7の出力発振周波数を下げるた
めの制御信号が取出される。これにより、VCO7の出力発
振周波数は第６図（Ｅ）を示す如く、クロックピット
R1,信号D1の位相差に対応して取出され、基準クロック
信号として情報のリード，ライトの際に用いられる。
れ、ここで、INCパルスが入来した時はVCO7の出力発振
周波数を上げるための制御信号が取出され、一方、DEC
パルスが入来した時はVCO7の出力発振周波数を下げるた
めの制御信号が取出される。これにより、VCO7の出力発
振周波数は第６図（Ｅ）を示す如く、クロックピット
R1,信号D1の位相差に対応して取出され、基準クロック
信号として情報のリード，ライトの際に用いられる。
然るに、クロックピット2cがなくなっていたり、ユニ
ックディスタンス2b中に傷等があるとクロックピット2c
の検出ができなくなり、第６図（Ａ）に示すようにクロ
ックピット信号R1が抜けてしまう。この抜けにより、位
相比較回路５では信号D1の位相が抜けた次のクロックピ
ット信号R1の位相より進んでいるとみなされ、パルス幅
の広い不必要なDECパルスＣ（第６図（Ｃ））が出力さ
れてしまう。これにより、VCO7の出力周波数が無意味に
下げられてしまい、正しい基準クロック信号を得ること
ができない問題点があった。特に、PLLの引込み時には
クロックピットの検出抜けが多く、引込み特性が悪くな
る問題点があった。
ックディスタンス2b中に傷等があるとクロックピット2c
の検出ができなくなり、第６図（Ａ）に示すようにクロ
ックピット信号R1が抜けてしまう。この抜けにより、位
相比較回路５では信号D1の位相が抜けた次のクロックピ
ット信号R1の位相より進んでいるとみなされ、パルス幅
の広い不必要なDECパルスＣ（第６図（Ｃ））が出力さ
れてしまう。これにより、VCO7の出力周波数が無意味に
下げられてしまい、正しい基準クロック信号を得ること
ができない問題点があった。特に、PLLの引込み時には
クロックピットの検出抜けが多く、引込み特性が悪くな
る問題点があった。
本発明はクロックピットの検出ができなくなった場合
でもPLLを安定に動作させて正しい基準クロック信号を
生成できる光ディスク装置の基準クロック信号生成回路
を提供することを目的とする。
でもPLLを安定に動作させて正しい基準クロック信号を
生成できる光ディスク装置の基準クロック信号生成回路
を提供することを目的とする。
第１図は本発明の原理ブロック図を示す。同図中、５
は位相比較回路で、光ディスク１に予め記録されている
クロックピットを検出して得たクロックピット信号R1の
位相とVCO回路部９の出力信号D1の位相とを比較し、そ
の位相差関係に応じて該VCO回路部９の出力発振周波数
を上げるための第１のパルス（INC）又は下げるための
第２のパルス（DEC）を出力する。20は制御回路で、上
記第２のパルス（DEC）が所定時間（ΔＴ）発生してい
ることを検出して上記第２のパルス（DEC）を強制的に
終了させると共に、上記第１のパルス（INC）を上記所
定時間（ΔＴ）発生させる信号を出力する。
は位相比較回路で、光ディスク１に予め記録されている
クロックピットを検出して得たクロックピット信号R1の
位相とVCO回路部９の出力信号D1の位相とを比較し、そ
の位相差関係に応じて該VCO回路部９の出力発振周波数
を上げるための第１のパルス（INC）又は下げるための
第２のパルス（DEC）を出力する。20は制御回路で、上
記第２のパルス（DEC）が所定時間（ΔＴ）発生してい
ることを検出して上記第２のパルス（DEC）を強制的に
終了させると共に、上記第１のパルス（INC）を上記所
定時間（ΔＴ）発生させる信号を出力する。
クロックピットがなくなっていた場合など、クロック
ピット信号R1は検出されず、抜けてしまう。このような
時、位相比較回路５は前記第２のパルス（DEC）を出力
してVCO回路部９の出力発振周波数を下げようとする。
そこで、第２のパルス（DEC）が所定時間（ΔＴ）発生
している場合、この第２のパルスを強制的に終了させる
と共に、前記第１のパルスを所定時間（ΔＴ）出力して
VCO回路部９の出力発振周波数を上昇するようにする。
これにより、VCO回路部９の出力発振周波数が極端に変
動することがなく、クロックピット信号抜けの影響を最
小限に止めることができる。
ピット信号R1は検出されず、抜けてしまう。このような
時、位相比較回路５は前記第２のパルス（DEC）を出力
してVCO回路部９の出力発振周波数を下げようとする。
そこで、第２のパルス（DEC）が所定時間（ΔＴ）発生
している場合、この第２のパルスを強制的に終了させる
と共に、前記第１のパルスを所定時間（ΔＴ）出力して
VCO回路部９の出力発振周波数を上昇するようにする。
これにより、VCO回路部９の出力発振周波数が極端に変
動することがなく、クロックピット信号抜けの影響を最
小限に止めることができる。
第２図は本発明回路の一実施例のブロック図を示し、
同図中、第４図と同一構成部分には同一番号を付してそ
の説明を省略する。第２図中、10,11は負論理のオアゲ
ート、12はDECパルスがＬレベルになった時点で無条件
にパルス幅ΔＴの時間Ｌレベルとなるパルスｅ（第３図
（Ｅ））を出力するモノマルチ、13はパルスｅがＬレベ
ルからＨレベルになった時点でDECパルスがＬレベルの
場合に限ってこの時点からパルス幅ΔＴの時間Ｌレベル
となるパルスｆ（第３図（Ｆ））を出力するモノマルチ
である。なおループフィルタ6,VCO7および分周回路８で
第１図に示したVCO回路部９が構成されている。
同図中、第４図と同一構成部分には同一番号を付してそ
の説明を省略する。第２図中、10,11は負論理のオアゲ
ート、12はDECパルスがＬレベルになった時点で無条件
にパルス幅ΔＴの時間Ｌレベルとなるパルスｅ（第３図
（Ｅ））を出力するモノマルチ、13はパルスｅがＬレベ
ルからＨレベルになった時点でDECパルスがＬレベルの
場合に限ってこの時点からパルス幅ΔＴの時間Ｌレベル
となるパルスｆ（第３図（Ｆ））を出力するモノマルチ
である。なおループフィルタ6,VCO7および分周回路８で
第１図に示したVCO回路部９が構成されている。
次に、本発明の動作について第３図に示す信号波形図
と共に説明する。
と共に説明する。
第２図において、通常状態でクロックピット信号R
1（第３図（Ａ））が正常に出力されている場合、信号D
1の位相との関係でINCパルス（第３図（Ｇ））又はDEC
パルス（第３図（Ｄ））が出力されることは前述の従来
例と同様である。この場合、モノマルチ12はDECパルス
（第３図（Ｄ））が出力される度にパルス幅ΔＴのパル
スｅ（第３図（Ｅ））を出力するが、パルスｅが立上る
時点では通常はDECパルスは終了しているため、モノマ
ルチ13はパルスを出力しない。
1（第３図（Ａ））が正常に出力されている場合、信号D
1の位相との関係でINCパルス（第３図（Ｇ））又はDEC
パルス（第３図（Ｄ））が出力されることは前述の従来
例と同様である。この場合、モノマルチ12はDECパルス
（第３図（Ｄ））が出力される度にパルス幅ΔＴのパル
スｅ（第３図（Ｅ））を出力するが、パルスｅが立上る
時点では通常はDECパルスは終了しているため、モノマ
ルチ13はパルスを出力しない。
ここで、クロックピット信号R1（第３図（Ａ））が抜
けた場合、前述の従来装置で説明してように広いパルス
幅をもつDECパルス（第３図（Ｄ））が出力され、VCO7
の出力発振周波数は下げられる。DECパルスの立下がり
でモノマルチ12から無条件にパルス幅ΔＴのパルスｅ
（第３図（Ｅ））が出力されるが、上記DECパルスはク
ロックピット信号がぬけたためにパルスｅが立上る時点
でもまたＬレベルとされており、これにより、モノマル
チ13よりパルス幅ΔＴのパルスｆ（第３図（Ｆ））が出
力される。
けた場合、前述の従来装置で説明してように広いパルス
幅をもつDECパルス（第３図（Ｄ））が出力され、VCO7
の出力発振周波数は下げられる。DECパルスの立下がり
でモノマルチ12から無条件にパルス幅ΔＴのパルスｅ
（第３図（Ｅ））が出力されるが、上記DECパルスはク
ロックピット信号がぬけたためにパルスｅが立上る時点
でもまたＬレベルとされており、これにより、モノマル
チ13よりパルス幅ΔＴのパルスｆ（第３図（Ｆ））が出
力される。
パルスｆはオアゲート10を介して信号R1′（第３図
（Ｂ））として位相比較回路５に供給され、これによ
り、DECパルス（第３図（Ｄ））は信号R1′の立上りで
ＬレベルからＨレベルに復帰される。このDECパルスの
Ｈレベル復帰により、VCO7の出力発振周波数の低下が中
止される。一方、これと同時に、パルスｆはオアゲート
11を介してINCパルス（第３図（Ｇ））としてループフ
ィルタ６に供給され、これにより、VCO7の出力発振周波
数を増加される。
（Ｂ））として位相比較回路５に供給され、これによ
り、DECパルス（第３図（Ｄ））は信号R1′の立上りで
ＬレベルからＨレベルに復帰される。このDECパルスの
Ｈレベル復帰により、VCO7の出力発振周波数の低下が中
止される。一方、これと同時に、パルスｆはオアゲート
11を介してINCパルス（第３図（Ｇ））としてループフ
ィルタ６に供給され、これにより、VCO7の出力発振周波
数を増加される。
即ち、本発明ではクロックピット信号R1の抜けを生じ
た場合に出力されるDECパルス（VCO7の出力発振周波数
は無意味に低下してしまう）はやむを得ないものとして
その出力時間を最小限に止め（パルスｆ即ち信号R1′に
よってDECパルスを強制的に終了させる）、VCO7の出力
発振周波数の低下分をその直後のINCパルスによるVCO7
の出力発振周波数の増加で埋合せする。従って、VCO7の
出力発振周波数が従来例のように極端に変動することは
なく、クロックピット信号R1の抜けの影響を最小限に止
めることができる。
た場合に出力されるDECパルス（VCO7の出力発振周波数
は無意味に低下してしまう）はやむを得ないものとして
その出力時間を最小限に止め（パルスｆ即ち信号R1′に
よってDECパルスを強制的に終了させる）、VCO7の出力
発振周波数の低下分をその直後のINCパルスによるVCO7
の出力発振周波数の増加で埋合せする。従って、VCO7の
出力発振周波数が従来例のように極端に変動することは
なく、クロックピット信号R1の抜けの影響を最小限に止
めることができる。
以上説明した如く、本発明によれば、VCOの出力発振
周波数が極端に変動するようなことはなく、クロックピ
ット信号の抜けの影響を最小限に止めることができ、PL
Lを安定に動作させて正しい基準クロック信号を生成す
ることができる。
周波数が極端に変動するようなことはなく、クロックピ
ット信号の抜けの影響を最小限に止めることができ、PL
Lを安定に動作させて正しい基準クロック信号を生成す
ることができる。
第１図は本発明の原理ブロック図、 第２図は本発明回路の一実施例のブロック図、 第３図は第２図に示す回路の信号波形図、 第４図は従来回路に一例のブロック図、 第５図はサンプルサーボ方式の光ディスクのピット構成
図、 第６図は第４図に示す回路の信号波形図である。 図において、 １は光ディスク、 ２はサーボバイト、 2aはウォルブルドピット、 2bはユニークディスタンス部、 2cはクロックピット、 ４はクロックピット検出回路、 ５は位相比較回路、 ６はループフィルタ、 ７はVCO（電圧制御発振器）、 ９はVCO回路部、 10,11はオアゲート、 12,13はモノマルチ を示す。
図、 第６図は第４図に示す回路の信号波形図である。 図において、 １は光ディスク、 ２はサーボバイト、 2aはウォルブルドピット、 2bはユニークディスタンス部、 2cはクロックピット、 ４はクロックピット検出回路、 ５は位相比較回路、 ６はループフィルタ、 ７はVCO（電圧制御発振器）、 ９はVCO回路部、 10,11はオアゲート、 12,13はモノマルチ を示す。
Claims (1)
- 【請求項１】光ディスク（１）に予め記録されているク
ロックピットを検出して得たクロックピット信号（R1）
の位相とVCO回路部（９）の出力信号（D1）の位相とを
比較し、その位相差関係に応じて該VCO回路部（９）の
出力発振周波数を上げるための第１のパルス（INC）又
は下げるための第２のパルス（DEC）を出力する位相比
較回路（５）を設け、上記VCO回路部（９）より、上記
クロックピットを基準にした情報のリード，ライトのた
めの基準クロック信号を得る光ディスク装置の基準クロ
ック信号生成回路において、 上記第２のパルス（DEC）が所定時間（ΔＴ）発生して
いることを検出した場合、上記第２のパルス（DEC）を
強制的に終了させると共に、上記第１のパルス（INC）
を上記所定時間（ΔＴ）発生させる信号を出力する制御
回路（20）を有してなることを特徴とする光ディスク装
置の基準クロック信号生成回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63136772A JP2624776B2 (ja) | 1988-06-03 | 1988-06-03 | 光ディスク装置の基準クロック信号生成回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63136772A JP2624776B2 (ja) | 1988-06-03 | 1988-06-03 | 光ディスク装置の基準クロック信号生成回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01307060A JPH01307060A (ja) | 1989-12-12 |
| JP2624776B2 true JP2624776B2 (ja) | 1997-06-25 |
Family
ID=15183154
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63136772A Expired - Fee Related JP2624776B2 (ja) | 1988-06-03 | 1988-06-03 | 光ディスク装置の基準クロック信号生成回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2624776B2 (ja) |
-
1988
- 1988-06-03 JP JP63136772A patent/JP2624776B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH01307060A (ja) | 1989-12-12 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |