JP2527931B2 - 通信回路網 - Google Patents
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- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Data Exchanges In Wide-Area Networks (AREA)
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Description
【発明の詳細な説明】 〔技術分野〕 本発明は、デイジタル音声通信に関し、更に詳細に
は、パケツト・スイツチングのデイジタル音声兼データ
通信に関する。また、本発明は、ケーブル・テレビ回路
網で用いられている同軸ケーブルや電話回路網で使用さ
れているデイジタル・トランクのような媒体を含む、高
データ・レートで運用できる回路網におけるパケツト・
スイツチングのデイジタル音声兼データ通信に関する。
は、パケツト・スイツチングのデイジタル音声兼データ
通信に関する。また、本発明は、ケーブル・テレビ回路
網で用いられている同軸ケーブルや電話回路網で使用さ
れているデイジタル・トランクのような媒体を含む、高
データ・レートで運用できる回路網におけるパケツト・
スイツチングのデイジタル音声兼データ通信に関する。
パケツト通信は一般に周知である。しかし、周知のパ
ケツト・スイツチング技術は、記憶及び先方環境（forw
ard environment）において可変で任意の遅れを有して
いる。このような遅れは、実時間の音声信号を含む双方
向通信においては、許容しがたい。人間の耳は、約200m
s以上の絶対遅延に対して非常に敏感である。また、耳
は任意の遅れやまたはギヤツプ・モジユレーシヨンにも
敏感である。
ケツト・スイツチング技術は、記憶及び先方環境（forw
ard environment）において可変で任意の遅れを有して
いる。このような遅れは、実時間の音声信号を含む双方
向通信においては、許容しがたい。人間の耳は、約200m
s以上の絶対遅延に対して非常に敏感である。また、耳
は任意の遅れやまたはギヤツプ・モジユレーシヨンにも
敏感である。
ベル・ノーザン・リサーチは、電話トランクを経由し
て私設回路網の２つの離れた地点を接続するため、PLC
−１という名称のデイジタル集線装置を開発した。テル
シス1982年三（Telesis 1982 Three）の第２頁〜第８頁
に示された、ブラツク（Black）他による論文「PLC−1:
デジタル技術によりアナログ・トランクのコスト低減
（Digital Technology Cuts Cost of Analog Trunkin
g）」には、システムがローデイング法則に従つて信号
伝送を割当てるデイジタル通話挿入について述べられて
いる。デイジタル通話挿入（DSI）技術は、信号負荷を
検出してチヤネル容量に適合させるのに、デイジタル信
号処理技術と音声統計学を使用している。PLC−１シス
テムにおいて、１つの負荷は、瞬間的オーバロードが消
滅するまで、通話バーストを一時記憶することにより処
理されている。この技術では、オーバーロードの発生の
約10％において300ms（1/3秒）以上の遅れとなろう。通
常の２倍のチヤネル容量も得られよう。
て私設回路網の２つの離れた地点を接続するため、PLC
−１という名称のデイジタル集線装置を開発した。テル
シス1982年三（Telesis 1982 Three）の第２頁〜第８頁
に示された、ブラツク（Black）他による論文「PLC−1:
デジタル技術によりアナログ・トランクのコスト低減
（Digital Technology Cuts Cost of Analog Trunkin
g）」には、システムがローデイング法則に従つて信号
伝送を割当てるデイジタル通話挿入について述べられて
いる。デイジタル通話挿入（DSI）技術は、信号負荷を
検出してチヤネル容量に適合させるのに、デイジタル信
号処理技術と音声統計学を使用している。PLC−１シス
テムにおいて、１つの負荷は、瞬間的オーバロードが消
滅するまで、通話バーストを一時記憶することにより処
理されている。この技術では、オーバーロードの発生の
約10％において300ms（1/3秒）以上の遅れとなろう。通
常の２倍のチヤネル容量も得られよう。
ペンシルバニア州，フオートワシントンに所在のアイ
デン・モニター・システムズ（Aydin Monitor System
s）は、24の音声チヤネルを扱うよう設計された単一の
Ｔ−１トランクに48の音声チヤネルを多重化することが
できるＴ−１チヤネル音声データ・マルチプレクサを提
案している。このアイデン・システムは、２−１音声圧
縮により、音声特性の低減を最小限に抑えて、通話路の
有効なチヤネル容量を増加することができる可変量子化
レベル（VQL）技術を使用している。1982年７月のデー
タ・シートには、このようなチヤネル・バンク機能が示
されている。
デン・モニター・システムズ（Aydin Monitor System
s）は、24の音声チヤネルを扱うよう設計された単一の
Ｔ−１トランクに48の音声チヤネルを多重化することが
できるＴ−１チヤネル音声データ・マルチプレクサを提
案している。このアイデン・システムは、２−１音声圧
縮により、音声特性の低減を最小限に抑えて、通話路の
有効なチヤネル容量を増加することができる可変量子化
レベル（VQL）技術を使用している。1982年７月のデー
タ・シートには、このようなチヤネル・バンク機能が示
されている。
アイデン・モニター・システムは、72の音声またはデ
ータ・チヤネルを、標準Ｔ−１トランクにおいて扱える
と称するＴ−１チヤネル音声／データ・マルチプレクサ
を最近公表した。この新しいシステムは、VQLエンコー
デイング及びデイジタル通話挿入（DSI）技術を使用し
ている。
ータ・チヤネルを、標準Ｔ−１トランクにおいて扱える
と称するＴ−１チヤネル音声／データ・マルチプレクサ
を最近公表した。この新しいシステムは、VQLエンコー
デイング及びデイジタル通話挿入（DSI）技術を使用し
ている。
パケツト音声伝送の文献は、広範囲にわたるが、パケ
ツト音声伝送がそれほど高性能でも低コストでもないこ
とを示唆している。パケツト音声に関する代表的な論文
としては、スピーチ技術（Speech Technology）の1982
年９月/10月号における、ライデイ・コール（Randy Col
e）による「パケツト音声：戦力化は何時か（When It M
akes Sense）」がある。本発明は、これらの文献に指摘
の限界を克服しようとするものである。
ツト音声伝送がそれほど高性能でも低コストでもないこ
とを示唆している。パケツト音声に関する代表的な論文
としては、スピーチ技術（Speech Technology）の1982
年９月/10月号における、ライデイ・コール（Randy Col
e）による「パケツト音声：戦力化は何時か（When It M
akes Sense）」がある。本発明は、これらの文献に指摘
の限界を克服しようとするものである。
米国において使用されているＴ−１キヤリヤ・システ
ムに関連した時分割多重パルス・コード変調システムを
含む時分割多重（TDM）システムは周知である。PCM通信
は、アナログ音声信号をデイジタル信号に変換し、次に
他の同様の信号とともにタイム・スロツトにおいて組合
わせる回路スイツチングに基づいている。TDMにおい
て、24、30、またはさらに多くのデイバイス信号は時間
的に組合わされ、一般に1.544または2.048Mbpsのビツト
・レートで電話伝送システムを通過する。ビツト・スト
リームの発生は、各タイミング・フレームごとに24のア
ナログ／デイジタル・コンバータのそれぞれのサンプル
を順次走査する結果として生じる。フレームにおける各
24のタイム・スロツトは、別の回路に伝送される。T1・
PCMでは、選択されたタイム・スロツトにフレームを配
置するのに、入りビツト・ストリームをわずかに遅延さ
せることにより、いく分制限された回路スイツチングを
実施することができる。遅延を制御するコマンド・シグ
ナリングは、帯域範囲外とは言え、情報ビツト・ストリ
ームに関連して伝送され得る。普通の回路スイツチング
技術において、伝送時間とスイツチング期間との間の比
率は非常に長い。PCMは、時分割スイツチングと普通の
マトリツクス・スペース分割スイツチングとに適応して
いる（時分割スイツチングは、各タイム・スロツトが異
なる経路を表わしているスイツチングである。スペース
分割スイツチングは、各入力経路が別の出力経路に切換
えられるスイツチングである）。
ムに関連した時分割多重パルス・コード変調システムを
含む時分割多重（TDM）システムは周知である。PCM通信
は、アナログ音声信号をデイジタル信号に変換し、次に
他の同様の信号とともにタイム・スロツトにおいて組合
わせる回路スイツチングに基づいている。TDMにおい
て、24、30、またはさらに多くのデイバイス信号は時間
的に組合わされ、一般に1.544または2.048Mbpsのビツト
・レートで電話伝送システムを通過する。ビツト・スト
リームの発生は、各タイミング・フレームごとに24のア
ナログ／デイジタル・コンバータのそれぞれのサンプル
を順次走査する結果として生じる。フレームにおける各
24のタイム・スロツトは、別の回路に伝送される。T1・
PCMでは、選択されたタイム・スロツトにフレームを配
置するのに、入りビツト・ストリームをわずかに遅延さ
せることにより、いく分制限された回路スイツチングを
実施することができる。遅延を制御するコマンド・シグ
ナリングは、帯域範囲外とは言え、情報ビツト・ストリ
ームに関連して伝送され得る。普通の回路スイツチング
技術において、伝送時間とスイツチング期間との間の比
率は非常に長い。PCMは、時分割スイツチングと普通の
マトリツクス・スペース分割スイツチングとに適応して
いる（時分割スイツチングは、各タイム・スロツトが異
なる経路を表わしているスイツチングである。スペース
分割スイツチングは、各入力経路が別の出力経路に切換
えられるスイツチングである）。
通常の電話システムに関する上述の何れのシステム
も、アナログ電話音声チャネルを、チャネル毎にディジ
タル・パルス・コード変調（PCM）信号に変換するチャ
ネル・バンク・アーキテクチャをとっている。従ってこ
れらのシステムは、２点間（点から点）の経路でのアナ
ログ・ディジタル変換に限られることになる。
も、アナログ電話音声チャネルを、チャネル毎にディジ
タル・パルス・コード変調（PCM）信号に変換するチャ
ネル・バンク・アーキテクチャをとっている。従ってこ
れらのシステムは、２点間（点から点）の経路でのアナ
ログ・ディジタル変換に限られることになる。
本発明は、元来アドレシング機能が考慮に入れられて
いない標準的な通信フォーマットに対応している通信媒
体を用いて、その標準的な通信フォーマットに追加のフ
レーム構造を付加することなしに、アドレッシング（従
ってパケット・ルーチング）機能を持った、音声および
データのパケット化された情報の通信を可能にしようと
するものである。
いない標準的な通信フォーマットに対応している通信媒
体を用いて、その標準的な通信フォーマットに追加のフ
レーム構造を付加することなしに、アドレッシング（従
ってパケット・ルーチング）機能を持った、音声および
データのパケット化された情報の通信を可能にしようと
するものである。
本発明によれば、ディジタル化された音声とデータを
個別パケットで交信するための、次の通りの通信回路網
が提供される。
個別パケットで交信するための、次の通りの通信回路網
が提供される。
すなわち、第１ノードと第２ノードとを少なくとも有
するディジタル通信媒体にして、所定のビット同期のフ
レーム構造（第3B図）を持つ標準化されたビット同期通
信フォーマットに従って、標準化されたビット同期のデ
ィジタル時間フレームで情報を通信するディジタル通信
媒体を備え；ディジタル通信媒体に対してその第１のノ
ードにてディジタル信号を結合する結合手段を備え、こ
の結合手段は信号をパケット化してディジタル化した情
報パケットにするパケット化する手段を含み、そのディ
ジタル化した情報パケットのパケット・フォーマット
（第3A図）が、宛先アドレスの全ての情報および完全な
メッセージユニットを含むとともに、前記ビット同期通
信フォーマットにビット同期していて、前記標準化され
たビット同期のディジタル時間フレームの区切りに従っ
て始まり且つ終わるものである、ようにした通信回路網
が提供される。
するディジタル通信媒体にして、所定のビット同期のフ
レーム構造（第3B図）を持つ標準化されたビット同期通
信フォーマットに従って、標準化されたビット同期のデ
ィジタル時間フレームで情報を通信するディジタル通信
媒体を備え；ディジタル通信媒体に対してその第１のノ
ードにてディジタル信号を結合する結合手段を備え、こ
の結合手段は信号をパケット化してディジタル化した情
報パケットにするパケット化する手段を含み、そのディ
ジタル化した情報パケットのパケット・フォーマット
（第3A図）が、宛先アドレスの全ての情報および完全な
メッセージユニットを含むとともに、前記ビット同期通
信フォーマットにビット同期していて、前記標準化され
たビット同期のディジタル時間フレームの区切りに従っ
て始まり且つ終わるものである、ようにした通信回路網
が提供される。
本発明による装置は、同期パケツト・スイツチングの
真に独立したデイジタル・パケツトの態様で、高容量の
音声兼データ通信を提供する。回路網は、標準化TDMト
ランク・フォーマットと適合し得るもので、かつ音声パ
ケツトのパケツト・スイツチングを十分行なえる速さで
パケツト・フレームにデータをフオーマツト化できるも
のである。
真に独立したデイジタル・パケツトの態様で、高容量の
音声兼データ通信を提供する。回路網は、標準化TDMト
ランク・フォーマットと適合し得るもので、かつ音声パ
ケツトのパケツト・スイツチングを十分行なえる速さで
パケツト・フレームにデータをフオーマツト化できるも
のである。
システムの要素は、情報を標準化パケツトにフオーマ
ツト化しかつこのパケツトを標準化同期通信フオーマツ
トに従つて互いに同期して切換えかつ送る音声／データ
・パケツト・スイツチ（VDPS）を含んでいる。このシス
テムにより、各パケツトの宛先とソースとの間において
各パケツトに関しての遅延が固定した最小のものとな
る。好ましい実施例では、VDPSは標準トランク伝送フレ
ーム・フオーマツト、たとえば1.544MbpsでのAT＆Ｔ標
準DS−１に適合するパケツト・フオーマツトを使用して
いる。
ツト化しかつこのパケツトを標準化同期通信フオーマツ
トに従つて互いに同期して切換えかつ送る音声／データ
・パケツト・スイツチ（VDPS）を含んでいる。このシス
テムにより、各パケツトの宛先とソースとの間において
各パケツトに関しての遅延が固定した最小のものとな
る。好ましい実施例では、VDPSは標準トランク伝送フレ
ーム・フオーマツト、たとえば1.544MbpsでのAT＆Ｔ標
準DS−１に適合するパケツト・フオーマツトを使用して
いる。
音声の高密度化は、サイレンス期間を検出して、双方
向会話状態における通常のサイレンス期間ではパケツト
を送らないことにより得られる。両方の人が同時に話す
ことは殆んどないので、必要とされる伝送パケツトの数
は50％まで減少する。このシステムで使用されるパケツ
トは比較的短い。従つて、音声の通常のとぎれにおいて
サイレンス期間が更に見出されるから、さらに無駄を省
くことができる。
向会話状態における通常のサイレンス期間ではパケツト
を送らないことにより得られる。両方の人が同時に話す
ことは殆んどないので、必要とされる伝送パケツトの数
は50％まで減少する。このシステムで使用されるパケツ
トは比較的短い。従つて、音声の通常のとぎれにおいて
サイレンス期間が更に見出されるから、さらに無駄を省
くことができる。
今日の通常の電話事業では、それぞれ８ビツトの対数
比精度の8,000サンプル／秒か、または約64,000ビツト
／秒のパルス・コード・変調（PCM）として送られる。
好ましい実施例では、64,000ビツト／秒ストリームを、
現在、CCITTドラフト・リコメンデーシヨンG.7xxとして
採用された新しい工業基準に従つて、32,000ビツト／秒
アダプテイブ・パルス・コード変調（ADPCM）に選択に
より変換している。
比精度の8,000サンプル／秒か、または約64,000ビツト
／秒のパルス・コード・変調（PCM）として送られる。
好ましい実施例では、64,000ビツト／秒ストリームを、
現在、CCITTドラフト・リコメンデーシヨンG.7xxとして
採用された新しい工業基準に従つて、32,000ビツト／秒
アダプテイブ・パルス・コード変調（ADPCM）に選択に
より変換している。
これまでのパケツト・スイツチングでは、臨時の遠回
りのルートを生じる適応ルーチングを使用しており、そ
の結果長い遅延となり得る。本発明の好ましい実施例
は、ケーブル・テレビ・システムや普通の電話回路網に
おいて一般に見られるような、階層トリー・アーキテク
チヤに最も適している。
りのルートを生じる適応ルーチングを使用しており、そ
の結果長い遅延となり得る。本発明の好ましい実施例
は、ケーブル・テレビ・システムや普通の電話回路網に
おいて一般に見られるような、階層トリー・アーキテク
チヤに最も適している。
これまでのパケツト・スイツチングは、（巡回冗長検
査の不合格により）欠陥のあるパケツトを検出してそれ
の繰返しを行なう。好ましい実施例では、音声信号を含
んでいるパケツトは特有の方法で識別され、エラーがあ
つても繰返されない。一方、データを内容とするパケツ
トは時間経過に対し敏感でないので繰返され得る。
査の不合格により）欠陥のあるパケツトを検出してそれ
の繰返しを行なう。好ましい実施例では、音声信号を含
んでいるパケツトは特有の方法で識別され、エラーがあ
つても繰返されない。一方、データを内容とするパケツ
トは時間経過に対し敏感でないので繰返され得る。
好ましい実施例は、193ビツトの標準DS−１フレーム
に内蔵されている168ビツトのデータを有している個別
にアドレス可能なパケツトを標準的に使用している。４
−ビツトADPCMに従つて音声をパケツト化しかつコード
化することによりもたらされる遅延は、５−1/4msであ
る。
に内蔵されている168ビツトのデータを有している個別
にアドレス可能なパケツトを標準的に使用している。４
−ビツトADPCMに従つて音声をパケツト化しかつコード
化することによりもたらされる遅延は、５−1/4msであ
る。
VDPSは、電話回路形トラフイツク及びパケツト・スイ
ツチングのトラフイツクの間で時分割され外部グローバ
ルDS−１クロツクに同期されている内部バスを用いるア
ーキテクチヤを使用している。パケツト待機は、コンテ
ンシヨン分析に関してだけ使用される。従つて、パケツ
ト音声回路網を形成するVDPSユニットは、同じグローバ
ル・クロツクに同期されている。この方法で、同期パケ
ツト通信が、記憶及びフオワード・パケツト通信に反し
て、達成できる。
ツチングのトラフイツクの間で時分割され外部グローバ
ルDS−１クロツクに同期されている内部バスを用いるア
ーキテクチヤを使用している。パケツト待機は、コンテ
ンシヨン分析に関してだけ使用される。従つて、パケツ
ト音声回路網を形成するVDPSユニットは、同じグローバ
ル・クロツクに同期されている。この方法で、同期パケ
ツト通信が、記憶及びフオワード・パケツト通信に反し
て、達成できる。
本発明の利点は、同期音声パケツト通信フオーマツト
のモード間でスイツチングができることである。
のモード間でスイツチングができることである。
以下、添付の図面に基づいて、本発明の実施例に関し
説明する。
説明する。
第１図は、本発明による同期パケツト通信回路網12を
用いたシステム10のブロツク図を示している。同期パケ
ツト通信回路網12は、トランク回路マルチプレクサ及び
デマルチプレクサとして動作し以下においてトランクMU
Xまたは音声／データ・パケツト・スイツチ（VDPS、す
なわちVoice/Data Packet Switch）として示されている
複数のモジユラ・ユニツトを含んでいる。本明細書にお
いては、これら用語のいずれかを使用している。第１図
には、第１トランクMUX14,第２トランクMUX16,第３トラ
ンクMUX18が示されており、これらトランクMUXのそれぞ
れは少くとも２つのポートを有しているが、外部トラン
ク・ポート20はトランクMUX14に付随している。また外
部トランク・ポート22はトランクMUX16に付随してい
る。４つの外部トランク・ポート24,26,28,30は、第３
トランクMUX18に付随している（従つて、これはクアド
・トランクMUXと呼称されることがある）。各外部トラ
ンク・ポートは、各部トランクに接続している。第１図
には、外部トランク32,34,36,38,40,42が示されてい
る。外部トランクは、トランクMUXからの普通のフオー
マツトのデイジタルPCM信号を、コンパチブルなPCMトラ
ンク・インターフエイスを有する種々の通信システムに
送る。図示のアナログPBXトランク44は、DS−１形のチ
ヤネル・バンク46と外部トランク36を介して外部トラン
ク・ポート24に接続している。また、別のPBXは、外部
トランク38を介して第３トランクMUX18の外部トランク
・ポート26に直接的に接続したデイジタルPBX48であ
る。第２トランクMUX16は、外部トランク・ポート22か
ら外部トランク34を介してPBX54に接続している。これ
ら様々のPBX及びチヤネル・バンクは、回路網12の外部
ポートとのインターフエイスの実現可能性を単に示すた
めのものである。
用いたシステム10のブロツク図を示している。同期パケ
ツト通信回路網12は、トランク回路マルチプレクサ及び
デマルチプレクサとして動作し以下においてトランクMU
Xまたは音声／データ・パケツト・スイツチ（VDPS、す
なわちVoice/Data Packet Switch）として示されている
複数のモジユラ・ユニツトを含んでいる。本明細書にお
いては、これら用語のいずれかを使用している。第１図
には、第１トランクMUX14,第２トランクMUX16,第３トラ
ンクMUX18が示されており、これらトランクMUXのそれぞ
れは少くとも２つのポートを有しているが、外部トラン
ク・ポート20はトランクMUX14に付随している。また外
部トランク・ポート22はトランクMUX16に付随してい
る。４つの外部トランク・ポート24,26,28,30は、第３
トランクMUX18に付随している（従つて、これはクアド
・トランクMUXと呼称されることがある）。各外部トラ
ンク・ポートは、各部トランクに接続している。第１図
には、外部トランク32,34,36,38,40,42が示されてい
る。外部トランクは、トランクMUXからの普通のフオー
マツトのデイジタルPCM信号を、コンパチブルなPCMトラ
ンク・インターフエイスを有する種々の通信システムに
送る。図示のアナログPBXトランク44は、DS−１形のチ
ヤネル・バンク46と外部トランク36を介して外部トラン
ク・ポート24に接続している。また、別のPBXは、外部
トランク38を介して第３トランクMUX18の外部トランク
・ポート26に直接的に接続したデイジタルPBX48であ
る。第２トランクMUX16は、外部トランク・ポート22か
ら外部トランク34を介してPBX54に接続している。これ
ら様々のPBX及びチヤネル・バンクは、回路網12の外部
ポートとのインターフエイスの実現可能性を単に示すた
めのものである。
様々な電話業務が実現されている。アナログPBX44の
ようなアナログPBXは、たとえば、通常のアナログ電話
機56,58間の通常のアナログ電話信号を切換え、受信
し、かつチヤネル・バンク46へ送る。PBX48のようなデ
イジタルPBXは、デイジタル電話60,62を介して音声信号
を、データ端末64のデイジタル・データ信号とともに、
切換えかつ送受信する。端末64は、コンピユータ66から
離れている。コンピユータ66は、端末64と同様の方法
で、PBX54のようなデイジタルPBXに接続している。デイ
ジタル電話68,70は、デイジタル電話60,62がPBX48を介
してトランクMUX18に接続しているのと同様に、デイジ
タルPBX54に接続している。デイジタル電話72,74は、デ
イジタルPBX50、チヤネル・バンク52を介してトランクM
UX14に接続している。後述するような、パケツト通信指
向のバスを中心に形成されたモジユラー化により高めら
れたユニークな分散化させたインテリジエントをもつ構
成における、ユーザには見えないユニークなパケツト・
フオーマツトの組合せにより、本発明装置との相互接続
には多様性と融通性とが得られる。
ようなアナログPBXは、たとえば、通常のアナログ電話
機56,58間の通常のアナログ電話信号を切換え、受信
し、かつチヤネル・バンク46へ送る。PBX48のようなデ
イジタルPBXは、デイジタル電話60,62を介して音声信号
を、データ端末64のデイジタル・データ信号とともに、
切換えかつ送受信する。端末64は、コンピユータ66から
離れている。コンピユータ66は、端末64と同様の方法
で、PBX54のようなデイジタルPBXに接続している。デイ
ジタル電話68,70は、デイジタル電話60,62がPBX48を介
してトランクMUX18に接続しているのと同様に、デイジ
タルPBX54に接続している。デイジタル電話72,74は、デ
イジタルPBX50、チヤネル・バンク52を介してトランクM
UX14に接続している。後述するような、パケツト通信指
向のバスを中心に形成されたモジユラー化により高めら
れたユニークな分散化させたインテリジエントをもつ構
成における、ユーザには見えないユニークなパケツト・
フオーマツトの組合せにより、本発明装置との相互接続
には多様性と融通性とが得られる。
本発明は、標準的な通信フォーマットが使用されてい
る環境において利用価値のあるパケット回路網であっ
て、遠隔地からシステム構成が可能な、コンピュータを
基礎としたパケット回路網を提供する。ここで言う標準
的な通信フォーマットは、DS−１トランク・フォーマッ
トのような標準化されたビット同期通信フォーマットで
ある。
る環境において利用価値のあるパケット回路網であっ
て、遠隔地からシステム構成が可能な、コンピュータを
基礎としたパケット回路網を提供する。ここで言う標準
的な通信フォーマットは、DS−１トランク・フォーマッ
トのような標準化されたビット同期通信フォーマットで
ある。
標準化されたビット同期通信フォーマットは、通信媒
体におけるビットそれぞれおよびそのフレームの時間的
な同期位置が、通信媒体それ自体により定まっているフ
ォーマットである。（ここで、通信媒体は発信側のノー
ドと受信側のノードの間を意味し、ノードのプロセッサ
内部での経路を意味しない。）そして「標準化された」
ビット同期通信フォーマットと称するのは、そのような
特性を持つ通信媒体が国際的に存在して利用されている
からである（たとえば、Ｔ−１通信プロトコルにおける
DS−１のフォーマット）。DS−１フォーマットは、元
来、フレームそれぞれで24チャネルの時分割多重を採用
するものである。各フレームは、所定のビット長を有し
（ビット位置はそれぞれが正確に分かっている）、所定
のスタート点（特定のビット値）と所定のストップ点
（特定のビット値）などを含む。この通信フォーマット
については、CCITTによる国際標準G.703およびG.704に
詳細が定められている。
体におけるビットそれぞれおよびそのフレームの時間的
な同期位置が、通信媒体それ自体により定まっているフ
ォーマットである。（ここで、通信媒体は発信側のノー
ドと受信側のノードの間を意味し、ノードのプロセッサ
内部での経路を意味しない。）そして「標準化された」
ビット同期通信フォーマットと称するのは、そのような
特性を持つ通信媒体が国際的に存在して利用されている
からである（たとえば、Ｔ−１通信プロトコルにおける
DS−１のフォーマット）。DS−１フォーマットは、元
来、フレームそれぞれで24チャネルの時分割多重を採用
するものである。各フレームは、所定のビット長を有し
（ビット位置はそれぞれが正確に分かっている）、所定
のスタート点（特定のビット値）と所定のストップ点
（特定のビット値）などを含む。この通信フォーマット
については、CCITTによる国際標準G.703およびG.704に
詳細が定められている。
DS−１の基準では、PCM符号化が用いられ、グローバ
ルな同期をとるためのユニバーサル・タイム・クロック
を利用したビット毎の同期がとられている、ビット同期
の通信である。第3B図に示されるようにフレーム長は19
3ビットであり、フレームあたりのデータ容量は192ビッ
ト（１チャネル当たり８ビットで24チャネル分）であ
る。同期パケット回路網12の中央制御は、回路網制御端
末76により行なわれ、この端末は、手動操作のもとで回
路網12の状態を初期設定したり、または状態を変化させ
るのに使用される。通常、パケット回路網12は、外部か
らの介入なしで動作する。回路網制御端末76は、遠隔地
からの別のデータ通信リンク80を介して回路網12に接続
している。これは、専用通信リンク・インターフエイス
を備えている、回路網12のいずれかのトランクMUXに接
続できる。（回路網12における）トランクMUXのどれも
制御端末76に接続できる。構成信号は、制御端末76か
ら、回路網のパケツト・フオーマツトで送られる。
ルな同期をとるためのユニバーサル・タイム・クロック
を利用したビット毎の同期がとられている、ビット同期
の通信である。第3B図に示されるようにフレーム長は19
3ビットであり、フレームあたりのデータ容量は192ビッ
ト（１チャネル当たり８ビットで24チャネル分）であ
る。同期パケット回路網12の中央制御は、回路網制御端
末76により行なわれ、この端末は、手動操作のもとで回
路網12の状態を初期設定したり、または状態を変化させ
るのに使用される。通常、パケット回路網12は、外部か
らの介入なしで動作する。回路網制御端末76は、遠隔地
からの別のデータ通信リンク80を介して回路網12に接続
している。これは、専用通信リンク・インターフエイス
を備えている、回路網12のいずれかのトランクMUXに接
続できる。（回路網12における）トランクMUXのどれも
制御端末76に接続できる。構成信号は、制御端末76か
ら、回路網のパケツト・フオーマツトで送られる。
同期パケツト回路網12は、電話事業において一般に使
用されているようなユニバーサル・タイム・クロツクの
ユニバーサル・タイムに同期している。このため、同期
パケツト回路網12には、ユニバーサル・タイム・クロツ
ク80から入力信号が供給される。米国におけるユニバー
サル・タイム・クロツク信号は、世界的な同期を得る目
的で、米国標準局により発生されている。回路網12にお
いて使用するクロツク信号及びタイミングは、受信され
たDS−１電話トランク信号の、いずれかのフレーム信号
から得られる。たとえば、DS−１キヤリヤ34はフレーム
信号を第２トランクMUX16に供給し、そこから回路網シ
ステム・タイミング信号が得られる。トランクMUX16
は、回路網12の全体にタイミング信号を配分する。
用されているようなユニバーサル・タイム・クロツクの
ユニバーサル・タイムに同期している。このため、同期
パケツト回路網12には、ユニバーサル・タイム・クロツ
ク80から入力信号が供給される。米国におけるユニバー
サル・タイム・クロツク信号は、世界的な同期を得る目
的で、米国標準局により発生されている。回路網12にお
いて使用するクロツク信号及びタイミングは、受信され
たDS−１電話トランク信号の、いずれかのフレーム信号
から得られる。たとえば、DS−１キヤリヤ34はフレーム
信号を第２トランクMUX16に供給し、そこから回路網シ
ステム・タイミング信号が得られる。トランクMUX16
は、回路網12の全体にタイミング信号を配分する。
同期パケツト回路網12は、２地点間Ｔ−１ケーブルと
PCMトランシーバとで形成し得る標準DS−１トランク・
ラインを有している。トランク・ライン82,84,86のよう
なトランク・ラインは、各トランクMUXを相互接続して
いる。本発明では、トランクMUXは、DS−１トランク・
ライン・システムを、高帯域利用におけるデータ兼音声
のスイツチング支援ができるパケツト・スイツチングの
システムに変換する。代表的には、電話事業により使用
されるＴ−１リンクは、1,544,000ビツト／秒の速度で
動作する。普通のDS−１通信では、これらリンクは、8,
000回／秒でサンプルされた24のPCMチヤネルに加えて19
2ビツトごとの初めに余分のフレーミング・ビツトの１
つを送る。192ビツトは、24個の８−ビツトのサンプル
から成り、全193ビツトは１フレームと呼称される。６
番目のフレームごとに、サンプルの大きさは７ビツトに
減少され、それにより残された１ビツトはシグナリング
情報を送るのに使用される。しかし、本発明では、信号
は、普通のDS−１・PCM信号としてではなく、パケツト
として送られるので、Ｔ−１伝送装置により識別できな
い。従つて、通常の電話会社のＴ−１伝送システムのア
ラームを起動させてしまうようなビツトの組合せを避け
る必要がある。このシステムの制限に対処することも本
発明の目的の１つである。
PCMトランシーバとで形成し得る標準DS−１トランク・
ラインを有している。トランク・ライン82,84,86のよう
なトランク・ラインは、各トランクMUXを相互接続して
いる。本発明では、トランクMUXは、DS−１トランク・
ライン・システムを、高帯域利用におけるデータ兼音声
のスイツチング支援ができるパケツト・スイツチングの
システムに変換する。代表的には、電話事業により使用
されるＴ−１リンクは、1,544,000ビツト／秒の速度で
動作する。普通のDS−１通信では、これらリンクは、8,
000回／秒でサンプルされた24のPCMチヤネルに加えて19
2ビツトごとの初めに余分のフレーミング・ビツトの１
つを送る。192ビツトは、24個の８−ビツトのサンプル
から成り、全193ビツトは１フレームと呼称される。６
番目のフレームごとに、サンプルの大きさは７ビツトに
減少され、それにより残された１ビツトはシグナリング
情報を送るのに使用される。しかし、本発明では、信号
は、普通のDS−１・PCM信号としてではなく、パケツト
として送られるので、Ｔ−１伝送装置により識別できな
い。従つて、通常の電話会社のＴ−１伝送システムのア
ラームを起動させてしまうようなビツトの組合せを避け
る必要がある。このシステムの制限に対処することも本
発明の目的の１つである。
普通のDS−１システムと異なり、本発明によるパケッ
ト通信システムでは、トランク・マルチプレキシング・
モードにおいて、DS−１基準の１つのタイム・フレーム
の全体が１つのパケットを形成し、タイム・フレームを
単位としてルート設定（routing）のスイッチングがで
きる。従つて、本発明によるパケツト・スイツチングに
より、DS−１の環境に組み込まれた外部から見えないト
ランスペアレントなパケツト通信が提供される。これ
は、DS−１基準の各フレームを、短いインクリメンタル
的に固定された最大遅延に従う１つの個別にアドレス可
能な通信パケツトに変換することにより可能となる。普
通のDS−１環境における個別にアドレス可能なスイツチ
ングのパケツトは、スイツチド遠隔通信マトリツクスに
おいてこれまで知られていない帯域密度での利用を可能
にする。スイツチド・ルーチングの例としては、端末64
は、２つのルートの１つを介してコンピュータ66へ情報
のパケットを送る。第１のルートは、トランクMUX18と
トランクMUX16の間のトランク・ライン86であり、そし
て、第２ルートは、トランク・ライン84,82である（こ
こで、トランクMUX14は、単にトランク・ライン84,82間
でパケットを送る）。各パケットは、メッセージユニッ
トのみならずルート設定のための宛先アドレスの全ての
情報を含み、かつ、DS−１基準で同期して動作するの
で、音声通信とデータの双方を、ほぼ実時間で、パケッ
ト化されたフォーマットでもってサポートできる。本発
明は、使用されていないトランク・ラインをフレーム分
割のマルチプレキシング基準で使用することができるの
で、DS−１環境での機能帯域の利用度を著しく増加する
ことができる。さらに、情報圧縮技術は、データを圧縮
してＴ−１ケーブルの周波数スペクトルをより良く利用
するのにも使用し得る。
ト通信システムでは、トランク・マルチプレキシング・
モードにおいて、DS−１基準の１つのタイム・フレーム
の全体が１つのパケットを形成し、タイム・フレームを
単位としてルート設定（routing）のスイッチングがで
きる。従つて、本発明によるパケツト・スイツチングに
より、DS−１の環境に組み込まれた外部から見えないト
ランスペアレントなパケツト通信が提供される。これ
は、DS−１基準の各フレームを、短いインクリメンタル
的に固定された最大遅延に従う１つの個別にアドレス可
能な通信パケツトに変換することにより可能となる。普
通のDS−１環境における個別にアドレス可能なスイツチ
ングのパケツトは、スイツチド遠隔通信マトリツクスに
おいてこれまで知られていない帯域密度での利用を可能
にする。スイツチド・ルーチングの例としては、端末64
は、２つのルートの１つを介してコンピュータ66へ情報
のパケットを送る。第１のルートは、トランクMUX18と
トランクMUX16の間のトランク・ライン86であり、そし
て、第２ルートは、トランク・ライン84,82である（こ
こで、トランクMUX14は、単にトランク・ライン84,82間
でパケットを送る）。各パケットは、メッセージユニッ
トのみならずルート設定のための宛先アドレスの全ての
情報を含み、かつ、DS−１基準で同期して動作するの
で、音声通信とデータの双方を、ほぼ実時間で、パケッ
ト化されたフォーマットでもってサポートできる。本発
明は、使用されていないトランク・ラインをフレーム分
割のマルチプレキシング基準で使用することができるの
で、DS−１環境での機能帯域の利用度を著しく増加する
ことができる。さらに、情報圧縮技術は、データを圧縮
してＴ−１ケーブルの周波数スペクトルをより良く利用
するのにも使用し得る。
第２図は、最大構成のトランクMUXすなわち音声及び
データ・パケツト・スイツチ（VDPS）18のブロツク図を
示している。これは、DS−１信号の８つのライン・イン
ターフエイスを相互接続するのに使用し得るタイプのト
ランクMUXである。各VDPSを、DS−１トランク・ライン
・インターフエイス、非DS−１・インターフエイス、及
び制御インターフエイスの見地から特定のモードの要求
を満足するよう拡張し得るように、アーキテクチヤはモ
ジユラー化されている。ここでは、簡単化のため、DS−
１インターフエイスだけを示している。これは、高速度
バス、すなわちMUXBUS90を中心にしてモジユラー化され
ている。
データ・パケツト・スイツチ（VDPS）18のブロツク図を
示している。これは、DS−１信号の８つのライン・イン
ターフエイスを相互接続するのに使用し得るタイプのト
ランクMUXである。各VDPSを、DS−１トランク・ライン
・インターフエイス、非DS−１・インターフエイス、及
び制御インターフエイスの見地から特定のモードの要求
を満足するよう拡張し得るように、アーキテクチヤはモ
ジユラー化されている。ここでは、簡単化のため、DS−
１インターフエイスだけを示している。これは、高速度
バス、すなわちMUXBUS90を中心にしてモジユラー化され
ている。
VDPS18は、保護インターフエイス・カード（PIC、す
なわちProtection Interface Card）92（第９図にも示
されている）を介して、外部環境に交信する。PIC92
は、レシーバとして動作する第１トランク・トランシー
バ94へ、入り信号をルーチングしかつトランスミツタと
して動作する第２トランク・トランシーバ96に出信号を
ルーチングするトランク・ラインのポートを有してい
る。また、PIC92は同期を得るよう動作する。同期信号
は、同期入力ライン98を介して、内部制御ユニツト、す
なわちパケツト制御カード（PCC、すなわちPacket Cont
rol Card）100に送られる。PCC100は、ソース及び宛先
の装置、たとえば、２つのポート間、ポートとVDPS18に
おけるデイバイス間、またはVDPS18における２つのデイ
バイス間において、MUXBUS90でルーチングする時間多重
パケツトを形成する。PCC100は、また、VDPS16のシステ
ム構成を形成する。MUXBUSは、２つのモード、すなわち
パケツトモード及び回路モードに関する２つの時間多重
バスとして動作する。
なわちProtection Interface Card）92（第９図にも示
されている）を介して、外部環境に交信する。PIC92
は、レシーバとして動作する第１トランク・トランシー
バ94へ、入り信号をルーチングしかつトランスミツタと
して動作する第２トランク・トランシーバ96に出信号を
ルーチングするトランク・ラインのポートを有してい
る。また、PIC92は同期を得るよう動作する。同期信号
は、同期入力ライン98を介して、内部制御ユニツト、す
なわちパケツト制御カード（PCC、すなわちPacket Cont
rol Card）100に送られる。PCC100は、ソース及び宛先
の装置、たとえば、２つのポート間、ポートとVDPS18に
おけるデイバイス間、またはVDPS18における２つのデイ
バイス間において、MUXBUS90でルーチングする時間多重
パケツトを形成する。PCC100は、また、VDPS16のシステ
ム構成を形成する。MUXBUSは、２つのモード、すなわち
パケツトモード及び回路モードに関する２つの時間多重
バスとして動作する。
VDPSは、独立して動作可能な制御処理装置（CPU）を
それぞれ有するいくつかのカードすなわちサブシステム
を含んでいる。制御バス102は、VDPS内でのCPU−CPU連
絡を行なう。内部システム・ハウスキーピングは、回路
モードのMUXBUS90に接続し、かつ数値アドレス・アサイ
ンメントにより、相互通信の目的のために識別可能であ
る。PCC100は、各カードに関するアドレスのアサインメ
ントと、MUXBUS90に形成されるタイム・スロツトに対す
るアドレスの割当てを制御する。音声／データ・プロセ
ツサ（VDP、すなわちVoice/Data Processor）103も、MU
XBUS90に接続している。これは、トランク・ライン間で
の配分のため、パケツトの音声情報を圧縮（コンプレツ
ス）及び圧縮解除（デコンプレツス）する。VDP103は、
より精確には、パケツト・クリエータ及びデイスアセン
ブラである。VDP103は、システムに遅延を生じさせる。
この遅延は、最小限度でかつ有限であり、一般に13ms以
下である。タイム・スロツト・クオリフアイヤ線106
は、パケツト・モードと回路モードを区別するため、VD
PS18に内部同期を与える。
それぞれ有するいくつかのカードすなわちサブシステム
を含んでいる。制御バス102は、VDPS内でのCPU−CPU連
絡を行なう。内部システム・ハウスキーピングは、回路
モードのMUXBUS90に接続し、かつ数値アドレス・アサイ
ンメントにより、相互通信の目的のために識別可能であ
る。PCC100は、各カードに関するアドレスのアサインメ
ントと、MUXBUS90に形成されるタイム・スロツトに対す
るアドレスの割当てを制御する。音声／データ・プロセ
ツサ（VDP、すなわちVoice/Data Processor）103も、MU
XBUS90に接続している。これは、トランク・ライン間で
の配分のため、パケツトの音声情報を圧縮（コンプレツ
ス）及び圧縮解除（デコンプレツス）する。VDP103は、
より精確には、パケツト・クリエータ及びデイスアセン
ブラである。VDP103は、システムに遅延を生じさせる。
この遅延は、最小限度でかつ有限であり、一般に13ms以
下である。タイム・スロツト・クオリフアイヤ線106
は、パケツト・モードと回路モードを区別するため、VD
PS18に内部同期を与える。
第3A図は本発明によるパケット情報パケットの構造を
示す。一方、第3B図は、１チャネル当たりが８ビットの
サンプルで、24チャネルが一連になったDS−１のフレー
ムを示している。ベル・システム・コンパテイビイリテ
イ・カタログ・ナンバ119に示されているようなDS−１
の標準トランク・フレームは、1.544MHzのクロツク・レ
ートに相当する1.544bpsのデータ・レートの193PCMビツ
トである。本発明においては、全フレームが１つのパケ
ツトを形成している。第１ビツトは標準DS−１フレーミ
ング・ビツトで、次の24ビツトはパケツトのオーバヘツ
ド機能のために用いられる。そして168ビツトがメッセ
ージユニットで、音声またはデータの内容の伝送に使用
される。特に、24ビツトのうちの16ビツトはパケツトの
宛先の装置アドレス情報に関し、６ビツトはハミング・
エラー・修正コード（HE）に関し、１ビツトは優先順位
に関し、かつ１ビツトはスペアである。各バケツトにお
ける情報は、単一の宛先装置に向けられ、かつ割当てら
れるフレームとは独立している。普通のDS−１フオーマ
ツトはパケツト化データ流に使用されるので、転送ビツ
ト・レートへのパケツトの同期は非常に簡単化される。
示す。一方、第3B図は、１チャネル当たりが８ビットの
サンプルで、24チャネルが一連になったDS−１のフレー
ムを示している。ベル・システム・コンパテイビイリテ
イ・カタログ・ナンバ119に示されているようなDS−１
の標準トランク・フレームは、1.544MHzのクロツク・レ
ートに相当する1.544bpsのデータ・レートの193PCMビツ
トである。本発明においては、全フレームが１つのパケ
ツトを形成している。第１ビツトは標準DS−１フレーミ
ング・ビツトで、次の24ビツトはパケツトのオーバヘツ
ド機能のために用いられる。そして168ビツトがメッセ
ージユニットで、音声またはデータの内容の伝送に使用
される。特に、24ビツトのうちの16ビツトはパケツトの
宛先の装置アドレス情報に関し、６ビツトはハミング・
エラー・修正コード（HE）に関し、１ビツトは優先順位
に関し、かつ１ビツトはスペアである。各バケツトにお
ける情報は、単一の宛先装置に向けられ、かつ割当てら
れるフレームとは独立している。普通のDS−１フオーマ
ツトはパケツト化データ流に使用されるので、転送ビツ
ト・レートへのパケツトの同期は非常に簡単化される。
動作において、トランクのような外部ソースからの情
報は、保護インターフエイス・カード92を介して受信さ
れ、待機させられ、割当ての回路モード・フレームにお
いてMUXBUS90へ送られる。次に、フレームはVDP103によ
りパケツト化され、待機させられ、かつ割当てられたパ
ケツト・モード・フレームにおいてMUXBUS90に再び送ら
れる。各パケツトは、同期バス・サイクルのタイム・ス
ロツト・アロケーシヨン（割当て）に基づいて、後述す
るようなMUXBUS90に接続した各ユニツトまたはカードに
より読出されるか、または無視される。パケツトは宛先
アドレスを含んでいる。パケツトはトランシーバにより
最終的に読出され、トランシーバは、回路網12（第１
図）を介して、そのパケツト・アドレスで指定された宛
先装置へ配分するために内部トランク・ラインへパケツ
トを送る。
報は、保護インターフエイス・カード92を介して受信さ
れ、待機させられ、割当ての回路モード・フレームにお
いてMUXBUS90へ送られる。次に、フレームはVDP103によ
りパケツト化され、待機させられ、かつ割当てられたパ
ケツト・モード・フレームにおいてMUXBUS90に再び送ら
れる。各パケツトは、同期バス・サイクルのタイム・ス
ロツト・アロケーシヨン（割当て）に基づいて、後述す
るようなMUXBUS90に接続した各ユニツトまたはカードに
より読出されるか、または無視される。パケツトは宛先
アドレスを含んでいる。パケツトはトランシーバにより
最終的に読出され、トランシーバは、回路網12（第１
図）を介して、そのパケツト・アドレスで指定された宛
先装置へ配分するために内部トランク・ラインへパケツ
トを送る。
タイム・スロツト・アロケーシヨンは、VDPS18に関し
て内部の、パケツト・モードでアドレスする宛先装置を
決定する。タイム・スロツト・アロケーシヨンは、VDPS
18の初期構成の後に、PCC100により行なわれる。音声ま
たはデータパケツトのスタテイツク・アロケーシヨンの
ためカードはパケツトの内容を音声としてかデータ形情
報としてかの何れの翻訳をするかを自動的に認識する。
て内部の、パケツト・モードでアドレスする宛先装置を
決定する。タイム・スロツト・アロケーシヨンは、VDPS
18の初期構成の後に、PCC100により行なわれる。音声ま
たはデータパケツトのスタテイツク・アロケーシヨンの
ためカードはパケツトの内容を音声としてかデータ形情
報としてかの何れの翻訳をするかを自動的に認識する。
優先順位に従つて、情報は待機させられる。音声形情
報がパケツトの喪失にあまり敏感でないので、データ形
情報は音声形情報よりも高い優先順位を割当てられる。
MUXBUS90は、適当な制御のもとで、２つ以上の外部トラ
ンクからの情報を単一の回路網トランクにルーチングし
て、トランク・ライン・スペクトルの利用を最大にする
ことができる。最高４から１のトランク圧縮が考えられ
ている。
報がパケツトの喪失にあまり敏感でないので、データ形
情報は音声形情報よりも高い優先順位を割当てられる。
MUXBUS90は、適当な制御のもとで、２つ以上の外部トラ
ンクからの情報を単一の回路網トランクにルーチングし
て、トランク・ライン・スペクトルの利用を最大にする
ことができる。最高４から１のトランク圧縮が考えられ
ている。
MUXBUS90は、本来的に並列データバスであり、直列化
された情報は、MUXBUS90に接続されたカード間での交換
のため並列に変換される。パケツト化されていないデー
タは、当初、回路モードでMUXBUSに送られ、その後、パ
ケツト化されかつ場合によつては圧縮される。続いてこ
のように処理されたデータがパケツト・モードで１パケ
ツトとしてMUSBUX90に再び現われ、MUXBUS90を介して最
終的にトランク・トランシーバ94または96へ送られる。
制御及びシグナリング信号は、MUXBUSを介して送られ
る。たとえばパケツト化制御シグナリング信号は回路網
12を通じてPCC100間で交換される。
された情報は、MUXBUS90に接続されたカード間での交換
のため並列に変換される。パケツト化されていないデー
タは、当初、回路モードでMUXBUSに送られ、その後、パ
ケツト化されかつ場合によつては圧縮される。続いてこ
のように処理されたデータがパケツト・モードで１パケ
ツトとしてMUSBUX90に再び現われ、MUXBUS90を介して最
終的にトランク・トランシーバ94または96へ送られる。
制御及びシグナリング信号は、MUXBUSを介して送られ
る。たとえばパケツト化制御シグナリング信号は回路網
12を通じてPCC100間で交換される。
第４図は、本発明に従つてMUXBUS90に接続したPCC100
のブロツク図を示している。PCC100は、マイクロプロセ
ツサ・システム110の周囲に形成された小型コンピユー
タである。マイクロプロセツサ・システム110には、シ
ステム・データ・バス112、システム・アドレス・バス1
14（制御線を含む）、システム・データ・バス及び制御
線などによりアクセス可能な種々の他の普通の構造を有
している。タイミングは、MUXBUS90を介して外部マスタ
同期クロツクに接続した同期ユニツト116から得られ
る。同期ユニツト116は、外部マスタ・クロツクの接続
外れまたは故障の場合に、フエーズ・ロツクド発振器の
制御に使用する水晶（図示せず）を伴つた普通のフエー
ズ・ロツクド発振器（図示せず）を含む。マスタ・クロ
ツクは、同期クロツク線118を介して、万国標準時から
得られた8.192MHzのクロツク信号を発生する。同期ユニ
ツトは、システム・クロツク線120とバス・クロツク線1
22を介して8.192MHzのクロツクをマイクロプロセツサ・
システム110に送る。バス・クロツク線は、MUXBUSコン
トローラ124に4.096MHzのクロツクを送る。この機能に
ついては後述する。
のブロツク図を示している。PCC100は、マイクロプロセ
ツサ・システム110の周囲に形成された小型コンピユー
タである。マイクロプロセツサ・システム110には、シ
ステム・データ・バス112、システム・アドレス・バス1
14（制御線を含む）、システム・データ・バス及び制御
線などによりアクセス可能な種々の他の普通の構造を有
している。タイミングは、MUXBUS90を介して外部マスタ
同期クロツクに接続した同期ユニツト116から得られ
る。同期ユニツト116は、外部マスタ・クロツクの接続
外れまたは故障の場合に、フエーズ・ロツクド発振器の
制御に使用する水晶（図示せず）を伴つた普通のフエー
ズ・ロツクド発振器（図示せず）を含む。マスタ・クロ
ツクは、同期クロツク線118を介して、万国標準時から
得られた8.192MHzのクロツク信号を発生する。同期ユニ
ツトは、システム・クロツク線120とバス・クロツク線1
22を介して8.192MHzのクロツクをマイクロプロセツサ・
システム110に送る。バス・クロツク線は、MUXBUSコン
トローラ124に4.096MHzのクロツクを送る。この機能に
ついては後述する。
同期ユニツト116は、標準PCM同期技術を使用してい
る。これは、Ｔ−１トランク・タイミングを比較する
か、またはローカル・システム・クロツクをユニバーサ
ル・クロツクと同期させるのに必要な内部クリスタル・
タイミングを発生する。
る。これは、Ｔ−１トランク・タイミングを比較する
か、またはローカル・システム・クロツクをユニバーサ
ル・クロツクと同期させるのに必要な内部クリスタル・
タイミングを発生する。
マイクロプロセツサ・システム110は、モトローラ社
製68000フアミリの１つである16/32−ビツト・マイクロ
プロセツサ・ユニツトを中心に構成するのが望ましい。
マイクロプロセツサ・システム110は、本発明によるア
ドレス・ルーチングの目的を果すように構成されてい
る。システム110とシステム・データ・バス及びシステ
ム・アドレス・バスに関連した素子とは、プロセシング
に関して自己充足形に設計されている。従つて、オペレ
ーテイング・システムは、システムROM125に記憶されて
いることが望ましい。データは、システムRAM126に記憶
されている。システムRAM126は、データの揮発性を最小
にするため、電気的消去可能なプログラム可能読出し専
用メモリを含んでいる。システムROM125の代表的な寸法
は128Kバイトである。システムRAM126の代表的な寸法は
64Kバイトである。
製68000フアミリの１つである16/32−ビツト・マイクロ
プロセツサ・ユニツトを中心に構成するのが望ましい。
マイクロプロセツサ・システム110は、本発明によるア
ドレス・ルーチングの目的を果すように構成されてい
る。システム110とシステム・データ・バス及びシステ
ム・アドレス・バスに関連した素子とは、プロセシング
に関して自己充足形に設計されている。従つて、オペレ
ーテイング・システムは、システムROM125に記憶されて
いることが望ましい。データは、システムRAM126に記憶
されている。システムRAM126は、データの揮発性を最小
にするため、電気的消去可能なプログラム可能読出し専
用メモリを含んでいる。システムROM125の代表的な寸法
は128Kバイトである。システムRAM126の代表的な寸法は
64Kバイトである。
68000フアミリ・マイクロコンピユータの機能を実行
するのに種々のオペレーテイング・システムが開発され
ている。このようなマイクロプロセツサ・システム110
を使用した構成の実現は、一旦機能が定義されると比較
的簡単なプログラミングである。従つて、このような機
能は設計上の事項であるので、PCC100及びそれに関連し
た機能を制御するソフトウエアの実際のコーテイングや
オペレーテイング・システムについての詳細な説明は不
必要である。それでも、パケツト通信システムの構成は
本明細書に明らかにされているので、構成及びシステム
仕様書は、本発明への貢献を表わしていることがわか
る。
するのに種々のオペレーテイング・システムが開発され
ている。このようなマイクロプロセツサ・システム110
を使用した構成の実現は、一旦機能が定義されると比較
的簡単なプログラミングである。従つて、このような機
能は設計上の事項であるので、PCC100及びそれに関連し
た機能を制御するソフトウエアの実際のコーテイングや
オペレーテイング・システムについての詳細な説明は不
必要である。それでも、パケツト通信システムの構成は
本明細書に明らかにされているので、構成及びシステム
仕様書は、本発明への貢献を表わしていることがわか
る。
PCC100は、RS−232Cポートを有する直列インターフエ
イス128と、直列制御バス102（第２図）との入出力のた
めの制御バス・インターフエイス130と、MUXBUS90を介
して入出力するよう設定されたアラーム及びステータス
論理インターフエイス132（オプシヨン）と、及びMUXBU
SにおけるI/O機能を制御する先入れ／先出し（FIFO）ユ
ニツト138,140とをさらに有している。MUXBUSにおけるI
/Oを制御するユニツト138,140は、MUXBUS90に接続した
クロツク（CLKS），アドレス（ADR），及びデータ・ラ
インを伴うパケツト・レシーバ134、またはMUXBUS90に
接続したクロツク（CLKS），アドレス（ADR），及びデ
ータ・バスを伴うパケツト・トランスミツタ136に接続
している。FIFOユニツト138,140は、先入れ／先出しメ
モリを含む標準的なパーツであり、これは読出しアドレ
ス命令または書込みアドレス命令に応答する。PCC100に
向けてアドレスされたパケツトは、パケツト・レシーバ
134を介して受信される。PCC100で生じたパケツトは、F
IFOユニツト140で待機させられかつパケツト・トランス
ミツタ136を介してMUXBUS90に送られる。
イス128と、直列制御バス102（第２図）との入出力のた
めの制御バス・インターフエイス130と、MUXBUS90を介
して入出力するよう設定されたアラーム及びステータス
論理インターフエイス132（オプシヨン）と、及びMUXBU
SにおけるI/O機能を制御する先入れ／先出し（FIFO）ユ
ニツト138,140とをさらに有している。MUXBUSにおけるI
/Oを制御するユニツト138,140は、MUXBUS90に接続した
クロツク（CLKS），アドレス（ADR），及びデータ・ラ
インを伴うパケツト・レシーバ134、またはMUXBUS90に
接続したクロツク（CLKS），アドレス（ADR），及びデ
ータ・バスを伴うパケツト・トランスミツタ136に接続
している。FIFOユニツト138,140は、先入れ／先出しメ
モリを含む標準的なパーツであり、これは読出しアドレ
ス命令または書込みアドレス命令に応答する。PCC100に
向けてアドレスされたパケツトは、パケツト・レシーバ
134を介して受信される。PCC100で生じたパケツトは、F
IFOユニツト140で待機させられかつパケツト・トランス
ミツタ136を介してMUXBUS90に送られる。
重要な要素は、MUXBUSコントローラ124である。汎用
中央処理装置におけるコントローラは普通のデイジタル
論理デバイスであるが、このMUXBUSコントローラ124
は、後述するように、特定の予め選択されたビツト・パ
ターンを表わすように、及びバス・クロツクを発生する
ように応動するテーブル駆動デイバイスである。
中央処理装置におけるコントローラは普通のデイジタル
論理デバイスであるが、このMUXBUSコントローラ124
は、後述するように、特定の予め選択されたビツト・パ
ターンを表わすように、及びバス・クロツクを発生する
ように応動するテーブル駆動デイバイスである。
PCC100は、次のような機能を行う。すなわち、割込み
制御機構及びタイミングを含むシステム制御と、全トラ
ンク信号を同期させるクロツク信号を含む、MUXBUS90に
おいて使用される全クロツクの発生と、MUXBUS90の仲裁
制御と、MUXBUS90のエラー制御（パリテイ）と、（シス
テムマネージヤに関する）直列インターフエイス128と
のインターフエイスと、VDPS16における非パケツト化制
御機能に関する制御バス130へのインターフエイスと、
アラーム及びステータス論理ユニツト132を介するシス
テム・ステータス及びアラームの検出及び発生と、トラ
ンク・ラインのインテグリテイを保持しかつVDPS16を構
成するハウスキーピング制御と、たとえば遠隔システム
・マネージヤにより発生されるような、VDPS16から離れ
た制御ユニツトとの制御通信のためのMUXBUS90へのパケ
ツト・インターフエイスとを行なう。
制御機構及びタイミングを含むシステム制御と、全トラ
ンク信号を同期させるクロツク信号を含む、MUXBUS90に
おいて使用される全クロツクの発生と、MUXBUS90の仲裁
制御と、MUXBUS90のエラー制御（パリテイ）と、（シス
テムマネージヤに関する）直列インターフエイス128と
のインターフエイスと、VDPS16における非パケツト化制
御機能に関する制御バス130へのインターフエイスと、
アラーム及びステータス論理ユニツト132を介するシス
テム・ステータス及びアラームの検出及び発生と、トラ
ンク・ラインのインテグリテイを保持しかつVDPS16を構
成するハウスキーピング制御と、たとえば遠隔システム
・マネージヤにより発生されるような、VDPS16から離れ
た制御ユニツトとの制御通信のためのMUXBUS90へのパケ
ツト・インターフエイスとを行なう。
PCC100における融通性を保持するため、システム・デ
ータ・バス112及びシステム・アドレス・バス114を拡張
する拡張ポート113が設けられている。このような拡張
ポートは、制御，ハウスキーピング，及びメモリの付加
などに対する他のユニツトの付加を考慮したものであ
る。
ータ・バス112及びシステム・アドレス・バス114を拡張
する拡張ポート113が設けられている。このような拡張
ポートは、制御，ハウスキーピング，及びメモリの付加
などに対する他のユニツトの付加を考慮したものであ
る。
本発明において、MUXBUSコントローラ124は、バス・
クロツク122と同期して、あらかじめ定義された一連の
アドレス及びデータ・ワードを並列MUXBUS90に発生す
る。各読出しアドレス及び書込みアドレスは、タイム・
スロツト当り１回割当てられる。本実施例では、12個の
並列ビツトが書込みアドレスに対して与えられ、12個の
並列ビツトが読出しアドレスに対して与えられ、１ビツ
トがパケツト・モード及び回路モード間でMUXBUSのタイ
ム・スロツト割当てを定義する。バス・クロツクと同期
して、並列読出しアドレス線の読出しアドレスと並列書
込みアドレス線の書込みアドレスとともに、タイム・ス
ロツト・クオリフアイヤ線106のタイム・スロツト・ク
オリフアイヤ・ビツトを発生することにより、本発明に
よるパケツト・スイツチングが行なわれる。本実施例に
おいて、512のタイム・スロツトが、125マイクロ秒の標
準化フレーム継続期間ごとに発生される。マイクロプロ
セツサ110の機能は、主に、パケツト・スイツチを定義
するアドレス・テーブルを供給することである。MUXBUS
コントローラ124は、MUXBUS90へアドレス・テーブルを
クロツクで送る。MUXBUS90は、タイム・スロツト・クオ
リフアイヤ線106の設定に従つて回路及びパケツト・タ
イム・スロツト間での時分割を行なう。たとえば、タイ
ム・スロツト・クオリフアイヤ線106が高状態にある場
合、MUXBUS90はパケツト・タイム・スロツトに割当てら
れる。タイム・スロツト・クオリフアイヤ線106が低状
態にある場合、MUXBUSは回路モードに割当てられる。第
５図は、MUXBUSタイミングと信号の関係を示している。
MUXBUSサイクルは、244ナノ秒で、125マイクロ秒フレー
ム当り512のMUXBUSタイム・スロツトを定義する。従つ
て、フレーム・クロツクは8KHzで動作する。
クロツク122と同期して、あらかじめ定義された一連の
アドレス及びデータ・ワードを並列MUXBUS90に発生す
る。各読出しアドレス及び書込みアドレスは、タイム・
スロツト当り１回割当てられる。本実施例では、12個の
並列ビツトが書込みアドレスに対して与えられ、12個の
並列ビツトが読出しアドレスに対して与えられ、１ビツ
トがパケツト・モード及び回路モード間でMUXBUSのタイ
ム・スロツト割当てを定義する。バス・クロツクと同期
して、並列読出しアドレス線の読出しアドレスと並列書
込みアドレス線の書込みアドレスとともに、タイム・ス
ロツト・クオリフアイヤ線106のタイム・スロツト・ク
オリフアイヤ・ビツトを発生することにより、本発明に
よるパケツト・スイツチングが行なわれる。本実施例に
おいて、512のタイム・スロツトが、125マイクロ秒の標
準化フレーム継続期間ごとに発生される。マイクロプロ
セツサ110の機能は、主に、パケツト・スイツチを定義
するアドレス・テーブルを供給することである。MUXBUS
コントローラ124は、MUXBUS90へアドレス・テーブルを
クロツクで送る。MUXBUS90は、タイム・スロツト・クオ
リフアイヤ線106の設定に従つて回路及びパケツト・タ
イム・スロツト間での時分割を行なう。たとえば、タイ
ム・スロツト・クオリフアイヤ線106が高状態にある場
合、MUXBUS90はパケツト・タイム・スロツトに割当てら
れる。タイム・スロツト・クオリフアイヤ線106が低状
態にある場合、MUXBUSは回路モードに割当てられる。第
５図は、MUXBUSタイミングと信号の関係を示している。
MUXBUSサイクルは、244ナノ秒で、125マイクロ秒フレー
ム当り512のMUXBUSタイム・スロツトを定義する。従つ
て、フレーム・クロツクは8KHzで動作する。
本実施例では、MUXBUS90は、３つの並列線群、いくつ
かのタイプのクロツク線及びいくつかのタイプの制御線
とから成る。たとえば、MUXBUS90は次のものを含んでい
る。すなわち、12ビツトの読出しアドレス線群と、12ビ
ツトの書込みアドレス線群と、８ビツトのデータ線群
と、8.192MHzで動作するバスクロツクに関するバス・サ
イクル・クロツク線と、4.096MHzで動作するデータ伝送
クロツク線と、MUXBUS90におけるフレーミングを定義す
るのに使用するため、ユニバーサル・タイム・クロツク
と同期して8KHzで動作するクロツクに関するフレーム・
クロツク線と、パケツト・サイクルと回路サイクルを区
別する信号を送るタイム・スロツト・クオリフアイヤ線
106と、パケツトを受信するのに使用し得る十分な待機
スペースがないことを表わすアボート信号を発生するよ
うMUXBUS90に接続したパケツト・レシーバにより用いら
れるパケツト・アボート線と、回路を初期設定またはリ
セツトする信号を送るのに使用されるリセツト線とを含
んでいる。さらに、MUXBUS90には、システムのサブシス
テム間での直線通信するのに使用される直列多重アクセ
ス線である制御バスが接続されている。バツクアツプMU
XBUSがある十分な冗長システムにおいては、どのMUXBUS
がアクテイブであるのかを定義するバス選択線が設けら
れている。
かのタイプのクロツク線及びいくつかのタイプの制御線
とから成る。たとえば、MUXBUS90は次のものを含んでい
る。すなわち、12ビツトの読出しアドレス線群と、12ビ
ツトの書込みアドレス線群と、８ビツトのデータ線群
と、8.192MHzで動作するバスクロツクに関するバス・サ
イクル・クロツク線と、4.096MHzで動作するデータ伝送
クロツク線と、MUXBUS90におけるフレーミングを定義す
るのに使用するため、ユニバーサル・タイム・クロツク
と同期して8KHzで動作するクロツクに関するフレーム・
クロツク線と、パケツト・サイクルと回路サイクルを区
別する信号を送るタイム・スロツト・クオリフアイヤ線
106と、パケツトを受信するのに使用し得る十分な待機
スペースがないことを表わすアボート信号を発生するよ
うMUXBUS90に接続したパケツト・レシーバにより用いら
れるパケツト・アボート線と、回路を初期設定またはリ
セツトする信号を送るのに使用されるリセツト線とを含
んでいる。さらに、MUXBUS90には、システムのサブシス
テム間での直線通信するのに使用される直列多重アクセ
ス線である制御バスが接続されている。バツクアツプMU
XBUSがある十分な冗長システムにおいては、どのMUXBUS
がアクテイブであるのかを定義するバス選択線が設けら
れている。
第５図は、MUXBUS90の動作を示したタイミング図であ
る。読出しアドレスと書込みアドレスは、バス・クロッ
ク信号SCLKの第１降下縁部で各MUXBUSサイクルごとに各
線群RADDR及びWADDRにそれぞれ書込まれる。バスにおけ
る各サブシステムは、バス・クロツク信号RCLKの次の上
昇縁部でアドレスをラツチする。アドレスのラツチに続
く１タイム・スロツトにおいて、書込みアドレス・バス
WADDRによりアドレスされたサブシステムは、一般に遅
延バスクロツクRCLKの上昇縁部で、データ線群DBにデー
タを送る。
る。読出しアドレスと書込みアドレスは、バス・クロッ
ク信号SCLKの第１降下縁部で各MUXBUSサイクルごとに各
線群RADDR及びWADDRにそれぞれ書込まれる。バスにおけ
る各サブシステムは、バス・クロツク信号RCLKの次の上
昇縁部でアドレスをラツチする。アドレスのラツチに続
く１タイム・スロツトにおいて、書込みアドレス・バス
WADDRによりアドレスされたサブシステムは、一般に遅
延バスクロツクRCLKの上昇縁部で、データ線群DBにデー
タを送る。
タイム・スロツト・クオリフアイヤ線を制御するパケ
ツト制御カード100は、タイム・スロツト・クオリフア
イヤ信号PTSを任意に構成する。従つて、タイム・スロ
ツト・クオリフアイヤ信号は、パケツトにおける全情報
を伝送するのに必要とされるのと同数のバス・サイクル
において、そのパケツト状態に保持される。
ツト制御カード100は、タイム・スロツト・クオリフア
イヤ信号PTSを任意に構成する。従つて、タイム・スロ
ツト・クオリフアイヤ信号は、パケツトにおける全情報
を伝送するのに必要とされるのと同数のバス・サイクル
において、そのパケツト状態に保持される。
書込みアドレスは、MUXBUSにパケツト情報を送るのに
必要とされるサブシステムのアドレスを表わす全情報を
含んでいる。１つのビツトは現在の書込みアドレスがパ
ケツトの開始にあることを表わし、かつ１つのビツトは
現在の書込みアドレスがパケツトの終了にあることを表
わしている。第６図は、パケツト・モード動作におけ
る、MUXBUSコントローラ124（第４図）に記憶されてい
る代表的な接続テーブルの構成を示している。この接続
テーブルは、MUXBUSコントローラ124のランダム・アク
セス・メモリに記憶されている。MUXBUSコントローラ
は、MUXBUS90にアドレス及びデータを供給するバス・ク
ロツク速度で、接続テーブルにより、インクリメントす
るクロツク制御のもとで動作する。重要なことは、アド
レスはMUXBUSコントローラ124により発生され、かつデ
ータ・パケツトは、アドレスされたすなわちソース・サ
ブシステムからバスに送られることである。第６図は、
タイム・スロツト・クオリフアイヤ線と、書込みアドレ
ス線群すなわちバスと、読出しアドレス線群すなわちバ
スと、及びデータ・バスとに関するテーブルの構成を示
している。書込みアドレス・バスには、データ・バスに
より送られるパケツトに関するソース・アドレス情報を
含む12個の位置を含む表が対応する。本実施例では、ア
ドレスは２つのフイールドで構成されている。すなわち
ソース・サブシステム・アドレス・カード・アドレスに
関する第１フイールドと、ソース・サブシステムすなわ
ちスイツチ・アドレスに関する第２フイールドとで構成
されている。ソース・サブシステム・スイツチは、カー
ドにおける特定の要素へのアドレスである。接続テーブ
ルにおける１つのビツト位置は、パケツト開始（ビツト
６）を示すためのものであり、他の１つのビツト位置は
パケツト終了（ビツト５）を示すためのものである。タ
イム・スロツト・クオリフアイヤ・ビツト（ビツト12）
により示された、パケツト・モードにおけるパケツト開
始ビツト及びパケツト終了ビツト間の全アドレスは１つ
のパケツトに関するアドレスを定義する。従つて、ソー
ス・サブシステム・カード・アドレス及びソース・サブ
システム・スイツチ・アドレスはパケツト開始及びパケ
ツト終了間で変化しない。
必要とされるサブシステムのアドレスを表わす全情報を
含んでいる。１つのビツトは現在の書込みアドレスがパ
ケツトの開始にあることを表わし、かつ１つのビツトは
現在の書込みアドレスがパケツトの終了にあることを表
わしている。第６図は、パケツト・モード動作におけ
る、MUXBUSコントローラ124（第４図）に記憶されてい
る代表的な接続テーブルの構成を示している。この接続
テーブルは、MUXBUSコントローラ124のランダム・アク
セス・メモリに記憶されている。MUXBUSコントローラ
は、MUXBUS90にアドレス及びデータを供給するバス・ク
ロツク速度で、接続テーブルにより、インクリメントす
るクロツク制御のもとで動作する。重要なことは、アド
レスはMUXBUSコントローラ124により発生され、かつデ
ータ・パケツトは、アドレスされたすなわちソース・サ
ブシステムからバスに送られることである。第６図は、
タイム・スロツト・クオリフアイヤ線と、書込みアドレ
ス線群すなわちバスと、読出しアドレス線群すなわちバ
スと、及びデータ・バスとに関するテーブルの構成を示
している。書込みアドレス・バスには、データ・バスに
より送られるパケツトに関するソース・アドレス情報を
含む12個の位置を含む表が対応する。本実施例では、ア
ドレスは２つのフイールドで構成されている。すなわち
ソース・サブシステム・アドレス・カード・アドレスに
関する第１フイールドと、ソース・サブシステムすなわ
ちスイツチ・アドレスに関する第２フイールドとで構成
されている。ソース・サブシステム・スイツチは、カー
ドにおける特定の要素へのアドレスである。接続テーブ
ルにおける１つのビツト位置は、パケツト開始（ビツト
６）を示すためのものであり、他の１つのビツト位置は
パケツト終了（ビツト５）を示すためのものである。タ
イム・スロツト・クオリフアイヤ・ビツト（ビツト12）
により示された、パケツト・モードにおけるパケツト開
始ビツト及びパケツト終了ビツト間の全アドレスは１つ
のパケツトに関するアドレスを定義する。従つて、ソー
ス・サブシステム・カード・アドレス及びソース・サブ
システム・スイツチ・アドレスはパケツト開始及びパケ
ツト終了間で変化しない。
読出しアドレス・バスはパケツト・モードにおいて使
用され、各入出力パケツトFIFOにインデツクスするよう
他のサブシステムにより使用されるパケツト・バイト・
計数を発生する。タイム・スロツト・テーブルにおける
アドレスの24このインクリメントは、各パケツトを特定
する。MUXBUSコントローラ124は、フレームごとに１回
タイム・スロツト・テーブルを再実行する。
用され、各入出力パケツトFIFOにインデツクスするよう
他のサブシステムにより使用されるパケツト・バイト・
計数を発生する。タイム・スロツト・テーブルにおける
アドレスの24このインクリメントは、各パケツトを特定
する。MUXBUSコントローラ124は、フレームごとに１回
タイム・スロツト・テーブルを再実行する。
MUXBUSパケツトは、MUXBUSのデータ・バス部分を介し
てデータ・バス部分を介してデータ待機から並列バイト
でチヤネルへ送られる。これは、MUXBUSコントローラの
宛先チヤネル・アドレスと宛先デイバイス・アドレスと
に従つて送られる。宛先デイバイス・アドレスと宛先チ
ヤネル・アドレスは、第６図右側に示すように、MUXBUS
90におけるパケツトの最初の２つの８ビツト・バイトに
供給される。宛先デイバイス・アドレスは第１バイト
で、宛先チヤネル・アドレスは第２バイトである。第３
バイトの第１ビツトは、音声パケツトとデータ・パケツ
トを区別する優先順位ビツトである。音声パケツトは、
音声パケツトの伝送がデータ・パケツトの伝送よりも厳
格でないので、低い優先順位を割当てられる。データ・
パケツトは高い優先順位が与えられる。元来のソース及
び最終の宛先間で伝達されるパケツトの情報は、各パケ
ツトの開始の後に、データ・バスの４番目〜24番目のタ
イム・スロツト・テーブルに含まれている。ハウスキー
ピング信号は、トランク・フレーム・パケツト（第３
図）のハミング・ビツトに使用される第３バイトの位置
に含まれている。最初の３バイトを除いて、第３のトラ
ンク・フレーム・パケツトと第６図のデータ・バス・タ
イムスロツト・テーブルに示されたMUXBUSパケツトと
は、実質的に同じ情報を含んでいる。トランク・フレー
ム・パケツトでは、フレーミング・ビツトが加えられて
おり、かつデイバイス・アドレスとチヤネル・アドレス
・フイールドの修正のためハミング・ビツトを使用して
いる。データ修正は、MUXBUSの場合においては必要ない
ので、ハミング・ビツトは不必要で、かつMUXBUSパケツ
トが形成される時に除去される。
てデータ・バス部分を介してデータ待機から並列バイト
でチヤネルへ送られる。これは、MUXBUSコントローラの
宛先チヤネル・アドレスと宛先デイバイス・アドレスと
に従つて送られる。宛先デイバイス・アドレスと宛先チ
ヤネル・アドレスは、第６図右側に示すように、MUXBUS
90におけるパケツトの最初の２つの８ビツト・バイトに
供給される。宛先デイバイス・アドレスは第１バイト
で、宛先チヤネル・アドレスは第２バイトである。第３
バイトの第１ビツトは、音声パケツトとデータ・パケツ
トを区別する優先順位ビツトである。音声パケツトは、
音声パケツトの伝送がデータ・パケツトの伝送よりも厳
格でないので、低い優先順位を割当てられる。データ・
パケツトは高い優先順位が与えられる。元来のソース及
び最終の宛先間で伝達されるパケツトの情報は、各パケ
ツトの開始の後に、データ・バスの４番目〜24番目のタ
イム・スロツト・テーブルに含まれている。ハウスキー
ピング信号は、トランク・フレーム・パケツト（第３
図）のハミング・ビツトに使用される第３バイトの位置
に含まれている。最初の３バイトを除いて、第３のトラ
ンク・フレーム・パケツトと第６図のデータ・バス・タ
イムスロツト・テーブルに示されたMUXBUSパケツトと
は、実質的に同じ情報を含んでいる。トランク・フレー
ム・パケツトでは、フレーミング・ビツトが加えられて
おり、かつデイバイス・アドレスとチヤネル・アドレス
・フイールドの修正のためハミング・ビツトを使用して
いる。データ修正は、MUXBUSの場合においては必要ない
ので、ハミング・ビツトは不必要で、かつMUXBUSパケツ
トが形成される時に除去される。
動作において、MUXBUSコントローラのタイム・スロツ
ト・テーブルは、継続する値のテーブルにおいて、パケ
ツト・モードと、ソース・サブシステム・カード・アド
レスと、ソース・サブシステム・スイツチ・アドレス
と、パケツト開始及びパケツト終了とを表わすデイジタ
ル値を、ランダム・アクセス・メモリにロードすること
により、マイクロプロセツサ・システム110により設定
される。テーブルは、512の位置を含んでいる。24の位
置は、パケツト・モードにおいて各パケツトに関し分類
されている。回路モードにおいては、テーブルは、MUXB
USの部分だけにおいて情報を交換し、かつパケタイザ／
デパケタイザへまたはパケタイザ／デパケタイザから非
パケツト化情報を送るため、コントローラ・シーケンス
によつて設定される。
ト・テーブルは、継続する値のテーブルにおいて、パケ
ツト・モードと、ソース・サブシステム・カード・アド
レスと、ソース・サブシステム・スイツチ・アドレス
と、パケツト開始及びパケツト終了とを表わすデイジタ
ル値を、ランダム・アクセス・メモリにロードすること
により、マイクロプロセツサ・システム110により設定
される。テーブルは、512の位置を含んでいる。24の位
置は、パケツト・モードにおいて各パケツトに関し分類
されている。回路モードにおいては、テーブルは、MUXB
USの部分だけにおいて情報を交換し、かつパケタイザ／
デパケタイザへまたはパケタイザ／デパケタイザから非
パケツト化情報を送るため、コントローラ・シーケンス
によつて設定される。
第７図は、VDP103（第２図）をより詳細に示してい
る。VDP103は、２つのインターフエイス、すなわち回路
MUXBUSインターフエイス150とパケツトMUXBUSインター
フエイス152を含んでいる。パケツトMUXBUSインターフ
エイス152は、MUXBUS90がパケツト・モードにある時、M
UXBUS90と交信する。回路MUXBUSインターフエイス150
は、MUXBUS90が回路モードにある時、MUXBUS90に接続し
ている。MUXBUS90のパケツトモード−回路モードの制御
は、タイム・スロツト・クオリフアイヤ線106の状態に
より示されるタイム・スロツトに従つている。
る。VDP103は、２つのインターフエイス、すなわち回路
MUXBUSインターフエイス150とパケツトMUXBUSインター
フエイス152を含んでいる。パケツトMUXBUSインターフ
エイス152は、MUXBUS90がパケツト・モードにある時、M
UXBUS90と交信する。回路MUXBUSインターフエイス150
は、MUXBUS90が回路モードにある時、MUXBUS90に接続し
ている。MUXBUS90のパケツトモード−回路モードの制御
は、タイム・スロツト・クオリフアイヤ線106の状態に
より示されるタイム・スロツトに従つている。
パケツトMUXBUSインターフエイス152における交信
は、本発明によるパケツト・フオーマツトで行なわれ
る。回路MUXBUSインターフエイス150における交信は、T
TLレベルを除いて、普通の時分割多重パルス・コード変
調形式で行なわれる。VDP103の目的は、公にされている
ADPCM（adaptive,digital pulsecode modulation）デー
タ圧縮基準に従つて音声情報をパケツト化（パケタイ
ズ）かつ非パケツト化（デパケタイズ）することであ
る。VDP103は、全VDPサブシステム機能を制御するた
め、自身のマイクロプロセツサ・ユニツト154を含んで
いる半独立のサブシステムである。
は、本発明によるパケツト・フオーマツトで行なわれ
る。回路MUXBUSインターフエイス150における交信は、T
TLレベルを除いて、普通の時分割多重パルス・コード変
調形式で行なわれる。VDP103の目的は、公にされている
ADPCM（adaptive,digital pulsecode modulation）デー
タ圧縮基準に従つて音声情報をパケツト化（パケタイ
ズ）かつ非パケツト化（デパケタイズ）することであ
る。VDP103は、全VDPサブシステム機能を制御するた
め、自身のマイクロプロセツサ・ユニツト154を含んで
いる半独立のサブシステムである。
VDP103は、２つのデータ通路から成つている。第１の
データ通路は、回路MUXBUSインターフエイス150からの
信号を受信しかつパケツト化信号をパケツトMUXBUSイン
ターフエイス152へ出力として供給するよう接続した音
声パケタイザ156を含んでいる。音声パケタイザ156は、
データ及びアドレス情報を２−ポートの先入れ先出しラ
ンダム・アクセス・メモリ（２−ポートFIFO・RAM）158
に供給するよう接続されている。データ出力は、パケツ
ト・トランスミツタ160に接続し、さらにこれはパケツ
トMUXBUSインターフエイス152に接続している。パケツ
ト・トランスミツタ160は、パケツト・タイム・スロツ
ト・アクセスを通してRAM158のデータをアクセスする。
データ通路は、回路MUXBUSインターフエイス150からの
信号を受信しかつパケツト化信号をパケツトMUXBUSイン
ターフエイス152へ出力として供給するよう接続した音
声パケタイザ156を含んでいる。音声パケタイザ156は、
データ及びアドレス情報を２−ポートの先入れ先出しラ
ンダム・アクセス・メモリ（２−ポートFIFO・RAM）158
に供給するよう接続されている。データ出力は、パケツ
ト・トランスミツタ160に接続し、さらにこれはパケツ
トMUXBUSインターフエイス152に接続している。パケツ
ト・トランスミツタ160は、パケツト・タイム・スロツ
ト・アクセスを通してRAM158のデータをアクセスする。
パケツト側から回路側への信号通路は、パケツト・レ
シーバ162,音声／データ・デパケタイザ164,及び２−ポ
ートFIFO・RAM166から成つている。
シーバ162,音声／データ・デパケタイザ164,及び２−ポ
ートFIFO・RAM166から成つている。
マイクロプロセツサ・ユニツト154は、RAM,ROMを伴う
CPUで、更に、自己テスト及び診断、音声パケツト・ス
ケジユーリング，チヤネル・ロード・モニタリング，先
入れ先出し制御，及び、たとえばパケツト制御カードを
介しての外部制御により生じる何らかの必要な構成変更
をサポートできるマイクロコントローラを得るのに必要
とされる他のサポート・サブシステム（図示せず）を備
えている。マイクロプロセツサ・ユニツト154は、マイ
クロプロセツサ入力／出力バス168を介して他のユニツ
トのそれぞれに接続しており、またバス168は、制御バ
ス・インターフエイス170を介して直列制御バス102（第
２図）に接続し、これを介して情報が構成変更のため交
換される。代表的なシステムでは、本発明によるシステ
ムを動作するのにデータだけを必要とするように、汎用
機能はリード・オンリー・メモリ（図示せず）に記憶さ
れている。
CPUで、更に、自己テスト及び診断、音声パケツト・ス
ケジユーリング，チヤネル・ロード・モニタリング，先
入れ先出し制御，及び、たとえばパケツト制御カードを
介しての外部制御により生じる何らかの必要な構成変更
をサポートできるマイクロコントローラを得るのに必要
とされる他のサポート・サブシステム（図示せず）を備
えている。マイクロプロセツサ・ユニツト154は、マイ
クロプロセツサ入力／出力バス168を介して他のユニツ
トのそれぞれに接続しており、またバス168は、制御バ
ス・インターフエイス170を介して直列制御バス102（第
２図）に接続し、これを介して情報が構成変更のため交
換される。代表的なシステムでは、本発明によるシステ
ムを動作するのにデータだけを必要とするように、汎用
機能はリード・オンリー・メモリ（図示せず）に記憶さ
れている。
動作時、音声／データ・パケタイザ156は、データ・
ポートで、回路MUXBUSインターフエイス150からPCM音声
データを受信する。PCMデータが音声サンプルである場
合には、そのサンプルは、ADPCM変換基準に従つて圧縮
される。PCMサンプルは、音声サンプルでない場合に
は、この変換プロセスを経過することはない。サンプル
は、２−ポートFIFO・RAM158に記憶される。音声パケタ
イザの一例では、構成素子は、ADPCM基準に従つて音声
サンプルをパケツト化するため、回路MUXBUSインターフ
エイスからのアドレス情報とマイクロプロセツサ入力／
出力バス168からの構成情報とに応答する通常のランダ
ム論理回路素子である。音声／データ・デパケタイザ16
4は、音声パケタイザ156に対して逆の機能を行なう。す
なわちこれは、パケツト化サンプルを、順次チヤネル化
PCMデータに戻すよう変換する。そのPCMデータは２−ポ
ートFIFO・RAM166に記憶される。受信したパケツトに圧
縮された音声サンプルが含まれている場合、各サンプル
は、FIFO・RAM166に記憶される前に、ADPCM変換基準に
従つて先ず圧縮解除される。入りサンプルは、また通話
検出器157により走査される。この通話検出器157は、通
話を検出するのに標準アルゴリズムを使用している。通
話が存在している場合、マイクロプロセツサ・ユニツト
154は、送信するため通話パケツトを、パケツト・トラ
ンスミツタ160を介してスケジユールする。データ・パ
ケツトは、常に送信されている。動作において、通話検
出器157は、通話のエネルギを積分し、それを２つの閾
値に対し比較する。パケツトが線159を介して入つてく
る場合、積分された通話エネルギは、高い閾値と比較さ
れる。パケツトが入つて来ない場合、積分された通話エ
ネルギは、低い閾値と比較される。いずれの場合にも閾
値を越えた場合には、信号がマイクロプロセツサ・ユニ
ツト154に送られる。エコーとして戻つた音声信号が通
話検出器157をトリツプするのを阻止するために、この
２つの閾値技術が使用される。さらに、通話検出器157
は、入り回路通話サンプルのゼロ交差を計数する。ゼロ
交差の数が特定の期間内に閾値を越える場合、通話サン
プルは、「トーン・データ」として分類される。その
後、マイクロプロセツサ・ユニツトは、特定のチヤネル
のパケツトの優先順位を増加する。これは、音声帯域デ
ータのモデム・チヤネルの性能を改善するためにある。
ポートで、回路MUXBUSインターフエイス150からPCM音声
データを受信する。PCMデータが音声サンプルである場
合には、そのサンプルは、ADPCM変換基準に従つて圧縮
される。PCMサンプルは、音声サンプルでない場合に
は、この変換プロセスを経過することはない。サンプル
は、２−ポートFIFO・RAM158に記憶される。音声パケタ
イザの一例では、構成素子は、ADPCM基準に従つて音声
サンプルをパケツト化するため、回路MUXBUSインターフ
エイスからのアドレス情報とマイクロプロセツサ入力／
出力バス168からの構成情報とに応答する通常のランダ
ム論理回路素子である。音声／データ・デパケタイザ16
4は、音声パケタイザ156に対して逆の機能を行なう。す
なわちこれは、パケツト化サンプルを、順次チヤネル化
PCMデータに戻すよう変換する。そのPCMデータは２−ポ
ートFIFO・RAM166に記憶される。受信したパケツトに圧
縮された音声サンプルが含まれている場合、各サンプル
は、FIFO・RAM166に記憶される前に、ADPCM変換基準に
従つて先ず圧縮解除される。入りサンプルは、また通話
検出器157により走査される。この通話検出器157は、通
話を検出するのに標準アルゴリズムを使用している。通
話が存在している場合、マイクロプロセツサ・ユニツト
154は、送信するため通話パケツトを、パケツト・トラ
ンスミツタ160を介してスケジユールする。データ・パ
ケツトは、常に送信されている。動作において、通話検
出器157は、通話のエネルギを積分し、それを２つの閾
値に対し比較する。パケツトが線159を介して入つてく
る場合、積分された通話エネルギは、高い閾値と比較さ
れる。パケツトが入つて来ない場合、積分された通話エ
ネルギは、低い閾値と比較される。いずれの場合にも閾
値を越えた場合には、信号がマイクロプロセツサ・ユニ
ツト154に送られる。エコーとして戻つた音声信号が通
話検出器157をトリツプするのを阻止するために、この
２つの閾値技術が使用される。さらに、通話検出器157
は、入り回路通話サンプルのゼロ交差を計数する。ゼロ
交差の数が特定の期間内に閾値を越える場合、通話サン
プルは、「トーン・データ」として分類される。その
後、マイクロプロセツサ・ユニツトは、特定のチヤネル
のパケツトの優先順位を増加する。これは、音声帯域デ
ータのモデム・チヤネルの性能を改善するためにある。
２−ポートFIFO・RAM166,158は、標準２−ポート・メ
モリ・デイバイス、すなわち、読出しポート及び書込み
ポートを備えた再循環ランダム・アクセス・メモリであ
る。RAM158,166は、デイジタル化情報を受信サブシステ
ムに送る前に一時記憶するのに使用される。マイクロプ
ロセツサ・ユニツト154は、診断目的でRAM158または166
のいずれかの場所に書込み読出しできる。
モリ・デイバイス、すなわち、読出しポート及び書込み
ポートを備えた再循環ランダム・アクセス・メモリであ
る。RAM158,166は、デイジタル化情報を受信サブシステ
ムに送る前に一時記憶するのに使用される。マイクロプ
ロセツサ・ユニツト154は、診断目的でRAM158または166
のいずれかの場所に書込み読出しできる。
２−ポートFIFO・RAM166は、PCM音声サンプルを一時
記憶するのに十分大きい、チヤネル毎の循環FIFO、待機
機能（キユー）を含んでいるので、回路MUXBUSインター
フエイスは、125マイクロ秒の速度で、各音声サンプル
に対して同期してキユーからのサンプルを読出すことが
できる。音声デパケタイザ164は、新しいパケツトが到
着した時にFIFO・RAM166をロードする。パケツトがない
場合、サイレンス・コードが送られる。
記憶するのに十分大きい、チヤネル毎の循環FIFO、待機
機能（キユー）を含んでいるので、回路MUXBUSインター
フエイスは、125マイクロ秒の速度で、各音声サンプル
に対して同期してキユーからのサンプルを読出すことが
できる。音声デパケタイザ164は、新しいパケツトが到
着した時にFIFO・RAM166をロードする。パケツトがない
場合、サイレンス・コードが送られる。
パケツト・トランスミツタ160は、高速パケツトFIFO
・RAM158を操作する。パケツト・トランスミツタは、マ
イクロプロセツサ・ユニツト154に応答し、FIFO・RAM15
8にインストラクシヨンを与え、音声パケツトのブロツ
クを送るべき時を表示する。
・RAM158を操作する。パケツト・トランスミツタは、マ
イクロプロセツサ・ユニツト154に応答し、FIFO・RAM15
8にインストラクシヨンを与え、音声パケツトのブロツ
クを送るべき時を表示する。
パケツト・レシーバ162は、バスのパケツト部分をア
クテイブにタイム・スロツト・セレクタ線106が確立し
ている期間において、パケツトMUXBUSインターフエイス
152からのパケツト・データを受信する。パケツト・レ
シーバ162は、MUXBUS90からの音声パケツトを受信する
のに使用される２つの高速FIFOを含んでいる。パケツト
・レシーバは、先ず到着パケツトがパリテイ・エラー・
ビツトを用いて妥当性（バリデイテイ）に関してチエツ
クされるように、構成されている。妥当でないアドレス
はパケツトを捨てさせることになる。妥当なアドレス
は、マイクロプロセツサ・ユニツト154によりあらかじ
めロードされているRAMアドレスと、このパケツトを保
持するかまたは捨てるかを決めるため、比較される。そ
のRAMアドレスは予測されるアドレスを示しているもの
である。パケツトを保持すべき場合、パケツトは音声／
データ・デパケタイザ164に送られる。同じアドレスが
音声／データ・デパケタイザ及び２−ポートFIFO・RAM1
66の両方に送られる。パケツト・レシーバ162は、どの
パケツトを処理すべきかということに関し、選択線172
を介して音声デパケタイザ164に信号を送る。
クテイブにタイム・スロツト・セレクタ線106が確立し
ている期間において、パケツトMUXBUSインターフエイス
152からのパケツト・データを受信する。パケツト・レ
シーバ162は、MUXBUS90からの音声パケツトを受信する
のに使用される２つの高速FIFOを含んでいる。パケツト
・レシーバは、先ず到着パケツトがパリテイ・エラー・
ビツトを用いて妥当性（バリデイテイ）に関してチエツ
クされるように、構成されている。妥当でないアドレス
はパケツトを捨てさせることになる。妥当なアドレス
は、マイクロプロセツサ・ユニツト154によりあらかじ
めロードされているRAMアドレスと、このパケツトを保
持するかまたは捨てるかを決めるため、比較される。そ
のRAMアドレスは予測されるアドレスを示しているもの
である。パケツトを保持すべき場合、パケツトは音声／
データ・デパケタイザ164に送られる。同じアドレスが
音声／データ・デパケタイザ及び２−ポートFIFO・RAM1
66の両方に送られる。パケツト・レシーバ162は、どの
パケツトを処理すべきかということに関し、選択線172
を介して音声デパケタイザ164に信号を送る。
第８図は、本発明によるチヤネル・トランク・トラン
シーバ94（第２図）を示している。MUXBUS90とトランク
・インターフエイス（第２図）との間にトランシーバが
接続されている。MUXBUS90は、制御バス102とともに示
されている。トランシーバ94は、シグナリング制御プロ
セツサ180を使用している。シグナリング制御プロセツ
サ180は、割込み制御論理装置，タイマ，及びアドレス
・デコード論理装置の他、サブシステム中のアドレス及
びデータバスを駆動する論理装置を含むマイクロプロセ
ツサを基礎とするユニツトである。なお、シグナリング
制御プロセツサの詳細は当業者による設計事項である。
第１の機能は、フレーム・シグナリング及び抽出を制御
し、かつ、標準化Ｔ−１トランク・ラインに接続した保
護インターフエイス・カード92にTTLレベル信号の交換
におけるフレーム・シグナリング及び挿入を供給するこ
とである。制御バス102は、パケツト制御カード100のよ
うなMUXBUS90を共有する中央システム・コントローラか
らの構成信号を供給する。
シーバ94（第２図）を示している。MUXBUS90とトランク
・インターフエイス（第２図）との間にトランシーバが
接続されている。MUXBUS90は、制御バス102とともに示
されている。トランシーバ94は、シグナリング制御プロ
セツサ180を使用している。シグナリング制御プロセツ
サ180は、割込み制御論理装置，タイマ，及びアドレス
・デコード論理装置の他、サブシステム中のアドレス及
びデータバスを駆動する論理装置を含むマイクロプロセ
ツサを基礎とするユニツトである。なお、シグナリング
制御プロセツサの詳細は当業者による設計事項である。
第１の機能は、フレーム・シグナリング及び抽出を制御
し、かつ、標準化Ｔ−１トランク・ラインに接続した保
護インターフエイス・カード92にTTLレベル信号の交換
におけるフレーム・シグナリング及び挿入を供給するこ
とである。制御バス102は、パケツト制御カード100のよ
うなMUXBUS90を共有する中央システム・コントローラか
らの構成信号を供給する。
トランシーバ94は、PIC92からTTLレベルの直列データ
及びクロツク信号を受信するように接続したTTLレベル
・レシーバ182を含んでいる。TTLレシーバ182は、フレ
ーム及びシグナリング抽出器184を駆動する。アラーム
信号は抽出器184から発生され、トランク信号の通常の
分析から生じたシステムのアラーム状態の可視表示を行
なう。フレーム及びシグナリング抽出器184は、普通の
トランク・システム技術のものである。トランク・ライ
ンの一方は、標準PCM/DS−１フオーマツトであり、他方
のトランク・ラインは、本発明によるパケツト・フオー
マツトを使用している。従つて、抽出器184は、レシー
バ制御ユニツト186にパケツト情報を供給する。レシー
バ制御ユニット186は、パケツト・フオーマツトの情報
をレシーバ・パケツトFIFO188に送り、或は普通の時分
割多重形式の情報をレシーバ・２−ポート回路ランダム
・アクセス・メモリ（回路RAM）190に送る時分割コント
ローラである。レシーバ回路RAM190は、回路モード動作
におけるデータとして、MUXBUS90を介して検索するため
のTDM信号を記憶する。レシーバ・パケツトFIFO188は、
MUXBUS90に送られるパケツトを一時記憶するのに使用さ
れる。レシーバ・パケツトFIFO188に含まれている情報
へのアクセスは、前述したように、MUXBUS90におけるパ
ケツト通信用に確立されたプロトコルに従うものであ
る。換言すれば、トランシーバ94と回路RAM190は、あら
かじめ選択された読出しアドレスにより識別し得る。指
定された読出しアドレスがMUXBUS90に与えられると、ア
ドレスに対応するデータがアクセスされ、かつ、MUXBUS
90を介して、MUXBUS90に接続された他のユニツトにおい
て使用可能となる。
及びクロツク信号を受信するように接続したTTLレベル
・レシーバ182を含んでいる。TTLレシーバ182は、フレ
ーム及びシグナリング抽出器184を駆動する。アラーム
信号は抽出器184から発生され、トランク信号の通常の
分析から生じたシステムのアラーム状態の可視表示を行
なう。フレーム及びシグナリング抽出器184は、普通の
トランク・システム技術のものである。トランク・ライ
ンの一方は、標準PCM/DS−１フオーマツトであり、他方
のトランク・ラインは、本発明によるパケツト・フオー
マツトを使用している。従つて、抽出器184は、レシー
バ制御ユニツト186にパケツト情報を供給する。レシー
バ制御ユニット186は、パケツト・フオーマツトの情報
をレシーバ・パケツトFIFO188に送り、或は普通の時分
割多重形式の情報をレシーバ・２−ポート回路ランダム
・アクセス・メモリ（回路RAM）190に送る時分割コント
ローラである。レシーバ回路RAM190は、回路モード動作
におけるデータとして、MUXBUS90を介して検索するため
のTDM信号を記憶する。レシーバ・パケツトFIFO188は、
MUXBUS90に送られるパケツトを一時記憶するのに使用さ
れる。レシーバ・パケツトFIFO188に含まれている情報
へのアクセスは、前述したように、MUXBUS90におけるパ
ケツト通信用に確立されたプロトコルに従うものであ
る。換言すれば、トランシーバ94と回路RAM190は、あら
かじめ選択された読出しアドレスにより識別し得る。指
定された読出しアドレスがMUXBUS90に与えられると、ア
ドレスに対応するデータがアクセスされ、かつ、MUXBUS
90を介して、MUXBUS90に接続された他のユニツトにおい
て使用可能となる。
２−ポート・トランスミツタ回路RAM192は、回路スイ
ツチング・モード動作においてMUXBUSからのデータを受
信する。レシーバ・２−ポート回路RAM190の読出しアド
レスがアクテイブになるのと同時に、トランスミツタ・
２−ポート回路RAM192のアドレスがアクテイブになる
と、TDM信号はトランシーバ94を通してループされる。
同様に、トランスミツタ・パケツトFIFO194は、MUXBUS9
0からのデータを受信する。レシーバ・パケツトFIFO188
の読出しアドレスがアクテイブになるのと同時に、トラ
ンスミツタ・パケツトFIFO194の書込みアドレスがアク
テイブになると、パケツト・データはトランク・ライン
・ポート間でトランシーバを介して再循環させられる。
ツチング・モード動作においてMUXBUSからのデータを受
信する。レシーバ・２−ポート回路RAM190の読出しアド
レスがアクテイブになるのと同時に、トランスミツタ・
２−ポート回路RAM192のアドレスがアクテイブになる
と、TDM信号はトランシーバ94を通してループされる。
同様に、トランスミツタ・パケツトFIFO194は、MUXBUS9
0からのデータを受信する。レシーバ・パケツトFIFO188
の読出しアドレスがアクテイブになるのと同時に、トラ
ンスミツタ・パケツトFIFO194の書込みアドレスがアク
テイブになると、パケツト・データはトランク・ライン
・ポート間でトランシーバを介して再循環させられる。
FIFO194は、自己が一杯のためこれ以上パケツトを受
け入れられない場合、PKABORTライン196を介してシグナ
リング制御プロセツサ180とMUXBUSへその状態を送る。
この制御ラインがアクテイブ化される回数は、シグナリ
ング制御プロセツサ180とPCCとによりモニタされ、シス
テムがオーバーロードであるかどうかを決定する。トラ
ンスミツタ回路RAM192とトランスミツタ・パケツトFIFO
194は伝送制御ユニツト198に接続されている。そのユニ
ツト198を介して、伝送されたTDM信号または伝送された
パケツトのいずれかがフレーム及びシグナリング挿入器
200へ送られる。フレーム及びシグナリング挿入器200
は、普通のトランク・システム技術に従つて、TDM信号
へまたはパケツトへDS−１フレーミング信号を挿入す
る。DS−１伝送では、ビツトあるいは組合せが生じるこ
とは、考えられない。たとえは、一行に15より多数のゼ
ロは伝送されない。パケツト・トランク・ラインは、パ
ケツトが15より多数の連続ゼロビツトを含んでいないこ
とを保証することによりこの問題から保護されている。
パケツト・クリエータ（すなわちVDP及びPCC）は、これ
を保証する責任を果す。挿入器200は、TTLトランスミッ
タ202に出力を送る。TTLトランスミツタ202は、保護イ
ンターフエイス・カード（PIC）92による変換のため、T
TLレベルの直列データを発生する。
け入れられない場合、PKABORTライン196を介してシグナ
リング制御プロセツサ180とMUXBUSへその状態を送る。
この制御ラインがアクテイブ化される回数は、シグナリ
ング制御プロセツサ180とPCCとによりモニタされ、シス
テムがオーバーロードであるかどうかを決定する。トラ
ンスミツタ回路RAM192とトランスミツタ・パケツトFIFO
194は伝送制御ユニツト198に接続されている。そのユニ
ツト198を介して、伝送されたTDM信号または伝送された
パケツトのいずれかがフレーム及びシグナリング挿入器
200へ送られる。フレーム及びシグナリング挿入器200
は、普通のトランク・システム技術に従つて、TDM信号
へまたはパケツトへDS−１フレーミング信号を挿入す
る。DS−１伝送では、ビツトあるいは組合せが生じるこ
とは、考えられない。たとえは、一行に15より多数のゼ
ロは伝送されない。パケツト・トランク・ラインは、パ
ケツトが15より多数の連続ゼロビツトを含んでいないこ
とを保証することによりこの問題から保護されている。
パケツト・クリエータ（すなわちVDP及びPCC）は、これ
を保証する責任を果す。挿入器200は、TTLトランスミッ
タ202に出力を送る。TTLトランスミツタ202は、保護イ
ンターフエイス・カード（PIC）92による変換のため、T
TLレベルの直列データを発生する。
TTLトランスミツタ202からのTTLレベル信号は、保護
インターフエイス・カード92に送られる。クロツク信号
は、標準フレーミング・パルス速度でパケツト制御カー
ド100から得られる。
インターフエイス・カード92に送られる。クロツク信号
は、標準フレーミング・パルス速度でパケツト制御カー
ド100から得られる。
第９図は、保護インターフエイス・カード（PIC）92
の要素を示している。保護インターフエイス・カード92
の機能は、外部デイジタル・トランク・ライン、たとえ
ばＴ−１トランク・ラインに、TTLレベルの内部デイジ
タル信号を送るものである。保護インターフエイス・カ
ード92は、普通の素子から組立てられる。これは、信号
保護を備えた標準Ｔ−１トランシーバを有している。DS
−１信号は、標準Ｔ−１インターフエイスとリレーを介
して、たとえば８つのバイポーラ信号のバンクに送られ
る。バイポーラ信号は、標準バイポーラ−TTLコンバー
タ・アレイ210においてTTL信号に変換される。TTL信号
は、スペース・スイツチ212に送られる。スペース・ス
イツチ212は、TTL信号を適当なトランシーバ・カード
（TXR）94（第８図）に送るよう応答する。入りDS−１
信号は、マスタ同期信号を発生するのに使用される。フ
エーズ・ロツクド発振器と水晶とから成るマスタ同期ユ
ニツト214は、DS−１信号からユニバーサル・タイム・
クロツク信号を引き出し、同期信号を生じる。同期信号
は、同期ライン98（第２図）を介して、MUXBUS90に送ら
れる。TXR94からの信号は、トランスミツタ・スペース
・スイツチ216へ送られる。なお、２つ以上のトランシ
ーバを保護インターフエイス・カード92に接続できる。
それは、ライン・レシーバが２組以上の信号を扱えるか
らである。標準TTL−バイポーラ・コンバーダ218のアレ
イは、トランスミツタ・スペース・スイツチ216の出力
を受信する。コンバータ218は、TTL−レベル信号をバイ
ポーラ信号に変換し、その信号を信号リレーを介して、
たとえば信号リレー220を介して、DS−１フオーマツト
の出力でＴ−１ケーブルへ供給する。同様に、信号リレ
ー209は、Ｔ−１ケーブルからのDS−１信号を受信す
る。信号リレー223は、診断のためシステムにループ・
バツクするよう普通の技術手段に従つて、入力信号リレ
ー209と出力信号リレー220との間で信号を結合する。
の要素を示している。保護インターフエイス・カード92
の機能は、外部デイジタル・トランク・ライン、たとえ
ばＴ−１トランク・ラインに、TTLレベルの内部デイジ
タル信号を送るものである。保護インターフエイス・カ
ード92は、普通の素子から組立てられる。これは、信号
保護を備えた標準Ｔ−１トランシーバを有している。DS
−１信号は、標準Ｔ−１インターフエイスとリレーを介
して、たとえば８つのバイポーラ信号のバンクに送られ
る。バイポーラ信号は、標準バイポーラ−TTLコンバー
タ・アレイ210においてTTL信号に変換される。TTL信号
は、スペース・スイツチ212に送られる。スペース・ス
イツチ212は、TTL信号を適当なトランシーバ・カード
（TXR）94（第８図）に送るよう応答する。入りDS−１
信号は、マスタ同期信号を発生するのに使用される。フ
エーズ・ロツクド発振器と水晶とから成るマスタ同期ユ
ニツト214は、DS−１信号からユニバーサル・タイム・
クロツク信号を引き出し、同期信号を生じる。同期信号
は、同期ライン98（第２図）を介して、MUXBUS90に送ら
れる。TXR94からの信号は、トランスミツタ・スペース
・スイツチ216へ送られる。なお、２つ以上のトランシ
ーバを保護インターフエイス・カード92に接続できる。
それは、ライン・レシーバが２組以上の信号を扱えるか
らである。標準TTL−バイポーラ・コンバーダ218のアレ
イは、トランスミツタ・スペース・スイツチ216の出力
を受信する。コンバータ218は、TTL−レベル信号をバイ
ポーラ信号に変換し、その信号を信号リレーを介して、
たとえば信号リレー220を介して、DS−１フオーマツト
の出力でＴ−１ケーブルへ供給する。同様に、信号リレ
ー209は、Ｔ−１ケーブルからのDS−１信号を受信す
る。信号リレー223は、診断のためシステムにループ・
バツクするよう普通の技術手段に従つて、入力信号リレ
ー209と出力信号リレー220との間で信号を結合する。
保護インターフエイス・カード92は、メモリ224とI/O
226とを伴つたマイクロプロセツサを基礎にしたコント
ローラ222を含んでいる。I/O226は、リレー223,コンバ
ータ210,218及びステータス／アラーム・インジケータ
及びリレー225に接続している。マイクロプロセツサ222
は、普通の設計の内部プロセツサ・バス230を介して、
制御バス・インターフエイス228の他、メモリ及びI/Oに
接続している。制御バス・インターフエイス228は、マ
イクロプロセツサ22と制御バス102間のインターフエイ
スを行なう。
226とを伴つたマイクロプロセツサを基礎にしたコント
ローラ222を含んでいる。I/O226は、リレー223,コンバ
ータ210,218及びステータス／アラーム・インジケータ
及びリレー225に接続している。マイクロプロセツサ222
は、普通の設計の内部プロセツサ・バス230を介して、
制御バス・インターフエイス228の他、メモリ及びI/Oに
接続している。制御バス・インターフエイス228は、マ
イクロプロセツサ22と制御バス102間のインターフエイ
スを行なう。
本発明の各サブシステムは、自律形で、MUXBUSを基礎
とするシステムと接続させたい他のユニツトとともに、
その環境において動作するのに必要な全機能ユニツトか
ら成つている。モジユラ設計は、特定の構成のため内蔵
されるべき新しい構造を考慮している。また、このシス
テムは、トランク環境におけるリレー・ステーシヨンと
して、PBXシステムとのインターフエイスとしてまたは
多数のPBXシステムとのインターフエイスとして使用す
ることができる。システムの能力は、MUXBUSのアドレス
・ベースによつてだけ制限される。非常に高密度な環境
においては、並列MUXBUSにするための装置が設けられ、
システムの能力を強化することができる。
とするシステムと接続させたい他のユニツトとともに、
その環境において動作するのに必要な全機能ユニツトか
ら成つている。モジユラ設計は、特定の構成のため内蔵
されるべき新しい構造を考慮している。また、このシス
テムは、トランク環境におけるリレー・ステーシヨンと
して、PBXシステムとのインターフエイスとしてまたは
多数のPBXシステムとのインターフエイスとして使用す
ることができる。システムの能力は、MUXBUSのアドレス
・ベースによつてだけ制限される。非常に高密度な環境
においては、並列MUXBUSにするための装置が設けられ、
システムの能力を強化することができる。
本発明によれば、標準化されたビット同期通信フォー
マットに従ったディジタル時間フレームで情報を通信す
るディジタル通信媒体を用いて、パケットされた情報
（音声のパケットとデータのパケットとを含む）の通信
を行える。これにより、本発明の通信回路網では、ルー
チング機能を有するパケット通信の際に、制御のオーバ
ーヘッド（別のフレーム構造をとる従来のパケット通信
プロトコルではそのプロトコルに従うために必要であっ
た）が小さくなるから、パケット化された情報の伝送速
度が著しく高速化される。
マットに従ったディジタル時間フレームで情報を通信す
るディジタル通信媒体を用いて、パケットされた情報
（音声のパケットとデータのパケットとを含む）の通信
を行える。これにより、本発明の通信回路網では、ルー
チング機能を有するパケット通信の際に、制御のオーバ
ーヘッド（別のフレーム構造をとる従来のパケット通信
プロトコルではそのプロトコルに従うために必要であっ
た）が小さくなるから、パケット化された情報の伝送速
度が著しく高速化される。
第１図は本発明による装置を用いたトランク環境のブロ
ツク図、第２図は本発明による音声／データ・パケツト
・スイツチ（VDPS）のブロツク図、第3A図は本発明によ
るデータ・フレーム図、第3B図はそれぞれ８−ビツト・
サンプルを有する24の直列チヤネルの標準電話回路網PC
Mフレームのデータ・フレーム図、第４図はVDPSにおい
て使用されるパケツト制御カードすなわちVDPS制御サブ
システムのブロツク図、第５図は本発明によるMUXBUSの
タイミング図、第６図はMUXBUSコントローラの動作を説
明するための図、第７図は本発明による音声コンプレツ
サ／デコンプレツサ・サブシステムのブロツク図、第８
図は本発明によるVDPSにおいて使用するためのＴ−１形
用の４チヤネル・トランシーバのブロツク図、第９図は
本発明によるVDPSにおいて使用するための、保護及びイ
ンターフエイス・カード、すなわちサブシステムのブロ
ツク図である。 12……同期パケツト通信回路網、14,16,18……トランク
MUX、44……アナログPBX、46……チヤネルバンク、48…
…デイジタルPBX、66……コンピユータ、76……回路網
制御端末、90……MUXBUS、92……保護インターフエイス
・カード、94,96……トランク・トランシーバ、100……
パケツト制御カード、103……音声／データ・プロセツ
サ、110……マイクロプロセツサ・システム、112……シ
ステム・データ・バス、114……システム・アドレス・
バス、124……MUXBUSコントローラ、126……システムRA
M、128……直列インターフエイス、130……制御バス・
インターフエイス、132……アラーム及びステータス論
理装置、138,140……FIFO、150……回路MUXBUSインター
フエイス、156……音声パケタイザ、157……通話検出
器、158……２−ポートFIFO・RAM、160……パケツト・
トランスミツタ、162……パケツト・レシーバ、164……
音声／データ・パケタイザ、166……２−ポートFIFO・R
AM、170……制御バス・インターフエイス、180……シグ
ナリング制御プロセツサ、182……TTLレシーバ、184…
…フレーム及びシグナリング抽出器、200……フレーム
及びシグナリング挿入器、202……TTLトランスミツタ、
209,220,223……リレー、210……バイポーラーTTLコン
バータ、212,216……スペース・スイツチ、218……TTL
−バイポーラ・コンバータ。
ツク図、第２図は本発明による音声／データ・パケツト
・スイツチ（VDPS）のブロツク図、第3A図は本発明によ
るデータ・フレーム図、第3B図はそれぞれ８−ビツト・
サンプルを有する24の直列チヤネルの標準電話回路網PC
Mフレームのデータ・フレーム図、第４図はVDPSにおい
て使用されるパケツト制御カードすなわちVDPS制御サブ
システムのブロツク図、第５図は本発明によるMUXBUSの
タイミング図、第６図はMUXBUSコントローラの動作を説
明するための図、第７図は本発明による音声コンプレツ
サ／デコンプレツサ・サブシステムのブロツク図、第８
図は本発明によるVDPSにおいて使用するためのＴ−１形
用の４チヤネル・トランシーバのブロツク図、第９図は
本発明によるVDPSにおいて使用するための、保護及びイ
ンターフエイス・カード、すなわちサブシステムのブロ
ツク図である。 12……同期パケツト通信回路網、14,16,18……トランク
MUX、44……アナログPBX、46……チヤネルバンク、48…
…デイジタルPBX、66……コンピユータ、76……回路網
制御端末、90……MUXBUS、92……保護インターフエイス
・カード、94,96……トランク・トランシーバ、100……
パケツト制御カード、103……音声／データ・プロセツ
サ、110……マイクロプロセツサ・システム、112……シ
ステム・データ・バス、114……システム・アドレス・
バス、124……MUXBUSコントローラ、126……システムRA
M、128……直列インターフエイス、130……制御バス・
インターフエイス、132……アラーム及びステータス論
理装置、138,140……FIFO、150……回路MUXBUSインター
フエイス、156……音声パケタイザ、157……通話検出
器、158……２−ポートFIFO・RAM、160……パケツト・
トランスミツタ、162……パケツト・レシーバ、164……
音声／データ・パケタイザ、166……２−ポートFIFO・R
AM、170……制御バス・インターフエイス、180……シグ
ナリング制御プロセツサ、182……TTLレシーバ、184…
…フレーム及びシグナリング抽出器、200……フレーム
及びシグナリング挿入器、202……TTLトランスミツタ、
209,220,223……リレー、210……バイポーラーTTLコン
バータ、212,216……スペース・スイツチ、218……TTL
−バイポーラ・コンバータ。
フロントページの続き (72)発明者 チヤールズ・エム・コーバリス アメリカ合衆国 95132 カリフオルニ ア州・サン ホゼ・ヴイア デル ソ ル・2998 (72)発明者 ブライアン・デイ・ホールデン アメリカ合衆国94019 カリフオルニア 州・ハーフ ムーン ベイ・シエルター コウブ・380 (72)発明者 ジヨン・ケイ・マサツグ アメリカ合衆国 94043 カリフオルニ ア州・マウンテンビユー・フリン アヴ エニユウ・90―シイ (72)発明者 ルイス・ジエイ・マーグラフ アメリカ合衆国 94040 カリフオルニ ア州・マウンテンビユー・スワンソン ウエイ・2650 (72)発明者 デイビツド・ピー・オウエン アメリカ合衆国 94301 カリフオルニ ア州・パロ アルト・アデイソン アヴ エニユウ・567 (72)発明者 ピーター・ダブリユ・ジエイ・ストーン ブリツジ アメリカ合衆国 95136 カリフオルニ ア州・サン ホゼ・アンフイールド コ ート・4052 (56)参考文献 特開 昭54−145406（ＪＰ，Ａ) 特開 昭54−29504（ＪＰ，Ａ) 特開 昭57−4636（ＪＰ，Ａ)
Claims (12)
- 【請求項１】ディジタル化された音声とデータを個別パ
ケットで交信する通信回路網（10）であって： 第１ノード（14）と第２ノード（16）とを少なくとも有
するディジタル通信媒体（12）にして、所定のビット同
期のフレーム構造（第3B図）を持つ標準化されたビット
同期通信フォーマットに従って、標準化されたビット同
期のディジタル時間フレームで情報を通信するディジタ
ル通信媒体（12）を備え； 前記ディジタル通信媒体（12）に対してその前記第１の
ノード（14）にてディジタル信号を結合する結合手段
（100,103,90,94,96,102,98）を備え、この結合手段は
信号をパケット化してディジタル化した情報パケット
（第3A図）にするパケット化する手段（100）を含み、
そのディジタル化した情報パケットのパケット・フォー
マットが、宛先アドレスの全ての情報および完全なメッ
セージユニットを含むとともに、前記ビット同期通信フ
ォーマット（b1,b2,b3,b4,b5,b6,b7,b8）にビット同期
していて、前記標準化されたビット同期のディジタル時
間フレームの区切りに従って始まり且つ終わるものであ
る、 ことを特徴とする通信回路網。 - 【請求項２】特許請求の範囲第１項記載の通信回路網に
おいて、前記ディジタル通信媒体（12）は第３ノード
（18）を含み、前記結合手段は、前記第１ノード（14）
から前記第２ノード（16）または前記第３ノード（18）
への、前記ディジタル化した情報パケットのスイッチン
グ手段を含み、前記第１ノード（14），前記第２ノード
（16）、前記第３ノード（18）の相互間でパケットスイ
ッチングの同期が維持されている、ことを特徴とする通
信回路網。 - 【請求項３】特許請求の範囲第１項記載の通信回路網に
おいて、前記ディジタル通信媒体（12）は少なくとも第
３ノード（18）を含み、前記結合手段は、前記第１ノー
ド（14）から前記第２ノード（16）へ、それから更に前
記第３ノード（18）への、前記ディジタル化した情報パ
ケットのスイッチング手段を含み、前記第１ノード（1
4），前記第２ノード（16）、前記第３ノード（18）の
相互間でパケットスイッチングの同期が維持されてい
る、ことを特徴とする通信回路網。 - 【請求項４】特許請求の範囲第１項記載の通信回路網に
おいて、前記標準化されたビット同期通信フォーマット
は193ビットのフレームを有し、前記ディジタル化した
情報パケットは、フォーマットとして、アドレスおよび
エラー訂正の24ビットのフィールドと168ビットの情報
フィールドおよび１ビットの同期フィールドを有する、
ことを特徴とする通信回路網。 - 【請求項５】特許請求の範囲第４項記載の通信回路網に
おいて、前記ディジタル化した情報パケットは、通常動
作時４ビットでコード化されている音声のパケットであ
る、ことを特徴とする通信回路網。 - 【請求項６】特許請求の範囲第４項記載の通信回路網に
おいて、前記ディジタル化した情報パケットは、通常動
作時８ビット・バイトのデータのパケットである、こと
を特徴とする通信回路網。 - 【請求項７】特許請求の範囲第１項記載の通信回路網に
おいて、前記パケット化する手段は、音声やデータのパ
ケットを通常動作時18ミリ秒未満の遅れでスイッチング
することを特徴とする通信回路網。 - 【請求項８】特許請求の範囲第５項記載の通信回路網に
おいて、前記パケット化する手段は、音声のパケットを
通常動作時18ミリ秒以下の遅れでスイッチングすること
を特徴とする通信回路網。 - 【請求項９】特許請求の範囲第１項記載の通信回路網に
おいて、前記パケット化する手段は、ディジタル通話挿
入（DSI）に従って音声信号を圧縮し、アダプティブ・
ディファレンシャル・パルス・コード・モジュレーショ
ン（ADPCM）技術を使用する装置のような音声データ・
レート圧縮装置において使用するために上記音声信号を
エンコードする機能を有することを特徴とする通信回路
網。 - 【請求項１０】特許請求の範囲第９項記載の通信回路網
において、音声のパケットは、前記ディジタル通信媒体
の能力を越える動作においては、破棄されることを特徴
とする通信回路網。 - 【請求項１１】特許請求の範囲第１項記載の通信回路網
において、前記ディジタル通信媒体は、電話回線のディ
ジタル・トランクであることを特徴とする通信回路網。 - 【請求項１２】特許請求の範囲第１項記載の通信回路網
において、前記ディジタル通信媒体は、通常のビデオ・
チャネル内において前記標準化されたビット同期通信フ
ォーマットに従った信号を伝送できるケーブルTVシステ
ムであることを特徴とする通信回路網。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US06/665,819 US4771425A (en) | 1984-10-29 | 1984-10-29 | Synchoronous packet voice/data communication system |
| US665819 | 2000-09-20 |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4208569A Division JPH05276243A (ja) | 1984-10-29 | 1992-07-14 | ディジタル信号結合装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61107856A JPS61107856A (ja) | 1986-05-26 |
| JP2527931B2 true JP2527931B2 (ja) | 1996-08-28 |
Family
ID=24671685
Family Applications (2)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60219278A Expired - Lifetime JP2527931B2 (ja) | 1984-10-29 | 1985-10-03 | 通信回路網 |
| JP4208569A Pending JPH05276243A (ja) | 1984-10-29 | 1992-07-14 | ディジタル信号結合装置 |
Family Applications After (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4208569A Pending JPH05276243A (ja) | 1984-10-29 | 1992-07-14 | ディジタル信号結合装置 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US4771425A (ja) |
| EP (1) | EP0179979B1 (ja) |
| JP (2) | JP2527931B2 (ja) |
| DE (1) | DE3586031D1 (ja) |
Families Citing this family (212)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4675863A (en) | 1985-03-20 | 1987-06-23 | International Mobile Machines Corp. | Subscriber RF telephone system for providing multiple speech and/or data signals simultaneously over either a single or a plurality of RF channels |
| IL79775A (en) * | 1985-08-23 | 1990-06-10 | Republic Telcom Systems Corp | Multiplexed digital packet telephone system |
| US4907186A (en) * | 1987-02-09 | 1990-03-06 | The United States Of America As Represented By The Secretary Of Commerce | Data direct ingest system |
| US5228129A (en) * | 1987-04-01 | 1993-07-13 | Digital Equipment Corporation | Synchronous communication interface for reducing the effect of data processor latency |
| US4893306A (en) * | 1987-11-10 | 1990-01-09 | Bell Communications Research, Inc. | Method and apparatus for multiplexing circuit and packet traffic |
| JPH01179597A (ja) * | 1988-01-11 | 1989-07-17 | Fujitsu Ltd | 分散制御方式 |
| JPH0773394B2 (ja) * | 1988-03-09 | 1995-08-02 | 富士通株式会社 | 異種通信網の一元的通信網への統合方法 |
| AU614246B2 (en) * | 1988-07-11 | 1991-08-22 | Nec Infrontia Corporation | Packet switching system for a distributed processing isdn switch |
| GB2224181B (en) * | 1988-08-25 | 1993-05-19 | Canon Kk | Telephone system |
| US5107493A (en) * | 1989-08-02 | 1992-04-21 | At&T Bell Laboratories | High-speed packet data network using serially connected packet and circuit switches |
| AU639088B2 (en) * | 1990-04-13 | 1993-07-15 | Digital Equipment Corporation | Telecommunications network with plesiochronous transfer mode |
| US5115429A (en) * | 1990-08-02 | 1992-05-19 | Codex Corporation | Dynamic encoding rate control minimizes traffic congestion in a packet network |
| US5115431A (en) * | 1990-09-28 | 1992-05-19 | Stratacom, Inc. | Method and apparatus for packet communications signaling |
| US5243342A (en) * | 1990-09-28 | 1993-09-07 | Stratacom, Inc. | Integrated PCM level control and conversion using a lookup table |
| AU652814B2 (en) * | 1991-02-01 | 1994-09-08 | Republic Telcom Systems Corporation | Packet switching communications system |
| JP2680198B2 (ja) * | 1991-02-08 | 1997-11-19 | 三菱電機株式会社 | 音声ディジタル１リンク接続方式 |
| AU1586992A (en) * | 1991-02-28 | 1992-10-06 | Stratacom, Inc. | Method and apparatus for routing cell messages using delay |
| US5224099A (en) * | 1991-05-17 | 1993-06-29 | Stratacom, Inc. | Circuitry and method for fair queuing and servicing cell traffic using hopcounts and traffic classes |
| US5335356A (en) * | 1991-09-05 | 1994-08-02 | Telefonaktiebolaget L M Ericsson | Adaptive resource allocation in a mobile telephone system |
| US5421030A (en) * | 1991-09-17 | 1995-05-30 | Com21, Inc. | Communications system and method for bi-directional communications between an upstream control facility and downstream user terminals |
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