JP2023504291A - ビデオ符号化のための方法および装置 - Google Patents
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Abstract
Description
本出願は、2020年10月2日に出願された米国仮出願第63/087,042号「TRANSFORMATION SCHEME FOR L-SHAPED PARTITION」の優先権の利益を主張する、2021年4月19日に出願された米国特許出願第17/234507号「METHOD AND APPARATUS FOR VIDEO CODING」の優先権の利益を主張する。先行出願の開示全体は、参照によりその全体が本明細書に組み込まれる。
られている。開示された主題は、VVCの文脈で使用されることがある。
-CTUサイズ:四分木のルートノードサイズ、例えば、HEVCと同じ概念
-MinQTSize:四分木リーフノードの最小許容サイズ
-MaxBTSize:二分木ルートノードの最大許容サイズ
-MaxBTDepth:二分木の最大許容深さ
-MinBTSize:二分木リーフノードの最小許容サイズ
JEM:joint exploration model 共同探索モデル
VVC:versatile video coding 多用途ビデオ符号化
BMS:benchmark set ベンチマークセット
MV:Motion Vector 動きベクトル
HEVC:High Efficiency Video Coding 高効率ビデオ符号化
SEI:Supplementary Enhancement Information 補足エンハンスメント情報
VUI:Video Usability Information ビデオユーザビリティ情報
GOP:Groups of Pictures グループオブピクチャ
TU:Transform Units 変換ユニット
PU:Prediction Units 予測ユニット
CTU:Coding Tree Units 符号化ツリーユニット
CTB:Coding Tree Blocks 符号化ツリーブロック
PB:Prediction Blocks 予測ブロック
HRD:Hypothetical Reference Decoder 仮想参照デコーダ
SNR:Signal Noise Ratio 信号対雑音比
CPU:Central Processing Units 中央処理装置
GPU:Graphics Processing Units グラフィックス処理装置
CRT:Cathode Ray Tube ブラウン管
LCD:Liquid-Crystal Display 液晶ディスプレイ
OLED:Organic Light-Emitting Diode 有機発光ダイオード
CD:Compact Disc コンパクトディスク
DVD:Digital Video Disc デジタルビデオディスク
ROM:Read-Only Memory 読み出し専用メモリ
RAM:Random Access Memory ランダムアクセスメモリ
ASIC:Application-Specific Integrated Circuit 特定用途向け集積回路
PLD:Programmable Logic Device プログラマブルロジックデバイス
LAN:Local Area Network ローカルエリアネットワーク
GSM:Global System for Mobile communications グローバル移動体通信システム
LTE:Long-Term Evolution ロングタームエボリューション
CANBus:Controller Area Network Bus コントローラエリアネットワークバス
USB:Universal Serial Bus ユニバーサルシリアルバス
PCI:Peripheral Component Interconnect 周辺構成要素相互接続
FPGA:Field Programmable Gate Areas フィールドプログラマブルゲートエリア
SSD:solid-state drive ソリッドステートドライブ
IC:Integrated Circuit 集積回路
CU:Coding Unit 符号化ユニット
TSM:Transform Skip Mode 変換スキップモード
IBC:Intra Block Copy イントラブロックコピー
DPCM:Differential pulse-code modulation 差動パルス符号変調
BDPCM:Block based DPCM ブロックベースDPCM
110 端末装置
120 端末装置
130 端末装置
140 端末装置
150 ネットワーク
200 通信システム
201 ビデオソース
202 ストリーム
203 ビデオエンコーダ
204 ビデオデータ
205 ストリーミングサーバ
206 クライアントサブシステム
207 ビデオデータ
209 ビデオデータ
210 ビデオデコーダ
211 ビデオ画像の出力ストリーム
212 ディスプレイ
213 キャプチャサブシステム
220 電子装置
230 電子装置
301 チャネル
310 ビデオデコーダ
312 レンダリング装置
315 バッファメモリ
320 パーサ
321 シンボル
330 電子装置
331 受信機
351 逆変換ユニット
352 イントラ画像予測ユニット
353 動き補償予測ユニット
355 集約装置
356 ループフィルタユニット
357 参照画像メモリ
358 画像バッファ
401 ビデオソース
403 ビデオエンコーダ
420 電子装置
430 ソースコーダ
432 符号化エンジン
433 デコーダ
434 参照画像バッファ
435 予測器
440 送信機
443 ビデオシーケンス
445 エントロピーコーダ
450 コントローラ
460 通信チャネル
503 ビデオエンコーダ
521 一般コントローラ
522 イントラエンコーダ
523 残差算出部
524 残差エンコーダ
525 エントロピーエンコーダ
526 スイッチ
528 残差デコーダ
530 インターエンコーダ
610 ビデオデコーダ
671 エントロピーデコーダ
672 イントラデコーダ
673 残差デコーダ
674 再構成モジュール
680 インターデコーダ
710 画像
720 ブロック
721 第1の様式
722 第2の様式
723 第3の様式
724 第4の様式
810 画像
820 ブロック
821 様式
822 様式
823 様式
824 様式
825 様式
826 様式
827 様式
828 様式
829 様式
830 様式
920 ブロック分割構造
1100 L字形分割
1100 L字形ブロック
1210 L型分割ツリー
1220 L型分割ツリー
1230 L型分割ツリー
1240 L型分割ツリー
1410 ブロック
1510 ブロック
1600 L字形ブロック
1601 矩形ブロック
1700 L字形ブロック
1701 ブロック
1702 ブロック
1703 ブロック
1810 L字形ブロック
1811 ブロック
1820 L字形状ブロック
1821 ブロック
1910 L字型ブロック
1911 矩形ブロック
1912 矩形ブロック
1913 矩形ブロック
2000 L字形変換ユニット
2100 L字形変換ユニット
2210 L字形残差ブロック
2220 L字形変換係数ブロック
2310 L字形残差ブロック
2320 L字形変換係数ブロック
2410 L字形残差ブロック
2420 変換係数ブロック
2510 L字形残差ブロック
2520 L字形変換係数ブロック
2600 L字形分割
2610 ジグザグ走査順序
2700 プロセス
2800 コンピュータシステム
2801 キーボード
2802 マウス
2803 トラックパッド
2805 ジョイスティック
2806 マイクロフォン
2807 スキャナ
2808 カメラ
2809 スピーカ
2810 画面
2821 媒体
2822 サムドライブ
2823 ソリッドステートドライブ
2840 コア
2841 コンピュータ中央処理装置
2842 グラフィックス処理装置
2843 FPGA
2844 アクセラレータ
2845 ROM
2846 ランダムアクセスメモリ
2847 大容量記憶装置
2848 システムバス
2849 周辺バス
Claims (20)
- デコーダにおけるビデオ復号のための方法であって、
プロセッサによって、符号化されたビデオビットストリームから、画像の非矩形分割である符号化ブロックに関連付けられた変換係数を復号するステップと、
前記プロセッサによって、前記変換係数に基づいて前記符号化ブロックの残差を決定するステップと、
前記プロセッサによって、前記符号化ブロックの前記残差に基づいて前記符号化ブロックのサンプルを再構成するステップと、
を含む方法。 - 前記プロセッサによって、前記変換係数における第1の変換係数に基づいて、第1の矩形サブブロックの第1の残差を決定するステップであって、前記第1の矩形サブブロックが前記非矩形分割の第1の分割である、ステップ
をさらに含む、請求項1に記載の方法。 - 前記プロセッサによって、前記変換係数における第2の変換係数に基づいて、第2の矩形サブブロックの第2の残差を決定するステップであって、前記第2の矩形サブブロックが、前記非矩形分割の第2の分割であり、前記第1の矩形サブブロックと同じサイズを有する、ステップ
をさらに含む、請求項2に記載の方法。 - 前記プロセッサによって、前記変換係数における第2の変換係数に基づいて、第2の矩形サブブロックの第2の残差を決定するステップであって、前記第2の矩形サブブロックが、前記非矩形分割の第2の分割であり、前記第1の矩形サブブロックとは異なるサイズを有する、ステップ
をさらに含む、請求項2に記載の方法。 - 変換ユニットの逆変換を第1の方向に実行することによって、中間変換ユニットの中間変換係数を決定するステップであって、前記変換ユニットが前記変換係数によって形成される、ステップと、
前記中間変換ユニットの逆変換を第2の方向に実行することによって、前記符号化ブロックの前記残差を決定するステップと、
をさらに含む、請求項1に記載の方法。 - 前記変換ユニットの第1の列に対して第1の逆変換演算をそれぞれ実行するステップであって、前記第1の逆変換演算がそれぞれ第1の数の点の逆変換である、ステップと、
前記変換ユニットの第2の列に対して第2の逆変換演算をそれぞれ実行するステップであって、前記第2の逆変換演算がそれぞれ第2の数の点の逆変換である、ステップと、
前記中間変換ユニットの第1の行に対して第3の逆変換演算をそれぞれ実行するステップであって、前記第3の逆変換演算がそれぞれ第3の数の点の逆変換である、ステップと、
前記中間変換ユニットの第2の行に対して第4の逆変換演算をそれぞれ実行するステップであって、前記第4の逆変換演算がそれぞれ第4の数の点の逆変換である、ステップと、
をさらに含む、請求項5に記載の方法。 - 前記変換ユニットの第1の行に対して第1の逆変換演算をそれぞれ実行するステップであって、前記第1の逆変換演算がそれぞれ第1の数の点の逆変換である、ステップと、
前記変換ユニットの第2の行に対して第2の逆変換演算をそれぞれ実行するステップであって、前記第2の逆変換演算がそれぞれ第2の数の点の逆変換である、ステップと、
前記中間変換ユニットの第1の列に対して第3の逆変換演算をそれぞれ実行するステップであって、前記第3の逆変換演算がそれぞれ第3の数の点の逆変換である、ステップと、
前記中間変換ユニットの第2の列に対して第4の逆変換演算をそれぞれ実行するステップであって、前記第4の逆変換演算がそれぞれ第4の数の点の逆変換である、ステップと、
をさらに含む、請求項5に記載の方法。 - 前記プロセッサによって、前記変換係数の逆カルーネン・レーベ変換(KLT)を実行することによって前記符号化ブロックの前記残差を決定するステップ
をさらに含む、請求項1に記載の方法。 - 前記プロセッサが、前記変換係数の2次元逆変換を実行することによって前記非矩形分割を含む矩形ユニットの第1の残差を決定するステップと、
前記プロセッサによって、前記矩形ユニットの前記第1の残差から前記符号化ブロックの前記残差を選択するステップと、
をさらに含む、請求項1に記載の方法。 - 前記非矩形分割を包含する矩形ユニットに対する走査順序に従うことによって、前記非矩形分割に対する変換ユニットを形成するステップと、
前記非矩形分割の外にある走査位置をスキップするステップと、
をさらに含む、請求項1に記載の方法。 - ビデオ復号のための装置であって、
符号化されたビデオビットストリームから、画像の非矩形分割である符号化ブロックに関連付けられた変換係数を復号し、
前記変換係数に基づいて前記符号化ブロックの残差を決定し、
前記符号化ブロックの前記残差に基づいて前記符号化ブロックのサンプルを再構成する
ように構成された処理回路
を備える装置。 - 前記処理回路が、前記変換係数における第1の変換係数に基づいて、第1の矩形サブブロックの第1の残差を決定するようにさらに構成され、前記第1の矩形サブブロックが前記非矩形分割の第1の分割である、請求項11に記載の装置。
- 前記処理回路が、前記変換係数における第2の変換係数に基づいて、第2の矩形サブブロックの第2の残差を決定するようにさらに構成され、前記第2の矩形サブブロックが、前記非矩形分割の第2の分割であり、前記第1の矩形サブブロックと同じサイズを有する、請求項12に記載の装置。
- 前記処理回路が、前記変換係数における第2の変換係数に基づいて、第2の矩形サブブロックの第2の残差を決定するようにさらに構成され、前記第2の矩形サブブロックが、前記非矩形分割の第2の分割であり、前記第1の矩形サブブロックとは異なるサイズを有する、請求項12に記載の装置。
- 前記処理回路が、
変換ユニットの逆変換を第1の方向に実行することによって、中間変換ユニットの中間変換係数を決定し、前記変換ユニットが前記変換係数によって形成され、
前記中間変換ユニットの逆変換を第2の方向に実行することによって、前記符号化ブロックの前記残差を決定する
ようにさらに構成された、請求項11に記載の装置。 - 前記処理回路が、
前記変換ユニットの第1の列に対して第1の逆変換演算をそれぞれ実行し、前記第1の逆変換演算がそれぞれ第1の数の点の逆変換であり、
前記変換ユニットの第2の列に対して第2の逆変換演算をそれぞれ実行し、前記第2の逆変換演算がそれぞれ第2の数の点の逆変換であり、
前記中間変換ユニットの第1の行に対して第3の逆変換演算をそれぞれ実行し、前記第3の逆変換演算がそれぞれ第3の数の点の逆変換であり、
前記中間変換ユニットの第2の行に対して第4の逆変換演算をそれぞれ実行し、前記第4の逆変換演算がそれぞれ第4の数の点の逆変換である
ようにさらに構成された、請求項15に記載の装置。 - 前記処理回路が、
前記変換ユニットの第1の行に対して第1の逆変換演算をそれぞれ実行し、前記第1の逆変換演算がそれぞれ第1の数の点の逆変換であり、
前記変換ユニットの第2の行に対して第2の逆変換演算をそれぞれ実行し、前記第2の逆変換演算がそれぞれ第2の数の点の逆変換であり、
前記中間変換ユニットの第1の列に対して第3の逆変換演算をそれぞれ実行し、前記第3の逆変換演算がそれぞれ第3の数の点の逆変換であり、
前記中間変換ユニットの第2の列に対して第4の逆変換演算をそれぞれ実行し、前記第4の逆変換演算がそれぞれ第4の数の点の逆変換である
ようにさらに構成された、請求項15に記載の装置。 - 前記処理回路が、
前記変換係数の逆カルーネン・レーベ変換(KLT)を実行することによって前記符号化ブロックの前記残差を決定する
ようにさらに構成された、請求項11に記載の装置。 - 前記処理回路が、
前記変換係数の2次元逆変換を実行することによって、前記非矩形分割を含む矩形ユニットの第1の残差を決定し、
前記矩形ユニットの前記第1の残差から前記符号化ブロックの前記残差を選択する
ようにさらに構成された、請求項11に記載の装置。 - 前記処理回路が、
前記非矩形分割を包含する矩形ユニットに対する走査順序に従うことによって、前記非矩形分割に対する変換ユニットを形成し、
前記非矩形分割の外にある走査位置をスキップする
ようにさらに構成された、請求項11に記載の装置。
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