JP2023177434A - Semiconductor device - Google Patents

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和広 安達
Kazukiro Adachi
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Abstract

To provide a semiconductor device that can determine whether stress due to impact or heat is applied thereto.SOLUTION: A semiconductor device comprises: a semiconductor chip that has a semiconductor substrate including an internal circuit, a terminal for input and output connected with the internal circuit, and a terminal for inspection whose contact area with the semiconductor substrate is smaller than the contact area of the terminal for input and output with the semiconductor substrate; a wire that is connected with the terminal for input and output and the terminal for inspection; and a wiring board that is connected with the terminal for input and output and the terminal for inspection through the wire.SELECTED DRAWING: Figure 6

Description

本発明は、半導体装置に関する。 The present invention relates to a semiconductor device.

従来、特許文献1に示すように、記憶装置が設けられた消耗品ユニットが知られている。この記憶装置には、消耗品ユニットのリユース回数が記憶される。また、この記憶装置は、EEPROM(Electrically Erasable Programmable Read-Only Memory)などの半導体装置である。 Conventionally, as shown in Patent Document 1, a consumable unit provided with a storage device is known. This storage device stores the number of times the consumable unit is reused. Further, this storage device is a semiconductor device such as an EEPROM (Electrically Erasable Programmable Read-Only Memory).

特開2015-20315号公報JP 2015-20315 Publication

消耗品ユニットの使用時や、使用済みの消耗品ユニットの回収時などにおいて、消耗品ユニットは、衝撃を受けたり、高温環境に放置されたりすることがある。消耗品ユニットに衝撃や熱などによる応力が加わると、リユース回数の多少に係わらず、消耗品ユニットに不具合が生じる虞がある。例えば、消耗品ユニットに設けられた記憶装置に衝撃や熱などによる応力が加わると、記憶装置が損傷する虞がある。損傷した記憶装置は、記憶装置の動作確認テストでは正常動作が確認できたとしても、リユースには適さない。
しかしながら、特許文献1に記載の技術では、消耗品ユニットに衝撃や熱による応力が加えられたか否かを判定することができないという課題がある。
When using a consumable unit or collecting a used consumable unit, the consumable unit may be subjected to impact or left in a high temperature environment. If stress due to impact or heat is applied to the consumable unit, there is a risk that the consumable unit will malfunction, regardless of the number of times it is reused. For example, if stress due to shock or heat is applied to a storage device provided in a consumable unit, there is a risk that the storage device will be damaged. A damaged storage device is not suitable for reuse, even if normal operation is confirmed in a storage device operation test.
However, the technique described in Patent Document 1 has a problem in that it cannot determine whether stress due to impact or heat has been applied to the consumable unit.

半導体装置は、内部回路を含む半導体基板と、前記内部回路と接続される入出力用端子と、前記半導体基板と前記入出力用端子との接触面積よりも前記半導体基板との接触面積が小さい検査用端子と、を有する半導体チップと、前記入出力用端子および前記検査用端子とそれぞれ接続されるワイヤーと、前記入出力用端子および前記検査用端子と前記ワイヤーを介して接続される配線基板と、を備える。 A semiconductor device has a semiconductor substrate including an internal circuit, an input/output terminal connected to the internal circuit, and a contact area with the semiconductor substrate that is smaller than a contact area between the semiconductor substrate and the input/output terminal. a semiconductor chip having a terminal for input/output, a wire connected to the input/output terminal and the inspection terminal, respectively, and a wiring board connected to the input/output terminal and the inspection terminal via the wire; , is provided.

半導体装置は、内部回路を含む半導体基板と、前記内部回路と接続される入出力用端子と、前記入出力用端子よりも厚さが小さい検査用端子と、を有する半導体チップと、前記入出力用端子および前記検査用端子とそれぞれ接続されるワイヤーと、前記入出力用端子および前記検査用端子と前記ワイヤーを介して接続される配線基板と、を備える。 A semiconductor device includes a semiconductor chip having a semiconductor substrate including an internal circuit, an input/output terminal connected to the internal circuit, an inspection terminal whose thickness is smaller than the input/output terminal, and the input/output terminal. and a wiring board connected to the input/output terminal and the inspection terminal via the wire.

半導体装置は、内部回路を含む半導体基板と、前記内部回路と接続される入出力用端子と、検査用端子と、を有する半導体チップと、前記入出力用端子と接続される第1ワイヤーと、前記検査用端子と接続される第2ワイヤーと、前記入出力用端子と前記第1ワイヤーを介して接続され、前記検査用端子と前記第2ワイヤーを介して接続される配線基板と、を備え、前記検査用端子と前記第2ワイヤーとの接触面積は、前記入出力用端子と前記第1ワイヤーとの接触面積よりも小さい。 The semiconductor device includes: a semiconductor substrate including an internal circuit; a semiconductor chip having an input/output terminal connected to the internal circuit; and a testing terminal; a first wire connected to the input/output terminal; a second wire connected to the test terminal; a wiring board connected to the input/output terminal via the first wire; and a wiring board connected to the test terminal via the second wire. , a contact area between the test terminal and the second wire is smaller than a contact area between the input/output terminal and the first wire.

実施形態1に係る半導体装置を備えるインクカートリッジを示す斜め上方からの正面斜視図。1 is a front perspective view from diagonally above showing an ink cartridge including a semiconductor device according to a first embodiment; FIG. 図1に示すインクカートリッジの背面斜視図。2 is a rear perspective view of the ink cartridge shown in FIG. 1. FIG. 回路基板の表面を示す平面図。FIG. 3 is a plan view showing the surface of the circuit board. 回路基板の裏面を示す平面図。FIG. 3 is a plan view showing the back side of the circuit board. 図1に示す取り付け部を拡大した部分斜視図。FIG. 2 is an enlarged partial perspective view of the attachment portion shown in FIG. 1; 実施形態1に係る半導体装置の平面図。1 is a plan view of a semiconductor device according to a first embodiment. 図6中のA-A線断面図。A sectional view taken along the line AA in FIG. 6. 図6のB1部の位置に相当する平面図。FIG. 7 is a plan view corresponding to the position of part B1 in FIG. 6; 図6のC1部の位置に相当する平面図。FIG. 7 is a plan view corresponding to the position of part C1 in FIG. 6; 実施形態2に係る半導体装置の平面図。FIG. 2 is a plan view of a semiconductor device according to a second embodiment. 図10中のB-B線断面図。11 is a sectional view taken along line BB in FIG. 10. 実施形態3に係る半導体装置の平面図。FIG. 3 is a plan view of a semiconductor device according to a third embodiment. 図12中のC-C線断面図。FIG. 13 is a sectional view taken along line CC in FIG. 12. 実施形態4に係る半導体装置の平面図。FIG. 4 is a plan view of a semiconductor device according to a fourth embodiment. 図14中のD-D線断面図。15 is a sectional view taken along line DD in FIG. 14. 実施形態5に係る半導体装置の平面図。FIG. 7 is a plan view of a semiconductor device according to a fifth embodiment. 図16のE1部の位置に相当する平面図。FIG. 17 is a plan view corresponding to the position of part E1 in FIG. 16; 図16のF1部の位置に相当する平面図。FIG. 17 is a plan view corresponding to the position of section F1 in FIG. 16; 実施形態6に係る半導体装置の図16のF1部の位置に相当する平面図。17 is a plan view of the semiconductor device according to Embodiment 6, corresponding to the position of section F1 in FIG. 16. FIG. 実施形態7に係る半導体装置の図16のF1部の位置に相当する平面図。17 is a plan view of the semiconductor device according to Embodiment 7, corresponding to the position of section F1 in FIG. 16. FIG.

1.実施形態1
まず、実施形態1に係る半導体装置24を備えるインクカートリッジ10について、図1~図5を参照して説明し、次に、実施形態1に係る半導体装置24について、図6~図9を参照して説明する。
1. Embodiment 1
First, the ink cartridge 10 including the semiconductor device 24 according to the first embodiment will be explained with reference to FIGS. 1 to 5. Next, the semiconductor device 24 according to the first embodiment will be explained with reference to FIGS. 6 to 9. I will explain.

インクカートリッジ10は、消耗品ユニットの一例である。インクカートリッジ10は、インクジェット式記録装置のキャリッジに着脱して用いられる。なお、インクカートリッジ10は、インク以外の液体を収容する液体カートリッジにも適用することができる。このような液体カートリッジは、液体を噴射する液体噴射ヘッドを備えた液体噴射装置に着脱可能に装着される。液体噴射装置としては、例えば、液晶ディスプレイなどのカラーフィルターの製造に用いられる色材噴射装置、有機ELディスプレイなどの電極形成に用いられる電極材噴射装置、バイオチップの製造に用いられる生体有機物を含む液体を噴射する液体噴射装置などが挙げられる。 The ink cartridge 10 is an example of a consumable unit. The ink cartridge 10 is used by being attached to and detached from a carriage of an inkjet recording apparatus. Note that the ink cartridge 10 can also be applied to a liquid cartridge that stores liquids other than ink. Such a liquid cartridge is removably attached to a liquid ejecting device equipped with a liquid ejecting head that ejects liquid. Examples of liquid ejecting devices include coloring material ejecting devices used for manufacturing color filters for liquid crystal displays, electrode material ejecting devices used for forming electrodes for organic EL displays, and biological organic materials used for manufacturing biochips. Examples include a liquid ejecting device that ejects liquid.

図1および図2に示すように、インクカートリッジ10は、カートリッジ本体12と、蓋体14と、を有する。カートリッジ本体12は、図示しない凹部を有する箱状である。この凹部の図示しない開口部は、蓋体14によって覆われる。このようにして、カートリッジ本体12と蓋体14との間に、インクを収容するインク収容部が形成される。 As shown in FIGS. 1 and 2, the ink cartridge 10 includes a cartridge body 12 and a lid 14. As shown in FIGS. The cartridge body 12 is box-shaped and has a recess (not shown). An opening (not shown) of this recess is covered with a lid 14. In this way, an ink accommodating portion for accommodating ink is formed between the cartridge body 12 and the lid 14.

カートリッジ本体12には、図示しないインク流路部と、図示しない大気連通部と、が形成される。インク流路部は、インク収容部からインク供給部16へインクを供給するためのインク流路である。大気連通部は、インクカートリッジ10の外部とインク収容部との間の大気の流路である。大気連通部は、インク側通路、大気弁収容部、および大気側通路により構成される。大気連通部は、それぞれを区画する隔壁にフィルム11を熱溶着などの方法で貼着することにより大気と隔離された領域となっている。 The cartridge main body 12 is formed with an ink flow path section (not shown) and an atmosphere communication section (not shown). The ink channel section is an ink channel for supplying ink from the ink storage section to the ink supply section 16. The atmospheric communication section is an atmospheric flow path between the outside of the ink cartridge 10 and the ink storage section. The atmosphere communication section includes an ink side passage, an atmosphere valve accommodating part, and an atmosphere side passage. The atmosphere communication section is an area isolated from the atmosphere by attaching the film 11 to the partition wall that partitions each section by a method such as thermal welding.

また、インクカートリッジ10は、インク供給部16と、図示しないインク供給制御部と、係合レバー18と、取り付け部19と、回路基板20と、を有する。 The ink cartridge 10 also includes an ink supply section 16, an ink supply control section (not shown), an engagement lever 18, an attachment section 19, and a circuit board 20.

インク供給部16は、カートリッジ本体12の下面に配置される。インクカートリッジ10がキャリッジに装着されたとき、キャリッジに設けられたインク供給針がインク供給部16に挿入される。インク供給針がインク供給部16に挿入されることにより、インクを噴射する記録ヘッドとインク供給針との間に設けられるインク流路を介して、インク収容部に収容されているインクが、記録ヘッドに供給される。インク供給部16は、インク供給針が挿入される挿入口を有するエラストマーなどから形成されたシール部材と、シール部材の挿入口を塞ぐ供給弁と、供給弁をシール部材に向けて付勢するコイルスプリングなどからなる付勢部材とを有する。なお、シール部材の挿入口には、工場出荷時において、フィルム13が貼り付けられている。 The ink supply section 16 is arranged on the lower surface of the cartridge main body 12. When the ink cartridge 10 is mounted on the carriage, an ink supply needle provided on the carriage is inserted into the ink supply section 16. When the ink supply needle is inserted into the ink supply section 16, the ink stored in the ink storage section is transferred to the ink storage section through the ink flow path provided between the ink supply needle and the recording head that ejects ink. supplied to the head. The ink supply unit 16 includes a seal member made of an elastomer or the like having an insertion port into which an ink supply needle is inserted, a supply valve that closes the insertion port of the seal member, and a coil that urges the supply valve toward the seal member. It has a biasing member made of a spring or the like. Note that a film 13 is attached to the insertion opening of the seal member at the time of shipment from the factory.

インク供給制御部は、インクの消費に伴って発生するインク収容部とインク供給部16との圧力差を調整する差圧弁と、差圧弁を閉じるように付勢するコイルスプリングを備える。 The ink supply control section includes a differential pressure valve that adjusts the pressure difference between the ink storage section and the ink supply section 16 that occurs as ink is consumed, and a coil spring that biases the differential pressure valve to close.

係合レバー18は、カートリッジ本体12の側面の上部に形成される。インクカートリッジ10がキャリッジに装着されたとき、係合レバー18は、キャリッジと係合する。 The engagement lever 18 is formed at the upper side of the cartridge body 12 . When the ink cartridge 10 is installed in the carriage, the engagement lever 18 engages with the carriage.

取り付け部19は、カートリッジ本体12における係合レバー18と反対側の側面の下方に配置される。取り付け部19には、複数の端子21と、記憶装置としての半導体装置24と、を有する回路基板20が取り付けられる。
インクカートリッジ10がキャリッジに装着されたとき、取り付け部19の側面がキャリッジに形成されたリブにより規制されることにより、回路基板20の端子21と、キャリッジに設けられる弾性接点と、が当接する。
The attachment portion 19 is arranged below the side surface of the cartridge body 12 opposite to the engagement lever 18 . A circuit board 20 having a plurality of terminals 21 and a semiconductor device 24 as a storage device is attached to the attachment portion 19 .
When the ink cartridge 10 is mounted on the carriage, the side surface of the mounting portion 19 is restricted by ribs formed on the carriage, so that terminals 21 of the circuit board 20 and elastic contacts provided on the carriage come into contact.

図3および図4に示すように、回路基板20は、平板状の基板23と、複数の端子21と、半導体装置24と、半導体装置24を被覆するモールド樹脂25と、を有する。 As shown in FIGS. 3 and 4, the circuit board 20 includes a flat substrate 23, a plurality of terminals 21, a semiconductor device 24, and a mold resin 25 covering the semiconductor device 24.

基板23は、例えば、プリント基板である。基板23は、表面23Aと、表面23Aとは反対側の裏面23Bと、を有する。表面23Aは、回路基板20をカートリッジ本体12に固定したとき、カートリッジ本体12の外部に露出する面である。
表面23Aには、複数の端子21が配置される。裏面23Bには、半導体装置24が配置される。端子21と、半導体装置24と、は基板23に設けられる図示しない配線により、電気的に接続される。これにより、端子21を介して、半導体装置24に電気的に接続することができる。例えば、端子21を介して、半導体装置24を電源や接地電位に接続したり、記憶装置としての半導体装置24に対して各種の情報の記憶や読み出しなどを行うことができる。
The board 23 is, for example, a printed circuit board. The substrate 23 has a front surface 23A and a back surface 23B opposite to the front surface 23A. The surface 23A is a surface exposed to the outside of the cartridge body 12 when the circuit board 20 is fixed to the cartridge body 12.
A plurality of terminals 21 are arranged on the surface 23A. A semiconductor device 24 is arranged on the back surface 23B. The terminal 21 and the semiconductor device 24 are electrically connected by wiring (not shown) provided on the substrate 23. Thereby, it is possible to electrically connect to the semiconductor device 24 via the terminal 21. For example, the semiconductor device 24 can be connected to a power source or a ground potential via the terminal 21, and various information can be stored and read from the semiconductor device 24 as a storage device.

記憶装置としての半導体装置24は、インクカートリッジ10およびインクに関する情報を記憶する。半導体装置24は、基板23の表面23Aに露出した複数の端子21を介して、インクジェット式記録装置本体との間でこれらの情報を受け渡す。
半導体装置24に記憶する情報としては、例えば、インクカートリッジ10の製造年月日、インクカートリッジ10の種類、インクカートリッジ10が保持するインクの色、インク残量、キャリッジに対して着脱された回数、リユース回数などがある。
The semiconductor device 24 as a storage device stores information regarding the ink cartridge 10 and ink. The semiconductor device 24 exchanges this information with the main body of the inkjet recording apparatus via a plurality of terminals 21 exposed on the surface 23A of the substrate 23.
The information stored in the semiconductor device 24 includes, for example, the manufacturing date of the ink cartridge 10, the type of the ink cartridge 10, the color of the ink held by the ink cartridge 10, the amount of ink remaining, the number of times it has been attached to and removed from the carriage, It includes the number of reuses, etc.

また、基板23には、カートリッジ本体12の取り付け部19に固定されるための位置決め用凹部である貫通孔27と切り欠き部28とが形成される。 Further, the substrate 23 is formed with a through hole 27 and a notch 28 which are positioning recesses for being fixed to the mounting portion 19 of the cartridge body 12 .

図5に示すように、回路基板20は、取り付け部19に形成された取り付け凹部30に嵌め込まれて固定される。回路基板20が取り付け部19に固定されたとき、回路基板20の表面23Aは、カートリッジ本体12の外部に露出している。
取り付け凹部30は、基板23を収容するために基板23より僅かに大きく形成された底部31と、底部31の外縁から立設された壁部32と、により形成される。底部31には、基板23に形成された貫通孔27および切り欠き部28にそれぞれ対応する位置に、位置決め用凸部としてのピン34およびリブ36が立設されている。ピン34およびリブ36が、それぞれ貫通孔27と切り欠き部28との内側にそれぞれ挿入されることにより、回路基板20の位置決めが行われる。また、底部31の中央部分には、基板23の裏面23Bに設けられる半導体装置24と、半導体装置24を被覆するモールド樹脂25と、を収容する空間33が設けられる。
As shown in FIG. 5, the circuit board 20 is fitted into a mounting recess 30 formed in the mounting portion 19 and fixed. When the circuit board 20 is fixed to the attachment part 19, the surface 23A of the circuit board 20 is exposed to the outside of the cartridge body 12.
The mounting recess 30 is formed by a bottom portion 31 formed slightly larger than the substrate 23 to accommodate the substrate 23, and a wall portion 32 erected from the outer edge of the bottom portion 31. Pins 34 and ribs 36 as positioning projections are provided on the bottom 31 at positions corresponding to the through holes 27 and cutouts 28 formed in the substrate 23, respectively. The circuit board 20 is positioned by inserting the pin 34 and the rib 36 inside the through hole 27 and the notch 28, respectively. Furthermore, a space 33 is provided in the center of the bottom portion 31 to accommodate the semiconductor device 24 provided on the back surface 23B of the substrate 23 and the mold resin 25 covering the semiconductor device 24.

取り付け凹部30に嵌め込まれた回路基板20は、貫通孔27および切り欠き部28から基板23の表面23A側に突出したピン34の頂部35およびリブ36の頂部37を熱により軟化させて基板23に向けて押圧することにより熱加締めがなされ、取り付け凹部30内に固定される。なお、ピン34とリブ36を位置決めのためだけに用いて熱加締めを行わず、基板23の裏面23Bと底部31とを接着剤により固定しても構わない。 The circuit board 20 fitted into the mounting recess 30 is attached to the board 23 by softening the tops 35 of the pins 34 and the tops 37 of the ribs 36 that protrude from the through holes 27 and cutouts 28 toward the surface 23A of the board 23 by heat. By pressing toward the mounting hole 30, heat crimping is performed and the mounting recess 30 is fixed. Note that the pins 34 and ribs 36 may be used only for positioning, and the back surface 23B of the substrate 23 and the bottom portion 31 may be fixed with an adhesive without performing heat crimping.

このように構成されたインクカートリッジ10は、インクジェット式記録装置によって印刷が行われ、インクが徐々に消費されていく。インクの残量は、適時、半導体装置24に記憶される。そして、半導体装置24に記憶されているインク残量がゼロになり、インクジェット式記録装置がその情報を読み取ると、インクジェット式記録装置を駆動するコンピューターにインク切れのメッセージ等が表示され、ユーザーに報知される。これにより、ユーザーはインク切れとなったインクカートリッジ10をインクジェット式記録装置のキャリッジから取り外す。
インク切れとなったインクカートリッジ10は、使用済みのインクカートリッジとして、インクカートリッジ10の製造、販売を行うメーカーやベンダーにより回収される。インクカートリッジ10を回収したメーカーやベンダーは、回収されたインクカートリッジ10を検査し、回収されたインクカートリッジ10がリユースに適する状態であるか否かを判定する。回収されたインクカートリッジ10がリユースに適する状態であると判定されたとき、インクカートリッジ10は再整備され、未使用のインクカートリッジに準じる状態に仕上げられ、再び市場に流通される。
The ink cartridge 10 configured in this way is printed by an inkjet recording device, and the ink is gradually consumed. The remaining amount of ink is stored in the semiconductor device 24 at appropriate times. When the remaining amount of ink stored in the semiconductor device 24 reaches zero and the inkjet recording device reads this information, a message such as an out-of-ink message is displayed on the computer that drives the inkjet recording device to notify the user. be done. As a result, the user removes the ink cartridge 10 that has run out of ink from the carriage of the inkjet recording apparatus.
The ink cartridge 10 that has run out of ink is collected as a used ink cartridge by a manufacturer or vendor who manufactures and sells the ink cartridge 10. The manufacturer or vendor who has collected the ink cartridge 10 inspects the collected ink cartridge 10 and determines whether the collected ink cartridge 10 is in a state suitable for reuse. When it is determined that the collected ink cartridge 10 is in a state suitable for reuse, the ink cartridge 10 is refurbished, finished in a state similar to that of an unused ink cartridge, and distributed again on the market.

ところで、インクカートリッジ10の使用時や、インクカートリッジ10の回収時などにおいて、インクカートリッジ10は、衝撃を受けたり、高温環境に放置されたりすることがある。そのため、衝撃や熱などによる応力がインクカートリッジ10に加わり、インクカートリッジ10に不具合が生じることがある。
例えば、衝撃や熱などによる応力が半導体装置24に加わると、半導体装置24が損傷することがある。損傷した半導体装置24は、半導体装置24の動作確認テストでは正常動作が確認できたとしても、半導体装置24の寿命が低下している虞がある。そのため、衝撃や熱などによる応力が加えられた半導体装置24は、リユースには適さない。
By the way, when the ink cartridge 10 is used or when the ink cartridge 10 is collected, the ink cartridge 10 may be subjected to impact or left in a high temperature environment. Therefore, stress due to impact or heat is applied to the ink cartridge 10, which may cause a malfunction in the ink cartridge 10.
For example, if stress due to impact or heat is applied to the semiconductor device 24, the semiconductor device 24 may be damaged. Even if normal operation of the semiconductor device 24 is confirmed in the operation confirmation test of the damaged semiconductor device 24, the life of the semiconductor device 24 may be shortened. Therefore, the semiconductor device 24 that has been subjected to stress due to impact, heat, etc. is not suitable for reuse.

そこで、インクカートリッジ10に衝撃や熱などによる応力が加えられたか否かを判定し、インクカートリッジ10に衝撃や熱などによる応力が加えられたと判定されたとき、損傷した可能性がある半導体装置24を、正常な半導体装置24に交換する。
このように、損傷した可能性がある半導体装置24を正常な半導体装置24に交換することにより、再整備されたインクカートリッジ10の信頼性が向上する。
Therefore, it is determined whether stress due to impact, heat, etc. has been applied to the ink cartridge 10, and when it is determined that stress due to impact, heat, etc. has been applied to the ink cartridge 10, the semiconductor device 24 that may have been damaged is replaced with a normal semiconductor device 24.
In this way, by replacing the potentially damaged semiconductor device 24 with a normal semiconductor device 24, the reliability of the refurbished ink cartridge 10 is improved.

半導体装置24について、図6~図9を参照して説明する。 The semiconductor device 24 will be explained with reference to FIGS. 6 to 9.

図6および図7に示すように、半導体装置24は、半導体チップ40と、配線基板60と、半導体チップ40と配線基板60とを電気的に接続する導電性のワイヤー70と、半導体チップ40とワイヤー70とを被覆するモールド樹脂90と、を有する。なお、説明の都合上、図6では、モールド樹脂90を透過して図示している。 As shown in FIGS. 6 and 7, the semiconductor device 24 includes a semiconductor chip 40, a wiring board 60, a conductive wire 70 that electrically connects the semiconductor chip 40 and the wiring board 60, and a semiconductor chip 40. and a mold resin 90 covering the wire 70. Note that, for convenience of explanation, in FIG. 6, the mold resin 90 is shown transparently.

半導体チップ40は、半導体基板42と、入出力用端子44と、検査用端子46と、を有する。半導体チップ40は、例えば、IC(Integrated Circuit)チップである。 The semiconductor chip 40 has a semiconductor substrate 42, input/output terminals 44, and inspection terminals 46. The semiconductor chip 40 is, for example, an IC (Integrated Circuit) chip.

半導体基板42には、各種の信号処理を行なう内部回路48が形成される。換言すると、半導体基板42は、内部回路48を含む。
内部回路48は、インクカートリッジ10およびインクに関する情報を記憶する記憶回路と、記憶回路などを制御する制御回路と、を有する。内部回路48が記憶回路を有することにより、半導体装置24は、インクカートリッジ10およびインクに関する情報を記憶する記憶装置として機能する。
An internal circuit 48 that performs various signal processing is formed on the semiconductor substrate 42 . In other words, the semiconductor substrate 42 includes the internal circuit 48.
The internal circuit 48 includes a memory circuit that stores information regarding the ink cartridge 10 and ink, and a control circuit that controls the memory circuit and the like. Since the internal circuit 48 has a storage circuit, the semiconductor device 24 functions as a storage device that stores information regarding the ink cartridge 10 and ink.

半導体基板42は、平板状であり、上面42Aと下面42Bとを有する。
半導体基板42の上面42Aには、入出力用端子44と、検査用端子46と、が配置される。詳細には、本実施形態では、半導体基板42の上面42Aには、複数の入出力用端子44と、1つの検査用端子46と、が配置される。
The semiconductor substrate 42 has a flat plate shape and has an upper surface 42A and a lower surface 42B.
On the upper surface 42A of the semiconductor substrate 42, input/output terminals 44 and inspection terminals 46 are arranged. Specifically, in this embodiment, a plurality of input/output terminals 44 and one inspection terminal 46 are arranged on the upper surface 42A of the semiconductor substrate 42.

入出力用端子44は、内部回路48と電気的に接続される。
入出力用端子44は、電源に接続される端子、接地電位に接続される端子、内部回路48に各種の信号を入力するための端子、内部回路48から各種の信号を出力するための端子などを含む。内部回路48に入出力される各種の信号は、インクカートリッジ10およびインクに関する情報を含む。
入出力用端子44のうち、接地電位に接続される端子を接地端子44Aとも言う。
The input/output terminal 44 is electrically connected to the internal circuit 48 .
The input/output terminals 44 include a terminal connected to a power supply, a terminal connected to a ground potential, a terminal for inputting various signals to the internal circuit 48, a terminal for outputting various signals from the internal circuit 48, etc. including. Various signals input to and output from the internal circuit 48 include information regarding the ink cartridge 10 and ink.
Among the input/output terminals 44, the terminal connected to the ground potential is also referred to as a ground terminal 44A.

検査用端子46は、半導体基板42に設けられる配線50を介して、接地端子44Aと電気的に接続される。 The test terminal 46 is electrically connected to the ground terminal 44A via a wiring 50 provided on the semiconductor substrate 42.

配線基板60は、リードフレームである。配線基板60としてのリードフレームは、ダイパッド62と、複数のリード64と、を有する。なお、配線基板60は、リードフレームに限らない。例えば、配線基板60は、インターポーザー基板でも構わない。 The wiring board 60 is a lead frame. The lead frame as the wiring board 60 has a die pad 62 and a plurality of leads 64. Note that the wiring board 60 is not limited to a lead frame. For example, the wiring board 60 may be an interposer board.

ダイパッド62には、半導体基板42が固定される。詳細には、ダイパッド62の上面と、半導体基板42の下面42Bと、の間に配置される図示しない接着部材を介して、ダイパッド62の上面と半導体基板42の下面42Bとが機械的に接続される。 The semiconductor substrate 42 is fixed to the die pad 62 . Specifically, the upper surface of the die pad 62 and the lower surface 42B of the semiconductor substrate 42 are mechanically connected via an adhesive member (not shown) disposed between the upper surface of the die pad 62 and the lower surface 42B of the semiconductor substrate 42. Ru.

リード64と、入出力用端子44および検査用端子46と、は導電性のワイヤー70を介して、電気的に接続される。つまり、リード64と、入出力用端子44および検査用端子46と、はワイヤーボンディングにより、接合される。
導電性のワイヤー70は、例えば、金、アルミニウム、銅により形成される。
The lead 64, the input/output terminal 44, and the inspection terminal 46 are electrically connected via a conductive wire 70. That is, the lead 64, the input/output terminal 44, and the inspection terminal 46 are joined by wire bonding.
The conductive wire 70 is made of, for example, gold, aluminum, or copper.

ワイヤー70は、入出力用端子44とリード64とを電気的に接続する第1ワイヤー71と、検査用端子46とリード64とを電気的に接続する第2ワイヤー72と、を有する。第1ワイヤー71と、第2ワイヤー72と、を区別する必要がないとき、第1ワイヤー71と第2ワイヤー72とをまとめてワイヤー70と言う。 The wire 70 includes a first wire 71 that electrically connects the input/output terminal 44 and the lead 64, and a second wire 72 that electrically connects the test terminal 46 and the lead 64. When there is no need to distinguish between the first wire 71 and the second wire 72, the first wire 71 and the second wire 72 are collectively referred to as the wire 70.

第1ワイヤー71は、その一端において入出力用端子44と接合し、他端においてリード64と接合する。また、第2ワイヤー72は、その一端において検査用端子46と接合し、他端においてリード64と接合する。 The first wire 71 is connected to the input/output terminal 44 at one end and to the lead 64 at the other end. Further, the second wire 72 is connected to the test terminal 46 at one end and to the lead 64 at the other end.

図7に示すように、入出力用端子44と接合される側の第1ワイヤー71の一端を、第1ワイヤー71の端子接合部74とも言う。また、検査用端子46と接合される側の第2ワイヤー72の一端を、第2ワイヤー72の端子接合部76とも言う。換言すると、入出力用端子44と接合される側の第1ワイヤー71の一端には、端子接合部74が形成され、検査用端子46と接合される側の第2ワイヤー72の一端には、端子接合部76が形成される。 As shown in FIG. 7, one end of the first wire 71 that is joined to the input/output terminal 44 is also referred to as a terminal joint portion 74 of the first wire 71. Further, one end of the second wire 72 on the side to be joined to the test terminal 46 is also referred to as a terminal joining portion 76 of the second wire 72. In other words, the terminal joint part 74 is formed at one end of the first wire 71 on the side to be joined to the input/output terminal 44, and the terminal joint part 74 is formed at one end of the second wire 72 on the side to be joined to the inspection terminal 46. A terminal joint 76 is formed.

周知のワイヤーボンディング技法としては、ボールボンディングと、ウエッジボンディングと、がある。本実施形態では、ボールボンディングを用いて、リード64と、入出力用端子44および検査用端子46と、を電気的に接続している。ただし、ウエッジボンディングを用いて、リード64と、入出力用端子44および検査用端子46と、を電気的に接続しても構わない。
また、本実施形態では、ワイヤー70と入出力用端子44および検査用端子46との接合をファーストボンディングで行い、ワイヤー70とリード64との接合をセカンドボンディングで行う。ただし、ワイヤー70とリード64との接合をファーストボンディングで行い、ワイヤー70と入出力用端子44および検査用端子46との接合をセカンドボンディングで行っても構わない。
Well-known wire bonding techniques include ball bonding and wedge bonding. In this embodiment, the lead 64 is electrically connected to the input/output terminal 44 and the inspection terminal 46 using ball bonding. However, the leads 64, the input/output terminals 44, and the inspection terminals 46 may be electrically connected using wedge bonding.
Further, in this embodiment, the wire 70 and the input/output terminal 44 and the inspection terminal 46 are bonded by first bonding, and the wire 70 and the lead 64 are bonded by second bonding. However, the wire 70 and the lead 64 may be joined by first bonding, and the wire 70 and the input/output terminal 44 and the inspection terminal 46 may be joined by second bonding.

図8および図9は、それぞれ入出力用端子44および検査用端子46を半導体基板42の上面42A側から見た平面図である。説明の都合上、図8では、第1ワイヤー71の端子接合部74を透過して図示し、端子接合部74以外の第1ワイヤー71の図示を省略している。図9では、第2ワイヤー72の端子接合部76を透過して図示し、端子接合部76以外の第2ワイヤー72の図示を省略している。 8 and 9 are plan views of the input/output terminal 44 and the inspection terminal 46, respectively, viewed from the upper surface 42A side of the semiconductor substrate 42. FIG. For convenience of explanation, in FIG. 8, the terminal joint portion 74 of the first wire 71 is shown transparently, and illustration of the first wire 71 other than the terminal joint portion 74 is omitted. In FIG. 9, the terminal joint part 76 of the second wire 72 is shown transparently, and the second wire 72 other than the terminal joint part 76 is not shown.

図8に示すように、本実施形態では、半導体基板42の上面42A側から見た平面視で、入出力用端子44は、正方形状である。
入出力用端子44の下面全体が、半導体基板42の上面42Aと接合している。そのため、入出力用端子44と半導体基板42との接触面積S1は、入出力用端子44の下面全体の面積と等しい。
As shown in FIG. 8, in this embodiment, the input/output terminal 44 has a square shape when viewed from above from the top surface 42A side of the semiconductor substrate 42. As shown in FIG.
The entire lower surface of the input/output terminal 44 is joined to the upper surface 42A of the semiconductor substrate 42. Therefore, the contact area S1 between the input/output terminal 44 and the semiconductor substrate 42 is equal to the area of the entire lower surface of the input/output terminal 44.

図9に示すように、本実施形態では、半導体基板42の上面42A側から見た平面視で、検査用端子46は、正方形状である。詳細には、半導体基板42の上面42A側から見た平面視で、検査用端子46は、入出力用端子44と比べ、各辺の長さが短い正方形状である。
検査用端子46の下面全体が、半導体基板42の上面42Aと接合している。そのため、検査用端子46と半導体基板42との接触面積S2は、検査用端子46の下面全体の面積と等しい。
As shown in FIG. 9, in this embodiment, the test terminal 46 has a square shape when viewed from above from the top surface 42A side of the semiconductor substrate 42. As shown in FIG. Specifically, when viewed from above from the top surface 42A of the semiconductor substrate 42, the test terminal 46 has a square shape with each side having a shorter length than the input/output terminal 44.
The entire lower surface of the test terminal 46 is joined to the upper surface 42A of the semiconductor substrate 42. Therefore, the contact area S2 between the test terminal 46 and the semiconductor substrate 42 is equal to the area of the entire lower surface of the test terminal 46.

半導体基板42の上面42A側から見た平面視で、検査用端子46は、入出力用端子44と比べ、各辺の長さが短い正方形状であるため、入出力用端子44と半導体基板42との接触面積S1よりも、検査用端子46と半導体基板42との接触面積S2は、小さくなる。 In a plan view seen from the top surface 42A side of the semiconductor substrate 42, the inspection terminal 46 has a square shape with each side shorter than the input/output terminal 44, so that the input/output terminal 44 and the semiconductor substrate 42 The contact area S2 between the test terminal 46 and the semiconductor substrate 42 is smaller than the contact area S1 between the test terminal 46 and the semiconductor substrate 42.

なお、本実施形態では、半導体基板42の上面42A側から見た平面視で、入出力用端子44および検査用端子46は、正方形状であるが、入出力用端子44および検査用端子46は、正方形状以外の形状でも構わない。つまり、接触面積S1よりも接触面積S2が小さくなる限りにおいて、入出力用端子44および検査用端子46は、任意の形状であって構わない。 In this embodiment, the input/output terminals 44 and the inspection terminals 46 have a square shape when viewed from the top surface 42A side of the semiconductor substrate 42, but the input/output terminals 44 and the inspection terminals 46 have a square shape. , a shape other than a square shape may be used. In other words, the input/output terminal 44 and the inspection terminal 46 may have any shape as long as the contact area S2 is smaller than the contact area S1.

入出力用端子44と半導体基板42との接触面積S1よりも、検査用端子46と半導体基板42との接触面積S2を小さくすることにより、入出力用端子44と半導体基板42との接合強度よりも、検査用端子46と半導体基板42との接合強度は小さくなる。
そのため、衝撃や熱などによる応力がインクカートリッジ10に加えられたとき、入出力用端子44と比べ、検査用端子46は、半導体基板42との接合面が破壊され易い。
By making the contact area S2 between the inspection terminal 46 and the semiconductor substrate 42 smaller than the contact area S1 between the input/output terminal 44 and the semiconductor substrate 42, the bonding strength between the input/output terminal 44 and the semiconductor substrate 42 can be lowered. Also, the bonding strength between the test terminal 46 and the semiconductor substrate 42 is reduced.
Therefore, when stress due to impact, heat, etc. is applied to the ink cartridge 10, the bonding surface of the test terminal 46 with the semiconductor substrate 42 is more likely to be destroyed than the input/output terminal 44.

検査用端子46と半導体基板42との接合面が破壊されると、検査用端子46と半導体基板42との間の電気的特性が変化する。詳細には、検査用端子46と半導体基板42との接合面が破壊されると、検査用端子46が半導体基板42から剥離する。検査用端子46が半導体基板42から剥離すると、検査用端子46と、半導体基板42に設けられた配線50と、の接続部の接続状態が変化する。検査用端子46と配線50との接続部の接続状態が変化すると、検査用端子46と配線50との間の電気的特性が変化する。例えば、検査用端子46と配線50との接続部の接続状態が変化すると、検査用端子46と配線50との間の電気抵抗が高くなる。なお、電気抵抗が高くなるとは、検査用端子46と配線50との接続部において検査用端子46と配線50とが断線し、非導通状態になることを含む。この電気的特性の変化を検出することにより、検査用端子46と半導体基板42との接合面に破壊が生じているか否かを判定することができる。換言すると、この電気的特性の変化を検出することにより、衝撃や熱などによる応力が半導体装置24に加えられたか否かを判定することができる。さらに換言すると、衝撃や熱などによる応力がインクカートリッジ10に加えられたか否かを判定することができる。 When the bonding surface between the test terminal 46 and the semiconductor substrate 42 is destroyed, the electrical characteristics between the test terminal 46 and the semiconductor substrate 42 change. Specifically, when the bonding surface between the test terminal 46 and the semiconductor substrate 42 is destroyed, the test terminal 46 is peeled off from the semiconductor substrate 42 . When the inspection terminal 46 is peeled off from the semiconductor substrate 42, the connection state of the connection portion between the inspection terminal 46 and the wiring 50 provided on the semiconductor substrate 42 changes. When the connection state of the connection between the test terminal 46 and the wiring 50 changes, the electrical characteristics between the test terminal 46 and the wiring 50 change. For example, when the connection state of the connection between the test terminal 46 and the wiring 50 changes, the electrical resistance between the test terminal 46 and the wiring 50 increases. Note that an increase in electrical resistance includes a disconnection between the testing terminal 46 and the wiring 50 at the connection portion between the testing terminal 46 and the wiring 50, resulting in a non-conducting state. By detecting this change in electrical characteristics, it can be determined whether or not the bonding surface between the test terminal 46 and the semiconductor substrate 42 is broken. In other words, by detecting this change in electrical characteristics, it is possible to determine whether stress due to impact, heat, or the like has been applied to the semiconductor device 24. In other words, it is possible to determine whether stress due to impact, heat, or the like has been applied to the ink cartridge 10.

ここで、検査用端子46と配線50との間の電気的特性を測定する方法について、説明する。 Here, a method of measuring the electrical characteristics between the test terminal 46 and the wiring 50 will be explained.

上述したように、本実施形態では、検査用端子46は、半導体基板42に設けられる配線50を介して、接地端子44Aと電気的に接続している。検査用端子46は、第2ワイヤー72を介して、リード64に電気的に接続している。接地端子44Aは、第1ワイヤー71を介して、リード64に電気的に接続している。つまり、検査用端子46に電気的に接続されるリード64と、接地端子44Aに電気的に接続されるリード64と、は第2ワイヤー72、検査用端子46、配線50、および接地端子44Aを介して、電気的に接続している。換言すると、検査用端子46に電気的に接続されるリード64と、接地端子44Aに電気的に接続されるリード64と、の間には、検査用端子46と配線50との接続部を含む電気的導通路が形成されている。 As described above, in this embodiment, the test terminal 46 is electrically connected to the ground terminal 44A via the wiring 50 provided on the semiconductor substrate 42. The test terminal 46 is electrically connected to the lead 64 via the second wire 72. The ground terminal 44A is electrically connected to the lead 64 via the first wire 71. That is, the lead 64 electrically connected to the test terminal 46 and the lead 64 electrically connected to the ground terminal 44A connect the second wire 72, the test terminal 46, the wiring 50, and the ground terminal 44A. It is electrically connected through. In other words, the connection part between the test terminal 46 and the wiring 50 is included between the lead 64 electrically connected to the test terminal 46 and the lead 64 electrically connected to the ground terminal 44A. An electrical conduction path is formed.

検査用端子46と半導体基板42との接合面が破壊されると、検査用端子46と配線50との接続部を含む電気的導通路、すなわち、検査用端子46に電気的に接続されるリード64と接地端子44Aに電気的に接続されるリード64との間に形成される電気的導通路の電気抵抗が高くなる。 When the bonding surface between the test terminal 46 and the semiconductor substrate 42 is destroyed, the electrical conduction path including the connection between the test terminal 46 and the wiring 50, that is, the lead electrically connected to the test terminal 46, is destroyed. The electrical resistance of the electrical conduction path formed between the lead 64 and the lead 64 electrically connected to the ground terminal 44A increases.

インクカートリッジ10を製造するメーカーは、インクカートリッジ10の製造時において、検査用端子46に電気的に接続されるリード64と、接地端子44Aに電気的に接続されるリード64と、に図示しない測定装置を接続する。
本実施形態では、半導体装置24は、回路基板20に実装されており、この測定装置は、回路基板20に配置される端子21を介して、検査用端子46に電気的に接続されるリード64と、接地端子44Aに電気的に接続されるリード64と、に接続される。
The manufacturer of the ink cartridge 10 conducts measurements (not shown) on the lead 64 electrically connected to the test terminal 46 and the lead 64 electrically connected to the ground terminal 44A when manufacturing the ink cartridge 10. Connect the device.
In this embodiment, the semiconductor device 24 is mounted on the circuit board 20, and this measuring device includes a lead 64 electrically connected to the test terminal 46 via the terminal 21 arranged on the circuit board 20. and a lead 64 electrically connected to the ground terminal 44A.

この測定装置は、検査用端子46に電気的に接続されるリード64と、接地端子44Aに電気的に接続されるリード64と、の間に形成される電気的導通路の電気的導通度を測定する。詳細には、この測定装置は、電気抵抗を測定する。この計測装置には、電気抵抗の測定に必要な電力の供給を行う電源を含めても構わない。なお、電気抵抗の測定には、所定の電圧または電流を供給したときの電流または電圧を測定する場合も含まれる。 This measuring device measures the degree of electrical conductivity of the electrical conduction path formed between the lead 64 electrically connected to the test terminal 46 and the lead 64 electrically connected to the ground terminal 44A. Measure. In detail, this measuring device measures electrical resistance. This measuring device may include a power source that supplies the power necessary for measuring electrical resistance. Note that the measurement of electrical resistance also includes the measurement of current or voltage when a predetermined voltage or current is supplied.

この測定装置により測定された電気抵抗値、すなわち、検査用端子46に電気的に接続されるリード64と接地端子44Aに電気的に接続されるリード64との間の電気抵抗値が、所定の値以下であるとき、リード64と、入出力用端子44および検査用端子46と、の間のワイヤーボンディングは正常に行われたと判定する。所定の値は、例えば、1nΩである。 The electrical resistance value measured by this measuring device, that is, the electrical resistance value between the lead 64 electrically connected to the test terminal 46 and the lead 64 electrically connected to the ground terminal 44A is determined to be within a predetermined value. When the value is less than or equal to the value, it is determined that the wire bonding between the lead 64 and the input/output terminal 44 and the inspection terminal 46 has been performed normally. The predetermined value is, for example, 1 nΩ.

使用済みのインクカートリッジ10を回収したメーカーやベンダーは、回収したインクカートリッジ10の再整備時において、検査用端子46に電気的に接続されるリード64と、接地端子44Aに電気的に接続されるリード64と、に図示しない測定装置を接続する。
この測定装置は、検査用端子46に電気的に接続されるリード64と、接地端子44Aに電気的に接続されるリード64と、の間に形成される電気的導通路の電気的導通度を測定する。詳細には、この測定装置は、電気抵抗を測定する。
When the manufacturer or vendor who collects the used ink cartridge 10 re-maintains the collected ink cartridge 10, the lead 64 is electrically connected to the test terminal 46 and the ground terminal 44A. A measuring device (not shown) is connected to the lead 64.
This measuring device measures the degree of electrical conductivity of the electrical conduction path formed between the lead 64 electrically connected to the test terminal 46 and the lead 64 electrically connected to the ground terminal 44A. Measure. In detail, this measuring device measures electrical resistance.

上述したように、本実施形態では、衝撃や熱などによる応力がインクカートリッジ10に加えられたとき、入出力用端子44と比べ、検査用端子46は、半導体基板42との接合面が破壊され易くなっている。そして、検査用端子46と半導体基板42との接合面が破壊されると、検査用端子46に電気的に接続されるリード64と、接地端子44Aに電気的に接続されるリード64と、の間の電気抵抗が高くなる。
そのため、この測定装置により測定された電気抵抗値、すなわち、検査用端子46に電気的に接続されるリード64と接地端子44Aに電気的に接続されるリード64との間の電気抵抗値が、所定の閾値以上であるとき、衝撃や熱などによる応力が半導体装置24に加えられたと判定する。所定の閾値は、例えば、1MΩである。
As described above, in this embodiment, when stress due to impact or heat is applied to the ink cartridge 10, the bonding surface of the test terminal 46 with the semiconductor substrate 42 is destroyed compared to the input/output terminal 44. It's getting easier. When the bonding surface between the test terminal 46 and the semiconductor substrate 42 is destroyed, the lead 64 electrically connected to the test terminal 46 and the lead 64 electrically connected to the ground terminal 44A are separated. The electrical resistance between them increases.
Therefore, the electrical resistance value measured by this measuring device, that is, the electrical resistance value between the lead 64 electrically connected to the test terminal 46 and the lead 64 electrically connected to the ground terminal 44A is When it is greater than or equal to a predetermined threshold value, it is determined that stress due to impact, heat, etc. has been applied to the semiconductor device 24. The predetermined threshold value is, for example, 1 MΩ.

このようにして、衝撃や熱などによる応力が半導体装置24に加えられたか否かを判定することができる。換言すると、衝撃や熱による応力がインクカートリッジ10に加えられたか否かを判定することできる。 In this way, it can be determined whether stress due to impact, heat, or the like has been applied to the semiconductor device 24. In other words, it is possible to determine whether stress due to impact or heat has been applied to the ink cartridge 10.

衝撃や熱による応力がインクカートリッジ10に加えられていないと判定されたときは、インクカートリッジ10の外観検査や半導体装置24の動作確認テストなどを行い、インクカートリッジ10がリユースに適した状態であるか否かを判定する。インクカートリッジ10がリユースに適した状態であると判定されると、インクカートリッジ10の再整備が行われる。 When it is determined that stress due to impact or heat is not applied to the ink cartridge 10, an external inspection of the ink cartridge 10, an operation confirmation test of the semiconductor device 24, etc. are performed, and it is determined that the ink cartridge 10 is in a state suitable for reuse. Determine whether or not. When it is determined that the ink cartridge 10 is in a state suitable for reuse, the ink cartridge 10 is re-maintained.

衝撃や熱による応力がインクカートリッジ10に加えられたと判定されたときは、回収されたインクカートリッジ10に設けられた半導体装置24は損傷している可能性がある。そのため、回収されたインクカートリッジ10に設けられた半導体装置24は、正常な半導体装置24に交換される。詳細には、回収されたインクカートリッジ10に装着された回路基板20が取り外され、正常な半導体装置24が実装されている回路基板20がインクカートリッジ10に取り付けられる。 When it is determined that stress due to impact or heat has been applied to the ink cartridge 10, the semiconductor device 24 provided in the collected ink cartridge 10 may be damaged. Therefore, the semiconductor device 24 provided in the collected ink cartridge 10 is replaced with a normal semiconductor device 24. Specifically, the circuit board 20 attached to the collected ink cartridge 10 is removed, and the circuit board 20 on which the normal semiconductor device 24 is mounted is attached to the ink cartridge 10.

本実施形態では、回収されたインクカートリッジ10に設けられた半導体装置24を、正常な半導体装置24に交換した後に、インクカートリッジ10の外観検査や半導体装置24の動作確認テストなどを行い、インクカートリッジ10がリユースに適した状態であるか否かを判定する。インクカートリッジ10がリユースに適した状態であると判定されると、インクカートリッジ10の再整備が行われる。 In this embodiment, after replacing the semiconductor device 24 provided in the collected ink cartridge 10 with a normal semiconductor device 24, an external inspection of the ink cartridge 10, an operation check test of the semiconductor device 24, etc. are performed, and the ink cartridge 10 is in a state suitable for reuse. When it is determined that the ink cartridge 10 is in a state suitable for reuse, the ink cartridge 10 is re-maintained.

上述したように、インクカートリッジ10に衝撃や熱などによる応力が加えられたと判定されたとき、損傷した可能性がある半導体装置24は、正常な半導体装置24に交換される。これにより、再整備されたインクカートリッジ10の信頼性が向上する。 As described above, when it is determined that stress due to impact or heat has been applied to the ink cartridge 10, the potentially damaged semiconductor device 24 is replaced with a normal semiconductor device 24. This improves the reliability of the refurbished ink cartridge 10.

なお、衝撃や熱による応力がインクカートリッジ10に加えられたと判定されたときは、インクカートリッジ10を構成する半導体装置24以外の部品にも損傷が生じている虞がある。したがって、衝撃や熱による応力がインクカートリッジ10に加えられたと判定されたときは、そのインクカートリッジ10をリユース対象から除外することにしても構わない。この場合、衝撃や熱による応力が加えられたと判定されたインクカートリッジ10は分解され、インクカートリッジ10を構成する部品単位でのリユース、あるいはリサイクルが行われる。 Note that if it is determined that stress due to impact or heat has been applied to the ink cartridge 10, there is a possibility that components other than the semiconductor device 24 constituting the ink cartridge 10 may also be damaged. Therefore, when it is determined that stress due to impact or heat has been applied to the ink cartridge 10, the ink cartridge 10 may be excluded from being reused. In this case, the ink cartridge 10 that has been determined to have been subjected to stress due to impact or heat is disassembled, and each part of the ink cartridge 10 is reused or recycled.

以上述べた通り、本実施形態によれば、以下の効果を得ることができる。
半導体装置24は、内部回路48を含む半導体基板42と、内部回路48と接続される入出力用端子44と、半導体基板42と入出力用端子44との接触面積S1よりも半導体基板42との接触面積S2が小さい検査用端子46と、を有する半導体チップ40と、入出力用端子44および検査用端子46とそれぞれ接続されるワイヤー70と、入出力用端子44および検査用端子46とワイヤー70を介して接続される配線基板60と、を備える。
これにより、衝撃や熱などによる応力が半導体装置24に加えられたか否かを判定することができる。また、このような半導体装置24をインクカートリッジ10に設けることにより、インクカートリッジ10に衝撃や熱による応力が加えられたか否かを判定することができる。
As described above, according to this embodiment, the following effects can be obtained.
The semiconductor device 24 includes a semiconductor substrate 42 including an internal circuit 48, an input/output terminal 44 connected to the internal circuit 48, and a contact area S1 between the semiconductor substrate 42 and the input/output terminal 44 that is smaller than the contact area S1 between the semiconductor substrate 42 and the input/output terminal 44. A semiconductor chip 40 having a testing terminal 46 with a small contact area S2, a wire 70 connected to the input/output terminal 44 and the testing terminal 46, respectively, and the input/output terminal 44, the testing terminal 46, and the wire 70. A wiring board 60 connected via the wiring board 60 is provided.
Thereby, it can be determined whether stress due to impact, heat, etc. has been applied to the semiconductor device 24. Furthermore, by providing such a semiconductor device 24 in the ink cartridge 10, it is possible to determine whether stress due to impact or heat has been applied to the ink cartridge 10.

また、衝撃や熱などによる応力が半導体装置24に加えられたか否かを判定することができるので、回収されたインクカートリッジ10を再整備するときに、損傷した可能性がある半導体装置24を、正常な半導体装置24に交換することができる。そのため、再整備されたインクカートリッジ10の信頼性が向上する。 Furthermore, since it is possible to determine whether stress due to impact or heat has been applied to the semiconductor device 24, when re-maintaining the collected ink cartridge 10, the semiconductor device 24 that may have been damaged can be The semiconductor device 24 can be replaced with a normal one. Therefore, the reliability of the refurbished ink cartridge 10 is improved.

また、配線基板60が有する2つのリード64の間の電気抵抗を測定するだけなので、衝撃や熱などによる応力が半導体装置24に加えられたか否かを容易に判定することができる。 Further, since only the electrical resistance between the two leads 64 of the wiring board 60 is measured, it is possible to easily determine whether stress due to impact, heat, etc. has been applied to the semiconductor device 24.

2.実施形態2
次に、実施形態2に係る半導体装置24aについて、図10および図11を参照して説明する。
実施形態2の半導体装置24aは、実施形態1と比べ、半導体基板42の上面42Aに検査用端子46に加え、さらに検査用端子46aが配置されることや、検査用端子46と接地端子44Aとを接続する配線50に代わり、検査用端子46と検査用端子46aとを接続する配線50aが半導体基板42に設けられていること以外は、実施形態1と同様である。
なお、上述した実施形態1と同様の構成については、同一の符号を付し、その説明を省略する。
2. Embodiment 2
Next, a semiconductor device 24a according to a second embodiment will be described with reference to FIGS. 10 and 11.
The semiconductor device 24a of the second embodiment is different from the first embodiment in that, in addition to the test terminal 46, a test terminal 46a is arranged on the upper surface 42A of the semiconductor substrate 42, and that the test terminal 46 and the ground terminal 44A are arranged on the top surface 42A of the semiconductor substrate 42. The second embodiment is the same as the first embodiment except that a wiring 50a connecting the testing terminal 46 and the testing terminal 46a is provided on the semiconductor substrate 42 instead of the wiring 50 connecting the testing terminal 46 and the testing terminal 46a.
Note that the same components as those in the first embodiment described above are given the same reference numerals, and the description thereof will be omitted.

図10および図11に示すように、半導体基板42の上面42Aには、複数の入出力用端子44と、2つの検査用端子46,46aと、が配置される。
検査用端子46と、検査用端子46aと、は半導体基板42に設けられる配線50aを介して、互いに電気的に接続される。
As shown in FIGS. 10 and 11, on the upper surface 42A of the semiconductor substrate 42, a plurality of input/output terminals 44 and two test terminals 46, 46a are arranged.
The test terminal 46 and the test terminal 46a are electrically connected to each other via a wiring 50a provided on the semiconductor substrate 42.

検査用端子46aは、第2ワイヤー72を介して、リード64と電気的に接続される。なお、検査用端子46aが電気的に接続されるリード64と、検査用端子46が電気的に接続されるリード64と、はそれぞれ異なる。 The test terminal 46a is electrically connected to the lead 64 via the second wire 72. Note that the lead 64 to which the test terminal 46a is electrically connected is different from the lead 64 to which the test terminal 46 is electrically connected.

本実施形態では、半導体基板42の上面42A側から見た平面視で、検査用端子46aは、正方形状である。詳細には、半導体基板42の上面42A側から見た平面視で、検査用端子46aは、検査用端子46と互いに寸法が同じ正方形状である。つまり、検査用端子46aと半導体基板42との接触面積は、検査用端子46と半導体基板42との接触面積S2と等しい。換言すると、入出力用端子44と半導体基板42との接触面積S1よりも、検査用端子46aと半導体基板42との接触面積は、小さくなる。 In this embodiment, the test terminal 46a has a square shape when viewed from above from the top surface 42A side of the semiconductor substrate 42. Specifically, when viewed from above from the top surface 42A of the semiconductor substrate 42, the test terminal 46a has a square shape with the same dimensions as the test terminal 46. That is, the contact area between the test terminal 46a and the semiconductor substrate 42 is equal to the contact area S2 between the test terminal 46 and the semiconductor substrate 42. In other words, the contact area between the test terminal 46a and the semiconductor substrate 42 is smaller than the contact area S1 between the input/output terminal 44 and the semiconductor substrate 42.

そのため、衝撃や熱などによる応力がインクカートリッジ10に加えられたとき、入出力用端子44と比べ、検査用端子46,46aは、半導体基板42との接合面が破壊され易い。 Therefore, when stress due to impact or heat is applied to the ink cartridge 10, the bonding surfaces of the test terminals 46 and 46a with the semiconductor substrate 42 are more likely to be destroyed than the input/output terminals 44.

検査用端子46,46aと半導体基板42との接合面が破壊されると、検査用端子46,46aと半導体基板42との間の電気的特性が変化する。詳細には、検査用端子46,46aと配線50aとのそれぞれの接続部の接続状態が変化し、検査用端子46,46aと配線50aとの間の電気的特性が変化する。この電気的特性の変化を検出することにより、検査用端子46,46aと半導体基板42との接合面に破壊が生じているか否かを判定することができる。換言すると、この電気的特性の変化を検出することにより、衝撃や熱などによる応力が半導体装置24aに加えられたか否かを判定することができる。 When the bonding surface between the test terminals 46, 46a and the semiconductor substrate 42 is destroyed, the electrical characteristics between the test terminals 46, 46a and the semiconductor substrate 42 change. Specifically, the connection state of each connection portion between the test terminals 46, 46a and the wiring 50a changes, and the electrical characteristics between the test terminals 46, 46a and the wiring 50a change. By detecting this change in electrical characteristics, it can be determined whether or not the bonding surface between the test terminals 46, 46a and the semiconductor substrate 42 is broken. In other words, by detecting this change in electrical characteristics, it is possible to determine whether stress due to impact, heat, or the like has been applied to the semiconductor device 24a.

検査用端子46,46aと配線50aとの間の電気的特性を測定する方法について、説明する。 A method of measuring the electrical characteristics between the test terminals 46, 46a and the wiring 50a will be described.

検査用端子46に電気的に接続されるリード64と、検査用端子46aに電気的に接続されるリード64と、は第2ワイヤー72、検査用端子46,46a、および配線50aを介して、電気的に接続している。換言すると、検査用端子46に電気的に接続されるリード64と、検査用端子46aに電気的に接続されるリード64と、の間には、検査用端子46と配線50aとの接続部および検査用端子46aと配線50aとの接続部を含む電気的導通路が形成されている。 The lead 64 electrically connected to the test terminal 46 and the lead 64 electrically connected to the test terminal 46a are connected via the second wire 72, the test terminals 46, 46a, and the wiring 50a. electrically connected. In other words, between the lead 64 electrically connected to the test terminal 46 and the lead 64 electrically connected to the test terminal 46a, there is a connection part between the test terminal 46 and the wiring 50a, and a connection part between the test terminal 46 and the wiring 50a. An electrical conduction path including a connecting portion between the test terminal 46a and the wiring 50a is formed.

使用済みのインクカートリッジ10を回収したメーカーやベンダーは、回収したインクカートリッジ10の再整備時において、検査用端子46に電気的に接続されるリード64と、検査用端子46aに電気的に接続されるリード64と、に図示しない測定装置を接続する。
この測定装置は、検査用端子46に電気的に接続されるリード64と、検査用端子46aに電気的に接続されるリード64と、の間に形成される電気的導通路の電気的導通度を測定する。詳細には、この測定装置は、電気抵抗を測定する。
Manufacturers and vendors who have collected used ink cartridges 10, when re-maintaining the collected ink cartridges 10, have a lead 64 that is electrically connected to the test terminal 46 and a lead 64 that is electrically connected to the test terminal 46a. A measuring device (not shown) is connected to the lead 64.
This measuring device measures the degree of electrical conductivity of an electrical conduction path formed between a lead 64 electrically connected to the test terminal 46 and a lead 64 electrically connected to the test terminal 46a. Measure. In detail, this measuring device measures electrical resistance.

この測定装置により測定された電気抵抗値、すなわち、検査用端子46に電気的に接続されるリード64と検査用端子46aに電気的に接続されるリード64との間の電気抵抗値が、所定の閾値以上であるとき、衝撃や熱などによる応力が半導体装置24aに加えられたと判定する。所定の閾値は、例えば、1MΩである。 The electrical resistance value measured by this measuring device, that is, the electrical resistance value between the lead 64 electrically connected to the test terminal 46 and the lead 64 electrically connected to the test terminal 46a is determined to be a predetermined value. When the threshold is greater than or equal to the threshold value, it is determined that stress due to impact, heat, etc. has been applied to the semiconductor device 24a. The predetermined threshold value is, for example, 1 MΩ.

このようにして、衝撃や熱などによる応力が半導体装置24aに加えられたか否かを判定することができる。換言すると、衝撃や熱による応力がインクカートリッジ10に加えられたか否かを判定することできる。 In this way, it can be determined whether stress due to impact, heat, or the like has been applied to the semiconductor device 24a. In other words, it is possible to determine whether stress due to impact or heat has been applied to the ink cartridge 10.

インクカートリッジ10に衝撃や熱などによる応力が加えられたと判定されたとき、損傷した可能性がある半導体装置24aは、正常な半導体装置24aに交換される。これにより、再整備されたインクカートリッジ10の信頼性が向上する。 When it is determined that stress due to impact or heat has been applied to the ink cartridge 10, the potentially damaged semiconductor device 24a is replaced with a normal semiconductor device 24a. This improves the reliability of the refurbished ink cartridge 10.

以上述べた通り、本実施形態によれば、実施形態1と同様な効果を得ることができる。 As described above, according to this embodiment, the same effects as in the first embodiment can be obtained.

なお、本実施形態では、検査用端子46aと半導体基板42との接触面積は、検査用端子46と半導体基板42との接触面積S2と等しいが、検査用端子46aと半導体基板42との接触面積は、接触面積S2と異なっていても構わない。つまり、検査用端子46aと半導体基板42との接触面積と、検査用端子46と半導体基板42との接触面積S2と、のうち、少なくとも一方の接触面積が、入出力用端子44と半導体基板42との接触面積S1よりも小さければ、実施形態1と同様な効果を得ることができる。 In this embodiment, the contact area between the test terminal 46a and the semiconductor substrate 42 is equal to the contact area S2 between the test terminal 46 and the semiconductor substrate 42, but the contact area between the test terminal 46a and the semiconductor substrate 42 is equal to the contact area S2 between the test terminal 46a and the semiconductor substrate 42. may be different from the contact area S2. That is, at least one of the contact area between the test terminal 46a and the semiconductor substrate 42 and the contact area S2 between the test terminal 46 and the semiconductor board 42 is the contact area between the input/output terminal 44 and the semiconductor board 42. If the contact area S1 is smaller than the contact area S1, the same effect as in the first embodiment can be obtained.

3.実施形態3
次に、実施形態3に係る半導体装置24bについて、図12および図13を参照して説明する。
実施形態3の半導体装置24bは、実施形態1と比べ、検査用端子46に代わり、検査用端子46bが配置されることや、入出力用端子44に代わり、入出力用端子44bが配置されること以外は、実施形態1と同様である。検査用端子46bは、検査用端子46と比べ、半導体基板42との接触面積が異なる。詳細には、検査用端子46bと半導体基板42との接触面積は、入出力用端子44bと半導体基板42との接触面積と、は同じである。また、入出力用端子44bの厚さt1は、検査用端子46bの厚さt2よりも大きくなっている。
なお、上述した実施形態1と同様の構成については、同一の符号を付し、その説明を省略する。
3. Embodiment 3
Next, a semiconductor device 24b according to Embodiment 3 will be described with reference to FIGS. 12 and 13.
The semiconductor device 24b of the third embodiment differs from the first embodiment in that a test terminal 46b is arranged instead of the test terminal 46, and an input/output terminal 44b is arranged instead of the input/output terminal 44. Other than that, this embodiment is the same as the first embodiment. The test terminal 46b has a different contact area with the semiconductor substrate 42 than the test terminal 46. Specifically, the contact area between the test terminal 46b and the semiconductor substrate 42 is the same as the contact area between the input/output terminal 44b and the semiconductor substrate 42. Moreover, the thickness t1 of the input/output terminal 44b is larger than the thickness t2 of the inspection terminal 46b.
Note that the same components as those in the first embodiment described above are given the same reference numerals, and the description thereof will be omitted.

図12および図13に示すように、本実施形態では、半導体基板42の上面42Aには、複数の入出力用端子44bと、1つの検査用端子46bと、が配置される。 As shown in FIGS. 12 and 13, in this embodiment, a plurality of input/output terminals 44b and one inspection terminal 46b are arranged on the upper surface 42A of the semiconductor substrate 42.

入出力用端子44bは、内部回路48と電気的に接続される。
入出力用端子44bのうち、接地電位に接続される端子を接地端子44Abとも言う。
The input/output terminal 44b is electrically connected to the internal circuit 48.
Among the input/output terminals 44b, the terminal connected to the ground potential is also referred to as a ground terminal 44Ab.

検査用端子46bは、半導体基板42に設けられる配線50を介して、接地端子44Abと電気的に接続される。 The inspection terminal 46b is electrically connected to the ground terminal 44Ab via a wiring 50 provided on the semiconductor substrate 42.

リード64と入出力用端子44bとは、第1ワイヤー71を介して、電気的に接続される。リード64と検査用端子46bとは、第2ワイヤー72を介して、電気的に接続される。 The lead 64 and the input/output terminal 44b are electrically connected via the first wire 71. The lead 64 and the test terminal 46b are electrically connected via the second wire 72.

本実施形態では、半導体基板42の上面42A側から見た平面視で、入出力用端子44bおよび検査用端子46bは、互いに寸法が同じ正方形状である。つまり、入出力用端子44bと半導体基板42との接触面積と、検査用端子46bと半導体基板42との接触面積と、は同じである。なお、入出力用端子44bおよび検査用端子46bは、正方形状以外の形状でも構わない。 In the present embodiment, the input/output terminal 44b and the inspection terminal 46b have a square shape with the same dimensions as viewed in plan from the top surface 42A side of the semiconductor substrate 42. In other words, the contact area between the input/output terminal 44b and the semiconductor substrate 42 and the contact area between the inspection terminal 46b and the semiconductor substrate 42 are the same. Note that the input/output terminal 44b and the inspection terminal 46b may have a shape other than a square shape.

図13に示すように、入出力用端子44bの厚さt1は、検査用端子46bの厚さt2よりも、大きい。換言すると、検査用端子46bの厚さt2は、入出力用端子44bの厚さt1よりも、小さい。 As shown in FIG. 13, the thickness t1 of the input/output terminal 44b is larger than the thickness t2 of the inspection terminal 46b. In other words, the thickness t2 of the test terminal 46b is smaller than the thickness t1 of the input/output terminal 44b.

検査用端子46bの厚さt2を入出力用端子44bの厚さt1よりも小さくすることにより、入出力用端子44bと第1ワイヤー71の端子接合部74との接合強度よりも、検査用端子46bと第2ワイヤー72の端子接合部76との接合強度は小さくなる。
詳細には、検査用端子46bの厚さt2を入出力用端子44bの厚さt1よりも小さくすることにより、入出力用端子44bと第1ワイヤー71の端子接合部74との接合面における入出力用端子44bの変形よりも、検査用端子46bと第2ワイヤー72の端子接合部76との接合面における検査用端子46bの変形は、小さくなる。そのため、例えば、入出力用端子44bおよび検査用端子46bのそれぞれの表面に酸化膜が形成されていたとき、入出力用端子44bの表面に形成される酸化膜に比べ、検査用端子46bの表面に形成される酸化膜は、破壊され難くなる。したがって、入出力用端子44bと第1ワイヤー71の端子接合部74との接合強度よりも、検査用端子46bと第2ワイヤー72の端子接合部76との接合強度は小さくなる。
By making the thickness t2 of the test terminal 46b smaller than the thickness t1 of the input/output terminal 44b, the test terminal The bonding strength between 46b and the terminal bonding portion 76 of the second wire 72 becomes smaller.
Specifically, by making the thickness t2 of the inspection terminal 46b smaller than the thickness t1 of the input/output terminal 44b, the input/output terminal 44b and the terminal joint portion 74 of the first wire 71 are connected at the joint surface. The deformation of the test terminal 46b at the joint surface between the test terminal 46b and the terminal joint portion 76 of the second wire 72 is smaller than the deformation of the output terminal 44b. Therefore, for example, when an oxide film is formed on the surface of each of the input/output terminal 44b and the inspection terminal 46b, the surface of the inspection terminal 46b is larger than the oxide film formed on the surface of the input/output terminal 44b. The oxide film formed on the surface becomes difficult to destroy. Therefore, the bonding strength between the test terminal 46b and the terminal bonding portion 76 of the second wire 72 is smaller than the bonding strength between the input/output terminal 44b and the terminal bonding portion 74 of the first wire 71.

そのため、衝撃や熱などによる応力がインクカートリッジ10に加えられたとき、入出力用端子44bと第1ワイヤー71の端子接合部74との接合面と比べ、検査用端子46bと第2ワイヤー72の端子接合部76との接合面は破壊され易い。 Therefore, when stress due to impact or heat is applied to the ink cartridge 10, compared to the joint surface between the input/output terminal 44b and the terminal joint portion 74 of the first wire 71, the contact surface between the test terminal 46b and the second wire 72 is The joint surface with the terminal joint portion 76 is easily destroyed.

検査用端子46bと第2ワイヤー72の端子接合部76との接合面が破壊されると、検査用端子46bと第2ワイヤー72の端子接合部76との間の電気的特性が変化する。この電気的特性の変化を検出することにより、検査用端子46bと第2ワイヤー72の端子接合部76との接合面に破壊が生じているか否かを判定することができる。換言すると、この電気的特性の変化を検出することにより、衝撃や熱などによる応力が半導体装置24bに加えられたか否かを判定することができる。 When the bonding surface between the test terminal 46b and the terminal joint portion 76 of the second wire 72 is destroyed, the electrical characteristics between the test terminal 46b and the terminal joint portion 76 of the second wire 72 change. By detecting this change in electrical characteristics, it is possible to determine whether or not the joint surface between the test terminal 46b and the terminal joint portion 76 of the second wire 72 is broken. In other words, by detecting this change in electrical characteristics, it can be determined whether stress due to impact, heat, or the like has been applied to the semiconductor device 24b.

検査用端子46bと第2ワイヤー72の端子接合部76との間の電気的特性を測定する方法について、説明する。 A method of measuring the electrical characteristics between the test terminal 46b and the terminal joint portion 76 of the second wire 72 will be described.

上述したように、本実施形態では、検査用端子46bは、配線50を介して、接地端子44Abと電気的に接続している。つまり、検査用端子46bに電気的に接続されるリード64と、接地端子44Abに電気的に接続されるリード64と、は第2ワイヤー72、検査用端子46b、配線50、および接地端子44Abを介して、電気的に接続している。換言すると、検査用端子46bに電気的に接続されるリード64と、接地端子44Abに電気的に接続されるリード64と、の間には、検査用端子46bと第2ワイヤー72の端子接合部76との接合面を含む電気的導通路が形成されている。 As described above, in this embodiment, the test terminal 46b is electrically connected to the ground terminal 44Ab via the wiring 50. That is, the lead 64 electrically connected to the test terminal 46b and the lead 64 electrically connected to the ground terminal 44Ab connect the second wire 72, the test terminal 46b, the wiring 50, and the ground terminal 44Ab. It is electrically connected through. In other words, there is a terminal joint between the test terminal 46b and the second wire 72 between the lead 64 electrically connected to the test terminal 46b and the lead 64 electrically connected to the ground terminal 44Ab. An electrically conductive path including a joint surface with 76 is formed.

使用済みのインクカートリッジ10を回収したメーカーやベンダーは、回収したインクカートリッジ10の再整備時において、検査用端子46bに電気的に接続されるリード64と、接地端子44Abに電気的に接続されるリード64と、に図示しない測定装置を接続する。
この測定装置は、検査用端子46bに電気的に接続されるリード64と、接地端子44Abに電気的に接続されるリード64と、の間に形成される電気的導通路の電気的導通度を測定する。詳細には、この測定装置は、電気抵抗を測定する。
When the manufacturer or vendor who collects the used ink cartridge 10 re-maintains the collected ink cartridge 10, the lead 64 is electrically connected to the test terminal 46b and the ground terminal 44Ab. A measuring device (not shown) is connected to the lead 64.
This measuring device measures the degree of electrical conductivity of an electrical conduction path formed between a lead 64 electrically connected to the test terminal 46b and a lead 64 electrically connected to the ground terminal 44Ab. Measure. In detail, this measuring device measures electrical resistance.

この測定装置により測定された電気抵抗値、すなわち、検査用端子46bに電気的に接続されるリード64と接地端子44Abに電気的に接続されるリード64との間の電気抵抗値が、所定の閾値以上であるとき、衝撃や熱などによる応力が半導体装置24bに加えられたと判定する。所定の閾値は、例えば、1MΩである。 The electrical resistance value measured by this measuring device, that is, the electrical resistance value between the lead 64 electrically connected to the test terminal 46b and the lead 64 electrically connected to the ground terminal 44Ab is determined to be within a predetermined value. When it is equal to or greater than the threshold value, it is determined that stress due to impact, heat, etc. has been applied to the semiconductor device 24b. The predetermined threshold value is, for example, 1 MΩ.

このようにして、衝撃や熱などによる応力が半導体装置24bに加えられたか否かを判定することができる。換言すると、衝撃や熱による応力がインクカートリッジ10に加えられたか否かを判定することできる。 In this way, it can be determined whether stress due to impact, heat, etc. has been applied to the semiconductor device 24b. In other words, it is possible to determine whether stress due to impact or heat has been applied to the ink cartridge 10.

インクカートリッジ10に衝撃や熱などによる応力が加えられたと判定されたとき、損傷した可能性がある半導体装置24bは、正常な半導体装置24bに交換される。これにより、再整備されたインクカートリッジ10の信頼性が向上する。 When it is determined that stress due to impact or heat has been applied to the ink cartridge 10, the potentially damaged semiconductor device 24b is replaced with a normal semiconductor device 24b. This improves the reliability of the refurbished ink cartridge 10.

以上述べた通り、本実施形態によれば、以下の効果を得ることができる。
半導体装置24bは、内部回路48を含む半導体基板42と、内部回路48と接続される入出力用端子44bと、入出力用端子44bよりも厚さt2が小さい検査用端子46bと、を有する半導体チップ40と、入出力用端子44bおよび検査用端子46bとそれぞれ接続されるワイヤー70と、入出力用端子44bおよび検査用端子46bとワイヤー70を介して接続される配線基板60と、を備える。
これにより、実施形態1と同様な効果を得ることができる。
As described above, according to this embodiment, the following effects can be obtained.
The semiconductor device 24b is a semiconductor having a semiconductor substrate 42 including an internal circuit 48, an input/output terminal 44b connected to the internal circuit 48, and an inspection terminal 46b having a thickness t2 smaller than the input/output terminal 44b. It includes a chip 40, a wire 70 connected to the input/output terminal 44b and the inspection terminal 46b, respectively, and a wiring board 60 connected to the input/output terminal 44b and the inspection terminal 46b via the wire 70.
Thereby, the same effects as in the first embodiment can be obtained.

4.実施形態4
次に、実施形態4に係る半導体装置24cについて、図14および図15を参照して説明する。
実施形態4の半導体装置24cは、実施形態3と比べ、半導体基板42に代わり、半導体基板42cを有することや、入出力用端子44bに代わり、入出力用端子44cが配置されること以外は、実施形態3と同様である。半導体基板42cは、絶縁膜421を有する。入出力用端子44cは、複数の電極を有する。複数の電極を積層することにより、入出力用端子44cの厚さは、検査用端子46bの厚さt2よりも大きくなっている。
なお、上述した実施形態3と同様の構成については、同一の符号を付し、その説明を省略する。
4. Embodiment 4
Next, a semiconductor device 24c according to a fourth embodiment will be described with reference to FIGS. 14 and 15.
The semiconductor device 24c of the fourth embodiment is different from the third embodiment except that it has a semiconductor substrate 42c instead of the semiconductor substrate 42 and that an input/output terminal 44c is arranged instead of the input/output terminal 44b. This is the same as the third embodiment. The semiconductor substrate 42c has an insulating film 421. The input/output terminal 44c has a plurality of electrodes. By stacking a plurality of electrodes, the thickness of the input/output terminal 44c is larger than the thickness t2 of the inspection terminal 46b.
Note that the same configurations as those in the third embodiment described above are designated by the same reference numerals, and the description thereof will be omitted.

図14および図15に示すように、半導体基板42cは、絶縁膜421を有する。
絶縁膜421は、半導体基板42cの上面42A側に設けられる。本実施形態では、半導体基板42cの上面42A側に絶縁膜421が設けられることにより、絶縁膜421の上面が半導体基板42cの上面42Aとなる。
As shown in FIGS. 14 and 15, the semiconductor substrate 42c has an insulating film 421.
The insulating film 421 is provided on the upper surface 42A side of the semiconductor substrate 42c. In this embodiment, the insulating film 421 is provided on the upper surface 42A side of the semiconductor substrate 42c, so that the upper surface of the insulating film 421 becomes the upper surface 42A of the semiconductor substrate 42c.

入出力用端子44cは、複数の電極を有する。後述するように、入出力用端子44cは、複数の電極が半導体基板42cの厚さ方向に沿って積層して配置された多層構造となっている。詳細には、入出力用端子44cは、2つの電極を有する、2つの電極のうち、一方は、第1電極441であり、他方は、第2電極442である。 The input/output terminal 44c has a plurality of electrodes. As will be described later, the input/output terminal 44c has a multilayer structure in which a plurality of electrodes are stacked and arranged along the thickness direction of the semiconductor substrate 42c. In detail, the input/output terminal 44c has two electrodes, one of which is a first electrode 441 and the other is a second electrode 442.

第1電極441は、半導体基板42cの上面42A、すなわち、絶縁膜421の上面に配置される。
第2電極442は、半導体基板42cの厚さ方向に沿って、第1電極441の下方に配置される。第1電極441と、第2電極442と、は半導体基板42cの上面42A側から見た平面視で、重なるように配置される、つまり、入出力用端子44cは、第1電極441と第2電極442とが半導体基板42cの厚さ方向に沿って積層して配置される。
The first electrode 441 is arranged on the upper surface 42A of the semiconductor substrate 42c, that is, the upper surface of the insulating film 421.
The second electrode 442 is arranged below the first electrode 441 along the thickness direction of the semiconductor substrate 42c. The first electrode 441 and the second electrode 442 are arranged to overlap when viewed from the top surface 42A side of the semiconductor substrate 42c. Electrodes 442 are stacked and arranged along the thickness direction of the semiconductor substrate 42c.

第1電極441と第2電極442とが半導体基板42cの厚さ方向に沿って積層して配置されることにより、入出力用端子44cの厚さは、第1電極441の厚さと第2電極442の厚さとの和となる。
また、本実施形態では、第1電極441と第2電極442とが半導体基板42の厚さ方向に沿って積層して配置されている入出力用端子44cの厚さは、検査用端子46bの厚さt2(図13参照)よりも大きい。換言すると、検査用端子46bの厚さt2は、入出力用端子44cの厚さよりも、小さい。
Since the first electrode 441 and the second electrode 442 are stacked and arranged along the thickness direction of the semiconductor substrate 42c, the thickness of the input/output terminal 44c is equal to the thickness of the first electrode 441 and the second electrode. It is the sum of the thickness of 442.
Further, in this embodiment, the thickness of the input/output terminal 44c, in which the first electrode 441 and the second electrode 442 are stacked and arranged along the thickness direction of the semiconductor substrate 42, is the same as that of the testing terminal 46b. It is larger than the thickness t2 (see FIG. 13). In other words, the thickness t2 of the test terminal 46b is smaller than the thickness of the input/output terminal 44c.

第1電極441と、第2電極442と、は絶縁膜421を挟んで配置される。第1電極441と、第2電極442と、は絶縁膜421を半導体基板42cの厚さ方向に貫通する複数の貫通電極52により電気的に接続される。なお、本実施形態では、第1電極441と第2電極442とは絶縁膜421を挟んで配置され、貫通電極52により電気的に接続されているが、絶縁膜421および貫通電極52は無くても構わない。つまり、第1電極441と第2電極442とは半導体基板42の厚さ方向に沿って積層して配置されていれば構わない。例えば、第2電極442の上面に第1電極441が配置され、第1電極441の下面と第2電極442の上面とが機械的および電気的に接続されていても構わない。 The first electrode 441 and the second electrode 442 are arranged with the insulating film 421 in between. The first electrode 441 and the second electrode 442 are electrically connected by a plurality of through electrodes 52 that penetrate the insulating film 421 in the thickness direction of the semiconductor substrate 42c. Note that in this embodiment, the first electrode 441 and the second electrode 442 are arranged with the insulating film 421 in between and are electrically connected by the through electrode 52, but the insulating film 421 and the through electrode 52 are not provided. I don't mind. In other words, the first electrode 441 and the second electrode 442 may be stacked and arranged along the thickness direction of the semiconductor substrate 42 . For example, the first electrode 441 may be arranged on the upper surface of the second electrode 442, and the lower surface of the first electrode 441 and the upper surface of the second electrode 442 may be mechanically and electrically connected.

入出力用端子44cは、内部回路48と電気的に接続される。詳細には、入出力用端子44cが有する第2電極442と内部回路48とは、半導体基板42cに設けられる図示しない配線を介して、電気的に接続される。
入出力用端子44cのうち、接地電位に接続される端子を接地端子44Acとも言う。
The input/output terminal 44c is electrically connected to the internal circuit 48. Specifically, the second electrode 442 of the input/output terminal 44c and the internal circuit 48 are electrically connected via a wiring (not shown) provided on the semiconductor substrate 42c.
Among the input/output terminals 44c, the terminal connected to the ground potential is also referred to as a ground terminal 44Ac.

接地端子44Acは、半導体基板42に設けられる配線50を介して、検査用端子46bと電気的に接続される。詳細には、配線50は、接地端子44Acが有する第2電極442と電気的に接続される。 The ground terminal 44Ac is electrically connected to the test terminal 46b via a wiring 50 provided on the semiconductor substrate 42. Specifically, the wiring 50 is electrically connected to the second electrode 442 that the ground terminal 44Ac has.

リード64と入出力用端子44cとは、第1ワイヤー71を介して、電気的に接続される。詳細には、リード64と、入出力用端子44cが有する第1電極441と、は第1ワイヤー71を介して、電気的に接続される。 The lead 64 and the input/output terminal 44c are electrically connected via the first wire 71. Specifically, the lead 64 and the first electrode 441 of the input/output terminal 44c are electrically connected via the first wire 71.

本実施形態では、半導体基板42cの上面42A側から見た平面視で、入出力用端子44cが有する第1電極441および第2電極442と、検査用端子46bと、は互いに寸法が同じ正方形状である。なお、第1電極441、第2電極442、および検査用端子46bは、正方形状以外の形状でも構わない。 In this embodiment, the first electrode 441 and the second electrode 442 of the input/output terminal 44c and the inspection terminal 46b have the same square shape as viewed from the top surface 42A side of the semiconductor substrate 42c. It is. Note that the first electrode 441, the second electrode 442, and the test terminal 46b may have a shape other than a square shape.

上述したように、検査用端子46bの厚さt2は、入出力用端子44cの厚さよりも、小さい。 As described above, the thickness t2 of the test terminal 46b is smaller than the thickness of the input/output terminal 44c.

検査用端子46bの厚さt2を入出力用端子44cの厚さよりも小さくすることにより、入出力用端子44cと第1ワイヤー71の端子接合部74との接合強度よりも、検査用端子46bと第2ワイヤー72の端子接合部76との接合強度は小さくなる。 By making the thickness t2 of the test terminal 46b smaller than the thickness of the input/output terminal 44c, the bonding strength between the test terminal 46b and the input/output terminal 44c and the terminal joint portion 74 of the first wire 71 is lower than that of the test terminal 46b. The bonding strength between the second wire 72 and the terminal bonding portion 76 becomes smaller.

そのため、衝撃や熱などによる応力がインクカートリッジ10に加えられたとき、入出力用端子44cと第1ワイヤー71の端子接合部74との接合面と比べ、検査用端子46bと第2ワイヤー72の端子接合部76との接合面は破壊され易い。 Therefore, when stress due to impact or heat is applied to the ink cartridge 10, compared to the joint surface between the input/output terminal 44c and the terminal joint part 74 of the first wire 71, the test terminal 46b and the second wire 72 are The joint surface with the terminal joint portion 76 is easily destroyed.

検査用端子46bと第2ワイヤー72の端子接合部76との接合面が破壊されると、検査用端子46bと第2ワイヤー72の端子接合部76との間の電気的特性が変化する。この電気的特性の変化を検出することにより、検査用端子46bと第2ワイヤー72の端子接合部76との接合面に破壊が生じているか否かを判定することができる。換言すると、この電気的特性の変化を検出することにより、衝撃や熱などによる応力が半導体装置24cに加えられたか否かを判定することができる。 When the bonding surface between the test terminal 46b and the terminal joint portion 76 of the second wire 72 is destroyed, the electrical characteristics between the test terminal 46b and the terminal joint portion 76 of the second wire 72 change. By detecting this change in electrical characteristics, it is possible to determine whether or not the joint surface between the test terminal 46b and the terminal joint portion 76 of the second wire 72 is broken. In other words, by detecting this change in electrical characteristics, it is possible to determine whether stress due to impact, heat, or the like has been applied to the semiconductor device 24c.

使用済みのインクカートリッジ10を回収したメーカーやベンダーは、回収したインクカートリッジ10の再整備時において、検査用端子46bに電気的に接続されるリード64と、接地端子44Acに電気的に接続されるリード64と、に図示しない測定装置を接続する。
この測定装置は、検査用端子46bに電気的に接続されるリード64と、接地端子44Acに電気的に接続されるリード64と、の間に形成される電気的導通路の電気的導通度を測定する。詳細には、この測定装置は、電気抵抗を測定する。
When the manufacturer or vendor who collects the used ink cartridge 10 re-maintains the collected ink cartridge 10, the lead 64 is electrically connected to the test terminal 46b and the ground terminal 44Ac. A measuring device (not shown) is connected to the lead 64.
This measuring device measures the degree of electrical conductivity of an electrical conduction path formed between a lead 64 electrically connected to the test terminal 46b and a lead 64 electrically connected to the ground terminal 44Ac. Measure. In detail, this measuring device measures electrical resistance.

この測定装置により測定された電気抵抗値、すなわち、検査用端子46bに電気的に接続されるリード64と接地端子44Acに電気的に接続されるリード64との間の電気抵抗値が、所定の閾値以上であるとき、衝撃や熱などによる応力が半導体装置24cに加えられたと判定する。所定の閾値は、例えば、1MΩである。 The electrical resistance value measured by this measuring device, that is, the electrical resistance value between the lead 64 electrically connected to the test terminal 46b and the lead 64 electrically connected to the ground terminal 44Ac, is determined to be within a predetermined value. When it is equal to or greater than the threshold value, it is determined that stress due to impact, heat, etc. has been applied to the semiconductor device 24c. The predetermined threshold value is, for example, 1 MΩ.

このようにして、衝撃や熱などによる応力が半導体装置24cに加えられたか否かを判定することができる。換言すると、衝撃や熱による応力がインクカートリッジ10に加えられたか否かを判定することできる。 In this way, it can be determined whether stress due to impact, heat, etc. has been applied to the semiconductor device 24c. In other words, it is possible to determine whether stress due to impact or heat has been applied to the ink cartridge 10.

インクカートリッジ10に衝撃や熱などによる応力が加えられたと判定されたとき、損傷した可能性がある半導体装置24cは、正常な半導体装置24cに交換される。これにより、再整備されたインクカートリッジ10の信頼性が向上する。 When it is determined that stress due to impact or heat has been applied to the ink cartridge 10, the potentially damaged semiconductor device 24c is replaced with a normal semiconductor device 24c. This improves the reliability of the refurbished ink cartridge 10.

なお、本実施形態では、入出力用端子44cは、2つの電極、すなわち、第1電極441および第2電極442を有するが、3つ以上の電極を有していても構わない。つまり、入出力用端子44cは、2つの電極が半導体基板42cの厚さ方向に沿って積層して配置された構造に限らず、3つ以上の電極が半導体基板42cの厚さ方向に沿って積層して配置された構造でも構わない。 In this embodiment, the input/output terminal 44c has two electrodes, that is, the first electrode 441 and the second electrode 442, but it may have three or more electrodes. In other words, the input/output terminal 44c is not limited to a structure in which two electrodes are stacked and arranged along the thickness direction of the semiconductor substrate 42c, and three or more electrodes are arranged in a stacked manner along the thickness direction of the semiconductor substrate 42c. A structure in which they are arranged in a stacked manner may also be used.

以上述べた通り、本実施形態によれば、実施形態3と同様な効果を得ることができる。 As described above, according to this embodiment, the same effects as in the third embodiment can be obtained.

5.実施形態5
次に、実施形態5に係る半導体装置24dについて、図16、図17、および図18を参照して説明する。
実施形態5の半導体装置24dは、実施形態1と比べ、検査用端子46に代わり、検査用端子46bが配置されることや、第2ワイヤー72の一端には端子接合部76に代わり、端子接合部76dが形成されること以外は、実施形態1と同様である。検査用端子46bは、実施形態3と同様に、半導体基板42の上面42A側から見た平面視で、入出力用端子44bと寸法が同じ正方形状である。第2ワイヤー72の端子接合部76dと検査用端子46bとの接触面積S5は、第1ワイヤー71の端子接合部74と入出力用端子44との接触面積S4よりも、小さい。
なお、上述した実施形態1と同様の構成については、同一の符号を付し、その説明を省略する。
5. Embodiment 5
Next, a semiconductor device 24d according to the fifth embodiment will be described with reference to FIGS. 16, 17, and 18.
The semiconductor device 24d of the fifth embodiment differs from the first embodiment in that a test terminal 46b is arranged instead of the test terminal 46, and a terminal joint is provided at one end of the second wire 72 instead of the terminal joint 76. The second embodiment is the same as the first embodiment except that the portion 76d is formed. Similarly to the third embodiment, the inspection terminal 46b has a square shape with the same dimensions as the input/output terminal 44b when viewed from the top surface 42A side of the semiconductor substrate 42. The contact area S5 between the terminal joint part 76d of the second wire 72 and the test terminal 46b is smaller than the contact area S4 between the terminal joint part 74 of the first wire 71 and the input/output terminal 44.
Note that the same components as those in the first embodiment described above are given the same reference numerals, and the description thereof will be omitted.

図16に示すように、本実施形態では、半導体基板42の上面42Aには、複数の入出力用端子44と、1つの検査用端子46bと、が配置される。 As shown in FIG. 16, in this embodiment, a plurality of input/output terminals 44 and one inspection terminal 46b are arranged on the upper surface 42A of the semiconductor substrate 42.

検査用端子46bは、半導体基板42に設けられる配線50を介して、接地端子44Aと電気的に接続される。 The inspection terminal 46b is electrically connected to the ground terminal 44A via a wiring 50 provided on the semiconductor substrate 42.

本実施形態では、半導体基板42の上面42A側から見た平面視で、入出力用端子44および検査用端子46bは、互いに寸法が同じ正方形状である。なお、入出力用端子44および検査用端子46bは、正方形状以外の形状でも構わない。 In this embodiment, the input/output terminal 44 and the inspection terminal 46b have a square shape with the same dimensions as viewed in plan from the top surface 42A side of the semiconductor substrate 42. Note that the input/output terminal 44 and the inspection terminal 46b may have a shape other than a square shape.

リード64と入出力用端子44とは、第1ワイヤー71を介して、電気的に接続される。リード64と検査用端子46bとは、第2ワイヤー72を介して、電気的に接続される。 The lead 64 and the input/output terminal 44 are electrically connected via the first wire 71. The lead 64 and the test terminal 46b are electrically connected via the second wire 72.

本実施形態では、第1ワイヤー71と入出力用端子44とをワイヤーボンディングにより接合するときのボンディング条件と、第2ワイヤー72と検査用端子46とをワイヤーボンディングにより接合するときのボンディング条件と、が異なる。ワイヤーボンディングにより接合するときのボンディング条件とは、例えば、ワイヤー70を入出力用端子44および検査用端子46に接合するときの圧力、超音波の出力エネルギー、超音波の印加時間、温度などである。 In this embodiment, the bonding conditions when bonding the first wire 71 and the input/output terminal 44 by wire bonding, the bonding conditions when bonding the second wire 72 and the inspection terminal 46 by wire bonding, are different. The bonding conditions when bonding by wire bonding include, for example, the pressure when bonding the wire 70 to the input/output terminal 44 and the inspection terminal 46, the output energy of the ultrasonic wave, the application time of the ultrasonic wave, the temperature, etc. .

図17および図18に示すように、本実施形態では、第1ワイヤー71と入出力用端子44とを接合するときのボンディング条件と、第2ワイヤー72と検査用端子46とを接合するときのボンディング条件と、を異なる条件とすることにより、第2ワイヤー72の端子接合部76dと検査用端子46bとの接触面積S5を第1ワイヤー71の端子接合部74と入出力用端子44との接触面積S4よりも小さくしている。なお、説明の都合上、図17では、第1ワイヤー71の端子接合部74を透過して図示し、端子接合部74以外の第1ワイヤー71の図示を省略している。図18では、第2ワイヤー72の端子接合部76を透過して図示し、端子接合部76以外の第2ワイヤー72の図示を省略している。 As shown in FIGS. 17 and 18, in this embodiment, the bonding conditions when bonding the first wire 71 and the input/output terminal 44 and the bonding conditions when bonding the second wire 72 and the inspection terminal 46 are described. By setting the bonding conditions to different conditions, the contact area S5 between the terminal joint part 76d of the second wire 72 and the test terminal 46b is changed from the contact area S5 between the terminal joint part 74 of the first wire 71 and the input/output terminal 44. The area is made smaller than the area S4. For convenience of explanation, in FIG. 17, the terminal joint portion 74 of the first wire 71 is shown transparently, and illustration of the first wire 71 other than the terminal joint portion 74 is omitted. In FIG. 18, the terminal joint portion 76 of the second wire 72 is shown transparently, and the second wire 72 other than the terminal joint portion 76 is omitted.

詳細には、例えば、第1ワイヤー71と入出力用端子44とを接合するときの圧力に比べ、第2ワイヤー72と検査用端子46とを接合するときの圧力を小さくすることにより、第2ワイヤー72の端子接合部76dと検査用端子46bとの接触面積S5を第1ワイヤー71の端子接合部74と入出力用端子44との接触面積S4よりも小さくすることができる。また、例えば、第1ワイヤー71と入出力用端子44とを接合するときの超音波の印加時間に比べ、第2ワイヤー72と検査用端子46とを接合するときの超音波の印加時間を短くすることにより、第2ワイヤー72の端子接合部76dと検査用端子46bとの接触面積S5を第1ワイヤー71の端子接合部74と入出力用端子44との接触面積S4よりも小さくすることができる。なお、第1ワイヤー71の端子接合部74と入出力用端子44との接触面積S4を、第1ワイヤー71と入出力用端子44との接触面積S4とも言い、第2ワイヤー72の端子接合部76dと検査用端子46bとの接触面積S5を、第2ワイヤー72と検査用端子46bとの接触面積S5とも言う。 In detail, for example, by reducing the pressure when joining the second wire 72 and the inspection terminal 46 compared to the pressure when joining the first wire 71 and the input/output terminal 44, the second The contact area S5 between the terminal joint part 76d of the wire 72 and the test terminal 46b can be made smaller than the contact area S4 between the terminal joint part 74 of the first wire 71 and the input/output terminal 44. For example, compared to the time for applying ultrasonic waves when joining the first wire 71 and the input/output terminal 44, the time for applying ultrasonic waves when joining the second wire 72 and the inspection terminal 46 is shorter. By doing so, the contact area S5 between the terminal joint part 76d of the second wire 72 and the test terminal 46b can be made smaller than the contact area S4 between the terminal joint part 74 of the first wire 71 and the input/output terminal 44. can. Note that the contact area S4 between the terminal joint portion 74 of the first wire 71 and the input/output terminal 44 is also referred to as the contact area S4 between the first wire 71 and the input/output terminal 44; The contact area S5 between 76d and the test terminal 46b is also referred to as the contact area S5 between the second wire 72 and the test terminal 46b.

第2ワイヤー72の端子接合部76dと検査用端子46bとの接触面積S5を、第1ワイヤー71の端子接合部74と入出力用端子44との接触面積S4よりも小さくすることにより、入出力用端子44と第1ワイヤー71の端子接合部74との接合強度よりも、検査用端子46bと第2ワイヤー72の端子接合部76dとの接合強度は小さくなる。 By making the contact area S5 between the terminal joint part 76d of the second wire 72 and the inspection terminal 46b smaller than the contact area S4 between the terminal joint part 74 of the first wire 71 and the input/output terminal 44, the input/output The bonding strength between the test terminal 46b and the terminal bonding portion 76d of the second wire 72 is smaller than the bonding strength between the testing terminal 44 and the terminal bonding portion 74 of the first wire 71.

そのため、衝撃や熱などによる応力がインクカートリッジ10に加えられたとき、入出力用端子44と第1ワイヤー71の端子接合部74との接合面と比べ、検査用端子46bと第2ワイヤー72の端子接合部76との接合面は破壊され易い。 Therefore, when stress due to impact or heat is applied to the ink cartridge 10, compared to the joint surface between the input/output terminal 44 and the terminal joint portion 74 of the first wire 71, the test terminal 46b and the second wire 72 are The joint surface with the terminal joint portion 76 is easily destroyed.

検査用端子46bと第2ワイヤー72の端子接合部76との接合面が破壊されると、検査用端子46bと第2ワイヤー72の端子接合部76との間の電気的特性が変化する。この電気的特性の変化を検出することにより、検査用端子46bと第2ワイヤー72の端子接合部76との接合面に破壊が生じているか否かを判定することができる。換言すると、この電気的特性の変化を検出することにより、衝撃や熱などによる応力が半導体装置24dに加えられたか否かを判定することができる。 When the bonding surface between the test terminal 46b and the terminal joint portion 76 of the second wire 72 is destroyed, the electrical characteristics between the test terminal 46b and the terminal joint portion 76 of the second wire 72 change. By detecting this change in electrical characteristics, it is possible to determine whether or not the joint surface between the test terminal 46b and the terminal joint portion 76 of the second wire 72 is broken. In other words, by detecting this change in electrical characteristics, it is possible to determine whether stress due to impact, heat, or the like has been applied to the semiconductor device 24d.

使用済みのインクカートリッジ10を回収したメーカーやベンダーは、回収したインクカートリッジ10の再整備時において、検査用端子46bに電気的に接続されるリード64と、接地端子44Aに電気的に接続されるリード64と、に図示しない測定装置を接続する。
この測定装置は、検査用端子46bに電気的に接続されるリード64と、接地端子44Aに電気的に接続されるリード64と、の間に形成される電気的導通路の電気的導通度を測定する。詳細には、この測定装置は、電気抵抗を測定する。
When the manufacturer or vendor who collects the used ink cartridge 10 re-maintains the collected ink cartridge 10, the lead 64 is electrically connected to the test terminal 46b and the ground terminal 44A. A measuring device (not shown) is connected to the lead 64.
This measuring device measures the degree of electrical conductivity of the electrical conduction path formed between the lead 64 electrically connected to the test terminal 46b and the lead 64 electrically connected to the ground terminal 44A. Measure. In detail, this measuring device measures electrical resistance.

この測定装置により測定された電気抵抗値、すなわち、検査用端子46bに電気的に接続されるリード64と接地端子44Aに電気的に接続されるリード64との間の電気抵抗値が、所定の閾値以上であるとき、衝撃や熱などによる応力が半導体装置24dに加えられたと判定する。所定の閾値は、例えば、1MΩである。 The electrical resistance value measured by this measuring device, that is, the electrical resistance value between the lead 64 electrically connected to the test terminal 46b and the lead 64 electrically connected to the ground terminal 44A is determined to be within a predetermined value. When it is equal to or greater than the threshold value, it is determined that stress due to impact, heat, etc. has been applied to the semiconductor device 24d. The predetermined threshold value is, for example, 1 MΩ.

このようにして、衝撃や熱などによる応力が半導体装置24dに加えられたか否かを判定することができる。換言すると、衝撃や熱による応力がインクカートリッジ10に加えられたか否かを判定することできる。 In this way, it can be determined whether stress due to impact, heat, etc. has been applied to the semiconductor device 24d. In other words, it is possible to determine whether stress due to impact or heat has been applied to the ink cartridge 10.

インクカートリッジ10に衝撃や熱などによる応力が加えられたと判定されたとき、損傷した可能性がある半導体装置24dは、正常な半導体装置24dに交換される。これにより、再整備されたインクカートリッジ10の信頼性が向上する。 When it is determined that stress due to impact or heat has been applied to the ink cartridge 10, the possibly damaged semiconductor device 24d is replaced with a normal semiconductor device 24d. This improves the reliability of the refurbished ink cartridge 10.

以上述べた通り、本実施形態によれば、以下の効果を得ることができる。
半導体装置24dは、内部回路48を含む半導体基板42と、内部回路48と接続される入出力用端子44と、検査用端子46bと、を有する半導体チップ40と、入出力用端子44と接続される第1ワイヤー71と、検査用端子46bと接続される第2ワイヤー72と、入出力用端子44と第1ワイヤー71を介して接続され、検査用端子46bと第2ワイヤー72を介して接続される配線基板60と、を備え、検査用端子46bと第2ワイヤー72との接触面積S5は、入出力用端子44と第1ワイヤー71との接触面積S4よりも小さい。
これにより、実施形態1と同様な効果を得ることができる。
As described above, according to this embodiment, the following effects can be obtained.
The semiconductor device 24d includes a semiconductor chip 40 having a semiconductor substrate 42 including an internal circuit 48, an input/output terminal 44 connected to the internal circuit 48, and a test terminal 46b, and a semiconductor chip 40 connected to the input/output terminal 44. The first wire 71 is connected to the test terminal 46b, the second wire 72 is connected to the input/output terminal 44, and the test terminal 46b is connected to the second wire 72. The contact area S5 between the test terminal 46b and the second wire 72 is smaller than the contact area S4 between the input/output terminal 44 and the first wire 71.
Thereby, the same effects as in the first embodiment can be obtained.

6.実施形態6
次に、実施形態6に係る半導体装置24eについて、図19を参照して説明する。
実施形態6の半導体装置24eは、実施形態1と比べ、検査用端子46に代わり、検査用端子46eが配置されること以外は、実施形態1と同様である。半導体基板42の上面42A側から見た平面視で、検査用端子46eと、第2ワイヤー72の端子接合部76の一部と、が重なるように、検査用端子46eは配置される。これにより、第2ワイヤー72の端子接合部76と検査用端子46eとの接触面積S5eは、第1ワイヤー71の端子接合部74と入出力用端子44との接触面積S4よりも、小さくなる。
なお、上述した実施形態1と同様の構成については、同一の符号を付し、その説明を省略する。
6. Embodiment 6
Next, a semiconductor device 24e according to a sixth embodiment will be described with reference to FIG. 19.
The semiconductor device 24e of the sixth embodiment is the same as the first embodiment except that a test terminal 46e is arranged instead of the test terminal 46. The test terminal 46e is arranged so that the test terminal 46e and a part of the terminal joint portion 76 of the second wire 72 overlap when viewed from the top surface 42A side of the semiconductor substrate 42. Thereby, the contact area S5e between the terminal joint part 76 of the second wire 72 and the test terminal 46e becomes smaller than the contact area S4 between the terminal joint part 74 of the first wire 71 and the input/output terminal 44.
Note that the same components as those in the first embodiment described above are given the same reference numerals, and the description thereof will be omitted.

図19に示すように、検査用端子46eは、半導体基板42の上面42A側から見た平面視で、長方形状である。なお、説明の都合上、図19では、第2ワイヤー72の端子接合部76を透過して図示し、端子接合部76以外の第2ワイヤー72の図示を省略している。 As shown in FIG. 19, the test terminal 46e has a rectangular shape when viewed from above from the upper surface 42A of the semiconductor substrate 42. As shown in FIG. Note that, for convenience of explanation, in FIG. 19, the terminal joint portion 76 of the second wire 72 is shown transparently, and illustration of the second wire 72 other than the terminal joint portion 76 is omitted.

半導体基板42の上面42A側から見た平面視で、検査用端子46eと、第2ワイヤー72の端子接合部76の一部と、が重なるように、検査用端子46eは配置される。換言すると、半導体基板42の上面42A側から見た平面視で、第2ワイヤー72と検査用端子46eとは、第2ワイヤー72の端子接合部76の一部が検査用端子46eと重なるように、接合される。 The test terminal 46e is arranged so that the test terminal 46e and a part of the terminal joint portion 76 of the second wire 72 overlap when viewed from the top surface 42A side of the semiconductor substrate 42. In other words, the second wire 72 and the test terminal 46e are arranged in such a way that a part of the terminal joint part 76 of the second wire 72 overlaps with the test terminal 46e when viewed from the top surface 42A side of the semiconductor substrate 42. , joined.

半導体基板42の上面42A側から見た平面視で、検査用端子46eと、第2ワイヤー72の端子接合部76の一部と、が重なるように、検査用端子46eを配置することにより、第2ワイヤー72の端子接合部76と検査用端子46eとの接触面積S5eは、第1ワイヤー71の端子接合部74と入出力用端子44との接触面積S4(図17参照)よりも、小さくなる。 By arranging the test terminal 46e so that the test terminal 46e overlaps a part of the terminal joint portion 76 of the second wire 72 when viewed from the top surface 42A side of the semiconductor substrate 42, The contact area S5e between the terminal joint part 76 of the second wire 72 and the test terminal 46e is smaller than the contact area S4 between the terminal joint part 74 of the first wire 71 and the input/output terminal 44 (see FIG. 17). .

第2ワイヤー72の端子接合部76と検査用端子46eとの接触面積S5eを、第1ワイヤー71の端子接合部74と入出力用端子44との接触面積S4よりも小さくすることにより、入出力用端子44と第1ワイヤー71の端子接合部74との接合強度よりも、検査用端子46eと第2ワイヤー72の端子接合部76との接合強度は小さくなる。 By making the contact area S5e between the terminal joint part 76 of the second wire 72 and the inspection terminal 46e smaller than the contact area S4 between the terminal joint part 74 of the first wire 71 and the input/output terminal 44, the input/output The bonding strength between the inspection terminal 46e and the terminal bonding portion 76 of the second wire 72 is smaller than the bonding strength between the testing terminal 44 and the terminal bonding portion 74 of the first wire 71.

そのため、衝撃や熱などによる応力がインクカートリッジ10に加えられたとき、入出力用端子44と第1ワイヤー71の端子接合部74との接合面と比べ、検査用端子46eと第2ワイヤー72の端子接合部76との接合面は破壊され易い。 Therefore, when stress due to impact or heat is applied to the ink cartridge 10, the contact surface between the input/output terminal 44 and the terminal joint portion 74 of the first wire 71 is compared to the contact surface between the test terminal 46e and the second wire 72. The joint surface with the terminal joint portion 76 is easily destroyed.

検査用端子46eと第2ワイヤー72の端子接合部76との接合面が破壊されると、検査用端子46eと第2ワイヤー72の端子接合部76との間の電気的特性が変化する。この電気的特性の変化を検出することにより、検査用端子46eと第2ワイヤー72の端子接合部76との接合面に破壊が生じているか否かを判定することができる。換言すると、この電気的特性の変化を検出することにより、衝撃や熱などによる応力が半導体装置24eに加えられたか否かを判定することができる。 When the bonding surface between the test terminal 46e and the terminal joint portion 76 of the second wire 72 is destroyed, the electrical characteristics between the test terminal 46e and the terminal joint portion 76 of the second wire 72 change. By detecting this change in electrical characteristics, it is possible to determine whether or not the joint surface between the test terminal 46e and the terminal joint portion 76 of the second wire 72 is broken. In other words, by detecting this change in electrical characteristics, it is possible to determine whether stress due to impact, heat, or the like has been applied to the semiconductor device 24e.

使用済みのインクカートリッジ10を回収したメーカーやベンダーは、回収したインクカートリッジ10の再整備時において、検査用端子46eに電気的に接続されるリード64と、接地端子44Aに電気的に接続されるリード64と、に図示しない測定装置を接続する。
この測定装置は、検査用端子46eに電気的に接続されるリード64と、接地端子44Aに電気的に接続されるリード64と、の間に形成される電気的導通路の電気的導通度を測定する。詳細には、この測定装置は、電気抵抗を測定する。
When the manufacturer or vendor who collects the used ink cartridge 10 re-maintains the collected ink cartridge 10, the lead 64 is electrically connected to the test terminal 46e and the ground terminal 44A. A measuring device (not shown) is connected to the lead 64.
This measuring device measures the degree of electrical conductivity of the electrical conduction path formed between the lead 64 electrically connected to the test terminal 46e and the lead 64 electrically connected to the ground terminal 44A. Measure. In detail, this measuring device measures electrical resistance.

この測定装置により測定された電気抵抗値、すなわち、検査用端子46eに電気的に接続されるリード64と接地端子44Aに電気的に接続されるリード64との間の電気抵抗値が、所定の閾値以上であるとき、衝撃や熱などによる応力が半導体装置24eに加えられたと判定する。所定の閾値は、例えば、1MΩである。 The electrical resistance value measured by this measuring device, that is, the electrical resistance value between the lead 64 electrically connected to the test terminal 46e and the lead 64 electrically connected to the ground terminal 44A is determined to be within a predetermined value. When it is equal to or greater than the threshold value, it is determined that stress due to impact, heat, etc. has been applied to the semiconductor device 24e. The predetermined threshold value is, for example, 1 MΩ.

このようにして、衝撃や熱などによる応力が半導体装置24eに加えられたか否かを判定することができる。換言すると、衝撃や熱による応力がインクカートリッジ10に加えられたか否かを判定することできる。 In this way, it can be determined whether stress due to impact, heat, etc. has been applied to the semiconductor device 24e. In other words, it is possible to determine whether stress due to impact or heat has been applied to the ink cartridge 10.

インクカートリッジ10に衝撃や熱などによる応力が加えられたと判定されたとき、損傷した可能性がある半導体装置24eは、正常な半導体装置24eに交換される。これにより、再整備されたインクカートリッジ10の信頼性が向上する。 When it is determined that stress due to impact or heat has been applied to the ink cartridge 10, the potentially damaged semiconductor device 24e is replaced with a normal semiconductor device 24e. This improves the reliability of the refurbished ink cartridge 10.

なお、本実施形態では、半導体基板42の上面42A側から見た平面視で、検査用端子46eは、長方形状であるが、検査用端子46は、長方形状以外の形状でも構わない。つまり、半導体基板42の上面42A側から見た平面視で、検査用端子46eと第2ワイヤー72の端子接合部76の一部とが重なるように検査用端子46eが配置されて、接触面積S4よりも接触面積S5eが小さくなる限りにおいて、検査用端子46eは、任意の形状であって構わない。 In this embodiment, the test terminal 46e has a rectangular shape when viewed from the top surface 42A of the semiconductor substrate 42, but the test terminal 46 may have a shape other than the rectangle. In other words, the test terminal 46e is arranged so that the test terminal 46e overlaps a part of the terminal joint part 76 of the second wire 72 when viewed from the top surface 42A side of the semiconductor substrate 42, and the contact area S4 The test terminal 46e may have any shape as long as the contact area S5e is smaller than the above.

また、本実施形態では、半導体基板42の上面42A側から見た平面視で、第2ワイヤー72の端子接合部76のうち、検査用端子46eと重ならない部分は、検査用端子46eから離れた位置で、半導体基板42と接合している。図19中、領域S10は、半導体基板42の上面42A側から見た平面視で、第2ワイヤー72の端子接合部76が、検査用端子46eから離れた位置で半導体基板42と接合している領域を示す。 Further, in this embodiment, in a plan view seen from the upper surface 42A side of the semiconductor substrate 42, the portion of the terminal joint portion 76 of the second wire 72 that does not overlap with the test terminal 46e is located away from the test terminal 46e. It is joined to the semiconductor substrate 42 at the position. In FIG. 19, region S10 is a planar view of the semiconductor substrate 42 seen from the upper surface 42A side, where the terminal joint portion 76 of the second wire 72 is joined to the semiconductor substrate 42 at a position away from the test terminal 46e. Indicates the area.

以上述べた通り、本実施形態によれば、実施形態1と同様な効果を得ることができる。 As described above, according to this embodiment, the same effects as in the first embodiment can be obtained.

7.実施形態7
次に、実施形態7に係る半導体装置24fについて、図20を参照して説明する。
実施形態7の半導体装置24fは、実施形態1と比べ、検査用端子46に代わり、検査用端子46fが配置されること以外は、実施形態1と同様である。半導体基板42の上面42A側から見た平面視で、検査用端子46fと、第2ワイヤー72の端子接合部76の一部と、が重なるように、検査用端子46fは配置される。これにより、第2ワイヤー72の端子接合部76と検査用端子46fとの接触面積S5fは、第1ワイヤー71の端子接合部74と入出力用端子44との接触面積S4よりも、小さくなる。
なお、上述した実施形態1と同様の構成については、同一の符号を付し、その説明を省略する。
7. Embodiment 7
Next, a semiconductor device 24f according to a seventh embodiment will be described with reference to FIG. 20.
The semiconductor device 24f of the seventh embodiment is the same as the first embodiment except that a test terminal 46f is arranged instead of the test terminal 46. The test terminal 46f is arranged so that the test terminal 46f overlaps a part of the terminal joint portion 76 of the second wire 72 when viewed from the top surface 42A side of the semiconductor substrate 42. Thereby, the contact area S5f between the terminal joint part 76 of the second wire 72 and the test terminal 46f becomes smaller than the contact area S4 between the terminal joint part 74 of the first wire 71 and the input/output terminal 44.
Note that the same components as those in the first embodiment described above are given the same reference numerals, and the description thereof will be omitted.

図20に示すように、検査用端子46fは、第1検査用電極461と、第2検査用電極462と、を有する。半導体基板42の上面42A側から見た平面視で、第1検査用電極461と、第2検査用電極462と、は互いに離間して配置される。つまり、半導体基板42の上面42A側から見た平面視で、第1検査用電極461と、第2検査用電極462と、の間には間隙が形成される。なお、説明の都合上、図20では、第2ワイヤー72の端子接合部76を透過して図示し、端子接合部76以外の第2ワイヤー72の図示を省略している。 As shown in FIG. 20, the test terminal 46f includes a first test electrode 461 and a second test electrode 462. In a plan view seen from the upper surface 42A side of the semiconductor substrate 42, the first inspection electrode 461 and the second inspection electrode 462 are arranged apart from each other. That is, a gap is formed between the first inspection electrode 461 and the second inspection electrode 462 in a plan view when viewed from the upper surface 42A side of the semiconductor substrate 42. Note that, for convenience of explanation, in FIG. 20, the terminal joint portion 76 of the second wire 72 is shown transparently, and illustration of the second wire 72 other than the terminal joint portion 76 is omitted.

本実施形態では、半導体基板42の上面42A側から見た平面視で、第1検査用電極461と、第2検査用電極462と、は互いに寸法が同じ長方形状である。第1検査用電極461が有する長辺と、第2検査用電極462が有する長辺と、は対向して配置される。つまり、第1検査用電極461が有する長辺と、その長辺に対向して配置される第2検査用電極462が有する長辺と、の間には間隙が形成される。 In this embodiment, the first inspection electrode 461 and the second inspection electrode 462 have a rectangular shape with the same dimensions as viewed in plan from the upper surface 42A side of the semiconductor substrate 42. The long side of the first testing electrode 461 and the long side of the second testing electrode 462 are arranged to face each other. That is, a gap is formed between the long side of the first testing electrode 461 and the long side of the second testing electrode 462 disposed opposite to the long side.

半導体基板42の上面42A側から見た平面視で、検査用端子46fと、第2ワイヤー72の端子接合部76の一部と、が重なるように、検査用端子46fは配置される。換言すると、半導体基板42の上面42A側から見た平面視で、第2ワイヤー72と検査用端子46fとは、第2ワイヤー72の端子接合部76の一部が検査用端子46fと重なるように、接合される。詳細には、第2ワイヤー72の端子接合部76は、第1検査用電極461と第2検査用電極462とに跨るように配置される。これにより、第2ワイヤー72の端子接合部76と検査用端子46fとの接触面積S5fは、第2ワイヤー72の端子接合部76と第1検査用電極461との接触面積S51と、第2ワイヤー72の端子接合部76と第2検査用電極462との接触面積S52と、の和となる。 The test terminal 46f is arranged so that the test terminal 46f overlaps a part of the terminal joint portion 76 of the second wire 72 when viewed from the top surface 42A side of the semiconductor substrate 42. In other words, the second wire 72 and the test terminal 46f are arranged in such a way that a part of the terminal joint part 76 of the second wire 72 overlaps the test terminal 46f when viewed from the top surface 42A side of the semiconductor substrate 42. , joined. Specifically, the terminal joint portion 76 of the second wire 72 is arranged so as to straddle the first test electrode 461 and the second test electrode 462. Thereby, the contact area S5f between the terminal joint part 76 of the second wire 72 and the test terminal 46f is the contact area S51 between the terminal joint part 76 of the second wire 72 and the first test electrode 461, and the contact area S5f between the terminal joint part 76 of the second wire 72 and the first test electrode 461, It is the sum of the contact area S52 between the terminal joint portion 76 of 72 and the second inspection electrode 462.

また、本実施形態では、半導体基板42の上面42A側から見た平面視で、第1検査用電極461と第2検査用電極462との間に形成される間隙において、第2ワイヤー72の端子接合部76は、検査用端子46fおよび半導体基板42とは接触していない。ただし、第1検査用電極461と第2検査用電極462との間に形成される間隙において、第2ワイヤー72の端子接合部76は、半導体基板42と接触しても構わない。 Furthermore, in the present embodiment, the terminal of the second wire 72 is located in the gap formed between the first inspection electrode 461 and the second inspection electrode 462 when viewed from the top surface 42A side of the semiconductor substrate 42. The joint portion 76 is not in contact with the test terminal 46f and the semiconductor substrate 42. However, the terminal joint portion 76 of the second wire 72 may come into contact with the semiconductor substrate 42 in the gap formed between the first inspection electrode 461 and the second inspection electrode 462.

半導体基板42の上面42A側から見た平面視で、検査用端子46fと、第2ワイヤー72の端子接合部76の一部と、が重なるように、検査用端子46fを配置することにより、第2ワイヤー72の端子接合部76と検査用端子46fとの接触面積S5fは、第1ワイヤー71の端子接合部74と入出力用端子44との接触面積S4(図17参照)よりも、小さくなる。 By arranging the test terminal 46f so that the test terminal 46f overlaps a part of the terminal joint portion 76 of the second wire 72 when viewed from the top surface 42A side of the semiconductor substrate 42, The contact area S5f between the terminal joint part 76 of the second wire 72 and the test terminal 46f is smaller than the contact area S4 between the terminal joint part 74 of the first wire 71 and the input/output terminal 44 (see FIG. 17). .

第2ワイヤー72の端子接合部76と検査用端子46fとの接触面積S5fを、第1ワイヤー71の端子接合部74と入出力用端子44との接触面積S4よりも小さくすることにより、入出力用端子44と第1ワイヤー71の端子接合部74との接合強度よりも、検査用端子46fと第2ワイヤー72の端子接合部76との接合強度は小さくなる。 By making the contact area S5f between the terminal joint part 76 of the second wire 72 and the inspection terminal 46f smaller than the contact area S4 between the terminal joint part 74 of the first wire 71 and the input/output terminal 44, the input/output The bonding strength between the testing terminal 46f and the terminal bonding portion 76 of the second wire 72 is smaller than the bonding strength between the test terminal 44 and the terminal bonding portion 74 of the first wire 71.

そのため、衝撃や熱などによる応力がインクカートリッジ10に加えられたとき、入出力用端子44と第1ワイヤー71の端子接合部74との接合面と比べ、検査用端子46fと第2ワイヤー72の端子接合部76との接合面は破壊され易い。 Therefore, when stress due to impact or heat is applied to the ink cartridge 10, compared to the joint surface between the input/output terminal 44 and the terminal joint part 74 of the first wire 71, the test terminal 46f and the second wire 72 are The joint surface with the terminal joint portion 76 is easily destroyed.

検査用端子46fと第2ワイヤー72の端子接合部76との接合面が破壊されると、検査用端子46fと第2ワイヤー72の端子接合部76との間の電気的特性が変化する。この電気的特性の変化を検出することにより、検査用端子46fと第2ワイヤー72の端子接合部76との接合面に破壊が生じているか否かを判定することができる。換言すると、この電気的特性の変化を検出することにより、衝撃や熱などによる応力が半導体装置24fに加えられたか否かを判定することができる。 When the bonding surface between the test terminal 46f and the terminal joint portion 76 of the second wire 72 is destroyed, the electrical characteristics between the test terminal 46f and the terminal joint portion 76 of the second wire 72 change. By detecting this change in electrical characteristics, it is possible to determine whether or not the joint surface between the test terminal 46f and the terminal joint portion 76 of the second wire 72 is broken. In other words, by detecting this change in electrical characteristics, it is possible to determine whether stress due to impact, heat, or the like has been applied to the semiconductor device 24f.

使用済みのインクカートリッジ10を回収したメーカーやベンダーは、回収したインクカートリッジ10の再整備時において、検査用端子46fに電気的に接続されるリード64と、接地端子44Aに電気的に接続されるリード64と、に図示しない測定装置を接続する。
この測定装置は、検査用端子46fに電気的に接続されるリード64と、接地端子44Aに電気的に接続されるリード64と、の間に形成される電気的導通路の電気的導通度を測定する。詳細には、この測定装置は、電気抵抗を測定する。
When the manufacturer or vendor who collects the used ink cartridge 10 re-maintains the collected ink cartridge 10, the lead 64 is electrically connected to the test terminal 46f and the ground terminal 44A. A measuring device (not shown) is connected to the lead 64.
This measuring device measures the degree of electrical conductivity of the electrical conduction path formed between the lead 64 electrically connected to the test terminal 46f and the lead 64 electrically connected to the ground terminal 44A. Measure. In detail, this measuring device measures electrical resistance.

この測定装置により測定された電気抵抗値、すなわち、検査用端子46fに電気的に接続されるリード64と接地端子44Aに電気的に接続されるリード64との間の電気抵抗値が、所定の閾値以上であるとき、衝撃や熱などによる応力が半導体装置24fに加えられたと判定する。所定の閾値は、例えば、1MΩである。 The electrical resistance value measured by this measuring device, that is, the electrical resistance value between the lead 64 electrically connected to the test terminal 46f and the lead 64 electrically connected to the ground terminal 44A is determined to be within a predetermined value. When it is equal to or greater than the threshold value, it is determined that stress due to impact, heat, etc. has been applied to the semiconductor device 24f. The predetermined threshold value is, for example, 1 MΩ.

このようにして、衝撃や熱などによる応力が半導体装置24fに加えられたか否かを判定することができる。換言すると、衝撃や熱による応力がインクカートリッジ10に加えられたか否かを判定することできる。 In this way, it can be determined whether stress due to impact, heat, etc. has been applied to the semiconductor device 24f. In other words, it is possible to determine whether stress due to impact or heat has been applied to the ink cartridge 10.

インクカートリッジ10に衝撃や熱などによる応力が加えられたと判定されたとき、損傷した可能性がある半導体装置24fは、正常な半導体装置24fに交換される。これにより、再整備されたインクカートリッジ10の信頼性が向上する。 When it is determined that stress due to impact or heat has been applied to the ink cartridge 10, the possibly damaged semiconductor device 24f is replaced with a normal semiconductor device 24f. This improves the reliability of the refurbished ink cartridge 10.

なお、第1検査用電極461および第2検査用電極462の形状は、長方形以外の形状でも構わない。つまり、半導体基板42の上面42A側から見た平面視で、検査用端子46fと第2ワイヤー72の端子接合部76の一部とが重なるように検査用端子46fが配置されて、接触面積S4よりも接触面積S5fが小さくなる限りにおいて、第1検査用電極461および第2検査用電極462は、任意の形状であって構わない。 Note that the first test electrode 461 and the second test electrode 462 may have shapes other than rectangles. In other words, the test terminal 46f is arranged so that the test terminal 46f overlaps a part of the terminal joint portion 76 of the second wire 72 in a plan view when viewed from the top surface 42A side of the semiconductor substrate 42, and the contact area S4 The first inspection electrode 461 and the second inspection electrode 462 may have any shape as long as the contact area S5f is smaller than the above.

以上述べた通り、本実施形態によれば、実施形態1と同様な効果を得ることができる。 As described above, according to this embodiment, the same effects as in the first embodiment can be obtained.

以上、半導体装置24~24fについて、実施形態1~実施形態7に基づいて説明した。ただし、本発明はこれに限定されるものではなく、各部の構成は、同様の機能を有する任意の構成のものに置換することができる。また、本発明に、他の任意の構成物が付加されていても構わない。また、各実施形態を適宜組み合わせても構わない。また、本開示における「同じ」および「等しい」は、製造ばらつきを含む概念であり、製造ばらつきの範囲内で異なっていても構わない。 The semiconductor devices 24 to 24f have been described above based on Embodiments 1 to 7. However, the present invention is not limited to this, and the configuration of each part can be replaced with any configuration having a similar function. Moreover, other arbitrary components may be added to the present invention. Further, each embodiment may be combined as appropriate. Further, "same" and "equal" in the present disclosure are concepts that include manufacturing variations, and may be different within the range of manufacturing variations.

10…インクカートリッジ、20…回路基板、24,24a,24b,24c,24d,24e,24f…半導体装置、40…半導体チップ、42,42c…半導体基板、44,44b,44c…入出力用端子、44A,44Ab,44Ac…接地端子、46,46a,46b,46e,46f…検査用端子、48…内部回路、50,50a…配線、60…配線基板、62…ダイパッド、64…リード、70…ワイヤー、71…第1ワイヤー、72…第2ワイヤー、74…端子接合部、76,76d…端子接合部、S1…接触面積、S2…接触面積、S4…接触面積、S5…接触面積、S5e…接触面積、S5f…接触面積、t1…厚さ、t2…厚さ。 10... Ink cartridge, 20... Circuit board, 24, 24a, 24b, 24c, 24d, 24e, 24f... Semiconductor device, 40... Semiconductor chip, 42, 42c... Semiconductor board, 44, 44b, 44c... Input/output terminal, 44A, 44Ab, 44Ac...Ground terminal, 46, 46a, 46b, 46e, 46f...Test terminal, 48...Internal circuit, 50, 50a...Wiring, 60...Wiring board, 62...Die pad, 64...Lead, 70...Wire , 71...First wire, 72...Second wire, 74...Terminal joint, 76, 76d...Terminal joint, S1...Contact area, S2...Contact area, S4...Contact area, S5...Contact area, S5e...Contact Area, S5f...Contact area, t1...Thickness, t2...Thickness.

Claims (3)

内部回路を含む半導体基板と、前記内部回路と接続される入出力用端子と、前記半導体基板と前記入出力用端子との接触面積よりも前記半導体基板との接触面積が小さい検査用端子と、を有する半導体チップと、
前記入出力用端子および前記検査用端子とそれぞれ接続されるワイヤーと、
前記入出力用端子および前記検査用端子と前記ワイヤーを介して接続される配線基板と、を備える、
半導体装置。
a semiconductor substrate including an internal circuit, an input/output terminal connected to the internal circuit, and an inspection terminal having a contact area with the semiconductor substrate smaller than a contact area between the semiconductor substrate and the input/output terminal; a semiconductor chip having
Wires connected to the input/output terminal and the inspection terminal, respectively;
A wiring board connected to the input/output terminal and the inspection terminal via the wire,
Semiconductor equipment.
内部回路を含む半導体基板と、前記内部回路と接続される入出力用端子と、前記入出力用端子よりも厚さが小さい検査用端子と、を有する半導体チップと、
前記入出力用端子および前記検査用端子とそれぞれ接続されるワイヤーと、
前記入出力用端子および前記検査用端子と前記ワイヤーを介して接続される配線基板と、を備える、
半導体装置。
a semiconductor chip having a semiconductor substrate including an internal circuit, an input/output terminal connected to the internal circuit, and an inspection terminal having a thickness smaller than the input/output terminal;
Wires connected to the input/output terminal and the inspection terminal, respectively;
A wiring board connected to the input/output terminal and the inspection terminal via the wire,
Semiconductor equipment.
内部回路を含む半導体基板と、前記内部回路と接続される入出力用端子と、検査用端子と、を有する半導体チップと、
前記入出力用端子と接続される第1ワイヤーと、
前記検査用端子と接続される第2ワイヤーと、
前記入出力用端子と前記第1ワイヤーを介して接続され、前記検査用端子と前記第2ワイヤーを介して接続される配線基板と、を備え、
前記検査用端子と前記第2ワイヤーとの接触面積は、前記入出力用端子と前記第1ワイヤーとの接触面積よりも小さい、
半導体装置。
a semiconductor chip having a semiconductor substrate including an internal circuit, input/output terminals connected to the internal circuit, and inspection terminals;
a first wire connected to the input/output terminal;
a second wire connected to the test terminal;
A wiring board connected to the input/output terminal via the first wire and connected to the inspection terminal via the second wire,
The contact area between the test terminal and the second wire is smaller than the contact area between the input/output terminal and the first wire.
Semiconductor equipment.
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