JP2023142545A5 - - Google Patents
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- 238000004519 manufacturing process Methods 0.000 description 4
- 238000012790 confirmation Methods 0.000 description 1
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- 239000000523 sample Substances 0.000 description 1
Description
ところで、近年、このような遊技機では、製造コストの更なる削減を図りたいとの要望
がある。
がある。
遊技の進行を制御する主制御部(例えば、主制御部411a)と、遊技価値の管理に関
する制御を行う遊技価値制御部(例えば、メダル数制御部411b)と、が搭載された主
制御基板(例えば、主制御基板411)を備える遊技機であって、
前記主制御基板は、透明な基板ケースに収容された状態で前記遊技機の内部に取り付け
られ、その状態において視認可能な位置に、固有情報(例えば、基板管理情報)を表示す
るための固有情報表示部(例えば、固有情報表示部541)が設けられ、
前記主制御基板は、通電可能な配線パターンがその表面に配される基板本体(例えば、
基板本体544)と、該基板本体の表面を覆う絶縁層(例えば、レジスト層545)と、
を有し、
前記絶縁層は、透明又は半透明に構成され、
前記固有情報は、前記固有情報表示部において前記基板本体と前記絶縁層の間に配され
るものであり、
前記主制御基板は、前記固有情報表示部が設けられる面を部品実装面とし、該部品実装
面に複数の電子部品を実装可能であり、
前記固有情報表示部以外の前記部品実装面においては、前記絶縁層の表面に、実装され
た電子部品を特定するための部品情報が印刷され、
前記主制御基板には、前記部品実装面側でその端子が半田付けされる複数の表面実装部
品と、前記主制御基板を貫通するスルーホールに前記部品実装面側からその端子を挿通さ
せ、前記部品実装面の裏面側でその端子が半田付けされる複数のディップ実装部品と、が
実装され、
前記複数の表面実装部品は、前記主制御部のマイクロプロセッサに接続された第1の集
積回路(例えば、IC3)と、前記遊技価値制御部のマイクロプロセッサに接続された第
2の集積回路(例えば、IC5)と、を少なくとも含み、
前記第1の集積回路及び前記第2の集積回路はそれぞれ複数の端子を有しており、前記
第1の集積回路の複数の端子と前記第2の集積回路の複数の端子との間がそれぞれ複数の
配線で接続され、
前記複数の配線全てにおいて、それぞれに接続された複数のテストポイントを設け、
前記固有情報表示部において前記基板本体には、前記配線パターンが配されず、
前記主制御部のマイクロプロセッサと前記遊技価値制御部のマイクロプロセッサとは同
一の構成であることを特徴とする。
する制御を行う遊技価値制御部(例えば、メダル数制御部411b)と、が搭載された主
制御基板(例えば、主制御基板411)を備える遊技機であって、
前記主制御基板は、透明な基板ケースに収容された状態で前記遊技機の内部に取り付け
られ、その状態において視認可能な位置に、固有情報(例えば、基板管理情報)を表示す
るための固有情報表示部(例えば、固有情報表示部541)が設けられ、
前記主制御基板は、通電可能な配線パターンがその表面に配される基板本体(例えば、
基板本体544)と、該基板本体の表面を覆う絶縁層(例えば、レジスト層545)と、
を有し、
前記絶縁層は、透明又は半透明に構成され、
前記固有情報は、前記固有情報表示部において前記基板本体と前記絶縁層の間に配され
るものであり、
前記主制御基板は、前記固有情報表示部が設けられる面を部品実装面とし、該部品実装
面に複数の電子部品を実装可能であり、
前記固有情報表示部以外の前記部品実装面においては、前記絶縁層の表面に、実装され
た電子部品を特定するための部品情報が印刷され、
前記主制御基板には、前記部品実装面側でその端子が半田付けされる複数の表面実装部
品と、前記主制御基板を貫通するスルーホールに前記部品実装面側からその端子を挿通さ
せ、前記部品実装面の裏面側でその端子が半田付けされる複数のディップ実装部品と、が
実装され、
前記複数の表面実装部品は、前記主制御部のマイクロプロセッサに接続された第1の集
積回路(例えば、IC3)と、前記遊技価値制御部のマイクロプロセッサに接続された第
2の集積回路(例えば、IC5)と、を少なくとも含み、
前記第1の集積回路及び前記第2の集積回路はそれぞれ複数の端子を有しており、前記
第1の集積回路の複数の端子と前記第2の集積回路の複数の端子との間がそれぞれ複数の
配線で接続され、
前記複数の配線全てにおいて、それぞれに接続された複数のテストポイントを設け、
前記固有情報表示部において前記基板本体には、前記配線パターンが配されず、
前記主制御部のマイクロプロセッサと前記遊技価値制御部のマイクロプロセッサとは同
一の構成であることを特徴とする。
この遊技機によれば、主制御基板において、少なくとも一部の電子部品に表面実装部品
を採用しつつ、表面実装部品同士(主制御部のマイクロプロセッサに接続された第1の集
積回路と遊技価値制御部のマイクロプロセッサに接続された第2の集積回路)の接続経路
には複数のテストポイントを設けるようにしたことから、例えば、測定器のプローブ等で
はアクセス困難な箇所についても適切な検査を行い得るため、遊技の公平性や信頼性を損
なうことなく、その製造コストの削減を図ることできる。
また、この遊技機によれば、固有情報を適切に保護することができるため、その製造コ
ストの削減を図りつつ、より信頼性を高めた基板構成とすることができ、また、固有情報
のみならず、その基板構成自体も容易に視認させることができるため、その製造コストの
削減を図りつつ、その確認性を高めることができる。
を採用しつつ、表面実装部品同士(主制御部のマイクロプロセッサに接続された第1の集
積回路と遊技価値制御部のマイクロプロセッサに接続された第2の集積回路)の接続経路
には複数のテストポイントを設けるようにしたことから、例えば、測定器のプローブ等で
はアクセス困難な箇所についても適切な検査を行い得るため、遊技の公平性や信頼性を損
なうことなく、その製造コストの削減を図ることできる。
また、この遊技機によれば、固有情報を適切に保護することができるため、その製造コ
ストの削減を図りつつ、より信頼性を高めた基板構成とすることができ、また、固有情報
のみならず、その基板構成自体も容易に視認させることができるため、その製造コストの
削減を図りつつ、その確認性を高めることができる。
Claims (1)
- 遊技の進行を制御する主制御部と、遊技価値の管理に関する制御を行う遊技価値制御部
と、が搭載された主制御基板を備える遊技機であって、
前記主制御基板は、透明な基板ケースに収容された状態で前記遊技機の内部に取り付け
られ、その状態において視認可能な位置に、固有情報を表示するための固有情報表示部が
設けられ、
前記主制御基板は、通電可能な配線パターンがその表面に配される基板本体と、該基板
本体の表面を覆う絶縁層と、を有し、
前記絶縁層は、透明又は半透明に構成され、
前記固有情報は、前記固有情報表示部において前記基板本体と前記絶縁層の間に配され
るものであり、
前記主制御基板は、前記固有情報表示部が設けられる面を部品実装面とし、該部品実装
面に複数の電子部品を実装可能であり、
前記固有情報表示部以外の前記部品実装面においては、前記絶縁層の表面に、実装され
た電子部品を特定するための部品情報が印刷され、
前記主制御基板には、前記部品実装面側でその端子が半田付けされる複数の表面実装部
品と、前記主制御基板を貫通するスルーホールに前記部品実装面側からその端子を挿通さ
せ、前記部品実装面の裏面側でその端子が半田付けされる複数のディップ実装部品と、が
実装され、
前記複数の表面実装部品は、前記主制御部のマイクロプロセッサに接続された第1の集
積回路と、前記遊技価値制御部のマイクロプロセッサに接続された第2の集積回路と、を
少なくとも含み、
前記第1の集積回路及び前記第2の集積回路はそれぞれ複数の端子を有しており、前記
第1の集積回路の複数の端子と前記第2の集積回路の複数の端子との間がそれぞれ複数の
配線で接続され、
前記複数の配線全てにおいて、それぞれに接続された複数のテストポイントを設け、
前記固有情報表示部において前記基板本体には、前記配線パターンが配されず、
前記主制御部のマイクロプロセッサと前記遊技価値制御部のマイクロプロセッサとは同
一の構成であることを特徴とする遊技機。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2022049496A JP2023142545A (ja) | 2022-03-25 | 2022-03-25 | 遊技機 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2022049496A JP2023142545A (ja) | 2022-03-25 | 2022-03-25 | 遊技機 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2023142545A JP2023142545A (ja) | 2023-10-05 |
JP2023142545A5 true JP2023142545A5 (ja) | 2024-02-29 |
Family
ID=88206026
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2022049496A Pending JP2023142545A (ja) | 2022-03-25 | 2022-03-25 | 遊技機 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2023142545A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP7551143B2 (ja) | 2022-03-25 | 2024-09-17 | 株式会社ユニバーサルエンターテインメント | 遊技機 |
JP7551142B2 (ja) | 2022-03-25 | 2024-09-17 | 株式会社ユニバーサルエンターテインメント | 遊技機 |
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---|---|---|---|---|
JP7551146B2 (ja) | 2022-03-25 | 2024-09-17 | 株式会社ユニバーサルエンターテインメント | 遊技機 |
JP7551145B2 (ja) | 2022-03-25 | 2024-09-17 | 株式会社ユニバーサルエンターテインメント | 遊技機 |
JP7551147B2 (ja) | 2022-03-25 | 2024-09-17 | 株式会社ユニバーサルエンターテインメント | 遊技機 |
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2022
- 2022-03-25 JP JP2022049496A patent/JP2023142545A/ja active Pending
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Publication number | Priority date | Publication date | Assignee | Title |
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JP7551142B2 (ja) | 2022-03-25 | 2024-09-17 | 株式会社ユニバーサルエンターテインメント | 遊技機 |