JP2021518083A - ピクセル・ユニット・セルにおけるデジタル・シフト・レジスタのための方法 - Google Patents
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Abstract
一態様によれば、本願における実施形態は、フォトダイオードと、フォトダイオードに結合されており、積分期間にわたってフォトダイオードに入射する入力光信号に応じてフォトダイオードにより生成される電荷を蓄積するように構成された積分キャパシタと、積分キャパシタに結合されており、積分キャパシタにかかる電圧と基準電圧とを比較し、積分キャパシタにかかる電圧は基準電圧より大きい旨の判断が行われる毎に、クロック信号を第1レベルで生成するように構成された比較器と、比較器に結合されており、比較器からクロック信号を受信し、第1レベルのクロック信号が比較器から受信される毎に、カウント値を増やすように構成されたシフト・レジスタと、シフト・レジスタに結合されており、カウント値を外部システムに提供するように構成された出力とを備えるデジタル・ユニット・セルを提供する。
Description
デジタル・カメラ、ビデオ・カメラ、又はその他の写真及び/又は画像捕捉装置のような多種多様な画像捕捉デバイスが存在する。これらの画像捕捉デバイスは、所望のシーンから画像を捕捉するために画像センサを使用する可能性がある。例えば、画像センサは、レンズ又はその他のフォーカシング光学系により光を受けるユニット・セルのアレイ(即ち、フォーカル・プレーン・アレイ)を含む可能性がある。受けた光は、アレイ内の各ユニット・セルが、その位置での光強度に比例した電荷を蓄積することを引き起こす。
フォーカル・プレーン・アレイは典型的には列及び行によって組織されたユニット・セルの2次元アレイを含む。ユニット・セル内の回路又は撮像素子がフォトダイオードからの電荷を蓄積することは一般的であり、その電荷はフォトダイオードに入射する様々な波長のフラックスに対応している。しばしば、電荷は、電荷を効果的に統合する容量性素子に蓄積され、統合区間又は積分期間と呼ばれる所与の時間間隔にわたるフラックスの強度に対応する電圧を生成する。
フォーカル・プレーン・アレイ内の各ユニット・セルは、一般に、所望のシーンの最終画像における画素、即ちピクセルに対応する。ピクセルは、デジタル画像の最小部分と考えられる。デジタル画像は一般にピクセルのアレイにより構成される。画像捕捉装置に結合された回路は、各ユニット・セルからの蓄積された電荷をピクセル情報に変換するために、光捕捉・後処理ステップを実行することが可能である。この情報は、デジタル画像記憶フォーマットが必要とする可能性がある色、彩度、輝度、又はその他の情報を含む可能性がある。デジタル画像は、“.JPG”,“.GIF”,“.TIFF”又は適切な他のフォーマットのような形式で保存されることが可能である。
従来のアナログ・ユニット・セルでは、ウェル・キャパシタがディテクタ・ダイオードに結合されている。ウェル・キャパシタは、積分間隔(例えば、10μs)にわたってディテクタ・ダイオードからの光電流を統合する。フレーム毎に1回、ウェル・キャパシタの電圧は、サンプル・ホールド・キャパシタに転送され、次いで、ライン毎に、電圧をバイナリ値に変換するアナログ・デジタル・コンバータ(ADC)に転送される。しかしながら、ユニット・セル・サイズが低減するにつれて、ウェル・キャパシタが有効量の電荷を蓄積する能力は低下してきている。
従来の「デジタル」ユニット・セルは、蓄積された電荷のアナログ・デジタル変換(ADC)を提供する。インユニット・セルADC撮像(In−unit cell ADC imaging)は、ユニット・セルの所望サイズが縮小し続けている場合でさえ(例えば、15ミクロン未満)、改善された光電キャパシティを提供する。例えば、従来のデジタル・ユニット・セル設計は、比較的小さなキャパシタに電荷を蓄積し、閾値電荷がキャパシタに蓄積される毎にリセットされる(即ち放電される)量子化アナログ・フロント・エンド回路を含む。充電及びリセットのパターンは、より多くの光電流が集まるように反復される。各リセット・イベントは、デジタル・カウンタ回路によって「累積」(即ち、カウント)される。各フレームで、デジタル・カウンタの内容をスナップショット・レジスタにコピーし、次いで、スナップショット・レジスタをライン毎に読み出すことによって、グローバル・スナップショットが得られる。この効果は、比較的小さなユニット・セル・サイズを維持しつつ、撮像素子のウェル・キャパシティを増加させることである。
少なくとも1つの実施形態の種々の態様は、添付の図面を参照しながら後述されるが、これらは寸法通りに描かれるようには意図されていない。図面は、種々の態様及び実施形態の説明及び更なる理解を提供するために含まれており、本願に組み込まれて本願の一部を構成するが、本発明の限界の定義としては意図されていない。図面において、種々の図に示される同一又はほぼ同一の各コンポーネントは、同様な数字で表される。明確性の目的で、全てのコンポーネントが全ての図面においてラベル付けされていない可能性がある。
概 要
比較的低コストであり、較正を必要としないシフト・レジスタ・ベースのデジタル・カウンタが本願で提供される。積分キャパシタにかかる電圧が基準電圧を超えるたびに、シフト・レジスタ・ベースのデジタル・カウンタはレジスタにより電荷を移動させ、その結果、カウンタから読み出される「ビット」は、積分キャパシタの両端電圧が基準電圧を超えた回数を示す。
比較的低コストであり、較正を必要としないシフト・レジスタ・ベースのデジタル・カウンタが本願で提供される。積分キャパシタにかかる電圧が基準電圧を超えるたびに、シフト・レジスタ・ベースのデジタル・カウンタはレジスタにより電荷を移動させ、その結果、カウンタから読み出される「ビット」は、積分キャパシタの両端電圧が基準電圧を超えた回数を示す。
本発明の少なくとも1つの態様はデジタル・ユニット・セルに関連し、デジタル・ユニット・セルは、フォトダイオードと;フォトダイオードに結合されており、積分期間にわたってフォトダイオードに入射する入力光信号に応じてフォトダイオードにより生成される電荷を蓄積するように構成された積分キャパシタと;積分キャパシタに結合されており、積分キャパシタにかかる電圧と基準電圧とを比較し、積分キャパシタにかかる電圧は基準電圧より大きい旨の判断が行われる毎に、クロック信号を第1レベルで生成するように構成された比較器と;比較器に結合されており、比較器からクロック信号を受信し、第1レベルのクロック信号が比較器から受信される毎に、カウント値を増やすように構成されたシフト・レジスタと;シフト・レジスタに結合されており、カウント値を外部システムに提供するように構成された出力とを備える。
一実施形態によれば、シフト・レジスタはバケツリレー・デバイス(a Bucket Brigade Device,BBD)である。一実施形態において、シフト・レジスタは、比較器に結合される複数のトランジスタを備え、クロック信号を受信するように構成されている。別の実施形態において、シフト・レジスタは、複数のトランジスタに結合された複数のキャパシタを更に備え、複数のトランジスタは、第1レベルのクロック信号を比較器から受信したことに応答して、複数のキャパシタを通じて電荷を伝搬させるように構成されている。一実施形態において、複数のトランジスタは、第1レベルのクロック信号を比較器から1回目に受信したことに応答して、複数のキャパシタのうちの第1キャパシタに電荷を蓄える動作を行うように構成されている。別の実施形態において、デジタル・ユニット・セルは、シフト・レジスタに結合されており、第1キャパシタをグランドに選択的に結合するように構成されたリセット・スイッチを更に備える。
別の実施形態によれば、複数のトランジスタは、第1レベルのクロック信号を比較器から2回目に受信したことに応答して、複数のキャパシタのうちの第1キャパシタから第2キャパシタへ、蓄えられている電荷を伝搬させる動作を行うように構成されている。一実施形態において、出力により提供されるカウント値は、複数のキャパシタの中で電荷が伝搬してきたキャパシタの数を表す。一実施形態において、シフト・レジスタは、複数のトランジスタに結合される複数のレジスタを更に備えている。
一実施形態によれば、デジタル・ユニット・セルは、積分キャパシタに結合されており、積分期間の終わりに積分キャパシタに蓄えられている電荷をデジタル信号に変換するように構成されている残留回路を更に備える。
本発明の別の態様は、フォトダイオードと積分キャパシタとを備えるデジタル・ユニット・セルを作動させる方法に関連し、本方法は、積分期間にわたってフォトダイオードに入射する入力光信号に応じて電荷を生成するステップと;積分キャパシタに電荷を蓄積するステップと;積分キャパシタにかかる電圧と基準電圧とを比較するステップと;積分キャパシタにかかる電圧は基準電圧より大きい旨の判断が行われる毎に、シフト・レジスタのカウント値を増やすステップと;カウント値をデジタル・ユニット・セルの出力に提供するステップとを含む。
一実施形態によれば、シフト・レジスタのカウント値を増やすステップは、シフト・レジスタ内の複数のキャパシタを通じて電荷を伝搬させるステップを含む。一実施形態において、カウント値を出力に提供するステップは、複数のキャパシタの中で電荷が伝搬してきたキャパシタの数を表すカウント値を出力に提供するステップを含む。
別の実施形態によれば、シフト・レジスタ内の複数のキャパシタを通じて電荷を伝搬させるステップは、積分キャパシタにかかる電圧は基準電圧より大きい旨の判断が初めて行われた場合に、複数のキャパシタのうちの第1キャパシタに電荷を蓄えるステップを含む。一実施形態において、本方法は、積分期間の前に、第1キャパシタをグランドに結合するステップを更に含む。別の実施形態において、シフト・レジスタ内の複数のキャパシタを通じて電荷を伝搬させるステップは、積分キャパシタにかかる電圧は基準電圧より大きい旨の判断が2回目に行われたことに応答して、複数のキャパシタのうちの第1キャパシタから第2キャパシタへ、蓄えられている電荷を伝搬させるステップを含む。
一実施形態によれば、本方法は、積分期間の終わりに積分キャパシタにおける残留電荷をデジタル信号に変換するステップを更に含む。一実施形態において、本方法は、カウント値及びデジタル信号に基づいて入力光信号の強度を計算するステップを更に含む。
本発明の少なくとも1つの態様は、画像処理回路と画像処理回路に結合されたユニット・セルのアレイとを備える画像センサに関連し、各々のユニット・セルは、フォトダイオードと;フォトダイオードに結合されており、積分期間にわたってフォトダイオードに入射する入力光信号に応じてフォトダイオードにより生成される電荷を蓄積するように構成された積分キャパシタと;積分キャパシタに結合されており、積分キャパシタにかかる電圧と基準電圧とを比較し、積分キャパシタにかかる電圧は基準電圧より大きい旨の判断が行われる毎に、クロック信号を第1レベルで生成するように構成された比較器と;比較器に結合されており、比較器からクロック信号を受信し、第1レベルのクロック信号が比較器から受信される毎に、カウント値を増やすように構成されたシフト・レジスタと;シフト・レジスタに結合されており、カウント値を画像処理回路に提供するように構成された出力とを備え、画像処理回路は、各ユニット・セルからのカウント値に少なくとも部分的に基づいて各フォトダイオードに入射する入力光信号の強度を計算するように構成されている。
一実施形態によれば、各ユニット・セルは、積分キャパシタに結合されており、積分期間の終わりに積分キャパシタに蓄えられている電荷をデジタル信号に変換するように構成されている残留回路を更に備え、画像処理回路は、各ユニット・セルからのカウント値と各残留回路からのデジタル信号とに基づいて、各フォトダイオードに入射する入力光信号の強度を計算するように構成されている。
詳細な説明
上述したように、画像キャプチャ・デバイスの画像センサは、眺めたシーンから光を受けるように構成されたアナログ又はデジタル・ユニット・セルのアレイを含むことが可能である。受けた光は、アレイ中の各ユニット・セルが、その位置における光強度に比例した電荷を蓄積することを引き起こし、各ユニット・セルに結合された画像処理回路は、蓄積された電荷を、眺めたシーンに対応する画像情報に変換する。
上述したように、画像キャプチャ・デバイスの画像センサは、眺めたシーンから光を受けるように構成されたアナログ又はデジタル・ユニット・セルのアレイを含むことが可能である。受けた光は、アレイ中の各ユニット・セルが、その位置における光強度に比例した電荷を蓄積することを引き起こし、各ユニット・セルに結合された画像処理回路は、蓄積された電荷を、眺めたシーンに対応する画像情報に変換する。
デジタル・ユニット・セルは、アナログ・ユニット・セルと同様に電荷を統合するが;デジタル・ユニット・セルの統合された電荷が最大レベルを超えると、デジタル・ユニット・セル内の追加回路は、個々のカウンタ値をインクリメントしながら、統合された電荷を除去する。統合電荷が除去された後(及びカウンタがインクリメントされた後)、デジタル・ユニット・セル内の電荷の統合が再び始まる。従って、デジタル・ユニット・セルは、積分ノードがリセットされるたびに(即ち、電荷がユニット・セルから除去されるたびに)インクリメントされるように構成される計数要素を必要とする。
アナログ・カウンタは、典型的には、デジタル・カウント値を復元するために、デジタル化(即ち、アナログ・デジタル・コンバータ)、キャリブレーション、及びポスト非一様補正(NUC)を必要とする。更に、このようなアナログ・カウンタは一般に良好なサイズ制限を有する。従って、デジタル・カウンタ素子は、通常、デジタル・ユニット・セル内で利用され、ユニット・セルに蓄積された電荷がリセットされた回数をカウントするが;そのようなデジタル・カウンタは、典型的には、大きくて複雑である。例えば、従来のデジタル・カウンタの実装は、ビット当たり複数のトランジスタ(例えば、約15個)を利用し、そのため、ユニット・セルに物理的に適合することが可能な「カウンタ・ビット」の数は制限される可能性がある。更に、複雑なデジタル・フォーカル・プレーン・アレイ(FPA)回路は、より低いリードアウト集積回路(ROIC)イールドをもたらす可能性がある。
インユニット・セル・デジタル・カウンタ素子に対する代替として、ペリフェラル(即ち、ピクセル・アレイ外側の)デジタル・カウンタが使用される可能性がある。しかしながら、そのようなペリフェラル・デジタル・カウンタは、通常、対応するFPAが比較的大きく/高価である結果をもたらし、通常、ユニット・セルとペリフェラル・カウンタとの間に多数の相互接続を必要とする。更に、ペリフェラル・デジタル・カウンタは、典型的には、比較的高いカウント/スイッチング・ノイズを示し、また、積分期間の終了時にユニット・セルに蓄えられた残留電荷を無視してしまう結果として、幾らか不正確になる可能性がある。
そこで、本願で説明される態様及び実施形態は、ユニット・セル内のデジタル・ピクセルと組み合わせて使用されることが可能なシフト・レジスタ・ベースのデジタル・カウンタに関連する。少なくとも1つの実施形態によれば、本願で説明されるデジタル・カウンタは比較的低コストであり、較正を必要としない。更に、デジタル・カウンタは、アナログFPAと比較した場合にフィードスルー条件を軽減することが可能であり、ロング・ドゥエル長波長赤外線(long dwell LWIR)及び中波長赤外線(MWIR)用途に対して比較的高いパフォーマンスを示す。更に、デジタル・カウンタは、アナログ残留キャパシタ読み出しアプローチを利用することによって、完全なパフォーマンスを維持する。
本願で説明される方法及び装置の実施形態は、以下の説明に記載された、又は添付図面に示された構成及び構成要素の配置の詳細に適用することに限定されないことが認められるべきである。方法及び装置は、他の実施形態で実装すること、様々な方法で実施されること、又は様々な方法で実行されることが可能である。具体的な実装の実施例は本願において例示的な目的だけのために提供されており、限定であるようには意図されていない。また、本願で使用される表現及び用語は、説明を目的としており、限定するように理解されるべきではない。「含んでいる」、「備えている」、「有している」、「包含している」、「関わっている」及びそれらの変形の本願における使用は、そこに列挙される項目及びそれらの均等物、並びに追加の項目を包含することを意味する。「又は」に対する言及は包括的に解釈される可能性があり、そのため「又は」を使用して説明される如何なる用語も、説明される用語についての単独の、複数の、及び全てのものを示す可能性がある。
図1は、本願で説明される態様に従って画像をキャプチャするために使用されることが可能な画像キャプチャ・デバイス10を示すブロック図である。例えば、デバイス10は、デジタル・カメラ、ビデオ・カメラ、又はその他の写真及び/又は画像キャプチャ装置であってもよい。画像キャプチャ・デバイス10は、画像センサ120と画像処理部106とを含む。画像センサ120は、アクティブ・ピクセル・センサ(APS)又は画像を捕捉することが可能な適切な他の光センシング・デバイスであってもよい。画像処理部106は、画像センサ120から信号情報を受信し、信号情報をデジタル画像に変換するように動作することが可能なハードウェア、ソフトウェア、及び/又はファームウェアの組み合わせであってもよい。
画像センサ120は、ユニット・セル160のアレイ170を含む。各ユニット・セル160は、視野内のその位置での光強度に比例した電荷を蓄積し、その位置での光強度の指標(又は表示)を画像処理部106に提供する。各ユニット・セル160は、捕捉された電子画像内のピクセルに対応してもよい。
画像キャプチャ・デバイス10を用いる特定の撮像方法は、リップル・キャプチャであってもよい。リップル・キャプチャは、ユニット・セル160の各行を画像センサ120から順番にキャプチャする方法である。例えば、リップル・キャプチャは、画像センサ120のユニット・セル160のうちの最上行を光にさらし、次いで第2行を、次いで第3行等々を、画像センサ120のユニット・セル160の最後の行が光にさらされるまで行うことが可能である。画像センサ120によってキャプチャされるピクセル情報を画像処理部106が受信するための別の特定の方法は、リップル・リード(ripple read)であってもよい。リップル・リードは、画像センサ120からのユニット・セル160の各行を順番に処理する方法である。リップル・キャプチャと同様に、リップル・リードは、画像センサ120のユニット・セル160の最上行を処理し、次いで第2行を、次いで第3行等々を、画像センサ120のユニット・セル160の最終行が処理されるまで行うことが可能である。画像センサ120のユニット・セル160の行をリセットするためのリップル・リセット動作が、同様に実行されてもよい。
これらの方法は、連続した行において実行されることが可能である。例えば、リップル・キャプチャ動作は、画像センサ120のユニット・セル160の第1行から始まってもよい。リップル・キャプチャ動作が第2行に移ると、画像センサ120の第1行に関してリップル・リード動作が始まってもよい。リップル・キャプチャ動作が第3行に移ると、第2行に関してリップル・リード動作が始まってもよく、第1行に関してリップル・リセット動作が始まってもよい。これは最終行が処理されるまで継続する可能性がある。一旦、最終行が処理されると、画像は、画像処理部106によって処理、記憶、及び/又は伝送されることが可能である。
図2は、本願で説明される態様によるデジタル・ユニット・セル200を示すブロック図である。デジタル・ユニット・セル200は、図1のユニット・セル160のうちの少なくとも1つに含まれ、入力回路202と、カウンタ210と、残留回路211とを含む。入力回路202は、フォトディテクタ204と、ディテクタ入力回路206と、積分キャパシタ208と、第1リセット・スイッチ209と、比較器212とを含む。フォトディテクタ204は、ディテクタ入力回路206に結合される。積分キャパシタ208は、フォトディテクタ204とグランドとに結合される。第1リセット・スイッチ209は、積分キャパシタ208と並列に、ディテクタ入力回路206とグランドとに結合される。比較器212は、ディテクタ入力回路206と基準電圧215とに結合される。一実施形態によれば、ディテクタ入力回路206は、ダイレクト・インジェクション(DI)回路であるが;他の実施形態では、異なるタイプの入力回路(例えば、キャパシタ・トランス・インピーダンス増幅器(CTIA))を利用することができる。ディテクタ入力回路206は、シングル・エンド又は差動型であるとすることが可能である。
カウンタ210は、シフト・レジスタ219と、第1クロック信号(Clk)214を受信するための第1入力と、第2クロック信号(Clk−)216を受信するための第2入力と、出力218とを含む。シフト・レジスタ219は、第1クロック信号214と、第2クロック信号216と、出力218とに結合される。一実施形態によれば(例えば、図2に示すように)、シフト・レジスタ219はバケツリレー・デバイス(BBD)である。BBDシフト・レジスタ219は、複数のトランジスタ220と、第1キャパシタ(C1)222と、複数のキャパシタ224(例えば、第2キャパシタ(C2)224a、第3キャパシタ(C3)224b、第4キャパシタ(C4)224c....第nキャパシタ(Cn))と、第2リセット・スイッチ213とを含む。複数のトランジスタ220の第1部分220aのゲートは第1クロック信号(Clk)214に結合され、複数のトランジスタ220の第2部分220bのゲートは第2クロック信号(Clk−)216に結合される。
第1キャパシタ(C1)222は、複数のトランジスタ220とグランド221との間に結合される。第2リセット・スイッチ213は、第1キャパシタ(C1)222と並列に、複数のトランジスタ220とグランド221との間に結合される。複数のキャパシタ224(例えば、第2キャパシタ(C2)224a、第3キャパシタ(C3)224b、第4キャパシタ(C4)224c...第nキャパシタ(Cn))の各々は、複数のトランジスタ220のうちの1つの端子とゲートとの間に結合される。一実施形態によれば、BBDシフト・レジスタ219は、複数のトランジスタ220の第3部分220cに結合される電圧バイアス・ライン(Vselect)217を含む。出力218は画像処理部106に結合される。残留回路211は図1の画像処理部106と積分キャパシタ208とに結合される。一実施形態によれば、残留回路211は、積分キャパシタ208に結合された少なくとも1つのアナログ・デジタル・コンバータと、画像処理部106に結合された出力とを含む。デジタル・ユニット・セル200の動作は、図3に関連して後述される。
図3は、図2のデジタル・ユニット・セル200の動作の一実施形態を示すグラフ300である。グラフ300は、コントローラ(例えば、画像処理部106)によってリセット・スイッチ209、213に提供されるリセット信号を表す第1トレース302と、積分キャパシタ208の両端電圧を表す第2トレース304と、第1クロック信号(Clk)214を表す第3トレース306と、第1キャパシタ(C1)222の両端電圧を表す第4トレース308と、複数のキャパシタ224のうちの第2キャパシタ(C2)224aの両端電圧を表す第5トレース310と、複数のキャパシタ224のうちの第3キャパシタ(C3)224bの両端電圧を表す第6トレース312と、複数のキャパシタ224のうちの第4キャパシタ(C4)224cの両端電圧を表す第7トレース314とを含む。
積分周期(Tint)316の開始前に、(例えば、画像処理部106のようなコントローラからの)リセット信号302は、積分キャパシタ208をグランドに結合するために、入力回路202の第1リセット・スイッチ209を作動させ、それにより積分キャパシタ208を放電させ、且つ、第1キャパシタ(C1)222をグランド221に結合するために、シフト・レジスタ219の第2リセット・スイッチ213を作動させ、それにより第1キャパシタ(C1)222を放電させる。
積分周期(Tint)316の開始時において、積分キャパシタ208にかかる電圧304はゼロであり、画像処理部106はリセット・スイッチ209、213をオープンにするように動作する。シーンからの光放射(例えば、入力光信号)がフォトダイオード204に入射すると、フォトダイオード204から生じる光電流は、ディテクタ入力回路206を介して積分キャパシタ208に供給され、フォトダイオード204に入射した光放射のフラックスに対応する電荷が積分キャパシタ208に蓄積される。電荷が積分キャパシタ208に蓄積されるにつれて、積分キャパシタ208にかかる電圧304は、光電流を積分キャパシタ208のキャパシタンスで除算したレベルに等しいレートで増加する(即ち、トレース304の傾きは、フォトダイオード204に入射する光放射のフラックスの強度に依存する)。積分キャパシタ208にかかる電圧304は、比較器212によって監視される。より具体的には、積分キャパシタ208にかかる電圧304は、比較器212によって、基準電圧215と比較される。
積分キャパシタ208にかかる電圧304が基準電圧215より小さい旨の判定に応答して、比較器212は、第1クロック信号214を低レベルで出力する。低レベルの第1クロック信号(Clk)214(及び相補的な高レベルの反転された第2クロック信号(Clk−)216)がカウンタ210に供給される。低レベル第1クロック信号(Clk)214を受信したことに応答して、カウンタ210は何らの動作も行わず、第1キャパシタ(C1)222、複数のキャパシタ224の各々にかかる電圧308はゼロのままである。
積分キャパシタ208にかかる電圧304は基準電圧215より大きい旨の判定に応答して、比較器212は、第1クロック信号(Clk)214を高レベルで出力する。高レベルの第1クロック信号(Clk)214(及び相補的な低レベルの反転された第2クロック信号(Clk−)216)がカウンタ210に供給される。高レベルの第1クロック信号(Clk)214及び対応する低レベルの反転された第2クロック信号(Clk−)216を受信したことに応答して、カウンタ210は第1キャパシタ(C1)222に電荷を蓄積するように動作し、その結果、第1キャパシタ(C1)222にかかる電圧308は、積分キャパシタ208にかかる電圧304が基準電圧215を1回超えたことを示すレベルまで増加する。
第1キャパシタ(C1)222にかかる電圧308が増加した後、(例えば、画像処理部106のようなコントローラからの)リセット信号302は、積分キャパシタ208をグランドに結合するために、入力回路202の第1リセット・スイッチ209を作動させ、それにより積分キャパシタ208を放電し、積分キャパシタ208にかかる電圧304をゼロに向かわせる。一旦、積分キャパシタ208が放電されると、第1リセット・スイッチ209はオープンにされ、眺めているシーンからの継続的な光放射(フォトダイオード204への入射)は、フォトダイオード204からの光電流が、ディテクタ入力回路206を介して積分キャパシタ208に供給されることを再び引き起こす。フォトダイオード204に入射する光放射のフラックスに対応する電荷は、積分キャパシタ208に再び蓄積される。
比較器212は、電圧304を基準電圧215と比較することによって、積分キャパシタにかかる電圧304を監視し続ける。積分キャパシタ208にかかる電圧304は基準電圧215より小さい旨の判定に応答して、比較器212は、第1クロック信号(Clk)214を低レベルで出力する。低レベルの第1クロック信号(Clk)214(及び相補的な高レベルの反転された第2クロック信号(Clk−)216)がカウンタ210に供給される。低レベルの第1クロック信号(Clk)214を受信したことに応答して、カウンタ210は追加の動作を何ら行わず、第1キャパシタ(C1)222にかかる電圧308は高レベルのままであり、複数のキャパシタ224の各々の電圧はゼロのままである。
積分キャパシタ208にかかる電圧304が基準電圧215より大きい旨の判定に応答して、比較器212は、第1クロック信号214を高レベルでカウンタ210に出力する。高レベルの第1クロック信号(Clk)214(及び相補的な低レベルの反転された第2クロック信号(Clk−)216)を受信したことに応答して、カウンタ210は、シフト・レジスタ219により電荷を伝搬させるように動作し、その結果、電荷は複数のキャパシタ224の第2キャパシタ(C2)224aに蓄積され、第2キャパシタ(C2)224aにかかる電圧310は、積分キャパシタ208にかかる電圧が2回目に基準電圧215を超えたことを示すレベルまで増加する。
第2キャパシタ(C2)224aにかかる電圧310が増加した後、(例えば、画像処理部106のようなコントローラからの)リセット信号302は、積分キャパシタ208をグランドに結合するために、入力回路202の第1リセット・スイッチ209を作動させ、それによって積分キャパシタ208を放電し、積分キャパシタ208にかかる電圧をゼロに向かわせる。一旦、積分キャパシタ208が放電されると、第1リセット・スイッチ209はオープンにされ、眺めているシーンからの継続的な光放射(フォトダイオード204への入射)は、ディテクタ入力回路206を介して、フォトダイオード204からの光電流が積分キャパシタ208に再び供給されることを引き起こす。フォトダイオード204に入射する光放射のフラックスに対応する電荷は、積分キャパシタ208に再び蓄積される。
比較器212は、電圧304を基準電圧215と比較することによって、積分キャパシタにかかる電圧304を監視し続ける。積分キャパシタ208にかかる電圧304が基準電圧215より小さい旨の判定に応答して、比較器212は、第1クロック信号214を低レベルで出力する。低レベルの第1クロック信号(Clk)214(及び相補的な高レベルの反転された第2クロック信号(Clk−)216)がカウンタ210に供給される。低レベルの第1クロック信号(Clk)214を受信したことに応答して、カウンタ210は追加的な動作を何ら行わず、第1キャパシタ(C1)222にかかる電圧308は高レベルのまま残り、第2キャパシタ(C2)224aにかかる電圧310も高レベルのまま残り、複数のキャパシタ224のうちの他のものにかかる電圧はゼロのままである。
積分キャパシタ208にかかる電圧304が基準電圧215より大きい旨の判定に応答して、比較器212は、第1クロック信号(Clk)214を高レベルでカウンタ210に出力する。高レベルの第1クロック信号(Clk)214(及び相補的な低レベルの反転された第2クロック信号(Clk−)216)を受信したこと応答して、カウンタ210は、複数のキャパシタ224のうちの第3キャパシタ(C3)224bに電荷が蓄積されるように、電荷をシフト・レジスタ219により伝搬させるように動作し、その結果、第3キャパシタ(C3)224bにかかる電圧312は、集積キャパシタ208にかかる電圧が3回目に基準電圧215を超えたことを示すレベルまで増加する。
第3キャパシタ(C3)224bにかかる電圧312が増加した後、(例えば、画像処理部106のようなコントローラからの)リセット信号302は、積分キャパシタ208をグランドに結合するために、入力回路202の第1リセット・スイッチ209を作動させ、それによって積分キャパシタ208を放電し、積分キャパシタ208にかかる電圧をゼロに向かわせる。一旦、積分キャパシタ208が放電されると、第1リセット・スイッチ209はオープンにされ、眺めているシーンからの継続的な光放射(フォトダイオード204への入射)は、ディテクタ入力回路206を介して、フォトダイオード204からの光電流が積分キャパシタ208に供給されることを再び引き起こす。フォトダイオード204に入射する光放射のフラックスに対応する電荷は、積分キャパシタ208に再び蓄積される。
図2に示すように、上述したように、シフト・レジスタ219は4つのキャパシタを含むが;他の実施形態では、シフト・レジスタ219は、任意の数の所望のキャパシタを含むことが可能であり、その結果、カウンタのカウント深度(即ち、計数能力)は任意の所望のレベルで定義されることが可能である。眺めるシーンからの光放射がユニット・セル200に入射し続ける限り、カウンタ200は、そのカウント値を最大カウント値まで増やし続けること(即ち、シフト・レジスタ219により電荷を伝播させてゆくこと)が可能である。
積分期間(Tint)316の終了時に、出力218は、カウンタ210の「ビット」又は「カウント値」(即ち、シフト・レジスタ219内の各キャパシタ(即ち、第1キャパシタ(C1)222、複数のキャパシタ224のうちの各々)にかかる電圧レベル)を、画像処理部106などの外部システムに提供し、その外部システムは、カウンタ210の「ビット」を分析し、ユニット・セル200に入射した光放射のトータル強度を判定する。一実施形態では、各キャパシタにかかる電圧(即ち、カウンタ210の「ビット」)は、並列的に読み出されるが;他の実施形態では、各キャパシタの電圧は、直列的に読み出される。一実施形態によれば、カウンタ210は、複数のトランジスタ220と出力218との間に結合された比較器226を更に含む。比較器226は、Hi/Lo信号の識別を支援するため及び/又はデジタル論理値をバッファリングするために利用することができる。
「ハイ(高)」であるカウンタ210の「ビット」数は、積分キャパシタ208にかかる電圧(ユニット・セル200に入射した光の放射に起因するもの)が基準電圧215を超えた回数と相関している。例えば、カウンタ210の3つの「ビット」が高であること(例えば、第1キャパシタ(C1)222、第2キャパシタ(C2)224a、第3キャパシタ(C3)224bにかかる電圧308、310、312が高であること)ことを確認したことに応答して、画像処理部106は、積分キャパシタ208にかかる電圧(ユニット・セル200に入射した光の放射に起因するもの)が基準電圧215を3回超えたと判断する。
一実施形態によれば、カウンタ210の最後の「ビット」(即ち、一連のキャパシタ224の中の最後のキャパシタ(例えば、第4キャパシタ(C4)224c))は、カウンタ210がそのカウント・キャパシティに達したことを示すインジケータとして利用される。例えば、画像処理部106は、第4キャパシタ(C4)224c(即ち、図2に示すカウンタ210のキャパシタ列224の最終キャパシタ)にかかる電圧314は高であると判断した場合、画像処理部106は、カウンタ210がカウント・キャパシティに達したと判断することができる。
積分期間(Tint)316の終了時に、残留回路211は積分キャパシタ208に蓄積された何らかの残留電荷を読み出す。例えば、少なくとも1つの実施形態において、残留回路211のA/Dコンバータは、積分期間(Tin)316の終了時に積分キャパシタ208に蓄積された残留電荷のレベルを示すデジタル信号を生成する。デジタル信号は画像処理部106に供給される。
画像処理部106は、カウンタ210からのカウント値及び残留回路211からのデジタル信号に基づいて、積分期間(Tin)316の間にユニット・セル200に入射した光放射の強度を計算することができる。例えば、少なくとも1つの実施形態によれば、画像処理部106は、以下の式を利用することにより、積分期間(Tin)316の間にユニット・セル200に入射した光放射の強度(即ち、「ピクセル値」)を計算する:
ピクセル値=(カウンタ「ビット」値)*(積分キャパシタ・キャパシティ)+残留(A/D)値
ピクセル値=(カウンタ「ビット」値)*(積分キャパシタ・キャパシティ)+残留(A/D)値
上述したように、シフト・レジスタ219は、バケツリレー・デバイスであるが;他の実施形態では、異なるタイプのシフト・レジスタを利用することができる。また、上述したように、複数のキャパシタ224がシフト・レジスタ219内で利用されているが;他の実施形態では、複数のキャパシタを複数の抵抗器で置き換えることが可能である。少なくとも1つの実施形態において、シフト・レジスタは、カスケード・トランジスタ・ラッチアップ及び電流制限抵抗器により実現することができる。
上述したように、ユニット・セル200は、統合終了時に積分キャパシタ208に蓄積されていた残留電荷を取り込むための残留回路を含むが;他の実施形態では、ユニット・セル200は、残留回路を含まなくてもよい。
上述したように、ユニット・セル内のデジタル・ピクセルと組み合わせて利用できるシフト・レジスタ・ベースのデジタル・カウンタが説明されている。少なくとも1つの実施例によれば、本願で説明されるデジタル・カウンタは比較的低コストであり、較正を必要としない。更に、デジタル・カウンタは、従来のデジタル・カウンタよりも少ないトランジスタしか必要としない可能性がある。更に、デジタル・カウンタは、アナログ・フォーカル・プレーン・アレイと比較した場合に、フィードスルー条件を低減することが可能であり、ロング・ドゥエル長波長赤外線(LWIR)及び中波長赤外線(MWIR)の用途に対して比較的高いパフォーマンスを示す。更に、デジタル・カウンタは、アナログ残留キャパシタ読出アプローチを利用することによって、完全なパフォーマンスを維持する。
少なくとも1つの実施形態の幾つかの態様を上述してきたが、当業者には、様々な変更、修正、及び改良が容易に生じることが理解されるはずである。このような変更、修正、及び改良は、本開示の一部であるように意図されており、且つ本発明の範囲内にあることが意図されている。従って、前述の説明及び図面は、単なる例示であるにすぎず、本発明の範囲は、添付の特許請求の範囲及びそれらの均等物の適切な構成から決定されるべきである。
Claims (20)
- デジタル・ユニット・セルであって:
フォトダイオード;
前記フォトダイオードに結合されており、積分期間にわたって前記フォトダイオードに入射する入力光信号に応じて前記フォトダイオードにより生成される電荷を蓄積するように構成された積分キャパシタ;
前記積分キャパシタに結合されており、前記積分キャパシタにかかる電圧と基準電圧とを比較し、前記積分キャパシタにかかる電圧は前記基準電圧より大きい旨の判断が行われる毎に、クロック信号を第1レベルで生成するように構成された比較器;
前記比較器に結合されており、前記比較器から前記クロック信号を受信し、前記第1レベルの前記クロック信号が前記比較器から受信される毎に、カウント値を増やすように構成されたシフト・レジスタ;及び
前記シフト・レジスタに結合されており、前記カウント値を外部システムに提供するように構成された出力;
を備えるデジタル・ユニット・セル。 - 前記シフト・レジスタはバケツリレー・デバイス(BBD)である、請求項1に記載のデジタル・ユニット・セル。
- 前記シフト・レジスタは、前記比較器に結合された複数のトランジスタを備え、前記クロック信号を受信するように構成されている、請求項1に記載のデジタル・ユニット・セル。
- 前記シフト・レジスタは、前記複数のトランジスタに結合された複数のキャパシタを更に備え、
前記複数のトランジスタは、前記第1レベルの前記クロック信号を前記比較器から受信したことに応答して、前記複数のキャパシタを通じて電荷を伝搬させるように構成されている、請求項3に記載のデジタル・ユニット・セル。 - 前記複数のトランジスタは、前記第1レベルの前記クロック信号を前記比較器から初めて受信したことに応答して、前記複数のキャパシタのうちの第1キャパシタに電荷を蓄える動作を行うように構成されている、請求項4に記載のデジタル・ユニット・セル。
- 前記シフト・レジスタに結合されており、前記第1キャパシタをグランドに選択的に結合するように構成されたリセット・スイッチを更に備える請求項5に記載のデジタル・ユニット・セル。
- 前記複数のトランジスタは、前記第1レベルの前記クロック信号を前記比較器から2回目に受信したことに応答して、前記複数のキャパシタのうちの前記第1キャパシタから第2キャパシタへ、蓄えられている前記電荷を伝搬させる動作を行うように構成されている、請求項5に記載のデジタル・ユニット・セル。
- 前記出力により提供される前記カウント値は、前記複数のキャパシタの中で前記電荷が伝搬してきたキャパシタの数を表す、請求項4に記載のデジタル・ユニット・セル。
- 前記シフト・レジスタは、前記複数のトランジスタに結合される複数の抵抗器を更に備えている、請求項3に記載のデジタル・ユニット・セル。
- 前記積分キャパシタに結合されており、前記積分期間の終わりに前記積分キャパシタに蓄えられている電荷をデジタル信号に変換するように構成されている残留回路を更に備える請求項1に記載のデジタル・ユニット・セル。
- フォトダイオードと積分キャパシタとを備えるデジタル・ユニット・セルを作動させる方法であって:
積分期間にわたって前記フォトダイオードに入射する入力光信号に応じて電荷を生成するステップ;
前記積分キャパシタに前記電荷を蓄積するステップ;
前記積分キャパシタにかかる電圧と基準電圧とを比較するステップ;
前記積分キャパシタにかかる電圧は前記基準電圧より大きい旨の判断が行われる毎に、シフト・レジスタのカウント値を増やすステップ;及び
前記カウント値を前記デジタル・ユニット・セルの出力に提供するステップ;
を含む方法。 - 前記シフト・レジスタのカウント値を増やすステップは、前記シフト・レジスタ内の複数のキャパシタを通じて電荷を伝搬させるステップを含む、請求項11に記載の方法。
- 前記カウント値を出力に提供するステップは、前記複数のキャパシタの中で電荷が伝搬してきたキャパシタの数を表す前記カウント値を前記出力に提供するステップを含む、請求項12に記載の方法。
- 前記シフト・レジスタ内の複数のキャパシタを通じて電荷を伝搬させるステップは:
前記積分キャパシタにかかる電圧は前記基準電圧より大きい旨の判断が初めて行われた場合に、前記複数のキャパシタのうちの第1キャパシタに電荷を蓄えるステップ
を含む、請求項12に記載の方法。 - 前記積分期間の前に、前記第1キャパシタをグランドに結合するステップを更に含む請求項14に記載の方法。
- 前記シフト・レジスタ内の複数のキャパシタを通じて電荷を伝搬させるステップは:
前記積分キャパシタにかかる電圧は前記基準電圧より大きい旨の判断が2回目に行われたことに応答して、前記複数のキャパシタのうちの前記第1キャパシタから第2キャパシタへ、蓄えられている前記電荷を伝搬させるステップ
を含む、請求項14に記載の方法。 - 前記積分期間の終わりに前記積分キャパシタにおける残留電荷をデジタル信号に変換するステップを更に含む請求項11に記載の方法。
- 前記カウント値及び前記デジタル信号に基づいて前記入力光信号の強度を計算するステップを更に含む請求項17に記載の方法。
- 画像処理回路と、前記画像処理回路に結合されたユニット・セルのアレイと、を備える画像センサであって、各々のユニット・セルは:
フォトダイオード;
前記フォトダイオードに結合されており、積分期間にわたって前記フォトダイオードに入射する入力光信号に応じて前記フォトダイオードにより生成される電荷を蓄積するように構成された積分キャパシタ;
前記積分キャパシタに結合されており、前記積分キャパシタにかかる電圧と基準電圧とを比較し、前記積分キャパシタにかかる電圧は前記基準電圧より大きい旨の判断が行われる毎に、クロック信号を第1レベルで生成するように構成された比較器;
前記比較器に結合されており、前記比較器から前記クロック信号を受信し、前記第1レベルの前記クロック信号が前記比較器から受信される毎に、カウント値を増やすように構成されたシフト・レジスタ;及び
前記シフト・レジスタに結合されており、前記カウント値を前記画像処理回路に提供するように構成された出力;
を備え、前記画像処理回路は、各ユニット・セルからの前記カウント値に少なくとも部分的に基づいて各フォトダイオードに入射する入力光信号の強度を計算するように構成されている、画像センサ。 - 各ユニット・セルは、前記積分キャパシタに結合された残留回路であって、前記積分期間の終わりに前記積分キャパシタに蓄えられている電荷をデジタル信号に変換するように構成された残留回路を更に備え、
前記画像処理回路は、各ユニット・セルからの前記カウント値と各残留回路からの前記デジタル信号とに基づいて、各フォトダイオードに入射する前記入力光信号の強度を計算するように構成されている、請求項19に記載の画像センサ。
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