JP2021111979A - サイリスタ整流器の制御装置および制御方法 - Google Patents
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Abstract
Description
サイリスタ整流器5は、U相のサイリスタ(サイリスタ素子)5U,5X、V相のサイリスタ5V,5Y、W相のサイリスタ5W,5Zでなる。
(2) サイリスタ整流器5の出力電圧の低下に伴う、不足励磁状態の発生
(3) サイリスタ整流器5のゲインの低下に伴う、制御系の応答性の悪化
また、従来技術においてサイリスタ整流器の1素子の故障を検出して電力変換器の運転が停止しない様にする技術がある。しかし、この技術は、直列接続されたサイリスタ素子に関するものであり、上記の問題を解決できない。
(第1の実施形態)
まず、第1の実施形態について説明する。
<構成>
図1は、第1の実施形態に係る半導体電力変換器制御装置の機能構成例を示す図である。図1において、図7と同一の符号は同一部分又は相当部分を示し、すでに説明した部分は説明を省略する。
図2に示した故障検出部19は、交流電流検出部13と、直流電流検出部14と、差電流演算部12と、過電流検出部8Dと、各相に対応する流出方向過電流検出部8U,8V,8Wと、各相に対応する流入方向過電流検出部8X,8Y,8Zと、論理積回路(論理積と称することもある)10U,10X,10V,10Y,10W,10Zと、保持部11U,11X,11V,11Y,11W,11Zとを有する。論理積回路10U,10X,10V,10Y,10W,10Zを総称して論理積回路10と称することがある。また、保持部11U,11X,11V,11Y,11W,11Zを総称して保持部11と称することがある。
交流電流検出部13は、整流器交流電流CU,CV,CWを入力し、これらの電流の全波整流値を検出し、この値に比例する信号である整流器交流電流CACを出力する。
論理積回路10Yは、過電流故障信号ESと、過電流信号OCY,OCU,OCWとを入力し、論理積による論理演算により、短絡故障したサイリスタ5Yを検出し、この検出を示す過電流故障信号ESYを出力する。
論理積回路10Zは、過電流故障信号ESと、過電流信号OCZ,OCU,OCVとを入力し、論理積による論理演算により、短絡故障したサイリスタ5Zを検出し、この検出を示す過電流故障信号ESZを出力する。
図3に示すように、ゲートパルス切替部2Fは、判定部2Gと、切替部2Hとを有する。判定部2Gは、ゲートパルス発生部2B、故障検出部19、切替部2Hに接続される。判定部2Gは、出力するゲートパルス信号のON/OFFおよび種別を故障信号EU,EX,EV,EY,EW,EZにより判定する。この判定の詳細については後述する。切替部2Hは、ゲートパルス入信号を用いて出力するゲートパルス信号を判定部2Gによる判定結果に応じて切り替える。
ゲートパルス切替部2Fの判定部2Gは、故障検出部19より故障信号EU,EX,EV,EY,EW,EZを入力する。判定部2Gは、ゲートパルス入信号PLU,PLX,PLV,PLY,PLW,PLZをゲートパルス信号PU,PX,PV,PY,PW,PZに切り替える信号である切替指令信号PSU,PSX,PSV,PSY,PSW,PSZを図4に示される関係に従って判定し、この判定した切替指令信号を切替部2Hに出力する。ゲートパルス入信号PLU,PLX,PLV,PLY,PLW,PLZと、切替指令信号PSU,PSX,PSV,PSY,PSW,PSZと、ゲートパルス信号PU,PX,PV,PY,PW,PZとは1対1で対応する。
切替部2Hは、切替指令信号PSU,PSX,PSV,PSY,PSW,PSZのうちONである信号があるときに、このONである信号に対応するゲートパルス入信号PLU,PLX,PLV,PLY,PLW,PLZを、ゲートパルス信号PU,PX,PV,PY,PW,PZとして出力する。
一方で、切替部2Hは、切替指令信号PSU,PSX,PSV,PSY,PSW,PSZのうちOFFである信号があるときに、このOFFである信号に対応するゲートパルス入信号PLU,PLX,PLV,PLY,PLW,PLZを、ゲートパルス信号PU,PX,PV,PY,PW,PZとして出力しない。
第1の実施形態における作用を説明する。例えば、サイリスタ5Uが短絡故障した場合、短絡故障後にサイリスタ5Vと5Wが導通(点弧)した際に過電流となる。この場合、サイリスタ整流器変流器7Uからの整流器交流電流CUが流出方向過電流検出部8Uに入力されることで、U相では流出方向の過電流信号OCUがONとなり、サイリスタ整流器変流器7V,7Wからの整流器交流電流CVとCWが流入方向過電流検出部8Xに入力されることで、V相とW相では流入方向の過電流信号OCYとOCZがONとなる。
図4に示すように、第1に、故障信号EUがONで、その他の故障信号がOFFの時は、切替指令信号PSV,PSWがOFFとなり、その他の切替指令信号がONとなることで、ゲートパルス入信号PLV,PLWに対応するゲートパルス信号PV,PWがOFFとなり、残りのゲートパルス入信号PLU,PLX,PLY,PLZがゲートパルス信号PU,PX,PY,PZに切り替えて出力される。
第1の実施形態によれば、サイリスタ整流器5の1素子に短絡故障が生じたにも関わらず警報接点付きヒューズ4が短時間に溶断しない場合でも、整流器交流電流と整流器直流電流の大小関係と、素子故障による過電流の流入相と流出相の関係とから、故障したサイリスタ素子を検出する事ができる。
次に、第2の実施形態について説明する。第2の実施形態について、第1の実施形態と同様の部分については、詳細な説明を省略する。
<構成>
図5は、第2の実施形態に係る半導体電力変換器制御装置の機能構成例を示す図である。図5において、図1と同一の符号は同一部分又は相当部分を示し、すでに説明した部分は説明を省略する。
これらの故障信号EU,EX,EV,EY,EW,EZの何れか1つでもオン出力されている期間は、補正部2Jは、サイリスタ制御角信号αの制御ゲインが2倍(α=90°からの偏差を2倍)に切り替えられたサイリスタ制御角信号αAとして出力する。
第2の実施形態における作用を説明する。図6は、第2の実施形態に係る半導体電力変換器制御装置における出力電圧と電源位相の関係を示す波形図である。
例えば、サイリスタ5Uが短絡故障して、短絡後にサイリスタ5V,5WへのゲートパルスPV,PWが停止した場合、サイリスタ整流器5が出力する直流電圧VDは、図6に示すように、短絡故障前の直流電圧VDに対して約0.5倍に低下する。図6では、サイリスタ5Uが短絡故障する前の直流電圧VD(図6の中のa)、サイリスタ5Uが短絡故障した後にサイリスタ5V,5WへのゲートパルスPV,PWが停止した場合の直流電圧VD(図6の中のb)が示される。このとき、故障信号EUはONとなるので、サイリスタ制御角信号αの制御ゲインが2倍(α=90°からの偏差を2倍)に切り替わる。
第2の実施形態によれば、第1の実施形態と同じく、サイリスタ整流器5の1素子に短絡故障が生じたにも関わらず警報接点付きヒューズ4が短時間に溶断しない場合でも、整流器交流電流と整流器直流電流の大小関係と、素子故障による過電流の流入相と流出相との関係から、故障したサイリスタ素子を検出する事ができる。
よって、過電流状態の長時間継続による周辺機器の過熱・損傷を抑制しつつ、運転を停止せず短絡故障したサイリスタ整流器5を用いて縮退して継続運転できる。
しかし、第2の実施形態のように、サイリスタ制御角信号αの制御ゲインを2倍とする補正部2Jを設けて継続運転する事で、第1の実施形態のように短絡故障したサイリスタ整流器5を用いて縮退して運転継続する場合と比較して、制御系の応答性を悪化させる事無く運転継続できる。
Claims (18)
- サイリスタ整流器の交流側電圧を入力して、前記交流側電圧の基準位相を出力する基準位相検出手段と、
所定のサイリスタ制御角信号と前記基準位相検出手段より出力される基準位相とに基づいてゲートパルス入信号を発生させるゲートパルス発生手段と、
前記サイリスタ整流器の交流側電流と前記サイリスタ整流器の直流側電流とをそれぞれ入力して、前記交流側電流と前記直流側電流との差電流が所定範囲外であるときに、前記サイリスタ整流器が故障であることを検出し、この故障を示す故障信号を出力する故障検出手段と、
前記ゲートパルス発生手段からのゲートパルス入信号と前記故障検出手段からの故障信号とに基づいて前記ゲートパルス入信号から選択したゲートパルス信号を前記サイリスタ整流器へ出力するゲートパルス切替手段と
を備えたサイリスタ整流器の制御装置。 - 前記ゲートパルス切替手段は、
前記故障検出手段からの故障信号を入力して、この故障信号が、前記サイリスタ整流器における流入相のサイリスタ素子のいずれか1つが故障したことを示す場合は、残り2つの流入相のサイリスタ素子への前記ゲートパルス信号の出力を停止し、前記故障信号が、前記サイリスタ整流器における流出相のサイリスタ素子のいずれか1つが故障したことを示す場合は、残り2つの流出相のサイリスタ素子への前記ゲートパルス信号の出力を停止する
請求項1に記載のサイリスタ整流器の制御装置。 - 前記故障検出手段は、
前記サイリスタ整流器の交流側電流を検出し、この交流側電流の値を出力する交流電流検出手段と、
前記サイリスタ整流器の直流側電流を検出し、この直流側電流の値を出力する直流電流検出手段と、
前記交流電流検出手段からの交流側電流の値と前記直流電流検出手段からの直流側電流の値との差分を示す差電流を演算する差電流演算手段と、
前記差電流演算手段からの差電流が所定範囲外であるときに前記サイリスタ整流器の過電流を検出し、この検出を示す過電流検出信号を出力する過電流検出手段と、
前記交流側電流を入力し、前記サイリスタ整流器における流出方向の電流が所定の値を超過したときに前記サイリスタ整流器の過電流を検出し、この検出を示す第1の過電流信号を出力する流出方向過電流検出手段と、
前記交流側電流を入力し、前記サイリスタ整流器における流入方向の電流が所定の値を超過したときに前記サイリスタ整流器の過電流を検出し、この検出を示す第2の過電流信号を出力する流入方向過電流検出手段と、
前記過電流検出信号と前記第1および第2の過電流信号とを入力とした論理積演算により、故障したサイリスタ素子を検出し、この故障を示す前記故障信号を出力する論理積回路と
を備えた請求項1に記載のサイリスタ整流器の制御装置。 - 前記故障検出手段からの故障信号により指定される条件に従って、前記サイリスタ制御角信号を補正して前記ゲートパルス発生手段へ出力する補正手段をさらに備える
請求項1乃至3のいずれか1項に記載のサイリスタ整流器の制御装置。 - 前記補正手段は、
前記故障検出手段からの故障信号が出力されている期間は、前記サイリスタ制御角信号の制御ゲインを2倍に切り替えて前記ゲートパルス発生手段へ出力する
請求項4に記載のサイリスタ整流器の制御装置。 - 前記交流電流検出手段は、前記交流側電流の全波整流値を検出し、この値を前記交流側電流の値として出力する
請求項3に記載のサイリスタ整流器の制御装置。 - 前記交流電流検出手段は、
前記交流側電流の瞬時値のうち正の値を加算した流入電流を算出し、この電流の値を前記交流側電流の値として出力する
請求項3に記載のサイリスタ整流器の制御装置。 - 前記交流電流検出手段は、
前記交流側電流の瞬時値のうち負の値を加算した値の絶対値である流出電流を算出し、この電流の値を前記交流側電流の値として出力する
請求項3に記載のサイリスタ整流器の制御装置。 - 前記交流電流検出手段は、
各相の前記交流側電流の絶対値を加算して1/2倍した値を前記交流側電流の値として出力する
請求項3に記載のサイリスタ整流器の制御装置。 - サイリスタ整流器の交流側電圧を入力して、前記交流側電圧の基準位相を出力することと、
所定のサイリスタ制御角信号と前記基準位相とに基づいてゲートパルス入信号を発生させることと、
前記サイリスタ整流器の交流側電流と前記サイリスタ整流器の直流側電流とをそれぞれ入力し、前記交流側電流と前記直流側電流との差電流が所定範囲外であるときに、前記サイリスタ整流器5が故障であることを検出して、この故障を示す故障信号を出力することと、
前記ゲートパルス入信号と前記故障信号とに基づいて前記ゲートパルス入信号から選択したゲートパルス信号を前記サイリスタ整流器へ出力するゲートパルス切替を行なうことと
を有するサイリスタ整流器の制御方法。 - 前記ゲートパルス切替を行なうことは、
前記故障信号を入力して、この故障信号が、前記サイリスタ整流器における流入相のサイリスタ素子のいずれか1つが故障したことを示す場合は、残り2つの流入相のサイリスタ素子への前記ゲートパルス信号の出力を停止し、前記故障信号が、前記サイリスタ整流器における流出相のサイリスタ素子のいずれか1つが故障したことを示す場合は、残り2つの流出相のサイリスタ素子への前記ゲートパルス信号の出力を停止することを含む
請求項10記載のサイリスタ整流器の制御方法。 - 前記故障信号を出力することは、
前記サイリスタ整流器の交流側電流を検出し、この交流側電流の値を出力することと、
前記サイリスタ整流器の直流側電流を検出し、この直流側電流の値を出力することと、
前記交流側電流の値と前記直流側電流の値との差分を示す差電流を演算することと、
前記差電流が所定範囲外であるとき時に前記サイリスタ整流器の過電流を検出し、この検出を示す過電流故障信号を出力することと、
前記交流側電流を入力し、前記サイリスタ整流器における流出方向の電流が所定の値を超過したときに前記サイリスタ整流器の過電流を検出し、この検出を示す第1の過電流信号を出力することと、
前記交流側電流を入力し、前記サイリスタ整流器における流入方向の電流が所定の値を超過したときに前記サイリスタ整流器の過電流を検出し、この検出を示す第2の過電流信号を出力することと、
前記過電流故障信号と前記第1および第2の過電流信号とを入力とした論理積演算により、故障したサイリスタ素子を検出し、この故障を示す前記故障信号を出力することを含む
請求項10記載のサイリスタ整流器の制御方法。 - 前記故障信号により指定される条件に従って、前記サイリスタ制御角信号を補正する
請求項10乃至12のいずれか1項に記載のサイリスタ整流器の制御方法。 - 前記補正することは、
前記故障信号が出力されている期間は、前記サイリスタ制御角信号の制御ゲインを2倍に切り替えることを含む
請求項13に記載のサイリスタ整流器の制御方法。 - 前記故障信号を出力することは、前記交流側電流の全波整流値を検出し、この値を前記交流側電流の値として出力することを含む
請求項12に記載のサイリスタ整流器の制御方法。 - 前記故障信号を出力することは、前記交流側電流の瞬時値のうち正の値を加算した流入電流を算出し、この電流の値を前記交流側電流の値として出力することを含む
請求項12に記載のサイリスタ整流器の制御方法。 - 前記故障信号を出力することは、前記交流側電流の瞬時値のうち負の値を加算した値の絶対値である流出電流を算出し、この電流の値を前記交流側電流の値として出力することを含む
請求項12に記載のサイリスタ整流器の制御方法。 - 前記故障信号を出力することは、
各相の前記交流側電流の各絶対値を加算して1/2倍した値を前記交流側電流の値として出力することを含む
請求項12に記載のサイリスタ整流器の制御方法。
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JP2015233391A (ja) * | 2014-06-10 | 2015-12-24 | 株式会社東芝 | 電力変換器の制御装置、サイリスタ整流器の制御装置および制御方法 |
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