JP2020057880A - Macアドレスの下位アドレス、crcビット主でパケットを転送するリング網 - Google Patents
Macアドレスの下位アドレス、crcビット主でパケットを転送するリング網 Download PDFInfo
- Publication number
- JP2020057880A JP2020057880A JP2018186234A JP2018186234A JP2020057880A JP 2020057880 A JP2020057880 A JP 2020057880A JP 2018186234 A JP2018186234 A JP 2018186234A JP 2018186234 A JP2018186234 A JP 2018186234A JP 2020057880 A JP2020057880 A JP 2020057880A
- Authority
- JP
- Japan
- Prior art keywords
- packet
- address
- bit
- memory
- drop
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Landscapes
- Small-Scale Networks (AREA)
Abstract
【課題】リング網でMACアドレスの下位アドレスおよびCRCビットでパケットを転送する。【解決手段】パケットのドロップを指定する下位アドレスメモリ7及びパケットのドロップを指定するCRCビットメモリ8に下位アドレスおよびCRCビットが記憶されていない場合には記憶し、パケットのドロップを指定する下位アドレスメモリに下位アドレスを記憶し、パケットのドロップを指定するCRCビットメモリにCRCビットが記憶されていない場合には、送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶し、左回りリングから装置にパケットが到着した場合に、パケットのドロップを指定する下位アドレスメモリおよびパケットのドロップを指定するCRCビットメモリに下位アドレスおよびCRCビットが記憶されている場合には、パケットのドロップを指定するCRCビットメモリをCRCビットでアドレス指定した位置に0を書き込む。【選択図】図1
Description
本発明は、MACアドレスの下位アドレス、CRCビット主でパケットを転送するリング網を利用したパケット転送システムに関する。
MACアドレスの下位アドレス、MACアドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列でパケットを転送する従来のリング網としては、特開2017−192118「アドレス記憶方法およびリング網」がある。この従来例は、パケットの送信元アドレスの下位アドレスでアドレス指定した位置にビット1を記憶するあいまい記憶アドレスメモリである一つのメモリと、パケットの送信元アドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列であいまい記憶ビット列合成値メモリである一つのメモリをアドレス指定した位置にビット1を記憶する方法を用いて、パケットの送信元アドレスの下位アドレスおよびパケットの宛先アドレスの下位アドレスおよびパケットの送信元アドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列およびパケットの宛先アドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列のみでパケットを転送することによって、高速でアドレス記憶数の多いパケット転送システムを得ようとしたものである。
この例は、頂点装置(頂点ノード)のアウターリング(0系リング)の全パケット流を交換機に送り、交換機からのパケットをインナーリング(1系リング)に送り、アウターリングでは頂点装置(頂点ノード)まで、パケットがリングからドロップすることがない構成にすることにより、1方向性のパケット転送リングとしている。
リングの通常パケットのアッド・ドロップおよび通過の装置(ノード)は、リング外からパケットが到着した場合には、そのパケットの送信元アドレスの下位アドレスでパケットのドロップを指定するのあいまい記憶アドレスメモリをアドレス指定した位置にビット1を記憶すると共に、パケットの通過を指定するのあいまい記憶ビット列合成値メモリを前記パケットの送信元アドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列でアドレス指定した位置からビット1が読み出される場合には、パケットのドロップを指定するのアドレステーブルにそのパケットの送信元アドレス全体を記憶して、アウターリングにより交換機に向かわせる。途中のパケットのアッド・ドロップおよび通過の装置(ノード)にパケットが到着した場合に、そのパケットの送信元アドレスの下位アドレスでパケットのドロップを指定するあいまい記憶アドレスメモリをアドレス指定した位置からビット1が読み出される場合には、パケットの通過を指定するあいまい記憶ビット列合成値メモリをそのパケットから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットの排他的論理和のビット列でアドレス指定した位置にビット1を記憶し、アウターリングによりそのパケットを交換機に向かわせる。
交換機からインナーリングに送出されたパケットがパケットのアッド・ドロップおよび通過の装置(ノード)に到着した場合に、パケットのドロップを指定するあいまい記憶アドレスメモリをそのパケットの宛先アドレスの下位アドレスでアドレス指定した位置からビット1が読み出されない場合には、そのパケットをインナーリングにより端末方向に向かわせ、ビット1が読み出され、パケットの通過を指定するのあいまい記憶ビット列合成値メモリをそのパケットの宛先アドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列でアドレス指定した位置からビット1が読み出されない場合には、そのパケットをリングからドロップし、パケットの通過を指定するのあいまい記憶ビット列合成値メモリをそのパケットの宛先アドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列でアドレス指定した位置からビット1が読み出される場合で、パケットのドロップを指定するアドレステーブルにそのパケットの宛先アドレスがある場合には、そのパケットをリングからドロップし、無い場合には、そのパケットをインナーリングにより端末方向に向かわせる。
従来例特開2017−192118では、左回りリング(アウターリング)のパケット流が頂点装置(頂点ノード)で交換機を介して右回りリング(インナーリング)に折り返すことにより、パケットの進行方向を固定し、それにより、アウターリングを頂点装置(頂点ノード)に向かうパケットにより、頂点装置(頂点ノード)から、端末からのパケットがリングにADDしたパケットのアッド・ドロップおよび通過の装置(ノード)までの経路を設定することにより、端末からのパケットがリングにADDしたパケットのアッド・ドロップおよび通過の装置(ノード)のフル稼働するMACアドレステーブルを省略している。
しかし、この従来例では、新フローのパケットがパケットのアッド・ドロップおよび通過の装置(ノード)にリング外からADDしてから前記パケットの送信元MACアドレスの下位アドレスに送信元MACアドレスの下位アドレスが一致する左回りリング(アウターリング)のパケットが通過するまでの間と、左回りリング(アウターリング)の新パケットフローのパケットが通過してからそのパケットのアッド・ドロップおよび通過の装置(通常ノード)に、前記パケットの送信元MACアドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列に送信元MACアドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列が一致するパケットがリング外からADDするまでの間に、右回りリングの宛先MACアドレスの下位アドレスがパケットのドロップを指定するあいまい記憶アドレスメモリにある場合および右回りリングの宛先MACアドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列がパケットの通過を指定するあいまい記憶ビット列合成値メモリにあるパケットが到来した場合に誤動作が発生する。パケットのドロップを指定するアドレステーブルに記憶されているアドレスは、左回りリングの送信元MACアドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列ではなく、リング外からリングにADDしたパケットの送信元MACアドレスの下位アドレスに送信元MACアドレスの下位アドレスが一致するアウターリングからのパケットの送信元MACアドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列について、リング外からリングADDしたパケットの送信元MACアドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列が一致するパケットの送信元MACアドレスであり、記憶アドレスに漏れがあるため、誤動作が発生する。
本発明は、上記従来技術の問題点を鑑みて成されたもので、その目的とする所は、リング外から2重リング網のパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元端末を識別するユニークなアドレス(以下、送信元アドレスと言う)を上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を指定するビットが読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前記頂点装置(頂点ノード)に向かわせ、
前記パケットが前記頂点装置(頂点ノード)に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前記頂点装置に向かわせるか、または、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前記頂点装置に向かわせる方法を提供することにある。
前記パケットが前記頂点装置(頂点ノード)に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前記頂点装置に向かわせるか、または、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前記頂点装置に向かわせる方法を提供することにある。
上記のように構成にしたことにより、パケットの通過を指定する下位アドレスメモリを使わないか、使う場合には、パケットの通過を指定する下位アドレスメモリには漏れは無く、左回りリングから到着するパケットで、パケットのドロップを指定するCRCビットメモリとパケットのドロップを指定する下位アドレスメモリの両方からビット1が読み出される誤一致は、パケットのドロップを指定するCRCビットメモリの記憶を消すことにより、右回りリングから到着するパケットの宛先アドレスで、パケットのドロップを指定するCRCビットメモリとパケットのドロップを指定する下位アドレスメモリの両方からビット1が読み出される誤一致によるパケットの誤ドロップを無くすことができ、次にリング外からそのパケットのアッド・ドロップおよび通過の装置に到着するパケットの送信元アドレスの下位アドレスでパケットのドロップを指定する下位アドレスメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、送信元MACアドレスのCRCビットでパケットのドロップを指定するCRCビットメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、パケットのドロップを指定するアドレステーブルにそのパケットの送信元MACアドレスを記憶することで、前記誤一致を避ける方法を提供することにある。
パケットのドロップを指定するCRCビットメモリとパケットのドロップを指定する下位アドレスメモリの両方からビット1が読み出される誤一致の確率は、メモリのビット数がリング上を転送されるパケットの端末数に比較して、多い場合には、非常に小さくなる。
上記説明したように、本発明は、パケットがリング外からパケットのアッド・ドロップおよび通過の装置に到着した場合に、そのパケットの送信元アドレスの下位アドレスでパケットの通過を指定する下位アドレスメモリをアドレス指定した場合に、下位アドレス記憶有を示すビットが読み出される場合に、そのパケットの送信元アドレスをパケットのドロップを指定するアドレステーブルに記憶するという動作を行わないため、リング上を転送されるパケットが10万程度の端末数のパケットと多い場合にも、パケットのドロップを指定するアドレステーブルの記憶アドレス数は僅かで済む利点がある。また、パケットの通過を指定するアドレスメモリを使わないこともできるため、パケットの通過を指定するアドレスメモリを高速でも動作させることのできるメモリのビット数には限界があるので、本発明は有効である。
また、上記説明したように、パケットがリング外からパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶することにより、端末の移動以外に誤一致を起こす確率は非常に小さいので、音声パケット転送だけでなく、データパケット転送にも使用できる利点がある。
しかし、端末の移動以外で誤一致の場合に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込んだ場合には、そのパケットのアッド・ドロップおよび通過の装置でリングからドロップすべきパケットが、そのパケットのアッド・ドロップおよび通過の装置に、リング外から前記ビットに関係するパケットが到着するまで、誤って、そのパケットのアッド・ドロップおよび通過の装置を通過してしまう問題がある。これを避けるためには、やはり、端末の移動以外で誤一致の場合に、パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込んだ場合には、さらに、そのパケットの送信元アドレスをパケット通過を指定するアドレステーブルに記憶する必要がある。
なお、携帯電話網で端末の属する基地局が変わった場合には、今までその端末が属していた基地局に対応するパケットのアッド・ドロップおよび通過の装置を通過する場合、すなわち、パケットが通過したパケットのアッド・ドロップおよび通過の装置の数がN以下の場合には、そのパケットのアッド・ドロップおよび通過の装置のパケットのドロップを指定するアドレステーブルにそのパケットの送信元アドレスがある場合には、そのアドレスを消去して、無い場合には、そのパケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、上記以外は、そのまま、前記パケットを左回りリングにより、前方のパケットのアッド・ドロップおよび通過の装置に向かわせるか、または、前記下位アドレスでパケットの通過を指定する下位アドレスメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより、前方のパケットのアッド・ドロップおよび通過の装置に向かわせ、
一方、パケットが通過したパケットのアッド・ドロップおよび通過の装置の数がN以上の場合には、そのパケットのアッド・ドロップおよび通過の装置のパケットのドロップを指定するアドレステーブルにそのパケットの送信元アドレスがある場合には、そのアドレスを消去して、無い場合には、そのパケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、そのパケットの送信元アドレスをパケット通過を指定するアドレステーブルに記憶し、上記以外は、そのまま、前記パケットを左回りリングにより、前方のパケットのアッド・ドロップおよび通過の装置に向かわせるか、または、前記下位アドレスでパケットの通過を指定する下位アドレスメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより、前方のパケットのアッド・ドロップおよび通過の装置に向かわせることで対応できる。
一方、パケットが通過したパケットのアッド・ドロップおよび通過の装置の数がN以上の場合には、そのパケットのアッド・ドロップおよび通過の装置のパケットのドロップを指定するアドレステーブルにそのパケットの送信元アドレスがある場合には、そのアドレスを消去して、無い場合には、そのパケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、そのパケットの送信元アドレスをパケット通過を指定するアドレステーブルに記憶し、上記以外は、そのまま、前記パケットを左回りリングにより、前方のパケットのアッド・ドロップおよび通過の装置に向かわせるか、または、前記下位アドレスでパケットの通過を指定する下位アドレスメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより、前方のパケットのアッド・ドロップおよび通過の装置に向かわせることで対応できる。
また、携帯電話網で端末の属する基地局が変わった場合には、今までその端末が属していた基地局より頂点装置側の基地局に移動する場合、しかし、実際には頂点装置に向かう側のパケットのアッド・ドロップおよび通過の装置に移動したのか、頂点装置に向かう側の反対側のパケットのアッド・ドロップおよび通過の装置に移動したのかを判断するのは難しいので、旧基地局配下の端末が前記端末の属する基地局を変えた直後の前記端末からのパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合には、パケットの通過を指定する下位アドレスメモリを使用しないか、または、パケットの通過を指定する下位アドレスメモリを使用する場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリをアドレス指定した位置に下位アドレス記憶無を示すビット0を書き込み、かつ、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶し、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリをアドレス指定した位置にCRCビット記憶有を示すビット1を記憶し、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせることで対応できる。
このパケット転送システムで特徴的なのは、左回りリングではリング外の伝送路からパケットを受信するだけで、サーバ以外にはリング外にパケットを送出しないことと、パケットのアッド・ドロップおよび通過の装置のメモリへの書き込みは左回りリングを転送されるパケットによってのみ行われることである。これにより、このパケット転送システムではパケットの送信元MACアドレスの下位アドレスとCRCビットおよび宛先MACアドレスの下位アドレスとCRCビットのみを主にパケットのアッド・ドロップおよび通過の装置が扱うことでパケットを転送できる利点がある。
本発明(1)によれば、左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムであって、
前記2重リング網は、パケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが左回りリングからパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前方のアッド・ドロップおよび通過を指定する装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システムを提供する。
前記2重リング網は、パケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが左回りリングからパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前方のアッド・ドロップおよび通過を指定する装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システムを提供する。
また、本発明(2)によれば、左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定するアドレステーブルとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムであって、
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレス全体がパケット通過を指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、前記パケットの送信元アドレス全体をパケット通過を指定するアドレステーブルに記憶して、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケット通過を指定するアドレステーブルにある場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、一方、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システムを提供する。
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレス全体がパケット通過を指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、前記パケットの送信元アドレス全体をパケット通過を指定するアドレステーブルに記憶して、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケット通過を指定するアドレステーブルにある場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、一方、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システムを提供する。
また、本発明(3)によれば、左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットのドロップを指定する下位アドレスメモリの記憶アドレスのみでパケットをドロップする制限時間付アドレスを記憶するパケットの通過を指定するアドレステーブルとパケットドロップ許可タイマーを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムであって、
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレス全体がパケット通過を指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合か、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、パケットドロップ許可タイマーをセットし、パケットのドロップを指定する下位アドレスメモリの記憶アドレスのみでパケットをドロップする制限時間付アドレスを記憶するパケットの通過を指定するアドレステーブルに前記パケットの送信元アドレスを記憶し、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケット通過を指定するアドレステーブルにある場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、一方、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外で、パケットドロップ許可タイマーがタイムアウトしていない場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出されない場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システムを提供する。
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレス全体がパケット通過を指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合か、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、パケットドロップ許可タイマーをセットし、パケットのドロップを指定する下位アドレスメモリの記憶アドレスのみでパケットをドロップする制限時間付アドレスを記憶するパケットの通過を指定するアドレステーブルに前記パケットの送信元アドレスを記憶し、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケット通過を指定するアドレステーブルにある場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、一方、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外で、パケットドロップ許可タイマーがタイムアウトしていない場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出されない場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システムを提供する。
また、本発明(4)によれば、 左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定する下位アドレスメモリとパケットドロップ許可タイマーを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムであって、
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合か、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、パケットドロップ許可タイマーをセットし、前記パケットの通過したパケットのアッド・ドロップおよび通過の装置数が一定値N以上の場合には、そのまま、一方、前記パケットの通過したパケットのアッド・ドロップおよび通過の装置数が一定値N未満の場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、下位アドレス記憶有を示すビット1が読み出されない場合で、パケットドロップ許可タイマーがタイムアウトしていない場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出されない場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システムを提供する。
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合か、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、パケットドロップ許可タイマーをセットし、前記パケットの通過したパケットのアッド・ドロップおよび通過の装置数が一定値N以上の場合には、そのまま、一方、前記パケットの通過したパケットのアッド・ドロップおよび通過の装置数が一定値N未満の場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、下位アドレス記憶有を示すビット1が読み出されない場合で、パケットドロップ許可タイマーがタイムアウトしていない場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出されない場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システムを提供する。
また、本発明(5)によれば、 左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定する下位アドレスメモリとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムであって、
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合か、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケット通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、下位アドレス記憶有を示すビット1が読み出されない場合には、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システムを提供する。
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合か、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケット通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、下位アドレス記憶有を示すビット1が読み出されない場合には、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システムを提供する。
また、本発明(6)によれば、左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定する下位アドレスメモリとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流を2重リング網の頂点装置の右回りリングのパケット流に折り返す構成のパケット転送システムであって、
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合か、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケット通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、下位アドレス記憶有を示すビット1が読み出されない場合には、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システムを提供する。
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合か、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケット通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、下位アドレス記憶有を示すビット1が読み出されない場合には、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システムを提供する。
また、本発明(7)によれば、左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定する下位アドレスメモリとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムであって、
前記2重リング網は、パケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶し、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前記頂点装置に向かわせる手段とを備えたことを特徴とするパケット転送システムを提供する。
前記2重リング網は、パケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶し、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前記頂点装置に向かわせる手段とを備えたことを特徴とするパケット転送システムを提供する。
また、本発明(8)によれば、左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、前記2つのリング伝送路に、左回りリングのパケット流を右回りリングに折り返し、かつ、特定パケット以外のパケットの通過を遮断するリング伝送路ポートを右回りリングの特定パケットを受信する側に持つ装置である頂点装置と、複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網からなるパケット転送システムであって、
前記2重リング網のパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶し、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前記頂点装置に向かわせる手段とを備えたことを特徴とするパケット転送システムを提供する。
前記2重リング網のパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶し、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前記頂点装置に向かわせる手段とを備えたことを特徴とするパケット転送システムを提供する。
また、本発明(9)によれば、本発明(7)または(8)において、前記2重リング網は、右回りリングを転送されるブロードキャストパケットまたは発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、前記パケットをリング外伝送路経由でリング外に送出し、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、少なくとも、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合で、かつ、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルに無い場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出する手段をさらに備えたことを特徴とするパケット転送システムを提供する。
また、本発明(10)によれば、本発明(7)または(8)において、前記2重リング網は、右回りリングを転送されるブロードキャストパケットまたは発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合には、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出する手段をさらに備えたことを特徴とするパケット転送システムを提供する。
また、本発明(11)によれば、本発明(7)または(8)において、前記2重リング網は、右回りリングを転送されるブロードキャストパケットまたは発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置装置に送出し、ビット1が読み出されない場合には、前記パケットを廃棄する手段をさらに備えたことを特徴とするパケット転送システムを提供する。
また、本発明(12)によれば、本発明(7)または(8)において、前記2重リング網は、右回りリングを転送されるブロードキャストパケットまたは発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出されない場合で、かつ、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出されない場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合には、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置装置に送出する手段をさらに備えたことを特徴とするパケット転送システムを提供する。
また、本発明(13)によれば、本発明(4)から(12)のいずれかにおいて、前記2重リング網は、前記パケットのアッド・ドロップおよび通過の装置配下の端末が前記端末の属するパケットのアッド・ドロップおよび通過の装置を変えた直後の前記端末からのパケットが通常パケットのアッド・ドロップおよび通過の装置に到着した場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶無を示すビット0を書き込み、かつ、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶し、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶有を示すビット1を記憶し、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段をさらに備えたことを特徴とするパケット転送システムを提供する。
また、本発明(14)によれば、本発明(1)から(3)のいずれかにおいて、前記2重リング網は、前記パケットのアッド・ドロップおよび通過の装置配下の端末が前記端末の属するパケットのアッド・ドロップおよび通過の装置を変えた直後の前記端末からのパケットが通常パケットのアッド・ドロップおよび通過の装置に到着した場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶し、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶有を示すビット1を記憶し、前記パケットを右回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段をさらに備えたことを特徴とするパケット転送システムを提供する。
また、本発明(15)によれば、本発明(1)から(6)または(9)から(12)のいずれかにおいて、前記2重リング網は、右回りリングからパケットのアッド・ドロップおよび通過の装置に発呼パケットが到着した場合に、前記パケットをコピーし、片一方のパケットはリングから接続している伝送路でリング外に送出し、もう、片方のパケットは、右回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段をさらに備えたことを特徴とするパケット転送システムを提供する。
また、本発明(16)によれば、本発明(1)から(6)または(9)から(12)のいずれかにおいて、前記2重リング網は、右回りリングからパケットのアッド・ドロップおよび通過の装置にブロードキャストパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合、または、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、前記パケットをパケットのアッド・ドロップおよび通過の装置をスルーで通過させ、上記以外の場合および1度、パケットのアッド・ドロップおよび通過の装置をスルーで通過した後の場合には、前記パケットをコピーし、片一方のパケットはリング外から接続している伝送路でリング外に送出し、もう、片方のパケットは、右回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせることを特徴とするパケット転送システムを提供する。
また、本発明(17)によれば、本発明(1)から(14)または(16)のいずれかにおいて、パケットのドロップを指定するCRCビットメモリをパケットの送信元アドレスのCRCビットまたは宛先アドレスのCRCビットでアドレス指定に代えて、パケットのドロップを指定するビット列合成値メモリを、パケットの送信元アドレスまたは宛先アドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットの排他的論理和のビット列でアドレス指定にすること特徴とするパケット転送システムを提供する。
また、本発明(18)によれば、左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムに適用され、
リング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
パケットが左回りリングから到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前方のアッド・ドロップおよび通過を指定する装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットが到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システムのパケットのアッド・ドロップおよび通過の装置を提供する。
リング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
パケットが左回りリングから到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前方のアッド・ドロップおよび通過を指定する装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットが到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システムのパケットのアッド・ドロップおよび通過の装置を提供する。
また、本発明(19)によれば、左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定するアドレステーブルとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムに適用され、
リング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレス全体がパケット通過を指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが左回りリングから到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、前記パケットの送信元アドレス全体をパケット通過を指定するアドレステーブルに記憶して、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットが到着した場合に、前記パケットの宛先アドレス全体がパケット通過を指定するアドレステーブルにある場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、一方、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システムのパケットのアッド・ドロップおよび通過の装置を提供する。
リング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレス全体がパケット通過を指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが左回りリングから到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、前記パケットの送信元アドレス全体をパケット通過を指定するアドレステーブルに記憶して、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットが到着した場合に、前記パケットの宛先アドレス全体がパケット通過を指定するアドレステーブルにある場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、一方、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システムのパケットのアッド・ドロップおよび通過の装置を提供する。
また、本発明(20)によれば、左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定する下位アドレスメモリとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムに適用され、
リング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが左回りリングから到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットが到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケット通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出し、ビット1が読み出されない場合には、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システムのパケットのアッド・ドロップおよび通過の装置を提供する。
リング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが左回りリングから到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットが到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケット通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出し、ビット1が読み出されない場合には、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システムのパケットのアッド・ドロップおよび通過の装置を提供する。
また、本発明(21)によれば、左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定する下位アドレスメモリとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流を2重リング網の頂点装置の右回りリングのパケット流に折り返す構成のパケット転送システムに適用され、
リング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが左回りリングから到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットが到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケット通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出し、ビット1が読み出されない場合には、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システムのパケットのアッド・ドロップおよび通過の装置を提供する。
リング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが左回りリングから到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットが到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケット通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出し、ビット1が読み出されない場合には、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システムのパケットのアッド・ドロップおよび通過の装置を提供する。
また、本発明(22)によれば、本発明(18)から(21)のいずれかにおいて、パケットのドロップを指定するCRCビットメモリをパケットの送信元アドレスのCRCビットまたは宛先アドレスのCRCビットでアドレス指定に代えて、パケットのドロップを指定するビット列合成値メモリを、パケットの送信元アドレスまたは宛先アドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットの排他的論理和のビット列でアドレス指定にすること特徴とするパケット転送システムのパケットのアッド・ドロップおよび通過の装置を提供する。
以上、説明したように、本発明によれば、高速で記憶ビット長が短く、記憶アドレス数の多いアドレス記憶法を得、その欠点をパケットがリングからドロップしない左回りリングとパケットがリングにアッドしない右回りリングからなる2重リング網の頂点装置にサーバが接続されたパケット転送システムを用いることで解決し、このパケット転送システムでは主にMACアドレスの下位アドレスとCRCビットのみでパケットを転送できるため、コストを下げられる効果がある。
本発明の第1実施例を図1により説明する。本実施例は、パケットの通過を指定する下位アドレスメモリとパケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するドレステーブルを用いたパケットを転送する加入者系パケット転送システムの例である。リングのパケットのアッド・ドロップおよび通過の装置には集線装置が接続されるが、この位置にPONの光分岐装置を置いてもよい。
図1において、1は左回りリング(0系リング)、2は右回りリング(1系リング)、3は頂点装置(頂点ノード)、4はサーバ、5は特定パケット以外のパケットの通過を遮断する伝送路ポート、6−1,6−2,6−3はパケットのアッド・ドロップおよび通過の装置(ノード)、7はパケットのドロップを指定する下位アドレスメモリ、8はパケットのドロップを指定するCRCビットメモリ、9はパケットのドロップを指定するアドレステーブル、10はパケットの通過を指定する下位アドレスメモリ、11−1、11−2、11−3は集線装置、13−1,13−2,13−3は端末、20はルータである。また、(1)〜(29)はパケットである。特定パケット以外のパケットの通過を遮断する伝送路ポート5の特定パケットはOAMパケット等のパケットである。頂点装置(頂点ノード)3の左回りリング1の特定パケット以外の全パケット流は、サーバ4に転送され、サーバ4からのパケットは右回りリング2のパケット流に挿入される。
なお、パケットのドロップを指定するアドレステーブル9は従来のMACアドレステーブルと異なり、ポート番号を記憶しないアドレステーブルである。
なお、パケットのドロップを指定するアドレステーブル9は従来のMACアドレステーブルと異なり、ポート番号を記憶しないアドレステーブルである。
以下に、図1の動作を説明する。最初に、端末13−2がブロードキャストパケットをルータ20に送り、その応答パケットを端末13−2が受信後に送る送出パケット(1)Ms1s2a3a2(MはMACパケットを示し、s1s2はルータ20のMACアドレスである宛先上位MACアドレスs1と下位MACアドレスs2を示し、a3a2は端末13−2のMACアドレスである送信元上位MACアドレスa3と下位MACアドレスa2を示す)を、集線装置11−2に送る例を示す。図に示す点線の矢印は説明用の記号である。集線装置11−2はそのパケットの送信元MACアドレスを図に記してないMACアドレステーブルに記憶して、そのパケットを(2)Ms1s2a3a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−2に送る。パケットのアッド・ドロップおよび通過の装置6−2はそのパケットの送信元MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、そのパケットの送信元MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1を記憶する。図1ではパケットのアッド・ドロップおよび通過の装置6−2のパケットのドロップを指定する下位アドレスメモリ7に便宜上a2が記憶され、パケットのドロップを指定するCRCビットメモリ8に便宜上h3が記憶されていることを示している。図示したa2は、メモリをa2でアドレス指定した位置にビット1を記憶したことを示す。そのパケットは左回りリング1により(3)Ms1s2a3a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−3に向かう。
パケットのアッド・ドロップおよび通過の装置6−3は、そのパケットの送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。そのパケットは左回りリング1により(4)Ms1s2a3a2で図に示されるように頂点装置3に向かう。
頂点装置3は、そのパケットを(5)Ms1s2a3a2で図に示されるようにルータ20に向かわせる。ルータ20ではそのパケットをサーバ4に送り、応答パケットを(6)Ma3a2s1s2で図に示されるように頂点装置3の右回りリング2に送る。
そのパケットは右回りリング2により(7)Ma3a2s1s2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−3に向かう。パケットのアッド・ドロップおよび通過の装置6−3は、そのパケットの宛先MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、そのパケットの宛先MACアドレスがパケットのドロップを指定するアドレステーブル9に無いので、そのパケットを下流パケットのアッド・ドロップおよび通過の装置に送出する。そのパケットは右回りリング2により(8)Ma3a2s1s2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−2に向かう。
そのパケットは右回りリング2により(7)Ma3a2s1s2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−3に向かう。パケットのアッド・ドロップおよび通過の装置6−3は、そのパケットの宛先MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、そのパケットの宛先MACアドレスがパケットのドロップを指定するアドレステーブル9に無いので、そのパケットを下流パケットのアッド・ドロップおよび通過の装置に送出する。そのパケットは右回りリング2により(8)Ma3a2s1s2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−2に向かう。
パケットのアッド・ドロップおよび通過の装置6−2は、そのパケットの宛先MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、そのパケットの宛先MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置からCRCビット記憶有を示すビット1が読み出されるので、そのパケットをリングからドロップして、(9)Ma3a2s1s2で図に示されるように集線装置11−2に向かわせる。そのパケットは(10)Ma3a2s1s2で図に示されるように端末13−2に到達する。
次に、端末13−1がブロードキャストパケットをルータ20に送り、その応答パケットを端末13−1が受信後に送る送出パケット(11)Ms1s2a1a2(MはMACパケットを示し、s1s2はルータ20のMACアドレスである宛先上位MACアドレスs1と下位MACアドレスs2を示し、a1a2は端末13−1のMACアドレスである送信元上位MACアドレスa1と下位MACアドレスa2を示す)を、集線装置11−1に送る例を示す。集線装置11−1はそのパケットの送信元MACアドレスを図に記してないMACアドレステーブルに記憶して、そのパケットを(12)Ms1s2a1a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−1に送る。パケットのアッド・ドロップおよび通過の装置6−1はそのパケットの送信元MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、そのパケットの送信元MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1を記憶する。そのパケットは左回りリング1により(13)Ms1s2a1a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−2に向かう。
パケットのアッド・ドロップおよび通過の装置6−2は、そのパケットの送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、そのパケットの送信元アドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。そのパケットは左回りリング1により(14)Ms1s2a1a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−3に向かう。
パケットのアッド・ドロップおよび通過の装置6−3は、その到着したパケットの送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。そのパケットは左回りリング1により(15)Ms1s2a1a2で図に示されるように頂点装置3に向かう。
頂点装置3は、その到着したパケットを(16)Ms1s2a1a2で図に示されるようにルータ20に向かわせる。ルータ20はそのパケットをサーバ4に送り、応答パケットを(17)Ma1a2s1s2で図に示されるように頂点装置3の右回りリング2に送る。
そのパケットは右回りリング2により(18)Ma1a2s1s2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−3に向かう。パケットのアッド・ドロップおよび通過の装置6−3は、そのパケットの宛先MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、そのパケットの宛先MACアドレスがパケットのドロップを指定するアドレステーブル9に無いので、そのパケットを下流パケットのアッド・ドロップおよび通過の装置に送出する。そのパケットは右回りリング2により(19)Ma1a2s1s2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−2に向かう。
パケットのアッド・ドロップおよび通過の装置6−2は、そのパケットの宛先MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、そのパケットの宛先MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置からCRCビット記憶無を示すビット0が読み出され、そのパケットの宛先MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、そのパケットの宛先MACアドレスa1a2がパケットのドロップを指定するアドレステーブル9に無いので、右回りリング2によりそのパケットを(20)Ma1a2s1s2で図に示すように下流のパケットのアッド・ドロップおよび通過の装置6−1に向かわせる。
パケットのアッド・ドロップおよび通過の装置6−1は、そのパケットの宛先MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、そのパケットの宛先MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置からCRCビット記憶有を示すビット1が読み出されるので、そのパケットをリングからドロップして、(21)Ma1a2s1s2で図に示されるように集線装置11−1に向かわせる。そのパケットは(22)Ma1a2s1s2で図に示されるように端末13−1に到達する。
次に、集線装置11−2が図に記してないMACアドレステーブルにある端末13−2の送信元MACアドレスのみを持つパケット(23)M0a3a2(MはMACパケットを示し、0は宛先MACアドレスが無いことを示し、a3a2は端末13−2のMACアドレスである送信元上位MACアドレスa3と下位MACアドレスa2を示す)を、パケットのアッド・ドロップおよび通過の装置6−2に送る例を示す。この送信元MACアドレスのみを持つパケットは、パケットのアッド・ドロップおよび通過の装置6−2のメモリのタイマーが切れて、MACアドレス記憶が消失することを防ぐもので、集線装置11−2の図に記してないMACアドレステーブルのMACアドレスの記憶時間は端末のARPテーブルのMACアドレス記憶時間より長く設定する。パケットのアッド・ドロップおよび通過の装置6−2はそのパケットの送信元MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されているので、そのパケットの送信元MACアドレスa3a2をパケットのドロップを指定するアドレステーブル9に記憶する。そのパケットは左回りリング1により(24)M0a3a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−3に向かう。
パケットのアッド・ドロップおよび通過の装置6−3では、そのパケットの送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。そのパケットは左回りリング1により(25)M0a3a2で図に示されるように頂点装置3に向かう。頂点装置3では、そのパケットが送信元MACアドレスのみを持つパケットであることを識別してそのパケットを廃棄する。
なお、実施例1では、2重リング網および集線装置が局内にある場合の例である。
なお、実施例1で端末はルータでもよい。
なお、実施例1で端末はルータでもよい。
次に、本発明の第2実施例を図2により説明する。本実施例は、パケットの通過を指定する下位アドレスメモリとパケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルを用いたパケットを転送する携帯電話用リング網の例である。本実施例は、発端末がサーバまで発呼パケットを送り、サーバはそのパケットを宛先アドレスのあるコピー用パケットとして、サーバ配下の全基地局に送り、そのパケットの宛先端末が自基地局の配下の端末である場合には、その端末を呼び出し、応答がある場合には、応答パケットをサーバまで送り、サーバは発端末に発呼応答パケットを送る例である。この実施例では従来網と基地局で分離し、新携帯網を転送されるMACパケットは、従来のMACパケットのヘッダをMACアドレスから携帯番号アドレス(携帯番号全体を2進化ビット列に変換したアドレス)に変換したもので、従来網のMACヘッダと新網のMACヘッダの区別はMACアドレスの先頭バイトのLSBを第1ビットとした時、2ビット目が1であり、1ビット目が0である場合に新網のMACアドレスとし、それ以外は従来網のMACアドレスとすることで行う。新携帯網を転送されるパケットは基地局から端末まで到達するものとする。または、基地局で従来MACアドレスと新網のMACアドレスとヘッダ変換してもよい。
図2において、14−1,14−2,14−3は基地局、15−1,15−2,15−3は携帯端末、24はサーバである。また、(1)〜(19)はパケットである。他の記号は、図1と同じである。頂点装置(頂点ノード)3の左回りリング1の特定パケット以外の全パケット流は、サーバ24に転送され、サーバ24からのパケットは右回りリング2のパケット流に挿入される。
以下に、図2の動作を説明する。最初に、基地局14−2が発側携帯端末15−2からの発呼パケットをサーバ24に送り、サーバ24はそのパケットを宛先携帯端末15−1に送り、その応答パケットがサーバ24を介して発側携帯端末15−2に送られた後の携帯端末15−2から携帯端末15−1への送出パケット(1)Ma1a2a3a2(MはMACパケットを示し、a1a2は携帯端末15−1のMACアドレスである宛先上位MACアドレスa1と下位MACアドレスa2を示し、a3a2は携帯端末15−2のMACアドレスである送信元上位MACアドレスa3と下位MACアドレスa2を示す)を、パケットのアッド・ドロップおよび通過の装置6−2に送出する例を示す。前記発呼パケットは、右回りリングからパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットをコピーし、片一方のパケットはリングから接続している伝送路でリング外に向かい、もう、片方のパケットは、右回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かう。パケットのアッド・ドロップおよび通過の装置6−2は、パケット(1)Ma1a2a3a2を受信した場合に、そのパケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に、この時点で、既に、前記発呼パケットの応答パケットにより、下位アドレス記憶有を示すビット1が記憶されているので、そのパケットの送信元アドレスa3a2をパケットのドロップを指定するアドレステーブル9に記憶して、そのパケットを左回りリング1に送出する。
そのパケットは(2)Ma1a2a3a2で図に示されるように、左回りリング1によりパケットのアッド・ドロップおよび通過の装置6−3に向かう。パケットのアッド・ドロップおよび通過の装置6−3は、到着した前記パケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に、下位アドレス記憶無を示すビット0が記憶されているか、または、前記パケットの送信元MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置に、CRCビット記憶無を示すビット0が記憶されているので、前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。そのパケットは(3)Ma1a2a3a2で図に示されるように、左回りリング1により頂点装置3に向かう。頂点装置3ではそのパケットを左回りリング1からドロップして、(4)Ma1a2a3a2で図に示されるようにサーバ24に向かわせる。
サーバ24は、到着したパケットの宛先携帯端末がこのサーバ配下にあることを確認して、そのパケットを(5)Ma1a2a3a2で図に示されるように頂点装置3の右回りリングのパケット流に挿入する。
そのパケットは、(6)Ma1a2a3a2で図に示されるように右回りリング2により転送されてパケットのアッド・ドロップおよび通過の装置6−3に向かう。パケットのアッド・ドロップおよび通過の装置6−3は、そのパケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、前記パケットの宛先MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されているか、または、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブル9に記憶されていることが無く、そのパケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されているので、そのパケットを(7)Ma1a2a3a2で図に示されるように右回りリング2により転送して、パケットのアッド・ドロップおよび通過の装置6−2に向かわせる。
パケットのアッド・ドロップおよび通過の装置6−2は、そのパケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、前記パケットの宛先MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されているか、または、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブル9に記憶されていることが無く、そのパケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されているので、そのパケットを(8)Ma1a2a3a2で図に示されるように右回りリング2により転送して、パケットのアッド・ドロップおよび通過の装置6−1に向かわせる。
パケットのアッド・ドロップおよび通過の装置6−1は、そのパケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの宛先MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置からCRCビット記憶有を示すビット1が読み出されるので、そのパケットをリングからドロップして、(9)Ma1a2a3a2で図に示されるように基地局14−1に向かわせる。
基地局14−1はパケットMa1a2a3a2の宛先携帯端末がこの基地局の配下の携帯端末であることを確認して、そのパケットを携帯端末15−1に送出する。携帯端末15−1は、前記パケットが自携帯端末宛てのパケットであることを確認して、応答パケットMa3a2a1a2を基地局14−1に送出する。携帯端末15−1は周期的に音声パケットを送出する。
そのパケットは(10)Ma3a2a1a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−1に送られ、そのパケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出され、かつ、前記発呼パケットの応答パケットにより、前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に、下位アドレス記憶有を示すビット1が記憶されており、かつ、前記パケットの送信元MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されているので、そのパケットをそのまま、左回りリング1に送出する。
前記パケットは左回りリング1により(11)Ma3a2a1a2で図に示されるように転送されて、パケットのアッド・ドロップおよび通過の装置6−2に向かう。パケットのアッド・ドロップおよび通過の装置6−2は、前記パケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶無を示すビット0が読み出されるので、前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。
そのパケットは(12)Ma3a2a1a2で図に示されるように、左回りリング1によりパケットのアッド・ドロップおよび通過の装置6−3に向かう。パケットのアッド・ドロップおよび通過の装置6−3は、到着した前記パケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されていないので、送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。そのパケットは(13)Ma3a2a1a2で図に示されるように、左回りリング1により頂点装置3に向かう。頂点装置3ではそのパケットを左回りリング1からドロップして、(14)Ma3a2a1a2で図に示されるようにサーバ24に向かわせる。
サーバ24は、そのパケットの宛先携帯端末がこのサーバ配下にあることを確認して、そのパケットを(15)Ma3a2a1a2で図に示されるように頂点装置3の右回りリングのパケット流に挿入する。
そのパケットは、(16)Ma3a2a1a2で図に示されるように右回りリング2により転送されてパケットのアッド・ドロップおよび通過の装置6−3に向かう。パケットのアッド・ドロップおよび通過の装置6−3は、そのパケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、前記パケットの宛先MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されているか、または、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブル9に記憶されていることが無く、そのパケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されているので、そのパケットを右回りリング2によりパケットのアッド・ドロップおよび通過の装置6−2に向かわせる。
そのパケットは、(17)Ma3a2a1a2で図に示されるように右回りリング2により転送されてパケットのアッド・ドロップおよび通過の装置6−2に到着する。パケットのアッド・ドロップおよび通過の装置6−2は、そのパケットの宛先MACアドレスa3a2がパケットのドロップを指定するアドレステーブル9に記憶されてるので、前記パケットをリングからドロップして、(18)Ma3a2a1a2で図に示されるように基地局14−2に向かわせる。
基地局14−2はパケットMa3a2a1a2の宛先携帯端末がこの基地局の配下の携帯端末であることを確認して、そのパケットを携帯端末15−2に送出する。携帯端末15−2は、前記パケットが自携帯端末宛てのパケットであることを確認して、応答パケットMa1a2a3a2を基地局14−2に送出する。携帯端末15−2は周期的に音声パケットを送出する。
基地局14−2はそのパケットを(19)Ma1a2a3a2で図に示されるように、パケットのアッド・ドロップおよび通過の装置6−2に送出する。パケットのアッド・ドロップおよび通過の装置6−2はそのパケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットの通過を指定する下位アドレス記憶アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されているので、前記パケットの送信元MACアドレス全体a3a2をパケットのドロップを指定するアドレステーブル9に記憶して、そのパケットを左回りリング1に送出する。
そのパケットは、2重リング網を転送されて、携帯端末15−1に到達する。
なお、携帯端末15−1が基地局14−2の配下に移動した場合には、携帯端末15−1からのパケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた前記下位アドレスa2でパケットのアッド・ドロップおよび通過の装置6−2のパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されているので、パケットのアッド・ドロップおよび通過の装置6−2のパケットのドロップを指定するアドレステーブル9に携帯端末15−1の送信元MACアドレスa1a2を記憶すればよい。また、携帯端末15−2が基地局14−1の配下に移動した場合には、パケットのアッド・ドロップおよび通過の装置6−1のパケットのドロップを指定する下位アドレスメモリ7を携帯端末15−2からのパケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でアドレス指定した位置に、下位アドレス記憶有を示すビット1が記憶されており、パケットのドロップを指定するCRCビットメモリ8を携帯端末15−2からのパケットの送信元アドレスのCRCビットh3でアドレス指定した位置からCRCビット記憶無を示すビット0が読み出されるので、そのパケットの送信元MACアドレスをパケットのドロップを指定するアドレステーブル9に記憶し、パケットのアッド・ドロップおよび通過の装置6−2のパケットのドロップを指定するアドレステーブル9の記憶アドレスa3a2を消去して、携帯端末15−2からのパケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた前記下位アドレスa2でパケットのアッド・ドロップおよび通過の装置6−2のパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置からCRCビット記憶有を示すビット1が読み出されるので、前記パケットの送信元MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶無を示すビット0を書き込んで(h3を消去して)、パケットの通過を指定する下位アドレスメモリ10を前記下位アドレスa2でアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すればよい。
なお、実施例2ではリング網が広範囲に存在する例を示したが、リング網は、局内にあり、その局から伝送路が放射状に基地局に伸びている構成にしてもよい。
本発明の第3実施例を図3により説明する。本実施例は、パケットの通過を指定する下位アドレスメモリとパケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとメールサーバを用いたパケットを転送する携帯端末用リング網の例である。本実施例は、携帯端末がメールサーバにパケットを送り、メールサーバが応答パケットを携帯端末に送る例である。
図3において、16はメールサーバである。また、(1)〜(19)はパケットである。他の記号は、上記実施例と同じである。頂点装置(頂点ノード)3の左回りリング1の特定パケット以外の全パケット流は、メールサーバ16に転送され、メールサーバ16からのパケットは右回りリング2のパケット流に挿入される。
以下に、図3の動作を説明する。携帯端末15−2がパケットMs1s2a3a2(MはMACパケットを示し、s1s2はメールサーバ16のMACアドレスである宛先上位MACアドレスs1と下位MACアドレスs2であり、a3a2は携帯端末15−2の送信元上位MACアドレスa3と下位MACアドレスa2である)を基地局14−2に送出する。
そのパケットは、(1)Ms1s2a3a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−2に到着する。パケットのアッド・ドロップおよび通過の装置6−2は、そのパケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した場合に下位アドレス記憶無を示すビット0が読み出され、かつ、前記パケットの送信元MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置からCRCビット記憶無を示すビット0が読み出され、パケットのドロップを指定するアドレステーブル9にそのパケットの送信元MACアドレス全体が、この時点で記憶されていないので、前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1を記憶して、そのパケットを左回りリング1に送出する。
そのパケットは(2)Ms1s2a3a2で図に示されるように、左回りリング1によりパケットのアッド・ドロップおよび通過の装置6−3に向かう。パケットのアッド・ドロップおよび通過の装置6−3は、到着した前記パケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置から、この時点で下位アドレス記憶無を示すビット0が読み出され、前記パケットの送信元MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置から、この時点で、CRCビット記憶無を示すビット0が読み出されるので、前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。そのパケットは(3)Ms1s2a3a2で図に示されるように、左回りリング1により転送されて頂点装置3に向かう。頂点装置3はそのパケットを左回りリングからドロップして、(4)Ms1s2a3a2で図に示されるようにメールサーバ16に向かわせる。
メールサーバ16は、そのパケットの送信元携帯端末がこのサーバ配下にあることを確認して、そのパケットの応答パケットを(5)Ma3a2s1s2で図に示されるように頂点装置3の右回りリングのパケット流に挿入する。
そのパケットは、(6)Ma3a2s1s2で図に示されるように右回りリング2により転送されてパケットのアッド・ドロップおよび通過の装置6−3に向かう。パケットのアッド・ドロップおよび通過の装置6−3は、そのパケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出され、かつ、前記パケットの宛先MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置からCRCビット記憶無を示すビット0が読み出され、かつ、前記下位アドレスでパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、前記パケットの宛先MACアドレス全体がパケットのドロップを指定するアドレステーブル9に無いので、そのパケットを(7)Ma3a2s1s2で図に示されるように、右回りリング2により転送して、パケットのアッド・ドロップおよび通過の装置6−2に向かわせる。
パケットのアッド・ドロップおよび通過の装置6−2は、到着したそのパケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、前記パケットの宛先MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されているので、そのパケットをリングからドロップして、(8)Ma3a2s1s2で図に示すように基地局14−2に向かわせる。
基地局14−2はパケットMa3a2s1s2の宛先携帯端末がこの基地局の配下の携帯端末であることを確認して、そのパケットを携帯端末15−2に送出する。
次に、携帯端末15−1がパケットMs1s2a1a2(MはMACパケットを示し、s1s2はメールサーバ16のMACアドレスである宛先上位MACアドレスs1と下位MACアドレスs2であり、a1a2は携帯端末15−1の送信元上位MACアドレスa1と下位MACアドレスa2である)を基地局14−1に送出する。
そのパケットは、(9)Ms1s2a1a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−1に到着する。パケットのアッド・ドロップおよび通過の装置6−1は、そのパケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10を、この時点でアドレス指定した場合に下位アドレス記憶無を示すビット0が読みだされ、かつ、前記パケットの送信元アMACドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶無を示すビット0が読み出され、かつ、パケットのドロップを指定するアドレステーブル9にそのパケットの送信元アドレス全体が記憶されていないので、前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1を記憶して、そのパケットを左回りリング1に送出する。
そのパケットは(10)Ms1s2a1a2で図に示されるように、左回りリング1によりパケットのアッド・ドロップおよび通過の装置6−2に向かう。パケットのアッド・ドロップおよび通過の装置6−2は、到着した前記パケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されおり、前記パケットの送信元アドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置からCRCビット記憶無を示すビット0が読み出されるので、前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。そのパケットは(11)Ms1s2a1a2で図に示されるように、左回りリング1によりパケットのアッド・ドロップおよび通過の装置6−3に向かう。
パケットのアッド・ドロップおよび通過の装置6−3は、到着した前記パケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出され、前記パケットの送信元MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置からCRCビット記憶無を示すビット0が読み出されるので、前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。そのパケットは(12)Ms1s2a1a2で図に示されるように、左回りリング1により頂点装置3に向かう。頂点装置3はそのパケットを左回りリング1からドロップして、(13)Ms1s2a1a2で図に示されるようにメールサーバ16に向かわせる。
メールサーバ16は、そのパケットの送信元携帯端末がこのサーバ配下にあることを確認して、そのパケットの応答パケットを(14)Ma1a2s1s2で図に示されるように頂点装置3の右回りリング2に送出する。
そのパケットは、(15)Ma1a2s1s2で図に示されるように右回りリング2により転送されてパケットのアッド・ドロップおよび通過の装置6−3に向かう。パケットのアッド・ドロップおよび通過の装置6−3は、そのパケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出され、かつ、前記パケットの宛先MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置からCRCビット記憶無を示すビット0が読み出され、かつ、前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、前記パケットの宛先MACアドレス全体がパケットのドロップを指定するアドレステーブル9に無いので、そのパケットを(16)Ma1a2s1s2で図に示されるように、右回りリング2により転送して、パケットのアッド・ドロップおよび通過の装置6−2に向かわせる。
パケットのアッド・ドロップおよび通過の装置6−2は、到着したそのパケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、前記パケットの宛先MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置からCRCビット記憶無を示すビット0が読み出され、かつ、前記下位アドレスでパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、パケットのドロップを指定するアドレステーブル9に前記パケットの宛先MACアドレス全体a1a2が記憶されていないので、そのパケットを(17)Ma1a2s1s2で図に示されるように右回りリング2により転送して、パケットのアッド・ドロップおよび通過の装置6−1に向かわせる。
パケットのアッド・ドロップおよび通過の装置6−1は、到着したそのパケットMa1a2s1s2の宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、前記パケットの宛先MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されているので、そのパケットをリングからドロップして、(18)Ma1a2s1s2で図に示すように基地局14−1に向かわせる。
基地局14−1はパケットMa1a2s1s2の宛先携帯端末がこの基地局の配下の携帯端末であることを確認して、そのパケットを携帯端末15−1に送出する。
次に、携帯端末15−2がパケットMs1s2a3a2を基地局14−2に送出する。そのパケットは、(19)Ms1s2a3a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−2に到着する。パケットのアッド・ドロップおよび通過の装置6−2は、そのパケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されているので、パケットのドロップを指定するアドレステーブル9に前記パケットの送信元アドレス全体a3a2を記憶して、そのパケットを左回りリング1に送出する。
なお、実施例3ではリング網が広範囲に存在する例を示したが、リング網は、局内にあり、その局から伝送路が放射状に基地局に伸びている構成にしてもよい。
本発明の第4実施例を図4により説明する。本実施例は、パケットの通過を指定する下位アドレスメモリとパケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとL2スイッチを用いたパケットを転送するLANまたはMANに用いるリング網の例である。
図4において、17は頂点装置、18は左回りリングのパケット流を右回りリングに折り返す経路、21−1、21−2,21−3はL2スイッチ、13−4,13−5,13−6,13−7は端末、23はサーバである。また、(1)〜(24)はパケットである。他の記号は、上記実施例と同じである。
以下に、図4の動作を説明する。最初に、端末13−5が、サーバ23にパケットを送るために、パケットのアッド・ドロップおよび通過の装置6−2のパケットのドロップを指定する下位アドレスメモリ7を端末13−5の送信元MACアドレスの下位アドレスa2でアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶し、パケットのドロップを指定するCRCビットメモリ8を端末13−5の送信元MACアドレスのCRCビットh1でアドレス指定した位置にCRCビット記憶有を示すビット1を記憶したものとする。次に、端末13−4がブロードキャストパケット(1)MBa3a2(MはMACパケットを示し、Bはブロードキャストアドレスを示し、a3a2は端末13−4のMACアドレスである送信元上位MACアドレスa3と下位アドレスa2を示す)を、パケットのアッド・ドロップおよび通過の装置6−2に送る例を示す。図に示す点線の矢印は説明用の記号である。パケットのアッド・ドロップおよび通過の装置6−2は、リング外から到着したパケットの送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、そのパケットの送信元MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスa3a2をパケットのドロップを指定するアドレステーブル9に記憶して、そのパケットを左回りリング1により(2)MBa3a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−3に向かわせる。
パケットのアッド・ドロップおよび通過の装置6−3は、左回りリングから到着したパケットMBa3a2の送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。そのパケットは左回りリング1により(3)MBa3a2で図に示されるように頂点装置17に向かう。
頂点装置17は、左回りリングから到着したパケットMBa3a2の送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。そのパケットは左回りリングにより頂点装置17の左回りリングのパケット流を右回りリングに折り返す経路18に向かう。
頂点装置17の左回りリングのパケット流を右回りリングに折り返す経路18は、そのパケットを右回りリングに折り返す。頂点装置17は、折り返したそのパケットがブロードキャストパケットであることを確認後、そのパケットをコピーして、片一方のパケットは、L2スイッチ21−3に送出し、もう、片方のパケットは、下流のパケットのアッド・ドロップおよび通過の装置に送出する。そのパケットは右回りリング2により(5)MBa3a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−3に向かう。
パケットのアッド・ドロップおよび通過の装置6−3は、右回りリング2から到着したパケットがブロードキャストパケットであることを確認後、そのパケットをコピーして、片一方のパケットは、L2スイッチ21−2に送出し、もう、片方のパケットは、下流のパケットのアッド・ドロップおよび通過の装置に送出する。そのパケットは右回りリング2により(7)MBa3a2(I2)で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−2に向かう。
パケットのアッド・ドロップおよび通過の装置6−2は、右回りリングから到着したパケットMBa3a2がブロードキャストパケットであることを確認後、そのパケットの送信元MACアドレスがパケットのドロップを指定するアドレステーブルにあるので、そのパケットをそのまま、下流パケットのアッド・ドロップおよび通過の装置に送出する。そのパケットは(8)MBa3a2で図に示されるように右回りリング2によりパケットのアッド・ドロップおよび通過の装置6−1に向かう。
パケットのアッド・ドロップおよび通過の装置6−1は、右回りリングから到着したパケットMBa3a2がブロードキャストパケットであることを確認後、そのパケットの送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、そのパケットの送信元MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置からCRCビット記憶有を示すビット1が読み出されることが無く、かつ、そのパケットの送信元MACアドレスがパケットのドロップを指定するアドレステーブル9にないので、そのパケットをコピーして、片一方のパケットは、ルータ20に送出し、もう、片方のパケットは、下流のパケットのアッド・ドロップおよび通過の装置に送出する。そのパケットは右回りリング2により(10)MBa3a2(I2)で図に示されるように頂点装置17に向かい、頂点装置17の入口で廃棄される。
ルータ20は、リングから到着したパケットMBa3a2(I2)の宛先IPアドレスが自装置宛てであることを確認後、応答パケットMa3a2a1a2(MはMACパケットを示し、a3a2は宛先端末13−4のMACアドレスである宛先上位MACアドレスa3と下位MACアドレスa2を示し、a1a2はルータ20のMACアドレスである送信元上位MACアドレスa1と下位MACアドレスa2を示す)を、パケットのアッド・ドロップおよび通過の装置6−1に送出する。
パケットのアッド・ドロップおよび通過の装置6−1は、リング外から到着したパケットMa3a2a1a2の送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されておらず、かつ、そのパケットの送信元MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、そのパケットの送信元MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1を記憶して、そのパケットを左回りリング1により(12)Ma3a2a1a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−2に向かわせる。
パケットのアッド・ドロップおよび通過の装置6−2は、左回りリングから到着したパケットMa3a2a1a2の送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、送信元MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されているので、送信元MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶無を示すビット0を書き込んで、そのパケットの送信元MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。図4のパケットのアッド・ドロップおよび通過の装置6−2のパケットのドロップを指定するCRCビットメモリ8の横線の入れられたh1は消去されたことを示している。そのパケットは左回りリング1により(13)Ma3a2a1a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−3に向かう。
パケットのアッド・ドロップおよび通過の装置6−3は、左回りリングから到着したパケットMa3a2a1a2の送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されていないので、パケットの送信元MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。そのパケットは左回りリング1により(14)Ma3a2a1a2で図に示されるように頂点装置17に向かう。
頂点装置17は、左回りリングから到着したパケットMa3a2a1a2の送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶する。そのパケットは左回りリングにより頂点装置17の左回りリングのパケット流を右回りリングに折り返す経路18に向かう。
頂点装置17の左回りリングのパケット流を右回りリングに折り返す経路18は、そのパケットを右回りリングに折り返す。頂点装置17は、折り返したそのパケットの宛先MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されておらず、かつ、宛先MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されておらず、かつ、宛先MACアドレスがパケットのドロップを指定するアドレステーブル9に記憶されておらず、かつ、パケットの宛先MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されているので、そのパケットを右回りリング2に送出する。そのパケットは右回りリング2により(15)Ma3a2a1a2で図に示されるように転送されてパケットのアッド・ドロップおよび通過の装置6−3に向かう。
パケットのアッド・ドロップおよび通過の装置6−3は、右回りリング2から到着したパケットの宛先MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されておらず、かつ、宛先MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されておらず、かつ、宛先MACアドレスがパケットのドロップを指定するアドレステーブル9に記憶されておらず、かつ、パケットの宛先MACアドレスの下位アドレスa2でパケットの通過を指定する下位アドレスメモリ10をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されているので、そのパケットを右回りリング2に送出する。そのパケットは右回りリング2により(16)Ma3a2a1a2で図に示されるように転送されてパケットのアッド・ドロップおよび通過の装置6−2に向かう。
パケットのアッド・ドロップおよび通過の装置6−2は、右回りリングから到着したパケットの宛先MACアドレスa3a2がパケットのドロップを指定するアドレステーブルに記憶されているので、そのパケットをリングからドロップして、(17)Ma3a2a1a2で図に示されるようにL2スイッチ21−1に向かわせる。
L2スイッチ21−1は、リング外から到着したパケットMa3a2a1a2の宛先MACアドレスa3a2がMACアドレステーブルにあるので、その位置に記憶されているポートにそのパケットを送出する。送出されたパケットは端末13−4に到着する。端末13−4は、ルータ20からのパケットを受信後、サーバ23宛ての宛先IPアドレスI5を持つパケット(18)Ma1a2a3a2(I5)をルータ20経由でサーバ23に送出する。
一方、端末13−5は、サーバ23にパケットを送る場合に、パケットのアッド・ドロップおよび通過の装置6−2のパケットのドロップを指定する下位アドレスメモリ7を端末13−5の送信元MACアドレスの下位アドレスa2でアドレス指定した場合に、下位アドレス記憶有を示すビット1が記憶されており、パケットのドロップを指定するCRCビットメモリ8を端末13−5の送信元MACアドレスのCRCビットh1でアドレス指定した場合に、CRCビット記憶有を示すビット1が記憶されていないので、端末13−5から送られたパケットの送信元MACアドレスa4a2をパケットドロップを指定するアドレステーブル9に記憶する。
本発明の第5実施例を図5により説明する。本実施例は、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定するアドレステーブルとコンテンツサーバを用いたパケットを転送する携帯端末用リング網の例である。本実施例は、携帯端末がコンテンツサーバにパケットを送り、コンテンツサーバが応答パケットを携帯端末に送る例である。
図5において、22はコンテンツサーバ、122はパケットのドロップを指定する下位アドレスメモリ7のみでパケットドロップする制限時間付アドレスを記憶するパケットの通過を指定するアドレステーブル、15−4,15−5,15−6,15−7は携帯端末である。また、(1)〜(19)はパケットである。他の記号は、上記実施例と同じである。
以下に、図5の動作を説明する。最初に、携帯端末15−6がパケットMs1s2a4a2(MはMACパケットを示し、s1s2はコンテンツサーバ22のMACアドレスである宛先上位MACアドレスs1と下位MACアドレスs2を示し、a4a2は携帯端末15−6の送信元上位MACアドレスa4と下位MACアドレスa2を示す)を基地局14−2を介してコンテンツサーバ22に送出し、それにより、パケットのアッド・ドロップおよび通過の装置6−2のパケットのドロップを指定する下位アドレスメモリ7を、そのパケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶され、パケットのドロップを指定するCRCビットメモリ8を、前記パケットの送信元MACアドレスのCRCビットh3でアドレス指定した位置にCRCビット記憶有を示すビット1が記憶される。次に、携帯端末15−5がパケットMs1s2a3a2(MはMACパケットを示し、s1s2はコンテンツサーバ22のMACアドレスである宛先上位MACアドレスs1と下位MACアドレスs2を示し、a3a2は携帯端末15−5の送信元上位MACアドレスa3と下位MACアドレスa2を示す)を基地局14−2に送出する例を示す。
そのパケットは、(1)Ms1s2a3a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−2に到着する。パケットのアッド・ドロップおよび通過の装置6−2は、そのパケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、前記パケットの送信元MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されているので、そのまま、そのパケットを左回りリング1に送出する。
そのパケットは(2)Ms1s2a3a2で図に示されるように、左回りリング1によりパケットのアッド・ドロップおよび通過の装置6−3に向かう。パケットのアッド・ドロップおよび通過の装置6−3は、左回りリング1から到着した前記パケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に、この時点で下位アドレス記憶有を示すビット1が記憶されていないので、そのパケットを、そのまま、(3)Ms1s2a3a2で図に示されるように、左回りリング1により頂点装置3に向かわせる。頂点装置3は、そのパケットを左回りリング1からドロップして、(4)Ms1s2a3a2で図に示されるようにコンテンツサーバ22に向かわせる。
コンテンツサーバ22は、そのパケットの送信元携帯端末がこのサーバ配下にあることを確認して、そのパケットの応答パケットを(5)Ma3a2s1s2で図に示されるように頂点装置3の右回りリング2に送出する。
そのパケットは、(6)Ma3a2s1s2で図に示されるように右回りリング2により転送されてパケットのアッド・ドロップおよび通過の装置6−3に向かう。パケットのアッド・ドロップおよび通過の装置6−3は、右回りリングから到着した前記パケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されておらず、かつ、前記パケットの宛先MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されておらず、かつ、パケットのドロップを指定するアドレステーブルに前記パケットの宛先MACアドレスが記憶されていないので、そのパケットを(7)Ma3a2s1s2で図に示されるように、右回りリング2により転送して、パケットのアッド・ドロップおよび通過の装置6−2に向かわせる。
パケットのアッド・ドロップおよび通過の装置6−2は、右回りリングから到着したそのパケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、前記パケットの宛先MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されているので、そのパケットをリングからドロップして、(8)Ma3a2s1s2で図に示すように基地局14−2に向かわせる。
基地局14−2はパケットMa3a2s1s2の宛先携帯端末がこの基地局の配下の携帯端末であることを確認して、そのパケットを携帯端末15−5に送出する。
次に、携帯端末15−4がパケットMs1s2a1a2(MはMACパケットを示し、s1s2はコンテンツサーバ22のMACアドレスである宛先上位MACアドレスs1と下位MACアドレスs2を示し、a1a2は携帯端末15−4の送信元上位MACアドレスa1と下位MACアドレスa2を示す)を基地局14−1に送出する。
そのパケットは、(9)Ms1s2a1a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−1に到着する。パケットのアッド・ドロップおよび通過の装置6−1は、そのパケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されておらず、かつ、前記パケットの送信元MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶するとと共に、前記パケットの送信元MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶して、そのパケットを左回りリング1に送出する。
そのパケットは(10)Ms1s2a1a2で図に示されるように、左回りリング1によりパケットのアッド・ドロップおよび通過の装置6−2に向かう。パケットのアッド・ドロップおよび通過の装置6−2は、左回りリング1から到着した前記パケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、前記パケットの送信元MACアドレスのCRCビットh1でパケットのドロップのCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されていないので、そのパケットを、そのまま、(11)Ms1s2a1a2で図に示されるように、左回りリング1に送出する。以下の動作は、上記携帯端末15−5がコンテンツサーバ22にパケットを送出した場合と同じなので説明を省略する。
次に、携帯端末15−5が、基地局14−2の配下から基地局14−1の配下に移動した場合の例の動作を説明する。移動した携帯端末15−5からのパケットMs1s2a3a2が基地局14−1を介して、パケットのアッド・ドロップおよび通過の装置6−1に到着した場合に、パケットのアッド・ドロップおよび通過の装置6−1は、そのパケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、前記パケットの送信元MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスa3a2をパケットのドロップを指定するアドレステーブル9に記憶して、そのパケットを左回りリング1に送出する。
そのパケットは左回りリング1によりパケットのアッド・ドロップおよび通過の装置6−2に向かう。パケットのアッド・ドロップおよび通過の装置6−2は、左回りリング1から到着した前記パケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、前記パケットの送信元MACアドレスのCRCビットh3でパケットのドロップのCRCビットメモリ120をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されているので、前記パケットの送信元MACアドレスのCRCビットh3でパケットのドロップのCRCビットメモリ8をアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、パケットのドロップを指定する下位アドレスメモリ7のみでパケットドロップする制限時間付アドレスを記憶するパケットの通過を指定するアドレステーブル122に、前記パケットの制限時間付送信元MACアドレスa3a2を記憶すると共に、パケットドロップ許可タイマーをセットする。
次に、携帯端末15−6が、コンテンツサーバ22に送出したパケットの応答パケットMa4a2s1s2を、パケットのアッド・ドロップおよび通過の装置6−2経由で、基地局14−2から受信する場合の例を示す。パケットのアッド・ドロップおよび通過の装置6−2は、右回りリングからパケットMa4a2s1s2を受信した場合に、前記パケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、前記パケットの送信元MACアドレスのCRCビットh3でパケットのドロップのCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されておらず、そのパケットの宛先MACアドレスa4a2がその時点でパケットのドロップを指定するアドレステーブル9に無く、パケットのドロップを指定する下位アドレスメモリ7のみでパケットドロップする制限時間付アドレスを記憶するパケットの通過を指定するアドレステーブル122にそのパケットの宛先MACアドレスが無く、パケットドロップ許可タイマーがタイムアウトしていない場合には、前記パケットをリングからドロップして、基地局14−2に送る。ちなみに、パケットドロップ許可タイマーがタイムアウトしている場合には、パケットの宛先MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、パケットの送信元MACアドレスのCRCビットでパケットのドロップのCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されているか、またはパケットの宛先MACアドレスがパケットのドロップを指定するアドレステーブル9にある場合には、到着したパケットをリング外にドロップし、それ以外は右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出する。パケットのドロップを指定する下位アドレスメモリ7のみでパケットドロップする制限時間付アドレスを記憶するパケットの通過を指定するアドレステーブル122に記憶されている送信元MACアドレスa3a2は制限時間後に消去される。
次に、携帯端末15−6が、前のパケットの送出の後、パケット(19)Ms1s2a4a2を基地局14−2を介して、パケットのアッド・ドロップおよび通過の装置6−2に送出した場合の動作を示す。パケットのアッド・ドロップおよび通過の装置6−2は、リング外から到着した前記パケットの送信元MACアドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、前記パケットの送信元MACアドレスのCRCビットh3でパケットのドロップのCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されていないので、前記パケットの送信元MACアドレスa4a2をパケットのドロップを指定するアドレステーブル9に記憶する。
なお、実施例5ではリング網が広範囲に存在する例を示したが、リング網は、局内にあり、その局から伝送路が放射状に基地局に伸びている構成にしてもよい。
なお、実施例5で、携帯端末が移動してない場合の、誤一致でパケットのドロップを指定するCRCビットメモリの記憶アドレスを消去する確率は以下のようになる。
パケットのアッド・ドロップおよび通過の装置にリング外から到着するパケットの端末数を10000、リング上を流れるパケットの端末数を100000、パケットのドロップを指定する下位アドレスメモリおよびパケットのドロップを指定するCRCビットメモリの記憶アドレスビット数を24ビットとした場合、100000/(2の24乗)*100000/(2の24乗)*20000=0.7となる。これは、メモリのビット数に対して、パケットの端末数が少ない場合に成り立つもので、多い場合には、パケットのドロップを指定する下位アドレスメモリおよびパケットのドロップを指定するCRCビットメモリの記憶アドレスが重なる確率が増加するので上記計算は成立しない。
また、パケットの送信元アドレスの下位アドレスでパケットのドロップを指定する下位アドレスメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリをアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されていない場合、または、パケットの送信元アドレスの下位アドレスでパケットのドロップを指定する下位アドレスメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されておらず、パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリをアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されている場合に、パケットのドロップを指定するアドレステーブルにパケットの送信元アドレスを記憶する確率は、10000/(2の24乗)*2=0.001となる。
パケットのアッド・ドロップおよび通過の装置にリング外から到着するパケットの端末数を10000、リング上を流れるパケットの端末数を100000、パケットのドロップを指定する下位アドレスメモリおよびパケットのドロップを指定するCRCビットメモリの記憶アドレスビット数を24ビットとした場合、100000/(2の24乗)*100000/(2の24乗)*20000=0.7となる。これは、メモリのビット数に対して、パケットの端末数が少ない場合に成り立つもので、多い場合には、パケットのドロップを指定する下位アドレスメモリおよびパケットのドロップを指定するCRCビットメモリの記憶アドレスが重なる確率が増加するので上記計算は成立しない。
また、パケットの送信元アドレスの下位アドレスでパケットのドロップを指定する下位アドレスメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリをアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されていない場合、または、パケットの送信元アドレスの下位アドレスでパケットのドロップを指定する下位アドレスメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されておらず、パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリをアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されている場合に、パケットのドロップを指定するアドレステーブルにパケットの送信元アドレスを記憶する確率は、10000/(2の24乗)*2=0.001となる。
本発明の第6実施例を図6により説明する。本実施例は、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとL2スイッチを用いたパケットを転送するLANまたはMANに用いるリング網の例である。
図6において、図に用いた記号は上記実施例と同じである。
以下に、図6の動作を説明する。最初に、端末13−5が、サーバ23にパケットを送るために、パケットのアッド・ドロップおよび通過の装置6−2のパケットのドロップを指定する下位アドレスメモリ7を端末13−5の送信元MACアドレスa8a2の下位アドレスa2でアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶し、パケットのドロップを指定するCRCビットメモリ8を端末13−5の送信元MACアドレスa8a2のCRCビットh1でアドレス指定した位置にCRCビット記憶有を示すビット1を記憶したものとする。次に、端末13−4がブロードキャストパケット(1)MBa3a2(MはMACパケットを示し、Bはブロードキャストアドレスを示し、a3a2は端末13−4のMACアドレスである送信元上位MACアドレスa3と下位アドレスa2を示す)を、パケットのアッド・ドロップおよび通過の装置6−2に送る例を示す。図に示す点線の矢印は説明用の記号である。パケットのアッド・ドロップおよび通過の装置6−2は、リング外から到着したパケットの送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、そのパケットの送信元MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスa3a2をパケットのドロップを指定するアドレステーブル9に記憶して、そのパケットを左回りリング1により(2)MBa3a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−3に向かわせる。
パケットのアッド・ドロップおよび通過の装置6−3は、左回りリングから到着したパケットMBa3a2の送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されていないので、そのパケットをそのまま、左回りリング1により(3)MBa3a2で図に示されるように頂点装置17に向かわせる。
頂点装置17は、左回りリングから到着したパケットMBa3a2の送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されていないので、そのパケットをそのまま、左回りリングにより頂点装置17の左回りリングのパケット流を右回りリングに折り返す経路18に向かわせる。
頂点装置17の左回りリングのパケット流を右回りリングに折り返す経路18は、そのパケットを右回りリングに折り返す。頂点装置17は、折り返したそのパケットがブロードキャストパケットであることを確認後、そのパケットをコピーして、片一方のパケットは、L2スイッチ21−3に送出し、もう、片方のパケットは、下流のパケットのアッド・ドロップおよび通過の装置に送出する。そのパケットは右回りリング2により(5)MBa3a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−3に向かう。
パケットのアッド・ドロップおよび通過の装置6−3は、右回りリング2から到着したパケットがブロードキャストパケットであることを確認後、そのパケットをコピーして、片一方のパケットは、L2スイッチ21−2に送出し、もう、片方のパケットは、下流のパケットのアッド・ドロップおよび通過の装置に送出する。そのパケットは右回りリング2により(7)MBa3a2(I2)で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−2に向かう。
パケットのアッド・ドロップおよび通過の装置6−2は、右回りリングから到着したパケットMBa3a2がブロードキャストパケットであることを確認後、そのパケットの送信元MACアドレスがパケットのドロップを指定アドレステーブル9にあるので、そのパケットをそのまま、下流パケットのアッド・ドロップおよび通過の装置に送出する。そのパケットは(8)MBa3a2で図に示されるように右回りリング2によりパケットのアッド・ドロップおよび通過の装置6−1に向かう。
パケットのアッド・ドロップおよび通過の装置6−1は、右回りリングから到着したパケットMBa3a2がブロードキャストパケットであることを確認後、そのパケットの送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、そのパケットの送信元MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置からCRCビット記憶有を示すビット1が読み出されることが無く、かつ、そのパケットの送信元MACアドレスがパケットのドロップを指定するアドレステーブル9にないので、そのパケットをコピーして、片一方のパケットは、ルータ20に送出し、もう、片方のパケットは、下流のパケットのアッド・ドロップおよび通過の装置に送出する。そのパケットは右回りリング2により(10)MBa3a2(I2)で図に示されるように頂点装置17に向かい、頂点装置17の入口で廃棄される。
ルータ20は、リングから到着したパケットMBa3a2(I2)の宛先IPアドレスI2が自装置宛てであることを確認後、応答パケットMa3a2a1a2(MはMACパケットを示し、a3a2は宛先端末13−4のMACアドレスである宛先上位MACアドレスa3と下位アドレスa2を示し、a1a2はルータ20のMACアドレスである送信元上位MACアドレスa1と下位MACアドレスa2を示す)を、パケットのアッド・ドロップおよび通過の装置6−1に転送する。
パケットのアッド・ドロップおよび通過の装置6−1は、リング外から到着したパケットMa3a2a1a2の送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されておらず、かつ、そのパケットの送信元MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されていないので、そのパケットの送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、そのパケットの送信元MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1を記憶して、そのパケットを左回りリング1により(12)Ma3a2a1a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−2に向かわせる。
パケットのアッド・ドロップおよび通過の装置6−2は、左回りリングから到着したパケットMa3a2a1a2の送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されており、かつ、送信元MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されているので、送信元MACアドレスのCRCビットh1でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶無を示すビット0を書き込む。図7のパケットのアッド・ドロップおよび通過の装置6−2のパケットのドロップを指定するCRCビットメモリ8の横線の入れられたh1は消去されたことを示している。そのパケットは左回りリング1により(13)Ma3a2a1a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−3に向かう。
パケットのアッド・ドロップおよび通過の装置6−3は、左回りリングから到着したパケットMa3a2a1a2の送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されていないので、そのパケットをそのまま、左回りリング1により(14)Ma3a2a1a2で図に示されるように頂点装置17に向かわせる。
頂点装置17は、左回りリングから到着したパケットMa3a2a1a2の送信元MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレス記憶メモり7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されていないので、そのパケットをそのまま、左回りリングにより頂点装置17の左回りリングのパケット流を右回りリングに折り返す経路18に向かわせる。
頂点装置17の左回りリングのパケット流を右回りリングに折り返す経路18は、そのパケットを右回りリングに折り返す。頂点装置17は、折り返したそのパケットの宛先MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されておらず、かつ、宛先MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されておらず、かつ、宛先MACアドレスがパケットのドロップを指定するアドレステーブル9に記憶されていないので、そのパケットを右回りリング2に送出する。そのパケットは右回りリング2により(15)Ma3a2a1a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−3に向かう。
パケットのアッド・ドロップおよび通過の装置6−3は、右回りリング2から到着したパケットの宛先MACアドレスの下位アドレスa2でパケットのドロップを指定する下位アドレスメモリ7をアドレス指定した位置に下位アドレス記憶有を示すビット1が記憶されておらず、かつ、宛先MACアドレスのCRCビットh3でパケットのドロップを指定するCRCビットメモリ8をアドレス指定した位置にCRCビット記憶有を示すビット1が記憶されておらず、かつ、宛先MACアドレスがパケットのドロップを指定するアドレステーブル9に記憶されていないので、そのパケットを右回りリング2に送出する。そのパケットは右回りリング2により(16)Ma3a2a1a2で図に示されるようにパケットのアッド・ドロップおよび通過の装置6−2に向かう。
パケットのアッド・ドロップおよび通過の装置6−2は、右回りリングから到着したパケットの宛先MACアドレスa3a2がパケットのドロップを指定するアドレステーブル9に記憶されているので、そのパケットをリングからドロップして、(17)Ma3a2a1a2で図に示されるようにL2スイッチ21−1に向かわせる。
L2スイッチ21−1は、リング外から到着したパケットMa3a2a1a2の宛先MACアドレスa3a2がMACアドレステーブルにあるので、その位置に記憶されているポートにそのパケットを送出する。送出されたパケットは端末13−4に到着する。端末13−4は、ルータ19−5からのパケットを受信後、サーバ23宛ての宛先IPアドレスI5を持つパケット(18)Ma1a2a3a2(I5)をルータ20経由でサーバ23に送出する。
一方、端末13−5は、サーバ23にパケットを送る場合に、パケットのアッド・ドロップおよび通過の装置6−2のパケットのドロップを指定する下位アドレスメモリ7を端末13−5の送信元MACアドレスの下位アドレスa2でアドレス指定した場合に、下位アドレス記憶有を示すビット1が読み出され、パケットのドロップを指定するCRCビットメモリ8を端末13−5の送信元MACアドレスのCRCビットh1でアドレス指定した場合に、CRCビット記憶有を示すビット1が読み出されないので、端末13−5から送られたパケットの送信元MACアドレスa8a2をパケットドロップを指定するアドレステーブル9に記憶する。
1 左回りリング(0系リング)
2 右回りリング(1系リング)
3 頂点装置(頂点ノード)
4 サーバ
5 特定パケット以外のパケットの通過を遮断する伝送路ポート
6−1,6−2,6−3 パケットのアッド・ドロップおよび通過の装置(ノード)
7 パケットのドロップを指定する下位アドレスメモリ
8 パケットのドロップを指定するCRCビットメモリ
9 パケットのドロップを指定するアドレステーブル
10 パケットの通過を指定する下位アドレスメモリ
11−1、11−2、11−3は集線装置
13−1,13−2,13−3,13−4,13−5,13−6,13−7 端末
14−1,14−2,14−3 基地局
15−1,15−2,15−3, 15−4,15−5,15−6,15−7 携帯端末
17 頂点装置
18 左回りリングのパケット流を右回りリングに折り返す経路
21−1、21−2,21−3 L2スイッチ
20 ルータ
22 コンテンツサーバ
23、24 サーバ
122 パケットのドロップを指定する下位アドレスメモリ7のみでパケットドロップする制限時間付アドレスを記憶するパケットの通過を指定するアドレステーブル
2 右回りリング(1系リング)
3 頂点装置(頂点ノード)
4 サーバ
5 特定パケット以外のパケットの通過を遮断する伝送路ポート
6−1,6−2,6−3 パケットのアッド・ドロップおよび通過の装置(ノード)
7 パケットのドロップを指定する下位アドレスメモリ
8 パケットのドロップを指定するCRCビットメモリ
9 パケットのドロップを指定するアドレステーブル
10 パケットの通過を指定する下位アドレスメモリ
11−1、11−2、11−3は集線装置
13−1,13−2,13−3,13−4,13−5,13−6,13−7 端末
14−1,14−2,14−3 基地局
15−1,15−2,15−3, 15−4,15−5,15−6,15−7 携帯端末
17 頂点装置
18 左回りリングのパケット流を右回りリングに折り返す経路
21−1、21−2,21−3 L2スイッチ
20 ルータ
22 コンテンツサーバ
23、24 サーバ
122 パケットのドロップを指定する下位アドレスメモリ7のみでパケットドロップする制限時間付アドレスを記憶するパケットの通過を指定するアドレステーブル
Claims (22)
- 左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムであって、
前記2重リング網は、パケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元端末を識別するユニークなアドレス(以下、送信元アドレスと言う)を上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが左回りリングからパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前方のアッド・ドロップおよび通過を指定する装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システム。
- 左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定するアドレステーブルとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムであって、
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレス全体がパケット通過を指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、前記パケットの送信元アドレス全体をパケット通過を指定するアドレステーブルに記憶して、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケット通過を指定するアドレステーブルにある場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、一方、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システム。
- 左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットのドロップを指定する下位アドレスメモリの記憶アドレスのみでパケットをドロップする制限時間付アドレスを記憶するパケットの通過を指定するアドレステーブルとパケットドロップ許可タイマーを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムであって、
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレス全体がパケット通過を指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合か、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、パケットドロップ許可タイマーをセットし、パケットのドロップを指定する下位アドレスメモリの記憶アドレスのみでパケットをドロップする制限時間付アドレスを記憶するパケットの通過を指定するアドレステーブルに前記パケットの送信元アドレスを記憶し、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケット通過を指定するアドレステーブルにある場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、一方、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外で、パケットドロップ許可タイマーがタイムアウトしていない場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出されない場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システム。
- 左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定する下位アドレスメモリとパケットドロップ許可タイマーを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムであって、
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合か、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、パケットドロップ許可タイマーをセットし、前記パケットの通過したパケットのアッド・ドロップおよび通過の装置数が一定値N以上の場合には、そのまま、一方、前記パケットの通過したパケットのアッド・ドロップおよび通過の装置数が一定値N未満の場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、下位アドレス記憶有を示すビット1が読み出されない場合で、パケットドロップ許可タイマーがタイムアウトしていない場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出されない場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システム。
- 左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定する下位アドレスメモリとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムであって、
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合か、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケット通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、下位アドレス記憶有を示すビット1が読み出されない場合には、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システム。
- 左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定する下位アドレスメモリとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流を2重リング網の頂点装置の右回りリングのパケット流に折り返す構成のパケット転送システムであって、
前記2重リング網は、リング外からパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合か、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前記頂点装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケット通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、下位アドレス記憶有を示すビット1が読み出されない場合には、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システム。
- 左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定する下位アドレスメモリとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムであって、
前記2重リング網は、パケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶し、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前記頂点装置に向かわせる手段とを備えたことを特徴とするパケット転送システム。
- 左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、前記2つのリング伝送路に、左回りリングのパケット流を右回りリングに折り返し、かつ、特定パケット以外のパケットの通過を遮断するリング伝送路ポートを右回りリングの特定パケットを受信する側に持つ装置である頂点装置と、複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網からなるパケット転送システムであって、
前記2重リング網のパケットのアッド・ドロップおよび通過の装置にリング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶し、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが前記頂点装置に向かう途中のパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前記頂点装置に向かわせる手段とを備えたことを特徴とするパケット転送システム。
- 前記2重リング網は、右回りリングを転送されるブロードキャストパケットまたは発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、前記パケットをリング外伝送路経由でリング外に送出し、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、少なくとも、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合で、かつ、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルに無い場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出する手段をさらに備えたことを特徴とする請求項7または請求項8のいずれか1項に記載のパケット転送システム。
- 前記2重リング網は、右回りリングを転送されるブロードキャストパケットまたは発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合には、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出する手段をさらに備えたことを特徴とする請求項7または請求項8のいずれか1項にに記載のパケット転送システム。
- 前記2重リング網は、右回りリングを転送されるブロードキャストパケットまたは発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置装置に送出し、ビット1が読み出されない場合には、前記パケットを廃棄する手段をさらに備えたことを特徴とする請求項7または請求項8のいずれか1項に記載のパケット転送システム。
- 前記2重リング網は、右回りリングを転送されるブロードキャストパケットまたは発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットがパケットのアッド・ドロップおよび通過の装置に到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出されない場合で、かつ、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出されない場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合には、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置装置に送出する手段をさらに備えたことを特徴とする請求項7または請求項8のいずれか1項に記載のパケット転送システム。
- 前記2重リング網は、前記パケットのアッド・ドロップおよび通過の装置配下の端末が前記端末の属するパケットのアッド・ドロップおよび通過の装置を変えた直後の前記端末からのパケットが通常パケットのアッド・ドロップおよび通過の装置に到着した場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶無を示すビット0を書き込み、かつ、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶し、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶有を示すビット1を記憶し、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段をさらに備えたことを特徴とする請求項4から請求項12のいずれか1項に記載のパケット転送システム。
- 前記2重リング網は、前記パケットのアッド・ドロップおよび通過の装置配下の端末が前記端末の属するパケットのアッド・ドロップおよび通過の装置を変えた直後の前記端末からのパケットが通常パケットのアッド・ドロップおよび通過の装置に到着した場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶し、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶有を示すビット1を記憶し、前記パケットを右回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段をさらに備えたことを特徴とする請求項1から請求項3のいずれか1項に記載のパケット転送システム。
- 前記2重リング網は、右回りリングからパケットのアッド・ドロップおよび通過の装置に発呼パケットが到着した場合に、前記パケットをコピーし、片一方のパケットはリングから接続している伝送路でリング外に送出し、もう、片方のパケットは、右回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段をさらに備えたことを特徴とする請求項1から請求項6または請求項9から請求項12のいずれか1項に記載のパケット転送システム。
- 前記2重リング網は、右回りリングからパケットのアッド・ドロップおよび通過の装置にブロードキャストパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合、または、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、前記パケットをパケットのアッド・ドロップおよび通過の装置をスルーで通過させ、上記以外の場合および1度、パケットのアッド・ドロップおよび通過の装置をスルーで通過した後の場合には、前記パケットをコピーし、片一方のパケットはリング外から接続している伝送路でリング外に送出し、もう、片方のパケットは、右回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせることを特徴とする請求項1から請求項6または請求項9から請求項12のいずれか1項に記載のパケット転送システム。
- パケットのドロップを指定するCRCビットメモリである一つのメモリをパケットの送信元アドレスのCRCビットでアドレス指定に代えて、パケットのドロップを指定するあいまい記憶ビット列合成値メモリである一つのメモリを、パケットの送信元アドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列でアドレス指定にし、パケットのドロップを指定するCRCビットメモリである一つのメモリをパケットの宛先アドレスのCRCビットでアドレス指定に代えて、パケットのドロップを指定するあいまい記憶ビット列合成値メモリである一つのメモリを、パケットの宛先アドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列でアドレス指定にすること特徴とする請求項1から請求項14または請求項16のいずれか1項に記載のパケット転送システム。
- 左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムに適用され、
リング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
パケットが左回りリングから到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前方のアッド・ドロップおよび通過を指定する装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットが到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システムのパケットのアッド・ドロップおよび通過の装置。
- 左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定するアドレステーブルとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムに適用され、
リング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレス全体がパケット通過を指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが左回りリングから到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込むと共に、前記パケットの送信元アドレス全体をパケット通過を指定するアドレステーブルに記憶して、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットが到着した場合に、前記パケットの宛先アドレス全体がパケット通過を指定するアドレステーブルにある場合には、前記パケットを右回りリングにより下流パケットのアッド・ドロップおよび通過の装置に送出し、一方、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外は、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出する手段とを備えたことを特徴とするパケット転送システムのパケットのアッド・ドロップおよび通過の装置。
- 左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定する下位アドレスメモリとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流をサーバに送出し、サーバからのパケットを2重リング網の頂点装置の右回りリングのパケット流に挿入する構成を有するパケット転送システムに適用され、
リング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を指定するビットが読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが左回りリングから到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットが到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケット通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出し、下位アドレス記憶有を示すビット1が読み出されない場合には、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システムのパケットのアッド・ドロップおよび通過の装置。
- 左回りリングと前記リングと伝送方向が逆の右回りリングからなる2つのリング伝送路と、この2つのリング伝送路に、挿入した、特定パケット以外のパケットの通過を遮断する伝送路ポートを右回りリングの特定パケットを受信する側に持つ頂点装置と、パケットのドロップを指定する下位アドレスメモリとパケットのドロップを指定するCRCビットメモリとパケットのドロップを指定するアドレステーブルとパケットの通過を指定する下位アドレスメモリとを持つ複数のパケットのアッド・ドロップおよび通過の装置とを備えた2重リング網の頂点装置の左回りリングの全パケット流を2重リング網の頂点装置の右回りリングのパケット流に折り返す構成のパケット転送システムに適用され、
リング外の伝送路経由でパケットが到着した場合に、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶すると共に、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置に、CRCビット記憶有を示すビット1を記憶し、一方、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、そのままとし、上記以外の場合で、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合、または、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出される場合で、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレス全体をパケットのドロップを指定するアドレステーブルに記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
前記パケットが左回りリングから到着した場合に、前記パケットの送信元アドレス全体がパケットのドロップを指定するアドレステーブルにある場合には、その送信元アドレスを消去して、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出され、かつ、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置にCRCビット記憶無を示すビット0を書き込み、少なくとも、前記パケットの送信元アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶無を示すビット0が読み出されるか、または、前記パケットの送信元アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶無を示すビット0が読み出される場合には、そのまま、前記下位アドレスでパケットの通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置に下位アドレス記憶有を示すビット1を記憶して、前記パケットを左回りリングにより前方のパケットのアッド・ドロップおよび通過の装置に向かわせる手段と、
右回りリングを転送されるブロードキャストパケットまたは、発呼パケット以外の送信元アドレスおよび宛先アドレスを持つパケットが到着した場合に、前記パケットの宛先アドレス全体がパケットのドロップを指定するアドレステーブルにある場合、または、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケットのドロップを指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合で、かつ、前記パケットの宛先アドレスのCRCビットでパケットのドロップを指定するCRCビットメモリである一つのメモリをアドレス指定した位置からCRCビット記憶有を示すビット1が読み出される場合には、前記パケットをリング外伝送路経由でリング外に送出し、上記以外の場合で、前記パケットの宛先アドレスを上位アドレスと下位アドレスに分けた場合の前記下位アドレスでパケット通過を指定する下位アドレスメモリである一つのメモリをアドレス指定した位置から下位アドレス記憶有を示すビット1が読み出される場合には、前記パケットを右回りリングにより下流のパケットのアッド・ドロップおよび通過の装置に送出し、下位アドレス記憶有を示すビット1が読み出されない場合には、前記パケットを廃棄する手段とを備えたことを特徴とするパケット転送システムのパケットのアッド・ドロップおよび通過の装置。
- パケットのドロップを指定するCRCビットメモリである一つのメモリをパケットの送信元アドレスのCRCビットでアドレス指定に代えて、パケットのドロップを指定するあいまい記憶ビット列合成値メモリである一つのメモリを、パケットの送信元アドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列でアドレス指定にし、パケットのドロップを指定するCRCビットメモリである一つのメモリをパケットの宛先アドレスのCRCビットでアドレス指定に代えて、パケットのドロップを指定するあいまい記憶ビット列合成値メモリである一つのメモリを、パケットの宛先アドレスから上位アドレスと下位アドレスを採取し、採取した上位アドレスのビット列の各ビットと下位アドレスのビット列の各ビットとの排他的論理和のビット列でアドレス指定にすること特徴とする請求項18から請求項21のいずれか1項に記載のパケット転送システムのパケットのアッド・ドロップおよび通過の装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2018186234A JP2020057880A (ja) | 2018-09-29 | 2018-09-29 | Macアドレスの下位アドレス、crcビット主でパケットを転送するリング網 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2018186234A JP2020057880A (ja) | 2018-09-29 | 2018-09-29 | Macアドレスの下位アドレス、crcビット主でパケットを転送するリング網 |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2020057880A true JP2020057880A (ja) | 2020-04-09 |
Family
ID=70107777
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2018186234A Pending JP2020057880A (ja) | 2018-09-29 | 2018-09-29 | Macアドレスの下位アドレス、crcビット主でパケットを転送するリング網 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2020057880A (ja) |
-
2018
- 2018-09-29 JP JP2018186234A patent/JP2020057880A/ja active Pending
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP2023086623A (ja) | 下位アドレス記憶方法を用いたリング網を利用したハンドオーバー | |
JP7050177B2 (ja) | マルチキャストパケットを伝送する方法、デバイス、及びシステム | |
CN103457756B (zh) | 一种环路路径检测方法、装置及系统 | |
JP2020057880A (ja) | Macアドレスの下位アドレス、crcビット主でパケットを転送するリング網 | |
JP2014116854A (ja) | セルまたはパケットまたはセルヘッダ付きパケットを転送する網 | |
US6711161B1 (en) | Arrangement for providing linearly scaleable address forwarding tables within multiple network switch modules | |
JP2019047236A (ja) | アドレス記憶方法およびリング網 | |
JP2023007983A (ja) | アドレス記憶方法およびリング網 | |
JP2023076790A (ja) | 下位アドレス記憶方法を用いたリング網を利用したハンドオーバー | |
JP2019118085A (ja) | アドレス記憶方法およびリング網 | |
JP2018152686A (ja) | アドレス記憶方法およびリング網 | |
JP2020188342A (ja) | アドレス記憶方法およびリング網 | |
JP2014060679A (ja) | パケット転送法およびノード装置 | |
JP2019054468A (ja) | アドレス記憶方法およびリング網 | |
JP2019022087A (ja) | アドレス記憶方法およびリング網 | |
JP2023123314A (ja) | 下位アドレス記憶方法を用いたリングネットワークを利用してハンドオーバーを行うパケット転送システム | |
JP2023083862A (ja) | 下位アドレス記憶方法を用いたリング網を利用したハンドオーバーを可能とするパケット転送システム | |
JP2023035296A (ja) | アドレス記憶方法およびそれを用いたリング網におけるハンドオーバー等基地局間移動を可能とするパケット転送システム | |
JP2019068274A (ja) | アドレス記憶方法およびリング網 | |
JP2019050500A (ja) | アドレス記憶方法およびリング網 | |
JP2023086138A (ja) | 下位アドレス記憶方法を用いたリング網を利用したハンドオーバー | |
JP2023026774A (ja) | アドレス記憶方法およびそれを用いたリング網におけるハンドオーバー等基地局間移動を可能とするパケット転送システム | |
JP2023120610A (ja) | 下位アドレス記憶方法を用いたリングネットワークを利用したハンドオーバー | |
JP2023070687A (ja) | アドレス記憶方法およびそれを用いたリング網におけるハンドオーバー等基地局間移動を可能とするパケット転送システム | |
JP2023060780A (ja) | 下位アドレス記憶方法を用いたリング網を利用したハンドオーバー |