JP2019537153A - サービス・レイヤ・アダプタを用いる、コヒーレンシの最低点(lpc)メモリの管理方法、アダプタ、プログラム - Google Patents
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Abstract
Description
・ AFUに、コヒーレント・インターフェースから独立したオープン・プロセッサ・メモリ・インターフェースをAFUに備えることによって、コンピュータ・システムのオペレーションを改良し、ストレージ・アクセス効率を向上し、
・ アダプタに取付けられたLPCメモリへの保護されたアクセスをAFUに備えることによって、コンピュータ・システムのオペレーションを改良し、待ち時間を低減し、
・ AFUにより、アダプタにローカルなおよびリモートなメモリへのメモリ・アクセスを管理することによって、コンピュータ・システムのオペレーションを改良し、メモリの整合性を向上する。
このメモリ・アクセス命令は、プロセッサ上のベース・アドレス・レジスタを介してサービス・レイヤ・アダプタ(192)に向かわせることができる。
・ コヒーレント・インターフェースから独立したオープン・プロセッサ・メモリ・インターフェースをAFUに備えることによって、コンピュータ・システムのオペレーションを改良し、ストレージ・アクセス効率を向上する。
・ アダプタに取付けられたLPCメモリへの保護されたアクセスをAFUに備えることによって、コンピュータ・システムのオペレーションを改良し、待ち時間を低減する。
・ AFUにより、アダプタにローカルなおよびリモートなメモリへのメモリ・アクセスを管理することによって、コンピュータ・システムのオペレーションを改良し、メモリの整合性を向上する。
Claims (20)
- サービス・レイヤ・アダプタを用いてコヒーレンシの最低点(LPC)メモリを管理する方法であって、前記アダプタは、ホスト・コンピューティング・システム上のプロセッサおよびアクセラレータに連結され、前記プロセッサは、対称型マルチプロセッシング用に構成され、前記方法は、
前記アダプタによって、前記アクセラレータからメモリ・アクセス命令を受信するステップと、
前記アダプタによって、前記メモリ・アクセス命令に対する実アドレスを読み出すステップと、
前記アダプタ上のベース・アドレス・レジスタを使って、前記実アドレスが前記LPCメモリを対象としていることを判断するステップであって、前記ベース・アドレス・レジスタが、メモリ・アクセス要求を、前記LPCメモリ位置と前記ホスト・コンピューティング・システム上の他のメモリ位置との間で振り分ける、前記判断するステップと、
前記アダプタによって、前記メモリ・アクセス命令および前記実アドレスを、前記LPCメモリに対するメディア・コントローラに送信するステップであって、前記LPCメモリに対する前記メディア・コントローラはメモリ・インターフェースを介して前記アダプタに取付けられている、前記送信するステップと、
を含む、方法。 - 前記プロセッサから、後続のメモリ・アクセス命令を受信するステップと、
前記アダプタ上のベース・アドレス・レジスタを使って、前記後続のメモリ・アクセス命令が前記LPCメモリを対象としていることを判断するステップと、
前記アダプタによって、前記後続のメモリ・アクセス命令および前記後続のメモリ・アクセス命令に対する前記実アドレスを、前記LPCメモリに対する前記メディア・コントローラに送信するステップと、
をさらに含む、請求項1に記載の方法。 - 前記アクセラレータから、後続のメモリ・アクセス命令を受信するステップと、
前記アダプタ上のベース・アドレス・レジスタを使って、前記後続のメモリ・アクセス命令が前記LPCメモリを対象としていないことを判断するステップと、
前記アダプタによって、前記後続のメモリ・アクセス命令および前記後続のメモリ・アクセス命令に対する前記実アドレスを、前記プロセッサに送信するステップと、
をさらに含む、請求項1に記載の方法。 - 前記アクセラレータから、前記LPCメモリを対象としているメモリ・アクセス命令を受信するステップが、
前記アダプタによって、前記アクセラレータから、有効アドレスを含む、メモリ・アクセス・オペレーションを開始する要求を受信するステップと、
前記有効アドレスを前記実アドレスに変換するステップと、
前記アダプタによって、前記実アドレスに対応する変換タグ(「XTAG」)を前記アクセラレータに提供するステップと、
前記アダプタによって、前記アクセラレータから前記XTAGを含む前記メモリ・アクセス命令を受信するステップと、
を含む、請求項1に記載の方法。 - 前記他のメモリ位置が、プロセッサ・メモリ、および前記ホスト・コンピューティング・システム上のさらなるアダプタに連結されたメモリを含む、請求項1に記載の方法。
- 前記LPCメモリが、前記アクセラレータと前記プロセッサとの間で分割される、請求項1に記載の方法。
- 前記メモリ・アクセス命令が、前記アダプタ上のコヒーレンシ・インターフェースを介して、前記アダプタによって受信される、請求項1に記載の方法。
- サービス・レイヤ・アダプタを用いてコヒーレンシの最低点(LPC)メモリを管理するためのアダプタであって、前記アダプタは、ホスト・コンピューティング・システム上のプロセッサおよびアクセラレータに連結され、前記プロセッサは、対称型マルチプロセッシング用に構成され、前記アダプタが、
前記アダプタによって、前記アクセラレータからメモリ・アクセス命令を受信するステップと、
前記アダプタによって、前記メモリ・アクセス命令に対する実アドレスを読み出すステップと、
前記アダプタ上のベース・アドレス・レジスタを使って、前記実アドレスが前記LPCメモリを対象としていることを判断するステップであって、前記ベース・アドレス・レジスタが、メモリ・アクセス要求を、前記LPCメモリ位置と前記ホスト・コンピューティング・システム上の他のメモリ位置との間で振り分ける、前記判断するステップと、
前記アダプタによって、前記メモリ・アクセス命令および前記実アドレスを、前記LPCメモリに対するメディア・コントローラに送信するステップであって、前記LPCメモリに対する前記メディア・コントローラはメモリ・インターフェースを介して前記アダプタに取付けられている、前記送信するステップと、
を実行するように構成される、アダプタ。 - 前記ステップ群が、
前記プロセッサから、後続のメモリ・アクセス命令を受信するステップと、
前記アダプタ上のベース・アドレス・レジスタを使って、前記後続のメモリ・アクセス命令が前記LPCメモリを対象としていることを判断するステップと、
前記アダプタによって、前記後続のメモリ・アクセス命令および前記後続のメモリ・アクセス命令に対する前記実アドレスを、前記LPCメモリに対する前記メディア・コントローラに送信するステップと、
をさらに含む、請求項8に記載のアダプタ。 - 前記ステップ群が、
前記アクセラレータから、後続のメモリ・アクセス命令を受信するステップと、
前記アダプタ上のベース・アドレス・レジスタを使って、前記後続のメモリ・アクセス命令が前記LPCメモリを対象としていないことを判断するステップと、
前記アダプタによって、前記後続のメモリ・アクセス命令および前記後続のメモリ・アクセス命令に対する前記実アドレスを、前記プロセッサに送信するステップと、
をさらに含む、請求項8に記載のアダプタ。 - 前記アクセラレータから、前記LPCメモリを対象としているメモリ・アクセス命令を受信するステップが、
前記アダプタによって、前記アクセラレータから、有効アドレスを含む、メモリ・アクセス・オペレーションを開始する要求を受信するステップと、
前記有効アドレスを前記実アドレスに変換するステップと、
前記アダプタによって、前記実アドレスに対応する変換タグ(「XTAG」)を前記アクセラレータに提供するステップと、
前記アダプタによって、前記アクセラレータから前記XTAGを含む前記メモリ・アクセス命令を受信するステップと、
を含む、請求項8に記載のアダプタ。 - 前記他のメモリ位置が、プロセッサ・メモリ、および前記ホスト・コンピューティング・システム上のさらなるアダプタに連結されたメモリを含む、請求項8に記載のアダプタ。
- 前記LPCメモリが、前記アクセラレータと前記プロセッサとの間で分割される、請求項8に記載のアダプタ。
- 前記メモリ・アクセス命令が、前記アダプタ上のコヒーレンシ・インターフェースを介して、前記アダプタによって受信される、請求項8に記載のアダプタ。
- サービス・レイヤ・アダプタを用いてコヒーレンシの最低点(LPC)メモリを管理するためのコンピュータ・プログラム製品であって、前記アダプタは、ホスト・コンピューティング・システム上のプロセッサおよびアクセラレータに連結され、前記プロセッサは、対称型マルチプロセッシング用に構成され、前記コンピュータ・プログラム製品は、コンピュータ可読媒体上に配置され、前記コンピュータ・プログラム製品は、実行されると、前記アダプタに、
前記アダプタによって、前記アクセラレータからメモリ・アクセス命令を受信するステップと、
前記アダプタによって、前記メモリ・アクセス命令に対する実アドレスを読み出すステップと、
前記アダプタ上のベース・アドレス・レジスタを使って、前記実アドレスが前記LPCメモリを対象としていることを判断するステップであって、前記ベース・アドレス・レジスタが、メモリ・アクセス要求を、前記LPCメモリ位置と、前記ホスト・コンピューティング・システム上の他のメモリ位置との間で振り分ける、前記判断するステップと、
前記アダプタによって、前記メモリ・アクセス命令および前記実アドレスを、前記LPCメモリに対するメディア・コントローラに送信するステップであって、前記LPCメモリに対する前記メディア・コントローラはメモリ・インターフェースを介して前記アダプタに取付けられている、前記送信するステップと、
を実行させるコンピュータ・プログラム命令を含む、
コンピュータ・プログラム製品。 - 前記ステップ群が、
前記プロセッサから、後続のメモリ・アクセス命令を受信するステップと、
前記アダプタ上のベース・アドレス・レジスタを使って、前記後続のメモリ・アクセス命令が前記LPCメモリを対象としていることを判断するステップと、
前記アダプタによって、前記後続のメモリ・アクセス命令および前記後続のメモリ・アクセス命令に対する前記実アドレスを、前記LPCメモリに対する前記メディア・コントローラに送信するステップと、
をさらに含む、請求項15に記載のコンピュータ・プログラム製品。 - 前記ステップ群が、
前記アクセラレータから、後続のメモリ・アクセス命令を受信するステップと、
前記アダプタ上のベース・アドレス・レジスタを使って、前記後続のメモリ・アクセス命令が前記LPCメモリを対象としていないことを判断するステップと、
前記アダプタによって、前記後続のメモリ・アクセス命令および前記後続のメモリ・アクセス命令に対する前記実アドレスを、前記プロセッサに送信するステップと、
をさらに含む、請求項15に記載のコンピュータ・プログラム製品。 - 前記アクセラレータから、前記LPCメモリを対象としているメモリ・アクセス命令を受信するステップが、
前記アダプタによって、前記アクセラレータから、有効アドレスを含む、メモリ・アクセス・オペレーションを開始する要求を受信するステップと、
前記有効アドレスを前記実アドレスに変換するステップと、
前記アダプタによって、前記実アドレスに対応する変換タグ(「XTAG」)を前記アクセラレータに提供するステップと、
前記アダプタによって、前記アクセラレータから前記XTAGを含む前記メモリ・アクセス命令を受信するステップと、
を含む、請求項15に記載のコンピュータ・プログラム製品。 - 前記他のメモリ位置が、プロセッサ・メモリ、および前記ホスト・コンピューティング・システム上のさらなるアダプタに連結されたメモリを含む、請求項15に記載のコンピュータ・プログラム製品。
- 前記LPCメモリが、前記アクセラレータと前記プロセッサとの間で分割される、請求項15に記載のコンピュータ・プログラム製品。
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