JP2018515822A - コンピューティングデバイス内の複数のsocの間における動作状態の協調のための方法およびシステム - Google Patents
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Abstract
Description
20、30 SOC
22、32 状態機械
24 動作状態
34 コマンド
100 プロセスフロー図
200 アプリケーションプロセッサSOC
202 デジタル信号プロセッサ(DSP)、SOCプロセッサ
204 モデムプロセッサ、SOCプロセッサ
206 グラフィックスプロセッサ、SOCプロセッサ
208 アプリケーションプロセッサ、SOCプロセッサ
208a 状態モニタ
210 電力管理プロセッサ、SOCプロセッサ
210a 状態機械
212 メモリ
212a レジスタ
214 アナログ回路およびカスタム回路、回路
216 他のシステム構成要素およびリソース
218 相互接続/バスモジュール
300 WIFIトランシーバSOC
302 WIFIステーション(STA)管理プログラム、WIFIプロセッサ
302a 状態モニタ
304 802.11メディアアクセス制御/物理レイヤ(MAC/PHY)パケットプロセッサ、WIFIプロセッサ
306 中間周波数(IF)/ベースバンドプロセッサ、WIFIプロセッサ
308 802.11タイミング同期フレームワーク(TSF)プロセッサ、WIFIプロセッサ
310 電力マネージャプロセッサ、WIFIプロセッサ
310a 状態機械
312 メモリ要素
312a SOCレジスタ
314 他のWIFI構成要素およびリソース
318 相互接続/バスモジュール
350 状態図
500 コンピューティングデバイス
502 プロセッサ
504 タッチスクリーンコントローラ
506 内部メモリ
508 トランシーバ
510 アンテナ
512 タッチスクリーンパネル
514 スピーカ
520 ハウジング
522 電源
524 物理ボタン
526 電源ボタン
Claims (16)
- コンピューティングデバイス内の複数のシステムオンチップ(SOC)の動作状態を協調させる方法であって、
第1のSOCによって、前記第1のSOCと第2のSOCとの間における潜在的な切迫したインタラクションの事前通知を表す情報を通信するステップと、
前記第2のSOCによって、前記潜在的な切迫したインタラクションの前記事前通知を表す前記情報を受信するステップと、
前記第2のSOCによって、前記受信された情報に基づいて前記第2のSOCの動作状態を実行するステップと、を含む方法。 - 前記受信された情報に基づいて前記第2のSOCの動作状態を実行するステップは、前記第2のSOC上で実行している電力マネージャによって、前記受信された情報に基づいて前記第2のSOCの電力状態を実行するステップを含む、請求項1に記載の方法。
- 前記第1のSOCと前記第2のSOCとの間における前記潜在的な切迫したインタラクションの前記事前通知を表す前記情報を通信するステップは、前記第1のSOCによって、前記第1のSOCの動作状態を表す値を前記第2のSOCのメモリレジスタに設定するステップを含み、
前記受信された情報に基づいて前記第2のSOCの前記電力状態を実行するステップは、前記第2のSOC上で実行している前記電力マネージャによって、前記第2のSOCの前記メモリレジスタ内の前記値に基づいて前記第2のSOCの前記電力状態を決定するステップを含む、請求項2に記載の方法。 - 前記第1のSOCと前記第2のSOCとの間における前記潜在的な切迫したインタラクションの前記事前通知を表す前記情報を通信するステップは、前記第1のSOCによって、前記第2のSOCの前記電力マネージャにメッセージを送るステップを含み、前記メッセージは、複数の電力状態のうちの1つの実行に関するコマンドを含み、
前記受信された情報に基づいて前記第2のSOCの前記電力状態を実行するステップは、前記第2のSOCの前記電力マネージャによって、前記電力マネージャへの前記メッセージで送られた前記コマンドに基づいて、前記第2のSOCの前記電力状態を決定するステップを含む、請求項2に記載の方法。 - 第1のシステムオンチップ(「第1のSOC」)と第2のシステムオンチップ(「第2のSOC」)とを備え、前記第1のSOCおよび前記第2のSOCの各々は、コンピューティングデバイス内の複数のSOCの動作状態を協調させるための動作を実施するプロセッサ実行可能命令を用いて構成されたプロセッサをさらに備え、前記動作は、
前記第1のSOCの前記プロセッサによって、前記第1のSOCと前記第2のSOCとの間における潜在的な切迫したインタラクションの事前通知を表す情報を通信するステップと、
前記第2のSOCの前記プロセッサによって、前記潜在的な切迫したインタラクションの前記事前通知を表す前記情報を受信するステップと、
前記第2のSOCの前記プロセッサによって、前記受信された情報に基づいて前記第2のSOCの動作状態を実行するステップと、を含むコンピューティングデバイス。 - 前記第2のSOCの前記プロセッサは、前記受信された情報に基づいて前記第2のSOCの動作状態を実行するステップが、前記受信された情報に基づいて前記第2のSOCの電力状態を実行するステップを含むような動作を実施するプロセッサ実行可能命令を用いて構成される、請求項5に記載のコンピューティングデバイス。
- 前記第1のSOCの前記プロセッサは、前記第1のSOCと前記第2のSOCとの間における前記潜在的な切迫したインタラクションの前記事前通知を表す前記情報を通信するステップが、前記第1のSOCの動作状態を表す値を前記第2のSOCのメモリレジスタに設定するステップを含むような動作を実施するプロセッサ実行可能命令を用いて構成され、
前記第2のSOCの前記プロセッサは、前記受信された情報に基づいて前記第2のSOCの前記電力状態を実行するステップが、前記第2のSOCの前記メモリレジスタ内の前記値に基づいて前記第2のSOCの前記電力状態を決定するステップを含むような動作を実施するプロセッサ実行可能命令を用いて構成される、請求項6に記載のコンピューティングデバイス。 - 前記第1のSOCの前記プロセッサは、前記第1のSOCと前記第2のSOCとの間における前記潜在的な切迫したインタラクションの前記事前通知を表す前記情報を通信するステップが、前記第2のSOCの前記プロセッサにメッセージを送るステップを含むような動作を実施するプロセッサ実行可能命令を用いて構成され、前記メッセージは、複数の電力状態のうちの1つの実行に関するコマンドを含み、
前記第2のSOCの前記プロセッサは、前記受信された情報に基づいて前記第2のSOCの前記電力状態を実行するステップが、電力マネージャへの前記メッセージで送られた前記コマンドに基づいて前記第2のSOCの前記電力状態を決定するステップを含むような動作を実施するプロセッサ実行可能命令を用いて構成される、請求項6に記載のコンピューティングデバイス。 - 第1のシステムオンチップ(「第1のSOC」)のプロセッサおよび第2のシステムオンチップ(「第2のSOC」)のプロセッサに、コンピューティングデバイス内の複数のSOCの動作状態を協調させるための動作を実施させるように構成されたプロセッサ実行可能命令を記憶した非一時的プロセッサ可読記憶媒体であって、前記動作は、
前記第1のSOCの前記プロセッサによって、前記第1のSOCと前記第2のSOCとの間における潜在的な切迫したインタラクションの事前通知を表す情報を通信するステップと、
前記第2のSOCの前記プロセッサによって、前記潜在的な切迫したインタラクションの前記事前通知を表す前記情報を受信するステップと、
前記第2のSOCの前記プロセッサによって、前記受信された情報に基づいて前記第2のSOCの動作状態を実行するステップと、を含む非一時的プロセッサ可読記憶媒体。 - 前記記憶されたプロセッサ実行可能命令は、前記コンピューティングデバイスの前記第2のSOCの前記プロセッサに、前記受信された情報に基づいて前記第2のSOCの動作状態を実行するステップが、前記受信された情報に基づいて前記第2のSOCの電力状態を実行するステップを含むような動作を実施させるように構成される、請求項9に記載の非一時的プロセッサ可読記憶媒体。
- 前記記憶されたプロセッサ実行可能命令は、前記第1のSOCの前記プロセッサに、前記第1のSOCと前記第2のSOCとの間における前記潜在的な切迫したインタラクションの前記事前通知を表す前記情報を通信するステップが、前記第1のSOCの動作状態を表す値を前記第2のSOCのメモリレジスタに設定するステップを含むような動作を実施させるように構成され、
前記記憶されたプロセッサ実行可能命令は、前記第1のSOCの前記プロセッサに、前記受信された情報に基づいて前記第2のSOCの前記電力状態を実行するステップが、前記第2のSOCの前記メモリレジスタ内の前記値に基づいて前記第2のSOCの前記電力状態を決定するステップを含むような動作を実施させるように構成される、請求項10に記載の非一時的プロセッサ可読記憶媒体。 - 前記記憶されたプロセッサ実行可能命令は、前記第1のSOCの前記プロセッサに、前記第1のSOCと前記第2のSOCとの間における前記潜在的な切迫したインタラクションの前記事前通知を表す前記情報を通信するステップが、前記第2のSOCの前記プロセッサにメッセージを送るステップを含むような動作を実施させるように構成され、前記メッセージは、複数の電力状態のうちの1つの実行に関するコマンドを含み、
前記記憶されたプロセッサ実行可能命令は、前記第2のSOCの前記プロセッサに、前記受信された情報に基づいて前記第2のSOCの前記電力状態を実行するステップが、電力マネージャへの前記メッセージで送られた前記コマンドに基づいて前記第2のSOCの前記電力状態を決定するステップを含むような動作を実施させるように構成される、請求項10に記載の非一時的プロセッサ可読記憶媒体。 - コンピューティングデバイス内の複数のシステムオンチップ(SOC)の動作状態を協調させるように構成されたコンピューティングデバイスであって、
第1のSOCにおいて、前記第1のSOCと第2のSOCとの間における潜在的な切迫したインタラクションの事前通知を表す情報を通信するための手段と、
前記第2のSOCにおいて、前記潜在的な切迫したインタラクションの前記事前通知を表す前記情報を受信するための手段と、
前記第2のSOCにおいて、前記受信された情報に基づいて前記第2のSOCの動作状態を実行するための手段と、を備えるコンピューティングデバイス。 - 第2のSOCにおいて、前記受信された情報に基づいて前記第2のSOCの動作状態を実行するための手段は、前記受信された情報に基づいて前記第2のSOCの電力状態を実行するための手段を含む、請求項13に記載のコンピューティングデバイス。
- 前記第1のSOCにおいて、前記第1のSOCと前記第2のSOCとの間における前記潜在的な切迫したインタラクションの前記事前通知を表す前記情報を通信するための手段は、前記第1のSOCの動作状態を表す値を前記第2のSOCのメモリレジスタに設定するための手段を含み、
前記第2のSOCにおいて、前記受信された情報に基づいて前記第2のSOCの前記電力状態を実行する手段は、前記第2のSOCの前記メモリレジスタ内の前記値に基づいて前記第2のSOCの前記電力状態を決定するための手段を含む、請求項14に記載のコンピューティングデバイス。 - 前記第1のSOCにおいて、前記第1のSOCと前記第2のSOCとの間における前記潜在的な切迫したインタラクションの前記事前通知を表す前記情報を通信するための手段は、前記第2のSOCにメッセージを送るための手段を含み、前記メッセージは、複数の電力状態のうちの1つの実行に関するコマンドを含み、
前記第2のSOCにおいて、前記受信された情報に基づいて前記第2のSOCの前記電力状態を実行するための手段は、電力マネージャへの前記メッセージで送られた前記コマンドに基づいて前記第2のSOCの前記電力状態を決定するための手段を含む、請求項14に記載のコンピューティングデバイス。
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Families Citing this family (11)
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US9798377B2 (en) | 2014-10-08 | 2017-10-24 | Apple Inc. | Methods and apparatus for recovering errors with an inter-processor communication link between independently operable processors |
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US10572390B2 (en) | 2016-02-29 | 2020-02-25 | Apple Inc. | Methods and apparatus for loading firmware on demand |
US10198364B2 (en) | 2016-03-31 | 2019-02-05 | Apple Inc. | Memory access protection apparatus and methods for memory mapped access between independently operable processors |
US10474517B2 (en) * | 2016-07-18 | 2019-11-12 | American Megatrends International, Llc | Techniques of storing operational states of processes at particular memory locations of an embedded-system device |
US10423209B2 (en) * | 2017-02-13 | 2019-09-24 | Apple Inc. | Systems and methods for coherent power management |
US10642781B2 (en) | 2017-04-07 | 2020-05-05 | Qualcomm Incorporated | Boot time determination of calibration parameters for a component coupled to a system-on-chip |
US10838450B2 (en) * | 2018-09-28 | 2020-11-17 | Apple Inc. | Methods and apparatus for synchronization of time between independently operable processors |
TWI748570B (zh) * | 2020-07-22 | 2021-12-01 | 瑞昱半導體股份有限公司 | 資料處理裝置 |
TWI749867B (zh) | 2020-11-12 | 2021-12-11 | 華碩電腦股份有限公司 | 無線收發裝置 |
CN114020136B (zh) * | 2021-09-24 | 2022-11-29 | 荣耀终端有限公司 | 电子设备的运行方法和电子设备 |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2011235454A (ja) * | 2010-05-06 | 2011-11-24 | Seiko Epson Corp | 通信制御装置 |
US20140068297A1 (en) * | 2011-05-10 | 2014-03-06 | Beijing Lenovo Software Ltd. | State control method and apparatus and portable terminal |
US20160154452A1 (en) * | 2014-12-02 | 2016-06-02 | Arm Limited | System and method for controlling the power mode of operation of a memory device |
Family Cites Families (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US20020124199A1 (en) * | 2001-02-16 | 2002-09-05 | Fernando John Susantha | Method and apparatus for transferring multi-source/multi-sink control signals using a differential signaling technique |
US20020161978A1 (en) | 2001-02-28 | 2002-10-31 | George Apostol | Multi-service system-on-chip including on-chip memory with multiple access path |
US20040032605A1 (en) * | 2002-08-14 | 2004-02-19 | Regimbal Laurent A. | Monitoring patterns of use for peripheral device access |
EP1677175B1 (en) | 2004-12-31 | 2013-08-28 | ST-Ericsson SA | Dynamic power management in system on chips (SOC) |
US7461274B2 (en) * | 2005-08-23 | 2008-12-02 | International Business Machines Corporation | Method for maximizing server utilization in a resource constrained environment |
US8286014B2 (en) | 2008-03-25 | 2012-10-09 | Intel Corporation | Power management for a system on a chip (SoC) |
US8990591B2 (en) | 2009-12-31 | 2015-03-24 | Intel Corporation | Power management system for selectively changing the power state of devices using an OS power management framework and non-OS power management framework |
US8489904B2 (en) | 2010-03-25 | 2013-07-16 | International Business Machines Corporation | Allocating computing system power levels responsive to service level agreements |
US8656198B2 (en) * | 2010-04-26 | 2014-02-18 | Advanced Micro Devices | Method and apparatus for memory power management |
CN102270030B (zh) * | 2010-05-07 | 2015-09-09 | 三星电子株式会社 | 片上系统、具有其的设备以及该片上系统的电力控制方法 |
US10101797B2 (en) * | 2014-09-27 | 2018-10-16 | Intel Corporation | Efficient power management of UART interface |
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- 2015-03-13 US US14/657,107 patent/US9939869B2/en active Active
-
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Patent Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2011235454A (ja) * | 2010-05-06 | 2011-11-24 | Seiko Epson Corp | 通信制御装置 |
US20140068297A1 (en) * | 2011-05-10 | 2014-03-06 | Beijing Lenovo Software Ltd. | State control method and apparatus and portable terminal |
US20160154452A1 (en) * | 2014-12-02 | 2016-06-02 | Arm Limited | System and method for controlling the power mode of operation of a memory device |
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