JP2018056711A - 撮像素子、撮像装置、及び撮像素子の信号処理方法 - Google Patents
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Abstract
【解決手段】アナログ信号を出力する画素が複数配置された画素部と、AD変換部と、ビットシフト部とを有し、AD変換部は、第1のアナログ信号を第1の分解能でAD変換処理して第1のデジタル信号を出力するとともに、第2のアナログ信号の信号レベルが基準信号より小さい場合には第2のアナログ信号を第1の分解能でAD変換処理して第2のデジタル信号を出力し、第2のアナログ信号の信号レベルが基準信号より大きい場合には第2のアナログ信号を第1の分解能より低い第2の分解能でAD変換処理して第2のデジタル信号を出力し、ビットシフト部は、第1のデジタル信号を第2の分解能に合わせてビットシフトすることでデジタルゲイン処理を行う。
【選択図】図3
Description
本発明の第1の実施形態について説明する。
図1は、第1の実施形態における撮像素子100の構成例を示す模式図である。本実施形態における撮像素子100は、受光した被写体像を光電変換し、得られたアナログ信号Vaをデジタル信号に変換して出力する。撮像素子100は、画素部110、垂直走査部120、アナログ−デジタル変換部(AD変換部)130、列メモリ140、水平走査部150、デジタルフロントエンド部(DFE)160、及びタイミング生成部(TG)170を有する。
次に、本発明の第2の実施形態について説明する。以下では、第2の実施形態において、前述した第1の実施形態と異なる点についてのみ説明する。図8は、第2の実施形態における列メモリ140及びDFE160の構成例を示すブロック図である。図8において、図3に示した構成要素と同一の機能を有する構成要素には同一の符号を付し、重複する説明は省略する。図8に示すように、第2の実施形態におけるDFE160は、ビットシフト部161、セレクタ162、及び減算部163に加え、信号補正部164及びセレクタ165を有する。
Db=(Da−α)×4×β …(1)
Dd=(Dc−α)×4×β …(2)
これら式(1)、(2)から、以下の式(3)、(4)が導き出される。
β=(Dd−Db)/(4×(Dc−Da)) …(3)
α=Dc−(Dd/(4×β)) …(4)
補正後のS信号データ=(Ds1−α)×β …(5)
以上が本実施形態における信号補正部164の補正処理についての説明である。なお、α及びβの値は、予め算出しておき、撮像素子100の内部又は外部の記憶部に記憶させておくようにしてもよい。
Dj=1の場合:Ds2=(Ds1−α)×β …(6)
Dj=0の場合:Ds2=Ds1 …(7)
本発明は、前述の実施形態の1以上の機能を実現するプログラムを、ネットワーク又は記憶媒体を介してシステム又は装置に供給し、そのシステム又は装置のコンピュータにおける1つ以上のプロセッサがプログラムを読み出し実行する処理でも実現可能である。また、1以上の機能を実現する回路(例えば、ASIC)によっても実現可能である。
Claims (12)
- 第1のアナログ信号及び第2のアナログ信号を出力する画素が複数配置された画素部と、
前記第1のアナログ信号を第1の分解能でアナログ−デジタル変換処理して第1のデジタル信号を出力するとともに、前記第2のアナログ信号の信号レベルが所定のレベルより小さい場合には前記第2のアナログ信号を前記第1の分解能でアナログ−デジタル変換処理して第2のデジタル信号を出力し、前記第2のアナログ信号の信号レベルが前記所定のレベルより大きい場合には前記第2のアナログ信号を前記第1の分解能より低い第2の分解能でアナログ−デジタル変換処理して前記第2のデジタル信号を出力するアナログ−デジタル変換部と、
前記第1のデジタル信号を、前記第2の分解能に合わせてビットシフトすることでデジタルゲイン処理を行うビットシフト部とを有することを特徴とする撮像素子。 - 前記第2のアナログ信号の信号レベルが前記所定のレベルより小さい場合には前記アナログ−デジタル変換部でアナログ−デジタル変換処理して得られた前記第1のデジタル信号を選択して出力し、前記第2のアナログ信号の信号レベルが前記所定のレベルより大きい場合には前記ビットシフト部でデジタルゲイン処理された第1のデジタル信号を選択して出力するセレクタを有することを特徴とする請求項1記載の撮像素子。
- 前記第2のアナログ信号の信号レベルが前記所定のレベルより小さい場合には前記第2のデジタル信号から前記アナログ−デジタル変換部でアナログ−デジタル変換処理して得られた前記第1のデジタル信号を減算した第3のデジタル信号を出力し、前記第2のアナログ信号の信号レベルが前記所定のレベルより大きい場合には前記第2のデジタル信号から前記ビットシフト部でデジタルゲイン処理された前記第1のデジタル信号を減算した第3のデジタル信号を出力する減算部を有することを特徴とする請求項1又は2記載の撮像素子。
- 前記第3のデジタル信号に、前記第2のアナログ信号の信号レベルが前記所定のレベルより大きいか小さいかを示す1ビットの判定値を付加した第4のデジタル信号を外部に出力することを特徴とする請求項3記載の撮像素子。
- 前記第2の分解能は、前記第1の分解能の略2N分の1倍(Nは2以上の整数)倍の分解能であり、
前記ビットシフト部は、前記第1のデジタル信号を下位ビット側にNビットシフトすることを特徴とする請求項1〜4の何れか1項に記載の撮像素子。 - 前記第2の分解能は、前記第1の分解能の略4分の1倍以下の分解能であることを特徴とする請求項1〜4の何れか1項に記載の撮像素子。
- 前記アナログ−デジタル変換部でアナログ−デジタル変換処理して得られた前記第1のデジタル信号及び前記第2のデジタル信号の少なくとも一方に対して、前記アナログ−デジタル変換処理の誤差を補正する信号補正部を有することを特徴とする請求項1〜6の何れか1項に記載の撮像素子。
- 前記第1のアナログ信号は、前記画素のリセットノイズ出力に基づく信号であり、
前記第2のアナログ信号は、前記画素の信号電荷転送後の出力に基づく信号であることを特徴とする請求項1〜7の何れか1項に記載の撮像素子。 - 請求項4記載の撮像素子と、
前記第4のデジタル信号を受けて、付加されている前記判定値に応じて、前記第4のデジタル信号に含まれる前記第3のデジタル信号をデジタルゲイン処理するデータ伸張部とを有する撮像装置。 - 前記データ伸張部は、前記判定値が前記第2のアナログ信号の信号レベルが前記所定のレベルより大きいことを示す場合、前記第4のデジタル信号に含まれる前記第3のデジタル信号をデジタルゲイン処理することを特徴とする請求項9記載の撮像装置。
- 前記データ伸張部は、前記判定値に応じて、前記第4のデジタル信号に含まれる前記第3のデジタル信号の上位ビット側又は下位ビット側にダミーデータを付加することを特徴とする請求項9記載の撮像装置。
- 第1のアナログ信号及び第2のアナログ信号を出力する画素が複数配置された画素部を有する撮像素子の信号処理方法であって、
前記第1のアナログ信号を第1の分解能でアナログ−デジタル変換処理して第1のデジタル信号を出力する工程と、
前記第2のアナログ信号の信号レベルが所定のレベルより小さい場合には前記第2のアナログ信号を前記第1の分解能でアナログ−デジタル変換処理して第2のデジタル信号を出力し、前記第2のアナログ信号の信号レベルが前記所定のレベルより大きい場合には前記第2のアナログ信号を前記第1の分解能より低い第2の分解能でアナログ−デジタル変換処理して前記第2のデジタル信号を出力する工程と、
前記第1のデジタル信号を、前記第2の分解能に合わせてビットシフトすることでデジタルゲイン処理を行う工程とを有することを特徴とする信号処理方法。
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