JP2017208976A - Interleave converter - Google Patents
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Abstract
Description
本発明は、インターリーブコンバータに関する。 The present invention relates to an interleaved converter.
従来より、複数相（例えば２相）のスイッチング出力段を所定の位相差（２相であれば位相差１８０°）で駆動することにより、入力電圧から所望の出力電圧を生成するインターリーブコンバータ（マルチフェイズコンバータ）が提案されている。 Conventionally, an interleaved converter (multi-phase) that generates a desired output voltage from an input voltage by driving a switching output stage of a plurality of phases (for example, two phases) with a predetermined phase difference (180 ° for two phases). Phase converters have been proposed.
また、従来のインターリーブコンバータには、各相の電流に不均衡が生じないように、電流平衡制御を行うものもある。 In addition, some conventional interleaved converters perform current balance control so that no imbalance occurs in the current of each phase.
なお、上記に関連する従来技術の一例としては、特許文献１を挙げることができる。 As an example of the related art related to the above, Patent Document 1 can be cited.
しかしながら、従来のインターリーブコンバータでは、上記の電流平衡制御について、更なる改良（各相の電流に差がない場合の挙動改善）を図る余地があった。 However, the conventional interleaved converter has room for further improvement (the behavior improvement when there is no difference in the current of each phase) with respect to the current balance control.
本明細書中に開示されている発明は、本願の発明者らにより見出された上記の課題に鑑み、より好ましい電流平衡制御を実現することのできるインターリーブコンバータを提供することを目的とする。 An object of the invention disclosed in the present specification is to provide an interleaved converter capable of realizing more preferable current balance control in view of the above-mentioned problems found by the inventors of the present application.
本明細書中に開示されているインターリーブコンバータの制御装置は、複数相の出力段を所定の位相差で駆動することにより入力電圧から出力電圧を生成するインターリーブコンバータの制御主体であり、各相の出力段に流れる電流をそれぞれ検出して各相の電流帰還制御を行う複数の電流帰還制御部と、各相の出力段に流れる電流の平均値を用いて各相の電流帰還制御部をそれぞれ調整する電流平衡制御部と、を有する構成（第１の構成）とされている。 A control device for an interleaved converter disclosed in the present specification is a control main body of an interleaved converter that generates an output voltage from an input voltage by driving a plurality of output stages with a predetermined phase difference. Multiple current feedback control units that detect the current flowing through the output stage and perform current feedback control for each phase, and adjust the current feedback control unit for each phase using the average value of the current flowing through the output stage of each phase A current balance control unit (first configuration).
なお、上記第１の構成から成る制御装置は、前記出力電圧を検出して電圧帰還制御を行う電圧帰還制御部をさらに有する構成（第２の構成）にするとよい。 The control device having the first configuration may have a configuration (second configuration) further including a voltage feedback control unit that detects the output voltage and performs voltage feedback control.
また、上記第２の構成から成る制御装置において、前記電圧帰還制御部は、前記出力電圧またはこれに応じた帰還電圧と所定の参照電圧との差分に応じた電圧帰還信号を生成する制御器と、前記電圧帰還信号に応じて各相の出力段をそれぞれ駆動する複数の駆動部とを含む構成（第３の構成）にするとよい。 Further, in the control device having the second configuration, the voltage feedback control unit includes a controller that generates a voltage feedback signal according to a difference between the output voltage or a feedback voltage corresponding thereto and a predetermined reference voltage; A configuration (third configuration) including a plurality of drive units that respectively drive the output stages of the respective phases in accordance with the voltage feedback signal is preferable.
また、上記第３の構成から成る制御装置において、前記複数の電流帰還制御部はそれぞれ、対応する相の出力段に流れる電流を検出して電流検出信号を生成する電流検出部と、前記電流検出信号を増幅して電流帰還信号を生成する増幅器と、前記電圧帰還信号またはこれと比較されるスロープ信号を前記電流帰還信号に応じて調整する第１信号調整部と、を含む構成（第４の構成）にするとよい。 Further, in the control device having the third configuration, each of the plurality of current feedback control units detects a current flowing through an output stage of a corresponding phase and generates a current detection signal; and the current detection unit An amplifier that amplifies a signal to generate a current feedback signal, and a first signal adjustment unit that adjusts the voltage feedback signal or a slope signal compared with the voltage feedback signal according to the current feedback signal (fourth configuration) Configuration).
また、上記第４の構成から成る制御装置において、前記電流平衡制御部は、各相の電流帰還信号を平均して平均電流帰還信号を生成する平均部と、各相の電流帰還信号と前記平均電流帰還信号との差分を取って各相の差分電流帰還信号を生成する複数の減算器と、各相の差分電流帰還信号それぞれの位相を補償して各相の電流平衡信号を生成する複数の補償器と、各相の電流帰還信号を各相の電流平衡信号に応じて調整する複数の第２信号調整部と、を含む構成（第５の構成）にするとよい。 In the control device having the fourth configuration, the current balance control unit includes an averaging unit that averages current feedback signals of the phases to generate an average current feedback signal, current feedback signals of the phases, and the average A plurality of subtractors that generate a difference current feedback signal of each phase by taking a difference from the current feedback signal, and a plurality of subtractors that generate a current balance signal of each phase by compensating the phase of each phase difference current feedback signal A configuration (fifth configuration) including a compensator and a plurality of second signal adjustment units that adjust the current feedback signal of each phase in accordance with the current balance signal of each phase is preferable.
また、上記第１〜第５いずれかの構成から成る制御装置において、前記出力段の相数はｎ（ただしｎは２以上の整数）であり、前記位相差は３６０°／ｎである構成（第６の構成）にするとよい。 In the control device having any one of the first to fifth configurations, the number of phases of the output stage is n (where n is an integer of 2 or more), and the phase difference is 360 ° / n ( A sixth configuration) may be used.
また、本明細書中に開示されているインターリーブコンバータは、複数相の出力段と、請求項１〜請求項６のいずれか一項に記載の制御装置と、を有し、各相の出力段を所定の位相差で駆動することにより入力電圧から出力電圧を生成する構成（第７の構成）とされている。 Further, an interleaved converter disclosed in the present specification includes a plurality of phases of output stages and the control device according to any one of claims 1 to 6, and each phase of the output stages. Is driven with a predetermined phase difference to generate an output voltage from the input voltage (seventh configuration).
なお、上記第７の構成から成るインターリーブコンバータにおいて、各相の出力段は、それぞれ、昇圧型、降圧型、昇降圧型、または、反転型である構成（第８の構成）にするとよい。 In the interleaved converter having the seventh configuration, the output stage of each phase may be configured to be a step-up type, a step-down type, a step-up / down type, or an inversion type (eighth configuration).
また、上記第７または第８の構成から成るインターリーブコンバータは、前記出力電圧に応じた帰還電圧を生成して前記制御装置に出力する帰還電圧生成部をさらに有する構成（第９の構成）にするとよい。 The interleaved converter having the seventh or eighth configuration may further include a feedback voltage generation unit that generates a feedback voltage corresponding to the output voltage and outputs the feedback voltage to the control device (a ninth configuration). Good.
また、本明細書中に開示されている機器は、電源手段として、上記第７〜第９いずれかの構成から成るインターリーブコンバータを有する構成（第１０の構成）とされている。 Further, the device disclosed in the present specification has a configuration (tenth configuration) having an interleaved converter having any one of the seventh to ninth configurations as a power supply means.
本明細書中に開示されている発明によれば、より好ましい電流平衡制御を実現することのできるインターリーブコンバータを提供することが可能となる。 According to the invention disclosed in the present specification, it is possible to provide an interleaved converter that can realize more preferable current balance control.
＜インターリーブコンバータ＞
図１は、インターリーブコンバータの一構成例（特にその出力段周辺）を示す回路ブロック図である。本構成例のインターリーブコンバータ１は、２相昇圧型のインターリーブＤＣ／ＤＣコンバータであり、その出力段周辺の構成要素として、出力トランジスタＴｒ１及びＴｒ２と、インダクタＬ１及びＬ２と、整流ダイオードＤ１及びＤ２と、出力キャパシタＣｏと、制御装置１０と、を有する。
<Interleaved converter>
FIG. 1 is a circuit block diagram showing a configuration example (especially around the output stage) of an interleaved converter. The interleaved converter 1 of this configuration example is a two-phase step-up type interleaved DC / DC converter, and output transistors Tr1 and Tr2, inductors L1 and L2, rectifier diodes D1 and D2, The output capacitor Co and the control device 10 are included.
インダクタＬ１の第１端は、ライン抵抗ＲＬ１を介して入力電圧Ｖｉの入力端に接続されている。インダクタＬ１の第２端は、出力トランジスタＴｒ１のドレインと整流ダイオードＤ１のアノードに接続されている。出力トランジスタＴｒ１のソースとバックゲートは、いずれも基準電位端（例えば接地端）に接続されている。出力トランジスタＴｒ１のドレイン・ソース間には、図示の極性でボディダイオードＢＤ１が接続されている。出力トランジスタＴｒ１のゲートは、制御装置１０に接続されている。整流ダイオードＤ１のカソードは、出力電圧Ｖｏの出力端に接続されている。 The first end of the inductor L1 is connected to the input end of the input voltage Vi through the line resistor RL1. The second end of the inductor L1 is connected to the drain of the output transistor Tr1 and the anode of the rectifier diode D1. The source and back gate of the output transistor Tr1 are both connected to a reference potential terminal (for example, a ground terminal). A body diode BD1 is connected between the drain and source of the output transistor Tr1 with the polarity shown. The gate of the output transistor Tr1 is connected to the control device 10. The cathode of the rectifier diode D1 is connected to the output terminal of the output voltage Vo.
インダクタＬ２の第１端は、ライン抵抗ＲＬ２を介して入力電圧Ｖｉの入力端に接続されている。インダクタＬ２の第２端は、出力トランジスタＴｒ２のドレインと整流ダイオードＤ２のアノードに接続されている。出力トランジスタＴｒ２のソースとバックゲートは、いずれも基準電位端に接続されている。出力トランジスタＴｒ２のドレイン・ソース間には、図示の極性でボディダイオードＢＤ２が接続されている。出力トランジスタＴｒ２のゲートは、制御装置１０に接続されている。整流ダイオードＤ２のカソードは、出力電圧Ｖｏの出力端に接続されている。 The first end of the inductor L2 is connected to the input end of the input voltage Vi through the line resistor RL2. The second end of the inductor L2 is connected to the drain of the output transistor Tr2 and the anode of the rectifier diode D2. The source and back gate of the output transistor Tr2 are both connected to the reference potential terminal. A body diode BD2 is connected between the drain and source of the output transistor Tr2 with the polarity shown. The gate of the output transistor Tr2 is connected to the control device 10. The cathode of the rectifier diode D2 is connected to the output terminal of the output voltage Vo.
出力キャパシタＣｏは、出力電圧Ｖｏの出力端と基準電位端との間に接続されている。なお、出力キャパシタＣｏには、等価直列抵抗ＲＣが付随している。 The output capacitor Co is connected between the output terminal of the output voltage Vo and the reference potential terminal. The output capacitor Co is accompanied by an equivalent series resistance RC.
上記構成要素のうち、出力トランジスタＴｒ１とインダクタＬ１は、入力電圧Ｖｉから矩形波状のスイッチ電圧Ｖｏ１を生成する第１相の出力段として機能する。また、出力トランジスタＴｒ２とインダクタＬ２は、入力電圧Ｖｉから矩形波状のスイッチ電圧Ｖｏ２を生成する第２相の出力段として機能する。一方、整流ダイオードＤ１及びＤ２は、スイッチ電圧Ｖｏ１及びＶｏ２を足し合わせる出力加算部（出力整流部）として機能する。また、出力キャパシタＣｏは、ダイオードＤ１及びＤ２の加算出力を平滑化して最終的な出力電圧Ｖｏを生成する出力平滑部として機能する。 Among the above components, the output transistor Tr1 and the inductor L1 function as a first-phase output stage that generates a rectangular-wave-like switch voltage Vo1 from the input voltage Vi. The output transistor Tr2 and the inductor L2 function as a second-phase output stage that generates a rectangular-wave switch voltage Vo2 from the input voltage Vi. On the other hand, the rectifier diodes D1 and D2 function as an output adder (output rectifier) that adds the switch voltages Vo1 and Vo2. The output capacitor Co functions as an output smoothing unit that smoothes the sum output of the diodes D1 and D2 and generates the final output voltage Vo.
なお、本図では、各相の出力段を昇圧型とした例を挙げたが、その出力形式はこれに限定されるものではなく、各相の出力段を降圧型、昇降圧型、若しくは、反転型としてもよい。また、整流ダイオードＤ１及びＤ２に代えて、出力トランジスタＴｒ１及びＴｒ２と相補的にオン／オフされる同期整流トランジスタを用いることも可能である。 In this figure, an example in which the output stage of each phase is a boost type is given, but the output format is not limited to this, and the output stage of each phase is a step-down type, a step-up / step-down type, or an inversion type. It is good also as a type. In place of the rectifier diodes D1 and D2, a synchronous rectifier transistor that is turned on / off complementarily to the output transistors Tr1 and Tr2 can be used.
制御装置１０は、インターリーブコンバータ１の制御主体（いわゆる電源コントローラＩＣ）であり、入力電圧Ｖｉから所望の出力電圧Ｖｏを生成する際に、各相の出力段を所定の位相差で駆動する。本図の構成例に即して述べると、制御装置１０は、２相の出力段（具体的には出力トランジスタＴｒ１及びＴｒ２）を１８０°の位相差で駆動する。このようなインターリーブ制御を行うことにより、インダクタＬ１及びＬ２にそれぞれ流れるインダクタ電流ＩＬ１及びＩＬ２のリップル成分を互いに打ち消し合うことができる。従って、スイッチングノイズの低減や出力キャパシタＣｏのストレス軽減などを実現することが可能となる。 The control device 10 is a control subject (so-called power supply controller IC) of the interleaved converter 1, and drives the output stage of each phase with a predetermined phase difference when generating a desired output voltage Vo from the input voltage Vi. When described in accordance with the configuration example of this figure, the control device 10 drives the two-phase output stage (specifically, the output transistors Tr1 and Tr2) with a phase difference of 180 °. By performing such interleave control, the ripple components of the inductor currents IL1 and IL2 flowing in the inductors L1 and L2, respectively, can be canceled out. Accordingly, it is possible to realize switching noise reduction and stress reduction of the output capacitor Co.
なお、本図では、出力段の相数を２とした例を挙げたが、出力段の相数は何らこれに限定されるものではなく、３以上としても構わない。これを踏まえて、インターリーブ制御の位相差について一般化すると、出力段の相数がｎ（ただしｎは２以上の整数）であるときには、上記の位相差を３６０°／ｎとすることが望ましい。 In this figure, an example in which the number of phases of the output stage is 2 is given, but the number of phases of the output stage is not limited to this, and may be 3 or more. Based on this, the phase difference of the interleave control is generalized. When the number of phases of the output stage is n (where n is an integer of 2 or more), the above phase difference is preferably set to 360 ° / n.
次に、制御装置１０の構成と動作について詳述する。ただし、以下では、制御装置１０の実施形態について詳細な説明を行う前に、その技術的意義がより明確となるように、いくつかの参考例を挙げて簡単に説明しておく。 Next, the configuration and operation of the control device 10 will be described in detail. However, in the following, before a detailed description of the embodiment of the control device 10, a brief description will be given with some reference examples so that the technical significance of the embodiment will be clearer.
＜制御装置（第１参考例）＞
図２は、インターリーブコンバータ１（特に制御装置１０）の第１参考例を示すブロック線図である。本参考例のインターリーブコンバータ１は、出力段１０１Ａ及び１０１Ｂと、出力加算部１０２と、出力平滑部１０３と、帰還電圧生成部１０４と、差分入力部１０５と、制御器１０６と、駆動部１０７Ａ及び１０７Ｂと、電流検出部１０８Ａ及び１０８Ｂと、増幅器１０９Ａ及び１０９Ｂと、信号調整部１１０Ａ及び１１０Ｂとを有する。
<Control device (first reference example)>
FIG. 2 is a block diagram showing a first reference example of the interleaved converter 1 (particularly the control device 10). The interleaved converter 1 of this reference example includes an output stage 101A and 101B, an output adder 102, an output smoother 103, a feedback voltage generator 104, a difference input unit 105, a controller 106, a drive unit 107A, 107B, current detection units 108A and 108B, amplifiers 109A and 109B, and signal adjustment units 110A and 110B.
なお、上記構成要素のうち、例えば、差分入力部１０５、制御器１０６、駆動部１０７Ａ及び１０７Ｂ、電流検出部１０８Ａ及び１０８Ａ、増幅器１０９Ａ及び１０９Ｂ、並びに、信号調整部１１０Ａ及び１１０Ｂは、制御装置１０に含めておくとよい。ただし、出力段１０１Ａ及び１０１Ｂや帰還電圧生成部１０４を制御装置１０に含めたり、逆に、電流検出部１０８Ａ及び１０８Ｂを制御装置１０に含めないようにすることも任意である。 Among the above components, for example, the difference input unit 105, the controller 106, the drive units 107A and 107B, the current detection units 108A and 108A, the amplifiers 109A and 109B, and the signal adjustment units 110A and 110B are included in the control device 10. Should be included. However, the output stages 101A and 101B and the feedback voltage generation unit 104 may be included in the control device 10, or conversely, the current detection units 108A and 108B may not be included in the control device 10.
出力段１０１Ａ（伝達関数：Ｇｖｄ（ｓ））は、駆動信号Ｓ１２Ａに応じて矩形波状のスイッチ電圧Ｖｏ１を生成するパワー部である。出力段１０１Ａとしては、図１の出力トランジスタＴｒ１及びインダクタＬ１がこれに相当する。 The output stage 101A (transfer function: Gvd (s)) is a power unit that generates a rectangular wave switch voltage Vo1 in accordance with the drive signal S12A. The output stage 101A corresponds to the output transistor Tr1 and the inductor L1 in FIG.
出力段１０１Ｂ（伝達関数：Ｇｖｄ（ｓ））は、駆動信号Ｓ１２Ｂに応じて矩形波状のスイッチ電圧Ｖｏ２を生成するパワー部である。出力段１０１Ｂとしては、図１の出力トランジスタＴｒ２及びインダクタＬ２がこれに相当する。 The output stage 101B (transfer function: Gvd (s)) is a power unit that generates a rectangular wave switch voltage Vo2 in accordance with the drive signal S12B. The output stage 101B corresponds to the output transistor Tr2 and the inductor L2 in FIG.
出力加算部１０２は、スイッチ電圧Ｖｏ１及びＶｏ２をそれぞれ足し合わせて出力平滑部１０３に出力する。出力加算部１０２としては、図１の整流ダイオードＤ１及びＤ２がこれに相当する。 The output adding unit 102 adds the switch voltages Vo1 and Vo2 and outputs the sum to the output smoothing unit 103. The output adder 102 corresponds to the rectifier diodes D1 and D2 in FIG.
出力平滑部１０３は、ダイオードＤ１及びＤ２の加算出力を平滑化して出力電圧Ｖｏを生成する。出力平滑部１０３としては、図１の出力キャパシタＣｏがこれに相当する。 The output smoothing unit 103 smoothes the added output of the diodes D1 and D2, and generates an output voltage Vo. The output smoothing unit 103 corresponds to the output capacitor Co in FIG.
帰還電圧生成部１０４（ゲイン：Ｋｖ）は、出力電圧Ｖｏに応じた帰還電圧Ｖｆｂを生成して制御装置１０に出力する。なお、帰還電圧生成部１０４としては、例えば、出力電圧Ｖｏを分圧して帰還電圧Ｖｆｂを生成する抵抗分圧回路がこれに相当する。ただし、出力電圧Ｖｏが制御装置１０の入力ダイナミックレンジに収まっている場合には、帰還電圧生成部１０４を省略し、出力電圧Ｖｏを制御装置１０に直接入力することも可能である。 The feedback voltage generation unit 104 (gain: Kv) generates a feedback voltage Vfb corresponding to the output voltage Vo and outputs it to the control device 10. Note that the feedback voltage generation unit 104 corresponds to, for example, a resistance voltage dividing circuit that divides the output voltage Vo to generate the feedback voltage Vfb. However, when the output voltage Vo is within the input dynamic range of the control device 10, the feedback voltage generation unit 104 can be omitted and the output voltage Vo can be directly input to the control device 10.
差分入力部１０５は、帰還電圧Ｖｆｂと所定の参照電圧Ｖｒｅｆとの差分信号を制御器１０６に出力する。 The difference input unit 105 outputs a difference signal between the feedback voltage Vfb and a predetermined reference voltage Vref to the controller 106.
制御器１０６（伝達関数：Ｇｃｖ（ｓ））は、差分入力部１０５から入力される差分信号に応じた電圧帰還信号Ｓ１０を生成する。 The controller 106 (transfer function: Gcv (s)) generates a voltage feedback signal S10 corresponding to the difference signal input from the difference input unit 105.
なお、差分入力部１０５及び制御器１０６としては、例えば、エラーアンプや位相補償回路がこれに相当する。 As the difference input unit 105 and the controller 106, for example, an error amplifier or a phase compensation circuit corresponds to this.
駆動部１０７Ａ（伝達関数：Ｆｍ）は、制御信号Ｓ１１Ａ（＝電流帰還信号Ｓ１４Ａによる調整済みの電圧帰還信号Ｓ１０に相当）に応じて駆動信号Ｓ１２Ａを生成する。駆動部１０７Ａとしては、例えば、制御信号Ｓ１１Ａに応じたオンデューティ（＝一周期に占めるオン期間の割合）のパルス幅変調信号を生成するＰＷＭ［pulse width modulation］発生回路がこれに相当する。 The drive unit 107A (transfer function: Fm) generates the drive signal S12A according to the control signal S11A (= corresponding to the adjusted voltage feedback signal S10 by the current feedback signal S14A). As the drive unit 107A, for example, a PWM [pulse width modulation] generation circuit that generates a pulse width modulation signal having an on-duty (= a ratio of an on period in one cycle) according to the control signal S11A corresponds to this.
駆動部１０７Ｂ（伝達関数：Ｆｍ）は、制御信号Ｓ１１Ｂ（＝電流帰還信号Ｓ１４Ｂによる調整済みの電圧帰還信号Ｓ１０に相当）に応じて駆動信号Ｓ１２Ｂを生成する。駆動部１０７Ｂとしては、例えば、制御信号Ｓ１１Ｂに応じたオンデューティのパルス幅変調信号を生成するＰＷＭ発生回路がこれに相当する。 The drive unit 107B (transfer function: Fm) generates the drive signal S12B according to the control signal S11B (= corresponding to the adjusted voltage feedback signal S10 by the current feedback signal S14B). As the drive unit 107B, for example, a PWM generation circuit that generates an on-duty pulse width modulation signal corresponding to the control signal S11B corresponds to this.
なお、上記構成要素のうち、差分入力部１０５、制御器１０６、並びに、駆動部１０７Ａ及び１０７Ｂは、出力電圧Ｖｏ（ないしは帰還電圧Ｖｆｂ）を検出して電圧帰還制御を行う電圧帰還制御部として機能する。 Among the above components, the differential input unit 105, the controller 106, and the drive units 107A and 107B function as a voltage feedback control unit that detects the output voltage Vo (or the feedback voltage Vfb) and performs voltage feedback control. To do.
電流検出部１０８Ａ（伝達関数：Ｇｉｄ（ｓ））は、駆動信号Ｓ１２Ａに応じて電流検出信号Ｓ１３Ａを生成する。電流検出部１０８Ａとしては、例えば、インダクタ電流ＩＬ１を電流／電圧変換するセンス抵抗がこれに相当する。 The current detection unit 108A (transfer function: Gid (s)) generates a current detection signal S13A according to the drive signal S12A. As the current detection unit 108A, for example, a sense resistor that performs current / voltage conversion of the inductor current IL1 corresponds to this.
電流検出部１０８Ｂ（伝達関数：Ｇｉｄ（ｓ））は、駆動信号Ｓ１２Ｂに応じて電流検出信号Ｓ１３Ｂを生成する。電流検出部１０８Ｂとしては、例えば、インダクタ電流ＩＬ２を電流／電圧変換するセンス抵抗がこれに相当する。 The current detection unit 108B (transfer function: Gid (s)) generates a current detection signal S13B according to the drive signal S12B. As the current detection unit 108B, for example, a sense resistor that performs current / voltage conversion of the inductor current IL2 corresponds to this.
増幅器１０９Ａ（ゲイン：Ｋｉ）は、電流検出信号Ｓ１３Ａを増幅して電流帰還信号Ｓ１４Ａを生成する。 The amplifier 109A (gain: Ki) amplifies the current detection signal S13A and generates a current feedback signal S14A.
増幅器１０９Ｂ（ゲイン：Ｋｉ）は、電流検出信号Ｓ１３Ｂを増幅して電流帰還信号Ｓ１４Ｂを生成する。 The amplifier 109B (gain: Ki) amplifies the current detection signal S13B to generate a current feedback signal S14B.
信号調整部１１０Ａは、電流帰還信号Ｓ１４Ａに応じて電圧帰還信号Ｓ１０を調整することにより、制御信号Ｓ１１Ａを生成する。信号調整部１１０Ａとしては、例えば、電圧帰還信号Ｓ１０から電流帰還信号Ｓ１４Ａを差し引いて制御信号Ｓ１１Ａを生成する減算器がこれに相当する。 The signal adjustment unit 110A generates the control signal S11A by adjusting the voltage feedback signal S10 according to the current feedback signal S14A. As the signal adjusting unit 110A, for example, a subtractor that subtracts the current feedback signal S14A from the voltage feedback signal S10 to generate the control signal S11A corresponds to this.
信号調整部１１０Ｂは、電流帰還信号Ｓ１４Ｂに応じて電圧帰還信号Ｓ１０を調整することにより、制御信号Ｓ１１Ａを生成する。信号調整部１１０Ｂとしては、例えば、電圧帰還信号Ｓ１０から電流帰還信号Ｓ１４Ｂを差し引いて制御信号Ｓ１１Ｂを生成する減算器がこれに相当する。 The signal adjustment unit 110B generates the control signal S11A by adjusting the voltage feedback signal S10 according to the current feedback signal S14B. As the signal adjustment unit 110B, for example, a subtractor that subtracts the current feedback signal S14B from the voltage feedback signal S10 to generate the control signal S11B corresponds to this.
なお、上記構成要素のうち、電流検出部１０８Ａ、増幅器１０９Ａ、及び、信号調整部１１０Ａは、インダクタ電流ＩＬ１を検出して第１相の電流帰還制御を行う第１の電流帰還制御部として機能する。また、上記構成要素のうち、電流検出部１０８Ｂ、増幅器１０９Ｂ、及び、信号調整部１１０Ｂは、インダクタ電流ＩＬ２を検出して第２相の電流帰還制御を行う第２の電流帰還制御部として機能する。 Of the above components, the current detection unit 108A, the amplifier 109A, and the signal adjustment unit 110A function as a first current feedback control unit that detects the inductor current IL1 and performs first-phase current feedback control. . Among the above components, the current detection unit 108B, the amplifier 109B, and the signal adjustment unit 110B function as a second current feedback control unit that detects the inductor current IL2 and performs second-phase current feedback control. .
上記構成から成る第１参考例の制御装置１０では、各相共通の電圧モード制御が行われると共に、各相独立の電流モード制御が行われる。 In the control device 10 of the first reference example configured as described above, voltage mode control common to each phase is performed, and current mode control independent of each phase is performed.
図３は、第１参考例におけるインダクタ電流ＩＬ１及びＩＬ２のシミュレーション波形図である。なお、シミュレーション回路（先出の図１を参照）の回路定数については、入力電圧Ｖｉ＝１２Ｖ、出力電圧Ｖｏ＝４８Ｖ、出力電流Ｉｏ＝１０．４２Ａまたは２０．８４Ａ、出力電力Ｐｏ＝５００Ｗまたは１ｋＷ、自己インダクタンスＬ１及びＬ２＝７．２μＨ、直流ライン抵抗ＲＬ１、ＲＬ２＝５ｍΩ、２０ｍΩ、出力キャパシタンスＣｏ＝５００μＦ、等価直列抵抗ＲＣ＝３０ｍΩ、並びに、スイッチング周波数ｆｓ＝２００ｋＨｚであるものとする。また、図４は、図３における領域αの拡大図である。 FIG. 3 is a simulation waveform diagram of the inductor currents IL1 and IL2 in the first reference example. The circuit constants of the simulation circuit (see FIG. 1 above) are as follows: input voltage Vi = 12V, output voltage Vo = 48V, output current Io = 10.42A or 20.84A, output power Po = 500W or 1kW , Self inductances L1 and L2 = 7.2 μH, DC line resistance RL1, RL2 = 5 mΩ, 20 mΩ, output capacitance Co = 500 μF, equivalent series resistance RC = 30 mΩ, and switching frequency fs = 200 kHz. 4 is an enlarged view of a region α in FIG.
第１参考例の制御装置１０であれば、出力電圧Ｖｏに応じた電圧帰還制御だけでなく、インダクタ電流ＩＬ１及びＩＬ２に応じた電流帰還制御が行われるので、電圧帰還制御のみを行う構成と比べて、出力帰還制御の安定性を向上することが可能である。 In the control device 10 of the first reference example, not only voltage feedback control according to the output voltage Vo but also current feedback control according to the inductor currents IL1 and IL2 is performed. Thus, it is possible to improve the stability of the output feedback control.
また、電圧帰還ループと電流帰還ループの双方を有する構成であれば、電圧帰還ループの二次遅れ系と電流帰還ループの二次遅れ系を相殺することができる。従って、電圧帰還ループの二次遅れ系に特有の共振ピークが減るので、位相の遅れが緩やかとなる。その結果、電圧帰還ループのみを有する構成と比べて、出力電流Ｉｏ（延いてはインダクタ電流ＩＬ１及びＩＬ２）が急変しても、意図しないオーバーシュートまたはアンダーシュートを生じにくくなる。 In addition, if the configuration has both the voltage feedback loop and the current feedback loop, the secondary delay system of the voltage feedback loop and the secondary delay system of the current feedback loop can be offset. Therefore, the resonance peak peculiar to the secondary delay system of the voltage feedback loop is reduced, and the phase delay becomes gradual. As a result, compared to a configuration having only a voltage feedback loop, even if the output current Io (and thus the inductor currents IL1 and IL2) changes suddenly, it is difficult to cause unintended overshoot or undershoot.
しかしながら、第１参考例の制御装置１０では、インダクタ電流ＩＬ１及びＩＬ２に応じた各相の電流帰還制御がそれぞれ独立に実施されている。すなわち、各相の電流帰還制御には、インダクタ電流ＩＬ１及びＩＬ２相互間の偏差が何ら反映されていない。そのため、電流検出部１０８Ａ及び１０８Ｂの検出精度にばらつきがあったり、出力段１０１Ａ及び１０１Ｂの回路定数（例えば直流ライン抵抗ＲＬ１及びＲＬ２）にばらつきがあったりすると、インダクタ電流ＩＬ１及びＩＬ２に不均衡（定常偏差）を生じてしまう。 However, in the control device 10 of the first reference example, the current feedback control of each phase according to the inductor currents IL1 and IL2 is performed independently. That is, the current feedback control of each phase does not reflect any deviation between the inductor currents IL1 and IL2. Therefore, if the detection accuracy of the current detection units 108A and 108B varies, or if the circuit constants of the output stages 101A and 101B (for example, the DC line resistances RL1 and RL2) vary, the inductor currents IL1 and IL2 are unbalanced ( Steady deviation) occurs.
＜制御装置（第２参考例）＞
図５は、インターリーブコンバータ１（特に制御装置１０）の第２参考例を示すブロック線図である。本参考例のインターリーブコンバータ１は、インダクタ電流ＩＬ１及びＩＬ２の不均衡（定常偏差）を解消すべく、第１参考例（図２）の構成要素に加えて、さらに、減算器１１１と補償器１１２を有する。なお、これらの構成要素は、制御装置１０に含めるとよい。
<Control device (second reference example)>
FIG. 5 is a block diagram showing a second reference example of the interleaved converter 1 (particularly the control device 10). In addition to the components of the first reference example (FIG. 2), the interleaved converter 1 of this reference example further eliminates an imbalance (steady deviation) between the inductor currents IL1 and IL2, and further includes a subtractor 111 and a compensator 112. Have Note that these components may be included in the control device 10.
減算器１１１は、電流帰還信号Ｓ１４Ａと電流帰還信号Ｓ１４Ｂとの差分を取って差分電流帰還信号Ｓ１５（＝Ｓ１４Ａ−Ｓ１４Ｂ）を生成する。 The subtractor 111 takes the difference between the current feedback signal S14A and the current feedback signal S14B to generate a differential current feedback signal S15 (= S14A−S14B).
補償器１１２（伝達関数：Ｃｉ（ｓ））は、差分電流帰還信号Ｓ１５の位相を補償して電流平衡信号Ｓ１６を生成する。電流平衡信号Ｓ１６は、図２の電流帰還信号Ｓ１４Ａ及びＳ１４Ｂに代えて、信号調整部１１０Ａ及び１１０Ｂに入力されている。 The compensator 112 (transfer function: Ci (s)) compensates the phase of the differential current feedback signal S15 to generate a current balanced signal S16. The current balance signal S16 is input to the signal adjustment units 110A and 110B instead of the current feedback signals S14A and S14B in FIG.
従って、信号調整部１１０Ａ及び１１０Ｂでは、電流平衡信号Ｓ１６に応じて電圧帰還信号Ｓ１０を調整することにより、制御信号Ｓ１１Ａ及びＳ１１Ｂが生成される。 Therefore, in the signal adjustment units 110A and 110B, the control signals S11A and S11B are generated by adjusting the voltage feedback signal S10 according to the current balance signal S16.
上記構成から成る第２参考例の制御装置１０では、各相共通の電圧モード制御が行われると共に、各相の電流差分値（＝ＩＬ１−ＩＬ２）に応じた電流平衡制御が行われる。 In the control device 10 of the second reference example configured as described above, voltage mode control common to each phase is performed, and current balance control corresponding to the current difference value (= IL1-IL2) of each phase is performed.
図６は、第２参考例におけるインダクタ電流ＩＬ１及びＩＬ２のシミュレーション波形図である。なお、シミュレーション条件については、先出の図３と同様である。また、図７は、図６における領域βの拡大図である。 FIG. 6 is a simulation waveform diagram of the inductor currents IL1 and IL2 in the second reference example. The simulation conditions are the same as those in FIG. FIG. 7 is an enlarged view of a region β in FIG.
両図で示したように、第２参考例の制御装置１０であれば、各相のインダクタ電流ＩＬ１及びＩＬ２が定常偏差のない平衡状態となる。 As shown in both figures, in the control device 10 of the second reference example, the inductor currents IL1 and IL2 of each phase are in an equilibrium state with no steady deviation.
しかしながら、第２参考例の制御装置１０では、出力電流Ｉｏ（延いてはインダクタ電流ＩＬ１及びＩＬ２）の急変時において、意図しないオーバーシュートまたはアンダーシュートが生じやすくなる。これは、出力電流Ｉｏの急変時において、過渡的にＩＬ１＝ＩＬ２（またはＩＬ１≒ＩＬ２）となり、電流平衡ループが無効となるためである。以下では、この現象について説明する。 However, in the control device 10 of the second reference example, unintentional overshoot or undershoot is likely to occur when the output current Io (and thus the inductor currents IL1 and IL2) changes suddenly. This is because when the output current Io changes suddenly, IL1 = IL2 (or IL1≈IL2) is transiently set, and the current balance loop becomes invalid. Hereinafter, this phenomenon will be described.
図８は、各相のインダクタ電流ＩＬ１及びＩＬ２が等しい（またはほぼ等しい）ときに電流平衡ループが無効となる様子を示すブロック線図である。ＩＬ１＝ＩＬ２（またはＩＬ１≒ＩＬ２）である場合には、減算器１１１で生成される差分電流帰還信号Ｓ１５がゼロ値（またはほぼゼロ値）となるので、信号調整部１１０Ａ及び１１０Ｂにそれぞれ入力される電流平衡信号Ｓ１６もゼロ値（またはほぼゼロ値）となる。 FIG. 8 is a block diagram showing how the current balancing loop is disabled when the inductor currents IL1 and IL2 of each phase are equal (or substantially equal). When IL1 = IL2 (or IL1≈IL2), the differential current feedback signal S15 generated by the subtractor 111 has a zero value (or almost zero value), and is input to the signal adjustment units 110A and 110B, respectively. The current balance signal S16 is also zero (or almost zero).
その結果、本図の破線で示したように、電流平衡ループが何ら機能していない状態となる。このような状態は、電圧帰還ループのみを有する構成と等価であり、二次遅れ系に特有の共振ピークが大きくなる。 As a result, as indicated by the broken line in the figure, the current balancing loop is not functioning at all. Such a state is equivalent to a configuration having only a voltage feedback loop, and a resonance peak peculiar to the second-order lag system becomes large.
以上の理由から、第２参考例の制御装置１０では、出力電流Ｉｏの急変時において、意図しないオーバーシュートまたはアンダーシュートが生じやすくなる。 For the above reasons, in the control device 10 of the second reference example, unintended overshoot or undershoot is likely to occur when the output current Io changes suddenly.
＜制御装置（実施形態）＞
図９は、インターリーブコンバータ１（特に制御装置１０）の一実施形態を示すブロック図である。本実施形態のインターリーブコンバータ１は、第２参考例（図５）の減算器１１１と補償器１１２に代えて、加算器２０１と、１／２減衰器２０２と、減算器２０３Ａ及び２０３Ｂと、補償器２０４Ａ及び２０４Ｂと、信号調整部２０５Ａ及び２０５Ｂとを有する。なお、これらの構成要素は、制御装置１０に含めるとよい。
<Control device (embodiment)>
FIG. 9 is a block diagram showing an embodiment of the interleaved converter 1 (particularly the control device 10). The interleaved converter 1 according to the present embodiment includes an adder 201, a 1/2 attenuator 202, subtracters 203A and 203B, and compensation, instead of the subtractor 111 and the compensator 112 of the second reference example (FIG. 5). Units 204A and 204B and signal adjustment units 205A and 205B. Note that these components may be included in the control device 10.
加算器２０１は、電流帰還信号Ｓ１４Ａ及びＳ１４Ｂを足し合わせて加算電流帰還信号Ｓ２１（＝Ｓ１４Ａ＋Ｓ１４Ｂ）を生成する。 The adder 201 adds the current feedback signals S14A and S14B to generate an added current feedback signal S21 (= S14A + S14B).
１／２減衰器２０２は、加算電流帰還信号Ｓ２１を１／２に減衰して平均電流帰還信号Ｓ２２（＝（Ｓ１４Ａ＋Ｓ１４Ｂ）／２）を生成する。 The 1/2 attenuator 202 attenuates the addition current feedback signal S21 to 1/2 and generates an average current feedback signal S22 (= (S14A + S14B) / 2).
すなわち、加算器２０１及び１／２減衰器２０２は、電流帰還信号Ｓ１４Ａ及びＳ１４Ｂを平均して平均電流帰還信号Ｓ２２を生成する平均部として機能する。 That is, the adder 201 and the ½ attenuator 202 function as an average unit that averages the current feedback signals S14A and S14B to generate an average current feedback signal S22.
減算器２０３Ａは、電流帰還信号Ｓ１４Ａから平均電流帰還信号Ｓ２２を差し引いて差分電流帰還信号Ｓ２３Ａ（＝Ｓ１４Ａ−Ｓ２２）を生成する。 The subtractor 203A generates a differential current feedback signal S23A (= S14A−S22) by subtracting the average current feedback signal S22 from the current feedback signal S14A.
減算器２０３Ｂは、電流帰還信号Ｓ１４Ｂから平均電流帰還信号Ｓ２２を差し引いて差分電流帰還信号Ｓ２３Ｂ（＝Ｓ１４Ｂ−Ｓ２２）を生成する。 The subtractor 203B subtracts the average current feedback signal S22 from the current feedback signal S14B to generate a differential current feedback signal S23B (= S14B-S22).
補償器２０４Ａ（伝達関数：Ｃｉ（ｓ））は、差分電流帰還信号Ｓ２３Ａの位相を補償して電流平衡信号Ｓ２４Ａを生成する。 The compensator 204A (transfer function: Ci (s)) compensates the phase of the differential current feedback signal S23A to generate a current balanced signal S24A.
補償器２０４Ｂ（伝達関数：Ｃｉ（ｓ））は、差分電流帰還信号Ｓ２３Ｂの位相を補償して電流平衡信号Ｓ２４Ｂを生成する。 The compensator 204B (transfer function: Ci (s)) compensates the phase of the differential current feedback signal S23B and generates a current balanced signal S24B.
信号調整部２０５Ａは、電流平衡信号Ｓ２４Ａに応じて電流帰還信号Ｓ１４Ａを調整することにより、調整電流帰還信号Ｓ２５Ａを生成する。信号調整部２０５Ａとしては、例えば、電流帰還信号Ｓ１４Ａと電流平衡信号Ｓ２４Ａとを足し合わせて調整電流帰還信号Ｓ２５Ａ（＝Ｓ１４Ａ＋Ｓ２４Ａ）を生成する加算器がこれに相当する。 The signal adjustment unit 205A generates the adjusted current feedback signal S25A by adjusting the current feedback signal S14A in accordance with the current balance signal S24A. As the signal adjustment unit 205A, for example, an adder that adds the current feedback signal S14A and the current balance signal S24A to generate the adjustment current feedback signal S25A (= S14A + S24A) corresponds to this.
信号調整部２０５Ｂは、電流平衡信号Ｓ２４Ｂに応じて電流帰還信号Ｓ１４Ｂを調整することにより、調整電流帰還信号Ｓ２５Ｂを生成する。信号調整部２０５Ｂとしては、例えば、電流帰還信号Ｓ１４Ｂと電流平衡信号Ｓ２４Ｂとを足し合わせて調整電流帰還信号Ｓ２５Ｂ（＝Ｓ１４Ｂ＋Ｓ２４Ｂ）を生成する加算器がこれに相当する。 The signal adjustment unit 205B generates the adjusted current feedback signal S25B by adjusting the current feedback signal S14B in accordance with the current balance signal S24B. As the signal adjustment unit 205B, for example, an adder that adds the current feedback signal S14B and the current balance signal S24B to generate the adjustment current feedback signal S25B (= S14B + S24B) corresponds to this.
なお、先出の減算器２０３Ａの入力極性を正負逆とし、平均電流帰還信号Ｓ２２から電流帰還信号Ｓ１４Ａを差し引いて差分電流帰還信号Ｓ２３Ａ（＝Ｓ２２−Ｓ１４Ａ）を生成する場合には、信号調整部２０５Ａとして、電流帰還信号Ｓ１４Ａから電流平衡信号Ｓ２４Ａを差し引いて調整電流帰還信号Ｓ２５Ａ（＝Ｓ１４Ａ−Ｓ２４Ａ）を生成する減算器を用いればよい。 In the case where the input polarity of the subtracter 203A is positive / negative and the current feedback signal S14A is subtracted from the average current feedback signal S22 to generate the differential current feedback signal S23A (= S22-S14A), the signal adjustment unit As 205A, a subtractor that subtracts the current balance signal S24A from the current feedback signal S14A to generate the adjusted current feedback signal S25A (= S14A−S24A) may be used.
同様に、先出の減算器２０３Ｂの入力極性を正負逆とし、平均電流帰還信号Ｓ２２から電流帰還信号Ｓ１４Ｂを差し引いて差分電流帰還信号Ｓ２３Ｂ（＝Ｓ２２−Ｓ１４Ｂ）を生成する場合には、信号調整部２０５Ｂとして、電流帰還信号Ｓ１４Ｂから電流平衡信号Ｓ２４Ｂを差し引いて調整電流帰還信号Ｓ２５Ｂ（＝Ｓ１４Ｂ−Ｓ２４Ｂ）を生成する減算器を用いればよい。 Similarly, in the case where the input polarity of the subtractor 203B is positive / negative and the current feedback signal S14B is subtracted from the average current feedback signal S22 to generate the differential current feedback signal S23B (= S22−S14B), signal adjustment is performed. As the unit 205B, a subtracter that subtracts the current balance signal S24B from the current feedback signal S14B to generate the adjusted current feedback signal S25B (= S14B−S24B) may be used.
調整電流帰還信号Ｓ２５Ａ及びＳ２５Ｂは、それぞれ、図２の電流帰還信号Ｓ１４Ａ及びＳ１４Ｂ、若しくは、図５の電流平衡信号Ｓ１６に代えて、信号調整部１１０Ａ及び１１０Ｂに入力されている。 The adjusted current feedback signals S25A and S25B are input to the signal adjusters 110A and 110B in place of the current feedback signals S14A and S14B in FIG. 2 or the current balanced signal S16 in FIG.
従って、信号調整部１１０Ａ及び１１０Ｂでは、それぞれ、調整電流帰還信号Ｓ２５Ａ及びＳ２５Ｂに応じて電圧帰還信号Ｓ１０を調整することにより、制御信号Ｓ１１Ａ及びＳ１１Ｂが生成される。 Therefore, in the signal adjustment units 110A and 110B, the control signals S11A and S11B are generated by adjusting the voltage feedback signal S10 according to the adjustment current feedback signals S25A and S25B, respectively.
なお、上記の構成要素（２０１、２０２、２０３Ａ及び２０３Ｂ、２０４Ａ及び２０４Ｂ、並びに、２０５Ａ及び２０５Ｂ）は、インダクタ電流ＩＬ１及びＩＬ２の平均値を算出し、その算出結果を用いて電流帰還信号Ｓ１４Ａ及びＳ１４Ｂをそれぞれ調整する電流平衡制御部として機能する。 The above components (201, 202, 203A and 203B, 204A and 204B, and 205A and 205B) calculate the average values of the inductor currents IL1 and IL2, and use the calculation results to calculate the current feedback signal S14A and It functions as a current balance control unit for adjusting S14B.
以下では、本実施形態の技術的意義について、先の第２参考例（図５）と対比すべく、ＩＬ１＝ＩＬ２（またはＩＬ１≒ＩＬ２）である場合を例に挙げて説明する。 In the following, the technical significance of the present embodiment will be described by taking as an example the case where IL1 = IL2 (or IL1≈IL2), in contrast to the second reference example (FIG. 5).
図１０は、各相のインダクタ電流ＩＬ１及びＩＬ２が等しい（またはほぼ等しい）ときに、電流平衡制御部が無効となる様子を示すブロック線図である。 FIG. 10 is a block diagram illustrating a state in which the current balance control unit is disabled when the inductor currents IL1 and IL2 of each phase are equal (or substantially equal).
ＩＬ１＝ＩＬ２（またはＩＬ１≒ＩＬ２）である場合には、減算器２０３Ａ及び２０３Ｂでそれぞれ生成される差分電流帰還信号Ｓ２３Ａ及びＳ２３Ｂがゼロ値（またはほぼゼロ値）となるので、信号調整部２０５Ａ及び２０５Ｂにそれぞれ入力される電流平衡信号Ｓ２４Ａ及びＳ２４Ｂもゼロ値（またはほぼゼロ値）となる。その結果、本図の破線で示したように、電流平衡制御部が何ら機能していない状態となる。この点については、先の第２参考例（図５）と基本的に同様である。 When IL1 = IL2 (or IL1≈IL2), the differential current feedback signals S23A and S23B generated by the subtractors 203A and 203B respectively have zero values (or almost zero values). The current balance signals S24A and S24B respectively input to 205B also have a zero value (or almost zero value). As a result, as indicated by the broken line in the figure, the current balance control unit is not functioning at all. This is basically the same as the second reference example (FIG. 5).
ただし、本実施形態の制御装置１０では、電流平衡制御部が無効となっても、調整電流帰還信号Ｓ２５Ａ及びＳ２５Ｂがゼロ値となるわけではなく、無調整の電流帰還信号Ｓ１４Ａ及びＳ１４Ｂが調整電流帰還信号Ｓ２５Ａ及びＳ２５Ｂとしてそのまま信号調整部１１０Ａ及び１１０Ｂに入力される状態となる。従って、ＩＬ１＝ＩＬ２（またはＩＬ１≒ＩＬ２）であっても、各相独立の電流モード制御自体は、何ら支障なく継続される。 However, in the control device 10 of the present embodiment, even if the current balance control unit is disabled, the adjusted current feedback signals S25A and S25B do not become zero values, and the non-adjusted current feedback signals S14A and S14B are adjusted current. The feedback signals S25A and S25B are input to the signal adjustment units 110A and 110B as they are. Therefore, even if IL1 = IL2 (or IL1≈IL2), the current mode control independent of each phase is continued without any trouble.
すなわち、本実施形態の制御装置１０は、第２参考例（図５）と異なり、各相独立の電流帰還ループを残しつつ、電流平衡制御部が別途追加された構成であると言える。このような構成を採用すれば、ＩＬ１＝ＩＬ２（またはＩＬ１≒ＩＬ２）となり、電流平衡制御部が十全に機能しない状態となっても、出力電圧Ｖｏに応じた電圧帰還制御とインダクタ電流ＩＬ１及びＩＬ２に応じた電流帰還制御を支障なく継続することができる。従って、第１参考例（図２）と同様、出力電流Ｉｏ（延いてはインダクタ電流ＩＬ１及びＩＬ２）が急変しても、意図しないオーバーシュートまたはアンダーシュートを生じにくくなる。 That is, unlike the second reference example (FIG. 5), the control device 10 of the present embodiment can be said to have a configuration in which a current balance control unit is added separately while leaving a current feedback loop independent of each phase. If such a configuration is adopted, IL1 = IL2 (or IL1≈IL2), and even if the current balance control unit does not fully function, voltage feedback control according to the output voltage Vo and inductor current IL1 and Current feedback control according to IL2 can be continued without any problem. Therefore, as in the first reference example (FIG. 2), even if the output current Io (and thus the inductor currents IL1 and IL2) changes suddenly, it is difficult to cause an unintended overshoot or undershoot.
また、ＩＬ１≠ＩＬ２である場合には、上記の電流平衡制御部が有効となるので、第２参考例（図５）と同様、各相のインダクタ電流ＩＬ１及びＩＬ２について、定常偏差のない平衡状態を実現することが可能となる。 Further, when IL1 ≠ IL2, the current balance control unit is effective, so that the inductor currents IL1 and IL2 of each phase are in an equilibrium state without a steady state deviation as in the second reference example (FIG. 5). Can be realized.
図１１は、本実施形態におけるインダクタ電流ＩＬ１及びＩＬ２のシミュレーション波形図である。なお、シミュレーション条件については、先出の図３または図６と同様である。また、図１２は、図１１における領域γの拡大図である。 FIG. 11 is a simulation waveform diagram of the inductor currents IL1 and IL2 in the present embodiment. The simulation conditions are the same as those in FIG. 3 or FIG. FIG. 12 is an enlarged view of a region γ in FIG.
先にも述べたように、本実施形態の制御装置１０であれば、各相のインダクタ電流ＩＬ１及びＩＬ２を平衡させつつ、ＩＬ１＝ＩＬ２（またはＩＬ１≒ＩＬ２）となる場合でも各相独立の電流帰還制御を継続することができる。すなわち、第１参考例（図２）と第２参考例（図５）双方の長所を併せ持つ出力帰還制御を行うことが可能となる。 As described above, in the control device 10 of the present embodiment, the current independent of each phase even when IL1 = IL2 (or IL1≈IL2) while balancing the inductor currents IL1 and IL2 of each phase. Feedback control can be continued. That is, output feedback control having the advantages of both the first reference example (FIG. 2) and the second reference example (FIG. 5) can be performed.
特に、大電流・高電圧を取り扱う機器（民生機器、産業機器、または、車載機器など）の電源手段として、インターリーブコンバータ１を用いる場合には、電圧帰還ループの二次遅れ系に特有の共振ピークが大きくなりやすいので、本実施形態の制御装置１０を採用することが望ましいと言える。 In particular, when the interleaved converter 1 is used as a power source for a device that handles a large current / high voltage (such as a consumer device, an industrial device, or an in-vehicle device), a resonance peak peculiar to the secondary delay system of the voltage feedback loop. Therefore, it can be said that it is desirable to employ the control device 10 of the present embodiment.
図１３は、本実施形態におけるインターリーブコンバータ１の具体例を示す回路図である。本構成例のインターリーブコンバータ１において、出力段１０１Ａ及び１０１Ｂ、出力加算部１０２、並びに、出力平滑部１０３は、先出の図１と同様の構成から成るので、詳細な説明を割愛する。 FIG. 13 is a circuit diagram showing a specific example of the interleaved converter 1 in the present embodiment. In the interleaved converter 1 of this configuration example, the output stages 101A and 101B, the output addition unit 102, and the output smoothing unit 103 have the same configuration as in FIG.
帰還電圧生成部１０４は、出力電圧Ｖｏの出力端と基準電位端との間に直列接続された抵抗Ｒ１及びＲ２を含み、相互間の接続ノードから帰還電圧Ｖｆｂ（＝出力電圧Ｖｏの分圧電圧）が出力される。 The feedback voltage generator 104 includes resistors R1 and R2 connected in series between the output terminal of the output voltage Vo and the reference potential terminal, and the feedback voltage Vfb (= the divided voltage of the output voltage Vo) from the connection node between them. ) Is output.
差分入力部１０５と制御器１０６は、オペアンプＡＭＰ１と、抵抗Ｒ３と、キャパシタＣ１及びＣ２を含む。オペアンプＡＭＰ１の第１入力端には、参照電圧Ｖｒｅｆが印加されている。オペアンプＡＭＰ１の第２入力端には、帰還電圧Ｖｆｂが印加されている。抵抗Ｒ３の第１端とキャパシタＣ２の第１端は、オペアンプＡＭＰ１の第２入力端に接続されている。抵抗Ｒ３の第２端は、キャパシタＣ１の第１端に接続されている。キャパシタＣ１及びＣ２それぞれの第２端は、オペアンプＡＭＰ１の出力端に接続されている。上記接続態様のオペアンプＡＭＰ１は、その出力端から電圧帰還信号Ｓ１０を出力する。このように、差分入力部１０５と制御器１０６は、帰還電圧Ｖｆｂと参照電圧Ｖｒｅｆとの差分に応じた電圧帰還信号Ｓ１０を生成するエラーアンプとして実装されている。 The differential input unit 105 and the controller 106 include an operational amplifier AMP1, a resistor R3, and capacitors C1 and C2. A reference voltage Vref is applied to the first input terminal of the operational amplifier AMP1. A feedback voltage Vfb is applied to the second input terminal of the operational amplifier AMP1. The first end of the resistor R3 and the first end of the capacitor C2 are connected to the second input end of the operational amplifier AMP1. The second end of the resistor R3 is connected to the first end of the capacitor C1. The second ends of the capacitors C1 and C2 are connected to the output end of the operational amplifier AMP1. The operational amplifier AMP1 in the above connection mode outputs a voltage feedback signal S10 from its output terminal. As described above, the difference input unit 105 and the controller 106 are implemented as an error amplifier that generates the voltage feedback signal S10 according to the difference between the feedback voltage Vfb and the reference voltage Vref.
電流検出部１０８Ａ及び１０８Ｂは、それぞれ、インダクタ電流ＩＬ１及びＩＬ２に応じた電流検出信号Ｓ１３Ａ及びＳ１３Ｂを生成する。なお、電流検出手法については、インダクタ電流ＩＬ１及びＩＬ２（またはこれらと等価のミラー電流）が流れる電流経路に設けられたセンス抵抗の両端間電圧を測定する構成としてもよいし、或いは、出力トランジスタＴｒ１及びＴｒ２のオン期間中にそれぞれのドレイン・ソース間電圧を測定する構成としてもよい。 Current detection units 108A and 108B generate current detection signals S13A and S13B corresponding to inductor currents IL1 and IL2, respectively. The current detection method may be configured to measure the voltage across the sense resistor provided in the current path through which the inductor currents IL1 and IL2 (or mirror currents equivalent thereto) flow, or the output transistor Tr1. The drain-source voltage may be measured during the ON period of Tr2 and Tr2.
増幅器１０９Ａは、オペアンプＡＭＰ２と抵抗Ｒ４及びＲ５を含む。オペアンプＡＭＰ２の第１入力端には、電流検出信号Ｓ１３Ａが入力されている。抵抗Ｒ４の第１端は、オペアンプＡＭＰ２の出力端に接続されている。抵抗Ｒ４の第２端と抵抗Ｒ５の第１端は、オペアンプＡＭＰ２の第２入力端に接続されている。抵抗Ｒ５の第２端は、基準電位端に接続されている。本構成例の増幅器１０９Ａは、オペアンプＡＭＰ２の出力端から電流帰還信号Ｓ１４Ａを出力する。 The amplifier 109A includes an operational amplifier AMP2 and resistors R4 and R5. The current detection signal S13A is input to the first input terminal of the operational amplifier AMP2. A first terminal of the resistor R4 is connected to an output terminal of the operational amplifier AMP2. The second end of the resistor R4 and the first end of the resistor R5 are connected to the second input end of the operational amplifier AMP2. The second end of the resistor R5 is connected to the reference potential end. The amplifier 109A of this configuration example outputs a current feedback signal S14A from the output terminal of the operational amplifier AMP2.
増幅器１０９Ｂは、オペアンプＡＭＰ３と抵抗Ｒ６及びＲ７を含む。オペアンプＡＭＰ３の第１入力端には、電流検出信号Ｓ１３Ｂが入力されている。抵抗Ｒ６の第１端は、オペアンプＡＭＰ３の出力端に接続されている。抵抗Ｒ６の第２端と抵抗Ｒ７の第１端は、オペアンプＡＭＰ３の第２入力端に接続されている。抵抗Ｒ７の第２端は、基準電位端に接続されている。本構成例の増幅器１０９Ｂは、オペアンプＡＭＰ３の出力端から電流帰還信号Ｓ１４Ｂを出力する。 The amplifier 109B includes an operational amplifier AMP3 and resistors R6 and R7. The current detection signal S13B is input to the first input terminal of the operational amplifier AMP3. A first terminal of the resistor R6 is connected to the output terminal of the operational amplifier AMP3. The second end of the resistor R6 and the first end of the resistor R7 are connected to the second input end of the operational amplifier AMP3. The second end of the resistor R7 is connected to the reference potential end. The amplifier 109B of this configuration example outputs a current feedback signal S14B from the output terminal of the operational amplifier AMP3.
加算器２０１は、オペアンプＡＭＰ４と抵抗Ｒ８〜Ｒ１０とを含む。抵抗Ｒ８の第１端には、電流帰還信号Ｓ１４Ａが入力されている。抵抗Ｒ９の第１端には、電流帰還信号１４Ｂが入力されている。抵抗Ｒ８及びＲ９それぞれの第２端と抵抗Ｒ１０の第１端は、オペアンプＡＭＰ４の第１入力端に接続されている。オペアンプＡＭＰ４の第２入力端は、基準電位端に接続されている。抵抗Ｒ１０の第２端は、オペアンプＡＭＰ４の出力端に接続されている。本構成例の加算器２０１は、オペアンプＡＭＰ４の出力端から加算電流帰還信号Ｓ２１を出力する。 The adder 201 includes an operational amplifier AMP4 and resistors R8 to R10. The current feedback signal S14A is input to the first end of the resistor R8. The current feedback signal 14B is input to the first end of the resistor R9. A second end of each of the resistors R8 and R9 and a first end of the resistor R10 are connected to a first input end of the operational amplifier AMP4. The second input terminal of the operational amplifier AMP4 is connected to the reference potential terminal. The second end of the resistor R10 is connected to the output end of the operational amplifier AMP4. The adder 201 of this configuration example outputs the addition current feedback signal S21 from the output terminal of the operational amplifier AMP4.
１／２減衰器２０２は、オペアンプＡＭＰ５と、同一抵抗値の抵抗Ｒ１１及びＲ１２を含む。抵抗Ｒ１１の第１端には、加算電流帰還信号Ｓ２１が入力されている。抵抗Ｒ１１の第２端と抵抗Ｒ１２の第１端は、オペアンプＡＭＰ５の第１入力端に接続されている。オペアンプＡＭＰ５の第２入力端は、基準電位端に接続されている。抵抗Ｒ１２の第２端は、オペアンプＡＭＰ５の出力端に接続されている。本構成例の１／２減衰器２０２は、オペアンプＡＭＰ５の出力端から平均電流帰還信号Ｓ２２を出力する。 1/2 attenuator 202 includes operational amplifier AMP5 and resistors R11 and R12 having the same resistance value. The addition current feedback signal S21 is input to the first end of the resistor R11. The second end of the resistor R11 and the first end of the resistor R12 are connected to the first input end of the operational amplifier AMP5. The second input terminal of the operational amplifier AMP5 is connected to the reference potential terminal. The second end of the resistor R12 is connected to the output end of the operational amplifier AMP5. The 1/2 attenuator 202 of this configuration example outputs an average current feedback signal S22 from the output terminal of the operational amplifier AMP5.
減算器２０３Ａは、オペアンプＡＭＰ６と抵抗Ｒ１３〜Ｒ１６を含む。抵抗Ｒ１３の第１端には、電流帰還信号Ｓ１４Ａが入力されている。抵抗Ｒ１５の第１端には、平均電流帰還信号Ｓ２２が入力されている。抵抗Ｒ１３の第２端と抵抗Ｒ１４の第１端は、オペアンプＡＭＰ６の第１入力端に接続されている。抵抗Ｒ１５の第２端と抵抗Ｒ１６の第１端は、オペアンプＡＭＰ６の第２入力端に接続されている。抵抗Ｒ１４の第２端は、オペアンプＡＭＰ６の出力端に接続されている。抵抗Ｒ１６の第２端は、基準電位端に接続されている。本構成例の減算器２０３Ａは、オペアンプＡＭＰ６の出力端から差分電流帰還信号Ｓ２３Ａを出力する。 The subtractor 203A includes an operational amplifier AMP6 and resistors R13 to R16. The current feedback signal S14A is input to the first end of the resistor R13. The average current feedback signal S22 is input to the first end of the resistor R15. The second end of the resistor R13 and the first end of the resistor R14 are connected to the first input end of the operational amplifier AMP6. The second end of the resistor R15 and the first end of the resistor R16 are connected to the second input end of the operational amplifier AMP6. The second end of the resistor R14 is connected to the output end of the operational amplifier AMP6. The second end of the resistor R16 is connected to the reference potential end. The subtractor 203A of this configuration example outputs a differential current feedback signal S23A from the output terminal of the operational amplifier AMP6.
減算器２０３Ｂは、オペアンプＡＭＰ７と抵抗Ｒ１７〜Ｒ２０を含む。抵抗Ｒ１７の第１端には、電流帰還信号Ｓ１４Ｂが入力されている。抵抗Ｒ１９の第１端には、平均電流帰還信号Ｓ２２が入力されている。抵抗Ｒ１７の第２端と抵抗Ｒ１８の第１端は、オペアンプＡＭＰ７の第１入力端に接続されている。抵抗Ｒ１９の第２端と抵抗Ｒ２０の第１端は、オペアンプＡＭＰ７の第２入力端に接続されている。抵抗Ｒ１８の第２端は、オペアンプＡＭＰ７の出力端に接続されている。抵抗Ｒ２０の第２端は、基準電位端に接続されている。本構成例の減算器２０３Ｂは、オペアンプＡＭＰ７の出力端から差分電流帰還信号Ｓ２３Ｂを出力する。 The subtractor 203B includes an operational amplifier AMP7 and resistors R17 to R20. The current feedback signal S14B is input to the first end of the resistor R17. The average current feedback signal S22 is input to the first end of the resistor R19. The second end of the resistor R17 and the first end of the resistor R18 are connected to the first input end of the operational amplifier AMP7. The second end of the resistor R19 and the first end of the resistor R20 are connected to the second input end of the operational amplifier AMP7. The second end of the resistor R18 is connected to the output end of the operational amplifier AMP7. The second end of the resistor R20 is connected to the reference potential end. The subtractor 203B of this configuration example outputs a differential current feedback signal S23B from the output terminal of the operational amplifier AMP7.
補償器２０４Ａは、オペアンプＡＭＰ８と、抵抗Ｒ２１及びＲ２２と、キャパシタＣ３とを含む。抵抗Ｒ２１の第１端には、差分電流帰還信号Ｓ２３Ａが入力されている。抵抗Ｒ２１の第２端と抵抗Ｒ２２の第１端は、オペアンプＡＭＰ８の第１入力端に接続されている。オペアンプＡＭＰ８の第２入力端は、基準電位端に接続されている。抵抗Ｒ２２の第２端は、キャパシタＣ３の第１端に接続されている。キャパシタＣ３の第２端は、オペアンプＡＭＰ８の出力端に接続されている。本構成例の補償器２０４Ａは、オペアンプＡＭＰ８の出力端から電流平衡信号Ｓ２４Ａを出力する。 The compensator 204A includes an operational amplifier AMP8, resistors R21 and R22, and a capacitor C3. The differential current feedback signal S23A is input to the first end of the resistor R21. The second end of the resistor R21 and the first end of the resistor R22 are connected to the first input end of the operational amplifier AMP8. The second input terminal of the operational amplifier AMP8 is connected to the reference potential terminal. The second end of the resistor R22 is connected to the first end of the capacitor C3. The second end of the capacitor C3 is connected to the output end of the operational amplifier AMP8. The compensator 204A of this configuration example outputs a current balanced signal S24A from the output terminal of the operational amplifier AMP8.
補償器２０４Ｂは、オペアンプＡＭＰ９と、抵抗Ｒ２３及びＲ２４と、キャパシタＣ４とを含む。抵抗Ｒ２３の第１端には、差分電流帰還信号Ｓ２３Ｂが入力されている。抵抗Ｒ２３の第２端と抵抗Ｒ２４の第１端は、オペアンプＡＭＰ９の第１入力端に接続されている。オペアンプＡＭＰ９の第２入力端は、基準電位端に接続されている。抵抗Ｒ２４の第２端は、キャパシタＣ４の第１端に接続されている。キャパシタＣ４の第２端は、オペアンプＡＭＰ９の出力端に接続されている。本構成例の補償器２０４Ｂは、オペアンプＡＭＰ９の出力端から電流平衡信号Ｓ２４Ｂを出力する。 The compensator 204B includes an operational amplifier AMP9, resistors R23 and R24, and a capacitor C4. The differential current feedback signal S23B is input to the first end of the resistor R23. The second end of the resistor R23 and the first end of the resistor R24 are connected to the first input end of the operational amplifier AMP9. The second input terminal of the operational amplifier AMP9 is connected to the reference potential terminal. The second end of the resistor R24 is connected to the first end of the capacitor C4. The second end of the capacitor C4 is connected to the output end of the operational amplifier AMP9. The compensator 204B of this configuration example outputs a current balanced signal S24B from the output terminal of the operational amplifier AMP9.
信号調整部２０５Ａは、オペアンプＡＭＰ１０と抵抗Ｒ２５〜Ｒ２７を含む。抵抗Ｒ２５の第１端には、電流帰還信号Ｓ１４Ａが入力されている。抵抗Ｒ２６の第１端には、電流平衡信号Ｓ２４Ａが入力されている。抵抗Ｒ２５及びＲ２６それぞれの第２端と抵抗Ｒ２７の第１端は、オペアンプＡＭＰ１０の第１入力端に接続されている。オペアンプＡＭＰ１０の第２入力端は、基準電位端に接続されている。抵抗Ｒ２７の第２端は、オペアンプＡＭＰ１０の出力端に接続されている。本構成例の信号調整部２０５Ａは、オペアンプＡＭＰ１０の出力端から調整電流帰還信号Ｓ２５Ａを出力する。 The signal adjustment unit 205A includes an operational amplifier AMP10 and resistors R25 to R27. The current feedback signal S14A is input to the first end of the resistor R25. The current balance signal S24A is input to the first end of the resistor R26. A second end of each of the resistors R25 and R26 and a first end of the resistor R27 are connected to a first input end of the operational amplifier AMP10. The second input terminal of the operational amplifier AMP10 is connected to the reference potential terminal. The second end of the resistor R27 is connected to the output end of the operational amplifier AMP10. The signal adjustment unit 205A of this configuration example outputs the adjustment current feedback signal S25A from the output terminal of the operational amplifier AMP10.
信号調整部２０５Ｂは、オペアンプＡＭＰ１１と抵抗Ｒ２８〜Ｒ３０を含む。抵抗Ｒ２８の第１端には、電流帰還信号Ｓ１４Ｂが入力されている。抵抗Ｒ２９の第１端には、電流平衡信号Ｓ２４Ｂが入力されている。抵抗Ｒ２８及びＲ２９それぞれの第２端と抵抗Ｒ３０の第１端は、オペアンプＡＭＰ１１の第１入力端に接続されている。オペアンプＡＭＰ１１の第２入力端は、基準電位端に接続されている。抵抗Ｒ３０の第２端は、オペアンプＡＭＰ１１の出力端に接続されている。本構成例の信号調整部２０５Ｂは、オペアンプＡＭＰ１１の出力端から調整電流帰還信号Ｓ２５Ｂを出力する。 The signal adjustment unit 205B includes an operational amplifier AMP11 and resistors R28 to R30. The current feedback signal S14B is input to the first end of the resistor R28. The current balance signal S24B is input to the first end of the resistor R29. The second ends of the resistors R28 and R29 and the first end of the resistor R30 are connected to the first input end of the operational amplifier AMP11. The second input terminal of the operational amplifier AMP11 is connected to the reference potential terminal. The second end of the resistor R30 is connected to the output end of the operational amplifier AMP11. The signal adjustment unit 205B of this configuration example outputs the adjustment current feedback signal S25B from the output terminal of the operational amplifier AMP11.
信号調整部１１０Ａは、オペアンプＡＭＰ１２と抵抗Ｒ３１〜Ｒ３４を含む。抵抗Ｒ３１の第１端には、電圧帰還信号Ｓ１０が入力されている。抵抗Ｒ３３の第１端には、調整電流帰還信号Ｓ２５Ａが入力されている。抵抗Ｒ３１の第２端と抵抗Ｒ３２の第１端は、オペアンプＡＭＰ１２の第１入力端に接続されている。抵抗Ｒ３３の第２端と抵抗Ｒ３４の第１端は、オペアンプＡＭＰ１２の第２入力端に接続されている。抵抗Ｒ３２の第２端は、オペアンプＡＭＰ１２の出力端に接続されている。抵抗Ｒ３４の第２端は、基準電位端に接続されている。本構成例の信号調整部１１０Ａは、オペアンプＡＭＰ１２の出力端から制御信号Ｓ１１Ａを出力する。 The signal adjustment unit 110A includes an operational amplifier AMP12 and resistors R31 to R34. The voltage feedback signal S10 is input to the first end of the resistor R31. The adjustment current feedback signal S25A is input to the first end of the resistor R33. The second end of the resistor R31 and the first end of the resistor R32 are connected to the first input end of the operational amplifier AMP12. The second end of the resistor R33 and the first end of the resistor R34 are connected to the second input end of the operational amplifier AMP12. The second end of the resistor R32 is connected to the output end of the operational amplifier AMP12. The second end of the resistor R34 is connected to the reference potential end. The signal adjustment unit 110A in this configuration example outputs a control signal S11A from the output terminal of the operational amplifier AMP12.
信号調整部１１０Ｂは、オペアンプＡＭＰ１３と抵抗Ｒ３５〜Ｒ３８を含む。抵抗Ｒ３５の第１端には、電圧帰還信号Ｓ１０が入力されている。抵抗Ｒ３７の第１端には、調整電流帰還信号Ｓ２５Ｂが入力されている。抵抗Ｒ３５の第２端と抵抗Ｒ３６の第１端は、オペアンプＡＭＰ１３の第１入力端に接続されている。抵抗Ｒ３７の第２端と抵抗Ｒ３８の第１端は、オペアンプＡＭＰ１３の第２入力端に接続されている。抵抗Ｒ３６の第２端は、オペアンプＡＭＰ１３の出力端に接続されている。抵抗Ｒ３８の第２端は、基準電位端に接続されている。本構成例の信号調整部１１０Ｂは、オペアンプＡＭＰ１３の出力端から制御信号Ｓ１１Ｂを出力する。 The signal adjustment unit 110B includes an operational amplifier AMP13 and resistors R35 to R38. The voltage feedback signal S10 is input to the first end of the resistor R35. The adjustment current feedback signal S25B is input to the first end of the resistor R37. The second end of the resistor R35 and the first end of the resistor R36 are connected to the first input end of the operational amplifier AMP13. The second end of the resistor R37 and the first end of the resistor R38 are connected to the second input end of the operational amplifier AMP13. The second end of the resistor R36 is connected to the output end of the operational amplifier AMP13. The second end of the resistor R38 is connected to the reference potential end. The signal adjustment unit 110B of this configuration example outputs a control signal S11B from the output terminal of the operational amplifier AMP13.
駆動部１０７Ａは、スロープ生成部ＳＬＧ１と、コンパレータＣＭＰ１と、ロジック制御部ＣＴＲＬ１とを含む。コンパレータＣＭＰ１は、信号調整部１１０Ａから入力される制御信号Ｓ１１Ａとスロープ生成部ＳＬＧ１から入力されるスロープ信号ＳＬ１とを比較してパルス幅変調信号ＰＷＭ１を生成する。ロジック制御部ＣＴＲＬ１は、コンパレータＣＭＰ１から入力されるパルス幅変調信号ＰＷＭ１に応じて駆動信号Ｓ１２Ａを生成し、これを出力トランジスタＴｒ１のゲートに出力する。 The drive unit 107A includes a slope generation unit SLG1, a comparator CMP1, and a logic control unit CTRL1. The comparator CMP1 compares the control signal S11A input from the signal adjustment unit 110A with the slope signal SL1 input from the slope generation unit SLG1, and generates the pulse width modulation signal PWM1. The logic control unit CTRL1 generates the drive signal S12A according to the pulse width modulation signal PWM1 input from the comparator CMP1, and outputs this to the gate of the output transistor Tr1.
駆動部１０７Ｂは、スロープ生成部ＳＬＧ２と、コンパレータＣＭＰ２と、ロジック制御部ＣＴＲＬ２とを含む。コンパレータＣＭＰ２は、信号調整部１１０Ｂから入力される制御信号Ｓ１１Ｂとスロープ生成部ＳＬＧ２から入力されるスロープ信号ＳＬ２とを比較してパルス幅変調信号ＰＷＭ２を生成する。ロジック制御部ＣＴＲＬ２は、コンパレータＣＭＰ２から入力されるパルス幅変調信号ＰＷＭ２に応じて駆動信号Ｓ１２Ｂを生成し、これを出力トランジスタＴｒ２のゲートに出力する。 The drive unit 107B includes a slope generation unit SLG2, a comparator CMP2, and a logic control unit CTRL2. The comparator CMP2 compares the control signal S11B input from the signal adjustment unit 110B with the slope signal SL2 input from the slope generation unit SLG2, and generates the pulse width modulation signal PWM2. The logic control unit CTRL2 generates a drive signal S12B according to the pulse width modulation signal PWM2 input from the comparator CMP2, and outputs this to the gate of the output transistor Tr2.
なお、本構成例では、電圧帰還信号Ｓ１０から調整電流帰還信号Ｓ２５Ａ及びＳ２５Ｂをそれぞれ減算する構成を例に挙げたが、電流帰還制御手法は、何らこれに限定されるものではなく、例えば、スロープ信号ＳＬ１及びＳＬ２に調整電流帰還信号Ｓ２５Ａ及びＳ２５Ｂをそれぞれ加算する構成としてもよい。 In this configuration example, the configuration in which the adjustment current feedback signals S25A and S25B are subtracted from the voltage feedback signal S10 is taken as an example. However, the current feedback control method is not limited to this, for example, a slope The adjustment current feedback signals S25A and S25B may be added to the signals SL1 and SL2, respectively.
＜その他の変形例＞
なお、本明細書中に開示されている種々の技術的特徴は、上記実施形態のほか、その技術的創作の主旨を逸脱しない範囲で種々の変更を加えることが可能である。すなわち、上記実施形態は、全ての点で例示であって制限的なものではないと考えられるべきであり、本発明の技術的範囲は、上記実施形態の説明ではなく、特許請求の範囲によって示されるものであり、特許請求の範囲と均等の意味及び範囲内に属する全ての変更が含まれると理解されるべきである。
<Other variations>
The various technical features disclosed in the present specification can be variously modified within the scope of the technical creation in addition to the above-described embodiment. That is, the above-described embodiment is to be considered in all respects as illustrative and not restrictive, and the technical scope of the present invention is indicated not by the description of the above-described embodiment but by the scope of the claims. It should be understood that all modifications that fall within the meaning and range equivalent to the terms of the claims are included.
本明細書中に開示されているインターリーブコンバータは、例えば、大電流・高電圧を取り扱う機器（民生機器、産業機器、または、車載機器など）の電源手段として、好適に利用することが可能である。 The interleaved converter disclosed in the present specification can be suitably used as, for example, a power supply unit of a device (consumer device, industrial device, vehicle-mounted device, etc.) that handles a large current / high voltage. .
１ インターリーブコンバータ
１０ 制御装置
１０１Ａ、１０１Ｂ 出力段
１０２ 出力加算部
１０３ 出力平滑部
１０４ 帰還電圧生成部
１０５ 差分入力部
１０６ 制御器
１０７Ａ、１０７Ｂ 駆動部
１０８Ａ、１０８Ｂ 電流検出部
１０９Ａ、１０９Ｂ 増幅器
１１０Ａ、１１０Ｂ 信号調整部
１１１ 減算器
１１２ 補償器
２０１ 加算器
２０２ １／２減衰器
２０３Ａ、２０３Ｂ 減算器
２０４Ａ、２０４Ｂ 補償器
２０５Ａ、２０５Ｂ 信号調整部
Ｔｒ１、Ｔｒ２ 出力トランジスタ
ＢＤ１、ＢＤ２ ボディダイオード
Ｌ１、Ｌ２ インダクタ
ＲＬ１、ＲＬ２ ライン抵抗
Ｄ１、Ｄ２ 整流ダイオード
Ｃｏ 出力キャパシタ
ＲＣ 等価直列抵抗
Ｒ１〜Ｒ３８ 抵抗
Ｃ１〜Ｃ４ キャパシタ
ＡＭＰ１〜ＡＭＰ１３ オペアンプ
ＣＭＰ１、ＣＭＰ２ コンパレータ
ＳＬＧ１、ＳＬＧ２ スロープ生成部
ＣＴＲＬ１、ＣＴＲＬ２ ロジック制御部
DESCRIPTION OF SYMBOLS 1 Interleaved converter 10 Control apparatus 101A, 101B Output stage 102 Output addition part 103 Output smoothing part 104 Feedback voltage generation part 105 Difference input part 106 Controller 107A, 107B Drive part 108A, 108B Current detection part 109A, 109B Amplifier 110A, 110B Signal Adjustment unit 111 Subtractor 112 Compensator 201 Adder 202 1/2 Attenuator 203A, 203B Subtractor 204A, 204B Compensator 205A, 205B Signal adjustment unit Tr1, Tr2 Output transistor BD1, BD2 Body diode L1, L2 Inductor RL1, RL2 Line resistance D1, D2 Rectifier diode Co Output capacitor RC Equivalent series resistance R1-R38 Resistance C1-C4 Capacitor AMP1-AMP13 Operational amplifier CMP1, CMP2 Correlator SLG1, SLG2 slope generation unit CTRL1, CTRL2 logic control unit
Claims (10)
各相の出力段に流れる電流をそれぞれ検出して各相の電流帰還制御を行う複数の電流帰還制御部と、
各相の出力段に流れる電流の平均値を用いて各相の電流帰還制御部をそれぞれ調整する電流平衡制御部と、
を有することを特徴とする制御装置。 A control device for an interleaved converter that generates an output voltage from an input voltage by driving a plurality of output stages with a predetermined phase difference,
A plurality of current feedback control units for detecting current flowing in the output stage of each phase and performing current feedback control of each phase;
A current balance control unit that adjusts the current feedback control unit of each phase using the average value of the current flowing through the output stage of each phase; and
A control device comprising:
前記出力電圧またはこれに応じた帰還電圧と所定の参照電圧との差分に応じた電圧帰還信号を生成する制御器と、
前記電圧帰還信号に応じて各相の出力段をそれぞれ駆動する複数の駆動部と、
を含むことを特徴とする請求項２に記載の制御装置。 The voltage feedback controller is
A controller for generating a voltage feedback signal according to a difference between the output voltage or a feedback voltage corresponding thereto and a predetermined reference voltage;
A plurality of driving units for driving the output stages of the respective phases according to the voltage feedback signal;
The control device according to claim 2, further comprising:
対応する相の出力段に流れる電流を検出して電流検出信号を生成する電流検出部と、
前記電流検出信号を増幅して電流帰還信号を生成する増幅器と、
前記電圧帰還信号またはこれと比較されるスロープ信号を前記電流帰還信号に応じて調整する第１信号調整部と、
を含むことを特徴とする請求項３に記載の制御装置。 Each of the plurality of current feedback control units is
A current detection unit that detects a current flowing through an output stage of a corresponding phase and generates a current detection signal;
An amplifier for amplifying the current detection signal to generate a current feedback signal;
A first signal adjustment unit that adjusts the voltage feedback signal or a slope signal compared with the voltage feedback signal according to the current feedback signal;
The control device according to claim 3, comprising:
各相の電流帰還信号を平均して平均電流帰還信号を生成する平均部と、
各相の電流帰還信号と前記平均電流帰還信号との差分を取って各相の差分電流帰還信号を生成する複数の減算器と、
各相の差分電流帰還信号それぞれの位相を補償して各相の電流平衡信号を生成する複数の補償器と、
各相の電流帰還信号を各相の電流平衡信号に応じて調整する複数の第２信号調整部と、
を含むことを特徴とする請求項４に記載の制御装置。 The current balance controller is
An average unit that averages the current feedback signals of each phase to generate an average current feedback signal;
A plurality of subtractors for taking a difference between the current feedback signal of each phase and the average current feedback signal to generate a differential current feedback signal of each phase;
A plurality of compensators for generating a current balanced signal for each phase by compensating the phase of each phase differential current feedback signal;
A plurality of second signal adjustment units for adjusting the current feedback signal of each phase according to the current balance signal of each phase;
The control device according to claim 4, comprising:
請求項１〜請求項６のいずれか一項に記載の制御装置と、
を有し、
各相の出力段を所定の位相差で駆動することにより入力電圧から出力電圧を生成することを特徴とするインターリーブコンバータ。 A multi-phase output stage;
The control device according to any one of claims 1 to 6,
Have
An interleaved converter that generates an output voltage from an input voltage by driving an output stage of each phase with a predetermined phase difference.
Priority Applications (1)
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