JP2015176521A - 冗長化記憶制御装置、冗長化記憶制御方法、及び冗長化記憶制御プログラム - Google Patents
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Abstract
Description
(発明の目的)
本発明の目的は、装置全体に同時に障害が発生した場合のデータ書き込みの耐障害性を向上することが可能な、冗長化記憶制御装置、冗長化記憶制御方法、及び冗長化記憶制御プログラムを提供することにある。
(第1の実施形態)
本実施形態における構成について説明する。
(第2の実施形態)
本発明の冗長化記憶制御装置の例として、RAIDを用いて冗長化されたディスクを有する冗長化記憶装置の例を第2の実施形態として示す。
(第3の実施形態)
図4に示した第2の実施形態における冗長化記憶装置105では、スケジューリング手段115が、複数のデータ書き込み要求を所定の時間保持し、データ書き込み要求の順番を入れ替えて書き込みを実施させる。そのため、通常のRAID機能のみが提供される場合に比べて、ディスクにデータの書き込みが完了するまでの時間が長い。つまり、冗長化記憶装置105では、書き込み要求に対する応答性に改善の余地がある。
(第4の実施形態)
図4に示した第2の実施形態では、冗長化記憶装置105が、記憶装置としてディスクを有する場合について説明した。しかしながら、本発明の記憶装置は、必ずしもディスクに限定されず、例えば、ファイルレベルの分散ネットワークストレージであってもよい。
Claims (9)
- 外部の装置から、第1のデータ書き込み要求及び第2のデータ書き込み要求を受け取る受付手段と、
外部の第1の記憶装置に対し、第1の時点で前記第1のデータ書き込み要求に対する処理を実行させ、前記第1の時点とは異なる第2の時点で前記第2のデータ書き込み要求に対する処理を実行させるための第1のスケジュール、及び外部の第2の記憶装置に対し、前記第2の時点とは異なる第3の時点で前記第2のデータ書き込み要求に対する処理を実行させ、前記第1の時点とは異なる第4の時点で前記第1のデータ書き込み要求に対する処理を実行させるための第2のスケジュールを生成するスケジューリング手段と、
を備えることを特徴とする冗長化記憶制御装置。 - 分割冗長化手段を更に備え、
前記受付手段は、前記第1のデータ書き込み要求及び前記第2のデータ書き込み要求の代わりに第3のデータ書き込み要求を受け取り、
前記分割冗長化手段は、前記第3のデータ書き込み要求に対して、RAID(Redundant Arrays of Inexpensive Disks)方式に従い書き込み先の多重化を行うことにより、前記第1のデータ書き込み要求及び前記第2のデータ書き込み要求を生成する
ことを特徴とする請求項1に記載の冗長化記憶制御装置。 - 前記分割冗長化手段は、前記第3のデータ書き込み要求に基づいて、RAID方式に従いパリティ(誤り検出符号)が書き込み対象データである第4のデータ書き込み要求を更に生成する
ことを特徴とする請求項2に記載の冗長化記憶制御装置。 - 前記第1の記憶装置及び前記第2の記憶装置よりも高速なデータ書き込みが可能なバッファ手段を更に備え、
前記受付手段は、受け取った、前記第1のデータ書き込み要求及び前記第2のデータ書き込み要求を前記バッファ手段に記憶させ、
前記スケジューリング手段は、前記記憶された、前記第1のデータ書き込み要求及び前記第2のデータ書き込み要求に基づいて、前記第1のスケジュール及び前記第2のスケジュールを生成する
ことを特徴とする請求項1乃至3のいずれか1項に記載の冗長化記憶制御装置。 - 前記バッファ手段は、不揮発性メモリである
ことを特徴とする請求項4に記載の冗長化記憶制御装置。 - 前記第1の記憶装置及び前記第2の記憶装置は、ディスク装置である
ことを特徴とする請求項1乃至5のいずれか1項に記載の冗長化記憶制御装置。 - 前記第1の記憶装置及び前記第2の記憶装置は、ファイルサーバである
ことを特徴とする請求項1乃至5のいずれか1項に記載の冗長化記憶制御装置。 - 外部の第1の記憶装置に対し、第1の時点で第1のデータ書き込み要求に対する処理を実行させ、前記第1の時点とは異なる第2の時点で第2のデータ書き込み要求に対する処理を実行させるための第1のスケジュール、及び外部の第2の記憶装置に対し、前記第2の時点とは異なる第3の時点で前記第2のデータ書き込み要求に対する処理を実行させ、前記第1の時点とは異なる第4の時点で前記第1のデータ書き込み要求に対する処理を実行させるための第2のスケジュールを生成する
ことを特徴とする冗長化記憶制御方法。 - 外部の第1の記憶装置及び外部の第2の記憶装置に接続された、冗長化記憶制御装置が備えるコンピュータを、
第1のデータ書き込み要求及び第2のデータ書き込み要求を受け取る受付手段と、
前記第1の記憶装置に対し、第1の時点で前記第1のデータ書き込み要求に対する処理を実行させ、前記第1の時点とは異なる第2の時点で前記第2のデータ書き込み要求に対する処理を実行させるための第1のスケジュール、及び前記第2の記憶装置に対し、前記第2の時点とは異なる第3の時点で前記第2のデータ書き込み要求に対する処理を実行させ、前記第1の時点とは異なる第4の時点で前記第1のデータ書き込み要求に対する処理を実行させるための第2のスケジュールを生成するスケジューリング手段と、
として機能させるための冗長化記憶制御プログラム。
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JP2014054333A JP6605786B2 (ja) | 2014-03-18 | 2014-03-18 | 冗長化記憶制御装置、冗長化記憶制御方法、及び冗長化記憶制御プログラム |
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JP6605786B2 JP6605786B2 (ja) | 2019-11-13 |
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Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH06187101A (ja) * | 1992-09-09 | 1994-07-08 | Hitachi Ltd | ディスクアレイ |
JPH0764870A (ja) * | 1993-08-23 | 1995-03-10 | Internatl Business Mach Corp <Ibm> | デジタル情報のデータ・ブロックを記憶する方法及びそのためのディスク記憶装置 |
JPH1115720A (ja) * | 1997-06-26 | 1999-01-22 | Hitachi Ltd | 高速ファイル入出力制御方法 |
-
2014
- 2014-03-18 JP JP2014054333A patent/JP6605786B2/ja active Active
Patent Citations (3)
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JPH0764870A (ja) * | 1993-08-23 | 1995-03-10 | Internatl Business Mach Corp <Ibm> | デジタル情報のデータ・ブロックを記憶する方法及びそのためのディスク記憶装置 |
JPH1115720A (ja) * | 1997-06-26 | 1999-01-22 | Hitachi Ltd | 高速ファイル入出力制御方法 |
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