JP2015058111A - Game machine - Google Patents
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Abstract
Description
本発明はパチンコ遊技機、スロット遊技機などの遊技機に係り、特には主制御手段のCPUを強制リセットさせるためのウォッチドッグタイマを備えた遊技機における制御処理に関する。 The present invention relates to a gaming machine such as a pachinko gaming machine or a slot gaming machine, and more particularly to a control process in a gaming machine equipped with a watchdog timer for forcibly resetting a CPU of a main control means.
パチンコ遊技機、スロット遊技機等には、遊技動作を統括的に制御すると共に遊技動作に関連する制御コマンドを出力する主制御手段のCPU(Central Processing Unit)を強制リセットさせるためのウォッチドッグタイマを備えたものがある(例えば上記特許文献1を参照)。
ウォッチドッグタイマは、クリア制御が行われないまま所定時間を計数した際にCPUにタイムアウト信号を出力する。このタイムアウト信号に応じてCPUが強制リセットされる。
For pachinko machines, slot machines, etc., there is a watchdog timer for forcibly resetting the CPU (Central Processing Unit) of the main control means that controls the game operation as a whole and outputs control commands related to the game operation. Some are provided (see, for example,
The watchdog timer outputs a time-out signal to the CPU when a predetermined time is counted without performing clear control. The CPU is forcibly reset in response to this timeout signal.
ここで、遊技機に備えられたウォッチドッグタイマは、現状では一度起動させるとシステムリセットで初期化されるまで動作を継続するように構成されている。すなわち、タイムアウト信号に応じてCPUが強制リセットされた場合であってもウォッチドッグタイマは動作を継続している。
このため、現状では、タイムアウト信号に応じた強制リセットの後に実行される処理の過程において、ウォッチドッグタイマを逐次クリア制御するようにされている。
Here, at present, the watch dog timer provided in the gaming machine is configured to continue the operation until it is initialized by a system reset when it is activated once. That is, the watchdog timer continues to operate even when the CPU is forcibly reset in response to the timeout signal.
Therefore, at present, the watchdog timer is sequentially controlled to be cleared in the course of the process executed after the forced reset according to the timeout signal.
しかしながら、クリア制御を何度も実行することは制御負荷の軽減を図る上で望ましくない。 However, it is not desirable to execute the clear control many times in order to reduce the control load.
そこで、本発明では上記した問題的を克服し、制御負担を軽減しつつ安定した制御動作の実現を図ることを目的とする。 Accordingly, an object of the present invention is to overcome the above-mentioned problems and to realize a stable control operation while reducing the control burden.
第1に、本発明に係る遊技機は、遊技動作を統括的に制御すると共に、遊技動作に関連する制御コマンドを出力する主制御手段と、前記主制御手段から出力される制御コマンドに基づいて制御動作を行うサブ制御手段と、起動により計数を開始し、クリア制御が行われないまま所定時間を計数した際にタイムアウト信号を出力するとともに、動作を停止するウォッチドッグタイマと、を備える。
そして、前記主制御手段のCPUは、前記タイムアウト信号に応じた強制リセットを行った後、前記主制御手段の内部レジスタの値を初期設定する初期設定処理と、バックアップデータに基づいた復帰制御を行うバックアップ復帰処理と、タイマ割込処理を実行する期間を除いて所定の処理を繰り返し実行する無限ループ処理を順に行うと共に、前記バックアップ復帰処理の後に前記ウォッチドッグタイマを起動させるものである。
First, the gaming machine according to the present invention controls the game operation in an integrated manner, outputs a control command related to the game operation, and a control command output from the main control unit. Sub-control means for performing a control operation, and a watchdog timer that starts counting upon activation and outputs a time-out signal when counting a predetermined time without performing clear control, and stops the operation.
Then, the CPU of the main control means performs a forcible reset according to the timeout signal, and then performs an initial setting process for initializing the value of the internal register of the main control means and a return control based on the backup data A backup recovery process and an infinite loop process that repeatedly executes a predetermined process except for a period for executing the timer interrupt process are sequentially performed, and the watchdog timer is started after the backup recovery process.
これにより、ウォッチドッグタイマは、タイムアウト信号に応じて動作を停止した後、バックアップ復帰処理が完了するまでは起動されない。 As a result, the watchdog timer is not started until the backup recovery processing is completed after stopping the operation in response to the timeout signal.
本発明によれば、制御負担を軽減しつつ安定した制御動作の実現を図ることができる。 According to the present invention, it is possible to realize a stable control operation while reducing a control burden.
以下、本発明に係る遊技機の実施の形態としてパチンコ遊技機を例に挙げ、次の順序で説明する。
<1.パチンコ遊技機の構造>
<2.パチンコ遊技機の制御構成>
<3.主制御部の構成>
<4.ウォッチドッグタイマ回路の構成>
<5.実施の形態の制御処理>
[5−1:メイン処理]
[5−2:タイマ割込処理]
<6.まとめ及び変形例>
Hereinafter, a pachinko gaming machine will be exemplified as an embodiment of a gaming machine according to the present invention, and will be described in the following order.
<1. Pachinko machine structure>
<2. Control configuration of pachinko machine>
<3. Configuration of main control unit>
<4. Configuration of watchdog timer circuit>
<5. Control processing of embodiment>
[5-1: Main processing]
[5-2: Timer interrupt processing]
<6. Summary and Modification>
<1.パチンコ遊技機の構造>
まず図1、図2を参照して、本発明の実施の形態としてのパチンコ遊技機1の構成を概略的に説明する。
図1は実施の形態のパチンコ遊技機1の外観を示す正面側の斜視図であり、図2は遊技盤の正面図である。
図1,図2に示すパチンコ遊技機1は、主に「枠部」と「遊技盤部」から成る。
「枠部」は以下説明する前枠2,外枠2、ガラス扉5、操作パネル7を有して構成される。「遊技盤部」は図2の遊技盤3から成る。以下の説明上で、「枠部」「枠側」とは前枠2,外枠2、ガラス扉5、操作パネル7の総称とする。また「盤部」「盤側」とは遊技盤3を示す。
<1. Pachinko machine structure>
First, with reference to FIG. 1 and FIG. 2, the structure of the
FIG. 1 is a front perspective view showing the appearance of a
The
The “frame portion” includes a
図1に示すようにパチンコ遊技機1は、木製の外枠4の前面に額縁状の前枠2が開閉可能に取り付けられている。図示していないが、この前枠2の裏面には遊技盤収納フレームが形成されており、その遊技盤収納フレーム内に図2に示す遊技盤3が装着される。これにより遊技盤3の表面に形成した遊技領域3aが前枠2の開口部2aから図1のパチンコ遊技機1前面側に臨む状態となる。
なお遊技領域3aの前側には、透明ガラスを支持したガラス扉5が設けられており、遊技領域3aは透明ガラスを介して前面の遊技者側に表出される。
As shown in FIG. 1, the
A
ガラス扉5は軸支機構6により前枠2に対して開閉可能に取り付けられている。そしてガラス扉5の所定位置に設けられた図示しない扉ロック解除用キーシリンダを操作することで、前枠2に対するガラス扉5のロック状態を解除し、ガラス扉5を前側に開放できる構造とされている。また扉ロック解除用キーシリンダの操作によっては、外枠4に対する前枠2のロック状態も解除可能な構成とされている。
またガラス扉5の前面側には、枠側の発光手段として装飾ランプ20wが各所に設けられている。装飾ランプ20wは、例えばLEDによる発光動作として、演出用の発光動作、エラー告知用の発光動作、動作状態に応じた発光動作などを行う。
The
On the front side of the
ガラス扉5の下側には操作パネル7が設けられている。この操作パネル7も、図示しない軸支機構により、前枠2に対して開閉可能とされている。
操作パネル7には、上受け皿ユニット8、下受け皿ユニット9、発射操作ハンドル10が設けられている。
An operation panel 7 is provided below the
The operation panel 7 is provided with an
上受け皿ユニット8には、弾球に供される遊技球を貯留する上受け皿8aが形成されている。下受け皿ユニット9には、上受け皿8aに貯留しきれない遊技球を貯留する下受け皿9aが形成されている。
また上受け皿ユニット8には、上受け皿8aに貯留された遊技球を下受け皿9a側に抜くための球抜きボタン16が設けられている。下受け皿ユニット9には、下受け皿9aに貯留された遊技球をパチンコ遊技機1下方に抜くための球抜きレバー17が設けられている。
また上受け皿ユニット8には、図示しない遊技球貸出装置に対して遊技球の払い出しを要求するための球貸しボタン14と、遊技球貸出装置に挿入した有価価値媒体の返却を要求するためのカード返却ボタン15とが設けられている。
さらに上受け皿ユニット8には、パトライトスイッチ11、演出ボタン12、十字キー13が設けられている。パトライトスイッチ11や演出ボタン12は、所定の入力受付期間中に内蔵ランプが点灯されて操作可能となり、その内蔵ランプ点灯時に押下することにより演出に変化をもたらすことができる押しボタンとされる。また十字キー13は遊技者が演出状況に応じた操作や演出設定等のための操作を行う操作子である。
The
The
Further, the
Further, the
発射操作ハンドル10は操作パネル7の右端部側に設けられ、遊技者が弾球のために図3に示す発射装置32を作動させる操作子である。
また前枠2の上部の両側と、発射操作ハンドル10の近傍には、演出音を音響出力するスピーカ25が設けられている。
The firing operation handle 10 is provided on the right end side of the operation panel 7 and is an operator for operating the
In addition,
次に図2を参照して、遊技盤3の構成について説明する。遊技盤3は、略正方形状の木製合板または樹脂板を主体として構成されている。この遊技盤3には、発射された遊技球を案内する球誘導レール31が盤面区画部材として環状に装着されており、この球誘導レール31に取り囲まれた略円形状の領域が遊技領域3aとなっている。
Next, the configuration of the
この遊技領域3aの略中央部には、主液晶表示装置32M(LCD:Liquid Crystal Display)が設けられ、また主液晶表示装置32Mの右側には副液晶表示装置32Sが設けられている。
主液晶表示装置32Mでは、後述する演出制御部51の制御の下、背景画像上で、例えば左、中、右の3つの装飾図柄の変動表示が行われる。また通常演出、リーチ演出、スーパーリーチ演出などの各種の演出画像の表示も行われる。副液晶表示装置32Sも、同様に各種演出に応じた表示が行われる。
A main liquid
In the main liquid
また遊技領域3a内には、主液晶表示装置32M及び副液晶表示装置32Sの表示面の周囲を囲むように、センター飾り35Cが設けられている。
センター飾り35Cは、そのデザインにより装飾効果を発揮するだけでなく、周囲の遊技球から主液晶表示装置32M及び副液晶表示装置32Sの表示面を保護する作用を持つ。さらにセンター飾り35Cは、遊技球の打ち出しの強さまたはストローク長による遊技球の流路の左右打ち分けを可能とする部材としても機能する。すなわち球誘導レール31を介して遊技領域3a上部に打ち出された遊技球の流下経路は、センター飾り35Cによって分割された左遊技領域3bと右遊技領域3cのいずれかを流下することとなる。いわゆる左打ちの場合、遊技球は左遊技領域3bを流下していき、右打ちの場合、遊技球は右遊技領域3cを流下していく。
A
The
また左遊技領域3bの下方には、左下飾り35Lが設けられ、装飾効果を発揮するとともに左遊技領域3bとしての範囲を規定する。
同様に右遊技領域3cの下方には右下飾り35Rが設けられ、装飾効果を発揮するとともに左遊技領域3bとしての範囲を規定する。
なお、遊技領域3a(左遊技領域3b及び右遊技領域3c)内には、所要各所に釘49や風車47が設けられて遊技球の多様な流下経路を形成する。
また主液晶表示装置32Mの下方にはセンターステージ35Sが設けられており、装飾効果を発揮するとともに、遊技球の遊動領域として機能する。
なお図示していないが、センター飾り35Cには、適所に視覚的演出効果を奏する可動体役物が設けられている。
In addition, a lower
Similarly, a lower
In the
Further, a
Although not shown in the drawing, the
遊技領域3aの右上縁付近には、複数個のLEDを配置して形成されたドット表示器による図柄表示部33が設けられている。
この図柄表示部33では、所定のドット領域により、第1特別図柄表示部、第2特別図柄表示部、及び普通図柄表示部が形成され、第1特別図柄、第2特別図柄、及び普通図柄のそれぞれの変動表示動作(変動開始および変動停止を一セットする変動表示動作)が行われる。
なお、上述した主液晶表示装置32Mは、図柄表示部33による第1、第2特別図柄の変動表示と時間的に同調して、画像による装飾図柄を変動表示する。
In the vicinity of the upper right edge of the
In the symbol display unit 33, a first special symbol display unit, a second special symbol display unit, and a normal symbol display unit are formed by a predetermined dot area, and the first special symbol, the second special symbol, and the normal symbol are displayed. Each variation display operation (variation display operation for setting variation start and variation stop as one set) is performed.
The main liquid
センター飾り35Cの下方には、上始動口41(第1の特別図柄始動口)を有する入賞装置が設けられ、さらにその下方には下始動口42a(第2の特別図柄始動口)を備える普通変動入賞装置42が設けられている。
上始動口41及び下始動口42aの内部には、遊技球の通過を検出する検出センサ(図3に示す上始動口センサ71,下始動口センサ72)が形成されている。
A winning device having an upper start port 41 (first special symbol start port) is provided below the
Inside the upper start opening 41 and the lower start opening 42a, detection sensors (upper
上始動口41は、図柄表示部33における第1特別図柄の変動表示動作の始動条件に係る入賞口で、始動口開閉手段(始動口を開放または拡大可能にする手段)を有しない入賞率固定型の入賞装置となっている。
The
下始動口42aを有する普通変動入賞装置42は、始動口開閉手段により始動口の遊技球の入賞率を変動可能な入賞率変動型の入賞装置として構成されている。すなわち下始動口42aを開放または拡大可能にする左右一対の可動翼片(可動部材)42bを備えた、いわゆる電動チューリップ型の入賞装置である。
この普通変動入賞装置42の下始動口42aは、図柄表示部33における第2特別図柄の変動表示動作の始動条件に係る入賞口である。そして、この下始動口42aの入賞率は可動翼片42bの作動状態に応じて変動する。すなわち可動翼片42bが開いた状態では、入賞が容易となり、可動翼片42bが閉じた状態では、入賞が困難又は不可能となるように構成されている。
The normal
The lower start opening 42 a of the normal
また普通変動入賞装置42の左右には、一般入賞口43が複数個設けられている。各一般入賞口42の内部には、遊技球の通過を検出する検出センサ(図3に示す一般入賞口センサ74)が形成されている。
また右遊技領域3cの下部側には、遊技球が通過可能なゲート(特定通過領域)からなる普通図柄始動口44が設けられている。この普通図柄始動口44は、図柄表示部33における普通図柄の変動表示動作に係る入賞口であり、その内部には、通過する遊技球を検出するセンサ(図3に示すゲートセンサ73)が形成されている。
In addition, a plurality of general winning
In addition, a normal
右遊技領域3c内の普通図柄始動口44から普通変動入賞装置42へかけての流下経路途中には第1特別変動入賞装置45(特別電動役物)が設けられている。
第1特別変動入賞装置45は、突没式の開放扉45bにより第1大入賞口45aを閉鎖/開放する構造とされている。また、その内部には第1大入賞口45aへの遊技球の通過を検出するセンサ(図3の第1大入賞口センサ75)が形成されている。
第1大入賞口45aの周囲は、右下飾り35Rが遊技盤3の表面から膨出した状態となっており、その膨出部分の上辺及び開放扉45bの上面が右流下経路3cの下流案内部を形成している。従って、開放扉45bが盤内部側に引き込まれることで、下流案内部に達した遊技球は容易に第1大入賞口45に入る状態となる。
A first special variable winning device 45 (special electric accessory) is provided along the flow path from the normal
The first special variable winning
The lower
また普通変動入賞装置42の下方には、第2特別変動入賞装置46(特別電動役物)が設けられている。第2特別変動入賞装置46は、下部が軸支されて開閉可能な開放扉46bにより、その内側の第2大入賞口46aを閉鎖/開放する構造とされている。また、その内部には第2大入賞口46aへの遊技球の通過を検出するセンサ(図3の第2大入賞口センサ76)が形成されている。
開放扉46bが開かれることで第2大入賞口46aが開放される。この状態では、左遊技領域3b或いは右遊技領域3cを流下してきた遊技球は、高い確率で第2大入賞口50に入ることとなる。
A second special variable winning device 46 (special electric accessory) is provided below the normal
The second
以上のように盤面の遊技領域には、入賞口として上始動口41、下始動口42a、普通図柄始動口44、第1大入賞口45a、第2大入賞口46a、一般入賞口43が形成されている。
本実施の形態のパチンコ遊技機1においては、これら入賞口のうち、普通図柄始動口44以外の入賞口への入賞があった場合には、各入賞口別に設定された入賞球1個当りの賞球数が遊技球払出装置55(図3参照)から払い出される。
例えば、上始動口41および下始動口42aは3個、第1大入賞口45a、第2大入賞口46aは13個、一般入賞口43は10個などと賞球数が設定されている。
なお、これらの各入賞口に入賞しなかった遊技球は、アウト口48を介して遊技領域3aから排出される。
ここで「入賞」とは、入賞口がその内部に遊技球を取り込んだり、ゲートを遊技球が通過したりすることをいう。実際には入賞口ごとに形成されたセンサ(各入賞検出スイッチ)により遊技球が検出された場合、その入賞口に「入賞」が発生したものとして扱われる。この入賞に係る遊技球を「入賞球」とも称する。
As described above, the
In the
For example, the upper start opening 41 and the lower start opening 42a are set to three, the first big winning
Note that the game balls that have not won the prize holes are discharged from the
Here, “winning” means that the winning opening takes the game ball inside, or the game ball passes through the gate. Actually, when a game ball is detected by a sensor (each winning detection switch) formed for each winning opening, it is treated that a “winning” has occurred in that winning opening. The game ball related to the winning is also referred to as “winning ball”.
以上のような盤面において、センター飾り35C、左下飾り35L、右下飾り35R、センターステージ35S、第1特別変動入賞装置45、第2特別変動入賞装置46、さらには図示していない可動体役物には、詳細には図示していないが各所に、盤側の発光手段として装飾ランプ20bが設けられている。
装飾ランプ20bは、例えばLEDによる発光動作として、演出用の発光動作、エラー告知用の発光動作、動作状態に応じた発光動作などを行う。
On the board as described above, the
The
<2.パチンコ遊技機の制御構成>
次に本実施の形態のパチンコ遊技機1の制御系の構成について説明する。図3はパチンコ遊技機1の内部構成の概略的なブロック図である。
本実施の形態のパチンコ遊技機1は、その制御構成を形成する基板として主に、主制御基板50、演出制御基板51、液晶制御基板52、払出制御基板53、発射制御基板54、電源基板58が設けられている。
<2. Control configuration of pachinko machine>
Next, the configuration of the control system of the
The
主制御基板50は、マイクロコンピュータ等が搭載され、パチンコ遊技機1の遊技動作全般に係る統括的な制御を行う。なお以下では、主制御基板50に搭載されたマイクロコンピュータ等を含めて主制御基板50の構成体を「主制御部50」と表記する。
演出制御基板51は、マイクロコンピュータ等が搭載され、主制御部50から演出制御コマンドを受けて、画像表示、発光、音響出力を用いた各種の演出動作を実行させるための制御を行う。なお以下では、演出制御基板51に搭載されたマイクロコンピュータ等を含めて演出制御基板51の構成体を「演出制御部51」と表記する。
The
The
液晶制御基板52はマイクロコンピュータやビデオプロセッサ等が搭載され、演出制御部51からの表示制御コマンドを受けて、主液晶表示装置32M、副液晶表示装置32Sによる表示動作の制御を行う。
なお主液晶表示装置32M、副液晶表示装置32Sによる表示動作の制御を行う液晶制御基板として、主液晶制御基板、副液晶制御基板を独立して設けてもよい。
払出制御基板53は、パチンコ遊技機1に接続された遊技球払出装置55による賞球の払い出し制御を行う。
発射制御基板54は、遊技者のパチンコ遊技機1に設けられている発射装置56による遊技球の発射動作の制御を行う。
電源基板58は、外部電源(例えばAC24V)からAC/DC変換、さらにはDC/DC変換を行い、各部に動作電源電圧Vccを供給する。なお電源経路の図示は省略している。
The liquid
The main liquid crystal control substrate and the sub liquid crystal control substrate may be provided independently as the liquid crystal control substrate for controlling the display operation by the main liquid
The
The
The
まず主制御部50及びその周辺回路について述べる。
主制御部50は、CPU100(以下「主制御CPU100」と表記)を内蔵したマイクロプロセッサ、ROM101(以下「主制御ROM101」と表記)、RAM102(以下「主制御RAM102」と表記)を搭載し、マイクロコンピュータを構成している。
主制御CPU100は制御プログラムに基づいて、遊技の進行に応じた各種演算及び制御処理を実行する。
主制御ROM101は、主制御CPU100による遊技動作の制御プログラムや、遊技動作制御に必要な種々のデータを記憶する。
主制御RAM102は、主制御CPU100が各種演算処理に使用するワークエリアや、各種入出力データや処理データのバッファ領域として用いられる。
なお後述もするが、主制御部50は、各部とのインターフェース回路(外部バスI/F109等)、乱数を生成する乱数回路(104)、各種の時間計数のためのCTC(Counter Timer Circuit:タイマ回路106)、主制御CPU100に割込み信号を与える割込コントローラ(105)なども備えている。
また、主制御RAM102は、主制御部50に形成された不図示のバックアップ用電源端子に別途電源が供給されていることで、主制御部50の電源切断後もデータを保持するようにされている。
First, the
The
The
The
The
As will be described later, the
Further, the
主制御部50は、上述のように盤面の遊技領域の各入賞手段(上始動口41、下始動口42a、普通図柄始動口44、第1大入賞口45a、第2大入賞口46a、一般入賞口43)に設けられるセンサの検出信号を受信する構成となっている。
すなわち、上始動口センサ71、下始動口センサ72、ゲートセンサ73、一般入賞口センサ74、第1大入賞口センサ75、第2大入賞口センサ76のそれぞれの検出信号が主制御部50に供給される。
なお、これらのセンサ(71〜76)は、入球した遊技球を検出する検出スイッチにより構成されるが、具体的にはフォトスイッチや近接スイッチなどの無接点スイッチや、マイクロスイッチなどの有接点スイッチで構成することができる。
As described above, the
That is, the detection signals of the upper
These sensors (71 to 76) are configured by detection switches that detect a game ball that has entered, but specifically, contactless switches such as photoswitches and proximity switches, and contact points such as microswitches. It can consist of switches.
主制御部50は、上始動口センサ71、下始動口センサ72、ゲートセンサ73、一般入賞口センサ74、第1大入賞口センサ75、第2大入賞口センサ76のそれぞれの検出信号の受信に応じて、処理を行う。例えば抽選処理、図柄変動制御、賞球払出制御、演出制御コマンド送信制御、外部データ送信処理などを行う。
The
また主制御部50には、下始動口42の可動翼片42bを開閉駆動する普通電動役物ソレノイド77が接続され、主制御部50は遊技進行状況に応じて制御信号を送信して普通電動役物ソレノイド77の駆動動作を実行させ、可動翼片42bの開閉動作を実行させる。
さらに、主制御部50には、第1大入賞口45の開放扉45bを開閉駆動する第1大入賞口ソレノイド78と、第2大入賞口46の開放扉46bを開閉駆動する第2大入賞口ソレノイド79が接続されている。主制御部50は、いわゆる大当たり状況に応じて、第1大入賞口ソレノイド78又は第2大入賞口ソレノイド79を駆動制御して、第1大入賞口45又は第2大入賞口46の開放動作を実行させる。
The
Further, the
また主制御部50には、図柄表示部33が接続されており、図柄表示部33に制御信号を送信して、各種図柄表示(LEDの消灯/点灯/点滅)を実行させる。これにより図柄表示部33における第1特別図柄表示部80、第2特別図柄表示部81、普通図柄表示部82での表示動作が実行される。
In addition, a symbol display unit 33 is connected to the
また主制御部50には、枠用外部端子基板57が接続される。主制御部50は、遊技進行に関する情報を、枠用外部端子基板57を介して図示しないホールコンピュータに送信可能となっている。遊技進行に関する情報とは、例えば大当り当選情報、賞球数情報、図柄変動表示実行回数情報などの情報である。ホールコンピュータとは、パチンコホールのパチンコ遊技機1を統括的に管理する管理コンピュータであり、パチンコ遊技機1外部に設置されている。
The
また主制御部50には、払出制御基板53が接続されている。払出制御基板53には、発射装置56を制御する発射制御基板54と、遊技球の払い出しを行う遊技球払出装置55が接続されている。
主制御部50は、払出制御基板53に対し、払い出しに関する制御コマンド(賞球数を指定する払出制御コマンド)を送信する。払出制御基板53は当該制御コマンドに応じて遊技球払出装置55を制御し、遊技球の払い出しを実行させる。
また払出制御基板53は、主制御部50に対して、払い出し動作状態に関する情報(払出状態信号)を送信可能となっている。主制御部50側では、この払出状態信号によって、遊技球払出装置55が正常に機能しているか否かを監視する。具体的には、賞球の払い出し動作の際に、玉詰まりや賞球の払い出し不足といった不具合が発生したか否かを監視している。
In addition, a
The
The
また主制御部50は、特別図柄変動表示に関する情報を含む演出制御コマンドを、演出制御部51に送信する。なお、主制御部50から演出制御部51への演出制御コマンドの送信は一方向通信により実行されるようにしている。これは、外部からの不正行為による不正な信号が演出制御部51を介して主制御部50に入力されることを防止するためである。
The
続いて演出制御部51及びその周辺回路について説明する。
演出制御部51は、CPU200(以下「演出制御CPU200」と表記)を内蔵したマイクロプロセッサ、ROM201(以下「演出制御ROM201」と表記)、RAM202(以下「演出制御RAM202」と表記)を搭載し、マイクロコンピュータを構成している。
演出制御CPU200は演出制御プログラム及び主制御部50から受信した演出制御コマンドに基づいて、各種演出動作のための演算処理や各演出手段の制御を行う。演出手段とは、本実施の形態のパチンコ遊技機1の場合、主液晶表示装置32M、副液晶表示装置32S、装飾ランプ20w、20b、スピーカ59及び図示を省略した可動体役物となる。
演出制御ROM201は、演出制御CPU200による演出動作の制御プログラムや、演出動作制御に必要な種々のデータを記憶する。
演出制御RAM202は、演出制御CPU200が各種演算処理に使用するワークエリアや、テーブルデータ領域、各種入出力データや処理データのバッファ領域などとして用いられる。
なお図示は省略したが、演出制御部51は、各部とのインターフェース回路、演出のための抽選用乱数を生成する乱数生成回路、各種の時間計数のためのCTC、演出制御CPU200に割込み信号を与える割込コントローラ回路なども備えている。
この演出制御部51の主な役割は、主制御部50からの演出制御コマンドの受信、演出制御コマンドに基づく演出の選択決定、主液晶表示装置32M、副液晶表示装置32S側への演出制御コマンドの送信、スピーカ25による出力音制御、装飾ランプ20w,20b(LED)の発光制御、可動体役物の動作制御などとなる。
Next, the
The
The
The
The
Although illustration is omitted, the
The main roles of the
演出制御部51は、主液晶表示装置32M、副液晶表示装置32S側への演出制御コマンドの送信を行うが、その演出制御コマンドは、液晶インターフェース基板66を介して液晶制御基板52に送られる。
The
液晶制御基板52は、主液晶表示装置32M及び副液晶表示装置32Sの表示制御を行う。図示していないが、液晶制御基板52には、VDP(Video Display Processor)、画像ROM、VRAM(Video RAM)、液晶制御CPU、液晶制御ROM、液晶制御RAMを備えている。
VDPは、画像展開処理や画像の描画などの映像出力処理全般の制御を行う。
画像ROMには、VDPが画像展開処理を行う画像データ(演出画像データ)が格納されている。
VRAMは、VDPが展開した画像データを一時的に記憶する画像メモリ領域とされる。
液晶制御CPUは、VDPが表示制御を行うために必要な制御データを出力する。
液晶制御ROMには、液晶制御CPUの表示制御動作手順を記述したプログラムやその表示制御に必要な種々のデータが格納される。
液晶制御RAMは、ワークエリアやバッファメモリとして機能する。
The liquid
The VDP performs overall control of video output processing such as image development processing and image drawing.
The image ROM stores image data (effect image data) on which the VDP performs image expansion processing.
The VRAM is an image memory area that temporarily stores image data developed by the VDP.
The liquid crystal control CPU outputs control data necessary for the VDP to perform display control.
The liquid crystal control ROM stores a program describing the display control operation procedure of the liquid crystal control CPU and various data necessary for the display control.
The liquid crystal control RAM functions as a work area and a buffer memory.
液晶制御基板52は、これらの構成により、演出制御基板51からの演出制御コマンドに基づいて各種の画像データを生成し、主液晶表示装置32M及び副液晶表示装置32Sに出力する。これによって主液晶表示装置32M及び副液晶表示装置32Sにおいて各種の演出画像が表示される。
With these configurations, the liquid
また演出制御部51は、光演出や音演出の制御を行う。このため演出制御部51には枠ドライバ部61、盤ドライバ部62及び音源IC(Integrated Circuit)59が接続されている。
枠ドライバ部61は、枠側の装飾ランプ部63のLEDについて発光駆動を行う。なお、装飾ランプ部63とは、図1に示したように枠側に設けられている装飾ランプ20wを総括的に示したものである。
盤ドライバ部62は、盤側の装飾ランプ部64のLEDについて発光駆動を行う。なお、装飾ランプ部64とは、図2に示したように盤側に設けられている装飾ランプ20bを総括的に示したものである。
また盤ドライバ部62は、可動体役物モータ部65のモータの駆動も行う。可動体役物モータ65は、盤側に形成されている1又は複数の可動体役物を駆動する1又は複数の各モータを総括的に示している。可動体役物モータ部65のモータには例えばステッピングモータが用いられる。
The
The
The
The
なおこの例では盤ドライバ部62は、盤側に形成されている可動体役物を駆動する可動体役物モータ部65のモータの駆動も行うものとしているが、装飾ランプ部64の各LEDを発光駆動するドライバ部と、可動体役物モータ部65のモータを駆動するドライバ部が別体として設けられても良い。
In this example, the
可動体役物モータ部65としては、例えば複数の役物に対応して複数のモータ(例えばステッピングモータ)が設けられる。
各モータには原点位置が規定されている。原点位置は、例えば役物が図2の盤面に通常は表出しない位置などとされる。
モータが原点位置にあるか否かを演出制御基板51側で確認できるようにするため、各モータには原点スイッチ68が設けられている。例えばフォトインターラプタが用いられる。この原点スイッチ68の情報が演出制御CPU200によって検知される構成とされている。
As the movable body
Each motor has a specified origin position. The origin position is, for example, a position where an accessory does not normally appear on the board surface of FIG.
Each motor is provided with an
また演出制御部51は、スピーカ25により所望の音を出力させるべく、音源IC59に対する制御を行う。音源IC59には音データROM69が接続されており、音源IC59は音データROM69から必要な音データ(再生するフレーズの音データ)を取得して音声信号出力を行う。
音源IC59は、複数チャネル(後述する音チャネルaCH)のフレーズをミキシングして所定本数(チャネル数)の音声信号を得る。図1に示したように、本例の場合、スピーカ25は複数設けられるため、音源IC59の出力チャネル数は例えばLch,Rchの2チャネルなど(ステレオ出力)が可能となる。上記のミキシングにより、演出制御部51より再生指示された複数チャネルのフレーズを同時再生可能とされる。
また音源IC59は、演出制御部51からの指示に従い、制御対象として指示されたフレーズについての音コントロールを行う。具体的に、演出制御部51は、ボリュームの変化指示やフェードイン再生/フェードアウト再生等の音響効果の付与指示に係る情報を音源IC59に対して与え、音源IC59はそれらの情報に従って制御対象として指定されたフレーズの再生制御を行う。
Further, the
The
The
音源IC59による出力音声信号はアンプ部67で増幅された後、スピーカ25に対して与えられる。
なお、図3では図示の都合上、音源IC59の出力チャネル数を1つとしているが、実際にはアンプ部67及びスピーカ25は例えばLch、Rchに対応した出力チャネルがそれぞれ設けられ、ステレオによる音再生が可能とされる。
The output audio signal from the
In FIG. 3, for convenience of illustration, the number of output channels of the
なお、上記では音源IC59を演出制御基板51とは別体に設けるものとしたが、音源IC59は演出制御基板51と同一基板上に一体的に設けることもできる。
In the above description, the
また演出制御部51には、遊技者が操作可能な操作部60が接続され、操作部60からの操作検出信号を受信可能となっている。この操作部60は、図1で説明したパトライトスイッチ11、演出ボタン12、十字キー13と、それらの操作検出機構のことである。
演出制御部51は、操作部60からの操作検出信号に応じて、各種演出制御を行うことができる。
The
The
演出制御部51は、主制御部50から送られてくる演出制御コマンドに基づき、あらかじめ用意された複数種類の演出パターンの中から抽選によりあるいは一意に演出パターンを決定し、必要なタイミングで各種演出手段を制御する。これにより、演出パターンに対応する主・副液晶表示装置32M、32Sによる演出画像の表示、スピーカ25からの音再生、装飾ランプ部63、64(装飾ランプ20w、20b)におけるLEDの点灯点滅駆動、可動体役物モータ部65のモータによる可動体役物の動作が実現され、時系列的に種々の演出パターンが展開されていく。これにより「演出シナリオ」が実現される。
The
なお演出制御コマンドは、1バイト長のモード(MODE)と、同じく1バイト長のイベント(EVENT)からなる2バイト構成により機能を定義する。
MODEとEVENTの区別を行うために、MODEのBit7はON、EVENTのBit7をOFFとしている。
これらの情報を有効なものとして送信する場合、モード(MODE)およびイベント(EVENT)各々に対応してストローブ信号が出力される。すなわち、主制御CPU100は、送信すべきコマンドがある場合、演出制御部51にコマンドを送信するためのモード(MODE)情報の設定および出力を行い、この設定から所定時間経過後に1回目のストローブ信号の送信を行う。さらに、このストローブ信号の送信から所定時間経過後にイベント(EVENT)情報の設定および出力を行い、この設定から所定時間経過後に2回目のストローブ信号の送信を行う。
ストローブ信号は主制御CPU100により、演出制御CPU200が確実にコマンドを受信することが可能な所定期間アクティブ状態に制御される。
また演出制御部51(演出制御CPU200)は、ストローブ信号の入力に基づいて割込を発生させてコマンド受信割込処理用の制御プログラムを実行し、この割込処理において演出制御コマンドが取得される。
The effect control command defines a function by a 2-byte structure consisting of a 1-byte length mode (MODE) and a 1-byte length event (EVENT).
In order to distinguish between MODE and EVENT, MODE Bit 7 is ON, and EVENT Bit 7 is OFF.
When these pieces of information are transmitted as valid, a strobe signal is output corresponding to each of the mode (MODE) and the event (EVENT). That is, when there is a command to be transmitted, the
The strobe signal is controlled by the
The effect control unit 51 (effect control CPU 200) generates an interrupt based on the input of the strobe signal and executes a control program for command reception interrupt processing, and the effect control command is acquired in this interrupt processing. .
<3.主制御部の構成>
図4は、主制御部50の内部構成を示したブロック図である。
主制御部50は、前述した主制御CPU100、主制御ROM101及び主制御RAM102が接続された内部バス103と、内部バス103に対して接続された乱数回路104、割込コントローラ105、タイマ回路106、カウンタ回路107、リセットコントローラ108、外部バスI/F(インターフェース)109、クロック回路110、パラレル入力回路111、シリアル通信回路112、アドレスデコード回路113及び演算回路114の各部を備えている。
本例の場合、これら主制御部50を構成する各部は同一基板上に実装されている。すなわち、主制御部50としてのマイクロコンピュータは所謂ワンチップマイコンとされている。
<3. Configuration of main control unit>
FIG. 4 is a block diagram showing an internal configuration of the
The
In the case of this example, each part which comprises these
乱数回路104は、所定の規則に従って乱数値を発生させる回路である。本例の場合、乱数回路104は16ビット疑似乱数を2系統(2チャンネル)生成可能とされている。乱数回路104には、乱数値のスタート値や更新方法を選択的に設定可能とされている。
本例の場合、乱数回路104の乱数(ハードウェア乱数)は、大当り/小当り/はずれの判定に用いられる。なお、後述する特別図柄用乱数や普通図柄用乱数などの他の乱数は、プログラムにより更新されるソフトウェア乱数とされる。
The
In the case of this example, the random number (hardware random number) of the
割込コントローラ105は、パラレル入力回路111の所定の信号入力端子DTiを介して行われる外部からの割込要求や、主制御部50内の回路、特にシリアル通信回路112、乱数回路104、タイマ回路106からの割込要求を制御する回路である。
割込コントローラ105は、ノンマスカブル割込とマスカブル割込の2種の割込みについて制御を行うことが可能とされている。ノンマスカブル割込は、主制御CPU100の割込み禁止状態でも無条件に受け付けられるべき割込みであり、パラレル入力回路111の信号入力端子DTiのうちの所定の信号入力端子DTiに所定の信号が入力されることで発生する。
マスカブル割込は、主制御CPU100の設定命令により割込みの要求の受付を許可/禁止できる割込みである。マスカブル割込は、その種類ごとに予め優先順位を設定しておくことが可能とされ、優先度の低い割込みをマスクすることが可能とされている。
マスカブル割込には大別して外部マスカブル割込と内部マスカブル割込の2種がある。外部マスカブル割込は、パラレル入力回路111の信号入力端子DTiのうちの所定の信号入力端子DTiに所定の信号が入力されることで発生する割込みである。
内部マスカブル割込は、次に示す割込発生要因に起因して発生する割込みである。すなわち、タイマ回路106のタイムアウト、シリアル通信回路112のデータ受信、シリアル通信回路112のデータ送信、及び乱数回路104の乱数取り込みである。
The interrupt
The interrupt
The maskable interrupt is an interrupt that can permit / prohibit acceptance of an interrupt request by a setting instruction of the
There are two types of maskable interrupts: external maskable interrupts and internal maskable interrupts. The external maskable interrupt is an interrupt generated when a predetermined signal is input to a predetermined signal input terminal DTi among the signal input terminals DTi of the
An internal maskable interrupt is an interrupt generated due to the following interrupt generation factors. That is, timeout of the
タイマ回路106は、プログラマブルタイマとされ、ユーザプログラムの設定によりリアルタイム割込要求や時間計測が可能とされている。本例の場合、タイマ回路106は8ビットのタイマを3チャンネル有している。
The
カウンタ回路107は、プログラマブルカウンタとされ、ユーザプログラムの設定により時間計測等が可能とされている。本例の場合、カウンタ回路107は8ビットのカウンタを4チャンネル有している。
The
リセットコントローラ108は、各種リセットと内部リセットを制御する回路である。
ここで、パチンコ遊技機1のリセットにはシステムリセットとユーザリセットの2種が存在する。システムリセットは、主制御CPU100を含む主制御部50の内部回路全てが初期化されるリセットであり、リセット端子TRSにシステムリセット信号SRSTが入力されたことに応じて実行される。
ここで、システムリセットについては、初期化が実行された後、セキュリティモードに移行するかPROMモードに移行するかを選択可能とされている。セキュリティモードは、初期化が実行された後にセキュリティチェックを行い、その結果がOKであればユーザモード(ユーザプログラムをリセットアドレスから実行するモード)に移行し、NGであれば主制御CPU100を停止させる動作モードである。PROMモードは、主制御ROM101の読み書きを行うための動作モードである。初期化後にセキュリティモード/PROMモードの何れに移行するかは、設定端子TPRに入力するプログラム信号PRGのレベル(例えばLOWレベル/Highレベル)に応じて選択可能とされている。
ユーザリセットは、主制御部50内の所定の回路のみが選択的に初期化され、初期化後に上記のユーザモードに移行するリセットである。ユーザリセットにより初期化される回路は、例えば主制御CPU100、割込コントローラ105、タイマ回路106、カウンタ回路107、パラレル入力回路111、シリアル通信回路112及び演算回路114である。ユーザリセットは、リセットコントローラ108に備えられたWDT(ウォッチドッグタイマ)回路120による後述するタイムアウト信号Stoに応じて発生する。
なお、WDT回路120については後に改めて説明する。
The
Here, there are two types of resetting of the pachinko gaming machine 1: system reset and user reset. The system reset is a reset in which all the internal circuits of the
Here, with regard to the system reset, it is possible to select whether to shift to the security mode or the PROM mode after the initialization is executed. In the security mode, a security check is performed after the initialization is executed, and if the result is OK, the mode is shifted to the user mode (mode in which the user program is executed from the reset address), and if the result is NG, the
The user reset is a reset in which only a predetermined circuit in the
The
外部バスI/F109は、アドレスバス、データバス、及び各制御信号の方向制御や、駆動能力を強化するバスインターフェースである。図1に示した演出制御部51、液晶I/F基板66、音源IC59などの所定の外部デバイスとのデータ通信は外部バスI/F109を介して行われる。
外部バスI/F109は、データ入出力用端子DTを介して複数ビット(本例では8ビット)のデータを送受信可能とされていると共に、アドレスデータ出力端子を介して複数ビット(本例では16ビット)のアドレスデータを出力可能とされている。また外部バスI/F109は、各種のリクエスト信号やサイクルを示す信号などデータのやりとりに付随する信号を複数の信号出力端子SToを介して出力可能とされている。
The external bus I / F 109 is a bus interface that reinforces the address bus, the data bus, the direction control of each control signal, and the driving capability. Data communication with predetermined external devices such as the
The external bus I / F 109 can transmit / receive a plurality of bits (8 bits in this example) via the data input / output terminal DT and a plurality of bits (16 bits in this example) via the address data output terminal. Bit address data can be output. Further, the external bus I / F 109 can output signals accompanying data exchange such as various request signals and signals indicating cycles via a plurality of signal output terminals STo.
クロック回路110は、外部より第1の外部クロックと第2の外部クロックが入力され、第1の外部クロックに基づき主制御CPU100を始めとした主制御部50の内部回路に対してシステムクロックを供給する共に、第2の外部クロックを乱数回路104に対して供給する。またクロック回路110は、システムクロックを不図示のクロック端子を介して外部デバイスに供給可能とされている。
なお、本例の場合、クロック回路110は外部から入力されたクロックを2分周してシステムクロックを生成する。
The
In the case of this example, the
パラレル入力回路111は、入力専用のパラレル入力ポートであり、複数の信号入力端子DTiを介して外部デバイスより複数系統の信号をパラレル入力可能とされている。パラレル入力回路111は、パラレル入力された信号を内部バス103に送出可能とされている。またパラレル入力回路111は、信号入力端子DTiのうち所定の信号入力端子DTiに入力された信号を乱数回路104に供給可能とされている。
パラレル入力回路111は、信号入力端子DTiのうちの所定の信号入力端子DTiに所定の信号が入力されたことに応じて、前述したノンマスカブル割込又は外部マスカブル割込についての割込要求信号を割込コントローラ105に出力する。
The
The
シリアル通信回路112は、外部デバイスとの間でシリアルデータ通信によるデータの送受信を行う。本例の場合、主制御CPU100と払出制御基板53との間のデータ送受信は当該シリアル通信回路112を介して行われる。
シリアル通信回路112は、送信データをデータ送信端子TXを介して外部デバイスに送信する。一方、データの受信については、パラレル入力回路111の信号入力端子DTiのうち所定の一つの信号入力端子DTiを用いて行うことが可能とされている。
また、シリアル通信回路112は、データ送信に応じた割込要求信号を割込コントローラ105に出力する。
なお、ここではシリアル通信回路112のデータ送信端子TXが1つのみとされた場合すなわち送信系統が1系統のみとされた場合を例示したが、シリアル通信回路112による送信系統は2系統以上とすることもできる。
また、シリアル通信回路112がパラレル入力回路111の所定の信号入力端子DTiを共用してデータ受信を行う例を挙げたが、シリアル通信回路112がデータ受信を行うための端子を別途に設けることもできる。
The
The
Further, the
Here, the case where only one data transmission terminal TX of the
In addition, an example has been given in which the
アドレスデコード回路113は、ユーザプログラムの外部デバイス用のアドレスデコード回路である。本例のアドレスデコード回路113はメモリマップドI/O方式及びI/OマップドI/O方式の双方に対応しており、主制御RAM102へのリード/ライト命令に含まれるアドレスデータをデコードして外部デバイスのチップセレクト信号CSを生成し、外部デバイスに出力することが可能とされている。なお、生成したチップセレクト信号CSは、図示を省略したチップセレクト信号出力端子を介して外部デバイスに送出可能とされている。本例の場合、チップセレクト信号CSは設定によりシリアル通信回路112のデータ通信端子TXを介して出力することも可能とされている。
なお、本例のパチンコ遊技機1においては、設定によりチップセレクト信号CSを使用しない選択を行うことも可能とされている。
The
In the
演算回路114は、乗算回路と除算回路を備え、乗算及び除算を行うことが可能とされている。本例の場合、乗算回路は8ビット×8ビットの乗算回路とされ、除算回路は16ビット÷16ビットの除算回路とされている。
The
<4.ウォッチドッグタイマ回路の構成>
図5は、WDT回路120の内部構成を示したブロック図である。
WDT回路120は、タイマ制御部201、クロック選択部202、カウンタ203、出力回路204、クリアレジスタ205、機能設定レジスタ206及び停止制御部207を備えている。
<4. Configuration of watchdog timer circuit>
FIG. 5 is a block diagram showing the internal configuration of the
The
機能設定レジスタ206は、WDTとしてのカウンタ203の動作の許可/禁止や動作を許可する場合におけるタイムアウト時間の指示値をセットするためのレジスタとされる。
クリアレジスタ205は、カウンタ203のカウントクリア及びカウントリスタートを指示する値をセットするためのレジスタとされる。
これら機能設定レジスタ206及びクリアレジスタ205には、内部バス103を介して値がセットされる。
The
The
Values are set in the
クロック選択部202には、クロック回路110からのシステムクロックがそれぞれ22分周、23分周、24分周、25分周,…,28分周されて得られた複数のクロックが入力される。クロック選択部202は、タイマ制御部201からの指示に基づきこれら複数のクロックのうちの1つを選択してカウンタ203に出力する。
The
カウンタ203は、クロック選択部202より出力されるクロックをカウントクロックとして入力し、当該カウントクロックに従ってカウント動作(計数動作)を行う。
カウンタ203は、タイマ制御部201からの指示に基づき起動され、またカウント動作を停止/開始する。またカウンタ203は、タイマ制御部201からの指示に基づきカウント値のリセット及びカウントのリスタートを行う。
カウンタ203には、タイマ制御部201よりタイムアウト時間を表すカウント上限値が指示される。カウンタ203は、カウント値がタイマ制御部201より指示されたカウント上限値に達したことに応じて、その旨を表す信号を通知信号として出力回路204に出力する。
The
The
The
出力回路204は、タイマ制御部201からの通知信号に基づき、タイムアウト信号Stoを出力する。
タイムアウト信号Stoは、ユーザリセットによる初期化が必要とされる回路(本例では前述した主制御CPU100、割込コントローラ105、タイマ回路106、カウンタ回路107、パラレル入力回路111、シリアル通信回路112及び演算回路114)に対して出力される。
The
The timeout signal Sto is a circuit that needs to be initialized by a user reset (in this example, the
また、本例の場合、タイムアウト信号Stoは停止回路207にも出力される。
停止回路207は、タイムアウト信号Stoが入力されたことに応じて、その旨を表す信号をタイマ制御部201に出力する。
In the case of this example, the timeout signal Sto is also output to the
In response to the input of the timeout signal Sto, the
タイマ制御部201は、機能設定レジスタ206、クリアレジスタ205にセットされた値に基づきクロック選択部202、カウンタ203の動作を制御する。
具体的に、タイマ制御部201は、機能設定レジスタ206にセットされた値がカウンタ203の動作禁止を指示するものである場合は、カウンタ203の動作を停止させる。また、機能設定レジスタ206にセットされた値がカウンタ203の動作許可を表すものでタイムアウト時間を指示するものである場合には、指示されたタイムアウト時間の値に基づきクロック選択部202に対して選択すべきクロックを指示すると共に、カウンタ203に前述したカウント上限値を指示してカウント動作を開始させる。
また、タイマ制御部201は、クリアレジスタ205にカウンタ203のクリアを指示する所定の値がセットされたことに応じて、カウンタ203にカウント値のリセット及びカウントのリスタートを指示する。
The
Specifically, the
In addition, the
また、本例の場合、タイマ制御部201は、停止回路207よりタイムアウト信号Stoが入力された旨の信号が入力されたことに応じて、カウンタ203の動作を停止させる。
これにより、本例においては、タイムアウト信号Stoに応じたユーザリセットの発生時にWDTの動作は継続されずに停止される。
In the case of this example, the
Thereby, in this example, the operation of the WDT is stopped without being continued when a user reset is generated in response to the timeout signal Sto.
なお、システムリセット時には、従来と同様にリセットに伴いWDT回路120の動作が停止される。
When the system is reset, the operation of the
<5.実施の形態の制御処理>
[5−1:メイン処理]
以下、本実施の形態の制御処理について説明する。
図6は、主制御部50のメイン処理を示すフローチャートである。
メイン処理が開始されるのは、システムリセットが発生した場合及びユーザリセットが発生した場合である。前述のようにシステムリセットはリセット端子TRSにシステムリセット信号SRSTが供給されたことに応じて発生し、ユーザリセットはタイムアウト信号Stoに応じて発生するものである。
<5. Control processing of embodiment>
[5-1: Main processing]
Hereinafter, the control process of this Embodiment is demonstrated.
FIG. 6 is a flowchart showing main processing of the
The main process is started when a system reset occurs and when a user reset occurs. As described above, the system reset is generated in response to the supply of the system reset signal SRST to the reset terminal TRS, and the user reset is generated in response to the timeout signal Sto.
図6に示す主制御側メイン処理において、主制御CPU100は、先ずはステップS11で、自らを割込み禁止状態に設定(割込みモード2)する。そして、続くステップS12で、主制御部50内の各部を含めて内部レジスタの値を初期設定する(各種初期設定)。
In the main control side main process shown in FIG. 6, the
次いで主制御CPU100は、ステップS13でハード乱数回路を起動させる。すなわち、乱数回路104を起動させる。
Next, the
そして、主制御CPU100は、ステップS14でRAMクリア信号を読み込む。RAMクリア信号は、不図示の入力ポートを介して入力されるRAMクリアスイッチの出力信号を意味する。
Then, the
さらに、主制御CPU100は、ステップS15で周辺基板の起動待ち処理を行う。ここで言う周辺基板とは、主制御部50に対して通信可能に接続された基板(例えば演出制御基板51、液晶制御基板52など)を意味する。
なお、起動待ちのための待機時間は、周辺基板のプログラム構成や回路構成に基づいて適宜に決定されるが、本例では、例えば2s(second)〜3s程度の時間に設定されている。
Further, the
Note that the standby time for waiting for activation is appropriately determined based on the program configuration and circuit configuration of the peripheral board. In this example, the standby time is set to, for example, about 2 s (second) to 3 s.
主制御CPU100は、ステップS15の起動待ち処理を行った後、ステップS16で電源異常信号がOFF状態となるまで待機する。電源異常信号は、電源基板58より不図示の入力ポートを介して入力される信号であり、「1」がON状態(つまり異常状態)を表し「0」がOFF状態(つまり正常状態)を表す。
なお、先のステップS15の待機処理において十分な待ち時間が確保されているため、実際にはステップS16での待機が生じることは無い。
The
Since a sufficient waiting time is ensured in the waiting process of the previous step S15, the waiting in step S16 does not actually occur.
電源異常信号がOFF状態であることが確認されたら、主制御CPU100はステップS17で待機画面表示コマンドを周辺基板に送信する。
If it is confirmed that the power supply abnormality signal is in the OFF state, the
次いで主制御CPU100は、ステップS18で電源投入信号がON状態となるまで待機する。電源投入信号は、払出制御基板53から入力され、「1」がON状態(つまり電源投入状態)を表し「0」がOFF状態(つまり電源非投入状態)を表す。
Next, the
電源投入信号がON状態であることが確認されたことに応じ、主制御CPU100はステップS19で、RAMクリア信号の状態(ON/OFF)を判定する。RAMクリア信号とは、主制御RAM102の全領域を初期化(ゼロクリア)するか否かを決定する信号である。RAMクリア信号としては通常、RAMクリアスイッチ(パチンコ店の店員が操作する)のON/OFF状態に対応した値を有している。停電状態からの復旧時には、RAMクリアスイッチはOFF状態であるため、RAMクリア信号はOFF状態である。RAMクリアスイッチがON状態であればRAMクリア信号もON状態である。
In response to confirming that the power-on signal is in the ON state, the
RAMクリア信号がON状態であった場合、主制御CPU100は処理をステップS19からS22に進め、主制御RAM102の全領域のゼロクリアを行う(RAM初期化)。なお、RAM初期化は、主制御RAM102における所定の使用領域のみをゼロクリアするようにしてもよい。
続いてステップS23で主制御CPU100は、主制御RAM102がゼロクリアされたことを報知するための「RAMクリア表示コマンド」を初期化コマンドとして周辺基板に送信する。そしてステップS24で、RAMクリア報知タイマに、RAMクリアされた旨を報知するための時間として、例えば、30sを格納する(RAMクリア情報設定処理)。
上記のステップS22〜S24の処理により、パチンコ遊技機1の動作状態が初期状態に戻される。
主制御CPU100は、ステップS24の処理を実行したことに応じて、処理をステップS25に進める。
When the RAM clear signal is in the ON state, the
Subsequently, in step S23, the
The operation state of the
The
また、主制御CPU100は、ステップS19でRAMクリア信号がON状態でなかったと判定された場合は、ステップS20で主制御RAM102内のバックアップデータが有効であるか否かを判定する。バックアップデータが有効か否かの判定は、所謂バックアップフラグやチェックサム値に基づき行う。なお、バックアップデータは、後述する図7の電源異常チェック処理(S51)において実行されるバックアップ処理によって主制御RAM102に格納される。
ステップS20において、バックアップデータが有効でないとの判定結果が得られた場合は、主制御CPU100は上述したステップS22に処理を進めてRAM初期化処理を行った後、RAMクリア表示のコマンド送信処理(S23)及びRAMクリア情報設定処理(S24)を実行して、パチンコ遊技機1の動作状態を初期状態に戻す。
If it is determined in step S19 that the RAM clear signal is not in the ON state, the
If it is determined in step S20 that the backup data is not valid, the
一方、主制御CPU100は、ステップS20でバックアップデータが有効であるとの判定結果が得られた場合は、ステップS21で周辺基板に停電復帰を行うためのコマンド送信を行う。
主制御CPU100は、ステップS21のコマンド送信処理を行ったことに応じてステップS25に処理を進める。
On the other hand, when the determination result that the backup data is valid is obtained in step S20, the
The
ここで、ステップS21の処理は、バックアップデータに基づいた復帰制御を行うバックアップ復帰処理に相当する。 Here, the process of step S21 corresponds to a backup recovery process for performing a recovery control based on the backup data.
ステップS25では、主制御CPU100はタイマ割込み動作を起動するためにCTC(タイマ回路106)を初期設定して、主制御CPU100を割込み許可状態に設定する。
In step S25, the
次いで、主制御CPU100はステップS26で、WDT回路120を起動させる処理を行う。すなわち、機能設定レジスタ206にWDTの動作許可及びタイムアウト時間を指示するための値をセットして、WDT回路120を起動させる。これにより、クロック選択部202においてタイムアウト時間に応じたクロックの選択が行われると共に、カウンタ203のカウント動作が開始される。
なお本例の場合、タイムアウト時間としては例えば4msを設定している。
Next, the
In this example, 4 ms is set as the timeout time, for example.
主制御CPU100は、ステップS26でWDT回路120を起動させた後は、ステップS27、S28、S29の処理として、割込みが発生するまで割込禁止状態と割込許可状態とを繰り返すとともに、その間に、各種乱数更新処理を実行する。
具体的に、ステップS28の各種乱数更新処理では、特別図柄変動表示や普通図柄変動表示に使用される各種乱数の初期値(スタート値)変更のために使用する乱数と、変動パターンの選択に利用される変動パターン用乱数を更新する。すなわち、特別図柄用乱数の初期値を変更するための特別図柄用初期値乱数、普通図柄用乱数の初期値を変更するための普通図柄用初期値乱数、変動パターン用乱数1、及び変動パターン用乱数2である。
ここで、特別図柄用乱数は、確変/非確変の判定に用いられる乱数であり、普通図柄用乱数は普通電動役物(いわゆる電チュー)を開放するか否かの判定に用いられる乱数である。特別図柄用乱数、特別図柄用初期値乱数、普通図柄用乱数、普通図柄用初期値乱数、及び変動パターン用乱数1、変動パターン用乱数2は、プログラムによりカウントされるソフトウェア乱数とされている。
After starting the
Specifically, in the various random number update processing in step S28, the random number used for changing the initial value (start value) of various random numbers used for the special symbol variation display and the normal symbol variation display, and the variation pattern are used. The random number for the variation pattern to be updated is updated. That is, a special symbol initial value random number for changing an initial value of a special symbol random number, a normal symbol initial value random number for changing an initial value of a normal symbol random number, a variation pattern
Here, the special symbol random number is a random number used for the determination of probability variation / non-probability variation, and the normal symbol random number is a random number used for determination of whether or not to release the ordinary electric accessory (so-called electric Chu). . The special symbol random number, the special symbol initial value random number, the ordinary symbol random number, the ordinary symbol initial value random number, the variation pattern
主制御RAM102にはこれらのソフトウェア乱数のカウント値を格納するための記憶領域がそれぞれ定められている。これらの記憶領域は、それぞれ対応する乱数をソフトウェア的に生成するためのカウンタと換言できる。
ステップS28の各種乱数更新処理では、上述の特別図柄用初期値乱数、普通図柄用初期値乱数、及び変動パターン用乱数1、変動パターン用乱数2を生成するカウンタを更新する処理を行う。例えば、変動パターン用乱数1のカウンタとして取り得る数値範囲が0〜238とすると、主制御RAM102の変動パターン用乱数1の値を生成するための記憶領域から値を取得し、取得した値に1を加算してから元の記憶領域に格納する。このとき、取得した値に1を加算した結果が239であれば0を元の記憶領域に格納する。他の変動パターン用乱数2、特別図柄用初期値乱数及び普通図柄用初期値乱数についても同様に更新処理を行う。
主制御CPU100は、間欠的に実行されるタイマ割込処理を行っている間を除いて、ステップS27〜S29のループ処理によって上記の各種乱数更新処理を繰り返し実行するようになっている。
ステップS27〜S29のループ処理は、タイマ割込処理を実行する期間を除いて所定の処理を繰り返し実行する無限ループ処理である。
The
In the various random number update processing in step S28, the counter for generating the above-described special symbol initial value random number, normal symbol initial value random number, variation pattern
The
The loop process of steps S27 to S29 is an infinite loop process in which a predetermined process is repeatedly executed except for a period for executing the timer interrupt process.
[5−2:タイマ割込処理]
次に、図7を参照して主制御CPU100のタイマ割込処理(以下「主制御タイマ割込処理」と表記)について説明する。主制御タイマ割込処理は、CTCからの一定時間(4ms程度)ごとの割込みで起動され、上述したメイン処理実行中に割り込んで実行される。具体的に、主制御タイマ割込処理は、ステップS29で割込許可状態とされた後に実行されるものである。
[5-2: Timer interrupt processing]
Next, the timer interrupt process (hereinafter referred to as “main control timer interrupt process”) of the
タイマ割込みが生じると、主制御CPU100はレジスタの内容をスタック領域に退避させた後、まず図7のステップS51として電源基板58からの電源の供給状態を監視する電源異常チェック処理を行う。この電源異常チェック処理では、主に、電源基板58からの電源異常信号を監視する。ここでは、例えば、電断が生じるなどの異常が発生した場合、電源復帰時に支障なく遊技を復帰できるように、電断時における所定の遊技情報を主制御RAM102に格納するバックアップ処理などが行われる。
When a timer interrupt occurs, the
次にステップS52で、主制御CPU100は遊技動作制御に用いられるタイマを管理するタイマ管理処理を行う。パチンコ遊技機1の遊技動作制御に用いる各種タイマ(例えば特別図柄役物動作タイマなど)のタイマ値は、この処理で管理(更新)される。
In step S52, the
ステップS53では、主制御CPU100は入力管理処理を行う。この入力管理処理では、パチンコ遊技機1に設けられた各種センサによる検出情報を入賞カウンタに格納する。ここでの各種センサによる検出情報とは、例えば、上始動口センサ71、下始動口センサ72、ゲートセンサ(普通図柄始動口センサ)73、第1大入賞口センサ75、第2第入賞口センサ76、一般入賞口センサ74などの入賞検出スイッチから出力されるスイッチ信号のON/OFF情報(入賞検出情報)である。
このステップS53の処理により、各入賞口において入賞を検出(入賞が発生)したか否かが割込みごとに監視される。また上記「入賞カウンタ」とは、各々の入賞口ごとに対応して設けられ、入賞した遊技球数(入賞球数)を計数するカウンタである。本実施の形態では、主制御RAM102の所定領域に、上始動口41用の上始動口入賞カウンタ、下始動口42a用の下始動口入賞カウンタ、ゲート44用の普通図柄始動口入賞カウンタ、第1大入賞口45a用の第1大入賞口入賞カウンタ、第2大入賞口46a用の第2大入賞口入賞カウンタ、一般入賞口43用の一般入賞口用の入賞カウンタなどが設けられている。
またこの入力管理処理では、入賞検出スイッチからの検出情報が入賞を許容すべき期間中に入賞したか否かに基づいて、不正入賞があったか否かも監視される。例えば大当り遊技中でないにもかかわらず第1、第2大入賞口センサ75,76が遊技球を検出したような場合は、これを不正入賞とみなして入賞検出情報を無効化し、その無効化した旨を外部に報知するべく後述のステップS55のエラー管理処理において所定のエラー処理が行われるようになっている。
In step S53, the
Through the processing in step S53, it is monitored for each interrupt whether or not a winning is detected (winning has occurred) at each winning opening. The “winning counter” is a counter provided corresponding to each winning opening and counting the number of game balls (winning balls) won. In the present embodiment, in a predetermined area of the
Further, in this input management process, it is also monitored whether or not there is an illegal prize based on whether or not the detection information from the prize detection switch has won a prize during a period in which the prize should be allowed. For example, if the first and second big
ステップS54では、主制御CPU100はソフトウェア乱数を定期的に更新するタイマ割込内乱数管理処理を行う。この定期乱数更新処理では、変動パターン用乱数1、変動パターン用乱数2についての更新は実行せず、特別図柄用乱数、特別図柄用初期値乱数、普通図柄用乱数、普通図柄用初期値乱数の更新を実行する。
ここで、特別図柄用乱数、普通図柄用乱数についての更新処理としては、割込み毎に主制御RAM102の対応するカウンタの値を+1する処理と、カウント値がそのカウンタの取り得る数値の上限値に達するごと(つまりカウンタが1周するごと)にカウンタのスタート値(初期値)を変更する処理を行う。例えば、特別図柄用乱数のカウンタの値を所定範囲で更新(+1加算)し、特別図柄用乱数のカウンタが1周するごとに、特別図柄用初期値乱数のカウンタの値を読み出してその値を特別図柄用乱数カウンタに格納する。普通図柄用乱数についても、普通図柄用初期値乱数を用いて同様に処理する。
これにより、特別図柄用乱数及び普通図柄用乱数のカウント値は、更新周期は一定でありながらもランダムになる。
In step S54, the
Here, the update process for the special symbol random number and the normal symbol random number includes a process of incrementing the corresponding counter value of the
As a result, the count values of the special symbol random numbers and the normal symbol random numbers become random while the update cycle is constant.
ステップS55では、主制御CPU100は、遊技動作状態の異常の有無を監視するエラー管理処理を行う。このエラー管理処理では、遊技動作状態の異常として、例えば、基板間に断線が生じたか否かの監視や、不正入賞があったか否かの監視などをして、これらの動作異常(エラー)が発生した場合には、そのエラーに対応した所定のエラー処理を行う。
エラー処理としては、例えば、所定の遊技動作(例えば、遊技球の払い出し動作や遊技球の発射動作など)の進行を停止させたり、エラー報知用コマンドを演出制御部51に送信して、演出手段によりエラーが発生した旨を報知させたりする。
In step S55, the
As the error processing, for example, the progress of a predetermined game operation (for example, a game ball payout operation or a game ball launch operation) is stopped, or an error notification command is transmitted to the
ステップS56では、主制御CPU100は賞球管理処理を行う。この賞球管理処理では、ステップS53の入力管理処理で格納したデータを把握して、上述の入賞カウンタの確認を行い、入賞があった場合は、賞球数を指定する払出制御コマンドを払出制御基板53に送信する。
この払出制御コマンドを受信した払出制御基板53は、遊技球払出装置55を制御し、指定された賞球数の払い出し動作を行わせる。これにより、それぞれの入賞口に対応した賞球数が払い出されるようになっている。入賞口に対応した賞球数とは、入賞口別に設定された入賞球1個当りの所定の賞球数×入賞カウンタの値分の賞球数である。
In step S56, the
Upon receiving this payout control command, the
ステップS57では主制御CPU100は、普通図柄管理処理を行う。この普通図柄管理処理では、普通図柄変動表示における補助当り抽選を行い、その抽選結果に基づいて、普通図柄の変動パターンや普通図柄の停止表示態様を決定したり、所定時間毎に点滅を繰り返す普通図柄のデータ(普通図柄変動中のLED点滅表示用データ)を作成したり、普通図柄が変動中でなければ、停止表示用のデータ(普通図柄停止表示中のLED点滅表示用データ)を作成したりする。
In step S57, the
ステップS58では、主制御CPU100は、普通電動役物管理処理を行う。この普通電動役物管理処理では、ステップS57の普通図柄管理処理の補助当り抽選の抽選結果に基づき、普通電動役物ソレノイド77に対するソレノイド制御用の励磁信号の生成およびそのデータ(ソレノイド制御データ)の設定を行う。ここで設定されたデータに基づき、後述のステップS64のソレノイド管理処理にて、励磁信号が普通電動役物ソレノイド77に対して出力され、これにより可動翼片42bの動作が制御される。
In step S <b> 58, the
ステップS59では、主制御CPU100は、特別図柄管理処理を行う。この特別図柄管理処理では、主に、特別図柄変動表示における大当り抽選を行い、その抽選結果に基づいて、特別図柄の変動パターン(先読み変動パターン、変動開始時の変動パターン)や特別停止図柄などを決定する。
ステップS60では、主制御CPU100は特別電動役物管理処理を行う。この特別電動役物管理処理では、主に、大当り抽選結果が「大当り」または「小当り」であった場合、その当りに対応した当り遊技を実行制御するために必要な設定処理を行う。
In step S59, the
In step S60, the
ステップS61では、主制御CPU100は右打ち報知情報管理処理を行う。この右打ち報知情報管理処理では、例えば第1、第2第入賞口45a,46aが開放される機会や可動翼片42bが駆動される電サポ状態など、右打ちが有利な状況において右打ち指示報知を行う「発射位置誘導演出(右打ち報知演出)」を現出させるための処理を行う。右打ち指示とは、具体的には、右遊技領域3cを狙う旨を有技者に指示する演出動作であり、例えば主液晶表示装置32Mに「右打ち」を遊技者に促す画像を表示させたり、スピーカ25から右打ちメッセージ音声を発生させる。
右打ち報知演出が行われる場合、この右打ち報知情報管理処理において、演出制御コマンドとして、右打ち報知演出の実行指示する「右打ち指示コマンド」が演出制御部51に送信され、このコマンドを受けて、演出制御部51が、画像や音声による右打ち報知の実行制御を行う。
In step S61, the
When a right-handed notification effect is performed, in this right-handed notification information management process, a “right-handed instruction command” instructing execution of a right-handed notification effect is transmitted to the
ステップS62では、主制御CPU100は、LED管理処理を行う。このLED管理処理は、図柄表示部33に対して普通図柄表示や第1,第2特別図柄表示のための表示データを出力する処理である。この処理により、普通図柄や特別図柄の変動表示および停止表示が行われる。なお、ステップS57の普通図柄管理処理で作成された普通図柄の表示データや、ステップS59の特別図柄管理処理中の特別図柄表示データ更新処理で作成される特別図柄の表示データは、このLED管理処理で出力される。
In step S62, the
ステップS63では、主制御CPU100は、外部端子管理処理を行う。この外部端子管理処理では、枠用外部端子基板57を通して、パチンコ遊技機1の動作状態情報をホールコンピュータや島ランプなどの外部装置に対して出力する。動作状態情報としては、大当り遊技が発生した旨(条件装置が作動した旨)、小当り遊技が発生した旨、図柄変動表示が実行された旨(特別図柄変動表示ゲームの開始または終了した旨)、入賞情報(始動口や大入賞口に入賞した旨や賞球数情報)などの情報が含まれる。
In step S63, the
ステップS64では、主制御CPU100は、ソレノイド管理処理を行う。このソレノイド管理処理では、ステップS58の普通電動役物管理処理で作成されたソレノイド制御データに基づく普通電動役物ソレノイド77に対する励磁信号の出力処理や、ステップS60の特別電動役物管理処理で作成されたソレノイド制御データに基づく第1,第2大入賞口ソレノイド78,79に対する励磁信号の出力処理を行う。これにより、可動翼片42bや開放扉45b、46bが所定のパターンで動作し、下始動口42aや大入賞口45a、46bが開閉される。
In step S64, the
主制御CPU100は、以上のステップS51〜ステップS64の処理を終えた後、退避していたレジスタの内容を復帰させて、ステップS65で割込み許可状態に設定する。これにより、タイマ割込処理を終了して、割込み前の図6の主制御側メイン処理に戻り、次のタイマ割込みが発生するまでステップS27〜S29のループ処理を行う。
After completing the above steps S51 to S64, the
<6.まとめ及び変形例>
以上で説明したように本実施の形態のパチンコ遊技機1は、遊技動作を統括的に制御すると共に、遊技動作に関連する制御コマンドを出力する主制御部50と、主制御部50から出力される制御コマンドに基づいて制御動作を行うサブ制御手段(例えば演出制御基板51、液晶制御基板52、払出制御基板53、音源IC59、枠ドライバ部61、盤ドライバ部62など)を備えている。そして、起動により計数を開始し、クリア制御が行われないまま所定時間を計数した際にタイムアウト信号Stoを出力するとともに、計数を停止するWDT回路120を備えている。
その上で、主制御部50の主制御CPU100は、タイムアウト信号Stoに応じた強制リセット(ユーザリセット)を行った後、主制御部50の内部レジスタの値を初期設定する初期設定処理(ステップS12)と、バックアップデータに基づいた復帰制御を行うバックアップ復帰処理(ステップS21)と、タイマ割込処理を実行する期間を除いて所定の処理を繰り返し実行する無限ループ処理(ステップS27〜S29)を順に行うと共に、バックアップ復帰処理の後にWDT回路120を起動させている。
<6. Summary and Modification>
As described above, the
After that, the
ここで、従来は、タイムアウト信号Stoに応じたユーザリセット時にはWDTの動作が継続されていたため、図6に示したメイン処理におけるステップS15の周辺基板起動待ち処理、及びステップS18の電源投入信号のON状態を待機する処理の際に、主制御CPU100がWDTのクリア制御を実行する必要があった(なお、前述のようにステップS16では実際には待機が生じることは無い)。
上記本実施の形態のパチンコ遊技機1によれば、WDT回路120は、タイムアウト信号Stoに応じて動作を停止した後、バックアップ復帰処理が完了するまでは起動されない。すなわち、タイムアウト信号Stoに応じた強制リセット後、初期設定処理が完了しさらにバックアップ復帰処理が完了するまでは起動されない。
このため、ステップS15やステップS18の待機処理の際にWDT回路120のクリア制御を実行する必要性がなくなり、強制リセット後に実行される処理の過程において、WDT回路120のクリア制御の回数の削減を図ることができる。
従って、本実施の形態のパチンコ遊技機1によれば、主制御CPU100の制御負担を軽減しつつ安定した制御動作の実現を図ることができる。
Here, conventionally, since the WDT operation was continued at the time of user reset in response to the timeout signal Sto, the peripheral substrate activation waiting process in step S15 and the power-on signal in step S18 in the main process shown in FIG. 6 are turned on. In the process of waiting for the state, the
According to the
For this reason, there is no need to execute the clear control of the
Therefore, according to the
なお、本発明は実施の形態で挙げた例に限らず多様な変形例や適用例が考えられる。
例えば、上記による説明では、WDT回路120の動作をタイムアウト信号Stoに応じて停止させるにあたり、停止制御部207がタイマ制御部201に直接的に制御信号を入力するようにしたが、これに代えて、停止制御部207がタイムアウト信号Stoに応じて機能設定レジスタ206にWDTの動作を禁止する旨の値をセットすることで、タイムアウト信号Stoに応じてWDT回路120の動作が停止されるようにすることもできる。
Note that the present invention is not limited to the examples given in the embodiment, and various modifications and application examples are conceivable.
For example, in the above description, when stopping the operation of the
また、上記では、WDT回路120が主制御部50に内蔵される場合を例示したが、WDT回路120は主制御部50の外付け回路として設けられてもよい。
ここで、主制御CPU100が暴走するような異常時には、ワンチップマイコンとしての主制御部50の内蔵回路にも何らかの異常が発生している可能性を否定できない。WDT回路120を外付け回路とした場合には、このような異常時に対して万全の安全対策を採ることができる。
In the above description, the case where the
Here, at the time of an abnormality in which the
また、上記では、本発明がパチンコ遊技機1のような弾球遊技機に適用される例を示したが、本発明は回胴式遊技機(いわゆるスロット機)にも好適に適用できるものである。
Moreover, in the above, the example in which the present invention is applied to a ball game machine such as the
1 パチンコ遊技機
2 前枠
3 遊技盤
50 主制御基板(主制御部)
51 演出制御基板(演出制御部)
52 液晶制御基板
53 払出制御基板
54 発射制御基板
58 電源基板
100 CPU(主制御CPU)
120 WDT回路
1
51 Production control board (production control unit)
52 Liquid
120 WDT circuit
Claims (1)
前記主制御手段から出力される制御コマンドに基づいて制御動作を行うサブ制御手段と、
起動により計数を開始し、クリア制御が行われないまま所定時間を計数した際にタイムアウト信号を出力するとともに、動作を停止するウォッチドッグタイマと、
を備え、
前記主制御手段のCPUは、前記タイムアウト信号に応じた強制リセットを行った後、前記主制御手段の内部レジスタの値を初期設定する初期設定処理と、バックアップデータに基づいた復帰制御を行うバックアップ復帰処理と、タイマ割込処理を実行する期間を除いて所定の処理を繰り返し実行する無限ループ処理を順に行うと共に、前記バックアップ復帰処理の後に前記ウォッチドッグタイマを起動させる
遊技機。 Main control means for overall control of game operations and outputting control commands related to game operations;
Sub-control means for performing a control operation based on a control command output from the main control means;
The watchdog timer that starts counting, outputs a time-out signal when counting a predetermined time without performing clear control, and stops operation,
With
The CPU of the main control means performs a forcible reset according to the timeout signal, and then performs an initial setting process for initializing the value of the internal register of the main control means, and a backup return for performing return control based on backup data A game machine that sequentially performs an infinite loop process that repeatedly executes a predetermined process except for a period during which a timer interrupt process is executed, and starts the watchdog timer after the backup recovery process.
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Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2017056780A (en) * | 2015-09-15 | 2017-03-23 | 日野自動車株式会社 | Lane change steering control system |
JP2018126418A (en) * | 2017-02-10 | 2018-08-16 | 株式会社大一商会 | Game machine |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2011253339A (en) * | 2010-06-02 | 2011-12-15 | Fujitsu Ltd | Information processing device and method for controlling driver execution |
JP2013027693A (en) * | 2012-06-13 | 2013-02-07 | Daito Giken:Kk | Game machine |
JP2013158582A (en) * | 2012-02-08 | 2013-08-19 | Sophia Co Ltd | Game machine |
JP2013180074A (en) * | 2012-03-02 | 2013-09-12 | Daito Giken:Kk | Game machine |
-
2013
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Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2011253339A (en) * | 2010-06-02 | 2011-12-15 | Fujitsu Ltd | Information processing device and method for controlling driver execution |
JP2013158582A (en) * | 2012-02-08 | 2013-08-19 | Sophia Co Ltd | Game machine |
JP2013180074A (en) * | 2012-03-02 | 2013-09-12 | Daito Giken:Kk | Game machine |
JP2013027693A (en) * | 2012-06-13 | 2013-02-07 | Daito Giken:Kk | Game machine |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2017056780A (en) * | 2015-09-15 | 2017-03-23 | 日野自動車株式会社 | Lane change steering control system |
JP2018126418A (en) * | 2017-02-10 | 2018-08-16 | 株式会社大一商会 | Game machine |
Also Published As
Publication number | Publication date |
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