JP2015008583A - Power-factor correction circuit - Google Patents
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Abstract
Description
本発明は、力率改善回路に関する。 The present invention relates to a power factor correction circuit.
発光ダイオード(LED:Light Emitting Diode)を利用した照明(LED照明)は、従来の白熱電球などを利用した照明よりも消費電力が小さく寿命が長いなどの特長を有する。 Lighting (LED lighting) using a light emitting diode (LED) has features such as lower power consumption and longer life than lighting using a conventional incandescent bulb.
LEDはDC(直流)電力によって発光する。そのため、LED照明は、商用のAC(交流)電力をDC電力に変換してLEDに供給するための電源回路を必要とする。 The LED emits light by DC (direct current) power. Therefore, LED lighting requires a power supply circuit for converting commercial AC (alternating current) power into DC power and supplying it to the LED.
そのような電源回路は整流回路の整流作用によりAC電力をDC電力に変換する。その際の力率を改善し、あるいは電流の高調波含有率を低減するための力率改善(PFC:Power Factor Correction)回路が、整流回路の後段に接続される。 Such a power supply circuit converts AC power into DC power by the rectifying action of the rectifier circuit. A power factor correction (PFC) circuit for improving the power factor at that time or reducing the harmonic content of the current is connected to the subsequent stage of the rectifier circuit.
商用のAC電力には、100V系や200V系など、電圧(あるいは電力)の大きさが異なるものもある。そのため、電源回路は、複数の入力レベル(たとえば、電圧がAC85V〜AC240V)に対応することが望ましい。 Some commercial AC powers have different voltage (or power) levels, such as 100V and 200V systems. Therefore, it is desirable that the power supply circuit supports a plurality of input levels (for example, the voltage is AC85V to AC240V).
また、LED照明は、LEDに供給するDC電力の大きさを調節することで、照度を変えることができる(調光)。そのため、電源回路は、複数の出力レベル(たとえば、30W〜60W)にも対応することが望ましい。 Moreover, LED illumination can change illumination intensity by adjusting the magnitude | size of DC electric power supplied to LED (light control). Therefore, it is desirable that the power supply circuit can cope with a plurality of output levels (for example, 30 W to 60 W).
ここで、電源は、電流の高調波含有率に対する規格(以下、「高調波スペック」という場合もある)などを満たす必要がある。従来は、入力レベルに応じて個別にハードウェア設計を行っている(たとえば特開2006−304534号公報など参照)。 Here, the power supply needs to satisfy a standard for the harmonic content of current (hereinafter also referred to as “harmonic spec”). Conventionally, hardware design is individually performed according to the input level (see, for example, JP-A-2006-304534).
そのため、複数の入力レベルに対応した電源回路は、入力レベルに応じて個別に設計されたハードウェアを組み合わせて構成されることになり、コストが掛かる。 Therefore, a power supply circuit corresponding to a plurality of input levels is configured by combining hardware individually designed according to the input levels, and costs are increased.
本願発明者らは、1つのハードウェア構成で複数の入力レベルに対応した電源回路を実現することについて鋭意検討を行った結果、次の課題が存在することを見出した。 The inventors of the present application have intensively studied to realize a power supply circuit corresponding to a plurality of input levels with one hardware configuration, and as a result, have found that the following problems exist.
典型的な電源回路は、整流回路、PFC回路をこの順に接続して構成されている。整流回路の入力側には商用電源などのAC電源が接続され、PFC回路の出力側にはLED負荷などが接続されている。 A typical power supply circuit is configured by connecting a rectifier circuit and a PFC circuit in this order. An AC power source such as a commercial power source is connected to the input side of the rectifier circuit, and an LED load or the like is connected to the output side of the PFC circuit.
PFC回路は、スイッチング素子のスイッチング動作を利用してPFC回路を流れる電流を制御することで、整流回路の出力電流(整流電流)が整流回路の出力電圧(整流電圧)に対して同相かつ相似形となる(両者の波形が近づく)ように制御する。これにより、AC電源における電流(入力電流)も電圧(入力電圧)に対して同相かつ相似形となり、その結果、力率が改善され、また、電流の高調波含有率が低減される。 The PFC circuit controls the current flowing through the PFC circuit using the switching operation of the switching element, so that the output current (rectified current) of the rectifier circuit is in-phase and similar to the output voltage (rectified voltage) of the rectifier circuit. So that both waveforms are close to each other. As a result, the current (input current) in the AC power source is also in-phase and similar to the voltage (input voltage), and as a result, the power factor is improved and the harmonic content of the current is reduced.
ここで、PFC回路でのスイッチング動作により生じた周波数成分の整流回路側への影響を防ぐために、PFC回路の入力側(すなわち、整流回路の後段)に、コンデンサ(入力側コンデンサ)が並列に接続される。整流回路は、たとえばダイオードを利用した全波整流回路であり、整流電圧はリップルを含むため変動する。入力側コンデンサの電圧は、整流電圧に追従するように変動するため、入力側コンデンサには充放電電流が流れる。 Here, a capacitor (input-side capacitor) is connected in parallel to the input side of the PFC circuit (that is, the subsequent stage of the rectifier circuit) in order to prevent the influence of the frequency component generated by the switching operation in the PFC circuit on the rectifier circuit side. Is done. The rectifier circuit is a full-wave rectifier circuit using, for example, a diode, and the rectified voltage varies because it includes ripples. Since the voltage of the input side capacitor varies so as to follow the rectified voltage, a charge / discharge current flows through the input side capacitor.
入力側コンデンサの充電は、整流回路から入力側コンデンサへの電流により行われる。しかし、入力側コンデンサから整流回路へは電流が流れないため、入力側コンデンサの放電は、入力側コンデンサからPFC回路への電流により行われる。 The input side capacitor is charged by a current from the rectifier circuit to the input side capacitor. However, since no current flows from the input side capacitor to the rectifier circuit, the input side capacitor is discharged by the current from the input side capacitor to the PFC circuit.
PFC回路は、そのような充放電電流を制御することができない。そのため、充放電電流の大きさは、整流電流とPFC回路を流れる電流との差として現れる。また、充放電電流は、整流電圧とは位相がずれている(理論上は整流電圧に対して90°位相が進んでいる)。 The PFC circuit cannot control such charge / discharge current. Therefore, the magnitude of the charge / discharge current appears as a difference between the rectified current and the current flowing through the PFC circuit. Further, the charge / discharge current is out of phase with the rectified voltage (theoretically, the phase is advanced by 90 ° with respect to the rectified voltage).
充放電電流が比較的大きくなると、上記の差も大きくなる。その場合、PFC回路は、整流電流を適切に制御できなくなり、高調波スペックなどを満たさなくなる恐れがある。そこで、充放電電流ができるだけ小さくなるように、入力側コンデンサの容量が定められる。 As the charge / discharge current becomes relatively large, the above difference also increases. In this case, the PFC circuit cannot properly control the rectified current, and may not satisfy the harmonic specifications. Therefore, the capacitance of the input side capacitor is determined so that the charge / discharge current is as small as possible.
しかし、充放電電流の大きさは、電源回路の入力レベルにより異なる。そのため、ある入力レベルにおいて充放電電流が比較的小さくなるように入力側コンデンサの容量を定めたとしても、それとは異なる入力レベルにおいて、充放電電流が大きくなってしまうこともある。それを防ぐためには、入力側コンデンサの容量を変え、充放電電流を小さくする必要がある。そのため、入力レベルに応じて個別にハードウェア設計を行わねばならない。 However, the magnitude of the charge / discharge current differs depending on the input level of the power supply circuit. Therefore, even if the capacitance of the input-side capacitor is determined so that the charge / discharge current becomes relatively small at a certain input level, the charge / discharge current may increase at an input level different from that. In order to prevent this, it is necessary to change the capacitance of the input side capacitor to reduce the charge / discharge current. Therefore, hardware design must be performed individually according to the input level.
本発明は、上記課題を解決するためになされたものである。本発明の目的は、充放電電流によるPFC回路の電流制御への影響を低減することにより、1つのハードウェア構成で複数の入力レベル(あるいは出力レベル)に対応した電源回路を実現することを可能とする、力率改善回路を提供することである。 The present invention has been made to solve the above problems. An object of the present invention is to realize a power supply circuit corresponding to a plurality of input levels (or output levels) with one hardware configuration by reducing the influence of the charge / discharge current on the current control of the PFC circuit. It is to provide a power factor correction circuit.
本発明は、交流電源からの交流電圧を整流する整流回路の後段に接続され、交流電源の力率を改善するために用いられる力率改善回路であって、入力側に設けられた入力側コンデンサと、入力側コンデンサに流れる電流がないと仮定したときに、交流電圧の半周期において、半周期における後半の電流量が半周期における前半の電流量よりも大きくなるように回路電流を制御する回路電流制御部とを備える。 The present invention is a power factor correction circuit that is connected to a subsequent stage of a rectifier circuit that rectifies an AC voltage from an AC power source and is used to improve the power factor of the AC power source, and includes an input side capacitor provided on the input side And a circuit that controls the circuit current so that in the half cycle of the AC voltage, the latter half current amount in the half cycle is larger than the first half current amount in the half cycle when it is assumed that there is no current flowing in the input-side capacitor. A current control unit.
好ましくは、回路電流制御部は、半周期において回路電流のピークが整流回路により整流された整流電圧のピークよりも遅れるように回路電流を制御する。 Preferably, the circuit current control unit controls the circuit current so that the peak of the circuit current is delayed from the peak of the rectified voltage rectified by the rectifier circuit in a half cycle.
好ましくは、回路電流制御部は、スイッチング動作によって回路電流の大きさを調節するスイッチング素子と、スイッチング動作におけるオン時間が半周期において増加するようにオン時間を決定するオン時間決定部と、オン時間決定部により決定されたオン時間でスイッチング素子を駆動するスイッチング素子駆動部とを備える。 Preferably, the circuit current control unit includes a switching element that adjusts the magnitude of the circuit current by the switching operation, an on time determination unit that determines the on time so that the on time in the switching operation increases in a half cycle, A switching element driving unit that drives the switching element with the on-time determined by the determining unit.
好ましくは、オン時間は、半周期の間、一定の割合で増加する。
好ましくは、力率改善回路は、複数の入力レベルに対応した力率改善回路である。回路電流制御部は、力率改善回路の入力レベルに応じてスイッチング動作におけるスイッチング周波数の下限値を変える。
Preferably, the on-time increases at a constant rate during a half cycle.
Preferably, the power factor correction circuit is a power factor correction circuit corresponding to a plurality of input levels. The circuit current control unit changes the lower limit value of the switching frequency in the switching operation according to the input level of the power factor correction circuit.
好ましくは、回路電流制御部は、半周期における整流電圧の少なくとも一部を記憶する整流電圧記憶部を備える。回路電流制御部は、現在の半周期における整流電圧と整流電圧記憶部に記憶された現在の半周期の前の半周期における整流電圧との差に応じてスイッチング動作におけるオン時間を調節する。 Preferably, the circuit current control unit includes a rectified voltage storage unit that stores at least a part of the rectified voltage in a half cycle. The circuit current control unit adjusts the ON time in the switching operation according to the difference between the rectified voltage in the current half cycle and the rectified voltage in the half cycle before the current half cycle stored in the rectified voltage storage unit.
また、本発明に係る照明用電源は、上記のいずれかの力率改善回路を備える。 Moreover, the power supply for illumination which concerns on this invention is provided with one of said power factor improvement circuits.
本発明によると、複数の入力レベルに対応した電源回路を1つのハードウェア構成で実現することができる。それにより、電源回路のコストを下げることが可能となる。 According to the present invention, a power supply circuit corresponding to a plurality of input levels can be realized with one hardware configuration. As a result, the cost of the power supply circuit can be reduced.
以下、本発明の実施の形態について、図面を参照しながら詳細に説明する。なお、図中同一または相当部分には同一符号を付してその説明は繰り返さない。
[実施の形態1]
図1は、本発明の実施の形態の一例である力率改善回路を含む電源回路100の概略構成を示す図である。
Hereinafter, embodiments of the present invention will be described in detail with reference to the drawings. In the drawings, the same or corresponding parts are denoted by the same reference numerals and description thereof will not be repeated.
[Embodiment 1]
FIG. 1 is a diagram showing a schematic configuration of a
電源回路100は、ラインフィルタ2、整流回路3、PFC回路4および降圧コンバータ5をこの順に接続して構成されている。電源回路100の入力側には、AC電源1が接続されている。電源回路100の出力側には、LED負荷6が接続されている。
The
AC電源1は、たとえば商用電源である。AC電源1の電圧を入力電圧Vin、AC電源1から流れる電流を入力電流Iinとする。
The
ラインフィルタ2は、コイルとコンデンサからなるローパスフィルタである。ラインフィルタ2は、AC電源1と整流回路3とを高周波的に分離するが、入力電圧Vinと入力電流Iinは通過させる。
The
整流回路3は、ダイオードを利用した全波整流回路である。整流回路3は、ラインフィルタ2を通過した入力電圧Vin、入力電流Iinを整流して出力する。整流回路3の出力側の電圧を整流電圧Vrect、電流を整流電流Irectとする。
The
PFC回路4は、AC電源1の力率を改善するための力率改善回路である。また、降圧コンバータ5は、PFC回路4の出力を所望のレベルに変えて出力する。PFC回路4と降圧コンバータ5の詳細は、後に図2および図3で説明する。
The
LED負荷6は、LED素子で構成されている。LED負荷6は、降圧コンバータ5から供給される電力により、発光する。
The
図2は、PFC回路4の詳細な構成を示す図である。説明の便宜上、図2に示すように、PFC回路4の上側のラインをLINE_P1a,LINE_P1bおよびLINE_P1c、下側のラインをLINE_N1とする。
FIG. 2 is a diagram showing a detailed configuration of the
PFC回路4の入力側には、コンデンサ7がLINE_P1aとLINE_N1の間に接続されている(以後、PFC回路4においては、LINE_P1a,LINE_P1bまたはLINE_P1cとLINE_N1との間の接続を「並列に接続されている」という)。コンデンサ7は、後述のFET11のスイッチング動作による電圧変動を低減(電圧を平滑化)する。
On the input side of the
コンデンサ7の後段には、互いに直列に接続された抵抗8と抵抗9とが、並列に接続されている。抵抗8,9は、PFC回路4の入力電圧を分圧して測定するために用いられる。なお、PFC回路4の入力電圧は、整流電圧Vrectに等しい。抵抗8,9を流れる電流はPFC回路4の全体を流れる電流に比べて十分に小さいため、無視できる。
A
抵抗8と抵抗9との後段には、インダクタ10が接続されている。インダクタ10は、昇圧などのために用いられるコイルである。インダクタ10には、補助巻き線10Aが備えられている。
An
インダクタ10の後段には、電界効果トランジスタであるFET11が並列に接続されている。FET11はスイッチング素子であり、スイッチング動作によってインダクタ10に流れる電流を制御する。
A
FET11の後段は、ダイオード12のアノード側に接続されている。ダイオード12は、インダクタ10とともに昇圧などのために用いられる。
The subsequent stage of the
ダイオード12のカソード側には、コンデンサ13(たとえば電解コンデンサ)が並列に接続されている。コンデンサ13は、PFC回路4の出力電圧、出力電流を平滑化する。また、コンデンサ13は、インダクタ10やダイオード12を利用した昇圧機能によって、PFC回路4の入力電圧であるVrectよりも高い電圧に充電される。
A capacitor 13 (for example, an electrolytic capacitor) is connected in parallel to the cathode side of the
コンデンサ13の後段には、互いに直列に接続された抵抗14と抵抗15とが、並列に接続されている。抵抗14,15は、PFC回路4の出力電圧を分圧して測定するために用いられる。抵抗14,15を流れる電流はPFC回路4の全体を流れる電流に比べて十分に小さいため、無視できる。
A
PFC回路4は、FETドライバ18を含む。FETドライバ18は、FET11を駆動する。
The
PFC回路4は、マイコン17を含む。マイコン17は、上記のオン時間を決定するためのオン時間決定部17A、および記憶部17Bを含む。マイコン17は、ADコンバータやタイマ機能なども有している。
The
マイコン17は、抵抗8と抵抗9との間のノードと接続されている。これにより、マイコン17は、PFC回路4の入力電圧をADコンバータで変換することによりディジタル値として得ることができる。
The
マイコン17は、インダクタ10に備えられた補助巻き線10Aと接続されている。これにより、マイコン17は、補助巻き線10Aの電圧の極性変化やゼロの状態を検出することができる。
The
マイコン17は、抵抗14と抵抗15との間のノードと接続されている。これにより、マイコン17は、PFC回路4の出力電圧をADコンバータで変換することによりディジタル値として得ることができる。
The
マイコン17は、FETドライバ18に接続されている。これにより、マイコン17は、FETドライバ18を制御して、FET11を駆動できる。マイコン17は、たとえば、所定のオン時間やスイッチング周波数でFET11を駆動するように、FETドライバ18を制御することができる。
The
以上の構成により、PFC回路4は、FET11のスイッチング動作により、インダクタ10を流れる電流を制御することができる。また、PFC回路4の出力電圧は、PFC回路4の入力電圧よりも高くなる(昇圧)。
With the above configuration, the
ここで、PFC回路4は、回路電流制御部16を含む。回路電流制御部16は、インダクタ10、FET11、マイコン17およびFETドライバ18を含む部分であり、PFC回路4を流れる回路電流を制御する。
Here, the
図3は、降圧コンバータ5の詳細な構成を示す図である。説明の便宜上、図3に示すように、降圧コンバータ5の上側のラインをLINE_P2a,LINE_P2bおよびLINE_P2c、下側のラインをLINE_N2とする。
FIG. 3 is a diagram showing a detailed configuration of the step-down
降圧コンバータ5の入力側には、互いに直列に接続されたFET19とダイオード20とが、LINE_P2とLINE_P2の間に接続されている(以後、降圧コンバータ5においては、LINE_P2a,LINE_P2bまたはLINE_P2cとLINE_N2との間の接続を「並列に接続されている」という)。FET19はダイオード20のアノード側に接続されている。
On the input side of the step-down
FET19とダイオード20との後段には、インダクタ21が接続され、さらにその後段には、コンデンサ22が並列に接続されている。
An
コンデンサ22の後段のLINE_N2側には、電流センサ25が備えられている。電流センサ25は、降圧コンバータ5の出力電流を測定し、電圧に変換する。
A
降圧コンバータ5は、制御回路23を含む。
制御回路23は、FETドライバ26を含む。FETドライバ26は、FET19を駆動する。
Step-
The
制御回路23は、マイコン24を含む。マイコン24は、電流センサ25と接続されている。これにより、マイコン24は、降圧コンバータ5の出力側を流れる電流をディジタル値として得ることができる。
The
マイコン24は、FETドライバ26と接続されている。これにより、マイコン24は、FETドライバ26を制御することにより、FET19を駆動することができる。
The
以上の構成により、降圧コンバータ5は、FET19のスイッチング動作によりインダクタ21を流れる電流を制御し、所望の電圧および電流を出力することができる。また、降圧コンバータ5の出力電圧は、降圧コンバータ5の入力電圧よりも低くなる(降圧)。
With the above configuration, the step-down
次に、PFC回路4のコンデンサ7よりも後段を流れる電流(以下、「PFC電流Ipfc」という)の制御(以下、「電流制御」という場合もある)について、比較例の電流制御と併せて、図4〜図8、および図11〜図14を参照しつつ説明する。
Next, regarding the control of the current (hereinafter referred to as “PFC current Ipfc”) that flows after the
なお、図2のコンデンサ7の充放電電流はIcとする。充放電電流Icが十分に小さい場合、PFC電流Ipfcはインダクタ10を流れる電流に対応すると考えてよい。ただし、厳密にはインダクタ10を流れる電流はFET11のスイッチング動作によるリップルを含むのに対し、本明細書では、そのようなリップルを除いた電流をPFC電流Ipfcとする。
The charging / discharging current of the
まず、比較例の電流制御について説明する。
比較例の電流制御は、入力電圧Vinの半周期において、たとえば、インダクタ10を流れる電流がゼロになったのを検出した後に、FET11がスイッチング動作を開始するようにしていた(電流臨界モード)。その際、スイッチング動作のオン時間は、半周期内において一定値としていた。
First, current control of a comparative example will be described.
In the current control of the comparative example, for example, after detecting that the current flowing through the
図4は、比較例の電流制御が行われているときの、PFC回路4の入力端における電圧、電流のグラフを示す図である。
FIG. 4 is a diagram illustrating a graph of voltage and current at the input terminal of the
PFC電流Ipfcは、整流電圧Vrectに対して、同相かつ相似形となっている。
また、充放電電流Icは、インダクタ電圧VLに対して90°位相が進んでいる。整流電流Irectは、PFC電流Ipfcと充放電電流Icを足し合わせた大きさとなる。
The PFC current Ipfc is in-phase and similar to the rectified voltage Vrect.
Further, the charge / discharge current Ic is advanced in phase by 90 ° with respect to the inductor voltage VL. The rectified current Ilect has a magnitude obtained by adding the PFC current Ipfc and the charge / discharge current Ic.
そのときの入力電圧Vin、目標電流It、充放電電流Ic、および入力電流Iinは、図6(a)に示すグラフのようになる。ここで、目標電流Itは、理想的な入力電流であり、図4のPFC電流Ipfcの右半分を縦軸で反転させたものに対応する。 The input voltage Vin, target current It, charge / discharge current Ic, and input current Iin at that time are as shown in the graph of FIG. Here, the target current It is an ideal input current and corresponds to the right half of the PFC current Ipfc in FIG.
ここで、図6(a)は、電源回路100の入力レベルがAC85V、出力レベルが60Wのときに、コンデンサ7の容量を0.68pFに設計した場合の、電圧、電流の計算結果を示すグラフである。図6(a)で示されるように、充放電電流Icは、目標電流Itと比較して十分小さいため、入力電流Iinは目標電流Itにかなり近づく。そのため、入力電流Iinはほとんど歪まない。
Here, FIG. 6A is a graph showing calculation results of voltage and current when the capacity of the
図6(b)は、入力電流Iinの各高調波次数における高調波含有率を示すグラフである。ここでは、高調波(次数が3以上)の成分はほとんど生じていない。なお、グラフ中の規格値は、国際電気標準会議(IEC:International Electrotechnical Comission)により定められた、高調波含有率の上限の値(61000−3−2 クラスC)を示している。 FIG. 6B is a graph showing the harmonic content in each harmonic order of the input current Iin. Here, almost no harmonic component (order of 3 or more) is generated. In addition, the standard value in a graph has shown the upper limit value (61000-3-2 class C) of the harmonic content rate defined by the International Electrotechnical Commission (IEC).
図7(a)は、図6(a)および図6(b)の状態から、入力レベルのみをAC85VからAC240Vに変えた場合の、電圧、電流の計算結果を示すグラフである。入力レベルの上昇に伴い、充放電電流Icが大きくなる。一方、出力レベルが変わらないため、目標電流Itは小さくなる。その結果、充放電電流Icの影響により、入力電流Iinの歪みは大きくなる。そのため、図7(b)に示すグラフのように、入力電流Iinの高調波成分も大きくなる。 FIG. 7A is a graph showing calculation results of voltage and current when only the input level is changed from AC85V to AC240V from the states of FIGS. 6A and 6B. As the input level increases, the charge / discharge current Ic increases. On the other hand, since the output level does not change, the target current It becomes small. As a result, the distortion of the input current Iin increases due to the influence of the charge / discharge current Ic. Therefore, as shown in the graph of FIG. 7B, the harmonic component of the input current Iin also increases.
図8(a)は、図7(a)および図7(b)の状態から、出力レベルのみを60Wから30Wに変えた場合の、電圧、電流の計算結果を示すグラフである。出力レベルの低下に伴い、目標電流Itはさらに小さくなる。その結果、入力電流Iinの歪みはさらに大きくなる。そのため、図8(b)に示すグラフのように、入力電流Iinの高調波成分がさらに大きくなる。特に、次数11の高調波含有率が、規格値を超える恐れがある。
FIG. 8A is a graph showing calculation results of voltage and current when only the output level is changed from 60 W to 30 W from the states of FIG. 7A and FIG. 7B. As the output level decreases, the target current It becomes further smaller. As a result, the distortion of the input current Iin is further increased. Therefore, as shown in the graph of FIG. 8B, the harmonic component of the input current Iin is further increased. In particular, the harmonic content of
なお、仮に、図8(a)および図(b)の状態から、コンデンサの容量のみを0.68μFから0.33μFに変えるハードウェア設計変更を行ったとすれば、図9(a)および図9(b)に示すように、入力電流Iinの歪みは小さくなる。 If the hardware design is changed from the state of FIGS. 8A and 8B to change only the capacitance of the capacitor from 0.68 μF to 0.33 μF, FIG. 9A and FIG. As shown in (b), the distortion of the input current Iin is reduced.
補足であるが、図6(a)および図6(b)の状態から、出力レベルのみを60Wから30Wに変えたとしても、図10(a)および図10(b)に示すように、入力電流Iinには、ほとんど影響がない。 As a supplement, even if only the output level is changed from 60 W to 30 W from the states of FIGS. 6A and 6B, as shown in FIG. 10A and FIG. The current Iin has almost no effect.
次に、実施の形態1による電流制御について説明する。
本発明の実施の形態による電流制御では、半周期内においてオン時間は一定値ではない。すなわち、半周期における後半の電流量が半周期における前半の電流量よりも大きくなるように、PFC電流Ipfcを制御する。ここでの電流量は、電流を時間積分した値をいう。
Next, current control according to the first embodiment will be described.
In the current control according to the embodiment of the present invention, the on-time is not a constant value within a half cycle. That is, the PFC current Ipfc is controlled so that the latter half current amount in the half cycle is larger than the first half current amount in the half cycle. The amount of current here is a value obtained by integrating the current over time.
図5は、本発明の実施の形態による電流制御が行われているときのPFC回路4の入力における電圧、電流を示すグラフである。
FIG. 5 is a graph showing the voltage and current at the input of the
PFC電流Ipfcは、整流電圧Vrectに対して、同相かつ相似形となっていない。すなわち、PFC電流Ipfcは、半周期における後半の電流量が半周期における前半の電流量よりも大きくなっている。この場合、PFC電流Ipfcのピークは、整流電圧Vrectのピークよりも遅れていると言うことができる。 The PFC current Ipfc is not in phase and similar to the rectified voltage Vrect. That is, in the PFC current Ipfc, the current amount in the second half in the half cycle is larger than the current amount in the first half in the half cycle. In this case, it can be said that the peak of the PFC current Ipfc is behind the peak of the rectified voltage Vrect.
本発明の実施の形態による電流制御では、FET11のスイッチング動作におけるオン時間の比率を、一定の割合で増加させる。たとえば、半周期の開始時点でのオン時間の比率をTon0とし、半周期の終了時点でのオン時間の比率をTon0+ΔTonとする。半周期におけるTon0やΔTonを変えることで、PFC電流Ipfcのピークの、整流電圧Vrectのピークに対する遅れを、調節することができる。
In the current control according to the embodiment of the present invention, the ratio of the ON time in the switching operation of the
図11は、半周期におけるオン時間の比率の変化を示すグラフである。オン時間の比率が変化する場合として、Ton0が0.1でΔTonが0.15(図11の「0.1+Δ0.15」)、Ton0が0.05でΔTonが0.25(図11の「0.05+Δ0.25」)、Ton0が0でΔTonが0.35(図11の「0+Δ0.35」)の組み合わせを示す。なお、Ton0が0.17でΔTonが0(図11の「0.17+Δ0」)の組み合わせは、比較例の電流制御を示す。 FIG. 11 is a graph showing a change in the ratio of on-time in a half cycle. As a case where the ratio of on-time changes, Ton0 is 0.1 and ΔTon is 0.15 (“0.1 + Δ0.15” in FIG. 11), Ton0 is 0.05 and ΔTon is 0.25 (“Ton” in FIG. 11). 0.05 + Δ0.25 ”), Ton0 is 0, and ΔTon is 0.35 (“ 0 + Δ0.35 ”in FIG. 11). A combination of Ton0 of 0.17 and ΔTon of 0 (“0.17 + Δ0” in FIG. 11) indicates current control of the comparative example.
図12(a)は、Ton0を0.1、ΔTonを0.15とした場合(図11の「補正Δ0.15」)の電圧、電流の波形を示す。なお、その他の条件は図8(a)と同じ(AC240V、30W、0.68μF)である。 FIG. 12A shows voltage and current waveforms when Ton0 is 0.1 and ΔTon is 0.15 (“correction Δ0.15” in FIG. 11). The other conditions are the same as in FIG. 8A (AC 240 V, 30 W, 0.68 μF).
図13(a)は、Ton0を0.05、ΔTonを0.25とした場合(図11の「補正Δ0.25」)の電圧、電流の波形を示す。その他の条件は、図8(a)と同じである。 FIG. 13A shows voltage and current waveforms when Ton0 is 0.05 and ΔTon is 0.25 (“correction Δ0.25” in FIG. 11). Other conditions are the same as those in FIG.
図14(a)は、Ton0を0、ΔTonを0.35とした場合(図11の「補正Δ0.35」)の電圧、電流の波形を示す。その他の条件は、図8(a)と同じである。 FIG. 14A shows voltage and current waveforms when Ton0 is 0 and ΔTon is 0.35 (“correction Δ0.35” in FIG. 11). Other conditions are the same as those in FIG.
図12(b)、図13(b)および図14(b)は、入力電流Iinの各高調波次数における高調波含有率を示すグラフであるが、いずれも図8(b)と比較して、特に11次の高調波成分が低減していることがわかる。これは、PFC電流Ipfcのピークが整流電圧Vrectのピークよりも遅れた結果、整流電圧Vrectに対して進み位相にある充放電電流Icと打ち消しあう部分が生じ、それにより、入力電流Iinの歪みが改善したためである。 FIGS. 12 (b), 13 (b) and 14 (b) are graphs showing the harmonic content at each harmonic order of the input current Iin, all of which are compared with FIG. 8 (b). In particular, it can be seen that the 11th harmonic component is reduced. This is because, as a result of the peak of the PFC current Ipfc being delayed from the peak of the rectified voltage Vrect, there is a portion that cancels out with the charge / discharge current Ic that is in an advanced phase with respect to the rectified voltage Vrect, thereby causing distortion of the input current Iin. It is because it improved.
このように半周期におけるオン時間(あるいはオン時間の比率)を変化させることで、ΔTonが最も小さい図11の場合であっても、図8で問題となっていた入力電流Iinの11次の高調波成分は低減し、規格に対してマージンができている。さらにΔTonを大きくした図12では、11次の高調波成分はさらに低減し、規格値に対して十分なマージンができている。一方、それ以上ΔTonを大きくした図13では、入力電流Iinの3次の高調波成分が増加といった副作用も生じている。したがって、この場合は、ΔTonを0.15から0.25の間にすることが適切であると考えられ、そのようなΔTonを採用することで、高調波スペックを満たすことが可能な電源回路100を、1つのハードウェアで構成することができる。
In this way, by changing the on-time (or ratio of on-time) in the half cycle, even in the case of FIG. 11 where ΔTon is the smallest, the 11th-order harmonic of the input current Iin, which is a problem in FIG. The wave component is reduced, and a margin for the standard is created. In FIG. 12, in which ΔTon is further increased, the 11th-order harmonic component is further reduced, and a sufficient margin is provided with respect to the standard value. On the other hand, in FIG. 13 in which ΔTon is further increased, there is a side effect that the third-order harmonic component of the input current Iin increases. Therefore, in this case, it is considered appropriate to set ΔTon between 0.15 and 0.25. By adopting such ΔTon, the
適切なTon0とΔTonの組み合わせは、電源回路100の入力レベル(あるいは出力レベル)によってさまざまである。そのため、複数の入力レベルに対して、適切なTon0とΔTonの組み合わせを予め定めておき、その情報を図2の記憶部17Bに記憶させておくとよい。マイコン17のオン時間決定部17Aは、その情報に基づいてオン時間を決定することができる。
The appropriate combination of Ton0 and ΔTon varies depending on the input level (or output level) of the
図15は、マイコン17が実行する処理を説明するためのフローチャートである。このフローチャートは、半周期における処理を示す。半周期の長さや、開始および終了のタイミングなどは、入力電圧Vinのゼロクロス点の検出などによって予め分かっており、マイコン17は、それらの情報を図2の記憶部17Bに記憶させている。
FIG. 15 is a flowchart for explaining processing executed by the
図2および図15を参照して、半周期が開始すると(ステップS100)、マイコン17は、タイマ機能を作動させ、時間tのカウントを開始する(ステップS101)。
Referring to FIGS. 2 and 15, when the half cycle starts (step S100),
次に、マイコン17は、オン時間(あるいはオン時間の比率)を初期値であるTon0に決定する。(ステップS102)。具体的には、オン時間決定部17Aがオン時間を決定する。
Next, the
そして、マイコン17は、決定したオン時間でFET11を駆動するように、FETドライバ18を制御する。FETドライバ18は、FET11をスイッチング動作させる(ステップS103)。
Then, the
その後、マイコン17は、時間tが半周期の期間を経過しているかどうか判断する(ステップS104)。
Thereafter, the
時間tが半周期の期間を経過していない場合(ステップS104でNO)、マイコン17は、現在のオン時間に、ΔTon/(t/半周期)を加えた値を新たなオン時間とし、その値を記憶部17Bに記憶させる(ステップS105)。そして、マイコン17は、再び、ステップS103に処理を戻す。
If the time t has not passed the half cycle period (NO in step S104), the
一方、時間tが半周期の期間を経過した場合(ステップS104でYES)、マイコン17は、半周期内における処理を終了する(ステップS106)。
On the other hand, when the time t has passed a half-cycle period (YES in step S104), the
以上のマイコン17の処理により、半周期においては、前半から後半に向かうにつれて、FET11のオン時間が大きくなる。ディユーティ比が大きくなると、PFC電流Ipfcも同様に大きくなる。その結果、PFC電流Ipfcのピークは、整流電圧Vrectのピークよりも遅れる。
[実施の形態2]
本発明の実施の形態の別の例によるPFC回路は、スイッチング周波数の制御に関する。PFC回路の基本的な構成は、図2のPFC回路4と同じである。
By the processing of the
[Embodiment 2]
A PFC circuit according to another example of an embodiment of the present invention relates to control of switching frequency. The basic configuration of the PFC circuit is the same as that of the
PFC回路4は昇圧型の回路でもある。そのため、PFC回路4は、入力電圧Vinのピーク値よりも大きい電圧を出力することとなる。入力電圧Vinが240Vの場合、PFC回路4の出力電圧は、たとえば400V程度とする。
The
ところで、降圧コンバータ5の降圧比は小さい方が電力変換効率が高くなる。これは、一般的に、ダイオードよりもFETの方が損失が小さく、降圧比が小いほど、ダイオードの導通率よりもFETの導通率が大きくなるためである。また、降圧コンバータ5の降圧比は、PFC回路4の昇圧比にも関係する。そのため、異なる入力レベルに対応した電源回路100では、入力電圧Vinの大きさに応じて、PFC回路4の昇圧比や降圧コンバータ5の降圧比を変えることが望ましい。すなわち、入力電圧Vinが比較的小さければ、PFC回路4の出力電圧も比較的小さくする。一方、入力電圧Vinが比較的大きければ、PFC回路4の出力電圧も比較的大きくする。
By the way, the power conversion efficiency becomes higher when the step-down ratio of the step-down
具体的には、たとえば、入力電圧Vinが100Vの場合はPFC回路4の出力電圧を170Vに、入力電圧Vinが200Vの場合はPFC回路4の出力電圧を340Vに、入力電圧Vinが240Vの場合はPFC回路4の出力電圧を400Vにすることが考えられる。
Specifically, for example, when the input voltage Vin is 100V, the output voltage of the
本願発明者らは、実験により、出力レベルが60Wの電源回路において、PFC回路の出力電圧を400Vから170Vに下げることで、電力変換効率が88%から90%に改善することを確認した。 The inventors of the present application have confirmed through experiments that the power conversion efficiency is improved from 88% to 90% by reducing the output voltage of the PFC circuit from 400V to 170V in a power supply circuit having an output level of 60W.
ところで、入力電圧Vinの瞬時値のピーク付近におけるFET11のスイッチング周波数(ACピーク時周波数)は、入力レベル(入力電圧Vinや入力電流Iin)に応じて変化する。
By the way, the switching frequency (AC peak frequency) of the
図16のグラフは、入力電圧Vinが100V、200V、240Vの3通り(AC100V、AC200V、AC240V)の場合の、入力電力とACピーク時周波数との関係を示す。ここで、入力電力は、電源回路100に入力される電力を示すが、電源回路100の各部における電力損失を無視したときは、PFC回路4の入力電力および電源回路100の出力電力に等しい。図16のグラフに示すように、入力電力が大きくなると、ACピーク時周波数は低くなる。また、入力電圧Vinが小さくなると、ACピーク時周波数は低くなる。
The graph of FIG. 16 shows the relationship between the input power and the AC peak frequency when the input voltage Vin is 100V, 200V, and 240V (AC100V, AC200V, and AC240V). Here, the input power indicates the power input to the
異なる入力レベルに対応した電源回路100において、上述のように電力変換効率を高めるためにPFC回路4の出力電圧を下げると、FET11のスイッチング周波数は広範囲に変化してしまう。
In the
しかし、ラインフィルタ2などのローパスフィルタは、FET11のスイッチング周波数に応じて設計されている。そのため、スイッチング周波数が低くなりすぎた場合に、その周波数におけるフィルタリング機能が低下するといった問題が生じる。
However, the low-pass filter such as the
そこで、実施の形態2では、スイッチング周波数が所定下限値を下回らないように、PFC回路4の出力電圧を決定する。すなわち、PFC回路の出力電圧を170Vまで下げた方が電力変換効率がよくなる場合であったとしても、PFC回路の出力電圧を170Vよりも高くする。
Therefore, in the second embodiment, the output voltage of the
その詳細を、図17、図18および図19も参照しつつ説明する。
図17は、入力電圧Vinが100Vの場合において、入力電力PinとACピーク時周波数の関係を示したグラフである。
Details thereof will be described with reference to FIGS. 17, 18, and 19.
FIG. 17 is a graph showing the relationship between the input power Pin and the AC peak frequency when the input voltage Vin is 100V.
PFC回路4の出力電圧が400Vで固定(図17の「AC100V/PFC400V固定」)の場合は、ACピーク時周波数が比較的高い。
When the output voltage of the
一方、入力電圧Vinが100Vの場合は、電力変換効率を高めるために、PFC回路4の出力電圧を、170Vまで下げることが望ましい。しかし、PFC回路4の出力電圧を170Vまで下げて固定すると、ACピーク時周波数が低下する(図17の「AC100V\PFC170V固定」)。その結果、たとえば、入力電力が比較的大きい(約40W以上)場合に、ACピーク時周波数がかなり低くなり(たとえば30kHz)、ローパスフィルタのフィルタリング機能が低下してしまう。
On the other hand, when the input voltage Vin is 100V, it is desirable to lower the output voltage of the
そこで、ACピーク時周波数の所定下限値を30kHzに設定する。その場合、PFC回路4の出力電圧を固定するのではなく可変にする。これにより、入力電力が40Wを超えた場合にも、ACピーク時周波数が30kHzを下回ることがなくなる(図17の「AC100V/PFC電圧可変」)。
Therefore, the predetermined lower limit of the AC peak frequency is set to 30 kHz. In that case, the output voltage of the
PFC回路4の出力電圧を可変にする場合、入力のAC電圧が100Vの場合に、入力電力に対するPFC回路の出力電力を、たとえば、図18に示すような関係となるように定めておくことが考えられる。
When the output voltage of the
図18は、入力のAC電圧が100Vの場合の、入力電力とPFC回路4の出力電圧の関係を示す。電力変換効率の観点からは、入力電力の大きさにかかわらず、PFC回路の出力電圧は170Vとすることが望ましい(図18の「AC100V/PFC170V」)。しかし、ここでは、入力電力が比較的大きい(約40W以上)場合、それに応じて、PFC回路の出力電圧も大きくなるように設定する(図18の「AC100V/PFC電圧可変」)。
FIG. 18 shows the relationship between the input power and the output voltage of the
これにより、スイッチング周波数が低くなりすぎてラインフィルタ2などのフィルタリング機能が低下するのを防ぐことが可能となる。 As a result, it is possible to prevent the switching function from being lowered due to the switching frequency becoming too low.
図19は、マイコン17が実行する処理を説明するためのフローチャートである。
電源回路100を起動すると(ステップS200)、マイコン17は、入力電圧Vinの値を確認する(ステップS201)。入力電圧Vinの値は、たとえば、整流電圧Vrectの値を測定することにより得られる。
FIG. 19 is a flowchart for explaining processing executed by the
When the
次に、マイコン17は、入力電力の値を決定する(ステップS202)。入力電力は、LED負荷6の消費電力に対応する値である。その値は、予め定められたものであってもよいし、電源回路100の外部から(たとえばユーザの操作によって)与えられるものでもよい。
Next, the
マイコン17は、上記入力電圧Vinと入力電力の値に基づいて、PFC回路4の出力電圧を決定する(ステップS203)。たとえば、入力電圧VinがAC100Vの場合、PFC回路4の出力電圧は、図18に示すグラフに基づいて計算できる。
The
このようにして、マイコン17は、PFC回路4の出力電圧を設定し、処理を終了する(ステップS204)。
[実施の形態3]
本発明の実施の形態の別の例は、AC電源1の電圧の瞬時低下に関する。
In this way, the
[Embodiment 3]
Another example of the embodiment of the present invention relates to an instantaneous drop in the voltage of the
図20は、実施の形態3の電源回路200の概略構成を示す。電源回路200は、図1に記載の電源回路100のPFC回路4および降圧コンバータ5に替えて、PFC回路30を備える。
FIG. 20 shows a schematic configuration of the
図21は、PFC回路30の詳細な構成を示す。PFC回路30は、要約すると、PFC回路4と降圧コンバータ5の機能を併せ持つ。そのため、PFC回路30の各部については、手短に説明する。
FIG. 21 shows a detailed configuration of the
コンデンサ31,39は、平滑化コンデンサである。抵抗32,33,44,45は、電圧測定用の抵抗である。FET35,36、ダイオード37,38は、インダクタ34を流れる電流を制御し、また、PFC回路の所望の電圧および電流を出力するために用いられる。インダクタ34には、補助巻き線が備えられている。電流センサ43は、PFC回路30の出力側を流れる電流を測定し、電圧に変換する。回路電流制御部40は、マイコン41、FETドライバ42を含む。FETドライバ42は、FET35,36を駆動する。マイコン41は、オン時間決定部41A、記憶部41Bを含む。さらに、マイコン41は、ADコンバータやタイマ機能なども有している。
以上の構成により、PFC回路30は、インダクタ34を流れる電流を制御し、また、所望の電圧および電流を出力することができる。
With the above configuration, the
ところで、通常、AC電源1には、他の電気器機も接続される。そして、他の電気機器がAC電源1の電力の利用を開始する際に、AC電源1の電圧(入力電圧Vin)が瞬時的に低下(瞬時低下)する場合がある。
By the way, normally, other electric devices are also connected to the
入力電圧Vinの瞬時低下が生じると、整流電流Irectも瞬時低下する。すると、図22に示すように、LED負荷6への電流(ILED)が瞬時的に小さくなる。その結果、LED負荷6の照度も小さくなり、ちらつきが生じてしまう。
When the input voltage Vin decreases instantaneously, the rectified current Irect also decreases instantaneously. Then, as shown in FIG. 22, the current (ILED) to the
ちらつきの問題を防ぐためには、たとえば、電源回路200が入力電圧Vinをモニタし、入力電圧Vinの瞬時低下が生じたときでも、LED負荷6への電流の大きさを維持するように、PFC回路30が電流制御を行なうことが考えられる。
In order to prevent the problem of flickering, for example, the
具体的には、現在の半周期における整流電圧Vrectの波形の情報と、現在の半周期の前の半周期における整流電圧Vrectとを比較し、その差に応じてLED負荷6への電流(すなわち、PFC回路30の出力電流)を制御するといったことが考えられる。
Specifically, the information on the waveform of the rectified voltage Vrect in the current half cycle is compared with the rectified voltage Vrect in the half cycle before the current half cycle, and the current to the LED load 6 (that is, in accordance with the difference) It is conceivable that the output current of the
ここで、整流電圧は、図23に示すように、FET35などのスイッチング周波数に応じた周波数成分を含み、それにより変動している。そのような整流電圧の波形の情報を正確に取得するためには、スイッチング周波数を考慮したサンプリング周波数で、整流電圧をサンプリングする必要がある。
Here, as shown in FIG. 23, the rectified voltage includes a frequency component corresponding to the switching frequency of the
スイッチング周波数を考慮したサンプリング周波数は、比較的高い周波数となるため、サンプリングデータの量がかなり大きくなる。そのため、記憶部41Bの容量が大きくなってしまいコストが掛かる、といった問題が生じる。 Since the sampling frequency considering the switching frequency is a relatively high frequency, the amount of sampling data is considerably large. Therefore, there arises a problem that the capacity of the storage unit 41B is increased and costs are increased.
ところで、整流電圧のピーク付近の電圧が瞬時低下すると、LED負荷6への電流が大幅に減少する。これに対し、整流電圧のピークから離れたところでの電圧が瞬時低下しても、LED負荷6への電流はあまり減少しない。
By the way, when the voltage near the peak of the rectified voltage is instantaneously reduced, the current to the
そこで、実施の形態3では、マイコン41は、整流電圧Vrectのピーク付近での電圧のみを記憶部41Bに記憶させる。そして、現在の半周期の前の半周期の整流電圧のピーク付近での電圧との差を比較する。マイコン41は、両電圧の差が所定の値よりも大きいかどうかで、入力電圧Vinの瞬時低下の有無を判断し、瞬時低下が生じたと判断した場合は、FET35,36のオン時間を増加させる。
Therefore, in the third embodiment, the
これにより、入力電圧Vinの瞬時低下が生じた場合であっても、LED負荷06への電流が減少するのを防ぎ、照明のちらつきを防ぐことが可能となる。 Accordingly, even when the input voltage Vin instantaneously decreases, it is possible to prevent the current to the LED load 06 from decreasing and to prevent flickering of illumination.
図24は、整流電圧Vrectの変化に対するFET35,36のオン時間の変化を示す。
FIG. 24 shows changes in the ON times of the
ここでは、整流電圧Vrectの、2つめの半周期のピーク付近(時刻t1)で瞬時低下が生じ、オン時間が増加している(ΔTon)。その後、整流電圧Vrectの3周期目では、ピーク付近(時刻t2)での整流電圧Vrectの瞬時低下がないため、オン時間がもとの値に戻っている。 Here, an instantaneous decrease occurs near the peak of the second half cycle of the rectified voltage Vrect (time t1), and the on-time increases (ΔTon). Thereafter, in the third period of the rectified voltage Vrect, the on-time returns to the original value because there is no instantaneous decrease in the rectified voltage Vrect near the peak (time t2).
ところで、図23に示すような整流電圧のサンプリングにおいては、サンプリング開始のタイミングによって結果が異なることもあり、正確なサンプリングができない。たとえば、図25では、スイッチング周波数の2倍のサンプリング周期で、整流電圧Vrectを、合計2回サンプリングしている。しかし、サンプリング開始のタイミングが比較的早い場合(T1)と、サンプリング開始のタイミングが比較的遅い場合(T2)では、それぞれのサンプリングにより得られる測定値が異なることがわかる。 By the way, in the sampling of the rectified voltage as shown in FIG. 23, the result may differ depending on the sampling start timing, and accurate sampling cannot be performed. For example, in FIG. 25, the rectified voltage Vrect is sampled twice in total at a sampling period twice the switching frequency. However, it can be seen that the measurement value obtained by each sampling differs when the sampling start timing is relatively early (T1) and when the sampling start timing is relatively late (T2).
そこで、サンプリングは、スイッチング周期の整数倍+半周期、の間隔で行なうことが望ましい。ここで、スイッチング周期は、スイッチング周波数の逆数である。 Therefore, it is desirable to perform sampling at an interval of an integral multiple of the switching cycle + a half cycle. Here, the switching period is the reciprocal of the switching frequency.
たとえば、図26では、スイッチング周期の2.5倍のサンプリング周期で、整流電圧を、合計2回サンプリングしている。この場合、サンプリング開始のタイミングが比較的早い場合(T3)と、サンプリング開始のタイミングが比較的遅い場合(T4)では、それぞれのサンプリングにより得られる測定値(2回のサンプリングの平均値)が、ほぼ同じ値になる。 For example, in FIG. 26, the rectified voltage is sampled twice in total at a sampling period 2.5 times the switching period. In this case, when the sampling start timing is relatively early (T3) and when the sampling start timing is relatively late (T4), the measured value (average value of two samplings) obtained by each sampling is It becomes almost the same value.
このようにスイッチング周期の2.5倍のサンプリング周期を選択することで、サンプリングデータ数を減らしつつ、整流電圧を正確に測定することができる。 Thus, by selecting a sampling period that is 2.5 times the switching period, the rectified voltage can be accurately measured while reducing the number of sampling data.
図27は、マイコン41が実行する処理を説明するためのフローチャートである。
このフローチャートは、半周期内における処理を示す。前提として、マイコン41は、現在の半周期の前の半周期の整流電圧の波形の情報を記憶部41Bに記憶させている。また、入力電圧Vinの瞬時低下がない場合のオン時間のデフォルト値(Ton0)とする。
FIG. 27 is a flowchart for explaining processing executed by the
This flowchart shows processing in a half cycle. As a premise, the
半周期が開始すると(ステップS300)、マイコン41は、整流電圧Vrectのピーク付近において、電圧値のサンプリングを行い、その情報を記憶部17Bに記憶させる(ステップS301)。
When the half cycle starts (step S300), the
その後、マイコン41は、記憶部17Bが記憶している、現在の半周期の整流電圧Vrectのサンプリング値の平均値S1と、現在の半周期の前の半周期の整流電圧Vrectのサンプリング値の平均値S2を計算し、その差ΔS(S2−S1)を求める(ステップS302)。
Thereafter, the
次いで、マイコン41は、ΔSが所定値Sthよりも大きいかどうか判断する(ステップS303)。所定値Sthは、入力電圧Vinの瞬時低下を判断するための基準値である。
Next, the
ステップS303において、ΔSがSth以下であると判断した場合(ステップS303でNO)、マイコン41は、オン時間をデフォルト値(Ton0)に決定する(ステップS304)。具体的には、オン時間決定部41Aがオン時間を決定する。
If it is determined in step S303 that ΔS is equal to or less than Sth (NO in step S303), the
一方、ステップS303において、ΔSがSth以下であると判断した場合(ステップS303でYES)、マイコン41は、オン時間をΔTだけ増加させる(ステップS305)。
On the other hand, if it is determined in step S303 that ΔS is equal to or less than Sth (YES in step S303), the
ステップS304またはステップS305の処理を行った後、マイコン41は処理を終える(ステップS306)。
After performing the process of step S304 or step S305, the
最後に、再び図1、図2、図20および図21を参照して、本発明の実施の形態について総括する。 Finally, referring to FIG. 1, FIG. 2, FIG. 20 and FIG. 21 again, the embodiments of the present invention will be summarized.
本発明は、交流電源(1)からの交流電圧(Vin)を整流する整流回路(3)の後段に接続され、交流電源(1)の力率を改善するために用いられる力率改善回路(PFC回路4,PFC回路30)であって、入力側に設けられた入力側コンデンサ(7,31)と、入力側コンデンサ(7,31)に流れる電流(Ic)がないと仮定したときに、交流電圧(Vin)の半周期において、半周期における後半の電流量が半周期における前半の電流量よりも大きくなるように回路電流(IL)を制御する回路電流制御部(16,40)とを備える。
The present invention is connected to a subsequent stage of a rectifier circuit (3) for rectifying an AC voltage (Vin) from an AC power supply (1), and is used to improve the power factor of the AC power supply (1) (
ここで、電流量は、電流を時間積分した値をいう。
好ましくは、回路電流制御部(16,40)は、半周期において回路電流(IL)のピークが整流回路(3)により整流された整流電圧(Vrect)のピークよりも遅れるように回路電流(IL)を制御する。
Here, the amount of current refers to a value obtained by integrating the current over time.
Preferably, the circuit current control unit (16, 40) is configured so that the peak of the circuit current (IL) is delayed from the peak of the rectified voltage (Vrect) rectified by the rectifier circuit (3) in a half cycle. ) To control.
好ましくは、回路電流制御部(16,40)は、スイッチング動作によって回路電流(IL)の大きさを調節するスイッチング素子(FET11,FET35,FET36)と、スイッチング動作におけるオン時間が半周期において増加するようにオン時間を決定するオン時間決定部(17A,41A)と、オン時間決定部(17A,41A)により決定されたオン時間でスイッチング素子(FET11,FET35,FET36)を駆動するスイッチング素子駆動部(FETドライバ18,FETドライバ42)とを備える。
Preferably, the circuit current control unit (16, 40) includes a switching element (FET11, FET35, FET36) that adjusts the magnitude of the circuit current (IL) by the switching operation, and an ON time in the switching operation increases in a half cycle. The on-time determining unit (17A, 41A) for determining the on-time and the switching element driving unit for driving the switching elements (FET11, FET35, FET36) with the on-time determined by the on-time determining unit (17A, 41A) (
好ましくは、オン時間は、半周期の間、一定の割合で増加する。
好ましくは、力率改善回路(PFC回路3,PFC回路30)は、複数の入力レベルに対応した力率改善回路である。回路電流制御部(16,40)は、力率改善回路(PFC回路3,30)の入力レベルに応じてスイッチング動作におけるスイッチング周波数の下限値を変える。
Preferably, the on-time increases at a constant rate during a half cycle.
Preferably, the power factor correction circuit (
好ましくは、回路電流制御部(16,40)は、半周期における整流電圧の少なくとも一部を記憶する整流電圧記憶部(17B,41B)を備える。回路電流制御部(16,40)は、現在の半周期における整流電圧と整流電圧記憶部(17B,41B)に記憶された現在の半周期の前の半周期における整流電圧との差に応じてスイッチング動作におけるオン時間を調節する。 Preferably, the circuit current control unit (16, 40) includes a rectified voltage storage unit (17B, 41B) that stores at least a part of the rectified voltage in a half cycle. The circuit current control unit (16, 40) responds to the difference between the rectified voltage in the current half cycle and the rectified voltage in the half cycle before the current half cycle stored in the rectified voltage storage unit (17B, 41B). Adjust the ON time in the switching operation.
また、本発明に係る照明用電源(100,200)は、上記のいずれかの力率改善回路(PFC回路3,PFC回路30)を備える。
The illumination power supply (100, 200) according to the present invention includes any one of the above power factor correction circuits (
今回開示された実施の形態は、すべての点で例示であって制限的なものではないと考えられるべきである。本発明の範囲は、上記した実施の形態の説明でなくて特許請求の範囲によって示され、特許請求の範囲と均等の意味および範囲内でのすべての変更が含まれることが意図される。 The embodiment disclosed this time should be considered as illustrative in all points and not restrictive. The scope of the present invention is shown not by the above description of the embodiment but by the scope of the claims, and is intended to include all modifications within the meaning and scope equivalent to the scope of the claims.
1 電源、2 ラインフィルタ、3 整流回路、4,30 PFC回路、5 降圧コンバータ、6 LED負荷、7,13,22,31,39 コンデンサ、8,9,14,15,32,33,44,45 抵抗、10,21,34 インダクタ、11,35,36 FET、12,20,37,38 ダイオード、16,40 回路電流制御部、17,24,41 マイコン、17A,41A オン時間決定部、17B,41B 記憶部、18,26,42 FETドライバ、23 制御回路、25,43 電流センサ、100,200 電源回路。 1 power supply, 2 line filter, 3 rectifier circuit, 4,30 PFC circuit, 5 step-down converter, 6 LED load, 7, 13, 22, 31, 39 capacitor, 8, 9, 14, 15, 32, 33, 44, 45 resistor, 10, 21, 34 inductor, 11, 35, 36 FET, 12, 20, 37, 38 diode, 16, 40 circuit current control unit, 17, 24, 41 microcomputer, 17A, 41A on-time determination unit, 17B , 41B storage unit, 18, 26, 42 FET driver, 23 control circuit, 25, 43 current sensor, 100, 200 power supply circuit.
Claims (5)
入力側に設けられた入力側コンデンサと、
前記入力側コンデンサに流れる電流がないと仮定したときに、前記交流電圧の半周期において、前記半周期における後半の電流量が前記半周期における前半の電流量よりも大きくなるように回路電流を制御する回路電流制御部とを備える、力率改善回路。 A power factor correction circuit connected to a subsequent stage of a rectifier circuit for rectifying an AC voltage from an AC power source and used to improve the power factor of the AC power source,
An input side capacitor provided on the input side;
When it is assumed that there is no current flowing through the input-side capacitor, the circuit current is controlled so that, in the half cycle of the AC voltage, the current amount in the latter half of the half cycle is larger than the current amount in the half cycle of the half cycle. A power factor correction circuit comprising a circuit current control unit.
スイッチング動作によって前記回路電流の大きさを調節するスイッチング素子と、
前記スイッチング動作におけるオン時間が前記半周期において増加するようにオン時間を決定するオン時間決定部と、
前記オン時間決定部により決定されたオン時間で前記スイッチング素子を駆動するスイッチング素子駆動部とを備える、請求項1または2に記載の力率改善回路。 The circuit current controller is
A switching element that adjusts the magnitude of the circuit current by a switching operation;
An on-time determining unit that determines an on-time so that an on-time in the switching operation increases in the half cycle;
The power factor correction circuit according to claim 1, further comprising: a switching element driving unit that drives the switching element with an on-time determined by the on-time determining unit.
前記回路電流制御部は、前記力率改善回路の入力レベルに応じて前記スイッチング動作におけるスイッチング周波数の下限値を変える、請求項1〜3のいずれか1項に記載の力率改善回路。 The power factor correction circuit is a power factor correction circuit corresponding to a plurality of input levels,
4. The power factor correction circuit according to claim 1, wherein the circuit current control unit changes a lower limit value of a switching frequency in the switching operation according to an input level of the power factor correction circuit. 5.
半周期における整流電圧の少なくとも一部を記憶する整流電圧記憶部を備え、
現在の半周期における整流電圧と前記整流電圧記憶部に記憶された現在の半周期の前の半周期における整流電圧との差に応じて前記スイッチング動作におけるオン時間を調節する、請求項1〜4のいずれか1項に記載の力率改善回路。
The circuit current controller is
A rectified voltage storage unit that stores at least a part of the rectified voltage in a half cycle,
The on-time in the switching operation is adjusted according to a difference between a rectified voltage in a current half cycle and a rectified voltage in a half cycle before the current half cycle stored in the rectified voltage storage unit. The power factor correction circuit according to any one of the above.
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WO2018087960A1 (en) * | 2016-11-08 | 2018-05-17 | 三菱電機株式会社 | Power factor compensation power supply device and led lighting device |
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