JP2014197941A - Power conversion device and inrush current suppression method - Google Patents

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Abstract

PROBLEM TO BE SOLVED: To provide a power conversion device and an inrush current suppression method that can suppress an inrush current occurring when a feed side recovers from an instantaneous power failure while suppressing an influence on a power conversion operation.SOLUTION: A power conversion device (1), which includes a step-up converter (20) for stepping up a DC input voltage to a predetermined voltage and an inrush current suppression circuit (40) for suppressing an inrush current flowing through the step-up converter, is provided with a power failure detection section (50) for, in the event of a power failure occurring on a feed side supplying the DC input voltage with the DC input voltage exceeding a specified value, detecting the power failure on the feed side when the time of the power failure reaches a predetermined time; and an initialization section (60) for initializing a circuit state of the inrush current suppression circuit when the power failure detection section detects the power failure on the feed side.

Description

本発明は、電力変換装置及び突入電流抑制方法に関し、更に詳しくは、瞬時停電時に発生する突入電流を抑制するための技術に関する。   The present invention relates to a power conversion device and an inrush current suppression method, and more particularly to a technique for suppressing an inrush current that occurs during an instantaneous power failure.

スイッチング電源などの電力変換装置は、電源投入時の突入電流を抑制する突入電流抑制回路を備えている。また、電源投入時のみならず、瞬時停電時の突入電流を抑制するための技術も知られている(特許文献1)。この技術によれば、瞬時停電が発生した場合、突入電流抑制回路を構成する抵抗と並列接続された電界効果トランジスタ(FET; Field Effect Transistor)等を非導通状態に制御することにより、給電側が瞬時停電から復旧する際に発生する突入電流を上記抵抗に流し込んで抑制する。   A power conversion device such as a switching power supply includes an inrush current suppression circuit that suppresses an inrush current when the power is turned on. In addition, a technique for suppressing inrush current at the time of instantaneous power failure as well as when power is turned on is also known (Patent Document 1). According to this technology, when an instantaneous power failure occurs, the power supply side is instantaneously controlled by controlling a field effect transistor (FET) or the like connected in parallel with the resistor constituting the inrush current suppression circuit to a non-conductive state. The inrush current generated when recovering from a power failure is suppressed by flowing into the resistor.

ところで、近年、高電圧直流入力(例えば192V〜410V)仕様の電力変換装置に対する要請が高まっている。この種の電力変換装置は、電圧を安定化させるための昇圧コンバータを備えており、高電圧直流入力の電圧値が変動しても、昇圧コンバータにより高電圧直流入力が一定の目標電圧(例えば380V)に昇圧される。この昇圧された電圧を電力変換することにより、所望の出力電圧を安定的に得ることができる。この種の電力変換装置では、高電圧直流入力の電圧値が上述の電圧安定化用の昇圧コンバータの出力電圧に近づくと、その動作の原理上、昇圧コンバータが間欠発振を起こし、発振動作が不安定になる。このため、一般に、高電圧直流入力の電圧値が昇圧コンバータの出力電圧に近づいた場合、昇圧コンバータの発振動作を停止させている。   Incidentally, in recent years, there has been an increasing demand for power converters with high voltage DC input (for example, 192 to 410 V) specifications. This type of power conversion device includes a boost converter for stabilizing the voltage, and even if the voltage value of the high-voltage DC input fluctuates, the boost converter converts the high-voltage DC input to a target voltage (for example, 380 V). ). A desired output voltage can be stably obtained by power-converting the boosted voltage. In this type of power conversion device, when the voltage value of the high-voltage DC input approaches the output voltage of the above-described voltage stabilizing boost converter, the boost converter causes intermittent oscillation due to the principle of operation, and the oscillation operation is not performed. Become stable. For this reason, generally, when the voltage value of the high-voltage DC input approaches the output voltage of the boost converter, the oscillation operation of the boost converter is stopped.

特開平6−22543号公報JP-A-6-22543

上述の電圧安定化用の昇圧コンバータを備えた電力変換装置によれば、高電圧直流入力の電圧値が昇圧コンバータの出力電圧に近づいたために昇圧コンバータを停止させている状態で給電側の異常により瞬時停電が発生すると、この瞬時停電から給電側が復旧する際に、電力変換装置の入力インピーダンスを形成する例えば入力コンデンサの充電に伴って過大な突入電流が発生する場合がある。   According to the above-described power converter including the voltage stabilizing boost converter, the voltage value of the high-voltage DC input approaches the output voltage of the boost converter, and the boost converter is stopped due to an abnormality on the power supply side. When an instantaneous power failure occurs, when the power supply side recovers from the instantaneous power failure, an excessive inrush current may occur with charging of the input capacitor that forms the input impedance of the power converter.

上述の特許文献1の技術によれば、給電側が瞬時停電から復旧する際の突入電流を抑制することはできるが、昇圧コンバータの動作とは無関係に突入電流抑制回路が機能する。ここで、通常、昇圧コンバータはチョークコイルを備え、このチョークコイルをスイッチング駆動する過程で給電側からチョークコイルに電流が断続的に流し込まれる。このため、昇圧コンバータ自体も動作中は突入電流を吸収する機能を有していると言える。従って、昇圧コンバータが動作している状態で突入電流抑制回路が機能すると、双方の機能が相俟って入力電流が過剰に抑制される場合が起こり得る。この場合、電力変換動作が不安定になるおそれがある。   According to the technology of Patent Document 1 described above, the inrush current when the power supply side recovers from the instantaneous power failure can be suppressed, but the inrush current suppression circuit functions regardless of the operation of the boost converter. Here, the boost converter normally includes a choke coil, and current is intermittently supplied from the power feeding side to the choke coil in the process of switching the choke coil. For this reason, it can be said that the boost converter itself has a function of absorbing inrush current during operation. Therefore, when the inrush current suppression circuit functions in a state where the boost converter is operating, there is a possibility that the input current is excessively suppressed due to the combination of both functions. In this case, the power conversion operation may become unstable.

本発明は、電力変換動作に与える影響を抑制しつつ、瞬時停電から給電側が復旧する際に発生する突入電流を抑制することができる電力変換装置及び突入電流抑制方法を提供することを目的とする。   An object of the present invention is to provide a power conversion device and an inrush current suppression method capable of suppressing an inrush current generated when the power supply side recovers from an instantaneous power failure while suppressing an influence on the power conversion operation. .

本発明の一態様による電力変換装置は、直流入力電圧を所定電圧に昇圧するための昇圧コンバータと、前記昇圧コンバータを通して流れる突入電流を抑制するための突入電流抑制回路とを備え、前記昇圧コンバータから出力される電圧を電力変換するように構成された電力変換装置であって、前記直流入力電圧が規定値を上回った状態で、前記直流入力電圧を供給する給電側の停電が発生した場合、前記停電の時間が所定時間に達したときに、前記給電側が停電したことを検出する停電検出部と、前記停電検出部が前記給電側の停電を検出した場合、前記突入電流抑制回路の回路状態を初期化する初期化部と、を備えた電力変換装置の構成を有する。   A power converter according to an aspect of the present invention includes a boost converter for boosting a DC input voltage to a predetermined voltage, and an inrush current suppressing circuit for suppressing an inrush current flowing through the boost converter. In the power conversion device configured to convert the output voltage to power, in the state where the DC input voltage exceeds a specified value, when a power failure occurs on the power supply side supplying the DC input voltage, When the time of the power failure reaches a predetermined time, when the power failure detection unit detects that the power supply side has failed, and when the power failure detection unit detects a power failure on the power supply side, the circuit state of the inrush current suppression circuit is changed. And an initialization unit that initializes the power conversion device.

例えば、前記規定値は、前記直流入力電圧が昇圧コンバータから出力される直流電圧に接近したことによる前記昇圧コンバータの不安定動作を防止するために予め設定された所定電圧を示す値である。
例えば、前記停電検出部は、前記直流入力電圧が前記規定値を上回った状態から所定電圧以下に低下したことを検出する電圧検出部と、前記直流入力電圧が前記所定電圧以下に低下したことを前記電圧検出部が検出した場合に前記所定時間の計時を開始する計時部と、前記計時部が前記所定時間の計時を終了したときに、前記計時が終了した旨の信号を発生させる信号発生部と、を備える。
例えば、前記突入電流抑制回路は、前記給電側が停電から復旧したときに発生する突入電流の経路上に介挿された抵抗と、前記抵抗に対して並列接続されたスイッチ素子とを備えて構成され、前記初期化部は、前記停電検出部が前記給電側の停電を検出した場合、前記スイッチ素子がオフ状態となるように前記突入電流抑制回路の回路状態を初期化する。
例えば、前記直流入力電圧は、商用電源から供給される電力を整流して得られた電圧である。
For example, the specified value is a value indicating a predetermined voltage set in advance to prevent unstable operation of the boost converter due to the DC input voltage approaching the DC voltage output from the boost converter.
For example, the power failure detection unit detects that the DC input voltage has dropped below a predetermined voltage from a state where the DC input voltage has exceeded the specified value, and that the DC input voltage has dropped below the predetermined voltage. A timing unit that starts counting the predetermined time when the voltage detection unit detects, and a signal generation unit that generates a signal indicating that the timing has ended when the timing unit finishes counting the predetermined time And comprising.
For example, the inrush current suppression circuit includes a resistor inserted on a path of an inrush current that occurs when the power supply side recovers from a power failure, and a switch element connected in parallel to the resistor. The initialization unit initializes the circuit state of the inrush current suppression circuit so that the switch element is turned off when the power failure detection unit detects a power failure on the power feeding side.
For example, the DC input voltage is a voltage obtained by rectifying power supplied from a commercial power source.

本発明の一態様による電力変換方法は、直流入力電圧を所定電圧に昇圧するための昇圧コンバータと、前記昇圧コンバータを通して流れる突入電流を抑制するための突入電流抑制回路とを備え、前記昇圧コンバータから出力される電圧を電力変換するように構成された電力変換装置において、前記突入電流を抑制する突入電流抑制方法であって、前記直流入力電圧が規定値を上回った状態で、前記直流入力電圧を供給する給電側の停電が発生した場合、前記停電の時間が所定時間に達したときに、前記給電側が停電したことを検出する段階と、前記給電側の停電が検出された場合、前記突入電流抑制回路の回路状態を初期化する段階と、を含む突入電流抑制方法の構成を有する。   A power conversion method according to an aspect of the present invention includes a boost converter for boosting a DC input voltage to a predetermined voltage, and an inrush current suppression circuit for suppressing an inrush current flowing through the boost converter. In the power conversion device configured to convert the output voltage to power, the inrush current suppressing method for suppressing the inrush current, wherein the direct current input voltage is increased in a state where the direct current input voltage exceeds a specified value. When a power failure occurs on the power supply side to be supplied, when the time of the power failure reaches a predetermined time, the step of detecting the power failure on the power supply side, and when the power failure on the power supply side is detected, the inrush current And a step of initializing the circuit state of the suppression circuit.

本発明の一態様によれば、電力変換動作に与える影響を抑制しつつ、瞬時停電から給電側が復旧する際に発生する突入電流を抑制することができる。   According to one aspect of the present invention, it is possible to suppress an inrush current that occurs when the power supply side recovers from an instantaneous power failure while suppressing an influence on a power conversion operation.

本発明の第1実施形態による電力変換装置の構成の一例を示す図である。It is a figure which shows an example of a structure of the power converter device by 1st Embodiment of this invention. 本発明の第1実施形態による電力変換装置が備える昇圧コンバータの構成の一例を示す図である。It is a figure which shows an example of a structure of the step-up converter with which the power converter device by 1st Embodiment of this invention is provided. 本発明の第1実施形態による電力変換装置の電源投入時の動作の一例を説明するための図である。It is a figure for demonstrating an example of the operation | movement at the time of power activation of the power converter device by 1st Embodiment of this invention. 本発明の第1実施形態による電力変換装置の瞬時停電時の全体動作(瞬時停電時間が短い場合)の一例を説明するための図である。It is a figure for demonstrating an example of the whole operation | movement at the time of the instantaneous power failure (when instantaneous power failure time is short) of the power converter device by 1st Embodiment of this invention. 本発明の第1実施形態による電力変換装置の瞬時停電時の全体動作(瞬時停電時間が長い場合)の一例を説明するための図である。It is a figure for demonstrating an example of the whole operation | movement (when instantaneous power failure time is long) at the time of the instantaneous power failure of the power converter device by 1st Embodiment of this invention. 本発明の第1実施形態による電力変換装置の瞬時停電時の詳細動作の一例を説明するための図である。It is a figure for demonstrating an example of detailed operation | movement at the time of the momentary power failure of the power converter device by 1st Embodiment of this invention. 本発明の第1実施形態による電力変換装置の動作を補足説明するための図である。It is a figure for supplementarily explaining operation of the power converter by a 1st embodiment of the present invention.

(第1実施形態)
[構成の説明]
図1は、本発明の第1実施形態による電力変換装置1の構成の一例を示す。
電力変換装置1は、概略的には、外部の給電側の直流電源Eから供給される直流入力電圧Vinを所定の直流電圧Vpに昇圧するための昇圧コンバータ20と、昇圧コンバータ20を通して流れる突入電流Irushを抑制するための突入電流抑制回路40とを備え、昇圧コンバータ20の出力(昇圧コンバータ20から出力される直流電圧Vp)を電力変換するように構成される。
(First embodiment)
[Description of configuration]
FIG. 1 shows an example of the configuration of the power conversion device 1 according to the first embodiment of the present invention.
In general, the power conversion apparatus 1 includes a boost converter 20 for boosting a DC input voltage Vin supplied from an external DC power supply E on a power supply side to a predetermined DC voltage Vp, and an inrush current flowing through the boost converter 20. And an inrush current suppression circuit 40 for suppressing Irush, and is configured to convert power of the output of the boost converter 20 (DC voltage Vp output from the boost converter 20).

詳細には、電力変換装置1は、入力端子TIH,TIL、ヒューズF1,F2、電源スイッチSW、フィルタ10、逆接防止用ダイオードD1,D2、昇圧コンバータ20、入力コンデンサCin、DC/DC変換部30、突入電流抑制回路40、停電検出部50、初期化部60、制御部70、電圧検出用抵抗R1,R2,R3,R4、昇圧コンバータ発振停止回路80、入力電圧監視回路90、出力端子TOH,TOLを備える。入力端子TILはグランドGNDに接地されている。   Specifically, the power conversion device 1 includes input terminals TIH and TIL, fuses F1 and F2, a power switch SW, a filter 10, reverse connection prevention diodes D1 and D2, a boost converter 20, an input capacitor Cin, and a DC / DC conversion unit 30. , Inrush current suppression circuit 40, power failure detection unit 50, initialization unit 60, control unit 70, voltage detection resistors R1, R2, R3, R4, boost converter oscillation stop circuit 80, input voltage monitoring circuit 90, output terminal TOH, A TOL is provided. The input terminal TIL is grounded to the ground GND.

入力端子TIHと入力端子TILとの間には直流電源Eが接続され、この直流電源Eから直流入力電圧Vinが電力変換装置1に入力される。本実施形態では、直流入力電圧Vinは、例えば192V〜410Vの高電圧であり、電力変換装置1は、このような高電圧に対応した高電圧入力仕様となっている。ただし、直流入力電圧Vinの電圧範囲は、このような例に限定されず、任意である。直流電源Eの正極が接続される入力端子TIHから入力コンデンサCinの正極端子に至る経路は電源ラインDHを形成する。また、直流電源Eの負極が接続される入力端子TILから入力コンデンサCinの負極端子に至る経路はグランドラインDLを形成する。   A DC power supply E is connected between the input terminal TIH and the input terminal TIL, and a DC input voltage Vin is input from the DC power supply E to the power converter 1. In the present embodiment, the DC input voltage Vin is a high voltage of, for example, 192V to 410V, and the power conversion device 1 has a high voltage input specification corresponding to such a high voltage. However, the voltage range of the DC input voltage Vin is not limited to such an example and is arbitrary. A path from the input terminal TIH to which the positive electrode of the DC power supply E is connected to the positive electrode terminal of the input capacitor Cin forms a power supply line DH. A path from the input terminal TIL to which the negative electrode of the DC power supply E is connected to the negative electrode terminal of the input capacitor Cin forms a ground line DL.

入力端子TIHとフィルタ10の一方の入力部との間の電源ラインDH上には、ヒューズF1と電源スイッチSWとが直列接続されている。また、入力端子TILとフィルタ10の他方の入力部との間のグランドラインDL上にはヒューズF2が接続されている。これらヒューズF1,F2は、電力変換装置1で短絡障害が発生した場合に発生する短絡電流を遮断して装置を短絡電流から保護するためのものである。また、電源スイッチSWは、電力変換装置1の電源を投入するためのものであり、電源スイッチSWが閉じられると、直流電源Eから直流入力電圧Vinが電力変換装置1に供給され、電力変換装置1が電力変換動作を開始する。なお、本実施形態では、ヒューズF1,F2は必須の構成要素ではなく、必要に応じて省略してもよい。   On the power supply line DH between the input terminal TIH and one input part of the filter 10, a fuse F1 and a power switch SW are connected in series. A fuse F2 is connected on the ground line DL between the input terminal TIL and the other input portion of the filter 10. These fuses F1 and F2 are for protecting a device from a short circuit current by interrupting a short circuit current generated when a short circuit fault occurs in the power conversion device 1. The power switch SW is for turning on the power of the power conversion device 1. When the power switch SW is closed, the DC input voltage Vin is supplied from the DC power source E to the power conversion device 1, and the power conversion device. 1 starts the power conversion operation. In the present embodiment, the fuses F1 and F2 are not essential components and may be omitted as necessary.

図1において、ヒューズF2とフィルタ10の他方の入力部との間に表記された入力インピーダンスZinは、入力端子TIH,TILから見た電力変換装置1の入力インピーダンスを表している。本実施形態では、入力インピーダンスZinは、主として、入力端子TIHから入力コンデンサCinを経由して第2入力端子TILに至る入力コンデンサCinの充電経路のインピーダンスであり、この充電経路を構成する配線等のインピーダンスZs(不図示)と、突入電流抑制回路40内の抵抗41の抵抗値rを含む。   In FIG. 1, an input impedance Zin written between the fuse F2 and the other input portion of the filter 10 represents the input impedance of the power conversion device 1 viewed from the input terminals TIH and TIL. In the present embodiment, the input impedance Zin is mainly the impedance of the charging path of the input capacitor Cin from the input terminal TIH via the input capacitor Cin to the second input terminal TIL, and the wiring etc. constituting this charging path The impedance Zs (not shown) and the resistance value r of the resistor 41 in the inrush current suppression circuit 40 are included.

フィルタ10は、後段の昇圧コンバータ20またはDC/DC変換部30のスイッチング動作によって発生するスイッチングノイズの漏洩を防止するためのものであり、例えばコモンモードチョークコイルから構成される。
なお、突入電流Irushを抑制する本発明の課題との関係では、フィルタ10は必須の構成要素ではなく、必要に応じて省略してもよい。
The filter 10 is for preventing leakage of switching noise generated by the switching operation of the boost converter 20 or the DC / DC converter 30 in the subsequent stage, and is configured of, for example, a common mode choke coil.
Note that the filter 10 is not an essential component in the relationship with the problem of the present invention that suppresses the inrush current Irush, and may be omitted as necessary.

フィルタ10の一方の出力部は、電源ラインDH上の逆接防止用ダイオードD1を通じて昇圧コンバータ部20の一方の入力部に接続されている。また、フィルタ10の他方の出力部は、グランドラインDL上に介挿された突入電流抑制回路40内の抵抗41を通じて昇圧コンバータ部20の他方の入力部に接続されている。   One output section of the filter 10 is connected to one input section of the boost converter section 20 through a reverse connection prevention diode D1 on the power supply line DH. The other output part of the filter 10 is connected to the other input part of the boost converter part 20 through a resistor 41 in an inrush current suppression circuit 40 inserted on the ground line DL.

昇圧コンバータ部20は、直流入力電圧Vinを所定の直流電圧Vp(例えば380V)に昇圧するためのものである。
図2は、昇圧コンバータ20の構成の一例を示す図である。同図に示すように、昇圧コンバータ20は、チョークコイル(昇圧インダクタ)L20、nチャネル型電界効果トランジスタQ20、ダイオードD21,D22、コンデンサC20から構成されている。ここで、チョークコイルL20の一端は昇圧コンバータ20の一方の入力部をなし、上述の電源ラインDH上のダイオードD1を通じてフィルタ10の出力部に接続されている。また、チョークコイルL20の他端は、ダイオードD21のアノードに接続されている。このダイオードD21のカソードは昇圧コンバータ20の一方の出力部をなす。昇圧コンバータ20の一方の入力部と一方の出力部との間にはバイパス用のダイオードD22が接続されている。
The boost converter unit 20 is for boosting the DC input voltage Vin to a predetermined DC voltage Vp (for example, 380 V).
FIG. 2 is a diagram illustrating an example of the configuration of boost converter 20. As shown in the figure, the boost converter 20 includes a choke coil (boost inductor) L20, an n-channel field effect transistor Q20, diodes D21 and D22, and a capacitor C20. Here, one end of the choke coil L20 constitutes one input portion of the boost converter 20, and is connected to the output portion of the filter 10 through the diode D1 on the power supply line DH. The other end of the choke coil L20 is connected to the anode of the diode D21. The cathode of the diode D21 forms one output part of the boost converter 20. A bypass diode D22 is connected between one input portion and one output portion of the boost converter 20.

チョークコイルL20の他端には、nチャネル型電界効果トランジスタQ20のドレインが接続され、そのソースは、昇圧コンバータ20の他方の入力部および他方の出力部に接続されている。この昇圧コンバータ20の他方の入力部は、上述のグランドラインDL上の抵抗41を通じてフィルタ10の出力部に接続されている。nチャネル型電界効果トランジスタQ20のゲートには、後述する制御部70から駆動信号SD(発振信号)が供給される。昇圧コンバータ20の一方の出力部と他方の出力部との間にはコンデンサC20が接続される。
なお、上述した昇圧コンバータ20の構成は一例に過ぎず、昇圧インダクタを用いて入力電圧を昇圧する構成であれば、その回路形式は任意である。
The other end of the choke coil L20 is connected to the drain of an n-channel field effect transistor Q20, and its source is connected to the other input section and the other output section of the boost converter 20. The other input portion of the boost converter 20 is connected to the output portion of the filter 10 through the resistor 41 on the ground line DL. A drive signal SD (oscillation signal) is supplied to the gate of the n-channel field effect transistor Q20 from the control unit 70 described later. Capacitor C20 is connected between one output portion of boost converter 20 and the other output portion.
Note that the above-described configuration of the boost converter 20 is merely an example, and the circuit format is arbitrary as long as the input voltage is boosted using a boost inductor.

説明を図1に戻す。上述の昇圧コンバータ20の後段に設けられた入力コンデンサCinは、昇圧コンバータ20から出力される直流電圧Vpを安定化させるためのものであり、例えば電解コンデンサが用いられる。入力コンデンサCinの正極端子は、昇圧コンバータ20の一方の出力部に接続され、入力コンデンサCinの負極端子は、昇圧コンバータ20の他方の出力部に接続されている。入力コンデンサCinは、上述のヒューズF1,F2、電源スイッチSW、フィルタ10、昇圧コンバータ20等を介して、入力端子TIHと端子TILとの間に接続されている。   Returning to FIG. The input capacitor Cin provided in the subsequent stage of the boost converter 20 described above is for stabilizing the DC voltage Vp output from the boost converter 20, and for example, an electrolytic capacitor is used. The positive terminal of the input capacitor Cin is connected to one output part of the boost converter 20, and the negative terminal of the input capacitor Cin is connected to the other output part of the boost converter 20. The input capacitor Cin is connected between the input terminal TIH and the terminal TIL via the above-described fuses F1 and F2, the power switch SW, the filter 10, the boost converter 20, and the like.

DC/DC変換部30は、昇圧コンバータ20から供給される直流電圧Vpを電力変換して所望の出力電圧Voutを発生させるものである。本実施形態では、DC/DC変換部30は、このDC/DC変換部30を構成するスイッチング素子(不図示)のスイッチング動作により直流電圧Vpを交流電圧に一旦変換し、この交流電圧をトランス(不図示)により電圧変換して所望の出力電圧Voutを得るように構成されている。DC/DC変換部30により発生された出力電圧Voutは出力端子TOH,TOLを介して出力される。なお、DC/DC変換部30の回路形式は任意である。   The DC / DC converter 30 converts the direct current voltage Vp supplied from the boost converter 20 to generate a desired output voltage Vout. In the present embodiment, the DC / DC converter 30 temporarily converts the DC voltage Vp into an AC voltage by a switching operation of a switching element (not shown) constituting the DC / DC converter 30, and converts the AC voltage into a transformer ( A desired output voltage Vout is obtained by performing voltage conversion according to (not shown). The output voltage Vout generated by the DC / DC converter 30 is output via the output terminals TOH and TOL. The circuit format of the DC / DC converter 30 is arbitrary.

突入電流抑制回路40は、昇圧コンバータ20を通して流れる突入電流Irushを抑制するためのものであり、抵抗41、nチャネル型電界効果トランジスタ42(スイッチ素子)、抵抗43,44、コンパレータ45、遅延部46、駆動部47から構成される。抵抗41は、電源スイッチSWが閉じられて電力変換装置1の電源が投入された際、または、給電側の直流電源Eが瞬時停電から復旧する際に、入力コンデンサCinの充電経路に発生する突入電流Irushを抑制するためのものである。抵抗41の一端は、フィルタ10の他方の出力部に接続され、このフィルタ10およびヒューズF2を通じて入力端子TILに接続されている。また、抵抗41の他端は昇圧コンバータ20の他方の入力部に接続され、この昇圧コンバータ20を通じて入力コンデンサCinの負極端子に接続されている。即ち、抵抗41は、入力端子TIHと入力端子TILとの間に、昇圧コンバータ20を介して入力コンデンサCinと直列に接続されている。   The inrush current suppression circuit 40 is for suppressing the inrush current Irush that flows through the boost converter 20, and includes a resistor 41, an n-channel field effect transistor 42 (switch element), resistors 43 and 44, a comparator 45, and a delay unit 46. The drive unit 47 is configured. The resistor 41 is an inrush that occurs in the charging path of the input capacitor Cin when the power switch 1 is closed and the power conversion device 1 is turned on, or when the DC power source E on the power supply side recovers from an instantaneous power failure. This is to suppress the current Irush. One end of the resistor 41 is connected to the other output part of the filter 10, and is connected to the input terminal TIL through the filter 10 and the fuse F2. Further, the other end of the resistor 41 is connected to the other input portion of the boost converter 20 and is connected to the negative terminal of the input capacitor Cin through the boost converter 20. That is, the resistor 41 is connected in series with the input capacitor Cin via the boost converter 20 between the input terminal TIH and the input terminal TIL.

また、抵抗41は、給電側の直流電源Eが瞬時停電から復旧したときに発生する突入電流Irushの経路上に介挿されている。図1の例では、抵抗41は、入力端子TILから入力コンデンサCinの負極端子に至るグランドラインDL上に設けられているが、この例に限定されず、入力端子TIHから入力コンデンサCinの正極端子に至る電源ラインDH上に設けられてもよく、入力コンデンサCinの充電経路上であれば、どこに設けられてもよい。   The resistor 41 is inserted on the path of the inrush current Irush that occurs when the DC power source E on the power supply side recovers from the instantaneous power failure. In the example of FIG. 1, the resistor 41 is provided on the ground line DL extending from the input terminal TIL to the negative terminal of the input capacitor Cin. However, the present invention is not limited to this example, and the positive terminal of the input capacitor Cin is connected from the input terminal TIH. May be provided on the power supply line DH leading to, and may be provided anywhere on the charging path of the input capacitor Cin.

nチャネル型電界効果トランジスタ42は、通常の電力変換動作において抵抗41による電力損失を抑制するために、抵抗41の端子間を短絡するものである。nチャネル型電界効果トランジスタ42は、抵抗41に対して並列接続されている。具体的には、nチャネル型電界効果トランジスタ42のソースは、フィルタ10の出力部に接続された抵抗41の一端に接続され、そのドレインは、昇圧コンバータの入力部に接続された抵抗41の他端に接続されている。また、nチャネル型電界効果トランジスタ42のゲートには、後述の駆動部47から駆動信号SGが供給される。
なお、nチャネル型電界効果トランジスタ42に代えて、例えばIGBT(Insulated Gate Bipolar Transistor)やサイリスタなど、他の任意の素子を用いることができる。
The n-channel field effect transistor 42 is a short circuit between the terminals of the resistor 41 in order to suppress power loss due to the resistor 41 in a normal power conversion operation. The n-channel field effect transistor 42 is connected in parallel to the resistor 41. Specifically, the source of the n-channel field effect transistor 42 is connected to one end of a resistor 41 connected to the output unit of the filter 10, and the drain of the n-channel field effect transistor 42 is connected to the input unit of the boost converter. Connected to the end. A drive signal SG is supplied to the gate of the n-channel field effect transistor 42 from a drive unit 47 described later.
Instead of the n-channel field effect transistor 42, any other element such as an IGBT (Insulated Gate Bipolar Transistor) or a thyristor can be used.

抵抗43,44、コンパレータ45、遅延部46、駆動部47は、nチャネル型電界効果トランジスタ42のオン・オフを制御するトランジスタ制御部を構成する。このトランジスタ制御部は、電源の投入から突入電流Irushが消失した状態になるまでの所定時間Tsが経過するまで、nチャネル型電界効果トランジスタ42をオフ状態に維持し、所定時間Tsの経過後にnチャネル型電界効果トランジスタ42をオン状態に制御する。所定時間Tsは、突入電流Irushに関する電源変換装置1の特性に応じて任意に設定し得る。   The resistors 43 and 44, the comparator 45, the delay unit 46, and the drive unit 47 constitute a transistor control unit that controls on / off of the n-channel field effect transistor 42. The transistor control unit maintains the n-channel field effect transistor 42 in an off state until a predetermined time Ts from when the power is turned on until the inrush current Irush disappears, and after the predetermined time Ts has elapsed, n The channel type field effect transistor 42 is controlled to be turned on. The predetermined time Ts can be arbitrarily set according to the characteristics of the power converter 1 relating to the inrush current Irush.

抵抗43,44およびコンパレータ45は、電源スイッチSWが閉じられたことによる電源の投入を検知する検知部として機能する。ここで、抵抗43,44は、直流入力電圧Vinを検出するためのものであり、入力端子TIHに繋がる電源ラインDHとグランドラインDLに繋がる配線GL(即ちグランドラインDLの一部)との間に直列接続されている。具体的には、抵抗43の一端は、逆接防止用のダイオードD2を通じて電源ラインDHに接続されている。抵抗43の他端には抵抗44の一端が接続され、抵抗44の他端は配線GLに接続されている。抵抗43と抵抗44との間の接続ノードN40には、電源ラインDL上の直流入力電圧Vinを抵抗43,44により分圧して得られる電圧V40が発生する。   The resistors 43 and 44 and the comparator 45 function as a detection unit that detects power-on due to the power switch SW being closed. Here, the resistors 43 and 44 are for detecting the DC input voltage Vin, and between the power supply line DH connected to the input terminal TIH and the wiring GL connected to the ground line DL (that is, a part of the ground line DL). Are connected in series. Specifically, one end of the resistor 43 is connected to the power supply line DH through a reverse connection prevention diode D2. One end of the resistor 44 is connected to the other end of the resistor 43, and the other end of the resistor 44 is connected to the wiring GL. At a connection node N40 between the resistor 43 and the resistor 44, a voltage V40 obtained by dividing the DC input voltage Vin on the power supply line DL by the resistors 43 and 44 is generated.

接続ノードN40には、電圧V40と所定の参照電圧Vrefとを比較するためのコンパレータ45の入力部が接続されている。抵抗43,44の各抵抗値と参照電圧Vrefの値は、電源が投入された際の電源ラインDHの電圧上昇をコンパレータ45で判別できるような適切な値に設定されている。コンパレータ45は、電圧V40が参照電圧Vrefを超えると、電源が投入されたことを示すハイレベルの信号を出力する。本実施形態では、コンパレータ45の入出力特性は、検知動作の安定化のため、ヒステリシス特性を有するが、この例に限定されない。   The connection node N40 is connected to an input unit of a comparator 45 for comparing the voltage V40 with a predetermined reference voltage Vref. The resistance values of the resistors 43 and 44 and the value of the reference voltage Vref are set to appropriate values so that the comparator 45 can determine the voltage increase of the power supply line DH when the power is turned on. When the voltage V40 exceeds the reference voltage Vref, the comparator 45 outputs a high level signal indicating that the power is turned on. In this embodiment, the input / output characteristic of the comparator 45 has a hysteresis characteristic in order to stabilize the detection operation, but is not limited to this example.

遅延部46は、電源の投入が検知されたときにコンパレータ45から出力される信号を上記所定時間Tsだけ遅延させるものである。換言すれば、遅延部46は、電源の投入が検知されたときに所定時間Tsの計時を開始し、所定時間Tsが経過したときにコンパレータ45の出力信号と同じ信号レベルを有する信号を出力する。本実施形態では、遅延部46は、コンデンサCdの充放電時間を利用してコンパレータ45の出力信号を所定時間Tsだけ遅延させる遅延回路から構成され、コンデンサCdの容量値等により所定時間Tsの調整が可能となっている。遅延部46は、電源の投入が検知されない場合、ローレベルの信号を出力する。遅延部46は、上述の遅延回路のほか、所定周波数のクロック信号をカウントすることにより所定時間Tsを計時するカウンタ回路等、種々の形式の回路により実現可能である。   The delay unit 46 delays a signal output from the comparator 45 when the power-on is detected by the predetermined time Ts. In other words, the delay unit 46 starts measuring the predetermined time Ts when the power-on is detected, and outputs a signal having the same signal level as the output signal of the comparator 45 when the predetermined time Ts elapses. . In the present embodiment, the delay unit 46 is configured by a delay circuit that delays the output signal of the comparator 45 by a predetermined time Ts using the charge / discharge time of the capacitor Cd, and adjusts the predetermined time Ts by the capacitance value of the capacitor Cd and the like. Is possible. The delay unit 46 outputs a low level signal when power-on is not detected. The delay unit 46 can be realized by various types of circuits such as a counter circuit that counts a predetermined time Ts by counting clock signals having a predetermined frequency in addition to the above-described delay circuit.

駆動部47は、遅延部46の出力信号に基づいてnチャネル型電界効果トランジスタ42のオン・オフを制御するための駆動信号SGを発生させるものである。駆動部47は、遅延部46から出力される信号に応答して、nチャネル型電界効果トランジスタ42をオン状態にする信号レベルを有する駆動信号SGをnチャネル型電界効果トランジスタ42のゲートに出力する。   The drive unit 47 generates a drive signal SG for controlling on / off of the n-channel field effect transistor 42 based on the output signal of the delay unit 46. In response to the signal output from the delay unit 46, the drive unit 47 outputs a drive signal SG having a signal level for turning on the n-channel field effect transistor 42 to the gate of the n-channel field effect transistor 42. .

停電検出部50は、直流入力電圧Vinが第1規定値VT1を上回った状態で、直流入力電圧Vinを供給する給電側の直流電源Eの瞬時停電が発生した場合、この瞬時停電の時間が所定時間T1に達したときに、給電側の直流電源Eが停電したことを検出するものである。ここで、第1規定値VT1は、直流入力電圧Vinが昇圧コンバータ20から出力される直流電圧Vpに接近したことによる昇圧コンバータ20の不安定動作(例えば間欠動作)を防止するために予め設定された所定電圧を示す値である。第1規定値VT1は、例えば、昇圧コンバータ20から出力される直流電圧Vpの目標値(例えば380V)よりも一定値(例えば20V)だけ低い電圧値(例えば360V)に設定される。このような第1規定値VT1は、昇圧コンバータ20の動作が不安定にならない電圧範囲の上限値を示すものとして定義される。ただし、このような定義に限定されず、第1規定値VT1は、昇圧コンバータ20の動作が不安定になる電圧範囲の下限値を示すものとして定義してもよい。   The power failure detection unit 50 determines the time of the instantaneous power failure when the power source DC power source E that supplies the DC input voltage Vin occurs in a state where the DC input voltage Vin exceeds the first specified value VT1. When the time T1 is reached, it is detected that the power supply side DC power source E has failed. Here, the first specified value VT1 is set in advance in order to prevent unstable operation (for example, intermittent operation) of the boost converter 20 due to the DC input voltage Vin approaching the DC voltage Vp output from the boost converter 20. It is a value indicating the predetermined voltage. For example, the first specified value VT1 is set to a voltage value (eg, 360 V) that is lower than a target value (eg, 380 V) of the DC voltage Vp output from the boost converter 20 by a certain value (eg, 20 V). Such first specified value VT1 is defined as indicating the upper limit value of the voltage range in which the operation of boost converter 20 does not become unstable. However, the present invention is not limited to such a definition, and the first specified value VT1 may be defined as indicating a lower limit value of a voltage range in which the operation of the boost converter 20 becomes unstable.

上述の所定時間T1は、給電側の直流電源Eが瞬時停電から復旧した際に発生する突入電流Irushが許容範囲内の値となる瞬時停電時間の上限値を示す。瞬時停電時間が所定時間T1を超えた場合、許容範囲を超える突入電流Irushが発生することとなる。本実施形態では、突入電流Irushは、主として、入力コンデンサCinの充電電流によって形成される。停電検出部50は、瞬時停電が発生したかどうかについて、直流入力電圧Vinが第2規定値VT2を下回ったかどうかによって判定する。ここで、第2規定値VT2は、直流入力電圧Vinの通常的な電圧範囲(例えば192V〜410V)よりも低い任意の所定電圧に設定され、例えば100Vに設定される。   The predetermined time T1 indicates the upper limit value of the instantaneous power failure time at which the inrush current Irush generated when the DC power source E on the power supply side is recovered from the instantaneous power failure becomes a value within the allowable range. When the instantaneous power failure time exceeds the predetermined time T1, an inrush current Irush exceeding the allowable range is generated. In the present embodiment, the inrush current Irush is mainly formed by the charging current of the input capacitor Cin. The power failure detection unit 50 determines whether or not an instantaneous power failure has occurred depending on whether or not the DC input voltage Vin is lower than the second specified value VT2. Here, the second specified value VT2 is set to an arbitrary predetermined voltage lower than a normal voltage range (for example, 192V to 410V) of the DC input voltage Vin, and is set to 100V, for example.

本実施形態では、直流入力電圧Vinが第1規定値VT1で示される電圧値以上にある状態から低下し、直流入力電圧Vinが第2規定値で示される電圧値を下回った場合の瞬時停電を検出の対象としている。このことは、前述したように、本発明が、昇圧コンバータ20が停止状態にある場合に発生する瞬時停電による突入電流Irushを抑制することを目的としていることに対応している。   In the present embodiment, an instantaneous power failure occurs when the DC input voltage Vin drops from a state equal to or higher than the voltage value indicated by the first specified value VT1, and the DC input voltage Vin falls below the voltage value indicated by the second specified value. The target of detection. As described above, this corresponds to the fact that the present invention aims to suppress the inrush current Irush due to the instantaneous power failure that occurs when the boost converter 20 is in the stopped state.

停電検出部50の構成を詳細に説明すると、停電検出部50は、電圧検出部51、計時部52、信号発生部53から構成される。ここで、電圧検出部51は、直流入力電圧Vinが上記規定値VT1で示される電圧(360V)を上回った状態から第2規定値VT2で示される所定電圧(100V)以下に低下したことを検出するものである。計時部52は、直流入力電圧Vinが第2規定値VT2で示される所定電圧以下に低下したことを電圧検出部51が検出した場合に上記所定時間T1の計時を開始するものである。この計時部52は、上述の遅延部46と同様に、遅延部として構成してもよい。信号発生部53は、計時部52が所定時間T1の計時を終了したときに、所定時間T1の計時が終了した旨の信号SPを発生させるものである。本実施形態では、信号発生部53は、パルス幅Tspのワンショットパルスを信号SPとして発生させる。以下では、信号SPをワンショットパルス信号SPと称す。   The configuration of the power failure detection unit 50 will be described in detail. The power failure detection unit 50 includes a voltage detection unit 51, a timer unit 52, and a signal generation unit 53. Here, the voltage detection unit 51 detects that the DC input voltage Vin has dropped from a state where the DC input voltage Vin exceeds the voltage (360 V) indicated by the above-mentioned specified value VT1 to a predetermined voltage (100 V) indicated by the second specified value VT2. To do. The timer 52 starts counting the predetermined time T1 when the voltage detector 51 detects that the DC input voltage Vin has dropped below a predetermined voltage indicated by the second specified value VT2. The time measuring unit 52 may be configured as a delay unit, similar to the delay unit 46 described above. The signal generation unit 53 generates a signal SP indicating that the measurement of the predetermined time T1 has been completed when the time measurement unit 52 has completed the measurement of the predetermined time T1. In the present embodiment, the signal generator 53 generates a one-shot pulse having a pulse width Tsp as the signal SP. Hereinafter, the signal SP is referred to as a one-shot pulse signal SP.

初期化部60は、停電検出部50が給電側の直流電源Eの瞬時停電を検出した場合、突入電流抑制回路40の回路状態を初期化するものである。本実施形態では、初期化部60は、停電検出部50が給電側の瞬時停電を検出した場合、突入電流抑制回路40を構成するnチャネル型電界効果トランジスタ42がオフ状態となるように突入電流抑制回路40の回路状態を初期化する。初期化部60は、突入電流抑制回路40を構成する抵抗44に対して並列接続されたnチャネル型電界効果トランジスタ61から構成される。このnチャネル型電界効果トランジスタ61のドレインは、突入電流抑制回路40を構成する抵抗43と抵抗44との間の接続ノードN40に接続され、そのソースは、配線GLに接続されている。nチャネル型電界効果トランジスタ61のゲートには、上述の停電検出部50からワンショットパルス信号SPが供給される。このワンショットパルス信号SPに応答してnチャネル型電界効果トランジスタ61がオン状態になることによりコンパレータ45の回路状態が初期化される。   The initialization unit 60 initializes the circuit state of the inrush current suppression circuit 40 when the power failure detection unit 50 detects an instantaneous power failure of the DC power supply E on the power feeding side. In the present embodiment, when the power failure detection unit 50 detects an instantaneous power failure on the power feeding side, the initialization unit 60 causes the inrush current so that the n-channel field effect transistor 42 constituting the inrush current suppression circuit 40 is turned off. The circuit state of the suppression circuit 40 is initialized. The initialization unit 60 includes an n-channel field effect transistor 61 connected in parallel to the resistor 44 constituting the inrush current suppression circuit 40. The drain of the n-channel field effect transistor 61 is connected to a connection node N40 between the resistor 43 and the resistor 44 constituting the inrush current suppression circuit 40, and its source is connected to the wiring GL. The one-shot pulse signal SP is supplied from the power failure detection unit 50 to the gate of the n-channel field effect transistor 61. In response to the one-shot pulse signal SP, the n-channel field effect transistor 61 is turned on, so that the circuit state of the comparator 45 is initialized.

また、図1には示されていないが、初期化部60は、ワンショットパルス信号SPに応答して遅延部46および駆動部47の各回路状態を初期化するためのnチャネル型電界効果トランジスタを更に備えている。本実施形態では、適宜、nチャネル型電界効果トランジスタ61が、コンパレータ45、遅延部46、駆動部47の各回路状態を初期化するための複数のnチャネル型電界効果トランジスタを代表しているものとして説明する。   Although not shown in FIG. 1, the initialization unit 60 is an n-channel field effect transistor for initializing the circuit states of the delay unit 46 and the drive unit 47 in response to the one-shot pulse signal SP. Is further provided. In the present embodiment, the n-channel field effect transistor 61 appropriately represents a plurality of n-channel field effect transistors for initializing the circuit states of the comparator 45, the delay unit 46, and the drive unit 47. Will be described.

制御部70は、昇圧コンバータ20の昇圧動作(発振動作)を制御するためのものである。抵抗R1,R2は、昇圧コンバータ20が出力する直流電圧Vpの低下を検出するためのものであり、電源ラインDHと配線GLとの間に直列接続されている。制御部70は、抵抗R1,R2により検出された直流電圧Vpを一定に維持するようにフィードバック動作を実施する。また、制御部70は、上述の駆動信号SGにより電源の投入が示された場合、または、直流入力電圧Vinが昇圧コンバータ20から出力される直流電圧Vpに近づいた場合、昇圧コンバータ20の昇圧動作を停止させる。   The control unit 70 is for controlling the step-up operation (oscillation operation) of the step-up converter 20. The resistors R1 and R2 are for detecting a drop in the DC voltage Vp output from the boost converter 20, and are connected in series between the power supply line DH and the wiring GL. The control unit 70 performs a feedback operation so as to keep the DC voltage Vp detected by the resistors R1 and R2 constant. Further, when the power supply is indicated by the drive signal SG described above, or when the DC input voltage Vin approaches the DC voltage Vp output from the boost converter 20, the control unit 70 performs the boost operation of the boost converter 20. Stop.

昇圧コンバータ発振停止回路80は、直流入力電圧Vinが昇圧コンバータ20から出力される直流電圧Vpに近づいた場合、昇圧コンバータ20の昇圧動作の停止を指示する信号を制御部70に出力するものである。制御部70は、昇圧コンバータ発振停止回路80からの信号に基づいて、直流入力電圧Vinが直流電圧Vpに近づいた場合に昇圧コンバータ20の昇圧動作を停止させる。   The boost converter oscillation stop circuit 80 outputs a signal instructing to stop the boost operation of the boost converter 20 to the control unit 70 when the DC input voltage Vin approaches the DC voltage Vp output from the boost converter 20. . Based on the signal from boost converter oscillation stop circuit 80, control unit 70 stops the boost operation of boost converter 20 when DC input voltage Vin approaches DC voltage Vp.

抵抗R3,R4は、昇圧コンバータ20が出力する直流電圧Vpの上昇を検出するためのものであり、電源ラインDHと配線GLとの間に直列接続されている。入力電圧監視回路90は、電源投入時に、昇圧コンバータ20から出力される直流電圧Vpを抵抗R3,R4により分圧して得られる電圧V90に基づいて直流電圧Vpの電圧レベルを監視し、昇圧コンバータ20から出力される直流電圧Vpの電圧レベルが安定化した場合にDC/DC変換部30の電力変換動作を起動させるためのものである。本実施形態では、瞬時停電が発生した場合にも、停電検出部50から出力されるワンショットパルス信号SPに基づいて、昇圧コンバータ20から出力される直流電圧Vpの電圧レベルが安定化した場合にDC/DC変換部30の電力変換動作が起動される。
なお、上述した突入電流抑制回路40、停電検出部50、初期化部60、制御部70、昇圧コンバータ発振停止回路80、入力電圧監視回路90は、基本的には、グランドラインDLに繋がる配線GLの電位(例えばグランド電位)を基準とした所定の電源電圧で動作するように構成されている。
The resistors R3 and R4 are for detecting an increase in the DC voltage Vp output from the boost converter 20, and are connected in series between the power supply line DH and the wiring GL. The input voltage monitoring circuit 90 monitors the voltage level of the DC voltage Vp based on the voltage V90 obtained by dividing the DC voltage Vp output from the boost converter 20 by the resistors R3 and R4 when the power is turned on. This is for starting up the power conversion operation of the DC / DC converter 30 when the voltage level of the DC voltage Vp output from is stabilized. In the present embodiment, even when an instantaneous power failure occurs, when the voltage level of the DC voltage Vp output from the boost converter 20 is stabilized based on the one-shot pulse signal SP output from the power failure detection unit 50. The power conversion operation of the DC / DC conversion unit 30 is activated.
Note that the inrush current suppression circuit 40, the power failure detection unit 50, the initialization unit 60, the control unit 70, the boost converter oscillation stop circuit 80, and the input voltage monitoring circuit 90 described above basically include the wiring GL connected to the ground line DL. Is configured to operate with a predetermined power supply voltage with reference to the potential (eg, ground potential).

次に、本実施形態による電力変換装置1の動作について突入電流Irushに着目して説明する。
最初に、図3を参照して、電源投入時の動作を説明する。図3は、電力変換装置1の電源投入時の動作を説明するための図である。図3において、時刻t01以前の電源投入前の初期状態では、図1の電源ラインDHおよびグランドラインDLは共にグランドレベルにあり、入力コンデンサCinは放電された状態にある。
Next, the operation of the power conversion apparatus 1 according to the present embodiment will be described by focusing on the inrush current Irush.
First, the operation at the time of power-on will be described with reference to FIG. FIG. 3 is a diagram for explaining the operation of the power conversion apparatus 1 when the power is turned on. In FIG. 3, in an initial state before power-on before time t01, both the power line DH and the ground line DL in FIG. 1 are at the ground level, and the input capacitor Cin is in a discharged state.

電源投入前の初期状態では、突入電流抑制回路40を構成する抵抗43と抵抗44との間の接続ノードN40の電圧V40はローレベル(グランドレベル)となっており、これを入力するコンパレータ45の出力信号もローレベルになっている。また、コンパレータ45からローレベルが入力される遅延部46の出力信号もローレベルになっており、駆動部47から出力される駆動信号SGもローレベルになっている。このため、時刻t01以前の電源投入前の状態では、nチャネル型電界効果トランジスタ42はオフ状態になっている。   In the initial state before the power is turned on, the voltage V40 at the connection node N40 between the resistor 43 and the resistor 44 constituting the inrush current suppression circuit 40 is at a low level (ground level). The output signal is also low. Further, the output signal of the delay unit 46 to which the low level is input from the comparator 45 is also at the low level, and the drive signal SG output from the drive unit 47 is also at the low level. For this reason, the n-channel field effect transistor 42 is in an off state before the power is turned on before time t01.

このような初期状態から、時刻t01で電源スイッチSWが閉じられ、電源が投入されると、昇圧コンバータ20から出力される直流電圧Vpが直流入力電圧Vinに追従して上昇を開始する。これにより、入力コンデンサCinの充電が開始される。このときの入力コンデンサCinの充電電流により、入力端子TIHから入力コンデンサCinを介して第2入力端子TILに至る充電経路に突入電流Irushが発生する。   From such an initial state, when the power switch SW is closed at time t01 and the power is turned on, the DC voltage Vp output from the boost converter 20 starts to rise following the DC input voltage Vin. Thereby, charging of the input capacitor Cin is started. Due to the charging current of the input capacitor Cin at this time, an inrush current Irush is generated in the charging path from the input terminal TIH to the second input terminal TIL via the input capacitor Cin.

ここで、電源が投入されれば、突入電流抑制回路40内の接続ノードN40の電圧V40も上昇を開始し、電圧V40が参照電圧Vref以上になると、コンパレータ45はハイレベルの信号を出力する。しかし、遅延部46により、突入電流Irushが消失した状態になるまで、所定期間Tsにわたってコンパレータ45の信号が遅延され、駆動信号SGがローレベルに維持される。これにより、電源投入後も所定期間Tsだけnチャネル型電界効果トランジスタ42がオフ状態に維持される。このため、電源投入時に、突入電流Irushは、nチャネル型電界効果トランジスタ42には流れ込まず、抵抗41に流れ込み、この抵抗41により突入電流Irushのピーク値Ipeakが抑制される。   Here, when the power is turned on, the voltage V40 of the connection node N40 in the inrush current suppression circuit 40 also starts to rise. When the voltage V40 becomes equal to or higher than the reference voltage Vref, the comparator 45 outputs a high level signal. However, the delay unit 46 delays the signal of the comparator 45 for a predetermined period Ts until the inrush current Irush disappears, and the drive signal SG is maintained at a low level. As a result, the n-channel field effect transistor 42 is maintained in the OFF state for a predetermined period Ts even after the power is turned on. For this reason, when the power is turned on, the inrush current Irush does not flow into the n-channel field effect transistor 42, but flows into the resistor 41, and the resistor 41 suppresses the peak value Ipeak of the inrush current Irush.

この後、所定期間Tsが経過した時刻t02で、遅延部46から出力される信号レベルがハイレベルに遷移し、これを受けて駆動部47が駆動信号SGとしてハイレベルを出力する。この駆動信号SGによりnチャネル型電界効果トランジスタ42がオン状態になる。これにより、グランドラインDL上に抵抗41が顕在化しなくなるため、この後の電力変換動作において、抵抗41による電力損失が防止される。   Thereafter, at time t02 when the predetermined period Ts has elapsed, the signal level output from the delay unit 46 transitions to a high level, and in response thereto, the drive unit 47 outputs a high level as the drive signal SG. The n-channel field effect transistor 42 is turned on by the drive signal SG. As a result, the resistor 41 does not appear on the ground line DL, so that power loss due to the resistor 41 is prevented in the subsequent power conversion operation.

また、駆動信号SGを受けて、制御部70が昇圧コンバータ20の昇圧動作を起動させる。この結果、昇圧コンバータ20から出力される直流電圧Vpが上昇する。ここで、時刻t02でnチャネル型電界効果トランジスタ42がオン状態になると、グランドラインDLのインピーダンスが低下するので、電力変換装置1に流れ込む入力電流Iinは瞬時的に上昇する。しかし、そのピーク値は突入電流ほどではないため、突入電流のような障害を引き起こすことはない。その後、昇圧コンバータ20の動作が安定して直流電圧Vpが目標値(380V)に安定すると、時刻t03で、入力電圧監視回路90からの信号に基づいてDC/DC変換部30が電力変換動作を開始して所望の出力電圧Voutを発生させる。   In response to the drive signal SG, the control unit 70 activates the boost operation of the boost converter 20. As a result, DC voltage Vp output from boost converter 20 increases. Here, when the n-channel field effect transistor 42 is turned on at time t02, the impedance of the ground line DL decreases, so the input current Iin flowing into the power conversion device 1 increases instantaneously. However, since the peak value is not as high as the inrush current, it does not cause a trouble like the inrush current. Thereafter, when the operation of boost converter 20 is stabilized and DC voltage Vp is stabilized at the target value (380 V), DC / DC conversion unit 30 performs power conversion operation based on the signal from input voltage monitoring circuit 90 at time t03. Starting, a desired output voltage Vout is generated.

次に、図4から図6を参照して、瞬時停電時の動作を説明する。
<瞬時停電時間が短い場合>
図4は、電力変換装置1の瞬時停電時の全体動作を説明するための図であり、瞬時停電時間Tdipが短い場合の説明図である。図4に示す時刻t1で瞬時停電が発生すると、直流入力電圧Vinの低下に伴って、昇圧コンバータ20から出力される直流電圧Vpも徐々に低下する。この例では、給電側が瞬時停電から復旧する時刻t2で、昇圧コンバータ20から出力される直流電圧Vpは電圧ΔV1だけ低下した状態となっている。
Next, with reference to FIG. 4 to FIG.
<When the instantaneous power failure time is short>
FIG. 4 is a diagram for explaining the overall operation of the power conversion device 1 during an instantaneous power failure, and is an explanatory diagram when the instantaneous power failure time Tdip is short. When an instantaneous power failure occurs at time t1 shown in FIG. 4, the DC voltage Vp output from the boost converter 20 gradually decreases as the DC input voltage Vin decreases. In this example, the DC voltage Vp output from the boost converter 20 is reduced by the voltage ΔV1 at time t2 when the power supply side recovers from the instantaneous power failure.

このように時停電の期間Tdipが所定時間T1よりも短い場合には、停電検出部50を構成する計時部52は所定時間T1の計時を終了しないので、停電検出部50はワンショットパルス信号SPを出力しない。このため、初期化部60を構成するnチャネル型電界効果トランジスタ61はオフ状態に維持され、初期化部60は、突入電流抑制回路40の回路状態を初期化しない。従って、nチャネル型電界効果トランジスタ42は瞬時停電の期間中、オン状態に維持される。   In this way, when the period Tdip of the power failure is shorter than the predetermined time T1, the time measuring unit 52 constituting the power failure detection unit 50 does not end the time measurement of the predetermined time T1, so the power failure detection unit 50 detects the one-shot pulse signal SP. Is not output. For this reason, the n-channel field effect transistor 61 constituting the initialization unit 60 is maintained in the off state, and the initialization unit 60 does not initialize the circuit state of the inrush current suppression circuit 40. Therefore, the n-channel field effect transistor 42 is kept on during the momentary power failure.

時刻t2で給電側が復旧すると、このときの直流入力電圧Vinの上昇に伴って、昇圧コンバータ20から出力される直流電圧Vpも目標値(380V)に復帰する。このとき、電圧ΔV1に応じて入力コンデンサCinの充電電流が発生し、この充電電流が突入電流Irushとなる。ただし、この場合、電圧ΔV1は小さいため、突入電流Irushのピーク値Ipは許容範囲内となり、例えば10A程度である。
このように、時停電時間Tdipが所定時間T1よりも短い場合、瞬時停電の影響が顕在化することなく、電力変換装置1は通常の動作を継続する。
When the power supply side is restored at time t2, the DC voltage Vp output from the boost converter 20 returns to the target value (380 V) as the DC input voltage Vin increases at this time. At this time, a charging current of the input capacitor Cin is generated according to the voltage ΔV1, and this charging current becomes an inrush current Irush. However, in this case, since the voltage ΔV1 is small, the peak value Ip of the inrush current Irush is within an allowable range, for example, about 10A.
Thus, when the hourly power failure time Tdip is shorter than the predetermined time T1, the power conversion device 1 continues normal operation without the influence of the instantaneous power failure becoming obvious.

<瞬時停電時間が長い場合>
次に、瞬時停電時間Tdipが所定時間T1よりも長い場合の動作を説明する。
図5は、電力変換装置1の瞬時停電時の全体動作を説明するための図であり、瞬時停電の期間Tdipが長い場合の説明図である。図5に示す時刻t1で瞬時停電が発生すると、直流入力電圧Vinの低下に伴って、昇圧コンバータ20から出力される直流電圧Vpも徐々に低下する。時刻t3で瞬時停電時間Tdipが所定時間T1に達すると、停電検出部50は、ワンショットパルス信号SPを発生させる。これを受けて初期化部60は突入電流抑制回路40を初期化する。これにより、突入電流抑制回路40を構成するnチャネル型電界効果トランジスタ42が時刻t3で強制的にオフ状態に制御され、グランドラインDL上に抵抗41が顕在化する。その詳細については後述する。
<If the instantaneous power outage time is long>
Next, the operation when the instantaneous power failure time Tdip is longer than the predetermined time T1 will be described.
FIG. 5 is a diagram for explaining the overall operation of the power conversion device 1 during an instantaneous power failure, and is an explanatory diagram when the instantaneous power failure period Tdip is long. When an instantaneous power failure occurs at time t1 shown in FIG. 5, the DC voltage Vp output from the boost converter 20 gradually decreases as the DC input voltage Vin decreases. When the instantaneous power failure time Tdip reaches a predetermined time T1 at time t3, the power failure detection unit 50 generates a one-shot pulse signal SP. In response to this, the initialization unit 60 initializes the inrush current suppression circuit 40. As a result, the n-channel field effect transistor 42 constituting the inrush current suppression circuit 40 is forcibly controlled to be turned off at time t3, and the resistor 41 becomes apparent on the ground line DL. Details thereof will be described later.

この後、時刻t4で給電側が瞬時停電から復旧する。時刻t4では、昇圧コンバータ20から出力されていた直流電圧Vpは目標値(例えば380V)から電圧ΔV2だけ低下した状態にある。この電圧ΔV2は、瞬時停電時間Tdipが長い分だけ、上述の電圧ΔV1よりも大きくなる。このため、仮に突入電流抑制回路40のnチャネル型電界効果トランジスタ42がオン状態に維持された状態で給電側が復旧すれば、電圧ΔV2に応じた入力コンデンサCinの充電電流が発生し、これが過大な突入電流Irushとなる。しかしながら、本実施形態によれば、次に詳細に説明するように、瞬時停電時間Tdipが所定時間T1を超えると、突入電流抑制回路40の回路状態が初期化される。これにより、突入電流抑制回路40を構成するnチャネル型電界効果トランジスタ42が強制的にオフ状態に制御され、グランドラインDL上に抵抗41が顕在化する。このため、時刻t4で給電側が復旧した際に発生する突入電流Irushが抵抗41により例えば10A程度に抑制される。   Thereafter, the power supply side recovers from the instantaneous power failure at time t4. At time t4, the DC voltage Vp output from the boost converter 20 is in a state of being lowered by a voltage ΔV2 from a target value (for example, 380 V). This voltage ΔV2 becomes larger than the above-described voltage ΔV1 by the amount of the instantaneous power failure time Tdip. For this reason, if the power supply side is restored while the n-channel field effect transistor 42 of the inrush current suppression circuit 40 is kept on, a charging current of the input capacitor Cin corresponding to the voltage ΔV2 is generated, which is excessive. The inrush current Irush is obtained. However, according to the present embodiment, as will be described in detail below, when the instantaneous power failure time Tdip exceeds a predetermined time T1, the circuit state of the inrush current suppression circuit 40 is initialized. As a result, the n-channel field effect transistor 42 constituting the inrush current suppression circuit 40 is forcibly controlled to be turned off, and the resistor 41 becomes apparent on the ground line DL. For this reason, the inrush current Irush generated when the power supply side is restored at time t4 is suppressed to about 10 A by the resistor 41, for example.

図6を参照して、瞬時停電時間Tdipが所定時間T1を超えた場合の電力変換装置1の詳細動作を説明する。
図6は、電力変換装置1の瞬時停電時の詳細動作を説明するための図であり、瞬時停電時間Tdipが所定時間T1を超えた場合の動作を説明するための図である。
前述したように、電源投入後、電力変換装置1が通常の電力変換動作を実施し、直流入力電圧Vinが規定値VT1で示される電圧値(例えば360V)よりも高い状態にあるときに、時刻t1で瞬時停電が発生すると、直流入力電圧Vinが低下を開始する。
With reference to FIG. 6, the detailed operation of the power converter 1 when the instantaneous power failure time Tdip exceeds the predetermined time T1 will be described.
FIG. 6 is a diagram for explaining the detailed operation at the time of the instantaneous power failure of the power conversion device 1, and is a diagram for explaining the operation when the instantaneous power failure time Tdip exceeds the predetermined time T1.
As described above, after the power is turned on, the power converter 1 performs a normal power conversion operation, and the time when the DC input voltage Vin is in a state higher than the voltage value (eg, 360 V) indicated by the specified value VT1. When an instantaneous power failure occurs at t1, the DC input voltage Vin starts to decrease.

そして、時刻t1aで直流入力電圧Vinが第2規定値VT2で示される所定電圧(例えば100V)以下に低下すると、停電検出部50の電圧検出部51は、その旨の信号を計時部52に出力する。計時部52は、停電検出部50からの信号を受けて所定時間T1の計時を開始する。時刻t3で瞬時停電時間Tdipが所定時間T1に到達すると、計時部52が所定時間T1の計時を終了し、その旨の信号を信号発生部53に出力する。信号発生部53は、時刻t3で計時部52からの信号を受けてワンショットパルス信号SPを発生させる。これにより、停電検出部50は、瞬時停電を検出したことを初期化部60に示す。   When the DC input voltage Vin falls below a predetermined voltage (for example, 100 V) indicated by the second specified value VT2 at time t1a, the voltage detection unit 51 of the power failure detection unit 50 outputs a signal to that effect to the time measurement unit 52. To do. The time measuring unit 52 receives the signal from the power failure detection unit 50 and starts measuring the predetermined time T1. When the instantaneous power failure time Tdip reaches the predetermined time T1 at time t3, the time measuring unit 52 finishes measuring the predetermined time T1, and outputs a signal to that effect to the signal generating unit 53. The signal generator 53 receives the signal from the timer 52 at time t3 and generates a one-shot pulse signal SP. Thereby, the power failure detection unit 50 indicates to the initialization unit 60 that an instantaneous power failure has been detected.

初期化部60は、時刻t3で停電検出部50から出力されたワンショットパルス信号SPに基づいて突入電流抑制回路40の回路状態を初期化する。具体的には、初期化部60を構成するnチャネル型電界効果トランジスタ61がワンショットパルス信号SPにより、そのパルス幅に相当する時間Tspだけオン状態となる。nチャネル型電界効果トランジスタ61がオン状態になると、抵抗43と抵抗44との間の接続ノードN40の電圧V40がグランドレベル(0V)に引き落とされる。電圧V40がグランドレベルになると、これが入力されるコンパレータ45が即座に初期化され、コンパレータ45の出力信号がローレベルになる。また、初期化部60は、コンパレータ45と共に、遅延部46および駆動部47の各回路状態も初期化する。   The initialization unit 60 initializes the circuit state of the inrush current suppression circuit 40 based on the one-shot pulse signal SP output from the power failure detection unit 50 at time t3. Specifically, the n-channel field effect transistor 61 constituting the initialization unit 60 is turned on by a one-shot pulse signal SP for a time Tsp corresponding to the pulse width. When the n-channel field effect transistor 61 is turned on, the voltage V40 at the connection node N40 between the resistor 43 and the resistor 44 is pulled down to the ground level (0 V). When the voltage V40 becomes the ground level, the comparator 45 to which the voltage V40 is input is immediately initialized, and the output signal of the comparator 45 becomes the low level. The initialization unit 60 also initializes the circuit states of the delay unit 46 and the drive unit 47 together with the comparator 45.

初期化部60によりコンパレータ45、遅延部46、駆動部47の各回路状態が初期化されると、駆動部47からnチャネル型電界効果トランジスタ42のゲートに供給される駆動信号SGがローレベルになる。駆動信号SGがローレベルになると、nチャネル型電界効果トランジスタ42がオフ状態になり、突入電流Irushの経路となるグランドラインDL上に抵抗41が顕在化する。これにより、突入電流抑制回路40が初期化された状態となる。初期化された突入電流抑制回路40の回路状態は、電源投入前の回路状態に対応する。   When the circuit states of the comparator 45, the delay unit 46, and the drive unit 47 are initialized by the initialization unit 60, the drive signal SG supplied from the drive unit 47 to the gate of the n-channel field effect transistor 42 becomes low level. Become. When the drive signal SG becomes a low level, the n-channel field effect transistor 42 is turned off, and the resistor 41 becomes apparent on the ground line DL serving as a path for the inrush current Irush. As a result, the inrush current suppression circuit 40 is initialized. The initialized circuit state of the inrush current suppression circuit 40 corresponds to the circuit state before the power is turned on.

続いて、時刻t3aでワンショットパルス信号SPがハイレベルからローレベルに遷移すると、接続ノードN40の電圧V40は、抵抗43,44により直流入力電圧Vinを分圧して得られる電圧を示すようになる。ただし、時刻t3aでは、給電側が瞬時停電から復旧していないので、直流入力電圧Vinは低下した状態にあり、電圧V40は参照電圧Vrefを下回ったレベルのままである。この後、時刻t4で給電側が瞬時停電から復旧すると、直流入力電圧Vinが上昇を開始する。   Subsequently, when the one-shot pulse signal SP transitions from the high level to the low level at time t3a, the voltage V40 of the connection node N40 indicates a voltage obtained by dividing the DC input voltage Vin by the resistors 43 and 44. . However, at time t3a, since the power supply side has not recovered from the instantaneous power failure, the DC input voltage Vin is in a lowered state, and the voltage V40 remains at a level below the reference voltage Vref. Thereafter, when the power supply side recovers from the instantaneous power failure at time t4, the DC input voltage Vin starts to rise.

時刻t4で直流入力電圧Vinが上昇すると、電源投入時と同様に突入電流抑制回路40が機能する。即ち、直流入力電圧Vinの上昇に伴って電圧V40が参照電圧Vrefを超えると、コンパレータ45の出力信号がハイレベルに遷移する。コンパレータ45の出力信号がハイレベルに遷移してから所定時間Tsだけ遅れて、時刻t5で遅延部46の出力信号がハイレベルに遷移し、駆動部46がハイレベルの駆動信号SGを出力する。駆動信号SGがハイレベルになると、突入電流抑制回路40のnチャネル型電界効果トランジスタ42がオフ状態からオン状態に復帰する。   When the DC input voltage Vin rises at time t4, the inrush current suppression circuit 40 functions in the same manner as when the power is turned on. That is, when the voltage V40 exceeds the reference voltage Vref as the DC input voltage Vin increases, the output signal of the comparator 45 transitions to a high level. The output signal of the delay unit 46 transitions to the high level at time t5 after a predetermined time Ts has elapsed after the output signal of the comparator 45 transitions to the high level, and the drive unit 46 outputs the high level drive signal SG. When the drive signal SG becomes high level, the n-channel field effect transistor 42 of the inrush current suppression circuit 40 returns from the off state to the on state.

ここで、給電側が瞬時停電から復旧する時刻t4から所定時間Tsが経過する時刻t5までの期間、nチャネル型電界効果トランジスタ42はオフ状態に維持される。このため、時刻t4で給電側が瞬時停電から復旧した際に発生する突入電流Irushは、nチャネル型電界効果トランジスタ42には流れ込まず、抵抗41に流れ込む。これにより、突入電流Irushは抵抗41により許容範囲内の例えば10A程度に抑制される。
このように、本実施形態によれば、瞬時停電が発生した場合、突入電流抑制回路40が電源投入前の状態に初期化されるため、給電側が瞬時停電から復旧した場合、突入電流抑制回路40は、電源投入時と同様に動作して突入電流Irushを抑制する。
Here, the n-channel field effect transistor 42 is maintained in the OFF state during a period from time t4 when the power supply side recovers from the instantaneous power failure to time t5 when the predetermined time Ts elapses. For this reason, the inrush current Irush generated when the power supply side recovers from the instantaneous power failure at time t4 does not flow into the n-channel field effect transistor 42 but flows into the resistor 41. Thereby, the inrush current Irush is suppressed by the resistor 41 to, for example, about 10 A within the allowable range.
Thus, according to the present embodiment, when an instantaneous power failure occurs, the inrush current suppression circuit 40 is initialized to the state before the power is turned on. Therefore, when the power supply side is recovered from the instantaneous power failure, the inrush current suppression circuit 40 is restored. Operates in the same manner as when the power is turned on to suppress the inrush current Irush.

次に、参考までに、図7を参照して、本実施形態の主要な特徴部である上述の停電検出部50および初期化部60を備えない場合の従来装置に相当する動作を補足説明する。
図7は、電力変換装置1の動作を補足説明するための図であり、本実施形態による図1の構成において停電検出部50および初期化部60を備えない場合の動作を説明するための図である。
Next, for reference, with reference to FIG. 7, the operation corresponding to the conventional apparatus when the power failure detection unit 50 and the initialization unit 60, which are the main features of the present embodiment, are not provided, will be supplementarily described. .
FIG. 7 is a diagram for supplementarily explaining the operation of the power converter 1, and is a diagram for explaining the operation when the power failure detection unit 50 and the initialization unit 60 are not provided in the configuration of FIG. 1 according to the present embodiment. It is.

停電検出部50および初期化部60を備えない場合、上述のワンショットパルス信号SPは発生されず、初期化部60により突入電流抑制回路40の回路状態が初期化されることもなくなる。従ってこの場合、瞬時停電期間中も駆動信号SGがハイレベルに維持され、給電側が瞬時停電から復旧する時刻t4でnチャネル型電界効果トランジスタ42がオン状態となっている。このため、給電側が復旧する際に入力コンデンサCinの充電電流によって形成される突入電流Irushはnチャネル型電界効果トランジスタ42を流れ、抵抗41により抑制されない。図7の例では、給電側が瞬時停電から復旧する時刻t4で直流電圧Vpが電圧ΔV3だけ低下しているが、瞬時停電時間Tdipが上述の図4の例よりもながく、例えば上述の図5の例と同じであれば、電圧ΔV3は図4の例における電圧ΔV1よりも大きくなり、図5の例における電圧ΔV2と等しくなる。従って、時刻t4で例えば35Aもの過大な突入電流Irushが発生することになる。しかしながら、本実施形態によれば、上述したように、突入電流Irushが発生する時刻t4を含む時刻t3から時刻t5までの期間、突入電流抑制回路40を構成するnチャネル型電界効果トランジスタ42がオフ状態に維持されるので、入力コンデンサCinの充電経路上に抵抗41が顕在化し、突入電流Irushが抵抗41により抑制される。   When the power failure detection unit 50 and the initialization unit 60 are not provided, the above-described one-shot pulse signal SP is not generated, and the initialization unit 60 does not initialize the circuit state of the inrush current suppression circuit 40. Therefore, in this case, the drive signal SG is maintained at a high level even during the momentary power failure, and the n-channel field effect transistor 42 is turned on at time t4 when the power supply side recovers from the momentary power failure. For this reason, the inrush current Irush formed by the charging current of the input capacitor Cin when the power supply side is restored flows through the n-channel field effect transistor 42 and is not suppressed by the resistor 41. In the example of FIG. 7, the DC voltage Vp is reduced by the voltage ΔV3 at the time t4 when the power supply side recovers from the instantaneous power failure. If it is the same as the example, the voltage ΔV3 is larger than the voltage ΔV1 in the example of FIG. 4 and is equal to the voltage ΔV2 in the example of FIG. Accordingly, an excessive inrush current Irush of 35 A, for example, is generated at time t4. However, according to the present embodiment, as described above, the n-channel field effect transistor 42 constituting the inrush current suppression circuit 40 is turned off during a period from time t3 to time t5 including time t4 when the inrush current Irush occurs. Since the state is maintained, the resistor 41 becomes apparent on the charging path of the input capacitor Cin, and the inrush current Irush is suppressed by the resistor 41.

なお、時刻t5で電界効果トランジスタ42がオン状態になると、抵抗41の端子間がnチャネル型電界効果トランジスタ42により短絡されるため、この抵抗41がグランドラインDL上に顕在化しなくなる。このため、時刻t5以降においてDC/DC変換部30がスイッチング動作を開始し、電力変換動作に伴う通常の動作電流がグランドラインDLに流れても、抵抗41による電力損失は発生しない。   When the field effect transistor 42 is turned on at time t5, the terminals of the resistor 41 are short-circuited by the n-channel field effect transistor 42, so that the resistor 41 does not appear on the ground line DL. For this reason, even if the DC / DC conversion unit 30 starts the switching operation after time t5 and a normal operation current accompanying the power conversion operation flows through the ground line DL, no power loss due to the resistor 41 occurs.

上述した第1実施形態によれば、直流入力電圧Vinが第1規定値VT1で示される電圧値を上回った状態で瞬時停電が発生した場合に突入電流抑制回路40が初期化され、入力コンデンサCinの充電経路上に抵抗41が顕在化する。これにより、昇圧コンバータ20が停止した状態で発生する突入電流Irushを抑制することができる。従って、入力電流を過剰に制限することなく、突入電流Irushを有効に抑制することができ、突入電流Irushを抑制する際に電力変換装置1の電力変換動作に与える影響を最小限に留めることができる。   According to the first embodiment described above, the inrush current suppression circuit 40 is initialized when the instantaneous power failure occurs when the DC input voltage Vin exceeds the voltage value indicated by the first specified value VT1, and the input capacitor Cin The resistor 41 becomes apparent on the charging path. Thereby, inrush current Irush generated when boost converter 20 is stopped can be suppressed. Therefore, the inrush current Irush can be effectively suppressed without excessively limiting the input current, and the influence on the power conversion operation of the power conversion device 1 can be minimized when the inrush current Irush is suppressed. it can.

(第2実施形態)
次に、本発明の第2実施形態を説明する。上述した第1実施形態では、直流電源Eから直流入力電圧Vinが電力変換装置1に入力されるものとしたが、本実施形態では、電力変換装置1は、商用電源から供給される交流電力を上記の直流入力電圧Vinに整流するための整流部(不図示)を更に備える。即ち、本実施形態では、直流入力電圧Vinは、商用電源から供給される電力を整流して得られた電圧である。その他の構成および動作は、第1実施形態と同様である。
(Second Embodiment)
Next, a second embodiment of the present invention will be described. In the first embodiment described above, the DC input voltage Vin is input to the power conversion device 1 from the DC power source E. However, in this embodiment, the power conversion device 1 uses AC power supplied from a commercial power source. A rectifier (not shown) for rectifying the DC input voltage Vin is further provided. That is, in this embodiment, the DC input voltage Vin is a voltage obtained by rectifying the power supplied from the commercial power source. Other configurations and operations are the same as those in the first embodiment.

上述した本発明の第1および第2実施形態では、本発明を電力変換装置として表現したが、本発明は、突入電流抑制方法として表現することもできる。この場合、本発明による突入電流抑制方法は、直流入力電圧を所定電圧に昇圧するための昇圧コンバータと、前記昇圧コンバータを通して流れる突入電流を抑制するための突入電流抑制回路とを備え、前記昇圧コンバータから出力される電圧を電力変換するように構成された電力変換装置において、前記突入電流を抑制する突入電流抑制方法であって、前記直流入力電圧が規定値を上回った状態で、前記直流入力電圧を供給する給電側の停電が発生した場合、前記停電の時間が所定時間に達したときに、前記給電側が停電したことを検出する段階(停電検出部50の機能に相当する段階)と、前記給電側の停電が検出された場合、前記突入電流抑制回路の回路状態を初期化する段階(初期化部60の機能に相当する段階)と、を含む突入電流抑制方法として表現することができる。   In the first and second embodiments of the present invention described above, the present invention is expressed as a power converter, but the present invention can also be expressed as an inrush current suppressing method. In this case, the inrush current suppression method according to the present invention includes a boost converter for boosting a DC input voltage to a predetermined voltage, and an inrush current suppression circuit for suppressing an inrush current flowing through the boost converter, and the boost converter In the power conversion device configured to convert the voltage output from the power, the inrush current suppressing method for suppressing the inrush current, wherein the DC input voltage exceeds a specified value, the DC input voltage When a power failure occurs on the power supply side that supplies power, when the time of the power failure reaches a predetermined time, a step of detecting that the power supply side has a power failure (a step corresponding to the function of the power failure detection unit 50), and An inrush current including a step of initializing a circuit state of the inrush current suppression circuit (a step corresponding to the function of the initialization unit 60) when a power failure on the power supply side is detected It can be expressed as a control method.

以上、本発明の実施形態を説明したが、本発明は上述の実施形態に限定されるものではなく、本発明の要旨を逸脱しない範囲で種々の変形が可能である。
例えば、上述の実施形態では、電源検出部50において、電源ラインDH上の直流入力電圧Vinが第1規定値VT1で示される電圧値(例えば360V)を上回った状態(昇圧コンバータ20の昇圧動作が停止している状態)にあるかどうかを検出する必要があるが、昇圧コンバータ20の昇圧動作を制御する制御部70から昇圧コンバータ20に出力される制御信号SDを利用して、直流入力電圧Vinが第1規定値VT1を上回った状態にあるかどうかを判定してもよい。この場合、制御信号SDとして、クロック信号ではなく、一定の信号レベルが継続して出力されていれば、直流入力電圧Vinが第1規定値VT1を上回った状態、即ち昇圧コンバータ20の昇圧動作が停止している状態にある。
Although the embodiments of the present invention have been described above, the present invention is not limited to the above-described embodiments, and various modifications can be made without departing from the scope of the present invention.
For example, in the above-described embodiment, in the power supply detection unit 50, the DC input voltage Vin on the power supply line DH exceeds the voltage value (eg, 360V) indicated by the first specified value VT1 (the boost operation of the boost converter 20 is It is necessary to detect whether or not it is in a stopped state, but the DC input voltage Vin is used by using the control signal SD output from the control unit 70 that controls the boost operation of the boost converter 20 to the boost converter 20. It may be determined whether or not the value exceeds the first specified value VT1. In this case, if a constant signal level is continuously output as the control signal SD instead of the clock signal, the DC input voltage Vin exceeds the first specified value VT1, that is, the boost operation of the boost converter 20 is performed. It is in a stopped state.

1…電力変換装置
10…フィルタ
20…昇圧コンバータ
30…DC/DC変換部
40…突入電流抑制回路
41…抵抗
42…nチャネル型電界効果トランジスタ
43,44…抵抗
45…コンパレータ
46…遅延部
47…駆動部
50…停電検出部
51…電圧検出部
52…計時部
53…信号発生部
60…初期化部
61…nチャネル型電界効果トランジスタ
70…制御部
80…昇圧コンバータ発振停止回路
90…入力電圧監視回路
DH…電源ライン
DL…グランドライン
F1,F2…ヒューズ
GL…配線
R1,R2,R3,R4…抵抗
SW…電源スイッチ
TIH,TIL…入力端子
TOH,TOL…出力端子
DESCRIPTION OF SYMBOLS 1 ... Power converter 10 ... Filter 20 ... Boost converter 30 ... DC / DC conversion part 40 ... Inrush current suppression circuit 41 ... Resistance 42 ... N channel type field effect transistor 43, 44 ... Resistance 45 ... Comparator 46 ... Delay part 47 ... Drive unit 50 ... power failure detection unit 51 ... voltage detection unit 52 ... timer unit 53 ... signal generation unit 60 ... initialization unit 61 ... n-channel field effect transistor 70 ... control unit 80 ... boost converter oscillation stop circuit 90 ... input voltage monitoring Circuit DH ... Power line DL ... Ground line F1, F2 ... Fuse GL ... Wiring R1, R2, R3, R4 ... Resistance SW ... Power switch TIH, TIL ... Input terminal TOH, TOL ... Output terminal

Claims (6)

直流入力電圧を所定電圧に昇圧するための昇圧コンバータと、前記昇圧コンバータを通して流れる突入電流を抑制するための突入電流抑制回路とを備え、前記昇圧コンバータから出力される電圧を電力変換するように構成された電力変換装置であって、
前記直流入力電圧が規定値を上回った状態で、前記直流入力電圧を供給する給電側の停電が発生した場合、前記停電の時間が所定時間に達したときに、前記給電側が停電したことを検出する停電検出部と、
前記停電検出部が前記給電側の停電を検出した場合、前記突入電流抑制回路の回路状態を初期化する初期化部と、
を備えた電力変換装置。
A boost converter for boosting a DC input voltage to a predetermined voltage, and an inrush current suppression circuit for suppressing an inrush current flowing through the boost converter, and configured to convert power output from the boost converter A power conversion device,
When a power failure occurs on the power supply side that supplies the DC input voltage with the DC input voltage exceeding a specified value, it is detected that the power supply side has failed when the power failure time reaches a predetermined time. A power failure detection unit
When the power failure detection unit detects a power failure on the power supply side, an initialization unit that initializes the circuit state of the inrush current suppression circuit;
The power converter provided with.
前記規定値は、前記直流入力電圧が昇圧コンバータから出力される直流電圧に接近したことによる前記昇圧コンバータの不安定動作を防止するために予め設定された所定電圧を示す値である、請求項1に記載の電力変換装置。   The predetermined value is a value indicating a predetermined voltage set in advance to prevent unstable operation of the boost converter due to the DC input voltage approaching a DC voltage output from the boost converter. The power converter device described in 1. 前記停電検出部は、
前記直流入力電圧が前記規定値を上回った状態から所定電圧以下に低下したことを検出する電圧検出部と、
前記直流入力電圧が前記所定電圧以下に低下したことを前記電圧検出部が検出した場合に前記所定時間の計時を開始する計時部と、
前記計時部が前記所定時間の計時を終了したときに、前記計時が終了した旨の信号を発生させる信号発生部と、
を備えた、請求項1または2に記載の電力変換装置。
The power failure detection unit is
A voltage detector for detecting that the DC input voltage has dropped below a predetermined voltage from a state in which the DC input voltage has exceeded the specified value;
A timing unit that starts counting the predetermined time when the voltage detection unit detects that the DC input voltage has decreased below the predetermined voltage;
A signal generator for generating a signal indicating that the time measurement has been completed when the time measurement unit has finished measuring the predetermined time; and
The power conversion device according to claim 1, comprising:
前記突入電流抑制回路は、
前記給電側が停電から復旧したときに発生する突入電流の経路上に介挿された抵抗と、前記抵抗に対して並列接続されたスイッチ素子とを備えて構成され、
前記初期化部は、
前記停電検出部が前記給電側の停電を検出した場合、前記スイッチ素子がオフ状態となるように前記突入電流抑制回路の回路状態を初期化する、請求項1から3の何れか1項に記載の電力変換装置。
The inrush current suppression circuit is
A resistor inserted on the path of the inrush current that occurs when the power supply side recovers from a power failure, and a switch element connected in parallel to the resistor,
The initialization unit includes:
The said power failure detection part initializes the circuit state of the said inrush current suppression circuit so that the said switch element may be in an OFF state, when detecting the power failure at the said electric power feeding side. Power converter.
前記直流入力電圧は、商用電源から供給される電力を整流して得られた電圧である、請求項1から4の何れか1項に記載の電力変換装置。   5. The power conversion device according to claim 1, wherein the DC input voltage is a voltage obtained by rectifying electric power supplied from a commercial power source. 6. 直流入力電圧を所定電圧に昇圧するための昇圧コンバータと、前記昇圧コンバータを通して流れる突入電流を抑制するための突入電流抑制回路とを備え、前記昇圧コンバータから出力される電圧を電力変換するように構成された電力変換装置において、前記突入電流を抑制する突入電流抑制方法であって、
前記直流入力電圧が規定値を上回った状態で、前記直流入力電圧を供給する給電側の停電が発生した場合、前記停電の時間が所定時間に達したときに、前記給電側が停電したことを検出する段階と、
前記給電側の停電が検出された場合、前記突入電流抑制回路の回路状態を初期化する段階と、
を含む突入電流抑制方法。
A boost converter for boosting a DC input voltage to a predetermined voltage, and an inrush current suppression circuit for suppressing an inrush current flowing through the boost converter, and configured to convert power output from the boost converter In the power conversion device, the inrush current suppression method for suppressing the inrush current,
When a power failure occurs on the power supply side that supplies the DC input voltage with the DC input voltage exceeding a specified value, it is detected that the power supply side has failed when the power failure time reaches a predetermined time. And the stage of
When a power failure on the power feeding side is detected, initializing the circuit state of the inrush current suppression circuit;
Inrush current suppression method including:
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