JP2014161099A5 - - Google Patents

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図１から明らかなとおり、このデジタルＰＷＭ制御装置は、デューティ比演算部がデューティ比の演算に要する時間Ｔｓ１と、パルス出力部が出力することのできる最大デューティ比のパルス長に相当する時間Ｔｓ２の合計が、基本クロックの周期Ｔ０よりも長い。この関係は、デューティ比演算部がパルス出力部と並列に動作できることによって達成される。また、図１から明らかなとおり、デューティ比演算の周期とパルス出力の周期はともに基本クロックの周期Ｔｓ０に等しく、パルス出力はデューティ比演算に要する一定時間Ｔｓ１の後となるので、パルス出力の周期はその位相がデューティ比演算に要する時間だけデューティ比演算の周期よりずれることになる。

Claims (1)

  1. ＰＷＭ制御のデューティ比演算の周期である第１の周期と、前記デューティ比演算により決定したデューティ比のパルスを出力する周期である第２の周期の長さが同一であり、
    前記第２の周期は、前記第１の周期より位相を前記デューティ比演算に要する時間だけずらして制御する、
    ことを特徴とするデジタルＰＷＭ制御装置。
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