JP2014035617A5 - - Google Patents

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<コア側入力部100>
コア側入出力部100は、読み出しI/F回路6Rの動作クロックが読み出しアービタ3Rのそれと同期している一方、モジュールコア5の動作クロックとは非同期であるとの例に応じて、設けられている。このため、読み出しI/F回路6Rの動作クロックがモジュールコア5のそれと同期している場合には、コア側入出力部100は省略可能である。図の例によれば、コア側入出力部100は、入力用の非同期FIFO(First In First Out)部101と、出力用の非同期FIFO部102とを含んでいる。
書き込み管理部23は、書き込み対象データおよび書き込み先領域を、書き込みラインFIFO部ごとに決定し、その決定は所定の書き込み条件に従って行われる。書き込み条件については後述する。
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH06266612A (ja) * 1993-03-17 1994-09-22 Toshiba Corp Dmaコントローラ
JPH10326342A (ja) * 1997-05-27 1998-12-08 Canon Inc メモリ制御回路
JP4384124B2 (ja) * 2002-12-26 2009-12-16 キヤノン株式会社 画像処理装置及び画像処理方法
KR101034493B1 (ko) * 2004-01-09 2011-05-17 삼성전자주식회사 화상 변환 장치, 화상 변환을 위한 직접 메모리 액세스장치 및 화상 변환을 지원하는 카메라 인터페이스
JP4956282B2 (ja) * 2007-05-30 2012-06-20 株式会社リコー 画像処理装置
JP2012146032A (ja) * 2011-01-07 2012-08-02 Konica Minolta Business Technologies Inc 画像メモリ制御装置および画像処理装置

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