JP2013211853A - 集積回路装置、これを用いた撮像装置及び撮像システム - Google Patents
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Abstract
【解決手段】 本発明の集積回路装置204は、入力された電気信号を増幅するための増幅回路Aと、バイアス源bias1,2,Vssと電気的に接続される入力端子を有し増幅回路Aに増幅動作をさせるための動作バイアスを増幅回路Aのバイアス入力端子に供給するバイアス回路B,bと、を含む信号処理回路Eを複数有し、複数の信号処理回路Eは複数の群に分割されており、ここで、集積回路装置204は、群毎に分割して設けられた接続配線BL,SLを複数有し、複数の群のうちの1つの群内に含まれるバイアス回路B,bの入力端子が接続配線BL,SLにより共通に接続される。
【選択図】 図1
Description
置に適用される。
まず、図2を用いて本発明の撮像装置の全体構成を説明する。図2は、本発明の第1の実施形態における撮像装置の概略等価回路図を示すものである。
図7を用いて、本実施形態における半導体集積回路装置を説明する。なお、第1の実施形態と同じ構成要素については同じ番号もしくは記号を付与し、説明は割愛する。図7は、本実施形態における半導体集積回路装置の概略的な等価回路図である。
次に、本発明に係る撮像装置である放射線撮像装置を用いた放射線撮像システムについて図8を用いて説明する。
202 画素
203 駆動回路
204 集積回路装置
S11〜Smn 変換素子
T11〜Tmn スイッチ素子
Vg1〜Vgm 駆動線
Sig1〜Sign 信号線
E、E1〜En 信号処理回路
A、A1〜An 増幅回路
B、B1〜Bn 第1のバイアス回路
b、b1〜bn 第2のバイアス回路
bias1 定電流源
bias2 定電圧源
Vss 定電位源
BL バイアスライン
SL 電源ライン
CL 接続用配線
Claims (14)
- バイアス入力端子を有する増幅回路と、
バイアス源と電気的に接続される入力端子と前記バイアス入力端子と電気的に接続される出力端子とを有して前記増幅回路に動作バイアスを供給するバイアス回路と、
を有する信号処理回路を複数含む集積回路装置であって、
複数の前記信号処理回路は複数の群に分割されており、
前記群毎に分割して設けられた接続配線を複数有し、前記複数の群のうちの1つの群内に含まれる複数の前記バイアス回路の前記入力端子が複数の前記接続配線のうちの1つにより共通に接続されることを特徴とする集積回路装置。 - 更に前記複数の群に対応して前記バイアス源を複数有し、複数の前記バイアス源のうち前記1つの群に対応する1つの前記バイアス源と前記1つの群の前記接続配線とが電気的に接続される請求項1に記載の集積回路装置。
- 前記複数の群のうちの1つの群内に含まれる複数の前記バイアス回路の前記出力端子が電気的に共通に接続される請求項1又は2に記載の集積回路装置。
- 前記増幅回路は前記増幅回路の電流源であるトランジスタを有し、前記バイアス入力端子は前記トランジスタのゲートを含む請求項1から3のいずれか1項に記載の集積回路装置。
- 前記増幅回路はゲート接地回路を有し、前記バイアス入力端子は前記ゲート接地回路を構成するトランジスタのゲートを含む請求項1から3のいずれか1項に記載の集積回路装置。
- 前記増幅回路は、前記増幅回路の電流源であるトランジスタとゲート接地回路を構成するトランジスタと、を有し、前記バイアス回路は、前記増幅回路の電流源であるトランジスタのゲートと電気的に接続される出力端子を有する第1のバイアス回路と、前記ゲート接地回路を構成するトランジスタのゲートと電気的に接続される出力端子を有する第2のバイアス回路と、を含む請求項1から3のいずれか1項に記載の集積回路装置。
- n個の前記信号処理回路を有し、前記1つの群内にx個の前記信号処理回路を有する場合、前記複数の群の数n/xは10以上13以下であり、xは2以上でnより小さい自然数であり且つnの約数である請求項3に記載の集積回路装置。
- 放射線又は光を電気信号に変換するための変換素子を含む画素を複数有し、前記画素から出力された電気信号を並列に伝送するための複数の信号線を有する検出器と、
バイアス入力端子を有し、並列に伝送された電気信号を入力し、前記入力された電気信号を増幅するための増幅回路と、バイアス源と電気的に接続される入力端子と前記バイアス入力端子と電気的に接続される出力端子とを有して前記増幅回路に動作バイアスを供給するバイアス回路と、を含む信号処理回路を複数の前記信号線に対応して複数有し、複数の前記信号処理回路は複数の群に分割されている集積回路装置と、
を有する撮像装置であって、
前記集積回路装置は、前記群毎に分割して設けられた接続配線を複数有し、前記複数の群のうちの1つの群内に含まれる複数の前記バイアス回路の前記入力端子が複数の前記接続配線のうちの1つにより共通に接続されることを特徴とする撮像装置。 - 前記複数の信号線のうち所定の信号線に対応する信号処理回路と、前記所定の信号線とは物理的に隣接しない信号線に対応する信号処理回路とが、前記1つの群内に含まれており、前記複数の信号線のうち前記所定の信号線と物理的に隣接する信号線に対応する信号処理回路は、前記1つの群とは異なる群に含まれている請求項8に記載の撮像装置。
- 前記集積回路装置は更に前記複数の群に対応して前記バイアス源を複数有し、複数の前記バイアス源のうち前記1つの群に対応する1つの前記バイアス源と前記1つの群の前記接続配線とが電気的に接続される請求項8又は9に記載の撮像装置。
- 前記バイアス回路は、前記バイアス入力端子と電気的に接続される出力端子を有し、複数の群のうちの1つの群内に含まれる複数の前記バイアス回路の前記出力端子が電気的に共通に接続される請求項8から10のいずれか1項に記載の撮像装置。
- 前記集積回路装置はn個の前記信号処理回路を有し、前記1つの群内にx個の前記信号処理回路を有する場合、前記複数の群の数n/xは10以上13以下であり、xは2以上でnより小さい自然数であり且つnの約数である請求項11に記載の撮像装置。
- 前記検出器はN列の前記画素を含み、前記集積回路装置は前記N列の前記画素のうちの前記n列の前記画素に対応して1つ設けられており、N/n個の前記集積回路装置が設けられている請求項12に記載の撮像装置。
- 請求項8から13のいずれか1項に記載の撮像装置と、前記撮像装置からの信号を処理する信号処理手段とを含む撮像システム。
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