JP2012208296A - Method for manufacturing electro-optic device, electro-optic device, projection-type display device, and electronic equipment - Google Patents

Method for manufacturing electro-optic device, electro-optic device, projection-type display device, and electronic equipment Download PDF

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Abstract

PROBLEM TO BE SOLVED: To provide a method for manufacturing an electro-optic device that is capable of appropriately controlling the thickness of a pixel electrode when unevenness resulting from the presence of the pixel electrode is reduced by an insulating film provided in a region between pixels, and to provide an electro-optic device manufactured by the above method, a projection-type display device including the above electro-optic device, and electronic equipment.SOLUTION: In forming a pixel electrode 9a on an element substrate of a liquid crystal device, a first insulating film 47 including a lattice-shaped convex part 47f extending along an inter-pixel region 10f is formed, then, a contact hole 47a is formed in the first insulating film 47, and thereafter, a conductive film 9 and a second insulating film 49 are sequentially stacked. Next, in a polishing step, the convex part 47f is polished to be exposed, and the second insulating film 49 and the conductive film 9 are divided by the convex part 47f (inter-pixel region 10f).

Description

本発明は、素子基板に複数の画素電極が形成された液晶装置の製造方法、かかる方法により製造された液晶装置、および当該液晶装置を備えた投射型表示装置に関するものである。   The present invention relates to a method for manufacturing a liquid crystal device in which a plurality of pixel electrodes are formed on an element substrate, a liquid crystal device manufactured by such a method, and a projection display device including the liquid crystal device.

液晶装置等の電気光学装置では、素子基板上に複数の画素電極がマトリクス状に配置されている(特許文献1参照)。かかる電気光学装置のうち、例えば、液晶装置において、図8(a)に示すように、素子基板10の表面に画素電極9aに起因する凹凸が発生していると、ポリイミド膜等の有機材料系の配向膜16に対するラビング処理を均一に行えない等の問題点がある。また、シリコン酸化膜等の斜方蒸着により、無機材料系の配向膜16を形成する際、画素電極9aに起因する凹凸が発生していると、隣り合う画素電極9aにより挟まれた画素間領域10fに対して斜方蒸着を好適に行うことができず、配向膜16の配向能力がばらつく等の問題点がある。   In an electro-optical device such as a liquid crystal device, a plurality of pixel electrodes are arranged in a matrix on an element substrate (see Patent Document 1). Among such electro-optical devices, for example, in a liquid crystal device, as shown in FIG. 8A, when irregularities due to the pixel electrode 9a are generated on the surface of the element substrate 10, an organic material system such as a polyimide film is used. There is a problem that the rubbing treatment for the alignment film 16 cannot be performed uniformly. Further, when unevenness due to the pixel electrode 9a occurs when the inorganic material-based alignment film 16 is formed by oblique vapor deposition such as a silicon oxide film, an inter-pixel region sandwiched between adjacent pixel electrodes 9a. The oblique deposition cannot be suitably performed for 10f, and there is a problem that the alignment ability of the alignment film 16 varies.

それに対して、図8(b)に示すように、隣り合う画素電極9aにより挟まれた画素間領域10fを絶縁膜90で埋めておけば、配向膜16を平坦面上に形成することができ、上記の問題点を解消することができる。かかる平坦化は一般的に、図8(c)に示すように、画素電極9aの表面側に絶縁膜90を形成した後、図8(d)に示すように、画素電極9aの表面が露出するまで研磨し、絶縁膜90を画素間領域10fに残すことにより実現することができる。   On the other hand, as shown in FIG. 8B, if the inter-pixel region 10f sandwiched between the adjacent pixel electrodes 9a is filled with an insulating film 90, the alignment film 16 can be formed on a flat surface. The above problems can be solved. In general, such planarization is performed by forming an insulating film 90 on the surface side of the pixel electrode 9a as shown in FIG. 8C and then exposing the surface of the pixel electrode 9a as shown in FIG. 8D. This can be realized by polishing until the insulating film 90 is left in the inter-pixel region 10f.

特開2010−96966号公報JP 2010-96966 A

しかしながら、図8(b)〜(d)を参照して説明した方法では、研磨の際、画素電極9aの表面が研磨されることを避けることができないため、画素電極9aの厚さが変動するという問題点がある。その結果、透過型の液晶装置においては、画素電極9aを構成する透光性導電膜の分光特性が変動し、画像の品位が低下するという問題が発生する。また、反射型の液晶装置で形成される画像は、液晶層の厚さによって影響を受けやすいため、画素電極9aを構成する反射性導電膜の厚さが変動した結果、液晶層の厚さが変動すると、画像の品位が低下するという問題が発生する。   However, in the method described with reference to FIGS. 8B to 8D, it is inevitable that the surface of the pixel electrode 9a is polished at the time of polishing, and therefore the thickness of the pixel electrode 9a varies. There is a problem. As a result, in the transmissive liquid crystal device, there arises a problem that the spectral characteristics of the translucent conductive film constituting the pixel electrode 9a are fluctuated and the image quality is deteriorated. In addition, an image formed by a reflective liquid crystal device is easily affected by the thickness of the liquid crystal layer, and as a result, the thickness of the reflective conductive film constituting the pixel electrode 9a varies. If it fluctuates, there arises a problem that the quality of the image is lowered.

以上の問題点に鑑みて、本発明の課題は、画素間領域に設けた絶縁膜によって画素電極に起因する凹凸を緩和する場合でも、画素電極の厚さを適正に制御することができる電気光学装置の製造方法、電気光学装置、投射型表示装置および電子機器を提供することにある。   In view of the above problems, an object of the present invention is to provide an electro-optic that can appropriately control the thickness of the pixel electrode even when the unevenness caused by the pixel electrode is alleviated by the insulating film provided in the inter-pixel region. An object of the present invention is to provide a device manufacturing method, an electro-optical device, a projection display device, and an electronic apparatus.

上記課題を解決するために、本発明に係る電気光学装置の製造方法は、基板の一方面側に、少なくとも格子状の凸部を備えた第1絶縁膜を形成する第1絶縁膜形成工程と、該第1絶縁膜を貫通するコンタクトホールを形成するコンタクトホール形成工程と、前記第1絶縁膜に対して前記基板と反対側に画素電極を構成する導電膜を成膜する導電膜成膜工程と、前記導電膜に対して前記第1絶縁膜と反対側に第2絶縁膜を成膜する第2絶縁膜成膜工程と、前記導電膜および前記第2絶縁膜を前記凸部が露出するまで研磨して前記導電膜を前記凸部により分割して前記画素電極を形成する研磨工程と、を有することを特徴とする。   In order to solve the above-described problem, a method for manufacturing an electro-optical device according to the present invention includes a first insulating film forming step of forming a first insulating film having at least a lattice-shaped convex portion on one surface side of a substrate. A contact hole forming step of forming a contact hole penetrating the first insulating film, and a conductive film forming step of forming a conductive film constituting a pixel electrode on the opposite side of the substrate from the first insulating film A second insulating film forming step of forming a second insulating film on the opposite side of the first insulating film with respect to the conductive film; and the protrusions exposing the conductive film and the second insulating film And polishing to form the pixel electrode by dividing the conductive film by the protrusions.

本発明では、画素間領域に沿って格子状に延在する凸部を備えた第1絶縁膜を形成した後、第1絶縁膜にコンタクトホールを形成し、その後、導電膜および第2絶縁膜を順次積層する。次に、研磨工程では、凸部が露出するまで研磨し、第2絶縁膜および導電膜を凸部(画素間領域)により分割する。その結果、分割された導電膜によって画素電極が形成され、かかる画素電極の間(画素間領域)には第1絶縁膜の凸部が残る。従って、画素電極に起因する凹凸は、第1絶縁膜の凸部によって緩和される。また、本発明によれば、コンタクトホール内では、画素電極の表面に第2絶縁膜が残るので、コンタクトホールに起因する凹凸は、コンタクトホール内の第2絶縁膜によって緩和される。さらに、本発明では、導電膜の表面に第2絶縁膜を形成しておくので、導電膜の表面は研磨されない。従って、画素電極の厚さは、研磨によって変動せず、導電膜を成膜した際の厚さによって制御される。それ故、例えば、透過型の液晶装置においては、画素電極を構成する透光性導電膜の分光特性が変動しないので、かかる分光特性の変動に起因する画像の品位低下を防止することができる。また、反射型の液晶装置においては、画素電極を構成する反射性導電膜の厚さが変動しないので、液晶層の厚さ変動に起因する画像の品位低下を防止することができる。   In the present invention, after forming the first insulating film having the protrusions extending in a lattice shape along the inter-pixel region, a contact hole is formed in the first insulating film, and then the conductive film and the second insulating film Are sequentially stacked. Next, in the polishing step, polishing is performed until the convex portions are exposed, and the second insulating film and the conductive film are divided by the convex portions (inter-pixel regions). As a result, a pixel electrode is formed by the divided conductive film, and a convex portion of the first insulating film remains between the pixel electrodes (inter-pixel region). Accordingly, the unevenness caused by the pixel electrode is alleviated by the convex portion of the first insulating film. According to the present invention, since the second insulating film remains on the surface of the pixel electrode in the contact hole, unevenness caused by the contact hole is alleviated by the second insulating film in the contact hole. Furthermore, in the present invention, since the second insulating film is formed on the surface of the conductive film, the surface of the conductive film is not polished. Therefore, the thickness of the pixel electrode is not changed by polishing, but is controlled by the thickness when the conductive film is formed. Therefore, for example, in a transmissive liquid crystal device, the spectral characteristics of the light-transmitting conductive film constituting the pixel electrode do not vary, so that it is possible to prevent image quality degradation due to the variation in spectral characteristics. In the reflective liquid crystal device, since the thickness of the reflective conductive film constituting the pixel electrode does not vary, it is possible to prevent deterioration in image quality due to the variation in the thickness of the liquid crystal layer.

本発明に係る方法により製造された電気光学装置は、基板と、該基板の一方面側に設けられた複数の画素電極と、前記複数の画素電極と前記基板との間に設けられ、前記複数の画素電極のうち、隣り合う画素電極により挟まれた画素間領域内で延在する凸部、およびコンタクトホールが形成された第1絶縁膜と、前記コンタクトホール内において前記画素電極に対して前記基板とは反対側で重なる第2絶縁膜と、を有することを特徴とする。   The electro-optical device manufactured by the method according to the present invention includes a substrate, a plurality of pixel electrodes provided on one side of the substrate, and the plurality of pixel electrodes and the substrate. Among the pixel electrodes, a first insulating film formed with a protrusion extending in an inter-pixel region sandwiched between adjacent pixel electrodes, and a contact hole, and the pixel electrode in the contact hole with respect to the pixel electrode And a second insulating film overlapping on the opposite side of the substrate.

本発明に係る液晶装置の製造方法において、前記研磨工程の後、前記第2絶縁膜と前記凸部との間で露出する前記導電膜をエッチングする導電膜エッチング工程と、前記凸部と前記導電膜とが平坦な面を形成するまで第1絶縁膜および前記第2絶縁膜をエッチングする絶縁膜エッチング工程と、を行うことが好ましい。かかる方法で製造した液晶装置では、前記凸部の高さ寸法は、前記画素電極の厚さ寸法と同一である。それ故、画素電極の間(画素間領域)は第1絶縁膜の凸部によって完全に平坦化されることになる。   In the method for manufacturing a liquid crystal device according to the present invention, after the polishing step, a conductive film etching step of etching the conductive film exposed between the second insulating film and the convex portion, and the convex portion and the conductive portion. It is preferable to perform an insulating film etching step of etching the first insulating film and the second insulating film until a flat surface is formed with the film. In the liquid crystal device manufactured by such a method, the height dimension of the convex portion is the same as the thickness dimension of the pixel electrode. Therefore, the space between the pixel electrodes (inter-pixel region) is completely planarized by the convex portion of the first insulating film.

本発明において、前記第2絶縁膜は、リンおよびボロンのうちの少なくとも一方がドープされたシリケートガラスであることが好ましい。かかるシリケートガラスは研磨速度が速いので、第2絶縁膜の成膜厚さに対するマージンが大であるという利点がある。   In the present invention, the second insulating film is preferably silicate glass doped with at least one of phosphorus and boron. Since such a silicate glass has a high polishing rate, there is an advantage that a margin with respect to the thickness of the second insulating film is large.

本発明を適用した液晶装置は、直視型表示装置や投射型表示装置等、各種の電子機器に用いることができる。かかる電子機器のうち、投射型表示装置は、本発明を適用した電気光学装置に照射される照明光を出射する光源部と、前記液晶装置により変調された光を投射する投射光学系と、を有している。   A liquid crystal device to which the present invention is applied can be used for various electronic devices such as a direct-view display device and a projection display device. Among such electronic devices, the projection display device includes: a light source unit that emits illumination light applied to the electro-optical device to which the present invention is applied; and a projection optical system that projects light modulated by the liquid crystal device. Have.

本発明を適用した液晶装置(液晶装置)の電気的構成を示すブロック図である。It is a block diagram which shows the electrical constitution of the liquid crystal device (liquid crystal device) to which this invention is applied. 本発明を適用した液晶装置に用いた液晶パネルの説明図である。It is explanatory drawing of the liquid crystal panel used for the liquid crystal device to which this invention is applied. 本発明を適用した液晶装置の画素の説明図である。It is explanatory drawing of the pixel of the liquid crystal device to which this invention is applied. 本発明を適用した液晶装置における画素電極周辺の断面構成を拡大して示す説明図である。It is explanatory drawing which expands and shows the cross-sectional structure of the pixel electrode periphery in the liquid crystal device to which this invention is applied. 本発明を適用した液晶装置の製造工程の要部を示す説明図である。It is explanatory drawing which shows the principal part of the manufacturing process of the liquid crystal device to which this invention is applied. 本発明を適用した液晶装置の製造工程の要部を示す説明図である。It is explanatory drawing which shows the principal part of the manufacturing process of the liquid crystal device to which this invention is applied. 本発明を適用した液晶装置を用いた投射型表示装置の概略構成図である。It is a schematic block diagram of the projection type display apparatus using the liquid crystal device to which this invention is applied. 従来の問題点を示す説明図である。It is explanatory drawing which shows the conventional problem.

図面を参照して、本発明の実施の形態を説明する。以下の説明では、各種の電気光学装置のうち、液晶装置およびその製造方法に本発明を適用した場合を中心に説明する。また、以下の説明で参照する図においては、各層や各部材を図面上で認識可能な程度の大きさとするため、各層や各部材毎に縮尺を異ならしめてある。また、図8を参照して説明した構成との対応が分かりやすいように、対応する部分には同一の符号を付して説明する。また、画素トランジスターを流れる電流の方向が反転する場合、ソースとドレインとが入れ替わるが、本説明では、画素電極が接続されている側(画素側ソースドレイン領域)をドレインとし、データ線が接続されている側(データ線側ソースドレイン領域)をソースとする。また、素子基板に形成される層を説明する際、上層側あるいは表面側とは素子基板の基板本体が位置する側とは反対側(対向基板が位置する側)を意味し、下層側とは素子基板の基板本体が位置する側を意味する。   Embodiments of the present invention will be described with reference to the drawings. In the following description, the case where the present invention is applied to a liquid crystal device and a manufacturing method thereof among various electro-optical devices will be mainly described. In the drawings referred to in the following description, the scales are different for each layer and each member so that each layer and each member have a size that can be recognized on the drawing. Further, in order to easily understand the correspondence with the configuration described with reference to FIG. 8, the corresponding portions will be described with the same reference numerals. In addition, when the direction of the current flowing through the pixel transistor is reversed, the source and the drain are switched. In this description, the side to which the pixel electrode is connected (pixel side source / drain region) is the drain, and the data line is connected. The source side (data line side source / drain region) is the source. Further, when describing the layers formed on the element substrate, the upper layer side or the surface side means the side opposite to the side where the substrate body of the element substrate is located (the side on which the counter substrate is located), and the lower layer side means It means the side where the substrate body of the element substrate is located.

[液晶装置の説明]
(全体構成)
図1は、本発明を適用した液晶装置の電気的構成を示すブロック図である。なお、図1は、あくまで電気的な構成を示すブロック図であるため、容量線等が延在している方向等、レイアウトについては模式的に示してある。
[Description of liquid crystal device]
(overall structure)
FIG. 1 is a block diagram showing an electrical configuration of a liquid crystal device to which the present invention is applied. Note that FIG. 1 is a block diagram showing the electrical configuration to the last, and therefore the layout, such as the direction in which the capacitor lines extend, is schematically shown.

図1において、本形態の液晶装置100は、TN(Twisted Nematic)モードやVA(Vertical Alignment)モードの液晶パネル100pを有しており、液晶パネル100pは、その中央領域に複数の画素100aがマトリクス状に配列された画像表示領域10a(画素領域)を備えている。液晶パネル100pにおいて、後述する素子基板10(図2等を参照)では、画像表示領域10aの内側で複数本のデータ線6aおよび複数本の走査線3aが縦横に延びており、それらの交点に対応する位置に画素100aが構成されている。複数の画素100aの各々には、電界効果型トランジスターからなる画素トランジスター30、および後述する画素電極9aが形成されている。画素トランジスター30のソースにはデータ線6aが電気的に接続され、画素トランジスター30のゲートには走査線3aが電気的に接続され、画素トランジスター30のドレインには、画素電極9aが電気的に接続されている。   In FIG. 1, a liquid crystal device 100 of this embodiment includes a liquid crystal panel 100p in a TN (Twisted Nematic) mode or a VA (Vertical Alignment) mode, and the liquid crystal panel 100p has a plurality of pixels 100a in a matrix in a matrix area. Image display area 10a (pixel area) arranged in a shape. In the liquid crystal panel 100p, in the element substrate 10 (see FIG. 2 and the like) to be described later, a plurality of data lines 6a and a plurality of scanning lines 3a extend vertically and horizontally inside the image display region 10a. A pixel 100a is configured at a corresponding position. In each of the plurality of pixels 100a, a pixel transistor 30 made of a field effect transistor and a pixel electrode 9a described later are formed. The data line 6 a is electrically connected to the source of the pixel transistor 30, the scanning line 3 a is electrically connected to the gate of the pixel transistor 30, and the pixel electrode 9 a is electrically connected to the drain of the pixel transistor 30. Has been.

素子基板10において、画像表示領域10aより外周側には走査線駆動回路104やデータ線駆動回路101が設けられている。データ線駆動回路101は各データ線6aに電気的に接続しており、画像処理回路から供給される画像信号を各データ線6aに順次供給する。走査線駆動回路104は、各走査線3aに電気的に接続しており、走査信号を各走査線3aに順次供給する。   In the element substrate 10, a scanning line driving circuit 104 and a data line driving circuit 101 are provided on the outer peripheral side of the image display region 10 a. The data line driving circuit 101 is electrically connected to each data line 6a, and sequentially supplies the image signal supplied from the image processing circuit to each data line 6a. The scanning line driving circuit 104 is electrically connected to each scanning line 3a, and sequentially supplies a scanning signal to each scanning line 3a.

各画素100aにおいて、画素電極9aは、後述する対向基板20(図2等を参照)に形成された共通電極と液晶層を介して対向し、液晶容量50aを構成している。また、各画素100aには、液晶容量50aで保持される画像信号の変動を防ぐために、液晶容量50aと並列に蓄積容量55が付加されている。本形態では、蓄積容量55を構成するために、複数の画素100aに跨る第1電極層5aが容量電極層として形成されている。本形態において、第1電極層5aは、共通電位Vcomが印加された共通電位線5cに導通している。   In each pixel 100a, the pixel electrode 9a is opposed to a common electrode formed on a counter substrate 20 (see FIG. 2 and the like), which will be described later, via a liquid crystal layer, and constitutes a liquid crystal capacitor 50a. Further, a storage capacitor 55 is added to each pixel 100a in parallel with the liquid crystal capacitor 50a in order to prevent fluctuation of the image signal held in the liquid crystal capacitor 50a. In this embodiment, in order to form the storage capacitor 55, the first electrode layer 5a straddling the plurality of pixels 100a is formed as a capacitor electrode layer. In this embodiment, the first electrode layer 5a is electrically connected to the common potential line 5c to which the common potential Vcom is applied.

(液晶パネル100pの構成)
図2は、本発明を適用した液晶装置100に用いた液晶パネル100pの説明図であり、図2(a)、(b)は各々、液晶パネル100pを各構成要素と共に対向基板の側から見た平面図、およびそのH−H′断面図である。
(Configuration of the liquid crystal panel 100p)
FIG. 2 is an explanatory diagram of a liquid crystal panel 100p used in the liquid crystal device 100 to which the present invention is applied. FIGS. 2A and 2B show the liquid crystal panel 100p together with the respective components from the counter substrate side. FIG. 6 is a plan view and a sectional view taken along the line HH ′.

図2(a)、(b)に示すように、液晶パネル100pでは、素子基板10と対向基板20とが所定の隙間を介してシール材107によって貼り合わされており、シール材107は対向基板20の外縁に沿うように枠状に設けられている。シール材107は、光硬化樹脂や熱硬化性樹脂等からなる接着剤であり、両基板間の距離を所定値とするためのグラスファイバー、あるいはガラスビーズ等のギャップ材が配合されている。   As shown in FIGS. 2A and 2B, in the liquid crystal panel 100p, the element substrate 10 and the counter substrate 20 are bonded to each other with a seal material 107 through a predetermined gap. It is provided in the shape of a frame along the outer edge. The sealing material 107 is an adhesive made of a photo-curing resin, a thermosetting resin, or the like, and is mixed with a gap material such as glass fiber or glass beads for setting the distance between both substrates to a predetermined value.

かかる構成の液晶パネル100pにおいて、素子基板10および対向基板20はいずれも四角形であり、液晶パネル100pの略中央には、図1を参照して説明した画像表示領域10aが四角形の領域として設けられている。かかる形状に対応して、シール材107も略四角形に設けられ、シール材107の内周縁と画像表示領域10aの外周縁との間には、略四角形の周辺領域10bが額縁状に設けられている。素子基板10において、画像表示領域10aの外側では、素子基板10の一辺に沿ってデータ線駆動回路101および複数の端子102が形成されており、この一辺に隣接する他の辺に沿って走査線駆動回路104が形成されている。なお、端子102には、フレキシブル配線基板(図示せず)が接続されており、素子基板10には、フレキシブル配線基板を介して各種電位や各種信号が入力される。   In the liquid crystal panel 100p having such a configuration, the element substrate 10 and the counter substrate 20 are both square, and the image display area 10a described with reference to FIG. 1 is provided as a square area in the approximate center of the liquid crystal panel 100p. ing. Corresponding to this shape, the sealing material 107 is also provided in a substantially rectangular shape, and a substantially rectangular peripheral region 10b is provided in a frame shape between the inner peripheral edge of the sealing material 107 and the outer peripheral edge of the image display region 10a. Yes. In the element substrate 10, a data line driving circuit 101 and a plurality of terminals 102 are formed along one side of the element substrate 10 outside the image display region 10 a, and scanning lines are formed along other sides adjacent to the one side. A drive circuit 104 is formed. Note that a flexible wiring board (not shown) is connected to the terminal 102, and various potentials and various signals are input to the element substrate 10 through the flexible wiring board.

詳しくは後述するが、素子基板10の一方面10sおよび他方面10tのうち、一方面10s側では、画像表示領域10aに、図1を参照して説明した画素トランジスター30、および画素トランジスター30に電気的に接続する画素電極9aがマトリクス状に形成されており、かかる画素電極9aの上層側には配向膜16が形成されている。   As will be described in detail later, on the one surface 10s side of the one surface 10s and the other surface 10t of the element substrate 10, the pixel transistor 30 and the pixel transistor 30 described with reference to FIG. The pixel electrodes 9a to be connected are formed in a matrix, and an alignment film 16 is formed on the upper layer side of the pixel electrodes 9a.

また、素子基板10の一方面10s側において、周辺領域10bには、画素電極9aと同時形成されたダミー画素電極9b(図2(b)参照)が形成されている。ダミー画素電極9bについては、ダミーの画素トランジスターと電気的に接続された構成、ダミーの画素トランジスターが設けられずに配線に直接、電気的に接続された構成、あるいは電位が印加されていないフロート状態にある構成が採用される。かかるダミー画素電極9bは、素子基板10において配向膜16が形成される面を研磨により平坦化する際、画像表示領域10aと周辺領域10bとの高さ位置を圧縮し、配向膜16が形成される面を平坦面にするのに寄与する。また、ダミー画素電極9bを所定の電位に設定すれば、画像表示領域10aの外周側端部での液晶分子の配向の乱れを防止することができる。   Further, on the one surface 10s side of the element substrate 10, a dummy pixel electrode 9b (see FIG. 2B) formed simultaneously with the pixel electrode 9a is formed in the peripheral region 10b. For the dummy pixel electrode 9b, a configuration in which the dummy pixel transistor is electrically connected, a configuration in which the dummy pixel transistor is not provided, and a configuration in which the dummy pixel electrode is directly electrically connected to the wiring, or a floating state in which no potential is applied The structure which exists in is adopted. The dummy pixel electrode 9b compresses the height positions of the image display region 10a and the peripheral region 10b when the surface on which the alignment film 16 is formed in the element substrate 10 is flattened by polishing, and the alignment film 16 is formed. This contributes to a flat surface. Further, if the dummy pixel electrode 9b is set to a predetermined potential, it is possible to prevent the disorder of the alignment of the liquid crystal molecules at the outer peripheral side end of the image display region 10a.

対向基板20において素子基板10と対向する一方面側には共通電極21が形成されており、共通電極21の上層には配向膜26が形成されている。共通電極21は、対向基板20の略全面あるいは複数の帯状電極として複数の画素100aに跨って形成されている。また、対向基板20において素子基板10と対向する一方面側には、共通電極21の下層側に遮光層108が形成されている。本形態において、遮光層108は、画像表示領域10aの外周縁に沿って延在する額縁状に形成されており、見切りとして機能する。ここで、遮光層108の外周縁は、シール材107の内周縁との間に隙間を隔てた位置にあり、遮光層108とシール材107とは重なっていない。なお、対向基板20において、遮光層108は、隣り合う画素電極9aにより挟まれた画素間領域と重なる領域等にブラックマトリクス部として形成されることもある。   A common electrode 21 is formed on one side of the counter substrate 20 facing the element substrate 10, and an alignment film 26 is formed on the common electrode 21. The common electrode 21 is formed across the plurality of pixels 100a as substantially the entire surface of the counter substrate 20 or a plurality of strip electrodes. Further, a light shielding layer 108 is formed on the lower layer side of the common electrode 21 on one surface side of the counter substrate 20 facing the element substrate 10. In this embodiment, the light shielding layer 108 is formed in a frame shape extending along the outer peripheral edge of the image display region 10a, and functions as a parting. Here, the outer peripheral edge of the light shielding layer 108 is located with a gap between the inner peripheral edge of the sealing material 107 and the light shielding layer 108 and the sealing material 107 do not overlap. In the counter substrate 20, the light shielding layer 108 may be formed as a black matrix portion in an area that overlaps an inter-pixel area sandwiched between adjacent pixel electrodes 9 a.

このように構成した液晶パネル100pにおいて、素子基板10には、シール材107より外側において対向基板20の角部分と重なる領域に、素子基板10と対向基板20との間で電気的導通をとるための基板間導通用電極109が形成されている。かかる基板間導通用電極109には、導電粒子を含んだ基板間導通材109aが配置されており、対向基板20の共通電極21は、基板間導通材109aおよび基板間導通用電極109を介して、素子基板10側に電気的に接続されている。このため、共通電極21は、素子基板10の側から共通電位Vcomが印加されている。シール材107は、略同一の幅寸法をもって対向基板20の外周縁に沿って設けられている。このため、シール材107は、略四角形である。但し、シール材107は、対向基板20の角部分と重なる領域では基板間導通用電極109を避けて内側を通るように設けられており、シール材107の角部分は略円弧状である。   In the liquid crystal panel 100p configured as described above, the element substrate 10 is electrically connected between the element substrate 10 and the counter substrate 20 in a region overlapping the corner portion of the counter substrate 20 outside the sealant 107. The inter-substrate conduction electrode 109 is formed. The inter-substrate conducting material 109 a containing conductive particles is disposed on the inter-substrate conducting electrode 109, and the common electrode 21 of the counter substrate 20 is interposed via the inter-substrate conducting material 109 a and the inter-substrate conducting electrode 109. Are electrically connected to the element substrate 10 side. Therefore, the common potential Vcom is applied to the common electrode 21 from the element substrate 10 side. The sealing material 107 is provided along the outer peripheral edge of the counter substrate 20 with substantially the same width dimension. For this reason, the sealing material 107 is substantially rectangular. However, the sealing material 107 is provided so as to pass inside avoiding the inter-substrate conduction electrode 109 in a region overlapping the corner portion of the counter substrate 20, and the corner portion of the sealing material 107 has a substantially arc shape.

かかる構成の液晶装置100において、画素電極9aおよび共通電極21をITOやIZO等の透光性の導電膜により形成すると、透過型の液晶装置を構成することができる。これに対して、共通電極21をITO(Indium Tin Oxide)やIZO(Indium Zinc Oxide)等の透光性導電膜により形成し、画素電極9aをアルミニウム等の反射性導電膜により形成すると、反射型の液晶装置を構成することができる。液晶装置100が反射型である場合、対向基板20の側から入射した光が素子基板10の側の基板で反射して出射される間に変調されて画像を表示する。液晶装置100が透過型である場合、素子基板10および対向基板20のうち、一方側の基板から入射した光が他方側の基板を透過して出射される間に変調されて画像を表示する。   In the liquid crystal device 100 having such a configuration, when the pixel electrode 9a and the common electrode 21 are formed of a light-transmitting conductive film such as ITO or IZO, a transmissive liquid crystal device can be configured. On the other hand, when the common electrode 21 is formed of a light-transmitting conductive film such as ITO (Indium Tin Oxide) or IZO (Indium Zinc Oxide) and the pixel electrode 9a is formed of a reflective conductive film such as aluminum, a reflective type is obtained. The liquid crystal device can be configured. When the liquid crystal device 100 is of a reflective type, light incident from the counter substrate 20 side is modulated while being reflected by the substrate on the element substrate 10 side and emitted, thereby displaying an image. In the case where the liquid crystal device 100 is a transmissive type, the light incident from one of the element substrate 10 and the counter substrate 20 is modulated while being transmitted through the other substrate, and an image is displayed.

液晶装置100は、モバイルコンピューター、携帯電話機等といった電子機器のカラー表示装置として用いることができ、この場合、対向基板20には、カラーフィルター(図示せず)や保護膜が形成される。また、液晶装置100では、使用する液晶層50の種類や、ノーマリホワイトモード/ノーマリブラックモードの別に応じて、位相差フィルムや偏光板等が液晶パネル100pに対して所定の向きに配置される。さらに、液晶装置100は、後述する投射型表示装置(液晶プロジェクター)において、RGB用のライトバルブとして用いることができる。この場合、RGB用の各液晶装置100の各々には、RGB色分解用のダイクロイックミラーを介して分解された各色の光が投射光として各々入射されることになるので、カラーフィルターは形成されない。   The liquid crystal device 100 can be used as a color display device of an electronic device such as a mobile computer or a mobile phone. In this case, a color filter (not shown) and a protective film are formed on the counter substrate 20. In the liquid crystal device 100, a retardation film, a polarizing plate, and the like are arranged in a predetermined direction with respect to the liquid crystal panel 100p according to the type of the liquid crystal layer 50 to be used and the normally white mode / normally black mode. The Furthermore, the liquid crystal device 100 can be used as a light valve for RGB in a projection display device (liquid crystal projector) described later. In this case, each color liquid crystal device 100 for RGB receives light of each color separated through RGB color separation dichroic mirrors as projection light, so that no color filter is formed.

本形態において、液晶装置100が、後述する投射型表示装置においてRGB用のライトバルブとして用いられる透過型の液晶装置であって、対向基板20から入射した光が素子基板10を透過して出射される場合を中心に説明する。また、本形態において、液晶装置100は、液晶層50として、誘電異方性が負のネマチック液晶化合物を用いたVAモードの液晶パネル100pを備えている場合を中心に説明する。   In this embodiment, the liquid crystal device 100 is a transmissive liquid crystal device used as a RGB light valve in a projection display device described later, and light incident from the counter substrate 20 is transmitted through the element substrate 10 and emitted. The case will be mainly described. Further, in this embodiment, the liquid crystal device 100 will be described focusing on the case where the liquid crystal layer 50 includes a VA mode liquid crystal panel 100p using a nematic liquid crystal compound having a negative dielectric anisotropy.

(画素の具体的構成)
図3は、本発明を適用した液晶装置100の画素の説明図であり、図3(a)、(b)は各々、素子基板10において隣り合う画素の平面図、および図3(a)のF−F′線に相当する位置で液晶装置100を切断したときの断面図である。なお、図3(a)では、各領域を以下の線で表してある。
走査線3a=太い実線
半導体層1a=細くて短い点線
データ線6aおよびドレイン電極6b=一点鎖線
第1電極層5aおよび中継電極5b=細くて長い破線
第2電極層7a=二点鎖線
画素電極9a=太くて短い破線
(Specific pixel configuration)
3A and 3B are explanatory diagrams of pixels of the liquid crystal device 100 to which the present invention is applied. FIGS. 3A and 3B are a plan view of adjacent pixels in the element substrate 10 and FIG. It is sectional drawing when the liquid crystal device 100 is cut | disconnected in the position corresponded to FF 'line. In FIG. 3A, each region is represented by the following line.
Scanning line 3a = thick solid line Semiconductor layer 1a = thin and short dotted line Data line 6a and drain electrode 6b = dot and dash line First electrode layer 5a and relay electrode 5b = thin and long broken line Second electrode layer 7a = two-dot chain line Pixel electrode 9a = Thick and short dashed line

図3(a)に示すように、素子基板10には、複数の画素100aの各々に矩形状の画素電極9aが形成されており、隣り合う画素電極9aにより挟まれた縦横の画素間領域10fと重なる領域に沿ってデータ線6aおよび走査線3aが形成されている。より具体的には、画素間領域10fのうち、走査線3aに沿って延在する第1画素間領域10gと重なる領域に沿って走査線3aが延在し、データ線6aに沿って延在する第2画素間領域10hと重なる領域に沿ってデータ線6aが延在している。データ線6aおよび走査線3aは各々、直線的に延びており、データ線6aと走査線3aとが交差する領域に画素トランジスター30が形成されている。素子基板10には、データ線6aと重なるように、図1を参照して説明した第1電極層5a(容量電極層)が形成されている。   As shown in FIG. 3A, a rectangular pixel electrode 9a is formed on each of the plurality of pixels 100a on the element substrate 10, and a vertical and horizontal inter-pixel region 10f sandwiched between adjacent pixel electrodes 9a. A data line 6a and a scanning line 3a are formed along the overlapping area. More specifically, in the inter-pixel region 10f, the scanning line 3a extends along the region overlapping the first inter-pixel region 10g extending along the scanning line 3a, and extends along the data line 6a. A data line 6a extends along a region overlapping the second inter-pixel region 10h. Each of the data line 6a and the scanning line 3a extends linearly, and a pixel transistor 30 is formed in a region where the data line 6a and the scanning line 3a intersect. On the element substrate 10, the first electrode layer 5a (capacitance electrode layer) described with reference to FIG. 1 is formed so as to overlap the data line 6a.

図3(a)、(b)に示すように、素子基板10は、石英基板やガラス基板等の透光性の基板本体10w、基板本体10wの液晶層50側の表面(一方面10s側)に形成された画素電極9a、画素スイッチング用の画素トランジスター30、および配向膜16を主体として構成されている。対向基板20は、石英基板やガラス基板等の透光性の基板本体20w、その液晶層50側の表面(素子基板10と対向する一方面側)に形成された共通電極21、および配向膜26を主体として構成されている。   As shown in FIGS. 3A and 3B, the element substrate 10 includes a translucent substrate body 10w such as a quartz substrate and a glass substrate, and a surface of the substrate body 10w on the liquid crystal layer 50 side (on the one surface 10s side). The pixel electrode 9a, the pixel transistor 30 for pixel switching, and the alignment film 16 are mainly formed. The counter substrate 20 includes a translucent substrate main body 20w such as a quartz substrate or a glass substrate, a common electrode 21 formed on a surface of the liquid crystal layer 50 side (one surface facing the element substrate 10), and an alignment film 26. Is the main constituent.

素子基板10において、基板本体10wの一方面側には、導電性のポリシリコン膜、金属シリサイド膜、金属膜あるいは金属膜化合物等の導電膜からなる走査線3aが形成されている。本形態において、走査線3aは、タングステンシリサイド(WSi)等の遮光性導電膜から構成されており、画素トランジスター30に対する遮光膜としても機能している。本形態において、走査線3aは、厚さが200nm程度のタングステンシリサイドからなる。なお、基板本体10wと走査線3aとの間には、シリコン酸化膜等の絶縁膜が設けられることもある。   In the element substrate 10, a scanning line 3 a made of a conductive film such as a conductive polysilicon film, a metal silicide film, a metal film, or a metal film compound is formed on one surface side of the substrate body 10 w. In this embodiment, the scanning line 3 a is made of a light-shielding conductive film such as tungsten silicide (WSi), and also functions as a light-shielding film for the pixel transistor 30. In this embodiment, the scanning line 3a is made of tungsten silicide having a thickness of about 200 nm. An insulating film such as a silicon oxide film may be provided between the substrate body 10w and the scanning line 3a.

基板本体10wの一方面10s側において、走査線3aの上層側には、シリコン酸化膜等の絶縁膜12が形成されており、かかる絶縁膜12の表面に、半導体層1aを備えた画素トランジスター30が形成されている。本形態において、絶縁膜12は、例えば、テトラエトキシシラン(Si(OC254)を用いた減圧CVD法やテトラエトキシシランと酸素ガスとを用いたプラズマCVD法等により形成したシリコン酸化膜と、高温CVD法により形成したシリコン酸化膜(HTO(High Temperature Oxide)膜)との2層構造を有している。 An insulating film 12 such as a silicon oxide film is formed on the upper side of the scanning line 3a on the one surface 10s side of the substrate body 10w, and the pixel transistor 30 including the semiconductor layer 1a on the surface of the insulating film 12 is formed. Is formed. In this embodiment, the insulating film 12 is formed by, for example, a silicon oxide formed by a low pressure CVD method using tetraethoxysilane (Si (OC 2 H 5 ) 4 ) or a plasma CVD method using tetraethoxysilane and oxygen gas. It has a two-layer structure of a film and a silicon oxide film (HTO (High Temperature Oxide) film) formed by a high temperature CVD method.

画素トランジスター30は、走査線3aとデータ線6aとの交差領域において走査線3aの延在方向に長辺方向を向けた半導体層1aと、半導体層1aの長さ方向と直交する方向に延在して半導体層1aの長さ方向の中央部分に重なるゲート電極3cとを備えている。また、画素トランジスター30は、半導体層1aとゲート電極3cとの間に透光性のゲート絶縁層2を有している。半導体層1aは、ゲート電極3cに対してゲート絶縁層2を介して対向するチャネル領域1gを備えているとともに、チャネル領域1gの両側にソース領域1bおよびドレイン領域1cを備えている。本形態において、画素トランジスター30は、LDD構造を有している。従って、ソース領域1bおよびドレイン領域1cは各々、チャネル領域1gの両側に低濃度領域1b1、1c1を備え、低濃度領域1b1、1c1に対してチャネル領域1gとは反対側で隣接する領域に高濃度領域1b2、1c2を備えている。   The pixel transistor 30 extends in a direction perpendicular to the length direction of the semiconductor layer 1a, and a semiconductor layer 1a having a long side direction in the extending direction of the scan line 3a in the intersection region of the scan line 3a and the data line 6a. The gate electrode 3c is provided so as to overlap the central portion in the length direction of the semiconductor layer 1a. Further, the pixel transistor 30 has a light-transmitting gate insulating layer 2 between the semiconductor layer 1a and the gate electrode 3c. The semiconductor layer 1a includes a channel region 1g opposed to the gate electrode 3c via the gate insulating layer 2, and includes a source region 1b and a drain region 1c on both sides of the channel region 1g. In this embodiment, the pixel transistor 30 has an LDD structure. Accordingly, each of the source region 1b and the drain region 1c includes the low concentration regions 1b1, 1c1 on both sides of the channel region 1g, and the high concentration in the region adjacent to the low concentration regions 1b1, 1c1 opposite to the channel region 1g. Regions 1b2 and 1c2 are provided.

半導体層1aは、多結晶シリコン膜等によって構成されている。ゲート絶縁層2は、半導体層1aを熱酸化したシリコン酸化膜からなる第1ゲート絶縁層2aと、CVD法等により形成されたシリコン酸化膜等からなる第2ゲート絶縁層2bとの2層構造からなる。ゲート電極3cは、導電性のポリシリコン膜、金属シリサイド膜、金属膜あるいは金属膜化合物等の導電膜からなり、半導体層1aの両側において、第2ゲート絶縁層2bおよび絶縁膜12を貫通するコンタクトホール12a、12bを介して走査線3aに導通している。本形態において、ゲート電極3cは、膜厚が100nm程度の導電性のポリシリコン膜と、膜厚が100nm程度のタングステンシリサイド膜との2層構造を有している。   The semiconductor layer 1a is composed of a polycrystalline silicon film or the like. The gate insulating layer 2 has a two-layer structure of a first gate insulating layer 2a made of a silicon oxide film obtained by thermally oxidizing the semiconductor layer 1a and a second gate insulating layer 2b made of a silicon oxide film or the like formed by a CVD method or the like. Consists of. The gate electrode 3c is made of a conductive film such as a conductive polysilicon film, a metal silicide film, a metal film, or a metal film compound, and contacts that penetrate the second gate insulating layer 2b and the insulating film 12 on both sides of the semiconductor layer 1a. It is electrically connected to the scanning line 3a through the holes 12a and 12b. In this embodiment, the gate electrode 3c has a two-layer structure of a conductive polysilicon film having a thickness of about 100 nm and a tungsten silicide film having a thickness of about 100 nm.

なお、本形態では、液晶装置100を透過した後の光が他の部材で反射した際、かかる反射光が半導体層1aに入射して画素トランジスター30で光電流に起因する誤動作が発生することを防止することを目的に、走査線3aを遮光膜により形成してある。但し、走査線をゲート絶縁層2の上層に形成し、その一部をゲート電極3cとしてもよい。この場合、図3に示す走査線3aは、遮光のみを目的として形成されることになる。   In this embodiment, when the light after passing through the liquid crystal device 100 is reflected by another member, the reflected light is incident on the semiconductor layer 1a and the pixel transistor 30 malfunctions due to the photocurrent. For the purpose of prevention, the scanning line 3a is formed of a light shielding film. However, the scanning line may be formed in the upper layer of the gate insulating layer 2 and a part thereof may be used as the gate electrode 3c. In this case, the scanning line 3a shown in FIG. 3 is formed only for light shielding.

ゲート電極3cの上層側にはシリコン酸化膜等からなる透光性の層間絶縁膜41が形成されており、層間絶縁膜41の上層には、データ線6aおよびドレイン電極6bが同一の導電膜によって形成されている。層間絶縁膜41は、例えば、シランガス(SH4)と亜酸化窒素(N2O)とを用いたプラズマCVD法等により形成したシリコン酸化膜等からなる。 A translucent interlayer insulating film 41 made of a silicon oxide film or the like is formed on the upper layer side of the gate electrode 3c. On the upper layer of the interlayer insulating film 41, the data line 6a and the drain electrode 6b are made of the same conductive film. Is formed. The interlayer insulating film 41 is made of, for example, a silicon oxide film formed by a plasma CVD method using silane gas (SH 4 ) and nitrous oxide (N 2 O).

データ線6aおよびドレイン電極6bは、導電性のポリシリコン膜、金属シリサイド膜、金属膜あるいは金属膜化合物等の導電膜からなる。本形態において、データ線6aおよびドレイン電極6bは、膜厚が20nmのチタン(Ti)膜、膜厚が50nmの窒化チタン(TiN)膜、膜厚が350nmのアルミニウム(Al)膜、膜厚が150nmのTiN膜をこの順に積層してなる4層構造を有している。データ線6aは、層間絶縁膜41および第2ゲート絶縁層2bを貫通するコンタクトホール41aを介してソース領域1b(データ線側ソースドレイン領域)に導通している。ドレイン電極6bは、第1画素間領域10gと重なる領域において、半導体層1aのドレイン領域1c(画素電極側ソースドレイン領域)と一部が重なるように形成されており、層間絶縁膜41および第2ゲート絶縁層2bを貫通するコンタクトホール41bを介してドレイン領域1cに導通している。   The data line 6a and the drain electrode 6b are made of a conductive film such as a conductive polysilicon film, a metal silicide film, a metal film, or a metal film compound. In this embodiment, the data line 6a and the drain electrode 6b are formed of a titanium (Ti) film having a thickness of 20 nm, a titanium nitride (TiN) film having a thickness of 50 nm, an aluminum (Al) film having a thickness of 350 nm, and a film thickness. It has a four-layer structure in which 150 nm TiN films are stacked in this order. The data line 6a is electrically connected to the source region 1b (data line side source / drain region) through a contact hole 41a penetrating the interlayer insulating film 41 and the second gate insulating layer 2b. The drain electrode 6b is formed so as to partially overlap the drain region 1c (pixel electrode side source / drain region) of the semiconductor layer 1a in a region overlapping the first inter-pixel region 10g. It is electrically connected to the drain region 1c through a contact hole 41b that penetrates the gate insulating layer 2b.

データ線6aおよびドレイン電極6bの上層側にはシリコン酸化膜等からなる透光性の層間絶縁膜42が形成されている。層間絶縁膜42は、例えば、テトラエトキシシランと酸素ガスとを用いたプラズマCVD法等により形成したシリコン酸化膜等からなる。   A translucent interlayer insulating film 42 made of a silicon oxide film or the like is formed on the upper side of the data line 6a and the drain electrode 6b. The interlayer insulating film 42 is made of, for example, a silicon oxide film formed by a plasma CVD method using tetraethoxysilane and oxygen gas.

層間絶縁膜42の上層側には、第1電極層5aおよび中継電極5bが同一の導電膜によって形成されている。第1電極層5aおよび中継電極5bは、導電性のポリシリコン膜、金属シリサイド膜、金属膜あるいは金属膜化合物等の導電膜からなる。本形態において、第1電極層5aおよび中継電極5bは、膜厚が200nm程度のAl膜と、膜厚が100nm程度のTiN膜との2層構造を有している。第1電極層5aは、データ線6aと同様、第2画素間領域10hと重なる領域に沿って延在している。中継電極5bは、第1画素間領域10gと重なる領域において、ドレイン電極6bと一部が重なるように形成されており、層間絶縁膜42を貫通するコンタクトホール42aを介してドレイン電極6bに導通している。   On the upper layer side of the interlayer insulating film 42, the first electrode layer 5a and the relay electrode 5b are formed of the same conductive film. The first electrode layer 5a and the relay electrode 5b are made of a conductive film such as a conductive polysilicon film, a metal silicide film, a metal film, or a metal film compound. In this embodiment, the first electrode layer 5a and the relay electrode 5b have a two-layer structure of an Al film having a thickness of about 200 nm and a TiN film having a thickness of about 100 nm. Similar to the data line 6a, the first electrode layer 5a extends along a region overlapping the second inter-pixel region 10h. The relay electrode 5b is formed so as to partially overlap the drain electrode 6b in a region overlapping the first inter-pixel region 10g, and is electrically connected to the drain electrode 6b through a contact hole 42a penetrating the interlayer insulating film 42. ing.

第1電極層5aおよび中継電極5bの上層側にはシリコン酸化膜等の層間絶縁膜44がエッチングストッパー層として形成されており、かかる層間絶縁膜44には、第1電極層5aと重なる領域に開口部44bが形成されている。本形態において、層間絶縁膜44は、テトラエトキシシランと酸素ガスとを用いたプラズマCVD法等により形成したシリコン酸化膜等からなる。ここで、開口部44bは、図3(a)では図示を省略するが、データ線6aと走査線3aとの交差領域を起点として第1画素間領域10gと重なる領域に沿って延在する部分と、データ線6aと走査線3aとの交差領域を起点として第2画素間領域10hと重なる領域に沿って延在する部分とを備えたL字形状に形成されている。   An interlayer insulating film 44 such as a silicon oxide film is formed as an etching stopper layer on the upper side of the first electrode layer 5a and the relay electrode 5b, and the interlayer insulating film 44 is formed in a region overlapping the first electrode layer 5a. An opening 44b is formed. In this embodiment, the interlayer insulating film 44 is made of a silicon oxide film or the like formed by a plasma CVD method using tetraethoxysilane and oxygen gas. Here, although not shown in FIG. 3A, the opening 44b is a portion extending along a region overlapping with the first inter-pixel region 10g starting from the intersection region between the data line 6a and the scanning line 3a. And a portion extending along a region overlapping the second inter-pixel region 10h starting from the intersection region of the data line 6a and the scanning line 3a.

層間絶縁膜44の上層側には透光性の誘電体層40が形成されており、かかる誘電体層40の上層側には第2電極層7aが形成されている。第2電極層7aは、導電性のポリシリコン膜、金属シリサイド膜、金属膜あるいは金属膜化合物等の導電膜からなる。本形態において、第2電極層7aは、膜厚が100nm程度のTiN膜からなる。誘電体層40としては、シリコン酸化膜やシリコン窒化膜等のシリコン化合物を用いることができる他、アルミニウム酸化膜、チタン酸化膜、タンタル酸化膜、ニオブ酸化膜、ハフニウム酸化膜、ランタン酸化膜、ジルコニウム酸化膜等の高誘電率の誘電体層を用いることができる。第2電極層7aは、データ線6aと走査線3aとの交差領域を起点として第1画素間領域10gと重なる領域に沿って延在する部分と、データ線6aと走査線3aとの交差領域を起点として第2画素間領域10hと重なる領域に沿って延在する部分とを備えたL字形状に形成されている。従って、第2電極層7aのうち、第2画素間領域10hと重なる領域に沿って延在する部分は、層間絶縁膜44の開口部44bにおいて、誘電体層40を介して第1電極層5aに重なっている。このようにして、本形態では、第1電極層5a、誘電体層40、および第2電極層7aは、第1画素間領域10gと重なる領域に蓄積容量55を構成している。   A translucent dielectric layer 40 is formed on the upper layer side of the interlayer insulating film 44, and a second electrode layer 7 a is formed on the upper layer side of the dielectric layer 40. The second electrode layer 7a is made of a conductive film such as a conductive polysilicon film, a metal silicide film, a metal film, or a metal film compound. In this embodiment, the second electrode layer 7a is made of a TiN film having a thickness of about 100 nm. As the dielectric layer 40, a silicon compound such as a silicon oxide film or a silicon nitride film can be used, and an aluminum oxide film, a titanium oxide film, a tantalum oxide film, a niobium oxide film, a hafnium oxide film, a lanthanum oxide film, zirconium A dielectric layer having a high dielectric constant such as an oxide film can be used. The second electrode layer 7a includes a portion extending along a region overlapping the first inter-pixel region 10g starting from an intersection region between the data line 6a and the scanning line 3a, and an intersection region between the data line 6a and the scanning line 3a. And a portion extending along a region overlapping with the second inter-pixel region 10h. Therefore, a portion of the second electrode layer 7 a that extends along the region overlapping with the second inter-pixel region 10 h is the first electrode layer 5 a via the dielectric layer 40 in the opening 44 b of the interlayer insulating film 44. It overlaps with. In this way, in the present embodiment, the first electrode layer 5a, the dielectric layer 40, and the second electrode layer 7a constitute the storage capacitor 55 in a region overlapping the first inter-pixel region 10g.

また、第2電極層7aにおいて、第1画素間領域10gと重なる領域に沿って延在する部分は、中継電極5bと部分的に重なっており、誘電体層40および層間絶縁膜44を貫通するコンタクトホール44aを介して中継電極5bに導通している。   In the second electrode layer 7a, the portion extending along the region overlapping the first inter-pixel region 10g partially overlaps the relay electrode 5b and penetrates the dielectric layer 40 and the interlayer insulating film 44. It is electrically connected to the relay electrode 5b through the contact hole 44a.

第2電極層7aの上層側には透光性の層間絶縁膜45が形成されており、本形態では、層間絶縁膜45の上層側には、図4〜図6を参照して後述する第1絶縁膜47が形成されている。層間絶縁膜45は、例えば、シランガスと亜酸化窒素(N2O)とを用いたプラズマCVD法等により形成したシリコン酸化膜等からなる。 A translucent interlayer insulating film 45 is formed on the upper layer side of the second electrode layer 7a. In this embodiment, the upper layer side of the interlayer insulating film 45 is a second layer which will be described later with reference to FIGS. One insulating film 47 is formed. The interlayer insulating film 45 is made of, for example, a silicon oxide film formed by a plasma CVD method using silane gas and nitrous oxide (N 2 O).

第1絶縁膜47の上層側には、厚さが140nm程度のITO膜等の透光性の導電膜からなる画素電極9aが形成されている。画素電極9aは、データ線6aと走査線3aとの交差領域の近傍で第2電極層7aと部分的に重なっており、第1絶縁膜47および層間絶縁膜45を貫通するコンタクトホール47aを介して第2電極層7aに導通している。また、コンタクトホール47aの内部において、画素電極9aの表面には、図4〜図6を参照して後述する第2絶縁膜49が形成されている。   On the upper layer side of the first insulating film 47, a pixel electrode 9a made of a light-transmitting conductive film such as an ITO film having a thickness of about 140 nm is formed. The pixel electrode 9a partially overlaps the second electrode layer 7a in the vicinity of the intersection region between the data line 6a and the scanning line 3a, and through the contact hole 47a penetrating the first insulating film 47 and the interlayer insulating film 45. Are electrically connected to the second electrode layer 7a. Further, in the contact hole 47a, a second insulating film 49 described later with reference to FIGS. 4 to 6 is formed on the surface of the pixel electrode 9a.

画素電極9aの表面には配向膜16が形成されている。配向膜16は、ポリイミド等の樹脂膜、あるいはシリコン酸化膜等の斜方蒸着膜からなる。本形態において、配向膜16は、SiOX(x<2)、SiO2、TiO2、MgO、Al23、In23、Sb23、Ta25等の斜方蒸着膜からなる無機配向膜(垂直配向膜)である。 An alignment film 16 is formed on the surface of the pixel electrode 9a. The alignment film 16 is made of a resin film such as polyimide or an oblique deposition film such as a silicon oxide film. In this embodiment, the alignment film 16 is an obliquely deposited film of SiO x (x <2), SiO 2 , TiO 2 , MgO, Al 2 O 3 , In 2 O 3 , Sb 2 O 3 , Ta 2 O 5 or the like. An inorganic alignment film (vertical alignment film).

対向基板20では、石英基板やガラス基板等の透光性の基板本体20wの液晶層50側の表面(素子基板10に対向する側の面)に、ITO膜等の透光性導電膜からなる共通電極21が形成されており、かかる共通電極21を覆うように配向膜26が形成されている。配向膜26は、配向膜16と同様、ポリイミド等の樹脂膜、あるいはシリコン酸化膜等の斜方蒸着膜からなる。本形態において、配向膜26は、SiOX(x<2)、SiO2、TiO2、MgO、Al23、In23、Sb23、Ta25等の斜方蒸着膜からなる無機配向膜(垂直配向膜)である。かかる配向膜16、26は、液晶層50に用いた誘電異方性が負のネマチック液晶化合物を垂直配向させ、液晶パネル100pは、ノーマリブラックのVAモードとして動作する。 The counter substrate 20 is made of a light-transmitting conductive film such as an ITO film on the surface of the light-transmitting substrate body 20 w such as a quartz substrate or a glass substrate on the liquid crystal layer 50 side (surface facing the element substrate 10). A common electrode 21 is formed, and an alignment film 26 is formed so as to cover the common electrode 21. Similar to the alignment film 16, the alignment film 26 is made of a resin film such as polyimide or an oblique deposition film such as a silicon oxide film. In this embodiment, the alignment film 26 is an obliquely deposited film such as SiO x (x <2), SiO 2 , TiO 2 , MgO, Al 2 O 3 , In 2 O 3 , Sb 2 O 3 , Ta 2 O 5. An inorganic alignment film (vertical alignment film). The alignment films 16 and 26 vertically align the nematic liquid crystal compound having negative dielectric anisotropy used for the liquid crystal layer 50, and the liquid crystal panel 100p operates as a normally black VA mode.

なお、図1および図2を参照して説明したデータ線駆動回路101および走査線駆動回路104には、nチャネル型の駆動用トランジスターとpチャネル型の駆動用トランジスターとを備えた相補型トランジスター回路等が構成されている。ここで、駆動用トランジスターは、画素トランジスター30の製造工程の一部を利用して形成されたものである。このため、素子基板10においてデータ線駆動回路101および走査線駆動回路104が形成されている領域も、図3(b)に示す断面構成と略同様な断面構成を有している。   Note that the data line driving circuit 101 and the scanning line driving circuit 104 described with reference to FIGS. 1 and 2 are complementary transistor circuits each including an n-channel driving transistor and a p-channel driving transistor. Etc. are configured. Here, the driving transistor is formed by utilizing a part of the manufacturing process of the pixel transistor 30. Therefore, the region where the data line driving circuit 101 and the scanning line driving circuit 104 are formed in the element substrate 10 also has a cross-sectional configuration substantially similar to the cross-sectional configuration shown in FIG.

(画素電極9a周辺の詳細構成)
図4は、本発明を適用した液晶装置100における画素電極9a周辺の断面構成を拡大して示す説明図である。
(Detailed configuration around the pixel electrode 9a)
FIG. 4 is an explanatory diagram showing an enlarged cross-sectional configuration around the pixel electrode 9a in the liquid crystal device 100 to which the present invention is applied.

図4に示すように、本形態の液晶装置100においては、第2電極層7aの上層側には透光性の層間絶縁膜45が形成されており、層間絶縁膜45の上層側には、透光性の第1絶縁膜47が形成されている。第1絶縁膜47の上層側には、画素電極9aが形成されており、画素電極9aは、第1絶縁膜47および層間絶縁膜45を貫通するコンタクトホール47aを介して第2電極層7aに導通している。層間絶縁膜45の表面は、化学機械的研磨等の方法で平坦面になっており、かかる平坦面上に第1絶縁膜47が形成されている。また、画素電極9aは、第1絶縁膜47のうち、平坦部分47eの表面に形成されている。より具体的には、第1絶縁膜47は、画素電極9aが位置する部分が凹部47gになっており、かかる凹部47gの底部において、画素電極9aに下層側で重なる部分は平坦部分47eになっている。このため、画素電極9aの表面は平坦面になっている。   As shown in FIG. 4, in the liquid crystal device 100 of the present embodiment, a translucent interlayer insulating film 45 is formed on the upper layer side of the second electrode layer 7a, and on the upper layer side of the interlayer insulating film 45, A translucent first insulating film 47 is formed. A pixel electrode 9 a is formed on the upper layer side of the first insulating film 47, and the pixel electrode 9 a is connected to the second electrode layer 7 a through a contact hole 47 a that penetrates the first insulating film 47 and the interlayer insulating film 45. Conducted. The surface of the interlayer insulating film 45 is a flat surface by a method such as chemical mechanical polishing, and the first insulating film 47 is formed on the flat surface. Further, the pixel electrode 9 a is formed on the surface of the flat portion 47 e of the first insulating film 47. More specifically, in the first insulating film 47, the portion where the pixel electrode 9a is located is a recess 47g, and the portion of the bottom of the recess 47g that overlaps the pixel electrode 9a on the lower layer side is a flat portion 47e. ing. For this reason, the surface of the pixel electrode 9a is a flat surface.

また、第1絶縁膜47において、凹部47g(平坦部分47e)に挟まれた部分は、幅寸法が0.5μm程度の凸部47fになっている。ここで、凸部47fは、隣り合う画素電極9aにより挟まれた画素間領域10f内で連続的に延在しており、画素電極9aにより挟まれた凹部(画素間領域10f)を埋めている。また、凸部47fの高さ寸法は、画素電極9aの厚さと同一であり、約140nmである。このため、画素電極9aの表面と凸部47fの上端面とは、連続した平坦面を構成している。   Further, in the first insulating film 47, a portion sandwiched between the concave portions 47g (flat portion 47e) is a convex portion 47f having a width dimension of about 0.5 μm. Here, the convex portion 47f extends continuously in the inter-pixel region 10f sandwiched between the adjacent pixel electrodes 9a, and fills the concave portion (inter-pixel region 10f) sandwiched between the pixel electrodes 9a. . The height dimension of the convex portion 47f is the same as the thickness of the pixel electrode 9a and is about 140 nm. For this reason, the surface of the pixel electrode 9a and the upper end surface of the convex portion 47f constitute a continuous flat surface.

また、コンタクトホール47aの内部では、画素電極9aの表面側に第2絶縁膜49が形成されており、画素電極9aの表面において、コンタクトホール47aに起因する凹部を埋めている。   Further, in the contact hole 47a, a second insulating film 49 is formed on the surface side of the pixel electrode 9a, and a recess caused by the contact hole 47a is filled in the surface of the pixel electrode 9a.

このように本形態では、画素電極9aは、第1絶縁膜47の平坦部分47eに形成されており、画素電極9aの表面は平坦面である。また、画素電極9aにより挟まれた凹部(画素間領域10f)は、第1絶縁膜47の凸部47fによって埋められ、画素電極9aの表面と凸部47fの上端面とは、連続した平坦面を構成している。さらに、画素電極9aの表面において、コンタクトホール47aに起因する凹凸は、第2絶縁膜49によって緩和されている。従って、本形態では、配向膜16を無機材料から形成する際、連続した平坦面に対して斜方蒸着を行うことになるので、配向膜16を好適に形成することができる。また、配向膜16をポリイミド等の有機材料から形成した際、配向膜16の表面が連続した平坦面になっているので、ラビング処理を適正に行うことができる。それ故、液晶層50を好適に配向させることができる。   Thus, in this embodiment, the pixel electrode 9a is formed on the flat portion 47e of the first insulating film 47, and the surface of the pixel electrode 9a is a flat surface. Further, the concave portion (inter-pixel region 10f) sandwiched between the pixel electrodes 9a is filled with the convex portion 47f of the first insulating film 47, and the surface of the pixel electrode 9a and the upper end surface of the convex portion 47f are continuous flat surfaces. Is configured. Further, the unevenness caused by the contact hole 47 a on the surface of the pixel electrode 9 a is relaxed by the second insulating film 49. Therefore, in this embodiment, when forming the alignment film 16 from an inorganic material, oblique vapor deposition is performed on a continuous flat surface, and therefore the alignment film 16 can be preferably formed. Moreover, when the alignment film 16 is formed from an organic material such as polyimide, the surface of the alignment film 16 is a continuous flat surface, so that the rubbing process can be performed appropriately. Therefore, the liquid crystal layer 50 can be suitably aligned.

(液晶装置100の製造方法)
図5および図6は、本発明を適用した液晶装置100の製造工程の要部を示す説明図である。なお、以下に説明する工程は、素子基板10を多数取りできる大型基板の状態で行われるが、以下の説明では、サイズにかかわらず、素子基板10として説明する。
(Manufacturing method of the liquid crystal device 100)
5 and 6 are explanatory views showing the main part of the manufacturing process of the liquid crystal device 100 to which the present invention is applied. In addition, although the process demonstrated below is performed in the state of the large sized substrate which can take many element substrates 10, in the following description, it demonstrates as the element substrate 10 irrespective of size.

本形態の液晶装置100の製造工程のうち、素子基板10を形成する工程では、周知の方法により、図5(a)に示すように、層間絶縁膜45までを形成した後、層間絶縁膜45の表面を研磨し、平坦化する。   Of the manufacturing steps of the liquid crystal device 100 of the present embodiment, in the step of forming the element substrate 10, as shown in FIG. 5A, up to the interlayer insulating film 45 is formed by a known method, and then the interlayer insulating film 45. The surface of is polished and flattened.

次に、図5(a)、(b)に示す第1絶縁膜工程において、隣り合う画素電極9aにより挟まれた画素間領域10fに沿って延在する凸部47fを備えた第1絶縁膜47(図4参照)を形成する。より具体的には、図5(a)に示すように、層間絶縁膜45の上層にシリコン酸化膜等の絶縁膜47wを形成した後、画素間領域10fと重なる領域にレジストマスク470を形成する。本形態では、絶縁膜47wを約500nm程度の厚さに形成する。また、本形態では、絶縁膜47wとして、例えば、テトラエトキシシランと酸素ガスとを用いたプラズマCVD法等により形成したノンドープのシリコン酸化膜等を形成する。   Next, in the first insulating film step shown in FIGS. 5A and 5B, a first insulating film provided with a protrusion 47f extending along the inter-pixel region 10f sandwiched between adjacent pixel electrodes 9a. 47 (see FIG. 4) is formed. More specifically, as shown in FIG. 5A, after an insulating film 47w such as a silicon oxide film is formed on the interlayer insulating film 45, a resist mask 470 is formed in a region overlapping the inter-pixel region 10f. . In this embodiment, the insulating film 47w is formed to a thickness of about 500 nm. In this embodiment, as the insulating film 47w, for example, a non-doped silicon oxide film formed by a plasma CVD method using tetraethoxysilane and oxygen gas or the like is formed.

次に、絶縁膜47wの表面にレジストマスク470を形成した状態で、絶縁膜47wをエッチングした後、レジストマスク470を除去する。その結果、画素間領域10fにより囲まれた領域(画素電極9a)が形成される領域に凹部47gが形成され、その結果として、格子状の凸部47fを備えた第1絶縁膜47が形成される。本形態において、凸部47fの高さ寸法は約400nm程度であり、幅寸法は0.5μm程度である。   Next, with the resist mask 470 formed on the surface of the insulating film 47w, the insulating film 47w is etched, and then the resist mask 470 is removed. As a result, a concave portion 47g is formed in a region where the region (pixel electrode 9a) surrounded by the inter-pixel region 10f is formed, and as a result, the first insulating film 47 including the lattice-shaped convex portion 47f is formed. The In the present embodiment, the height of the protrusion 47f is about 400 nm, and the width is about 0.5 μm.

次に、コンタクトホール形成工程では、第1絶縁膜47の表面にレジストマスク(図示せず)を形成し、この状態で、第1絶縁膜47をエッチングした後、レジストマスクを除去し、図5(c)に示すように、第1絶縁膜47および層間絶縁膜46を貫通するコンタクトホール47aを形成する。   Next, in the contact hole forming step, a resist mask (not shown) is formed on the surface of the first insulating film 47. In this state, the first insulating film 47 is etched, and then the resist mask is removed. As shown in FIG. 3C, a contact hole 47a penetrating the first insulating film 47 and the interlayer insulating film 46 is formed.

次に、図5(d)に示す導電膜成膜工程では、画素電極9aを構成する導電膜9として、ITO膜等の透光性の導電膜9をスパッタ法等により成膜する。その結果、導電膜9は、コンタクトホール47aの底部で第2電極層7aと導通する。導電膜9の厚さは、例えば140nm程度である。   Next, in the conductive film forming step shown in FIG. 5D, a light-transmitting conductive film 9 such as an ITO film is formed by sputtering or the like as the conductive film 9 constituting the pixel electrode 9a. As a result, the conductive film 9 is electrically connected to the second electrode layer 7a at the bottom of the contact hole 47a. The thickness of the conductive film 9 is, for example, about 140 nm.

次に、図6(a)に示す第2絶縁膜工程では、導電膜9の表面側にシリコン酸化膜等の絶縁膜からなる第2絶縁膜49を成膜する。第2絶縁膜49の厚さは、導電膜9の厚さより大であり、例えば150nm程度である。第2絶縁膜49は、例えば、リンおよびボロンのうちの少なくとも一方がドープされたシリケートガラスであり、かかるシリケートガラスは、常圧CVD法等により形成することができる。かかるシリケートガラスのうち、リンドープトシリケートガラス(PSG膜)を形成する場合の使用ガスは、SiH4、PH3、O3等である。ボロンドープトシリケートガラス(BSG膜)を形成する場合の使用ガスは、SiH4、B26、O3等であり、ボロン・リンドープトシリケートガラス膜(BPSG膜)を形成する場合の使用ガスは、SiH4、B26、PH3、O3等である。 Next, in the second insulating film step shown in FIG. 6A, a second insulating film 49 made of an insulating film such as a silicon oxide film is formed on the surface side of the conductive film 9. The thickness of the second insulating film 49 is larger than the thickness of the conductive film 9, and is about 150 nm, for example. The second insulating film 49 is, for example, silicate glass doped with at least one of phosphorus and boron, and such silicate glass can be formed by an atmospheric pressure CVD method or the like. Among such silicate glasses, the gas used for forming the phosphorus-doped silicate glass (PSG film) is SiH 4 , PH 3 , O 3, or the like. The gas used when forming boron-doped silicate glass (BSG film) is SiH 4 , B 2 H 6 , O 3, etc., and the gas used when forming boron-phosphorous-doped silicate glass film (BPSG film). Are SiH 4 , B 2 H 6 , PH 3 , O 3 and the like.

次に、図6(b)に示す研磨工程では、第2絶縁膜49を表面側から研磨して第1絶縁膜47の凸部47fを露出させ、第2絶縁膜49および導電膜9を画素間領域10fで分割する。その結果、分割された導電膜9によって画素電極9aが形成される。本形態では、第1絶縁膜47の凸部47fが露出した以降も研磨を行って凸部47fの高さ寸法を低くするが、導電膜9(画素電極9a)の表面に第2絶縁膜49が薄く残っているうちに研磨を停止する。本形態では、導電膜9(画素電極9a)の表面に第2絶縁膜49が約50nm程度の厚さで残っているうちに研磨を停止する。その結果、凸部47fの高さ寸法は、約200nm程度まで低くなる。   Next, in the polishing step shown in FIG. 6B, the second insulating film 49 is polished from the surface side to expose the convex portions 47f of the first insulating film 47, and the second insulating film 49 and the conductive film 9 are formed into pixels. The area is divided by the intermediate area 10f. As a result, the pixel electrode 9 a is formed by the divided conductive film 9. In the present embodiment, polishing is performed after the protrusion 47f of the first insulating film 47 is exposed to reduce the height dimension of the protrusion 47f, but the second insulating film 49 is formed on the surface of the conductive film 9 (pixel electrode 9a). Stop polishing while remains thin. In this embodiment, the polishing is stopped while the second insulating film 49 remains on the surface of the conductive film 9 (pixel electrode 9a) with a thickness of about 50 nm. As a result, the height of the protrusion 47f is reduced to about 200 nm.

かかる研磨工程においては、化学機械研磨を利用でき、化学機械研磨では、研磨液に含まれる化学成分の作用と、研磨剤と素子基板10との相対移動によって、高速で平滑な研磨面を得ることができる。より具体的には、研磨装置において、不織布、発泡ポリウレタン、多孔質フッ素樹脂等からなる研磨布(パッド)を貼り付けた定盤と、素子基板10を保持するホルダーとを相対回転させながら、研磨を行なう。その際、例えば、平均粒径が0.01〜20μmの酸化セリウム粒子、分散剤としてのアクリル酸エステル誘導体、および水を含む研磨剤を研磨布と素子基板10との間に供給する。   In this polishing process, chemical mechanical polishing can be used. In chemical mechanical polishing, a smooth polishing surface can be obtained at high speed by the action of chemical components contained in the polishing liquid and the relative movement between the abrasive and the element substrate 10. Can do. More specifically, in a polishing apparatus, polishing is performed while relatively rotating a surface plate on which a polishing cloth (pad) made of nonwoven fabric, polyurethane foam, porous fluororesin, or the like is attached and a holder for holding the element substrate 10. To do. At that time, for example, an abrasive containing cerium oxide particles having an average particle diameter of 0.01 to 20 μm, an acrylate derivative as a dispersant, and water is supplied between the polishing cloth and the element substrate 10.

かかる研磨の際、画素電極9aと重なる領域では、第2絶縁膜49のみが研磨されるのに対して、画素間領域10fと重なる領域では、第2絶縁膜49および導電膜9を研磨した後、第1絶縁膜47の凸部47fが研磨されることになる。   In such polishing, only the second insulating film 49 is polished in the region overlapping with the pixel electrode 9a, whereas the second insulating film 49 and the conductive film 9 are polished in the region overlapping with the inter-pixel region 10f. The convex portion 47f of the first insulating film 47 is polished.

このようにして画素電極9aを形成した時点で、画素電極9aに起因する凹凸がかなり緩和されているので、この状態で配向膜16を形成してもよい。但し、本形態では、凸部47fに相当する箇所は、第2絶縁膜49が残っている箇所よりわずかに高い位置にある。そこで、本形態では、研磨工程の後、図6(c)、(d)を参照して以下に説明する工程を行うことによって、凹凸を解消してから配向膜16を形成する。   Since the unevenness caused by the pixel electrode 9a is considerably relaxed when the pixel electrode 9a is formed in this manner, the alignment film 16 may be formed in this state. However, in this embodiment, the portion corresponding to the convex portion 47f is slightly higher than the portion where the second insulating film 49 remains. Therefore, in this embodiment, after the polishing step, the steps described below with reference to FIGS. 6C and 6D are performed, so that the alignment film 16 is formed after the unevenness is eliminated.

より具体的には、研磨工程の後、図6(c)に示す導電膜エッチング工程において、第2絶縁膜49と凸部47fとの間で露出する導電膜9の端部(画素電極9aの端部9e)をエッチングする。かかるエッチングでは、ウエットエッチングおよびドライエッチングのいずれをも用いることができる。但し、導電膜9(画素電極9a)と絶縁膜(第1絶縁膜47および第2絶縁膜49)との間にエッチング選択性があることが望ましいことから、ウエットエッチングが好ましい。   More specifically, after the polishing step, in the conductive film etching step shown in FIG. 6C, the end of the conductive film 9 exposed between the second insulating film 49 and the protrusion 47f (the pixel electrode 9a The edge 9e) is etched. In such etching, either wet etching or dry etching can be used. However, wet etching is preferable because it is desirable to have etching selectivity between the conductive film 9 (pixel electrode 9a) and the insulating film (the first insulating film 47 and the second insulating film 49).

次に、図6(d)に示す絶縁膜エッチング工程では、凸部47fの高さ寸法が導電膜9(画素電極9a)の厚さ寸法と同一となるまで第1絶縁膜47をエッチングする。その際、第2絶縁膜49もエッチングされる。かかるエッチングでは、ウエットエッチングおよびドライエッチングのいずれをも用いることができる。但し、導電膜9(画素電極9a)と絶縁膜(第1絶縁膜47および第2絶縁膜49)との間におけるエッチング選択性が高いことが望ましいことから、ウエットエッチングが好ましい。その結果、画素電極9aはエッチングされずに、凸部47fの高さ寸法が導電膜9(画素電極9a)の厚さ寸法と同一となる。また、画素電極9aと重なる領域の第2絶縁膜49は除去される。従って、画素電極9aの表面と凸部47fの上端面とは、連続した平坦面を構成することになる。なお、コンタクトホール47aの内部には第2絶縁膜49の一部49cが残るので、画素電極9aの表面において、コンタクトホール47aに起因する凹凸が緩和される。   Next, in the insulating film etching step shown in FIG. 6D, the first insulating film 47 is etched until the height dimension of the convex portion 47f becomes the same as the thickness dimension of the conductive film 9 (pixel electrode 9a). At that time, the second insulating film 49 is also etched. In such etching, either wet etching or dry etching can be used. However, since it is desirable that the etching selectivity between the conductive film 9 (pixel electrode 9a) and the insulating film (the first insulating film 47 and the second insulating film 49) is high, wet etching is preferable. As a result, the pixel electrode 9a is not etched, and the height dimension of the projection 47f is the same as the thickness dimension of the conductive film 9 (pixel electrode 9a). Further, the second insulating film 49 in the region overlapping with the pixel electrode 9a is removed. Therefore, the surface of the pixel electrode 9a and the upper end surface of the convex portion 47f constitute a continuous flat surface. In addition, since a part 49c of the second insulating film 49 remains inside the contact hole 47a, the unevenness caused by the contact hole 47a is relaxed on the surface of the pixel electrode 9a.

しかる後に、図4に示すように配向膜16を形成する。なお、それ以降の工程は、周知の方法を利用できるので、説明を省略する。   Thereafter, an alignment film 16 is formed as shown in FIG. In addition, since the process after that can use a well-known method, description is abbreviate | omitted.

(本形態の主な効果)
以上説明したように、本形態によれば、画素間領域10fに沿って延在する凸部47fを備えた第1絶縁膜47を形成した後、第1絶縁膜47にコンタクトホール47aを形成し、その後、導電膜9および第2絶縁膜49を順次積層する。次に、研磨工程では、凸部47fが露出するまで研磨し、第2絶縁膜49および導電膜9を凸部47f(画素間領域10f)により分割する。その結果、分割された導電膜9によって画素電極9aが形成され、かかる画素電極9aの間(画素間領域10f)には第1絶縁膜47の凸部47fが残る。従って、画素電極9aに起因する凹凸は、第1絶縁膜47の凸部47fによって緩和される。また、本形態によれば、コンタクトホール47a内では、画素電極9aの表面に第2絶縁膜49の一部49cが残るので、コンタクトホール47aに起因する凹凸は、コンタクトホール47a内の第2絶縁膜49によって緩和される。それ故、配向膜16を形成する際、平坦な面上に配向膜を形成することができ、その結果、配向膜16の表面も平坦となる。
(Main effects of this form)
As described above, according to this embodiment, after forming the first insulating film 47 having the protrusions 47f extending along the inter-pixel region 10f, the contact hole 47a is formed in the first insulating film 47. Thereafter, the conductive film 9 and the second insulating film 49 are sequentially stacked. Next, in the polishing step, polishing is performed until the convex portion 47f is exposed, and the second insulating film 49 and the conductive film 9 are divided by the convex portion 47f (inter-pixel region 10f). As a result, pixel electrodes 9a are formed by the divided conductive films 9, and the protrusions 47f of the first insulating film 47 remain between the pixel electrodes 9a (inter-pixel region 10f). Accordingly, the unevenness caused by the pixel electrode 9 a is alleviated by the convex portion 47 f of the first insulating film 47. Further, according to this embodiment, since the part 49c of the second insulating film 49 remains on the surface of the pixel electrode 9a in the contact hole 47a, the unevenness caused by the contact hole 47a is not uneven in the second insulating film 49a. Relaxed by the membrane 49. Therefore, when the alignment film 16 is formed, the alignment film can be formed on a flat surface. As a result, the surface of the alignment film 16 is also flat.

また、本形態では、導電膜9の表面に第2絶縁膜49を形成しておくので、導電膜9の表面は研磨されない。それ故、画素電極9aの厚さは、研磨によって変動せず、導電膜9を成膜した際の厚さによって制御される。それ故、透過型の液晶装置100においては、画素電極9aを構成する透光性導電膜の分光特性が変動しないので、かかる分光特性の変動に起因する画像の品位低下を防止することができる。   Further, in this embodiment, since the second insulating film 49 is formed on the surface of the conductive film 9, the surface of the conductive film 9 is not polished. Therefore, the thickness of the pixel electrode 9a is not changed by polishing, but is controlled by the thickness when the conductive film 9 is formed. Therefore, in the transmissive liquid crystal device 100, the spectral characteristics of the translucent conductive film constituting the pixel electrode 9a do not vary, so that it is possible to prevent image quality degradation due to the variation in spectral characteristics.

また、本形態では、研磨工程の後、第2絶縁膜49と第1凸部47fとの間で露出する導電膜9(画素電極9aの端部9e)をエッチングする導電膜エッチング工程と、凸部47fの高さ寸法が導電膜9(画素電極9a)の厚さ寸法と同一となるまで第1絶縁膜47および第2絶縁膜49をエッチングする絶縁膜エッチング工程とを行う。このため、凸部47fの高さ寸法は、画素電極9aの厚さ寸法と同一であるため、画素電極9aの間(画素間領域10f)と重なる領域は、第1絶縁膜47の凸部47fによって完全に平坦化される。   Further, in this embodiment, after the polishing process, a conductive film etching process for etching the conductive film 9 (end part 9e of the pixel electrode 9a) exposed between the second insulating film 49 and the first convex part 47f; An insulating film etching step for etching the first insulating film 47 and the second insulating film 49 is performed until the height dimension of the portion 47f becomes equal to the thickness dimension of the conductive film 9 (pixel electrode 9a). For this reason, since the height dimension of the convex part 47f is the same as the thickness dimension of the pixel electrode 9a, the area overlapping between the pixel electrodes 9a (inter-pixel area 10f) is the convex part 47f of the first insulating film 47. Is completely flattened.

また、本形態では、第2絶縁膜49は、リンおよびボロンのうちの少なくとも一方がドープされたシリケートガラスであるため、第1絶縁膜47に比して、研磨速度が速い。それ故、第2絶縁膜49を形成する際の厚さに対するマージンが大きいという利点がある。   In this embodiment, since the second insulating film 49 is silicate glass doped with at least one of phosphorus and boron, the polishing rate is higher than that of the first insulating film 47. Therefore, there is an advantage that a margin with respect to the thickness when forming the second insulating film 49 is large.

[他の実施の形態]
上記実施の形態では、透過型の液晶装置100に本発明を適用した例を説明したが、反射型の液晶装置100に本発明を適用してもよい。この場合でも、本形態によれば、画素電極9aの厚さは、研磨によって変動せず、導電膜9を成膜した際の厚さによって制御される。それ故、液晶層50の厚さが変動しないので、液晶層50の厚さ変動に起因する画像の品位低下を防止することができる。また、上記実施の形態では、液晶装置100に本発明を適用した例を説明したが、有機エレクトロルミネッセンス装置等の液晶装置以外の電気光学装置に本発明を適用してもよい。
[Other embodiments]
In the above embodiment, the example in which the present invention is applied to the transmissive liquid crystal device 100 has been described. However, the present invention may be applied to the reflective liquid crystal device 100. Even in this case, according to this embodiment, the thickness of the pixel electrode 9a is not changed by polishing, but is controlled by the thickness when the conductive film 9 is formed. Therefore, since the thickness of the liquid crystal layer 50 does not vary, it is possible to prevent image quality deterioration due to the thickness variation of the liquid crystal layer 50. In the above embodiment, the example in which the present invention is applied to the liquid crystal device 100 has been described. However, the present invention may be applied to an electro-optical device other than a liquid crystal device such as an organic electroluminescence device.

[電子機器への構成例]
上述した実施形態に係る液晶装置100を備えた電子機器について説明する。図7は、本発明を適用した液晶装置100を用いた投射型表示装置の概略構成図であり、図7(a)、(b)は各々、透過型の液晶装置100を用いた投射型表示装置の説明図、および反射型の液晶装置100を用いた投射型表示装置の説明図である。
[Configuration example for electronic devices]
An electronic apparatus including the liquid crystal device 100 according to the above-described embodiment will be described. FIG. 7 is a schematic configuration diagram of a projection type display device using the liquid crystal device 100 to which the present invention is applied. FIGS. 7A and 7B are respectively a projection type display using the transmission type liquid crystal device 100. FIG. 2 is an explanatory diagram of the device and an explanatory diagram of a projection display device using the reflective liquid crystal device 100.

(投射型表示装置の第1例)
図7(a)に示す投射型表示装置110は、観察者側に設けられたスクリーン111に光を照射し、このスクリーン111で反射した光を観察する、いわゆる投影型の投射型表示装置である。投射型表示装置110は、光源112を備えた光源部130と、ダイクロイックミラー113、114と、液晶ライトバルブ115〜117(液晶装置100)と、投射光学系118と、クロスダイクロイックプリズム119と、リレー系120とを備えている。
(First example of projection display device)
The projection display device 110 shown in FIG. 7A is a so-called projection type projection display device that irradiates light onto a screen 111 provided on the viewer side and observes light reflected by the screen 111. . The projection display device 110 includes a light source unit 130 including a light source 112, dichroic mirrors 113 and 114, liquid crystal light valves 115 to 117 (liquid crystal device 100), a projection optical system 118, a cross dichroic prism 119, and a relay. System 120.

光源112は、赤色光、緑色光及び青色光を含む光を供給する超高圧水銀ランプで構成されている。ダイクロイックミラー113は、光源112からの赤色光を透過させると共に緑色光及び青色光を反射する構成となっている。また、ダイクロイックミラー114は、ダイクロイックミラー113で反射された緑色光及び青色光のうち青色光を透過させると共に緑色光を反射する構成となっている。このように、ダイクロイックミラー113、114は、光源112から出射した光を赤色光と緑色光と青色光とに分離する色分離光学系を構成する。   The light source 112 is composed of an ultrahigh pressure mercury lamp that supplies light including red light, green light, and blue light. The dichroic mirror 113 is configured to transmit red light from the light source 112 and reflect green light and blue light. The dichroic mirror 114 is configured to transmit blue light and reflect green light among the green light and the blue light reflected by the dichroic mirror 113. Thus, the dichroic mirrors 113 and 114 constitute a color separation optical system that separates the light emitted from the light source 112 into red light, green light, and blue light.

ここで、ダイクロイックミラー113と光源112との間には、インテグレーター121及び偏光変換素子122が光源112から順に配置されている。インテグレーター121は、光源112から照射された光の照度分布を均一化する構成となっている。また、偏光変換素子122は、光源112からの光を例えばs偏光のような特定の振動方向を有する偏光にする構成となっている。   Here, between the dichroic mirror 113 and the light source 112, an integrator 121 and a polarization conversion element 122 are sequentially arranged from the light source 112. The integrator 121 is configured to uniformize the illuminance distribution of the light emitted from the light source 112. Further, the polarization conversion element 122 is configured to change the light from the light source 112 into polarized light having a specific vibration direction such as s-polarized light.

液晶ライトバルブ115は、ダイクロイックミラー113を透過して反射ミラー123で反射した赤色光を画像信号に応じて変調する透過型の液晶装置100である。液晶ライトバルブ115は、λ/2位相差板115a、第1偏光板115b、液晶パネル115c及び第2偏光板115dを備えている。ここで、液晶ライトバルブ115に入射する赤色光は、ダイクロイックミラー113を透過しても光の偏光は変化しないことから、s偏光のままである。   The liquid crystal light valve 115 is a transmissive liquid crystal device 100 that modulates red light transmitted through the dichroic mirror 113 and reflected by the reflection mirror 123 in accordance with an image signal. The liquid crystal light valve 115 includes a λ / 2 phase difference plate 115a, a first polarizing plate 115b, a liquid crystal panel 115c, and a second polarizing plate 115d. Here, the red light incident on the liquid crystal light valve 115 remains s-polarized light because the polarization of the light does not change even if it passes through the dichroic mirror 113.

λ/2位相差板115aは、液晶ライトバルブ115に入射したs偏光をp偏光に変換する光学素子である。また、第1偏光板115bは、s偏光を遮断してp偏光を透過させる偏光板である。そして、液晶パネル115cは、p偏光を画像信号に応じた変調によってs偏光(中間調であれば円偏光又は楕円偏光)に変換する構成となっている。さらに、第2偏光板115dは、p偏光を遮断してs偏光を透過させる偏光板である。したがって、液晶ライトバルブ115は、画像信号に応じて赤色光を変調し、変調した赤色光をクロスダイクロイックプリズム119に向けて出射する構成となっている。   The λ / 2 phase difference plate 115a is an optical element that converts s-polarized light incident on the liquid crystal light valve 115 into p-polarized light. The first polarizing plate 115b is a polarizing plate that blocks s-polarized light and transmits p-polarized light. The liquid crystal panel 115c is configured to convert p-polarized light into s-polarized light (circularly polarized light or elliptically polarized light in the case of halftone) by modulation according to the image signal. Furthermore, the second polarizing plate 115d is a polarizing plate that blocks p-polarized light and transmits s-polarized light. Therefore, the liquid crystal light valve 115 is configured to modulate the red light according to the image signal and emit the modulated red light toward the cross dichroic prism 119.

なお、λ/2位相差板115a及び第1偏光板115bは、偏光を変換させない透光性のガラス板115eに接した状態で配置されており、λ/2位相差板115a及び第1偏光板115bが発熱によって歪むのを回避することができる。   Note that the λ / 2 phase difference plate 115a and the first polarizing plate 115b are disposed in contact with a light-transmitting glass plate 115e that does not convert polarized light, and the λ / 2 phase difference plate 115a and the first polarizing plate 115b. It is possible to avoid distortion of 115b due to heat generation.

液晶ライトバルブ116は、ダイクロイックミラー113で反射した後にダイクロイックミラー114で反射した緑色光を画像信号に応じて変調する透過型の液晶装置100である。そして、液晶ライトバルブ116は、液晶ライトバルブ115と同様に、第1偏光板116b、液晶パネル116c及び第2偏光板116dを備えている。液晶ライトバルブ116に入射する緑色光は、ダイクロイックミラー113、114で反射されて入射するs偏光である。第1偏光板116bは、p偏光を遮断してs偏光を透過させる偏光板である。また、液晶パネル116cは、s偏光を画像信号に応じた変調によってp偏光(中間調であれば円偏光又は楕円偏光)に変換する構成となっている。そして、第2偏光板116dは、s偏光を遮断してp偏光を透過させる偏光板である。したがって、液晶ライトバルブ116は、画像信号に応じて緑色光を変調し、変調した緑色光をクロスダイクロイックプリズム119に向けて出射する構成となっている。   The liquid crystal light valve 116 is a transmissive liquid crystal device 100 that modulates green light reflected by the dichroic mirror 114 after being reflected by the dichroic mirror 113 in accordance with an image signal. Similarly to the liquid crystal light valve 115, the liquid crystal light valve 116 includes a first polarizing plate 116b, a liquid crystal panel 116c, and a second polarizing plate 116d. Green light incident on the liquid crystal light valve 116 is s-polarized light that is reflected by the dichroic mirrors 113 and 114 and then incident. The first polarizing plate 116b is a polarizing plate that blocks p-polarized light and transmits s-polarized light. The liquid crystal panel 116c is configured to convert s-polarized light into p-polarized light (circularly polarized light or elliptically polarized light in the case of halftone) by modulation according to the image signal. The second polarizing plate 116d is a polarizing plate that blocks s-polarized light and transmits p-polarized light. Accordingly, the liquid crystal light valve 116 is configured to modulate green light in accordance with the image signal and emit the modulated green light toward the cross dichroic prism 119.

液晶ライトバルブ117は、ダイクロイックミラー113で反射し、ダイクロイックミラー114を透過した後でリレー系120を経た青色光を画像信号に応じて変調する透過型の液晶装置100である。そして、液晶ライトバルブ117は、液晶ライトバルブ115、116と同様に、λ/2位相差板117a、第1偏光板117b、液晶パネル117c及び第2偏光板117dを備えている。ここで、液晶ライトバルブ117に入射する青色光は、ダイクロイックミラー113で反射してダイクロイックミラー114を透過した後にリレー系120の後述する2つの反射ミラー125a、125bで反射することから、s偏光となっている。   The liquid crystal light valve 117 is a transmissive liquid crystal device 100 that modulates blue light reflected by the dichroic mirror 113 and transmitted through the dichroic mirror 114 and then through the relay system 120 in accordance with an image signal. Similarly to the liquid crystal light valves 115 and 116, the liquid crystal light valve 117 includes a λ / 2 retardation film 117a, a first polarizing plate 117b, a liquid crystal panel 117c, and a second polarizing plate 117d. Here, since the blue light incident on the liquid crystal light valve 117 is reflected by the two reflecting mirrors 125a and 125b described later of the relay system 120 after being reflected by the dichroic mirror 113 and transmitted through the dichroic mirror 114, the s-polarized light is reflected. It has become.

λ/2位相差板117aは、液晶ライトバルブ117に入射したs偏光をp偏光に変換する光学素子である。また、第1偏光板117bは、s偏光を遮断してp偏光を透過させる偏光板である。そして、液晶パネル117cは、p偏光を画像信号に応じた変調によってs偏光(中間調であれば円偏光又は楕円偏光)に変換する構成となっている。さらに、第2偏光板117dは、p偏光を遮断してs偏光を透過させる偏光板である。したがって、液晶ライトバルブ117は、画像信号に応じて青色光を変調し、変調した青色光をクロスダイクロイックプリズム119に向けて出射する構成となっている。なお、λ/2位相差板117a及び第1偏光板117bは、ガラス板117eに接した状態で配置されている。   The λ / 2 phase difference plate 117a is an optical element that converts s-polarized light incident on the liquid crystal light valve 117 into p-polarized light. The first polarizing plate 117b is a polarizing plate that blocks s-polarized light and transmits p-polarized light. The liquid crystal panel 117c is configured to convert p-polarized light into s-polarized light (circularly polarized light or elliptically polarized light in the case of halftone) by modulation according to the image signal. Furthermore, the second polarizing plate 117d is a polarizing plate that blocks p-polarized light and transmits s-polarized light. Accordingly, the liquid crystal light valve 117 is configured to modulate blue light in accordance with an image signal and emit the modulated blue light toward the cross dichroic prism 119. The λ / 2 phase difference plate 117a and the first polarizing plate 117b are disposed in contact with the glass plate 117e.

リレー系120は、リレーレンズ124a、124bと反射ミラー125a、125bとを備えている。リレーレンズ124a、124bは、青色光の光路が長いことによる光損失を防止するために設けられている。ここで、リレーレンズ124aは、ダイクロイックミラー114と反射ミラー125aとの間に配置されている。また、リレーレンズ124bは、反射ミラー125a、125bの間に配置されている。反射ミラー125aは、ダイクロイックミラー114を透過してリレーレンズ124aから出射した青色光をリレーレンズ124bに向けて反射するように配置されている。また、反射ミラー125bは、リレーレンズ124bから出射した青色光を液晶ライトバルブ117に向けて反射するように配置されている。   The relay system 120 includes relay lenses 124a and 124b and reflection mirrors 125a and 125b. The relay lenses 124a and 124b are provided to prevent light loss due to a long blue light path. Here, the relay lens 124a is disposed between the dichroic mirror 114 and the reflection mirror 125a. The relay lens 124b is disposed between the reflection mirrors 125a and 125b. The reflection mirror 125a is disposed so as to reflect the blue light transmitted through the dichroic mirror 114 and emitted from the relay lens 124a toward the relay lens 124b. The reflection mirror 125b is arranged to reflect the blue light emitted from the relay lens 124b toward the liquid crystal light valve 117.

クロスダイクロイックプリズム119は、2つのダイクロイック膜119a、119bをX字型に直交配置した色合成光学系である。ダイクロイック膜119aは青色光を反射して緑色光を透過する膜であり、ダイクロイック膜119bは赤色光を反射して緑色光を透過する膜である。したがって、クロスダイクロイックプリズム119は、液晶ライトバルブ115〜117のそれぞれで変調された赤色光と緑色光と青色光とを合成し、投射光学系118に向けて出射するように構成されている。   The cross dichroic prism 119 is a color combining optical system in which two dichroic films 119a and 119b are arranged orthogonally in an X shape. The dichroic film 119a is a film that reflects blue light and transmits green light, and the dichroic film 119b is a film that reflects red light and transmits green light. Therefore, the cross dichroic prism 119 is configured to combine the red light, the green light, and the blue light modulated by the liquid crystal light valves 115 to 117 and emit the resultant light toward the projection optical system 118.

なお、液晶ライトバルブ115、117からクロスダイクロイックプリズム119に入射する光はs偏光であり、液晶ライトバルブ116からクロスダイクロイックプリズム119に入射する光はp偏光である。このようにクロスダイクロイックプリズム119に入射する光を異なる種類の偏光としていることで、クロスダイクロイックプリズム119において各液晶ライトバルブ115〜117から入射する光を合成できる。ここで、一般に、ダイクロイック膜119a、119bはs偏光の反射トランジスター特性に優れている。このため、ダイクロイック膜119a、119bで反射される赤色光及び青色光をs偏光とし、ダイクロイック膜119a、119bを透過する緑色光をp偏光としている。投射光学系118は、投影レンズ(図示略)を有しており、クロスダイクロイックプリズム119で合成された光をスクリーン111に投射するように構成されている。   Note that light incident on the cross dichroic prism 119 from the liquid crystal light valves 115 and 117 is s-polarized light, and light incident on the cross dichroic prism 119 from the liquid crystal light valve 116 is p-polarized light. Thus, by making the light incident on the cross dichroic prism 119 into different types of polarized light, the light incident from the liquid crystal light valves 115 to 117 in the cross dichroic prism 119 can be synthesized. Here, in general, the dichroic films 119a and 119b are excellent in s-polarized reflection transistor characteristics. Therefore, red light and blue light reflected by the dichroic films 119a and 119b are s-polarized light, and green light transmitted through the dichroic films 119a and 119b is p-polarized light. The projection optical system 118 has a projection lens (not shown) and is configured to project the light combined by the cross dichroic prism 119 onto the screen 111.

(投射型表示装置の第2例)
図7(b)に示す投射型表示装置1000において、光源部890は、システム光軸Lに沿って光源810、インテグレーターレンズ820および偏光変換素子830が配置された偏光照明装置800を有している。また、光源部890は、システム光軸Lに沿って、偏光照明装置800から出射されたs偏光光束をs偏光光束反射面841により反射させる偏光ビームスプリッター840と、偏光ビームスプリッター840のs偏光光束反射面841から反射された光のうち、青色光(B)の成分を分離するダイクロイックミラー842と、青色光が分離された後の光束のうち、赤色光(R)の成分を反射させて分離するダイクロイックミラー843とを有している。
(Second example of projection display device)
In the projection display device 1000 shown in FIG. 7B, the light source unit 890 includes a polarization illumination device 800 in which a light source 810, an integrator lens 820, and a polarization conversion element 830 are arranged along the system optical axis L. . The light source unit 890 also reflects the s-polarized light beam emitted from the polarization illumination device 800 along the system optical axis L by the s-polarized light beam reflection surface 841 and the s-polarized light beam of the polarization beam splitter 840. Of the light reflected from the reflecting surface 841, the dichroic mirror 842 that separates the blue light (B) component and the red light (R) component of the luminous flux after the blue light is separated are separated. And a dichroic mirror 843.

また、投射型表示装置1000は、各色光が入射する3つの反射型の液晶装置100(液晶装置100R、100G、100B)を備えており、光源部890は、3つの液晶装置100(液晶装置100R、100G、100B)に所定の色光を供給する。   The projection display device 1000 includes three reflective liquid crystal devices 100 (liquid crystal devices 100R, 100G, and 100B) on which each color light is incident, and the light source unit 890 includes three liquid crystal devices 100 (liquid crystal devices 100R). , 100G, 100B).

かかる投射型表示装置1000においては、3つの液晶装置100R、100G、100Bにて変調された光をダイクロイックミラー842、843、および偏光ビームスプリッター840にて合成した後、この合成光を投射光学系850によってスクリーン860等の被投射部材に投射する。   In the projection display apparatus 1000, the light modulated by the three liquid crystal devices 100R, 100G, and 100B is synthesized by the dichroic mirrors 842 and 843 and the polarization beam splitter 840, and then the synthesized light is projected by the projection optical system 850. Is projected onto a projection target member such as a screen 860.

(他の投射型表示装置)
なお、投射型表示装置については、光源部として、各色の光を出射するLED光源等を用い、かかるLED光源から出射された色光を各々、別の液晶装置に供給するように構成してもよい。
(Other projection display devices)
In addition, about a projection type display apparatus, you may comprise the LED light source etc. which radiate | emit the light of each color as a light source part, and supply each color light radiate | emitted from this LED light source to another liquid crystal device. .

(他の電子機器)
本発明を適用した液晶装置100については、上記の電子機器の他にも、携帯電話機、情報携帯端末(PDA:Personal Digital Assistants)、デジタルカメラ、液晶テレビ、カーナビゲーション装置、テレビ電話、POS端末、タッチパネルを備えた機器等の電子機器において直視型表示装置として用いてもよい。
(Other electronic devices)
As for the liquid crystal device 100 to which the present invention is applied, in addition to the electronic devices described above, mobile phones, personal digital assistants (PDAs), digital cameras, liquid crystal televisions, car navigation devices, video phones, POS terminals, You may use as a direct view type | mold display apparatus in electronic devices, such as an apparatus provided with the touch panel.

9・・導電膜、9a・・画素電極、10・・素子基板、10f・・画素間領域、10w・・基板本体、30・・画素トランジスター、47・・第1絶縁膜、47a・・コンタクトホール、47f・・凸部、47g・・凹部、49・・第2絶縁膜、100・・液晶装置、110、1000・・投射型表示装置 9 .. Conductive film, 9a ... Pixel electrode, 10 ... Element substrate, 10f ... Inter pixel area, 10w ... Substrate body, 30 ... Pixel transistor, 47 ... First insulation film, 47a ... Contact hole ··· 47f ··· convex portion, 47g ··· concave portion, 49 ··· second insulating film, 100 · · liquid crystal device, 110, 1000 ··· projection display device

Claims (10)

基板の一方面側に、少なくとも格子状の凸部を備えた第1絶縁膜を形成する第1絶縁膜形成工程と、
該第1絶縁膜を貫通するコンタクトホールを形成するコンタクトホール形成工程と、
前記第1絶縁膜に対して前記基板と反対側に画素電極を構成する導電膜を成膜する導電膜成膜工程と、
前記導電膜に対して前記第1絶縁膜と反対側に第2絶縁膜を成膜する第2絶縁膜成膜工程と、
前記導電膜および前記第2絶縁膜を前記凸部が露出するまで研磨して前記導電膜を前記凸部により分割して前記画素電極を形成する研磨工程と、
を有することを特徴とする電気光学装置の製造方法。
A first insulating film forming step of forming a first insulating film provided with at least lattice-shaped convex portions on one surface side of the substrate;
A contact hole forming step of forming a contact hole penetrating the first insulating film;
A conductive film forming step of forming a conductive film constituting a pixel electrode on the opposite side of the substrate with respect to the first insulating film;
A second insulating film forming step of forming a second insulating film on the opposite side of the conductive film to the first insulating film;
Polishing the conductive film and the second insulating film until the convex portions are exposed, and dividing the conductive film by the convex portions to form the pixel electrodes;
A method for manufacturing an electro-optical device.
前記研磨工程の後、前記第2絶縁膜と前記凸部との間で露出する前記導電膜をエッチングする導電膜エッチング工程と、前記凸部と前記導電膜とが平坦な面を形成するまで第1絶縁膜および前記第2絶縁膜をエッチングする絶縁膜エッチング工程と、を行うことを特徴とする請求項1に記載の電気光学装置の製造方法。   After the polishing step, a conductive film etching step for etching the conductive film exposed between the second insulating film and the convex portion, and until the convex portion and the conductive film form a flat surface. The method of manufacturing an electro-optical device according to claim 1, wherein an insulating film etching step of etching the first insulating film and the second insulating film is performed. 前記第2絶縁膜は、リンおよびボロンのうちの少なくとも一方がドープされたシリケートガラスであることを特徴とする請求項1または2に記載の電気光学装置の製造方法。   3. The method of manufacturing an electro-optical device according to claim 1, wherein the second insulating film is a silicate glass doped with at least one of phosphorus and boron. 前記導電膜は、透光性導電膜であることを特徴とする請求項1乃至3の何れか一項に記載の電気光学装置の製造方法。   The method of manufacturing an electro-optical device according to claim 1, wherein the conductive film is a light-transmitting conductive film. 前記導電膜は、反射性導電膜であることを特徴とする請求項1乃至3の何れか一項に記載の電気光学装置の製造方法。   The method of manufacturing an electro-optical device according to claim 1, wherein the conductive film is a reflective conductive film. 基板と、
該基板の一方面側に設けられた複数の画素電極と、
前記複数の画素電極と前記基板との間に設けられ、前記複数の画素電極のうち、隣り合う画素電極により挟まれた画素間領域内で延在する凸部、およびコンタクトホールが形成された第1絶縁膜と、
前記コンタクトホール内において前記画素電極に対して前記基板とは反対側で重なる第2絶縁膜と、
を有することを特徴とする電気光学装置。
A substrate,
A plurality of pixel electrodes provided on one side of the substrate;
Protrusions provided between the plurality of pixel electrodes and the substrate and extending in an inter-pixel region sandwiched between adjacent pixel electrodes among the plurality of pixel electrodes, and contact holes are formed. 1 insulating film;
A second insulating film overlapping the pixel electrode on the opposite side of the substrate in the contact hole;
An electro-optical device comprising:
前記凸部と前記画素電極とが平坦な面を形成することを特徴とする請求項6に記載の電気光学装置。   The electro-optical device according to claim 6, wherein the convex portion and the pixel electrode form a flat surface. 前記第2絶縁膜は、リンおよびボロンのうちの少なくとも一方がドープされたシリケートガラスであることを特徴とする請求項6または7に記載の電気光学装置。   8. The electro-optical device according to claim 6, wherein the second insulating film is a silicate glass doped with at least one of phosphorus and boron. 請求項6乃至8の何れか一項に記載の電気光学装置を備えた投射型表示装置であって、
前記液晶装置に照射される照明光を出射する光源部と、前記液晶装置により変調された光を投射する投射光学系と、を有していることを特徴とする投射型表示装置。
A projection display device comprising the electro-optical device according to any one of claims 6 to 8,
A projection-type display device comprising: a light source unit that emits illumination light applied to the liquid crystal device; and a projection optical system that projects light modulated by the liquid crystal device.
請求項6乃至8の何れか一項に記載の電気光学装置を備えたことを特徴とする電子機器。   An electronic apparatus comprising the electro-optical device according to claim 6.
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