JP2012085401A - 保護継電器 - Google Patents
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Abstract
【解決手段】本発明の実施形態に係る保護継電器は、入力電流の大きさを変換し、アナログ信号として出力する入力変流器と、入力変流器から出力されたアナログ信号を、所定のアナログ信号を示す所定アナログ信号に変換するアナログ変換回路と、アナログ変換回路により変換された所定アナログ信号をデジタル信号に変換するA/D変換回路と、A/D変換回路により変換されたデジタル信号に基づいて演算処理を行う演算処理回路と、演算処理回路の演算結果に応じて接点出力を動作させるリレー出力回路とを備える。
さらに、アナログ変換回路は、入力変流器から出力されたアナログ信号を、負性の抵抗値を持つ負性抵抗回路を介して受信する。
【選択図】図1
Description
第1の実施形態における保護継電器の構成について図1を用いて説明する。図1は保護継電器の構成を示すブロック図である。保護継電器は入力変流器1、負性抵抗回路8、アナログ変換回路2、A/D変換回路3、演算処理回路4、リレー出力回路5、接点出力6から構成されている。
(一般的な変流器は変流器一次巻線抵抗r1≒0とし無視できる。)
ここで、
Ima :変流器飽和電流(Arms)
Em :変流器飽和時の入力電圧(Vrms)
ω :角周波数(rad/s)
f :入力周波数(Hz)
N1 :変流器一次巻線の巻回数18(T)
N2 :変流器二次巻線の巻回数19(T)
S :鉄心断面積(cm2)
Bm :最大磁束密度(Wb/m2)
φ :変流器鉄心発生磁束(Wb)
Zin :変流器入力インピーダンス(Ω)
r1 :変流器一次巻線抵抗16の抵抗値(Ω)
r2 :変流器二次巻線抵抗17の抵抗値(Ω)
ZL :変流器二次負荷インピーダンス21の抵抗値(Ω)
としている。
式(8)から負性抵抗回路8の合成インピーダンスr3は、式(9)のように示され負性の抵抗値を持つことになる。図3に示すように、負性抵抗回路8を設置しているため、負性の抵抗値である負性抵抗回路8の合成インピーダンス26により変流器二次巻線抵抗17をキャンセルできる。
ここで、
Vi :負性抵抗回路8に入力される電圧(V0P)
Vo :負性抵抗回路8から出力される電圧(V0P)
I2 :変流器二次側に流れる電流(A0P)
Z1 :抵抗22の抵抗値(Ω)
Z2 :抵抗23の抵抗値(Ω)
Z3 :抵抗24の抵抗値(Ω)
r3 :負性抵抗回路8の合成インピーダンス26(Ω)
である。
系統事故電流I1ad=100Arms、系統周波数f=50Hz、変流器飽和電流Ima=180Arms、変流器一次巻回数N1=1T、変流器二次巻回数N2=3000T、変流器二次巻線抵抗r2=210Ω、変流器二次負荷インピーダンスZL=10Ωを条件とすると、式(10)から変流器一次側に系統事故電流I1adが流れた場合の変流器二次側電流I2ad≒94.3mA0Pとなる。
ここで、
K :オーバーサイズファクター
ω :角周波数(rad/s)
T :無飽和期待時間(ms)
である。
式(12)から直流電流が100%重畳しても飽和しない飽和限界電流Imda≒31.5Armsとなる。
式(13)から変流器一次側に飽和限界電流Imdaが流れた場合の変流器二次側電流I2ad’≒29.7mA0Pとなり、変流器一次側に飽和限界電流Imdaが流れた場合の変流器二次側電流I2ad’と式(14)から変流器飽和時の変流器二次側電圧E2’≒6.5V0Pとなり、これが変流器二次側に発生可能な電圧値を示す。
ここで、r2+ZL>r2+r3になるようr3の定数を選定するため、負性抵抗回路8を設けた場合は、(r2+ZL)/(r2+r3)だけ飽和限界電流Imdaを大きくできる。
第2の実施形態の保護継電器について図5を用いて説明する。本実施形態の構成が第1の実施形態と異なる点は、負性抵抗回路8にNTCサーミスタ30を追加した点である。
ここで、
Z1 :抵抗22の抵抗値(Ω)
Z2 :抵抗23の抵抗値(Ω)
Z3 :抵抗24の抵抗値(Ω)
Z4 :NTCサーミスタ30の抵抗値(Ω)
r3 :負性抵抗回路8の合成インピーダンス26の抵抗値(Ω)
である。
2 :アナログ変換回路
3 :A/D変換回路
4 :演算処理回路
5 :リレー出力回路
6 :出力接点
8 :負性抵抗回路
9 :入力端子
10 :入力端子
11 :変流器一次巻線
12 :変流器二次巻線
14 :出力端子
15 :出力端子
16 :変流器一次巻線抵抗
17 :変流器二次巻線抵抗
18 :変流器一次巻回数
19 :変流器二次巻回数
20 :変流器二次励磁インピーダンス
21 :変流器二次負荷インピーダンス
22 :抵抗
23 :抵抗
24 :抵抗
25 :オペアンプ
26 :負性抵抗8の合成インピーダンス
27 :npn型トランジスタ
28 :pnp型トランジスタ
29 :パワーブースタ回路
30 :NTCサーミスタ
Claims (6)
- 入力電流の大きさを変換し、アナログ信号として出力する入力変流器と、
前記入力変流器から出力された前記アナログ信号を、所定のアナログ信号を示す所定アナログ信号に変換するアナログ変換回路と、
前記アナログ変換回路により変換された所定アナログ信号をデジタル信号に変換するA/D変換回路と、
前記A/D変換回路により変換されたデジタル信号に基づいて演算処理を行う演算処理回路と、
前記演算処理回路の演算結果に応じて接点出力を動作させるリレー出力回路と、
を備える保護継電器において、
前記アナログ変換回路は、前記入力変流器から出力された前記アナログ信号を、負性の抵抗値を持つ負性抵抗回路を介して受信する保護継電器。 - 前記負性抵抗回路は、オペアンプおよび複数の抵抗器を備える請求項1記載の保護継電器。
- 前記アナログ変換回路は、前記入力変流器から出力された前記アナログ信号を、前記負性抵抗回路およびパワーブースタ回路を介して受信し、
前記パワーブースタ回路は、前記アナログ信号の強度を増大させて出力する保護継電器。 - 前記負性抵抗回路は、マイナスの温度係数を持つサーミスタを備える請求項1乃至3のいずれか1項に記載の保護継電器。
- 前記サーミスタは、前記負性抵抗回路を構成する抵抗器と直列に接続する請求項4記載の保護継電器。
- 前記サーミスタは、温度変化に伴う前記入力変流器巻線の抵抗値の変化を補償する請求項4または5記載の保護継電器。
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- 2010-10-07 JP JP2010227986A patent/JP5643592B2/ja active Active
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