JP2010211322A5 - ネットワークプロセッサ - Google Patents
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Claims (1)
- 受信データを記憶する格納領域を具備し、前記格納領域の位置を指定するディスクリプタを記憶する外部メモリと接続されたネットワークプロセッサであって、
前記ディスクリプタのうちの複数のディスクリプタを記憶するディスクリプタ格納回路と、
前記複数のディスクリプタを前記外部メモリから前記ディスクリプタ格納回路へDMA(Direct Memory Access)転送して、前記受信データを受信すると、前記ディスクリプタ格納回路に記憶された前記複数のディスクリプタの各々に基づいて前記受信データを前記外部メモリの前記格納領域へDMA転送して、前記受信データを前記外部メモリへDMA転送する度に当該受信データの状態を示す受信ステータスを生成するDMA制御回路と、
前記受信ステータスを格納する受信ステータス格納回路と、
前記受信ステータス格納回路に格納された前記受信ステータスを結合する受信ステータス結合制御回路と、
を備え、
前記DMA制御回路は、前記結合された受信ステータスを前記外部メモリへDMA転送する
ネットワークプロセッサ。
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Family Applications (1)
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