JP2010088231A - Driver circuit and its protection method - Google Patents

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Abstract

<P>PROBLEM TO BE SOLVED: To provide a protection method for preventing damage of a switching element by preventing an increase of surge voltage due to sudden stop. <P>SOLUTION: A driver circuit includes: a DC chopper circuit for transforming an input voltage supplied from outside, and for output of a transformed power; and an inverter for generating an AC drive power from a power input from the DC chopper circuit, and for output of the drive power to a driving object. The driver circuit also includes a drive current limiting means limiting a drive current which the inverter outputs to any value not more than a prescribed upper limit value when the voltage of input power is determined to drop to a threshold set to be higher than the operation limit voltage. <P>COPYRIGHT: (C)2010,JPO&INPIT

Description

本発明は、直流チョッパ回路及びインバータから構成されたドライバ回路及びその保護方法に関する。   The present invention relates to a driver circuit including a DC chopper circuit and an inverter, and a protection method thereof.

下記特許文献1には、車両用空調装置に設けられたモータドライバの短絡事故による過電流の流入を防止すると共に、安定化電源回路のアースの確保を確実にするモータドライバ保護回路が開示されている。このモータドライバ保護回路は、安定化電源回路から供給された電力によってアクチュエータモータの駆動を制御するモータドライバを備えており、当該モータドライバの第1グランド端子は、第1アース配線によってコントロールユニットの第2グランド端子に接続され、外部の第1アース接続点にアースされるようになっている。一方、安定化電源回路では、安定化電源回路に接続する第2アース配線が上記第1アース配線に接続されることでコントロールユニットの外部のアース接続点に接続すると共に、第2アース接続点に接続するパワートランジスタユニットに上記第2アース接続点が接続し、断線回避用ダイオードが、第2アース配線とパワートランジスタユニットの間に、そのカソードがパワートランジスタユニット側となるように設けられている。このような構成によって、モータドライバに短絡が発生しても、安定化電源回路によって過電流がモータドライバへ流れることがなく、また安定化電源回路と第1アース接続点との接続が断たれても、第2アース接続点へ接続しており、安定化電源回路のアースが確保される。
特開平9−93798号公報
Patent Document 1 below discloses a motor driver protection circuit that prevents inflow of an overcurrent due to a short circuit accident of a motor driver provided in a vehicle air conditioner and ensures the grounding of a stabilized power circuit. Yes. The motor driver protection circuit includes a motor driver that controls driving of the actuator motor by electric power supplied from the stabilized power supply circuit, and the first ground terminal of the motor driver is connected to the first of the control unit by the first ground wiring. 2 is connected to the ground terminal and grounded to the external first ground connection point. On the other hand, in the stabilized power supply circuit, the second ground wiring connected to the stabilized power supply circuit is connected to the first ground wiring so as to connect to the ground connection point outside the control unit, and to the second ground connection point. The second ground connection point is connected to the power transistor unit to be connected, and the disconnection avoidance diode is provided between the second ground wiring and the power transistor unit so that the cathode is on the power transistor unit side. With such a configuration, even if a short circuit occurs in the motor driver, an overcurrent does not flow to the motor driver due to the stabilized power circuit, and the connection between the stabilized power circuit and the first ground connection point is disconnected. Are connected to the second ground connection point, and the ground of the stabilized power supply circuit is secured.
JP-A-9-93798

ところで、上記従来技術は、安定化電源回路がモータドライバへ過電流が流れないように電流を制御し、かつ安定化電源回路と第2アース接続点との接続を確保することによって安定化電源回路の安定的な動作を確保して、モータドライバを保護している。しかしながら、このようなドライバ回路(上記安定化電源回路及びモータドライバに相当)では、電源がバッテリである場合に、モータを駆動している最中にバッテリから供給されるドライバ入力電圧が、時間とともに低下するという現象が発生する。   By the way, the above-mentioned prior art controls the stabilized power circuit by controlling the current so that no overcurrent flows to the motor driver and securing the connection between the stabilized power circuit and the second ground connection point. Ensures stable operation and protects the motor driver. However, in such a driver circuit (corresponding to the above-described stabilized power supply circuit and motor driver), when the power source is a battery, the driver input voltage supplied from the battery during driving of the motor increases with time. The phenomenon that it falls is generated.

そして、ドライバ入力電圧がドライバ運転可能範囲外まで低下してしまうと、ドライバ回路では、内部の制御機構が停止し、それに伴って電力変換処理を停止する。すると、バッテリからのドライバ入力電流が停止してしまい、ドライバ回路を構成するスイッチング素子のコネクタ電圧には、コネクタ端子が接続する配線のインダクタンス成分の影響によって大きなサージ電圧が生じる。そして、この大きなサージ電圧によってスイッチング素子が破損してしまうことがあった。このように、上記従来技術には、ドライバ入力電圧の低下により発生するサージ電圧によってスイッチング素子が破損してしまうという課題が残されている。   And if a driver input voltage falls outside a driver driving | operation possible range, an internal control mechanism will stop in a driver circuit, and a power conversion process will be stopped in connection with it. Then, the driver input current from the battery is stopped, and a large surge voltage is generated in the connector voltage of the switching element constituting the driver circuit due to the influence of the inductance component of the wiring connected to the connector terminal. Then, the switching element may be damaged by this large surge voltage. As described above, the above-described prior art still has a problem that the switching element is damaged by the surge voltage generated by the decrease in the driver input voltage.

本発明は、上述した事情に鑑みてなされたものであり、不意な停止に起因するサージ電圧の増大を防ぐことによってスイッチング素子の破損を防ぐことが出来るものを提供することを目的とする。   The present invention has been made in view of the above-described circumstances, and an object of the present invention is to provide a device that can prevent damage to a switching element by preventing an increase in surge voltage caused by an unexpected stop.

上記目的を達成するために、本発明では、ドライバ回路に係る第1の解決手段として、外部から供給される入力電力を変圧し、変圧した電力を出力する直流チョッパ回路と、前記直流チョッパ回路から入力された電力から交流の駆動電力を生成し、当該駆動電力を駆動対象へ出力するインバータとを有するドライバ回路であって、運転限界電圧より高い電圧に設定されたしきい値まで、前記入力電力の電圧が低下したと判断すると、前記インバータが出力する駆動電流を所定の上限値以下に制限する駆動電流制限手段とを、
具備するという手段を採用する。
In order to achieve the above object, in the present invention, as a first solution means for a driver circuit, a DC chopper circuit that transforms input power supplied from the outside and outputs the transformed power, and the DC chopper circuit, A driver circuit having an inverter that generates alternating current drive power from input power and outputs the drive power to a drive target, up to the threshold set to a voltage higher than the operation limit voltage, the input power Driving current limiting means for limiting the driving current output from the inverter to a predetermined upper limit value or less,
A means of providing is adopted.

本発明では、ドライバ回路に係る第2の解決手段として、上記第1の解決手段において、前記駆動電流制限手段は、電流操作量の最大値を制限することによって、前記インバータが出力する前記駆動電流を所定の上限値以下に制限する
という手段を採用する。
In the present invention, as the second solving means relating to the driver circuit, in the first solving means, the driving current limiting means limits the maximum value of the current manipulated variable, thereby limiting the driving current output from the inverter. The method of limiting the value to a predetermined upper limit value or less is adopted.

本発明では、ドライバ回路に係る第3の解決手段として、上記第1または第2の解決手段において、前記駆動電流制限手段は、運転限界電圧より高い電圧に設定されたしきい値まで、前記入力電力の電圧が低下したと判断すると、駆動電流を制限する旨の通知信号を外部へ出力するという手段を採用する。   In the present invention, as a third solving means related to the driver circuit, in the first or second solving means, the driving current limiting means is configured to input the input up to a threshold set to a voltage higher than an operation limit voltage. If it is determined that the power voltage has decreased, a means for outputting a notification signal for limiting the drive current to the outside is employed.

本発明では、ドライバ回路に係る第4の解決手段として、上記第1〜第3いずれかの解決手段において、前記直流チョッパ回路は、昇圧チョッパ回路、降圧チョッパ回路及び昇降圧チョッパ回路のいずれかであるこという手段を採用する。   In the present invention, as a fourth solving means relating to the driver circuit, in any one of the first to third solving means, the DC chopper circuit is any one of a step-up chopper circuit, a step-down chopper circuit, and a step-up / step-down chopper circuit. Adopt a certain means.

また、本発明では、ドライバ回路の保護方法に係る第1の解決手段として、外部から供給される直流の入力電力を変圧し、変圧した電力を出力する直流チョッパ回路と、前記直流チョッパ回路から入力された電力から交流の駆動電力を生成し、当該駆動電力を駆動対象へ出力するインバータとを有するドライバ回路の保護方法であって、運転限界電圧より高い電圧に設定されたしきい値まで、前記入力電力の電圧が低下すると、前記インバータが出力する駆動電流を所定の上限値以下に制限するという手段を採用する。   In the present invention, as a first solving means related to the protection method of the driver circuit, a DC input power supplied from the outside is transformed, and a DC chopper circuit that outputs the transformed power is input from the DC chopper circuit. A method for protecting a driver circuit having an inverter that generates AC drive power from the generated power and outputs the drive power to a drive target, up to a threshold set to a voltage higher than the operation limit voltage, When the voltage of the input power decreases, a means for limiting the drive current output from the inverter to a predetermined upper limit value or less is adopted.

本発明によれば、ドライバ回路が、運転限界電圧より高い電圧に設定されたしきい値まで、入力電力の電圧が低下したと判断すると、前記インバータが出力する駆動電流を所定の上限値以下に制限する駆動電流制限手段を具備することによって、入力電力の電圧の低下によって生じる直流チョッパ回路の制御系の停止を防ぐことが出来る。そして、直流チョッパ回路の制御系の停止を防ぐことで、サージ電圧の増大によるスイッチング素子の破損を防ぐことが出来る。   According to the present invention, when the driver circuit determines that the voltage of the input power has decreased to a threshold set to a voltage higher than the operation limit voltage, the drive current output by the inverter is set to a predetermined upper limit value or less. By providing the drive current limiting means for limiting, it is possible to prevent the control system of the DC chopper circuit from being stopped due to a decrease in the voltage of the input power. Further, by preventing the control system of the DC chopper circuit from being stopped, it is possible to prevent damage to the switching element due to an increase in surge voltage.

以下、図面を参照して、本発明の一実施形態について説明する。
図1は、本実施形態に係るドライバ回路Aの構成を示す回路図である。まず、ドライバ回路Aの回路構成について、図1を参照して、説明する。
ドライバ回路Aは、バッテリBから供給される直流のドライバ入力電力によって負荷である永久磁石同期モータCを回転駆動させるものであり、図1に示すように昇圧チョッパ回路1、インバータ2、U相電流検出部3、V相電流検出部4、W相電流検出部5、電圧センサ6及びインバータ制御部7を備えている。なお、永久磁石同期モータCには、回転位置検出部Dが設けられており、この回転位置検出部Dは、永久磁石同期モータCの回転子の回転位置を検出し、後述するドライバ回路Aの速度算出部7iへ当該回転位置を示す回転位置検出信号θを出力する。
Hereinafter, an embodiment of the present invention will be described with reference to the drawings.
FIG. 1 is a circuit diagram showing a configuration of a driver circuit A according to the present embodiment. First, the circuit configuration of the driver circuit A will be described with reference to FIG.
The driver circuit A rotates a permanent magnet synchronous motor C, which is a load, by DC driver input power supplied from a battery B. As shown in FIG. 1, the booster chopper circuit 1, inverter 2, U-phase current A detection unit 3, a V-phase current detection unit 4, a W-phase current detection unit 5, a voltage sensor 6 and an inverter control unit 7 are provided. The permanent magnet synchronous motor C is provided with a rotational position detector D. The rotational position detector D detects the rotational position of the rotor of the permanent magnet synchronous motor C. A rotational position detection signal θ indicating the rotational position is output to the speed calculator 7i.

昇圧チョッパ回路1は、バッテリBから供給されたドライバ入力電力の電圧を昇圧してインバータ2へ供給するものであり、チョッパ入力端子1a‐1,1a‐2,チョークコイル1b、スイッチングトランジスタ1c、MOSFET1d、平滑コンデンサ1e、チョッパ出力端子1f‐1,1f‐2から構成されている。
チョッパ入力端子1a‐1,1a‐2は、昇圧チョッパ回路1へドライバ入力電力を入力するための一対の接続端子であり、一方のチョッパ入力端子1a‐1はバッテリBの正極端に接続され、他方のチョッパ入力端子1a‐2は上記バッテリBの負極端に接続されている。
The step-up chopper circuit 1 boosts the voltage of the driver input power supplied from the battery B and supplies it to the inverter 2. The chopper input terminals 1a-1, 1a-2, choke coil 1b, switching transistor 1c, MOSFET 1d , A smoothing capacitor 1e, and chopper output terminals 1f-1 and 1f-2.
The chopper input terminals 1a-1 and 1a-2 are a pair of connection terminals for inputting driver input power to the step-up chopper circuit 1. One chopper input terminal 1a-1 is connected to the positive terminal of the battery B, The other chopper input terminal 1a-2 is connected to the negative terminal of the battery B.

チョークコイル1bは、一端が一方のチョッパ入力端子1a‐1に接続され、他端がスイッチングトランジスタ1cのコレクタ端子に接続されている。スイッチングトランジスタ1cは、コレクタ端子がチョークコイル1bの他端及びMOSFET1dのソース端子に接続され、エミッタ端子が他方のチョッパ入力端子1a‐2に接続されている。そして、スイッチングトランジスタ1cのベース端子は、昇圧チョッパ回路制御部(図示略)に接続され、制御信号としてのPWM信号がインバータ制御部7から入力される。   The choke coil 1b has one end connected to one chopper input terminal 1a-1 and the other end connected to the collector terminal of the switching transistor 1c. The switching transistor 1c has a collector terminal connected to the other end of the choke coil 1b and the source terminal of the MOSFET 1d, and an emitter terminal connected to the other chopper input terminal 1a-2. The base terminal of the switching transistor 1c is connected to a boost chopper circuit control unit (not shown), and a PWM signal as a control signal is input from the inverter control unit 7.

MOSFET1dは、ソース端子が上記チョークコイル1bの他端及びスイッチングトランジスタ1cのコレクタ端子に接続され、ドレイン端子が平滑コンデンサ1eの一端及び一方のチョッパ出力端子1f‐1に接続されている。平滑コンデンサ1eは、上述したように一端がMOSFET1dのドレイン端子及び一方のチョッパ出力端子1f‐1に接続され、他端が他方のチョッパ入力端子1a‐2及び他方のチョッパ出力端子1f‐2並びにスイッチングトランジスタ1cのエミッタ端子に接続されている。すなわち、平滑コンデンサ1eの両端はチョッパ出力端子1f‐1,1f‐2に各々接続されている。チョッパ出力端子1f‐1,1f‐2は、昇圧チョッパ回路1の出力電力をインバータ2へ出力するための一対の接続端子であり、一方のチョッパ出力端子1f‐1はインバータ2の一端に接続され、他方のチョッパ出力端子1f‐2は上記インバータ2の他端に接続されている。   The MOSFET 1d has a source terminal connected to the other end of the choke coil 1b and the collector terminal of the switching transistor 1c, and a drain terminal connected to one end of the smoothing capacitor 1e and one chopper output terminal 1f-1. As described above, the smoothing capacitor 1e has one end connected to the drain terminal of the MOSFET 1d and one chopper output terminal 1f-1, and the other end connected to the other chopper input terminal 1a-2, the other chopper output terminal 1f-2, and switching. It is connected to the emitter terminal of the transistor 1c. That is, both ends of the smoothing capacitor 1e are connected to the chopper output terminals 1f-1 and 1f-2, respectively. The chopper output terminals 1f-1 and 1f-2 are a pair of connection terminals for outputting the output power of the boost chopper circuit 1 to the inverter 2, and one chopper output terminal 1f-1 is connected to one end of the inverter 2. The other chopper output terminal 1f-2 is connected to the other end of the inverter 2.

インバータ2は、インバータ制御部7から入力されるPWM信号に基づいてU相、V相及びW相からなる3相のモータ駆動電力を生成し、当該モータ駆動電力を永久磁石同期モータCへ出力するものであり、インバータ入力端2a‐1,2a‐2、平滑コンデンサ2b、6個のスイッチングトランジスタ2c‐1〜2c‐6及び3つのインバータ出力端子2d‐1〜2d‐3から構成されている。
インバータ入力端2a‐1,2a‐2は、インバータ2へ昇圧チョッパ回路1からの出力電力を入力するための一対の接続端子であり、一方のインバータ入力端2a‐1は昇圧チョッパ回路1のチョッパ出力端子1f‐1に接続され、他方のインバータ入力端2a‐2は昇圧チョッパ回路1のチョッパ出力端子1f‐2に接続されている。
The inverter 2 generates three-phase motor drive power including a U phase, a V phase, and a W phase based on the PWM signal input from the inverter control unit 7 and outputs the motor drive power to the permanent magnet synchronous motor C. It comprises inverter input terminals 2a-1, 2a-2, a smoothing capacitor 2b, six switching transistors 2c-1 to 2c-6, and three inverter output terminals 2d-1 to 2d-3.
The inverter input terminals 2a-1 and 2a-2 are a pair of connection terminals for inputting output power from the boost chopper circuit 1 to the inverter 2. One inverter input terminal 2a-1 is a chopper of the boost chopper circuit 1. The other inverter input terminal 2 a-2 is connected to the output terminal 1 f-1 and is connected to the chopper output terminal 1 f-2 of the boost chopper circuit 1.

平滑コンデンサ2bは、一端が上記一方のインバータ入力端子2a‐1に接続され、他端が他方のインバータ入力端子2a‐2に接続されている。6個のスイッチングトランジスタ2c‐1〜2c‐6は、図示するように平滑コンデンサ2bに対して並列接続される第1〜第3のスイッチングアームを構成している。すなわち、6個のスイッチングトランジスタ2c‐1〜2c‐6のうち、スイッチングトランジスタ2c‐1とスイッチングトランジスタ2c‐2とは第1のスイッチングアームを、スイッチングトランジスタ2c‐3とスイッチングトランジスタ2c‐4とは第2のスイッチングアームを、またスイッチングトランジスタ2c‐5とスイッチングトランジスタ2c‐6とは第3のスイッチングアームをそれぞれ構成している。   The smoothing capacitor 2b has one end connected to the one inverter input terminal 2a-1 and the other end connected to the other inverter input terminal 2a-2. The six switching transistors 2c-1 to 2c-6 constitute first to third switching arms connected in parallel to the smoothing capacitor 2b as shown in the figure. That is, among the six switching transistors 2c-1 to 2c-6, the switching transistor 2c-1 and the switching transistor 2c-2 are the first switching arm, and the switching transistor 2c-3 and the switching transistor 2c-4 are The second switching arm and the switching transistor 2c-5 and the switching transistor 2c-6 constitute a third switching arm, respectively.

第1のスイッチングアームを構成するスイッチングトランジスタ2c‐1は、コレクタ端子が上記一方のインバータ入力端子2a‐1に、エミッタ端子がスイッチングトランジスタ2c‐2のコレクタ端子に、ベース端子がインバータ制御部7にそれぞれ接続されている。そして、スイッチングトランジスタ2c‐2は、コレクタ端子が上述したようにスイッチングトランジスタ2c‐1のエミッタ端子に、エミッタ端子が他方のインバータ入力端子2a‐2に、ベース端子がインバータ制御部7にそれぞれ接続されている。このような第1のスイッチングアームにおいて、スイッチングトランジスタ2c‐1のエミッタ端子とスイッチングトランジスタ2c‐1のコレクタ端子との接続点は、第1のスイッチングアームの出力端である。   The switching transistor 2c-1 constituting the first switching arm has a collector terminal connected to the one inverter input terminal 2a-1, an emitter terminal connected to the collector terminal of the switching transistor 2c-2, and a base terminal connected to the inverter control unit 7. Each is connected. As described above, the switching transistor 2c-2 has a collector terminal connected to the emitter terminal of the switching transistor 2c-1, an emitter terminal connected to the other inverter input terminal 2a-2, and a base terminal connected to the inverter control unit 7. ing. In such a first switching arm, the connection point between the emitter terminal of the switching transistor 2c-1 and the collector terminal of the switching transistor 2c-1 is the output terminal of the first switching arm.

第2のスイッチングアームを構成するスイッチングトランジスタ2c‐3は、コレクタ端子が上記一方のインバータ入力端子2a‐1に、エミッタ端子がスイッチングトランジスタ2c‐4のコレクタ端子に、ベース端子がインバータ制御部7にそれぞれ接続されている。そして、スイッチングトランジスタ2c‐4は、コレクタ端子が上述したようにスイッチングトランジスタ2c‐3のエミッタ端子に、エミッタ端子が他方のインバータ入力端子2a‐2に、ベース端子がインバータ制御部7にそれぞれ接続されている。このような第2のスイッチングアームにおいて、スイッチングトランジスタ2c‐3のエミッタ端子とスイッチングトランジスタ2c‐4のコレクタ端子との接続点は、第2のスイッチングアームの出力端である。   The switching transistor 2c-3 constituting the second switching arm has a collector terminal connected to the one inverter input terminal 2a-1, an emitter terminal connected to the collector terminal of the switching transistor 2c-4, and a base terminal connected to the inverter control unit 7. Each is connected. In the switching transistor 2c-4, the collector terminal is connected to the emitter terminal of the switching transistor 2c-3, the emitter terminal is connected to the other inverter input terminal 2a-2, and the base terminal is connected to the inverter control unit 7 as described above. ing. In such a second switching arm, the connection point between the emitter terminal of the switching transistor 2c-3 and the collector terminal of the switching transistor 2c-4 is the output terminal of the second switching arm.

第3のスイッチングアームを構成するスイッチングトランジスタ2c‐5は、コレクタ端子が上記一方のインバータ入力端子2a‐1に、エミッタ端子がスイッチングトランジスタ2c‐6のコレクタ端子に、ベース端子がインバータ制御部7にそれぞれ接続されている。そして、スイッチングトランジスタ2c‐6は、コレクタ端子が上述したようにスイッチングトランジスタ2c‐5のエミッタ端子に、エミッタ端子が他方のインバータ入力端子2a‐2に、ベース端子がインバータ制御部7にそれぞれ接続されている。このような第3のスイッチングアームにおいて、スイッチングトランジスタ2c‐5のエミッタ端子とスイッチングトランジスタ2c‐6のコレクタ端子との接続点は、第3のスイッチングアームの出力端である。   The switching transistor 2c-5 constituting the third switching arm has a collector terminal connected to the one inverter input terminal 2a-1, an emitter terminal connected to the collector terminal of the switching transistor 2c-6, and a base terminal connected to the inverter controller 7. Each is connected. As described above, the switching transistor 2c-6 has a collector terminal connected to the emitter terminal of the switching transistor 2c-5, an emitter terminal connected to the other inverter input terminal 2a-2, and a base terminal connected to the inverter control unit 7. ing. In such a third switching arm, the connection point between the emitter terminal of the switching transistor 2c-5 and the collector terminal of the switching transistor 2c-6 is the output terminal of the third switching arm.

そして、各スイッチングトランジスタ2c‐1〜2c‐6のベース端子には、インバータ制御部7から制御信号としてのPWM信号が入力される。第1〜第3のスイッチングアームは、各スイッチングトランジスタ2c‐1〜2c‐6が上記PWM信号に基づいてON/OFFすることにより、各出力端に互いに位相差が120°となるU相、V相及びW相の交流のモータ駆動電力を出力する。なお、第1スイッチングアームは、U相のモータ駆動電力を出力し、第2スイッチングアームは、V相のモータ駆動電力を出力し、第3スイッチングアームは、W相のモータ駆動電力を出力する。   A PWM signal as a control signal is input from the inverter control unit 7 to the base terminals of the switching transistors 2c-1 to 2c-6. In the first to third switching arms, each of the switching transistors 2c-1 to 2c-6 is turned on / off based on the PWM signal, so that the phase difference between each of the output ends becomes 120 °, V phase Phase and W phase AC motor drive power is output. The first switching arm outputs U-phase motor driving power, the second switching arm outputs V-phase motor driving power, and the third switching arm outputs W-phase motor driving power.

3つのインバータ出力端子2d‐1〜2d‐3は、上記三相のモータ駆動電力を永久磁石同期モータCへ出力するための接続端子である。各インバータ出力端子2d‐1〜2d‐3のうち、第1のインバータ出力端子2d‐1は上記第1のスイッチングアームの出力端に、第2のインバータ出力端子2d‐2は上記第2のスイッチングアームの出力端に、また第3のインバータ出力端子2d‐3は上記第3のスイッチングアームの出力端にそれぞれ接続されている。このような各インバータ出力端子2d‐1〜2d‐3は、永久磁石同期モータCにそれぞれ接続されており、当該永久磁石同期モータCへU相、V相及びW相の交流のモータ駆動電力を供給する。   The three inverter output terminals 2d-1 to 2d-3 are connection terminals for outputting the three-phase motor drive power to the permanent magnet synchronous motor C. Of the inverter output terminals 2d-1 to 2d-3, the first inverter output terminal 2d-1 is the output terminal of the first switching arm, and the second inverter output terminal 2d-2 is the second switching terminal. The output terminal of the arm and the third inverter output terminal 2d-3 are connected to the output terminal of the third switching arm, respectively. Each of the inverter output terminals 2d-1 to 2d-3 is connected to the permanent magnet synchronous motor C, and U-phase, V-phase, and W-phase AC motor drive power is supplied to the permanent magnet synchronous motor C. Supply.

U相電流検出部3は、インバータ2のインバータ出力端子2d‐1と永久磁石同期モータCのU相固定子巻線とを接続するU相駆動信号線に設けられており、インバータ出力端子2d‐1からU相固定子巻線へ流れるモータ駆動電流Iuを検出してインバータ制御部7へ出力する。V相電流検出部4は、インバータ2のインバータ出力端子2d‐2と永久磁石同期モータCのV相固定子巻線とを接続するV相駆動信号線に設けられており、インバータ出力端子2d‐2からV相固定子巻線へ流れるモータ駆動電流Ivを検出してインバータ制御部7へ出力する。W相電流検出部5は、インバータ2のインバータ出力端子2d‐3と永久磁石同期モータCのW相固定子巻線とを接続するW相駆動信号線に設けられており、インバータ出力端子2d‐3からW相固定子巻線へ流れるモータ駆動電流Iwを検出してインバータ制御部7へ出力する。   The U-phase current detection unit 3 is provided on the U-phase drive signal line that connects the inverter output terminal 2d-1 of the inverter 2 and the U-phase stator winding of the permanent magnet synchronous motor C, and the inverter output terminal 2d- The motor drive current Iu flowing from 1 to the U-phase stator winding is detected and output to the inverter control unit 7. The V-phase current detection unit 4 is provided on a V-phase drive signal line that connects the inverter output terminal 2d-2 of the inverter 2 and the V-phase stator winding of the permanent magnet synchronous motor C, and the inverter output terminal 2d- The motor drive current Iv flowing from 2 to the V-phase stator winding is detected and output to the inverter control unit 7. The W-phase current detection unit 5 is provided on a W-phase drive signal line that connects the inverter output terminal 2d-3 of the inverter 2 and the W-phase stator winding of the permanent magnet synchronous motor C, and the inverter output terminal 2d- The motor drive current Iw flowing from 3 to the W-phase stator winding is detected and output to the inverter control unit 7.

電圧センサ6は、一方の端子がバッテリBの正極端及びチョッパ入力端子1a‐1に接続し、他方の端子がバッテリBの負極端及びチョッパ入力端子1a‐2に接続している。この電圧センサ6は、入力電圧を示す検出信号Svをインバータ制御部7へ出力する。   The voltage sensor 6 has one terminal connected to the positive terminal of the battery B and the chopper input terminal 1a-1, and the other terminal connected to the negative terminal of the battery B and the chopper input terminal 1a-2. The voltage sensor 6 outputs a detection signal Sv indicating the input voltage to the inverter control unit 7.

図2は、本実施形態に係るドライバ回路Aのインバータ制御部7の機能構成を示す機能ブロック図である。インバータ制御部7は、上記インバータ2をPWM制御することによって永久磁石同期モータCの回転を制御するものであり、図2に示すように、3相/2相変換部7a、減算部7b、速度制御部7c、リミッタ7d、q軸電流制御部7e、d軸電流制御部7f、2相/3相変換部7g、PWM信号発生部7h、速度算出部7i及び制限値制御部7j、q軸電圧リミッタ7k及びd軸電圧リミッタ7lから構成されている。なお、電圧センサ6、制限値制御部7j及びリミッタ7dは、本実施形態における駆動電流制限手段を構成している。   FIG. 2 is a functional block diagram showing a functional configuration of the inverter control unit 7 of the driver circuit A according to the present embodiment. The inverter control unit 7 controls the rotation of the permanent magnet synchronous motor C by PWM control of the inverter 2, and as shown in FIG. 2, a three-phase / two-phase conversion unit 7a, a subtraction unit 7b, a speed Controller 7c, limiter 7d, q-axis current controller 7e, d-axis current controller 7f, 2-phase / 3-phase converter 7g, PWM signal generator 7h, speed calculator 7i and limit value controller 7j, q-axis voltage It comprises a limiter 7k and a d-axis voltage limiter 7l. Note that the voltage sensor 6, the limit value control unit 7j, and the limiter 7d constitute drive current limiting means in the present embodiment.

3相/2相変換部7aは、U相電流検出部3、V相電流検出部4、W相電流検出部5によって各々検出されたU相、V相、W相のモータ駆動電流Iu、Iv、Iwに基づいて永久磁石同期モータCの回転子上に固定された2次元座標系(q軸とd軸とからなる座標系)上におけるq軸駆動電流検出量Iqとd軸駆動電流検出量Idとを算出し、q軸駆動電流検出量Iqをq軸電流制御部7eへ出力し、d軸駆動電流検出量Idをd軸電流制御部7fへ出力する。   The three-phase / two-phase converter 7a includes U-phase, V-phase, and W-phase motor drive currents Iu, Iv detected by the U-phase current detector 3, the V-phase current detector 4, and the W-phase current detector 5, respectively. Qw driving current detection amount Iq and d axis driving current detection amount on a two-dimensional coordinate system (coordinate system consisting of q axis and d axis) fixed on the rotor of the permanent magnet synchronous motor C based on Iw Id is calculated, the q-axis drive current detection amount Iq is output to the q-axis current control unit 7e, and the d-axis drive current detection amount Id is output to the d-axis current control unit 7f.

より詳細には、3相/2相変換部7aは、U相、V相及びW相からなる3次元座標系上のモータ駆動電流Iu、Iv、Iwに所定の座標変換を施すことにより上記2次元座標系上のq軸駆動電流検出量Iqとd軸駆動電流検出量Idを算出する。上記q軸は、回転子の回転面上において永久磁石のS極とN極との対向方向に設定された座標軸であり、d軸は、上述したq軸に直交する座標軸である。   More specifically, the three-phase / two-phase conversion unit 7a performs a predetermined coordinate conversion on the motor driving currents Iu, Iv, Iw on the three-dimensional coordinate system including the U phase, the V phase, and the W phase, thereby performing the above 2 processing. A q-axis drive current detection amount Iq and a d-axis drive current detection amount Id on the dimensional coordinate system are calculated. The q axis is a coordinate axis set in the opposing direction of the S pole and the N pole of the permanent magnet on the rotating surface of the rotor, and the d axis is a coordinate axis orthogonal to the q axis described above.

減算部7bは、上位制御装置であるECU(Engine Control Units)から供給される角速度指令値ω0と速度算出部7iから供給される永久磁石同期モータCの回転子の角速度ωkとの差分を速度誤差Δωとして演算し、速度制御部7cへ出力する。
速度制御部7cは、一種のPID制御部であり、上記速度誤差Δωに所定の比例積分・微分演算を施すことにより速度誤差Δωに対応するq軸電流操作量Iqsを算出し、当該q軸電流操作量Iqsをリミッタ7dへ出力する。
The subtractor 7b calculates a difference between the angular velocity command value ω0 supplied from an ECU (Engine Control Units) which is a host controller and the angular velocity ωk of the rotor of the permanent magnet synchronous motor C supplied from the speed calculator 7i as a speed error. It calculates as (DELTA) omega and outputs to the speed control part 7c.
The speed control unit 7c is a kind of PID control unit, calculates a q-axis current manipulated variable Iqs corresponding to the speed error Δω by performing a predetermined proportional integral / differential operation on the speed error Δω, and the q-axis current The manipulated variable Iqs is output to the limiter 7d.

リミッタ7dは、上記q軸電流操作量Iqsの最大値を制限値制御部7jから入力される制限値以下に制限し、q軸電流制御部7eへ出力する。
q軸電流制御部7eは、一種のPID制御部であり、リミッタ7dによって最大値が制限されたq軸電流操作量Iqsと、3相/2相変換部7aから供給されるq軸駆動電流検出量Iqとの差分として誤差電流ΔIqを算出し、当該誤差電流ΔIqに所定の比例積分・微分演算を各々施することにより電圧操作量Vqを算出し、当該電圧操作量Vqをq軸電圧リミッタ7kへ出力する。
The limiter 7d limits the maximum value of the q-axis current manipulated variable Iqs to be equal to or less than the limit value input from the limit value control unit 7j, and outputs the limit value to the q-axis current control unit 7e.
The q-axis current control unit 7e is a kind of PID control unit. The q-axis current operation amount Iqs whose maximum value is limited by the limiter 7d and the q-axis drive current detection supplied from the three-phase / two-phase conversion unit 7a. An error current ΔIq is calculated as a difference from the amount Iq, and the voltage operation amount Vq is calculated by subjecting the error current ΔIq to predetermined proportional integration / differentiation operations, respectively. The voltage operation amount Vq is calculated as a q-axis voltage limiter 7k. Output to.

d軸電流制御部7fは、ECUから供給されるd軸電流操作量Idsと、3相/2相変換部7aから入力されるd軸駆動電流検出量Idとに基づいてd軸電流操作量Idsに対応するd軸電圧操作量Vdを算出し、当該d軸電圧操作量Vdをd軸電圧リミッタ7lへ出力する。
q軸電圧リミッタ7kは、上記電圧操作量Vqの最大値を所定の制限値以下になるように制限し、2相/3相変換部7gへ出力する。
d軸電圧リミッタ7lは、上記電圧操作量Vdの最大値を所定の制限値以下になるように制限し、2相/3相変換部7gへ出力する。
The d-axis current control unit 7f is based on the d-axis current operation amount Ids supplied from the ECU and the d-axis drive current detection amount Ids input from the three-phase / two-phase conversion unit 7a. Is calculated, and the d-axis voltage manipulated variable Vd is output to the d-axis voltage limiter 7l.
The q-axis voltage limiter 7k limits the maximum value of the voltage manipulated variable Vq to be equal to or less than a predetermined limit value, and outputs it to the 2-phase / 3-phase converter 7g.
The d-axis voltage limiter 7l limits the maximum value of the voltage manipulated variable Vd to be equal to or less than a predetermined limit value, and outputs the limit to the two-phase / three-phase converter 7g.

2相/3相変換部7gは、q軸電流制御部7eから入力されたq軸電圧操作量Vqと、d軸電流制御部7fから入力されたd軸電圧操作量Vdとを、U相、V相及びW相からなる3次元座標系上の電圧操作量Vu,Vv,Vwに変換し、当該電圧操作量Vu,Vv,VwをPWM信号発生部7hへ出力する。   The 2-phase / 3-phase converter 7g converts the q-axis voltage manipulated variable Vq input from the q-axis current controller 7e and the d-axis voltage manipulated variable Vd input from the d-axis current controller 7f into the U-phase, The voltage manipulated variables Vu, Vv, Vw are converted into voltage manipulated variables Vu, Vv, Vw on the three-dimensional coordinate system composed of the V phase and the W phase, and the voltage manipulated variables Vu, Vv, Vw are output to the PWM signal generator 7h.

PWM信号発生部7hは、上記電圧操作量Vu,Vv,Vwに基づいてインバータ2をスイッチング動作させるためのPWM信号を生成してインバータ2へ出力する。インバータ制御部7は、正弦波通電方式に基づいて動作するものであり、したがってPWM信号発生部7hは、インバータ2が永久磁石同期モータCの全回転角(360°)に亘ってモータ駆動信号を出力するようにPWM信号を出力する。   The PWM signal generator 7h generates a PWM signal for switching the inverter 2 based on the voltage operation amounts Vu, Vv, Vw and outputs the PWM signal to the inverter 2. The inverter control unit 7 operates based on a sine wave energization method. Therefore, the PWM signal generation unit 7h is configured so that the inverter 2 outputs a motor drive signal over the entire rotation angle (360 °) of the permanent magnet synchronous motor C. A PWM signal is output so as to be output.

速度算出部7iは、回転位置検出部Dから入力される回転位置検出信号θを微分処理することにより、永久磁石同期モータCの回転状態値として角速度ωkを算出し、当該角速度ωkを減算部7bに出力する。
制限値制御部7jは、電圧センサ6から入力された検出信号Svに基づいてドライバ入力電圧が所定のしきい値まで低下したか否か判断し、ドライバ入力電圧がしきい値まで低下すると、所定の上限値まで制限値を下げ、当該制限値をリミッタ7dへ出力する。
The speed calculation unit 7i differentiates the rotational position detection signal θ input from the rotational position detection unit D, thereby calculating the angular speed ωk as the rotational state value of the permanent magnet synchronous motor C, and subtracts the angular speed ωk from the angular speed ωk. Output to.
The limit value control unit 7j determines whether or not the driver input voltage has decreased to a predetermined threshold based on the detection signal Sv input from the voltage sensor 6. When the driver input voltage decreases to the threshold, the limit value control unit 7j The limit value is lowered to the upper limit value and the limit value is output to the limiter 7d.

次に、このように構成されたドライバ回路Aの動作について、図3を参照して詳しく説明する。
図3は、ドライバ入力電圧、ドライバ入力電力の電流(ドライバ入力電流)及びスイッチングトランジスタ1c並びにスイッチングトランジスタ2c‐1〜2c‐6のコレクタ電圧を示す波形図である。そして、図3の(a)の点線の波形は、ドライバ入力電圧がドライバ運転限界電圧まで低下した場合のドライバ入力電圧を示し、実線の波形は、本実施形態のドライバ入力電圧を示す。
Next, the operation of the driver circuit A configured as described above will be described in detail with reference to FIG.
FIG. 3 is a waveform diagram showing the driver input voltage, the current of the driver input power (driver input current), and the collector voltage of the switching transistor 1c and the switching transistors 2c-1 to 2c-6. 3A shows the driver input voltage when the driver input voltage is lowered to the driver operation limit voltage, and the solid line waveform shows the driver input voltage of the present embodiment.

また、図3の(b)の点線の波形は、ドライバ入力電圧がドライバ運転限界電圧まで低下した場合のドライバ入力電流を示し、実線の波形は、本実施形態の入力電圧を示す。さらに、図3の(c)の点線の波形は、ドライバ入力電圧がドライバ運転限界電圧まで低下した場合のスイッチングトランジスタ1c及びスイッチングトランジスタ2c‐1〜2c‐6のコレクタ電圧を示し、実線の波形は、本実施形態のコレクタ電圧を示す。なお、図3の(a)におけるドライバ運転限界電圧とは、昇圧チョッパ回路1の制御系の動作が電圧不足によって停止してしまうドライバ入力電圧であり、ドライバ運転制限電圧とは、制限値制御部7jが制限値を下げるか否か判断する際に判断基準となる上記しきい値である。   Also, the dotted waveform in FIG. 3B indicates the driver input current when the driver input voltage is reduced to the driver operation limit voltage, and the solid waveform indicates the input voltage of the present embodiment. Further, the dotted waveform in FIG. 3C shows the collector voltage of the switching transistor 1c and the switching transistors 2c-1 to 2c-6 when the driver input voltage is lowered to the driver operation limit voltage, and the solid line waveform is The collector voltage of this embodiment is shown. Note that the driver operation limit voltage in FIG. 3A is a driver input voltage at which the operation of the control system of the step-up chopper circuit 1 stops due to insufficient voltage, and the driver operation limit voltage is a limit value control unit. 7j is the above threshold value that serves as a determination criterion when determining whether or not to lower the limit value.

ドライバ回路Aでは、バッテリBから供給されたドライバ入力電力が昇圧チョッパ回路1によって所定電圧まで昇圧され、当該昇圧された直流電力はインバータ2によって三相のモータ駆動電力に変換されて永久磁石同期モータCへ供給される。
このドライバ回路Aにおいて、電圧センサ6は、常に検出信号Scをインバータ制御部7の制限値制御部7jへ出力する。
In the driver circuit A, the driver input power supplied from the battery B is boosted to a predetermined voltage by the boost chopper circuit 1, and the boosted DC power is converted into three-phase motor drive power by the inverter 2 to be a permanent magnet synchronous motor. C is supplied.
In the driver circuit A, the voltage sensor 6 always outputs the detection signal Sc to the limit value control unit 7j of the inverter control unit 7.

そして、ドライバ入力電圧は、バッテリBが有する電荷が有限である為に、図3の(a)に示すように時間が経つとともに下がっていく。
制限値制御部7jでは、ドライバ入力電圧が図3の(a)に示すドライバ運転制限電圧まで低下すると、所定の上限値まで制限値を下げ、当該制限値をリミッタ7dへ出力する。リミッタ7dでは、q軸電流操作量Iqsの最大値を制限値制御部7jから入力された制限値以下になるように制限し、q軸電流制御部7eへ出力する。
And since the electric charge which the battery B has is finite, as shown to (a) of FIG. 3, driver input voltage falls with time.
When the driver input voltage decreases to the driver operation limit voltage shown in FIG. 3A, the limit value control unit 7j decreases the limit value to a predetermined upper limit value and outputs the limit value to the limiter 7d. The limiter 7d limits the maximum value of the q-axis current manipulated variable Iqs to be equal to or less than the limit value input from the limit value control unit 7j, and outputs the limit value to the q-axis current control unit 7e.

そして、リミッタ7dがq軸電流操作量Iqsを制限することによって、インバータ2は、永久磁石同期モータCへ出力されるモータ駆動電力の電流を所定の上限値以下にする。これにより、ドライバ入力電流は、図3の(b)の実線に示すように低下していく。さらに、これによって、ドライバ入力電圧は、図3の(a)の実線に示すようにドライバ運転制限電圧の下まで低下しない。そして、ドライバ回路Aは、ドライバ入力電圧がドライバ運転可能電圧以下まで低下しない為、昇圧チョッパ回路1の制御系が停止することなく、継続して動作することが出来る。   Then, the limiter 7d limits the q-axis current manipulated variable Iqs, so that the inverter 2 sets the current of the motor driving power output to the permanent magnet synchronous motor C to a predetermined upper limit value or less. As a result, the driver input current decreases as shown by the solid line in FIG. Further, this prevents the driver input voltage from dropping below the driver operation limit voltage as shown by the solid line in FIG. The driver circuit A can continue to operate without stopping the control system of the step-up chopper circuit 1 because the driver input voltage does not drop below the driver operable voltage.

従来のようにリミッタの制限値を下げない場合には、図3の(a)の点線に示すように、ドライバ入力電圧はドライバ運転限界電圧を下回ってしまう為、昇圧チョッパ回路1の制御系(図示略)が停止してしまう。これによって、ドライバ入力電流は、図3の(b)の点線に示すように急激に低下する。そして、スイッチングトランジスタ1c及びスイッチングトランジスタ2c‐1〜2c‐6のコレクタ端子には、急激なドライバ入力電流の低下及び接続する配線のインダクタンス成分によって大きな起電力が発生して、図3の(c)の点線に示すようにコレクタ電圧に大きなサージ電圧が生してしまう。そして、この大きなサージ電圧によって、スイッチングトランジスタ1c及びスイッチングトランジスタ2c‐1〜2c‐6が破損してしまう。   When the limit value of the limiter is not lowered as in the prior art, the driver input voltage falls below the driver operation limit voltage as shown by the dotted line in FIG. (Not shown) stops. As a result, the driver input current rapidly decreases as shown by the dotted line in FIG. A large electromotive force is generated at the collector terminals of the switching transistor 1c and the switching transistors 2c-1 to 2c-6 due to an abrupt drop in the driver input current and the inductance component of the wiring to be connected. As shown by the dotted line, a large surge voltage is generated in the collector voltage. The large surge voltage causes the switching transistor 1c and the switching transistors 2c-1 to 2c-6 to be damaged.

しかしながら、ドライバ回路Aでは、昇圧チョッパ回路1の制御系が停止しない為、図3の(c)の実線に示すようにコレクタ電圧に生じるサージ電圧を低く抑え、スイッチングトランジスタ1c及びスイッチングトランジスタ2c‐1〜2c‐6の破損を防ぐことが出来る。   However, in the driver circuit A, since the control system of the step-up chopper circuit 1 does not stop, the surge voltage generated in the collector voltage is suppressed low as shown by the solid line in FIG. 3C, and the switching transistor 1c and the switching transistor 2c-1 The damage of ˜2c-6 can be prevented.

以上、本発明の一実施形態について説明したが、本発明は上記実施形態に限定されることなく、例えば以下のような変形が考えられる。
(1)上記実施形態では昇圧チョッパ回路1を備えたドライバ回路Aについて説明したが、本発明における昇圧チョッパ回路はこれに限定されるものではない。直流チョッパ回路には、昇圧チョッパ回路の他に降圧チョッパ回路や昇降圧チョッパ回路があり、本発明における昇圧チョッパ回路には、このような降圧チョッパ回路や昇降圧チョッパ回路にも適用可能である。
As mentioned above, although one Embodiment of this invention was described, this invention is not limited to the said embodiment, For example, the following modifications can be considered.
(1) Although the driver circuit A provided with the boost chopper circuit 1 has been described in the above embodiment, the boost chopper circuit in the present invention is not limited to this. In addition to the step-up chopper circuit, the DC chopper circuit includes a step-down chopper circuit and a step-up / step-down chopper circuit. The step-up chopper circuit in the present invention can be applied to such a step-down chopper circuit and step-up / step-down chopper circuit.

(2)上記実施形態では、前記制限値制御部は、制限値を下げ、モータ駆動電流を低下させたが、この永久磁石同期モータCへのモータ駆動電流を制限する旨の通知信号をECUへ出力し、ECUが表示部等によって外部へ報知するようにしてもよい。 (2) In the above embodiment, the limit value control unit lowers the limit value and decreases the motor drive current. However, the ECU notifies the ECU of a notification signal to limit the motor drive current to the permanent magnet synchronous motor C. It may be outputted and the ECU may notify the outside by a display unit or the like.

本発明の一実施形態に係るドライバ回路Aの構成を示す回路図である。It is a circuit diagram which shows the structure of the driver circuit A which concerns on one Embodiment of this invention. 本発明の一実施形態に係るドライバ回路Aのインバータ制御部7の機能構成を示す機能ブロック図である。It is a functional block diagram which shows the function structure of the inverter control part 7 of the driver circuit A which concerns on one Embodiment of this invention. 本発明の一実施形態に係るドライバ回路Aのドライバ入力電圧、ドライバ入力電流及びスイッチングトランジスタ1c並びにスイッチングトランジスタ2c‐1〜2c‐6のコレクタ電圧を示す波形図である。It is a wave form diagram which shows the driver input voltage of the driver circuit A which concerns on one Embodiment of this invention, a driver input current, and the collector voltage of the switching transistor 1c and the switching transistors 2c-1 to 2c-6.

符号の説明Explanation of symbols

A…ドライバ回路、B…バッテリ、C…永久磁石同期モータ、D…回転位置検出部、1…昇圧チョッパ回路、1a‐1,1a‐2…チョッパ入力端子、1b…チョークコイル、1c…スイッチングトランジスタ、1d…MOSFET、1e…平滑コンデンサ、1f‐1,1f‐2…チョッパ出力端子、2…インバータ、2a‐1,2a‐2…インバータ入力端子、2b…平滑コンデンサ、2c‐1〜2c‐6…スイッチングトランジスタ、2d‐1〜2d‐3…インバータ出力端子、3…U相電流検出部、4…V相電流検出部、5…W相電流検出部、6…電圧センサ、7…インバータ制御部、7a…3相/2相変換部、7b…減算部、7c…速度制御部、7d…リミッタ、7e…q軸電流制御部、7f…d軸電流制御部、7g…2相/3相変換部、7h…PWM信号発生部、7i…速度算出部、7j…制限値制御部、7k…q軸電圧リミッタ、7l…d軸電圧リミッタ
DESCRIPTION OF SYMBOLS A ... Driver circuit, B ... Battery, C ... Permanent magnet synchronous motor, D ... Rotation position detection part, 1 ... Boost chopper circuit, 1a-1, 1a-2 ... Chopper input terminal, 1b ... Choke coil, 1c ... Switching transistor 1d ... MOSFET, 1e ... smoothing capacitor, 1f-1,1f-2 ... chopper output terminal, 2 ... inverter, 2a-1,2a-2 ... inverter input terminal, 2b ... smoothing capacitor, 2c-1 to 2c-6 ... Switching transistor, 2d-1 to 2d-3 ... Inverter output terminal, 3 ... U-phase current detector, 4 ... V-phase current detector, 5 ... W-phase current detector, 6 ... Voltage sensor, 7 ... Inverter controller 7a, 3-phase / 2-phase converter, 7b, subtractor, 7c, speed controller, 7d, limiter, 7e, q-axis current controller, 7f, d-axis current controller, 7g, 2-phase / 3-phase change. Parts, 7h ... PWM signal generating section, 7i ... speed calculating unit, 7j ... limiting value control unit, 7k ... q-axis voltage limiter, 7l ... d-axis voltage limiter

Claims (5)

外部から供給される直流の入力電力を変圧し、変圧した電力を出力する直流チョッパ回路と、前記直流チョッパ回路から入力された電力から交流の駆動電力を生成し、当該駆動電力を駆動対象へ出力するインバータとを有するドライバ回路であって、
運転限界電圧より高い電圧に設定されたしきい値まで、前記入力電力の電圧が低下したと判断すると、前記インバータが出力する駆動電流を所定の上限値以下に制限する駆動電流制限手段とを、
具備することを特徴とするドライバ回路。
A DC chopper circuit that transforms DC input power supplied from the outside, outputs the transformed power, and generates AC drive power from the power input from the DC chopper circuit, and outputs the drive power to the drive target A driver circuit having an inverter to
When it is determined that the voltage of the input power has decreased to a threshold set to a voltage higher than the operation limit voltage, drive current limiting means for limiting the drive current output by the inverter to a predetermined upper limit value or less,
A driver circuit comprising the driver circuit.
前記駆動電流制限手段は、電流操作量の最大値を制限することによって、前記インバータが出力する前記駆動電流を所定の上限値以下に制限することを特徴とする請求項1記載のドライバ回路。   2. The driver circuit according to claim 1, wherein the drive current limiting unit limits the drive current output from the inverter to a predetermined upper limit value or less by limiting a maximum value of a current operation amount. 前記駆動電流制限手段は、運転限界電圧より高い電圧に設定されたしきい値まで、前記入力電力の電圧が低下したと判断すると、駆動電流を制限する旨の通知信号を外部へ出力することを特徴とする請求項1または2に記載のドライバ回路。   When the driving current limiting means determines that the voltage of the input power has decreased to a threshold set to a voltage higher than the operating limit voltage, the driving current limiting means outputs a notification signal to the outside to limit the driving current. 3. The driver circuit according to claim 1, wherein the driver circuit is characterized in that: 前記直流チョッパ回路は、昇圧チョッパ回路、降圧チョッパ回路及び昇降圧チョッパ回路のいずれかであることを特徴とする請求項1〜3のいずれかに記載のドライバ回路。   4. The driver circuit according to claim 1, wherein the DC chopper circuit is any one of a step-up chopper circuit, a step-down chopper circuit, and a step-up / step-down chopper circuit. 外部から供給される直流の入力電力を変圧し、変圧した電力を出力する直流チョッパ回路と、前記直流チョッパ回路から入力された電力から交流の駆動電力を生成し、当該駆動電力を駆動対象へ出力するインバータとを有するドライバ回路の保護方法であって、
運転限界電圧より高い電圧に設定されたしきい値まで、前記入力電力の電圧が低下すると、前記インバータが出力する駆動電流を所定の上限値以下に制限することを特徴とするドライバ回路の保護方法。
A DC chopper circuit that transforms DC input power supplied from the outside, outputs the transformed power, and generates AC drive power from the power input from the DC chopper circuit, and outputs the drive power to the drive target A method of protecting a driver circuit having an inverter that includes:
A method for protecting a driver circuit, wherein when the input power voltage drops to a threshold value set to a voltage higher than an operation limit voltage, the drive current output from the inverter is limited to a predetermined upper limit value or less. .
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