JP2007298937A - 発光素子及びその駆動方法 - Google Patents
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Abstract
【解決手段】上記発光素子は、第1方向に配列されるデータラインD1〜D6、第1方向と異なる第2方向に配列されるスキャンラインS1〜S4、データラインとスキャンラインとが交差する領域に形成されるピクセルE11〜E64、及び少なくとも一つのデータラインを放電時間中の第1サブ放電時間の間第1放電電圧に放電し、放電時間中の第2サブ放電時間の間上記第1放電電圧を上記第2放電電圧に変える放電部308を含む。発光素子は、データラインを該当ピクセルのカソード電圧に対応する放電電圧まで放電するので、クロストーク現象及び櫛形が生じない。
【選択図】図3(a)
Description
図1は、従来の発光素子を図示したブロック図である。
制御部102は、外部装置から表示データを受信し、上記受信された表示データを用いてスキャン駆動部104、106、放電部108、プリチャージ部110及びデータ駆動部112の動作を制御する。
データ駆動部112は、制御部102の制御によって上記表示データに対応するデータ電流を上記プリチャージされたデータラインD1〜D6に供給する。その結果、ピクセルE11〜E64が発光する。
第1スキャンラインS1に該当するピクセルE11〜E61のカソード電圧VC11〜VC61の大きさを比較する。
ここで、ピクセルE11〜E61を同じ輝度で発光させるために、同じ大きさのデータ電流I11〜I61がデータラインD1〜D6に供給されると仮定する。
スイッチSW1〜SW6がターン−オンされ、スキャンラインS1〜S4が上記発光素子の駆動電圧、例えば、データ電流の最大輝度に対応する電圧と同じ大きさの電圧V2を有する非発光源に接続される。従って、ピクセルE11〜E64は発光せず、データラインD1〜D6は、第1放電時間dcha1の間、ツェナーダイオードのツェナー電圧まで同一に放電される。
即ち、第1データラインD1と第6データラインD6に同じ大きさのデータ電流I11、I61が、第1発光時間t1の間、供給される。
スキャンラインD1〜D6が上記非発光源に接続され、スイッチSW1〜SW6がターン−オンされる。その結果、データラインD1〜D6が、図2(c)に示されるように、第2放電時間dcha2の間、所定放電レベルまで放電される。
次いで、上記第2表示データに該当するデータ電流I12〜I62が、データラインD1〜D6に供給され、これにより、ピクセルE12〜E62が、第2発光時間t2の間発光する。
この場合、ピクセルE12とグランドと間の抵抗がピクセルE11とグランドと間の抵抗より大きいため、ピクセルE12のカソード電圧VC12がピクセルE11のカソード電圧VC11より大きく、これにより、ピクセルE12のアノード電圧VA12が安定化されるまで消耗される電荷量は、ピクセルE11のアノード電圧VA11が安定化されるまで消耗される電荷量より大きい。
第1スキャンラインS1に対応するピクセルE11〜E61中のピクセルE11が、上述するように、ピクセルE11〜E61の中から、最も明るく発光し、ピクセルE61が最も暗く発光する。また、第2スキャンラインS2に対応するピクセルE12〜E62中のピクセルE12は、ピクセルE12〜E62の中から最も暗く発光し、ピクセルE62が最も明るく発光する。
図3(a)は、本発明の好ましい第1の実施形態に係る発光素子を図示したブロック図で、図3(b)は、(a)の放電部の動作に係る放電レベルグラフを図示した図面である。
各ピクセルE11〜E64は、基板上に順次に形成されるアノード電極層、有機物層及びカソード電極層を含む。
放電レベル部322は、データラインD1〜D6とサブ放電部320をそれぞれ接続する複数のスイッチSW1〜SW6を含む。
データ駆動部312は、制御部302の制御下に上記表示データに対応して上記スキャン信号に同期されたデータ信号、即ち、データ電流を上記プリチャージされたデータラインD1〜D6に供給する。その結果、ピクセルE11〜E64が発光する。
第1スキャンラインS1がグランドに接続され、他のスキャンラインS2〜S4は上記発光素子の駆動電圧、例えば、データ電流の最大輝度に対応する電圧と同じ大きさの電圧V2を有する非発光源に接続される。
続いて、データラインD1〜D6が、上記第1表示データ入力後に制御部302に入力される第2表示データに対応するレベルまでプリチャージされる。
その後、第2スキャンラインS2がグランドに接続され、他のスキャンラインS1、S3、S4は上記非発光源に接続される。
第1スキャンラインS1に該当するピクセルE11〜E61のカソード電圧VC11〜VC61の大きさを比較する。
この場合、データ電流I11〜I61が、該当ピクセルE11〜E61及び第1スキャンラインS1を通過した後グランドに流れる。従って、ピクセルE11〜E61のカソード電圧VC11〜VC61は、データ電流I11〜I61の大きさが同一なので、該当抵抗、即ち、ピクセルE11〜E61と上記グランドと間の抵抗に比例する大きさを有する。
放電部308は、データラインD1〜D6を放電する。
次いで、放電部308は、第2電圧VLに対応する第1出力電圧をデータラインD1〜D6に供給し、これにより、データラインD1〜D6が上記第1出力電圧に対応する第1放電電圧、例えば、第1放電レベルまで放電される。
次いで、放電部308は、第1電圧VHに対応する第2出力電圧をデータラインD1〜D6に供給し、これにより、データラインD1〜D6が上記第2出力電圧に対応する第2放電電圧、例えば第2放電レベルまで放電される。
放電部308は、第2放電時間dcha2の間、データラインD1〜D6を放電する。
第1例に、第2放電時間dcha2中の第1サブ放電時間の間、スイッチSW1、SW2、SW3、SW4、SW5、SW6、SW8がターン−オンされる。
次いで、放電部308は、第1電圧VHに対応する第2出力電圧をデータラインD1〜D6に供給し、データラインD1〜D6が、上記第2出力電圧に対応する第2放電電圧まで放電される。
第12ピクセルE12のカソード電圧VC12が、第11ピクセルE11のカソード電圧VC11より大きいので、第1データラインD1は、図4(c)に示されるように、第1放電時間dcha1より第2放電時間dcha2の間、さらに高い放電レベルに放電される。
次いで、上記第2表示データに対応するデータ電流I12〜I62が、データラインD1〜D6に供給される。
図5を参照すれば、本発明の発光素子は、パネル500、制御部502、第1スキャン駆動部504、第2スキャン駆動部506、放電部508、プリチャージ部510及びデータ駆動部512を含む。
放電部508は、サブ放電部520、スイッチング部522及び放電レベル部524を含む。
まず、OPアンプの入力端が、第1電圧VHを有する第1電圧源に接続された時、スイッチSW15及びスイッチSW1、SW3、SW5、SW7、SW9、SW11がターン−オン、他のスイッチSW2、SW4、SW6、SW8、SW10、SW12、SW16がターン−オフされる。この場合、データラインD1〜D6間の抵抗RD1は、第1抵抗値を有する。
図6を参照すれば、本発明の発光素子はパネル600、制御部602、第1スキャン駆動部604、第2スキャン駆動部606、放電部608、プリチャージ部610及びデータ駆動部612を含む。
放電部608は、第1サブ放電部620、第2サブ放電部622及び放電レベル部624を含む。
第1の実施形態で、発光素子は、上記OPアンプから出力される電流のみを利用してピクセルE11〜E64のカソード電圧VC11〜VC64を補償しており、これにより、上記発光素子の消費電力が大きい。しかし、第3の実施形態で、発光素子は、ツェナーダイオードを利用してデータラインD1〜D6を所定放電電圧まで放電した後、上記OPアンプを利用してカソード電圧VC11〜VC64を補償しているので、第3の実施形態の発光素子が第1の実施形態の発光素子より消費電力が低い。
図7を参照すれば、本発明の発光素子は、パネル700、制御部702、スキャン駆動部704、放電部706、プリチャージ部708及びデータ駆動部710を含む。
上記発光素子の構成要素は、上記第1の実施形態の構成要素と同様の機能を遂行するので、以下説明を省略する。
制御部802は、外部装置から表示データを受信し、上記受信された表示データを用いて、スキャン駆動部804、806、放電部808、プリチャージ部810及びデータ駆動部812の動作を制御する。
サブ放電部820は、デジタル−アナログ変換器830(DAC)及びOPアンプ832を含む。
その後、OPアンプ832は、DAC830から出力された電圧によって放電時間の間、所定電圧をデータラインD1〜D6に供給し、これにより、データラインD1〜D6が、図8(a)に示されるように、第2電圧VLに対応する第1放電レベルと第1電圧VHに対応する第2放電レベルと間の放電電圧まで放電される。即ち、データラインD1〜D6は、図8(a)に示されるように、一定の勾配(但し、直線でない曲線であってもよい。)を有し、該当ピクセルのカソード電圧に対応する放電電圧まで放電される。
データ駆動部812は、制御部802の制御下に上記表示データに対応して上記スキャン信号に同期されたデータ信号、即ち、データ電流を上記プリチャージされたデータラインD1〜D6に供給する。その結果、ピクセルE11〜E64が発光する。
図9(a)及び(b)は、図8(a)の発光素子を概略的に図示した回路図である。
第1スキャンラインS1に該当するピクセルE11〜E61のカソード電圧VC11〜VC61の大きさを比較する。
放電部808は、データラインD1〜D6を放電する。
第1例に、第1放電時間dcha1中の第1サブ放電時間の間、スイッチSW1〜SW6がターン−オンされる。
続いて、OPアンプ832は、DAC830から出力された電圧によってデータ[0,0,0,0,1]に対応する第2OPアンプ出力電圧をデータラインD1〜D6に供給する。但し、この場合、第1スイッチSW1はターン−オフであり、他のスイッチSW2〜SW6はオン状態を保持する。
続いて、OPアンプ832は、DAC830から出力された電圧によってデータ[0,0,0,1,0]に対応する第3OPアンプ出力電圧をデータラインD1〜D6に供給する。但し、この場合、スイッチSW1はオフ状態を保持し、スイッチSW2はターン−オフであり、他のスイッチSW3〜SW6はオン状態を保持する。
次いで、DAC830は、Mビットデータ中の最上位データに対応する電圧、即ち、第1電圧VHに対応する電圧を出力する。例えば、Mが5のとき、DAC830は、最上位データ[1,1,1,1,1]に対応する電圧を出力する。
続いて、OPアンプ832は、DAC830から出力された電圧によってデータ[1,1,1,0,1]に対応する第6OPアンプ出力電圧をデータラインD1〜D6に供給する。但し、この場合、スイッチSW6はオフ状態を保持し、スイッチSW5はターン−オフ、他のスイッチSW1〜SW4はオン状態を保持する。
放電部808は、第2放電時間dcha2の間、データラインD1〜D6を放電する。
第1例に、第2放電時間dcha2中の第1サブ放電時間の間、スイッチSW1〜SW6がターン−オンされる。
続いて、OPアンプ832はDAC830から出力された電圧によってデータ[0,0,0,1,0]に対応する第9OPアンプ出力電圧をデータラインD1〜D6に供給する。但し、この場合、スイッチSW6はオフ状態を保持し、スイッチSW5はターン−オフ、他のスイッチSW1〜SW4はオン状態を保持する。
次いで、DAC830は、Mビットデータ中の最上位データに対応する電圧、即ち、第1電圧VHに対応する電圧を出力する。例えば、Mが5のとき、DAC830は最上位データ[1,1,1,1,1]に対応する電圧を出力する。
続いて、OPアンプ832は、DAC830から出力された電圧によってデータ[1,1,1,0,1]に対応する第12OPアンプ出力電圧をデータラインD1〜D6に供給する。但し、この場合、スイッチSW1はオフ状態を保持し、スイッチSW2はターン−オフ、他のスイッチSW3〜SW6はオン状態を保持する。
以上では、スイッチSW1〜SW6が、上記第2サブ放電時間の間、1個ずつ順次にターン−オフされるものを説明したが、2個以上の単位で順次にターン−オフされることもある。
第12ピクセルE12のカソード電圧VC12が、第11ピクセルE11のカソード電圧VC11より大きいので、第1データラインD1は、図4(c)に示されるように、第1放電時間dcha1より第2放電時間dcha2の間、より高い放電レベルで放電される。
図10は本発明の好ましい第6実施形態に係る発光素子を図示したブロック図である。
図10を参照すれば、本発明の発光素子は、パネル1000、制御部1002、第1スキャン駆動部1004、第2スキャン駆動部1006、放電部1008、プリチャージ部1010及びデータ駆動部1012を含む。
放電部1008は、サブ放電部1020、スイッチング部1022及び放電レベル部1024を含む。
まず、OPアンプの第1入力端が、第1電圧VHを有する第1電圧源に接続されたとき、スイッチSW15及びスイッチSW1、SW3、SW5、SW7、SW9、SW11がターン−オンされ、他のスイッチSW2、SW4、SW6、SW8、SW10、SW12、SW16がターン−オフされる。
放電過程は第5の実施形態の放電過程と同様なので、以下説明を省略する。
図11を参照すれば、本発明の発光素子は、パネル1100、制御部1102、第1スキャン駆動部1104、第2スキャン駆動部1106、放電部1108、プリチャージ部1110及びデータ駆動部1112を含む。
放電部1108は、第1サブ放電部1120、第2サブ放電部1122及び放電レベル部1124を含む。
第5の実施形態で、発光素子は、上記OPアンプから出力される電流のみを利用してカソード電圧VC11〜VC64を補償し、これにより、上記発光素子の消費電力が大きい。しかし、第7実施形態で、発光素子がツェナーダイオードを利用してデータラインD1〜D6を所定放電電圧まで放電した後、上記OPアンプを利用してカソード電圧VC11〜VC64を補償するので、第7実施形態の発光素子が第5の実施形態の発光素子より消費電力が低い。
図12を参照すれば、本発明の発光素子は、パネル1200、制御部1202、スキャン駆動部1204、放電部1206、プリチャージ部1208及びデータ駆動部1210を含む。
302 制御部
304 第1スキャン駆動部
306 第2スキャン駆動部
308 放電部
310 プリチャージ部
312 データ駆動部
320 サブ放電部
322 放電レベル部
D1〜D6 データライン
E11〜E64 ピクセル
S1〜S4 スキャンライン
SW1〜SW8 スイッチ
Claims (32)
- 第1方向に配列されたデータラインと、
前記第1方向と異なる第2方向に配列されたスキャンラインと、
前記データラインと前記スキャンラインとが交差する領域に形成される複数のピクセルと、
少なくとも一つのデータラインを放電時間中の第1サブ放電時間の間、第1放電電圧に放電し、前記放電時間中の第2サブ放電時間の間、前記第1放電電圧を前記第2放電電圧に変える放電部とを含み、
前記第2放電電圧は、前記第1放電電圧と異なることを特徴とする発光素子。 - 前記第2放電電圧は、前記データラインに対応するピクセルのカソード電圧によって設定されることを特徴とする請求項1に記載の発光素子。
- 前記放電部は、
前記第1サブ放電時間の間、前記データラインに前記第1放電電圧に対応する第1出力電圧を供給し、前記第2サブ放電時間の間、前記データラインに前記第2放電電圧に対応する第2出力電圧を供給するサブ放電部と、
前記データラインと前記サブ放電部と間の接続をスイッチングする放電レベル部と、を含むことを特徴とする請求項1に記載の発光素子。 - 前記サブ放電部は、OPアンプを含み、
前記OPアンプの入力端は、第1電圧を有する第1電圧源または前記第1電圧と異なる第2電圧を有する第2電圧源に接続されることを特徴とする請求項3に記載の発光素子。 - 前記放電部は、
前記第1サブ放電時間の間、前記データラインに前記第1放電電圧に対応する第1出力電圧を供給し、前記第2サブ放電時間の間、前記データラインに前記第2放電電圧に対応する第2出力電圧を供給するサブ放電部と、
前記データラインと前記サブ放電部の接続をそれぞれスイッチングする複数のスイッチを有する放電レベル部と、を含むことを特徴とする請求項1に記載の発光素子。 - 前記スイッチは、前記第1サブ放電時間の間、前記データラインと前記サブ放電部を接続し、前記第2サブ放電時間の間、N(1以上の整数)個単位で順にターン−オフされることを特徴とする請求項5に記載の発光素子。
- 前記データライン中の第1最外側データラインに対応するピクセルのカソード電圧が、第2最外側データラインに対応するピクセルのカソード電圧より大きく、前記第1放電電圧が、前記第2放電電圧より小さい場合、
前記スイッチは、前記第2サブ放電時間の間、前記第2最外側データラインから前記第1最外側データラインの方向に、N個単位で順にターン−オフされることを特徴とする請求項6に記載の発光素子。 - 前記データライン中の第1最外側データラインに対応するピクセルのカソード電圧が、第2最外側データラインに対応するピクセルのカソード電圧より大きく、前記第1放電電圧が、前記第2放電電圧より大きい場合、
前記スイッチは、前記第2サブ放電時間の間、前記第1最外側データラインから前記第2最外側データラインの方向に、N個単位で順にターン−オフされることを特徴とする請求項8に記載の発光素子。 - 前記サブ放電部は、OPアンプを含み、
前記OPアンプの入力端は、第1電圧を有する第1電圧源または前記第1電圧と異なる第2電圧を有する第2電圧源に接続されることを特徴とする請求項5に記載の発光素子。 - 前記放電部は、
前記第1サブ放電時間の間、前記データラインに前記第1放電電圧に対応する第1出力電圧を供給し、前記第2サブ放電時間の間、前記データラインに前記第2放電電圧に対応する第2出力電圧を供給するサブ放電部と、
前記第1サブ放電時間の間、前記データラインと前記サブ放電部を接続する複数の第1スイッチ、及び前記第2サブ放電時間の間、前記データラインと前記サブ放電部を接続する複数の第2スイッチを有する放電レベル部と、を含むことを特徴とする請求項1に記載の発光素子。 - 前記第1スイッチが前記サブ放電部と前記データラインを接続する時、前記データライン間の抵抗は、第1抵抗値を有し、前記第2スイッチが前記サブ放電部と前記データラインを接続するとき、前記データライン間の抵抗は、前記第1抵抗値と異なる第2抵抗値を有することを特徴とする請求項10に記載の発光素子。
- 前記第2抵抗値は、前記第1抵抗値より大きいことを特徴とする請求項11に記載の発光素子。
- 前記放電部は、
前記データラインを所定放電電圧まで放電する第1サブ放電部と、
前記第1サブ放電時間の間、前記データラインに前記第1放電電圧に対応する第1出力電圧を供給し、前記第2サブ放電時間の間、前記データラインに前記第2放電電圧に対応する第2出力電圧を供給する第2サブ放電部と、を含むことを特徴とする請求項1に記載の発光素子。 - 前記第1サブ放電部は、
前記データラインに接続されるツェナーダイオードを含み、
前記第2サブ放電部は、
その入力端が第1電圧を有する第1電圧源または第1電圧と異なる第2電圧を有する第2電圧源に接続されるOPアンプを含むことを特徴とする請求項13に記載の発光素子。 - 第1方向に配列されたデータラインと、
前記第1方向と異なる第2方向に配列されたスキャンラインと、
前記データラインと前記スキャンラインとが交差する領域に形成される複数のピクセルと、
前記データラインが該当ピクセルのカソード電圧に対応する放電電圧を有するように、前記データラインにM(2つ以上の整数)ビットデータに対応する出力電圧を供給する放電部と、を含むことを特徴とする発光素子。 - 前記放電部は、
前記データラインにMビットデータに対応する出力電圧を供給するサブ放電部と、
前記サブ放電部と前記データラインと間の接続をスイッチングする複数のスイッチを有する放電レベル部と、を含むことを特徴とする請求項15に記載の発光素子。 - 前記スイッチは、放電時間中の第1サブ放電時間の間、前記データラインと前記サブ放電部を接続し、前記放電時間中の第2サブ放電時間の間、N(1以上の整数)個単位で順にターン−オフされることを特徴とする請求項16に記載の発光素子。
- 前記データライン中の第1最外側データラインに対応するピクセルのカソード電圧が、第2最外側データラインに対応するピクセルのカソード電圧より大きく、前記第1サブ放電時間の間、前記データラインに前記Mビットデータ中の最下位データに対応する出力電圧が供給された場合、
前記スイッチは、前記第2サブ放電時間の間、前記第2最外側データラインから前記第1最外側データラインの方向に、N個単位で順にターン−オフされることを特徴とする請求項17に記載の発光素子。 - 前記データライン中の第1最外側データラインに対応するピクセルのカソード電圧が、第2最外側データラインに対応するピクセルのカソード電圧より大きく、前記第1サブ放電時間の間、前記データラインに前記Mビットデータ中の最上位データに対応する出力電圧が供給された場合、
前記スイッチは、前記第2サブ放電時間の間、前記第1最外側データラインから前記第2最外側データラインの方向に、N個単位で順にターン−オフされることを特徴とする請求項17に記載の発光素子。 - 前記サブ放電部は、
前記Mビットデータによって所定電圧を出力するデジタル−アナログ変換器と、
前記デジタル−アナログ変換器から出力された電圧によって前記データラインに前記出力電圧を供給するOPアンプと、を含むことを特徴とする請求項16に記載の発光素子。 - 前記デジタル−アナログ変換器の入力端中の第1入力端は、第1電圧を有する第1電圧源に接続され、第2入力端は、前記第1電圧より小さい第2電圧を有する第2電圧源に接続されることを特徴とする請求項20に記載の発光素子。
- 前記放電レベル部は、
放電時間中の第1サブ放電時間の間、前記データラインと前記サブ放電部を接続する複数の第1スイッチと、
前記放電時間中の第2サブ放電時間の間、前記データラインと前記サブ放電部を接続する複数の第2スイッチと、を含むことを特徴とする請求項16に記載の発光素子。 - 前記第1スイッチが前記サブ放電部と前記データラインを接続するとき、前記データライン間の抵抗は、第1抵抗値を有し、前記第2スイッチが、前記サブ放電部と前記データラインを接続するとき、前記データライン間の抵抗は、前記第1抵抗値と異なる第2抵抗値を有することを特徴とする請求項22に記載の発光素子。
- 前記第2抵抗値は、前記第1抵抗値より大きいことを特徴とする発請求項23に記載の光素子。
- 前記放電部は、
前記データラインを所定放電電圧まで放電する第1サブ放電部と、
前記データラインに前記Mビットデータに対応する出力電圧を供給する第2サブ放電部と、
前記サブ放電部と前記データラインと間の接続をスイッチングする複数のスイッチを有する放電レベル部と、を含むことを特徴とする請求項15に記載の発光素子。 - 前記第1サブ放電部は、
前記データラインに接続されるツェナーダイオードを含み、
前記第2サブ放電部は、
前記Mビットデータによって所定電圧を出力するデジタル−アナログ変換器と、
前記デジタル−アナログ変換器から出力された電圧によって前記データラインに前記出力電圧を供給するOPアンプと、を含むことを特徴とする請求項25に記載の発光素子。 - データラインとスキャンラインとが交差する発光領域に形成される複数のピクセルを含む発光素子を駆動する方法において、
放電時間中の第1サブ放電時間の間、少なくとも一つのデータラインに第1出力電圧を供給して前記データラインを第1放電電圧まで放電する段階、及び
前記放電時間中の第2サブ放電時間の間、前記データラインに第2出力電圧を供給して前記第1放電電圧を第2放電電圧に変える段階を含み、
前記第2放電電圧が前記第1放電電圧と異なることを特徴とする発光素子駆動方法。 - 前記第2放電電圧は、該当ピクセルのカソード電圧に対応するレベルを有することを特徴とする請求項27に記載の発光素子駆動方法。
- 前記発光素子駆動方法は、
前記データラインを、ツェナーダイオードを用いて所定放電電圧まで放電する段階を、さらに含むことを特徴とする請求項27に記載の発光素子駆動方法。 - データラインとスキャンラインとが交差する発光領域に形成される複数のピクセルを含む発光素子を駆動する方法において、
M(2以上の整数)ビットデータ中の第1データを選択する段階、
前記選択された第1データに対応する第1出力電圧を少なくとも一つのデータラインに供給する段階、
前記Mビットデータ中の第2データを選択する段階、及び
前記選択された第2データに対応する第2出力電圧を前記データラインに供給する段階を含むことを特徴とする発光素子駆動方法。 - 前記第1出力電圧を前記データラインに供給する段階は、
前記選択された第1データによって前記第1データに対応する第1電圧を出力する段階、及び前記出力された第1電圧によって前記第1出力電圧を前記データラインに供給する段階を含み、
前記第2出力電圧を前記データラインに供給する段階は、
前記選択された第2データによって前記第2データに対応する第2電圧を出力する段階、及び前記出力された第2電圧によって前記第2出力電圧を前記データラインに供給する段階を含むことを特徴とする請求項30に記載の発光素子駆動方法。 - 前記発光素子駆動方法は、
前記データラインを所定放電電圧まで放電する段階を、さらに含むことを特徴とする請求項30に記載の発光素子駆動方法。
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