JP2007147460A - Magnetic balance type electric current sensor - Google Patents

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聡 大平
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Abstract

<P>PROBLEM TO BE SOLVED: To provide a magnetic balance type electric current sensor for further enhancing current detection accuracy. <P>SOLUTION: In this magnetic balance type electric current sensor, a secondary winding 20 includes a first wiring pattern comprising a plurality of strip-shaped first conductor patterns 21 drawn in parallel within a semiconductor substrate 1 and a second wiring pattern comprising a plurality of strip-shaped second conductor patterns 22 drawn in parallel within the semiconductor substrate 1 while being formed in parallel with the first wiring pattern. The secondary winding 20 is formed by providing each of the conductor patterns 21 with two conductive connection parts 25 for severally connecting a front end and a base end of each of the conductor patterns 21 to a front end of a conductor pattern 22 and to a base end of a second conductor pattern 22 lying next thereto. <P>COPYRIGHT: (C)2007,JPO&INPIT

Description

本発明は、ホール素子を利用して電流を検出する電流センサにかかり、詳しくは、磁気平衡式の電流センサに関する。   The present invention relates to a current sensor that detects current using a Hall element, and more particularly to a magnetic balance type current sensor.

従来、ホール素子の特性を利用して電流を検出する電流センサが知られている。ホール素子は、半導体材料からなる素子であり、その内部に制御電流が流れている状態で制御電流の方向に対して直交する方向に磁界が印加されたときにホール効果の発現によってその磁界の大きさに応じたホール電圧を出力する。電流の流れる電流線の周囲にはこの電流の流れる方向に対して直交する方向に同電流の大きさに応じた磁界が発生するため、電流線に近接してホール素子を配設することで、その電流の大きさを検出することができる。例えば図12に示すように、ホール素子100を流れる制御電流Ibの方向と電流線CLとが平行となるように両者を近接させて配置すれば、電流線CLに流れる被検出電流Ifをホール素子100において発生するホール電圧Vhから求めることができるようになる。   2. Description of the Related Art Conventionally, current sensors that detect current using characteristics of Hall elements are known. A Hall element is an element made of a semiconductor material. When a magnetic field is applied in a direction perpendicular to the direction of the control current in a state where a control current flows in the Hall element, the magnitude of the magnetic field is increased by the development of the Hall effect. The hall voltage corresponding to the size is output. Since a magnetic field corresponding to the magnitude of the current is generated in the direction perpendicular to the direction of current flow around the current line through which the current flows, by disposing the Hall element close to the current line, The magnitude of the current can be detected. For example, as shown in FIG. 12, if the direction of the control current Ib flowing through the Hall element 100 and the current line CL are arranged close to each other, the detected current If flowing through the current line CL is changed to the Hall element. 100 can be obtained from the Hall voltage Vh generated at 100.

ただし、このようにホール素子100と電流線CLとを近接させて同電流線CLに流れる被検出電流Ifを直接検出する方法では、電流線CLの周囲に発生する磁束の一部が外部の空間に漏れることから、被検出電流Ifの検出精度には自ずと限界がある。そこで、電流線CLの周囲に発生する磁束をフェライト等の磁性体からなるコアによって集磁するようにした電流センサが提案されており、広く実用化されている。   However, in the method of directly detecting the detected current If flowing through the current line CL by bringing the Hall element 100 and the current line CL close to each other, a part of the magnetic flux generated around the current line CL is external space. Therefore, the detection accuracy of the detected current If is naturally limited. Therefore, a current sensor has been proposed in which magnetic flux generated around the current line CL is collected by a core made of a magnetic material such as ferrite, and has been widely put into practical use.

こうした磁性体のコアを用いた電流センサとしては、磁気比例式と磁気平衡式との2つの方式のものがある。このうち磁気比例式の電流センサは、図13に示されるように、ギャップ(間隙)を有する環状のコア110と、そのコア110のギャップ部110aに配設されたホール素子111と、ホール素子111のホール電圧Vhを増幅する増幅回路112とを備えて構成されている。電流線CLは、上記コア110によって囲繞される空間内にあって同コア110の軸心と直交する方向に配設されている。このような構成のもとでは、電流線CLに被検出電流Ifが流れると、上記コア110のギャップ部110aに被検出電流Ifの大きさに応じた磁界が発生する。上記磁気比例式の電流センサでは、このコア110のギャップ部110aに発生する磁界を、ホール素子のホール電圧Vhとして検出するようにしている。こうした磁気比例式電流センサは、その構成が簡素であることから、製造コストが安く、また被検出電流Ifの検出範囲が広い等の利点を有する反面、ホール素子の温度依存性によるホール電圧Vhの変化が被検出電流Ifの検出精度に影響を及ぼす等の欠点も併有している。   As a current sensor using such a magnetic core, there are two types, a magnetic proportional type and a magnetic balance type. Among these, as shown in FIG. 13, the magnetic proportional current sensor includes an annular core 110 having a gap (gap), a Hall element 111 disposed in a gap portion 110 a of the core 110, and a Hall element 111. And an amplifier circuit 112 that amplifies the Hall voltage Vh. The current line CL is disposed in a space surrounded by the core 110 and in a direction perpendicular to the axis of the core 110. Under such a configuration, when the detected current If flows through the current line CL, a magnetic field corresponding to the magnitude of the detected current If is generated in the gap 110a of the core 110. In the magnetic proportional current sensor, the magnetic field generated in the gap 110a of the core 110 is detected as the Hall voltage Vh of the Hall element. Such a magnetic proportional current sensor has advantages such as a low manufacturing cost and a wide detection range of the detected current If because of its simple configuration, but it has a Hall voltage Vh due to the temperature dependence of the Hall element. There are also disadvantages such as a change affecting the detection accuracy of the detected current If.

その点、例えば特許文献1に記載の磁気平衡式の電流センサによれば、上述の磁気比例式電流センサのホール素子の温度依存性に起因する検出精度の悪化も好適に抑制され、被検出電流Ifの検出精度の向上が図られるようになる。ここで、この種の磁気平衡式電流センサについてその概略構成を図14に示し、同図14を参照しつつ説明する。   In that respect, for example, according to the magnetic balance type current sensor described in Patent Document 1, the deterioration of the detection accuracy due to the temperature dependence of the Hall element of the magnetic proportional current sensor described above is also suitably suppressed, and the detected current The detection accuracy of If can be improved. Here, a schematic configuration of this type of magnetic balanced current sensor is shown in FIG. 14, and will be described with reference to FIG.

同図14に示されるように、磁気平衡式電流センサは、ギャップを有する環状のコア120と、このコア120に巻回された二次巻線121と、コア120のギャップ部120aに配設されたホール素子122とを備えて構成されている。また磁気平衡式電流センサには、ホール素子122のホール電圧Vhを増幅するとともにこの増幅された電圧を電流Icに変換する電流増幅回路123が更に設けられている。二次巻線121の一端は、電流増幅回路123に接続され、その他端は、負荷抵抗Rを介して接地されている。電流線CLは、上記磁気比例式電流センサと同様、上記コア120によって囲繞される空間内にあって同コア120の軸心と直交する方向に配設されている。そして、この磁気平衡式電流センサにおいては、二次巻線121の巻回方向や電流増幅回路123の増幅率等が、電流線CLに被検出電流Ifが流れることによってコア120内に発生する磁界と二次巻線121に電流Icが流れることによって同コア120内に発生する磁界とが相殺されるように設定されている。   As shown in FIG. 14, the magnetic balanced current sensor is disposed in an annular core 120 having a gap, a secondary winding 121 wound around the core 120, and a gap portion 120 a of the core 120. The Hall element 122 is provided. The magnetic balance type current sensor is further provided with a current amplification circuit 123 that amplifies the Hall voltage Vh of the Hall element 122 and converts the amplified voltage into a current Ic. One end of the secondary winding 121 is connected to the current amplifier circuit 123, and the other end is grounded via the load resistor R. Similarly to the magnetic proportional current sensor, the current line CL is disposed in a space surrounded by the core 120 and in a direction perpendicular to the axis of the core 120. In this magnetic balance type current sensor, the winding direction of the secondary winding 121, the amplification factor of the current amplification circuit 123, and the like are the magnetic fields generated in the core 120 when the detected current If flows through the current line CL. And the magnetic field generated in the core 120 when the current Ic flows through the secondary winding 121 is set to cancel.

以上の構成を有する磁気平衡式電流センサでは、被検出電流Ifに応じてホール素子122の発生したホール電圧Vhを、電流増幅回路123を通じてまず電流Icに変換して二次巻線121に出力する。こうして電流Icが二次巻線121を流れると、被検出電流Ifに基づく磁界と、上記電流Icに基づく磁界、いわゆるキャンセル磁界とが相殺されて平衡状態が形成される。このとき、上記負荷抵抗Rにおける電圧降下分をセンサ出力電圧Vsとして検出し、このセンサ出力電圧Vsに基づき上記電流Icを検出すれば、電流線CLを流れる被検出電流Ifの検出が可能となる。このような磁気平衡式電流センサによれば、ホール素子の温度依存性に起因する温度ドリフトも好適に抑制され、また被検出電流Ifとセンサ出力電圧Vsとの直線性も良好であることから、高い精度のもとに被検出電流Ifを検出することができるようになる。
特開2002−228689号公報
In the magnetic balance type current sensor having the above configuration, the Hall voltage Vh generated by the Hall element 122 according to the detected current If is first converted into the current Ic through the current amplifier circuit 123 and output to the secondary winding 121. . When the current Ic flows through the secondary winding 121 in this way, the magnetic field based on the detected current If and the magnetic field based on the current Ic, that is, a so-called cancellation magnetic field are canceled out to form an equilibrium state. At this time, if the voltage drop in the load resistor R is detected as the sensor output voltage Vs and the current Ic is detected based on the sensor output voltage Vs, the detected current If flowing through the current line CL can be detected. . According to such a magnetic balance type current sensor, the temperature drift due to the temperature dependence of the Hall element is also preferably suppressed, and the linearity between the detected current If and the sensor output voltage Vs is also good. The detected current If can be detected with high accuracy.
JP 2002-228689 A

ところで、上述のような磁気平衡式電流センサでは、二次巻線121の巻かれたコア120とホール素子122との位置関係によってホール素子122周囲のキャンセル磁界の強さが変化してしまうため、それらの組み付け位置の精度によって電流の検出精度が大きく影響されてしまう。またたとえ組み付け時にはそれらの位置精度が十分に確保されていたとしても、例えば周囲温度等に起因して時間の経過とともに位置関係が変化して、電流センサの検出精度が悪化してしまうおそれがある。   By the way, in the magnetic balance type current sensor as described above, the strength of the canceling magnetic field around the Hall element 122 changes depending on the positional relationship between the core 120 around which the secondary winding 121 is wound and the Hall element 122. The accuracy of current detection is greatly affected by the accuracy of the assembly position. Even if the positional accuracy is sufficiently secured at the time of assembly, the positional relationship may change over time due to, for example, the ambient temperature, and the current sensor detection accuracy may deteriorate. .

本発明は、こうした実情に鑑みてなされたものであり、その目的は、電流検出精度の更なる向上を図ることのできる磁気平衡式電流センサを提供することにある。   The present invention has been made in view of such circumstances, and an object of the present invention is to provide a magnetic balance type current sensor capable of further improving current detection accuracy.

こうした目的を達成するため、請求項1に記載の発明では、電流線への被検出電流の通電により発生する磁界に対して方向の異なるキャンセル磁界を通電に応じて発生する二次巻線と、上記電流線および上記二次巻線の近傍に配設されるホール素子とを有するとともに、周囲の磁界に応じて上記ホール素子に発生するホール電圧により上記二次巻線への通電を行って、該ホール素子の周囲において上記電流線の周囲の磁界と上記キャンセル磁界とが相殺される平衡状態となったときの上記二次巻線に流れる電流に基づき上記被検出電流を検出する磁気平衡式電流センサにおいて、上記二次巻線を、上記ホール素子の形成される半導体基板に一体に形成するようにした。   In order to achieve such an object, in the invention described in claim 1, a secondary winding that generates a canceling magnetic field having a direction different from a magnetic field generated by energization of a current to be detected applied to a current line in response to energization; And having a Hall element disposed in the vicinity of the current line and the secondary winding, and energizing the secondary winding by a Hall voltage generated in the Hall element in response to a surrounding magnetic field, A magnetically balanced current for detecting the detected current based on the current flowing through the secondary winding when the magnetic field around the current line and the canceling magnetic field cancel each other around the Hall element. In the sensor, the secondary winding is integrally formed on a semiconductor substrate on which the Hall element is formed.

上記構成では、二次巻線とホール素子とが同一の半導体基板に形成されている。こうした場合、半導体プロセス技術を用いて、二次巻線とホール素子との位置決めを極めて高い精度で行うことができるため、電流の検出精度を向上することができるようになる。   In the above configuration, the secondary winding and the Hall element are formed on the same semiconductor substrate. In such a case, the current detection accuracy can be improved because the positioning of the secondary winding and the Hall element can be performed with extremely high accuracy using semiconductor process technology.

ちなみにこうした磁気平衡式電流センサでは、ホール素子と二次巻線とを極めて近い位置に配置することができるため、たとえコアによる集磁を行わなくても、小電流で十分に強いキャンセル磁界をホール素子に作用させることができる。そのため、上記構成では、コアを割愛することが可能でもある。勿論、コアが必要な場合には、ホール素子や二次巻線と共に、コアも同一の半導体基板に一体形成するように、磁気平衡式電流センサを構成することは可能である。   By the way, in such a magnetic balanced current sensor, the Hall element and the secondary winding can be arranged very close to each other, so that a sufficiently strong canceling magnetic field can be generated with a small current even if the magnetic flux is not collected by the core. It can act on the element. Therefore, in the above configuration, it is possible to omit the core. Of course, when a core is required, it is possible to configure the magnetic balance type current sensor so that the core is integrally formed on the same semiconductor substrate together with the Hall element and the secondary winding.

またこの磁気平衡式電流センサにおいて、請求項2に記載の発明によるように、上記二次巻線を、上記被検出電流の流れる方向に直交する方向がその軸心方向となるように形成すれば、電流線への被検出電流の通電により発生する磁界のうち、上記二次巻線の軸心方向、すなわちキャンセル磁界の方向と平行な方向における磁界成分がより大きくなるため、ホール素子において発生するホール電圧の変化量も大きくなり、電流検出の精度をより向上することができるようになる。   In this magnetic balance type current sensor, as in the invention according to claim 2, if the secondary winding is formed such that the direction perpendicular to the direction in which the detected current flows is the axial direction. Of the magnetic field generated by energizing the current to be detected to the current line, the magnetic field component in the axial direction of the secondary winding, that is, the direction parallel to the direction of the canceling magnetic field is larger, so that it is generated in the Hall element. The amount of change in Hall voltage is also increased, and the accuracy of current detection can be further improved.

こうした請求項1または請求項2に記載の磁気平衡式電流センサにおいて、上記二次巻線は、例えば請求項3に記載の発明によるように、上記半導体基板の内部に並行して延伸された複数の帯状の導体パターンからなる第1配線パターンと、上記半導体基板の内部に並行して延伸された複数の帯状の導体パターンからなり、上記第1配線パターンと平行に形成された第2配線パターンと、を備えるとともに、上記第1配線パターンの導体パターンのそれぞれについて、その先端および基端を上記第2配線パターンの導体パターンの先端およびそれに隣接する同第2配線パターンの導体パターンの基端にそれぞれ接続する2つの導電性の接続部を設けることで形成される。このように第1配線パターン、第2配線パターン、および接続部といった複数の部材から上記二次巻線を構成するようにすれば、半導体基板における二次巻線の配置に関してその自由度が向上するようになり、ひいては半導体基板においてより的確な形態で二次巻線を形成することができるようになる。   In such a magnetic balance type current sensor according to claim 1 or 2, the secondary winding includes a plurality of parallel wires extending in parallel to the inside of the semiconductor substrate, for example, according to the invention according to claim 3. A first wiring pattern comprising a strip-shaped conductor pattern, and a second wiring pattern comprising a plurality of strip-shaped conductor patterns extending in parallel with the inside of the semiconductor substrate and formed in parallel with the first wiring pattern; For each of the conductor patterns of the first wiring pattern, the tip and the base end thereof are respectively connected to the tip of the conductor pattern of the second wiring pattern and the base end of the conductor pattern of the second wiring pattern adjacent thereto. It is formed by providing two conductive connection portions to be connected. If the secondary winding is constituted by a plurality of members such as the first wiring pattern, the second wiring pattern, and the connection portion in this way, the degree of freedom with respect to the arrangement of the secondary winding in the semiconductor substrate is improved. As a result, the secondary winding can be formed in a more accurate form on the semiconductor substrate.

更に、請求項3に記載の磁気平衡式電流センサにおいて、請求項4に記載の発明によるように、上記半導体基板の同一層に上記第1配線パターンの各導体パターンが形成され、それとは別の上記半導体基板の同一層に上記第2配線パターンの各導体パターンが形成されるようにすれば、半導体プロセス技術を用いて上記二次巻線をより容易に形成することができるようになる。   Furthermore, in the magnetic balance type current sensor according to claim 3, each conductor pattern of the first wiring pattern is formed in the same layer of the semiconductor substrate as in the invention according to claim 4. If each conductor pattern of the second wiring pattern is formed on the same layer of the semiconductor substrate, the secondary winding can be more easily formed using a semiconductor process technique.

また、請求項3または請求項4に記載の磁気平衡式電流センサにおいて、請求項5に記載の発明によるように、上記ホール素子を、制御電流の方向が上記半導体基板の厚さ方向となる縦型ホール素子とし、上記二次巻線を、上記ホール素子の上記制御電流の方向に対して直交する方向がその軸心方向となるように形成することが、キャンセル磁界を発生するための二次巻線への通電量を抑制する点から有効である。すなわち、このように二次巻線を縦型ホール素子の制御電流の方向に対して直交する方向がその軸心方向となるように形成すれば、同縦型ホール素子によって検出されるキャンセル磁界の大きさがより大きくなるため、二次巻線への通電量を少なくしても、電流線の周囲の磁界を相殺して平衡状態とするのに十分なキャンセル磁界を発生させることができるようになる。   Further, in the magnetic balance type current sensor according to claim 3 or 4, as in the invention according to claim 5, the Hall element has a longitudinal direction in which the direction of the control current is the thickness direction of the semiconductor substrate. And forming the secondary winding so that the direction orthogonal to the direction of the control current of the Hall element is the axial direction of the Hall element. This is effective from the viewpoint of suppressing the amount of current supplied to the winding. That is, if the secondary winding is formed so that the direction perpendicular to the control current direction of the vertical Hall element is the axial direction of the secondary winding, the canceling magnetic field detected by the vertical Hall element is reduced. Since the size is larger, even if the energization amount to the secondary winding is reduced, it is possible to generate a canceling magnetic field sufficient to cancel out the magnetic field around the current line and achieve an equilibrium state. Become.

こうした請求項5に記載の磁気平衡式電流センサにおいて、上記二次巻線の具体的な構成としては、例えば請求項6に記載の発明によるように、
(イ)その第1配線パターンおよび第2配線パターンが共に、前記ホール素子に対して前記半導体基板の厚さ方向における同一の側に位置されるように形成される。
あるいは、請求項8に記載の発明によるように、
(ロ)上記半導体基板の厚さ方向において、その第1配線パターンと第2配線パターンとの間に上記ホール素子が位置されるように形成される。
等々、を採用することができる。このうち上記(イ)の構成を採用する場合には、更に請求項7に記載の発明によるように、上記二次巻線が、上記半導体基板の厚さ方向においてその第1配線パターンおよび第2配線パターンが共に、上記ホール素子に対して上記電流線が配置される側に位置されるように形成されるようにすれば、二次巻線が電流線に対してホール素子に近い側に配置されるため、上記キャンセル磁界を発生させるための二次巻線への通電量をより少なくすることができるようになる。また、上記(ロ)の構成によれば、二次巻線への通電によって生じるキャンセル磁界が最も強い領域内にホール素子が配設されることになるため、上記キャンセル磁界を発生させるための二次巻線への通電量をさらに少なくすることができるようになる。
In such a magnetic balanced current sensor according to claim 5, as a specific configuration of the secondary winding, for example, according to the invention according to claim 6,
(A) Both the first wiring pattern and the second wiring pattern are formed so as to be located on the same side in the thickness direction of the semiconductor substrate with respect to the Hall element.
Alternatively, as in the invention according to claim 8,
(B) The Hall element is formed so as to be positioned between the first wiring pattern and the second wiring pattern in the thickness direction of the semiconductor substrate.
And so on. Among these, when adopting the configuration of (a) above, as in the invention according to claim 7, the secondary winding has the first wiring pattern and the second wiring in the thickness direction of the semiconductor substrate. If both the wiring patterns are formed so as to be positioned on the side where the current line is disposed with respect to the Hall element, the secondary winding is disposed on the side closer to the Hall element with respect to the current line. As a result, the energization amount to the secondary winding for generating the canceling magnetic field can be further reduced. Further, according to the configuration (b), the Hall element is disposed in a region where the cancellation magnetic field generated by energization of the secondary winding is strongest. It is possible to further reduce the energization amount to the next winding.

また、請求項1〜8のいずれかに記載の磁気平衡式電流センサにおいて、請求項9に記載の発明によるように、上記ホール素子の特性を調整する回路および同ホール素子の出力処理を行なう処理回路を上記ホール素子の形成される半導体基板に一体に形成するようにすれば、二次巻線、ホール素子、およびその周辺回路が1チップ上に集積されることから、磁気平衡式電流センサの小型化と製造コストの抑制とを併せて図ることができるようになる。   Further, in the magnetic balanced current sensor according to any one of claims 1 to 8, according to the invention according to claim 9, a circuit for adjusting the characteristics of the Hall element and a process for performing output processing of the Hall element If the circuit is integrally formed on the semiconductor substrate on which the Hall element is formed, the secondary winding, the Hall element and its peripheral circuit are integrated on one chip. It becomes possible to achieve both downsizing and reduction in manufacturing cost.

(第1の実施の形態)
以下、本発明にかかる磁気平衡式電流センサを具体化した第1の実施の形態について、図1〜図6を参照しつつ説明する。
(First embodiment)
Hereinafter, a first embodiment in which a magnetic balance type current sensor according to the present invention is embodied will be described with reference to FIGS.

図1に示されるように、この磁気平衡式電流センサは、大きくは、被検出電流Ifの流れる電流線CLに近接される磁気検出部10と、該磁気検出部10からの出力に基づいて上記被検出電流Ifを検出するための各種処理を行う処理回路30とを備えて構成されている。本実施の形態において、これら磁気検出部10および処理回路30は、同一の半導体基板1上に配設されている。   As shown in FIG. 1, this magnetic balanced current sensor is largely based on the magnetic detection unit 10 that is close to the current line CL through which the detected current If flows and the output from the magnetic detection unit 10. And a processing circuit 30 that performs various processes for detecting the detected current If. In the present embodiment, the magnetic detection unit 10 and the processing circuit 30 are disposed on the same semiconductor substrate 1.

このうち磁気検出部10は、縦型ホール素子11と、その上方に配設された二次巻線20とを備えて構成されている。二次巻線20は、半導体基板1の内部に並行して延伸された複数の帯状の第1導体パターン21と、同じく半導体基板1の内部に並行して延伸された複数の帯状の第2導体パターン22と、これら第1導体パターン21および第2導体パターン22を電気的に接続する接続部25とを備えて構成されている。上記電流線CLは、二次巻線20の上方にあって、その被検出電流Ifの方向が上記二次巻線20の軸心Oの方向と直交するように配置されている。以下、こうした磁気検出部10について、更に詳細に説明する。   Among these, the magnetic detection unit 10 includes a vertical Hall element 11 and a secondary winding 20 disposed above the vertical Hall element 11. The secondary winding 20 includes a plurality of strip-shaped first conductor patterns 21 extending in parallel inside the semiconductor substrate 1 and a plurality of strip-shaped second conductors extending in parallel inside the semiconductor substrate 1. The pattern 22 includes a connection portion 25 that electrically connects the first conductor pattern 21 and the second conductor pattern 22. The current line CL is arranged above the secondary winding 20 so that the direction of the detected current If is orthogonal to the direction of the axis O of the secondary winding 20. Hereinafter, the magnetic detection unit 10 will be described in more detail.

図2に、図1中の二次巻線20の軸心Oに沿った磁気検出部10の断面構造を示す。同図2に示されるように、磁気検出部10では、縦型ホール素子11の形成されたベース基板1aの上方に、それぞれ層間絶縁膜からなる第1スペーサ層IDL1、第2配線パターン層IDL2、第2スペーサ層IDL3および第1配線パターン層IDL4が順に、ベース基板1aの上面に平行となるように積層されている。第2配線パターン層IDL2には、二次巻線20の第2配線パターン24を構成する各第2導体パターン22が層間絶縁膜内に埋込形成されている。また第1配線パターン層IDL4には、二次巻線20の第1配線パターン23を構成する各第1導体パターン21が層間絶縁膜内に埋込形成されている。すなわち、第1配線パターン23の各第1導体パターン21は、半導体基板1内の同一の層(第1配線パターン層IDL4)内に形成されており、また第2配線パターン24の各第2導体パターン22は、それとは別の半導体基板1内の同一の層(第2配線パターンIDL2)に、第1配線パターン23と平行をなすように形成されている。なお、第2スペーサ層IDL3の層間絶縁膜内には、第1導体パターン21と第2導体パターン22とを接続する導電性の接続部25(図1参照)が埋込形成されている。   FIG. 2 shows a cross-sectional structure of the magnetic detection unit 10 along the axis O of the secondary winding 20 in FIG. As shown in FIG. 2, in the magnetic detection unit 10, a first spacer layer IDL1, a second wiring pattern layer IDL2, each made of an interlayer insulating film, are provided above the base substrate 1a on which the vertical Hall elements 11 are formed. The second spacer layer IDL3 and the first wiring pattern layer IDL4 are sequentially stacked so as to be parallel to the upper surface of the base substrate 1a. In the second wiring pattern layer IDL2, the second conductor patterns 22 constituting the second wiring pattern 24 of the secondary winding 20 are embedded in the interlayer insulating film. In the first wiring pattern layer IDL4, the first conductor patterns 21 constituting the first wiring pattern 23 of the secondary winding 20 are embedded in the interlayer insulating film. That is, each first conductor pattern 21 of the first wiring pattern 23 is formed in the same layer (first wiring pattern layer IDL4) in the semiconductor substrate 1, and each second conductor of the second wiring pattern 24. The pattern 22 is formed in the same layer (second wiring pattern IDL2) in another semiconductor substrate 1 so as to be parallel to the first wiring pattern 23. A conductive connecting portion 25 (see FIG. 1) for connecting the first conductor pattern 21 and the second conductor pattern 22 is embedded in the interlayer insulating film of the second spacer layer IDL3.

こうした二次巻線20の第1配線パターン23および第2配線パターン24は、縦型ホール素子11と半導体基板1の上方に配置される電流線CLとに挟まれる態様で配設されている。すなわち、半導体基板1の厚さ方向において、二次巻線20の第1配線パターン23および第2配線パターン24は共に、縦型ホール素子11に対して電流線CLが配置されたその上方に配置されている。   The first wiring pattern 23 and the second wiring pattern 24 of the secondary winding 20 are arranged so as to be sandwiched between the vertical Hall element 11 and the current line CL arranged above the semiconductor substrate 1. That is, in the thickness direction of the semiconductor substrate 1, the first wiring pattern 23 and the second wiring pattern 24 of the secondary winding 20 are both disposed above the current line CL with respect to the vertical Hall element 11. Has been.

図3に、こうして半導体基板1の内部に埋込形成された二次巻線20の斜視構造を示す。ここで各導体パターン21、22の図中右側の端部を先端とし、図中左上側の端部を基端とすると、各第2導体パターン22がその先端から基端まで真直に延伸されているのに対して、第1導体パターン21は、その先端側と基端側とがそれぞれ隣接する第2導体パターン22の上方に位置するように、略S字状に屈曲して延伸されている。そして、こうした第1導体パターン21のそれぞれについて、その先端および基端を第2導体パターン22の先端およびそれに隣接する同第2導体パターン22の基端にそれぞれ接続する2つの導電性の接続部25が設けられている。なお、本実施の形態では、上記第1配線パターン23の各第1導体パターン21、上記第2配線パターン24の各第2導体パターン22、および上記接続部25の材質を、アルミニウム(Al)としている。また、接続部25については、半導体プロセス技術により、ビアホールとして形成するようにしている。   FIG. 3 shows a perspective structure of the secondary winding 20 embedded in the semiconductor substrate 1 in this way. Here, assuming that the end on the right side of each conductor pattern 21, 22 is the front end and the upper left end in the figure is the base end, each second conductor pattern 22 is straightly extended from the front end to the base end. In contrast, the first conductor pattern 21 is bent and extended in a substantially S shape so that the distal end side and the proximal end side thereof are located above the adjacent second conductor pattern 22. . And about each of these 1st conductor patterns 21, the two electroconductive connection part 25 which each connects the front-end | tip and base end to the front-end | tip of the 2nd conductor pattern 22, and the base end of the 2nd conductor pattern 22 adjacent to it. Is provided. In the present embodiment, the materials of the first conductor patterns 21 of the first wiring patterns 23, the second conductor patterns 22 of the second wiring patterns 24, and the connection portions 25 are aluminum (Al). Yes. Further, the connection portion 25 is formed as a via hole by a semiconductor process technique.

次に、縦型ホール素子11の構造および磁界検出原理について、図4を参照しながらその概略を説明する。図4(a)はこの縦型ホール素子11の平面構造を模式的に示したものであり、図4(b)は図4(a)中のL1−L1に沿った同縦型ホール素子11の断面構造を、図4(c)は図4(a)中のL2−L2に沿った同縦型ホール素子11の断面構造をそれぞれ模式的に示したものである。   Next, the outline of the structure and magnetic field detection principle of the vertical Hall element 11 will be described with reference to FIG. FIG. 4A schematically shows the planar structure of the vertical Hall element 11, and FIG. 4B shows the vertical Hall element 11 along L1-L1 in FIG. 4A. FIG. 4C schematically shows the cross-sectional structure of the vertical Hall element 11 along L2-L2 in FIG. 4A.

縦型ホール素子11は、ベース基板1aの表面に垂直な成分を含む制御電流Ibが供給された状態で、同ベース基板1aの表面に平行な磁界成分が印加されるとき、その磁界成分に対応するホール電圧Vhを出力する素子である。すなわち、縦型ホール素子11における制御電流Ibの方向は、半導体基板1の厚さ方向となっている。具体的には、この縦型ホール素子11は、その断面構造を同図4(b)に示すように、例えばP型のシリコンからなる半導体層(P−sub)12と、この表面にN型の導電型不純物が導入されるかたちで形成された埋込層BLと、さらにこの上にエピタキシャル成長にて形成されたN型のシリコンからなる半導体領域13とを有して構成されている。半導体層12に形成された上記埋込層BLの不純物濃度は、上記半導体領域13よりも高い濃度となっている。   The vertical Hall element 11 corresponds to a magnetic field component when a parallel magnetic field component is applied to the surface of the base substrate 1a in a state where a control current Ib including a component perpendicular to the surface of the base substrate 1a is supplied. This is an element that outputs a Hall voltage Vh. That is, the direction of the control current Ib in the vertical Hall element 11 is the thickness direction of the semiconductor substrate 1. Specifically, as shown in FIG. 4B, the vertical Hall element 11 has a semiconductor layer (P-sub) 12 made of, for example, P-type silicon and an N-type on the surface thereof, as shown in FIG. The buried layer BL is formed by introducing a conductive type impurity, and the semiconductor region 13 made of N-type silicon is formed thereon by epitaxial growth. The impurity concentration of the buried layer BL formed in the semiconductor layer 12 is higher than that of the semiconductor region 13.

このうち半導体領域13には、その平面構造を図4(a)に示すように、ベース基板1aから縦型ホール素子11を電気的に隔離するための拡散分離壁としてP型の拡散層14が、上記半導体層12に接続するように四角筒状に形成されている。また、この拡散層14の内周面には、P型拡散層15、16とが、上記埋込層BLに接続されるように形成されており、半導体領域13は、これら拡散層14〜16によって略直方体形状をなす3つの領域13a〜13cに分割されている。これら領域13a〜13cのうち、中央に位置する領域13aの表面には、不純物濃度(N型)が選択的に高められるかたちで3つのコンタクト領域(N+拡散層)17a、17d、17eが形成されている。コンタクト領域17a、17d、17eは、コンタクト領域17aが中央に位置するように、直線上に配置されている。一方、領域13bの表面中央には、不純物濃度(N型)が選択的に高められるかたちでコンタクト領域(N+拡散層)17bが形成され、領域13cの表面中央には、同様に、不純物濃度(N型)が選択的に高められるかたちでコンタクト領域(N+拡散層)17cがそれぞれ形成されている。すなわち、上記コンタクト領域17aは、上記拡散層15および上記拡散層16を隔ててコンタクト領域17bおよびコンタクト領域17cの各々に対向するように配置されている。これらコンタクト領域17a〜17eには、それぞれ端子S、端子G1、端子G2、端子V1、および端子V2がそれぞれ接続されている。そしてこの縦型ホール素子11においては、上記領域17aの基板内部に電気的に区画される領域にあって上記コンタクト領域17dおよびコンタクト領域17eにて挟まれる領域が、いわゆるホールプレートHPとなる。   Among these, the semiconductor region 13 has a P-type diffusion layer 14 as a diffusion separation wall for electrically isolating the vertical Hall element 11 from the base substrate 1a as shown in FIG. A rectangular tube is formed so as to be connected to the semiconductor layer 12. In addition, P-type diffusion layers 15 and 16 are formed on the inner peripheral surface of the diffusion layer 14 so as to be connected to the buried layer BL, and the semiconductor region 13 includes the diffusion layers 14 to 16. Are divided into three regions 13a to 13c having a substantially rectangular parallelepiped shape. Of these regions 13a to 13c, three contact regions (N + diffusion layers) 17a, 17d, and 17e are formed on the surface of the region 13a located in the center so that the impurity concentration (N-type) is selectively increased. Has been. The contact regions 17a, 17d, and 17e are arranged on a straight line so that the contact region 17a is located at the center. On the other hand, a contact region (N + diffusion layer) 17b is formed in the center of the surface of the region 13b in a manner that the impurity concentration (N type) is selectively increased, and the impurity concentration is similarly formed in the center of the surface of the region 13c. Contact regions (N + diffusion layers) 17c are formed in such a manner that (N-type) is selectively enhanced. That is, the contact region 17a is disposed so as to face the contact region 17b and the contact region 17c with the diffusion layer 15 and the diffusion layer 16 therebetween. A terminal S, a terminal G1, a terminal G2, a terminal V1, and a terminal V2 are connected to the contact regions 17a to 17e, respectively. In the vertical Hall element 11, a region sandwiched between the contact region 17d and the contact region 17e in a region electrically partitioned inside the substrate of the region 17a is a so-called hole plate HP.

ここで例えば、図4(c)に示すように、端子Sから端子G1へ、また端子Sから端子G2へそれぞれ一定の制御電流Ibを流すと、その制御電流Ibは、基板表面に形成されたコンタクト領域17aから上記ホールプレートHP、埋込層BLを通じて、コンタクト領域17bおよびコンタクト領域17cへとそれぞれ流れ込む。その結果、上記ホールプレートHPには、基板表面に垂直な成分を主に含む制御電流Ibが流れることとなる。このため、この制御電流Ibを流した状態において、基板表面に平行な成分を含む磁界(例えば図4中に矢印Bで示される磁界)が当該縦型ホール素子11のホールプレートHPに印加されたとすると、ホール効果の発現によって、図4(b)に示すように、上記端子V1と端子V2との間にその磁界に対応するホール電圧Vhが発生する。よって、このホール電圧Vhを検出することで、当該縦型ホール素子11の基板表面、すなわち半導体基板1に平行な磁界成分が求められる。   Here, for example, as shown in FIG. 4C, when a constant control current Ib is passed from the terminal S to the terminal G1 and from the terminal S to the terminal G2, the control current Ib is formed on the substrate surface. The contact region 17a flows into the contact region 17b and the contact region 17c through the hole plate HP and the buried layer BL. As a result, a control current Ib mainly containing a component perpendicular to the substrate surface flows through the hall plate HP. For this reason, when the control current Ib is applied, a magnetic field including a component parallel to the substrate surface (for example, a magnetic field indicated by an arrow B in FIG. 4) is applied to the Hall plate HP of the vertical Hall element 11. Then, due to the expression of the Hall effect, as shown in FIG. 4B, a Hall voltage Vh corresponding to the magnetic field is generated between the terminal V1 and the terminal V2. Therefore, by detecting the Hall voltage Vh, a magnetic field component parallel to the substrate surface of the vertical Hall element 11, that is, the semiconductor substrate 1 is obtained.

こうした縦型ホール素子11の各端子S、G1、G2、V1、V2、および上述の二次巻線20の両端部は、それぞれ処理回路30に接続されている。次に、この処理回路30の概略構成について、図5を参照しつつ説明する。   Each terminal S, G1, G2, V1, V2 of the vertical Hall element 11 and both ends of the secondary winding 20 are connected to the processing circuit 30, respectively. Next, a schematic configuration of the processing circuit 30 will be described with reference to FIG.

同図5に示されるように、処理回路30は、制御電流印加回路31、電流増幅回路32、負荷抵抗R、検出回路33、およびホール素子補正回路34を備えて構成されている。
制御電流印加回路31には、縦型ホール素子11の各端子S、G1、G2がそれぞれ接続されている。この制御電流印加回路31は、定電流源回路または定電圧源回路を備えて構成されており、端子Sに対して一定の制御電流Ibを出力する。
As shown in FIG. 5, the processing circuit 30 includes a control current application circuit 31, a current amplification circuit 32, a load resistor R, a detection circuit 33, and a Hall element correction circuit 34.
Each terminal S, G1, G2 of the vertical Hall element 11 is connected to the control current application circuit 31. The control current application circuit 31 includes a constant current source circuit or a constant voltage source circuit, and outputs a constant control current Ib to the terminal S.

また、電流増幅回路32には、縦型ホール素子11の端子V1、V2が接続されるとともに、端子INを介して二次巻線20の一方の端部に接続されている。電流増幅回路32は、端子V1および端子V2の電位差として検出されるホール電圧Vhを差動増幅するとともに、この増幅された電圧に比例したキャンセル電流Icを端子INに出力する。具体的には、この電流増幅回路32は、端子V1、V2からの入力電圧を差動増幅する比較器と、この比較器の出力電圧に基づき作動し、同比較器の出力電圧を電流増幅して上記端子INに出力する相補エミッタホロワ回路とを備えて構成されている。そして、電流増幅回路32における各回路定数は、縦型ホール素子11の周囲において、被検出電流Ifの流れる電流線CLの周囲に発生する磁界と、二次巻線20にキャンセル電流Icが流れることによって同二次巻線20の周囲に発生するキャンセル磁界とが相殺されて平衡状態となるような値に設定されている。   The current amplifier circuit 32 is connected to the terminals V1 and V2 of the vertical Hall element 11 and is connected to one end of the secondary winding 20 via the terminal IN. The current amplifier circuit 32 differentially amplifies the Hall voltage Vh detected as the potential difference between the terminal V1 and the terminal V2, and outputs a cancel current Ic proportional to the amplified voltage to the terminal IN. Specifically, the current amplification circuit 32 operates based on a comparator that differentially amplifies the input voltage from the terminals V1 and V2, and an output voltage of the comparator, and amplifies the output voltage of the comparator. And a complementary emitter follower circuit for outputting to the terminal IN. The circuit constants in the current amplifying circuit 32 are such that the magnetic field generated around the current line CL through which the detected current If flows around the vertical Hall element 11 and the cancel current Ic flows through the secondary winding 20. Is set to a value that cancels out the canceling magnetic field generated around the secondary winding 20 to achieve an equilibrium state.

一方、二次巻線20の他方の端部は、端子OUTを介して負荷抵抗Rに接続されている。負荷抵抗Rの両端は、検出回路33に接続されている。検出回路33は、負荷抵抗Rの端子間電圧であるセンサ出力電圧Vsに基づき、二次巻線20に流れるキャンセル電流Icを検出する。この検出回路33により、電流線CLの周囲に発生する磁界と二次巻線20の周囲に発生するキャンセル磁界とが平衡状態となった状態でのキャンセル電流Icを検出することができる。   On the other hand, the other end of the secondary winding 20 is connected to a load resistor R via a terminal OUT. Both ends of the load resistor R are connected to the detection circuit 33. The detection circuit 33 detects the cancel current Ic flowing through the secondary winding 20 based on the sensor output voltage Vs that is the voltage across the load resistor R. The detection circuit 33 can detect the cancel current Ic in a state where the magnetic field generated around the current line CL and the cancel magnetic field generated around the secondary winding 20 are in an equilibrium state.

また、ホール素子補正回路34は、縦型ホール素子11に接続され、同縦型ホール素子11の特性を補正(調整)するための回路である。このホール素子補正回路34は、縦型ホール素子11の補正係数が予め記憶されたEPROMやEEPROM、あるいはヒューズのトリム回路等から構成されている。   The Hall element correction circuit 34 is connected to the vertical Hall element 11 and is a circuit for correcting (adjusting) the characteristics of the vertical Hall element 11. The Hall element correction circuit 34 is composed of an EPROM or EEPROM in which the correction coefficient of the vertical Hall element 11 is stored in advance, a fuse trim circuit, or the like.

次に、以上のように構成された磁気平衡式電流センサによる被検出電流Ifの検出手順について、図6を参照しつつ説明する。
磁気平衡式電流センサでは、被検出電流Ifの検出に際して、処理回路30の制御電流印加回路31を通じて縦型ホール素子11に制御電流Ibを出力する。この制御電流Ibは、例えば同図6に示すように、半導体基板1の厚さ方向にて下方に流れるように出力される。
Next, the detection procedure of the detected current If by the magnetic balance type current sensor configured as described above will be described with reference to FIG.
The magnetic balance type current sensor outputs the control current Ib to the vertical Hall element 11 through the control current application circuit 31 of the processing circuit 30 when detecting the detected current If. The control current Ib is output so as to flow downward in the thickness direction of the semiconductor substrate 1, for example, as shown in FIG.

ここで、電流線CLに同図6に示す方向に被検出電流Ifが流されると、電流線CLの周囲には、被検出電流Ifが流れている方向に対して時計回りに同心円状の磁束が発生する。このとき磁気平衡式電流センサでは、この被検出電流Ifによる磁界に応じて縦型ホール素子11からホール電圧Vhが出力される。磁気平衡式電流センサは、このホール電圧Vhを電流増幅回路32を通じてまずキャンセル電流Icに変換し、同キャンセル電流Icを端子INを介して二次巻線20に出力する。上述のように、電流増幅回路32における各回路定数は、電流線CLの周囲に発生する磁界と二次巻線20の周囲に発生するキャンセル磁界とが平衡状態となるような値に設定されているため、二次巻線20には、図6に示す方向にキャンセル電流Icが流れることとなる。すなわち、縦型ホール素子11の周囲においては、二次巻線20への通電により、電流線CLへの被検出電流Ifの通電により発生する磁界に対して方向の異なるキャンセル磁界が発生する。   Here, when the detected current If flows through the current line CL in the direction shown in FIG. 6, a concentric magnetic flux is formed around the current line CL in the clockwise direction with respect to the direction in which the detected current If flows. Will occur. At this time, in the magnetic balanced current sensor, the Hall voltage Vh is output from the vertical Hall element 11 in accordance with the magnetic field generated by the detected current If. The magnetic balance type current sensor first converts the Hall voltage Vh into a cancel current Ic through the current amplifier circuit 32, and outputs the cancel current Ic to the secondary winding 20 via the terminal IN. As described above, each circuit constant in the current amplifier circuit 32 is set to a value such that the magnetic field generated around the current line CL and the canceling magnetic field generated around the secondary winding 20 are in an equilibrium state. Therefore, the cancel current Ic flows in the secondary winding 20 in the direction shown in FIG. That is, in the periphery of the vertical Hall element 11, a cancellation magnetic field having a direction different from a magnetic field generated by energization of the detected current If to the current line CL is generated by energization of the secondary winding 20.

こうした二次巻線20へのキャンセル電流Icの通電は、電流線CLの周囲の磁界と二次巻線20の周囲の磁界とが縦型ホール素子11の周囲において平衡状態となって縦型ホール素子11から出力されるホール電圧Vhが「0」になるまで継続される。こうして平衡状態が形成されたときのキャンセル電流Icの大きさは、被検出電流Ifに応じて変化する。そこで、磁気平衡式電流センサは、検出回路33を通じてセンサ出力電圧Vsからこのときのキャンセル電流Icを求め、このキャンセル電流Icに基づいて被検出電流Ifを検出する。   When the canceling current Ic is applied to the secondary winding 20, the magnetic field around the current line CL and the magnetic field around the secondary winding 20 are in an equilibrium state around the vertical Hall element 11, and the vertical hall This is continued until the Hall voltage Vh output from the element 11 becomes “0”. The magnitude of the cancel current Ic when the equilibrium state is thus formed changes according to the detected current If. Therefore, the magnetic balance type current sensor obtains the cancel current Ic at this time from the sensor output voltage Vs through the detection circuit 33, and detects the detected current If based on the cancel current Ic.

以上説明したように、本実施の形態にかかる磁気平衡式電流センサによれば、以下のような効果を得ることができるようになる。
(1)二次巻線20を、縦型ホール素子11の形成される半導体基板1に一体に形成するようにした。このため、半導体プロセス技術を用いて、二次巻線20と縦型ホール素子11との位置決めを極めて高い精度で行うことができるため、被検出電流Ifの検出精度を向上することができるようになる。
As described above, according to the magnetic balance type current sensor according to the present embodiment, the following effects can be obtained.
(1) The secondary winding 20 is formed integrally with the semiconductor substrate 1 on which the vertical Hall element 11 is formed. For this reason, since the positioning of the secondary winding 20 and the vertical Hall element 11 can be performed with extremely high accuracy using semiconductor process technology, the detection accuracy of the detected current If can be improved. Become.

(2)半導体プロセス技術により二次巻線20と縦型ホール素子11との位置決めを極めて高い精度で行うことができることから、縦型ホール素子11と二次巻線20とを極めて近い位置に配置して、従来の磁気平衡式電流センサにおけるような集磁用のコアを割愛するようにした。このため、磁気平衡式電流センサを小型化することができるとともに、その製造コストを抑制することができるようにもなる。   (2) Since the positioning of the secondary winding 20 and the vertical Hall element 11 can be performed with extremely high accuracy by the semiconductor process technology, the vertical Hall element 11 and the secondary winding 20 are disposed at extremely close positions. Thus, the magnetic collecting core as in the conventional magnetic balance type current sensor is omitted. For this reason, it is possible to reduce the size of the magnetic balance type current sensor and to suppress the manufacturing cost thereof.

(3)二次巻線20を、半導体基板1の厚さ方向においてその第1配線パターン23および第2配線パターン24が共に、縦型ホール素子11に対して電流線CLが配置される側に位置されるように形成した。そして、二次巻線20が電流線CLに対して縦型ホール素子11に近い側に配置されるようにした。このため、被検出電流Ifの検出を、上記キャンセル磁界を発生させるための二次巻線20への通電量をより少なくして行うことができる。   (3) The secondary winding 20 is arranged on the side where the current line CL is arranged with respect to the vertical Hall element 11 with the first wiring pattern 23 and the second wiring pattern 24 in the thickness direction of the semiconductor substrate 1. Formed to be positioned. The secondary winding 20 is arranged on the side closer to the vertical Hall element 11 with respect to the current line CL. For this reason, the detected current If can be detected with a smaller energization amount to the secondary winding 20 for generating the cancel magnetic field.

(4)二次巻線20や縦型ホール素子11が形成された半導体基板1に、縦型ホール素子11からのホール電圧Vhを増幅するための電流増幅回路32や、縦型ホール素子11の特性を補正するためのホール素子補正回路34等の各種回路を処理回路30として一体に形成するようにした。これにより、磁気平衡式電流センサの小型化と製造コストの抑制とを併せて図ることができるようになる。
(第2の実施の形態)
次に、本発明にかかる磁気平衡式電流センサを具体化した第2の実施の形態について説明する。本実施の形態にかかる磁気平衡式電流センサの構造も、基本的には、先の第1の実施の形態にかかる磁気平衡式電流センサの構造に準じたものとなっている。ただし、本実施の形態にかかる磁気平衡式電流センサでは、二次巻線と縦型ホール素子との配置関係を変更することで、二次巻線への通電量がより少なくとも、電流線の周囲の磁界を相殺して平衡状態とするのに十分なキャンセル磁界を発生することができるようにしている。こうした磁気平衡式電流センサについて、図7〜図9を参照しつつ説明する。なお、本実施の形態にかかる磁気平衡式電流センサの処理回路部の構成は、先の第1の実施の形態における構成と基本的に同一であるため、ここではその詳細な説明を割愛することとする。また、先の第1の実施の形態と同様あるいはそれに準じた構造については、同一の符号を付してその説明は割愛する。
(4) The current amplification circuit 32 for amplifying the Hall voltage Vh from the vertical Hall element 11 or the vertical Hall element 11 on the semiconductor substrate 1 on which the secondary winding 20 and the vertical Hall element 11 are formed. Various circuits such as the Hall element correction circuit 34 for correcting the characteristics are integrally formed as the processing circuit 30. As a result, the magnetic balance type current sensor can be reduced in size and the manufacturing cost can be reduced.
(Second Embodiment)
Next, a second embodiment in which the magnetic balance type current sensor according to the present invention is embodied will be described. The structure of the magnetic balance type current sensor according to the present embodiment is basically based on the structure of the magnetic balance type current sensor according to the first embodiment. However, in the magnetic balanced current sensor according to the present embodiment, by changing the arrangement relationship between the secondary winding and the vertical Hall element, the energization amount to the secondary winding is at least around the current line. It is possible to generate a canceling magnetic field sufficient to cancel out the magnetic field and to achieve an equilibrium state. Such a magnetic balance type current sensor will be described with reference to FIGS. The configuration of the processing circuit unit of the magnetic balance type current sensor according to the present embodiment is basically the same as the configuration in the first embodiment, and therefore detailed description thereof is omitted here. And In addition, the same reference numerals are assigned to the same or similar structures as those in the first embodiment, and the description thereof is omitted.

図7に示すように、本実施の形態の磁気検出部40は、縦型ホール素子11と、この縦型ホール素子11を半導体基板の厚さ方向に挟んで形成された二次巻線50とを備えて構成されている。電流線CLは、二次巻線50の上方にあって、その被検出電流Ifの方向が上記二次巻線50の軸心Oの方向と直交するように配設されている。以下、こうした磁気検出部40について、更に詳細に説明する。   As shown in FIG. 7, the magnetic detection unit 40 of the present embodiment includes a vertical Hall element 11 and a secondary winding 50 formed by sandwiching the vertical Hall element 11 in the thickness direction of the semiconductor substrate. It is configured with. The current line CL is disposed above the secondary winding 50 so that the direction of the detected current If is orthogonal to the direction of the axis O of the secondary winding 50. Hereinafter, the magnetic detection unit 40 will be described in more detail.

図8に、図7中の二次巻線50の軸心Oに沿った磁気検出部40の断面構造を示す。同図8に示されるように、磁気検出部40は、埋込層として形成された第2配線パターン24と、縦型ホール素子11とが順に積層されたベース基板1aの上方に、層間絶縁膜からなるスペーサ層IDL10および第1配線パターン23が層間絶縁膜内に埋め込み形成された配線パターン層IDL11が順に積層された構造を有している。すなわち、二次巻線50は、半導体基板1の厚さ方向において、その第1配線パターン23と第2配線パターン24との間に縦型ホール素子11が位置されるように形成されている。また、本実施の形態においても、半導体基板1の同一層に第1配線パターン23の各第1導体パターン21が形成されるとともに、それとは別の半導体基板1の同一層に第2配線パターン24の各第2導体パターン22が形成されている。そして、第2配線パターン24は、第1配線パターン23と平行となるように形成されている。   FIG. 8 shows a cross-sectional structure of the magnetic detection unit 40 along the axis O of the secondary winding 50 in FIG. As shown in FIG. 8, the magnetic detection unit 40 includes an interlayer insulating film above a base substrate 1a in which a second wiring pattern 24 formed as a buried layer and a vertical Hall element 11 are sequentially stacked. The spacer layer IDL10 and the wiring pattern layer IDL11 in which the first wiring pattern 23 is embedded in the interlayer insulating film are sequentially stacked. That is, the secondary winding 50 is formed such that the vertical Hall element 11 is positioned between the first wiring pattern 23 and the second wiring pattern 24 in the thickness direction of the semiconductor substrate 1. Also in the present embodiment, each first conductor pattern 21 of the first wiring pattern 23 is formed on the same layer of the semiconductor substrate 1, and the second wiring pattern 24 is formed on the same layer of the semiconductor substrate 1 other than that. Each second conductor pattern 22 is formed. The second wiring pattern 24 is formed to be parallel to the first wiring pattern 23.

また、上記二次巻線50は、先の第1の実施の形態同様、第1導体パターン21のそれぞれについて、その先端および基端を第2導体パターン22の先端およびそれに隣接する同第2導体パターン22の基端にそれぞれ接続する2つの導電性の接続部25aとを設けることで形成されている。   In addition, the secondary winding 50 is similar to the first embodiment in that the first conductor pattern 21 has the tip and the base end of the second conductor pattern 22 and the second conductor adjacent thereto. It is formed by providing two conductive connection portions 25a connected to the base ends of the pattern 22, respectively.

以上の構成を有する磁気平衡式電流センサによる被検出電流Ifの検出も、基本的には、先の第1の実施の形態における磁気平行電流センサによる磁気検出手順にしたがって行われる。図9は、先の第1の実施の形態に準じて、被検出電流Ifを図9に示す方向に流した場合の、電流線CLの周囲に発生する磁界の磁束、キャンセル電流Icの方向、およびこのキャンセル電流Icによって二次巻線50の周囲に発生するキャンセル磁界の磁束の方向をそれぞれ示したものである。同図9に示すように、第1配線パターン23と第2配線パターン24との間に縦型ホール素子11が形成されているため、縦型ホール素子11にはより多くの磁束が鎖交する。このため、電流線CLに被検出電流Ifが流れる際に発生する磁界を打ち消すために二次巻線50に入力されるキャンセル電流Icをより小さくすることができる。   The detection of the detected current If by the magnetic balance type current sensor having the above configuration is also basically performed according to the magnetic detection procedure by the magnetic parallel current sensor in the first embodiment. FIG. 9 shows the magnetic flux generated around the current line CL, the direction of the cancel current Ic when the detected current If flows in the direction shown in FIG. 9 according to the first embodiment, The direction of the magnetic flux of the cancel magnetic field generated around the secondary winding 50 by the cancel current Ic is shown. As shown in FIG. 9, since the vertical Hall element 11 is formed between the first wiring pattern 23 and the second wiring pattern 24, more magnetic flux is linked to the vertical Hall element 11. . For this reason, in order to cancel the magnetic field generated when the detected current If flows through the current line CL, the cancel current Ic input to the secondary winding 50 can be further reduced.

以上説明したように、本実施の形態にかかる磁気平衡式電流センサによれば、以下のような新たな効果を得ることができるようになる。
(5)半導体基板の厚さ方向において、その第1配線パターン23と第2配線パターン24との間に縦型ホール素子11が位置されるように二次巻線50を形成した。そして、二次巻線50への通電によって生じるキャンセル磁界が最も強い領域内に縦型ホール素子11を配設するようにした。このため、上記キャンセル磁界を発生させるための二次巻線50への通電量を更に少なくして、被検出電流Ifの検出を行うことができるようになる。
(他の実施の形態)
なお、この発明にかかる磁気平衡式電流センサは上記各実施の形態に限定されるものではなく、これら実施の形態を適宜変更した例えば次のような形態として実施することもできる。
As described above, according to the magnetic balance type current sensor according to the present embodiment, the following new effects can be obtained.
(5) The secondary winding 50 is formed so that the vertical Hall element 11 is positioned between the first wiring pattern 23 and the second wiring pattern 24 in the thickness direction of the semiconductor substrate. The vertical Hall element 11 is disposed in a region where the cancellation magnetic field generated by energization of the secondary winding 50 is strongest. For this reason, it becomes possible to detect the detected current If by further reducing the energization amount to the secondary winding 50 for generating the cancel magnetic field.
(Other embodiments)
The magnetic balance type current sensor according to the present invention is not limited to the above-described embodiments, and can be implemented as, for example, the following forms obtained by appropriately changing these embodiments.

・第1実施形態では、半導体基板1の厚さ方向において、二次巻線20を構成する第1および第2配線パターン23、24が共に、縦型ホール素子11に対して電流線CLが配置される側に位置するようにしていたが、第1および第2配線パターン23、24を、縦型ホール素子11に対して電流線CLが配設される側と反対側に位置するように磁気検出部10を構成するようにしてもよい。すなわち、この場合、縦型ホール素子11は、電流線CLと二次巻線20との間に挟み込まれる態様で配置されることになる。   In the first embodiment, in the thickness direction of the semiconductor substrate 1, both the first and second wiring patterns 23 and 24 constituting the secondary winding 20 are arranged with the current line CL with respect to the vertical Hall element 11. The first and second wiring patterns 23 and 24 are magnetically positioned so as to be located on the side opposite to the side on which the current line CL is disposed with respect to the vertical Hall element 11. The detection unit 10 may be configured. That is, in this case, the vertical Hall element 11 is arranged in a manner of being sandwiched between the current line CL and the secondary winding 20.

・上記各実施の形態において、第1配線パターン23の各第1導体パターン21および第2配線パターン24の各第2導体パターン22の数、すなわち二次巻線20の巻き数は任意である。例えば第1導体パターン21および第2導体パターン22の数を増加させることとすれば、二次巻線20の周囲により強いキャンセル磁界を発生させることができるため、キャンセル磁界を発生させるための二次巻線20への通電量をさらに少なくすることができるようになる。   In each of the above embodiments, the number of the first conductor patterns 21 of the first wiring pattern 23 and the number of the second conductor patterns 22 of the second wiring pattern 24, that is, the number of turns of the secondary winding 20 is arbitrary. For example, if the number of the first conductor patterns 21 and the second conductor patterns 22 is increased, a stronger canceling magnetic field can be generated around the secondary winding 20, so that a secondary for generating the canceling magnetic field is generated. The amount of current supplied to the winding 20 can be further reduced.

・上記各実施の形態において、縦型ホール素子11の構造は任意である。例えば、図10(a)〜(c)に示すような構造を有する縦型ホール素子を採用するようにしてもよい。この縦型ホール素子は、図10(b)に示すように、例えばP型のシリコンからなる半導体層(P−sub)60と、該半導体層60の表面に例えばN型の導電型不純物が導入されて拡散層(ウェル)として形成されたN型の半導体領域(Nウェル)61とを有して構成されている。また、その平面構造を図10(a)に示すように、この半導体層60には、拡散分離壁としてP型の拡散層(Pウェル)62が、上記半導体領域61を囲繞するように形成されている。拡散層62の内周面には、上記半導体領域61よりも浅い拡散深さを有するP型の拡散層(Pウェル)63、64が形成されており、半導体領域61の表面近傍は、これら拡散層62〜64によって略直方体形状をなす3つの領域61a〜61cに分割されている。そして、当該縦型ホール素子においても、中央に位置する領域61aの表面には、3つのコンタクト領域17a、17d、17eがコンタクト領域17aを中央にして直線上に形成されている。一方、領域61bの表面中央にはコンタクト領域17bが、領域61cの表面中央にはコンタクト領域17cがそれぞれ形成されている。なお、この縦型ホール素子では、上記領域61aの基板内部に電気的に区画される領域にあって上記コンタクト領域17dおよび17eにて挟まれる領域がホールプレートHPとなっている。このような構造を有する縦型ホール素子によっても、図10(c)に示すように、端子Sから端子G1へ、また端子Sから端子G2へそれぞれ一定の制御電流Ibを流すと、基板表面に垂直な成分を主に含む制御電流Ibが上記ホールプレートHPに流れるようになる。このため、この制御電流Ibを流した状態において、基板に平行な成分を含む磁界(例えば図10中に矢印Bで示される磁界)が当該縦型ホール素子のホールプレートHPに印加されると、端子V1と端子V2との間にその磁界に対応するホール電圧Vhが発生する。したがって、このホール電圧Vhを検出することで、上記半導体基板1に平行な磁界成分を求めることができる。また、このような構造の縦型ホール素子の製造にあたっては、半導体層60の表面に半導体領域61を拡散層(ウェル)として形成すればよいことから、単一の導電型からなる半導体基板を当該縦型ホール素子の形成基板として採用することができる。このため、上記各実施の形態における上記処理回路30をCMOS回路として構成することとすれば、縦型ホール素子および処理回路30を共にCMOS工程で製造することができるようになり、ひいては磁気平衡式電流センサの製造工程の簡素化を図ることができるようにもなる。   In each of the above embodiments, the structure of the vertical Hall element 11 is arbitrary. For example, you may make it employ | adopt the vertical Hall element which has a structure as shown to Fig.10 (a)-(c). In this vertical Hall element, as shown in FIG. 10B, for example, a semiconductor layer (P-sub) 60 made of, for example, P-type silicon, and, for example, an N-type conductive impurity is introduced into the surface of the semiconductor layer 60. And an N-type semiconductor region (N well) 61 formed as a diffusion layer (well). Further, as shown in FIG. 10A, the planar structure is formed in this semiconductor layer 60 with a P-type diffusion layer (P well) 62 as a diffusion separation wall so as to surround the semiconductor region 61. ing. P-type diffusion layers (P wells) 63 and 64 having a diffusion depth shallower than that of the semiconductor region 61 are formed on the inner peripheral surface of the diffusion layer 62. The layers 62 to 64 are divided into three regions 61a to 61c having a substantially rectangular parallelepiped shape. Also in the vertical Hall element, three contact regions 17a, 17d, and 17e are formed in a straight line with the contact region 17a at the center on the surface of the region 61a located at the center. On the other hand, a contact region 17b is formed at the center of the surface of the region 61b, and a contact region 17c is formed at the center of the surface of the region 61c. In the vertical Hall element, a region sandwiched between the contact regions 17d and 17e in the region that is electrically partitioned inside the substrate of the region 61a is the hole plate HP. Even with a vertical Hall element having such a structure, as shown in FIG. 10C, when a constant control current Ib is passed from the terminal S to the terminal G1 and from the terminal S to the terminal G2, respectively, A control current Ib mainly including a vertical component flows through the hall plate HP. For this reason, when a magnetic field including a component parallel to the substrate (for example, a magnetic field indicated by an arrow B in FIG. 10) is applied to the Hall plate HP of the vertical Hall element in a state where the control current Ib flows. A Hall voltage Vh corresponding to the magnetic field is generated between the terminal V1 and the terminal V2. Therefore, a magnetic field component parallel to the semiconductor substrate 1 can be obtained by detecting the Hall voltage Vh. Further, in the manufacture of the vertical Hall element having such a structure, the semiconductor region 61 may be formed as a diffusion layer (well) on the surface of the semiconductor layer 60. It can be employed as a substrate for forming a vertical Hall element. For this reason, if the processing circuit 30 in each of the above embodiments is configured as a CMOS circuit, both the vertical Hall element and the processing circuit 30 can be manufactured by a CMOS process. The manufacturing process of the current sensor can be simplified.

またこの他にも、例えば図11に示すように、端子G2、端子V2、端子S、端子V1、および端子G1がこの順に直線上に配置される縦型ホール素子を採用するようにしてもよい。このようにしても、縦型ホール素子において、制御電流Ibの方向が半導体基板1の厚さ方向となるため、電流線CLの周囲の磁界およびキャンセル磁界を縦型ホール素子により有効に検出することができる。   In addition, as shown in FIG. 11, for example, a vertical Hall element in which the terminal G2, the terminal V2, the terminal S, the terminal V1, and the terminal G1 are arranged in a straight line in this order may be adopted. . Even in this case, since the direction of the control current Ib is the thickness direction of the semiconductor substrate 1 in the vertical Hall element, the magnetic field around the current line CL and the canceling magnetic field can be effectively detected by the vertical Hall element. Can do.

・半導体支持基板に形成されるホール素子は、縦型ホール素子に限定されない。例えば、制御電流Ibの方向が半導体基板1の厚さ方向となるように、横型ホール素子を半導体基板1に形成するようにしてもよい。要するに、制御電流Ibの方向が半導体基板1の厚さ方向となるようであれば、ホール素子として任意のものを採用することができる。   The Hall element formed on the semiconductor support substrate is not limited to a vertical Hall element. For example, the lateral Hall element may be formed on the semiconductor substrate 1 so that the direction of the control current Ib is the thickness direction of the semiconductor substrate 1. In short, as long as the direction of the control current Ib is the thickness direction of the semiconductor substrate 1, an arbitrary Hall element can be adopted.

・上記各実施の形態では、半導体基板1の同一層に第1配線パターン23の各第1導体パターン21が形成されるとともに、それとは別の半導体基板1の同一層に第2配線パターン24の各第2導体パターン22が形成されている。しかしながら、第1配線パターン23の各第1導体パターン21および第2配線パターン24の各第2導体パターン22は、それぞれ必ずしも同一層に形成されなくてもよい。半導体基板1の内部に縦型ホール素子11とともに二次巻線20が形成される構成であれば、二次巻線20(50)を半導体プロセス技術を用いて形成することが可能であり、二次巻線20(50)と縦型ホール素子11との位置決めを極めて高い精度で行うことができる。   In each of the above embodiments, each first conductor pattern 21 of the first wiring pattern 23 is formed on the same layer of the semiconductor substrate 1, and the second wiring pattern 24 is formed on the same layer of a different semiconductor substrate 1. Each second conductor pattern 22 is formed. However, each first conductor pattern 21 of the first wiring pattern 23 and each second conductor pattern 22 of the second wiring pattern 24 are not necessarily formed in the same layer. If the secondary winding 20 is formed together with the vertical Hall element 11 inside the semiconductor substrate 1, the secondary winding 20 (50) can be formed using a semiconductor process technology. The positioning of the secondary winding 20 (50) and the vertical Hall element 11 can be performed with extremely high accuracy.

・第1配線パターン23の第1導体パターン21や第2配線パターン24の第2導体パターン22の材質、あるいは接続部25の材質は、アルミニウム(Al)に限定されない。例えば、第1導体パターン21および第2導体パターン22の少なくとも一方の材質に多結晶シリコンを採用するようにしてもよい。また、上記各実施の形態では、接続部25は、半導体プロセス技術により、ビアホールとして形成されている。これに代えて、接続部25を、コンタクト層として形成するようにしてもよい。   -The material of the 1st conductor pattern 21 of the 1st wiring pattern 23, the 2nd conductor pattern 22 of the 2nd wiring pattern 24, or the material of the connection part 25 is not limited to aluminum (Al). For example, polycrystalline silicon may be adopted as at least one material of the first conductor pattern 21 and the second conductor pattern 22. In each of the above embodiments, the connection portion 25 is formed as a via hole by a semiconductor process technique. Instead of this, the connecting portion 25 may be formed as a contact layer.

・上記各実施の形態において、第1配線パターン23の第1導体パターン21、第2配線パターン24の第2導体パターン22、および接続部25(25a)の各形状としては、任意の形状を採用することができる。二次巻線20(50)は、第1導体パターン21のそれぞれについて、その先端および基端を第2導体パターン22の先端およびそれに隣接する同第2導体パターン22の基端にそれぞれ接続する2つの導電性の接続部25(25a)とを設けることで形成されればよい。こうした二次巻線20(50)の構成が確保される限り、その構成部材である第1導体パターン21、第2導体パターン22、および接続部25(25a)の各形状を任意とすることができる。   -In each said embodiment, arbitrary shapes are employ | adopted as each shape of the 1st conductor pattern 21 of the 1st wiring pattern 23, the 2nd conductor pattern 22 of the 2nd wiring pattern 24, and the connection part 25 (25a). can do. The secondary winding 20 (50) is connected to the tip end and the base end of each of the first conductor patterns 21 to the tip end of the second conductor pattern 22 and the base end of the second conductor pattern 22 adjacent thereto, respectively. What is necessary is just to form by providing the one electroconductive connection part 25 (25a). As long as the configuration of the secondary winding 20 (50) is ensured, the shapes of the first conductor pattern 21, the second conductor pattern 22, and the connecting portion 25 (25a), which are constituent members, may be arbitrary. it can.

・上記各実施の形態では、電流線CLの周囲の磁界を縦型ホール素子11にてより有効に検出されるように、二次巻線20(50)に対して被検出電流Ifの流れる方向と二次巻線20(50)の軸心Oの方向とが直交するように電流線CLを配設している。しかしながら、電流線CLの周囲に十分大きな磁界が発生している場合には、被検出電流Ifの流れる方向と二次巻線20(50)の軸心Oの方向とが必ずしも直交する関係でなくてもよい。   In each of the above embodiments, the direction in which the detected current If flows in the secondary winding 20 (50) so that the magnetic field around the current line CL is more effectively detected by the vertical Hall element 11 The current line CL is disposed so that the direction of the axis O of the secondary winding 20 (50) is orthogonal to the direction of the axis O. However, when a sufficiently large magnetic field is generated around the current line CL, the flowing direction of the detected current If and the direction of the axis O of the secondary winding 20 (50) are not necessarily orthogonal to each other. May be.

・上記各実施の形態にかかる磁気平衡式電流センサでは、縦型ホール素子11と二次巻線20とを、極めて近い位置に配置することにより、従来の磁気平衡式電流センサにおける集磁用のコアを割愛している。しかし、縦型ホール素子11にて検出される磁界が弱い等の諸事情がある場合には、必要に応じて、縦型ホール素子11や二次巻線20(50)と共に、コアも半導体基板1に一体形成するようにしてもよい。   In the magnetic balance type current sensor according to each of the above embodiments, the vertical Hall element 11 and the secondary winding 20 are arranged at very close positions, thereby collecting the magnetic flux in the conventional magnetic balance type current sensor. The core is omitted. However, when there are various circumstances such as a weak magnetic field detected by the vertical Hall element 11, the core and the semiconductor substrate are combined with the vertical Hall element 11 and the secondary winding 20 (50) as necessary. 1 may be integrally formed.

本発明にかかる磁気平衡式電流センサの第1の実施の形態についてその概略構成を示す平面図。The top view which shows the schematic structure about 1st Embodiment of the magnetic balance type current sensor concerning this invention. 図1中の二次巻線の軸心Oに沿った磁気検出部の断面構造を示す断面図。Sectional drawing which shows the cross-section of the magnetic detection part along the axial center O of the secondary winding in FIG. 同実施の形態にかかる磁気平衡式電流センサの二次巻線についてその斜視構造を示す斜視図。The perspective view which shows the perspective structure about the secondary winding of the magnetic balance type current sensor concerning the embodiment. (a)は、縦型ホール素子の平面図、(b)は、図(a)中のL1−L1に沿った縦型ホール素子の断面構造を示す断面図、(c)は、図(a)中のL2−L2に沿った縦型ホール素子の断面構造を示す断面図。(A) is a plan view of the vertical Hall element, (b) is a cross-sectional view showing a cross-sectional structure of the vertical Hall element along L1-L1 in FIG. (A), and (c) is a diagram (a). Sectional drawing which shows the cross-section of the vertical Hall element along L2-L2 in the inside. 同実施の形態にかかる磁気平衡式電流センサの処理回路についてその概略構成を示すブロック図。The block diagram which shows the schematic structure about the processing circuit of the magnetic balance type current sensor concerning the embodiment. 図1中の二次巻線の軸心Oに沿った磁気検出部の断面構造を示す断面図。Sectional drawing which shows the cross-section of the magnetic detection part along the axial center O of the secondary winding in FIG. 本発明にかかる磁気平衡式電流センサの第2の実施の形態についてその概略構成を示す平面図。The top view which shows the schematic structure about 2nd Embodiment of the magnetic balance type current sensor concerning this invention. 図7中の二次巻線の軸心Oに沿った磁気検出部の断面構造を示す断面図。Sectional drawing which shows the cross-sectional structure of the magnetic detection part along the axial center O of the secondary winding in FIG. 図2中の二次巻線の軸心Oに沿った磁気検出部の断面構造を示す断面図。Sectional drawing which shows the cross-section of the magnetic detection part along the axial center O of the secondary winding in FIG. (a)は、他の実施の形態にかかる磁気平衡式電流センサを構成する縦型ホール素子の平面図、(b)は、図(a)中のL1−L1に沿った同縦型ホール素子の断面構造を示す断面図、(c)は、図(a)中のL2−L2に沿った同縦型ホール素子の断面構造を示す断面図。(A) is a top view of the vertical Hall element which comprises the magnetic balance type current sensor concerning other embodiment, (b) is the same vertical Hall element along L1-L1 in FIG. Sectional drawing which shows the cross-sectional structure of (2), (c) is a cross-sectional view showing the cross-sectional structure of the vertical Hall element along L2-L2 in FIG. 他の実施の形態にかかる磁気平衡式電流センサについて、縦型ホール素子の各端子の配列を示す模式図。The schematic diagram which shows the arrangement | sequence of each terminal of a vertical Hall element about the magnetic balance type current sensor concerning other embodiment. 直接検出式電流センサの概略構成を示す斜視図。The perspective view which shows schematic structure of a direct detection type current sensor. 集磁用コアを用いた直接検出式電流センサの概略構成を示す斜視図。The perspective view which shows schematic structure of the direct detection type current sensor using the core for magnetism collection. 従来の磁気平衡式電流センサの概略構成を示す斜視図。The perspective view which shows schematic structure of the conventional magnetic balance type current sensor.

符号の説明Explanation of symbols

1…半導体基板、1a…ベース基板、10,40…磁気検出部、11…縦型ホール素子、20,50…二次巻線、21…第1導体パターン、22…第2導体パターン、23…第1配線パターン、24…第2配線パターン、25,25a…接続部、30…処理回路、31…制御電流印加回路、32…電流増幅回路、33…検出回路、34…ホール素子補正回路、R…負荷抵抗、IDL…絶縁膜、IDL1…第1スペーサ層、IDL2…第2配線パターン層、IDL3…第2スペーサ層、IDL4…第1配線パターン層、IDL10…スペーサ層、IDL11…配線パターン層、CL…電流線。   DESCRIPTION OF SYMBOLS 1 ... Semiconductor substrate, 1a ... Base substrate, 10, 40 ... Magnetic detection part, 11 ... Vertical Hall element, 20, 50 ... Secondary winding, 21 ... 1st conductor pattern, 22 ... 2nd conductor pattern, 23 ... 1st wiring pattern, 24 ... 2nd wiring pattern, 25, 25a ... Connection part, 30 ... Processing circuit, 31 ... Control current application circuit, 32 ... Current amplification circuit, 33 ... Detection circuit, 34 ... Hall element correction circuit, R ... load resistance, IDL ... insulating film, IDL1 ... first spacer layer, IDL2 ... second wiring pattern layer, IDL3 ... second spacer layer, IDL4 ... first wiring pattern layer, IDL10 ... spacer layer, IDL11 ... wiring pattern layer, CL: Current line.

Claims (9)

電流線への被検出電流の通電により発生する磁界に対して方向の異なるキャンセル磁界を通電に応じて発生する二次巻線と、前記電流線および前記二次巻線の近傍に配設されるホール素子とを有するとともに、周囲の磁界に応じて前記ホール素子に発生するホール電圧により前記二次巻線への通電を行って、該ホール素子の周囲において前記電流線の周囲の磁界と前記キャンセル磁界とが相殺される平衡状態となったときの前記二次巻線に流れる電流に基づき前記被検出電流を検出する磁気平衡式電流センサにおいて、
前記二次巻線を、前記ホール素子の形成される半導体基板に一体に形成した
ことを特徴とする磁気平衡式電流センサ。
A secondary winding that generates a canceling magnetic field having a different direction with respect to a magnetic field generated by energization of a current to be detected to be applied to the current line, and disposed in the vicinity of the current line and the secondary winding. And a current applied to the secondary winding by a Hall voltage generated in the Hall element in response to a surrounding magnetic field, and the magnetic field around the current line and the cancellation around the Hall element. In a magnetic balance type current sensor that detects the detected current based on a current that flows in the secondary winding when an equilibrium state in which a magnetic field is canceled is achieved.
The magnetic balance type current sensor, wherein the secondary winding is integrally formed on a semiconductor substrate on which the Hall element is formed.
前記二次巻線は、前記被検出電流の流れる方向に直交する方向がその軸心方向となるように形成される
ことを特徴とする請求項1に記載の磁気平衡式電流センサ。
2. The magnetic balanced current sensor according to claim 1, wherein the secondary winding is formed such that a direction orthogonal to a direction in which the current to be detected flows is an axial center direction.
前記半導体基板の内部に並行して延伸された複数の帯状の導体パターンからなる第1配線パターンと、
前記半導体基板の内部に並行して延伸された複数の帯状の導体パターンからなり、前記第1配線パターンと平行に形成された第2配線パターンと、
を備えるとともに、
前記第1配線パターンの導体パターンのそれぞれについて、その先端および基端を前記第2配線パターンの導体パターンの先端およびそれに隣接する同第2配線パターンの導体パターンの基端にそれぞれ接続する2つの導電性の接続部を設けることで、前記二次巻線が形成されてなる
請求項1または2に記載の磁気平衡式電流センサ。
A first wiring pattern comprising a plurality of strip-shaped conductor patterns extending in parallel to the inside of the semiconductor substrate;
A plurality of strip-shaped conductor patterns extending in parallel with the inside of the semiconductor substrate, and a second wiring pattern formed in parallel with the first wiring pattern;
With
For each of the conductor patterns of the first wiring pattern, two conductors that connect the leading end and the base end to the leading end of the conductor pattern of the second wiring pattern and the base end of the conductor pattern of the second wiring pattern adjacent thereto, respectively. The magnetic balance type current sensor according to claim 1, wherein the secondary winding is formed by providing a sexual connection portion.
前記半導体基板の同一層に前記第1配線パターンの各導体パターンが形成され、それとは別の前記半導体基板の同一層に前記第2配線パターンの各導体パターンが形成された
請求項3に記載の磁気平衡式電流センサ。
4. The conductor patterns of the first wiring pattern are formed on the same layer of the semiconductor substrate, and the conductor patterns of the second wiring pattern are formed on the same layer of the semiconductor substrate different from the first wiring pattern. Magnetic balanced current sensor.
前記ホール素子は、制御電流の方向が前記半導体基板の厚さ方向となる縦型ホール素子であり、
前記二次巻線は、前記ホール素子の前記制御電流の方向に対して直交する方向がその軸心方向となるように形成されてなる
請求項3または4に記載の磁気平衡式電流センサ。
The Hall element is a vertical Hall element in which the direction of the control current is the thickness direction of the semiconductor substrate,
5. The magnetic balanced current sensor according to claim 3, wherein the secondary winding is formed such that a direction orthogonal to a direction of the control current of the Hall element is an axial direction thereof.
前記二次巻線は、その第1配線パターンおよび第2配線パターンが共に、前記ホール素子に対して前記半導体基板の厚さ方向における同一の側に位置されるように形成されてなる
請求項5に記載の磁気平衡式電流センサ。
The secondary winding is formed such that both the first wiring pattern and the second wiring pattern are positioned on the same side in the thickness direction of the semiconductor substrate with respect to the Hall element. 2. A magnetic balance type current sensor according to 1.
前記二次巻線は、前記半導体基板の厚さ方向においてその第1配線パターンおよび第2配線パターンが共に、前記ホール素子に対して前記電流線が配置される側に位置されるように形成されてなる
請求項5に記載の磁気平衡式電流センサ。
The secondary winding is formed such that both the first wiring pattern and the second wiring pattern in the thickness direction of the semiconductor substrate are positioned on the side where the current line is disposed with respect to the Hall element. The magnetic balance type current sensor according to claim 5.
前記二次巻線は、前記半導体基板の厚さ方向において、その第1配線パターンと第2配線パターンとの間に前記ホール素子が位置されるように形成されてなる
請求項5に記載の磁気平衡式電流センサ。
The magnetic circuit according to claim 5, wherein the secondary winding is formed so that the Hall element is positioned between the first wiring pattern and the second wiring pattern in the thickness direction of the semiconductor substrate. Balanced current sensor.
前記ホール素子の特性を調整する回路および前記ホール素子の出力処理を行なう回路を前記ホール素子の形成される半導体基板に一体に形成した
請求項1〜8のいずれか一項に記載の磁気平衡式電流センサ。
The magnetic balance type according to claim 1, wherein a circuit for adjusting characteristics of the Hall element and a circuit for performing output processing of the Hall element are integrally formed on a semiconductor substrate on which the Hall element is formed. Current sensor.
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