JP2007066142A - ダイレクトメモリアクセスコントローラ - Google Patents
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Abstract
【解決手段】 DMAC4は、DMA転送要求ごとに、転送元データをDMA転送する。1回のDMA転送要求で転送される転送元データは、1または複数のブロックからなり、ブロック単位で圧縮データと非圧縮データとが混在可能である。DMAC4は、圧縮データを伸張する伸張回路48を含み、圧縮データについては、伸張回路48による伸張を行いつつ、転送先へ転送し、非圧縮データについては、伸張回路48による伸張を行うことなく、転送先へ転送する。
【選択図】 図4
Description
DMAリクエストキュー45には、リクエストバッファから入力された、「転送元アドレス」、「転送先アドレス」、及び「転送バイト数」、並びに、どの機能ユニット(CPU5/RPU9/SPU13)からの要求であるかを示す情報を、DMA転送要求として格納する。
Claims (9)
- ダイレクトメモリアクセス転送要求ごとに、転送元データをダイレクトメモリアクセス転送するダイレクトメモリアクセス実行手段を備え、
前記ダイレクトメモリアクセス実行手段は、圧縮データを伸張する伸張手段を含み、
1回の前記ダイレクトメモリアクセス転送要求で転送される前記転送元データは、1または複数のブロックからなり、ブロック単位で圧縮データと非圧縮データとが混在可能であり、
前記ダイレクトメモリアクセス実行手段は、圧縮データについては、前記伸張手段による伸張を行いつつ、転送先へ転送し、非圧縮データについては、前記伸張手段による伸張を行うことなく、転送先へ転送する、ダイレクトメモリアクセスコントローラ。 - 前記ダイレクトメモリアクセス実行手段は、予め設定されている圧縮ブロック識別コードと一致するコードが前記ブロックに含まれる場合、当該ブロックに含まれる圧縮データを前記伸張手段に転送し、前記伸張手段は、当該圧縮データを伸張する、請求項1記載のダイレクトメモリアクセスコントローラ。
- 前記ダイレクトメモリアクセス実行手段は、前記圧縮ブロック識別コードを保持する圧縮ブロック識別コードレジスタをさらに含み、
前記圧縮ブロック識別コードレジスタに格納される前記圧縮ブロック識別コードは、外部から書き換え可能である、請求項2記載のダイレクトメモリアクセスコントローラ。 - 前記ブロックに含まれる圧縮データは、辞書に登録されたデータ列の中から符号化すべきデータ列と最長一致するデータ列を探し出して、一致したデータ列の位置情報及び長さ情報を符号として出力する圧縮方式により圧縮されたデータであり、第1データストリーム及び第2データストリームを含み、
前記第2データストリームは、圧縮されていない生データ及び前記一致したデータ列の前記位置情報を含み、
前記第1データストリームは、生データ及び圧縮データの別を識別する情報、及び前記一致したデータ列の前記長さ情報を含み、
前記伸張手段は、前記識別する情報に基づいて、前記生データを出力し、かつ、前記識別する情報に基づき、前記一致したデータ列の前記長さ情報を識別して、その長さ情報と前記位置情報とから、前記符号を復元する、請求項1から3記載のダイレクトメモリアクセスコントローラ。 - 前記辞書に登録されるデータ列は、前記伸張手段から出力されるデータであり、最も新しく前記伸張手段から出力されるデータへの入れ換えが常時行われる、請求項4記載のダイレクトメモリアクセスコントローラ。
- 前記一致したデータ列の前記長さ情報は、可変長符号化されており、
前記伸張手段は、可変長符号化された前記長さ情報を復元して、この復元した長さ情報と前記位置情報とから、前記符号を復元する、請求項4又は5記載のダイレクトメモリアクセスコントローラ。 - 前記ダイレクトメモリアクセスコントローラは、各々演算処理を実行する複数のプロセッサコアからの前記ダイレクトメモリアクセス転送要求を調停して、ダイレクトメモリアクセス転送を行い、
前記伸張手段は、前記複数のプロセッサコアのうち、予め指定された1または複数の前記プロセッサコアからの前記ダイレクトメモリアクセス転送要求によるダイレクトメモリアクセス転送においてのみ伸張処理を行う、請求項1から6記載のダイレクトメモリアクセスコントローラ。 - 前記ダイレクトメモリアクセスコントローラは、
各々が、対応する前記プロセッサコアからの前記ダイレクトメモリアクセス転送要求を格納する複数のバッファと、
複数の前記バッファが送出した複数の前記ダイレクトメモリアクセス転送要求を調停して、いずれか1つの前記ダイレクトメモリアクセス転送要求を出力する調停手段と、
複数の前記ダイレクトメモリアクセス転送要求を保持でき、前記調停手段が出力した前記ダイレクトメモリアクセス転送要求を受け取った順に出力するキューと、をさらに備え、
前記ダイレクトメモリアクセス実行手段は、前記キューが出力した前記ダイレクトメモリアクセス転送要求に応じたダイレクトメモリアクセス転送を実行する、請求項7記載のダイレクトメモリアクセスコントローラ。 - 各々演算処理を実行する複数のプロセッサコアからのダイレクトメモリアクセス転送要求を調停して、前記複数のプロセッサコアによって共有される内部メモリと、外部バスに接続される外部メモリと、の間でダイレクトメモリアクセス転送を行うダイレクトメモリアクセスコントローラであって、
各々が、対応する前記プロセッサコアからの前記ダイレクトメモリアクセス転送要求を格納する複数のバッファと、
複数の前記バッファが送出した複数の前記ダイレクトメモリアクセス転送要求を調停して、いずれか1つの前記ダイレクトメモリアクセス転送要求を出力する調停手段と、
複数の前記ダイレクトメモリアクセス転送要求を保持でき、前記調停手段が出力した前記ダイレクトメモリアクセス転送要求を受け取った順に出力するキューと、
前記キューが出力した前記ダイレクトメモリアクセス転送要求に応じたダイレクトメモリアクセス転送を実行するダイレクトメモリアクセス転送実行手段と、を備えるダイレクトメモリアクセスコントローラ。
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