JP2006332614A - Semiconductor device, organic transistor and manufacturing method thereof - Google Patents

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Abstract

<P>PROBLEM TO BE SOLVED: To provide a highly reliable organic transistor having less tunnel leak current by forming a high-quality gate insulation film which is dense and has high insulation resistance. <P>SOLUTION: For the organic transistor, highly dense plasma having electron density of 10<SP>11</SP>cm<SP>-3</SP>and an electron temperature of 0.2 eV-2.0 eV is used to activate oxygen (or gas containing oxygen) or nitrogen (or gas containing nitrogen) by plasma excitation, and is caused to directly react with one part of a conductive layer used as a gate electrode, thereby forming the gate insulation film. <P>COPYRIGHT: (C)2007,JPO&INPIT

Description

本発明は、有機半導体層を有する有機トランジスタ、有機トランジスタを有する半導体装置及びその作製方法に関する。   The present invention relates to an organic transistor having an organic semiconductor layer, a semiconductor device having an organic transistor, and a manufacturing method thereof.

電界効果トランジスタは、ソース電極とドレイン電極の2つの電極間に設けられている半導体層の電気伝導度をゲート電極に印加する電圧で制御するものであり、正孔もしくは電子のいずれか一方のキャリアの輸送を用いた、ユニポーラ素子の代表的なものである。   A field effect transistor controls the electrical conductivity of a semiconductor layer provided between two electrodes, a source electrode and a drain electrode, by a voltage applied to a gate electrode, and is a carrier of either a hole or an electron. This is a typical unipolar device using the following transport.

これらの電界効果トランジスタは、その組み合わせによって種々のスイッチング素子や増幅素子を形成することができるため、様々な分野で応用されている。例えば、アクティブマトリクス型ディスプレイにおける画素のスイッチング素子などがその応用例として挙げられる。   These field effect transistors are applied in various fields because various switching elements and amplifying elements can be formed by their combination. For example, a switching element of a pixel in an active matrix display can be cited as an application example.

これまで、電界効果トランジスタに用いる半導体材料としては、シリコンに代表される無機半導体材料が広く用いられてきたが、無機半導体材料を半導体層として成膜するためには高温で処理する必要があるため、基板にプラスチックやフィルムを用いることが難しい。   Until now, an inorganic semiconductor material typified by silicon has been widely used as a semiconductor material for a field effect transistor. However, in order to form an inorganic semiconductor material as a semiconductor layer, it needs to be processed at a high temperature. It is difficult to use plastic or film for the substrate.

これに対し、有機半導体材料を半導体層として用いると、比較的低温でも成膜が可能であるため、ガラス基板のみならずプラスチックなどの熱耐久性の小さい基板上にも原理的に電界効果トランジスタを作製することが可能となる。   In contrast, when an organic semiconductor material is used as a semiconductor layer, a film can be formed even at a relatively low temperature. Therefore, a field effect transistor is theoretically applied not only on a glass substrate but also on a substrate having low thermal durability such as plastic. It can be produced.

有機半導体材料からなる半導体層を低温プロセスにて成膜し形成された有機トランジスタが、特許文献1に開示されている。なお、特許文献1に記載されている有機トランジスタのゲート絶縁膜は、プラズマCVD法を用いて形成されている。
特開2000−174277号公報
An organic transistor formed by forming a semiconductor layer made of an organic semiconductor material by a low temperature process is disclosed in Patent Document 1. Note that the gate insulating film of the organic transistor described in Patent Document 1 is formed using a plasma CVD method.
JP 2000-174277 A

トランジスタの微細化に伴い、チャネル長を短くすると同時にゲート絶縁膜を薄膜化する必要がある。しかしながら、ゲート絶縁膜を薄膜化するとトンネルリーク電流が大きくなり、信頼性の低下が懸念される。そのため、より耐性の強いゲート絶縁膜が必要となる。   With the miniaturization of transistors, it is necessary to reduce the channel length and simultaneously reduce the thickness of the gate insulating film. However, when the gate insulating film is thinned, the tunnel leakage current increases, and there is a concern that the reliability may be lowered. Therefore, a more durable gate insulating film is required.

本発明では、従来のCVD法を用いて形成したゲート絶縁膜より緻密かつ絶縁耐性が強いゲート絶縁膜を形成し、トンネルリーク電流がより少ない有機トランジスタを提案することを目的とする。   An object of the present invention is to propose an organic transistor in which a gate insulating film that is denser and stronger in insulation resistance than a gate insulating film formed by using a conventional CVD method is formed, and the tunnel leakage current is smaller.

上記目的を達成するために本発明は以下の手段を講じる。   In order to achieve the above object, the present invention takes the following measures.

本発明の有機トランジスタの一形態は、ゲート電極となる導電層を形成し、電子密度が1011cm−3以上かつ電子温度が0.2eV以上2.0eV以下の高密度プラズマを用いて酸素(もしくは酸素を含むガス)や窒素(もしくは窒素を含むガス)などをプラズマ励起によって活性化し、ゲート電極となる導電層の一部と直接反応させ絶縁化することにより、ゲート絶縁膜を形成することを特徴とする。 One embodiment of the organic transistor of the present invention is a method in which a conductive layer to be a gate electrode is formed and oxygen (using an high-density plasma having an electron density of 10 11 cm −3 or more and an electron temperature of 0.2 eV or more and 2.0 eV or less. Or a gas containing oxygen) or nitrogen (or a gas containing nitrogen) is activated by plasma excitation to form a gate insulating film by directly reacting with a part of a conductive layer to be a gate electrode and insulating. Features.

本発明の有機トランジスタの一形態は、ゲート電極と、ゲート絶縁膜と、有機半導体材料を含む半導体層と、ソース及びドレイン電極とを有し、ソース及びドレイン電極は、有機化合物及び金属酸化物との複合層と導電層とを有し、ゲート絶縁膜はゲート電極となる導電層に対し高密度プラズマ処理を行うことによって形成されることを特徴とする。   One embodiment of an organic transistor of the present invention includes a gate electrode, a gate insulating film, a semiconductor layer containing an organic semiconductor material, and a source and drain electrode, and the source and drain electrodes include an organic compound and a metal oxide. The gate insulating film is formed by performing high-density plasma treatment on the conductive layer to be a gate electrode.

本発明の有機トランジスタの別の一形態は、ゲート電極と、ゲート電極上に接して形成されたゲート絶縁膜と、ゲート絶縁膜上に形成された有機半導体材料を含む半導体層と、半導体層上にソース及びドレイン電極とを有し、ソース及びドレイン電極は、有機化合物及び金属酸化物との複合層と導電層とを有し、ゲート絶縁膜は前記ゲート電極となる導電層に対し高密度プラズマ処理を行うことによって形成されることを特徴とする。   Another embodiment of the organic transistor of the present invention includes a gate electrode, a gate insulating film formed on and in contact with the gate electrode, a semiconductor layer containing an organic semiconductor material formed on the gate insulating film, and a semiconductor layer The source and drain electrodes have a composite layer of an organic compound and a metal oxide and a conductive layer, and the gate insulating film has a high density plasma with respect to the conductive layer to be the gate electrode. It is formed by performing processing.

本発明の有機トランジスタの別の一形態は、ゲート電極と、ゲート電極上に形成されたゲート絶縁膜と、ゲート絶縁膜上に形成された有機半導体材料を含む半導体層と、半導体層上にソース及びドレイン電極とを有し、ソース及びドレイン電極は、有機化合物及び金属酸化物との複合層と導電層とを有し、ゲート絶縁膜は高密度プラズマ処理が施された膜であることを特徴とする。   Another embodiment of the organic transistor of the present invention includes a gate electrode, a gate insulating film formed on the gate electrode, a semiconductor layer including an organic semiconductor material formed on the gate insulating film, and a source on the semiconductor layer And the drain electrode, the source and drain electrodes have a composite layer of an organic compound and a metal oxide, and a conductive layer, and the gate insulating film is a film subjected to high-density plasma treatment. And

本発明の有機トランジスタの一作製方法は、基板上に第1の導電層を形成し、第1の導電層の表面を高密度プラズマ処理により絶縁化し、絶縁化された第1の導電膜上に有機半導体材料を含む半導体層を形成し、半導体層上に有機化合物及び金属酸化物とが混合された複合層を形成し、複合層上に第2の導電層を形成することを特徴とする。この時、複合層と第2の導電層はソース及びドレイン電極であり、第1の導電層のうち導電性を有する部分はゲート電極であり、第1の導電層のうち絶縁性を有する部分はゲート絶縁膜であることを特徴とする。   In one manufacturing method of an organic transistor of the present invention, a first conductive layer is formed over a substrate, the surface of the first conductive layer is insulated by high-density plasma treatment, and the insulated first conductive film is formed on the insulated first conductive film. A semiconductor layer including an organic semiconductor material is formed, a composite layer in which an organic compound and a metal oxide are mixed is formed over the semiconductor layer, and a second conductive layer is formed over the composite layer. At this time, the composite layer and the second conductive layer are the source and drain electrodes, the conductive portion of the first conductive layer is the gate electrode, and the insulating portion of the first conductive layer is It is a gate insulating film.

本発明の有機トランジスタの別の作製方法は、基板上にゲート電極を形成し、ゲート電極上にゲート絶縁膜を形成し、ゲート絶縁膜上に有機半導体材料を含む半導体層を形成し、半導体層上に有機化合物及び金属酸化物とが混合された複合層を形成し、複合層上に導電層を形成し、複合層と前記導電層はソース及びドレイン電極であり、ゲート絶縁膜は高密度プラズマ処理が施されていることを特徴とする。   Another method for manufacturing an organic transistor of the present invention includes forming a gate electrode over a substrate, forming a gate insulating film over the gate electrode, forming a semiconductor layer containing an organic semiconductor material over the gate insulating film, A composite layer in which an organic compound and a metal oxide are mixed is formed thereon, a conductive layer is formed on the composite layer, the composite layer and the conductive layer are source and drain electrodes, and the gate insulating film is a high-density plasma. It is characterized by being treated.

前記高密度プラズマ処理は、電子密度が1011cm−3以上かつ電子温度が0.2以上2.0eV以下(より好ましくは0.5以上1.5eV以下)のプラズマを用いていることを特徴とする。 The high-density plasma treatment uses plasma having an electron density of 10 11 cm −3 or more and an electron temperature of 0.2 to 2.0 eV (more preferably 0.5 to 1.5 eV). And

上記ゲート電極は、タンタル、ニオブ、アルミニウム、モリブデン、タングステン、チタン、銅、クロム、ニッケル、コバルト、マグネシウムのいずれか一であることを特徴としても良い。   The gate electrode may be any one of tantalum, niobium, aluminum, molybdenum, tungsten, titanium, copper, chromium, nickel, cobalt, and magnesium.

上記ゲート絶縁膜は8以上の誘電率を有することを特徴としても良い。   The gate insulating film may have a dielectric constant of 8 or more.

上記複合層を形成する有機化合物は、芳香族アミン骨格を有することを特徴としても良い。   The organic compound forming the composite layer may have an aromatic amine skeleton.

上記複合層を形成する金属酸化物は、チタン、バナジウム、クロム、ジルコニウム、ニオブ、モリブデン、ハフニウム、タンタル、タングステン、レニウムの酸化物から選ばれた一または複数であることを特徴としても良い。   The metal oxide forming the composite layer may be one or more selected from oxides of titanium, vanadium, chromium, zirconium, niobium, molybdenum, hafnium, tantalum, tungsten, and rhenium.

本発明の半導体装置の一形態は、電子密度が1011cm−3以上かつ電子温度が0.2eV以上2.0eV以下(より好ましくは0.5以上1.5eV以下)の高密度プラズマを用いて形成された絶縁膜と有機半導体材料を含む半導体層が接する有機トランジスタで回路が形成することを特徴とする。 One embodiment of a semiconductor device of the present invention uses high-density plasma with an electron density of 10 11 cm −3 or more and an electron temperature of 0.2 eV or more and 2.0 eV or less (more preferably 0.5 or more and 1.5 eV or less). A circuit is formed by an organic transistor in which an insulating film formed in contact with a semiconductor layer containing an organic semiconductor material is in contact.

高密度プラズマを用いて形成されたゲート絶縁膜は、プラズマダメージが少なく、欠陥が少ない高品質な膜を形成することができるため、トンネルリーク電流を低減することができる。よって、信頼性が高い有機トランジスタを得ることが可能となる。また、ゲート電極となる導電層を絶縁化してゲート絶縁膜とすることで、高集積化が可能となる。   A gate insulating film formed using high-density plasma can form a high-quality film with little plasma damage and few defects, so that tunnel leakage current can be reduced. Therefore, an organic transistor with high reliability can be obtained. Further, high integration can be achieved by insulating a conductive layer to be a gate electrode to form a gate insulating film.

本発明の実施の形態について、図面を用いて以下に説明する。但し、本発明は以下の説明に限定されず、本発明の趣旨及びその範囲から逸脱することなくその形態及び詳細を様々に変更し得ることは当業者であれば容易に理解される。従って、本発明は以下に示す実施の形態の記載内容に限定して解釈されるものではない。なお、以下に説明する本発明の構成において、同じものを指す符号は異なる図面間で共通して用いる場合がある。   Embodiments of the present invention will be described below with reference to the drawings. However, the present invention is not limited to the following description, and it is easily understood by those skilled in the art that modes and details can be variously changed without departing from the spirit and scope of the present invention. Therefore, the present invention should not be construed as being limited to the description of the embodiments below. Note that in the structures of the present invention described below, the same reference numerals may be used in common in different drawings.

(実施の形態1)
本発明の有機トランジスタの構造の一形態を図1に示す。なお、10が基板、11がゲート電極、12がゲート絶縁膜、13が有機半導体材料を含む半導体層、14が有機化合物と金属酸化物とを有する複合層、15が導電層であり、ソース及びドレイン電極16a、bは、複合層14および導電層15を有する。各層及び電極の配置は、素子の用途により適宜選択できる。また、図1では複合層14が半導体層13に接して設けられているがこの限りではなく、ソース電極及び/またはドレイン電極の一部に含まれていれば良い。
(Embodiment 1)
One mode of the structure of the organic transistor of the present invention is shown in FIG. 10 is a substrate, 11 is a gate electrode, 12 is a gate insulating film, 13 is a semiconductor layer containing an organic semiconductor material, 14 is a composite layer containing an organic compound and a metal oxide, 15 is a conductive layer, a source and The drain electrodes 16 a and 16 b have the composite layer 14 and the conductive layer 15. The arrangement of each layer and electrode can be appropriately selected depending on the application of the element. In FIG. 1, the composite layer 14 is provided in contact with the semiconductor layer 13. However, the composite layer 14 is not limited to this and may be included in part of the source electrode and / or the drain electrode.

図1(A)の構造について、図2の作製方法に沿って説明する。基板10は、ガラス基板、石英基板、結晶性ガラスなどの絶縁性基板や、セラミック基板、ステンレス基板、プラスチック基板(ポリイミド、アクリル、ポリエチレンテレフタレート、ポリカーボネート、ポリアリレート、ポリエーテルスルホン等)等を用いることができる。また、これら基板は必要に応じてCMP等により研磨してから用いても良い。   The structure in FIG. 1A will be described along the manufacturing method in FIG. As the substrate 10, an insulating substrate such as a glass substrate, a quartz substrate, or crystalline glass, a ceramic substrate, a stainless steel substrate, a plastic substrate (polyimide, acrylic, polyethylene terephthalate, polycarbonate, polyarylate, polyethersulfone, or the like) is used. Can do. Further, these substrates may be used after being polished by CMP or the like, if necessary.

基板10上に後にゲート電極となる導電層17を形成する(図2(A))。導電層17に用いる材料は、窒化及び/または酸化することで絶縁性を有する金属であれば良く、特にタンタル、ニオブ、アルミニウム、モリブデン、銅、チタンが好ましい。その他、タングステン、クロム、ニッケル、コバルト、マグネシウムなどが挙げられる。導電層17の形成方法について特に限定は無く、スパッタリング法や蒸着法などにより成膜した後、エッチングなどの方法により所望の形状に加工すればよい。また、導電物を含む液滴を用いてインクジェット法等により形成してもよい。   A conductive layer 17 to be a gate electrode later is formed over the substrate 10 (FIG. 2A). The material used for the conductive layer 17 may be any metal that has an insulating property by nitriding and / or oxidizing, and tantalum, niobium, aluminum, molybdenum, copper, and titanium are particularly preferable. Other examples include tungsten, chromium, nickel, cobalt, and magnesium. A method for forming the conductive layer 17 is not particularly limited, and the conductive layer 17 may be formed into a desired shape by a method such as etching after being formed by sputtering or vapor deposition. Alternatively, a droplet including a conductive material may be used by an inkjet method or the like.

次に、高密度プラズマを用いて導電層17を窒化及び/または酸化することで上記金属の窒化物、酸化物もしくは酸化窒化物からなるゲート絶縁膜12を形成する(図2(B))。高密度プラズマは、高い周波数のマイクロ波、たとえば2.45GHzを使うことによって生成される。このような高密度プラズマを用い、酸素(もしくは酸素を含むガス)や窒素(もしくは窒素を含むガス)などをプラズマ励起によって活性化し、これらをゲート電極の材料と直接反応させ導電層17を絶縁化する。   Next, the conductive layer 17 is nitrided and / or oxidized using high-density plasma, thereby forming the gate insulating film 12 made of the metal nitride, oxide, or oxynitride (FIG. 2B). The high density plasma is generated by using a high frequency microwave, for example 2.45 GHz. Using such high-density plasma, oxygen (or oxygen-containing gas), nitrogen (or nitrogen-containing gas), etc. are activated by plasma excitation, and these are directly reacted with the gate electrode material to insulate the conductive layer 17. To do.

なお、高密度プラズマとしては電子密度が1011cm−3以上かつ電子温度が0.2以上2.0eV以下(より好ましくは0.5以上1.5eV以下)であるものを用いる。このように低電子温度が特徴である高密度プラズマは、活性種の運動エネルギーが低いため、従来のプラズマ処理に比べプラズマダメージが少なく欠陥が少ない膜を形成することができる。また、この絶縁膜は、陽極酸化法を用いて形成される絶縁膜より緻密な膜である。なお、導電層17のうち高密度プラズマを用いて絶縁化したゲート絶縁膜12以外はゲート電極11として機能する。 Note that high-density plasma having an electron density of 10 11 cm −3 or more and an electron temperature of 0.2 to 2.0 eV (more preferably 0.5 to 1.5 eV) is used. As described above, high-density plasma characterized by low electron temperature has low kinetic energy of active species, and thus can form a film with less plasma damage and fewer defects than conventional plasma treatment. Further, this insulating film is a denser film than the insulating film formed by using the anodic oxidation method. Note that the conductive layer 17 other than the gate insulating film 12 insulated using high-density plasma functions as the gate electrode 11.

たとえば、上記の高密度プラズマ処理は図6の装置を用いて行う。61は誘電体導波路、62は複数のスロットを有するスロットアンテナ、63は石英や酸化アルミニウムからなる誘電板、64は基板を設置する台である。なお、台64には加熱ヒーターを有する。60よりマイクロ波を伝送し、プラズマ発生領域66においてガス供給口65より供給されたガスを活性化する。なお、スロットアンテナ62におけるスロットの位置や長さは、60より伝送されたマイクロ波の波長に応じて適宜選択する。   For example, the high-density plasma treatment is performed using the apparatus shown in FIG. 61 is a dielectric waveguide, 62 is a slot antenna having a plurality of slots, 63 is a dielectric plate made of quartz or aluminum oxide, and 64 is a table on which a substrate is placed. The table 64 has a heater. The microwave is transmitted from 60, and the gas supplied from the gas supply port 65 is activated in the plasma generation region 66. Note that the position and length of the slot in the slot antenna 62 are appropriately selected according to the wavelength of the microwave transmitted from 60.

このような装置を用いることで、均一な高密度かつ低電子温度のプラズマを励起でき、低温プロセス(基板温度400℃以下)の実現が可能である。なお、一般的に耐熱性が低いと言われているプラスチックを基板としても利用することができる。   By using such an apparatus, uniform high density and low electron temperature plasma can be excited and a low temperature process (substrate temperature of 400 ° C. or lower) can be realized. In addition, a plastic that is generally said to have low heat resistance can also be used as a substrate.

なお、供給するガスは、アルゴン、クリプトン、ヘリウムやキセノンなどの不活性ガスに酸素(もしくは酸素を含むガス)や窒素(もしくは窒素を含むガス)を混入させたものを用いる。そのため、高密度プラズマ酸化もしく窒化処理により形成されたゲート絶縁膜にはこれらの不活性な元素が混入されている。なお、供給するガスには水素が含まれていても良い。   Note that as a gas to be supplied, an inert gas such as argon, krypton, helium, or xenon mixed with oxygen (or a gas containing oxygen) or nitrogen (or a gas containing nitrogen) is used. Therefore, these inactive elements are mixed in the gate insulating film formed by high-density plasma oxidation or nitriding treatment. Note that the supplied gas may contain hydrogen.

さらに、装置内部67にシャワープレートを設けることで、より均一な活性化されたガスを処理対象物に供給することができる。なお、以後の記載において、ゲート絶縁膜の作製における高密度プラズマ処理は上記の特徴を有するプラズマを用いて行う。   Furthermore, by providing a shower plate inside the apparatus 67, a more uniform activated gas can be supplied to the object to be processed. Note that in the following description, the high-density plasma treatment in manufacturing the gate insulating film is performed using plasma having the above characteristics.

次にゲート絶縁膜12を覆う半導体層13を形成する(図2(C))。半導体層13を形成する有機半導体材料はキャリア輸送性があり、かつ電界効果によりキャリア密度の変調が起こりうる有機材料であれば、低分子、高分子のいずれも用いることができ、その種類は特に限定されるものではないが、多環芳香族化合物、共役二重結合化合物、金属フタロシアニン錯体、電荷移動錯体、縮合環テトラカルボン酸ジイミド類、オリゴチオフェン類、フラーレン類、カーボンナノチューブ、などが挙げられる。例えばポリピロール、ポリチオフェン、ポリ(3−アルキルチオフェン)、ポリチエニレンビニレン、ポリ(p−フェニレンビニレン)、ポリアニリン、ポリジアセチレン、ポリアズレン、ポリピレン、ポリカルバゾール、ポリセレノフェン、ポリフラン、ポリ(p−フェニレン)、ポリインドール、ポリビリダジン、ナフタセン、ヘキサセン、ヘプタセン、ピレン、クリセン、ペリレン、コロネン、テリレン、オバレン、クオテリレン、アントラセン、トリフェノジオキサジン、トリフェノジリアジン、ヘキサセン−6,15−キノン、ポリビニルカルバゾール、ポリフェニレンスルフィド、ポリビニレンスルフィド、ポリビニルピリジン、ナフタレンテトラカルボン酸ジイミド、アントラセンテトラカルボン酸ジイミド、C60、C70、C76、C78、C84及びこれらの誘導体を用いることができる。また、これらの具体例としては、一般的にP型半導体とされるテトラセン、ペンタセン、セクシチオフェン(6T)、銅フタロシアニン、ビス−(1,2,5−チアジアゾロ)−p−キノビス(1、3−ジチオール)、ルブレン、ポリ(2、5−チェニレンビニレン)(PTV)、ポリ(3−ヘキシルチオフェン)(P3HT)、ジオクチルフルオレン−ビチオフェンコポリマー(F8T2)、一般的にN型半導体とされる7,7,8,8,−テトラシアノキノジメタン(TCNQ)、3,4,9,10−ペリレンテトラカルボン酸二無水物(PTCDA)、1,4,5,8,−ナフタレンテトラカルボン酸二無水物(NTCDA)、9,9,10,10−テトラシアノ−2,6−ナフトキノジメタン(TCNNQ)、N,N’−ジオクチルー3,4,9,10−ペリレンテトラカルボン酸ジイミド(PTCDI−C8H)、銅十六フッ化フタロシアニン(F16CuPc)、3’,4’−ジブチル−5,5’’−ビス(ジシアノメチレン)−5,5’’−ジヒドロ−2,2’:5’,2’’−テルチオフェン)(DCMT)等がある。なお、有機半導体においてP型やN型の特性はその物質固有のものでは無く、キャリアを注入する電極との関係や注入の際の電界の強度に依存し、どちらになりやすいという傾向はあるもののP型半導体としてもN型半導体としても使用することができる。なお、本実施の形態においては、P型半導体がより好ましい。 Next, a semiconductor layer 13 that covers the gate insulating film 12 is formed (FIG. 2C). The organic semiconductor material forming the semiconductor layer 13 can be either a low molecular weight or a high molecular weight material as long as it has carrier transport properties and can modulate the carrier density due to the electric field effect. Examples include, but are not limited to, polycyclic aromatic compounds, conjugated double bond compounds, metal phthalocyanine complexes, charge transfer complexes, fused ring tetracarboxylic acid diimides, oligothiophenes, fullerenes, carbon nanotubes, and the like. . For example, polypyrrole, polythiophene, poly (3-alkylthiophene), polythienylene vinylene, poly (p-phenylene vinylene), polyaniline, polydiacetylene, polyazulene, polypyrene, polycarbazole, polyselenophene, polyfuran, poly (p-phenylene) , Polyindole, polybilidazine, naphthacene, hexacene, heptacene, pyrene, chrysene, perylene, coronene, terylene, ovalen, quaterylene, anthracene, triphenodioxazine, triphenodiliadine, hexacene-6,15-quinone, polyvinylcarbazole, polyphenylene sulfide, Polyvinylene sulfide, polyvinyl pyridine, naphthalene tetracarboxylic acid diimide, anthracene tetracarboxylic acid diimide, C60, C70 C76, C78, C84 and can be used derivatives thereof. Specific examples thereof include tetracene, pentacene, sexithiophene (6T), copper phthalocyanine, bis- (1,2,5-thiadiazolo) -p-quinobis (1, 3, -Dithiol), rubrene, poly (2,5-chenylenevinylene) (PTV), poly (3-hexylthiophene) (P3HT), dioctylfluorene-bithiophene copolymer (F8T2), generally N-type semiconductors 7,7,8,8, -tetracyanoquinodimethane (TCNQ), 3,4,9,10-perylenetetracarboxylic dianhydride (PTCDA), 1,4,5,8, -naphthalenetetracarboxylic acid Dianhydride (NTCDA), 9,9,10,10-tetracyano-2,6-naphthoquinodimethane (TCNNQ), N, N′-dioctyl 3,4,9,10-perylenetetracarboxylic diimide (PTCDI-C8H), copper sixteen fluoride phthalocyanine (F 16 CuPc), 3 ' , 4'- dibutyl-5,5''- bis (dicyanomethylene) -5,5 "-dihydro-2,2 ': 5', 2" -terthiophene) (DCMT) and the like. Note that P-type and N-type characteristics in organic semiconductors are not unique to the substance, and depending on the relationship with the electrode for injecting carriers and the strength of the electric field at the time of injection, they tend to be either. It can be used as a P-type semiconductor or an N-type semiconductor. In the present embodiment, a P-type semiconductor is more preferable.

これらの有機半導体材料は、蒸着法やスピンコート法、液滴吐出法などの方法により成膜することができる。   These organic semiconductor materials can be formed by a method such as an evaporation method, a spin coating method, or a droplet discharge method.

次に半導体層13の上に複合層14を形成する(図2(D))。本発明の複合層14に使用する有機化合物の種類は特に限定されるものではないが、例えば、4,4’−ビス[N−(1−ナフチル)−N−フェニルアミノ]ビフェニル(NPB)、N,N’−ジフェニル−N,N’−ビス(3−メチルフェニル)−1,1’−ビフェニル−4,4’−ジアミン(TPD)、4,4’−ビス(N−{4−[N,N−ビス(3−メチルフェニル)アミノ]フェニル}−N−フェニルアミノ)ビフェニル((DNTPD)、4,4’,4’’−トリス[N−(3−メチルフェニル)−N−フェニルアミノ]トリフェニルアミン(m−MTDATA)、4,4’,4’’−トリス[N−(1−ナフチル)−N−フェニルアミノ]トリフェニルアミン(1−TNATA)のような芳香族アミン骨格を有するものが好ましい。また、N−(2−ナフチル)カルバゾール(NCz)、4,4’−ジ(N−カルバゾリル)ビフェニル(CBP)などのN−アリールカルバゾール誘導体やアントラセンや9,10−ジフェニルアントラセン(DPA)などの芳香族炭化水素を用いることもできる。また、半導体層13として用いることが可能な材料も使用することができる。この場合、半導体層13と複合層14との密着性や界面の化学安定性が向上する。また、製造プロセスが簡便になるといった利点があげられる。   Next, the composite layer 14 is formed over the semiconductor layer 13 (FIG. 2D). Although the kind of organic compound used for the composite layer 14 of the present invention is not particularly limited, for example, 4,4′-bis [N- (1-naphthyl) -N-phenylamino] biphenyl (NPB), N, N′-diphenyl-N, N′-bis (3-methylphenyl) -1,1′-biphenyl-4,4′-diamine (TPD), 4,4′-bis (N- {4- [ N, N-bis (3-methylphenyl) amino] phenyl} -N-phenylamino) biphenyl ((DNTPD), 4,4 ′, 4 ″ -tris [N- (3-methylphenyl) -N-phenyl Aromatic amine skeletons such as amino] triphenylamine (m-MTDATA), 4,4 ′, 4 ″ -tris [N- (1-naphthyl) -N-phenylamino] triphenylamine (1-TNATA) Preferred to have N-arylcarbazole derivatives such as N- (2-naphthyl) carbazole (NCz) and 4,4′-di (N-carbazolyl) biphenyl (CBP), anthracene and 9,10-diphenylanthracene (DPA) It is also possible to use an aromatic hydrocarbon such as a material that can be used as the semiconductor layer 13. In this case, adhesion between the semiconductor layer 13 and the composite layer 14 and chemical stability of the interface are also possible. In addition, there is an advantage that the manufacturing process is simplified.

本発明の複合層14に使用する金属酸化物は特に限定されるものではないが、チタン、バナジウム、クロム、ジルコニウム、ニオブ、モリブデン、ハフニウム、タンタル、タングステン、レニウムの酸化物であることが好ましい。なお、金属酸化物が5wt%以上80wt%以下、より好ましくは10wt%以上50wt%以下で含有されている複合層であることが望ましい。   The metal oxide used in the composite layer 14 of the present invention is not particularly limited, but is preferably an oxide of titanium, vanadium, chromium, zirconium, niobium, molybdenum, hafnium, tantalum, tungsten, rhenium. Note that a composite layer containing metal oxide in an amount of 5 wt% to 80 wt%, more preferably 10 wt% to 50 wt% is desirable.

なお、金属酸化物の代わりに7,7,8,8−テトラシアノキノジメタン(TCNQ)、2,3,5,6−テトラフルオロ−7,7,8,8−テトラシアノキノジメタン(F−TCNQ)等、電子受容性を示す有機化合物を用いても良い。 In addition, 7,7,8,8-tetracyanoquinodimethane (TCNQ), 2,3,5,6-tetrafluoro-7,7,8,8-tetracyanoquinodimethane (TCNQ) instead of metal oxide (TCNQ) An organic compound exhibiting an electron accepting property such as F 4 -TCNQ) may be used.

複合層14は、これらの材料を用いて抵抗加熱を用いた共蒸着による成膜や、抵抗加熱蒸着と電子銃蒸着(EB蒸着)を用いた共蒸着による成膜、スパッタリングと抵抗加熱による同時成膜などにより形成すればよい。また、ゾルーゲル法などによる湿式法を用いて成膜しても良い。   The composite layer 14 is formed by co-evaporation using resistance heating using these materials, co-evaporation using resistance heating evaporation and electron gun evaporation (EB evaporation), or simultaneous formation by sputtering and resistance heating. It may be formed by a film or the like. Alternatively, a film may be formed using a wet method such as a sol-gel method.

また、複合層14は電気伝導度が10−5[S/cm]程度と高く、膜厚を数nmから数百nmまで変化させてもトランジスタの抵抗値に変化が少ないため、複合層の膜厚は数nmから数百nm以上まで、作製する素子の用途や形状などに合わせて適宜調製することができる。 In addition, the composite layer 14 has a high electrical conductivity of about 10 −5 [S / cm], and even when the film thickness is changed from several nm to several hundred nm, there is little change in the resistance value of the transistor. The thickness can be appropriately adjusted from several nanometers to several hundred nanometers or more in accordance with the use and shape of the element to be produced.

次に、導電層15を形成する(図2(E))。導電層15に使用する材料は、特に限定されるものではないが、金、白金、アルミニウム、タングステン、チタン、銅、モリブデン、タンタル、ニオブ、クロム、ニッケル、コバルト、マグネシウムなどの金属及びそれらを含む合金、ポリアニリン、ポリピロール、ポリチオフェン、ポリアセチレン、ポリジアセチレンなどの導電性高分子化合物等が挙げられる。一般的にはソース及びドレイン電極16a、bに用いる導電層15としては、金属を用いることが多い。   Next, the conductive layer 15 is formed (FIG. 2E). The material used for the conductive layer 15 is not particularly limited, but includes metals such as gold, platinum, aluminum, tungsten, titanium, copper, molybdenum, tantalum, niobium, chromium, nickel, cobalt, magnesium, and the like. Examples thereof include conductive polymer compounds such as alloys, polyaniline, polypyrrole, polythiophene, polyacetylene, and polydiacetylene. Generally, a metal is often used as the conductive layer 15 used for the source and drain electrodes 16a and 16b.

なお、形成方法は半導体層13が分解しないようなものであれば特に限定は無く、スパッタリング法や蒸着法などにより成膜した後、エッチングするなどの方法により所望の形状に加工し作製すればよい。また、導電物を含む液滴を用いてインクジェット法等によって形成してもよい。   The formation method is not particularly limited as long as the semiconductor layer 13 is not decomposed. The film may be formed by sputtering or vapor deposition and then processed into a desired shape by a method such as etching. . Alternatively, a droplet including a conductive material may be used by an inkjet method or the like.

以上のようにして作製した有機トランジスタにおいて、半導体層13と導電層15との間に複合層14を挿入した構成のソース及びドレイン電極16a、bを用いることにより、半導体層13とソース及びドレイン電極16a、bとの間のエネルギー障壁が低減し、ソース及びドレイン電極の一方の電極から半導体層へのキャリアの注入と半導体層から他方の電極へのキャリアの排出が容易になる。このため、導電層15の材料は半導体層13とエネルギー障壁が低い材料を選択する必要がなく、仕事関数の制約無しに選択することが可能となる。   In the organic transistor manufactured as described above, by using the source and drain electrodes 16a and 16b in which the composite layer 14 is inserted between the semiconductor layer 13 and the conductive layer 15, the semiconductor layer 13 and the source and drain electrodes are used. The energy barrier between 16a and 16b is reduced, and carriers can be easily injected from one of the source and drain electrodes into the semiconductor layer and discharged from the semiconductor layer to the other electrode. For this reason, it is not necessary to select a material having a low energy barrier with respect to the semiconductor layer 13 as the material of the conductive layer 15, and it is possible to select the material without restriction of the work function.

また、複合層14はキャリア注入性に優れている他、化学的に安定であり、半導体層13との密着性も導電層15に比較して良好である。なお、本構成のソース及びドレイン電極16a、bは、配線と兼用することができる。   In addition, the composite layer 14 has excellent carrier injection properties, is chemically stable, and has better adhesion to the semiconductor layer 13 than the conductive layer 15. Note that the source and drain electrodes 16a and 16b of this configuration can also be used as wiring.

高密度プラズマを用いて形成されたゲート絶縁膜12は、プラズマダメージが少なく、欠陥が少ない膜を形成することができるため、トンネルリーク電流を低減することができる。また、表面の粗さが小さいため、キャリア移動度を大きくすることができる。さらに、ゲート絶縁膜上に形成される半導体層13を構成する有機半導体材料の配向がそろいやすくなる。また、ゲート電極にたとえばTaやAl等といった窒化及び/または酸化処理により高誘電率となる材料を選択することで、誘電率の高いゲート絶縁膜を形成することができる。よって、ゲート絶縁膜を薄膜化しても等価酸化膜厚(EOT:Equivalent Oxide Thickness)をかせぐことが可能となり、トンネルリーク電流を防ぎつつより高速な動作が可能となる。また、駆動電圧を下げることもできる。さらに、ゲート電極を直接反応させることでゲート電極の幅を狭くかつゲート電極を薄くすることができるため、チャネル長を短くできる。よって、高集積化が可能となる。   Since the gate insulating film 12 formed using high-density plasma can form a film with little plasma damage and few defects, tunnel leakage current can be reduced. Further, since the surface roughness is small, the carrier mobility can be increased. Furthermore, it becomes easy to align the organic semiconductor material constituting the semiconductor layer 13 formed on the gate insulating film. Further, by selecting a material having a high dielectric constant by nitriding and / or oxidizing treatment such as Ta or Al for the gate electrode, a gate insulating film having a high dielectric constant can be formed. Therefore, even if the gate insulating film is thinned, an equivalent oxide thickness (EOT: Equivalent Oxide Thickness) can be obtained, and a higher speed operation can be performed while preventing a tunnel leakage current. In addition, the drive voltage can be lowered. Further, by directly reacting the gate electrode, the width of the gate electrode can be narrowed and the gate electrode can be thinned, so that the channel length can be shortened. Therefore, high integration is possible.

さらに半導体層13の下面に接して、ポリイミド、ポリアミック酸、ポリビニルフェニールなど有機絶縁材料を成膜しても良い。このような構成により、有機半導体材料の配向をさらに高めるほか、ゲート絶縁膜12と半導体層13との密着性をさらに向上することができる。   Further, an organic insulating material such as polyimide, polyamic acid, or polyvinyl phenyl may be formed in contact with the lower surface of the semiconductor layer 13. With such a configuration, the orientation of the organic semiconductor material can be further improved, and the adhesion between the gate insulating film 12 and the semiconductor layer 13 can be further improved.

また、図1(A)の構造のように半導体層13上にソース及びドレイン電極16a、bが設けられた構造(以後、トップコンタクト型構造と表記する)を例示したが、本発明は図1(B)の構造のような有機半導体層の下にソース電極、ドレイン電極を設ける構造(以後、ボトムコンタクト型構造と表記する)であっても良い。   Further, the structure in which the source and drain electrodes 16a and 16b are provided on the semiconductor layer 13 as in the structure of FIG. 1A (hereinafter referred to as a top contact type structure) is illustrated. A structure in which a source electrode and a drain electrode are provided under the organic semiconductor layer as in the structure (B) (hereinafter referred to as a bottom contact structure) may be used.

ボトムゲート型の場合には、トップコンタクト型構造を採用したほうがキャリア移動度が大きいといった利点がある。一方、ボトムコンタクト型構造を用いた場合、ソース及びドレイン配線の微細加工を施すためにフォトリソグラフィなどの工程を容易に用いることができる。そのため、有機トランジスタの構造はその長所、短所に合わせて適宜選択すれば良い。   In the case of the bottom gate type, there is an advantage that the carrier mobility is higher when the top contact type structure is adopted. On the other hand, when the bottom contact type structure is used, a process such as photolithography can be easily used to finely process the source and drain wiring. Therefore, the structure of the organic transistor may be appropriately selected according to its advantages and disadvantages.

以上のことから、信頼性に優れた有機トランジスタを提供することができる。   From the above, an organic transistor with excellent reliability can be provided.

(実施の形態2)
実施の形態1に示した有機トランジスタは、ゲート電極となる導電層に対し高密度プラズマ処理を施すことにより形成した絶縁膜をゲート絶縁膜として利用しているが、本実施の形態では図3のようにあらかじめ形成した絶縁膜に対しさらに高密度プラズマによる窒化もしくは酸化を行うことでゲート絶縁膜を形成する。なお、ゲート絶縁膜及びゲート電極以外は実施の形態1と同様であるため、共通の符号を用いて示し、説明は省略する。
(Embodiment 2)
In the organic transistor described in Embodiment 1, an insulating film formed by performing high-density plasma treatment on the conductive layer serving as the gate electrode is used as the gate insulating film. In this embodiment, FIG. Thus, the gate insulating film is formed by performing nitridation or oxidation with high-density plasma on the previously formed insulating film. Note that the components other than the gate insulating film and the gate electrode are the same as those in Embodiment Mode 1, and thus are denoted by common reference numerals and description thereof is omitted.

基板10上にゲート電極31を形成する。ゲート電極31に用いる材料は、特に限定は無く、たとえば、金、白金、アルミニウム、タングステン、チタン、銅、モリブデン、タンタル、ニオブ、クロム、ニッケル、コバルト、マグネシウムなどの金属及びそれらを含む合金、ポリアニリン、ポリピロール、ポリチオフェン、ポリアセチレン、ポリジアセチレン、不純物をドープしたポリシリコンなどの導電性高分子化合物等が挙げられる。ゲート電極31の形成方法は特に限定は無く、スパッタリング法や蒸着法などにより成膜した後、エッチングするなどの方法により所望の形状に加工し作製すればよい。また、導電物を含む液滴を用いてインクジェット法等により形成してもよい。   A gate electrode 31 is formed on the substrate 10. The material used for the gate electrode 31 is not particularly limited. For example, a metal such as gold, platinum, aluminum, tungsten, titanium, copper, molybdenum, tantalum, niobium, chromium, nickel, cobalt, magnesium, and an alloy containing them, polyaniline , Conductive polymers such as polypyrrole, polythiophene, polyacetylene, polydiacetylene, polysilicon doped with impurities, and the like. A method for forming the gate electrode 31 is not particularly limited, and the gate electrode 31 may be formed by sputtering or vapor deposition, and then processed into a desired shape by a method such as etching. Alternatively, a droplet including a conductive material may be used by an inkjet method or the like.

次にゲート電極31を覆う絶縁膜32を形成する。絶縁膜32は、酸化珪素、窒化珪素、酸窒化珪素などの無機絶縁材料を用いる。なお、これらの絶縁膜32はディップ法、スピンコート法、液滴吐出法などの塗布法や、CVD法、スパッタ法などの方法によって成膜することができる。   Next, an insulating film 32 that covers the gate electrode 31 is formed. The insulating film 32 uses an inorganic insulating material such as silicon oxide, silicon nitride, or silicon oxynitride. These insulating films 32 can be formed by a coating method such as a dipping method, a spin coating method, or a droplet discharge method, or a method such as a CVD method or a sputtering method.

この絶縁膜32に対し、高密度プラズマを用いて窒化及び/または酸化処理を行いゲート絶縁膜を形成する。たとえば、酸化珪素の絶縁膜32に対し高密度プラズマ窒化処理や窒化珪素の絶縁膜32に対し高密度プラズマ酸化処理を行い酸化窒化珪素を形成する。また、酸化珪素もしくは窒化珪素と酸化窒化珪素との積層構造であるゲート絶縁膜を形成しても良い。なお、ゲート絶縁膜の積層数は特に限定されない。また、窒化珪素に対しさらに高密度プラズマ窒化を行うことで、より高い濃度の窒素を含有する窒化珪素膜を得ることも可能である。   The insulating film 32 is nitrided and / or oxidized using high-density plasma to form a gate insulating film. For example, silicon oxynitride is formed by performing high-density plasma nitriding treatment on the silicon oxide insulating film 32 or high-density plasma oxidizing treatment on the silicon nitride insulating film 32. Alternatively, a gate insulating film having a stacked structure of silicon oxide or silicon nitride and silicon oxynitride may be formed. Note that the number of stacked gate insulating films is not particularly limited. It is also possible to obtain a silicon nitride film containing a higher concentration of nitrogen by performing higher density plasma nitriding on silicon nitride.

高密度プラズマは、高い周波数のマイクロ波、たとえば2.45GHzを使うことによって生成される。このような高密度プラズマを用い、酸素(もしくは酸素を含むガス)や窒素(もしくは窒素を含むガス)などをプラズマ励起によって活性化し、これらを絶縁膜と反応させる。低電子温度が特徴である高密度プラズマは、活性種の運動エネルギーが低いため、従来のプラズマ処理に比べプラズマダメージが少なく欠陥が少ない膜を形成することができる。なお、ゲート絶縁膜には、実施の形態1に示した供給ガスに用いられる不活性ガスが混入されている。   The high density plasma is generated by using a high frequency microwave, for example 2.45 GHz. Using such high-density plasma, oxygen (or a gas containing oxygen), nitrogen (or a gas containing nitrogen), and the like are activated by plasma excitation, and these are reacted with the insulating film. Since high-density plasma characterized by low electron temperature has low kinetic energy of active species, it is possible to form a film with less plasma damage and fewer defects than conventional plasma treatment. Note that an inert gas used for the supply gas described in Embodiment Mode 1 is mixed in the gate insulating film.

ゲート絶縁膜上に半導体層13を形成する。次に、ソース及びドレイン電極16a、bを形成する。   A semiconductor layer 13 is formed on the gate insulating film. Next, source and drain electrodes 16a and 16b are formed.

このような構成を有する有機トランジスタにおいて、半導体層13と導電層15との間に複合層14を挿入した構成のソース及びドレイン電極16a、bを用いることにより、半導体層13とソース及びドレイン電極16a、bとの間のエネルギー障壁が低減し、ソース及びドレイン電極の一方の電極から半導体層へのキャリアの注入と半導体層から他方の電極へのキャリアの排出が容易になる。このため、導電層15の材料は半導体層13とエネルギー障壁が低い材料を選択する必要がなく、仕事関数の制約無しに選択することが可能となる。   In the organic transistor having such a configuration, by using the source and drain electrodes 16a and 16b in which the composite layer 14 is inserted between the semiconductor layer 13 and the conductive layer 15, the semiconductor layer 13 and the source and drain electrodes 16a are used. , B is reduced, and carriers can be easily injected from one of the source and drain electrodes into the semiconductor layer and discharged from the semiconductor layer to the other electrode. For this reason, it is not necessary to select a material having a low energy barrier with respect to the semiconductor layer 13 as the material of the conductive layer 15, and it is possible to select the material without restriction of the work function.

また、複合層14はキャリア注入性に優れている他、化学的に安定であり、半導体層13との密着性も導電層15に比較して良好である。なお、本構成のソース及びドレイン電極16a、bは、配線と兼用することができる。   In addition, the composite layer 14 has excellent carrier injection properties, is chemically stable, and has better adhesion to the semiconductor layer 13 than the conductive layer 15. Note that the source and drain electrodes 16a and 16b of this configuration can also be used as wiring.

高密度プラズマを用いて形成されたゲート絶縁膜は、プラズマダメージが少なく、欠陥が少ない膜を形成することができるため、トンネルリーク電流を低減することができる。また、表面の粗さが小さいため、キャリア移動度を大きくすることができる。さらに、ゲート絶縁膜上に形成される半導体層13を構成する有機半導体材料の配向がそろいやすくなる。   A gate insulating film formed using high-density plasma can form a film with little plasma damage and few defects, so that tunnel leakage current can be reduced. Further, since the surface roughness is small, the carrier mobility can be increased. Furthermore, it becomes easy to align the organic semiconductor material constituting the semiconductor layer 13 formed on the gate insulating film.

図3(A)のようなトップコンタクト型構造を例示したが、本発明は図3(B)のようなボトムコンタクト型構造であっても良い。   Although the top contact type structure as shown in FIG. 3A is illustrated, the present invention may be a bottom contact type structure as shown in FIG.

ボトムゲート型の場合には、トップコンタクト型構造を採用したほうがキャリア移動度が大きいといった利点がある。一方、ボトムコンタクト型構造を用いた場合、ソース及びドレイン配線の微細加工を施すためにフォトリソグラフィなどの工程を容易に用いることができる。そのため、有機トランジスタの構造はその長所、短所に合わせて適宜選択すれば良い。   In the case of the bottom gate type, there is an advantage that the carrier mobility is higher when the top contact type structure is adopted. On the other hand, when the bottom contact type structure is used, a process such as photolithography can be easily used in order to finely process the source and drain wiring. Therefore, the structure of the organic transistor may be appropriately selected according to its advantages and disadvantages.

また、実施の形態1のように、ゲート電極となる導電層を高密度プラズマを用いて絶縁化し、得られた絶縁膜をゲート絶縁膜の一部として用いても良い。ただし、その際に使用できるゲート電極の材料は、実施の形態1に記載した導電層17の材料である。この場合、ゲート電極となる導電層を絶縁化することでゲート電極の幅を狭くかつゲート電極を薄くすることができるため、チャネル長を短くできる。よって、高集積化が可能となる。   Further, as in Embodiment Mode 1, a conductive layer to be a gate electrode may be insulated using high-density plasma, and the obtained insulating film may be used as part of the gate insulating film. However, the material of the gate electrode that can be used at that time is the material of the conductive layer 17 described in Embodiment 1. In this case, by insulating the conductive layer to be the gate electrode, the width of the gate electrode can be narrowed and the gate electrode can be thinned, so that the channel length can be shortened. Therefore, high integration is possible.

以上のことから、信頼性に優れた有機トランジスタを提供することができる。   From the above, an organic transistor with excellent reliability can be provided.

(実施の形態3)
本実施の形態では、実施の形態1及び2に示した構造とは異なる構造を有する有機トランジスタについて、図4を用いて説明する。なお、実施の形態1及び2の有機トランジスタはボトムゲート型であったのに対し、本実施の形態ではトップゲート型である。実施の形態1と同様のものに関しては、共通の符号を用いて示し、詳細な説明は省略する。
(Embodiment 3)
In this embodiment, an organic transistor having a structure different from those described in Embodiments 1 and 2 is described with reference to FIGS. Note that the organic transistors of Embodiments 1 and 2 are of the bottom gate type, whereas in the present embodiment, they are of the top gate type. Components similar to those in Embodiment 1 are denoted by common reference numerals, and detailed description thereof is omitted.

図4(A)の構造について説明する。基板10上に、半導体層13を形成する。さらに、半導体層13上に複合層14及び導電層15を有するソース及びドレイン電極16a、bを形成する。   The structure of FIG. 4A will be described. A semiconductor layer 13 is formed on the substrate 10. Further, source and drain electrodes 16 a and 16 b having the composite layer 14 and the conductive layer 15 are formed on the semiconductor layer 13.

次に、半導体層13とソース及びドレイン電極16a、bを覆う絶縁膜42を形成する。絶縁膜42は、酸化珪素、窒化珪素、酸窒化珪素などの無機絶縁材料を用いる。なお、これらの絶縁膜はディップ法、スピンコート法、液滴吐出法などの塗布法や、CVD法、スパッタ法などの方法によって成膜することができる。ただし、半導体層13が破壊されないような条件や手法を用いる必要がある。   Next, an insulating film 42 covering the semiconductor layer 13 and the source and drain electrodes 16a and 16b is formed. The insulating film 42 uses an inorganic insulating material such as silicon oxide, silicon nitride, or silicon oxynitride. Note that these insulating films can be formed by a coating method such as a dip method, a spin coating method, or a droplet discharge method, a CVD method, a sputtering method, or the like. However, it is necessary to use conditions and methods that do not destroy the semiconductor layer 13.

この絶縁膜に対し、高密度プラズマを用いて窒化及び/または酸化処理を行いゲート絶縁膜を形成する。たとえば、酸化珪素の絶縁膜42に対し高密度プラズマ窒化処理や窒化珪素の絶縁膜42に対し高密度プラズマ酸化処理を行い酸化窒化珪素を形成する。また、酸化珪素もしくは窒化珪素と酸化窒化珪素との積層構造であるゲート絶縁膜を形成しても良い。なお、ゲート絶縁膜の積層数は特に限定されない。また、窒化珪素に対しさらに高密度プラズマ窒化を行うことで、より高い濃度の窒素を含有する窒化珪素膜を得ることも可能である。   The insulating film is nitrided and / or oxidized using high-density plasma to form a gate insulating film. For example, silicon oxynitride is formed by performing high-density plasma nitriding treatment on the silicon oxide insulating film 42 or high-density plasma oxidizing treatment on the silicon nitride insulating film 42. Alternatively, a gate insulating film having a stacked structure of silicon oxide or silicon nitride and silicon oxynitride may be formed. Note that the number of stacked gate insulating films is not particularly limited. It is also possible to obtain a silicon nitride film containing a higher concentration of nitrogen by performing higher density plasma nitriding on silicon nitride.

高密度プラズマは、高い周波数のマイクロ波、たとえば2.45GHzを使うことによって生成される。このような高密度プラズマを用い、酸素(もしくは酸素を含むガス)や窒素(もしくは窒素を含むガス)などをプラズマ励起によって活性化し、これらを絶縁膜と反応させる。低電子温度が特徴である高密度プラズマは、活性種の運動エネルギーが低いため、従来のプラズマ処理に比べプラズマダメージが少なく欠陥が少ない膜を形成することができる。なお、ゲート絶縁膜には、実施の形態1に示した供給ガスに用いられる不活性ガスが混入されている。   The high density plasma is generated by using a high frequency microwave, for example 2.45 GHz. Using such high-density plasma, oxygen (or a gas containing oxygen), nitrogen (or a gas containing nitrogen), and the like are activated by plasma excitation, and these are reacted with the insulating film. Since high-density plasma characterized by low electron temperature has low kinetic energy of active species, it is possible to form a film with less plasma damage and fewer defects than conventional plasma treatment. Note that an inert gas used for the supply gas described in Embodiment Mode 1 is mixed in the gate insulating film.

次に、ゲート電極41を形成する。ゲート電極41に用いる材料は、特に限定は無く、たとえば、金、白金、アルミニウム、タングステン、チタン、銅、モリブデン、タンタル、ニオブ、クロム、ニッケル、コバルト、マグネシウムなどの金属及びそれらを含む合金、ポリアニリン、ポリピロール、ポリチオフェン、ポリアセチレン、ポリジアセチレンなどの導電性高分子化合物等が挙げられる。ゲート電極41の形成方法について特に限定は無く、スパッタリング法や蒸着法などにより成膜した後、エッチングするなどの方法により所望の形状に加工すればよい。また、導電物を含む液滴を用いてインクジェット法等により形成してもよい。ただし、半導体層が破壊されないような条件や手法を用いる必要がある。   Next, the gate electrode 41 is formed. The material used for the gate electrode 41 is not particularly limited. For example, metals such as gold, platinum, aluminum, tungsten, titanium, copper, molybdenum, tantalum, niobium, chromium, nickel, cobalt, magnesium, and alloys containing them, polyaniline , Conductive polymer compounds such as polypyrrole, polythiophene, polyacetylene, and polydiacetylene. There is no particular limitation on a method for forming the gate electrode 41, and the gate electrode 41 may be processed into a desired shape by a method such as etching after forming a film by a sputtering method or an evaporation method. Alternatively, a droplet including a conductive material may be used by an inkjet method or the like. However, it is necessary to use conditions and techniques that do not destroy the semiconductor layer.

このような構成を有する有機トランジスタにおいて、半導体層13と導電層15との間に複合層14を挿入した構成のソース及びドレイン電極16a、bを用いることにより、半導体層13とソース及びドレイン電極16a、bとの間のエネルギー障壁が低減し、ソース及びドレイン電極の一方の電極から半導体層へのキャリアの注入と半導体層から他方の電極へのキャリアの排出が容易になる。このため、導電層15の材料は半導体層13とエネルギー障壁が低い材料を選択する必要がなく、仕事関数の制約無しに選択することが可能となる。   In the organic transistor having such a configuration, by using the source and drain electrodes 16a and 16b in which the composite layer 14 is inserted between the semiconductor layer 13 and the conductive layer 15, the semiconductor layer 13 and the source and drain electrodes 16a are used. , B is reduced, and carriers can be easily injected from one of the source and drain electrodes into the semiconductor layer and discharged from the semiconductor layer to the other electrode. For this reason, it is not necessary to select a material having a low energy barrier with respect to the semiconductor layer 13 as the material of the conductive layer 15, and it is possible to select the material without restriction of the work function.

また、複合層14はキャリアの注入性に優れている他、化学的に安定であり、半導体層13との密着性も導電層15に比較して良好である。なお、本構成のソース及びドレイン電極16a、bは、配線と兼用することができる。   The composite layer 14 is excellent in carrier injectability, is chemically stable, and has better adhesion to the semiconductor layer 13 than the conductive layer 15. Note that the source and drain electrodes 16a and 16b of this configuration can also be used as wiring.

また、高密度プラズマを用いて形成されたゲート絶縁膜は、プラズマダメージが少なく、欠陥が少ない膜を形成することができるため、トンネルリーク電流を低減することができる。   In addition, since the gate insulating film formed using high-density plasma can form a film with little plasma damage and few defects, tunnel leakage current can be reduced.

また、図4(A)の構造のようなトップコンタクト構造を例示したが、本発明は図4(B)の構造のようなボトムコンタクト型構造であっても良い。   Moreover, although the top contact structure like the structure of FIG. 4 (A) was illustrated, this invention may be a bottom contact type structure like the structure of FIG. 4 (B).

さらに、ゲート電極を高密度プラズマを用いて窒化処理することで耐熱性を向上させることも可能である。また、ゲート電極となる導電層を絶縁化した場合には、ゲート電極の幅を狭くかつゲート電極を薄くすることができるため、チャネル長を短くできる。よって、高集積化が可能となる。   Furthermore, heat resistance can be improved by nitriding the gate electrode using high-density plasma. In addition, when the conductive layer to be the gate electrode is insulated, the width of the gate electrode can be narrowed and the gate electrode can be thinned, so that the channel length can be shortened. Therefore, high integration is possible.

以上のことから、信頼性に優れた有機トランジスタを提供することができる。   From the above, an organic transistor with excellent reliability can be provided.

(実施の形態4)
本実施の形態では、電子をキャリアとするN型の有機トランジスタの構造例を図5を用いて説明する。実施の形態1におけるソース及びドレイン電極16a、bを、本実施の形態では、さらにアルカリ金属またはアルカリ土類金属、もしくはそれらを含む化合物(酸化物や窒化物や塩)を含む第2の複合層58を有する構成としたものである。なお、本実施の形態においては、実施の形態1における有機化合物と金属酸化物とを有する複合層14を第1の複合層14と記載する。実施の形態1と同様のものに関しては、同様の符号を用いて示し、詳細な説明は省略する。
(Embodiment 4)
In this embodiment, a structural example of an N-type organic transistor using electrons as carriers will be described with reference to FIGS. In this embodiment, the source and drain electrodes 16a and 16b in the first embodiment are further combined with an alkali metal or an alkaline earth metal, or a compound (oxide, nitride, or salt) containing them. 58. In the present embodiment, the composite layer 14 including the organic compound and the metal oxide in Embodiment 1 is referred to as a first composite layer 14. Components similar to those in Embodiment 1 are denoted by the same reference numerals, and detailed description thereof is omitted.

半導体層53に使用する有機半導体材料は、実施の形態1に記載した半導体材料を使用することができ、特にN型半導体として挙げられている材料が好ましい。   As the organic semiconductor material used for the semiconductor layer 53, the semiconductor material described in Embodiment 1 can be used, and the materials listed as N-type semiconductors are particularly preferable.

第2の複合層58に使用するアルカリ金属及びアルカリ土類金属、もしくはそれらを含む化合物(酸化物や窒化物や塩)の種類は特に限定されるものではないが以下に挙げる、リチウム、ナトリウム、カリウム、セシウム、マグネシウム、カルシウム、ストロンチウム、バリウム、リチウム酸化物、マグネシウム窒化物、カルシウム窒化物であることが好ましい。なお、第2の複合層58の形成方法は、半導体層53が分解しないようなものであれば特に限定は無く、スパッタリング法や蒸着法などを用いることができる。   The type of alkali metal and alkaline earth metal used in the second composite layer 58, or a compound containing them (oxide, nitride, or salt) is not particularly limited, but lithium, sodium, Potassium, cesium, magnesium, calcium, strontium, barium, lithium oxide, magnesium nitride, and calcium nitride are preferable. Note that the method for forming the second composite layer 58 is not particularly limited as long as the semiconductor layer 53 is not decomposed, and a sputtering method, an evaporation method, or the like can be used.

また、これらの材料と電子輸送性を有する有機化合物との混合材料によって、第2の複合層58を形成しても良い。電子輸送性を有する有機化合物としては、半導体層に使用されるペリレンテトラカルボン酸無水物及びその誘導体、ペリレンテトラカルボキシジイミド誘導体、ナフタレンテトラカルボン酸無水物及びその誘導体、ナフタレンテトラカルボキシジイミド誘導体、金属フタロシアニン誘導体、フラーレン類の他、例えば、トリス(8−キノリノラト)アルミニウム(略称:Alq)、トリス(4−メチル−8−キノリノラト)アルミニウム(略称:Almq)、ビス(10−ヒドロキシベンゾ[h]−キノリナト)ベリリウム(略称:BeBq)、ビス(2−メチル−8−キノリノラト)−4−フェニルフェノラト−アルミニウム(略称:BAlq)等キノリン骨格またはベンゾキノリン骨格を有する金属錯体等からなる材料を用いることができる。また、この他、ビス[2−(2−ヒドロキシフェニル)ベンゾオキサゾラト]亜鉛(略称:Zn(BOX))、ビス[2−(2−ヒドロキシフェニル)ベンゾチアゾラト]亜鉛(略称:Zn(BTZ))などのオキサゾール系、チアゾール系配位子を有する金属錯体などの材料も用いることができる。さらに、金属錯体以外にも、2−(4−ビフェニリル)−5−(4−tert−ブチルフェニル)−1,3,4−オキサジアゾール(略称:PBD)、1,3−ビス[5−(p−tert−ブチルフェニル)−1,3,4−オキサジアゾール−2−イル]ベンゼン(略称:OXD−7)、3−(4−tert−ブチルフェニル)−4−フェニル−5−(4−ビフェニリル)−1,2,4−トリアゾール(略称:TAZ)、3−(4−tert−ブチルフェニル)−4−(4−エチルフェニル)−5−(4−ビフェニリル)−1,2,4−トリアゾール(略称:p−EtTAZ)、バソフェナントロリン(略称:BPhen)、バソキュプロイン(略称:BCP)等を用いることができる。なお、電子輸送性を有する有機化合物が混合された第2の複合層58は、抵抗加熱を用いた共蒸着による成膜や、抵抗加熱蒸着と電子銃蒸着(EB蒸着)を用いた共蒸着による成膜、スパッタリングと抵抗加熱による同時成膜などにより成膜すればよい。 Alternatively, the second composite layer 58 may be formed using a mixed material of these materials and an organic compound having an electron transporting property. Examples of the organic compound having an electron transporting property include perylenetetracarboxylic anhydride and derivatives thereof used in semiconductor layers, perylenetetracarboxydiimide derivatives, naphthalenetetracarboxylic anhydride and derivatives thereof, naphthalenetetracarboxydiimide derivatives, metal phthalocyanines. In addition to derivatives and fullerenes, for example, tris (8-quinolinolato) aluminum (abbreviation: Alq 3 ), tris (4-methyl-8-quinolinolato) aluminum (abbreviation: Almq 3 ), bis (10-hydroxybenzo [h] -Quinolinato) Beryllium (abbreviation: BeBq 2 ), bis (2-methyl-8-quinolinolato) -4-phenylphenolato-aluminum (abbreviation: BAlq), etc. Use It is possible. In addition, bis [2- (2-hydroxyphenyl) benzoxazolate] zinc (abbreviation: Zn (BOX) 2 ), bis [2- (2-hydroxyphenyl) benzothiazolate] zinc (abbreviation: Zn (BTZ) A material such as a metal complex having an oxazole-based or thiazole-based ligand such as 2 ) can also be used. In addition to metal complexes, 2- (4-biphenylyl) -5- (4-tert-butylphenyl) -1,3,4-oxadiazole (abbreviation: PBD), 1,3-bis [5- (P-tert-butylphenyl) -1,3,4-oxadiazol-2-yl] benzene (abbreviation: OXD-7), 3- (4-tert-butylphenyl) -4-phenyl-5- ( 4-biphenylyl) -1,2,4-triazole (abbreviation: TAZ), 3- (4-tert-butylphenyl) -4- (4-ethylphenyl) -5- (4-biphenylyl) -1,2, 4-triazole (abbreviation: p-EtTAZ), bathophenanthroline (abbreviation: BPhen), bathocuproin (abbreviation: BCP), and the like can be used. The second composite layer 58 mixed with an organic compound having an electron transporting property is formed by co-evaporation using resistance heating, or by co-evaporation using resistance heating evaporation and electron gun evaporation (EB evaporation). The film may be formed by film formation, simultaneous film formation by sputtering and resistance heating, or the like.

まず、基板10上にゲート電極となる導電層17を形成する。次に、高密度プラズマを用いてゲート電極となる導電層17を窒化及び/または酸化することでゲート電極材料の窒化物、酸化物もしくは酸化窒化物からなるゲート絶縁膜12を形成する。さらに、第2の複合層58、第1の複合層14及び導電層15を有するソース及びドレイン電極56a、bを形成し、有機トランジスタを作製する。なお、ゲート絶縁膜12には、実施の形態1で示したように供給ガスに用いられたアルゴン、クリプトン、ヘリウムやキセノンなどの不活性ガスが混入されている。   First, a conductive layer 17 to be a gate electrode is formed on the substrate 10. Next, the gate insulating film 12 made of nitride, oxide, or oxynitride of the gate electrode material is formed by nitriding and / or oxidizing the conductive layer 17 that becomes the gate electrode using high-density plasma. Further, source and drain electrodes 56a and 56b having the second composite layer 58, the first composite layer 14 and the conductive layer 15 are formed, and an organic transistor is manufactured. Note that the gate insulating film 12 is mixed with an inert gas such as argon, krypton, helium, or xenon used as the supply gas as described in the first embodiment.

このようにして作製された有機トランジスタにおいて、第2の複合層58、第1の複合層14、導電層15が積層された構造を有する電極に電圧を印加すると、第2の複合層58と第1の複合層14の界面近傍においてホール及び電子がキャリア分離により発生する。発生したキャリアのうち電子は第2の複合層58から半導体層53へと供給され、ホールは導電層15へと流れる。このようにして半導体層53内部には電子をキャリアとする電流が流れることになる。   In the organic transistor manufactured as described above, when a voltage is applied to an electrode having a structure in which the second composite layer 58, the first composite layer 14, and the conductive layer 15 are stacked, the second composite layer 58 and the first composite layer 58 Holes and electrons are generated by carrier separation in the vicinity of the interface of one composite layer 14. Among the generated carriers, electrons are supplied from the second composite layer 58 to the semiconductor layer 53, and holes flow to the conductive layer 15. In this way, a current using electrons as carriers flows in the semiconductor layer 53.

また、半導体層53と導電層15との間に第2の複合層58と第1の複合層14とを挿入した構成のソース及びドレイン電極56a、bを用いることにより、半導体層53とソース及びドレイン電極56a、bとの間のエネルギー障壁が低減し、ソース及びドレイン電極の一方の電極から半導体層へのキャリアの注入と半導体層から他方の電極へのキャリアの排出が容易になる。このため、導電層15の材料はエネルギー障壁が低い材料を選択する必要がなく、仕事関数の制約無しに選択することが可能となる。   In addition, by using the source and drain electrodes 56 a and 56 b in which the second composite layer 58 and the first composite layer 14 are inserted between the semiconductor layer 53 and the conductive layer 15, the semiconductor layer 53 and the source and drain The energy barrier between the drain electrodes 56a and 56b is reduced, and carriers can be easily injected from one of the source and drain electrodes into the semiconductor layer and discharged from the semiconductor layer to the other electrode. For this reason, it is not necessary to select a material having a low energy barrier as the material of the conductive layer 15, and it is possible to select the material without restriction of the work function.

また、第1の複合層14はキャリア注入性に優れている他、化学的に安定であり、半導体層53との密着性も導電層15に比較して良好である。なお、本構成のソース及びドレイン電極56a、bは、配線と兼用することができる。   The first composite layer 14 is excellent in carrier injection property, chemically stable, and has better adhesion to the semiconductor layer 53 than the conductive layer 15. Note that the source and drain electrodes 56a and 56b of this configuration can also be used as wiring.

高密度プラズマを用いて形成されたゲート絶縁膜は、プラズマダメージが少なく、欠陥が少ない膜を形成することができるため、トンネルリーク電流を低減することができる。また、表面の粗さが小さいため、キャリア移動度を大きくすることができる。さらに、ゲート絶縁膜上に形成される半導体層53を構成する有機半導体材料の配向がそろいやすくなる。また、ゲート電極にたとえばTaやAl等といった窒化及び/または酸化処理により高誘電率となる材料を選択することで、誘電率の高いゲート絶縁膜を形成することができる。よって、ゲート絶縁膜を薄膜化しても物理膜厚をかせぐことが可能となり、トンネルリーク電流を防ぎつつより高速な動作が可能となる。また、駆動電圧を下げることもできる。さらに、ゲート電極を直接反応させることでゲート電極の幅を狭くかつゲート電極を薄くすることができるため、チャネル長を短くできる。よって、高集積化が可能となる。   A gate insulating film formed using high-density plasma can form a film with little plasma damage and few defects, so that tunnel leakage current can be reduced. Further, since the surface roughness is small, the carrier mobility can be increased. Further, the organic semiconductor material constituting the semiconductor layer 53 formed on the gate insulating film is easily aligned. Further, by selecting a material having a high dielectric constant by nitriding and / or oxidizing treatment such as Ta or Al for the gate electrode, a gate insulating film having a high dielectric constant can be formed. Therefore, even if the gate insulating film is thinned, it is possible to increase the physical film thickness, and it is possible to operate at higher speed while preventing tunnel leakage current. In addition, the drive voltage can be lowered. Further, by directly reacting the gate electrode, the width of the gate electrode can be narrowed and the gate electrode can be thinned, so that the channel length can be shortened. Therefore, high integration is possible.

また、さらに半導体層53の下面に接して、ポリイミド、ポリアミック酸、ポリビニルフェニールなど有機絶縁材料を成膜しても良い。このような構成により、有機半導体材料の配向をさらに高めるほか、ゲート絶縁膜12と半導体層53との密着性をさらに向上することができる。   Further, an organic insulating material such as polyimide, polyamic acid, or polyvinyl phenyl may be formed in contact with the lower surface of the semiconductor layer 53. With such a configuration, the orientation of the organic semiconductor material can be further improved, and the adhesion between the gate insulating film 12 and the semiconductor layer 53 can be further improved.

以上のことから、信頼性に優れた有機トランジスタを提供することができる。   From the above, an organic transistor with excellent reliability can be provided.

(実施の形態5)
本発明の有機トランジスタを含む液晶表示装置(液晶装置)の態様について、図7を用いて説明する。
(Embodiment 5)
A mode of a liquid crystal display device (liquid crystal device) including the organic transistor of the present invention will be described with reference to FIG.

図7は液晶表示装置を模式的に表した上面図である。点線で示された601は駆動回路部(ソース側駆動回路)、602は画素部、603は駆動回路部(ゲート側駆動回路)であり、これらは素子基板600、対向基板604及びシール材605により封止されている。   FIG. 7 is a top view schematically showing the liquid crystal display device. Reference numeral 601 indicated by a dotted line denotes a driving circuit portion (source side driving circuit), 602 denotes a pixel portion, and 603 denotes a driving circuit portion (gate side driving circuit). These are constituted by an element substrate 600, a counter substrate 604, and a sealant 605. It is sealed.

ソース側駆動回路601およびゲート側駆動回路603は、外部入力端子となるFPC(フレキシブルプリントサーキット)609からビデオ信号、クロック信号、スタート信号、リセット信号等を受け取る。なお、ここではFPCしか図示していないが、このFPCにはプリント配線基盤(PWB)が取り付けられていてもよい。本発明の液晶表示装置には、液晶表示装置本体だけの場合はもちろん、それにFPCもしくはPWBが取り付けられた状態をも含むものとする。   The source side driver circuit 601 and the gate side driver circuit 603 receive a video signal, a clock signal, a start signal, a reset signal, and the like from an FPC (flexible print circuit) 609 which is an external input terminal. Although only the FPC is shown here, a printed wiring board (PWB) may be attached to the FPC. The liquid crystal display device of the present invention includes not only the liquid crystal display device main body but also a state in which an FPC or PWB is attached thereto.

画素部602について特に限定はなく、例えば図8の断面図のように、液晶素子とそれを駆動するためのトランジスタとを有する。   The pixel portion 602 is not particularly limited, and includes a liquid crystal element and a transistor for driving the liquid crystal element as shown in a cross-sectional view of FIG.

図8の断面図で表される液晶表示装置は、実施の形態1に記載された有機トランジスタと同様にゲート電極となる導電層が高密度プラズマ処理により絶縁化されて形成されたゲート絶縁膜12を有する有機トランジスタ527を有する。なお、実施の形態1と同様のものは共通の符号を用いて示し、説明は省略する。   The liquid crystal display device represented by the cross-sectional view of FIG. 8 includes a gate insulating film 12 formed by insulating a conductive layer serving as a gate electrode by high-density plasma treatment, like the organic transistor described in the first embodiment. An organic transistor 527 having In addition, the same thing as Embodiment 1 is shown using a common code | symbol, and description is abbreviate | omitted.

基板10上に形成された有機トランジスタ527は、絶縁層528によって覆われており、コンタクトホールを介してソース及びドレイン電極の一部として機能する導電層15の一方と画素電極529とが電気的に接続されている。液晶素子は、対向基板531に形成された対向電極532と画素電極529との間に液晶層534を挟んで成り、液晶層534と接する側の対向電極532及び画素電極529の表面には、それぞれ配向膜533、530が設けられている。なお、液晶層534は、スペーサ535によりセルギャップが保たれている。なお、液晶装置の構成について特に限定はない。   The organic transistor 527 formed over the substrate 10 is covered with an insulating layer 528, and one of the conductive layers 15 functioning as part of the source and drain electrodes and the pixel electrode 529 are electrically connected to each other through contact holes. It is connected. The liquid crystal element is formed by sandwiching a liquid crystal layer 534 between a counter electrode 532 and a pixel electrode 529 formed on the counter substrate 531, and on the surface of the counter electrode 532 and the pixel electrode 529 on the side in contact with the liquid crystal layer 534, respectively. Alignment films 533 and 530 are provided. Note that the cell gap of the liquid crystal layer 534 is maintained by the spacer 535. Note that there is no particular limitation on the configuration of the liquid crystal device.

続いて、本発明の有機トランジスタ527を用いた発光装置について図9を参照しながら説明する。図9の断面図で表される発光装置は、実施の形態1に記載された有機トランジスタと同様にゲート電極となる導電層が高密度プラズマ処理により絶縁化されて形成されたゲート絶縁膜12を有する有機トランジスタ527を有する。なお、実施の形態1と同様のものは共通の符号を用いて示し、説明は省略する。   Next, a light emitting device using the organic transistor 527 of the present invention will be described with reference to FIG. The light-emitting device represented by the cross-sectional view of FIG. 9 includes a gate insulating film 12 formed by insulating a conductive layer serving as a gate electrode by high-density plasma treatment, like the organic transistor described in Embodiment 1. It has an organic transistor 527. In addition, the same thing as Embodiment 1 is shown using a common code | symbol, and description is abbreviate | omitted.

基板10上に形成された有機トランジスタ527は、絶縁層528によって覆われており、コンタクトホールを介してソース及びドレイン電極の一部として機能する導電層15の一方と第1の電極610とが電気的に接続されている。第1の電極610の端部は絶縁層611で覆われており、絶縁層611から露出した部分を覆うように発光層612が形成されている。発光層612上には第2の電極613及びパッシベーション膜614が形成されている。なお、基板10と対向基板615とを画素部の外側においてシール材(図示しない)を用いて封止することによって、発光層612を外気から隔離する。対向基板615と基板10との間の空間616には乾燥した窒素などの不活性気体を充填しても良いし、シール材の代わりに空間616に樹脂などを充填することによって封止を行っても良い。なお、発光装置の構成について特に限定はない。   The organic transistor 527 formed over the substrate 10 is covered with an insulating layer 528, and one of the conductive layers 15 functioning as part of the source and drain electrodes and the first electrode 610 are electrically connected to each other through contact holes. Connected. An end portion of the first electrode 610 is covered with an insulating layer 611, and a light emitting layer 612 is formed so as to cover a portion exposed from the insulating layer 611. A second electrode 613 and a passivation film 614 are formed over the light emitting layer 612. Note that the light-emitting layer 612 is isolated from the outside air by sealing the substrate 10 and the counter substrate 615 with a sealant (not shown) outside the pixel portion. The space 616 between the counter substrate 615 and the substrate 10 may be filled with an inert gas such as dry nitrogen, or sealing is performed by filling the space 616 with a resin or the like instead of the sealing material. Also good. Note that there is no particular limitation on the structure of the light-emitting device.

有機トランジスタ527に高密度プラズマを用いて形成されたゲート絶縁膜を用いることで、トンネルリーク電流を低減することが可能となり信頼性の高い表示装置を得ることができる。   When a gate insulating film formed using high-density plasma is used for the organic transistor 527, tunnel leakage current can be reduced and a highly reliable display device can be obtained.

なお、本実施の形態では、有機トランジスタ527に用いるゲート絶縁膜は、ゲート電極となる導電層に高密度プラズマ処理を施して形成した絶縁膜を利用しているが、高密度プラズマ処理を行ったゲート絶縁膜であれば良い。   Note that in this embodiment, the gate insulating film used for the organic transistor 527 uses an insulating film formed by subjecting a conductive layer to be a gate electrode to high-density plasma treatment, but the high-density plasma treatment was performed. Any gate insulating film may be used.

以上のような表示装置は、図10(A)、(B)に示すように、電話機や、テレビ受像機等の電子機器に実装される表示装置として用いることができる。また、図10(C)に示すようにIDカードの様な個人情報を管理する機能を有するカードや図10(D)に示すようにフレキシブルな電子ペーパー等に実装してもよい。   As shown in FIGS. 10A and 10B, the display device as described above can be used as a display device mounted on an electronic device such as a telephone or a television receiver. Further, it may be mounted on a card having a function of managing personal information such as an ID card as shown in FIG. 10C or flexible electronic paper as shown in FIG.

図10(A)は電話機の図であり、本体710には表示部711と、音声出力部713、音声入力部714、操作スイッチ715、716、アンテナ717等によって構成されている。   FIG. 10A is a diagram of a telephone set. A main body 710 includes a display portion 711, an audio output portion 713, an audio input portion 714, operation switches 715 and 716, an antenna 717, and the like.

表示部711にはアクティブマトリクス表示装置が設けられている。表示方式は液晶表示であってもEL表示であってもよい。表示部711は画素ごとに有機トランジスタを有し、当該有機トランジスタには上記実施の形態を用いて高密度プラズマ処理を行ったゲート絶縁膜を用いる。また、表示部711を駆動するための集積回路は当該有機トランジスタと同様に基板上に形成もしくは実装されている。集積回路に設けられたトランジスタにも上記実施の形態を用いて高密度プラズマ処理を行ったゲート絶縁膜を有する有機トランジスタを用いても良い。本発明の有機トランジスタを用いることで、電気特性が良好で信頼性が高い電話機を得ることができる。   The display portion 711 is provided with an active matrix display device. The display method may be a liquid crystal display or an EL display. The display portion 711 includes an organic transistor for each pixel, and a gate insulating film which is subjected to high-density plasma treatment using the above embodiment is used for the organic transistor. Further, an integrated circuit for driving the display portion 711 is formed or mounted on a substrate similarly to the organic transistor. As the transistor provided in the integrated circuit, an organic transistor including a gate insulating film which is subjected to high-density plasma treatment using the above embodiment may be used. By using the organic transistor of the present invention, a telephone with good electrical characteristics and high reliability can be obtained.

図10(B)は、本発明を適用して作製したテレビ受像機であり、表示部720、筐体721、スピーカー722などによって構成されている。   FIG. 10B illustrates a television receiver manufactured by applying the present invention, which includes a display portion 720, a housing 721, speakers 722, and the like.

表示部720にはアクティブマトリクス表示装置が設けられている。表示方式は液晶表示であってもEL表示であってもよい。表示部720は画素ごとに有機トランジスタを有し、当該有機トランジスタには上記実施の形態を用いて高密度プラズマ処理を行ったゲート絶縁膜を用いる。また、表示部720を駆動するための集積回路は当該有機トランジスタと同様に基板上に形成もしくは実装されている。集積回路に設けられたトランジスタにも上記実施の形態を用いて高密度プラズマ処理を行ったゲート絶縁膜を有する有機トランジスタを用いても良い。本発明の有機トランジスタを用いることで、電気特性が良好で信頼性が高いテレビ受像機を得ることができる。   The display portion 720 is provided with an active matrix display device. The display method may be a liquid crystal display or an EL display. The display portion 720 includes an organic transistor for each pixel, and a gate insulating film which is subjected to high-density plasma treatment using the above embodiment is used for the organic transistor. Further, an integrated circuit for driving the display portion 720 is formed or mounted on a substrate similarly to the organic transistor. As the transistor provided in the integrated circuit, an organic transistor including a gate insulating film which is subjected to high-density plasma treatment using the above embodiment may be used. By using the organic transistor of the present invention, a television receiver with favorable electrical characteristics and high reliability can be obtained.

図10(C)は、本発明を適用して作製したIDカードであり、支持体730、表示部731、支持体730内に組み込まれた集積回路チップ732等によって構成されている。なお、表示部731を駆動するための集積回路733、734についても支持体730内に組み込まれている。   FIG. 10C illustrates an ID card manufactured by applying the present invention, which includes a support 730, a display portion 731, an integrated circuit chip 732 incorporated in the support 730, and the like. Note that integrated circuits 733 and 734 for driving the display portion 731 are also incorporated in the support 730.

表示部731にはアクティブマトリクス表示装置が設けられている。表示方式は液晶表示であってもEL表示であってもよい。表示部731は画素ごとに有機トランジスタを有し、当該有機トランジスタには上記実施の形態を用いて高密度プラズマ処理を行ったゲート絶縁膜を用いる。また、表示部731を駆動するための集積回路733、734は当該有機トランジスタと同様に基板上に形成もしくは実装されている。集積回路733、734に設けられたトランジスタにも上記実施の形態を用いて高密度プラズマ処理を行ったゲート絶縁膜を有する有機トランジスタを用いても良い。本発明の有機トランジスタを用いることで、電気特性が良好で信頼性が高いIDカードを得ることができる。   The display portion 731 is provided with an active matrix display device. The display method may be a liquid crystal display or an EL display. The display portion 731 includes an organic transistor for each pixel, and a gate insulating film which is subjected to high-density plasma treatment using the above embodiment is used for the organic transistor. Further, the integrated circuits 733 and 734 for driving the display portion 731 are formed or mounted on a substrate in the same manner as the organic transistor. As the transistors provided in the integrated circuits 733 and 734, an organic transistor including a gate insulating film which is subjected to high-density plasma treatment using the above embodiment may be used. By using the organic transistor of the present invention, an ID card with good electrical characteristics and high reliability can be obtained.

また、表示部731において、集積回路チップ732において入出力された情報を表示し、どのような情報が入出力されたかを確認することができる。   The display unit 731 can display information input / output in the integrated circuit chip 732 and check what information is input / output.

図10(D)は、本発明を適用して作製した電子ペーパーであり、本体740は表示部741、受信装置742、駆動回路743、フィルムバッテリー744等によって構成されている。   FIG. 10D illustrates an electronic paper manufactured by applying the present invention. A main body 740 includes a display portion 741, a receiving device 742, a driver circuit 743, a film battery 744, and the like.

表示部741にはアクティブマトリクス表示装置が設けられている。表示方式は液晶表示であってもEL表示であってもよい。表示部741は画素ごとに有機トランジスタを有し、当該有機トランジスタには上記実施の形態を用いて高密度プラズマ処理を行ったゲート絶縁膜を用いる。また、受信装置742や表示部741を駆動するための駆動回路743は当該有機トランジスタと同様に基板上に形成もしくは実装されている。受信装置742や駆動回路743に設けられたトランジスタにも上記実施の形態を用いて高密度プラズマ処理を行ったゲート絶縁膜を有する有機トランジスタを用いても良い。なお、情報処理機能は受信装置742及び通信機能を有する他の装置を利用することで、表示装置の負荷を軽減できる。本発明の有機トランジスタは、プラスチック基板などフレキシブルな基板に作製できるため電子ペーパーに適用することは非常に効果的であり、電気特性が良好で信頼性が高い電子ペーパーを作製することができる。   The display portion 741 is provided with an active matrix display device. The display method may be a liquid crystal display or an EL display. The display portion 741 has an organic transistor for each pixel, and a gate insulating film which is subjected to high-density plasma treatment using the above embodiment is used for the organic transistor. In addition, the driving circuit 743 for driving the receiving device 742 and the display portion 741 is formed or mounted on a substrate in the same manner as the organic transistor. An organic transistor including a gate insulating film which is subjected to high-density plasma treatment using the above embodiment may also be used as a transistor provided in the reception device 742 or the driver circuit 743. Note that the information processing function can reduce the load on the display device by using the reception device 742 and another device having a communication function. Since the organic transistor of the present invention can be manufactured on a flexible substrate such as a plastic substrate, it is very effective to be applied to electronic paper, and an electronic paper with favorable electrical characteristics and high reliability can be manufactured.

以上の様に、本発明の適用範囲は極めて広く、あらゆる分野の表示装置に用いることが可能である。また、本実施形態は実施の形態1乃至4の構成を自由に組み合わせることができる。   As described above, the applicable range of the present invention is extremely wide and can be used for display devices in various fields. Further, in this embodiment, the configurations of Embodiments 1 to 4 can be freely combined.

本発明を用いて作製した有機トランジスタについて図1を用いて説明する。   An organic transistor manufactured using the present invention will be described with reference to FIG.

基板10上にスパッタリング法によってアルミニウムからなる100nmの厚さの導電層17を形成する。次に、導電層17に対し高密度プラズマ酸化を行い、30nmのゲート絶縁膜12を形成する。図6の高密度プラズマ処理装置を用いた場合、プラズマ源から処理対象物である基板までの距離は20mm以上80mm以下であれば良いが、20mm以上60mm以下が好ましい。なお、導電層17のうち高密度プラズマを用いて絶縁化したゲート絶縁膜12以外はゲート電極11として機能する。   A conductive layer 17 made of aluminum and having a thickness of 100 nm is formed on the substrate 10 by sputtering. Next, high density plasma oxidation is performed on the conductive layer 17 to form a gate insulating film 12 having a thickness of 30 nm. When the high-density plasma processing apparatus of FIG. 6 is used, the distance from the plasma source to the substrate that is the processing target may be 20 mm or more and 80 mm or less, but preferably 20 mm or more and 60 mm or less. Note that the conductive layer 17 other than the gate insulating film 12 insulated using high-density plasma functions as the gate electrode 11.

次に、ゲート絶縁膜12上に、ゲート絶縁膜12とゲート電極11との重畳部を覆うように50nmの厚さのペンタセンを蒸着法により成膜することで半導体層13を形成する。   Next, a semiconductor layer 13 is formed on the gate insulating film 12 by depositing pentacene with a thickness of 50 nm by vapor deposition so as to cover the overlapping portion of the gate insulating film 12 and the gate electrode 11.

次に、複合層14として酸化モリブデン(VI)と芳香族アミン化合物であるTPDをモル比で1対1となるよう共蒸着により10nmの厚さで成膜し、さらに導電層15としてアルミニウムをマスクを用いて真空蒸着により形成し、ソース及びドレイン電極16a、bを作製する。   Next, molybdenum oxide (VI) and aromatic amine compound TPD are formed as a composite layer 14 by co-evaporation so as to have a molar ratio of 1: 1, and a conductive layer 15 is masked with aluminum. To form source and drain electrodes 16a, 16b.

以上のようにして、信頼性の高いPチャネル型の有機トランジスタを得ることができる。   As described above, a highly reliable P-channel organic transistor can be obtained.

本発明の有機トランジスタの一形態について説明する図。The figure explaining one form of the organic transistor of this invention. 本発明の有機トランジスタの作製方法について説明する図。4A and 4B illustrate a method for manufacturing an organic transistor of the present invention. 本発明の有機トランジスタの一形態について説明する図。4A and 4B illustrate one embodiment of an organic transistor of the present invention. 本発明の有機トランジスタの一形態について説明する図。The figure explaining one form of the organic transistor of this invention. 本発明の有機トランジスタの一形態について説明する図。The figure explaining one form of the organic transistor of this invention. 高密度プラズマ処理装置の模式図。The schematic diagram of a high-density plasma processing apparatus. 本発明を用いた液晶表示装置の上面図。The top view of the liquid crystal display device using this invention. 本発明を用いた液晶表示装置の断面図。Sectional drawing of the liquid crystal display device using this invention. 本発明を用いた発光表示装置の断面図。1 is a cross-sectional view of a light-emitting display device using the present invention. 本発明を用いた電子機器の図。The figure of the electronic device using this invention.

符号の説明Explanation of symbols

10 基板
11 ゲート電極
12 ゲート絶縁膜
13 半導体層
14 複合層(第1の複合層)
15 導電層
16a、b ソース及びドレイン電極
17 導電層
31 ゲート電極
32 絶縁膜
41 ゲート電極
42 絶縁膜
53 半導体層
56a、b ソース及びドレイン電極
58 第2の複合層
61 誘電体導波路
62 スロットアンテナ
63 誘電板
64 台
65 ガス供給口
66 プラズマ発生領域
67 装置内部
527 有機トランジスタ
528 絶縁層
529 画素電極
530 配向膜
531 対向基板
532 対向電極
533 配向膜
534 液晶層
535 スペーサ
600 素子基板
601 ソース側駆動回路部
602 画素部
603 ゲート側駆動回路部
604 対向基板
605 シール材
609 FPC
610 第1の電極
611 絶縁層
612 発光層
613 第2の電極
614 パッシベーション膜
615 対向基板
616 空間
710 本体
711 表示部
713 音声出力部
714 音声入力部
715 操作スイッチ
716 操作スイッチ
717 アンテナ
720 表示部
721 筐体
722 スピーカー
730 支持体
731 表示部
732 集積回路チップ
733 集積回路
734 集積回路
740 本体
741 表示部
742 受信装置
743 駆動回路
744 フィルムバッテリー
10 substrate 11 gate electrode 12 gate insulating film 13 semiconductor layer 14 composite layer (first composite layer)
15 Conductive layer 16a, b Source and drain electrode 17 Conductive layer 31 Gate electrode 32 Insulating film 41 Gate electrode 42 Insulating film 53 Semiconductor layer 56a, b Source and drain electrode 58 Second composite layer 61 Dielectric waveguide 62 Slot antenna 63 Dielectric plate 64 Stand 65 Gas supply port 66 Plasma generation region 67 Inside the apparatus 527 Organic transistor 528 Insulating layer 529 Pixel electrode 530 Alignment film 531 Counter substrate 532 Counter electrode 533 Alignment film 534 Liquid crystal layer 535 Spacer 600 Element substrate 601 Source side drive circuit section 602 Pixel portion 603 Gate side drive circuit portion 604 Counter substrate 605 Seal material 609 FPC
610 First electrode 611 Insulating layer 612 Light emitting layer 613 Second electrode 614 Passivation film 615 Counter substrate 616 Space 710 Main body 711 Display unit 713 Audio output unit 714 Audio input unit 715 Operation switch 716 Operation switch 717 Antenna 720 Display unit 721 Case Body 722 Speaker 730 Support 731 Display unit 732 Integrated circuit chip 733 Integrated circuit 734 Integrated circuit 740 Main body 741 Display unit 742 Receiver 743 Drive circuit 744 Film battery

Claims (15)

電子密度が1011cm−3以上かつ電子温度が0.2eV以上2.0eV以下の高密度プラズマを用いて形成された絶縁膜と、
有機半導体材料を含む半導体層とが接する有機トランジスタで回路が形成された半導体装置。
An insulating film formed using high-density plasma having an electron density of 10 11 cm −3 or more and an electron temperature of 0.2 eV or more and 2.0 eV or less;
A semiconductor device in which a circuit is formed by an organic transistor in contact with a semiconductor layer containing an organic semiconductor material.
ゲート電極と、ゲート絶縁膜と、有機半導体材料を含む半導体層と、ソース及びドレイン電極とを有し、
前記ソース及びドレイン電極は、導電層と、前記導電層と前記半導体層との間に形成された有機化合物及び金属酸化物との複合層とを有し、
前記ゲート絶縁膜は前記ゲート電極となる導電層に対し電子密度が1011cm−3以上かつ電子温度が0.2eV以上2.0eV以下の高密度プラズマ処理を行うことによって形成されることを特徴とする有機トランジスタ。
A gate electrode, a gate insulating film, a semiconductor layer containing an organic semiconductor material, and source and drain electrodes;
The source and drain electrodes have a conductive layer and a composite layer of an organic compound and a metal oxide formed between the conductive layer and the semiconductor layer,
The gate insulating film is formed by performing high-density plasma treatment with an electron density of 10 11 cm −3 or more and an electron temperature of 0.2 eV or more and 2.0 eV or less on the conductive layer to be the gate electrode. An organic transistor.
ゲート電極と、ゲート絶縁膜と、有機半導体材料を含む半導体層と、ソース及びドレイン電極とを有し、
前記ソース及びドレイン電極は、導電層と、前記導電層と前記半導体層との間に形成された有機化合物及び金属酸化物との複合層とを有し、
前記ゲート絶縁膜は前記ゲート電極となる導電層に対し電子密度が1011cm−3以上かつ電子温度が0.5eV以上1.5eV以下の高密度プラズマ処理を行うことによって形成されることを特徴とする有機トランジスタ。
A gate electrode, a gate insulating film, a semiconductor layer containing an organic semiconductor material, and source and drain electrodes;
The source and drain electrodes have a conductive layer and a composite layer of an organic compound and a metal oxide formed between the conductive layer and the semiconductor layer,
The gate insulating film is formed by performing high-density plasma treatment with an electron density of 10 11 cm −3 or more and an electron temperature of 0.5 eV or more and 1.5 eV or less on the conductive layer to be the gate electrode. An organic transistor.
ゲート電極と、
前記ゲート電極上に接して形成されたゲート絶縁膜と、
前記ゲート絶縁膜上に形成された有機半導体材料を含む半導体層と、
前記半導体層上にソース及びドレイン電極とを有し、
前記ソース及びドレイン電極は、導電層と、前記導電層と前記半導体層との間に形成された有機化合物及び金属酸化物との複合層とを有し、
前記ゲート絶縁膜は前記ゲート電極となる導電層に対し電子密度が1011cm−3以上かつ電子温度が0.2eV以上2.0eV以下の高密度プラズマ処理を行うことによって形成されることを特徴とする有機トランジスタ。
A gate electrode;
A gate insulating film formed on and in contact with the gate electrode;
A semiconductor layer including an organic semiconductor material formed on the gate insulating film;
A source and drain electrode on the semiconductor layer;
The source and drain electrodes have a conductive layer and a composite layer of an organic compound and a metal oxide formed between the conductive layer and the semiconductor layer,
The gate insulating film is formed by performing high-density plasma treatment with an electron density of 10 11 cm −3 or more and an electron temperature of 0.2 eV or more and 2.0 eV or less on the conductive layer to be the gate electrode. An organic transistor.
請求項2乃至4のいずれか一項において、
前記ゲート電極は、タンタル、ニオブ、アルミニウム、モリブデン、チタン、銅のいずれか一であることを特徴とする有機トランジスタ。
In any one of Claims 2 thru | or 4,
The organic transistor according to claim 1, wherein the gate electrode is any one of tantalum, niobium, aluminum, molybdenum, titanium, and copper.
請求項2乃至4のいずれか一項において、
前記ゲート絶縁膜は8以上の誘電率を有することを特徴とする有機トランジスタ。
In any one of Claims 2 thru | or 4,
The organic transistor according to claim 1, wherein the gate insulating film has a dielectric constant of 8 or more.
ゲート電極と、
前記ゲート電極上に形成されたゲート絶縁膜と、
前記ゲート絶縁膜上に形成された有機半導体材料を含む半導体層と、
前記半導体層上にソース及びドレイン電極とを有し、
前記ソース及びドレイン電極は、導電層と、前記導電層と前記半導体層との間に形成された有機化合物及び金属酸化物との複合層とを有し、
前記ゲート絶縁膜は高密度プラズマ処理が施された膜であることを特徴とする有機トランジスタ。
A gate electrode;
A gate insulating film formed on the gate electrode;
A semiconductor layer including an organic semiconductor material formed on the gate insulating film;
A source and drain electrode on the semiconductor layer;
The source and drain electrodes have a conductive layer and a composite layer of an organic compound and a metal oxide formed between the conductive layer and the semiconductor layer,
The organic transistor according to claim 1, wherein the gate insulating film is a film subjected to high-density plasma treatment.
請求項2乃至7のいずれか一項において、
前記有機化合物は、芳香族アミン骨格を有することを特徴とする有機トランジスタ。
In any one of Claims 2 thru | or 7,
2. The organic transistor according to claim 1, wherein the organic compound has an aromatic amine skeleton.
請求項2乃至8のいずれか一項において、
前記金属酸化物は、チタン、バナジウム、クロム、ジルコニウム、ニオブ、モリブデン、ハフニウム、タンタル、タングステン、レニウムの酸化物から選ばれた一または複数であることを特徴とする有機トランジスタ。
In any one of Claims 2 thru | or 8,
2. The organic transistor according to claim 1, wherein the metal oxide is one or more selected from oxides of titanium, vanadium, chromium, zirconium, niobium, molybdenum, hafnium, tantalum, tungsten, and rhenium.
基板上に第1の導電層を形成し、
前記第1の導電層の表面を電子密度が1011cm−3以上かつ電子温度が0.2eV以上2.0eV以下の高密度プラズマ処理により絶縁化し、
絶縁化された前記第1の導電膜上に有機半導体材料を含む半導体層を形成し、
前記半導体層上に有機化合物及び金属酸化物とが混合された複合層を形成し、
前記複合層上に第2の導電層を形成し、
前記複合層と前記第2の導電層はソース及びドレイン電極であり、
前記第1の導電層のうち導電性を有する部分はゲート電極であり、
前記第1の導電層のうち絶縁性を有する部分はゲート絶縁膜であることを特徴とする有機トランジスタの作製方法。
Forming a first conductive layer on the substrate;
Insulating the surface of the first conductive layer by high-density plasma treatment with an electron density of 10 11 cm −3 or more and an electron temperature of 0.2 eV or more and 2.0 eV or less;
Forming a semiconductor layer containing an organic semiconductor material on the insulated first conductive film;
Forming a composite layer in which an organic compound and a metal oxide are mixed on the semiconductor layer;
Forming a second conductive layer on the composite layer;
The composite layer and the second conductive layer are source and drain electrodes,
The conductive portion of the first conductive layer is a gate electrode,
A method for manufacturing an organic transistor, wherein the insulating portion of the first conductive layer is a gate insulating film.
請求項10において、
前記ゲート電極は、タンタル、ニオブ、アルミニウム、モリブデン、チタン、銅のいずれか一であることを特徴とする有機トランジスタの作製方法。
In claim 10,
The method for manufacturing an organic transistor, wherein the gate electrode is any one of tantalum, niobium, aluminum, molybdenum, titanium, and copper.
請求項10において、
前記ゲート絶縁膜は8以上の誘電率を有することを特徴とする有機トランジスタの作製方法。
In claim 10,
The method for manufacturing an organic transistor, wherein the gate insulating film has a dielectric constant of 8 or more.
基板上にゲート電極を形成し、
前記ゲート電極上にゲート絶縁膜を形成し、
前記ゲート絶縁膜上に有機半導体材料を含む半導体層を形成し、
前記半導体層上に有機化合物及び金属酸化物とが混合された複合層を形成し、
前記複合層上に導電層を形成し、
前記複合層と前記導電層はソース及びドレイン電極であり、
前記ゲート絶縁膜は電子密度が1011cm−3以上かつ電子温度が0.2eV以上2.0eV以下の高密度プラズマ処理が施されていることを特徴とする有機トランジスタの作製方法。
Forming a gate electrode on the substrate;
Forming a gate insulating film on the gate electrode;
Forming a semiconductor layer containing an organic semiconductor material on the gate insulating film;
Forming a composite layer in which an organic compound and a metal oxide are mixed on the semiconductor layer;
Forming a conductive layer on the composite layer;
The composite layer and the conductive layer are source and drain electrodes,
The method for manufacturing an organic transistor, wherein the gate insulating film is subjected to high-density plasma treatment with an electron density of 10 11 cm −3 or more and an electron temperature of 0.2 eV to 2.0 eV.
請求項10乃至13のいずれか一項において、
前記有機化合物は、芳香族アミン骨格を有することを特徴とする有機トランジスタの作製方法。
In any one of claims 10 to 13,
The method for manufacturing an organic transistor, wherein the organic compound has an aromatic amine skeleton.
請求項10乃至14のいずれか一項において、
前記金属酸化物は、チタン、バナジウム、クロム、ジルコニウム、ニオブ、モリブデン、ハフニウム、タンタル、タングステン、レニウムの酸化物から選ばれた一または複数であることを特徴とする有機トランジスタの作製方法。
In any one of claims 10 to 14,
The method of manufacturing an organic transistor, wherein the metal oxide is one or more selected from oxides of titanium, vanadium, chromium, zirconium, niobium, molybdenum, hafnium, tantalum, tungsten, and rhenium.
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