JP2006173787A - Video display apparatus - Google Patents
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Abstract
Description
本発明は、映像ソースを表示するための映像表示装置に関し、特に、PAL方式の映像ソースを表示するための映像表示装置に関する。 The present invention relates to a video display device for displaying a video source, and more particularly to a video display device for displaying a PAL video source.
NTSC方式のデジタル映像ソースを表示するために液晶パネル、プラズマパネル等のマトリックス型表示パネルを用いた映像表示装置が知られている。このような映像表示装置には、通常、パーソナルコンピュータの表示規格に従った表示パネルが用いられる。例えば、4:3型のVGA(640ドット×480ドット)の表示パネルの場合、480行の画素列からなり、XGA(1024ドット×768ドット)の表示パネルの場合、768行の画素列からなる。 An image display apparatus using a matrix type display panel such as a liquid crystal panel or a plasma panel for displaying an NTSC digital image source is known. For such a video display device, a display panel according to the display standard of a personal computer is usually used. For example, in the case of a display panel of 4: 3 type VGA (640 dots × 480 dots), it consists of 480 rows of pixel columns, and in the case of a display panel of XGA (1024 dots × 768 dots), it consists of 768 rows of pixel columns. .
一方、映像ソースのフォーマットでは、PAL方式576iとハイビジョン方式1080iが規定されている。576iは走査線が576本のインターレース信号、1080iは走査線が1080本のインターレース信号である。即ち、映像ソースの走査線数は、マトリックス型表示パネルの画素の行数と異なる。
On the other hand, the video source format defines the
従って、映像ソースを走査線数の違うマトリックス型表示パネルに表示するためには、走査線のスケーリングを行う必要がある。 Therefore, in order to display a video source on a matrix type display panel having a different number of scanning lines, it is necessary to scale the scanning lines.
図5を参照してPAL方式の標準(SD)映像信号のスケーリングを説明する。図5Aは、走査線数が576本のインターレース方式の映像信号を模式的に表示したものであり、この映像信号を、以下、単に、576i映像信号と称する。図5Bは、16:9型のW−XGA(1366ドット×768ドット)の表示パネルの画素列を模式的に表示したものであり、これを、以下、単に、W−XGAパネルと称する。 The scaling of the standard (SD) video signal of the PAL system will be described with reference to FIG. FIG. 5A schematically shows an interlace video signal having 576 scanning lines, and this video signal is hereinafter simply referred to as a 576i video signal. FIG. 5B schematically shows a pixel column of a 16: 9 type W-XGA (1366 dots × 768 dots) display panel, which will be simply referred to as a W-XGA panel hereinafter.
先ず、図5Aの576i映像信号を、図5Cに示す、走査線が547本のプログレッシブ信号に変換する。こうして生成された信号を、以下、単に、547p信号と称する。ここで、走査線が576本から547本に減少しているのは、ラインメモリにより1ラインを2ラインに増やす処理を行って576p信号に変換し、さらに5%のオーバスキャン分29ラインカットを行ったためである。次に、図5Cの547p信号を、図5Dに示す、走査線が768本のプログレッシブ信号に変換する。こうして生成された信号を、以下、単に、768p信号と称する。ここで、走査線を547から768本に増加させる処理をスケーリングと称する。768p信号の走査線は、768本であるから、768行の画素列を有するW−XGAパネルに表示することができる。尚、576i映像信号は4:3型であるから、それを16:9型の表示パネルに表示するには、水平方向のスケーリングが必要である。 First, the 576i video signal in FIG. 5A is converted into a progressive signal having 547 scanning lines as shown in FIG. 5C. Hereinafter, the signal thus generated is simply referred to as a 547p signal. Here, the number of scanning lines is reduced from 576 to 547. The line memory is used to increase 1 line to 2 lines and convert it to a 576p signal, and further, 29 line cut for 5% overscan. It is because it went. Next, the 547p signal in FIG. 5C is converted into a progressive signal having 768 scanning lines as shown in FIG. 5D. Hereinafter, the signal generated in this way is simply referred to as a 768p signal. Here, the process of increasing the number of scanning lines from 547 to 768 is referred to as scaling. Since the number of scanning lines of the 768p signal is 768, it can be displayed on a W-XGA panel having 768 rows of pixel columns. Since the 576i video signal is a 4: 3 type, horizontal scaling is required to display it on a 16: 9 type display panel.
図6を参照してハイビジョン(HD)映像信号のスケーリングを説明する。図6Aは、走査線数が1080本のインターレース方式の映像信号を模式的に表示したものであり、この映像信号を、以下、単に、1080i映像信号と称する。図6Bは、W−XGAパネルの画素列を模式的に示す。 With reference to FIG. 6, the scaling of a high-definition (HD) video signal will be described. FIG. 6A schematically shows an interlace video signal having 1080 scanning lines, and this video signal is hereinafter simply referred to as a 1080i video signal. FIG. 6B schematically shows a pixel column of the W-XGA panel.
先ず、図6Aの1080i映像信号を、図6Cに示す、走査線が540本のプログレッシブ信号に変換する。こうして生成された信号を、以下、単に、540p信号と称する。ここで、走査線が1080本から540本に減少しているのは、偶数フィールドまたは奇数フィールドの信号の片方を取り込んだためである。次に、図6Cの540p信号を、図6Dに示す、走査線が768本のプログレッシブ信号に変換する。走査線が540本から768本に増加しているのは、スケーリングを行ったためである。768p信号の走査線は、768本であるから、768行の画素列を有するW−XGAパネルに表示することができる。尚、1080i映像信号は16:9型であるから、それを16:9型の表示パネルに表示するには、水平方向のスケーリングは不要である。 First, the 1080i video signal in FIG. 6A is converted into a progressive signal having 540 scanning lines as shown in FIG. 6C. The signal generated in this way is hereinafter simply referred to as a 540p signal. Here, the reason why the number of scanning lines is reduced from 1080 to 540 is because one of the signals of the even field or the odd field is captured. Next, the 540p signal in FIG. 6C is converted into a progressive signal having 768 scanning lines as shown in FIG. 6D. The reason why the number of scanning lines increases from 540 lines to 768 lines is that scaling has been performed. Since the number of scanning lines of the 768p signal is 768, it can be displayed on a W-XGA panel having 768 rows of pixel columns. Since the 1080i video signal is a 16: 9 type, horizontal scaling is not required to display it on a 16: 9 type display panel.
映像ソースを映像ソースと走査線数の違うパーソナルコンピュータの表示規格に従った表示パネルによって表示する場合には、上述のように、スケーリングを行う必要がある。 When the video source is displayed by a display panel in accordance with the display standard of a personal computer having a scanning line number different from that of the video source, it is necessary to perform scaling as described above.
XGA(1024ドット×768ドット)の表示パネルを用いる場合、スケーリング後のパネル駆動用クロックは65MHzであり、W−XGA(1366ドット×768ドット)の表示パネルを用いる場合、スケーリング後のパネル駆動用クロックは83.56MHzである。従って、スケーリング後のパネル駆動用クロックに起因する不要な輻射電波によって、表示パネルの回路に影響を与えることとなる。 When an XGA (1024 dots × 768 dots) display panel is used, the scaled panel drive clock is 65 MHz. When a W-XGA (1366 dots × 768 dots) display panel is used, the scaled panel drive is used. The clock is 83.56 MHz. Therefore, the unnecessary radiation wave caused by the scaled panel drive clock affects the display panel circuit.
一方、PAL又はSECAM方式の映像ソースを表示するためにマトリックス型表示装置を用いる技術は未だ開発されていない。PAL又はSECAM方式の映像ソースを欧州規格の表示パネルによって表示する場合には、上述のNTSC方式の場合と同様に、スケーリング後のパネル駆動用クロックに起因する不要な輻射電波によって、表示パネルの回路に影響を与える可能性がある。 On the other hand, a technique using a matrix display device to display a PAL or SECAM video source has not been developed yet. When a PAL or SECAM video source is displayed on a European standard display panel, as in the case of the NTSC system described above, the display panel circuit is caused by unnecessary radiated radio waves resulting from the scaled panel driving clock. May be affected.
本発明の目的は、PAL又はSECAM方式の映像ソースを表示するために欧州規格に対応させた表示パネルを用いたマトリックス型表示装置を提供することにある。 SUMMARY OF THE INVENTION An object of the present invention is to provide a matrix type display device using a display panel corresponding to the European standard for displaying a PAL or SECAM video source.
本発明の更に他の目的は、PAL又はSECAM方式の映像ソースを表示するために欧州規格に対応させた表示パネルを用いたマトリックス型表示装置において、簡単な構造でパネル駆動用クロックに起因する不要な輻射電波の影響を軽減することにある。 Still another object of the present invention is to provide a matrix type display device using a display panel that is compliant with European standards for displaying a PAL or SECAM video source. The purpose is to reduce the influence of radiated radio waves.
本発明によると、映像表示装置は、所定数の走査線を有するインターレース方式の映像信号を入力する映像信号入力部と、該映像信号入力部からの映像信号を上記所定数の整数分の1の走査線を有するプログレッシブ方式の映像信号に変換する映像信号変換部と、該映像信号変換部からの映像信号を入力してプログレッシブ方式の映像を表示するマトリックス型の表示パネルと、を有し、上記映像信号変換部の出力側の回路には、パネル駆動用クロックに起因した輻射を防止するためのシールドが除去されている。 According to the present invention, a video display device includes a video signal input unit that inputs an interlaced video signal having a predetermined number of scanning lines, and the video signal from the video signal input unit is a fraction of the predetermined number of integers. A video signal conversion unit for converting to a progressive video signal having a scanning line; and a matrix type display panel for inputting a video signal from the video signal conversion unit and displaying a progressive video. In the circuit on the output side of the video signal converter, a shield for preventing radiation due to the panel drive clock is removed.
本発明によると、PAL方式の映像ソース用のマトリックス型映像表示装置において、簡単な構造でパネル駆動用クロックに起因する不要輻射を防止することができる効果がある。 According to the present invention, in a matrix type video display device for a PAL video source, unnecessary radiation caused by a panel driving clock can be prevented with a simple structure.
図1は、本発明によるPAL方式の映像ソース用の液晶映像表示装置の構成の主要部を示す。本例の映像表示装置は、複数の映像ソースからの映像信号を切り替えて入力する入力切換部11、アナログ信号をデジタル信号に変換するADコンバータ12、映像信号変換用メモリ13、スケーリング、IP変換等の映像信号変換処理を行う映像信号変換部14、画質強調補正処理を行う画質強調補正部15、オンスクリーン信号を制御するOSD制御部16、オンスクリーン信号を混合するOSD混合部17、γ補正を行うγ補正部18、液晶パネルを制御する液晶コントローラ19、液晶パネル20、ゲートドライバ21、及びソースドライバ22を有する。
FIG. 1 shows a main part of the configuration of a liquid crystal display device for a PAL video source according to the present invention. The video display device of this example includes an
以下に、本例の映像信号変換部14における映像信号変換処理を説明する。
Below, the video signal conversion process in the
図2を参照してPAL方式の標準(SD)映像信号の映像信号変換処理を説明する。図2Aは、図5Aに示した走査線数が576本のインターレース方式の映像信号、即ち、576i映像信号を模式的に表示したものである。図2Bは、16:9型の欧州規格に対応させた表示パネル(960ドット×540ドット)の画素列を模式的に表示したものであり、これを、以下、単に、ワイドユーロパネルと称する。 A video signal conversion process of a standard (SD) video signal of the PAL system will be described with reference to FIG. FIG. 2A schematically shows the interlaced video signal having 576 scanning lines shown in FIG. 5A, that is, a 576i video signal. FIG. 2B schematically shows a pixel column of a display panel (960 dots × 540 dots) corresponding to the 16: 9 type European standard, which is simply referred to as a wide euro panel hereinafter.
先ず、図2Aの576i映像信号を、図2Cに示す、走査線が576本のプログレッシブ信号に変換する。こうして生成された信号を、以下、単に、576p信号と称する。ここで、インターレース信号はラインメモリにより1ラインを2ラインに増やす処理を行ってプログレッシブ信号に変化させている。 First, the 576i video signal in FIG. 2A is converted into a progressive signal having 576 scanning lines as shown in FIG. 2C. The signal generated in this way is hereinafter simply referred to as a 576p signal. Here, the interlace signal is changed to a progressive signal by performing a process of increasing one line to two lines by a line memory.
次に、図2Cの576p信号を、図2Dに示す、走査線が540本のプログレッシブ信号に変換する。こうして生成された信号を、以下、単に、540p信号と称する。ここで、走査線が576本から540本に減少しているのは、6.25%のオーバスキャン分36ラインカットを行ったためであり、スケーリングは不要である。540p信号の走査線は、540本であるから、540行の画素列を有するワイドユーロパネルに表示することができる。尚、576i映像信号は4:3型であるから、それを16:9型のワイドユーロパネルに表示するには、水平方向のスケーリングが必要である。 Next, the 576p signal in FIG. 2C is converted into a progressive signal having 540 scanning lines as shown in FIG. 2D. The signal generated in this way is hereinafter simply referred to as a 540p signal. Here, the reason why the number of scanning lines is reduced from 576 to 540 is that 36 lines have been cut for 6.25% overscan, and scaling is unnecessary. Since the number of scanning lines of the 540p signal is 540, it can be displayed on a wide euro panel having 540 pixel columns. Since the 576i video signal is a 4: 3 type, horizontal scaling is necessary to display it on a 16: 9 type wide euro panel.
図3を参照してハイビジョン(HD)映像信号の映像信号変換を説明する。図3Aは、図6Aに示した走査線数が1080本のインターレース方式の映像信号、即ち、1080i映像信号を模式的に表示したものである。図3Bは、図2Bに示した、16:9型の欧州規格のワイドユーロパネル(960ドット×540ドット)の画素列を模式的に表示したものである。本例では、整数分の一のプログレッシブ信号への変換として1080iの1/2のプログレッシブ信号540pに変換する例を示す。 Video signal conversion of a high-definition (HD) video signal will be described with reference to FIG. FIG. 3A schematically shows an interlace video signal having 1080 scanning lines shown in FIG. 6A, that is, a 1080i video signal. FIG. 3B schematically shows the 16: 9 type European standard wide euro panel (960 dots × 540 dots) pixel row shown in FIG. 2B. In this example, an example of conversion to a progressive signal 540p that is ½ of 1080i is shown as conversion to a progressive signal of an integer.
先ず、図3Aの1080i映像信号を、図3Cに示す、走査線が540本のプログレッシブ信号、即ち、540p信号に変換する。ここで、走査線が1080本から540本に減少しているのは、偶数フィールドまたは奇数フィールドの信号の片方を取り込んだためである。540p信号の走査線は、540本であるから、540行の画素列を有するワイドユーロパネルに表示することができる。尚、1080i映像信号は16:9型であるから、それを16:9型のワイドユーロパネルに表示するには、水平方向のスケーリングは不要である。 First, the 1080i video signal in FIG. 3A is converted into a progressive signal having 540 scanning lines, that is, a 540p signal shown in FIG. 3C. Here, the reason why the number of scanning lines is reduced from 1080 to 540 is because one of the signals of the even field or the odd field is captured. Since the number of scanning lines of the 540p signal is 540, it can be displayed on a wide euro panel having 540 pixel columns. Since the 1080i video signal is a 16: 9 type, horizontal scaling is not required to display it on a 16: 9 type wide euro panel.
以上、説明したように、本例のマトリックス型表示装置の映像信号変換部14では、PAL方式の標準(SD)映像信号をワイドユーロパネルに表示する場合、図2Aの576i映像信号を図3Cの576p信号にIP変換し、それを、図2Dの540p信号に変換するだけである。即ち、オーバスキャンと水平方向のスケーリングを行うが、垂直方向のスケーリングは行わない。PAL方式のハイビジョン(HD)映像信号をワイドユーロパネルに表示する場合、図3Aの1080i映像信号を図3Cの540p信号に変換するだけである。即ち、IP変換を行うが、オーバスキャンと水平方向のスケーリングは行わない。従って、本例では、映像信号変換用メモリ13の容量を小さくすることができる。
As described above, in the video
次に再び図1を参照して、本例の映像表示装置のパネル駆動用クロックについて説明する。映像信号変換部14は、576i信号又は1080i信号よりワイドユーロパネルに対応したパネル駆動用クロック信号mを生成し、それを信号線30を介して、画質強調補正部15、OSD混合部17、γ補正部18、液晶コントローラ19、ソースドライバ22に供給する。本例ではパネル駆動用クロックの周波数は40.5MHzである。映像信号変換部の出力信号f、OSD混合部16の出力信号h、及び液晶コントローラ18の出力信号jのクロック周波数も40.5MHzとなる。
Next, with reference to FIG. 1 again, the panel driving clock of the video display apparatus of this example will be described. The video
一方、従来のW-XGAパネル方式の映像ソース用のマトリックス型表示装置において、W−XGA(1366ドット×768ドット)の表示パネルを用いる場合、映像信号変換部は、576i信号又は1080i信号からW−XGAパネルに対応したパネル駆動用クロックを生成する。このパネル駆動用クロックの周波数は83.56MHzである。また、映像信号変換部の出力信号f、OSD混合部16の出力信号h、及び液晶コントローラ18の出力信号j、kのクロック周波数も83.56MHzとなる。尚、XGA(1024ドット×768ドット)の表示パネルを用いる場合、スケーリング後のクロック周波数は65MHzである。
On the other hand, when a W-XGA (1366 dots × 768 dots) display panel is used in a conventional W-XGA panel type matrix display device for video sources, the video signal converter converts the 576i signal or 1080i signal to W -Generate a panel drive clock corresponding to the XGA panel. The frequency of this panel driving clock is 83.56 MHz. The clock frequency of the output signal f of the video signal conversion unit, the output signal h of the
従って、本例の映像表示装置を、従来のW-XGAパネル方式の映像ソース用のマトリックス型映像表示装置と比較すると、本例ではパネル駆動用クロックの周波数が低い。そのため、パネル駆動用クロックに起因した不要輻射を低減することができる。 Therefore, when the video display device of this example is compared with the matrix type video display device for the video source of the conventional W-XGA panel system, the frequency of the panel driving clock is low in this example. Therefore, unnecessary radiation caused by the panel driving clock can be reduced.
パネル駆動用クロックの周波数は、表示パネルのドット数に対応している。即ち、表示パネルのドット数が大きいと、パネル駆動用クロックの周波数は高くなり、表示パネルのドット数が小さいと、パネル駆動用クロックの周波数は低くなる。本例の場合、ユーロパネル(960ドット×540ドット)を使用するから、ドット数が小さい。従って、パネル駆動用クロックの周波数は低くなる。 The frequency of the panel driving clock corresponds to the number of dots on the display panel. That is, when the number of dots on the display panel is large, the frequency of the panel driving clock is high, and when the number of dots on the display panel is small, the frequency of the panel driving clock is low. In the case of this example, since the Euro panel (960 dots × 540 dots) is used, the number of dots is small. Therefore, the frequency of the panel driving clock is lowered.
図4は、本発明によるPAL方式の映像ソース用のマトリックス型表示装置の背面の構成の例を示す。このマトリックス型表示装置の表面には液晶パネル20が装着され、背面には、電源基板101、信号入力基板102、メイン基板103、LCD制御基板104、バックライト用インバータ基板105、操作スイッチ基板106が設けられている。信号入力基板102には、入力切換部11に相当する入力切換IC41が設けられている。メイン基板103には、ADコンバータ12に相当するADコンバータIC42、映像信号変換用メモリ13に相当する映像信号変換用メモリIC43、と、映像信号変換部14、画質強調補正部15、OSD制御部16、及びOSD混合部17に相当する画像処理IC44が設けられている。LCD制御基板104には、γ補正部18に相当するγ補正IC45、と、液晶コントローラ19に相当する液晶コントローラIC46が設けられている。マトリックス型表示装置の背面には、更に、ゲートドライバ21、及びソースドライバ22が設けられている。
FIG. 4 shows an example of the configuration of the back side of a matrix display device for a PAL video source according to the present invention. A
実線の矢印32は映像信号の流れを模式的に示し、破線の矢印30は、パネル駆動用クロック信号の流れを模式的に示す。網掛け表示されている、映像信号変換用メモリIC43、画像処理IC44、γ補正IC45、液晶コントローラIC46、メイン基板103とLCD制御基板104を接続する接続ケーブル47、LCD制御基板104と表示パネル20を接続する接続ケーブル48、49は、パネル駆動用クロックに起因した不要な輻射の影響を受け易い部分である。
A
この部分は、通常、不要な輻射の影響を受けないように、適当なシールド又はシートが設けられる。また、パネル駆動用クロック信号を供給する配線30には、ノイズを除去するための磁性体リングであるフェライトビーズ31が設けられる。しかしながら、本例では、パネル駆動用クロックが低いから、不要な輻射の影響が小さい。従って、これらの部分に設ける、不要な輻射の影響を防止するためのシールド又はシートを減少させ、又は、除去することができる。更に、フェライトビーズ31を減少させ、又は、除去することができる。
This portion is usually provided with a suitable shield or sheet so as not to be affected by unwanted radiation. The
上述のように、本例では、ドット数が小さいユーロパネル(960ドット×540ドット)を使用する。それにより、以下の効果が得られる。 As described above, in this example, an euro panel (960 dots × 540 dots) with a small number of dots is used. Thereby, the following effects are obtained.
ソースドライバ22、及び、ゲートドライバ21はパネル駆動用クロックによって動作する。これらのパネルドライバを駆動する電流の変動より不要輻射が発生する。また、電流変動によりGNDがゆすられ、GNDを経由した不要輻射が発生する。本例の場合、パネルのドット数が少ないから、ソースドライバ、及び、ゲートドライバの動作回数が減少する。従って、パネルドライバの電流変動の回数が減少し、不要輻射量を削減できる。即ち、パネルドライバからの直接の輻射、及び、GND経由の輻射が抑えられる。その結果、ソースドライバ、ゲートドライバ、グランドライン付近のシールドの面積を縮小、又は廃止することができる。
The
本例によると、ソースドライバICの数量を削減することができる。従来のW-XGAパネル方式の表示パネルの場合、10個のソースドライバを用いるが、本例のPAL方式のユーロパネルでは7個のソースドライバを用いる。通常、ソースドライバIC毎に、電源とGND間にコンデンサを挿入し、電源とGNDラインの電流の変動を抑えている。ソースドライバICの数が減少することで、コンデンサ数が減少する。また、電源ライン、グランドラインの不要輻射量も抑えられる。 According to this example, the number of source driver ICs can be reduced. In the case of a conventional W-XGA panel type display panel, ten source drivers are used, but in the PAL type euro panel of this example, seven source drivers are used. Normally, a capacitor is inserted between the power supply and GND for each source driver IC to suppress fluctuations in the currents of the power supply and the GND line. As the number of source driver ICs decreases, the number of capacitors decreases. Further, the amount of unnecessary radiation on the power supply line and the ground line can be suppressed.
ここでは、ユーロパネル方式の映像ソース用のマトリックス型液晶表示装置にPAL標準映像信号及びハイビジョン信号を表示する場合について説明したが、本発明は、SECAM方式標準映像信号を表示する場合についても同様に適用可能であることは当業者であれば容易に理解できよう。また、ここではマトリックス型の表示パネルとして液晶パネルの場合を説明したが、本発明は、プラズマパネルなどのマトリックス型の表示装置であれば適用可能である。 Here, the case where the PAL standard video signal and the high-definition signal are displayed on the matrix type liquid crystal display device for the euro panel type video source has been described. However, the present invention similarly applies to the case where the SECAM standard video signal is displayed. Those skilled in the art will readily understand that this is applicable. Although the case of a liquid crystal panel has been described here as a matrix type display panel, the present invention is applicable to any matrix type display device such as a plasma panel.
以上、本発明の例を説明したが、本発明は上述の例に限定されるものではなく、特許請求の範囲に記載された発明の範囲にて様々な変更が可能であることは当業者に理解されよう。 The example of the present invention has been described above, but the present invention is not limited to the above-described example, and various modifications can be made by those skilled in the art within the scope of the invention described in the claims. It will be understood.
11…入力切換部、12…ADコンバータ、13…映像信号変換用メモリ、14…映像信号変換部、15…画質強調補正部、16…OSD制御部、17…OSD混合部、18…γ補正部、19…液晶コントローラ、20…表示パネル、21…ゲートドライバ、22…ソースドライバ、41…入力切換IC、42…ADコンバータIC、43…映像信号変換用メモリIC、44…画像処理IC、45…γ補正IC、46…液晶コントローラIC、47、48、49…接続ケーブル、101…電源基板、102…信号入力基板、103…メイン基板、104…LCD制御基板、105…バックライト用インバータ基板、106…操作スイッチ基板
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Application Number | Priority Date | Filing Date | Title |
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Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004360315A JP2006173787A (en) | 2004-12-13 | 2004-12-13 | Video display apparatus |
Publications (1)
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JP2006173787A true JP2006173787A (en) | 2006-06-29 |
Family
ID=36674095
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Country Status (1)
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JP (1) | JP2006173787A (en) |
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Legal Events
Date | Code | Title | Description |
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A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20070302 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20081104 |
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A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20090310 |