JP2006074688A - Encoder circuit, and analog-to-digital conversion circuit - Google Patents
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Abstract
Description
この発明はアナログの入力電圧をデジタル出力に変換する際に使用するエンコーダ回路、及びこのエンコーダ回路を使用したアナログ・デジタル変換回路(以下、ADC回路)に関するものである。 The present invention relates to an encoder circuit used for converting an analog input voltage into a digital output, and an analog / digital conversion circuit (hereinafter referred to as an ADC circuit) using the encoder circuit.
図4は並列比較型のADC回路の基本構成を示すブロック図であり、nビット並列比較型のADC回路の場合には、2n −1個のコンパレータ10とエンコーダ回路20を備えている。各コンパレータ10には入力電圧とそれぞれ等間隔に設定された基準電圧が供給されており、各コンパレータ10はアナログの入力電圧とそれぞれ設定された基準電圧を比較して比較結果を出力する。エンコーダ回路20は各コンパレータ10の比較結果をデジタル出力であるnビットのバイナリコード(Binary Code)103に変換する。
FIG. 4 is a block diagram showing a basic configuration of a parallel comparison type ADC circuit. In the case of an n-bit parallel comparison type ADC circuit, 2 n −1
各コンパレータ10の出力は、供給されている基準電圧の小さい方から大きい方に向かって‘1’が連続し、あるコンパレータ10から基準電圧の大きい方に向かって‘0’が連続することにより、複数のコンパレータ10からサーモメータコード(Thermometer Code;温度計符号)101が出力される。すなわち、サーモメータコード101における‘1’と‘0’の切り替わりポイントを検出することにより、アナログの入力電圧をデジタル出力に変換している。ところが、様々な要因により、図5に示すように、各コンパレータ10の‘1’/‘0’の変化点が複数となるバブリングが発生することがある。このバブリングが発生すると、エンコーダ回路20が正常なバイナリコード103を発生することができないので、このバブリングによるエラーをできるだけ小さい範囲にとどめるための補正が必要となる。
As for the output of each
そこで、従来は例えば非特許文献1に示すように、各コンパレータ10の出力であるサーモメータコード101を、隣り合う数値のハミング距離が‘1’となるグレイコード(Gray Code)104に変換してから、バイナリコード103に変換するという方法が用いられている。
Therefore, conventionally, for example, as shown in
図6はグレイコード104を使用する場合の従来のエンコーダ回路20の動作を説明する図であり、3ビット並列比較型のADC回路に使用する場合のサーモメータコード101、グレイコード104及びバイナリコード103の関係を示している。
図7はエンコーダ回路20におけるサーモメータコード101をグレイコード104に変換する回路図である。図7において、サーモメータコード101の各値T0〜T6とグレイコード104の各値G0〜G2の論理式は次の式(1)〜式(3)で示される。
G0=T0×T2* +T4×T6* (1)
G1=T1×T5* (2)
G2=T3 (3)
なお、T2* ,T6* ,T5* はそれぞれT2,T6,T5の反転を示す。
FIG. 6 is a diagram for explaining the operation of the
FIG. 7 is a circuit diagram for converting the
G0 = T0 * T2 * + T4 * T6 * (1)
G1 = T1 × T5 * (2)
G2 = T3 (3)
T2 * , T6 * , and T5 * indicate inversions of T2, T6, and T5, respectively.
図8は3ビット並列比較型のADC回路においてグレイコード104を使用した場合の従来のエンコーダ回路20の動作を説明する図である。ここでは、真のサーモメータコード101を‘0011111’(真の出力‘5’)とし、サーモメータコード101に‘0’のバブリングが1個発生した場合を示している。この図8の例では、真の出力5に対してバブリングが発生する場所により1〜−3までの誤差が発生している。これは、図7のサーモメータコード101をグレイコード104に変換する回路において、入力T0,T2,T4,T6は出力G0に影響し、入力T1,T5は出力G1に影響し、入力T3は出力G2に影響していることにより、サーモメータコード101のどの位置にバブリングが発生するかによって、グレイコード104への影響が変化するためである。
FIG. 8 is a diagram for explaining the operation of the
また、特許文献1に示すAD変換器では、入力信号と分解能に応じたレベルを発生する参照信号とを比較し、入力信号と各参照信号との大小関係を判定する比較器によりサーモメータコードに変換されたデジタル信号を符号変換することにより、所望のデジタル信号を得るものにおいて、比較器複数個をまとめてグループとし、各グループ内の各比較器の出力を加算し、加算結果がある闘値を越えたかどうかでグループ出力とし、該グループ出力を符号変換することによりAD変換器のデジタル出力の上位ビットを得るとともに、各グループ内の加算結果から下位ビットを得ることが開示されている。
In the AD converter shown in
従来の非特許文献1に示すエンコーダ回路20は以上のように構成されているので、図8に示すように、サーモメータコード101のバブリングが発生する場所によって真の出力との誤差が変化してしまい、誤差の範囲が大きくなってしまうという課題があった。
Since the
また、従来の特許文献1に示すAD変換器についても、同公報の第11図に示すように、同様にサーモメータコードのバブリングが発生する場所によって真の出力との誤差が変化してしまい、誤差の範囲が大きくなってしまうという課題があった。
Also, with respect to the conventional AD converter shown in
この発明は上記のような課題を解決するためになされたもので、サーモメータコード101のバブリングがどこで発生しても、同じバブリングの数の場合に誤差の範囲が一定となり、グレイコード104を使用した場合よりも誤差の範囲を小さくすることができるエンコーダ回路及びアナログ・デジタル変換回路を得ることを目的とする。
The present invention has been made to solve the above-described problems. Wherever bubbling of the
この発明に係るエンコーダ回路は、アナログの入力電圧を複数の基準電圧と比較して得られるサーモメータコードにおける1の数をカウントしてカウント値を出力するカウンタ回路と、上記カウンタ回路からのカウント値をラッチするラッチ回路とを備えたものである。 An encoder circuit according to the present invention includes a counter circuit for counting the number of 1 in a thermometer code obtained by comparing an analog input voltage with a plurality of reference voltages and outputting a count value, and a count value from the counter circuit And a latch circuit for latching.
この発明により、サーモメータコードのバブリングがどこで発生しても、同じバブリングの数の場合に誤差の範囲が一定となり、誤差の範囲を小さくすることができるという効果がある。 According to the present invention, no matter where the bubbling of the thermometer code occurs, the error range is constant when the number of bubblings is the same, and the error range can be reduced.
実施の形態1.
図1はこの発明の実施の形態1によるエンコーダ回路20の構成を示すブロック図である。なお、並列比較型のADC回路の基本構成を示すブロック図は図4と同一であり、図1に示すエンコーダ回路20はコンパレータ10の出力に接続されている。図1に示すエンコーダ回路20はカウンタ回路21とラッチ回路22とを備えている。カウンタ回路21はサーモメータコード101全体の出力における‘1’の数をカウントしてカウント値102を出力し、ラッチ回路22はカウンタ回路21のカウント値102をラッチしてクロックOSCに同期してバイナリコード103を出力する。
1 is a block diagram showing a configuration of an
図2は図1に示すエンコーダ回路20の6ビットエンコーダを実現するHDL(Hardware Description Language)記述例を示す図である。図2に示す記述例において、「ADCQ」は入力するサーモメータコード101、dQは出力するバイナリコード103、OSCはクロックをそれぞれ示している。
FIG. 2 is a diagram showing an example of HDL (Hardware Description Language) description that realizes the 6-bit encoder of the
図2において、1行目はモジュール名、ピン名、2行目から4行目はピン宣言、5行目はレジスタ宣言、6行目は変数宣言を示している。7行目はクロックのポジティブエッジで以下を実行することを示し、8行目はjに初期値‘0’を設定し、9行目は変数iを‘0’から‘63’まで1つずつ増加させて以下を実行し、10行目はもしi番目のサーモメータコード101が‘1’ならば以下を実行することを示している。11行目はjに‘1’を加算することを示し、12行目はif文の終了、13行目はfor文の終了を示している。14行目は出力するバイナリコード103にjを設定することを示し、15行目はalways文の終了、16行目はモジュールの終了を示している。
In FIG. 2, the first line indicates the module name, the pin name, the second to fourth lines indicate the pin declaration, the fifth line indicates the register declaration, and the sixth line indicates the variable declaration. The 7th line indicates that the following is executed at the positive edge of the clock, the 8th line sets the initial value '0' to j, and the 9th line sets the variable i from '0' to '63' one by one. The following is executed in increments, and the 10th line indicates that if the i-
図3は図1に示すエンコーダ回路20の3ビットエンコーダの動作を説明する図である。ここでは、図8と同様に、真のサーモメータコード101を‘0011111’(真の出力‘5’)とし、サーモメータコード101に‘0’のバブリングが1個発生した場合を示している。この図3の例では、サーモメータコード101のどの場所でバブリングが発生しても、カウンタ回路21はサーモメータコード101全体の出力における‘1’の数をカウントしてカウント値102を出力し、ラッチ回路22はカウンタ回路21のカウント値102をラッチしてクロックOSCに同期してバイナリコード103を出力することにより、真の出力5に対して誤差の値は一定の−1となり、従来のグレイコード104を使用した場合よりも誤差の範囲が小さくなっている。
FIG. 3 is a diagram for explaining the operation of the 3-bit encoder of the
図3の例では、サーモメータコード101に‘0’のバブリングが1個発生した場合を示しているが、‘0’のバブリングがn個発生した場合には、真の出力に対する誤差の値は−nとなり、‘1’のバブリングがk個発生した場合には、真の出力に対する誤差の値は+kとなる。また、0’のバブリングがn個、‘1’のバブリングがk個発生した場合には、真の出力に対する誤差の値はk−nとなる。このように、いずれの場合にもバブリングの個数のみに依存する一定の値となり、バブリングが発生する場所には依存しない。
In the example of FIG. 3, the case where one “0” bubbling occurs in the
以上のように、この実施の形態1によれば、カウンタ回路21はサーモメータコード101全体の出力における‘1’の数をカウントしてカウント値102を出力し、ラッチ回路22はカウンタ回路21のカウント値102をラッチしてクロックOSCに同期してバイナリコード103を出力することにより、サーモメータコード101のバブリングがどこで発生しても、同じバブリングの数の場合に誤差の範囲が一定となり、グレイコード104を使用した場合よりも誤差の範囲を小さくすることができるという効果が得られる。
As described above, according to the first embodiment, the
10 コンパレータ、20 エンコーダ回路、21 カウンタ回路、22 ラッチ回路、101 サーモメータコード、102 カウント値、103 バイナリコード。 10 Comparator, 20 Encoder circuit, 21 Counter circuit, 22 Latch circuit, 101 Thermometer code, 102 Count value, 103 Binary code.
Claims (2)
上記カウンタ回路からのカウント値をラッチするラッチ回路とを備えたエンコーダ回路。 A counter circuit that counts the number of 1 in a thermometer code obtained by comparing an analog input voltage with a plurality of reference voltages and outputs a count value;
An encoder circuit comprising: a latch circuit that latches a count value from the counter circuit.
上記請求項1記載のエンコーダ回路とを備えた並列比較型のアナログ・デジタル変換回路。 Multiple comparators that compare the analog input voltage to each reference voltage and output a thermometer code;
A parallel comparison type analog-digital conversion circuit comprising the encoder circuit according to claim 1.
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