JP2005191290A - Method for manufacturing semiconductor device - Google Patents
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Abstract
Description
この発明は、半導体装置の製造方法に関する。更に、具体的には、絶縁膜として、多孔質の絶縁膜を用いる半導体装置の製造方法に関するものである。 The present invention relates to a method for manufacturing a semiconductor device. More specifically, the present invention relates to a method for manufacturing a semiconductor device using a porous insulating film as the insulating film.
近年、半導体装置の高集積化、微細化に伴い、特に、RC遅延の低減が必要となっている。このため、配線材料としては抵抗率の低い材料、また、絶縁膜材料としては誘電率の低い低誘電率(Low-k)絶縁膜を用いることが考えられている。 In recent years, with high integration and miniaturization of semiconductor devices, it is particularly necessary to reduce RC delay. For this reason, it is considered to use a material having a low resistivity as the wiring material and a low dielectric constant (Low-k) insulating film having a low dielectric constant as the insulating film material.
低誘電率(Low-k)絶縁膜としては、比誘電率k<3.0の絶縁膜の研究が進められている。このような低誘電率絶縁膜には、例えば、Poly-siloxane、HSQ(hydrogen-silsesquioxane)、Poly-methyl-siloxane、MSQ(methyl silsesquioxane)などがある。なかでも、近年、加熱処理や加工処理における耐性の強いPoly-methyl-siloxane、MSQ等が広く用いられている。 As a low dielectric constant (Low-k) insulating film, an insulating film having a relative dielectric constant k <3.0 is being researched. Examples of such a low dielectric constant insulating film include poly-siloxane, HSQ (hydrogen-silsesquioxane), poly-methyl-siloxane, and MSQ (methyl silsesquioxane). Among them, in recent years, poly-methyl-siloxane, MSQ, and the like, which are highly resistant to heat treatment and processing, are widely used.
また、比誘電率<2.5程度の、多孔質絶縁膜(ポーラス絶縁膜)を用いることも検討されている。多孔質絶縁膜(ポーラス絶縁膜)とは、上述のような、低誘電率膜中に数Å〜数十Å程度の空孔を有するものである。 In addition, the use of a porous insulating film (porous insulating film) having a relative dielectric constant <2.5 is also under study. The porous insulating film (porous insulating film) is a film having pores of about several to several tens of thousands in the low dielectric constant film as described above.
一方、抵抗率の低い配線材料としては、現在、CuあるいはCu合金の適用が研究されている。Cuは、従来、配線材料として用いられてきたAlに比して、比抵抗が35%ほど低く、また、エレクトロマイグレーション耐性も高いことから、高集積化する半導体装置において、信頼性の高い配線材料として期待されている。 On the other hand, application of Cu or Cu alloy is currently being studied as a wiring material having a low resistivity. Cu has a specific resistance of about 35% lower than Al conventionally used as a wiring material and also has a high electromigration resistance. Therefore, a highly reliable wiring material in a highly integrated semiconductor device. As expected.
また、Cuを配線として用いる場合、Cuが絶縁膜中に拡散するのを防止するため、絶縁膜と、Cuとの間にバリアメタル膜を形成する場合が多い。このバリアメタル膜は、一般に、Cuに比べて、高抵抗である。したがって、配線の抵抗を下げるため、バリアメタル膜の形成においては、薄膜化が必須となる。 When Cu is used as the wiring, a barrier metal film is often formed between the insulating film and Cu in order to prevent Cu from diffusing into the insulating film. This barrier metal film generally has a higher resistance than Cu. Therefore, in order to reduce the wiring resistance, it is essential to reduce the thickness of the barrier metal film.
極薄のバリアメタル膜を形成する方法として、ALD(Atomic Layer Deposition)法を用いることが考えられる。この方法は、処理室内を元の状態にリセットしながら、交互に原料ガスを供給し、1原子層ごとに成膜を行う方法である。 As a method for forming an extremely thin barrier metal film, it is conceivable to use an ALD (Atomic Layer Deposition) method. This method is a method of performing film formation for each atomic layer by alternately supplying source gases while resetting the inside of the processing chamber to the original state.
図9は、従来のALD法を用いて、TaN膜を形成する過程の状態を説明するための断面模式図である。
図9を参照して、具体的に、ポーラスMSQ102に、バリアメタル膜として、TaNを形成する場合について説明する。なお、ポーラスMSQ102は、多孔質絶縁膜であり、空孔104を有する。
FIG. 9 is a schematic cross-sectional view for explaining the state of the process of forming the TaN film using the conventional ALD method.
With reference to FIG. 9, the case where TaN is specifically formed in the
まず、成膜装置内に、TaCl5を供給して、図9に示すように、絶縁膜上に、Ta-R膜104を吸着させる。ここで、Rは、Clxである(x:1〜5)。その後、Arにより、装置内をパージした後、NH3を供給する。これにより、Ta-R膜104のTaとNH3のNとが反応し、絶縁膜上に、TaNが形成される。再び、装置内をArによりパージした後、TaCl5の供給行う。このように、TaCl5の供給、パージ、NH3の供給、パージの4工程を1サイクルとして繰り返すことにより、必要な膜厚のTaN膜を形成することができる(例えば、特許文献1参照)。
First, TaCl 5 is supplied into the film forming apparatus, and the Ta—
しかし、ALD法における初期段階での材料供給の際には、絶縁膜上で、原子層レベルでの成膜が行われる。即ち、原料として供給するガスは、分子状態の原料ガスであり、成膜中、成膜室内に、空孔より小さな粒子が存在する場合がある。したがって、絶縁膜として、ポーラスMSQのような多孔質絶縁膜を用いる場合には、例えば、図9に示すように、空孔104内に、Taが拡散して侵入する等、原料ガス又は原料ガスの分解物質であるメタルの拡散が起こり、空孔内に侵入する可能性がある。 However, when the material is supplied at the initial stage in the ALD method, film formation at the atomic layer level is performed on the insulating film. That is, the gas supplied as the raw material is a molecular state raw material gas, and particles smaller than the voids may exist in the film formation chamber during film formation. Therefore, when a porous insulating film such as a porous MSQ is used as the insulating film, for example, as shown in FIG. There is a possibility that the metal, which is a decomposition substance, diffuses and enters into the pores.
このように、原料ガス又はメタルが絶縁膜中に侵入すると、絶縁膜の比誘電率が高くなってしまう。また、ALD法により成膜された薄膜は、バリアメタルとしての性能を充分に確保することができず、問題である。 In this way, when the source gas or metal enters the insulating film, the dielectric constant of the insulating film increases. In addition, a thin film formed by the ALD method is problematic because it cannot sufficiently ensure the performance as a barrier metal.
従って、この発明は、上述のような問題を解決し、多孔質絶縁膜を用いる場合にも、多孔質絶縁膜中へのメタル等の侵入を抑えることができるよう改良した半導体装置の製造方法を提供するものである。 Accordingly, the present invention provides a method for manufacturing a semiconductor device that solves the above-described problems and that can suppress the intrusion of metal or the like into the porous insulating film even when the porous insulating film is used. It is to provide.
この発明の半導体装置の製造方法は、基板上に形成された空孔を有する多孔質絶縁膜に、金属又は金属の化合物からなる膜を形成する成膜方法において、
前記多孔質絶縁膜上に、前記空孔よりも少なくとも大きな粒子の状態の第1膜を形成する第1膜形成工程と、
前記第1膜上に、前記金属又は金属化合物からなる第2膜を形成する第2膜形成工程とを備え、
前記第2膜形成工程は、
処理室内に、前記金属又は前記金属の化合物に含まれる原料のうち、少なくとも1の原料を含む第1の材料を供給する第1材料供給工程と、
前記処理室内の前記第1の材料をパージする第1パージ工程と、
前記処理室内に、前記第1の材料と反応して、前記第2膜を構成する前記金属又は金属の化合物を形成する第2の材料を供給する第2材料供給工程と、
前記処理室内の前記第2の材料をパージする第2パージ工程と、
を備えるものである。
According to a method of manufacturing a semiconductor device of the present invention, in a film forming method for forming a film made of a metal or a metal compound on a porous insulating film having pores formed on a substrate,
A first film forming step of forming a first film in a state of particles at least larger than the pores on the porous insulating film;
A second film forming step of forming a second film made of the metal or metal compound on the first film,
The second film forming step includes
A first material supply step of supplying a first material containing at least one of the raw materials contained in the metal or the metal compound into the processing chamber;
A first purge step of purging the first material in the processing chamber;
A second material supply step of supplying a second material that reacts with the first material and forms the metal or metal compound constituting the second film into the processing chamber;
A second purge step of purging the second material in the processing chamber;
Is provided.
また、この発明の半導体装置は、基板上に形成された空孔を有する絶縁膜と、
金属又は金属の化合物からなる膜を有する半導体装置において、
前記金属又は金属化合物からなる膜は、前記空孔のサイズ又は前記空孔の連結部分のサイズより大きな分子又はクラスターからなる膜であるものである。
Further, the semiconductor device of the present invention includes an insulating film having holes formed on the substrate,
In a semiconductor device having a film made of a metal or a metal compound,
The film made of the metal or metal compound is a film made of molecules or clusters larger than the size of the pores or the size of the connecting portion of the pores.
この発明においては、多孔質絶縁膜上に、金属又は金属化合物からなる膜を形成する際に、まず、多孔質絶縁膜の空孔よりも大きな粒子を供給して第1膜を形成する。従って、その後の第2膜成膜過程において、空孔よりも小さな粒子を含む原料ガスが供給された場合にも、この原料ガス中の粒子や粒子から分解したメタル等が、空孔内に侵入するのを抑えることができる。 In the present invention, when a film made of a metal or a metal compound is formed on the porous insulating film, first, particles larger than the pores of the porous insulating film are supplied to form the first film. Therefore, in the subsequent film formation process of the second film, even when a source gas containing particles smaller than the vacancies is supplied, the particles in the source gas and the metal decomposed from the particles enter the vacancies. Can be suppressed.
以下、図面を参照して本発明の実施の形態について説明する。なお、各図において、同一または相当する部分には同一符号を付してその説明を簡略化ないし省略する。 Embodiments of the present invention will be described below with reference to the drawings. In the drawings, the same or corresponding parts are denoted by the same reference numerals, and the description thereof is simplified or omitted.
実施の形態1.
図1は、この発明の実施の形態1における成膜方法を説明するためのフロー図であり、図2は、この発明の実施の形態1における成膜の際に導入するガスの導入状況について説明するための図である。また、図3〜図5は、この発明の実施の形態1における成膜過程における状態を説明するための断面模式図である。
以下、図1〜5を参照して、この発明の実施の形態1における成膜方法について説明する。
Embodiment 1 FIG.
FIG. 1 is a flowchart for explaining a film forming method according to the first embodiment of the present invention, and FIG. 2 explains a state of introduction of a gas introduced during film formation according to the first embodiment of the present invention. It is a figure for doing. 3 to 5 are schematic cross-sectional views for explaining states in the film forming process according to the first embodiment of the present invention.
Hereinafter, a film forming method according to Embodiment 1 of the present invention will be described with reference to FIGS.
実施の形態1においては、ポーラスMSQ2上に薄膜を形成する。ここで、ポーラスMSQ2には、MSQ内に、数Å〜数十Å程度の空孔4を有する、比誘電率が約2.3程度の薄膜である。また、ポーラスMSQ2は、必要に応じて、トランジスタや下層配線等が形成された基板(図示せず)上に形成されている。 In the first embodiment, a thin film is formed on porous MSQ2. Here, the porous MSQ2 is a thin film having a porosity of about several to several tens of millimeters in the MSQ and having a relative dielectric constant of about 2.3. The porous MSQ2 is formed on a substrate (not shown) on which a transistor, a lower layer wiring, and the like are formed as necessary.
このようなポーラスMSQ2上に、まず、減圧CVD(Chemical Vapor Deposition)装置を用いて、CVD法により、TaN膜6を成膜する(ステップS2)。減圧CVD装置によるTaN膜4の成膜においては、成膜原料として、TaCl5とNH3とを用いる。図2に示すように、TaCl5とNH3とは、同時に減圧CVD装置内に供給し、その供給時間は、約10秒間とする。また、このときの成膜温度は、約350℃とする。ここで、TaCl5とNH3とは、減圧CVD装置の気相内、特に、ポーラスMSQ2表面近傍で、反応し、複数のTaN分子が集合した粒子となり、ポーラスMSQ2上に堆積する。これにより、図3に示すように、ポーラスMSQ2上に、薄いTaN膜6が形成される。ここで形成されたTaN膜6の、TaNは、ある程度結合した粒子の状態となっており、その各粒子の直径は、少なくとも、ポーラスMSQ2に含まれる空孔4のうち、最大頻度分布の空孔4の直径よりも大きな状態となっている。
First, a
なお、図3において、ポーラスMSQ2に示される空孔4は、ポーラスMSQ2の空孔を、イメージ的に表したものであり、実際に、ポーラスMSQ2に含まれる空孔は、上述したように、微細なものである。また、TaN膜6についても、薄い薄膜であるが、粒子のイメージを表すように円形に表している。しかし、実際には、TaN膜6は、ポーラスMSQ2上に、平坦な膜として形成されている。
In FIG. 3, the
次に、H2により、TaN膜6の形成に用いた減圧CVD装置内をパージする(ステップS4)。また、減圧CVD装置内は、約350℃の状態で保つ。その後、不活性ガスでパージされた減圧CVD装置に、まず、形成するTaN膜の前駆体を含む第1の原料として、TaCl5を供給する(ステップS6)。供給時間は、約1秒間とする。これにより、TaN膜6上に、原子層レベルでの薄いTa-R膜8が形成される。なお、この実施の形態1においては、原料にTaCl5を用いているため、-Rは、Clxであり、xは、1〜5の状態のいずれかの状態のものであると考えられる。
Next, the inside of the low-pressure CVD apparatus used for forming the
次に、減圧CVD装置内をH2によりパージする(ステップS8)。供給時間は、約1秒間とする。その後、パージされた減圧CVD装置内に、NH3を供給する(ステップS10)。供給時間は、約2秒間とする。NH3の供給により、Ta-R膜8中のTaとNとが反応し、図5に示すように、ポーラスMSQ2のTaN膜6上に、原子層レベルの薄いTaN膜10が形成される。なお、-R(Clx)は、NH3のHと反応し、アウトガスとして排出される。その後、装置内にH2を供給し、装置内をパージする(ステップS12)。パージ時間は、約1秒とする。
Next, the inside of the low pressure CVD apparatus is purged with H 2 (step S8). The supply time is about 1 second. Thereafter, NH 3 is supplied into the purged low-pressure CVD apparatus (step S10). The supply time is about 2 seconds. By supplying NH 3 , Ta and N in the Ta—
その後、上述のALD法による成膜サイクル、即ち、TaCl5の供給、H2によるパージ、NH3の供給、H2によるパージの4工程(ステップS6〜S12)を繰り返し行い、全体で、このサイクルを30サイクル繰り返す。これにより、TaN膜10は、所望の膜厚に形成される。
Thereafter, the above-described film formation cycle by the ALD method, that is, four steps (steps S6 to S12) of supplying TaCl 5 , purging with H 2 , supplying NH 3 , and purging with H 2 are repeatedly performed. Is repeated 30 cycles. Thereby, the
TEM(透過電子顕微鏡)を用いて観察を行った結果、ポーラスMSQ2上の、TaN膜6、10は、全体で、2nmの膜厚に形成されていた。また、ポーラスMSQ2内へのメタル等の拡散は観察されなかった。
As a result of observation using a TEM (transmission electron microscope), the
TaN膜10成膜後、必要に応じて、TaN膜10上層に、金属膜や層間絶縁膜その他の膜を形成し、配線等を形成することにより、半導体装置が形成される。
After the
以上説明したように、この実施の形態1においては、成膜の最初の段階において、CVD法による成膜を行う。これにより、ポーラスMSQ2上に、薄いTaN膜6を成膜することができる。ここで、CVD法による成膜の場合、成膜原料となるガス(例えば、実施の形態1では、TaCl5とNH3)を同時に供給する。このため、原料ガスは、気相中あるいは、ポーラスMSQ2の表面付近で反応し、複数のTaN分子が結合した粒子を構成した後、ポーラスMSQ2上にTaN膜6として堆積する。ここで、TaNの粒子の直径は、ポーラスMSQ2内の空孔4の直径より大きいものとなる。したがって、このTaN膜6から、Taやその化合物等がポーラスMSQ2内に拡散することを抑えることができる。
As described above, in the first embodiment, film formation by the CVD method is performed in the first stage of film formation. Thereby, a
そして、この実施の形態1においては、CVD法により薄いTaN膜6を形成した後、原子層レベルでの、ALD法により成膜を開始する。ここで供給される原料ガスTaCl5等は、分子状態の原料ガスであり、独立して装置内に存在し、また分解しやすい状態にある。即ち、ALD法において供給する原料ガスの各粒子や分子は、ポーラスMSQ2の空孔4より大きいことが考えられる。しかし、予めポーラスMSQ2上には、TaN膜6が形成されているため、Taやその化合物等の小さな粒子が存在しても、ポーラスMSQ2の空孔4内への侵入は抑えることができる。
In the first embodiment, after the
したがって、ポーラスMSQ2の誘電率を低く保ちつつ、TaN膜6、10においては、バリアメタルとしての拡散防止効果等を確保することができる。したがって、この実施の形態1によれば、良好なデバイス特性の半導体装置を得ることができる。
Therefore, the
また、実施の形態1においては、温度約300℃で10秒間、CVD法による成膜を行った後、すぐに、ALD法による成膜に切り替えている。従って、形成する薄膜は、ALD法で成膜した薄膜と、同程度に近いくらいの高品質に保つことができる。 In the first embodiment, after the film formation by the CVD method is performed at a temperature of about 300 ° C. for 10 seconds, the film formation is immediately switched to the film formation by the ALD method. Therefore, the thin film to be formed can be kept at a high quality as close as the thin film formed by the ALD method.
なお、この実施の形態1においては、ポーラスMSQ2の平坦な表面に、TaN膜6、10を形成する場合について図示して説明した。しかし、この発明はこれに限るものではない。例えば、開口を有するポーラスMSQの開口内壁面を含めて全面に、TaN膜等を形成するものであってもよい。また、更に具体的に例えば、この発明は、開口を有するポーラスMSQの開口内壁にTaN膜を形成し、これをバリアメタル膜とし、更に、Cuを埋め込んで配線を形成する場合等に効果的に適用することができる。
In the first embodiment, the case where the
また、誘電率の低い絶縁膜として、ポーラスMSQ2を用いる場合について説明した。しかし、この発明はこれに限るものではなく、他の多孔質低誘電率絶縁膜等を用いるものであってもよい。また、この発明は、多孔質絶縁膜を用いる場合に、最も効果的なものではあるが、他の絶縁膜に適用したものであってもよい。 Further, the case where the porous MSQ2 is used as the insulating film having a low dielectric constant has been described. However, the present invention is not limited to this, and other porous low dielectric constant insulating films or the like may be used. The present invention is most effective when a porous insulating film is used, but may be applied to other insulating films.
また、この実施の形態1においては、ポーラスMSQ2に、TaN膜6、10を形成する場合について説明した。しかし、この発明はこれに限るものではなく、例えば、TiN膜等、他の膜を形成するものであっても良い。また、TaN膜1層に限るものではなく、例えば、CVD法を用いた成膜の場合には、TaSiN膜等他の膜を形成し、その後、ALD法により、TaN膜を成膜するなど、異なる2層膜を形成するものであってもよい。また、このときの原料ガスは、適宜選択すればよい。
In the first embodiment, the case where the
また、実施の形態1においては、パージガスとして、H2を用いたが、必ずしもH2ガスに限らず、Ar又はN2等、他の不活性ガスを用いてもよい。これらは、用いる原料ガス等を考慮して、適宜選択すればよい。 In the first embodiment, H 2 is used as the purge gas, but it is not necessarily limited to H 2 gas, and other inert gas such as Ar or N 2 may be used. These may be appropriately selected in consideration of the raw material gas to be used.
また、実施の形態1においては、TaN膜6の形成の際、CVD法により形成する場合について説明した。しかし、この発明においてはこれに限るものではない。ここでは、ポーラスMSQ2に直接接する第1層目の膜を成膜する場合には、少なくともポーラスMSQ2表面に付着する前、気相中又はポーラスMSQ2の表面近傍で、第1層目の成膜材料をポーラスMSQ2の有する空孔4よりも大きく結合した粒子の状態にして、堆積できるものであればよい。従って、例えば、CVD法に代えて、PVD(Physical Vapor Deposition)法を用いる等、第1層目の薄膜形成において、他の成膜方法を用いてもよい。
In the first embodiment, the case where the
また、実施の形態1においては、CVD法のよるTaN膜6の形成と、ALD法によるTaN膜10の形成を、同一の減圧CVD装置内で、同一の温度で行う場合について説明した。これによれば、工程数の増加を抑えて効率よく成膜を行うことができる。しかし、この発明は、必ずしも、同一の装置内で行うものに限らず、CVD法の場合とALD法の場合の成膜において、違う装置を用いて行ってもよい。また、同一の温度に保って行う場合について説明したが、温度を変更したものであってもよい。例えば、成膜精度を考慮すれば、CVD用成膜室内で、成膜温度を400℃程度としてCVD法による成膜を行い、成膜後、基板をALD用の成膜室に真空搬送して、ALD法における成膜温度を250℃程度として成膜するような、連続成膜を行うことも考えられる。このように、温度を変化させることにより、工程数は増加するものの、より性能の高い薄膜を形成することができる。装置や温度の変更は、要求される成膜精度や生産効率等を考慮して、適宜選択すればよい。
In the first embodiment, the case where the formation of the
また、この発明は、実施の形態1において説明した成膜温度、成膜時間、成膜する膜厚に限られるものではない。但し、膜のカバレッジや膜質を考慮すれば、ALD法により形成した部分の膜厚が占める割合ができるだけ大きい方が好ましく、CVD法により形成する第1膜の膜厚は、約1nm以下程度であることが好ましいものと考えられる。 Further, the present invention is not limited to the film formation temperature, the film formation time, and the film thickness to be formed described in the first embodiment. However, considering the coverage and quality of the film, it is preferable that the ratio of the film thickness of the portion formed by the ALD method is as large as possible. The film thickness of the first film formed by the CVD method is about 1 nm or less. Is considered preferable.
実施の形態2.
この実施の形態2における成膜方法は、実施の形態1において説明した方法と類似するものである。但し、実施の形態2においては、TaN膜の成膜に代えて、TiN膜の成膜を行う。以下、具体的に説明する。
The film forming method in the second embodiment is similar to the method described in the first embodiment. However, in the second embodiment, a TiN film is formed instead of the TaN film. This will be specifically described below.
まず、減圧CVD装置を用いて、ポーラスMSQ2上に、TiNの成膜を行う。ここでは、成膜原料ガスとして、TDMAT(テトラキスジメチルアミノチタニウム)とNH3とを用いる。成膜温度は約300℃とし、TDMATとNH3とを同時に、約5秒間供給する。 First, a TiN film is formed on the porous MSQ2 using a low pressure CVD apparatus. Here, TDMAT (tetrakisdimethylaminotitanium) and NH 3 are used as the film forming source gas. The film forming temperature is about 300 ° C., and TDMAT and NH 3 are simultaneously supplied for about 5 seconds.
これにより、ポーラスMSQ膜2上に、TiN膜が形成される。ここでのTiN膜は、実施の形態1のTaN膜6と同様に、気相中、ポーラスMSQ2表面付近で、空孔4より大きな粒子状態となった後に、堆積するため、ポーラスMSQ2の空孔4内に、Ti等の拡散は抑えられている。
Thereby, a TiN film is formed on the
次に、減圧CVD装置内をArによりパージした後、原料ガスとして、TDMATのみを供給する。ここでの供給は、約0.5秒間とする。これにより、CVD法により形成されたTiN膜上に、Ti-R膜が形成される。ここで、-Rは、ジメチルアミノ基(-N(CH3)2)など、Tiと結合するTDMATに含まれる何らかの成分である。 Next, after the inside of the low pressure CVD apparatus is purged with Ar, only TDMAT is supplied as a source gas. The supply here is about 0.5 seconds. Thereby, a Ti—R film is formed on the TiN film formed by the CVD method. Here, -R is dimethylamino group (-N (CH 3) 2), etc., is any component contained in TDMAT to bind to Ti.
ここでは、Ti-R膜が、原子層レベルで形成されるが、しかし、実施の形態1において説明したのと同様に、ポーラスMSQ2上に、予め粒子の大きいTiN膜が形成されているため、ポーラスMSQの空孔4内へのTi又はTiとの化合物の拡散を抑えることができる。
Here, the Ti—R film is formed at the atomic layer level. However, since the TiN film having large particles is formed on the
次に、Arによるパージを行う。Arの供給時間は約1秒間とする。その後、NH3を供給する。NH3の供給時間は、約2秒間とする。これにより、Ti-R膜のTiと、NH3中のNとが反応して、TiN膜上に、TiNが形成される。また、-Rと、Hとが反応して排出される。その後、Arにより、約2秒間パージを行う。 Next, purge with Ar is performed. The Ar supply time is about 1 second. Thereafter, NH 3 is supplied. The supply time of NH 3 is about 2 seconds. As a result, Ti in the Ti—R film reacts with N in NH 3 to form TiN on the TiN film. Moreover, -R and H react and are discharged. Thereafter, purge is performed with Ar for about 2 seconds.
その後、上述したTDMATの供給、Arによるパージ、NH3の供給、Arによるパージからなる4工程を、1サイクルとして、繰り返し、全体で20サイクル行う。これにより、ポーラスMSQ2上に、膜厚2nmのTiN膜が形成される。また、成膜後、TEM(透過電子顕微鏡)による観察を行ったが、ポーラスMSQ2中への拡散は観察されなかった。 Thereafter, the above four steps consisting of the above-described TDMAT supply, Ar purge, NH 3 supply, and Ar purge are repeated as 20 cycles for a total of 20 cycles. Thereby, a TiN film having a thickness of 2 nm is formed on the porous MSQ2. Further, after film formation, observation with a TEM (transmission electron microscope) was performed, but no diffusion into the porous MSQ2 was observed.
以上説明したように、実施の形態2においては、まず、CVD法により、TiN膜を形成した後、ALD法に切り替えて、TiN膜の形成を行う。ここで、CVD法により形成されたTiN膜は、ポーラスMSQ2に堆積する前に、気相中で反応してTiNとなり、空孔4よりも粒子の大きな状態となってからポーラスMSQ2上に成膜される。従って、ポーラスMSQ2内へのTi等の拡散は抑えられる。また、ALD法においては、分子レベルで独立して存在する原料ガスを供給するため、ガス中に、空孔4より小さな粒子が存在する場合がある。しかし、予めCVD法により、粒子の大きなTiN膜を形成することにより、Ti等の、ポーラスMSQ2内への侵入は抑えることができる。従って、ポーラスMSQ2の比誘電率を低く保ちつつ、バリアメタルとしての効力を高く確保して、バリアメタル等の薄膜の形成を行うことができる。
その他は、実施の形態1と同様であるから説明を省略する。
As described above, in the second embodiment, first, a TiN film is formed by a CVD method, and then the ALD method is switched to form a TiN film. Here, the TiN film formed by the CVD method reacts in the gas phase before being deposited on the porous MSQ2, becomes TiN, and is formed on the porous MSQ2 after particles become larger than the
Others are the same as those in the first embodiment, and thus description thereof is omitted.
実施の形態3.
図6は、この発明の実施の形態3における成膜方法を説明するためのフロー図である。また、図7及び図8は、実施の形態3における成膜過程の状態を説明するための断面模式図である。
実施の形態3における成膜方法は、実施の形態1において説明した成膜方法と類似するものである。しかし、実施の形態3においては、まずCVD法を用いてTiSiN膜を形成し、ALD法によりTiN膜を形成する。以下、具体的に説明する。
Embodiment 3 FIG.
FIG. 6 is a flowchart for explaining a film forming method according to Embodiment 3 of the present invention. 7 and 8 are schematic cross-sectional views for explaining the state of the film forming process in the third embodiment.
The film formation method in the third embodiment is similar to the film formation method described in the first embodiment. However, in the third embodiment, first, a TiSiN film is formed using a CVD method, and a TiN film is formed using an ALD method. This will be specifically described below.
まず、減圧CVD装置を用いて、ポーラスMSQ2上に、TiSiN膜12を形成する(ステップS22)。ここでは、成膜温度を300℃とし、成膜原料ガスとして、TDMAT、SiH4、NH3を用いて、これらのガスを同時に約5秒間供給する。これにより、図7に示すように、ポーラスMSQ2上にTiSiN膜12が形成される。ここで、TiSiN膜12は、実施の形態2のTiN膜と同様に、ポーラスMSQ2上に堆積する前に反応して、TiSiN分子が結合して大きな粒子となるため、ポーラスMSQ2内への侵入は、抑えられている。
First, the
次に、Heにより減圧CVD装置内をパージし(ステップS24)、その後、減圧CVD装置内に、TDMATを供給する(ステップS26)。これにより、図8に示すように、Ti-R膜14が、TiSiN膜12上に吸着する。なお、ここでのTDMATの供給時間は、約0.5秒間とする。その後、Heを約1秒間供給して装置内をパージし(ステップS28)、NH3を約2秒間供給する(ステップS30)。これにより、TiとNとが反応して、TiN膜が成膜される。その後、約1秒間、Heを供給することにより、装置内をパージする(ステップS32)。
Next, the inside of the low pressure CVD apparatus is purged with He (step S24), and then TDMAT is supplied into the low pressure CVD apparatus (step S26). Thereby, as shown in FIG. 8, the Ti—
その後、再び、TDMATの供給を開始する。実施の形態2と同様に、TDMATの供給、Heによるパージ、NH3の供給、Heによるパージの4工程(ステップS26〜S32)を1サイクルとして、全部で約20サイクル繰り返す。これにより。膜厚0.5nmのTiSiN膜12と、約1.5nmのTiN膜とが、ポーラスMSQ2上に形成される。ここで、TEMによる観察を行った結果、ポーラスMSQ2内へのメタル等の拡散は、確認されなかった。
Thereafter, the supply of TDMAT is started again. As in the second embodiment, the supply of TDMAT, purging with He, the supply of NH 3, the four steps (steps S26~S32) of the purge as one cycle according to He, repeated about 20 cycles in total. By this. A
以上説明したように、実施の形態3においては、ポーラスMSQ2上に、CVD法によるTiSiN膜12と、ALD法によるTiN膜を形成する。ここで、ALDによる成膜を行う前に、粒子の大きなTiSiN膜の形成を行う。これにより、原子層レベルで成膜が行われるALD法において、微細な粒子や分子等が、ポーラスMSQ2内への拡散するのを抑えることができる。これにより、ポーラスMSQ2の誘電率を低く保ちつつ、形成したメタル膜の拡散防止機能を充分に確保して、ポーラスMSQ上に高性能の薄膜の形成を行うことができる。
As described above, in the third embodiment, the
なお、この実施の形態3においては、TiSiN膜を形成した後に、TiN膜を形成する場合について説明した。しかし、この発明においてはこれに限るものではなく、例えば、TaSiN膜を形成した後、TaN膜あるいはTiN膜を形成する場合等であってもよい。即ち、この発明は、ポーラスMSQ2上に粒子の大きな原料を堆積させた第1膜を成膜した後、ALD法により薄膜を成膜するものであり、この発明の方法を適用可能な膜であれば、CVD法により形成する膜と、ALD法により形成する膜の種類及びその際に用いる材料は、適宜選択すればよい。 In the third embodiment, the case where the TiN film is formed after the TiSiN film is formed has been described. However, the present invention is not limited to this. For example, a TaNN film or a TiN film may be formed after the TaSiN film is formed. That is, in the present invention, the first film in which the raw material having large particles is deposited on the porous MSQ2 is formed, and then the thin film is formed by the ALD method. For example, a film formed by a CVD method, a type of a film formed by an ALD method, and a material used at that time may be appropriately selected.
また、ここで、TiSiN膜をCVD法により形成する場合について説明した。しかし、この発明においては、CVD法を用いる場合に限るものではなく、ポーラスMSQ2上へ堆積される前に、成膜原料を、少なくとも空孔4より大きな粒子とし、堆積できる成膜方法であれば、例えば、PVD法など、他の方法を用いたものであってよい。
その他は、実施の形態1、2と同様であるから説明を省略する。
Here, the case where the TiSiN film is formed by the CVD method has been described. However, the present invention is not limited to the case where the CVD method is used, and any film-forming method can be used as long as the film-forming raw material is at least larger than the
Others are the same as in the first and second embodiments, and thus the description thereof is omitted.
なお、例えば、実施の形態1〜3におけるポーラスMSQ2は、この発明の多孔質絶縁膜に該当し、TaN膜6及びTiSiN膜12は、第1膜に該当し、TaN膜10及びTiSiN膜上に形成されるTiN膜は、第2膜に該当する。また、実施の形態1〜3におけるTaCl5及びTDMATは、第1の材料に該当し、NH3は、第2の材料に該当する。但し、この発明が、これらに限られるものではない。
For example, the porous MSQ2 in the first to third embodiments corresponds to the porous insulating film of the present invention, the
また、例えば、実施の形態1〜3のステップS2、S22を実行することにより、この発明の第1膜形成工程が実行され、ステップS6、S26を実行することにより、第1材料供給工程が実行され、ステップS8、S28を実行することにより、第1パージ工程が実行され、ステップS10、S30を実行することにより、第2材料供給工程が実行され、ステップS12、S32を実行することにより、第2パージ工程が実行される。但し、この発明が、必ずしもこれらに限られるものではない。 Further, for example, the first film forming process of the present invention is executed by executing steps S2 and S22 of the first to third embodiments, and the first material supplying process is executed by executing steps S6 and S26. The first purge process is executed by executing steps S8 and S28, the second material supply process is executed by executing steps S10 and S30, and the first purge process is executed by executing steps S12 and S32. Two purge steps are performed. However, the present invention is not necessarily limited to these.
2 ポーラスMSQ
4 空孔
6 TaN膜(CVD)
8 Ta-R膜
10 TaN膜
12 TiSiN膜(CVD)
14 Ti−R膜
102 ポーラスMSQ
104 空孔
106 Ta−R膜
2 Porous MSQ
4
8 Ta-
14 Ti-
104
Claims (7)
前記多孔質絶縁膜上に、前記空孔よりも少なくとも大きな粒子の状態の第1膜を形成する第1膜形成工程と、
前記第1膜上に、前記金属又は金属化合物からなる第2膜を形成する第2膜形成工程とを備え、
前記第2膜形成工程は、
処理室内に、前記金属又は前記金属の化合物に含まれる原料のうち、少なくとも1の原料を含む第1の材料を供給する第1材料供給工程と、
前記処理室内の前記第1の材料をパージする第1パージ工程と、
前記処理室内に、前記第1の材料を反応させて、前記第2膜を構成する前記金属又は金属の化合物を形成する反応工程と、
前記処理室内をパージする第2パージ工程と、
を備えることを特徴とする半導体装置の製造方法。 In a film forming method for forming a film made of a metal or a metal compound on a porous insulating film having pores formed on a substrate,
A first film forming step of forming a first film in a state of particles at least larger than the pores on the porous insulating film;
A second film forming step of forming a second film made of the metal or metal compound on the first film,
The second film forming step includes
A first material supply step of supplying a first material containing at least one of the raw materials contained in the metal or the metal compound into the processing chamber;
A first purge step of purging the first material in the processing chamber;
A reaction step of reacting the first material in the processing chamber to form the metal or metal compound constituting the second film;
A second purge step for purging the processing chamber;
A method for manufacturing a semiconductor device, comprising:
金属又は金属の化合物からなる膜を有する半導体装置において、
前記金属又は金属化合物からなる膜は、前記空孔のサイズ又は前記空孔の連結部分のサイズより大きな分子又はクラスターからなる膜であることを特徴とする半導体装置。 An insulating film having holes formed on the substrate;
In a semiconductor device having a film made of a metal or a metal compound,
2. The semiconductor device according to claim 1, wherein the film made of the metal or the metal compound is a film made of molecules or clusters larger than the size of the holes or the connecting portion of the holes.
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