JP2005077315A - Optical waveguide sensor - Google Patents

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Abstract

<P>PROBLEM TO BE SOLVED: To build a small analysis system. <P>SOLUTION: A peripheral electrode 113 is provided and surrounds a region in which a silicon thin line core 105 is formed. When a sample contacts both silicon thin line core 105 and peripheral electrode 113, a component in a solution as the sample is separated by electrophoresis by applying a ground potential to the silicon thin line core 105 and applying a plus potential to the peripheral electrode 113, and a concentration of an analyzed material in the region of the silicon thin line core 105 is increased. <P>COPYRIGHT: (C)2005,JPO&NCIPI

Description

本発明は、屈折率の異なる界面で光が全反射するときにしみ出すエバネッセント光を利用した光吸収分光による分析に用いる光導波路型センサに関する。   The present invention relates to an optical waveguide sensor used for analysis by optical absorption spectroscopy using evanescent light that oozes out when light is totally reflected at interfaces having different refractive indexes.

物質の特性を知る分析法に、物質の赤外スペクトルを測定する赤外分光法がある。赤外分光法の一つに、ZnSeなどのATR(Attenuated Total Reflection)結晶プリズムを用いた全反射吸収スペクトル法(ATR法)がある。ATR法は、赤外線がATR結晶プリズムの中を全反射する際に、試料が接しているプリズムの外側にわずかにしみ出す光(エバネッセント光)を利用するものであり、固体試料の表面や水溶液試料中の成分を高感度に分析することを可能としている。   As an analysis method for knowing the characteristics of a substance, there is infrared spectroscopy that measures the infrared spectrum of the substance. One of the infrared spectroscopic methods is the total reflection absorption spectrum method (ATR method) using an ATR (Attenuated Total Reflection) crystal prism such as ZnSe. The ATR method uses light (evanescent light) that slightly oozes outside the prism in contact with the sample when infrared light is totally reflected inside the ATR crystal prism. This makes it possible to analyze the components inside with high sensitivity.

上述したATR法による分析では、より感度を向上させるために、プリズムの中で多数回の全反射が生じるように構成している(非特許文献1参照)。また、ATR法により、採血やセンサを埋め込むことなどを必要とせずに、人体の血中のグルコースの濃度を簡便に測定する分析システムなども開発されている(特許文献1参照)。   In the above-described analysis by the ATR method, in order to further improve the sensitivity, the prism is configured such that total reflection occurs many times in the prism (see Non-Patent Document 1). In addition, an analysis system that simply measures the concentration of glucose in the blood of a human body without the need for blood sampling or embedding a sensor by the ATR method has been developed (see Patent Document 1).

なお、出願人は、本明細書に記載した先行技術文献情報で特定される先行技術文献以外には、本発明に関連する先行技術文献を出願時までに発見するには至らなかった。
特公表2002−527136号公報 実用分光法シリーズ(4)分光学の医学応用,1999年9月30日発行、(株)アイピーシー
The applicant has not yet found prior art documents related to the present invention by the time of filing other than the prior art documents specified by the prior art document information described in this specification.
Japanese Patent Publication No. 2002-527136 Practical spectroscopy series (4) Medical application of spectroscopy, published September 30, 1999, IPC Corporation

しかしながら、従来のATR法による分析では、ATR結晶プリズムを小型化することが容易ではなく、分析システム(装置)の小型化が困難であった。
本発明は、以上のような問題点を解消するためになされたものであり、より小型な分析システムが構築できるようにすることを目的とする。
However, in the analysis by the conventional ATR method, it is not easy to reduce the size of the ATR crystal prism, and it is difficult to reduce the size of the analysis system (apparatus).
The present invention has been made to solve the above problems, and an object of the present invention is to make it possible to construct a smaller analysis system.

本発明に係る光導波路型センサは、下部クラッド層と、この下部クラッド層の上に形成されて少なくとも一部の面が露出した半導体からなるコアと、このコアから構成された導波路の光入射端と、導波路の光出射端と、コアの配設された領域と所定距離離間して設けられた周囲電極と、コアと周囲電極との間に電位を印加するための電位印加手段とを少なくとも備え、導波路は、シングルモード導波路であり、コアの露出した面と周囲電極とに分析対象物が接触するものである。
このセンサでは、コアと周囲電極との間に電位を印加すると、コア及び周囲電極の両方に接触している分析対象に電位が印加された状態となる。
An optical waveguide sensor according to the present invention includes a lower clad layer, a core made of a semiconductor formed on the lower clad layer and having at least a part of the surface exposed, and light incident on a waveguide composed of the core. An end, a light emitting end of the waveguide, a peripheral electrode provided at a predetermined distance from a region where the core is disposed, and a potential applying means for applying a potential between the core and the peripheral electrode. At least, the waveguide is a single mode waveguide, and the analyte is in contact with the exposed surface of the core and the surrounding electrode.
In this sensor, when a potential is applied between the core and the surrounding electrode, the potential is applied to the analysis target in contact with both the core and the surrounding electrode.

上記光導波路型センサにおいて、コアの露出した面に形成された酸化膜を備えることで、試料となる液体が接触したときに、この液体とコアとの良好な密着性を得ることができる。また、上記光導波路型センサにおいて、周囲電極を、コアの配設された領域の周囲を囲うように設けるようにしてもよい。また、コアと周囲電極とは、例えば半導体であるシリコンなどの同一材料から構成してもよく、周囲電極は金属から構成してもよい。周囲電極をシリコンから構成する場合、周囲電極の露出した面に酸化膜を形成することで、試料となる液体と周囲電極との良好な密着性を得ることができる。   In the optical waveguide sensor, by providing an oxide film formed on the exposed surface of the core, when the liquid as the sample comes into contact, good adhesion between the liquid and the core can be obtained. In the optical waveguide sensor, the surrounding electrode may be provided so as to surround the periphery of the region where the core is disposed. Further, the core and the peripheral electrode may be made of the same material such as silicon as a semiconductor, for example, and the peripheral electrode may be made of a metal. When the peripheral electrode is made of silicon, an excellent adhesion between the liquid serving as the sample and the peripheral electrode can be obtained by forming an oxide film on the exposed surface of the peripheral electrode.

また、上記光導波路型センサにおいて、電位印加手段は、コアに直接接触するコアと同一材料からなる電圧印加部と、この電圧印加部にオーミック接続する金属配線とから構成することができる。   In the optical waveguide sensor, the potential applying means can be composed of a voltage applying unit made of the same material as the core that is in direct contact with the core and a metal wiring that is ohmically connected to the voltage applying unit.

以上説明したように、本発明では、下部クラッド層の上に半導体からなるコアを形成し、このコアよりシングルモード導波路を構成し、これらの一部において少なくともコアの上面を露出させ、ここに分析対象物を接触させることで、分析対象物における赤外線の吸収などを検出する分光法による分析を可能とした。従って、本発明によれば、従来のATR法における結晶プリズムに代えて、シングルモード導波路を用いることによって、分析システムの小型化を図ることができる。また、小さな曲げ半径で導波方向が変更できる導波路で検出領域が構成できるので、感度を向上させることができるだけの長い導波路を小さな検出領域に配置できるようになる。このように、本発明によれば、感度を低下させることが無く、より小型な分析システムが構築できるようになるという優れた効果が得られる。   As described above, in the present invention, a core made of a semiconductor is formed on the lower clad layer, a single mode waveguide is formed from this core, and at least a top surface of the core is exposed in a part of these cores. By bringing the analysis object into contact, analysis by the spectroscopic method for detecting infrared absorption or the like in the analysis object was made possible. Therefore, according to the present invention, the size of the analysis system can be reduced by using a single mode waveguide instead of the crystal prism in the conventional ATR method. In addition, since the detection region can be configured by a waveguide whose waveguide direction can be changed with a small bending radius, a long waveguide capable of improving sensitivity can be arranged in the small detection region. Thus, according to the present invention, it is possible to obtain an excellent effect that a smaller analysis system can be constructed without lowering the sensitivity.

また、本発明では、分析対象物に接触する周囲電極を設け、周囲電極とコアとの間に電位を印加することで、印加した電位を分析対象物に作用させることを可能とした。このことにより、分析対象物の液体中の成分を、電気泳動により分離し、コアの近辺における成分濃度をより高くすることが可能となり、分析感度を向上させることができる。   Further, in the present invention, an ambient electrode that is in contact with the analysis target is provided, and a potential is applied between the peripheral electrode and the core, whereby the applied potential can be applied to the analysis target. As a result, the components in the liquid of the analysis object can be separated by electrophoresis, the component concentration in the vicinity of the core can be increased, and the analysis sensitivity can be improved.

以下、本発明の実施の形態について図を参照して説明する。
図1は、本発明の実施の形態における光導波路型センサの構成例を示す平面図である。
このセンサの構成について説明すると、まず、入射側の光ファイバー200の端部が固定されるV字状の溝101、出射側の光ファイバー300の端部が固定されるV字状の溝102が設けられている。溝101,102は、一般に市販されているSOI基板の基板部111に形成されている。
Hereinafter, embodiments of the present invention will be described with reference to the drawings.
FIG. 1 is a plan view showing a configuration example of an optical waveguide sensor according to an embodiment of the present invention.
The configuration of this sensor will be described. First, a V-shaped groove 101 to which the end portion of the incident-side optical fiber 200 is fixed, and a V-shaped groove 102 to which the end portion of the output-side optical fiber 300 is fixed are provided. ing. The grooves 101 and 102 are formed in the substrate portion 111 of a generally available SOI substrate.

これら溝101,102に続いてスポットサイズ変換領域が配置され、スポットサイズ変換領域には、入射側に配置されたスポットサイズ変換コア103と、出射側に配置されたスポットサイズ変換コア104とを備えている。これらは、酸化シリコンからなる上部クラッド層107に覆われている。スポットサイズ変換コア103,104は、例えば、シリコン酸窒化物から構成されている。スポットサイズ変換コア103には、光ファイバー200の光ファイバーコア201が接続し、スポットサイズ変換コア104には、光ファイバー300の光ファイバーコア301が接続している。   A spot size conversion region is disposed following these grooves 101 and 102, and the spot size conversion region includes a spot size conversion core 103 disposed on the incident side and a spot size conversion core 104 disposed on the exit side. ing. These are covered with an upper clad layer 107 made of silicon oxide. The spot size conversion cores 103 and 104 are made of, for example, silicon oxynitride. An optical fiber core 201 of the optical fiber 200 is connected to the spot size conversion core 103, and an optical fiber core 301 of the optical fiber 300 is connected to the spot size conversion core 104.

スポットサイズ変換領域に続いて検出領域が設けられ、検出領域には、半導体であるシリコンから構成されたシリコン細線コア105が形成されている。この領域においては、以降に説明する埋め込み酸化層112を下部クラッド層としたシリコン細線コア105による導波路が構成されている。また、検出領域の周辺部には、シリコン細線コア105の形成領域を囲うように、シリコンからなる周囲電極113が設けられている。シリコン細線コア105は、断面の寸法が約1μm角程度となっている。図2の断面図に示すように、シリコン細線コア105及び周囲電極113は、検出領域において、SOI基板の埋め込み酸化層112の上に配置されている。なお、図2は、図1のAA’断面である。   A detection area is provided following the spot size conversion area, and a silicon fine wire core 105 made of silicon as a semiconductor is formed in the detection area. In this region, a waveguide is formed by the silicon fine wire core 105 using a buried oxide layer 112 described below as a lower cladding layer. In addition, a peripheral electrode 113 made of silicon is provided around the detection region so as to surround the formation region of the silicon fine wire core 105. The silicon fine wire core 105 has a cross-sectional dimension of about 1 μm square. As shown in the cross-sectional view of FIG. 2, the silicon fine wire core 105 and the peripheral electrode 113 are disposed on the buried oxide layer 112 of the SOI substrate in the detection region. 2 is a cross-sectional view taken along the line AA ′ of FIG.

検出領域において、シリコン細線コア105の基板部111側の下面は、酸化シリコンである埋め込み酸化層112に覆われ、上面及び両側面は露出した状態の導波路となっている。なお、シリコン細線コア105の露出している面に、数nmから数10nm程度の酸化膜が形成されていてもよい。上述したように、シリコン細線コア105は、断面寸法が1μm角程度としてあるので、上記導波路は、波長4μm以下の光がシングルモードで伝搬する。言い換えると、シリコン細線コア105は、これより構成される導波路が、シングルモードとなる寸法に形成されていればよい。例えば、波長1.5μmの光をシングルモードとする場合、コアの断面寸法は、0.3μm角程度とすればよい。   In the detection region, the lower surface of the silicon fine wire core 105 on the substrate part 111 side is covered with a buried oxide layer 112 made of silicon oxide, and the upper surface and both side surfaces are exposed waveguides. Note that an oxide film with a thickness of several nanometers to several tens of nanometers may be formed on the exposed surface of the silicon fine wire core 105. As described above, since the silicon fine wire core 105 has a cross-sectional dimension of about 1 μm square, light having a wavelength of 4 μm or less propagates through the waveguide in a single mode. In other words, the silicon thin wire core 105 only needs to be formed in such a dimension that the waveguide formed therefrom becomes a single mode. For example, when light having a wavelength of 1.5 μm is set to a single mode, the cross-sectional dimension of the core may be about 0.3 μm square.

図1に示す光導波路型センサでは、入射側の光ファイバー200に光源を接続し、出射側の光ファイバー300に分光器を接続することで、分光測定のシステムが構成できる。なお、図1では、光の入射端と出射端とを各々設けるようにしているが、これらを同一とした閉回路としてもよい。   In the optical waveguide sensor shown in FIG. 1, a spectroscopic measurement system can be configured by connecting a light source to the optical fiber 200 on the incident side and connecting a spectroscope to the optical fiber 300 on the output side. In FIG. 1, the light incident end and the light exit end are provided, but a closed circuit in which these are the same may be used.

このようなシステムにおいて、シリコン細線コア105よりなる導波路に赤外線を導波させた状態で、検出領域で露出するシリコン細線コア105の上面に分析対象の試料が接触していると、シリコン細線コア105よりしみ出した光が、試料の特性に応じて吸収されるため、この吸収の強さに応じて導波する光の強度が低下する。従って、例えば、シリコン細線コア105から構成されている導波路を導波する光の強度をある波長帯域に対して測定すれば、分析対象の試料による吸収スペクトルが得られる。   In such a system, when the sample to be analyzed is in contact with the upper surface of the silicon fine wire core 105 exposed in the detection region in a state where infrared rays are guided through the waveguide made of the silicon fine wire core 105, the silicon fine wire core Since the light oozing out from 105 is absorbed according to the characteristics of the sample, the intensity of the guided light is lowered according to the intensity of the absorption. Therefore, for example, if the intensity of light guided through a waveguide composed of the silicon thin wire core 105 is measured with respect to a certain wavelength band, an absorption spectrum by the sample to be analyzed can be obtained.

また、この導波路は、最小曲げ半径が約15μm以下と、非常に小さい曲率で導波方向を変更することが可能である。従って、図1の平面図に示すように、シリコン細線コア105を、狭い間隔で往復させて配置させることが可能となり、狭い検出領域内で、試料と接触する領域をより長くすることが可能となる。   In addition, this waveguide can change the waveguide direction with a very small curvature, ie, a minimum bending radius of about 15 μm or less. Therefore, as shown in the plan view of FIG. 1, the silicon fine wire core 105 can be reciprocated at a narrow interval, and the region in contact with the sample can be made longer in the narrow detection region. Become.

シリコン細線コア105は、SOI構造の基板のシリコン層を加工することで形成されている。シリコン層は、SOI構造の基板の最上層に配置され、基板部111の上の埋め込み酸化層112の上に形成されている。シリコン層に、コアとなる領域を挟むように埋め込み酸化層112にまで貫通する溝を形成することで、図2の断面図に示すように、シリコン細線コア105が形成できる。なお、図2は、図1のAA’断面を示している。   The silicon thin wire core 105 is formed by processing a silicon layer of an SOI structure substrate. The silicon layer is disposed on the uppermost layer of the SOI structure substrate, and is formed on the buried oxide layer 112 on the substrate portion 111. By forming a groove penetrating to the buried oxide layer 112 so as to sandwich a core region, a silicon fine wire core 105 can be formed as shown in the cross-sectional view of FIG. FIG. 2 shows the AA ′ cross section of FIG. 1.

また、図1に示す導波路型センサでは、図3,4,5,6の断面図にも示すように、まず、金属材料から構成された電位均一化配線106,シリコンからなるコア電圧印加部(電圧印加部)121からなる電位印加手段を設け、シリコン細線コア105と周囲電極113との間に電位を印加することを可能としている。電位印加配線106とコア電圧印加部121とは、オーミック接続している。電位均一化配線106には端子108が接続し、周囲電極113には端子114が接続している。コア電圧印加部121は、シリコン細線コア105への光閉じ込め効果を大きくするため、シリコン細線コア105より薄く形成し、シリコン細線コア105に対する有効屈折率を小さくする。なお、図3,4,5,6は、各々、図1のBB’,CC’,DD’EE’断面を示している。   Further, in the waveguide type sensor shown in FIG. 1, as shown in the cross-sectional views of FIGS. 3, 4, 5 and 6, first, the potential equalization wiring 106 made of a metal material and the core voltage application unit made of silicon. A potential applying means including a (voltage applying unit) 121 is provided, and a potential can be applied between the silicon fine wire core 105 and the surrounding electrode 113. The potential application wiring 106 and the core voltage application unit 121 are ohmically connected. A terminal 108 is connected to the potential equalization wiring 106, and a terminal 114 is connected to the peripheral electrode 113. The core voltage application unit 121 is formed thinner than the silicon fine wire core 105 in order to increase the light confinement effect on the silicon fine wire core 105, and the effective refractive index with respect to the silicon fine wire core 105 is reduced. 3, 4, 5, and 6 show cross sections BB ′, CC ′, and DD′EE ′ in FIG. 1, respectively.

コア電圧印加部121は、シリコン細線コア105に接触して設けられている。図1に示す光導波路型センサでは、複数のコア電圧印加部121が設けられている。複数のコア電圧印加部121は、電位均一化配線106を介して端子108に接続している。これらは、スポットサイズ変換領域に配置され、電位均一化配線106は、上部クラッド層107に覆われている。なお、一部のコア電圧印加部121が、検出領域からスポットサイズ変換領域にわたって配設されている。   The core voltage application unit 121 is provided in contact with the silicon fine wire core 105. In the optical waveguide sensor shown in FIG. 1, a plurality of core voltage application units 121 are provided. The plurality of core voltage application units 121 are connected to the terminal 108 through the potential equalization wiring 106. These are arranged in the spot size conversion region, and the potential equalization wiring 106 is covered with the upper clad layer 107. A part of the core voltage application unit 121 is arranged from the detection region to the spot size conversion region.

一方、周囲電極113は、両端がスポットサイズ変換領域にまで延在し、スポットサイズ変換領域の部分は、上部クラッド層107に覆われている。また、周囲電極113の上部クラッド層107に覆われている一部は、図5にも示すように、上部クラッド層107の上に設けられた端子114に接続している。この周囲電極113には、高濃度に不純物が導入され、これの所定領域に設けられた接続部分にオーミック接続する金属層113aが形成され、金属層113aに端子114が接続されている。   On the other hand, both ends of the peripheral electrode 113 extend to the spot size conversion region, and the portion of the spot size conversion region is covered with the upper cladding layer 107. A part of the peripheral electrode 113 covered with the upper clad layer 107 is connected to a terminal 114 provided on the upper clad layer 107 as shown in FIG. Impurities are introduced into the peripheral electrode 113 at a high concentration, and a metal layer 113a that is ohmic-connected to a connection portion provided in a predetermined region thereof is formed. A terminal 114 is connected to the metal layer 113a.

これらの構成により、シリコン細線コア105と周囲電極113との間に電位を印加することを可能とし、検出領域に接触する試料溶液中において、シリコン細線コア105と周囲電極113との間で、電気泳動を起こさせることを可能としている。なお、周囲電極113は、コの字状に検出領域のシリコン細線コア105を覆う必要はなく、検出領域においてシリコン細線コア105の周囲に配置されているようにすればよい。   With these configurations, it is possible to apply a potential between the silicon fine wire core 105 and the surrounding electrode 113, and in the sample solution that is in contact with the detection region, an electric potential is generated between the silicon fine wire core 105 and the surrounding electrode 113. It is possible to cause electrophoresis. The peripheral electrode 113 does not need to cover the silicon fine wire core 105 in the detection region in a U shape, and may be arranged around the silicon fine wire core 105 in the detection region.

また、スポットサイズ変換領域において、シリコン細線コア105の両端は、先端に行くほど幅が狭くなる先細りの形状となり、図5,7の断面図にも示すように、上部及び側部をスポットサイズ変換コア103,104に覆われ、この領域がスポットサイズ変換部となる。スポットサイズ変換コア103,104は、高さ,幅が、光ファイバーコア201,301の半分程度からほぼ同程度までの寸法となっている。図7は、図1のFF’断面である。   In the spot size conversion region, both ends of the silicon fine wire core 105 have a tapered shape that becomes narrower toward the tip. As shown in the cross-sectional views of FIGS. Covered by the cores 103 and 104, this area becomes a spot size conversion unit. The spot size conversion cores 103 and 104 are about half the height and width of the optical fiber cores 201 and 301 to approximately the same size. FIG. 7 is a FF ′ cross section of FIG. 1.

スポットサイズ変換領域においては、「シリコン細線コア105の屈折率>スポットサイズ変換コア103,104の屈折率>上部クラッド層107の屈折率」となっている。このように構成したスポットサイズ変換領域により、光ファイバー200を導波してきた赤外線を、損失を低減した状態でスポットサイズを変換し、シリコン細線コア105の一端に結合させることを可能としている。
また、光ファイバー200、300の端部が固定される領域では、図8の断面図に示すように、基板部111に設けられたV字状の溝101,102に、例えば紫外線硬化型の接着剤などにより固定されている。図8は、図1のGG’断面を示している。
In the spot size conversion region, “refractive index of silicon fine wire core 105> refractive index of spot size conversion cores 103 and 104> refractive index of upper cladding layer 107”. The spot size conversion region configured as described above enables infrared light guided through the optical fiber 200 to be converted into a spot size with a reduced loss and coupled to one end of the silicon fine wire core 105.
Further, in the region where the end portions of the optical fibers 200 and 300 are fixed, as shown in the sectional view of FIG. 8, for example, an ultraviolet curable adhesive is provided in the V-shaped grooves 101 and 102 provided in the substrate portion 111. It is fixed by. FIG. 8 shows a GG ′ cross section of FIG.

なお、シリコン細線コア105,周囲電極113,及びコア電圧印加部121の露出する領域には、膜厚が数nmの酸化膜を設けるようにしてもよい。この酸化膜は、例えば熱酸化法により形成すればよい。酸化膜を形成しておくことで、コアなどの表面を保護するとともに、表面を親水性として分析対象の溶液などとの良好な密着性を得ることが可能となる。酸化膜(SiO2膜)は、シリコンより屈折率が小さいため、シリコン細線コア105による導波路としての機能を阻害することがない。 Note that an oxide film having a thickness of several nanometers may be provided in the exposed regions of the silicon fine wire core 105, the peripheral electrode 113, and the core voltage application unit 121. This oxide film may be formed by a thermal oxidation method, for example. By forming the oxide film, it is possible to protect the surface of the core and the like and obtain good adhesion to the solution to be analyzed by making the surface hydrophilic. Since the oxide film (SiO 2 film) has a refractive index smaller than that of silicon, the function of the silicon fine wire core 105 as a waveguide is not hindered.

また、例えば、界面活性剤などを用いることにより、シリコン細線コア105の表面を界面活性の高い状態とすることで、分析対象の溶液などとの良好な密着性を得るようにしてもよい。また、シリコン細線コア105の表面に、酸化チタンなどの超親水性薄膜(膜厚10nm以下)を形成するようにしてもよい。このことにより、親水性が高い状態が得られるととともに、より低い電圧で電気泳動現象を誘起できるようになる。   Further, for example, by using a surfactant or the like, the surface of the silicon fine wire core 105 may be brought into a state having a high surface activity, thereby obtaining good adhesion with a solution to be analyzed. Further, a super hydrophilic thin film (thickness 10 nm or less) such as titanium oxide may be formed on the surface of the silicon fine wire core 105. As a result, a state with high hydrophilicity can be obtained, and an electrophoresis phenomenon can be induced at a lower voltage.

次に、上述した光導波路型センサの製造方法について、簡単に説明する。
まず、SOI(Silicon on Insulator)基板を用意する。SOI基板は、埋め込み絶縁層(埋め込み酸化層)の上のシリコン層(単結晶シリコン層)が、高抵抗p形あるいは高抵抗n形であればよい。また、シリコン層は、所望の厚さより薄い高抵抗p形の単結晶シリコン層の上に、ノンドープの単結晶シリコンを結晶成長させて所望の厚さとしたものでもよい。同様に、シリコン層は、所望の厚さより薄い高抵抗n形の単結晶シリコン層の上に、ノンドープの単結晶シリコンを結晶成長させて所望の厚さとしたものでもよい。
Next, a method for manufacturing the above-described optical waveguide sensor will be briefly described.
First, an SOI (Silicon on Insulator) substrate is prepared. In the SOI substrate, the silicon layer (single crystal silicon layer) on the buried insulating layer (buried oxide layer) may be a high resistance p-type or a high resistance n-type. Further, the silicon layer may be formed by growing a non-doped single crystal silicon on a high resistance p-type single crystal silicon layer thinner than a desired thickness to a desired thickness. Similarly, the silicon layer may have a desired thickness obtained by crystal growth of non-doped single crystal silicon on a high resistance n-type single crystal silicon layer thinner than the desired thickness.

上述したようなSOI基板を用意したら、シリコン層を、公知のリソグラフィ技術とエッチング技術とにより微細加工し、シリコン細線コア105及び周囲電極113となるパターンを、厚さ方向に途中まで形成する。エッチングを途中で停止することで、上記パターンを途中まで形成した後、上記パターンを形成するためのマスクパターンに加え、新たに、コア電圧印加部121を形成するためのマスクパターンを、途中までエッチングされたシリコン層の上に形成する。   When the SOI substrate as described above is prepared, the silicon layer is finely processed by a known lithography technique and etching technique, and a pattern that becomes the silicon fine wire core 105 and the peripheral electrode 113 is formed halfway in the thickness direction. After the etching is stopped halfway, the pattern is formed halfway, and in addition to the mask pattern for forming the pattern, a new mask pattern for forming the core voltage application unit 121 is etched halfway. Formed on the formed silicon layer.

この後、すでに形成されているマスクパターンと新たに形成したマスクパターンとをマスクとし、残っているシリコン層を選択的にエッグすることで、図9の平面図に示すように、埋め込み酸化層112の上に、シリコン細線コア105,周囲電極113及びコア電圧印加部121を形成する。スポットサイズ変換領域では、シリコン細線コア105の先端部分の先細りとなるようにする。また、光ファイバー200、300が固定されるファイバー固定領域では、シリコン層を除去して埋め込み酸化層112を露出させる。   Thereafter, the remaining silicon layer is selectively egged using the already formed mask pattern and the newly formed mask pattern as a mask, so that the buried oxide layer 112 is formed as shown in the plan view of FIG. A silicon thin wire core 105, a peripheral electrode 113, and a core voltage application unit 121 are formed thereon. In the spot size conversion region, the tip of the silicon thin wire core 105 is tapered. Further, in the fiber fixing region where the optical fibers 200 and 300 are fixed, the silicon layer is removed and the buried oxide layer 112 is exposed.

ここで、形成したシリコンのパターンの露出面に、例えば熱酸化法により、数nm程度の膜厚の酸化膜を形成するようにしてもよい。
次に、図9の点線で囲う領域901と周囲電極113とに、選択的にイオン注入し、コア電圧印加部121の一部には、高濃度不純物領域を形成し、周囲電極113には高い導電性を与える。上記シリコン層がn形のときは、リンあるいはヒ素を不純物としてイオン注入し、シリコン層がp形のときは、ホウ素を不純物としてイオン注入すればよい。イオン注入をした後、例えば900℃程度に加熱し、イオン注入した領域の活性化と損傷の回復とを行う。
Here, an oxide film having a thickness of about several nm may be formed on the exposed surface of the formed silicon pattern by, for example, thermal oxidation.
Next, ions are selectively implanted into the region 901 surrounded by the dotted line in FIG. 9 and the surrounding electrode 113, a high concentration impurity region is formed in a part of the core voltage application unit 121, and the surrounding electrode 113 is high. Gives conductivity. When the silicon layer is n-type, phosphorus or arsenic may be ion-implanted as an impurity, and when the silicon layer is p-type, boron may be ion-implanted. After the ion implantation, the substrate is heated to about 900 ° C., for example, to activate the ion implanted region and recover from damage.

次いで、ECRプラズマCVD法によるステンシルマスクを用いた選択的な堆積により、スポットサイズ変換領域におけるシリコン細線コア105を覆うシリコン酸窒化膜を形成する。このシリコン酸窒化膜を、公知のリソグラフィ技術とエッチング技術とにより微細加工し、図10の平面図に示すように、スポットサイズ変換コア103,104を形成する。   Next, a silicon oxynitride film that covers the silicon thin wire core 105 in the spot size conversion region is formed by selective deposition using a stencil mask by ECR plasma CVD. The silicon oxynitride film is finely processed by a known lithography technique and etching technique to form spot size conversion cores 103 and 104 as shown in the plan view of FIG.

さらに、蒸着法あるいはスパッタ法によるステンシルマスクを用いた選択的な堆積により、例えばアルミニウムなどの金属材料の膜を形成し、電位均一化配線106を形成し、同時に、周囲電極113の所定箇所に金属層113aを形成する。前述したように、図9に示した領域901においては、n形もしくはp形の不純物が高濃度に添加されているので、領域901においてコア電圧印加部121と電位均一化配線106とは、オーミックコンタクトが形成される。   Furthermore, a film of a metal material such as aluminum is formed by selective deposition using a stencil mask by vapor deposition or sputtering, and a potential uniformizing wiring 106 is formed. At the same time, a metal is formed at a predetermined position of the peripheral electrode 113. Layer 113a is formed. As described above, since the n-type or p-type impurity is added at a high concentration in the region 901 shown in FIG. 9, the core voltage application unit 121 and the potential uniforming wiring 106 in the region 901 are ohmic. A contact is formed.

同様に、n形もしくはp形の不純物が高濃度に添加されている周囲電極113に形成された金属層113も、周囲電極113との接触部分は、オーミックコンタクトが形成される。なお、周囲電極113の全域に不純物を高濃度に添加する必要はなく、金属層113aを形成する領域に高濃度に不純物を導入するようにしてもよい。ただし、周囲電極113の全域に不純物を高濃度に添加することで、周囲電極113における導電性をより高くすることができ、より低い電圧で電気泳動現象を誘起できるようになる。   Similarly, the metal layer 113 formed on the peripheral electrode 113 to which an n-type or p-type impurity is added at a high concentration also forms an ohmic contact at the contact portion with the peripheral electrode 113. Note that it is not necessary to add impurities to the entire area of the peripheral electrode 113 at a high concentration, and impurities may be introduced at a high concentration into a region where the metal layer 113a is formed. However, by adding an impurity to the entire area of the peripheral electrode 113 at a high concentration, the conductivity of the peripheral electrode 113 can be increased, and the electrophoresis phenomenon can be induced at a lower voltage.

次に、図11に示すように、スポットサイズ変換領域において、スポットサイズ変換コア103,104,及び電位均一化配線106を覆うように、上部クラッド層107となるシリコン酸化膜を選択的に形成する。このシリコン酸化膜の形成も、ECRプラズマCVD法によるステンシルマスクを用いた選択的な堆積により行う。   Next, as shown in FIG. 11, in the spot size conversion region, a silicon oxide film to be the upper clad layer 107 is selectively formed so as to cover the spot size conversion cores 103 and 104 and the potential equalization wiring 106. . This silicon oxide film is also formed by selective deposition using a stencil mask by ECR plasma CVD.

次いで、公知のリソグラフィ技術とエッチング技術とにより、上部クラッド層107の所定領域に開口部を形成し、電位均一化配線106に到達する貫通孔1101と金属層113aに到達する貫通孔1102を形成する。この後、貫通孔1101を介して電位均一化配線106に接続する金属の層を形成することで端子108を形成し、貫通孔1102を介して金属層113aに接続する金属の層を形成することで端子114を形成する。   Next, an opening is formed in a predetermined region of the upper cladding layer 107 by a known lithography technique and etching technique, and a through hole 1101 reaching the potential uniforming wiring 106 and a through hole 1102 reaching the metal layer 113a are formed. . Thereafter, a metal layer connected to the potential equalization wiring 106 through the through hole 1101 is formed to form the terminal 108, and a metal layer connected to the metal layer 113a through the through hole 1102 is formed. Then, the terminal 114 is formed.

次に、検出領域及びスポットサイズ変換領域を覆うマスクパターンを形成し、このマスクパターンをマスクとしたエッチングを行い、スポットサイズ変換領域の垂直な入射端面及び出射端面を形成し、また、ファイバー固定領域の埋め込み酸化層112を選択的に除去する。このエッチングでは、例えばリアクティブイオンエッチングなど、垂直異方性を有するドライエッチング技術を用いればよい。   Next, a mask pattern covering the detection area and the spot size conversion area is formed, and etching is performed using the mask pattern as a mask to form a vertical incident end face and an output end face of the spot size conversion area, and a fiber fixing area. The buried oxide layer 112 is selectively removed. In this etching, a dry etching technique having vertical anisotropy such as reactive ion etching may be used.

最後に、ファイバー固定領域において、露出している基板部111の所定領域に、V字状の溝101,102を形成する。これらの溝は、例えば、開口部の間隔を徐々に広げた複数のマスクパターンによる選択的なエッチングを、繰り返すことで形成できる。また、基板部111として(111)面の単結晶シリコンを用いれば、水酸化カリウムなどのアルカリ溶液によるウエットエッチングで、自動的にV字状の溝が形成できる。   Finally, V-shaped grooves 101 and 102 are formed in a predetermined region of the exposed substrate portion 111 in the fiber fixing region. These grooves can be formed, for example, by repeating selective etching with a plurality of mask patterns in which the interval between the openings is gradually widened. Further, if (111) plane single crystal silicon is used as the substrate portion 111, a V-shaped groove can be automatically formed by wet etching with an alkaline solution such as potassium hydroxide.

以上に説明した光導波路型センサによる分析方法の一例について、簡単に説明する。本センサによる分析では、図12に示すように、試料となる溶液を滴下して検出領域に試料の溶液が保持され、試料がシリコン細線コア105及び周囲電極113の両方に接触した状態とする。この状態で、シリコン細線コア105側を接地電位とし、周囲電極113にプラス電位を印加することで、図12に示すように、試料となる溶液中の成分を電気泳動により分離し、シリコン細線コア105の領域における分析対象物質の濃度を高くすることが可能となる。   An example of the analysis method using the optical waveguide sensor described above will be briefly described. In the analysis by this sensor, as shown in FIG. 12, the sample solution is dropped to hold the sample solution in the detection region, and the sample is in contact with both the silicon fine wire core 105 and the surrounding electrode 113. In this state, the silicon fine wire core 105 side is set to the ground potential, and a positive potential is applied to the peripheral electrode 113, so that the components in the sample solution are separated by electrophoresis as shown in FIG. It is possible to increase the concentration of the analysis target substance in the region 105.

例えば、シリコン細線コア105の近傍における陽イオンの濃度を高くした状態で、分析をすることができる。例えば、血液中のタンパク質は、構成要素であるアミノ酸が各々pHにより荷電状態が異なり、荷電状態の差を利用して電気泳動法により分画可能である(文献:”最新電気泳動実験法”日本電気泳動学会編、医歯薬出版株式会社、2003年発行)。本実施の形態によれば、これらタンパク質の分析が可能となる。
また例えば、試料溶液中に、測定対象物質に対する妨害物質が高濃度に存在している場合、妨害物質がイオンの状態で存在していれば、シリコン細線コア105より遠ざかるように電圧を印加させることで、妨害物質による影響を低減することができる。
For example, the analysis can be performed in a state where the concentration of cations in the vicinity of the silicon fine wire core 105 is increased. For example, proteins in blood have different charge states depending on the pH of amino acids that are constituent elements, and can be fractionated by electrophoresis using the difference in charge states (Reference: "Latest Electrophoresis Experiment Method" Japan The Electrophoresis Society, Bio-Dental Publishing Co., Ltd., published in 2003). According to the present embodiment, analysis of these proteins becomes possible.
In addition, for example, when the interfering substance with respect to the measurement target substance is present in the sample solution in a high concentration, the voltage is applied so as to move away from the silicon fine wire core 105 if the interfering substance exists in an ionic state. Thus, the influence of the interfering substance can be reduced.

このように、シリコン細線コア105の近辺における分析対象物質の濃度を高くすることができるので、図1に示す光導波路型センサによれば、検出感度を向上させることができる。また、本実施の形態では、シリコン細線コア105及び周囲電極113の表面に酸化膜を形成することで親水性としてあるため、これらの表面に接触する試料となる溶液は、対流などの動きが束縛されるようになり、電気泳動による分離がより容易となる。   Thus, since the concentration of the substance to be analyzed in the vicinity of the silicon thin wire core 105 can be increased, the detection sensitivity can be improved according to the optical waveguide sensor shown in FIG. Further, in this embodiment, since the oxide film is formed on the surfaces of the silicon fine wire core 105 and the surrounding electrode 113 to make it hydrophilic, the solution that becomes a sample in contact with these surfaces is restricted in movement such as convection. Thus, separation by electrophoresis becomes easier.

なお、上述では、シリコン細線コア105としたが、化合物半導体であるGaNなど他の半導体から、検出領域のコアを形成するようにしてもよい。また、上述では、周囲電極113を、シリコン細線コア105と同一の半導体であるシリコンから構成するようにしたが、これに限るものではない。例えば、周囲電極113を、白金などの耐腐食性のある金属材料から構成するようにしてもよい。周囲電極113に金属材料を用いることで、より低い電圧で、上述した電気泳動現象を誘起できるようになる。ただし、周囲電極113をシリコン細線コア105と同一の半導体より構成することで、本光導波路型センサの製造が、異なる材料を用いる場合に比較してより容易になる。   In the above description, the silicon thin wire core 105 is used. However, the core of the detection region may be formed from another semiconductor such as GaN which is a compound semiconductor. In the above description, the peripheral electrode 113 is made of silicon, which is the same semiconductor as the silicon fine wire core 105, but is not limited thereto. For example, the surrounding electrode 113 may be made of a corrosion-resistant metal material such as platinum. By using a metal material for the peripheral electrode 113, the above-described electrophoresis phenomenon can be induced at a lower voltage. However, by forming the peripheral electrode 113 from the same semiconductor as the silicon thin wire core 105, it becomes easier to manufacture the optical waveguide sensor as compared with the case where a different material is used.

また、図1では、電位均一化配線106とコア電圧印加部121とにより、シリコン細線コア105に電位を印加する構成としたが、これに限るものではない。電位印加手段により印加する電位が、シリコン細線コア105以外で試料となる溶液に印加されなければ、他の構成とした電位印加手段により、シリコン細線コア105に電位を印加する構成としてもよい。例えば、下部クラッド層となる埋め込み酸化層112の側より、シリコン細線コア105に接続する配線を設けることで、シリコン細線コア105に電位を印加する構成としてもよい。   In FIG. 1, the potential equalization wiring 106 and the core voltage application unit 121 are used to apply a potential to the silicon thin wire core 105. However, the present invention is not limited to this. If the potential applied by the potential applying means is not applied to the sample solution other than the silicon fine wire core 105, a potential may be applied to the silicon fine wire core 105 by another potential applying means. For example, a potential may be applied to the silicon fine wire core 105 by providing a wiring connected to the silicon fine wire core 105 from the side of the buried oxide layer 112 serving as the lower cladding layer.

本発明の実施の形態における光導波路型センサの構成例を示す平面図である。It is a top view which shows the structural example of the optical waveguide type sensor in embodiment of this invention. 実施の形態における光導波路型センサの一部構成例を示す断面図である。It is sectional drawing which shows the partial structural example of the optical waveguide type sensor in embodiment. 実施の形態における光導波路型センサの一部構成例を示す断面図である。It is sectional drawing which shows the partial structural example of the optical waveguide type sensor in embodiment. 実施の形態における光導波路型センサの一部構成例を示す断面図である。It is sectional drawing which shows the partial structural example of the optical waveguide type sensor in embodiment. 実施の形態における光導波路型センサの一部構成例を示す断面図である。It is sectional drawing which shows the partial structural example of the optical waveguide type sensor in embodiment. 実施の形態における光導波路型センサの一部構成例を示す断面図である。It is sectional drawing which shows the partial structural example of the optical waveguide type sensor in embodiment. 実施の形態における光導波路型センサの一部構成例を示す断面図である。It is sectional drawing which shows the partial structural example of the optical waveguide type sensor in embodiment. 実施の形態における光導波路型センサの一部構成例を示す断面図である。It is sectional drawing which shows the partial structural example of the optical waveguide type sensor in embodiment. 実施の形態における光導波路型センサの製造過程を示す平面図である。It is a top view which shows the manufacturing process of the optical waveguide type sensor in embodiment. 実施の形態における光導波路型センサの製造過程を示す平面図である。It is a top view which shows the manufacturing process of the optical waveguide type sensor in embodiment. 実施の形態における光導波路型センサの製造過程を示す平面図である。It is a top view which shows the manufacturing process of the optical waveguide type sensor in embodiment. 実施の形態における光導波路型センサを用いた分析過程を説明するための説明図である。It is explanatory drawing for demonstrating the analysis process using the optical waveguide type sensor in embodiment.

符号の説明Explanation of symbols

101,102…溝、103,104…スポットサイズ変換コア、105…シリコン細線コア、106…電位均一化配線、107…上部クラッド層、108…端子、111…基板部、112…埋め込み酸化層、113…周囲電極、113a…金属層、114…端子、121…コア電圧印加部、200,300…光ファイバー、201,301…光ファイバーコア。
DESCRIPTION OF SYMBOLS 101,102 ... Groove, 103,104 ... Spot size conversion core, 105 ... Silicon fine wire core, 106 ... Electric potential equalization wiring, 107 ... Upper clad layer, 108 ... Terminal, 111 ... Substrate part, 112 ... Embedded oxide layer, 113 ... Ambient electrode, 113a ... Metal layer, 114 ... Terminal, 121 ... Core voltage application unit, 200,300 ... Optical fiber, 201,301 ... Optical fiber core.

Claims (7)

下部クラッド層と、
この下部クラッド層の上に形成されて少なくとも一部の面が露出した半導体からなるコアと、
このコアから構成された導波路の光入射端と、
前記導波路の光出射端と、
前記コアの配設された領域と所定距離離間して設けられた周囲電極と、
前記コアと前記周囲電極との間に電位を印加するための電位印加手段と
を少なくとも備え、
前記導波路は、シングルモード導波路であり、
前記コアの露出した面と前記周囲電極とに分析対象物が接触する
ことを特徴とする光導波路型センサ。
A lower cladding layer;
A core made of a semiconductor formed on the lower cladding layer and having at least a part of the surface exposed;
A light incident end of a waveguide composed of this core;
A light exit end of the waveguide;
A peripheral electrode provided at a predetermined distance from the region where the core is disposed;
At least a potential applying means for applying a potential between the core and the surrounding electrode,
The waveguide is a single mode waveguide,
An optical waveguide sensor, wherein an object to be analyzed is in contact with the exposed surface of the core and the surrounding electrode.
請求項1記載の光導波路型センサにおいて、
前記コアの露出した面に形成された酸化膜
を備えることを特徴とする光導波路型センサ。
The optical waveguide sensor according to claim 1, wherein
An optical waveguide sensor comprising an oxide film formed on an exposed surface of the core.
請求項1または2記載の光導波路型センサにおいて、
前記周囲電極は、前記コアの配設された領域の周囲を囲うように設けられた
ことを特徴とする光導波路型センサ。
The optical waveguide sensor according to claim 1 or 2,
The optical waveguide sensor, wherein the peripheral electrode is provided so as to surround a periphery of a region where the core is disposed.
請求項1〜3のいずれか1項に記載の光導波路型センサにおいて、
前記コア及び周囲電極は、同一の材料から構成されたものである
ことを特徴とする光導波路型センサ。
In the optical waveguide type sensor according to any one of claims 1 to 3,
The core and the surrounding electrode are made of the same material. An optical waveguide sensor, wherein:
請求項4記載の光導波路型センサにおいて、
前記周囲電極の露出した面に形成された酸化膜
を備えることを特徴とする光導波路型センサ。
The optical waveguide sensor according to claim 4, wherein
An optical waveguide sensor comprising an oxide film formed on an exposed surface of the peripheral electrode.
請求項1〜3のいずれか1項に記載の光導波路型センサにおいて、
前記周囲電極は、金属から構成されたものである
ことを特徴とする光導波路型センサ。
In the optical waveguide type sensor according to any one of claims 1 to 3,
The surrounding electrode is made of a metal. An optical waveguide sensor characterized in that:
請求項1〜6のいずれか1項に記載の光導波路型センサにおいて、
前記電位印加手段は、前記コアに直接接触する前記コアと同一材料からなる電圧印加部と、
この電圧印加部にオーミック接続する金属配線と
から構成されたものであることを特徴とする光導波路型センサ。
In the optical waveguide sensor according to any one of claims 1 to 6,
The potential application means includes a voltage application unit made of the same material as the core that is in direct contact with the core;
An optical waveguide sensor comprising: a metal wiring that is ohmic-connected to the voltage application unit.
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