JP2004101981A - 暗号演算回路 - Google Patents
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Abstract
【解決手段】Feistel型暗号アルゴリズムを実装した暗号演算回路は、非線形関数Fを演算する関数演算部24と、暗号化データの出力の後に、関数演算部24へ暗号演算結果とは無関係の乱数データを供給する手段とを備える。
【選択図】 図4
Description
【発明の属する技術分野】
本発明は、Feistel型アルゴリズムを実装した暗号演算回路に関し、特に、電力解析攻撃に対する耐性を持った暗号化演算回路に関する。
【0002】
【従来の技術】
暗号演算回路に対して演算処理中の消費電力に関するグラフを作成し、その消費電力グラフを用いて、暗号演算回路に納められている鍵情報を取り出すという電力解析攻撃(DPA: Differential Power Analysis) 法がある。
【0003】
DPA法は、まず、複数のデータをそれぞれ暗号演算回路に入力し、それぞれの消費電力を測定する。次に、暗号演算回路内にある鍵情報の推定を行う。このとき、推定した鍵情報と消費電力グラフに相関がある場合、計算されたその相関値は、推定した鍵情報が正しい時には大きな値となり、推定した鍵情報が間違っている時には小さな値となる。DPA法は、この原理を用いて、消費電力を測定することにより暗号演算回路内部の鍵情報を取り出すという攻撃方法である。
【0004】
DPA法は、破壊行為を伴わない攻撃であるため、外見を見ただけでは攻撃によって鍵情報が取り出されたかどうか判断できず、不正利用による被害が拡大する恐れがある。このため、暗号演算回路において、DPA法への対策が必須となってきている。
【0005】
DPA法に対する対策の一つとして、演算中のデータをマスクして演算する発明があった(例えば、特許文献1参照)。この発明は、鍵情報を用いた演算中の消費電力の変動が鍵情報と関係しないように、鍵情報をマスクして演算を行なうというものである。この発明は、鍵情報をマスクして演算することで、鍵情報と消費電力との相関関係を失わせるようにして、DPA法対策を行ったものである。
【0006】
【特許文献1】特開2000−66585公報
【0007】
【発明が解決しようとする課題】
ところで、共通鍵ブロック暗号方式では、Feistel氏の開発したFeistel型暗号アルゴリズムを用いたものが多く採用されている。
【0008】
従来の技術欄で説明した、特開2000−66585公報の発明は、このFeistel型暗号アルゴリズムを実装した暗号演算回路において、演算終了時点のDPA法の対策として有効であるが、演算終了の後の回路動作に対して行われるDPA法に対する対策では無かった。
【0009】
そこで、本発明は、このような問題点に鑑みなされたものであり、Feistel型暗号アルゴリズムを実装した暗号演算回路の演算終了の後に行われるDPA法の対策を実現した暗号演算回路を提供することを目的とする。
【0010】
【課題を解決するための手段】
上記目的を達成するために、本発明は、所定ビット数の第1データブロックと鍵情報とを所定の非線形関数Fへ作用させた結果得られる結果値と該所定ビット数の第2データブロックとを論理演算して結果値を得て、前記第2データブロックを第1データブロックと置き換えるとともに、前記第1データブロックを前記結果値と置き換える攪拌ステップを繰り返し実行することにより、暗号化処理を行って、該処理結果を暗号化データとして外部へ出力する暗号演算回路であって、前記非線形関数Fを作用させるための前記鍵情報を前記暗号化処理とは無関係の情報として供給する手段を備え、前記暗号化データの出力の後に、前記供給する手段によって始するようにした。
【0011】
また、本発明は、所定ビット数の第1データブロックと鍵情報とを所定の非線形関数Fへ作用させた結果得られる結果値と該所定ビット数のデータブロックとを論理演算して結果値を得て、前記第2データブロックを第1データブロックと置き換えるとともに、前記第1データブロックを前記結果値と置き換える攪拌ステップを繰り返し実行することにより、暗号化処理を行って、該処理結果を暗号化データとして外部へ出力する暗号演算回路であって、前記第1データブロックを保持する保持手段と、この保持手段へ前記暗号化処理とは無関係の情報を供給する手段を備え、前記暗号化データの出力の後には、前記供給する手段によって供給を開始するようにした。
【0012】
本発明は、例えば、Feistel型暗号アルゴリズムを実装した暗号演算回路の信号線の遷移や信号線の値に着目し、それぞれにおいてDPA法により攻撃されうるタイミングと攻撃ポイントを明確にして、上記のように対策するようにしたから、DPA法による攻撃に対して暗号演算回路の内部にある鍵情報の漏洩を防ぐことができる。
【0013】
【発明の実施の形態】
以下、本発明の実施の形態について、図面を用いて詳細に説明する。
【0014】
まず、Feistel型暗号アルゴリズムについて、その処理の流れを図1のフローチャートを用いて簡単に説明する。
【0015】
まず、暗号化する入力ブロックデータは、初期転値(IP:Initial Permutation)と呼ばれる、入力ブロックデータのビット間のデータを並び換える処理が施される(ステップS1)。次に、この初期転値後のブロックデータをn/2ビットのブロックに分割する(ステップS2)。この分割された2つのブロックを初期値とし、以下の演算を繰り返す(ステップS3、S4)。
Li=Ri−1
Ri=Li−1^F(keyi、Ri−1)
ここで、演算回数をi(1≦i≦k)、i回目の演算時の一方の分割されたブロック(右側)をRi、他方のブロック(左側)をLi、i回目の鍵情報をkeyi、非線形演算を行なう関数をFとする。また、「^」は、排他的論理和を示す。
【0016】
この繰り返し演算S3をk回繰り返した後(S4のY)に、各演算結果Rk、Lkを合成する(ステップS5)。なお、この合成は、Lkを上位n/2ビットのブロックに、Rkを下位n/2ビットのブロックとしたnビットのブロックデータとすることを意味する。そして、合成されたブロックデータに対し、逆初期転値(IP−1)を行ない(ステップS6)、演算結果を得て演算を終了する。
【0017】
次に、このFeistel 型暗号アルゴリズムを実装した暗号演算回路のデータパス部の構成を図2に示す。
【0018】
IP部21は、予め定められた規則に基づいて、初期転値の演算を行なう回路モジュールである。関数演算部24は、所定の非線形関数である関数Fの演算を行なう回路モジュールである。IP−1部25は、IP部21で定められた規則に相反する規則に基づいて、逆初期転値の演算を行なう回路モジュールである。Lレジスタ23、Rレジスタ22は、それぞれn/2ビット幅を持ったレジスタであり、3入力1出力のセレクタ26、27は、図示されていない制御回路部からの信号に応じて、Lレジスタ23、Rレジスタ22へ入力するデータを選択する。なお、セレクタ26への3入力とは、IP部21からの上位n/2ビットの値と、Rレジスタ22の出力値と、Lレジスタ23の出力値と関数演算部の出力値とを排他的論理和した値とであり、セレクタ27への3入力とは、IP部21からの下位n/2ビットの値と、Rレジスタ22の出力値と、Lレジスタ23の出力値と関数演算部の出力値とを排他的論理和した値とである。
【0019】
さて、以上説明した構成において処理された暗号演算結果C=(Cl、Cr)は、次式のように表すことができる。
C=IP−1{(Lk^F(keyk、Rk))、Rk}
ここで、IP−1部25は、ビット並びを入れ換えているだけであるために、演算結果CからRkの値は容易に特定される。Rkの値が特定されると、演算終了後の関数演算部24の出力値は、鍵情報keykの一変数の値のみによって決まる。以上のことから、関数演算部24の出力結果を攻撃ポイントとして、鍵情報keykを推定することにより、DPA法が行われてしまう。仮に、関数演算部24の消費電力の変動と鍵情報の演算との間に相関があった場合には、攻撃者に鍵情報を特定されてしまう。すなわち、暗号演算の終了時点で、DPA法を用いた攻撃を行なうことで、暗号演算回路内の鍵情報が取り出されてしまう。このDPA法を用いた攻撃法の対処方法としては、先に示した特開2000−66585号公報による発明によって解決できる。
【0020】
一方、Feistel型暗号アルゴリズムを回路実装した暗号演算回路においては、上記の暗号演算の終了時点での攻撃の他に、暗号演算が終了後(終了時点の次のタイミング以降)においても、DPA法を用いた攻撃を行うことで、暗号演算回路内の鍵情報が取り出されてしまう可能性があることが新たに分かった。このことを説明する前に、暗号演算回路の演算結果を出力する際のデータパス部におけるデータの制御方法には2通り有って、各制御方法によって、暗号演算の終了後のDPA法による攻撃ポイントが異なっているため、まず、2通りのデータの制御方法について説明する。
【0021】
1つめの制御方法は、演算結果を出力するタイミングにおいて、図3にあるようにセレクタ27がデータパス28を選択し、かつセレクタ26がデータパス29を選択することで、左右のデータを入れ換えた形で演算を終わらせる、クロス型回路構成である。一方、2つ目の制御方法は、演算結果を出力するタイミングにおいて、図10にあるようにセレクタ27がデータパス29を選択し、セレクタ26がデータパス28を選択することで、演算の最後において左右のデータを入れ換えないような形で演算を終わらせる、ストレート型回路構成である。
【0022】
Feistel型暗号アルゴリズムを実装した暗号演算回路において、そのアルゴリズムで定められている繰り返し演算を行なう場合、セレクタ26、セレクタ27は左右のデータが入れ替わるように、図2において図示されていない制御回路により制御される。この暗号演算回路において、演算結果を出力する場合に、特に必要がない場合は繰り返し演算を行なう場合と同様に、左右のデータが入れ替わったクロス型回路構成で演算を終了させる。このようなクロス型回路構成とする理由として、演算結果を出力するタイミング演算結果を出力するタイミングでデータの流れを変えるように制御するよりも、演算結果を出力する場合であっても、繰り返し演算を行なっているときと同様に左右のデータが入れ替わるような制御を行なった方が、制御が簡単であり制御回路の実装も小さくできるからである。
【0023】
一方、DESを3回行なうTriple DES(3DES)を実装した回路の場合には、1回目のDESの演算結果と2回目のDESの演算開始間、および2回目のDESの演算結果と3回目のDESの演算開始間において、左右のデータを入れ換えないような制御を行なう必要がある。そのため、3回目のDESが終了後も左右のデータを入れ換えずに出力するストレート型回路構成とすることが多い。このような回路構成となるのは、暗号演算回路として回路実装する場合において、その回路規模を小さくするために、演算中にできる限り場合分けを減らすような制御を行なうようにするためである。1回目、2回目が終わったときと同様に、3回目が終わったときにもストレート型回路構成となるようにセレクタ26、 セレクタ27を制御したほうが、場合分けの数が少なくなり制御回路を小さく構成することができる。
【0024】
以上説明したように、Feistel 型暗号アルゴリズムを実装した場合には、クロス型回路構成とストレート型回路構成との何れかで構成される。
【0025】
次に、これら回路構成の違いによる演算終了後におけるDPA法による攻撃ポイントについて説明する。
【0026】
まず、クロス型回路構成の場合について、DPA法により攻撃のポイントとなるタイミングと、その原因について説明する。
【0027】
演算結果を出力するクロックClockfinの立ち上がりのタイミングにおいて、Lレジスタ23の値をLfin、Rレジスタ22の値をRfinとする。このとき、この暗号演算回路の演算結果をCとすると、CはClとCrを用いてC=IP−1(Lfin^F(keyfin、Rfin)、Rfin)と表すことができる。ここで、IP−1は、ビットの並びを変換する処理だけであるため、演算結果CからRfinとLfin^F(keyfin、Rfin)の値は簡単に解ってしまう。
【0028】
次に、クロックClockfin+1において、Rレジスタ22 に値が書き込み可能である場合、Rレジスタ22の値はLfin^F(keyfin、Rfin)=Rfin+1となる。このとき、鍵情報がClockfinと同じkeyfinであるので、関数演算部24の出力はF(keyfin、Rfin+1)となる。Rfin+1は、暗号演算回路の出力結果から簡単に解ってしまう値であり、そのため、関数演算部24の関数Fは、keyfinの一変数の関数と見なすことができる。
【0029】
以上のように、関数演算部24の出力の遷移を攻撃ポイントとして、関数演算部24の出力を推定することにより鍵情報を特定されてしまうといった問題点があった。
【0030】
また、上記の他に、Lレジスタ23の値の遷移を攻撃ポイントとされる別の問題点がある。これについて説明する。
【0031】
Clockfin、Clockfin+1におけるLレジスタ23の値をLfin、Lfin+1とする。Lレジスタ23の値の遷移は次式で表すことができる。
Lfin^Lfin+1=Rfin−1^Rfin
なお、上記式の右辺は、クロス型回路構成においてLレジスタ23の値はLi=Ri−1(1≦i≦k)という関係があることから、書き変えたものである。ここで、Rfinは外部から観測可能な値であることから、Rfin−1に対して推定することができる。Lレジスタ23の遷移は、暗号演算回路の消費電力の変動と関係があるので、DPA法によりRfin−1の値が特定される可能性がある。つまり、上記で述べたように演算結果Cから、Lfin^F(keyfin、Rfin)(=Rfin+1)およびRfinの値は観測可能である。ここで、Lfin=Rfin−1であることから、Rfin−1が特定されると、Rfin+1、Lfin、Rfinが知ることのできる値となるため、keyfinを特定されてしまうという問題点があった。
【0032】
以上のように、関数演算部24の出力値の遷移、または、Lレジスタ23の値の遷移において、DPA法を用いて攻撃される可能性がある。
【0033】
クロス型回路構成の場合のこれらDPA法による攻撃に対する対策は、それぞれ異なる。
【0034】
まず、このクロス型回路構成のClockfin+1のタイミングにおける関数演算部24の出力値に関するDPA対策として、本実施の形態においては、Clockfin+1のときに関数演算部24に入力される値は、鍵情報と関係のない値を入力するような回路構成とする。このような回路の具体例としては、図4に示すように関数演算部24へ鍵情報を入力する個所へ新たにセレクタを設け、Clockfinまでは鍵情報を入力し、Clockfin+1以降は乱数を入力するような回路構成や、図5にあるように関数演算部24の入力として、鍵情報と乱数を排他的論理和(XOR)演算、論理積(AND)演算、または論理和(OR)演算した値を入力する回路構成とし、Clockfin+1以降のクロックの立ち上がり時に、常に異なる乱数を与えて得た演算結果を入力するという回路構成で解決した。
【0035】
また、関数演算部24の入力として、外部から観測可能な値を入れないようにする回路構成も対策となりうる。このような対策の具体例としては、図6に示すように、関数演算部24の入力の前にセレクタを設け、Clockfin+1以降は乱数を入力するような回路構成を用いる例がある。また、図6のセレクタを用いて乱数を入れる代わりに、図7のように演算回路を追加し、Rレジスタ22の値と乱数との演算結果が、関数演算部24に入力されるような回路構成としてもよい。このようにClockfin+1以降、関数演算部24の入力として、暗号演算回路で利用した鍵情報や演算結果が、そのまま入力されないような回路構成とすることで、関数演算部24の出力におけるDPA対策とすることができる。
【0036】
このほかに、Clockfin+1以降、Rレジスタ22の値を、演算結果と無関係な値とすることで、DPA法対策ができる。例えば、図8にあるようにRレジスタ22の入力の前にセレクタを入れ、Clockfin+1以降、このセレクタから乱数がRレジスタ22に書き込まれるような回路構成や、図6のようにデータパス29の結果と乱数を演算するような回路構成とすればよい。
【0037】
以上のような対策を施した暗号演算回路とすることにより、関数演算部24の出力の遷移を攻撃のポイントとできなくなった。
【0038】
次に、Lレジスタ23の値の遷移を攻撃ポイントとした場合には、Clockfin+1のタイミングでLレジスタ23にRfin+1を書き込まないような回路構成としなければならない。この時の対策として、回路構成の具体例は、図11のようにLレジスタ23へのデータパス30上にAND/OR/XORなどの演算回路を入れ、Clockfin+1以降でデータパス30上の値と乱数の演算結果をLレジスタ23に書き込むという方法や、図12にあるようにデータパス30にセレクタを入れることでClockfin+1以降、Lレジスタ23に乱数が書き込まれるような回路構成で実現できる。
【0039】
以上のような対策を施した暗号演算回路とすることにより、Lレジスタ23の値の遷移を攻撃のポイントとできなくなった。
【0040】
次に、図10のストレート型回路構成の場合についてのDPA法による攻撃のポイントとなるタイミングとその原因について説明する。
【0041】
ストレート型回路構成においてもクロス型回路構成のときと同様に、演算結果を出力するときのクロックClockfinの立ち上がりのタイミングにおいて、Lレジスタ23の値をLfin、Rレジスタ22の値をRfinとする。Clockfinの次のクロックClockfin+1の立ち上がりのタイミングにおいて、Lレジスタ23、Rレジスタ22の値はそれぞれLfin+1、Rfin+1とすると、次式で表すことができる。
Lfin+1=Lfin^F(keyfin、Rfin)
Rfin+1=Rfin
このClockfin+1のタイミングにおいて、Lレジスタ23の値の遷移に着目すると、Lレジスタ23の値の遷移はLfin^Lfin+1=F(keyfin、Rfin)と表すことができる。Lレジスタ23の値の遷移F(keyfin、Rfin) は、鍵情報に関係する情報を含んでいるうえに、Rfinは外部から観測可能な値である。従って、Lレジスタ23の値の遷移に対し、DPA法を用いて攻撃が行われると、暗号演算回路の鍵情報keyfinが特定されてしまう。
【0042】
そのため、本実施の形態においては、Lレジスタ23の値が、Clockfin+1において暗号演算回路が持つ鍵情報と相関を持つことのないような回路構成とする。この回路構成の具体例としては、クロス型回路構成で説明した方法と同様の図12にあるようにLレジスタ23へのデータパス28上にAND、OR、XORなどの論理演算器を配置し、データパス28の値と乱数の演算結果をLレジスタ23に書き込むという方法や、図11にあるように、Clockfin+1のタイミングにて、データパス28の値と乱数とをセレクタで切り替えるという方法で実現可能である。
【0043】
また、関数演算部24にClockfin+1以降、常にkeyfinとRfinとが入力されるような回路構成の場合には、上記のクロス型回路構成の時と同様に関数演算部24の出力値の遷移によって鍵情報が特定される可能性がある。そのため、前記クロス型回路構成の関数演算部24のDPA法の対策と同様、図4〜図9の何れかを用いることによって、対策を実現できる。
【0044】
また、クロス型回路構成、ストレート回路構成の何れの場合においても、Clockfin+1においてRレジスタ22、Lレジスタ23へのデータの書き込みが行なわれず、且つ、Clockfin;1以降、常に鍵情報keyfinが関数演算部24に入力されるような回路構成が取られている場合には、関数演算部24の出力値F(keyfin、Rfin)となるので、上記のクロス型回路構成の時と同様、関数演算部24の出力値の遷移がDPA法による攻撃の対象となってしまう。従って、上記のクロス型回路構成の関数演算部24のDPA法の対策と同様、図4〜図9の何れかを用いることによって、対策を実現できる。
【0045】
以上説明してきたように、本実施の形態では、暗号演算回路の演算終了後以降において、鍵情報と消費電力の相関関係を失わせるような回路構成としたから、暗号演算回路内部にある鍵情報の漏洩を防ぐことができ、DPA法による攻撃に対する耐性を持った暗号演算回路を提供できるようになった。
【0046】
【発明の効果】
以上説明したように、本発明によれば、暗号演算回路内部にある鍵情報の漏洩を防ぐことができ、DPA法による攻撃に対する耐性を持った暗号演算回路を提供できるようになった。
【図面の簡単な説明】
【図1】Feistel型アルゴリズムを示すフローチャート。
【図2】Feistel型アルゴリズムを採用した暗号演算回路のデータパス部に関する回路構成を示す図。
【図3】クロス型回路構成のデータパス部を示す図。
【図4】本実施の形態における、関数演算部24のDPA法対策を施した回路構成の第1例を示す図。
【図5】本実施の形態における、関数演算部24のDPA法対策を施した回路構成の第2例を示す図。
【図6】本実施の形態における、関数演算部24のDPA法対策を施した回路構成の第3例を示す図。
【図7】本実施の形態における、関数演算部24のDPA法対策を施した回路構成の第4例を示す図。
【図8】本実施の形態における、関数演算部24のDPA法対策を施した回路構成の第5例を示す図。
【図9】本実施の形態における、関数演算部24のDPA法対策を施した回路構成の第6例を示す図。
【図10】ストレート型回路構成のデータパス部を示す図。
【図11】本実施の形態における、Lレジスタ23のDPA法対策を施した回路構成の第1例を示す図。
【図12】本実施の形態における、Lレジスタ23のDPA法対策を施した回路構成の第2例を示す図。
【符号の説明】
21・・・IP部
22・・・Rレジスタ
23・・・Lレジスタ
24・・・関数演算部
25・・・IP−1部
26、27・・・セレクタ
28、29、30・・・データパス
Claims (5)
- 所定ビット数の第1データブロックと鍵情報とを所定の非線形関数Fへ作用させた結果得られる結果値と該所定ビット数の第2データブロックとを論理演算して結果値を得て、前記第2データブロックを第1データブロックと置き換えるとともに、前記第1データブロックを前記結果値と置き換える攪拌ステップを繰り返し実行することにより、暗号化処理を行って、該処理結果を暗号化データとして外部へ出力する暗号演算回路であって、
前記非線形関数Fを作用させるための前記鍵情報を前記暗号化処理とは無関係の情報として供給する手段を備え、前記暗号化データの出力の後に、前記供給する手段によって開始するようにしたことを特徴とする暗号演算回路。 - 所定ビット数の第1データブロックと鍵情報とを所定の非線形関数Fへ作用させた結果得られる結果値と該所定ビット数のデータブロックとを論理演算して結果値を得て、前記第2データブロックを第1データブロックと置き換えるとともに、前記第1データブロックを前記結果値と置き換える攪拌ステップを繰り返し実行することにより、暗号化処理を行って、該処理結果を暗号化データとして外部へ出力する暗号演算回路であって、
前記第1データブロックを保持する保持手段と、
この保持手段へ前記暗号化処理とは無関係の情報を供給する手段を備え、前記暗号化データの出力の後には、前記供給する手段によって供給を開始するようにしたことを特徴とする暗号演算回路。 - 所定ビット数の第1データブロックと鍵情報とを所定の非線形関数Fへ作用させた結果得られる結果値と該所定ビット数の第2データブロックとを論理演算して結果値を得て、前記第2データブロックを第1データブロックと置き換えるとともに、前記第1データブロックを前記結果値と置き換える攪拌ステップを繰り返し実行することにより、暗号化処理を行って、該処理結果を暗号化データとして外部へ出力する暗号演算回路であって、
前記非線形関数Fを作用させるための前記鍵情報を前記暗号化処理とは無関係の情報として供給する第1供給手段と、
前記第1データブロックを保持する保持手段と、
この保持手段へ前記暗号化処理とは無関係の情報を供給する第2供給手段とを備え、
前記暗号化データの出力の後には、前記第1供給手段および前記第2供給手段によってそれぞれ供給を開始するようにしたことを特徴とする暗号演算回路。 - 非線形関数Fを処理する手段を備えるFeistel型暗号アルゴリズムを実装し、暗号化データを出力する暗号演算回路であって、
前記非線形関数Fを処理する手段へ暗号演算結果とは無関係のデータを供給する手段を備え、前記暗号化データの出力の後に、前記供給する手段によってデータ供給を開始するようにしたことを特徴とする暗号演算回路。 - Feistel型暗号アルゴリズムを実装し、暗号化データを出力する暗号演算回路であって、
暗号演算回路内の内部データを保持する保持手段と、
この保持手段へ前記暗号化処理とは無関係の情報を供給する手段とを備え、
前記暗号化データの出力の後には、前記供給する手段によって供給を開始するようにしたことを特徴とする暗号演算回路。
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