JP2004080692A - Electronic circuit - Google Patents
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Abstract
Description
【0001】
【発明の属する技術分野】
本発明は、電子回路に関し、特に、サンプリング方式の電流積算回路において、オペアンプの温度特性によるオフセットの補正時間の短縮化を図り、電流積算を高精度に行うことができるようにした電子回路に関する。
【0002】
【従来の技術】
近年、ノート型のパーソナルコンピュータに代表される情報処理装置と、その補助電源としてのバッテリー(電池)のインタフェース規格の1つとして、SBS(Smart Battery System)が提唱されている。
【0003】
このSBSの規格が採用された情報処理装置には、バッテリーパックが設けられており、このバッテリーパックには、一般的に、その充放電電流を積算する回路(以下、電流積算回路と称する)が設けられている。
【0004】
この電流積算回路は、「クーロンカウンタ方式」と称される方式が採用された回路(以下、クーロンカウンタ方式電流積算回路と称する)と、「サンプリング方式」と称される方式が採用された回路(以下、サンプリング方式電流積算回路と称する)の2つに大別される。
【0005】
クーロンカウンタ方式電流積算回路は、サンプリング方式電流積算回路に比較して、精度がよいと言われているが、その回路構成が複雑であり、かつ、その回路の部品コストも高い。従って、電流積算回路として、回路構造が簡単で部品コストが安価なサンプリング方式電流積算回路が主流となっている。
【0006】
【発明が解決しようとする課題】
しかしながら、サンプリング方式電流積算回路は、オペアンプを高ゲインで使用しているため、環境温度の変化に対するオペアンプの入力オフセットが無視できず、定期的にそのオフセットを測定して補正する必要がある。
【0007】
これは、クーロンカウンタ方式も同様であるが、サンプリング方式電流積算回路には、さらに、以下のような問題点が発生する。
【0008】
即ち、サンプリング方式電流積算回路では、変動した電流を積算する場合、オペアンプの積分定数を大きくする必要がある。それに伴い、サンプリング方式電流積算回路では、オペアンプの入力オフセットを計測する場合、その計測時間として、大きい値とされた積分定数に対応する時定数分の時間が必要になる。この計測時間は、電流積算においては、デッドタイムとなり、無視できない誤差が生じるという問題点が発生する。
【0009】
そこで、従来、この問題点の解決策として、オフセットの計測が不要になる程の高精度に設計されたオペアンプを使用する第1の解決策、および、積分定数を電流積算に対して無視できる程度に小さくする第2の解決策が考えられている。
【0010】
しかしながら、第1の解決策では、設計されたオペアンプは非常に精密で高価なものとなり、回路構造が簡単で部品コストが安価であるというサンプリング方式電流積算回路が有するメリットを生かせなくなるという課題がある。
【0011】
また、第2の解決策では、積分定数が小さいため、変動する電流を積算する場合に誤差が大きくなるという課題がある。
【0012】
即ち、上述した問題点の解決策として、上述した第1の解決策、および、第2の解決策も含めて、いまだ有効な解決策が考案されていないという課題がある。
【0013】
本発明は、このような状況に鑑みてなされたものであり、サンプリング方式の電流積算回路において、オペアンプの温度特性によるオフセットの補正時間の短縮化を図り、電流積算を高精度に行うことができるようにするものである。
【0014】
【課題を解決するための手段】
本発明の電子回路は、オペアンプ、および、そのオペアンプに接続される、1つ以上のコンデンサを含む素子群から構成され、所定の電送路を流れる電流を検出し、検出した電流に対応するアナログの値を、第1の積分定数で積分して出力する積分回路と、上述したオペアンプ、および、上述した素子群のうちの所定の一部の素子から構成され、第1の積分定数より小さい0を含む第2の積分定数で、オペアンプのオフセットを検出し、検出したオフセットに対応するアナログの値を出力するオフセット検出回路と、積分回路と、オフセット検出回路のうちのいずれか一方を選択する選択回路と、積分回路とオフセット検出回路のうちの、選択回路により選択された回路から出力されたアナログの値を、A/D変換するA/D変換回路と、A/D変換回路によりデジタル化されたデータが、積分回路の出力に対応するデータである場合、そのデータの値を積算することで、電送路を流れる電流の積算値を演算し、デジタル化されたデータが、オフセット検出回路に対応するデータである場合、そのデータの値に基づいて、オペアンプのオフセットの電圧値を演算するデジタル演算回路とを備えることを特徴とする。
【0015】
積分回路を構成する素子群は、電送路を流れる電流を検出する検出抵抗をさらに有し、選択回路は、オン状態とされた場合、検出抵抗の両端を短絡し、オフ状態とされた場合、検出抵抗の短絡を解除する第1のスイッチと、オフ状態とされた場合、電送路を積分回路から切り離し、オン状態とされた場合、電送路を積分回路に接続する第2のスイッチと、オフ状態とされた場合、素子群を構成するコンデンサのうちの所定のものを、積分回路から切り離し、オン状態とされた場合、積分回路から切り離されたコンデンサを、積分回路に接続する第3のスイッチとを有し、積分回路を選択する場合、第1のスイッチをオフ状態とし、第2のスイッチをオン状態とし、かつ、第3のスイッチをオン状態とし、オフセット検出回路を選択する場合、第1のスイッチをオン状態とし、第2のスイッチをオフ状態とし、かつ、第3のスイッチをオフ状態とするようにすることができる。
【0016】
第3のスイッチは、オフ状態とされた場合、素子群を構成する全てのコンデンサを、積分回路から切り離すようにすることができる。
【0017】
A/D変換回路、およびデジタル演算回路は、マイクロコンピュータとして構成され、マイクロコンピュータは、選択回路に対して、積分回路とオフセット検出回路のうちのいずれか一方を指定する指定情報を提供する指定手段をさらに有し、選択回路は、積分回路とオフセット検出回路のうちの、指定手段より提供された指定情報に指定されている回路を選択するようにすることができる。
【0018】
本発明の電子回路においては、オペアンプ、および、そのオペアンプに接続される、1つ以上のコンデンサを含む素子群から構成され、所定の電送路を流れる電流を検出し、検出した電流に対応するアナログの値を、第1の積分定数で積分して出力する積分回路と、上述したオペアンプ、および、上述した素子群のうちの所定の一部の素子から構成され、第1の積分定数より小さい0を含む第2の積分定数で、オペアンプのオフセットを検出し、検出したオフセットに対応するアナログの値を出力するオフセット検出回路のうちのいずれか一方が選択され、選択された回路から出力されたアナログの値を、A/D変換されて、デジタル化データとなり、そのデータが、積分回路の出力に対応するデータである場合、そのデータの値が積算されて、電送路を流れる電流の積算値が演算され、それに対して、そのデータが、オフセット検出回路に対応するデータである場合、そのデータの値に基づいて、オペアンプの入力オフセットの電圧値が演算される。
【0019】
本発明の電子回路は、情報処理装置に搭載され、その情報処理装置に流れる、若しくは供給される電流の電流値を積算してもよいし、外部の情報処理装置に流れる、若しくは供給される電流の電流値を積算してもよいし、或いは、電子回路自身を流れる、若しくは供給される電流の電流値を積算してもよい。
【0020】
【発明の実施の形態】
図1は、本発明が適用される電流積算回路の構成例を表している。
【0021】
電流積算回路1は、様々な情報処理装置に適用可能であるが、この例においては、例えば、上述したノート型パーソナルコンピュータ(図示せず)に装着されるバッテリーパック(図示せず)に内蔵され、バッテリーパックの充放電電流の電流値を積算する回路とされる。
【0022】
図1に示されるように、電流積算回路1には、電流積算アンプ回路12とマイクロコンピュータ13が設けられている。
【0023】
電流積算アンプ回路12には、所定の電送路(ケーブル)11に流れるバッテリーパックの充放電電流Iを検出する電流検出部21、電流検出部21により検出された電流Iに対応するアナログの値を、第1の積分定数で積分して出力する積分フィルタ部22、および、第1の積分定数より小さい第2の積分定数で、環境温度の変化に対するオペアンプ(後述する増幅部25)の入力オフセット(以下、単にオペアンプのオフセットと称する)を検出し、それに対応するアナログの値を出力するオフセット検出部23が設けられている。
【0024】
電流積算アンプ回路12にはまた、積分フィルタ部22の出力と、オフセット検出部23の出力のうちのいずれか一方を選択し、選択した方の出力(アナログ信号)を増幅部(オペアンプ)25に供給する選択部24、および、選択部24より供給されたアナログ信号を増幅する増幅部(オペアンプ)25が設けられている。
【0025】
即ち、電流積算アンプ回路12は、電送路11を流れる電流Iに対応するアナログの値を、第1の積分定数で積分して出力する第1のモード、および、第1の積分定数より小さい第2の積分定数で、オペアンプ25のオフセットを検出し、それに対応するアナログの値を出力する第2のモードの2つのモードを有している。
【0026】
選択部24は、この2つのモードのうちのいずれか一方を選択する。選択部24により第1のモードが選択された場合、電流積算アンプ回路12において、電流検出部21、積分フィルタ部22、選択部24、およびオペアンプ25で形成される第1の回路が動作する。
【0027】
これに対して、選択部24により第2のモードが選択された場合、電流積算アンプ回路12において、オフセット検出部23、選択部24、およびオペアンプ25で形成される第2の回路が動作する。
【0028】
なお、後述するように、第1の回路は、オペアンプ25、および、1個以上のコンデンサを含む素子群から構成され、その伝達関数には、上述した第1の積分定数が含まれる。
【0029】
第2の回路は、その第1の回路のオペアンプ25、および、素子群の中の所定の一部分から構成され、その伝達関数には、第1の積分定数より小さい、0を含む第2の積分定数が含まれる。
【0030】
マイクロコンピュータ13には、電流積算アンプ回路12のオペアンプ25より出力されたアナログ信号を、所定のタイミングでA/D変換(Analog to Digital変換)するA/D変換部26、および、上述したスイッチ24と連動して、電流積算アンプ回路12が、上述した第1のモードで動作している場合、A/D変換部26より出力されたデジタルのデータを、後述する電流積算部28に供給するように選択し、電流積算アンプ回路12が、上述した第2のモードで動作している場合、A/D変換部26より出力されたデジタルのデータを、後述するオフセット計測部29に供給するように選択する選択部27が設けられている。
【0031】
マイクロコンピュータ13にはまた、電流積算アンプ回路12が、上述した第1のモードで動作している場合、A/D変換部26より出力されたデジタルのデータを選択部27を介して取得し、それを積算することで、電送路11を流れる電流Iの積算値を演算する電流積算部28、電流積算アンプ回路12が、上述した第2のモードで動作している場合、A/D変換部26より出力されたデジタルのデータを選択部27を介して取得し、その値に基づいて、オペアンプ25のオフセットの電圧値(若しくは、それに対応する値)を計測する(演算する)オフセット計測部29、および、上述した第1のモードと、第2のモードのいずれか一方を選択し、選択したモードに対応する信号を選択部24と選択部27のそれぞれに供給するモード選択部30が設けられている。即ち、選択部24と選択部27のそれぞれは、モード選択部30より供給された信号に対応するモードに従った入出力の設定を行う。
【0032】
このように、電流積算回路1においては、電送路11を流れる電流Iの積算値を演算する第1のモードと、オペアンプ25のオフセットを計測する第2のモードの2つのモードが用意されている。そして、第1のモードが選択された場合、電流積算アンプ回路12の伝達関数には、第1の積分定数が含まれる。これに対して、第2のモードが選択された場合、電流積算アンプ回路12の伝達関数には、第1のより小さい、0も含む第2の値の積分定数が含まれる。
【0033】
即ち、第1のモードと第2のモードのそれぞれで使用される積分定数の値は、相互に独立して設定可能であり、第1の積分定数として大きな値が設定されることで、電流Iの電流変動に対する積算誤差を小さくすることが可能になる。また、第2の積分定数として小さな値が設定されることで、その第2の積分定数に対応する時定数時間が短くなり、その結果、オペアンプ25のオフセットの計測時間の短縮が可能となる。従って、オペアンプ25のオフセット誤差を高速でキャンセル処理することができ、かつ、変動している電流Iを、第1の積分定数による積分処理で積算し、誤差を小さくすることができるので、電流Iの積算値の演算を高精度に行うことが可能になる。
【0034】
以上、電流積算回路1の基本構成について説明したが、上述した構成を有するものであれば、即ち、オペアンプを有するサンプリング方式の電流積算回路であって、電流積算を行う第1のモードと、オペアンプのオフセットを計測する第2のモードの2つのモードを有し、かつ、第1のモードで使用される第1の積分と、第2のモードで使用される第2の積分定数のそれぞれの値を相互に独立して設定可能な(相互に異なる値の積分定数が含まれるように、伝達関数のそれぞれが設定可能な)電流積算回路であれば、その構成は限定されず、様々な実施の形態を取ることが可能である。
【0035】
図2は、そのような電流積算回路1の実施の形態のうちの1つの構成例を表している。
【0036】
図2の電流積算アンプ回路12において、オペアンプOPAMPの出力と逆相入力(−)の間に、抵抗R4、および、スイッチS4とコンデンサC1が直列的に接続された直列回路が、並列的に接続されている。オペアンプOPAMPの出力にはまた、マイクロコンピュータ13(図1のA/D変換部26)が接続されている。オペアンプOPAMPの逆相入力(−)にはまた、抵抗R2とスイッチS2が直列的に接続された直列回路の一端が接続されている。その直列回路の他端は、電送路11に接続されている。
【0037】
オペアンプOPAMPの正相入力(+)には、抵抗R3とスイッチS3が直列的に接続された直列回路の一端が接続されている。その直列回路の他端は、電送路11に接続されている。オペアンプOPAMPの正相入力(+)にはまた、抵抗R5、および、スイッチS5とコンデンサC2が直列的に接続された直列回路の一端が、並列的に接続されている。その直列回路の他端は、接地されている。
【0038】
抵抗R2と抵抗R3の、オペアンプOPAMPと接続されている側とは反対側のそれぞれの一端の間に、スイッチS1が接続されており、また、スイッチS2とスイッチS3の、抵抗R2または抵抗R3と接続されている側とは反対側のそれぞれの一端の間に、電送路11を流れる電流Iを電圧値として検出する検出抵抗R1が接続されている。
【0039】
次に、図2の電流積算回路1の動作を説明する。
【0040】
例えば、いま、図1において、マイクロコンピュータ13のモード選択部30が、第1のモード(電流積算モード)を選択したとする。
【0041】
この場合、マイクロコンピュータ13の選択部27は、A/D変換部26の出力を電流積算部28に供給するようにその設定を変更する(選択する)。
【0042】
電流積算アンプ回路12の選択部24は、積分フィルタ22の出力をオペアンプ25に供給するようにその設定を変更する(選択する)。図2の電流積算アンプ回路12においては、この選択部24に相当する素子が、スイッチS1乃至S5とされており、第1のモードが選択されると、スイッチS1のみがオフ状態とされ、それ以外のスイッチS2乃至S5のそれぞれがオン状態とされる。
【0043】
従って、第1のモードが選択されると、電流積算アンプ回路12は、図3に示される等価回路12−1のように形成される(等価回路12−1として動作する)。
【0044】
ただし、図3の電流積算アンプ回路の等価回路12−1においては、説明の簡略上、抵抗R4と抵抗R5の値はRに設定され(R4=R5=Rとされ)、抵抗R2と抵抗R3の値はR2に設定され(R3=R2とされ)、かつ、コンデンサC1とコンデンサC2の値はCに設定されている(C1=C2=Cとされている)。
【0045】
即ち、図3の抵抗R1が、図1の電流検出部21に相当し、図3のスイッチS2乃至S5が、図1の選択部24に相当し、かつ、図3のスイッチS2乃至S5を含む、オペアンプOPAMP、抵抗R、抵抗R2、およびコンデンサCからなる回路が、図1の積分フィルタ部22、およびオペアンプ25に相当する。
【0046】
この場合、図3の電流積算アンプ回路の等価回路12−1は、1次のローパスフィルとなるため、その伝達関数は、次の式(1)に示されるようになる。
【0047】
【数1】
【0048】
式(1)において、VoはオペアンプOPAMPの出力電圧(周波数f)を、Viは検出抵抗R1の両端の電圧を、ωは正規化周波数(=2πf)を、それぞれ表している。
【0049】
式(1)を正規化すると、次の式(2)に示されるようになる。
【0050】
【数2】
【0051】
式(2)において、ω0 =1/CRとされると、ω/ω0は、遮断周波数を表している。
【0052】
ここで、伝達関数の振幅|T|および位相θは、交流理論より次の式(3)に示されるようになる。
【0053】
【数3】
【0054】
即ち、この例においては、第1のモードが選択されると、図2の電流積算アンプ回路12は、図3に示される等価回路12−1のように形成され、ゲインGが20log|T|となり、かつ、積分定数がCRとなる積分回路として動作する。
【0055】
なお、図3の例では、上述したように、説明の簡略上、抵抗R4と抵抗R5の値はRに設定され(R4=R5=Rとされ)、抵抗R2と抵抗R3の値はR2に設定され(R3=R2とされ)、かつ、コンデンサC1とコンデンサC2の値はCに設定されたが(C1=C2=Cとされたが)、ゲイン抵抗R2乃至R5、並びに、積分コンデンサC1およびC2のそれぞれの値は、図3の例に限定されず、任意の値とすることが可能である。
【0056】
即ち、第1のモードが選択されると、図2の電流積算アンプ回路12は、ゲイン抵抗R2乃至R5、並びに、積分コンデンサC1およびC2のそれぞれの値により決定される(それらの素子の値で表される伝達関数により決定される)、所定のゲインと第1の積分定数を持った積分回路として動作する。具体的には、電送路11を流れる電流Iが検出抵抗R1の両端の電圧値として検出され、検出されたアナログの電圧値が、第1の積分定数で、図3の等価回路12−1(ただし、各ゲイン抵抗、および、各積分コンデンサのそれぞれの値は、任意に設定された値)により積分され、所定のゲインで増幅されてマイクロコンピュータ13のA/D変換部26(図11)に出力される。
【0057】
図1において、A/D変換部26は、オペアンプ25より出力されたアナログ信号を、所定のタイミングでA/D変換し、デジタルデータとして出力する。電流積算部28は、A/D変換部26より出力されたデジタルデータを選択部27を介して取得し、それを積算することで、電送路11を流れる電流Iの積算値を演算する。
【0058】
このように、ゲイン抵抗R2乃至R5、並びに、積分コンデンサC1およびC2のそれぞれの値が適切に設定されれば、第1の積分定数は大きい値に設定され、その結果、図2の電流積算アンプ回路12は、第1のモードが選択された場合、マイクロコンピュータ13のA/D変換部26(図1)のA/Dサンプリングのナイキスト周波数近傍までの電流I(それに対応する電圧値)を残らず積分出力することが可能になる。
【0059】
次に、例えば、図1において、マイクロコンピュータ13のモード選択部30が、第2のモード(オペアンプ25のオフセット計測モード)を選択したとする。
【0060】
この場合、マイクロコンピュータ13の選択部27は、A/D変換部26の出力をオフセット計測部29に供給するようにその設定を変更する(選択する)。
【0061】
電流積算アンプ回路12の選択部24は、オフセット検出部23の出力をオペアンプ25に供給するようにその設定を変更する(選択する)。図2の電流積算アンプ回路12においては、上述したように、この選択部24に相当する素子が、スイッチS1乃至S5とされており、第2のモードが選択されると、スイッチS1のみがオン状態とされ、それ以外のスイッチS2乃至S5のそれぞれがオフ状態とされる。
【0062】
従って、第2のモードが選択されると、電流積算アンプ回路12は、図4に示される等価回路12−2のように形成される(等価回路12−2として動作する)。
【0063】
ただし、図4の電流積算アンプ回路の等価回路12−2においては、説明の簡略上、抵抗R4と抵抗R5の値は同一とされ(R4=R5とされ)、かつ、抵抗R2と抵抗R3の値は同一とされている(R3=R2とされている)。
【0064】
また、R0は、オペアンプOPAMPの内部抵抗を表している。Vn、および、Vpのそれぞれは、オペアンプOPAMP内の真の入力電圧の逆相側と正相側のそれぞれを表しており、オペアンプイナジナリショートの関係から、電圧Vnと電圧Vpの値は同一となる(Vn =Vp となる)。IBnとIBpのそれぞれは、バイアス電流の逆相側と正相側のそれぞれを表しており、入力オフセット電流をIioと記述すると、Iio =IBn −IBpとされる。Voは、オペアンプOPAMPの出力電圧を表しており、Vioは、入力オフセット電圧を表している。
【0065】
即ち、図4のスイッチS1が、図1の選択部24に相当し、かつ、図4のスイッチS1を含む、オペアンプOPAMP、および、抵抗R2乃至R5からなる等価回路12−2自身が、図1のオフセット検出部23、およびオペアンプ25に相当する。
【0066】
この場合、オペアンプOPAMPの出力電圧Voには、次の式(5)に示されるような関係が成立する。
【0067】
【数4】
【0068】
R4=R5なので、式(5)は、次の式(6)に示されるようになる。
【0069】
【数5】
【0070】
式(6)において、IBn =IBpとされると、オペアンプの負帰還特性からI4=I5となり、オペアンプOPAMPの出力電圧Vo は0となる。しなしながら、オペアンプOPAMPには、入力バイアス電流(IBp,IBn)が存在し、かつ、その正相入力(+)と逆相入力(−)のそれぞれの入力電流には差があるため、Vo =0 とははならない。環境温度により内部トランジスタの特性が変化するため、入力バイアス電流(IBp,IBn)が変化し、最終的には、オペアンプOPAMPの出力電圧Voも変化してしまう。この変化量を定期的に測定し、マイクロコンピュータ13にて補正をする。
【0071】
具体的には、第2のモードが選択されると、図2の電流積算アンプ回路12は、図4の等化回路12−2として形成され、伝達関数がゲインGのみとなる回路(以下、そのような回路をゲイン回路と称する)として動作する。即ち、図4の例では、第2の積分定数が0とされ、従って、電流積算アンプ回路12(等価回路12−2)よりオペアンプOPAMPの出力電圧Voが、オペアンプOPAMPのオフセットに対応する値として高速に出力される。
【0072】
図1において、A/D変換部26は、オペアンプ25より出力されたアナログ信号を、所定のタイミングでA/D変換し、デジタルデータとして出力する。オフセット計測部29は、A/D変換部26より出力されたデジタルデータを選択部27を介して取得し、そのデジタルデータの値に基づいて、オペアンプ25(図2のオペアンプOPAMP)のオフセットの電圧値を計測する(演算する)。
【0073】
このように、図2の電流積算アンプ回路12は、第2のモード(オペアンプOPAMPのオフセット計測モード)が選択された場合、第1のモード(電流積算モード)で使用される積分素子(コンデンサ)を切り離して、第2の積分定数が0となる単なるゲイン回路として動作するので、オペアンプOPAMPのオフセット計測時間の短縮が可能となるとともに、前置きホールド回路にもなるため、電流積算への誤差が小さくなるという効果を奏することも可能になる。
【0074】
なお、上述した例においては、単に積分回路の有無の2つのパターン(第1の積分定数と所定のゲインを持った積分回路として動作する第1のモードと、第2の積分定数が0となる単純なゲイン回路として動作する第2のモードの2つのモード)のうちのいずれかが一方が選択されるようになされているが、上述した例に限定されない。
【0075】
例えば、積分定数を無段階で切り換え可能とすることで、電送路11を流れる電流Iの電流変動にあわせて、積分定数をアダプティブに変化させることも可能である。この場合、さらにシステムの自由度が向上するという効果を奏することが可能になる。なお、積分定数の変更の方法は、特に限定されないが、例えば、図2の電流積算アンプ回路12にさらに複数の素子(ゲイン抵抗と積分コンデンサ)と、それらの素子の間にさらに複数のスイッチを設け、マイクロコンピュータ13がそれら複数のスイッチのそれぞれの状態を適宜制御することで、積分定数の変更が容易に実現できる。
【0076】
上述したように、図1の電流積算回路1においては、電流検出部21により検出された電流Iに対応するアナログ値が、積分フィルタ部22とオペアンプ25により積分されて出力される第1のモード(電流積算モード)と、オフセット検出部23とオペアンプ25により、オペアンプ25のオフセットが検出され、それに対応するアナログ値が出力される第2のモード(オフセット計測モード)の2つが使用可能である。
【0077】
さらに、第1のモードの場合、第1の積分定数で、電流Iに対応する値が積分されて、出力され、かつ、第2のモードの場合、第1の積分定数より小さい、0も含む第2の積分定数で、オペアンプのオフセットに対応する値が検出されて、出力される。
【0078】
換言すると、第1の積分定数と第2の積分定数のそれぞれは、相互に独立して設定が可能であり、その結果、第2の積分定数が小さくなれば、オペアンプのオフセット計測が高速で実行可能になる。また、第1の積分定数が大きくなれば、A/D変換部26のA/Dサンプリングの周波数を遅くすることができ、電流Iが大きく変動されてもそれらを漏れなく積算することが可能になる。従って、電流積算回路1は、電流積算を高精度に行うことが可能になる。換言すると、電流積算回路1は、上述した課題を解決することが可能になる。
【0079】
【発明の効果】
以上のごとく、本発明によれば、電流積算のための積分動作を行う第1のモードと、オペアンプのオフセット計測を行う第2のモードの2つのモードを有する、サンプリング方式の電流積算を行うことができる。特に、第1のモードで使用される第1の積分定数と、第2のモードで使用される第2の積分定数のそれぞれを、相互に独立して設定することができる。即ち、第1のモードと第2のモードにおける周波数特性のそれぞれを、相互に独立して可変することができる。従って、オペアンプの温度特性によるオフセットの補正時間の短縮化を図ることができ、かつ、大幅な電流変動状態であっても、その電流積算を高精度に行うことができる。
【図面の簡単な説明】
【図1】本発明が適用される電流積算回路の構成例を示すブロック図である。
【図2】図1の電流積算回路の電流積算アンプ回路の詳細な構成例を示す回路図である。
【図3】電流積算モードにおける図2の電流積算アンプ回路の等価回路を示す回路図である。
【図4】オペアンプのオフセット計測モードにおける図2の電流積算アンプ回路の等価回路を示す回路図である。
【符号の説明】
1 電流積算回路, 11 電送路, 12 電流積算アンプ回路, 13 マイクロコンピュータ, 21 電流検出部, 22 積分フィルタ部, 23オフセット検出部, 24 選択部, 25 増幅部(オペアンプ), 26A/D変換部, 27 選択部, 28 電流積算部, 29 オフセット計測部, C1,C2 コンデンサ, I 電流, OPAMP オペアンプ, R1乃至R5 抵抗, S1乃至S5 スイッチ[0001]
TECHNICAL FIELD OF THE INVENTION
The present invention relates to an electronic circuit, and more particularly, to an electronic circuit capable of performing a current integration with high accuracy by shortening an offset correction time due to a temperature characteristic of an operational amplifier in a sampling type current integration circuit.
[0002]
[Prior art]
2. Description of the Related Art In recent years, an SBS (Smart Battery System) has been proposed as one of interface standards for an information processing apparatus represented by a notebook personal computer and a battery (battery) as an auxiliary power supply for the information processing apparatus.
[0003]
An information processing apparatus adopting the SBS standard is provided with a battery pack, and this battery pack generally has a circuit for integrating the charge / discharge current (hereinafter, referred to as a current integration circuit). Is provided.
[0004]
The current integrating circuit employs a circuit employing a method referred to as a “coulomb counter method” (hereinafter referred to as a “coulomb counter current integrating circuit”) and a circuit employing a method referred to as a “sampling method” ( Hereinafter, this is referred to as a sampling type current integrating circuit).
[0005]
The Coulomb counter type current integrating circuit is said to be more accurate than the sampling type current integrating circuit, but the circuit configuration is complicated and the parts cost of the circuit is high. Therefore, as a current integrating circuit, a sampling type current integrating circuit having a simple circuit structure and a low component cost has become mainstream.
[0006]
[Problems to be solved by the invention]
However, since the sampling type current integrating circuit uses an operational amplifier with a high gain, the input offset of the operational amplifier with respect to a change in environmental temperature cannot be ignored, and the offset needs to be measured and corrected periodically.
[0007]
This is the same for the coulomb counter method, but the sampling type current integrating circuit further has the following problem.
[0008]
That is, in the sampling type current integrating circuit, when integrating the fluctuating current, it is necessary to increase the integration constant of the operational amplifier. Accordingly, when the input offset of the operational amplifier is measured in the sampling type current integrating circuit, a time corresponding to a time constant corresponding to a large integration constant is required as a measurement time. This measurement time becomes a dead time in the current integration, causing a problem that a non-negligible error occurs.
[0009]
Therefore, conventionally, as a solution to this problem, a first solution using an operational amplifier designed with high accuracy so that the measurement of the offset becomes unnecessary, and a solution in which the integration constant is negligible with respect to the current integration A second solution has been conceived.
[0010]
However, the first solution has a problem in that the designed operational amplifier becomes very precise and expensive, and the advantage of the sampling type current integrating circuit that the circuit structure is simple and the parts cost is low cannot be used. .
[0011]
Further, the second solution has a problem that an error increases when integrating a fluctuating current because the integration constant is small.
[0012]
That is, as a solution to the above-described problem, there is a problem that an effective solution has not yet been devised, including the above-described first solution and second solution.
[0013]
The present invention has been made in view of such circumstances, and in a sampling type current integrating circuit, it is possible to shorten the time for correcting an offset due to the temperature characteristics of an operational amplifier, and to perform current integration with high accuracy. Is to do so.
[0014]
[Means for Solving the Problems]
The electronic circuit of the present invention includes an operational amplifier, and an element group including one or more capacitors connected to the operational amplifier, detects a current flowing through a predetermined transmission path, and detects an analog signal corresponding to the detected current. An integration circuit that integrates and outputs a value with a first integration constant, the above-described operational amplifier, and a predetermined part of the above-described element group. An offset detection circuit that detects an offset of the operational amplifier with a second integration constant including the offset, and outputs an analog value corresponding to the detected offset; an integration circuit; and a selection circuit that selects one of the offset detection circuits An A / D conversion circuit for A / D converting an analog value output from a circuit selected by the selection circuit among the integration circuit and the offset detection circuit; If the data digitized by the D conversion circuit is data corresponding to the output of the integration circuit, the integrated value of the data is integrated to calculate the integrated value of the current flowing through the transmission path, and the digitized data is calculated. Is a data corresponding to the offset detection circuit, and a digital operation circuit for calculating an offset voltage value of the operational amplifier based on the value of the data.
[0015]
The element group forming the integration circuit further has a detection resistor for detecting a current flowing through the transmission path, and the selection circuit, when turned on, short-circuits both ends of the detection resistor, and when turned off, A first switch for releasing the short circuit of the detection resistor, a second switch for disconnecting the transmission path from the integration circuit when turned off, and a second switch for connecting the transmission path to the integration circuit when turned on; When in the state, a predetermined one of the capacitors constituting the element group is disconnected from the integration circuit, and when in the on state, the capacitor disconnected from the integration circuit is connected to the integration circuit by a third switch. When selecting the integration circuit, the first switch is turned off, the second switch is turned on, and the third switch is turned on, and the offset detection circuit is selected. 1 of the switch is turned on, the second switch is turned off, and the third switch can be made to the off state.
[0016]
When the third switch is turned off, all the capacitors constituting the element group can be disconnected from the integration circuit.
[0017]
The A / D conversion circuit and the digital operation circuit are configured as a microcomputer, and the microcomputer provides a selection circuit with specification information for specifying one of the integration circuit and the offset detection circuit. And the selection circuit may be configured to select a circuit specified by the specification information provided by the specification unit, from the integration circuit and the offset detection circuit.
[0018]
The electronic circuit according to the present invention includes an operational amplifier, and an element group including one or more capacitors connected to the operational amplifier. The electronic circuit detects a current flowing through a predetermined transmission path, and outputs an analog signal corresponding to the detected current. Is integrated by a first integration constant to output the integrated value, the operational amplifier described above, and a predetermined part of the above-described element group, and 0 is smaller than the first integration constant. And an offset detection circuit that detects the offset of the operational amplifier with the second integration constant and outputs an analog value corresponding to the detected offset, and selects the analog output from the selected circuit. Is converted to digital data by digital-to-analog conversion. If the data is data corresponding to the output of the integrating circuit, the values of the data are integrated. When the integrated value of the current flowing through the transmission path is calculated, and the data is data corresponding to the offset detection circuit, the voltage value of the input offset of the operational amplifier is calculated based on the data value. You.
[0019]
The electronic circuit of the present invention may be mounted on an information processing device and integrate the current value of a current flowing or supplied to the information processing device, or a current flowing or supplied to an external information processing device. May be integrated, or the current value of the current flowing through or supplied to the electronic circuit itself may be integrated.
[0020]
BEST MODE FOR CARRYING OUT THE INVENTION
FIG. 1 shows a configuration example of a current integration circuit to which the present invention is applied.
[0021]
The
[0022]
As shown in FIG. 1, the current integrating
[0023]
The current integrating
[0024]
The current integrating
[0025]
That is, the current
[0026]
The
[0027]
On the other hand, when the second mode is selected by the
[0028]
As described later, the first circuit includes an
[0029]
The second circuit is composed of the
[0030]
The
[0031]
When the current integrating
[0032]
As described above, the current integrating
[0033]
That is, the value of the integration constant used in each of the first mode and the second mode can be set independently of each other, and by setting a large value as the first integration constant, the current I , It is possible to reduce the integration error with respect to the current fluctuation. Further, by setting a small value as the second integration constant, the time constant time corresponding to the second integration constant is shortened, and as a result, the measurement time of the offset of the
[0034]
The basic configuration of the current integrating
[0035]
FIG. 2 shows a configuration example of one of the embodiments of such a current integrating
[0036]
In the current integrating
[0037]
One end of a series circuit in which a resistor R3 and a switch S3 are connected in series is connected to the positive-phase input (+) of the operational amplifier OPAMP. The other end of the series circuit is connected to the
[0038]
A switch S1 is connected between one end of each of the resistors R2 and R3 on a side opposite to the side connected to the operational amplifier OPAMP, and a resistor R2 or a resistor R3 of the switches S2 and S3 is connected to each other. A detection resistor R <b> 1 that detects a current I flowing through the
[0039]
Next, the operation of the current integrating
[0040]
For example, assume that the
[0041]
In this case, the
[0042]
The
[0043]
Therefore, when the first mode is selected, the current integrating
[0044]
However, in the equivalent circuit 12-1 of the current integrating amplifier circuit of FIG. 3, for simplification of description, the values of the resistors R4 and R5 are set to R (R4 = R5 = R), and the resistors R2 and R3 are set. Is set to R2 (R3 = R2), and the values of the capacitors C1 and C2 are set to C (C1 = C2 = C).
[0045]
That is, the resistor R1 in FIG. 3 corresponds to the
[0046]
In this case, since the equivalent circuit 12-1 of the current integrating amplifier circuit of FIG. 3 has a first-order low-pass fill, its transfer function is as shown in the following equation (1).
[0047]
(Equation 1)
[0048]
In Expression (1), Vo represents the output voltage (frequency f) of the operational amplifier OPAMP, Vi represents the voltage across the detection resistor R1, and ω represents the normalized frequency (= 2πf).
[0049]
When the equation (1) is normalized, it becomes as shown in the following equation (2).
[0050]
(Equation 2)
[0051]
In Expression (2), if ω0 = 1 / CR, ω / ω0 represents a cutoff frequency.
[0052]
Here, the amplitude | T | and the phase θ of the transfer function are expressed by the following equation (3) based on the AC theory.
[0053]
[Equation 3]
[0054]
That is, in this example, when the first mode is selected, the current integrating
[0055]
In the example of FIG. 3, as described above, for the sake of simplicity, the values of the resistors R4 and R5 are set to R (R4 = R5 = R), and the values of the resistors R2 and R3 are set to R2. Although it is set (R3 = R2) and the values of the capacitors C1 and C2 are set to C (C1 = C2 = C), the gain resistors R2 to R5 and the integration capacitors C1 and Each value of C2 is not limited to the example of FIG. 3 and can be any value.
[0056]
That is, when the first mode is selected, the current integrating
[0057]
In FIG. 1, an A /
[0058]
As described above, if the values of the gain resistors R2 to R5 and the integration capacitors C1 and C2 are appropriately set, the first integration constant is set to a large value. As a result, the current integration amplifier shown in FIG. When the first mode is selected, the
[0059]
Next, for example, in FIG. 1, it is assumed that the
[0060]
In this case, the
[0061]
The
[0062]
Therefore, when the second mode is selected, the current integrating
[0063]
However, in the equivalent circuit 12-2 of the current integrating amplifier circuit of FIG. 4, for the sake of simplicity, the values of the resistors R4 and R5 are the same (R4 = R5), and the values of the resistors R2 and R3 are equal. The values are the same (R3 = R2).
[0064]
R0 represents an internal resistance of the operational amplifier OPAMP. Vn and Vp respectively represent the negative phase side and the positive phase side of the true input voltage in the operational amplifier OPAMP, and the values of the voltage Vn and the voltage Vp are the same from the relation of the operational amplifier inergic short. (Vn = Vp). IBn and IBp respectively represent the negative phase side and the positive phase side of the bias current, and if the input offset current is described as Iio, then Iio = IBn-IBp. Vo represents the output voltage of the operational amplifier OPAMP, and Vio represents the input offset voltage.
[0065]
That is, the switch S1 in FIG. 4 corresponds to the
[0066]
In this case, the output voltage Vo of the operational amplifier OPAMP has a relationship represented by the following equation (5).
[0067]
(Equation 4)
[0068]
Since R4 = R5, equation (5) becomes as shown in the following equation (6).
[0069]
(Equation 5)
[0070]
In the equation (6), if IBn = IBp, I4 = I5 from the negative feedback characteristic of the operational amplifier, and the output voltage Vo of the operational amplifier OPAMP becomes zero. However, the operational amplifier OPAMP has input bias currents (IBp, IBn), and there is a difference between the input currents of the positive-phase input (+) and the negative-phase input (−). = 0. Since the characteristics of the internal transistor change depending on the environmental temperature, the input bias currents (IBp, IBn) change, and finally, the output voltage Vo of the operational amplifier OPAMP also changes. The amount of change is periodically measured and corrected by the
[0071]
Specifically, when the second mode is selected, the current integrating
[0072]
In FIG. 1, an A /
[0073]
As described above, when the second mode (the offset measurement mode of the operational amplifier OPAMP) is selected, the current integrating
[0074]
In the example described above, only two patterns of the presence or absence of the integration circuit (the first integration constant and the first mode operating as an integration circuit having a predetermined gain, and the second integration constant become 0) One of the two modes of the second mode operating as a simple gain circuit) is selected, but the present invention is not limited to the above-described example.
[0075]
For example, by allowing the integration constant to be switched in a stepless manner, it is possible to adaptively change the integration constant in accordance with the current fluctuation of the current I flowing through the
[0076]
As described above, in the
[0077]
Furthermore, in the case of the first mode, the value corresponding to the current I is integrated and output with the first integration constant, and in the case of the second mode, 0 which is smaller than the first integration constant is also included. With the second integration constant, a value corresponding to the offset of the operational amplifier is detected and output.
[0078]
In other words, each of the first integration constant and the second integration constant can be set independently of each other. As a result, if the second integration constant becomes small, the offset measurement of the operational amplifier can be performed at high speed. Will be possible. Further, if the first integration constant becomes large, the frequency of A / D sampling of the A /
[0079]
【The invention's effect】
As described above, according to the present invention, it is possible to perform the sampling type current integration having two modes, the first mode for performing the integration operation for current integration and the second mode for performing the offset measurement of the operational amplifier. Can be. In particular, the first integration constant used in the first mode and the second integration constant used in the second mode can be set independently of each other. That is, each of the frequency characteristics in the first mode and the second mode can be varied independently of each other. Therefore, it is possible to shorten the time for correcting the offset due to the temperature characteristics of the operational amplifier, and to perform the current integration with high accuracy even in a large current fluctuation state.
[Brief description of the drawings]
FIG. 1 is a block diagram illustrating a configuration example of a current integration circuit to which the present invention is applied.
FIG. 2 is a circuit diagram showing a detailed configuration example of a current integrating amplifier circuit of the current integrating circuit of FIG.
FIG. 3 is a circuit diagram showing an equivalent circuit of the current integration amplifier circuit of FIG. 2 in a current integration mode.
FIG. 4 is a circuit diagram showing an equivalent circuit of the current integrating amplifier circuit of FIG. 2 in an offset measuring mode of the operational amplifier.
[Explanation of symbols]
Claims (4)
前記オペアンプ、および、前記素子群のうちの所定の一部の素子から構成され、前記第1の積分定数より小さい、0を含む第2の積分定数で、前記オペアンプのオフセットを検出し、検出した前記オフセットに対応するアナログの値を出力するオフセット検出回路と、
前記積分回路と、前記オフセット検出回路のうちのいずれか一方を選択する選択回路と、
前記積分回路と前記オフセット検出回路のうちの、前記選択回路により選択された回路から出力されたアナログの値を、A/D変換するA/D変換回路と、
前記A/D変換回路によりデジタル化されたデータが、前記積分回路の出力に対応するデータである場合、前記データの値を積算することで、前記電送路を流れる前記電流の積算値を演算し、前記デジタル化されたデータが、前記オフセット検出回路に対応するデータである場合、前記データの値に基づいて、前記オペアンプのオフセットの電圧値を演算するデジタル演算回路と
を備えることを特徴とする電子回路。An operational amplifier, and an element group including one or more capacitors connected to the operational amplifier, configured to detect a current flowing through a predetermined transmission path, and to output an analog value corresponding to the detected current to a first An integration circuit that integrates and outputs an integration constant,
The offset of the operational amplifier is detected and detected by a second integration constant including 0, which is smaller than the first integration constant, and is configured by a predetermined part of the elements of the operational amplifier and the element group. An offset detection circuit that outputs an analog value corresponding to the offset,
A selection circuit that selects one of the integration circuit and the offset detection circuit;
An A / D conversion circuit for A / D converting an analog value output from a circuit selected by the selection circuit out of the integration circuit and the offset detection circuit;
If the data digitized by the A / D conversion circuit is data corresponding to the output of the integration circuit, the integrated value of the current is calculated by integrating the values of the data. And a digital operation circuit that calculates a voltage value of an offset of the operational amplifier based on a value of the data when the digitized data is data corresponding to the offset detection circuit. Electronic circuit.
前記選択回路は、
オン状態とされた場合、前記検出抵抗の両端を短絡し、オフ状態とされた場合、前記検出抵抗の短絡を解除する第1のスイッチと、
オフ状態とされた場合、前記電送路を前記積分回路から切り離し、オン状態とされた場合、前記電送路を前記積分回路に接続する第2のスイッチと、
オフ状態とされた場合、前記素子群を構成する前記コンデンサのうちの所定のものを、前記積分回路から切り離し、オン状態とされた場合、前記積分回路から切り離された前記コンデンサを、前記積分回路に接続する第3のスイッチと
を有し、
前記積分回路を選択する場合、前記第1のスイッチをオフ状態とし、前記第2のスイッチをオン状態とし、かつ、前記第3のスイッチをオン状態とし、
前記オフセット検出回路を選択する場合、前記第1のスイッチをオン状態とし、前記第2のスイッチをオフ状態とし、かつ、前記第3のスイッチをオフ状態とする
ことを特徴とする請求項1に記載の電子回路。The element group forming the integration circuit further includes a detection resistor that detects a current flowing through the transmission path,
The selection circuit,
A first switch that short-circuits both ends of the detection resistor when turned on, and releases the short-circuited detection resistor when turned off;
A second switch that disconnects the power transmission path from the integration circuit when in the off state and connects the power transmission path to the integration circuit when in the on state;
When turned off, a predetermined one of the capacitors constituting the element group is disconnected from the integration circuit, and when turned on, the capacitor disconnected from the integration circuit is replaced by the integration circuit And a third switch connected to the
When selecting the integration circuit, the first switch is turned off, the second switch is turned on, and the third switch is turned on,
The method according to claim 1, wherein when the offset detection circuit is selected, the first switch is turned on, the second switch is turned off, and the third switch is turned off. Electronic circuit as described.
ことを特徴とする請求項2に記載の電子回路。3. The electronic circuit according to claim 2, wherein when the third switch is turned off, all the capacitors forming the element group are disconnected from the integration circuit. 4.
前記マイクロコンピュータは、前記選択回路に対して、前記積分回路と前記オフセット検出回路のうちのいずれか一方を指定する指定情報を提供する指定手段をさらに有し、
前記選択回路は、前記積分回路と前記オフセット検出回路のうちの、前記指定手段より提供された前記指定情報に指定されている回路を選択する
ことを特徴とする請求項1に記載の電子回路。The A / D conversion circuit and the digital operation circuit are configured as a microcomputer,
The microcomputer further includes a designation unit that provides designation information for designating one of the integration circuit and the offset detection circuit to the selection circuit,
2. The electronic circuit according to claim 1, wherein the selection circuit selects a circuit specified by the specification information provided by the specification unit, from the integration circuit and the offset detection circuit. 3.
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