JP2002100294A - Flat type plasma display panel having independent trigger and controlled maintaining electrode - Google Patents

Flat type plasma display panel having independent trigger and controlled maintaining electrode

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JP2002100294A
JP2002100294A JP2001232538A JP2001232538A JP2002100294A JP 2002100294 A JP2002100294 A JP 2002100294A JP 2001232538 A JP2001232538 A JP 2001232538A JP 2001232538 A JP2001232538 A JP 2001232538A JP 2002100294 A JP2002100294 A JP 2002100294A
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ディ.シャーマーホーン ジェリー
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Abstract

PROBLEM TO BE SOLVED: To provide a flat type plasma display panel which has an independent trigger and controlled maintaining electrode, and can operate with a high efficiency. SOLUTION: In this flat type display panel, a pair of first parallel maintaining electrodes consisting of first and second maintaining electrodes (Y, Z) are formed on an upper glass substrate 12, and at least one of auxiliary electrodes (T, C) is coated on the substrate 12 in parallel to the pair of first parallel maintaining electrodes, and then the auxiliary electrodes (T, C) are adjacent to a first maintaining electrode in the pair of first parallel maintaining electrodes, and a pair of second parallel maintaining electrodes including first and second maintaining electrodes are coated on the substrate 12 in parallel to a trigger electrode (T), and a first maintaining electrode in the pair of second parallel maintaining electrodes is arranged adjacent to an auxiliary electrode so as to be a mirror image of the pair of first parallel maintaining electrodes. A single common first maintaining electrode pad (Z') is electrically connected to the first maintaining electrode in the pair of first maintaining electrodes and the first maintaining electrode in the pair of second maintaining electrodes, and then a first maintaining electrode pad is connected with a first voltage-waveform source, and then a first maintaining voltage-waveform is supplied to both first maintaining electrodes from a single electric source.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は、一般的に平面型プ
ラズマ表示パネルに関し、特にフルカラーで高解像度能
力を持ち、高効率で動作し、独立トリガ及び被制御維持
電極を含む平面型プラズマ表示パネル用の構造改善に関
する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention generally relates to a flat panel plasma display panel, and more particularly, to a flat panel plasma display panel having full color, high resolution capability, operating with high efficiency, and including independent triggers and controlled sustain electrodes. Related to structural improvement.

【0002】[0002]

【従来の技術】平面型プラズマ表示パネルは、エレクト
ロルミネッセント装置、AC型プラズマ表示パネル、D
C型プラズマ表示パネル及び電界放出型表示装置等の大
型直交配列の表示画素が平面状の画面を形成している電
子表示装置である。
2. Description of the Related Art A flat-type plasma display panel includes an electroluminescent device, an AC-type plasma display panel, and a D-type plasma display panel.
This is an electronic display device in which large-sized orthogonally arranged display pixels such as a C-type plasma display panel and a field emission display device form a planar screen.

【0003】AC型プラズマ表示パネルすなわちPDP
の基本構造は2枚のガラス板から構成され、各ガラス板
の内部表面は導線パターンの電極を有する。このガラス
板は、ガスが充填されている間隙によって分離されてい
る。電極はx−yマトリックス状に配置されており、各
ガラス板上の電極は従来の薄膜あるいは厚膜技術を用い
て互いに直角に成膜されている。少なくとも1組のAC
型PDPの維持電極が薄いガラス誘電体層で覆われてい
る。ガラス板は、スペーサによって固定されたガラス板
間のこの間隙を有するサンドイッチ状に組み立てられて
いる。ガラス板の縁部は封止され、ガラス板間の空隙は
排気され、ネオンガスとキセノンガスの混合気体又はこ
の技術分野ではよく知られている同じような種類の混合
気体が充填される。
[0003] AC type plasma display panel or PDP
Is composed of two glass plates, and the inner surface of each glass plate has electrodes in a conductive wire pattern. The glass sheets are separated by gaps filled with gas. The electrodes are arranged in an xy matrix, and the electrodes on each glass plate are deposited at right angles to each other using conventional thin or thick film technology. At least one set of AC
The sustain electrodes of the type PDP are covered with a thin glass dielectric layer. The glass plates are assembled in a sandwich with this gap between the glass plates fixed by spacers. The edges of the glass sheets are sealed and the gap between the glass sheets is evacuated and filled with a mixture of neon gas and xenon gas or a similar gas mixture well known in the art.

【0004】AC型PDPの動作中、充分な駆動電圧パ
ルスが電極に印加されて、ガラス板間に含まれるガスを
イオン化する。ガスがイオン化する際、誘電体はあたか
も小さいコンデンサのように帯電し、このことによっ
て、ガスの両端での電圧が下がり放電が消える。容量電
圧は、蓄積した電荷によるものであり、従来から壁電荷
と呼ばれる。次に、電圧が反転し、駆動電圧と壁電荷電
圧の和は、再度、ガスを励起し、グロー放電パルスを生
成するのに充分なほど大きくなる。繰り返し印加される
このような一連の駆動電圧は、維持電圧すなわちサステ
ナーと呼ばれる。サステナー波形を用いることで、電荷
が蓄積されている画素は放電し、サステナー周期毎に光
パルスを放出する。画素に電荷が蓄積されていない場
合、光は放出されない。適切な波形を電極のx−yマト
リックスの両端に印加すると、小さい発光画素によって
画像が形成される。
During operation of an AC PDP, a sufficient drive voltage pulse is applied to the electrodes to ionize the gas contained between the glass plates. As the gas ionizes, the dielectric charges as if it were a small capacitor, which reduces the voltage across the gas and eliminates the discharge. The capacitance voltage is due to the accumulated charge and is conventionally called wall charge. The voltage is then reversed and the sum of the drive voltage and the wall charge voltage is again large enough to excite the gas and generate a glow discharge pulse. Such a series of drive voltages applied repeatedly is called a sustaining voltage or a sustainer. By using the sustainer waveform, the pixel in which the charge is accumulated is discharged, and emits a light pulse in each sustainer cycle. If no charge is stored in the pixel, no light is emitted. When an appropriate waveform is applied across the xy matrix of electrodes, an image is formed by the small light emitting pixels.

【0005】一般的に、赤、緑、又は青の蛍光体の層
は、これらのガラス板の内、1枚のガラス板の内側表面
上に交互に成膜される。イオン化したガスによって、蛍
光体は各画素から色のついた光を放出する。一般的に、
隔壁はガラス板間に配置されて、電極間での色同士及び
画素同士の干渉を防ぐ。また隔壁は、解像度を高め、非
常に精細な像を提供する。更に隔壁は、隔壁の高さ、
幅、及びパターン間隙を利用して、ガラス板間において
均一な放電空間を設け所望の画素ピッチを達成する。
Generally, red, green, or blue phosphor layers are alternately deposited on the inner surface of one of these glass plates. Due to the ionized gas, the phosphor emits colored light from each pixel. Typically,
The partition is disposed between the glass plates to prevent interference between colors and between pixels between electrodes. The septum also increases the resolution and provides a very fine image. Further, the partition is the height of the partition,
Utilizing the width and the pattern gap, a uniform discharge space is provided between the glass plates to achieve a desired pixel pitch.

【0006】AC型PDPの構造及び動作の更なる詳細
については、米国特許番号第5,723,945号、表
題「平面型パネル表示装置」、米国特許番号第5,96
2,983号、表題「表示パネルの動作方法」、及び米
国特許出願番号第09/259,940号、1999年
3月1日申請、表題「平面型パネル表示装置」において
開示されており、これらは全て本明細書中に引用し参照
する。
For further details on the structure and operation of AC type PDPs, see US Pat. No. 5,723,945, entitled “Flat Panel Display”, US Pat.
No. 2,983, entitled "Method of Operating a Display Panel", and US Patent Application No. 09 / 259,940, filed on Mar. 1, 1999, entitled "Flat Panel Display Device", Are all cited and referenced herein.

【0007】[0007]

【発明が解決しようとする課題】本発明は、高効率で動
作し、独立トリガ及び被制御維持電極を含む平面型プラ
ズマ表示パネルの改善に関する。
SUMMARY OF THE INVENTION The present invention relates to an improvement in a planar plasma display panel that operates with high efficiency and includes independent triggers and controlled sustain electrodes.

【0008】表示装置の基板間に帯電空間を形成する維
持電極対を有する平面型プラズマ表示パネルの製造につ
いてはよく知られている。この電荷によって、複数のア
ドレス電極への電圧印加によって制御されるプラズマ放
電が保持される。この帯電空間は、維持電極に初期電圧
を印加することによって形成される。実際のプラズマ放
電は、第2維持電圧を維持電極に印加することによって
維持電極間で始まる。一般的に、放電維持のために必要
な電圧を大きくするようにガス及び形状パラメータを調
整した場合、パネルの効率が大きくなる。しかしなが
ら、このことによって、始動電圧に対して、関連する電
圧供給回路の複雑さが増すことになる。従がって、比較
的低い電圧で維持放電の始動及び制御を可能にし、一
方、その結果発生するプラズマ放電を比較的高い電圧で
維持できるプラズマ表示パネルを開発することが望まし
い。
It is well known to manufacture flat-panel plasma display panels having a pair of sustain electrodes forming a charged space between substrates of a display device. The charges maintain a plasma discharge controlled by voltage application to the plurality of address electrodes. This charging space is formed by applying an initial voltage to the sustain electrode. The actual plasma discharge starts between the sustain electrodes by applying a second sustain voltage to the sustain electrodes. Generally, when gas and shape parameters are adjusted so as to increase the voltage required for sustaining discharge, the efficiency of the panel increases. However, this increases the complexity of the associated voltage supply circuit for the starting voltage. Accordingly, it is desirable to develop a plasma display panel that enables the initiation and control of the sustain discharge at a relatively low voltage, while maintaining the resulting plasma discharge at a relatively high voltage.

【0009】また、プラズマ表示パネルにおける各電極
に個別の電圧ドライバを設けることも知られている。全
ての電圧ドライバ及びパネル電極への物理的な接続部の
数によって、最終的な表示パネルの容積及びコストはか
なり大きなものになる。従がってまた、個別の電圧ドラ
イバの数を減らすことも望ましい。
It is also known to provide an individual voltage driver for each electrode in a plasma display panel. With all the voltage drivers and the number of physical connections to the panel electrodes, the final display panel volume and cost can be quite large. Accordingly, it is also desirable to reduce the number of individual voltage drivers.

【0010】[0010]

【課題を解決するための手段】本発明の目的は、第1平
行維持電極対がその上に成膜された第1透明基板を有す
るプラズマ平面型パネル表示装置を提供することであ
る。第1維持電極対は、第1維持電極と第2維持電極を
含む。また、この表示装置は、第1維持電極対に平行
に、また第1維持電極対において第1維持電極に隣接し
て、第1基板上に成膜された少なくとも1つの補助電極
を含む。第2平行維持電極対は補助電極に平行に第1基
板上に成膜され、第2維持電極対は第1維持電極と第2
維持電極を含む。第2維持電極対は、第2維持電極対に
おける第1維持電極が補助電極に隣接するように、第1
維持電極対の鏡像として第1基板上に配向される。単一
共通第1維持電極パッドは、第1維持電極対における第
1維持電極及び第2維持電極対における第1維持電極に
電気的に接続される。第1維持電極パッドは、第1維持
電圧波形電源に接続されるようになっており、これによ
って、単一電源によって、第1維持電圧波形を第1維持
電極の両者に供給する。一層の誘電体が維持電極及び補
助電極を覆っている。保護層が形成され、この誘電体層
を覆っている。更に、本表示装置は、第1基板に気密封
止される第2基板を含み、この第2基板は第1基板に隣
接するその表面に複数の微細空隙を有する。この微細空
隙はガスで充填され、第1基板と共に複数の副画素を画
成する。蛍光体は各微細空隙内に成膜され、複数のアド
レス電極が前記第2基板内に組み込まれる。各アドレス
電極は副画素の一つに対応する。
SUMMARY OF THE INVENTION It is an object of the present invention to provide a plasma flat panel display device having a first transparent substrate on which a first pair of parallel sustain electrodes is formed. The first storage electrode pair includes a first storage electrode and a second storage electrode. The display device includes at least one auxiliary electrode formed on the first substrate in parallel with the first sustain electrode pair and adjacent to the first sustain electrode in the first sustain electrode pair. The second parallel sustain electrode pair is formed on the first substrate in parallel with the auxiliary electrode, and the second sustain electrode pair is formed of the first sustain electrode and the second sustain electrode.
Including a sustain electrode. The second pair of sustain electrodes is configured so that the first pair of sustain electrodes in the second pair of sustain electrodes is adjacent to the auxiliary electrode.
It is oriented on the first substrate as a mirror image of the sustain electrode pair. The single common first sustain electrode pad is electrically connected to the first sustain electrode in the first sustain electrode pair and the first sustain electrode in the second sustain electrode pair. The first sustain electrode pad is adapted to be connected to a first sustain voltage waveform power supply, whereby a single power supply supplies the first sustain voltage waveform to both of the first sustain electrodes. One layer of dielectric covers the sustain and auxiliary electrodes. A protective layer is formed and covers the dielectric layer. Further, the display device includes a second substrate hermetically sealed to the first substrate, the second substrate having a plurality of microvoids on its surface adjacent to the first substrate. The microvoids are filled with a gas and define a plurality of sub-pixels with the first substrate. A phosphor is formed in each of the minute gaps, and a plurality of address electrodes are incorporated in the second substrate. Each address electrode corresponds to one of the sub-pixels.

【0011】また、本発明の目的は、プラズマ平面型パ
ネル表示装置の動作方法を提供することである。本方法
は、立上げ期間において第1及び第2維持電圧波形、補
助電圧波形及びアドレス電圧波形を対応する電極に印加
する段階を含む。類似の電極はパッドによって接続さ
れ、「オフ」状態に適する値に制御された副セルの放電
空間に対応して、全ての壁電荷が関連する誘電体面上に
形成される。次に、第1補助電圧波形はアドレス期間に
おいてアドレス電圧波形と共に、パッドによって接続さ
れた補助電圧波形電源毎に、対応する第1補助電極に順
次印加される。第1補助電圧波形によって、関連した第
1及び第2維持電極対間において選択的に放電が開始さ
れ、これによって、「オン」状態に適する値に制御され
た選択された副セルの放電空間に対応して、これらの維
持電極に関連する誘電体面上において壁電荷が設定され
る。次に、第1及び第2維持波形電源を介して所定数の
電圧パルスが、維持期間中において印加され、「オン」
状態に設定されたセルにおいて、放電の位置と形状が補
助電圧波形電源によって制御された状態で、電圧パルス
に対応して順次所定数の放電が生成される。
Another object of the present invention is to provide a method of operating a plasma flat panel display. The method includes applying a first and second sustain voltage waveform, an auxiliary voltage waveform, and an address voltage waveform to corresponding electrodes during a power up period. Similar electrodes are connected by pads and all wall charges are formed on the associated dielectric surface, corresponding to the discharge space of the subcell controlled to a value appropriate for the "off" state. Next, the first auxiliary voltage waveform is sequentially applied to the corresponding first auxiliary electrode for each auxiliary voltage waveform power supply connected by the pad together with the address voltage waveform in the address period. The first auxiliary voltage waveform selectively initiates a discharge between the associated first and second sustain electrode pairs, thereby causing a discharge space of the selected sub-cell controlled to a value suitable for the "on" state. Correspondingly, wall charges are set on the dielectric surface associated with these storage electrodes. Next, a predetermined number of voltage pulses are applied during the sustain period via the first and second sustain waveform power supplies, and the “on”
In the cells set in the state, a predetermined number of discharges are sequentially generated corresponding to the voltage pulses in a state where the position and shape of the discharge are controlled by the auxiliary voltage waveform power supply.

【0012】本発明の様々な目的と利点は、好適な実施
例に関する以下の詳細な説明について、添付の図面に照
らし解釈することによって当業者に対して明らかになる
であろう。
Various objects and advantages of the present invention will become apparent to those skilled in the art from the following detailed description of the preferred embodiment, when read in light of the accompanying drawings.

【0013】[0013]

【発明の実施の形態】ここで図面において、図1及び図
2に、プラズマ表示パネル(PDP)10の構造を示す
が、好適な実施形態においては、このプラズマ表示パネ
ルはAC型PDPである。下記の説明において、同様な
参照文字は同様なあるいは対応する部分を指す。また、
下記の説明において、“上部”、“底部”、“前面”、
“背面”等の用語及び位置と方向に関する同様の用語
は、図面を基準にして、説明の便宜上用いられているこ
とを理解されたい。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS In the drawings, FIGS. 1 and 2 show the structure of a plasma display panel (PDP) 10. In a preferred embodiment, the plasma display panel is an AC PDP. In the following description, similar reference characters refer to similar or corresponding parts. Also,
In the following description, "top", "bottom", "front",
It is to be understood that terms such as "back" and similar terms related to position and orientation are used for convenience of description with reference to the drawings.

【0014】一般的に、PDP10は、上部ガラス基板
12及び間隔をおいて配置された底部ガラス基板14を
含む、密閉封止されたガスが充填されている筐体から構
成される。上部ガラス基板12は底部ガラス基板14に
重なり合っている。一般的に、表示側のみ、通常は上部
基板12のみが、可視光を透過する必要があるが、ガラ
ス基板12及び14は、両者とも光を通すことができ、
厚さが均一である。例えば、ガラス基板12及び14の
厚さは、約1/8乃至1/4インチ(3.175mm乃
至6.35mm)である。
In general, PDP 10 comprises a hermetically sealed gas-filled housing including a top glass substrate 12 and a spaced bottom glass substrate 14. Top glass substrate 12 overlaps bottom glass substrate 14. Generally, only the display side, usually only the upper substrate 12, needs to transmit visible light, but both glass substrates 12 and 14 can transmit light,
The thickness is uniform. For example, the thickness of the glass substrates 12 and 14 is about 1/8 to 1/4 inch (3.175 mm to 6.35 mm).

【0015】上部ガラス基板12の主成分は、Si
2 、Al2 3 、MgO2 、及びCaOであり、添加
成分としてNa2 O、K2 O、PbO、B2 3 等を含
む。上部基板12の下面16上には複数組の平行電極が
成膜される。こうした組の1つを、参照記号18で表
し、図1に示す。各組の電極は、表示用内部対すなわち
維持電極22及び23を含み、一般的に約800ミクロ
ンの間隔を有する。図1において最前面にある維持電極
22を第1維持電極と呼び、また以下参照記号Yで表
し、一方、もう一つの維持電極23を第2維持電極と呼
び、以下参照記号Yで表す。トリガ電極24は、第1維
持電極22に隣接して平行に配置され、以下参照記号T
で表す。同様に、制御電極25は、以下参照記号Cで表
し、第2維持電極23に隣接して平行に配置される。図
2から最も良く分かるように、維持電極22及び23
は、トリガ電極24と制御電極25の間にある。一般的
に、トリガ及び制御電極24及び25は、対応する維持
電極22及び23からの間隔が100ミクロン乃至40
0ミクロンの範囲内である。電極22、23、24及び
25は、従来のプロセスによって形成される。好適な実
施形態において、電極22、23、24及び25は、A
u、CrとAu、CuとAu、CuとCr、ITOとA
u、Ag、あるいはCr等の蒸着金属から加工される薄
膜電極である。
The main component of the upper glass substrate 12 is Si
O 2 , Al 2 O 3 , MgO 2 , and CaO, and Na 2 O, K 2 O, PbO, B 2 O 3 and the like as additional components. Plural sets of parallel electrodes are formed on the lower surface 16 of the upper substrate 12. One such set is designated by reference numeral 18 and is shown in FIG. Each set of electrodes includes a display inner pair or sustain electrodes 22 and 23 and is generally spaced about 800 microns. In FIG. 1, the foremost sustain electrode 22 is referred to as a first sustain electrode and is hereinafter referred to as a reference symbol Y, while another sustain electrode 23 is referred to as a second sustain electrode and is hereinafter referred to as a reference symbol Y. The trigger electrode 24 is disposed adjacent to and parallel to the first sustaining electrode 22, and is referred to as T
Expressed by Similarly, the control electrode 25 is represented by the reference symbol C hereinafter, and is arranged adjacent to and in parallel with the second storage electrode 23. As best seen in FIG. 2, sustain electrodes 22 and 23
Is between the trigger electrode 24 and the control electrode 25. Generally, the trigger and control electrodes 24 and 25 are spaced from the corresponding sustain electrodes 22 and 23 by 100 microns to 40 microns.
Within the range of 0 microns. Electrodes 22, 23, 24 and 25 are formed by conventional processes. In a preferred embodiment, the electrodes 22, 23, 24 and 25
u, Cr and Au, Cu and Au, Cu and Cr, ITO and A
It is a thin-film electrode processed from a deposited metal such as u, Ag, or Cr.

【0016】この技術分野でよく知られた種類の誘電体
膜等の均一な電荷蓄積膜26を用いて、表示装置製造の
技術分野でよく知られた様々なプレーナ技術によって、
電極22、23、24及び25が覆われる。電荷蓄積膜
26は、鉛ガラス材等、大抵の然るべき材料で形成して
よい。好適な実施形態において、電荷蓄積膜26は、薄
い電子放出層27によって覆われている。電子放出層2
7は、例えばダイヤモンドオーバーコート、MgO
2 等、大抵の然るべき材料から形成してよい。以下にお
いて説明するように、電子放出層27は、均一であって
もよいし、パターン形成されてもよい。
By using a uniform charge storage film 26 such as a dielectric film of a type well known in this technical field, various planar technologies well known in the technical field of display device manufacturing can be used.
Electrodes 22, 23, 24 and 25 are covered. The charge storage film 26 may be formed of almost any suitable material, such as a lead glass material. In a preferred embodiment, the charge storage film 26 is covered by a thin electron emitting layer 27. Electron emission layer 2
7 is, for example, diamond overcoat, MgO
It may be formed from most suitable materials, such as 2 . As described below, the electron emission layer 27 may be uniform or may be patterned.

【0017】図1に示すように、複数の平行なマイクロ
溝32は、底部基板14の上面内に形成される。一般的
に、マイクロ溝32は、上部基板12上に成膜される電
極22、23、24及び25に垂直である。マイクロ溝
32は、図1において上方向に延びる隔壁34によって
分離されている。各隔壁34の上端部は、上部基板12
の下面16上に成膜されている電子放出層27に接触し
ている。あるいは、マイクロ溝32及び隔壁34は、中
間ガラス層内に形成することができるが、この中間ガラ
ス層は、上部及び底部基板12と14の間に配置されて
いる(図示せず)。どちらのプロセスを用いても、マイ
クロ溝32及び隔壁34は、然るべき凝集剤を添加した
ガラスとセラミックの複合材等、選択的に結晶化する固
有の性質を有したエッチングできるガラス材料から形成
するのが好ましい。
As shown in FIG. 1, a plurality of parallel micro-grooves 32 are formed in the upper surface of the bottom substrate 14. In general, the microgrooves 32 are perpendicular to the electrodes 22, 23, 24 and 25 deposited on the upper substrate 12. The micro grooves 32 are separated by partition walls 34 extending upward in FIG. The upper end of each partition wall 34 is
Is in contact with the electron emission layer 27 formed on the lower surface 16. Alternatively, the microgrooves 32 and the partitions 34 can be formed in an intermediate glass layer, which is disposed between the top and bottom substrates 12 and 14 (not shown). With either process, the microgrooves 32 and barrier ribs 34 are formed from an etchable glass material that has the inherent properties of selectively crystallizing, such as a glass-ceramic composite with the appropriate coagulant added. Is preferred.

【0018】アドレス電極36は、以下参照記号Xで表
すが、各マイクロ溝32内に成膜される。アドレス電極
36は、発光の均一性を増し、マイクロ溝32の全面に
沿って蛍光体のコーティングを最適にするために、マイ
クロ溝32の基部及び周辺側壁に沿って成膜される。ア
ドレス電極36は、CrとAu又はCuとAu、又はイ
ンジウムスズ酸化物(ITO)とAu、又はCuとC
r、又はAg又はCrの薄膜層を、マイクロ溝表面内に
選択的に金属蒸着させることによって成膜される。金属
蒸着は、この技術分野ではよく知られている、薄膜成
膜、電子ビーム成膜、あるいは電子を用いない成膜等に
よって実施してもよい。一般的に、マイクロ溝32は、
上部基板12上に成膜される電極22、23、24及び
25に垂直であるため、アドレス電極36は、維持電極
対22及び23と協働して、直交電極マトリックスを画
成する。
The address electrodes 36 are formed in the respective micro-grooves 32 as indicated by the reference symbol X hereinafter. The address electrodes 36 are deposited along the base and peripheral sidewalls of the micro-grooves 32 to increase light emission uniformity and optimize phosphor coating along the entire surface of the micro-grooves 32. The address electrode 36 is made of Cr and Au or Cu and Au, or indium tin oxide (ITO) and Au, or Cu and C
r, or a thin film layer of Ag or Cr is formed by selectively depositing metal on the surface of the micro-groove. Metal deposition may be performed by thin film deposition, electron beam deposition, or electronless deposition, as is well known in the art. Generally, the micro grooves 32
The address electrodes 36 cooperate with the sustain electrode pairs 22 and 23 to define an orthogonal electrode matrix because they are perpendicular to the electrodes 22, 23, 24 and 25 deposited on the upper substrate 12.

【0019】また、マイクロ溝の代わりに、本発明は、
底部基板の表面において、電極22、23、24及び2
5上にまたそれらに合わせて窪みを生成することによっ
て形成される微細空隙(図示せず)を用いて実現できる
ことが理解されよう。空隙が無い表面部分は、電極2
2、23、24及び25に垂直な隔壁及び維持電極対2
2及び23とトリガ及び制御電極24及び25平行でま
たそれらを分離する仕切壁を形成する。あるいは、上記
で参照した米国特許出願番号第09/259,940号
に開示されているように、微細空隙を形成するために、
アドレス電極上にまたそれらに合わせて底部基板の表面
上に平行隔壁を形成することができる。
Also, instead of the micro grooves, the present invention provides:
On the surface of the bottom substrate, the electrodes 22, 23, 24 and 2
It will be appreciated that this can be achieved using microvoids (not shown) formed by creating depressions on and to 5 on them. The surface part without voids is the electrode 2
Partition wall and sustain electrode pair 2 perpendicular to 2, 23, 24 and 25
A partition wall is formed which is parallel to and separates the trigger and control electrodes 24 and 25 from and 2 and 23. Alternatively, to form microvoids, as disclosed in the above-referenced US patent application Ser. No. 09 / 259,940,
Parallel partitions can be formed on the address electrodes and correspondingly on the surface of the bottom substrate.

【0020】蛍光体材料38は、各アドレス電極36上
の少なくとも一部に成膜される。好適な実施形態におい
て、蛍光体材料38は、この技術分野でよく知られてい
る電気泳動法によって成膜される。蛍光体材料は、この
技術分野でよく知られている種類のものであり、フルカ
ラー表示の場合、赤、緑及び青の蛍光体は、交互に繰り
返すパターンに別々に成膜されて、個別の画素を画成す
る。PDP10の解像度は、単位面積当たりの画素数に
よって決まる。
The phosphor material 38 is formed on at least a part of each address electrode 36. In a preferred embodiment, the phosphor material 38 is deposited by electrophoresis as is well known in the art. The phosphor materials are of a type well known in the art, and for full color display, the red, green and blue phosphors are separately deposited in an alternating pattern to provide individual pixels. Is defined. The resolution of the PDP 10 is determined by the number of pixels per unit area.

【0021】溝部32は、イオン化可能な2つ以上のガ
スの釣合いの取れた混合気体で充填される。ガスは充分
なUV放射を生じ、蛍光体材料38を励起する。好適な
実施形態において、ネオン及び、キセノンとヘリウムが
5乃至20重量パーセントの混合気体が用いられる。
The groove 32 is filled with a balanced gaseous mixture of two or more ionizable gases. The gas produces sufficient UV radiation to excite the phosphor material 38. In a preferred embodiment, neon and a mixture of xenon and helium at 5 to 20 weight percent are used.

【0022】上部基板電極22、23、24及び25の
配列を図2に示す。図2において、電極22、23、2
4及び25は、斜線を付して電極パターンを示す。上部
の4つの電極は、参照符号38で表わされる電極の第1
グループを形成する。グループ38は、図の上部にある
制御電極25を含む。また、制御電極25は、補助電極
あるいは第2補助電極と呼ぶことができる。補助電極2
5は、図2の左側にある制御電極25´に接続される。
以下において説明するように、パッド25´によって、
制御電極25と制御電圧ドライバ間は電気的に接続され
る。図2において制御電極25から下方に進むと、第1
グループ38における次の電極は、第2維持電極23で
あり、この維持電極は、同様に図2の左側にある第2維
持電極パッド23´に接続される。第2維持電極23は
また、参照文字「Z」で表す。図2において下方に更に
進むと、図2の右側の第1維持電極パッド22´に接続
される第1維持電極22が第2維持電極パッド23に隣
接する。また、第1維持電極パッド22は参照文字
「Y」で表す。第1グループ38における底部電極はト
リガ電極24であり、このトリガ電極は、同様に図2の
右側にあるトリガ電極パッド24´に接続される。トリ
ガ電極24はまた、参照文字“T”で表す。また、トリ
ガ電極24は、補助電極電極あるいは第1補助電極と呼
ぶことができる。このように、第1グループ38におけ
る電極の向きは、図1に示したものと同じである。
The arrangement of the upper substrate electrodes 22, 23, 24 and 25 is shown in FIG. In FIG. 2, electrodes 22, 23, 2
Reference numerals 4 and 25 denote electrode patterns with diagonal lines. The top four electrodes are the first of the electrodes designated by reference numeral 38.
Form a group. Group 38 includes control electrode 25 at the top of the figure. Further, the control electrode 25 can be called an auxiliary electrode or a second auxiliary electrode. Auxiliary electrode 2
5 is connected to the control electrode 25 'on the left side of FIG.
As described below, the pad 25 '
The control electrode 25 and the control voltage driver are electrically connected. In FIG. 2, when proceeding downward from the control electrode 25, the first
The next electrode in group 38 is a second storage electrode 23, which is also connected to a second storage electrode pad 23 'on the left side of FIG. The second sustain electrode 23 is also denoted by a reference letter “Z”. 2, the first storage electrode 22 connected to the first storage electrode pad 22 ′ on the right side of FIG. 2 is adjacent to the second storage electrode pad 23. The first sustain electrode pad 22 is represented by a reference character “Y”. The bottom electrode in the first group 38 is the trigger electrode 24, which is also connected to the trigger electrode pad 24 'on the right side of FIG. Trigger electrode 24 is also designated by the reference letter "T". Further, the trigger electrode 24 can be called an auxiliary electrode electrode or a first auxiliary electrode. Thus, the orientation of the electrodes in the first group 38 is the same as that shown in FIG.

【0023】電極グループ38に対して示された電極の
向きは、図2における電極の残りのグループに対して繰
り返される。従って、第1グループ38直下の電極40
の第2グループは、上部に制御電極45を有しており、
この制御電極は、図2の左側の制御電極パッド45´に
接続されている。第2グループ40の上部からの第2電
極は、第2維持電極43であり、この維持電極は、図2
の左側の第2維持電極パッド43´に接続される。第3
電極は第1維持電極42であり、この維持電極は、右の
第1維持電極パッド42´に接続され、一方、第2グル
ープにおける底部電極は、トリガ電極パッド44´に接
続されるトリガ電極44であり、これもまた図右側にあ
る。図2における残りの電極は、文字で識別し、電極の
パターンを示す。C、Z、Y及びTの参照符号文字から
分かるように、このパターンは、後に続く電極のグルー
プ各々に対して繰り返えされる。個別の電極パッドは各
々電極と関連付けられ、従来のプラズマ表示パネルの電
圧ドライバに接続され、パネルのマイクロ溝32の対応
する部位内でプラズマ放電を選択的に起こす。
The orientation of the electrodes shown for electrode group 38 is repeated for the remaining groups of electrodes in FIG. Therefore, the electrode 40 immediately below the first group 38
Has a control electrode 45 on the top,
This control electrode is connected to the control electrode pad 45 'on the left side of FIG. The second electrode from the top of the second group 40 is a second storage electrode 43, which is shown in FIG.
Is connected to the second sustain electrode pad 43 'on the left side of the line. Third
The electrode is a first storage electrode 42, which is connected to the right first storage electrode pad 42 ', while the bottom electrode in the second group is a trigger electrode 44 which is connected to a trigger electrode pad 44'. Which is also on the right side of the figure. The remaining electrodes in FIG. 2 are identified by letters and indicate the electrode pattern. As can be seen from the reference letters C, Z, Y and T, this pattern is repeated for each subsequent group of electrodes. The individual electrode pads are each associated with an electrode and are connected to a voltage driver of a conventional plasma display panel to selectively cause a plasma discharge within a corresponding portion of the panel microgroove 32.

【0024】図3に示すように、発明者らは、プラズマ
表示パネルにおいて電極の交互配列を考えている。図3
における電極の上部グループは、図2に示す電極の上部
グループと同じ順序で形成される。従ってまた、上部グ
ループは図3において参照符号38で表され、上部から
下方向への電極の順序は、制御電極C、第2維持電極
Z、第1維持電極Yそしてトリガ電極Tである。図3に
おける電極の第2グループは参照記号50で表され、第
1グループ38の鏡像として上部基板12上に形成され
る。従って、第2グループ50における上部電極は、ト
リガ電極Tであり、グループ50の上部からの第2電極
は第1維持電極Yである。同様に、第3電極は、第2維
持電極Zであり、一方、グループ50における底部電極
は制御電極Cである。維持電極Y及びZに関連付けられ
た電極パッドは、図3の右側にあり、一方、制御及びト
リガ電極C及びTに関連付けられた電極パッドは図3の
左側にあることに留意されたい。各グループにおける電
極パターンの交互配列は、表示パネル10全体にわたっ
て繰り返される。従って、電極55の第3グループは、
第1グループ38と同じパターンを有し、一方、第4グ
ループ60は、第2グループ50のパターンを繰り返
す。
As shown in FIG. 3, the inventors have considered an alternate arrangement of electrodes in a plasma display panel. FIG.
Are formed in the same order as the upper group of electrodes shown in FIG. Accordingly, the upper group is represented by reference numeral 38 in FIG. 3, and the order of the electrodes from the top to the bottom is the control electrode C, the second sustain electrode Z, the first sustain electrode Y, and the trigger electrode T. The second group of electrodes in FIG. 3 is designated by the reference numeral 50 and is formed on the upper substrate 12 as a mirror image of the first group 38. Therefore, the upper electrode in the second group 50 is the trigger electrode T, and the second electrode from above the group 50 is the first sustain electrode Y. Similarly, the third electrode is a second sustain electrode Z, while the bottom electrode in group 50 is a control electrode C. Note that the electrode pads associated with sustain electrodes Y and Z are on the right side of FIG. 3, while the electrode pads associated with control and trigger electrodes C and T are on the left side of FIG. The alternate arrangement of the electrode patterns in each group is repeated over the entire display panel 10. Thus, a third group of electrodes 55
The fourth group 60 has the same pattern as the first group 38, while the fourth group 60 repeats the pattern of the second group 50.

【0025】図3に示す各電極グループにおける、維持
電極Y及びZは反転されるために、第1及び第2維持電
極は、共通電極パッドに電気的に接続できる。従って、
図3において、第1電極グループ38における第1維持
電極22(Y)及び第2電極グループ50における第1
維持電極42(Y)は、共通第2維持電極パッド62
(Y´)に電気的に接続される。同様に、第2電極グル
ープ50における第2維持電極43(Z)及び第3電極
グループ55における第2維持電極64(Z)は、共通
第2維持電極パッド66(Z´)に電気的に接続され
る。図3において実際には存在しないパッドによって示
すように、図2に示す従来技術の電極の配列と比較する
と、パネル10の右側にある維持電極パッドの約半分が
削減されている。従って、本発明によって、電気的な接
続及び関連したドライバ回路の数を、従来技術による表
示パネルから大幅に減らすことができる。従って、本発
明によって、プラズマ表示パネル10の組み立てコスト
が大幅に下がることが考えられる。
Since the sustain electrodes Y and Z in each electrode group shown in FIG. 3 are inverted, the first and second sustain electrodes can be electrically connected to the common electrode pad. Therefore,
3, the first sustain electrode 22 (Y) in the first electrode group 38 and the first sustain electrode 22 (Y) in the second electrode group 50
Sustain electrode 42 (Y) is provided with common second sustain electrode pad 62.
(Y ′). Similarly, the second storage electrode 43 (Z) in the second electrode group 50 and the second storage electrode 64 (Z) in the third electrode group 55 are electrically connected to the common second storage electrode pad 66 (Z ′). Is done. Compared to the prior art electrode arrangement shown in FIG. 2, about half of the sustain electrode pads on the right side of panel 10 are reduced, as indicated by the pads that do not actually exist in FIG. Therefore, according to the present invention, the number of electrical connections and associated driver circuits can be significantly reduced from the prior art display panel. Therefore, according to the present invention, it is considered that the cost of assembling the plasma display panel 10 is greatly reduced.

【0026】電極に関連付けられたドライバを、図4に
示すパネル10の平面図に示す。図4におけるパネルの
図面は、理解しやすいように簡略化してある。図3に示
す上部基板電極のパターンは、底部基板14上に形成さ
れるアドレス電極32及び隔壁34を追加して、図4に
繰り返して示す。上述したように、一般的に、アドレス
電極32および隔壁34は、上部基板電極に垂直であ
る。図4に示すように、アドレス電極32は、文字
“X”で識別される。また、電極ドライバの模式図を図
4に示す。底部基板電極の6つのグループ及び5つのア
ドレス電極は、図4に示されるが、30画素の6×5ア
レイを画成する。また図4に示す回路が、大小を問わず
どのような配列にも適用できることが理解されるであろ
う。
The drivers associated with the electrodes are shown in the plan view of panel 10 shown in FIG. The panel drawing in FIG. 4 is simplified for easy understanding. The pattern of the upper substrate electrode shown in FIG. 3 is repeated in FIG. 4 with the addition of the address electrode 32 and the partition wall 34 formed on the bottom substrate 14. As described above, generally, the address electrode 32 and the partition 34 are perpendicular to the upper substrate electrode. As shown in FIG. 4, the address electrodes 32 are identified by the letter “X”. FIG. 4 shows a schematic diagram of the electrode driver. The six groups of bottom substrate electrodes and the five address electrodes, shown in FIG. 4, define a 6 × 5 array of 30 pixels. It will also be appreciated that the circuit shown in FIG. 4 can be applied to any arrangement, large or small.

【0027】各ドライバは電圧電源から成り、この電圧
電源は従来のスイッチによって関連する電極に選択的に
接続される。従って、図4の右側に示すように、第1維
持電極Yの対は、共通電極パッドY´及び参照符号SY
で表される従来の電子スイッチを介して、参照符号VY
で表される第1維持電圧電源に選択的に接続される。第
1維持電圧電源は、以下において説明する第1維持電圧
波形を発生する。図面を簡略にするために、電子スイッ
チを制御するための論理回路は、図4からは割愛してい
る。同様に、第2維持電極Zの対は、共通電極パッドZ
´及び参照符号SZ で表される従来の電子スイッチを介
して、参照符号VZ で表される第2維持電圧電源に選択
的に接続される。第2維持電圧電源VZ は、以下におい
て説明する第2維持電圧波形を発生する。図4の左側
で、トリガ電極Tは、電極パッドT´及びST1から参照
符号ST6で表される個別の従来の電子スイッチを介し
て、参照符号VT で表されるトリガ電圧電源に選択的に
接続される。トリガ電圧電源V T は、以下において説明
するようなトリガ電圧波形を発生する。制御電極Cは、
電極パッドC´及び参照符号SC で表される従来の電子
スイッチを介して、参照符号VC で表される制御電圧電
源に選択的に連結される。最後に、アドレス電極Xは、
参照符号SX1からSX6で表される従来の電子スイッチを
介して、参照符号VX で表されるアドレス電圧電源に選
択的に接続される。アドレス電圧電源VXは、以下にお
いて説明するアドレス電圧波形を発生する。
Each driver comprises a voltage power supply,
Power is selectively applied to the relevant electrodes by conventional switches
Connected. Therefore, as shown on the right side of FIG.
The pair of the holding electrodes Y includes a common electrode pad Y ′ and a reference symbol S.Y
Via a conventional electronic switch represented byY
Is selectively connected to a first sustain voltage power supply represented by No.
The first sustain voltage power source is a first sustain voltage described below.
Generate a waveform. To simplify the drawing, electronic switches
The logic circuit for controlling the switches is omitted from FIG.
You. Similarly, the pair of the second sustain electrodes Z is connected to the common electrode pad Z
'And reference symbol SZVia a conventional electronic switch represented by
And the referenceZSelected as the second sustain voltage power supply represented by
Connected. Second sustain voltage power supply VZSmells like
A second sustain voltage waveform described below is generated. Left side of FIG.
Then, the trigger electrode T is composed of the electrode pads T ′ and ST1Reference from
Sign ST6Via a separate conventional electronic switch represented by
And the reference symbol VTSelectively for the trigger voltage power supply represented by
Connected. Trigger voltage power supply V TIs explained below
Generates a trigger voltage waveform. The control electrode C is
Electrode pad C 'and reference symbol SCConventional electron represented by
Via the switch, the reference VCThe control voltage expressed by
Selectively coupled to the source. Finally, the address electrode X is
Reference symbol SX1To SX6A conventional electronic switch represented by
Via the reference symbol VXSelected as the address voltage power supply
Selectively connected. Address voltage power supply VXBelow
To generate an address voltage waveform described below.

【0028】共通維持電極パッドY´及びZ´のため
に、維持電圧波形は、プラズマ表示パネル10の動作中
に、隣接する電極グループにおいて、第1及び第2維持
電極Y及びZの対に同時に印加される。しかしながら、
トリガ電圧波形のトリガ電極Tへの選択的な印加によっ
て、表示パネル10でのプラズマ放電の発生が制御され
る。
Due to the common sustain electrode pads Y 'and Z', the sustain voltage waveform is simultaneously applied to the first and second pairs of sustain electrodes Y and Z in adjacent electrode groups during operation of the plasma display panel 10. Applied. However,
By selectively applying the trigger voltage waveform to the trigger electrode T, generation of plasma discharge in the display panel 10 is controlled.

【0029】本発明の他の実施形態を図5に示すが、こ
こでは図3に示す構成要素と同様な構成要素は、同じ参
照符号を有する。図5における上部基板電極のパターン
は、図3に示したものと同じであるが、電極の電極パッ
ドへの接続は異なる。図5の左側において、隣接するト
リガ電極対は、共通トリガ電極パッドT´に接続され、
一方、隣接する制御電極Cの対は、共通制御電極パッド
C´に接続される。従って、トリガ電極パッドT´の数
は半分に減らされ、また、制御電極パッドC´の数は約
半分に減らされる。後述するように、維持電極Y及びZ
の対は、図5の右側において、各々、関連付けられた維
持電極パッドY´及びZ´あるいはY"及びZ"にそれぞ
れに接続されて放電を制御する。図3及び4に示すPD
Pと同様に、トリガ及び制御電極パッドT´及びC´の
数を減らすことによって、従来の技術の表示パネルか
ら、電気的な接続部及び関連したドライバ回路の数を更
にまた大幅に減らすことができる。従って、本発明によ
って、プラズマ表示パネル10の組み立てコストが大幅
に下がることが考えられる。
Another embodiment of the present invention is shown in FIG. 5, where components similar to those shown in FIG. 3 have the same reference numerals. The pattern of the upper substrate electrode in FIG. 5 is the same as that shown in FIG. 3, but the connection of the electrode to the electrode pad is different. On the left side of FIG. 5, adjacent trigger electrode pairs are connected to a common trigger electrode pad T ′,
On the other hand, a pair of adjacent control electrodes C is connected to a common control electrode pad C ′. Therefore, the number of trigger electrode pads T 'is reduced by half, and the number of control electrode pads C' is reduced by about half. As described later, sustain electrodes Y and Z
5 are respectively connected to the associated sustain electrode pads Y ′ and Z ′ or Y ″ and Z ″ on the right side of FIG. 5 to control the discharge. PD shown in FIGS. 3 and 4
As with P, reducing the number of trigger and control electrode pads T 'and C' further reduces the number of electrical connections and associated driver circuits from prior art display panels even further. it can. Therefore, according to the present invention, it is considered that the cost of assembling the plasma display panel 10 is greatly reduced.

【0030】電極に関連付けられたドライバを、図6に
示すパネル10の平面図において、他の実施形態用とし
て示す。上記のように、図6におけるパネルの図面は、
理解しやすいように簡略化してある。図4に示す構成要
素と同様な図6に示す構成要素は同じ参照符号を有す
る。上述したように、ドライバは、従来の電子スイッチ
を介して、関連付けられたドライバに選択的に連結され
た電圧電源から成る。一方、6×5アレイを図6に示す
が、本発明はまた、大きいアレイでも小さいアレイ上で
も実現されうることが理解されるであろう。図6に示す
ように、トリガ電極T用の電子スイッチの数は、6か
ら、図4に示すように、3に削減されている。加えて、
制御電極の数は、6から4に削減されている。
The driver associated with the electrodes is shown in a plan view of panel 10 shown in FIG. 6 for another embodiment. As described above, the drawing of the panel in FIG.
Simplified for easy understanding. Components shown in FIG. 6 that are similar to components shown in FIG. 4 have the same reference numerals. As mentioned above, the driver comprises a voltage power supply selectively coupled to the associated driver via a conventional electronic switch. On the other hand, while a 6 × 5 array is shown in FIG. 6, it will be understood that the invention can also be implemented on large or small arrays. As shown in FIG. 6, the number of electronic switches for the trigger electrode T is reduced from six to three as shown in FIG. in addition,
The number of control electrodes has been reduced from six to four.

【0031】共通トリガ電極パッドT´のために、トリ
ガ電圧波形は、プラズマ表示パネル10の動作中に、隣
接するトリガ電極Tの対に同時に印加される。トリガ電
圧が隣接するトリガ電極対に印加されるために、隣接す
る維持電極対は、参照符号S Z 、SY 、SZ'' 及びS
Y'' で表される4つの電子スイッチを介して接続される
個別の維持電圧電源によって供給される。従って、特定
の画素において放電を行うために、トリガ電圧及び維持
電圧が両方とも存在しなければならない。従って、維持
電圧波形の維持電極対Y及びZへの選択的な印加は、ト
リガ電圧と協働して、表示パネル10の特定画素に対す
るプラズマ放電の発生を制御する。4つの維持電圧電源
を図6に示すが、本発明はまた、Z電極電子スイッチS
Z'及びSZ' ' 両方に供給する1つの電圧電源VZ 及びY
電極電子スイッチSY'及びSY'' (図示せず)両方に供
給する1つの電圧電源VY を用いて実現できる。
For the common trigger electrode pad T ',
When the plasma display panel 10 is in operation,
It is simultaneously applied to the pair of trigger electrodes T that are in contact. Trigger power
Pressure is applied to adjacent pairs of trigger electrodes,
The pair of sustain electrodes is denoted by reference symbol S. Z, SY, SZ ''And S
Y ''Connected via four electronic switches represented by
It is supplied by a separate sustain voltage power supply. Therefore, specific
Trigger voltage and sustain to discharge in pixels
Both voltages must be present. Therefore, maintain
The selective application of the voltage waveform to the sustain electrode pairs Y and Z
In cooperation with the trigger voltage, a specific pixel of the display panel 10
Control the generation of plasma discharge. 4 sustain voltage power supplies
FIG. 6 shows that the present invention also provides a Z-electrode electronic switch S
Z 'And SZ ' 'One voltage power supply V that supplies bothZAnd Y
Electrode switch SY 'And SY ''(Not shown)
One voltage power supply VYIt can be realized by using

【0032】また本発明は、表示パネル10の更に効率
的な動作を目的としている。ここで、PDP10の動作
については、図7に示す電圧波形の観点から説明を行
う。同じ電圧波形を、図4及び6に示す両回路の実施形
態に用いる。上述したように、電圧電源は、図示したよ
うな形状を有する電圧波形を発生し、一方、波形を関連
付けられた電極に印加するために、電子スイッチが選択
的に閉じられる。
Further, the present invention aims at more efficient operation of the display panel 10. Here, the operation of the PDP 10 will be described from the viewpoint of the voltage waveform shown in FIG. The same voltage waveform is used for both circuit embodiments shown in FIGS. As described above, the voltage power supply generates a voltage waveform having the shape as shown, while the electronic switch is selectively closed to apply the waveform to the associated electrode.

【0033】最初に、プラズマ表示パネル10は、t1
とt2 の間で予め調整される。事前調整には、逆極性の
電圧波形を維持電極Y及びZに、負方向の電圧をトリガ
電極Tに印加することが含まれる。その結果、全ての壁
電荷がマイクロ溝32の側面から除去される。事前調整
段階は、起動の際あるいは新しい表示を行う場合のよう
に、表示パネル10を全てクリアしたい場合に用いられ
る。事前調整された状態は、t2 とt3 間において、参
照符号VY 及びVZ で表される曲線によって示されるよ
うに、交流電圧を維持電極Y及びZに印加することによ
って維持できる。交流維持電圧の1周期のみを図7に示
すが、壁電荷は、交流電圧を印加しつづけることによっ
て、より長時間維持できる。表示パネル10全体がクリ
アされるために、事前調整及びその維持は、“一括消
去”と呼ばれることがある。
First, the plasma display panel 10 operates at t 1.
And t 2 are pre-adjusted. The pre-adjustment includes applying voltage waveforms of opposite polarities to sustain electrodes Y and Z and applying a negative voltage to trigger electrode T. As a result, all the wall charges are removed from the side surfaces of the micro grooves 32. The pre-adjustment stage is used when it is desired to clear the entire display panel 10, such as when starting up or when performing a new display. Preconditioned state, between t 2 and t 3, as indicated by the curve represented by the reference numeral V Y and V Z, can be maintained by applying an AC voltage to the sustain electrodes Y and Z. Although only one cycle of the AC maintaining voltage is shown in FIG. 7, the wall charge can be maintained for a longer time by continuously applying the AC voltage. The pre-adjustment and its maintenance because the entire display panel 10 is cleared may be referred to as "batch erase".

【0034】書込みに備えてパネル10を準備するため
に、第1及び第2維持電圧は両方とも、t3 からt4
かけて負になり、一方、トリガ電圧は正になる。図8に
示すように、これらの電圧によって、短時間のプラズマ
放電70が生成されるが、このプラズマ放電は、上部基
板12のトリガ電極Tと底部基板14の対向アドレス電
極X間のマイクロ溝32を横切って延びる。プラズマ放
電70は、陰極降下領域72及びプラズマ柱74を含
む。プラズマ放電70によって、壁電荷76は、放電7
0を含む隣接するマイクロ溝32の側壁上に形成され
る。維持電極電圧がt4 で再び交流変動を始める時、プ
ラズマ放電70は消滅するが、図9に示すように、壁電
荷76は残留する。壁電荷を、図7の下部において、参
照符号VY −VZ 及びVT −VX で表される電圧波形に
おける破線で示す。ここで、パネル10の関連付けられ
た部分は、書込みに備えて準備されたことになる。従っ
て、t 1 とt5 間の電圧曲線部は、“立上げ”フェーズ
と呼ばれることが多い。図7において、t5 からt6
かけて示すように、壁電荷は維持電圧VY 及びVZ を交
互に繰り返すことによって保持される。
To prepare panel 10 for writing
In addition, the first and second sustaining voltages are both tThreeTo tFourTo
And the trigger voltage becomes positive. In FIG.
As shown, these voltages cause a short plasma
A discharge 70 is generated, but this plasma discharge is
Address electrode between the trigger electrode T of the plate 12 and the bottom substrate 14
It extends across the microgroove 32 between the poles X. Plasma discharge
The electricity 70 includes a cathode fall region 72 and a plasma column 74.
No. Due to the plasma discharge 70, the wall charges 76 are discharged.
0 formed on the side walls of adjacent micro-grooves 32
You. The sustain electrode voltage is tFourWhen the AC fluctuation starts again,
Although the plasma discharge 70 disappears, as shown in FIG.
The load 76 remains. The wall charge is shown at the bottom of FIG.
Reference code VY-VZAnd VT-VXThe voltage waveform represented by
This is indicated by a broken line in FIG. Here, the association of panel 10
The part which has been prepared is prepared for writing. Follow
And t 1And tFiveThe voltage curve during the “start-up” phase
Often called. In FIG. 7, tFiveTo t6To
As shown, the wall charge is equal to the sustain voltage VYAnd VZExchange
It is kept by repeating each other.

【0035】t6 において、選択された画素を発光させ
る書込みが実際に始まる。アドレス電極Xに印加された
電圧波形は正になり、一方、第1及び第2維持電圧は各
々負及び正になる。その結果、プラズマ放電柱80は、
マイクロ溝32において再び発生する。図10に示すよ
うに、柱80は、トリガ及び第1維持電極T及びYか
ら、マイクロ溝32内を横方向に、第2維持電極Zに向
かって弧を描く。柱80は、イオン化されたガスから成
り、正に帯電しているイオン及び負に帯電している電子
を含み、マイクロ溝32に成膜された蛍光体38を励起
する。励起された蛍光体38は可視光を放出する。t7
において、図11に示すように、維持電圧は再び繰り返
しを開始し、プラズマ柱80を維持し、それによって、
関連付けられた画素が光を放出し続ける。
At t 6 , writing for causing the selected pixel to emit light actually starts. The voltage waveform applied to the address electrode X becomes positive, while the first and second sustain voltages become negative and positive, respectively. As a result, the plasma discharge column 80
It occurs again in the micro groove 32. As shown in FIG. 10, the pillar 80 draws an arc from the trigger and the first storage electrodes T and Y in the micro groove 32 to the second storage electrode Z in the lateral direction. The column 80 is made of ionized gas, contains positively charged ions and negatively charged electrons, and excites the phosphor 38 formed in the microgroove 32. The excited phosphor emits visible light. t 7
At, as shown in FIG. 11, the sustaining voltage starts repeating again, maintaining the plasma column 80, thereby
The associated pixel continues to emit light.

【0036】発明者らが見出したことは、上述したプラ
ズマ表示パネルを用いて、100ボルト未満の比較的低
いトリガ電圧は、280乃至380ボルトの比較的高い
維持電圧に対してプラズマ放電80を起動できるが、こ
の維持電圧は、この技術分野で知られている180乃至
200ボルトの一般的な維持電圧よりも相当高い。図1
0及び11に示すように、維持電圧が高くなると、溝部
内のより深部でプラズマ放電80が行われる。放電80
がマイクロ溝32内により深く侵入すると、より多くの
蛍光体38が励起され、表示の輝度が高まる。加えて、
維持電圧が高くなると、表示装置の駆動に必要な電流量
を減らすことによって、パネル10の効率が改善する。
The inventors have found that using the above-described plasma display panel, a relatively low trigger voltage of less than 100 volts triggers a plasma discharge 80 for a relatively high sustaining voltage of 280-380 volts. Although possible, this maintenance voltage is significantly higher than the typical 180-200 volt maintenance voltage known in the art. FIG.
As shown in FIGS. 0 and 11, when the sustaining voltage increases, the plasma discharge 80 occurs deeper in the groove. Discharge 80
Penetrates deeper into the micro-grooves 32, more phosphors 38 are excited and the display brightness is increased. in addition,
As the sustain voltage increases, the efficiency of panel 10 improves by reducing the amount of current required to drive the display.

【0037】図4及び6に示すように、本発明は、個別
のトリガ及び維持電圧電源VT 、V Y 及びVZ について
検討する。従来技術のパネルにおいては、一般的に、同
じ電圧電源を用いて、トリガ及び維持電圧を供給してい
た。このことによって、スイッチ回路が複雑になったば
かりでなく、維持電圧の大きさが制限されていた。従っ
て、個別のトリガ電圧電源VT を備えることによって、
上述したように、維持電圧の大きさを高めることができ
る。
As shown in FIGS. 4 and 6, the present invention
Trigger and maintenance voltage power supply VT, V YAnd VZabout
consider. In prior art panels, this is generally the case.
Supply the trigger and maintenance voltage using the same voltage source.
Was. If this complicates the switch circuit,
In addition, the magnitude of the maintenance voltage was limited. Follow
And individual trigger voltage power supply VTBy having
As described above, the magnitude of the sustain voltage can be increased.
You.

【0038】上述したように、立上げの開始部分によっ
て、パネル内のセルが消される。同様の維持及びトリガ
電圧は、選択電極に印加されて、特定のセルを消去でき
る。しかしながら、一般的に、この消去によって、セル
の短い低レベルの発光が発生する。低レベルの発光は、
パネル10上に現れる画像のコントラストを減らす可能
性がある。従って、本発明はまた、傾斜した維持電圧
(図示せず)を印加することを検討して、消去動作中の
発光を除去する。傾斜した電圧によって、図12に示す
ように、壁電荷86が局在化することになる。
As described above, the start-up portion erases cells in the panel. Similar hold and trigger voltages can be applied to select electrodes to erase specific cells. However, in general, this erasure causes a short, low level emission of the cell. The low level emission is
There is a possibility that the contrast of the image appearing on the panel 10 is reduced. Therefore, the present invention also considers applying a ramped sustain voltage (not shown) to eliminate light emission during the erase operation. The ramped voltage causes the wall charge 86 to be localized, as shown in FIG.

【0039】本発明は更に、制御電圧波形をパネル10
に印加することを検討する。このような制御電圧波形
は、制御電圧電源VC によって発生され、図4及び6の
回路図で示すように、単一の従来の電子スイッチS C
を介して印加される。関連付けられた制御電圧波形は、
図7における上部の曲線として示される。制御電圧波形
は、維持電圧を補って、プラズマ柱80がマイクロ溝3
2内に確実に深く入り込むようにするか、そうでなけれ
ば、確実に柱80の形状を制御するようにする。
The present invention further provides a control voltage waveform
Consider applying to. Such a control voltage waveform is generated by the control voltage power supply V C and, as shown in the circuit diagrams of FIGS. 4 and 6, a single conventional electronic switch S C
Is applied. The associated control voltage waveform is
This is shown as the upper curve in FIG. The control voltage waveform compensates for the sustain voltage, and the plasma pillar 80
2 to ensure that it is deeply inserted, or else control the shape of the column 80.

【0040】また、本発明は、プラズマ表示パネル上の
選択された画素を選択的に消去するための方法を検討す
る。パネル電極に印加されて画素を消去する電圧を、図
13に示す。図13において、t8 からt9 にかけて、
プラズマ放電が存在し、維持されていると仮定する。図
において水平軸に沿って示される時間は、前述の図7に
おいて示される時間に続いている。t9 において、選択
消去が開始される。t 10において、維持電極Y及びZ上
の電圧は、ゼロに減らされ、ゼロのままで持続される
が、一方、パルスは、特定の画素に対して、トリガ及び
アドレス電極T及びXに印加される。トリガ及び電極パ
ルスは、減少した維持電極電圧と協働して、発光した画
素を消去する。そして、t11において、電圧は通常の維
持値に戻る。消去されたセルは、プラズマ放電を再び発
生させるために必要な壁電荷を保持するが、電極に印加
される電圧は、別の放電を引き起こすには不十分であ
る。プラズマ放電を再開するために、図7においてt6
からt7 にかけて示すように、対応するトリガ及びアド
レス電極T及びXにパルスを印加しつつ、維持電極Y及
びZに印加される電圧を、逆の電圧に保つことが必要で
ある。従って、消去段階によって、セルは放電再開のた
めの条件下におかれる。
The present invention also relates to a plasma display panel.
Consider a method for selectively erasing selected pixels
You. The voltage applied to the panel electrodes to erase pixels is shown in the figure.
FIG. In FIG. 13, t8To t9To
Assume that a plasma discharge exists and is maintained. Figure
The time shown along the horizontal axis in FIG.
Lasts for the time indicated. t9In, select
Erasure is started. t Ten, On the sustain electrodes Y and Z
Voltage is reduced to zero and remains at zero
However, on the other hand, the pulse triggers and
It is applied to address electrodes T and X. Trigger and electrode pad
Lus works in concert with the reduced sustain electrode voltage to
Erase element. And t11Voltage is normal
Return to the offer. The erased cell will regenerate the plasma discharge
Holds the wall charges necessary to generate
Voltage is not enough to cause another discharge
You. In order to restart the plasma discharge, in FIG.6
To t7Corresponding triggers and
While applying a pulse to the electrodes T and X, the electrodes Y and
It is necessary to keep the voltage applied to
is there. Therefore, the cell was restarted by the erase step.
Condition.

【0041】トリガ及び制御電極T及びCに印加される
電圧の大きさが、図7及び13両方において、変動して
いることに留意されたい。この変動は、本発明の一部と
して含まれる放電形状及び深度を調整する性能を表す。
It should be noted that the magnitude of the voltage applied to the trigger and control electrodes T and C varies in both FIGS. This variation represents the ability to adjust the discharge shape and depth included as part of the present invention.

【0042】更に本発明は、図3及び4に図示するPD
Pにおける他の回路の実施形態について考える。他の実
施形態を図14に示すが、ここで、隣接する電極グルー
プにおける維持電極Y及びZは、単一接点パッドY´及
びZ´によって共に接続され、電源供給される。電極
は、図3及び4に示すものより、図14の上部から底部
において異なるシーケンスにあるが、維持電極Y及び
Z、トリガ電極T及び制御電極Cの隣接するグループ
は、互いの鏡像として配列されていることに留意された
い。加えて、図14に示す回路接続は、図3に示すPD
P電極の方向にも適用できる。
Further, the present invention relates to the PD shown in FIGS.
Consider another circuit embodiment at P. Another embodiment is shown in FIG. 14, where the sustain electrodes Y and Z in adjacent electrode groups are connected together and powered by single contact pads Y 'and Z'. The electrodes are in a different sequence from the top to the bottom of FIG. 14 than shown in FIGS. 3 and 4, but adjacent groups of sustain electrodes Y and Z, trigger electrode T and control electrode C are arranged as mirror images of one another. Note that In addition, the circuit connection shown in FIG.
It can be applied to the direction of the P electrode.

【0043】図14における上部Y電極は、電極スイッ
チSY を介して、参照符号VY で表される維持電圧電源
に接続される右端部13及び第2電極グループにおける
Y電極の左端に図の上部から接続される左端部を有す
る。上部Z電極は、第2グループにおけるZ電極の左端
部に図の上部から接続される左端部を有する。第2グル
ープのZ電極もまた、電極スイッチSZ を介して、参照
符号VZ で表される維持電圧電源に接続される右端部を
有する。図示された維持電圧電源VZ 及びVY への接続
によって、接触パッドの数が減り、ドライバ回路が簡略
化されるだけでなく、維持電極Z及びYにおける電圧降
下も補償される。電圧は、Z及びY維持電極の複合対の
反対側端部に印加されるために、各維持電極対の間の電
圧差及び微細空隙両端の電圧差は、電極に沿って電圧降
下があっても、変わらない。制御電極パッドC´は、パ
ネルの右側に移されて、接続用の配線とY及びZ電極端
部を接続する配線との交差を防ぐ。
The upper Y electrode in FIG. 14 is connected, via an electrode switch S Y , to the right end 13 connected to a sustain voltage power supply represented by the reference numeral V Y and the left end of the Y electrode in the second electrode group. It has a left end connected from the top. The upper Z electrode has a left end connected to the left end of the Z electrode in the second group from the top in the figure. Z electrode of the second group also through the electrode switch S Z, has a right end that is connected to the sustain voltage source, represented by reference numeral V Z. The connection to the illustrated sustain voltage sources V Z and V Y not only reduces the number of contact pads and simplifies the driver circuit, but also compensates for the voltage drop across the sustain electrodes Z and Y. Since the voltage is applied to the opposite end of the composite pair of Z and Y sustain electrodes, the voltage difference between each sustain electrode pair and the voltage difference across the micro-gap has a voltage drop along the electrodes. Does not change. The control electrode pad C 'is moved to the right side of the panel to prevent the connection wiring from intersecting with the wiring connecting the ends of the Y and Z electrodes.

【0044】図14に示すPDPの動作は、上述したも
のと同じである。特許法の規定に従って、本発明の動作
の原理及び方法を、好適な実施形態において示してき
た。しかしながら、本発明は、発明の精神あるいは範囲
から逸脱することなく、具体的に示したものとは別の方
法で実現されうることを理解されたい。従って、図4、
6及び13に示す維持及び制御電極のためのドライバ回
路も図2に示す従来の技術の電極構造(図示せず)に適
用することができる。
The operation of the PDP shown in FIG. 14 is the same as that described above. In accordance with the provisions of the patent statutes, the principles and methods of operation of the present invention have been shown in preferred embodiments. It should be understood, however, that the invention may be practiced otherwise than as specifically set forth without departing from the spirit or scope of the invention. Therefore, FIG.
Driver circuits for the maintenance and control electrodes shown in FIGS. 6 and 13 can also be applied to the prior art electrode structure (not shown) shown in FIG.

【0045】[0045]

【発明の効果】上述したプラズマ表示パネルを用いて、
100ボルト未満の比較的低いトリガ電圧は、280乃
至380ボルトの比較的高い維持電圧に対してプラズマ
放電80を起動できるが、この維持電圧は、この技術分
野で知られている180乃至200ボルトの一般的な維
持電圧よりも相当高い。維持電圧が高くなると、溝部内
のより深部でプラズマ放電80が行われる。放電80が
マイクロ溝32内により深く侵入すると、より多くの蛍
光体38が励起され、表示の輝度が高まる。加えて、維
持電圧が高くなると、表示装置の駆動に必要な電流量を
減らすことによって、パネル10の効率が改善する。
According to the plasma display panel described above,
A relatively low trigger voltage of less than 100 volts can trigger the plasma discharge 80 for a relatively high sustain voltage of 280-380 volts, which can be between 180 and 200 volts as known in the art. It is much higher than a typical sustain voltage. When the sustain voltage increases, the plasma discharge 80 is performed deeper in the groove. As the discharge 80 penetrates deeper into the microgrooves 32, more phosphors 38 are excited and the display brightness increases. In addition, as the sustain voltage increases, the efficiency of panel 10 improves by reducing the amount of current required to drive the display.

【図面の簡単な説明】[Brief description of the drawings]

【図1】 プラズマ表示パネルの透視図である。FIG. 1 is a perspective view of a plasma display panel.

【図2】 図1に示すプラズマ表示パネルに含まれる電
極の配列の平面図である。
FIG. 2 is a plan view of an arrangement of electrodes included in the plasma display panel shown in FIG.

【図3】 図1に示すプラズマ表示パネルに含まれる電
極の交互配列の平面図である。
FIG. 3 is a plan view of an alternate arrangement of electrodes included in the plasma display panel shown in FIG.

【図4】 電圧電源に接続される図3に示す電極の平面
図である。
FIG. 4 is a plan view of the electrode shown in FIG. 3 connected to a voltage power supply.

【図5】 図1に示すプラズマ表示パネルに含まれる電
極の他の交互配列を示す平面図である。
FIG. 5 is a plan view showing another alternate arrangement of electrodes included in the plasma display panel shown in FIG.

【図6】 電圧電源に接続される図5に示す電極の平面
図である。
FIG. 6 is a plan view of the electrode shown in FIG. 5 connected to a voltage power supply.

【図7】 プラズマ表示パネル上において表示を始動及
び維持するために、時間の関数として図4及び6におけ
る電極に印加される電圧を示す。
FIG. 7 shows the voltage applied to the electrodes in FIGS. 4 and 6 as a function of time for starting and maintaining a display on a plasma display panel.

【図8】 線2−2に沿う図1におけるプラズマ表示パ
ネルの断面図であって、書込み開始フェーズ中のパネル
の動作を示す。
FIG. 8 is a cross-sectional view of the plasma display panel of FIG. 1 along line 2-2, illustrating operation of the panel during a write start phase.

【図9】 線2−2に沿う図1におけるプラズマ表示パ
ネルの断面図であって、設定電荷フェーズ中のパネルの
動作を示す。
FIG. 9 is a cross-sectional view of the plasma display panel of FIG. 1 taken along line 2-2, illustrating operation of the panel during a set charge phase.

【図10】 線2−2に沿う図1におけるプラズマ表示
パネルの断面図であって、維持フェーズ中のパネルの動
作を示す。
FIG. 10 is a cross-sectional view of the plasma display panel of FIG. 1 along line 2-2, illustrating operation of the panel during a sustain phase.

【図11】 線2−2に沿う図1におけるプラズマ表示
パネルの断面図であって、選択書込みフェーズ中のパネ
ルの動作を示す。
FIG. 11 is a cross-sectional view of the plasma display panel of FIG. 1 taken along line 2-2, illustrating operation of the panel during a selective write phase.

【図12】 線2−2に沿う図1におけるプラズマ表示
パネルの断面図であって、傾斜電圧を利用した書込み開
始フェーズ中のパネルの動作を示す。
FIG. 12 is a cross-sectional view of the plasma display panel of FIG. 1 along line 2-2, illustrating operation of the panel during a write start phase utilizing a ramp voltage.

【図13】 プラズマ放電パネルを消去するために、時
間の関数として図4及び6における電極に印加される電
圧を示す。
FIG. 13 shows the voltage applied to the electrodes in FIGS. 4 and 6 as a function of time to erase a plasma discharge panel.

【図14】 図3及び4に示すプラズマ表示パネルの更
に他の交互配列の実施形態を示す平面図である。
FIG. 14 is a plan view showing still another alternate embodiment of the plasma display panel shown in FIGS. 3 and 4;

【符号の説明】[Explanation of symbols]

10…プラズマ・ディスプレイ・パネル、12…上部ガ
ラス基板、14…底部ガラス基板、16…下面、18…
平行電極、Y…第1維持電極、Z…第2維持電極、T…
トリガ電極、C…制御電極、26…電荷蓄積膜、27…
薄い電子放出層、32…複数の平行なマイクロ溝、34
…隔壁、36…アドレス電極。
DESCRIPTION OF SYMBOLS 10 ... Plasma display panel, 12 ... Top glass substrate, 14 ... Bottom glass substrate, 16 ... Bottom surface, 18 ...
Parallel electrode, Y ... first sustain electrode, Z ... second sustain electrode, T ...
Trigger electrode, C: control electrode, 26: charge storage film, 27:
Thin electron-emitting layer, 32... Multiple parallel micro-grooves, 34
... partition walls, 36 ... address electrodes.

───────────────────────────────────────────────────── フロントページの続き (72)発明者 オレクサンドル シュビドキー アメリカ合衆国 43609 オハイオ州 ト リード ソーンウッド ドライブ 823 Fターム(参考) 5C040 FA01 FA04 GB03 GB14 GB16 GC11 GC20 GK14 LA05 LA18 MA03 5C080 AA05 BB05 CC03 DD03 HH02 HH04 HH05 JJ04 JJ06  ────────────────────────────────────────────────── ─── Continuing on the front page (72) Inventor Oleksandr Shubidky United States 43609 Ohio Toledo Thornwood Drive 823 F-term (reference) 5C040 FA01 FA04 GB03 GB14 GB16 GC11 GC20 GK14 LA05 LA18 MA03 5C080 AA05 BB05 CC03 DD03 HH02 HH04 HH05 JJ04 JJ06

Claims (29)

【特許請求の範囲】[Claims] 【請求項1】 プラズマ平面型パネル表示装置であっ
て、 第1透明基板に成膜され、各々第1維持電極と第2維持
電極を含む平行維持電極対アレイと、 各維持電極対において、少なくとも第1補助電極が第1
維持電極に隣接しており、前記各維持電極対に平行に且
つ対応して前記第1透明基板に成膜される補助電極と、 前記維持電極及び補助電極を覆う誘電体材料から形成さ
れる誘電体層と、 前記誘電体を覆う電子放出材料から形成される保護層
と、を含む前記第1透明基板と、 前記第1基板に隣接する第2基板の表面に形成された微
細空隙アレイと、 各アドレス電極は、前記維持電極に直交し、また前記各
微細空隙に対応し、前記微細空隙は、前記第1基板と共
に複数の副画素を画成し、前記各副画素は、前記アドレ
ス電極と関連した補助電極を有する維持電極対の交点
に、制御された放電空間を画成し、前記第2基板に組み
込まれた複数の前記アドレス電極と、 各微細空隙内に成膜され、また前記アドレス電極と関連
付けられた蛍光体材料と、 前記微細空隙を満たすガスと、を含む前記第1基板に気
密封止される前記第2基板と、を含む装置。
1. A plasma flat panel display device, comprising: a parallel sustain electrode pair array formed on a first transparent substrate and each including a first sustain electrode and a second sustain electrode; The first auxiliary electrode is the first
An auxiliary electrode formed on the first transparent substrate adjacent to the storage electrode and parallel to and corresponding to each of the storage electrode pairs; and a dielectric formed from a dielectric material covering the storage electrode and the auxiliary electrode. A first transparent substrate including a body layer and a protective layer formed of an electron emission material covering the dielectric; a fine void array formed on a surface of a second substrate adjacent to the first substrate; Each address electrode is orthogonal to the sustain electrode, and corresponds to each of the fine gaps, and the fine gaps define a plurality of sub-pixels together with the first substrate, and each of the sub-pixels is connected to the address electrode. A plurality of address electrodes incorporated in the second substrate defining a controlled discharge space at intersections of sustain electrode pairs having associated auxiliary electrodes, and a film formed in each micro-gap; Phosphor material associated with the electrode Apparatus comprising, a second substrate which is hermetically sealed to the first substrate; and a gas filling the microvoids.
【請求項2】 請求項1に記載されたプラズマ平面型パ
ネル表示装置であって、 前記各第1維持電極は対応する第1維持電極パッドに接
続され、前記第1維持電極パッドは少なくとも一つのグ
ループに接続されるようになっており、前記グループは
第1維持電圧波形電源に接続されており、 前記各第2維持電極は対応する第2維持電極パッドに接
続され、前記維持電極パッドは少なくとも一つのグルー
プに接続されるようになっており、前記グループは、第
1維持電圧波形と逆相の第2維持電圧波形電源に接続さ
れており、 各第1維持電極に隣接する少なくとも一つの前記補助電
極が、関連する補助電極パッドに接続され、前記補助電
極パッドは、複数の個別に制御可能な第1制御電圧波形
電源に接続されるようになっており、 前記各アドレス電極は対応する電極パッドに接続され、
前記アドレス電極パッドは、個別に制御可能なアドレス
電圧波形電源に、ほぼ前記第1維持電圧波形電源と同期
して低電圧で接続されるようになっている装置。
2. The plasma flat panel display according to claim 1, wherein each of the first storage electrodes is connected to a corresponding first storage electrode pad, and the first storage electrode pad is at least one. Connected to a group, wherein the group is connected to a first sustain voltage waveform power supply, each of the second sustain electrodes is connected to a corresponding second sustain electrode pad, and the sustain electrode pad is at least Connected to one group, wherein the group is connected to a second sustain voltage waveform power supply having a phase opposite to that of the first sustain voltage waveform, and at least one of the groups adjacent to each first sustain electrode An auxiliary electrode connected to an associated auxiliary electrode pad, wherein the auxiliary electrode pad is connected to a plurality of individually controllable first control voltage waveform power supplies; Source electrode is connected to the corresponding electrode pads,
An apparatus wherein the address electrode pads are connected to an individually controllable address voltage waveform power supply at a low voltage substantially in synchronization with the first sustain voltage waveform power supply.
【請求項3】 請求項2に記載されたプラズマ平面型パ
ネル表示装置であって、 各2番目の維持電極に隣接する2番目の前記補助電極が
関連する補助電極パッドに接続され、前記2番目の補助
電極パッドは少なくとも一つのグループ内に、前記第1
制御電圧波形電源とほぼ逆相で、2番目の制御電圧波形
電源に共通に接続されるようになっている装置。
3. The flat panel display according to claim 2, wherein a second auxiliary electrode adjacent to each second sustain electrode is connected to an associated auxiliary electrode pad, and wherein the second auxiliary electrode is connected to an associated auxiliary electrode pad. The auxiliary electrode pads of the first type are arranged in at least one group.
A device that is substantially in phase with the control voltage waveform power supply and is commonly connected to a second control voltage waveform power supply.
【請求項4】 請求項2に記載されたプラズマ平面型パ
ネル表示装置であって、 前記第1と第2維持電圧波形電源は電圧波形を前記維持
電極に印加して、前記第1と第2維持電極間においてプ
ラズマ放電を継続的に維持し、放電経路の位置と形状が
補助電圧波形によって制御され、これによって関連した
副画素の発光が増強される装置。
4. The plasma flat panel display according to claim 2, wherein the first and second sustaining voltage waveform power supplies apply a voltage waveform to the sustaining electrode, and the first and second sustaining voltage waveform power supplies apply a voltage waveform to the sustaining electrode. A device that continuously maintains a plasma discharge between sustain electrodes, and the position and shape of the discharge path is controlled by an auxiliary voltage waveform, thereby enhancing the emission of the associated sub-pixel.
【請求項5】 請求項4に記載されたプラズマ平面型パ
ネル表示装置であって、 前記波形電源が協働して、立上げ期間中、全ての電極に
関連付けられた誘電体表面上のいかなる壁電荷をも除去
する電圧波形を印加し、 前記アドレス電圧波形電源が前記第1補助電圧波形電源
と協働して、前記第1維持電極と第2維持電極間で制御
された放電空間において選択的に放電を開始する電圧を
印加し、また第1と第2維持電極とに関連する誘電体表
面に、アドレス期間中に選択された副画素に対応するこ
の制御された放電空間において通常維持時の量とほぼ等
価な量の電荷を蓄積し、 前記電圧波形電源は協働して、維持期間中維持電極の前
記関連した誘電体表面上に電荷を蓄積した副画素におい
て前記第1と第2維持電極間でこの制御された放電空間
において所定の数の連続的な維持放電を生成する装置。
5. The plasma flat panel display of claim 4, wherein the waveform power supplies cooperate to provide any walls on a dielectric surface associated with all electrodes during a start-up period. Applying a voltage waveform that also removes charge, wherein the address voltage waveform power supply cooperates with the first auxiliary voltage waveform power supply to selectively operate in a controlled discharge space between the first sustain electrode and the second sustain electrode. A voltage to start a discharge, and apply a voltage to the dielectric surface associated with the first and second sustain electrodes in this controlled discharge space corresponding to the sub-pixel selected during the address period. The voltage waveform power supplies cooperate to store the first and second sustained voltages in the sub-pixels that have accumulated charge on the associated dielectric surface of a sustain electrode during a sustain period. This controlled discharge space between the electrodes An apparatus for generating a predetermined number of continuous sustain discharges in the apparatus.
【請求項6】 請求項4に記載されたプラズマ平面型パ
ネル表示装置であって、 前記維持電圧波形は250ボルトを越える電圧であり、
また前記トリガ電圧波形は、100ボルト未満の電圧で
ある装置。
6. The plasma flat panel display according to claim 4, wherein the sustain voltage waveform is a voltage exceeding 250 volts,
The apparatus wherein the trigger voltage waveform is a voltage less than 100 volts.
【請求項7】 請求項5に記載されたプラズマ平面型パ
ネル表示装置であって、 前記維持電圧波形は280ボルトから380ボルトの範
囲の電圧である装置。
7. The plasma flat panel display device according to claim 5, wherein the sustain voltage waveform is a voltage in a range of 280 volts to 380 volts.
【請求項8】 請求項1に記載されたプラズマ平面型パ
ネル表示装置であって、 前記補助電極は、前記第1と第2維持電極の間に配置さ
れる装置。
8. The flat panel display according to claim 1, wherein the auxiliary electrode is disposed between the first and second sustain electrodes.
【請求項9】 請求項1に記載されたプラズマ平面型パ
ネル表示装置であって、 前記補助電極は、前記第1と第2維持電極の外側に配置
される装置。
9. The plasma flat panel display device according to claim 1, wherein the auxiliary electrode is disposed outside the first and second sustaining electrodes.
【請求項10】 請求項1に記載されたプラズマ平面型
パネル表示装置であって、 前記維持電極は同じ幅を有するが、補助電極の幅とは異
なる装置。
10. The plasma flat panel display device according to claim 1, wherein the sustain electrodes have the same width but different widths of the auxiliary electrodes.
【請求項11】 請求項9に記載されたプラズマ平面型
パネル表示装置であって、 前記第1と第2維持電極対は、対のアレイに沿って交互
に鏡像を成し、第1、第2、第2、第1維持電極のパタ
ーンを形成し、このパターンをアレイの最初から最後ま
で繰り返す装置。
11. The plasma flat panel display according to claim 9, wherein the first and second sustain electrode pairs alternately form a mirror image along an array of the pairs, and the first and second sustain electrodes are arranged in parallel. 2. An apparatus for forming a pattern of the second and first sustain electrodes and repeating the pattern from the beginning to the end of the array.
【請求項12】 請求項11に記載されたプラズマ平面
型パネル表示装置であって、 前記補助電極が、二つの隣接する補助電極間で共用され
るパッドに共通に接続されており、これによってパッド
の数と対応する補助波形電圧電源の数を半分に減ずる装
置。
12. The plasma flat panel display device according to claim 11, wherein the auxiliary electrode is commonly connected to a pad shared between two adjacent auxiliary electrodes, thereby forming a pad. A device that reduces the number of auxiliary waveform voltage power supplies by half.
【請求項13】 請求項11に記載されたプラズマ平面
型パネル表示装置であって、 前記第1の維持電極が、二つの隣接する第1補助電極間
で共用されるパッドに共通に接続されており、第2の維
持電極が、二つの隣接する第2補助電極間で共用される
パッドに共通に接続されており、これによってパッドの
数を半分に減ずる装置。
13. The flat panel display according to claim 11, wherein the first sustaining electrode is commonly connected to a pad shared between two adjacent first auxiliary electrodes. An apparatus wherein the second sustain electrode is commonly connected to a pad shared between two adjacent second auxiliary electrodes, thereby reducing the number of pads by half.
【請求項14】 請求項3に記載されたプラズマ平面型
パネル表示装置であって、 前記第1と第2維持電圧波形電源は電圧波形を前記維持
電極に印加して、前記第1と第2維持電極間においてプ
ラズマ放電を継続的に維持し、放電経路の位置と形状が
補助電圧波形によって制御され、これによって関連した
副画素の発光が増強される装置。
14. The plasma flat panel display device according to claim 3, wherein the first and second sustain voltage waveform power supplies apply a voltage waveform to the sustain electrode, and the first and second sustain voltage waveform power supplies apply a voltage waveform to the first and second sustain electrodes. A device that continuously maintains a plasma discharge between sustain electrodes, and the position and shape of the discharge path is controlled by an auxiliary voltage waveform, thereby enhancing the emission of the associated sub-pixel.
【請求項15】 請求項14に記載されたプラズマ平面
型パネル表示装置であって、 前記波形電源が協働して、立上げ期間中、全ての電極に
関連付けられた誘電体表面上のいかなる壁電荷をも除去
する電圧波形を印加し、 前記アドレス電圧波形電源が前記第1補助電圧波形電源
と協働して、前記第1維持電極と第2維持電極間で制御
された放電空間において選択的に放電を開始する電圧を
印加し、また第1と第2維持電極とに関連する誘電体表
面に、アドレス期間中に選択された副画素に対応するこ
の制御された放電空間において通常維持時の量とほぼ等
価な量の電荷を蓄積し、 前記電圧波形電源は協働して、維持期間中維持電極の前
記関連した誘電体表面上に電荷を蓄積した副画素におい
て前記第1と第2維持電極間でこの制御された放電空間
において所定の数の連続的な維持放電を生成する装置。
15. The plasma flat panel display of claim 14, wherein the waveform power supplies cooperate to provide any walls on a dielectric surface associated with all electrodes during a start-up period. Applying a voltage waveform that also removes charge, wherein the address voltage waveform power supply cooperates with the first auxiliary voltage waveform power supply to selectively operate in a controlled discharge space between the first sustain electrode and the second sustain electrode. A voltage to start a discharge, and apply a voltage to the dielectric surface associated with the first and second sustain electrodes in this controlled discharge space corresponding to the sub-pixel selected during the address period. The voltage waveform power supplies cooperate to store the first and second sustained voltages in the sub-pixels that have accumulated charge on the associated dielectric surface of a sustain electrode during a sustain period. This controlled discharge between the electrodes A device that generates a predetermined number of continuous sustain discharges in space.
【請求項16】 プラズマ平面型パネル表示装置であっ
て、 第1透明基板と、 前記第1透明基板上に成膜された、第1維持電極と第2
維持電極を含む第1平行維持電極対と、 前記第1維持電極対に平行に前記第1基板上に成膜され
た、前記第1維持電極対において前記第1維持電極に隣
接する少なくとも1つの補助電極と、 前記トリガ電極に平行に前記第1基板上に成膜され、第
1維持電極と第2維持電極を含み、第2維持電極対にお
ける前記第1維持電極が前記トリガ電極に隣接するよう
に前記第1維持電極対の鏡像として前記第1基板上に配
向される前記第2平行維持電極対と、 前記第1維持電極対における前記第1維持電極及び前記
第2維持電極対における前記第1維持電極に電気的に接
続され、第1維持電圧波形電源に接続されるようになっ
ており、これによって、単一電源によって、第1維持電
圧波形を第1維持電極の両者に供給する単一共通第1維
持電極パッドと、 前記維持電極及びトリガ電極を覆う誘電体材料から形成
された誘電体層と、 前記誘電体層を覆って形成された保護層と、 前記第1基板に気密封止される、前記第1基板に隣接す
るその表面に前記第1基板と共に複数の副画素を画成す
る複数の微細空隙を有する第2基板と、 前記微細空隙を満たすガスと、 各微細空隙内に成膜される蛍光体と、 前記第2基板内に組み込まれ、各々前記副画素の一つに
対応する複数のアドレス電極と、を含む装置。
16. A plasma flat panel display device, comprising: a first transparent substrate; a first storage electrode and a second storage film formed on the first transparent substrate.
A first parallel sustain electrode pair including a sustain electrode; and at least one adjacent to the first sustain electrode in the first sustain electrode pair formed on the first substrate in parallel with the first sustain electrode pair. An auxiliary electrode, formed on the first substrate in parallel with the trigger electrode, including a first sustain electrode and a second sustain electrode, wherein the first sustain electrode in a second sustain electrode pair is adjacent to the trigger electrode The second parallel sustain electrode pair oriented on the first substrate as a mirror image of the first sustain electrode pair, and the first sustain electrode and the second sustain electrode pair in the first sustain electrode pair. The first sustaining electrode is electrically connected to the first sustaining voltage waveform power supply, so that the first sustaining voltage waveform is supplied to both of the first sustaining electrodes by a single power supply. Single common first sustain electrode A dielectric layer formed of a dielectric material covering the sustain electrode and the trigger electrode; a protective layer formed covering the dielectric layer; and a first hermetically sealed with the first substrate. A second substrate having a plurality of fine voids defining a plurality of sub-pixels together with the first substrate on a surface adjacent to the substrate, a gas filling the fine voids, and a phosphor formed in each of the fine voids And a plurality of address electrodes incorporated in the second substrate, each address electrode corresponding to one of the sub-pixels.
【請求項17】 プラズマ平面型パネル表示装置を動作
させるための方法であって、 (a)プラズマ平面型パネル表示装置を提供する段階で
あって、 第1透明基板と、 第1透明基板上に成膜された、第1維持電極と第2維持
電極を含む第1平行維持電極対と、 第1維持電極対に平行に第1基板上に成膜された、第1
維持電極対において第1維持電極に隣接する少なくとも
1つの補助電極と、 トリガ電極に平行に第1基板上に成膜され、第1維持電
極と第2維持電極を含み、第2維持電極対における第1
維持電極が補助電極に隣接するように第1維持電極対の
鏡像として第1基板上に配向される第2平行維持電極対
と、 第1維持電極対における第1維持電極及び第2維持電極
対における第1維持電極に電気的に接続され、第1維持
電圧波形電源に接続されるようになっており、これによ
って、単一電源によって、第1維持電圧波形を第1維持
電極の両者に供給する単一共通第1維持電極パッドと、 維持電極及びトリガ電極を覆う誘電体材料から形成され
た誘電体層と、 誘電体層を覆って形成された保護層と、 第1基板に気密封止される、第1基板に隣接するその表
面に第1基板と共に複数の副画素を画成する複数の微細
空隙を有する第2基板と、 微細空隙を満たすガスと、 各微細空隙内に成膜される蛍光体と、 第2基板内に組み込まれ、各々副画素の一つに対応する
複数のアドレス電極と、を有するプラズマ平面型パネル
表示装置を提供する段階と、 (b)パッドによって接続され「オフ」状態に適する値
に制御された副セルの放電空間に対応して全ての壁電荷
が関連する誘電体面上に形成された対応する電極に、立
上げ期間において第1及び第2維持電圧波形、補助電圧
波形及びアドレス電圧波形を印加する段階と、 (c)アドレス期間においてアドレス電圧波形と共に、
パッドによって接続された補助電圧波形電源毎に、対応
する第1補助電極に順次第1補助電圧波形を印加し、関
連した第1及び第2維持電極対間において選択的に放電
を開始し、これによって、「オン」状態に適する値に制
御された選択された副セルの放電空間に対応して、前記
維持電極に関連する誘電体面上において壁電荷を設定す
る段階と、 (d)第1及び第2維持波形電源を介して所定数の電圧
パルスを維持期間中に印加し、これによって「オン」状
態に設定されたセルにおいて、放電の位置と形状が補助
電圧波形電源によって制御された状態で、前記電圧パル
スに対応して順次所定数の放電を生成する段階と、を含
む方法。
17. A method for operating a plasma flat panel display device, comprising: (a) providing a plasma flat panel display device, comprising: a first transparent substrate; A first parallel sustain electrode pair including a first sustain electrode and a second sustain electrode, and a first parallel sustain electrode pair formed on a first substrate in parallel with the first sustain electrode pair.
At least one auxiliary electrode adjacent to the first sustain electrode in the sustain electrode pair; and a film formed on the first substrate in parallel with the trigger electrode, the first sustain electrode and the second sustain electrode being included in the second sustain electrode pair. First
A second pair of parallel sustain electrodes that is oriented on the first substrate as a mirror image of the first pair of sustain electrodes such that the sustain electrode is adjacent to the auxiliary electrode; a first pair of sustain electrodes and a second pair of sustain electrodes in the first pair of sustain electrodes; Are electrically connected to the first sustain electrode and are connected to the first sustain voltage waveform power supply, whereby the first sustain voltage waveform is supplied to both of the first sustain electrodes by a single power supply. A single common first sustain electrode pad, a dielectric layer formed of a dielectric material covering the sustain electrode and the trigger electrode, a protective layer formed over the dielectric layer, and hermetically sealed to the first substrate A second substrate having a plurality of fine voids defining a plurality of sub-pixels together with the first substrate on a surface adjacent to the first substrate, a gas filling the fine voids, and a film formed in each fine void. Phosphor incorporated in the second substrate, Providing a plasma flat panel display having a plurality of address electrodes each corresponding to one of the sub-pixels; and (b) providing a sub-cell connected by a pad and controlled to a value suitable for an "off" state. Applying first and second sustaining voltage waveforms, auxiliary voltage waveforms, and address voltage waveforms to the corresponding electrodes formed on the dielectric surface where all wall charges are associated with the discharge spaces during the rise period; (C) together with the address voltage waveform in the address period,
For each auxiliary voltage waveform power supply connected by a pad, a first auxiliary voltage waveform is sequentially applied to a corresponding first auxiliary electrode, and a discharge is selectively started between the associated first and second sustain electrode pairs. Setting a wall charge on the dielectric surface associated with the sustain electrode corresponding to the discharge space of the selected sub-cell controlled to a value suitable for the "on"state; A predetermined number of voltage pulses are applied during the sustaining period via the second sustaining waveform power supply, so that in the cells set to the "ON" state, the position and shape of the discharge are controlled by the auxiliary voltage waveform power supply. Generating a predetermined number of discharges sequentially in response to the voltage pulses.
【請求項18】 請求項17に記載の方法であって、第
1と第2電圧波形は、同じ電圧を有し、逆位相である方
法。
18. The method of claim 17, wherein the first and second voltage waveforms have the same voltage and are out of phase.
【請求項19】 請求項17に記載の方法であって、第
1補助波形発生器によって生成される電圧波形は、ほぼ
第1維持電圧波形電源と同相であり、電圧はそれより小
さい方法。
19. The method of claim 17, wherein the voltage waveform generated by the first auxiliary waveform generator is substantially in-phase with the first sustain voltage waveform power supply, and the voltage is less.
【請求項20】 請求項19に記載の方法であって、第
1補助波形発生器によって生成される電圧波形は、最適
光出力及び最適光効率に調整可能である方法。
20. The method according to claim 19, wherein the voltage waveform generated by the first auxiliary waveform generator is adjustable for optimum light output and optimum light efficiency.
【請求項21】 プラズマ平面型パネル表示装置を動作
させるための方法であって、 (a)プラズマ平面型パネル表示装置を提供する段階で
あって、 第1透明基板と、 前記第1透明基板に成膜され、各々第1維持電極と第2
維持電極を含む平行維持電極対アレイと、 各維持電極対において、少なくとも第1補助電極が第1
維持電極に隣接しており、前記各維持電極対に平行に且
つ対応して前記第1透明基板に成膜される補助電極と、 前記維持電極及び補助電極を覆う誘電体材料から形成さ
れる誘電体層と、 前記誘電体を覆う電子放出材料から形成される保護層
と、 前記第1基板に気密封止される第2基板と、 前記第1基板に隣接する第2基板の表面に形成された微
細空隙アレイと、 各アドレス電極は前記維持電極に直交し、また前記各微
細空隙に対応し、前記微細空隙は前記第1基板と共に複
数の副画素を画成し、前記各副画素は前記アドレス電極
と関連した補助電極を有する維持電極対の交点に制御さ
れた放電空間を画成し、前記第2基板に組み込まれた複
数の前記アドレス電極と、 各微細空隙内に成膜され、また前記アドレス電極と関連
付けられた蛍光体材料と、 前記微細空隙を満たすガスと、を含む装置を提供する段
階と、 (b)パッドによって接続され「オフ」状態に適する値
に制御された副セルの放電空間に対応して全ての壁電荷
が関連する誘電体面上に形成された対応する電極に、立
上げ期間において第1及び第2維持電圧波形、補助電圧
波形及びアドレス電圧波形を印加する段階と、 (c)アドレス期間においてアドレス電圧波形と共に、
パッドによって接続された補助電圧波形電源毎に、対応
する第1補助電極に順次第1補助電圧波形を印加し、関
連した第1及び第2維持電極対間において選択的に放電
を開始し、これによって、「オン」状態に適する値に制
御された選択された副セルの放電空間に対応して、前記
維持電極に関連する誘電体面上において壁電荷を設定す
る段階と、 (d)第1及び第2維持波形電源を介して所定数の電圧
パルスを維持期間中に印加し、これによって「オン」状
態に設定されたセルにおいて、放電の位置と形状が補助
電圧波形電源によって制御された状態で、前記電圧パル
スに対応して順次所定数の放電を生成する段階と、を含
む方法。
21. A method for operating a plasma flat panel display device, comprising: (a) providing a plasma flat panel display device, comprising: a first transparent substrate; And a first sustain electrode and a second sustain electrode, respectively.
A parallel sustain electrode pair array including sustain electrodes, and in each sustain electrode pair, at least a first auxiliary electrode is a first sustain electrode.
An auxiliary electrode formed on the first transparent substrate adjacent to the storage electrode and parallel to and corresponding to each of the storage electrode pairs; and a dielectric formed from a dielectric material covering the storage electrode and the auxiliary electrode. A body layer, a protective layer formed of an electron-emitting material covering the dielectric, a second substrate hermetically sealed with the first substrate, and formed on a surface of the second substrate adjacent to the first substrate. The micro-gap array, each address electrode is orthogonal to the sustain electrode, and corresponds to each of the micro-gap, the micro-gap defines a plurality of sub-pixels with the first substrate, and each of the sub-pixels is Defining a controlled discharge space at the intersection of a sustain electrode pair having an auxiliary electrode associated with the address electrode, a plurality of the address electrodes incorporated in the second substrate, and a film formed in each of the fine voids; Fluorescence associated with the address electrode Providing a device comprising: a material; and a gas filling the microvoids; (b) all walls corresponding to the discharge space of the sub-cell connected by a pad and controlled to a value suitable for an "off"state; Applying first and second sustaining voltage waveforms, auxiliary voltage waveforms, and address voltage waveforms during a rise period to corresponding electrodes formed on a dielectric surface to which charges are related; and (c) address voltage during an address period. Along with the waveform,
For each auxiliary voltage waveform power supply connected by a pad, a first auxiliary voltage waveform is sequentially applied to a corresponding first auxiliary electrode, and a discharge is selectively started between the associated first and second sustain electrode pairs. Setting a wall charge on the dielectric surface associated with the sustain electrode corresponding to the discharge space of the selected sub-cell controlled to a value suitable for the "on"state; A predetermined number of voltage pulses are applied during the sustaining period via the second sustaining waveform power supply, so that in the cells set to the "ON" state, the position and shape of the discharge are controlled by the auxiliary voltage waveform power supply. Generating a predetermined number of discharges sequentially in response to the voltage pulses.
【請求項22】 請求項21に記載の方法であって、第
1と第2電圧波形は、同じ電圧を有し、逆位相である方
法。
22. The method of claim 21, wherein the first and second voltage waveforms have the same voltage and are out of phase.
【請求項23】 請求項21に記載の方法であって、第
1補助波形発生器によって生成される電圧波形は、ほぼ
第1維持電圧波形電源と同相であり、電圧はそれより小
さい方法。
23. The method of claim 21, wherein the voltage waveform generated by the first auxiliary waveform generator is substantially in phase with the first sustained voltage waveform power supply, and the voltage is less.
【請求項24】 請求項23に記載の方法であって、第
1補助波形発生器によって生成される電圧波形は、最適
光出力及び最適光効率に調整可能である方法。
24. The method of claim 23, wherein the voltage waveform generated by the first auxiliary waveform generator is adjustable for optimal light output and optimal light efficiency.
【請求項25】 プラズマ平面型パネル表示装置であっ
て、 第1透明基板と、 前記第1透明基板上に成膜された、第1維持電極と第2
維持電極を含む第1平行維持電極対と、 前記第1維持電極対に平行に前記第1基板上に成膜され
た、前記第1維持電極対において前記第1維持電極に隣
接する少なくとも1つの補助電極と、 前記トリガ電極に平行に前記第1基板上に成膜され、第
1維持電極と第2維持電極を含み、第2維持電極対にお
ける前記第1維持電極が他の前記トリガ電極に隣接する
ように前記第1維持電極対の鏡像として前記第1基板上
に配向される前記第2平行維持電極対と、 前記第1維持電極対における前記第1維持電極の一端及
び前記第2維持電極対における前記第1維持電極の対応
する端部に接続された前記第1維持電極の他端に電気的
に接続される単一共通第1維持電極パッドと、 前記第2維持電極対における前記第2維持電極の一端及
び前記第1維持電極対における前記第2維持電極の対応
する端部に接続された前記第2維持電極の他端に電気的
に接続される単一共通第2維持電極パッドと、 前記維持電極及びトリガ電極を覆う誘電体材料から形成
された誘電体層と、 前記誘電体層を覆って形成された保護層と、 前記第1基板に気密封止される、前記第1基板に隣接す
るその表面に前記第1基板と共に複数の副画素を画成す
る複数の微細空隙を有する第2基板と、 前記微細空隙を満たすガスと、 各微細空隙内に成膜される蛍光体と、 前記第2基板内に組み込まれ、各々前記副画素の一つに
対応する複数のアドレス電極と、を含む装置。
25. A plasma flat panel display device, comprising: a first transparent substrate; a first storage electrode and a second storage film formed on the first transparent substrate.
A first parallel sustain electrode pair including a sustain electrode; and at least one adjacent to the first sustain electrode in the first sustain electrode pair formed on the first substrate in parallel with the first sustain electrode pair. An auxiliary electrode, a film is formed on the first substrate in parallel with the trigger electrode, and includes a first sustain electrode and a second sustain electrode, wherein the first sustain electrode in the second sustain electrode pair is connected to the other trigger electrode. The second pair of parallel sustain electrodes, which are aligned on the first substrate as a mirror image of the first pair of sustain electrodes, and one end of the first sustain electrode in the first pair of sustain electrodes and the second sustain electrode. A single common first storage electrode pad electrically connected to the other end of the first storage electrode connected to a corresponding end of the first storage electrode in the electrode pair; One end of a second sustain electrode and the first sustain electrode A single common second storage electrode pad electrically connected to the other end of the second storage electrode connected to a corresponding end of the second storage electrode in the electrode pair; and covering the storage electrode and the trigger electrode A dielectric layer formed of a dielectric material; a protective layer formed to cover the dielectric layer; and a first layer on a surface adjacent to the first substrate, which is hermetically sealed to the first substrate. A second substrate having a plurality of fine voids defining a plurality of sub-pixels together with the substrate, a gas filling the fine voids, a phosphor formed in each of the fine voids, and being incorporated in the second substrate And a plurality of address electrodes each corresponding to one of the sub-pixels.
【請求項26】 請求項17に記載の方法であって、更
に、段階(d)に続いて、選択された副セルに含まれる
放電を消去するために適用される次の段階、すなわち、 (e)アドレス期間においてアドレス電圧波形と共に、
パッドによって接続された補助電圧波形電源毎に、対応
する第1補助電極に順次第1補助電圧波形を印加し、関
連した第1及び第2維持電極対間において選択的に放電
を開始し、これによって、「オフ」状態に適する値に制
御された選択された副セルの放電空間に対応して、前記
維持電極に関連する誘電体面上において壁電荷を設定す
る段階と、 (f)第1及び第2維持波形電源を介して所定数の電圧
パルスを後続の維持期間中に印加し、これによって「オ
ン」状態に設定されたセルにおいて、放電の位置と形状
が補助電圧波形電源によって制御された状態で、前記電
圧パルスに対応して順次所定数の放電を生成する段階
と、を含む方法。
26. The method of claim 17, further comprising, following step (d), a next step applied to erase a discharge contained in the selected sub-cell: e) along with the address voltage waveform during the address period,
For each auxiliary voltage waveform power supply connected by a pad, a first auxiliary voltage waveform is sequentially applied to a corresponding first auxiliary electrode, and a discharge is selectively started between the associated first and second sustain electrode pairs. Setting a wall charge on the dielectric surface associated with the sustain electrode corresponding to the discharge space of the selected sub-cell controlled to a value suitable for the "off"state; A predetermined number of voltage pulses are applied during a subsequent sustain period via the second sustain waveform power supply, thereby controlling the position and shape of the discharge in the cells set to the "on" state by the auxiliary voltage waveform power supply. Generating a predetermined number of discharges in sequence in response to said voltage pulses.
【請求項27】 請求項21に記載の方法であって、更
に、段階(d)に続いて、選択された副セルに含まれる
放電を消去するために適用される次の段階、すなわち、 (e)アドレス期間においてアドレス電圧波形と共に、
パッドによって接続された補助電圧波形電源毎に、対応
する第1補助電極に順次第1補助電圧波形を印加し、関
連した第1及び第2維持電極対間において選択的に放電
を開始し、これによって、「オフ」状態に適する値に制
御された選択された副セルの放電空間に対応して、前記
維持電極に関連する誘電体面上において壁電荷を設定す
る段階と、 (f)第1及び第2維持波形電源を介して所定数の電圧
パルスを後続の維持期間中に印加し、これによって「オ
ン」状態に設定されたセルにおいて、放電の位置と形状
が補助電圧波形電源によって制御された状態で、前記電
圧パルスに対応して順次所定数の放電を生成する段階
と、を含む方法。
27. The method according to claim 21, further comprising, following step (d), a next step applied to erase the discharge contained in the selected sub-cell: e) along with the address voltage waveform during the address period,
For each auxiliary voltage waveform power supply connected by a pad, a first auxiliary voltage waveform is sequentially applied to a corresponding first auxiliary electrode, and a discharge is selectively started between the associated first and second sustain electrode pairs. Setting a wall charge on the dielectric surface associated with the sustain electrode corresponding to the discharge space of the selected sub-cell controlled to a value suitable for the "off"state; A predetermined number of voltage pulses are applied during a subsequent sustain period via the second sustain waveform power supply, thereby controlling the position and shape of the discharge in the cells set to the "on" state by the auxiliary voltage waveform power supply. Generating a predetermined number of discharges in sequence in response to said voltage pulses.
【請求項28】 プラズマ平面型パネル表示装置を動
作させるための方法であって、 (a)プラズマ平面型パネル表示装置を提供する段階で
あって、 第1透明基板と、 第1透明基板上に成膜された、第1維持電極と第2維持
電極を含む第1平行維持電極対と、 第1維持電極対に平行に第1基板上に成膜された、第1
維持電極対において第1維持電極に隣接する少なくとも
1つの補助電極と、 トリガ電極に平行に第1基板上に成膜され、第1維持電
極と第2維持電極を含み、第2維持電極対における第1
維持電極が補助電極に隣接するように第1維持電極対の
鏡像として第1基板上に配向される第2平行維持電極対
と、 第1維持電極対における第1維持電極及び第2維持電極
対における第1維持電極に電気的に接続され、第1維持
電圧波形電源に接続されるようになっており、これによ
って、単一電源によって、第1維持電圧波形を第1維持
電極の両者に供給する単一共通第1維持電極パッドと、 維持電極及びトリガ電極を覆う誘電体材料から形成され
た誘電体層と、 誘電体層を覆って形成された保護層と、 第1基板に気密封止される、第1基板に隣接するその表
面に第1基板と共に複数の副画素を画成する複数の微細
空隙を有する第2基板と、 微細空隙を満たすガスと、 各微細空隙内に成膜される蛍光体と、 第2基板内に組み込まれ、各々副画素の一つに対応する
複数のアドレス電極と、を有するプラズマ平面型パネル
表示装置を提供する段階と、 少なくとも一つの副セルにおいて形成されたプラズマ放
電を維持するために電極に印加される、割当てられた電
圧がある状態において、 (b)アドレス期間においてアドレス電圧波形と共に、
パッドによって接続された補助電圧波形電源毎に、対応
する第1補助電極に順次第1補助電圧波形を印加し、関
連した第1及び第2維持電極対間において選択的に放電
を開始し、これによって、「オフ」状態に適する値に制
御された選択された副セルの放電空間に対応して、前記
維持電極に関連する誘電体面上において壁電荷を設定す
る段階と、 (c)第1及び第2維持波形電源を介して所定数の電圧
パルスを後続の維持期間中に印加し、これによって「オ
ン」状態に設定されたセルにおいて、放電の位置と形状
が補助電圧波形電源によって制御された状態で、前記電
圧パルスに対応して順次所定数の放電を生成する段階
と、を含む方法。
28. A method for operating a plasma flat panel display, comprising: (a) providing a plasma flat panel display, comprising: a first transparent substrate; A first parallel sustain electrode pair including a first sustain electrode and a second sustain electrode, and a first parallel sustain electrode pair formed on a first substrate in parallel with the first sustain electrode pair.
At least one auxiliary electrode adjacent to the first sustain electrode in the sustain electrode pair; and a film formed on the first substrate in parallel with the trigger electrode, the first sustain electrode and the second sustain electrode being included in the second sustain electrode pair. First
A second pair of parallel sustain electrodes that is oriented on the first substrate as a mirror image of the first pair of sustain electrodes such that the sustain electrode is adjacent to the auxiliary electrode; a first pair of sustain electrodes and a second pair of sustain electrodes in the first pair of sustain electrodes; Are electrically connected to the first sustain electrode and are connected to the first sustain voltage waveform power supply, whereby the first sustain voltage waveform is supplied to both of the first sustain electrodes by a single power supply. A single common first sustain electrode pad, a dielectric layer formed of a dielectric material covering the sustain electrode and the trigger electrode, a protective layer formed over the dielectric layer, and hermetically sealed to the first substrate A second substrate having a plurality of fine voids defining a plurality of sub-pixels together with the first substrate on a surface adjacent to the first substrate, a gas filling the fine voids, and a film formed in each fine void. Phosphor incorporated in the second substrate, Providing a plasma flat panel display having a plurality of address electrodes each corresponding to one of the sub-pixels; and applying to the electrodes to maintain a plasma discharge formed in at least one of the sub-cells. In the presence of the assigned voltage, (b) with the address voltage waveform during the address period,
For each auxiliary voltage waveform power supply connected by a pad, a first auxiliary voltage waveform is sequentially applied to a corresponding first auxiliary electrode, and a discharge is selectively started between the associated first and second sustain electrode pairs. Setting a wall charge on the dielectric surface associated with the sustain electrode corresponding to the discharge space of the selected sub-cell controlled to a value suitable for the "off"state; A predetermined number of voltage pulses are applied during a subsequent sustain period via the second sustain waveform power supply, thereby controlling the position and shape of the discharge in the cells set to the "on" state by the auxiliary voltage waveform power supply. Generating a predetermined number of discharges in sequence in response to said voltage pulses.
【請求項29】 平面型プラズマ表示装置を動作させる
ための方法であって、 プラズマ平面型パネル表示装置を提供する段階であっ
て、 第1透明基板と、 前記第1透明基板に成膜され、各々第1維持電極と第2
維持電極を含む平行維持電極対アレイと、 各維持電極対において、少なくとも第1補助電極が第1
維持電極に隣接しており、前記各維持電極対に平行に且
つ対応して前記第1透明基板に成膜される補助電極と、 前記維持電極及び補助電極を覆う誘電体材料から形成さ
れる誘電体層と、 前記誘電体を覆う電子放出材料から形成される保護層
と、 前記第1基板に気密封止される第2基板と、 前記第1基板に隣接する第2基板の表面に形成された微
細空隙アレイと、 各アドレス電極は前記維持電極に直交し、また前記各微
細空隙に対応し、前記微細空隙は前記第1基板と共に複
数の副画素を画成し、前記各副画素は前記アドレス電極
と関連した補助電極を有する維持電極対の交点に制御さ
れた放電空間を画成し、前記第2基板に組み込まれた複
数の前記アドレス電極と、 各微細空隙内に成膜され、また前記アドレス電極と関連
付けられた蛍光体材料と、 前記微細空隙を満たすガスと、を含む装置を提供する段
階と、 少なくとも一つの副セルにおいて形成されたプラズマ放
電を維持するために電極に印加される、割当てられた電
圧がある状態において、 (b)アドレス期間においてアドレス電圧波形と共に、
パッドによって接続された補助電圧波形電源毎に、対応
する第1補助電極に順次第1補助電圧波形を印加し、関
連した第1及び第2維持電極対間において選択的に放電
を開始し、これによって、「オフ」状態に適する値に制
御された選択された副セルの放電空間に対応して、前記
維持電極に関連する誘電体面上において壁電荷を設定す
る段階と、 (c)第1及び第2維持波形電源を介して所定数の電圧
パルスを後続の維持期間中に印加し、これによって「オ
ン」状態に設定されたセルにおいて、放電の位置と形状
が補助電圧波形電源によって制御された状態で、前記電
圧パルスに対応して順次所定数の放電を生成する段階
と、を含む方法。
29. A method for operating a flat panel plasma display device, comprising: providing a plasma flat panel display device, comprising: a first transparent substrate; a film formed on the first transparent substrate; A first sustain electrode and a second sustain electrode, respectively.
A parallel sustain electrode pair array including sustain electrodes, and in each sustain electrode pair, at least a first auxiliary electrode is a first sustain electrode.
An auxiliary electrode formed on the first transparent substrate adjacent to the storage electrode and parallel to and corresponding to each of the storage electrode pairs; and a dielectric formed from a dielectric material covering the storage electrode and the auxiliary electrode. A body layer, a protective layer formed of an electron-emitting material covering the dielectric, a second substrate hermetically sealed with the first substrate, and formed on a surface of the second substrate adjacent to the first substrate. The micro-gap array, each address electrode is orthogonal to the sustain electrode, and corresponds to each of the micro-gap, the micro-gap defines a plurality of sub-pixels with the first substrate, and each of the sub-pixels is Defining a controlled discharge space at the intersection of a sustain electrode pair having an auxiliary electrode associated with the address electrode, a plurality of the address electrodes incorporated in the second substrate, and a film formed in each of the fine voids; Fluorescence associated with the address electrode Providing an apparatus comprising: a material; and a gas that fills the microvoids; and in the presence of an assigned voltage applied to the electrodes to maintain a plasma discharge formed in at least one subcell. (B) along with the address voltage waveform in the address period,
For each auxiliary voltage waveform power supply connected by a pad, a first auxiliary voltage waveform is sequentially applied to a corresponding first auxiliary electrode, and a discharge is selectively started between the associated first and second sustain electrode pairs. Setting a wall charge on the dielectric surface associated with the sustain electrode corresponding to the discharge space of the selected sub-cell controlled to a value suitable for the "off"state; A predetermined number of voltage pulses are applied during a subsequent sustain period via the second sustain waveform power supply, thereby controlling the position and shape of the discharge in the cells set to the "on" state by the auxiliary voltage waveform power supply. Generating a predetermined number of discharges in sequence in response to said voltage pulses.
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