JP2001210836A - Method of manufacturing thin film transistor - Google Patents

Method of manufacturing thin film transistor

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JP2001210836A
JP2001210836A JP2000387834A JP2000387834A JP2001210836A JP 2001210836 A JP2001210836 A JP 2001210836A JP 2000387834 A JP2000387834 A JP 2000387834A JP 2000387834 A JP2000387834 A JP 2000387834A JP 2001210836 A JP2001210836 A JP 2001210836A
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JP
Japan
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protective film
region
base protective
thin film
gate insulating
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JP2000387834A
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Inventor
Koyu Cho
宏勇 張
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Semiconductor Energy Laboratory Co Ltd
Original Assignee
Semiconductor Energy Laboratory Co Ltd
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Publication date
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Abstract

PROBLEM TO BE SOLVED: To provide a new method of manufacturing thin film transistor. SOLUTION: In this method, a thin film transistor is manufactured in such a way that a base protective film is formed on a substrate having an insulating surface, and a channel area, a source area, and a drain area are formed on the protective film. Then a gate insulating film composed of the same material as that of the protective film is formed on the protective film, channel forming area, source area, and drain area and a gate electrode is formed on the insulating film. The source area and drain area contain micro crystals.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は非単結晶半導体薄膜
を用いた薄膜トランジスタ(以下にTFT ともいう)及び
その製造方法に関するものであり、特に液晶ディスプレ
ー,イメージセンサー等に適用可能な高信頼性を持つ薄
膜トランジスタの作製方法に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a thin film transistor (hereinafter also referred to as TFT) using a non-single-crystal semiconductor thin film and a method for manufacturing the same. Particularly, the present invention relates to a high reliability applicable to a liquid crystal display, an image sensor and the like. The present invention relates to a method for manufacturing a thin film transistor.

【0002】[0002]

【従来の技術】最近、化学的気相法等によって、作製さ
れた非単結晶半導体薄膜を利用した薄膜トランジスタが
注目されている。この薄膜トランジスタは、絶縁性基板
上に前述の如く化学的気相法等を用いて形成されるの
で、その作製雰囲気温度が最高で500 ℃程度と低温で形
成でき、安価なソーダガラス, ホウケイ酸ガラス等を基
板として用いることができる。
2. Description of the Related Art Recently, a thin film transistor using a non-single-crystal semiconductor thin film manufactured by a chemical vapor deposition method or the like has attracted attention. Since this thin film transistor is formed on an insulating substrate by the chemical vapor deposition method as described above, its fabrication atmosphere temperature can be formed at a low temperature of about 500 ° C. at the highest, and it is inexpensive soda glass and borosilicate glass. Can be used as a substrate.

【0003】この薄膜トランジスタは電界効果型であ
り、いわゆるMOSFETと同様の機能を有しているが、前述
の如く安価な絶縁性基板上に低温で形成できる。さら
に、その作製する最大面積は薄膜半導体を形成する装置
の寸法にのみ限定されるもので、容易に大面積基板上に
トランジスタを作製できるという利点を持っていた。こ
のため多量の画素を持つマトリクス構造の液晶ディスプ
レーのスイッチング素子や、一次元又は二次元のイメー
ジセンサー等のスイッチング素子として極めて有望であ
る。
This thin film transistor is a field effect type and has the same function as a so-called MOSFET, but can be formed on an inexpensive insulating substrate at a low temperature as described above. Further, the maximum area to be manufactured is limited only by the size of an apparatus for forming a thin film semiconductor, and has an advantage that a transistor can be easily manufactured on a large-area substrate. For this reason, it is extremely promising as a switching element of a liquid crystal display having a matrix structure having a large number of pixels and a switching element of a one-dimensional or two-dimensional image sensor.

【0004】また、この薄膜トランジスタを作製するに
はすでに確立された技術であるフォトリソグラフィーが
応用可能で、いわゆる微細加工が可能であり、IC等と同
様に集積化を図ることも可能であった。この従来より知
られたTFT の代表的な構造を図2に概略的に示す。
In order to fabricate the thin film transistor, photolithography, which is an established technique, can be applied, so-called fine processing can be performed, and integration can be achieved like an IC or the like. FIG. 2 schematically shows a typical structure of this conventionally known TFT.

【0005】(20)はガラスよりなる絶縁性基板であり、
(21)は非単結晶半導体よりなる薄膜半導体、(22),(23)
はソース/ドレイン領域で、(24),(25) はソース/ドレ
イン電極、(26)はゲート絶縁膜で(27)はゲート電極であ
ります。このように構成された薄膜トランジスタは、ゲ
ート電極(27)に電圧を加えることにより、ソース/ドレ
イン(22),(23) 間に流れる電流を調整するものでありま
す。
[0005] (20) is an insulating substrate made of glass,
(21) is a thin film semiconductor made of a non-single-crystal semiconductor, (22), (23)
Is the source / drain region, (24) and (25) are the source / drain electrodes, (26) is the gate insulating film, and (27) is the gate electrode. The thin film transistor configured as above adjusts the current flowing between the source / drain (22) and (23) by applying a voltage to the gate electrode (27).

【0006】この時、この薄膜トランジスタの応答速度
は次式で与えられる。 S=μ・V/L2 ここでLはチャネル長,μはキャリアの移動度,Vはゲ
ート電圧。
At this time, the response speed of the thin film transistor is given by the following equation. S = μ · V / L 2 where L is the channel length, μ is the carrier mobility, and V is the gate voltage.

【0007】[0007]

【発明が解決しようとする課題】この薄膜トランジスタ
に用いられる非単結晶半導体層は半導体層中に多量の結
晶粒界等を含んでおり、これらが原因で単結晶の半導体
に比べてキャリアの移動度が非常に小さく、上式より判
るようにトランジスタの応答速度が非常に遅いという問
題が発生していた。特にアモルファスシリコン半導体を
用いた時その移動度はだいたい0.1 〜1 (cm2/V・Sec
)程度で、ほとんどTFT として動作しない程度のもの
であった。
The non-single-crystal semiconductor layer used in the thin film transistor contains a large amount of crystal grain boundaries in the semiconductor layer, and the carrier mobility is higher than that of the single-crystal semiconductor due to these. Is very small, and the response speed of the transistor is very slow, as can be seen from the above equation. Especially when an amorphous silicon semiconductor is used, its mobility is about 0.1 to 1 (cm 2 / V · Sec).
) And almost no operation as a TFT.

【0008】このような問題を解決するには、上式より
明らかなようにチャネル長を短くすることと、キャリア
移動度を大きくすることが知られ、種々の改良が行われ
ている。
In order to solve such a problem, it is known that the channel length is shortened and the carrier mobility is increased as is apparent from the above equation, and various improvements have been made.

【0009】特にチャネル長Lを短くすると、その2乗
で応答速度に影響するので非常に有効な手段である。し
かしながら、TFT の特徴である大面積基板上に素子を形
成する場合、フォトリソグラフィー技術を用いて、ソー
スとドレイン間の間隔(だいたいのチャネル長に対応す
る)を10μm 以下にすることは、その加工精度、歩留ま
り、生産コスト等の面から明らかに困難であり、TFT の
チャネル長を短くする手段として現在のところ有効な手
段は確立されていない。
Particularly, when the channel length L is shortened, the response speed is affected by its square, which is a very effective means. However, when forming elements on a large-area substrate, which is a feature of TFTs, it is necessary to use photolithography technology to reduce the distance between the source and drain (which roughly corresponds to the channel length) to 10 μm or less. Obviously, it is difficult in terms of accuracy, yield, production cost, etc., and no effective means has yet been established to reduce the TFT channel length.

【0010】一方、半導体層自身の持つ移動度(μ)を
大きくする方法としては、TFTに使用する半導体層と
して単結晶半導体または多結晶半導体を採用したり、T
FTの活性層部分を単結晶半導体または多結晶半導体と
することが行われている。
On the other hand, as a method of increasing the mobility (μ) possessed by the semiconductor layer itself, a single crystal semiconductor or a polycrystalline semiconductor is used as a semiconductor layer used for a TFT,
2. Description of the Related Art An active layer portion of an FT is made of a single crystal semiconductor or a polycrystalline semiconductor.

【0011】前者の方法では、半導体層を形成する際の
温度を高くする必要がある。一方、後者の方法は部分的
に温度を高くしてTFTの活性層部分を単結晶半導体ま
たは多結晶半導体とするものであるが、いずれの方法に
おいても通常のTFT作製工程よりも若干高い温度が必
要である。
In the former method, it is necessary to increase the temperature for forming the semiconductor layer. On the other hand, in the latter method, the temperature is partially increased to make the active layer portion of the TFT a single-crystal semiconductor or a polycrystalline semiconductor. is necessary.

【0012】例えば、(1) 非晶質半導体薄膜トランジス
タにおいて、非晶質シリコンの成膜温度は約250℃程
度でその後の熱アニール工程の温度は最大で400℃程
度必要である。(2) 熱再結晶多結晶半導体薄膜トランジ
スタにおいて、減圧CVD法による多結晶シリコンの成
膜温度と熱による再結晶化工程の必要温度は500〜6
50℃である。(3) 活性層のみを多結晶化した薄膜トラ
ンジスタにおいて、半導体層を形成するのに必要なCV
Dの温度は250℃〜450℃程度であるが、CWレー
ザによる活性層の再結晶化工程では600℃を超える温
度となる。
For example, (1) In an amorphous semiconductor thin film transistor, the film formation temperature of amorphous silicon is about 250 ° C., and the temperature of the subsequent thermal annealing step needs to be about 400 ° C. at the maximum. (2) In the thermally recrystallized polycrystalline semiconductor thin film transistor, the film forming temperature of polycrystalline silicon by a low pressure CVD method and the temperature required for the recrystallization step by heat are 500 to 6
50 ° C. (3) CV necessary for forming a semiconductor layer in a thin film transistor in which only the active layer is polycrystallized
Although the temperature of D is about 250 ° C. to 450 ° C., the temperature exceeds 600 ° C. in the step of recrystallization of the active layer using the CW laser.

【0013】このように薄膜トランジスタの製造工程に
おいては避けられない熱処理工程が存在している。
As described above, there is an unavoidable heat treatment step in the manufacturing process of the thin film transistor.

【0014】一方、TFTはソーダガラス等の基板上に
形成されており、特にスタガ型とコプラナ型はキャリア
の表面導電チャネルを持つ活性層がガラス基板と直接に
接している。
On the other hand, the TFT is formed on a substrate made of soda glass or the like. In particular, in the staggered type and the coplanar type, an active layer having a surface conductive channel of a carrier is in direct contact with the glass substrate.

【0015】TFT製造工程では前述のように避けられ
ない熱処理工程が存在するので、ガラス基板中に存在す
るナトリウム、カリウム等のアルカリ不純物並びに金属
等が外部に拡散し、活性層やTFTを構成する半導体層
に侵入する。これによりTFTは、移動度の低下やしき
い値の変動等デバイス特性を悪化させたり、長期の信頼
性に悪影響を与える。
In the TFT manufacturing process, since there is an unavoidable heat treatment process as described above, alkali impurities such as sodium and potassium, metals and the like existing in the glass substrate are diffused outside to form an active layer and a TFT. Invades the semiconductor layer. As a result, the TFT deteriorates device characteristics such as a decrease in mobility and a change in threshold value, and adversely affects long-term reliability.

【0016】また、TFTの動作により、TFT自身が
発熱するこれによりガラス基板の温度が上昇し、同様に
基板より不純物が拡散して、TFTに影響を与える。
Further, the operation of the TFT causes the TFT itself to generate heat, whereby the temperature of the glass substrate rises, and similarly, impurities are diffused from the substrate to affect the TFT.

【0017】本発明は前述の如き問題を解決するもので
あり、素子特性の良い、長期の信頼性の高いTFTの作
製方法を提供することを課題とする。
An object of the present invention is to solve the above-mentioned problems, and an object of the present invention is to provide a method for manufacturing a TFT having good element characteristics and high long-term reliability.

【0018】[0018]

【課題を解決するための手段】本発明は上記の問題を解
決する為に、TFT素子を形成する前にガラス基板上に
CVD法またはスパッタ法によりTFT素子のゲート絶
縁膜に使用可能な絶縁膜と同じ材料からなる膜を下地保
護膜として設け、その下地保護膜上にTFT素子を形成
していることを特徴とするものであります。
In order to solve the above problems, the present invention provides an insulating film which can be used as a gate insulating film of a TFT element on a glass substrate by a CVD method or a sputtering method before forming the TFT element. This is characterized in that a film made of the same material as that described above is provided as a base protective film, and a TFT element is formed on the base protective film.

【0019】すなわち、ガラス基板はゲート絶縁膜に使
用可能な絶縁膜、例えばシリコン酸化膜で覆われている
ためTFT作製工程等での熱処理工程またはTFT動作
時の発熱による基板温度上昇時におけるガラス基板より
の不純物の拡散を防止し、TFT素子の特性の向上およ
び長期の信頼性向上を実現することができるものであり
ます。以下に実施例を示し本発明を説明する。
That is, the glass substrate is covered with an insulating film that can be used as a gate insulating film, for example, a silicon oxide film. This prevents the further diffusion of impurities and improves the characteristics of TFT elements and long-term reliability. Hereinafter, the present invention will be described with reference to examples.

【0020】[0020]

【実施例】〔実施例1〕この実施例1に対応するプレー
ナ型薄膜トランジスタの概略的な作製工程を図1に示
す。
[Embodiment 1] FIGS. 1A to 1C show schematic steps of manufacturing a planar thin film transistor corresponding to Embodiment 1. FIG.

【0021】まず、ガラス基板(1) としてソーダガラス
を用い、このソーダガラス(1) 上に公知のスパッタリン
グ法により、全面に下地保護膜として酸化珪素(2) を30
0nmの厚さに形成した。その作成したその作製条件を以
下に示す。 スパッタガス 酸素100% 反応圧力 0.5Pa RFパワー 400W 基板温度 150℃ 成膜速度 5nm/min
First, soda glass was used as the glass substrate (1), and silicon oxide (2) was formed on the entire surface of the soda glass (1) by a known sputtering method.
It was formed to a thickness of 0 nm. The conditions for the preparation are shown below. Sputtering gas Oxygen 100% Reaction pressure 0.5Pa RF power 400W Substrate temperature 150 ° C Deposition rate 5nm / min

【0022】次に、これらの上にI型の非単結晶珪素半
導体膜(3) を公知のプラズマCVD法で約100nmの厚さ
に形成した。その作成したその作製条件を以下に示す。 基板温度 300℃ 反応圧力 0.05Torr Rfパワー(13.56MHz) 80W 使用ガス SiH4
Next, an I-type non-single-crystal silicon semiconductor film (3) was formed thereon with a thickness of about 100 nm by a known plasma CVD method. The conditions for the preparation are shown below. A substrate temperature of 300 ° C. The reaction pressure 0.05 Torr Rf power (13.56MH z) 80W using gas SiH 4

【0023】その後、所定のエッチング処理を行い図1
(A)に示す状態を得た。この後この活性層を多結晶化す
る為にエキシマレーザーを使用して、この活性層に対し
てレーザーアニール処理を施した。その条件を以下に示
す。 レーザエネルギー密度 200mJ/cm2 照射ショット数 50回
Thereafter, a predetermined etching process is performed to
The state shown in (A) was obtained. Thereafter, the active layer was subjected to laser annealing using an excimer laser to polycrystallize the active layer. The conditions are shown below. Laser energy density 200mJ / cm 2 Number of irradiation shots 50

【0024】この上に低抵抗非単結晶半導体層として、
N型の導電型を有する非単結晶珪素膜(4) を形成する。
この時の作成条件は以下のとおりであった。 基板温度 220℃ 反応圧力 0.05Torr Rfパワー(13.56MHz) 120W 使用ガス SiH4+PH3 膜厚 1500Å
On this, as a low-resistance non-single-crystal semiconductor layer,
A non-single-crystal silicon film (4) having an N-type conductivity is formed.
The preparation conditions at this time were as follows. Substrate temperature 220 ° C. The reaction pressure 0.05 Torr Rf power (13.56MH z) 120W using gas SiH 4 + PH 3 thickness 1500Å

【0025】このN型の非単結晶珪素膜(4) は、その形
成時にH2 ガスを多量に導入しRfパワーを高くして、微
結晶化させて電気抵抗を下げたものを使用してもよい。
This N-type non-single-crystal silicon film (4) is formed by introducing a large amount of H 2 gas at the time of its formation, increasing the Rf power, and microcrystallizing to reduce the electric resistance. Is also good.

【0026】次に公知のフォトリソグラフィー技術を用
いて、この非単結晶珪素膜(4) をソース/ドレイン領域
(4) を残しチャネル形成領域(7) をパターニングし、図
1(B)に示す状態を得た。
Next, using a known photolithography technique, this non-single-crystal silicon film (4) is
The channel formation region (7) was patterned except for (4) to obtain the state shown in FIG.

【0027】この後、チャネル形成領域(7) の活性化の
為に、水素プラズマ処理を下記の条件で行いチャネル領
域の活性化を行った。 基板温度 250℃ RFパワー 100W 処理時間 60分
Thereafter, in order to activate the channel formation region (7), hydrogen plasma treatment was performed under the following conditions to activate the channel region. Substrate temperature 250 ° C RF power 100W Processing time 60 minutes

【0028】この後、先の下地保護膜(2) と同じ材料で
かつ同じ形成方法にてゲート酸化膜(5)100nmの厚みに形
成後ソース/ドレイン領域のコンタクトホールを公知の
エッチング法により形成し、その上にアルミニウム電極
(6) を形成して、図1(C)の状態を得薄膜トランジスタ
を完成した。
Thereafter, a gate oxide film (5) is formed to a thickness of 100 nm using the same material and the same forming method as the base protective film (2), and then contact holes in the source / drain regions are formed by a known etching method. And an aluminum electrode on it
By forming (6), the state shown in FIG. 1C was obtained, and the thin film transistor was completed.

【0029】本実施例の場合、ソース/ドレイン電極
(6) の下にはゲート絶縁膜(5) 、下地保護膜(2) が存在
する。 これらは同じ材料、同じ形成方法により形成さ
れているので薄膜トランジスタ作製工程における熱処理
又は薄膜トランジスタ動作時の発熱によって発生するこ
れら膜の熱膨張に差がなく、その上部に存在するアルミ
ニウム等の金属電極の断線又はピーリングを起こさず長
期の信頼性に優れたものとなった。
In the case of this embodiment, the source / drain electrodes
Under (6), there are a gate insulating film (5) and a base protective film (2). Since these are formed by the same material and the same forming method, there is no difference in the thermal expansion of these films generated by heat treatment in the thin film transistor manufacturing process or heat generated during the operation of the thin film transistor, and disconnection of a metal electrode such as aluminum present thereon. Or, it was excellent in long-term reliability without peeling.

【0030】〔実施例2〕図3に本実施例の作製方法の
概略図を示す。まず、ソーダガラス基板(1) 上に、公知
のスパッタリング法により実施例1と同じ作製条件にて
酸化珪素膜を作製した。
[Embodiment 2] FIG. 3 is a schematic view showing a manufacturing method of this embodiment. First, a silicon oxide film was formed on a soda glass substrate (1) by a known sputtering method under the same manufacturing conditions as in Example 1.

【0031】次に、この下地保護膜(2) 上にモリブデン
金属(10)を200nmの厚さに形成した後にこの上に低抵
抗非単結晶半導体層としてP型の導電型を有する非単結
晶珪素膜(8) を形成する。この時の作製条件は以下のと
おりであった。 基板温度 230℃ 反応圧力 0.05Torr Rfパワー(13.56MHz) 150W 使用ガス SiH4+B2H6 膜厚 200Å
Next, a molybdenum metal (10) is formed to a thickness of 200 nm on the base protective film (2), and then a non-single-crystal having a P-type conductivity is formed thereon as a low-resistance non-single-crystal semiconductor layer. A silicon film (8) is formed. The manufacturing conditions at this time were as follows. Substrate temperature 230 ° C. The reaction pressure 0.05 Torr Rf power (13.56MH z) 150W using gas SiH 4 + B 2 H 6 thickness 200Å

【0032】この場合膜厚は200 Åとし後工程で作製す
るI型半導体層とのオーミックコンタクトをとる目的だ
けとした。
In this case, the film thickness was set to 200 ° and only for the purpose of making ohmic contact with an I-type semiconductor layer to be formed in a later step.

【0033】次に、これらを所定のパターンにエッチン
グして図3(A)の状態を得た。そして、これらの上に
I型の非単結晶珪素半導体膜(3) を公知のスパッタ法で
200nmの厚さに形成した。その作成したその作製条件を
以下に示す。 基板温度 250℃ 反応圧力 0.2Pa Rfパワー(13.56MHz) 80W 使用ガス Ar
Next, these were etched into a predetermined pattern to obtain the state shown in FIG. Then, an I-type non-single-crystal silicon semiconductor film (3) is formed thereon by a known sputtering method.
It was formed to a thickness of 200 nm. The conditions for the preparation are shown below. A substrate temperature of 250 ° C. The reaction pressure 0.2 Pa Rf power (13.56MH z) 80W Gas used Ar

【0034】次に、実施例1と同じようにこのI型半導
体層(3) の多結晶化と水素プラズマ処理による活性化を
行い図3(B)に示す状態を得た。
Next, as in the first embodiment, the I-type semiconductor layer (3) was polycrystallized and activated by hydrogen plasma treatment to obtain the state shown in FIG. 3 (B).

【0035】さらに、スパッタリング法によりゲート絶
縁膜(5) を実施例1と同様に100nm形成した後、モ
リブデン金属によりゲート電極(9) を形成し所定のパタ
ーンに形成した。 このようにして図3(C)に示す薄
膜トランジスタを完成させた。
Further, a gate insulating film (5) was formed to a thickness of 100 nm in the same manner as in Example 1 by a sputtering method, and then a gate electrode (9) was formed of molybdenum metal to form a predetermined pattern. Thus, the thin film transistor shown in FIG. 3C was completed.

【0036】本実施例の場合、低抵抗半導体層下に金属
電極を有しているので、その配線抵抗が非常に小さい特
徴を有する。特に大面積の液晶装置のスイッチング素子
としてTFT を用いる際、この配線抵抗が小さい為に、駆
動信号波形がなまることがなく、多量のTFT を高速で応
答させることができる。また、本発明は、その他のデバ
イス構造を持つ薄膜トランジスタにも当然応用可能であ
る。
In this embodiment, since the metal electrode is provided below the low-resistance semiconductor layer, the wiring resistance is very small. In particular, when a TFT is used as a switching element of a large-area liquid crystal device, since the wiring resistance is small, a large amount of TFT can be responded at a high speed without the waveform of a drive signal being rounded. Further, the present invention is naturally applicable to thin film transistors having other device structures.

【0037】[0037]

【発明の効果】本発明の構成により、基板としての低温
ガラス中に存在する不純物が薄膜トランジスタの活性層
さらには素子自身へ侵入することを抑えることができ、
高相互コンダクタンスおよび高電界効果移動度を持つ薄
膜トランジスタを提供することができた。
According to the structure of the present invention, it is possible to prevent impurities existing in the low-temperature glass as the substrate from invading the active layer of the thin film transistor and the element itself.
A thin film transistor having high transconductance and high field effect mobility can be provided.

【0038】また、デバイス動作時における発熱により
基板より拡散する不純物をも抑えることができ、薄膜ト
ランジスタの電機的特性の劣化を抑制でき良好で長期の
安定性と信頼性を持つ薄膜トランジスタを実現すること
ができた。
Further, it is possible to suppress impurities diffused from the substrate due to heat generated during device operation, to suppress deterioration of the electrical characteristics of the thin film transistor, and to realize a thin film transistor having good long-term stability and reliability. did it.

【図面の簡単な説明】[Brief description of the drawings]

【図1】 本発明の一実施例のTFT の製造工程を示す概
略図。
FIG. 1 is a schematic view showing a manufacturing process of a TFT according to one embodiment of the present invention.

【図2】 従来のTFT の断面構造図。FIG. 2 is a cross-sectional structural view of a conventional TFT.

【図3】 本発明の一実施例のTFT の製造工程を示す概
略図。
FIG. 3 is a schematic view showing a manufacturing process of a TFT according to one embodiment of the present invention.

【符号の説明】[Explanation of symbols]

1 基板 2 下地保護膜 3 活性層 4 ソース/ドレイン領域 5 ゲート絶縁膜 6 ゲート並びにソース、ドレイン電極 7 チャネル形成領域 8 ソース/ドレイン領域 9 ゲート電極 10 ソース/ドレイン電極 20 基板 21 活性層 22、23 ソース/ドレイン領域 24、25 ソース/ドレイン電極 26 ゲート絶縁膜 27 ゲート電極 DESCRIPTION OF SYMBOLS 1 Substrate 2 Underlayer protective film 3 Active layer 4 Source / drain region 5 Gate insulating film 6 Gate and source / drain electrode 7 Channel formation region 8 Source / drain region 9 Gate electrode 10 Source / drain electrode 20 Substrate 21 Active layers 22, 23 Source / drain region 24, 25 Source / drain electrode 26 Gate insulating film 27 Gate electrode

Claims (9)

【特許請求の範囲】[Claims] 【請求項1】絶縁表面を有する基板上に下地保護膜を形
成し、 前記下地保護膜上にチャネル領域、ソース領域及びドレ
イン領域を形成し、 前記下地保護膜、チャネル形成領域、ソース領域及びド
レイン領域上に前記下地保護膜と同一材料からなるゲー
ト絶縁膜を形成し、 前記ゲート絶縁膜上にゲート電極を形成する薄膜トラン
ジスタにおいて、 前記ソース領域及び前記ドレイン領域は微結晶を有して
いることを特徴とする薄膜トランジスタの作製方法。
1. A base protective film is formed on a substrate having an insulating surface, and a channel region, a source region, and a drain region are formed on the base protective film, and the base protective film, a channel formation region, a source region, and a drain are formed. A thin film transistor in which a gate insulating film made of the same material as the base protective film is formed over a region, and a gate electrode is formed over the gate insulating film, wherein the source region and the drain region have microcrystals; A method for manufacturing a thin film transistor.
【請求項2】絶縁表面を有する基板上に下地保護膜を形
成し、 前記下地保護膜上にチャネル領域、ソース領域及びドレ
イン領域を形成し、 前記下地保護膜、チャネル形成領域、ソース領域及びド
レイン領域上に前記下地保護膜と同一材料からなるゲー
ト絶縁膜を形成し、 前記ゲート絶縁膜上にゲート電極を形成する薄膜トラン
ジスタにおいて、 前記ソース領域及び前記ドレイン領域は多結晶珪素でな
ることを特徴とする薄膜トランジスタの作製方法。
2. A base protective film is formed on a substrate having an insulating surface, a channel region, a source region, and a drain region are formed on the base protective film, and the base protective film, a channel formation region, a source region, and a drain are formed. A thin film transistor in which a gate insulating film made of the same material as the base protective film is formed on a region, and a gate electrode is formed on the gate insulating film, wherein the source region and the drain region are made of polycrystalline silicon; Method for manufacturing a thin film transistor.
【請求項3】絶縁表面を有する基板上に酸化珪素でなる
下地保護膜を形成し、 前記下地保護膜上にチャネル領域、ソース領域及びドレ
イン領域を形成し、 前記下地保護膜、チャネル形成領域、ソース領域及びド
レイン領域上に酸化珪素でなるゲート絶縁膜を形成し、 前記ゲート絶縁膜上にゲート電極を形成する薄膜トラン
ジスタにおいて、 前記ソース領域及び前記ドレイン領域は微結晶を有して
いることを特徴とする薄膜トランジスタの作製方法。
3. A base protective film made of silicon oxide is formed on a substrate having an insulating surface; a channel region, a source region, and a drain region are formed on the base protective film; In a thin film transistor in which a gate insulating film made of silicon oxide is formed over a source region and a drain region, and a gate electrode is formed over the gate insulating film, the source region and the drain region have microcrystals. Method for manufacturing a thin film transistor.
【請求項4】絶縁表面を有する基板上に酸化珪素でなる
下地保護膜を形成し、 前記下地保護膜上にチャネル領域、ソース領域及びドレ
イン領域を形成し、 前記下地保護膜、チャネル形成領域、ソース領域及びド
レイン領域上に酸化珪素でなるゲート絶縁膜を形成し、 前記ゲート絶縁膜上にゲート電極を形成する薄膜トラン
ジスタにおいて、 前記ソース領域及び前記ドレイン領域は多結晶珪素でな
ることを特徴とする薄膜トランジスタの作製方法。
4. A base protective film made of silicon oxide is formed on a substrate having an insulating surface; a channel region, a source region, and a drain region are formed on the base protective film; In a thin film transistor in which a gate insulating film made of silicon oxide is formed over a source region and a drain region, and a gate electrode is formed over the gate insulating film, the source region and the drain region are made of polycrystalline silicon. Method for manufacturing thin film transistor.
【請求項5】絶縁表面を有する基板上に下地保護膜を形
成し、 前記下地保護膜上に活性層を形成し、 前記活性層を結晶化し、 前記活性層上に微結晶を有するソース領域及びドレイン
領域を形成し、 前記下地保護膜、前記活性層、前記ソース領域及び前記
ドレイン領域上に下地保護膜と同一の材料からなるゲー
ト絶縁膜を形成し、 前記ゲート絶縁膜上にゲート電極を形成することを特徴
とする薄膜トランジスタの作製方法。
5. A source region having a base protective film formed on a substrate having an insulating surface, an active layer formed on the base protective film, crystallizing the active layer, and a source region having microcrystals on the active layer. Forming a drain region; forming a gate insulating film made of the same material as the base protective film on the base protective film, the active layer, the source region and the drain region; forming a gate electrode on the gate insulating film A method for manufacturing a thin film transistor.
【請求項6】絶縁表面を有する基板上に酸化珪素でなる
下地保護膜を形成し、 前記下地保護膜上に活性層を形成し、 前記活性層を結晶化し、 前記活性層上に微結晶を有するソース領域及びドレイン
領域を形成し、 前記下地保護膜、前記活性層、前記ソース領域及び前記
ドレイン領域上に酸化珪素でなるゲート絶縁膜を形成
し、 前記ゲート絶縁膜上にゲート電極を形成することを特徴
とする薄膜トランジスタの作製方法。
6. An under protective film made of silicon oxide is formed on a substrate having an insulating surface, an active layer is formed on the under protective film, the active layer is crystallized, and microcrystals are formed on the active layer. Forming a source region and a drain region, a gate insulating film made of silicon oxide on the base protective film, the active layer, the source region and the drain region, and forming a gate electrode on the gate insulating film. A method for manufacturing a thin film transistor, comprising:
【請求項7】絶縁表面を有する基板上に下地保護膜を形
成し、 前記下地保護膜上に、チャネル形成領域を含む多結晶半
導体層と、ソース領域及びドレイン領域を含む微結晶半
導体層とを形成し、 前記下地保護膜及び前記チャネル領域を覆う下地保護膜
と同一材料からなるゲート絶縁膜を形成し、 前記ゲート絶縁膜上にゲート電極を形成することを特徴
とする薄膜トランジスタの作製方法。
7. A base protective film is formed on a substrate having an insulating surface, and a polycrystalline semiconductor layer including a channel formation region and a microcrystalline semiconductor layer including a source region and a drain region are formed on the base protective film. Forming a gate insulating film made of the same material as the base protective film and the base protective film covering the channel region; and forming a gate electrode on the gate insulating film.
【請求項8】絶縁表面を有する基板上に酸化珪素でなる
下地保護膜を形成し、 前記下地保護膜上に、チャネル形成領域を含む多結晶半
導体層と、ソース領域及びドレイン領域を含む微結晶半
導体層とを形成し、 前記下地保護膜及び前記チャネル領域を覆う酸化珪素で
なるゲート絶縁膜を形成し、 前記ゲート絶縁膜上にゲート電極を形成することを特徴
とする薄膜トランジスタの作製方法。
8. A base protective film made of silicon oxide is formed on a substrate having an insulating surface, and a polycrystalline semiconductor layer including a channel formation region and a microcrystal including a source region and a drain region are formed on the base protective film. Forming a gate insulating film made of silicon oxide covering the base protective film and the channel region; and forming a gate electrode on the gate insulating film.
【請求項9】請求項1乃至8のいずれか一項において、 前記下地保護膜と前記ゲート絶縁膜は同一形成方法で形
成されたことを特徴とする薄膜トランジスタの作製方
法。
9. The method for manufacturing a thin film transistor according to claim 1, wherein the base protective film and the gate insulating film are formed by the same method.
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