JP2000221225A - Disconnection sensor and image input device having the same - Google Patents

Disconnection sensor and image input device having the same

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JP2000221225A
JP2000221225A JP11024406A JP2440699A JP2000221225A JP 2000221225 A JP2000221225 A JP 2000221225A JP 11024406 A JP11024406 A JP 11024406A JP 2440699 A JP2440699 A JP 2440699A JP 2000221225 A JP2000221225 A JP 2000221225A
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JP
Japan
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control
drive
circuit
signal
control circuit
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JP11024406A
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Japanese (ja)
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Norikazu Sakai
則和 酒井
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Fujifilm Business Innovation Corp
Original Assignee
Fuji Xerox Co Ltd
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Publication date
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Abstract

PROBLEM TO BE SOLVED: To detect a disconnection of wiring for transmitting a control signal from a control board to a drive board. SOLUTION: A control circuit mounted on a control board 100 counts number of times of changes of a clock signal transmitted from the board 100 to a drive board 300 by a counter 5A. The signal transmitted to the board 300 is returned to the board 100 through an AND gate 9, and number of times of the changes of the returned signal is counted by a counter 5B. A processor 3 decides the effect that a disconnection occurs at any of wiring group 200 for wiring the boards 100 and 300 in the case that a counted value of the counter 5A is different from that of the counter 5B.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は、断線検知装置及び
この断線検知装置を備えた画像入力装置に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a disconnection detecting device and an image input device provided with the disconnection detecting device.

【0002】[0002]

【従来の技術】複写機等の画像入力装置は、スキャナ等
の可動部を駆動するための駆動回路を有しているが、こ
の駆動回路はスキャナ駆動用のステッピングモータ等に
直接接続されているためノイズが発生しやすい。一方、
画像入力装置は、この駆動回路の他に、装置各部の制御
を行う制御回路を備えている。これらの駆動回路と制御
回路とを同一のプリント基板上に構成すると、駆動回路
において発生するノイズが制御回路に入力され、制御回
路が暴走するおそれがある。このため、制御回路を搭載
した制御基板とは別の駆動基板に駆動回路を搭載すると
共に、これらの各期板を配線で接続し、制御回路からの
制御信号を配線を介して駆動回路に伝送するような構成
が、一般的にとられている。
2. Description of the Related Art An image input apparatus such as a copying machine has a drive circuit for driving a movable portion such as a scanner. The drive circuit is directly connected to a stepping motor for driving the scanner. Therefore, noise is easily generated. on the other hand,
The image input device includes a control circuit for controlling each part of the device in addition to the drive circuit. If the drive circuit and the control circuit are formed on the same printed circuit board, noise generated in the drive circuit is input to the control circuit, and the control circuit may run away. For this reason, the drive circuit is mounted on a drive board separate from the control board on which the control circuit is mounted, and these period plates are connected by wiring, and a control signal from the control circuit is transmitted to the drive circuit via the wiring. Such a configuration is generally adopted.

【0003】[0003]

【発明が解決しようとする課題】ところで、上述した構
成において制御基板と駆動基板とを接続する配線が断線
してしまうことがある。この配線が断線すると、様々な
不具合が生じる。例えば、装置冷却用として使用される
ファンの制御信号ラインが断線した場合、駆動すべき信
号が制御回路から出力されていても、駆動回路に入力さ
れず、ファンは止まってしまう。従って、装置本体は異
常な温度上昇を続け、制御回路等の異常を引き起こす。
この様な問題を未然に防ぐためには、両基板を接続する
配線の断線を検知する簡便な手段が求められる。
However, in the above configuration, the wiring connecting the control board and the drive board may be disconnected. When this wiring is broken, various problems occur. For example, when a control signal line of a fan used for cooling the device is disconnected, even if a signal to be driven is output from the control circuit, the signal is not input to the drive circuit and the fan stops. Accordingly, the temperature of the apparatus main body continues to rise abnormally, causing an abnormality in the control circuit and the like.
In order to prevent such a problem beforehand, a simple means for detecting disconnection of the wiring connecting the two substrates is required.

【0004】そこで、本出願人は、この様な断線検知の
ための簡便な手段を得るべく、先行技術調査を行った
が、適当なものは得られなかった。例えば特開平5−2
15536号公報では、位置検出器とモータ制御装置と
からなる装置において、位置検出器内のエンコーダの出
力信号線の断線を検知するために、位置検出器側とモー
タ制御装置側の両方に、エンコーダの出力信号からパル
スを発生し、そのカウントを行う回路を設けている。す
なわち、エンコーダの出力信号線が断線した場合にその
出力信号レベルが不安定となり、位置検出器側の回路に
よって得られるカウント値とモータ制御装置側の回路に
よって得られるカウント値がずれることを利用して断線
検知を行うものである。しかし、画像入力装置において
問題となるのは、2種類の基板間において制御信号を伝
送するための配線の断線であり、上記のエンコーダの出
力信号線の断線検知のための技術をこのような基板間の
断線検知に適用することはできない。
Therefore, the present applicant has conducted a prior art search in order to obtain a simple means for detecting such a disconnection, but has failed to find a suitable one. For example, Japanese Patent Laid-Open No. 5-2
Japanese Patent Application Laid-Open No. 15536 discloses an apparatus including a position detector and a motor control device. In order to detect disconnection of an output signal line of an encoder in the position detector, an encoder is provided on both the position detector side and the motor control device side. And a circuit for generating a pulse from the output signal and counting the number of pulses. That is, when the output signal line of the encoder is disconnected, the output signal level becomes unstable, and the difference between the count value obtained by the circuit on the position detector side and the count value obtained by the circuit on the motor control device side is utilized. To detect disconnection. However, a problem in the image input device is the disconnection of the wiring for transmitting the control signal between the two types of boards. It cannot be applied to disconnection detection between the two.

【0005】また、特開平4−326410号公報は、
クロックの個数をカウントすることによりクロックの異
常を検知するクロック監視装置を開示している。この公
報の教示に従い、駆動基板側に制御基板側から送られて
くるクロック周波数を求めるカウンタを設けて、クロッ
ク周波数が所定範囲からずれた場合に断線が生じたと判
断する等の方法も考えられる。しかし、制御基板から駆
動基板に送られる制御信号は、このような定常的なクロ
ックばかりでなく、ある条件を満たしたときにのみ送ら
れるような単発的なパルスなどもある。このような制御
信号を伝送するための配線については、配線を介して供
給される制御信号の周波数を求めたとしても、断線を検
知することは不可能である。
[0005] Also, Japanese Patent Application Laid-Open No. Hei 4-326410 discloses that
A clock monitoring device that detects a clock abnormality by counting the number of clocks is disclosed. In accordance with the teachings of this publication, a method may be considered in which a counter for obtaining the clock frequency sent from the control board is provided on the drive board, and it is determined that a disconnection has occurred when the clock frequency deviates from a predetermined range. However, the control signal sent from the control board to the drive board includes not only such a steady clock but also a single pulse which is sent only when a certain condition is satisfied. Regarding the wiring for transmitting such a control signal, it is impossible to detect a disconnection even if the frequency of the control signal supplied via the wiring is obtained.

【0006】この発明は以上説明した事情に鑑みてなさ
れたものであり、制御基板から駆動基板へ制御信号を伝
送するための配線の断線を検知することができ、しか
も、安価に構成することができる断線検出装置、及びこ
の断線検出装置を備えた画像入力装置を提供することを
目的とする。
SUMMARY OF THE INVENTION The present invention has been made in view of the above-described circumstances, and it is possible to detect disconnection of a wiring for transmitting a control signal from a control board to a drive board, and furthermore, it is possible to provide an inexpensive structure. It is an object of the present invention to provide a disconnection detecting device capable of performing the above-described operation and an image input device including the disconnection detecting device.

【0007】[0007]

【課題を解決するための手段】この発明は、可動部と、
該可動部を駆動するための駆動回路を搭載した駆動基板
と、制御信号を生成する制御回路を搭載した制御基板と
を備えた装置に搭載され、前記制御回路から前記駆動回
路に制御信号を伝送するための配線の断線検知を行う断
線検知装置において、前記配線を介して前記制御回路か
ら前記駆動回路に送られた制御信号を前記制御回路に戻
す制御信号帰還手段と、前記制御回路から前記駆動回路
に送信される制御信号の変化の回数をカウントする第1
の計数手段と、前記制御信号帰還手段によって前記制御
回路に戻された制御信号の変化の回数をカウントする第
2の計数手段と、前記第1の計数手段のカウント値と前
記第2の計数手段のカウント値とが異なる場合に、前記
配線が断線している旨の判定をする判定手段とを具備す
ることを特徴とする断線検知装置を要旨とする。
SUMMARY OF THE INVENTION The present invention provides a moving part,
A control circuit is mounted on a device including a drive board on which a drive circuit for driving the movable portion is mounted, and a control board on which a control circuit for generating a control signal is mounted, and transmits a control signal from the control circuit to the drive circuit. Control signal feedback means for returning a control signal sent from the control circuit to the drive circuit through the wiring to the control circuit, and the control circuit The first counts the number of changes of the control signal transmitted to the circuit.
Counting means, a second counting means for counting the number of changes of the control signal returned to the control circuit by the control signal feedback means, a count value of the first counting means and the second counting means And a determination means for determining that the wiring is disconnected when the count value is different from the above.

【0008】かかる発明によれば、制御基板側で、駆動
基板側へ送った制御信号の変化の回数が計数されるとと
もに、駆動基板側から戻ってきた制御信号の変化の回数
が計数され、両カウント値の比較により、断線の有無が
判定される。
According to this invention, the control board counts the number of changes in the control signal sent to the drive board and counts the number of changes in the control signal returned from the drive board. By comparing the count values, the presence or absence of disconnection is determined.

【0009】[0009]

【発明の実施の形態】以下、図面を参照して本発明の実
施形態について説明する。 A.第1の実施形態 図1はこの発明の第1実施形態である画像入力装置の構
成を示すブロック図である。この画像入力装置はスキャ
ナやファンなどの可動部材を有している。図1に示す駆
動基板300は、この様な可動部材を駆動するための駆
動回路を搭載した基板である。図1には駆動回路の駆動
対象として、駆動部10Aと駆動部10Bが例示されて
いる。また、画像入力装置は、各部を制御するための制
御回路を有しており、この制御回路は図1に示す制御基
板100に搭載されている。そして、制御基板100
と、駆動基板300との間には、駆動クロックライン2
0A、確認クロックライン20Bおよび駆動信号ライン
20Cからなる配線群200が介在している。
Embodiments of the present invention will be described below with reference to the drawings. A. First Embodiment FIG. 1 is a block diagram showing a configuration of an image input device according to a first embodiment of the present invention. This image input device has movable members such as a scanner and a fan. The drive substrate 300 shown in FIG. 1 is a substrate on which a drive circuit for driving such a movable member is mounted. FIG. 1 illustrates a driving unit 10A and a driving unit 10B as driving targets of the driving circuit. Further, the image input device has a control circuit for controlling each unit, and this control circuit is mounted on the control board 100 shown in FIG. Then, the control board 100
And the drive board 300, the drive clock line 2
0A, a confirmation clock line 20B and a drive signal line 20C are interposed.

【0010】次に、制御基板100に搭載された制御回
路の構成について説明する。制御基板100において、
1はプログラムを予め記憶したROM、2は一時記憶手
段であるRAM、3はROM1に格納されたプログラム
に従い、画像入力装置の各部に制御信号を出力する演算
処理部、4は装置各部のタイミング制御のためのタイミ
ング信号を生成するタイミングジェネレータ、5A及び
5Bは入力されるパルスの数を計数するカウンタ、6は
バッファである。
Next, the configuration of a control circuit mounted on the control board 100 will be described. In the control board 100,
1 is a ROM in which a program is stored in advance, 2 is a RAM which is a temporary storage means, 3 is an arithmetic processing unit which outputs a control signal to each unit of the image input device according to the program stored in the ROM 1, and 4 is a timing control of each unit of the device. , 5A and 5B are counters for counting the number of input pulses, and 6 is a buffer.

【0011】タイミングジェネレータ4によって生成さ
れるタイミング信号の1つとして、駆動クロック信号a
がある。この駆動クロック信号aは駆動部10Aの駆動
タイミングを制御するための信号であり、駆動クロック
ライン20Aを介して駆動制御部8Aに伝送される。カ
ウンタ5Aは、タイミングジェネレータ4から駆動クロ
ックライン20Aに出力される駆動クロック信号aのパ
ルス数を計数する。また、駆動制御部8Aに送られた駆
動クロック信号aは、後述するANDゲート9を通過
し、確認クロックライン20Bを介して確認クロック信
号bとなって制御基板100に戻される。カウンタ5B
は、この確認クロック信号bのパルス数を計数する。こ
こで、確認クロック信号bが入力されるカウンタ5Bの
入力端子は、プルダウン抵抗7Aを介して接地されてい
る。カウンタ5A、5Bのカウント値は演算処理部3に
送られ、比較される。この演算処理部3からは、バッフ
ァ6を介して駆動信号cが出力され、駆動信号ライン2
0Cを介して駆動制御部8Bに伝送される。この駆動信
号cは連続的な信号で、少なくとも駆動クロック信号a
が出力されている間は常にハイレベルになっている。
One of the timing signals generated by the timing generator 4 is a driving clock signal a
There is. The drive clock signal a is a signal for controlling the drive timing of the drive unit 10A, and is transmitted to the drive control unit 8A via the drive clock line 20A. The counter 5A counts the number of pulses of the drive clock signal a output from the timing generator 4 to the drive clock line 20A. The drive clock signal a sent to the drive control unit 8A passes through an AND gate 9 described later, becomes a check clock signal b via a check clock line 20B, and is returned to the control board 100. Counter 5B
Counts the number of pulses of the confirmation clock signal b. Here, the input terminal of the counter 5B to which the confirmation clock signal b is input is grounded via the pull-down resistor 7A. The count values of the counters 5A and 5B are sent to the arithmetic processing unit 3 and compared. The driving signal c is output from the arithmetic processing unit 3 via the buffer 6, and the driving signal line 2
The data is transmitted to the drive control unit 8B via OC. The drive signal c is a continuous signal, and at least the drive clock signal a
Is always at the high level while is output.

【0012】次に、駆動基板300に搭載された駆動回
路の構成について説明する。まず、駆動制御部8Aは、
駆動クロックライン20Aを介して駆動クロック信号a
が与えられることにより、駆動部10Aの駆動制御を行
う手段である。ここで、駆動クロック信号aが入力され
る駆動制御部8Aの入力端子は、プルダウン抵抗7Bを
介して接地されている。次に、駆動制御部8Bは、駆動
信号ライン20Cを介してハイレベルの駆動信号cが与
えられることにより、駆動部10Bの駆動制御を行う手
段である。この駆動信号cが入力される駆動制御部8B
の入力端子は、プルダウン抵抗7Cを介して接地されて
いる。そして、ANDゲート9は、駆動クロックライン
20Aを介して供給される駆動クロック信号aと、駆動
信号ライン20Cを介して供給される駆動信号cとの論
理積である確認クロック信号bを出力する手段である。
この確認クロック信号bは、確認クロックライン20B
を介すことにより、上述した制御基板100内のカウン
タ5Bに戻される。
Next, the configuration of the drive circuit mounted on the drive board 300 will be described. First, the drive control unit 8A
Drive clock signal a via drive clock line 20A
Is a means for controlling the drive of the drive unit 10A. Here, the input terminal of the drive control unit 8A to which the drive clock signal a is input is grounded via the pull-down resistor 7B. Next, the drive control unit 8B is a unit that performs drive control of the drive unit 10B by receiving a high-level drive signal c via the drive signal line 20C. The drive control unit 8B to which the drive signal c is input
Are grounded via a pull-down resistor 7C. The AND gate 9 outputs a confirmation clock signal b which is a logical product of the driving clock signal a supplied via the driving clock line 20A and the driving signal c supplied via the driving signal line 20C. It is.
This confirmation clock signal b is transmitted to the confirmation clock line 20B.
, The data is returned to the counter 5B in the control board 100 described above.

【0013】この様な構成において、タイミングジェネ
レータ4から駆動クロック信号aが出力されると、演算
処理部3からはカウンタ5A、5Bに計数開始命令が出
される。このカウンタ5A及び5Bは、駆動クロック信
号aの出力が停止し、計数終了命令が出されるまでの
間、駆動クロック信号a及び確認クロック信号bの各パ
ルス数を計数する。
In such a configuration, when the drive clock signal a is output from the timing generator 4, the arithmetic processing unit 3 issues a count start instruction to the counters 5A and 5B. The counters 5A and 5B count the number of pulses of the driving clock signal a and the number of pulses of the confirmation clock signal b until the output of the driving clock signal a is stopped and a counting end command is issued.

【0014】(1)全ての配線20A、20Bおよび2
0Cが断線していない場合 図2はこの場合の各部の信号波形を示す波形図である。
この場合、タイミングジェネレータ4から出力された駆
動クロック信号aは、駆動クロックライン20Aを介し
て伝送され、駆動制御部8AおよびANDゲート9の一
方の入力端子に入力される。また、演算部3から出力さ
れた駆動信号cは、駆動信号ライン20Cを介して伝送
され、駆動部8BおよびANDゲート9の他方の入力端
子に入力される。ここで、駆動信号cは、少なくとも駆
動クロック信号aがタイミングジェネレータ4から出力
される期間、演算処理部3によってハイレベルとされ
る。従って、この間に駆動クロックライン20Aを介し
て制御基板100側から送られてくる駆動クロック信号
aは、そのまま、ANDゲート9から確認クロック信号
bとして出力される。この確認クロック信号bは、確認
クロックライン20Bを介して制御基板100側に戻さ
れる。制御基板100では、タイミングジェネレータ4
から出力される駆動クロック信号aのパルス数がカウン
タ5Aによってカウントされる一方、確認クロックライ
ン20Bを介して戻されてくる確認クロック信号bのパ
ルス数がカウンタ5Bによってカウントされる。ここ
で、駆動クロック信号aの波形と、確認クロック信号b
の波形は、図2にも示されるように同一波形となるた
め、カウンタ5Aおよび5Bのカウント値は一致する。
演算処理部3は、この両カウンタのカウント値が一致し
ていることを確認することにより、全ての配線20A、
20Bおよび20Cに断線が生じていない旨の判定をす
る。
(1) All wirings 20A, 20B and 2
FIG. 2 is a waveform diagram showing signal waveforms at various parts in this case.
In this case, the drive clock signal a output from the timing generator 4 is transmitted via the drive clock line 20A, and is input to the drive control unit 8A and one input terminal of the AND gate 9. The drive signal c output from the arithmetic unit 3 is transmitted via the drive signal line 20C, and is input to the drive unit 8B and the other input terminal of the AND gate 9. Here, the drive signal c is set to the high level by the arithmetic processing unit 3 at least during a period in which the drive clock signal a is output from the timing generator 4. Accordingly, the drive clock signal a sent from the control board 100 via the drive clock line 20A during this time is output as it is from the AND gate 9 as the confirmation clock signal b. This confirmation clock signal b is returned to the control board 100 via the confirmation clock line 20B. In the control board 100, the timing generator 4
The counter 5A counts the number of pulses of the drive clock signal a output from the counter 5A, while counting the number of pulses of the confirmation clock signal b returned via the confirmation clock line 20B. Here, the waveform of the driving clock signal a and the confirmation clock signal b
Are the same as shown in FIG. 2, so that the count values of the counters 5A and 5B match.
The arithmetic processing unit 3 confirms that the count values of the two counters are the same, so that all the wirings 20A,
It is determined that no disconnection has occurred in 20B and 20C.

【0015】(2)駆動クロックライン20Aが断線し
た場合 図3は駆動クロック信号aおよびハイレベルの駆動信号
cが駆動基板300に供給されている期間に駆動クロッ
クライン20Aが断線したときの各部の信号波形を示す
波形図である。この場合、駆動クロックライン20Aが
断線すると、このラインを介した駆動基板300側への
駆動クロックaの供給が断たれ、ANDゲート9の一方
の入力端子のレベルがプルダウン抵抗7Bによりローレ
ベルに固定される。このため、ANDゲート9の出力信
号レベルもローレベルに固定され、制御基板100側へ
の確認クロック信号bの供給も途絶える。従って、制御
基板100側では、駆動クロックライン20Aの断線時
以降、カウンタ5Aのカウント値が増加するにも拘わら
ず、カウンタ5Bによる確認クロック信号bのパルス数
のカウント値は停止したままとなる。演算処理部3は、
このように両カウンタのカウント値に相異が生じたこと
から、配線20A、20Bまたは20Cのいずれかに断
線が生じた旨の判定をする。
(2) When the Drive Clock Line 20A is Disconnected FIG. 3 shows each part when the drive clock line 20A is disconnected while the drive clock signal a and the high-level drive signal c are supplied to the drive substrate 300. FIG. 4 is a waveform diagram showing a signal waveform. In this case, when the drive clock line 20A is broken, the supply of the drive clock a to the drive substrate 300 via this line is cut off, and the level of one input terminal of the AND gate 9 is fixed to the low level by the pull-down resistor 7B. Is done. For this reason, the output signal level of the AND gate 9 is also fixed to the low level, and the supply of the confirmation clock signal b to the control board 100 is stopped. Therefore, on the control board 100 side, the count value of the pulse number of the confirmation clock signal b by the counter 5B remains stopped after the disconnection of the drive clock line 20A, despite the count value of the counter 5A increasing. The arithmetic processing unit 3
Since the difference between the count values of the two counters has occurred, it is determined that a disconnection has occurred in any of the wirings 20A, 20B, and 20C.

【0016】(3)駆動信号ライン20Cが断線した場
合 図4は駆動クロック信号aおよびハイレベルの駆動信号
cが駆動基板300に供給されている期間に駆動信号ラ
イン20Cが断線したときの各部の信号波形を示す波形
図である。この場合、駆動信号ライン20Cが断線する
と、このラインを介した駆動基板300側への駆動信号
cの供給が断たれ、ANDゲート9の一方の入力端子の
レベルがプルダウン抵抗7Cによりローレベルに固定さ
れる。このため、ANDゲート9の出力信号レベルもロ
ーレベルに固定され、制御基板100側への確認クロッ
ク信号bの供給も途絶える。従って、制御基板100側
では、駆動信号ライン20Cの断線時以降、カウンタ5
Aのカウント値が増加するにも拘わらず、カウンタ5B
による確認クロック信号bのパルス数のカウント値は停
止したままとなる。演算処理部3は、このように両カウ
ンタのカウント値に相異が生じたことから、配線20
A、20Bまたは20Cのいずれかに断線が生じた旨の
判定をする。
(3) When the Drive Signal Line 20C is Disconnected FIG. 4 shows each part when the drive signal line 20C is disconnected while the drive clock signal a and the high-level drive signal c are supplied to the drive substrate 300. FIG. 4 is a waveform diagram showing a signal waveform. In this case, when the drive signal line 20C is broken, the supply of the drive signal c to the drive substrate 300 via this line is cut off, and the level of one input terminal of the AND gate 9 is fixed to a low level by the pull-down resistor 7C. Is done. For this reason, the output signal level of the AND gate 9 is also fixed to the low level, and the supply of the confirmation clock signal b to the control board 100 is stopped. Therefore, on the control board 100 side, after the drive signal line 20C is disconnected, the counter 5
Although the count value of A increases, the counter 5B
, The count value of the number of pulses of the confirmation clock signal b remains stopped. The arithmetic processing unit 3 determines that the count values of the two counters differ from each other,
It is determined that a disconnection has occurred in any of A, 20B and 20C.

【0017】(4)確認クロックライン20Bが断線し
た場合 図5は駆動クロック信号aおよびハイレベルの駆動信号
cが駆動基板300に供給されている期間に確認クロッ
クライン20Bが断線したときの各部の信号波形を示す
波形図である。この場合、確認クロックライン20Bが
断線すると、このラインを介した制御基板100側への
確認クロックbの供給が断たれ、カウンタ5Bの一方の
入力端子のレベルがプルダウン抵抗7Aによりローレベ
ルに固定される。従って、制御基板100側では、確認
クロックライン20Bの断線時以降、カウンタ5Aのカ
ウント値が増加するにも拘わらず、カウンタ5Bによる
確認クロック信号bのパルス数のカウント値は停止した
ままとなる。演算処理部3は、このように両カウンタの
カウント値に相異が生じたから、配線20A、20Bま
たは20Cのいずれかに断線が生じた旨の判定をする。
(4) Case in which the Confirmation Clock Line 20B is Disconnected FIG. 5 shows the components of the respective parts when the confirmation clock line 20B is disconnected during a period in which the drive clock signal a and the high-level drive signal c are supplied to the drive substrate 300. FIG. 4 is a waveform diagram showing a signal waveform. In this case, when the check clock line 20B is disconnected, the supply of the check clock b to the control board 100 via this line is cut off, and the level of one input terminal of the counter 5B is fixed to the low level by the pull-down resistor 7A. You. Therefore, on the control board 100 side, after the disconnection of the confirmation clock line 20B, the count value of the number of pulses of the confirmation clock signal b by the counter 5B remains stopped despite the count value of the counter 5A increasing. The arithmetic processing unit 3 determines that any of the wirings 20A, 20B, and 20C has a disconnection because the count values of the two counters differ as described above.

【0018】なお、以上説明した実施形態では、駆動ク
ロック信号aと駆動信号cとの論理積を確認クロック信
号bとして制御基板側に戻したが、制御基板から駆動基
板に対し駆動信号cに相当するものが供給されないよう
な装置もあり得る。このような装置では、制御基板から
駆動基板に送られた駆動クロック信号aをそのまま確認
クロック信号bとして制御基板に戻すように構成すれば
よい。
In the above-described embodiment, the logical product of the driving clock signal a and the driving signal c is returned to the control board as the confirmation clock signal b. Some devices may not be supplied with anything to do. In such an apparatus, the drive clock signal a sent from the control board to the drive board may be directly returned to the control board as the confirmation clock signal b.

【0019】また、上記実施形態では、周期的な駆動ク
ロック信号aを伝送する配線を断線検知の対象とした
が、不規則なタイミングでレベル変化が発生する他の一
般的な制御信号の配線を断線検知の対象としてもよい。
この場合、制御基板側で当該制御信号の例えば立ち上が
り回数をカウントし、駆動基板に送られてから制御基板
に戻された当該制御信号の立ち上がり回数をカウント
し、両カウント値が異なるか否かにより、当該制御信号
のための配線に断線があるか否かを判断すればよい。
In the above-described embodiment, the wiring for transmitting the periodic drive clock signal a is targeted for disconnection detection. However, the wiring for other general control signals whose level changes at irregular timing is replaced by the wiring. It may be a target of disconnection detection.
In this case, the control board counts the number of rises of the control signal, for example, counts the number of rises of the control signal returned to the control board after being sent to the drive board, and determines whether the two count values are different. It may be determined whether there is a disconnection in the wiring for the control signal.

【0020】B.第2の実施形態 上記第1の実施形態では、制御回路を搭載した制御基板
と、駆動回路を搭載した駆動基板を接続するラインを断
線検知の対象としている。しかし、実際には、電源電圧
のように、他のモジュールから制御基板及び駆動基板に
入力されるラインもあり、かかるラインについても断線
検知を必要とする。そこで、本実施形態では、他のモジ
ュールから制御基板及び駆動基板に電源電圧が入力され
る場合の、電源と駆動基板を接続するラインについても
断線検知する。具体的には次の通りである。
B. Second Embodiment In the first embodiment, the line connecting the control board on which the control circuit is mounted and the drive board on which the drive circuit is mounted is targeted for disconnection detection. However, actually, there are lines such as power supply voltages that are input from other modules to the control board and the drive board, and such lines also require disconnection detection. Therefore, in the present embodiment, when a power supply voltage is input to the control board and the drive board from another module, the disconnection of the line connecting the power supply and the drive board is also detected. Specifically, it is as follows.

【0021】図6は本発明の第2の実施形態である画像
入力装置の構成を示すブロック図である。なお、この図
6において、前述した図1と対応する部分には同一符号
を付し、その説明を省略する。この画像入力装置におい
て、駆動基板300には、上記第1の実施形態における
駆動制御部8Aの代わりにステッピングモータ駆動部8
A’が、駆動制御部8Bの代わりにファンレベル駆動部
8B’が各々駆動回路として搭載されている。
FIG. 6 is a block diagram showing the configuration of an image input device according to a second embodiment of the present invention. In FIG. 6, portions corresponding to those in FIG. 1 described above are denoted by the same reference numerals, and description thereof is omitted. In this image input device, the driving substrate 300 includes a stepping motor driving unit 8 instead of the driving control unit 8A in the first embodiment.
A ′ is provided with a fan level driver 8B ′ as a drive circuit instead of the drive controller 8B.

【0022】ステッピングモータ10A’およびファン
10B’は、上記各駆動回路の駆動対象である。ここ
で、ステッピングモータ10A’は、図示しないキャリ
ッジを駆動して副走査を行う手段である。また、ファン
10B’は、この画像読取装置の内部を冷却するための
手段である。
The stepping motor 10A 'and the fan 10B' are driven by each of the above driving circuits. Here, the stepping motor 10A 'is means for driving a carriage (not shown) to perform sub-scanning. The fan 10B 'is a unit for cooling the inside of the image reading device.

【0023】制御基板100上の制御回路は、上記駆動
基板300等に供給する各種制御信号を発生する手段で
あり、上記第1の実施形態におけるものとほぼ同様な構
成を有している。なお、本実施形態では、制御基板10
0上にCPU400が搭載されているが、このCPU4
00は、上記第1の実施形態における演算処理部3、タ
イミングジェネレータ4、カウンタ5Aおよび5Bの諸
機能を営む。ただし、本実施形態における演算処理部3
は、上記第1の実施形態における演算処理部3の機能の
他、制御信号dを発生する機能を有している。この制御
信号dは、ステッピングモータ10A’を制御するため
の信号であり、制御信号ライン20Dを介してステッピ
ングモータ駆動部8A’に伝送される。
The control circuit on the control board 100 is a means for generating various control signals to be supplied to the drive board 300 and the like, and has substantially the same configuration as that in the first embodiment. In this embodiment, the control board 10
CPU 400 is mounted on the
00 performs various functions of the arithmetic processing unit 3, the timing generator 4, and the counters 5A and 5B in the first embodiment. However, the arithmetic processing unit 3 in the present embodiment
Has a function of generating a control signal d in addition to the function of the arithmetic processing unit 3 in the first embodiment. The control signal d is a signal for controlling the stepping motor 10A ', and is transmitted to the stepping motor driving unit 8A' via the control signal line 20D.

【0024】低電圧電源(以下、LPVSと略す。)1
1は、24Vの電圧eと、5Vの電圧fを発生する。そ
して、制御基板100上のCPU400、ROM1、R
AM2、バッファ6には、LPVS11によって発生さ
れる5Vの電圧fが電源電圧として供給される。
A low-voltage power supply (hereinafter abbreviated as LPVS) 1
1 generates a voltage e of 24V and a voltage f of 5V. Then, the CPU 400, the ROM1, and the R
The voltage f of 5 V generated by the LPVS 11 is supplied to the AM 2 and the buffer 6 as a power supply voltage.

【0025】駆動基板300には、LPVS11によっ
て発生された24Vの電圧eおよび5Vの電圧fが各々
ライン20Eおよび20Fを介して供給される。そし
て、24Vの電圧eは、ステッピングモータ駆動部8
A’およびファン駆動部8B’に電源電圧として供給さ
れる。このステッピングモータ駆動部8A’およびファ
ン駆動部8B’に電源電圧を供給する電源ラインは、プ
ルダウン抵抗7Dを介して接地されている。また、24
Vの電圧eは、電圧レベル変換器12によって5Vに変
換され、ANDゲート9に供給される。駆動基板300
に供給された5Vの電圧fは、ANDゲート9等の各種
論理回路に電源電圧として供給される。本実施形態によ
れば、制御基板100側から供給される励磁クロック信
号a、駆動信号bの他、電圧レベル変換器12から得ら
れる5Vの電圧もANDゲート9に入力される。従っ
て、励磁クロック信号a、駆動信号bを伝送する配線の
他、24Vの電源電圧を伝送するライン20Eが断線し
た場合にもその検知を行うことができる。
The drive board 300 is supplied with a voltage e of 24 V and a voltage f of 5 V generated by the LPVS 11 via lines 20E and 20F, respectively. The voltage e of 24 V is applied to the stepping motor driving unit 8.
A ′ and the fan drive unit 8B ′ are supplied as a power supply voltage. A power supply line for supplying a power supply voltage to the stepping motor drive section 8A 'and the fan drive section 8B' is grounded via a pull-down resistor 7D. Also, 24
The voltage e of V is converted into 5 V by the voltage level converter 12 and supplied to the AND gate 9. Driving board 300
Is supplied as a power supply voltage to various logic circuits such as the AND gate 9. According to the present embodiment, in addition to the excitation clock signal a and the drive signal b supplied from the control board 100 side, the 5 V voltage obtained from the voltage level converter 12 is also input to the AND gate 9. Therefore, even when the line 20E for transmitting the power supply voltage of 24V is disconnected in addition to the wiring for transmitting the excitation clock signal a and the drive signal b, the detection can be performed.

【0026】すなわち、励磁クロック信号aの制御基板
100から駆動基板300への伝送中、ライン20Eが
断線すると、電圧レベル変換器12から5Vの電圧が出
力されなくなる。この結果、ANDゲート9の出力信号
がローレベルに固定され、制御基板100側のカウンタ
5Bへの確認クロックbの供給が途絶える。そして、演
算処理部3は、カウンタ5Aおよび5Bの両カウント値
の相異から配線の断線を検知するのである。
That is, when the line 20E is disconnected during transmission of the excitation clock signal a from the control board 100 to the drive board 300, the voltage of the voltage level converter 12 does not output a voltage of 5V. As a result, the output signal of the AND gate 9 is fixed at the low level, and the supply of the confirmation clock b to the counter 5B on the control board 100 is interrupted. Then, the arithmetic processing unit 3 detects the disconnection of the wiring from the difference between the count values of the counters 5A and 5B.

【0027】[0027]

【発明の効果】以上説明したように、本発明によれば、
可動部と、該可動部を駆動するための駆動回路を搭載し
た駆動基板と、制御信号を生成する制御回路を搭載した
制御基板とを備えた装置に搭載され、前記制御回路から
前記駆動回路に制御信号を伝送するための配線の断線検
知を行う断線検知装置において、前記配線を介して前記
制御回路から前記駆動回路に送られた制御信号を前記制
御回路に戻す制御信号帰還手段と、前記制御回路から前
記駆動回路に送信される制御信号の変化の回数をカウン
トする第1の計数手段と、前記制御信号帰還手段によっ
て前記制御回路に戻された制御信号の変化の回数をカウ
ントする第2の計数手段と、前記第1の計数手段のカウ
ント値と前記第2の計数手段のカウント値とが異なる場
合に、前記配線が断線している旨の判定をする判定手段
とを設けたので、制御基板と駆動基板を接続するライン
の断線を検知できるという効果がある。
As described above, according to the present invention,
A movable section, mounted on a device including a drive board on which a drive circuit for driving the movable section is mounted, and a control board on which a control circuit for generating a control signal is mounted, from the control circuit to the drive circuit In a disconnection detecting device for detecting disconnection of a wiring for transmitting a control signal, control signal feedback means for returning a control signal sent from the control circuit to the drive circuit through the wiring to the control circuit; First counting means for counting the number of changes in the control signal transmitted from the circuit to the drive circuit; and second counting means for counting the number of changes in the control signal returned to the control circuit by the control signal feedback means. Counting means, and when the count value of the first counting means is different from the count value of the second counting means, the determination means for determining that the wiring is broken, provided There is an effect that can detect the disconnection of the line connecting the control substrate and the driving substrate.

【図面の簡単な説明】[Brief description of the drawings]

【図1】この発明の第一の実施形態である画像入力装置
の構成を示すブロック図である。
FIG. 1 is a block diagram illustrating a configuration of an image input device according to a first embodiment of the present invention.

【図2】同実施形態における各信号状態を示す図であ
る。
FIG. 2 is a diagram showing signal states in the embodiment.

【図3】同実施形態における各信号状態を示す図であ
る。
FIG. 3 is a diagram showing each signal state in the embodiment.

【図4】同実施形態における各信号状態を示す図であ
る。
FIG. 4 is a diagram showing each signal state in the embodiment.

【図5】同実施形態における各信号状態を示す図であ
る。
FIG. 5 is a diagram showing each signal state in the embodiment.

【図6】この発明の第2の実施形態である画像入力装置
の構成を示すブロック図である。
FIG. 6 is a block diagram showing a configuration of an image input device according to a second embodiment of the present invention.

【符号の説明】[Explanation of symbols]

100・・・制御基板、200・・・配線、 300・
・・駆動基板 3・・・演算処理部、 4・・・タイミングジェネレー
タ 5A、5B・・・カウンタ、 9・・・ANDゲート
100: control board, 200: wiring, 300
..Drive board 3 ... Calculation processing unit 4 ... Timing generator 5A, 5B ... Counter 9 ... AND gate

Claims (4)

【特許請求の範囲】[Claims] 【請求項1】 第1のモジュールから第2のモジュール
に制御信号を伝送する配線の断線検知を行う断線検知装
置において、 前記配線を介して前記第1のモジュールから前記第2の
モジュールに送られた制御信号を前記第1のモジュール
に戻す制御信号帰還手段と、 前記第1のモジュールから送信される制御信号の変化の
回数をカウントする第1の計数手段と、 前記制御信号帰還手段によって前記第1のモジュールに
戻された制御信号の変化の回数をカウントする第2の計
数手段と、 前記第1の計数手段のカウント値と前記第2の計数手段
のカウント値とが異なる場合に、前記配線が断線してい
る旨の判定をする判定手段とを具備することを特徴とす
る断線検知装置。
1. A disconnection detection device for detecting disconnection of a wiring for transmitting a control signal from a first module to a second module, wherein the disconnection is detected from the first module to the second module via the wiring. Control signal feedback means for returning the control signal to the first module, first counting means for counting the number of changes of the control signal transmitted from the first module, and A second counting means for counting the number of changes of the control signal returned to the first module; and a wiring when the count value of the first counting means is different from the count value of the second counting means. And a determining means for determining that the wire is disconnected.
【請求項2】 画像読み取りを行うスキャナ等の可動部
と、該可動部を駆動するステッピングモータ等の駆動回
路を搭載した駆動基板と、制御信号を生成する制御回路
を搭載した制御基板と、前記制御回路から前記駆動回路
に制御信号を伝送するための配線の断線検知を行う断線
検知装置とを備えた画像入力装置において、 該断線検知装置が、前記配線を介して前記制御回路から
前記駆動回路に送られた制御信号を前記制御回路に戻す
制御信号帰還手段と、 前記制御回路から前記駆動回路に送信される制御信号の
変化の回数をカウントする第1の計数手段と、 前記制御信号帰還手段によって前記制御回路に戻された
制御信号の変化の回数をカウントする第2の計数手段
と、 前記第1の計数手段のカウント値と前記第2の計数手段
のカウント値とが異なる場合に、前記配線が断線してい
る旨の判定をする判定手段とを具備することを特徴とす
る画像入力装置。
2. A movable board such as a scanner for reading an image, a drive board equipped with a drive circuit such as a stepping motor for driving the movable section, a control board equipped with a control circuit for generating a control signal, A disconnection detecting device for detecting disconnection of a wiring for transmitting a control signal from a control circuit to the driving circuit, wherein the disconnection detecting device is configured to transmit the control signal from the control circuit to the driving circuit via the wiring. Control signal feedback means for returning the control signal sent to the control circuit to the control circuit; first counting means for counting the number of changes of the control signal transmitted from the control circuit to the drive circuit; and the control signal feedback means Second counting means for counting the number of changes of the control signal returned to the control circuit, and a count value of the first counting means and a count of the second counting means Doo is if different, the image input apparatus characterized by comprising a determination means for the determination that the wiring is disconnected.
【請求項3】 画像読み取りを行うスキャナ等の可動部
と、該可動部を駆動するステッピングモータ等の駆動回
路を搭載した駆動基板と、クロック信号及び少なくとも
クロック信号が出力されている期間だけ所定レベルにさ
れる制御信号を生成する制御回路を搭載した制御基板
と、前記制御回路から前記駆動回路にクロック信号及び
制御信号を伝送するための配線の断線検知を行う断線検
知装置とを備えた画像入力装置において、 該断線検知装置が、前記制御回路から前記駆動回路に送
られた前記制御信号が所定レベルを維持している期間、
前記制御回路から前記駆動回路に送られたクロック信号
を確認信号として前記制御回路に戻す論理回路と、 前記制御回路から前記駆動回路に送信されるクロック信
号の変化の回数をカウントする第1の計数手段と、 前記駆動回路から前記制御回路に戻された確認信号の変
化の回数をカウントする第2の計数手段と、 前記第1の計数手段のカウント値と前記第2の計数手段
のカウント値とが異なる場合に、前記配線が断線してい
る旨の判定をする判定手段とを具備することを特徴とす
る画像入力装置。
3. A movable section such as a scanner for reading an image, a drive board on which a drive circuit such as a stepping motor for driving the movable section is mounted, and a clock signal and a predetermined level for at least a period during which the clock signal is output. An image input comprising: a control board on which a control circuit for generating a control signal to be generated is mounted; and a disconnection detecting device for detecting disconnection of wiring for transmitting a clock signal and a control signal from the control circuit to the drive circuit. In the device, while the disconnection detection device, while the control signal sent from the control circuit to the drive circuit is maintaining a predetermined level,
A logic circuit for returning a clock signal sent from the control circuit to the drive circuit to the control circuit as a confirmation signal; and a first count for counting the number of changes of the clock signal transmitted from the control circuit to the drive circuit. Means, a second counting means for counting the number of changes of the confirmation signal returned from the driving circuit to the control circuit, a count value of the first counting means and a count value of the second counting means, An image input device comprising: a determination unit configured to determine that the wiring is disconnected when the values are different from each other.
【請求項4】 前記論理回路は、前記制御信号のみなら
ず、これに加えて前記制御基板以外のモジュールから供
給される電圧が所定のレベルを維持している期間、前記
制御回路から前記駆動回路に送られたクロック信号を確
認信号として前記制御回路に戻すことを特徴とする請求
項3に記載の画像入力装置。
4. The control circuit according to claim 1, wherein the logic circuit is configured to output the control signal from the control circuit during a period in which a voltage supplied from a module other than the control board is maintained at a predetermined level. 4. The image input device according to claim 3, wherein the clock signal sent to the control circuit is returned to the control circuit as a confirmation signal.
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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010096986A (en) * 2008-10-16 2010-04-30 Nippon Seiki Co Ltd Display device
JP2010191351A (en) * 2009-02-20 2010-09-02 Alps Electric Co Ltd Display control system and failure detecting method
JP2016125850A (en) * 2014-12-26 2016-07-11 富士通株式会社 Test circuit and method for controlling test circuit

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