JP2000183053A - Manufacture of semiconductor device - Google Patents

Manufacture of semiconductor device

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JP2000183053A
JP2000183053A JP10355043A JP35504398A JP2000183053A JP 2000183053 A JP2000183053 A JP 2000183053A JP 10355043 A JP10355043 A JP 10355043A JP 35504398 A JP35504398 A JP 35504398A JP 2000183053 A JP2000183053 A JP 2000183053A
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film
oxidation
oxide film
region
etching
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Shuji Kawada
修二 川田
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Sony Corp
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Abstract

PROBLEM TO BE SOLVED: To provide a method for manufacturing a semiconductor device with which the loss of thickness in an LOCOS film can be reduced and the isolation characteristic of element can be improved. SOLUTION: A pad oxide film 120, a pad polysilicon film 130, a silicon oxide film 140, and a mask nitride film 150 are formed sequentially on a silicon substrate 110. Then the mask nitride film 150 and silicon oxide film 140 in the region of element isolation film to be formed are removed selectively through etching. An edge part 300 in the removed region is cut by side etching to form a groove 310 in the edge part 300. Furthermore an acid resistant film 170 is formed over the entire upper surface thereof, and it is etchbacked entirely thereon, while a sidewall 172 is left as it is. Thus, the sidewall 172 is formed in a state in which it partly penetrates the groove 310, and the growth of a top bird's beak part 182 can be suppressed in the subsequent growth step of a LOCOS film 180.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は、半導体装置の製造
方法に関し、半導体基板上にLOCOS法によって素子
間分離領域を形成する方法に関する。
[0001] 1. Field of the Invention [0002] The present invention relates to a method for manufacturing a semiconductor device, and more particularly to a method for forming an element isolation region on a semiconductor substrate by a LOCOS method.

【0002】[0002]

【従来の技術】従来より、半導体装置の製造方法とし
て、PPL(Poly Pad LOCOS)法によっ
て素子間分離領域を形成する方法が提案されている(例
えば特開平9−82699号公報、特開平10−928
05号公報参照)。図4は、このようなPPL法による
作業工程の従来例を示す説明図である。まず、図4
(ア)〜(エ)に示すように、シリコン基板10上にパ
ッド酸化(SiO2)膜20、パッドポリシリコン(P
olySi)膜30、シリコン酸化(SiO2)膜4
0、マスク窒化(SiN)膜50を成膜する。具体的に
は、シリコン基板10の上面を酸化してパッド酸化膜2
0を形成し、その上にCVDによってパッドポリシリコ
ン膜30を形成する。そして、パッドポリシリコン膜3
0の上面を酸化してシリコン酸化膜40を形成し、その
上にCVDによってマスク窒化膜50を成膜する。
2. Description of the Related Art Hitherto, as a method of manufacturing a semiconductor device, a method of forming an element isolation region by a PPL (Poly Pad LOCOS) method has been proposed (for example, Japanese Patent Application Laid-Open Nos. 9-82699 and 10-82). 928
No. 05). FIG. 4 is an explanatory view showing a conventional example of such a working process by the PPL method. First, FIG.
As shown in (a) to (d), a pad oxide (SiO 2 ) film 20 and a pad polysilicon (P) are formed on a silicon substrate 10.
(polysilicon) film 30, silicon oxide (SiO 2 ) film 4
0, a mask nitride (SiN) film 50 is formed. Specifically, the pad oxide film 2 is oxidized by oxidizing the upper surface of the silicon substrate 10.
0, and a pad polysilicon film 30 is formed thereon by CVD. Then, the pad polysilicon film 3
The silicon oxide film 40 is formed by oxidizing the upper surface of the mask 0, and a mask nitride film 50 is formed thereon by CVD.

【0003】図4(オ)、(カ)に示すように、形成す
べき素子分離膜の領域の除いてホトレジスト膜60を形
成し、エッチングによってマスク窒化膜50及びシリコ
ン酸化膜40を選択的に除去する。この後、図4(キ)
〜(サ)に示すように、形成すべき素子分離膜の領域に
熱酸化によってLOCOS膜70を成長させた後、3段
階のLight(Wet)エッチングによってマスク窒
化膜50、シリコン酸化膜40、パッドポリシリコン膜
30を除去し、次工程に移行する。
As shown in FIGS. 4E and 4F, a photoresist film 60 is formed except for a region of an element isolation film to be formed, and a mask nitride film 50 and a silicon oxide film 40 are selectively formed by etching. Remove. After this, FIG.
As shown in (a) to (c), after a LOCOS film 70 is grown by thermal oxidation in a region of an element isolation film to be formed, a mask nitride film 50, a silicon oxide film 40, and a pad are formed by three-stage Light (Wet) etching. The polysilicon film 30 is removed, and the process proceeds to the next step.

【0004】[0004]

【発明が解決しようとする課題】以上のようなPPL法
においては、パッド酸化膜20を薄くしても、マスク窒
化膜50のエッチング工程においてシリコン基板10を
エッチングしないため、ダメージや欠陥の発生を抑制で
きる利点がある。
In the PPL method as described above, even if the pad oxide film 20 is thinned, the silicon substrate 10 is not etched in the etching step of the mask nitride film 50, so that damage and defects are not generated. There is an advantage that can be suppressed.

【0005】しかしながら、このPPL法においては、
上述のようにLOCOS膜70を成長させた後、3段階
のエッチングによってマスク窒化膜50、シリコン酸化
膜40、パッドポリシリコン膜30を除去することか
ら、この工程におけるLOCOS膜70の除去量(LO
COS膜厚ロス)が大きくなり、例えば素子分離特性に
悪影響を及ぼす等の問題が生じていた。また、このよう
に後工程での除去量が大きいため初期のLOCOS膜7
0の膜厚を大きくする必要があり、例えば、LOCOS
膜70のトップバーズビーク70Aが大きく伸びてしま
い、この点においても例えば素子分離特性に悪影響を及
ぼす等の問題が生じていた。
However, in this PPL method,
After the LOCOS film 70 is grown as described above, the mask nitride film 50, the silicon oxide film 40, and the pad polysilicon film 30 are removed by three-stage etching. Therefore, the removal amount of the LOCOS film 70 (LO
(COS film thickness loss) is increased, which causes problems such as adversely affecting element isolation characteristics. In addition, since the removal amount in the subsequent process is large, the initial LOCOS film 7
0 needs to be increased, for example, LOCOS
The top bird's beak 70A of the film 70 is greatly extended, and this also causes a problem such as adversely affecting element isolation characteristics.

【0006】そこで本発明の目的は、LOCOS膜厚ロ
スを減少させ、例えば素子分離特性等の改善を図ること
が可能な半導体装置の製造方法を提供することにある。
SUMMARY OF THE INVENTION An object of the present invention is to provide a method of manufacturing a semiconductor device capable of reducing LOCOS film thickness loss and improving, for example, element isolation characteristics.

【0007】[0007]

【課題を解決するための手段】本発明は前記目的を達成
するため、シリコン基板上にパッド酸化膜、パッドポリ
シリコン膜、シリコン酸化膜、及びマスク窒化膜を順次
成膜する工程Aと、形成すべき素子分離膜の領域の前記
マスク窒化膜、シリコン酸化膜、及び前記パッドポリシ
リコン膜を選択的にエッチングして除去する工程Bと、
前記工程Bによって除去された領域のエッジ部をサイド
エッチングによって削る工程Cと、前記工程B及び工程
Cによって除去された領域及びマスク窒化膜の上面に耐
酸化性膜を成膜する工程Dと、前記工程Bによって除去
された領域のエッジ部に前記耐酸化性膜によるサイドウ
ォールを残した状態で、前記耐酸化性膜を全面エッチバ
ックにより除去する工程Eと、素子分離膜の領域のパッ
ド酸化膜に熱酸化を行い、素子分離膜を形成する工程F
とを有することを特徴とする。
According to the present invention, there is provided a method for forming a pad oxide film, a pad polysilicon film, a silicon oxide film, and a mask nitride film on a silicon substrate. A step B of selectively etching and removing the mask nitride film, the silicon oxide film, and the pad polysilicon film in the region of the element isolation film to be formed;
A step C of shaving the edge portion of the region removed by the step B by side etching, and a step D of forming an oxidation-resistant film on the region removed by the steps B and C and the upper surface of the mask nitride film; A step E of removing the oxidation-resistant film by etch-back over the entire surface while leaving a sidewall of the oxidation-resistant film at an edge of the region removed in the step B; Step F of subjecting the film to thermal oxidation to form an element isolation film
And characterized in that:

【0008】本発明の半導体装置の製造方法において、
まず、工程Aでは、シリコン基板上にパッド酸化膜、パ
ッドポリシリコン膜、シリコン酸化膜、及びマスク窒化
膜を順次成膜し、次に工程Bでは、形成すべき素子分離
膜の領域の前記マスク窒化膜、シリコン酸化膜、及び前
記パッドポリシリコン膜を選択的にエッチングして除去
する。次に工程Cでは、前記工程Bによって除去された
領域のエッジ部をサイドエッチングによって削る。この
工程Cのサイドエッチングにより、前記エッジ部のシリ
コン酸化膜の端部が削られて前記エッジ部に溝部が形成
される。
In the method for manufacturing a semiconductor device according to the present invention,
First, in a step A, a pad oxide film, a pad polysilicon film, a silicon oxide film, and a mask nitride film are sequentially formed on a silicon substrate, and then, in a step B, the mask in a region of an element isolation film to be formed is formed. The nitride film, the silicon oxide film, and the pad polysilicon film are selectively etched and removed. Next, in step C, the edge portion of the region removed in step B is cut by side etching. By the side etching in the step C, the edge of the silicon oxide film at the edge is shaved to form a groove at the edge.

【0009】次に工程Dでは、前記工程B及び工程Cに
よって除去された領域及びマスク窒化膜の上面に耐酸化
性膜を成膜する。この工程Dにおいて成膜される耐酸化
性膜が、工程Cで前記エッジ部に形成された溝部にくい
込む状態で形成される。次に工程Eでは、前記工程Bに
よって除去された領域のエッジ部に前記耐酸化性膜によ
るサイドウォールを残した状態で、前記耐酸化性膜を全
面エッチバックにより除去し、工程Fでは、素子分離膜
の領域のパッド酸化膜に熱酸化を行い、素子分離膜を形
成する。
Next, in step D, an oxidation resistant film is formed on the region removed in steps B and C and on the upper surface of the mask nitride film. The oxidation resistant film formed in the step D is formed so as to fit into the groove formed in the edge in the step C. Next, in step E, the oxidation-resistant film is removed by etch back over the entire surface, with the sidewall of the oxidation-resistant film left at the edge of the region removed in step B. Thermal oxidation is performed on the pad oxide film in the region of the isolation film to form an element isolation film.

【0010】この工程Fにおいて、素子分離膜の成長時
に、耐酸化性膜によるサイドウォールと、このサイドウ
ォールの前記エッジ部に形成された溝部にくい込んだ部
分により、素子分離膜の外周部に形成されるトップバー
ズビーク部の成長が抑制されることになる。したがっ
て、短いトップバーズビーク部の素子分離膜を形成でき
るため、後処理における素子分離膜のエッチング量を大
幅に減少することができ、例えば素子分離特性を改善す
ることが可能となる。
In this step F, at the time of growth of the element isolation film, the side wall of the oxidation resistant film and the groove formed in the edge of the side wall are formed on the outer peripheral portion of the element isolation film. This suppresses the growth of the top bird's beak. Therefore, since an element isolation film having a short top bird's beak portion can be formed, the etching amount of the element isolation film in post-processing can be significantly reduced, and, for example, the element isolation characteristics can be improved.

【0011】[0011]

【発明の実施の形態】以下、本発明による半導体装置の
製造方法の実施の形態例について説明する。図1〜図3
は、本発明による半導体装置の製造方法を示す説明図で
あり、PPL法による作業工程を示している。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS An embodiment of a method for manufacturing a semiconductor device according to the present invention will be described below. 1 to 3
FIG. 2 is an explanatory view showing a method for manufacturing a semiconductor device according to the present invention, showing working steps by the PPL method.

【0012】まず、図1(ア)〜(エ)に示すように、
シリコン基板(Si)110上にパッド酸化(Si
2)膜120、パッドポリシリコン(PolySi)
膜130、シリコン酸化(SiO2)膜140、マスク
窒化(シリコン窒化膜;SiN)膜150を順次成膜す
る(工程A)。具体的には、シリコン基板10の上面を
酸化してパッド酸化膜120を形成し、その上にCVD
によってパッドポリシリコン膜130を形成する。そし
て、パッドポリシリコン膜130の上面を酸化してシリ
コン酸化膜140を形成し、その上にCVDによってマ
スク窒化膜150を成膜する。
First, as shown in FIGS.
Pad oxidation (Si) is applied on a silicon substrate (Si) 110.
O 2 ) film 120, pad polysilicon (PolySi)
A film 130, a silicon oxide (SiO 2 ) film 140, and a mask nitride (silicon nitride film; SiN) film 150 are sequentially formed (Step A). More specifically, the upper surface of the silicon substrate 10 is oxidized to form a pad oxide film 120, on which a CVD
Thus, a pad polysilicon film 130 is formed. Then, the upper surface of the pad polysilicon film 130 is oxidized to form a silicon oxide film 140, on which a mask nitride film 150 is formed by CVD.

【0013】次に図1(オ)、(カ)に示すように、形
成すべき素子分離膜の領域の除いてホトレジスト膜16
0を形成し、エッチングによってマスク窒化膜150及
びシリコン酸化膜140を選択的に除去する(工程
B)。次に、図1(カ)に示すエッチング(工程B)に
よって除去された領域のエッジ部300をサイドエッチ
ングによって削る(工程C)。この工程Cのサイドエッ
チングにより、図1(キ)に示すように、エッジ部30
0のシリコン酸化膜140の端部が削られてエッジ部3
00に溝部310が形成される。
Next, as shown in FIGS. 1E and 1F, the photoresist film 16 is removed except for the region of the element isolation film to be formed.
Then, the mask nitride film 150 and the silicon oxide film 140 are selectively removed by etching (step B). Next, the edge portion 300 in the region removed by the etching (step B) shown in FIG. By the side etching in this step C, as shown in FIG.
The edge of the silicon oxide film 140 of 0
A groove 310 is formed at 00.

【0014】次に、図1(ク)に示すように、以上の工
程で成膜された基板の上面全体に耐酸化性膜(シリコン
窒化膜;SiN)170を成膜する(工程D)。図3
(ソ)(タ)は、この工程D及び次の工程Eを経た後の
エッジ部300の状態を示す拡大断面図である。図示の
ように、この工程Dにおいて成膜される耐酸化性膜17
0が、工程Cで前記エッジ部300に形成された溝部3
10にくい込む状態で形成される。次に図1(ケ)に示
すように、エッジ部300に耐酸化性膜170によるサ
イドウォール172を残した状態で、耐酸化性膜170
を全面エッチバックにより除去する(工程E)。
Next, as shown in FIG. 1 (g), an oxidation resistant film (silicon nitride film; SiN) 170 is formed on the entire upper surface of the substrate formed in the above steps (step D). FIG.
(S) and (T) are enlarged cross-sectional views showing the state of the edge portion 300 after the step D and the next step E. As illustrated, the oxidation resistant film 17 formed in this step D
0 is the groove 3 formed in the edge 300 in the step C.
It is formed in a state where it can be inserted into the recess. Next, as shown in FIG. 1G, the oxidation-resistant film 170 is left in a state where the sidewall 172 of the oxidation-resistant film 170 is left at the edge portion 300.
Is removed by etch back over the entire surface (step E).

【0015】この後、図2(コ)に示すように、形成す
べき素子分離膜の領域に熱酸化によってLOCOS膜
(素子分離膜)180を成長させる(工程F)。この工
程Fにおいて、LOCOS膜180の外周部に、シリコ
ン酸化膜140につながるトップバーズビーク部182
と、パッド酸化膜120につながるボトムバーズビーク
(最終的に残るビーク)部184が形成される。そし
て、このLOCOS膜180の成長時に、耐酸化性膜1
70によるサイドウォール172と、このサイドウォー
ル172のエッジ部300に形成された溝部310にく
い込んだ部分により、LOCOS膜180の外周部に形
成されるトップバーズビーク部182の成長が抑制され
ることになる。
Thereafter, as shown in FIG. 2C, a LOCOS film (element isolation film) 180 is grown by thermal oxidation in a region of the element isolation film to be formed (step F). In this step F, the top bird's beak portion 182 connected to the silicon oxide film 140 is formed on the outer peripheral portion of the LOCOS film 180.
Then, a bottom bird's beak (finally remaining beak) portion 184 connected to the pad oxide film 120 is formed. When the LOCOS film 180 is grown, the oxidation resistant film 1
The growth of the top bird's beak portion 182 formed on the outer peripheral portion of the LOCOS film 180 is suppressed by the side wall 172 formed by Become.

【0016】したがって、短く、かつ薄いトップバーズ
ビーク部182のLOCOS膜180を形成できるた
め、後処理におけるLOCOS膜180のエッチング量
を大幅に減少することができる。なお、図2(コ)の円
aで示す部分は、実際には上述したサイドウォール17
2等の形状によって複雑な形状となるが、図では単純化
して示している。この後、図2(サ)〜(セ)に示すよ
うに、3段階のLight(Wet)エッチングによっ
てマスク窒化膜150、シリコン酸化膜140、パッド
ポリシリコン膜130を除去し、次工程に移行する(工
程G〜I)。
Therefore, since the LOCOS film 180 of the short and thin top bird's beak portion 182 can be formed, the etching amount of the LOCOS film 180 in the post-processing can be greatly reduced. The part indicated by the circle a in FIG.
Although the shape becomes complicated depending on the shape such as 2, it is simplified in the figure. Thereafter, as shown in FIGS. 2A to 2C, the mask nitride film 150, the silicon oxide film 140, and the pad polysilicon film 130 are removed by three-stage Light (Wet) etching, and the process proceeds to the next step. (Steps GI).

【0017】[0017]

【発明の効果】以上説明したように本発明の半導体装置
の製造方法では、シリコン基板上にパッド酸化膜、パッ
ドポリシリコン膜、シリコン酸化膜、及びマスク窒化膜
を順次成膜した後、形成すべき素子分離膜の領域を選択
的にエッチングして除去し、この除去領域のエッジ部を
サイドエッチングによって削るとともに、その上面から
耐酸化性膜を成膜した後、エッジ部に耐酸化性膜による
サイドウォールを残した状態で全面エッチバックし、そ
の後、素子分離膜の領域のパッド酸化膜に熱酸化を行
い、素子分離膜を形成するようにした。
As described above, in the method of manufacturing a semiconductor device according to the present invention, a pad oxide film, a pad polysilicon film, a silicon oxide film, and a mask nitride film are sequentially formed on a silicon substrate and then formed. The region of the element isolation film to be removed is selectively etched and removed, and the edge of the removed region is cut by side etching, and an oxidation-resistant film is formed from the upper surface. The entire surface was etched back with the sidewalls left, and thereafter, thermal oxidation was performed on the pad oxide film in the region of the element isolation film to form an element isolation film.

【0018】このため、耐酸化性膜によるサイドウォー
ルの一部が、サイドエッチングによってエッジ部のシリ
コン酸化膜に形成された溝部にくい込む構造で形成され
ることから、この部分によって素子分離膜の外周部に形
成されるトップバーズビーク部の成長が抑制されること
になる。したがって、短く、かつ薄いトップバーズビー
ク部の素子分離膜を形成できるため、後処理における素
子分離膜のエッチング量を大幅に減少することができ、
膜厚ロスが少なくなる。
Therefore, a part of the sidewall made of the oxidation-resistant film is formed in a structure in which the groove formed in the silicon oxide film at the edge by the side etching is formed. The growth of the top bird's beak formed in the portion is suppressed. Therefore, since a short and thin device isolation film of the top bird's beak portion can be formed, the etching amount of the device isolation film in post-processing can be significantly reduced,
Film loss is reduced.

【0019】そして、この膜厚ロスの減少により、素子
分離特性を改善することができ、また、基板間容量を低
減できる効果がある。また、素子分離膜を成長させるた
めの酸化膜厚を少なくできるので、処理時間の減少によ
るコストダウンを図ることができる。また、素子分離膜
の酸化膜厚を少なくできるため、ボトムバーズビーク
(最終的に残るビーク)の低減により素子分離特性を向
上できる。
The reduction in the film thickness loss can improve the element isolation characteristics and reduce the inter-substrate capacitance. Further, since the oxide film thickness for growing the element isolation film can be reduced, cost can be reduced due to reduction in processing time. Further, since the oxide film thickness of the element isolation film can be reduced, the element isolation characteristics can be improved by reducing bottom bird's beak (final residual beak).

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明の実施の形態による作業工程を示す説明
図である。
FIG. 1 is an explanatory diagram showing work steps according to an embodiment of the present invention.

【図2】本発明の実施の形態による作業工程を示す説明
図である。
FIG. 2 is an explanatory diagram showing work steps according to the embodiment of the present invention.

【図3】本発明の実施の形態による作業工程を示す説明
図である。
FIG. 3 is an explanatory diagram showing a working process according to the embodiment of the present invention.

【図4】PPL法による作業工程の従来例を示す説明図
である。
FIG. 4 is an explanatory view showing a conventional example of a working process by the PPL method.

【符号の説明】[Explanation of symbols]

110……シリコン基板、120……パッド酸化膜、1
30……パッドポリシリコン膜、140……シリコン酸
化膜、150……マスク窒化膜、160……ホトレジス
ト膜、170……耐酸化性膜、172……サイドウォー
ル、180……LOCOS膜、182……トップバーズ
ビーク部、300……エッジ部、310……溝部。
110: silicon substrate, 120: pad oxide film, 1
30 pad polysilicon film, 140 silicon oxide film, 150 mask nitride film, 160 photoresist film, 170 oxidation resistant film, 172 side wall, 180 LOCOS film, 182 ... top bird's beak part, 300 ... edge part, 310 ... groove part.

Claims (4)

【特許請求の範囲】[Claims] 【請求項1】 シリコン基板上にパッド酸化膜、パッド
ポリシリコン膜、シリコン酸化膜、及びマスク窒化膜を
順次成膜する工程Aと、 形成すべき素子分離膜の領域の前記マスク窒化膜、シリ
コン酸化膜、及び前記パッドポリシリコン膜を選択的に
エッチングして除去する工程Bと、 前記工程Bによって除去された領域のエッジ部をサイド
エッチングによって削る工程Cと、 前記工程B及び工程Cによって除去された領域及びマス
ク窒化膜の上面に耐酸化性膜を成膜する工程Dと、 前記工程Bによって除去された領域のエッジ部に前記耐
酸化性膜によるサイドウォールを残した状態で、前記耐
酸化性膜を全面エッチバックにより除去する工程Eと、 前記素子分離膜の領域のパッド酸化膜に熱酸化を行い、
素子分離膜を形成する工程Fと、 を有することを特徴とする半導体装置の製造方法。
A step of sequentially forming a pad oxide film, a pad polysilicon film, a silicon oxide film, and a mask nitride film on a silicon substrate; and forming the mask nitride film and silicon in a region of an element isolation film to be formed. A step B of selectively etching and removing the oxide film and the pad polysilicon film; a step C of removing an edge portion of the region removed in the step B by side etching; and a removal in the steps B and C. Forming an oxidation-resistant film on the removed region and the upper surface of the mask nitride film; and forming the oxidation-resistant film on the edge of the region removed in the step B while leaving the sidewall formed of the oxidation-resistant film. A step E of removing the passivation film by etch back over the entire surface; and performing thermal oxidation on the pad oxide film in the region of the element isolation film;
A method for manufacturing a semiconductor device, comprising: a step F of forming an element isolation film.
【請求項2】 前記マスク窒化膜及び耐酸化性膜は、と
もにシリコン窒化膜よりなることを特徴とする請求項1
記載の半導体装置の製造方法。
2. The semiconductor device according to claim 1, wherein both the mask nitride film and the oxidation resistant film are made of a silicon nitride film.
The manufacturing method of the semiconductor device described in the above.
【請求項3】 前記工程Cのサイドエッチングにより、
前記エッジ部のシリコン酸化膜の端部が削られて前記エ
ッジ部に溝部が形成され、前記工程Dにおいて成膜され
る耐酸化性膜が前記エッジ部に形成された溝部にくい込
む状態で形成されることを特徴とする請求項1記載の半
導体装置の製造方法。
3. The side etching in the step C,
The edge portion of the silicon oxide film at the edge portion is shaved to form a groove portion at the edge portion, and the oxidation-resistant film formed in the step D is formed so as to fit into the groove portion formed at the edge portion. 2. The method for manufacturing a semiconductor device according to claim 1, wherein
【請求項4】 前記工程Fの後に、前記マスク窒化膜及
び前記耐酸化性膜の残存部分をエッチングにより除去す
る工程Gと、 前記シリコン酸化膜をエッチングにより除去する工程H
と、 前記パッドポリシリコン膜をエッチングにより除去する
工程Iと、 を有することを特徴とする請求項1記載の半導体装置の
製造方法。
4. A step G of removing the remaining portions of the mask nitride film and the oxidation-resistant film by etching after the step F, and a step H of removing the silicon oxide film by etching.
2. The method of manufacturing a semiconductor device according to claim 1, further comprising: a step I of removing the pad polysilicon film by etching.
JP10355043A 1998-12-14 1998-12-14 Manufacture of semiconductor device Pending JP2000183053A (en)

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN100365802C (en) * 2004-07-23 2008-01-30 海力士半导体有限公司 Method for manufacturing a flash memory device

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