JP2000166245A - Power supply - Google Patents

Power supply

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JP2000166245A
JP2000166245A JP10334395A JP33439598A JP2000166245A JP 2000166245 A JP2000166245 A JP 2000166245A JP 10334395 A JP10334395 A JP 10334395A JP 33439598 A JP33439598 A JP 33439598A JP 2000166245 A JP2000166245 A JP 2000166245A
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voltage
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Abstract

PROBLEM TO BE SOLVED: To provide a power supply which detects and controls the output voltage of a chopper circuit and the output voltage of an inverter circuit through simple circuitry in case of an anomaly. SOLUTION: The power supply comprises a chopper circuit 1 containing at least one switching element which receives the voltage of an alternating- current power supply Vs and outputs direct currents, a capacitor C1 for smoothing parallel-connected with the output ends of the chopper circuit 1, an inverter circuit 2 containing at least one switching element which converts the voltage VDC of the capacitor into a high frequency and supplies it to a load La, a first detecting means 3 which detects the voltage VDC of the capacitor C1, a second detecting means 4 which detects the voltage V1a across the load La, an adding means 5 which adds up the output of the first detecting means 3 and the output of the second detecting means 4, and a controlling means 6 which controls the switching elements in the chopper circuit 1 and the inverter circuit 2 so that the added value obtained by the adding means 5 is almost constant.

Description

【発明の詳細な説明】DETAILED DESCRIPTION OF THE INVENTION

【0001】[0001]

【発明の属する技術分野】本発明は交流電源を整流平滑
した直流電圧を高周波に変換して負荷に供給する電源装
置に関するものである。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a power supply device for converting a DC voltage obtained by rectifying and smoothing an AC power supply to a high frequency and supplying it to a load.

【0002】[0002]

【従来の技術】従来例の回路図を図14に示す。本回路
は、交流電源Vsにチョッパ回路1を接続し、チョッパ
回路1の出力に平滑用のコンデンサC1を接続し、更に
平滑用のコンデンサC1にインバータ回路2を接続し、
負荷Laに電力を供給する電源装置である。図14で
は、チョッパ回路1として、インダクタL1とダイオー
ドD1、スイッチング素子Q3、整流器DB及びフィル
タ回路FTよりなる昇圧チョッパ回路を、インバータ回
路2として、スイッチング素子Q1,Q2と共振用イン
ダクタL2、直流カット用コンデンサC2、共振用コン
デンサC3よりなるハーフブリッジインバータ回路を示
している。
2. Description of the Related Art FIG. 14 shows a circuit diagram of a conventional example. In this circuit, the chopper circuit 1 is connected to the AC power supply Vs, the smoothing capacitor C1 is connected to the output of the chopper circuit 1, and the inverter circuit 2 is further connected to the smoothing capacitor C1.
This is a power supply device that supplies power to the load La. In FIG. 14, a step-up chopper circuit including an inductor L1 and a diode D1, a switching element Q3, a rectifier DB and a filter circuit FT is used as a chopper circuit 1, and switching elements Q1 and Q2 and a resonance inductor L2 are used as an inverter circuit 2. 1 shows a half-bridge inverter circuit including a capacitor C2 for resonance and a capacitor C3 for resonance.

【0003】本回路において、電源変動などによるコン
デンサC1の電圧VDCの過昇圧や負荷変動などによるラ
ンプ電圧Vlaの過昇圧を抑制するために、図15に示
すように、VDC検出回路3、Vla検出回路4によりコ
ンデンサC1の電圧VDC、ランプ電圧Vlaをそれぞれ
検出して、それらの出力によってチョッパ制御回路61
及びインバータ制御回路62により、チョッパ回路1や
インバータ回路2のスイッチング素子Q1〜Q3を制御
し、出力を小さくしたり、あるいは停止させたりしてい
る。これにより素子へのストレスを低減している。
In this circuit, as shown in FIG. 15, a VDC detection circuit 3, as shown in FIG. 15, is provided to suppress over-boosting of the voltage VDC of the capacitor C1 due to power supply fluctuations and over-boosting of the lamp voltage Vla due to load fluctuations. The voltage V DC of the capacitor C1 and the lamp voltage Vla are respectively detected by the Vla detection circuit 4, and the chopper control circuit 61
In addition, the switching elements Q1 to Q3 of the chopper circuit 1 and the inverter circuit 2 are controlled by the inverter control circuit 62 to reduce or stop the output. This reduces stress on the element.

【0004】[0004]

【発明が解決しようとする課題】しかしながら、チョッ
パ回路1の出力であるコンデンサC1の電圧VDCの異常
昇圧を検出し、コンデンサC1の電圧VDCを制御するた
めの制御手段と、インバータ回路2の出力であるランプ
電圧Vlaの異常昇圧を検出し、ランプ電圧Vlaを制
御するための制御手段とが別々に設けられているため、
回路の部品数が増えて複雑になり、また、そのためコス
トが高くなるといった欠点があった。
However, control means for detecting an abnormal increase in the voltage VDC of the capacitor C1, which is the output of the chopper circuit 1, and controlling the voltage VDC of the capacitor C1, Since the control means for detecting the abnormal increase of the lamp voltage Vla as the output and controlling the lamp voltage Vla is provided separately,
There are drawbacks in that the number of circuit components increases and the circuit becomes complicated, and the cost increases.

【0005】本発明が解決しようとする課題は、異常時
におけるチョッパ回路の出力電圧とインバータ回路の出
力電圧の検出制御を簡単な回路構成で実現した電源装置
を提供することである。
[0005] An object of the present invention is to provide a power supply device which realizes detection control of an output voltage of a chopper circuit and an output voltage of an inverter circuit with a simple circuit configuration at the time of abnormality.

【0006】[0006]

【課題を解決するための手段】本発明によれば、上記の
課題を解決するために、図1に示すように、交流電源V
sの電圧を受けて直流を出力する少なくとも1つはスイ
ッチング素子を有するチョッパ回路1と、上記チョッパ
回路1の出力端に並列に接続される平滑用の第1のコン
デンサC1と、第1のコンデンサの電圧VDCを高周波に
変換して負荷Laに供給する少なくとも1つはスイッチ
ング素子を有するインバータ回路2と、第1のコンデン
サC1の電圧VDCを検出する第1の検出手段3と、負荷
Laの両端の電圧Vlaを検出する第2の検出手段4
と、第1の検出手段3の出力と第2の検出手段4の出力
を加算する加算手段5と、上記加算手段5により得られ
る加算値が略一定となるようにチョッパ回路1とインバ
ータ回路2のスイッチング素子を制御する制御手段6と
を有することを特徴とするものである。
According to the present invention, in order to solve the above-mentioned problems, as shown in FIG.
At least one chopper circuit 1 having a switching element for receiving a voltage of s and outputting a direct current, a first capacitor C1 for smoothing connected in parallel to an output terminal of the chopper circuit 1, and a first capacitor At least one of which converts the voltage VDC into a high frequency and supplies it to the load La, an inverter circuit 2 having a switching element, first detecting means 3 for detecting the voltage VDC of the first capacitor C1, and a load La. Detecting means 4 for detecting the voltage Vla across the terminals
Addition means 5 for adding the output of the first detection means 3 and the output of the second detection means 4; and the chopper circuit 1 and the inverter circuit 2 so that the addition value obtained by the addition means 5 is substantially constant. And control means 6 for controlling the switching element.

【0007】[0007]

【発明の実施の形態】(実施例1)本発明の第1の実施
例の回路図を図1に示す。図1の回路は本発明の基本構
成を示すものであり、交流電源Vsの電圧を受けて直流
を出力する少なくとも1つはスイッチング素子を有する
チョッパ回路1と、上記チョッパ回路1の出力端に並列
に接続される平滑用の第1のコンデンサC1と、第1の
コンデンサC1の電圧を高周波に変換して負荷Laに供
給する少なくとも1つはスイッチング素子を有するイン
バータ回路2と、第1のコンデンサC1の電圧VDCを検
出するVDC検出回路3と、負荷Laの両端の電圧Vla
を検出するVla検出回路4と、VDC検出回路3の出力
と、Vla検出回路4の出力を各々加算する加算回路5
と、上記加算回路5における加算値の出力を受けてチョ
ッパ回路1、インバータ回路2のスイッチング素子を制
御する制御回路6とからなっている。
(Embodiment 1) FIG. 1 shows a circuit diagram of a first embodiment of the present invention. The circuit shown in FIG. 1 shows the basic configuration of the present invention. At least one chopper circuit 1 having a switching element for receiving a voltage of an AC power supply Vs and outputting a DC is connected in parallel to an output terminal of the chopper circuit 1. , A first capacitor C1 for smoothing, an inverter circuit 2 having a switching element, at least one of which converts a voltage of the first capacitor C1 into a high frequency and supplies the high frequency to the load La; and a first capacitor C1. and V DC detection circuit 3 for detecting the voltage V DC, the voltage across the load La Vla
Detecting circuit 4, an output of the VDC detecting circuit 3, and an adding circuit 5 for adding the output of the Vla detecting circuit 4 respectively.
And a control circuit 6 for controlling the switching elements of the chopper circuit 1 and the inverter circuit 2 in response to the output of the added value in the addition circuit 5.

【0008】以下、本実施例の回路動作について説明す
る。負荷Laとして放電灯が接続された場合について説
明を行う。回路の定常時には、図示された制御回路6に
より所定の直流電圧VDC、所定のランプ電圧Vlaとな
るように制御される。回路の異常時には、VDC検出回路
3により第1のコンデンサC1の電圧VDCが検出され、
Vla検出回路4により負荷Laの両端の電圧Vlaが
各々検出される。ここで、直流電圧VDCが例えば300
(V)、ランプ電圧Vlaが100(V)だったとする
と、加算回路5の出力は400(V)に相当する電圧が
現れることになる。実際には各々の検出電圧は抵抗分圧
により、制御回路6内で用いている制御電源の電圧より
も小さく設定される。
Hereinafter, the circuit operation of this embodiment will be described. A case where a discharge lamp is connected as the load La will be described. When the circuit is in a steady state, the control circuit 6 shown is controlled to have a predetermined DC voltage VDC and a predetermined lamp voltage Vla. When the circuit is abnormal, the voltage V DC of the first capacitor C1 is detected by the V DC detection circuit 3,
The Vla detection circuit 4 detects the voltage Vla across the load La. Here, the DC voltage VDC is, for example, 300
(V), assuming that the lamp voltage Vla is 100 (V), a voltage corresponding to 400 (V) appears at the output of the adding circuit 5. Actually, each detection voltage is set to be smaller than the voltage of the control power supply used in the control circuit 6 by resistance division.

【0009】いま、仮に負荷Laが無くなる無負荷状態
になると、ランプ電圧Vlaは共振回路の作用により定
常点灯時の電圧よりも大きくなる。また、無負荷状態に
なると、負荷が軽くなったことにより、直流電圧VDC
急激に上昇する。すると、加算回路5の出力は先程の4
00(V)より著しく大きくなることになる。制御回路
6内ではあらかじめ設定された400(V)より大きく
なった場合にはインバータ回路2のスイッチング周波数
を高くして出力を弱めたり、あるいは停止させることに
より、素子に余分なストレスをかけずに済む。なお、負
荷Laが寿命末期のエミレスのような状態においてもラ
ンプ電圧Vlaと直流電圧VDCの両方が大きくなること
により、同様に制御し、素子にストレスをかけずに済
む。
[0009] If the load La is lost and there is no load, the lamp voltage Vla becomes higher than the voltage at the time of steady lighting due to the action of the resonance circuit. Further, in the no-load state, the DC voltage VDC sharply increases due to the lightening of the load. Then, the output of the adding circuit 5 becomes 4
00 (V). In the control circuit 6, when the voltage exceeds 400 (V) set in advance, the switching frequency of the inverter circuit 2 is increased to weaken or stop the output, so that no extra stress is applied to the element. I'm done. In addition, even when the load La is in a state like Emiless at the end of life, both the lamp voltage Vla and the DC voltage VDC are increased, so that the control is performed in the same manner and the element does not need to be stressed.

【0010】次に、例えば電源変動などにより直流電圧
DCが変動する場合を考える。もし、電源変動により直
流電圧VDCの値が大きくなる場合、負荷Laには、より
電流が流れることになり、ランプ負荷Laの負特性によ
りランプ電圧Vlaは逆に小さくなる。しかしながら、
ランプ電圧Vlaの変動幅は直流電圧VDCの変動幅ほど
は大きくないため、結果的に加算回路5の出力は大きく
なる方向に推移する。したがって、この場合も、先述し
たのと同じように、予め設定された電圧より加算回路5
の出力が大きくなったのを検出して、インバータ回路2
やチョッパ回路1のスイッチング周波数を上げたり、デ
ューティをアンバランスにしたりして、出力を弱めた
り、あるいは発振を停止させることにより素子にストレ
スをかけずに済む。
Next, consider the case where the DC voltage VDC fluctuates due to, for example, power fluctuation. If the value of the DC voltage VDC increases due to power supply fluctuations, more current flows through the load La, and the lamp voltage Vla decreases on the contrary due to the negative characteristics of the lamp load La. However,
Since the fluctuation width of the ramp voltage Vla is not as large as the fluctuation width of the DC voltage VDC , the output of the adder circuit 5 eventually increases. Therefore, also in this case, similarly to the above, the addition circuit 5 is applied from the preset voltage.
Of the inverter circuit 2
By increasing the switching frequency of the chopper circuit 1 or making the duty unbalanced to weaken the output or stop the oscillation, it is not necessary to apply stress to the element.

【0011】逆に、電源変動などにより直流電圧VDC
値が小さくなる場合、負荷Laには、より電流が流れな
いことになり、ランプ負荷Laの負特性によりランプ電
圧Vlaは逆に大きくなる。しかしながら、ランプ電圧
Vlaの変動幅は直流電圧V DCの変動幅ほどは大きくな
いため、結果的に加算回路5の出力は小さくなる方向に
推移する。したがって、この場合は、予め設定された電
圧より加算回路5の出力が小さくなったのを検出して、
インバータ回路2やチョッパ回路1のスイッチング周波
数を下げたり、デューティをより50%に近づけたりし
て、出力を強める方向へ制御する。そうすることによ
り、負荷Laを常に略一定の出力で駆動することができ
る。なお、加算回路5の出力が小さくなり過ぎた場合に
は、別に基準レベルを設けておき、チョッパ回路1やイ
ンバータ回路2の発振を止め、素子にストレスをかけず
に済むように構成することもできる。
Conversely, the DC voltage VDCof
When the value decreases, the current does not flow through the load La more.
And the negative characteristic of the lamp load La
The pressure Vla increases on the contrary. However, the lamp voltage
Vla has a fluctuation range of DC voltage V DCIs as large as
Therefore, as a result, the output of the adder circuit 5 becomes smaller.
Transition to. Therefore, in this case, the preset power
Detecting that the output of the adding circuit 5 has become smaller than the pressure,
Switching frequency of inverter circuit 2 and chopper circuit 1
Lower the number or make the duty closer to 50%
Control to increase the output. By doing so
As a result, the load La can always be driven with a substantially constant output.
You. If the output of the adding circuit 5 becomes too small,
Is provided with a separate reference level, and the chopper circuit 1 and the
Stop the oscillation of the inverter circuit 2 and do not put stress on the element
It can also be configured so that only

【0012】本実施例の回路構成によれば、コンデンサ
C1の直流電圧VDC、ランプ電圧Vlaの2つの検出制
御が1つの制御回路で行えるため、部品点数が少なくて
済む。また、無負荷、エミレス、電源変動といった様々
な異常時に素子に過大なストレスが印加されるのを抑制
することができる。
According to the circuit configuration of the present embodiment, the two detection controls of the DC voltage VDC of the capacitor C1 and the lamp voltage Vla can be performed by one control circuit, so that the number of components can be reduced. In addition, it is possible to suppress the application of excessive stress to the element at various abnormalities such as no load, Emiless, and power supply fluctuation.

【0013】(実施例2)本発明の第2の実施例の回路
図を図2に示す。本回路が図1と異なる点は、加算回路
5の出力と略一定の基準電圧Vkを比較器COMP1で
比較し、その出力を制御回路6に入力するように変更し
た点である。その他の構成は図1と同様である。本回路
は、例えば負荷Laの出力を調光器などで調整するとき
に、その調光範囲において、略一定の基準電圧Vkで済
む利点がある。
(Embodiment 2) FIG. 2 shows a circuit diagram of a second embodiment of the present invention. This circuit differs from FIG. 1 in that the output of the adder circuit 5 is compared with a substantially constant reference voltage Vk by a comparator COMP1, and the output is input to a control circuit 6. Other configurations are the same as those in FIG. This circuit has an advantage that, for example, when the output of the load La is adjusted by a dimmer or the like, a substantially constant reference voltage Vk is sufficient in the dimming range.

【0014】図3を用いて本実施例による検出の方法に
ついて説明する。図3は定常時におけるVDC検出回路3
の検出電圧VDCと、Vla検出回路4の検出電圧Vla
の和を調光比を横軸にとって示したものである。図の左
側が定格点灯時を、右側が調光下限時を示している。ま
た、図中、基準電圧Vkを一点鎖線で示す。図3におい
て、調光下限時のランプ電圧Vla’が定格点灯時のラ
ンプ電圧Vlaよりも大きいのは負荷の調光特性による
ものであり、この変化幅は負荷や調光の範囲によって異
なる。一方、調光下限時の直流電圧VDC’が定格点灯時
の直流電圧VDCより小さくなり、かつ、調光の全範囲に
わたって加算回路5の出力が基準電圧Vkよりも若干小
さいのは、チョッパ回路1およびインバータ回路2のス
イッチング周波数とデューティをあらかじめ適切に選ぶ
ことにより実現している。このスイッチング周波数とデ
ューティの関係を図4に示す。
The detection method according to this embodiment will be described with reference to FIG. FIG. 3 shows the VDC detection circuit 3 in a steady state.
The detection voltage V DC, the detection voltage of the Vla detection circuit 4 Vla
Are shown with the dimming ratio on the horizontal axis. The left side of the figure shows the rated lighting time, and the right side shows the dimming lower limit time. In the drawing, the reference voltage Vk is indicated by a dashed line. In FIG. 3, the reason why the lamp voltage Vla ′ at the lower limit of dimming is higher than the lamp voltage Vla at the time of rated lighting is due to the dimming characteristics of the load, and the change width varies depending on the load and the range of dimming. On the other hand, the reason why the DC voltage V DC ′ at the lower limit of dimming is lower than the DC voltage VDC at the time of rated lighting and the output of the adding circuit 5 is slightly lower than the reference voltage Vk over the entire range of dimming is that This is realized by appropriately selecting the switching frequency and duty of the circuit 1 and the inverter circuit 2 in advance. FIG. 4 shows the relationship between the switching frequency and the duty.

【0015】図4(a)は定格点灯時付近におけるチョ
ッパ回路1およびインバータ回路2のスイッチング信号
であり、チョッパ回路1の場合、τ1で示された期間が
電源をインダクタなどを介して短絡している期間であ
る。また、インバータ回路2が例えば2石の場合には、
インバータ回路2の一方のスイッチング素子の制御信号
は図示された波形であり、他方のスイッチング素子の制
御信号は図示された波形を反転したものとなる。T1が
スイッチングの1周期に相当し、スイッチング周波数f
(=1/T1)は数kHz〜数10kHzである。
FIG. 4A shows switching signals of the chopper circuit 1 and the inverter circuit 2 near the time of rated lighting. In the case of the chopper circuit 1, a period indicated by τ1 is obtained by short-circuiting a power supply via an inductor or the like. It is a period that is. When the inverter circuit 2 is, for example, two stones,
The control signal of one of the switching elements of the inverter circuit 2 has the illustrated waveform, and the control signal of the other switching element has an inverted waveform of the illustrated waveform. T1 corresponds to one cycle of switching, and the switching frequency f
(= 1 / T1) is several kHz to several tens kHz.

【0016】図4(b)は調光下限時のスイッチング波
形を示す。図4(a)に比べ、周波数は一定のまま、デ
ューティのみをアンバランスにしている。こうすること
によりチョッパ回路1のオン時間τ2はτ1よりも短く
なるため、チョッパ回路1の出力電圧VDCは図4(a)
の場合よりも低くなる。また、同時にインバータ回路2
においてはスイッチング信号がアンバランスになるた
め、図4(a)の場合よりも出力が絞られることにな
る。なお、図4(c)に示すように同時に周波数も高く
することによって、インバータ回路2の出力は更に絞ら
れることになる。
FIG. 4B shows a switching waveform at the time of the dimming lower limit. 4A, only the duty is unbalanced while the frequency is kept constant. By doing so, the ON time τ2 of the chopper circuit 1 becomes shorter than τ1, so that the output voltage VDC of the chopper circuit 1 becomes as shown in FIG.
Lower than in the case of At the same time, the inverter circuit 2
Since the switching signal becomes unbalanced in the case of, the output is narrowed down more than in the case of FIG. By increasing the frequency at the same time as shown in FIG. 4C, the output of the inverter circuit 2 is further reduced.

【0017】したがって、定格点灯時付近では図4
(a)、調光を深くするにしたがって図4(b)あるい
は図4(c)へと移行させることにより、直流電圧VDC
とランプ電圧Vlaの検出値の和が略一定で且つ基準電
圧Vkよりも低い電圧で連続的に変化させることができ
るのである。
Therefore, FIG.
(A) As the dimming is made deeper, by shifting to FIG. 4 (b) or FIG. 4 (c), the DC voltage V DC
And the detected value of the lamp voltage Vla is substantially constant and can be continuously changed at a voltage lower than the reference voltage Vk.

【0018】チョッパ回路1から出力される直流電圧V
DCが図3のように変化するようにできれば、調光のほぼ
全範囲において異常時の検出が簡単になる。すなわち、
実施例1と同様に直流電圧VDCとランプ電圧Vlaのい
ずれかが異常昇圧を起こしても1つの比較器COMP1
で検出が可能となる。
DC voltage V output from chopper circuit 1
If the DC can be changed as shown in FIG. 3, it is easy to detect an abnormal state in almost the entire range of dimming. That is,
As in the first embodiment, even if one of the DC voltage VDC and the lamp voltage Vla causes an abnormal boost, one comparator COMP1
Can be detected.

【0019】なお、基準電圧Vkは直流電圧VDCとラン
プ電圧Vlaの検出値の和よりも大きい値に設定した
が、逆に、直流電圧VDCとランプ電圧Vlaの検出値の
和よりも小さく設定した場合には、直流電圧VDCが著し
く小さくなったときにも検出制御を行うことができる。
Although the reference voltage Vk is set to a value larger than the sum of the detected values of the DC voltage VDC and the lamp voltage Vla, the reference voltage Vk is smaller than the sum of the detected values of the DC voltage VDC and the lamp voltage Vla. When set, detection control can be performed even when the DC voltage VDC becomes extremely small.

【0020】図2の回路において、チョッパ回路1に昇
圧チョッパを、インバータ回路2にハーフブリッジイン
バータを適用したのが図5である。図5の主回路は、交
流電源Vsと、交流電源Vsに並列的に接続されるフィ
ルタ回路FTと、フィルタ回路FTに交流入力端子が接
続されるダイオードブリッジDBと、ダイオードブリッ
ジDBの直流出力端子に接続されるインダクタL1とダ
イオードD1とコンデンサC1の直列回路と、インダク
タL1とダイオードD1の接続点と、ダイオードブリッ
ジDBのインダクタL1と接続しない側の直流出力端子
との間に接続されるスイッチング素子Q3と、コンデン
サC1に並列的に接続されるスイッチング素子Q1、Q
2の直列回路と、スイッチング素子Q2の両端に接続さ
れるイングクタL2とコンデンサC2とC3の直列回路
と、コンデンサC3に並列的に接続される負荷Laとか
らなっている。
In the circuit of FIG. 2, a boost chopper is applied to the chopper circuit 1 and a half-bridge inverter is applied to the inverter circuit 2 in FIG. 5 includes an AC power supply Vs, a filter circuit FT connected in parallel to the AC power supply Vs, a diode bridge DB having an AC input terminal connected to the filter circuit FT, and a DC output terminal of the diode bridge DB. A switching element connected between a series circuit of an inductor L1, a diode D1, and a capacitor C1, a connection point between the inductor L1 and the diode D1, and a DC output terminal of the diode bridge DB that is not connected to the inductor L1. Q3 and switching elements Q1, Q connected in parallel with the capacitor C1.
2, a series circuit of an ingot L2 and capacitors C2 and C3 connected to both ends of the switching element Q2, and a load La connected in parallel to the capacitor C3.

【0021】図5の制御回路6と各検出回路3,4をさ
らに詳細に示したのが図6である。まず、制御回路6
は、可変抵抗RT1、コンデンサCT1によって周波数が決
まる無安定マルチCN1と、無安定マルチCN1の出力
を受けて可変抵抗RT2とコンデンサCT2によってデュー
ティが決まる単安定マルチCN2と、単安定マルチCN
2の出力を受けてスイッチング素子Q3を駆動する駆動
回路DR1と、同じく単安定マルチCN2の出力を受け
てスイッチング素子Q1及びQ2を駆動する駆動回路D
R2とからなっている。なお、図示しないが、この駆動
回路DR2によって、スイッチング素子Q1及びQ2へ
のスイッチング信号は各々交互にオン・オフを繰り返す
信号として出力される。
FIG. 6 shows the control circuit 6 and the detection circuits 3 and 4 of FIG. 5 in further detail. First, the control circuit 6
Are an astable multi-CN1 whose frequency is determined by the variable resistor R T1 and the capacitor C T1 , a monostable multi-CN2 whose output is output from the astable multi-CN 1 and whose duty is determined by the variable resistor R T2 and the capacitor C T2 , and a monostable multi-CN. CN
And a driving circuit D1 that receives the output of the monostable multi-CN2 and drives the switching elements Q1 and Q2.
R2. Although not shown, the switching signal to the switching elements Q1 and Q2 is output by the drive circuit DR2 as a signal that alternately repeats on and off.

【0022】また、検出回路は、抵抗R1、R2、R3
と、トランジスタTr1、Tr2からなるVDC検出回路
3と、抵抗R4、R5、R6、R7と、コンデンサCf
と、トランジスタTr3、Tr4と、ダイオードDfと
からなるVla検出回路4と、上記VDC検出回路3とV
la検出回路4の出力の加算を行うための、抵抗R8、
R9、R10と、トランジスタTr5、Tr6からなる
加算回路5と、加算回路5の出力と基準電圧Vkを比較
するための、抵抗R11、R12、R13と、コンパレ
ータCOMP1とからなる比較回路とからなっている。
また、比較回路の出力はトランジスタQ4のベースヘと
接続されており、トランジスタQ4は単安定マルチCN
2の出力端に並列的に接続されているため、トランジス
タQ4のオン・オフによって単安定マルチCN2から駆
動回路DR1、DR2へ出力される信号を強制的に0に
することができる。
The detection circuit comprises resistors R1, R2, R3
, A VDC detection circuit 3 including transistors Tr1 and Tr2, resistors R4, R5, R6, R7, and a capacitor Cf.
If, the transistors Tr3, Tr4, the Vla detection circuit 4 consisting of a diode Df, and the V DC detection circuit 3 V
a resistor R8 for adding the outputs of the la detection circuit 4;
R9 and R10, an addition circuit 5 including transistors Tr5 and Tr6, and a comparison circuit including resistors R11, R12 and R13 and a comparator COMP1 for comparing the output of the addition circuit 5 with the reference voltage Vk. I have.
The output of the comparison circuit is connected to the base of the transistor Q4.
2, the signal output from the monostable multi-CN2 to the drive circuits DR1 and DR2 can be forcibly set to 0 by turning on / off the transistor Q4.

【0023】本回路において、調光は可変抵抗RT1を変
化させることによる周波数制御、あるいは可変抵抗RT2
を変化させることによるデューティ制御で行う。調光特
性は先述した図3のグラフに示す特性になるように可変
抵抗RT1、RT2の調整を行う。VDC検出回路3は直流電
圧VDCに比例した電流i1を抵抗R2に流すことでカレ
ントミラー回路の電流値として検出する。また、Vla
検出回路4の場合も同様にランプ電圧Vlaに比例した
電流i2を抵抗R6に流すことでカレントミラー回路の
電流値として検出する。ダイオードDfとコンデンサC
fは高周波のランプ電圧Vlaを整流平滑して振幅成分
を検出するために設けられている。加算回路5は各々の
電流を加算した電流(i1+i2)を抵抗R10に流す
ため、コンパレータCOMP1の入力端子である点eに
はR10×(i1+i2)に相当する電圧が現れ、これ
がVDC+Vlaに比例した電圧を示すことになる。ま
た、基準電圧であるVkは制御電源Vccを抵抗R11
とR12で分圧することにより得られる。
In the present circuit, dimming is performed by controlling the frequency by changing the variable resistor R T1 or by controlling the variable resistor R T2.
Is performed by changing the duty. The variable resistors R T1 and R T2 are adjusted so that the dimming characteristics have the characteristics shown in the graph of FIG. The VDC detection circuit 3 detects a current i1 proportional to the DC voltage VDC through the resistor R2 as a current value of the current mirror circuit. Vla
Similarly, in the case of the detection circuit 4, a current i2 proportional to the lamp voltage Vla is supplied to the resistor R6 to detect the current as a current value of the current mirror circuit. Diode Df and capacitor C
f is provided for rectifying and smoothing the high-frequency lamp voltage Vla to detect an amplitude component. Since the addition circuit 5 supplies the current (i1 + i2) obtained by adding the respective currents to the resistor R10, a voltage corresponding to R10 × (i1 + i2) appears at a point e which is an input terminal of the comparator COMP1, and this voltage is proportional to V DC + Vla. Will be shown. The reference voltage Vk is used to connect the control power supply Vcc to the resistor R11.
And R12.

【0024】回路動作が正常の場合は(点eの電圧)<
Vkであるため、コンパレータCOMP1の出力はLレ
ベルとなり、トランジスタQ4は常にオフ状態となる。
このため、単安定マルチCN2の出力は駆動回路DR
1、DR2へ入力され続け、回路は動作し続ける。一
方、無負荷などの異常が起こった場合、直流電圧VDC
るいはランプ電圧Vlaが著しく昇圧するためi1、i
2の電流が増加し、その結果、点eの電圧も比例して大
きくなる。すると、(点eの電圧)>Vkとなった時点
でコンパレータCOMP1の出力がLレベルからHレベ
ルに切り替わり、トランジスタQ4をオンさせることに
なる。その結果、単安定マルチCN2の出力を0にする
ことになるため、駆動回路DR1、DR2への入力信号
が無くなり、回路は停止することになる。
If the circuit operation is normal (voltage at point e) <
Since it is Vk, the output of the comparator COMP1 is at L level, and the transistor Q4 is always off.
For this reason, the output of the monostable multi-CN2 is
1, input to DR2 continues, and the circuit continues to operate. On the other hand, when an abnormality such as no load occurs, the DC voltage VDC or the lamp voltage Vla increases significantly, so that i1, i
2, the voltage at point e also increases proportionally. Then, when (voltage at point e)> Vk, the output of the comparator COMP1 switches from the L level to the H level, and the transistor Q4 is turned on. As a result, the output of the monostable multi-CN2 becomes 0, so that there is no input signal to the drive circuits DR1 and DR2, and the circuit stops.

【0025】なお、本実施例では、異常を検出したと
き、回路動作が停止する例を説明したが、検出後の制御
は停止に限らず、周波数を高くしたり、デューティをア
ンバランスにしたりして、出力を絞っても良く、あるい
は、間欠的に発振を繰り返すようにしても素子へのスト
レスを低減できることはいうまでもない。
In this embodiment, the example in which the circuit operation is stopped when an abnormality is detected has been described. However, the control after the detection is not limited to the stop, but the frequency may be increased or the duty may be unbalanced. Therefore, it is needless to say that the stress on the element can be reduced even if the output is reduced or the oscillation is intermittently repeated.

【0026】また、チョッパ回路1は昇圧チョッパに限
らず、昇降圧チョッパや降圧チョッパであってもよい。
インバータ回路2についてもハーフブリッジに限らず、
1石式やフルブリッジ型であってもよい。また、負荷は
1つである必要はなく、2本以上の多灯であってもよ
い。
The chopper circuit 1 is not limited to a step-up chopper, but may be a step-up / step-down chopper or a step-down chopper.
The inverter circuit 2 is not limited to the half bridge,
It may be a single stone type or a full bridge type. The load does not need to be one, but may be two or more.

【0027】本実施例によれば、調光の全域において、
2つの検出が1つの検出回路で行えるため、部品点数が
少なくて済む。また、検出のための基準値の設定が略一
定で済むため、簡単な回路で基準値を設定できる。さら
に、調光の全域において、正常点灯時と異常検出の基準
値の差を小さくできるため、異常時に素子に過大なスト
レスが印加されるのを抑制することができる。
According to this embodiment, in the entire range of dimming,
Since two detections can be performed by one detection circuit, the number of components can be reduced. Further, since the setting of the reference value for detection can be substantially constant, the reference value can be set with a simple circuit. Further, since the difference between the reference value for normal lighting and the reference value for abnormality detection can be reduced in the entire range of dimming, it is possible to suppress the application of excessive stress to the element at the time of abnormality.

【0028】(実施例3)本発明の第3の実施例の回路
図を図7に示す。本実施例の回路は、交流電源Vsと、
交流電源Vsに並列的に接続されるフィルタ回路FT
と、フィルタ回路FTに交流入力端子が接続されるダイ
オードブリッジDBと、平滑コンデンサC1と、平滑コ
ンデンサC1に並列的に接続されるスイッチング素子Q
1、Q2の直列回路と、ダイオードブリッジDBの直流
出力端子のうち+(プラス)側端子と、スイッチング素
子Q1、Q2の接続点との間に接続されたインダクタL
1とダイオードD1の直列回路と、スイッチング素子Q
2の両端に接続されるインダクタL2とコンデンサC2
とコンデンサC3の直列回路と、コンデンサC3に並列
的に接続される負荷Laと、コンデンサC1の電圧VDC
を検出するVDC検出回路3と、負荷Laの両端の電圧V
laを検出するVla検出回路4と、VDC検出回路3の
出力とVla検出回路4の出力を加算する加算回路5
と、加算回路5の出力と略一定の基準電圧Vkとを比較
する比較器COMP1と、上記比較器COMP1の出力
を受けてスイッチング素子Q1、Q2を制御する制御回
路6とからなっている。なお、ダイオードブリッジDB
の直流出力端子のうち−(マイナス)側端子は、スイッ
チング素子Q2と平滑コンデンサC1の接続点に接続さ
れている。
(Embodiment 3) FIG. 7 shows a circuit diagram of a third embodiment of the present invention. The circuit of this embodiment includes an AC power supply Vs,
Filter circuit FT connected in parallel to AC power supply Vs
, A diode bridge DB having an AC input terminal connected to the filter circuit FT, a smoothing capacitor C1, and a switching element Q connected in parallel to the smoothing capacitor C1.
1 and a series circuit of Q2, an inductor L connected between a + (plus) side terminal of the DC output terminals of the diode bridge DB and a connection point of the switching elements Q1 and Q2.
1 and a series circuit of a diode D1 and a switching element Q
L2 and capacitor C2 connected to both ends of
And a series circuit of a capacitor C3, a load La connected in parallel with the capacitor C3, and a voltage V DC of the capacitor C1.
And V DC detection circuit 3 for detecting the voltage across the load La V
the Vla detection circuit 4 for detecting a la, addition circuit for adding outputs of V DC detection circuit 3 and the output of the Vla detection circuit 4 5
And a comparator COMP1 for comparing the output of the adder circuit 5 with a substantially constant reference voltage Vk, and a control circuit 6 for receiving the output of the comparator COMP1 and controlling the switching elements Q1, Q2. The diode bridge DB
Of the DC output terminals is connected to a connection point between the switching element Q2 and the smoothing capacitor C1.

【0029】本回路は図2においてチョッパ回路1のス
イッチング要素とインバータ回路2のスイッチング要素
を1石兼用したタイプの回路である。本回路における制
御の方法は、今までの実施例と同様であるため説明は省
略する。チョッパ回路1とインバータ回路2とで兼用し
たスイッチング素子Q2の制御信号波形は図4のτで示
した期間に相当する。
This circuit is of a type in which the switching element of the chopper circuit 1 and the switching element of the inverter circuit 2 in FIG. The control method in this circuit is the same as that in the previous embodiments, and a description thereof will be omitted. The control signal waveform of the switching element Q2 that is shared by the chopper circuit 1 and the inverter circuit 2 corresponds to the period indicated by τ in FIG.

【0030】本回路が先述してきた実施例と異なる点
は、チョッパ回路1のスイッチング要素とインバータ回
路2のスイッチング要素を兼用したため、駆動回路を減
らすことができ、回路構成をさらに簡単にできる点であ
る。しかしながら、今までの実施例に比べ、スイッチン
グ要素が1つ減ることにより、制御の自由度は低くなる
ため、コンデンサC1の電圧VDCを図3で示したように
変化させるためには、周波数、デューティはほぼ一義的
に決まる。
This circuit differs from the above-described embodiment in that the switching element of the chopper circuit 1 and the switching element of the inverter circuit 2 are also used, so that the number of drive circuits can be reduced and the circuit configuration can be further simplified. is there. However, since the number of switching elements is reduced by one as compared with the previous embodiments, the degree of freedom of control is reduced. To change the voltage VDC of the capacitor C1 as shown in FIG. The duty is determined almost uniquely.

【0031】(実施例4)本発明の第4の実施例の回路
図を図8に示す。本回路は、交流電源Vsと、交流電源
Vsに並列的に接続されるフィルタ回路FTと、平滑コ
ンデンサC1とC2の直列回路と、上記直列回路に並列
的に接続されるスイッチング素子Q1、Q2の直列回路
と、同じく上記直列回路に並列的に接続されるダイオー
ドD1、D2の直列回路と、フィルタ回路FTの一方の
出力端子と、ダイオードD1、D2の接続点との間に接
続されたインダクタL1と、フィルタ回路FTの他方の
出力端子に接続されたスイッチング素子Q1、Q2の接
続点と平滑コンデンサC1、C2の接続点との間に接続
されたインダクタL2、コンデンサC2、C3の直列回
路と、コンデンサC3に並列的に接続される負荷La
と、平滑コンデンサC1、C2の直列回路の両端電圧V
DCを検出するVDC検出回路3と、負荷Laの両端電圧V
laを検出するVla検出回路4と、VDC検出回路3の
出力とVla検出回路4の出力を加算する加算回路5
と、加算回路5の出力と略一定の基準電圧Vkとを比較
する比較器COMP1と、上記比較器COMP1の出力
を受けてスイッチング素子Q1、Q2を制御する制御回
路6とからなっている。
(Embodiment 4) FIG. 8 shows a circuit diagram of a fourth embodiment of the present invention. This circuit includes an AC power supply Vs, a filter circuit FT connected in parallel to the AC power supply Vs, a series circuit of smoothing capacitors C1 and C2, and switching elements Q1 and Q2 connected in parallel to the series circuit. A series circuit, a series circuit of diodes D1 and D2 also connected in parallel to the series circuit, an inductor L1 connected between one output terminal of the filter circuit FT, and a connection point of the diodes D1 and D2. A series circuit of an inductor L2 and capacitors C2 and C3 connected between a connection point of the switching elements Q1 and Q2 connected to the other output terminal of the filter circuit FT and a connection point of the smoothing capacitors C1 and C2; Load La connected in parallel with capacitor C3
And the voltage V across the series circuit of the smoothing capacitors C1 and C2.
V DC detection circuit 3 for detecting DC and voltage V across load La
the Vla detection circuit 4 for detecting a la, addition circuit for adding outputs of V DC detection circuit 3 and the output of the Vla detection circuit 4 5
And a comparator COMP1 for comparing the output of the adder circuit 5 with a substantially constant reference voltage Vk, and a control circuit 6 for receiving the output of the comparator COMP1 and controlling the switching elements Q1, Q2.

【0032】本回路は図2においてチョッパ回路1のス
イッチング要素とインバータ回路2のスイッチング要素
を2石兼用したタイプの回路である。本回路における制
御の方法は、今までの実施例と同様であるため説明は省
略する。ただし、交流電源Vsが図の矢印で示す方向に
電圧が生じている電源の半周期においては、兼用したス
イッチング要素のうちスイッチング素子Q1の制御信号
波形が図4のτで示した期間に相当し、スイッチング素
子Q2の制御信号波形はその反転波形となる。また、交
流電源Vsの電圧極性が反転する残りの半周期は、逆に
スイッチング素子Q2の制御信号波形が図4のτで示し
た期間に相当し、スイッチング素子Q1の制御信号波形
はその反転波形となる。本回路が、先述してきた実施例
と異なる点は、チョッパ回路1のスイッチング要素とイ
ンバータ回路2のスイッチング要素を2石兼用したた
め、駆動回路を減らすことができ、制御回路をさらに簡
単にできる点である。さらに実施例3と比べると、チョ
ッパ回路としての動作が電源の半周期毎にスイッチング
素子Q1、Q2の間で切り替わるため、スイッチング要
素のストレスを低減できる。
This circuit is a type of circuit in which the switching element of the chopper circuit 1 and the switching element of the inverter circuit 2 in FIG. The control method in this circuit is the same as that in the previous embodiments, and a description thereof will be omitted. However, in the half cycle of the power supply in which the AC power supply Vs generates a voltage in the direction indicated by the arrow in the figure, the control signal waveform of the switching element Q1 of the switching elements that are shared also corresponds to the period indicated by τ in FIG. , The control signal waveform of the switching element Q2 becomes an inverted waveform thereof. On the other hand, the remaining half cycle in which the voltage polarity of the AC power supply Vs is inverted corresponds to the period in which the control signal waveform of the switching element Q2 is indicated by τ in FIG. 4, and the control signal waveform of the switching element Q1 has the inverted waveform. Becomes This circuit differs from the above-described embodiment in that the switching element of the chopper circuit 1 and the switching element of the inverter circuit 2 are used in common, so that the number of drive circuits can be reduced and the control circuit can be further simplified. is there. Further, as compared with the third embodiment, the operation of the chopper circuit is switched between the switching elements Q1 and Q2 every half cycle of the power supply, so that the stress of the switching element can be reduced.

【0033】(実施例5)本発明の第5の実施例の回路
図を図9に示す。本回路は、交流電源Vsと、交流電源
Vsの交流電圧を整流する整流器DBと、コンデンサC
5と、コンデンサC5に並列的に接続される高周波で交
互にオン・オフするスイッチング素子Q1、Q2の直列
回路と、コンデンサC5に並列的に接続されるインダク
タL1、平滑コンデンサC1、ダイオードD2の直列回
路と、コンデンサC1とダイオードD2の接続点とスイ
ッチング素子Q1とQ2の接続点との間に接続され、コ
ンデンサC1にアノード端子が接続されるダイオードD
1と、整流器DBの直流出力端子のうち−(マイナス)
側端子と、スイッチング素子Q1、Q2の直列回路のス
イッチング素子Q2側の端子との間に接続されるコンデ
ンサC4と、コンデンサC4と並列的に整流器DBの直
流出力端からの電流を流し得る方向に接続されるダイオ
ードD3と、整流器DBの直流出力端子のうち−(マイ
ナス)側の端子と、スイッチング素子Q1、Q2の接続
点との間に接続される、コンデンサC2とトランスT1
の1次巻線との直列回路と、トランスT1の2次側に接
続される負荷Laと、負荷Laの非電源側端子に並列的
に接続されるコンデンサC3と、トランスT1の2次側
に設けられ、一端が回路のグランドに接続されるダイオ
ードDTと抵抗RTの直列回路からなるVla検出回路
4と、コンデンサC5の両端の電圧を検出する抵抗RDC
からなるVDC検出回路3と、VDC検出回路3の出力とV
la検出回路4の出力を加算する加算回路5と、加算回
路5の出力と略一定の基準電圧Vkとを比較する比較器
COMP1と、上記比較器COMP1における出力を受
けてインバータ回路のスイッチング要素を制御する制御
回路6とからなっている。なお、整流器DBの直流出力
端子のうち+(プラス)側端子は、スイッチング素子Q
1、Q2の直列回路のスイッチング素子Q1側の端子に
接続されている。
(Embodiment 5) FIG. 9 shows a circuit diagram of a fifth embodiment of the present invention. This circuit includes an AC power supply Vs, a rectifier DB for rectifying an AC voltage of the AC power supply Vs, and a capacitor C
5 and a series circuit of switching elements Q1, Q2 alternately turned on and off at a high frequency connected in parallel to the capacitor C5, and a series of an inductor L1, a smoothing capacitor C1, and a diode D2 connected in parallel to the capacitor C5. Circuit, a diode D connected between a connection point between the capacitor C1 and the diode D2 and a connection point between the switching elements Q1 and Q2, and an anode terminal connected to the capacitor C1.
1 and-(minus) of the DC output terminals of the rectifier DB
A capacitor C4 connected between the side terminal and a terminal on the switching element Q2 side of the series circuit of the switching elements Q1 and Q2, and a direction in which current can flow from the DC output terminal of the rectifier DB in parallel with the capacitor C4. A capacitor C2 and a transformer T1, which are connected between the diode D3 to be connected, the-(minus) terminal of the DC output terminals of the rectifier DB, and the connection point of the switching elements Q1 and Q2.
, A series circuit with the primary winding, a load La connected to the secondary side of the transformer T1, a capacitor C3 connected in parallel to a non-power supply side terminal of the load La, and a secondary circuit of the transformer T1. A Vla detection circuit 4 provided with a series circuit of a diode DT and a resistor RT, one end of which is connected to the ground of the circuit, and a resistor R DC for detecting a voltage across the capacitor C5.
V DC detection circuit 3, and the output of V DC detection circuit 3 and V
la, an addition circuit 5 for adding the output of the detection circuit 4, a comparator COMP1 for comparing the output of the addition circuit 5 with a substantially constant reference voltage Vk, and a switching element of the inverter circuit receiving the output of the comparator COMP1. And a control circuit 6 for controlling. The + (plus) side terminal of the DC output terminals of the rectifier DB is connected to the switching element Q.
1, Q2 is connected to the terminal on the switching element Q1 side of the series circuit.

【0034】本回路は図2においてチョッパ回路として
2石の降圧チョッパを用い、インバータ回路としてハー
フブリッジインバータを用いた場合の回路を示してい
る。本回路における制御の方法は、今までの実施例と同
様であるため説明は省略する。本実施例では、インダク
タL1、平滑コンデンサC1、ダイオードD1,D2よ
りなる降圧チョッパ構成のため、コンデンサC5の両端
電圧が電源のピーク値以下の期間で入力電流歪を低減す
ることができる。また、チョッパ回路の駆動回路を省略
できるため、回路がより少ない部品点数で構成できる。
FIG. 2 shows a circuit in which two step-down choppers are used as the chopper circuit and a half-bridge inverter is used as the inverter circuit. The control method in this circuit is the same as that in the previous embodiments, and a description thereof will be omitted. In the present embodiment, since the step-down chopper configuration includes the inductor L1, the smoothing capacitor C1, and the diodes D1 and D2, the input current distortion can be reduced during the period when the voltage across the capacitor C5 is equal to or less than the peak value of the power supply. Further, since the drive circuit of the chopper circuit can be omitted, the circuit can be configured with a smaller number of components.

【0035】(実施例6)本発明の第6の実施例の回路
図を図10に示す。本回路は、交流電源Vsの交流出力
を整流する整流器DBと、平滑用の第1のコンデンサC
1と、第1のコンデンサC1と並列に接続されるととも
に高周波で交互にオン・オフされる一対の第1および第
2のスイッチング素子Q1、Q2の直列回路と、スイッ
チング素子Q1、Q2とそれぞれ逆並列に接続される第
1および第2のダイオード(MOSFETに内蔵される
逆方向の寄生ダイオード)と、上記スイッチング素子Q
1、Q2の接続点と、上記整流器DBの直流出力端の+
(プラス)側との間に1次巻線が接続されるトランスT
1と、トランスT1の2次巻線に接続される放電灯La
と、放電灯Laの非電源側端子に接続される共振用コン
デンサC3と、上記トランスT1の1次巻線と整流器D
Bの直流出力端の+(プラス)側端子との接続点に一端
が接続されるとともに、他端が上記コンデンサC1の−
(マイナス)側端子に接続され、かつ上記スイッチング
素子Q1、Q2のオン・オフに応じて上記トランスT1
の1次巻線と共振回路を形成する第2のコンデンサC2
とを備え、上記整流器DBの直流出力端の−(マイナ
ス)側端子と上記コンデンサC1の−(マイナス)側端
子とを接続し、スイッチング素子Q1、Q2はそれぞれ
制御回路6からの信号で駆動されるように接続した電源
装置において、トランスT1に設けられた3次巻線と、
ダイオードDTと抵抗RTからなるVla検出回路4の
出力と、コンデンサC1の+(プラス)側端子に抵抗R
DCを接続して設けられたVDC検出回路3の出力とを、加
算回路5によって加算し、上記加算回路5の出力と、略
一定の直流電源Vkとを比較器COMP1の各々+(プ
ラス)と−(マイナス)入力端子に接続し、上記比較器
COMP1の出力を制御回路6に接続したものである。
(Embodiment 6) FIG. 10 is a circuit diagram of a sixth embodiment of the present invention. This circuit comprises a rectifier DB for rectifying the AC output of the AC power supply Vs, and a first capacitor C for smoothing.
1, a series circuit of a pair of first and second switching elements Q1 and Q2 connected in parallel with the first capacitor C1 and alternately turned on and off at a high frequency, and the switching elements Q1 and Q2, respectively. A first and a second diode (parasitic diode in the reverse direction built in the MOSFET) connected in parallel;
1, +2 of the connection point of Q2 and the DC output terminal of the rectifier DB.
Transformer T whose primary winding is connected to the (plus) side
1 and a discharge lamp La connected to the secondary winding of the transformer T1.
A resonance capacitor C3 connected to the non-power-supply-side terminal of the discharge lamp La; a primary winding of the transformer T1;
One end is connected to a connection point between the DC output terminal of B and the + (plus) terminal, and the other end is connected to the negative terminal of the capacitor C1.
(Tin) terminal connected to the (negative) side terminal and connected to the transformer T1 according to the on / off of the switching elements Q1 and Q2.
Capacitor C2 forming a resonance circuit with the primary winding of
And a negative terminal of the DC output terminal of the rectifier DB is connected to a negative terminal of the capacitor C1. The switching elements Q1 and Q2 are each driven by a signal from the control circuit 6. Tertiary winding provided in the transformer T1;
The output of the Vla detection circuit 4 including the diode DT and the resistor RT, and the resistor R connected to the + (plus) side terminal of the capacitor C1.
The output of the V DC detection circuit 3 connected with DC is added by the addition circuit 5, and the output of the addition circuit 5 and the substantially constant DC power supply Vk are each + (plus) of the comparator COMP1. And the minus (−) input terminal, and the output of the comparator COMP1 is connected to the control circuit 6.

【0036】本回路は図2においてチョッパ回路として
昇圧チョッパを用い、インバータ回路としてハーフブリ
ッジインバータを用いた場合の回路を示している。本回
路における制御の方法は、実施例3と同様であるため説
明は省略する。実施例3と異なるのは、ランプ電圧Vl
aを直接的に検出するのではなく、トランスT1を用い
てランプ電圧Vlaに比例した電圧を検出できるように
した点である。この場合、絶縁したまま検出が行えるた
め、制御回路が安全である。また、チョッパ回路の駆動
回路を省略できるため、回路がより少ない部品点数で構
成できる。
FIG. 2 shows a circuit in which a boost chopper is used as a chopper circuit and a half-bridge inverter is used as an inverter circuit in FIG. The control method in this circuit is the same as that in the third embodiment, and thus the description is omitted. The difference from the third embodiment is that the lamp voltage Vl
The point is that instead of directly detecting a, a voltage proportional to the lamp voltage Vla can be detected using the transformer T1. In this case, since the detection can be performed while being insulated, the control circuit is safe. Further, since the drive circuit of the chopper circuit can be omitted, the circuit can be configured with a smaller number of components.

【0037】(実施例7)本発明の第7の実施例の回路
図を図11に示す。本回路は、交流電源Vsと、交流電
源Vsの一端に中点を接続されたダイオードD3、D4
の直列回路と、交流電源Vsの他端とダイオードD4の
アソード側端子との間に接続されるコンデンサC2と、
ダイオードD3、D4の直列回路と並列に接続される平
滑作用を行うコンデンサC1と、コンデンサC1と並列
に接続されるとともに高周波で交互にオン・オフされる
一対のスイッチング素子Q1、Q2の直列回路と、スイ
ッチング素子Q1、Q2とそれぞれ逆並列に接続される
第1および第2のダイオード(MOSFETに内蔵され
る逆方向の寄生ダイオード)と、上記スイッチング素子
Q1、Q2の接続点と、上記交流電源Vsとコンデンサ
C2の接続点との間に1次巻線が接続されるトランスT
1と、トランスT1の2次巻線に接続される放電灯La
と、放電灯Laの非電源側端子に接続される共振用コン
デンサC3とからなる電源装置において、スイッチング
素子Q1、Q2はそれぞれ制御回路6からの信号で制御
されるように接続し、トランスT1に設けられた3次巻
線と、ダイオードDTと抵抗RTからなるVla検出回
路4の出力と、コンデンサC1の両端に抵抗RDCを接続
して設けられたVDC検出回路3の出力とを、加算回路5
によって加算し、上記加算回路5の出力と、基準電圧V
kとを比較器COMP1の各々+(プラス)と−(マイ
ナス)入力端子に接続し、上記比較器COMP1の出力
を制御回路6に接続したものである。
(Embodiment 7) FIG. 11 is a circuit diagram of a seventh embodiment of the present invention. This circuit comprises an AC power supply Vs, and diodes D3 and D4 each having a middle point connected to one end of the AC power supply Vs.
And a capacitor C2 connected between the other end of the AC power supply Vs and the anode terminal of the diode D4.
A smoothing capacitor C1 connected in parallel with the series circuit of the diodes D3 and D4, and a series circuit of a pair of switching elements Q1 and Q2 connected in parallel with the capacitor C1 and alternately turned on and off at a high frequency; , Switching elements Q1, Q2, respectively, a first and a second diode (parasitic diode in the reverse direction built into the MOSFET) connected in antiparallel, a connection point between the switching elements Q1, Q2, and the AC power supply Vs A primary winding is connected between the connection point of the capacitor C2 and the transformer T
1 and a discharge lamp La connected to the secondary winding of the transformer T1.
And a resonance capacitor C3 connected to the non-power supply side terminal of the discharge lamp La, the switching elements Q1 and Q2 are connected so as to be controlled by a signal from the control circuit 6, respectively, and are connected to the transformer T1. The output of the provided tertiary winding, the output of the Vla detection circuit 4 including the diode DT and the resistor RT, and the output of the VDC detection circuit 3 provided by connecting the resistor R DC to both ends of the capacitor C1 are added. Circuit 5
And the output of the addition circuit 5 and the reference voltage V
k is connected to the + (plus) and-(minus) input terminals of the comparator COMP1, and the output of the comparator COMP1 is connected to the control circuit 6.

【0038】本回路の動作が実施例6と異なる点は、電
源の半周期毎にチョッパ回路として動作するスイッチン
グ要素が切り替わる点である。このため、各スイッチン
グ要素のストレスが低減できる。他の動作は実施例6と
同様である。本実施例においても、実施例6と同様に、
絶縁したまま検出が行えるため、制御回路が安全であ
る。また、インバータ回路とチョッパ回路とでスイッチ
ング素子が兼用されているので、主回路の素子数が少な
くて済む。さらに、チョッパ回路の制御回路や駆動回路
を省略できるため、回路がより少ない部品点数で構成で
きる。
The operation of this circuit is different from that of the sixth embodiment in that the switching element operating as a chopper circuit switches every half cycle of the power supply. Therefore, the stress of each switching element can be reduced. Other operations are the same as in the sixth embodiment. Also in this embodiment, similarly to the sixth embodiment,
Since the detection can be performed with the insulation, the control circuit is safe. Further, since the switching element is also used in the inverter circuit and the chopper circuit, the number of elements in the main circuit can be reduced. Further, since the control circuit and the drive circuit of the chopper circuit can be omitted, the circuit can be configured with a smaller number of parts.

【0039】(実施例8)本発明の第8の実施例の回路
図を図12に示す。回路構成について、図11と異なる
点は、加算回路5の出力を別の基準電圧Vk’と比較す
る比較器COMP2を新たに設け、その出力を制御回路
6に入力したことである。本回路は、例えば電源変動や
負荷変動といった回路動作を継続したいモードと、無負
荷などの回路動作を弱めたり、停止させたいモードを区
別して制御する回路である。このことを図13を用いて
説明する。
(Embodiment 8) FIG. 12 is a circuit diagram of an eighth embodiment of the present invention. The circuit configuration differs from that of FIG. 11 in that a comparator COMP2 for comparing the output of the adder circuit 5 with another reference voltage Vk ′ is newly provided and the output is input to the control circuit 6. The present circuit is a circuit that separately controls a mode in which circuit operation such as power supply fluctuation or load fluctuation is desired to be continued and a mode in which circuit operation such as no load is desired to be weakened or stopped. This will be described with reference to FIG.

【0040】図13は図3のグラフに新たに基準電圧V
k’を設けている。これまでの実施例では、基準電圧V
kを越えれば、回路が異常と判断して、停止したり出力
を低下させたりしていたが、無負荷やエミレスなどの他
にも基準電圧Vkを越える原因として、電源変動や負荷
変動が考えられる。しかしながら、プラスマイナス数パ
ーセントの電源変動や負荷変動であれば、出力を補償し
て、動作を継続することが望ましい。今、仮に電源電圧
が増える場合や、負荷出力が減少する場合を考える。電
源電圧が増える場合であれば直流電圧VDCが、負荷出力
が減少する場合であればランプ電圧Vlaが各々増加す
ることになる。このとき、いずれの電圧が増加した場合
でも第1の基準値Vkを越えることになる。ここで、こ
の検出電圧の和VaがVk<Va<Vk’の範囲にあれ
ば、インバータ回路の周波数を低くしたり、あるいはス
イッチング信号のデューティを50(%)に近付けて、
出力が増加する方向に補償してやる。もしも、Vk’<
Vaであったら、回路が無負荷などの異常であると判断
して、回路動作を弱めたり、停止させたりすれば良い。
FIG. 13 shows a new reference voltage V in the graph of FIG.
k ′ is provided. In the above embodiments, the reference voltage V
If the voltage exceeds k, the circuit is judged to be abnormal, and the circuit is stopped or the output is reduced. However, besides no load, Emiless, etc., power supply fluctuations and load fluctuations are considered as causes that exceed the reference voltage Vk. Can be However, if the power supply fluctuation or the load fluctuation is plus or minus several percent, it is desirable to compensate the output and continue the operation. Now, consider a case where the power supply voltage increases or a case where the load output decreases. When the power supply voltage increases, the DC voltage VDC increases, and when the load output decreases, the lamp voltage Vla increases. At this time, even if any of the voltages increases, the voltage exceeds the first reference value Vk. Here, if the sum Va of the detection voltages is in the range of Vk <Va <Vk ′, the frequency of the inverter circuit is lowered, or the duty of the switching signal is brought close to 50 (%).
I will compensate for the increase in output. If Vk '<
If it is Va, it may be determined that the circuit is abnormal, such as no load, and the circuit operation may be weakened or stopped.

【0041】本実施例の制御は、電源電圧の増加や負荷
出力の減少のみにとどまらず、逆に電源電圧が減少した
場合や負荷出力が増加した場合にも同様な制御を施すこ
とができる。その場合はまた新たに基準電圧Vkよりも
低い基準電圧Vk”を設定してVk”<Va<Vkの範
囲では出力補償を、Va<Vk”となった時点で回路動
作を停止などさせれば良い。
The control according to the present embodiment can be performed not only when the power supply voltage increases and the load output decreases, but also when the power supply voltage decreases and the load output increases. In that case, a reference voltage Vk "lower than the reference voltage Vk is newly set, output compensation is performed in the range of Vk"<Va<Vk, and circuit operation is stopped when Va <Vk "is satisfied. good.

【0042】[0042]

【発明の効果】請求項1の発明によれば、チョッパ回路
の出力電圧とインバータ回路の出力電圧の2つの検出制
御が1つの制御回路で行えるため、部品点数が少なくて
済むという利点があり、無負荷、エミレス、電源変動と
いった異常時に素子に過大なストレスが印加されるのを
抑制することができる。また、検出電圧が低くなった場
合には速やかに回路を停止でき、ちらつきやジャンプ現
象、あるいは過出力を抑えることができる。
According to the first aspect of the present invention, since two detection controls of the output voltage of the chopper circuit and the output voltage of the inverter circuit can be performed by one control circuit, there is an advantage that the number of components can be reduced. It is possible to suppress the application of excessive stress to the element at the time of abnormality such as no load, Emiless, or power supply fluctuation. Further, when the detection voltage becomes low, the circuit can be stopped immediately, and flickering, jump phenomenon, or over output can be suppressed.

【0043】請求項2の発明によれば、負荷電圧がイン
バータ回路の出力に反比例するため、チョッパ回路の出
力電圧とインバータ回路の出力電圧の検出電圧の和が略
一定となる検出制御が容易になる。請求項3の発明によ
れば、調光の全域において、チョッパ回路の出力電圧と
インバータ回路の出力電圧の検出が1つの検出回路で行
えるため、部品点数が少なくて済む。また、検出のため
の基準値の設定が略一定で済むため、簡単な回路で基準
値を設定できる。さらに、調光の全域において、正常点
灯時と異常検出の基準値の差を小さくできるため、異常
時に素子に過大なストレスが印加されるのを抑制するこ
とができる。
According to the second aspect of the present invention, since the load voltage is inversely proportional to the output of the inverter circuit, detection control in which the sum of the output voltage of the chopper circuit and the detection voltage of the output voltage of the inverter circuit becomes substantially constant can be easily performed. Become. According to the third aspect of the present invention, the output voltage of the chopper circuit and the output voltage of the inverter circuit can be detected by one detection circuit in the entire range of dimming, so that the number of components can be reduced. Further, since the setting of the reference value for detection can be substantially constant, the reference value can be set with a simple circuit. Further, since the difference between the reference value for normal lighting and the reference value for abnormality detection can be reduced in the entire range of dimming, it is possible to suppress the application of excessive stress to the element at the time of abnormality.

【0044】請求項4の発明によれば、チョッパ回路の
駆動回路を省略できるため、回路がより少ない部品点数
で構成できる。請求項5の発明によれば、チョッパ回路
の駆動回路を省略できるため、回路がより少ない部品点
数で構成できる。また、電源の半周期毎にチョッパ動作
を行うスイッチング要素が切り替わるため、各スイッチ
ング要素のストレスが低減できる。
According to the fourth aspect of the present invention, since the drive circuit of the chopper circuit can be omitted, the circuit can be configured with a smaller number of parts. According to the fifth aspect of the present invention, since the drive circuit of the chopper circuit can be omitted, the circuit can be configured with a smaller number of components. Further, since the switching element that performs the chopper operation switches every half cycle of the power supply, the stress of each switching element can be reduced.

【0045】請求項6の発明によれば、降圧チョッパ構
成のため、チョッパ回路の出力電圧が低く設定でき、ス
トレスが低減できる。また、チョッパ回路の駆動回路を
省略できるため、回路がより少ない部品点数で構成でき
る。請求項7の発明によれば、チョッパ用のインダクタ
をインバータ回路のインダクタと兼用できるため、回路
の部品が少なくて済む。請求項8の発明によれば、整流
器のダイオードが2個で済むため、さらに部品を少なく
できる。
According to the sixth aspect of the present invention, since the step-down chopper is configured, the output voltage of the chopper circuit can be set low, and the stress can be reduced. Further, since the drive circuit of the chopper circuit can be omitted, the circuit can be configured with a smaller number of components. According to the invention of claim 7, the chopper inductor can be used also as the inductor of the inverter circuit, so that the number of circuit components can be reduced. According to the invention of claim 8, since only two diodes are required for the rectifier, the number of components can be further reduced.

【0046】請求項9の発明によれば、異常昇圧の電圧
の大きさに応じて制御できるため、動作を継続させる電
源変動と、無負荷やエミレスなどの区別ができる。請求
項10の発明によれば、負荷と絶縁したまま検出が行え
るため、制御回路が安全である。また、チョッパ回路の
駆動回路を省略できるため、回路がより少ない部品点数
で構成できる。
According to the ninth aspect of the present invention, since the control can be performed in accordance with the magnitude of the abnormally boosted voltage, it is possible to distinguish between a power supply fluctuation for continuing the operation and no load or Emiless. According to the tenth aspect, the detection can be performed while being insulated from the load, so that the control circuit is safe. Further, since the drive circuit of the chopper circuit can be omitted, the circuit can be configured with a smaller number of components.

【図面の簡単な説明】[Brief description of the drawings]

【図1】本発明の実施例1の回路図である。FIG. 1 is a circuit diagram of a first embodiment of the present invention.

【図2】本発明の実施例2の回路図である。FIG. 2 is a circuit diagram according to a second embodiment of the present invention.

【図3】本発明の実施例2の動作説明図である。FIG. 3 is an operation explanatory diagram of a second embodiment of the present invention.

【図4】本発明の実施例2のスイッチング動作を説明す
るための波形図である。
FIG. 4 is a waveform chart for explaining a switching operation according to a second embodiment of the present invention.

【図5】本発明の実施例2のチョッパ回路とインバータ
回路を具体化して示した回路図である。
FIG. 5 is a circuit diagram specifically illustrating a chopper circuit and an inverter circuit according to a second embodiment of the present invention.

【図6】本発明の実施例2の検出回路と制御回路を具体
化して示した回路図である。
FIG. 6 is a circuit diagram specifically illustrating a detection circuit and a control circuit according to a second embodiment of the present invention.

【図7】本発明の実施例3の回路図である。FIG. 7 is a circuit diagram of a third embodiment of the present invention.

【図8】本発明の実施例4の回路図である。FIG. 8 is a circuit diagram of a fourth embodiment of the present invention.

【図9】本発明の実施例5の回路図である。FIG. 9 is a circuit diagram of a fifth embodiment of the present invention.

【図10】本発明の実施例6の回路図である。FIG. 10 is a circuit diagram of a sixth embodiment of the present invention.

【図11】本発明の実施例7の回路図である。FIG. 11 is a circuit diagram of a seventh embodiment of the present invention.

【図12】本発明の実施例8の回路図である。FIG. 12 is a circuit diagram of an eighth embodiment of the present invention.

【図13】本発明の実施例8の動作説明図である。FIG. 13 is an operation explanatory diagram of the eighth embodiment of the present invention.

【図14】従来例の回路図である。FIG. 14 is a circuit diagram of a conventional example.

【図15】従来例の検出回路と制御回路を説明するため
の回路図である。
FIG. 15 is a circuit diagram for explaining a conventional detection circuit and control circuit.

【符号の説明】[Explanation of symbols]

1 チョッパ回路 2 インバータ回路 3 VDC検出回路 4 Vla検出回路 5 加算回路 6 制御回路 Vs 交流電源 C1 コンデンサ La 負荷DESCRIPTION OF SYMBOLS 1 Chopper circuit 2 Inverter circuit 3 VDC detection circuit 4 Vla detection circuit 5 Addition circuit 6 Control circuit Vs AC power supply C1 Capacitor La Load

───────────────────────────────────────────────────── フロントページの続き Fターム(参考) 3K072 AA02 AB01 BA03 BA05 BB10 BC01 BC02 BC03 DB03 DD04 EA01 EA02 EA04 EB05 GA02 GB01 GB04 GB12 GB18 GC04 HA06 HA10 HB03 3K098 CC51 CC62 DD22 DD37 DD43 EE14 EE31 EE32 FF03 FF14 GG02 5H007 AA05 AA17 BB03 CA02 CB04 CB12 CB22 DC05 EA08 EA09 FA01 FA13 FA14  ──────────────────────────────────────────────────続 き Continued on the front page F term (reference) AA17 BB03 CA02 CB04 CB12 CB22 DC05 EA08 EA09 FA01 FA13 FA14

Claims (8)

【特許請求の範囲】[Claims] 【請求項1】 交流電源の電圧を受けて直流を出力す
る少なくとも1つはスイッチング素子を有するチョッパ
回路と、 上記チョッパ回路の出力端に並列に接続される平滑用の
第1のコンデンサと、 第1のコンデンサの電圧を高周波に変換して負荷に供給
する少なくとも1つはスイッチング素子を有するインバ
ータ回路と、 第1のコンデンサの電圧を検出する第1の検出手段と、 負荷の両端の電圧を検出する第2の検出手段と、 第1の検出手段の出力と第2の検出手段の出力を加算す
る加算手段と、 上記加算手段により得られる加算値が略一定となるよう
にチョッパ回路とインバータ回路のスイッチング素子を
制御する制御手段とを有することを特徴とする電源装
置。
1. A chopper circuit having at least one switching element for receiving a voltage of an AC power supply and outputting a direct current, a first capacitor for smoothing connected in parallel to an output terminal of the chopper circuit, At least one of: an inverter circuit having a switching element for converting a voltage of the first capacitor to a high frequency and supplying the converted voltage to a load; first detecting means for detecting a voltage of the first capacitor; and detecting a voltage across the load. A second detecting means, an adding means for adding an output of the first detecting means and an output of the second detecting means, a chopper circuit and an inverter circuit such that an added value obtained by the adding means becomes substantially constant. And a control unit for controlling the switching element.
【請求項2】 負荷は放電灯であり、負荷の出力を任
意に調整できる手段を備えたことを特徴とする請求項1
記載の電源装置。
2. The load according to claim 1, wherein the load is a discharge lamp, and a means for arbitrarily adjusting the output of the load is provided.
The power supply as described.
【請求項3】 交流電源を整流する整流器と、 整流器の直流出力を平滑する第1のコンデンサと、 第1のコンデンサに並列的に接続され、高周波で交互に
オンオフされる一対のスイッチング素子の直列回路と、 上記一対のスイッチング素子に各々逆並列に接続される
ダイオードと、 上記一対のスイッチング素子のいずれか一方の両端に接
続される、共振用インダクタと共振用コンデンサと負荷
を含んで成る負荷回路と、 上記整流器の直流出力端子と上記一対のスイッチング素
子のいずれか一方との間に接続されたチョッパ用のイン
ダクタと、 第1のコンデンサの電圧を検出する第1の検出手段と、 負荷の両端の電圧を検出する第2の検出手段と、 第1の検出手段の出力と第2の検出手段の出力を加算す
る加算手段と、 上記加算手段により得られる加算値が略一定となるよう
にスイッチング素子を制御する制御手段とを有すること
を特徴とする請求項1又は2に記載の電源装置。
3. A series of a rectifier for rectifying an AC power supply, a first capacitor for smoothing a DC output of the rectifier, and a pair of switching elements connected in parallel to the first capacitor and alternately turned on and off at a high frequency. A circuit, a diode connected in anti-parallel to each of the pair of switching elements, and a load circuit including a resonance inductor, a resonance capacitor, and a load connected to both ends of one of the pair of switching elements. A chopper inductor connected between the DC output terminal of the rectifier and one of the pair of switching elements; first detecting means for detecting a voltage of a first capacitor; Second detecting means for detecting the voltage of the first detecting means, adding means for adding the output of the first detecting means and the output of the second detecting means, 3. The power supply device according to claim 1, further comprising control means for controlling the switching element so that the obtained addition value becomes substantially constant.
【請求項4】 第1及び第2のダイオードを順方向が
一致するように直列接続した回路と、第3及び第4のダ
イオードを順方向が一致するように直列接続した回路と
を同じ方向に並列接続してダイオードブリッジ回路より
なる全波整流器を構成し、第3及び第4のダイオードと
各々逆並列に第1及び第2のスイッチング素子を接続
し、上記全波整流器の交流入力端子間にチョッパ用のイ
ンダクタを介して交流電源を接続し、上記全波整流器の
直流出力端子間に第1及び第2の平滑コンデンサの直列
回路を接続し、第1及び第2の平滑コンデンサの接続点
と、第1及び第2のスイッチング素子の接続点との間
に、共振用インダクタと共振用コンデンサと負荷を含ん
で成る負荷回路を接続して成る電力変換装置において、 第1及び第2の平滑コンデンサの直列回路の両端電圧を
検出する第1の検出手段と、 負荷の両端の電圧を検
出する第2の検出手段と、 第1の検出手段の出力と第2の検出手段の出力を加算す
る加算手段と、 上記加算手段により得られる加算値が略一定となるよう
にスイッチング素子を制御する制御手段とを有すること
を特徴とする請求項1又は2に記載の電源装置。
4. A circuit in which first and second diodes are connected in series so that their forward directions match, and a circuit in which third and fourth diodes are connected in series so that their forward directions match, in the same direction. A full-wave rectifier comprising a diode bridge circuit is connected in parallel, and first and second switching elements are connected in anti-parallel with the third and fourth diodes, respectively, between the AC input terminals of the full-wave rectifier. An AC power supply is connected via a chopper inductor, a series circuit of first and second smoothing capacitors is connected between the DC output terminals of the full-wave rectifier, and a connection point of the first and second smoothing capacitors is connected. , A load circuit including a resonance inductor, a resonance capacitor and a load connected between a connection point of the first and second switching elements. First detecting means for detecting the voltage between both ends of the series circuit of the sensor, second detecting means for detecting the voltage between both ends of the load, and adding the output of the first detecting means and the output of the second detecting means. The power supply device according to claim 1, further comprising: an adding unit; and a control unit that controls the switching element such that an addition value obtained by the adding unit is substantially constant.
【請求項5】 交流電源を整流する整流器と、 上記整流器の整流出力を受けて直流電圧を充電される第
1のコンデンサと、 上記整流器の整流出力と第1のコンデンサの間に整流出
力と同じ方向に直列に接続された第1のダイオードと、 第1のダイオードに並列的に接続される第2のコンデン
サと、 第1のコンデンサに並列的に接続される高周波で交互に
オンオフされる一対のスイッチング素子の直列回路と、 上記一対のスイッチング素子に各々逆並列に接続される
第2及び第3のダイオードと、 上記整流器と第1のダイオードの接続点と、上記一対の
スイッチング素子の接続点との間に直流カット用のコン
デンサを介して接続される共振用インダクタと共振用コ
ンデンサと負荷を含んで成る負荷回路と、 第1のコンデンサの両端に並列的に接続される部分平滑
回路と、 第1のコンデンサの電圧を検出する第1の検出手段と、 負荷の両端の電圧を検出する第2の検出手段と、 第1の検出手段の出力と第2の検出手段の出力を加算す
る加算手段と、 上記加算手段により得られる加算値が略一定となるよう
にスイッチング素子を制御する制御手段とを有すること
を特徴とする請求項1又は2に記載の電源装置。
5. A rectifier for rectifying an AC power supply, a first capacitor receiving a rectified output of the rectifier and charging a DC voltage, and a rectified output between the rectified output of the rectifier and the first capacitor. A first diode connected in series in the direction, a second capacitor connected in parallel to the first diode, and a pair of alternatingly turned on and off at a high frequency connected in parallel to the first capacitor. A series circuit of switching elements, second and third diodes respectively connected in anti-parallel to the pair of switching elements, a connection point between the rectifier and the first diode, and a connection point between the pair of switching elements. A load circuit including a resonance inductor, a resonance capacitor, and a load connected via a DC cut capacitor between the first capacitor and the load circuit; A connected partial smoothing circuit, first detection means for detecting the voltage of the first capacitor, second detection means for detecting the voltage across the load, and the output of the first detection means 3. The power supply according to claim 1, further comprising: an adding unit that adds an output of the detecting unit; and a control unit that controls a switching element so that an addition value obtained by the adding unit is substantially constant. apparatus.
【請求項6】 交流電源の交流出力を整流する整流器
と、 平滑用の第1のコンデンサと、 第1のコンデンサと並列に接続されるとともに高周波で
交互にオン・オフされる一対のスイッチング素子の直列
回路と、 上記一対のスイッチング素子とそれぞれ逆並列に接続さ
れる第1及び第2のダイオードと、 上記一対のスイッチング素子の接続点と、上記整流器の
一方の直流出力端との間に1次巻線が接続されるトラン
スと、 上記トランスの2次巻線に接続される負荷回路と 上記トランスの1次巻線と整流器の直流出力端の接続点
に一端が接続されるとともに、他端が上記第1のコンデ
ンサの一方の端子に接続され、かつ上記スイッチング素
子のオン・オフに応じて上記トランスの1次巻線と共振
回路を形成する第2のコンデンサとを備え、 上記整流器の直流出力端が、上記第1のコンデンサの端
子のうちで交流電源から上記トランスと第1及び第2の
ダイオードのいずれか一方と第1のコンデンサとを介し
て電流の流れる経路が形成される側の端子に接続されて
成る電源装置において、 第1のコンデンサの電圧を検出する第1の検出手段と、 負荷の両端の電圧を検出する第2の検出手段と、 第1の検出手段の出力と第2の検出手段の出力を加算す
る加算手段と、 上記加算手段により得られる加算値が略一定となるよう
にスイッチング素子を制御する制御手段とを有すること
を特徴とする請求項1又は2に記載の電源装置。
6. A rectifier for rectifying an AC output of an AC power supply, a first capacitor for smoothing, and a pair of switching elements connected in parallel with the first capacitor and alternately turned on and off at a high frequency. A series circuit, first and second diodes respectively connected in anti-parallel with the pair of switching elements, and a primary circuit between a connection point of the pair of switching elements and one DC output terminal of the rectifier. One end is connected to a connection point between the primary winding of the transformer and the DC output terminal of the rectifier, and the other end is connected to the transformer to which the winding is connected, the load circuit connected to the secondary winding of the transformer, A second capacitor connected to one terminal of the first capacitor and forming a resonance circuit with a primary winding of the transformer according to ON / OFF of the switching element; A DC output terminal of the rectifier forms a path through which a current flows from an AC power source among the terminals of the first capacitor, through the transformer, one of the first and second diodes, and the first capacitor. A first detecting means for detecting the voltage of the first capacitor; a second detecting means for detecting the voltage across the load; and a first detecting means for detecting the voltage across the load. 2. An adding means for adding an output and an output of a second detecting means, and a controlling means for controlling a switching element such that an added value obtained by the adding means is substantially constant. 3. The power supply device according to 2.
【請求項7】 第1及び第2のダイオードを順方向が
一致するように直列接続した回路と、第3及び第4のダ
イオードを順方向が一致するように直列接続した回路と
を同じ方向に並列接続してダイオードブリッジ回路より
なる全波整流器を構成し、第1及び第2のダイオードと
各々逆並列に第1及び第2のスイッチング素子を接続
し、上記全波整流器の交流入力端子間に交流電源と負荷
回路の直列回路を接続し、上記全波整流器の直流出力端
子間に平滑用の第1のコンデンサを接続し、交流電源と
負荷の接続点と全波整流器の一方の直流出力端子との間
に第2のコンデンサを接続して成る電力変換装置におい
て、 第1のコンデンサの電圧を検出する第1の検出手段と、 負荷の両端の電圧を検出する第2の検出手段と、 第1の検出手段の出力と第2の検出手段の出力を加算す
る加算手段と、 上記加算手段により得られる加算値が略一定となるよう
にスイッチング素子を制御する制御手段とを有すること
を特徴とする請求項1又は2に記載の電源装置。
7. A circuit in which first and second diodes are connected in series so that their forward directions match, and a circuit in which third and fourth diodes are connected in series so that their forward directions match are connected in the same direction. A full-wave rectifier consisting of a diode bridge circuit is connected in parallel, and first and second switching elements are connected in anti-parallel with the first and second diodes, respectively, between the AC input terminals of the full-wave rectifier. A series circuit of an AC power supply and a load circuit is connected, a first capacitor for smoothing is connected between the DC output terminals of the full-wave rectifier, and a connection point between the AC power supply and the load and one DC output terminal of the full-wave rectifier. And a second detection means for detecting the voltage of the first capacitor; a second detection means for detecting the voltage across the load; Output of the detecting means 1 3. An apparatus according to claim 1, further comprising an adder for adding an output of the second detector, and a controller for controlling the switching element such that an addition value obtained by the adder is substantially constant. The power supply as described.
【請求項8】 上記加算手段における加算値を任意の
基準電圧と比較する比較手段を備え、異常時には比較手
段の出力が正常時の出力とは異なることにより異常を検
出することを特徴とする請求項1乃至7のいずれかに記
載の電源装置。
8. A method according to claim 1, further comprising comparing means for comparing an added value of said adding means with an arbitrary reference voltage, wherein an abnormality is detected when an output of the comparing means is different from an output in a normal state. Item 8. The power supply device according to any one of Items 1 to 7.
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