ES2046106R - - Google Patents

Info

Publication number
ES2046106R
ES2046106R ES9200352A ES9200352A ES2046106R ES 2046106 R ES2046106 R ES 2046106R ES 9200352 A ES9200352 A ES 9200352A ES 9200352 A ES9200352 A ES 9200352A ES 2046106 R ES2046106 R ES 2046106R
Authority
ES
Spain
Prior art keywords
kbit
alignment
elastic
circuit
memory
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
ES9200352A
Other languages
English (en)
Other versions
ES2046106B1 (es
ES2046106A2 (es
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed filed Critical
Priority to ES9200352A priority Critical patent/ES2046106B1/es
Publication of ES2046106A2 publication Critical patent/ES2046106A2/es
Publication of ES2046106R publication Critical patent/ES2046106R/es
Application granted granted Critical
Publication of ES2046106B1 publication Critical patent/ES2046106B1/es
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Landscapes

  • Time-Division Multiplex Systems (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)

Abstract

METODO DE REALIZACION DE CIRCUITOS ALINEADORES INMUNES A LOS DESLIZAMIENTOS OCURRIDOS EN LA MEMORIA ELASTICA DE RECEPCION. APLICABLE A SISTEMAS DIGITALES DE TRANSMISION DE DATOS. BASADO EN GENERAR SEÑALES DE CONTROL EN LA MEMORIA ELASTICA (1) QUE INDIQUEN CUANDO SE REPITE O SE PIERDE INFORMACION, HACIENDO POSIBLE EL CONTROL DE CIRCUITOS ALINEADORES DE MANERA QUE UN DESLIZAMIENTO EN LA MEMORIA ELASTICA (1), DEBIDO A DIFERENCIAS DE FRECUENCIA ENTRE EL RELOJ DE RECEPCION Y DEL SISTEMA DE EMISION, NO IMPLIQUE FORZOSAMENTE EL DESALINEAMIENTO CUANDO SE ALCANZA EL ESTADO DE ALINEAMIENTO. PARA ELLO SE HA PREVISTO UNA ETAPA DE GENERACION DE SEÑALES TRAMA CONSTITUIDA POR LA MEMORIA ELASTICA (1), UN CONTADOR DE LECTURA (2), UN CONTADOR DE ESCRITURA (3), UN BLOQUE COMPARADOR Y DE CONTROL (4) QUE GENERA DICHAS SEÑALES TRAMA, Y UN CIRCUITO PIPO (5); CONECTANDOSE A ESA ETAPA UN CIRCUITO ALINEADOR DE MULTITRAMA DE SEÑALIZACION ASOCIADA AL CANAL PARA UNA TRAMA G.704 A 2.048 KBIT/S O UN CIRCUITO ALINEADOR SEGUN LA RECOMENDACION X.50 PARA LOS INTERVALOS DE CANAL A 64 KBIT/S CONTENIDOS EN UNA TRAMA G.704 A 2.048 KBIT/S, TODO ELLO DISEÑADO SEGUN EL METODO DE LA INVENCION.
ES9200352A 1992-02-18 1992-02-18 Metodo de realizacion de circuitos alineadores inmunes a los deslizamientos ocurridos en la memoria elastica de recepcion. Expired - Fee Related ES2046106B1 (es)

Priority Applications (1)

Application Number Priority Date Filing Date Title
ES9200352A ES2046106B1 (es) 1992-02-18 1992-02-18 Metodo de realizacion de circuitos alineadores inmunes a los deslizamientos ocurridos en la memoria elastica de recepcion.

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
ES9200352A ES2046106B1 (es) 1992-02-18 1992-02-18 Metodo de realizacion de circuitos alineadores inmunes a los deslizamientos ocurridos en la memoria elastica de recepcion.

Publications (3)

Publication Number Publication Date
ES2046106A2 ES2046106A2 (es) 1994-01-16
ES2046106R true ES2046106R (es) 1996-04-16
ES2046106B1 ES2046106B1 (es) 1996-11-16

Family

ID=8276106

Family Applications (1)

Application Number Title Priority Date Filing Date
ES9200352A Expired - Fee Related ES2046106B1 (es) 1992-02-18 1992-02-18 Metodo de realizacion de circuitos alineadores inmunes a los deslizamientos ocurridos en la memoria elastica de recepcion.

Country Status (1)

Country Link
ES (1) ES2046106B1 (es)

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
ZA804386B (en) * 1979-08-10 1981-07-29 Plessey Co Ltd Frame aligner for digital telecommunications exchange system
US4327411A (en) * 1980-03-04 1982-04-27 Bell Telephone Laboratories, Incorporated High capacity elastic store having continuously variable delay
FR2656479B1 (es) * 1989-12-27 1994-04-08 Alcatel Cit
US5119406A (en) * 1990-05-30 1992-06-02 At&T Bell Laboratories Digital signal synchronization employing single elastic store

Also Published As

Publication number Publication date
ES2046106B1 (es) 1996-11-16
ES2046106A2 (es) 1994-01-16

Similar Documents

Publication Publication Date Title
DK482183A (da) Fremgangsmaade til digital informationsoverfoering
FI20031396A (fi) Järjestelmä ja menetelmä signaaliaaltomuotojen synnyttämiseksi CDMA-solukkopuhelinjärjestelmässä
SE7710097L (sv) Anordning for att i en digitalinformationsstrom infoga tillsatsinformation och avlegsna sadan information fran informationsstrommen
JPS62269443A (ja) 並列伝送方式
IT1169871B (it) Metodo per il trasferimento di un canale di informazioni supplementare attraverso un mezzo di trasmissione
AR247649A1 (es) Una disposicion de transmision de datos
CA2047254A1 (en) Nyblet time switch
DK30287A (da) Digitalt kommunikationssystem
ES2146576T3 (es) Disposicion de bucle con enganche de pase.
ATE200380T1 (de) Taktrückgewinnung für einen atm-empfänger
ES8105124A1 (es) Perfeccionamientos en las disposiciones circuitales capaces de reconocer palabras de alineacion
ATE14058T1 (de) Digitales nachrichtenuebertragungssystem.
ES2046106B1 (es) Metodo de realizacion de circuitos alineadores inmunes a los deslizamientos ocurridos en la memoria elastica de recepcion.
FR2711467B1 (fr) Procédé de transmission par cellules ATM d'informations fournies sous la forme d'une suite d'entités distinctes pour une application donnée et dispositifs pour la mise en Óoeuvre de ce procédé.
ES2117040T3 (es) Dispositivo de sincronizacion para equipamiento de terminal de una red de telecomunicaciones digital con transferencia en modo asincrono.
ES2124709T3 (es) Vigilancia de linea para señales de jerarquia digital sincrona.
MX9303151A (es) Un metodo y una disposicion relacionados con la escritura y lectura de la memoria.
EP0195421A3 (en) System for the synchronisation of digital information signals
ES2139587T3 (es) Sistema de television para transmitir señales de imagen en un formato digital.
JPS57138237A (en) Transmission system for error correction parallel data
JPS57136845A (en) Coding and transfer system of information data
KR910017801A (ko) 독립 동기형 구내정보통신망 및 그것에 사용되는 노드장치
ES2114541T3 (es) Procedimiento y disposicion para generar una señal multiplex de emision y para sincronizar una señal multiplex de recepcion sobre la señal multiplex de emision.
FI903017A0 (fi) Mellanstaelle foer telekommunikationsfoerbindelse.
AR008499A1 (es) Procedimiento para la transmision de datos de trafico en un sistema de telecomunicaciones hibrido, en particular, un sistema ''rll/wll especifico deisdn ---dect''

Legal Events

Date Code Title Description
EC2A Search report published

Date of ref document: 19920218

Kind code of ref document: B1

Effective date: 19920218

FD1A Patent lapsed

Effective date: 20041004