EP3195134A1 - Dispositif de gestion d'erreurs sur un bus universel serie - Google Patents

Dispositif de gestion d'erreurs sur un bus universel serie

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EP3195134A1
EP3195134A1 EP15748296.9A EP15748296A EP3195134A1 EP 3195134 A1 EP3195134 A1 EP 3195134A1 EP 15748296 A EP15748296 A EP 15748296A EP 3195134 A1 EP3195134 A1 EP 3195134A1
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EP
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host
state
peripheral
connection
communication
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EP15748296.9A
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Inventor
Antony Boisserie
Mehdi ADJADJ
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PSA Automobiles SA
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Peugeot Citroen Automobiles SA
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Publication date
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    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/38Information transfer, e.g. on bus
    • G06F13/42Bus transfer protocol, e.g. handshake; Synchronisation
    • G06F13/4282Bus transfer protocol, e.g. handshake; Synchronisation on a serial bus, e.g. I2C bus, SPI bus
    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F2213/00Indexing scheme relating to interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F2213/0042Universal serial bus [USB]

Definitions

  • the invention relates to the transmission of data on a serial bus and more particularly to the management of errors during a transmission.
  • the Universal Serial Bus (or USB for Universal Serial Bus in English) is a serial transmission computer bus used to connect computer peripherals (also called USB devices in English) to a computer (also called host or USB host in English).
  • the USB is declined in several versions each allowing to communicate according to a plurality of modes.
  • the first version of the USB bus can communicate in two modes: a slow mode (or “Low Speed” whose bit rate is 1.5 Mbps) or a fast mode ("Full Speed” whose bit rate is 12 Mbit / s). s):
  • the second version of the USB bus also includes a third mode (called "High Speed" whose bit rate is 480 Mbit / s).
  • the USB bus operates on the basis of a token ring (or Token Ring) with which each node of the network has successively the bus.
  • Bandwidth is shared temporally among all connected devices. The time is subdivided into frames (frames) or micro-frames (microframes) during which several transfers can take place.
  • the communication between the host and the peripherals is done according to a protocol based on the successive interrogation of each peripheral by the host.
  • the host wishes to communicate with a device, it issues a token (a data packet, containing the device address, encoded on seven bits) designating a device. If the device recognizes its address in the token, it sends a packet of data in response.
  • a token a data packet, containing the device address, encoded on seven bits
  • USB defines different types of transfers: command transfer (for device enumeration and configuration), interrupt transfer (used to provide small information with low latency) isochronous transfer and transfer in bulk (to transfer voluminous information).
  • USB does not define a way to easily handle connection errors. According to the prior art, the host affects the bit rate of the USB connection when the device is connected. None is planned when, following a fault during the connection phase, a High Speed device is initialized in Full Speed. It stays in Full Speed until it is cut off.
  • the user is then forced to disconnect the device and reconnect it to reset the communication.
  • the invention therefore aims to remedy the aforementioned problems. It proposes more precisely for this purpose electronic equipment comprising a host controller (1 1) capable of controlling at least one serial universal communication port, adapted to be connected to a plurality of peripherals (12, 13) characterized in that the controller host (1 1) comprises: means for establishing a connection, at a predetermined rate, with a peripheral (12, 13) connected to the communication port, means for measuring the bit rate between the host controller (1 1 ) and the device (12) and signal an error if the measured flow rate is lower than the predetermined flow rate,
  • the invention provides robustness when connecting a device and makes it possible to make several attempts in High Speed then in Full Speed rather than losing communication at the first error.
  • the means for establishing a new connection with the device comprise a finite state machine.
  • the finite state machine comprises at least four states:
  • a fourth state corresponding to a communication with a degraded bit rate between the host and the peripheral.
  • the finite state machine further comprises a fifth state, corresponding to a termination of the connection between the host and the device.
  • the finite state machine goes from the first state to the third state after at least one connection failure at the nominal flow rate.
  • the finite state machine goes from the third state to the fifth state after at least one degraded flow connection failure.
  • the host has as many automata as peripherals connected to it.
  • the finite state machine goes from the third state to the first state after the lapse of a first delay time.
  • the finite state machine goes from the fourth state to the first state after the expiration of a second delay time.
  • the invention also relates to a vehicle comprising a device according to the invention.
  • FIG. 1 shows a schematic view of a network
  • FIG. 2 shows a representation of an automaton describing the operation of a supervisor according to the invention.
  • Figure 1 shows a schematic view of a network.
  • the network connects a host computer 1 1 to a first peripheral 12 and a second peripheral 13 via a USB link.
  • the number of devices is limited to two. But it is not beyond the scope of the invention by changing the number of network devices.
  • the host computer 1 1 is a motor vehicle calculator. But the invention is not limited to this embodiment. Indeed, it concerns any computer having a USB connector and a USB host controller.
  • the first device 12 is also a motor vehicle calculator. But the invention is not limited to this embodiment. Indeed, it concerns any computer having a USB connector and a peripheral USB controller.
  • the second device 13 is for example a storage device (hard disk type).
  • the means for establishing a new connection with the device comprise a finite state machine comprising the following states: a first state 21 "HS_Connect” corresponding to a connection attempt in High Speed (or bit rate) nominal) of the host 1 1 to the device 12; a second state 22 “HS_MODE” corresponding to a connection established in High Speed between the host 1 1 and the device 12; a third state 23 "FS_Connect” corresponding to a connection attempt in Full Speed (or degraded rate) of the host 1 1 to the device 12; a fourth state 24 "FS_MODE” corresponding to a connection established in Full Speed between the host 1 1 and the device 12 a fifth state "Error” corresponding to a stop attempts to reconnect the host 1 1 to the device 12.
  • the host 1 1 comprises as many automata 20 as peripherals 12,13 connected to it.
  • the controller of the host 1 1 enters the first state 21 "HS_Connect”.
  • the host 1 1 makes an attempt to connect in High Speed with the device 12.
  • the host 1 1 makes a third and last attempt.
  • the host 1 1 switches to the second state 22 "HS_MODE" and the functional communication can take place in High Speed between the host 1 1 and the device 12.
  • a network fault occurs (eg a loss of communication)
  • the host 1 1 switches to the first state 21 "HS_Connect” , to make up to three new high speed reconnection attempts.
  • the host 1 1 makes a third and last attempt. In case of failure on the third attempt, the host 11 switches to the fifth state "Error".
  • the host 1 1 switches to the fourth state 24 "FS_MODE" and the functional communication can take place in full speed between the host 1 1 and the device 12.
  • the host 1 1 when the host 1 1 is in the third state 23 "FS_Connect", it can switch in the first state 21 "HS_Connect” for example after the lapse of a first delay time for example, one minute.
  • the host 11 when the host 11 is in the fourth state 24 "FS_MODE", it can switch to the first state 21 "HS_Connect” for example after the lapse of a second period of time. delay, for example one minute.
  • the host 11 when the host 11 is in the fifth state "Error", it can switch to the third state 23 "FS_Connect” or in the first state 21 "HS_Connect” for example after the flow of a third time delay, for example one minute.
  • the number of repetitions for connection attempts is set to three. This is a non-limiting example. Indeed, this number can be lower or higher.

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Abstract

Dispositif de gestion d'erreurs sur un bus universel série L'invention concerne un équipement électronique comportant un contrôleur hôte (11) apte à contrôler au moins un port de communication universel série, apte à être connecté à une pluralité de périphériques (12, 13) caractérisé en ce que le contrôleur hôte (11) comporte : - des moyens d'établissement d'une connexion, selon un débit prédéterminé, avec un périphérique (12) connecté au port de communication, - de moyens de mesure du débit entre le contrôleur hôte (11) et le périphérique (12) et signaler une erreur si le débit mesuré est inférieur au débit prédéterminé, - des moyens d'établissement d'une nouvelle connexion avec le périphérique (12) selon le débit prédéterminé lorsque les moyens de mesure signalent une erreur.

Description

Dispositif de gestion d'erreurs sur un bus universel série
L'invention concerne la transmission de données sur un bus série et plus particulièrement, la gestion d'erreurs lors d'une transmission.
Le bus universel en série (ou USB pour Universal Sériai Bus en anglais) est un bus informatique en transmission série servant à connecter des périphériques informatiques (aussi appelé USB devices en anglais) à un ordinateur (aussi appelé hôte ou USB host en anglais).
L'USB est décliné en plusieurs versions permettant chacune de communiquer selon une pluralité de modes.
La première version du bus USB permet communiquer selon deux modes : un mode lent (ou « Low Speed » dont le débit est de 1 ,5 Mbit/s) ou un mode rapide (« Full Speed » dont le débit est de 12 Mbit/s) :
La deuxième version du bus USB comporte en outre un troisième mode (appelé « High Speed » dont le débit est de 480 Mbit/s).
Le bus USB fonctionne sur la base d'un anneau à jeton (ou Token Ring) avec lequel chaque nœud du réseau dispose successivement du bus.
La bande passante est partagée temporellement entre tous les périphériques connectés. Le temps est subdivisé en trames (frames) ou microtrames (microframes) pendant lesquels plusieurs transferts peuvent avoir lieu.
La communication entre l'hôte et les périphériques se fait selon un protocole basé sur l'interrogation successive de chaque périphérique par l'hôte. Lorsque l'hôte désire communiquer avec un périphérique, il émet un jeton (un paquet de données, contenant l'adresse du périphérique, codée sur sept bits) désignant un périphérique. Si le périphérique reconnaît son adresse dans le jeton, il envoie un paquet de données en réponse.
L'USB définit différents types de transferts : le transfert de commande (pour l'énumération et la configuration des périphériques), le transfert d'interruption (utilisé pour fournir des informations de petite taille avec une latence faible) le transfert isochrone et le transfert en masse (pour transférer des informations volumineuses).
L'USB ne définit pas de moyen permettant de gérer facilement des erreurs de connexion. Selon l'art connu, l'hôte affecte le débit de la liaison USB lors de la connexion du périphérique. Rien n'est prévu lorsque, suite à un défaut lors de la phase de connexion, un périphérique High Speed est initialisé en Full Speed. Celui-ci reste en Full Speed jusqu'à sa coupure d'alimentation.
L'utilisateur est alors obligé de déconnecter le périphérique et de le reconnecter pour réinitialiser la communication.
On connaît, par le document US2006/0236003, une méthode et un système pour contrôler une liaison USB. Cependant, cette solution ne permet pas de remédier à une erreur de connexion.
L'invention a donc pour but de remédier aux problèmes précités. Elle propose plus précisément à cet effet un équipement électronique comportant un contrôleur hôte (1 1 ) apte à contrôler au moins un port de communication universel série, apte à être connecté à une pluralité de périphériques (12, 13) caractérisé en ce que le contrôleur hôte (1 1 ) comporte : des moyens pour d'établissement d'une connexion, selon un débit prédéterminé, avec un périphérique (12, 13) connecté au port de communication, des moyens de mesure du débit entre le contrôleur hôte (1 1 ) et le périphérique (12) et signaler une erreur si le débit mesuré est inférieur au débit prédéterminé,
des moyens d'établissement d'une nouvelle connexion avec le périphérique selon le débit prédéterminé lorsque les moyens de mesure signalent une erreur.
L'invention apporte de la robustesse lors la connexion d'un périphérique et permet d'effectuer plusieurs tentatives en High Speed puis en Full Speed plutôt que de perdre la communication dès la première erreur.
Avantageusement, les moyens d'établissement d'une nouvelle connexion avec le périphérique comportent un automate à états finis. Avantageusement, l'automate à états finis comporte au moins quatre états :
- un premier état correspondant à une initialisation de la communication, avec un débit nominal, entre l'hôte et un périphérique,
- un deuxième état, correspondant à une communication, avec un débit nominal, entre l'hôte et le périphérique,
- un troisième état, correspondant à une initialisation de la communication, avec un débit dégradé, entre l'hôte et un périphérique,
- un quatrième état, correspondant à une communication avec un débit dégradé entre l'hôte et le périphérique.
Avantageusement, l'automate à états finis comporte en outre un cinquième état, correspondant à un arrêt de la connexion entre l'hôte et le périphérique.
Avantageusement, l'automate à états finis passe du premier état au troisième état après au moins un échec de connexion au débit nominal.
Avantageusement, l'automate à états finis passe du troisième état au cinquième état après au moins un échec de connexion au débit dégradé.
Avantageusement, l'hôte comporte autant d'automates que de périphériques connectés à lui.
Avantageusement, l'automate à états finis passe du troisième état au premier état après l'écoulement d'une première durée de temporisation.
Avantageusement, l'automate à états finis passe du quatrième état au premier état après l'écoulement d'une deuxième durée de temporisation.
L'invention concerne aussi un véhicule comportant un dispositif selon l'invention.
D'autres caractéristiques et avantages de l'invention apparaîtront à l'examen de la description détaillée ci-après, et des dessins annexés, sur lesquels:
- la figure 1 montre une vue schématique d'un réseau ;
- la figure 2 montre une représentation d'un automate décrivant le fonctionnement d'un superviseur selon l'invention.
Les dessins annexés pourront non seulement servir à compléter l'invention, mais aussi contribuer à sa définition, le cas échéant.
La figure 1 montre une vue schématique d'un réseau. Le réseau relie un calculateur hôte 1 1 à un premier périphérique 12 et à un deuxième périphérique 13 par l'intermédiaire d'une liaison USB.
Dans l'exemple, le nombre de périphériques est limité à deux. Mais on ne sort pas du cadre de l'invention en modifiant le nombre de périphériques du réseau.
Dans ce qui suit, on considère à titre d'exemple non limitatif que le calculateur hôte 1 1 est un calculateur de véhicule automobile. Mais l'invention n'est pas limitée à ce mode de réalisation. En effet, elle concerne tout calculateur comportant un connecteur USB et un contrôleur USB hôte.
Dans ce qui suit, on considère à titre d'exemple non limitatif que le premier périphérique 12 est aussi un calculateur de véhicule automobile. Mais l'invention n'est pas limitée à ce mode de réalisation. En effet, elle concerne tout calculateur comportant un connecteur USB et un contrôleur USB périphérique.
Le deuxième périphérique 13 est par exemple un périphérique de stockage (de type disque dur).
En référence à la figure 2, les moyens d'établissement d'une nouvelle connexion avec le périphérique comportent un automate à états finis comprenant les états suivants : un premier état 21 « HS_Connect » correspondant à une tentative de connexion en High Speed (ou débit nominal) de l'hôte 1 1 au périphérique 12 ; un deuxième état 22 « HS_MODE » correspondant à une connexion établie en High Speed entre l'hôte 1 1 et le périphérique 12 ; un troisième état 23 « FS_Connect » correspondant à une tentative de connexion en Full Speed (ou débit dégradé) de l'hôte 1 1 au périphérique 12 ; un quatrième état 24 « FS_MODE » correspondant à une connexion établie en Full Speed entre l'hôte 1 1 et le périphérique 12 un cinquième état 25 « Erreur » correspondant à un arrêt des tentatives de reconnexion de l'hôte 1 1 au périphérique 12.
Selon une caractéristique de l'invention, l'hôte 1 1 comporte autant d'automates 20 que de périphériques 12,13 connecté à lui.
Suite à la connexion d'un périphérique, l'automate de l'hôte 1 1 entre dans le premier état 21 « HS_Connect ».
Dans cet état, l'hôte 1 1 effectue une tentative de connexion en High Speed avec le périphérique 12.
Lorsque la tentative échoue, suite à la détection de l'erreur « ENUM_TIMEOUT », indiquant que le débit mesuré est inférieur au débit prédéterminé, l'hôte 1 1 effectue une nouvelle tentative et reste dans le premier état 21 « HS_Connect ».
En cas de nouvel échec, l'hôte 1 1 effectue une troisième et dernière tentative.
En cas d'échec lors de la troisième tentative, l'hôte 1 1 commute dans le troisième état 23 « FS_Connect ».
En cas de succès de connexion, l'hôte 1 1 commute dans le deuxième état 22 « HS_MODE » et la communication fonctionnelle peut s'opérer en High Speed entre l'hôte 1 1 et le périphérique 12.
De façon avantageuse, si un défaut réseau survient (ex : une perte de communication), pendant que l'hôte 1 1 est dans le deuxième état 22 « HS_MODE », alors l'hôte 1 1 commute dans le premier état 21 « HS_Connect », afin d'effectuer jusqu'à trois nouvelles tentatives de reconnexion en High Speed.
Dans le troisième état 23 « FS_Connect », l'hôte 1 1 effectue une tentative de connexion en Full Speed avec le périphérique 12.
Lorsque la tentative échoue, suite à la détection de l'erreur ENUM_TIMEOUT, l'hôte 1 1 effectue une nouvelle tentative et reste dans le troisième état 23 « FS_Connect ».
En cas de nouvel échec, l'hôte 1 1 effectue une troisième et dernière tentative. En cas d'échec lors de la troisième tentative, l'hôte 1 1 commute dans le cinquième état 25 « Erreur ».
En cas de succès de connexion, l'hôte 1 1 commute dans le quatrième état 24 « FS_MODE » et la communication fonctionnelle peut s'opérer en Full Speed entre l'hôte 1 1 et le périphérique 12.
Si, alors que l'hôte 1 1 est dans le quatrième état 24 « FS_MODE », un défaut réseau survient (ex : une perte de communication), l'hôte 1 1 commute dans le troisième état 23 « FS_Connect », afin d'effectuer jusqu'à trois nouvelles tentatives de reconnexion en Full Speed.
Dans le cinquième état 25 « Erreur », la connexion avec le périphérique 12 est désactivée, et plus aucune communication n'est possible entre l'hôte 1 1 et le périphérique 12.
Dans une variante de réalisation de l'invention, quand l'hôte 1 1 est dans le troisième état 23 « FS_Connect », il peut commuter dans le premier état 21 « HS_Connect » par exemple après l'écoulement d'une première durée de temporisation, par exemple d'une minute.
Dans une autre variante de réalisation de l'invention, quand l'hôte 1 1 est dans le quatrième état 24 « FS_MODE », il peut commuter dans le premier état 21 « HS_Connect » par exemple après l'écoulement d'une deuxième durée de temporisation, par exemple d'une minute.
Dans une autre variante de réalisation de l'invention, quand l'hôte 1 1 est dans le cinquième état 25 « Erreur », il peut commuter dans le troisième état 23 « FS_Connect » ou dans le premier état 21 « HS_Connect » par exemple après l'écoulement d'une troisième durée de temporisation, par exemple d'une minute.
Dans cet exemple, le nombre de répétition pour les tentatives de connexion est fixé à trois. Il s'agit d'un exemple non limitatif. En effet, ce nombre peut être inférieur ou supérieur.

Claims

REVENDICATIONS
1 . Equipement électronique comportant un contrôleur hôte (1 1 ) apte à contrôler au moins un port de communication universel série, apte à être connecté à une pluralité de périphériques (12, 13) caractérisé en ce que le contrôleur hôte (1 1 ) comporte :
- des moyens d'établissement d'une connexion, selon un débit prédéterminé, avec un périphérique (12) connecté au port de communication,
- de moyens de mesure du débit entre le contrôleur hôte (1 1 ) et le périphérique (12) et signaler une erreur si le débit mesuré est inférieur au débit prédéterminé,
- des moyens d'établissement d'une nouvelle connexion avec le périphérique (12) selon le débit prédéterminé lorsque les moyens de mesure signalent une erreur.
2. Equipement électronique selon la revendication 1 , caractérisé en ce que les moyens d'établissement d'une nouvelle connexion avec le périphérique comportent un automate (20) à états finis.
3. Equipement électronique selon la revendication 2, caractérisé en ce que l'automate (20) à états finis comporte au moins quatre états :
- un premier état (21 ) correspondant à une initialisation de la communication, avec un débit nominal, entre l'hôte (1 1 ) et un périphérique (12),
- un deuxième état (22), correspondant à une communication, avec un débit nominal, entre l'hôte (1 1 ) et le périphérique (12),
- un troisième état (23), correspondant à une initialisation de la communication, avec un débit dégradé, entre l'hôte (1 1 ) et un périphérique (12),
- un quatrième état (24), correspondant à une communication avec un débit dégradé entre l'hôte (1 1 ) et le périphérique (12).
4. Equipement électronique selon l'une des revendications 2 ou 3, caractérisé en ce que l'automate (20) à états finis comporte en outre un cinquième état (25), correspondant à un arrêt de la connexion entre l'hôte (1 1 ) et le périphérique (12).
5. Equipement électronique selon l'une des revendications 2 ou 3, caractérisé en ce que l'hôte (1 1 ) comporte autant d'automates (20) que de périphériques (12,13) connectés à lui.
6 Véhicule comportant un équipement électronique selon l'une des revendications précédentes.
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